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WO2013145022A1 - 炭化珪素半導体装置の製造方法 - Google Patents

炭化珪素半導体装置の製造方法 Download PDF

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Publication number
WO2013145022A1
WO2013145022A1 PCT/JP2012/002223 JP2012002223W WO2013145022A1 WO 2013145022 A1 WO2013145022 A1 WO 2013145022A1 JP 2012002223 W JP2012002223 W JP 2012002223W WO 2013145022 A1 WO2013145022 A1 WO 2013145022A1
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WO
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silicon carbide
semiconductor device
oxide film
manufacturing
region
Prior art date
Application number
PCT/JP2012/002223
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English (en)
French (fr)
Inventor
慶亮 小林
峰　利之
浩孝 濱村
Original Assignee
株式会社日立製作所
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
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Priority to PCT/JP2012/002223 priority patent/WO2013145022A1/ja
Priority to US14/381,597 priority patent/US20150044840A1/en
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Definitions

  • SiC-MOSFET A general manufacturing method of this SiC-MOSFET will be described. First, an SiC epitaxial layer is formed on a SiC substrate, and an impurity serving as a dopant is ion-implanted into a drain region, a base region, and a source region. Next, activation annealing is performed on the implanted impurities. At the time of annealing, for example, a carbon film having excellent heat resistance is deposited as a cap material so that Si of the SiC substrate does not sublime, and heat treatment is performed at a temperature of 1600 ° C. or higher.
  • the carbon layer of the cap material is removed by oxygen plasma ashing or heat treatment at, for example, about 900 ° C., in which the SiC substrate is hardly oxidized in an oxygen atmosphere.
  • the cap material and the substrate react and the formed carbon compound cannot be completely removed.
  • This carbon compound causes deterioration of the reliability of the gate insulating film. Therefore, the interface that forms the gate insulating film is thermally oxidized at a high temperature to form a silicon oxide film (sacrificial oxide film), and then the silicon oxide film is removed with diluted hydrofluoric acid, so-called sacrificial oxidation is performed.
  • a method for removing the carbon compound is generally used.
  • a SiC-MOSFET is completed through a gate insulating film process, a silicide electrode process, and an interlayer insulating film forming process.
  • the threshold voltage (V th ) of the current Si-IGBT is about 5 to 5.5 V, and a threshold voltage (V th ) of 5 V or more is required to replace this with SiC-MOSFET.
  • V th threshold voltage
  • Non-Patent Document 1 there is a method in which a deposited oxide film is applied to a gate oxide film to perform an oxynitriding process (Non-Patent Document 1).
  • the channel mobility is improved, but Vth is lowered.
  • Vth is increased by performing plasma oxidation instead of high-temperature thermal oxidation. That is, by replacing the conventional sacrificial oxidation by thermal oxidation with plasma oxidation, Vth of 5 V or more can be obtained without reducing the channel mobility of the SiC-MOSFET.
  • a silicon carbide substrate is oxidized by a low-temperature oxidation method typified by plasma oxidation to form a silicon oxide film.
  • the silicon oxide film is removed.
  • a gate insulating film is formed.
  • FIG. 1 is a cross sectional view of a silicon carbide semiconductor device in Example 1.
  • FIG. FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1.
  • FIG. 6 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 1. It is a figure which shows the gate voltage dependence of the drain current of the silicon carbide semiconductor device in Example 1 with a comparative example.
  • FIG. 10 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 2.
  • FIG. 10 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 2.
  • FIG. 10 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 2.
  • FIG. 10 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 2.
  • FIG. 10 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 2.
  • FIG. 10 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 2.
  • FIG. 10 is a cross sectional view showing a part of the process for manufacturing the silicon carbide semiconductor device in Example 2.
  • sacrificial oxidation the process of forming a silicon oxide film by oxidizing the interface that forms the gate insulating film, removing the silicon oxide film with diluted hydrofluoric acid, and repeating the above process one or more times is referred to as “sacrificial oxidation”. Call it.
  • Example 1 and Example 2 describe a silicon carbide semiconductor device having a so-called MOS (Metal-Oxide-Semiconductor) structure as shown in FIGS.
  • MOS Metal-Oxide-Semiconductor
  • FIG. 1 and 6 show application examples to a semiconductor device having a MOS structure.
  • FIG. 1 shows a structure in which a source 23 and a drain 24 are arranged in a direction parallel to the substrate surface (hereinafter referred to as a lateral MOS), and
  • FIG. 6 shows a source 23 and a drain 26 arranged in a direction perpendicular to the substrate surface (hereinafter referred to as a vertical MOS). Structure.
  • a silicon carbide MOSFET which is a silicon carbide semiconductor device includes a silicon carbide substrate 10, a silicon carbide layer 20 formed on silicon carbide substrate 10, an insulating film 32 formed on silicon carbide layer 20, Gate electrode 42 formed on insulating film 32, and source electrode 51, drain electrode 52, and base contact electrode 53 formed on silicon carbide layer 20 are included.
  • the silicon carbide layer 20 is formed of a silicon carbide epitaxial layer 21, a base region 22 that is an ion implantation region or an epitaxial layer, a source region 23 that is an ion implantation region, a drain region 24, and a base contact region 25.
  • N nitrogen
  • B boron
  • Al aluminum
  • a gate insulating film 32 On the surface of the silicon carbide layer 20, a gate insulating film 32, a source electrode 51, a drain electrode 52, and a base contact electrode 53 are formed.
  • the source electrode 51, the drain electrode 52, and the base contact electrode 53 are connected to the source region 23, the drain region 24, and the base contact region 25, respectively.
  • a gate electrode 42 is formed so as to cover a part of the source region 23 and the drain region 24 via the gate insulating film 32 on the silicon carbide layer 20.
  • Al ions were implanted into the surface layer portion of the silicon carbide epitaxial layer 21 to form a p-type base region 22.
  • the ions implanted into base contact region 25 may be B ions, or a p-type silicon carbide epitaxial layer may be further formed on silicon carbide epitaxial layer 21 to form p-type base region 22.
  • a carbon film 60 was deposited around the silicon carbide substrate 10 and the silicon carbide layer 20 as a cap material for impurity activation annealing.
  • impurity activation annealing is performed at a temperature of 1600 to 1800 ° C., for example. In this example, impurity activation annealing was performed at 1700 ° C. for 60 seconds.
  • the carbon layer of the cap material was removed by oxygen plasma ashing.
  • sacrificial oxidation by plasma oxidation was performed.
  • the surface of the silicon carbide layer 20 is plasma-oxidized to form an oxide film 31.
  • the oxide film 31 is removed with diluted hydrofluoric acid. The above process, so-called sacrificial oxidation process, is repeated one or more times.
  • the sacrificial oxidation step if the removal thickness of the silicon carbide layer 20 is thin, the carbon compound cannot be removed, and if it is thick, the impurity concentration in the ion implantation region is affected, so that the thickness is preferably 3 nm to 30 nm.
  • the source region 23, the drain region 24, the base contact region 25, and the silicon carbide epitaxial layer 21 which are ion implantation regions have different oxidation rates.
  • a step is generated at the interface of 32. This level difference leads to device characteristic deterioration such as electric field concentration on the gate insulating film.
  • the oxide film 31 is formed by plasma oxidation using an ICP (Inductive-Coupled-Plasma) method at a temperature of 500 ° C. or lower.
  • ICP Inductive-Coupled-Plasma
  • the above-described process, so-called sacrificial oxidation was repeatedly performed so that the thickness of the silicon carbide layer 20 removed by sacrificial oxidation was, for example, 10 nm.
  • the gate material film 41 was etched using the resist as a mask to form a gate electrode 42 of the MOS transistor.
  • FIGS. 3 to 5 show specifications using plasma oxidation for sacrificial oxidation (hereinafter abbreviated as plasma oxidation specifications) and specifications using conventional thermal oxidation for sacrificial oxidation (hereinafter abbreviated as thermal oxidation specifications). ) SiC-MOSFET device evaluation results are shown.
  • FIG. 3 shows the gate voltage dependency (I d V g characteristic) of the drain current of the silicon carbide semiconductor device in Example 1.
  • “Thermal Oxidation” uses a thermal oxide film
  • “Plasma Oxidation” is a characteristic line when a plasma oxide film is used.
  • the Vth of the plasma oxidation specification was higher than the thermal oxidation specification.
  • FIG. 4 shows the gate voltage dependence of the channel mobility ⁇ of the silicon carbide semiconductor device in Example 1.
  • “Thermal Oxidation” uses a thermal oxide film
  • “Plasma Oxidation” is a characteristic line when a plasma oxide film is used.
  • the horizontal axis of FIG. 4 is a value obtained by subtracting the gate threshold voltage Vth from the gate voltage Vg.
  • FIG. 5 shows a table summarizing the values of Vth and channel mobility ⁇ .
  • “Thermal Oxidation” is data when a thermal oxide film is used
  • “Plasma Oxidation” is data when a plasma oxide film is used.
  • the channel mobility is almost the same as in the thermal oxidation specification, and V th is about 2.3 V higher.
  • the conventional sacrificial oxide film by thermal oxidation is replaced with a plasma oxide film without changing the channel mobility of the SiC-MOSFET (same as the thermal oxide film). It can be seen that Vth can be increased by maintaining a certain degree of mobility.
  • silicon carbide MOSFET which is a silicon carbide semiconductor device is formed on silicon carbide substrate 10, back contact region 26 which is an ion implantation region formed inside silicon carbide substrate 10, and back contact region 26.
  • a source-base contact common electrode 55 formed on the silicon carbide layer 20.
  • Silicon carbide layer 20 is formed of a silicon carbide epitaxial layer 21, a base region 22 that is an ion implantation region, and a source region 23.
  • N nitrogen
  • B boron
  • Al aluminum
  • a gate insulating film 32 and a source-base contact common electrode 55 are formed on the surface of the silicon carbide layer 20.
  • a drain electrode 54 is formed on the back surface of the silicon carbide layer 20.
  • the source base contact common electrode 55 is connected to the base region 22 and the source region 23.
  • the drain electrode 54 is connected to the back contact region 26.
  • a gate electrode 40 is formed so as to cover a part of the n-type source region 23 via the gate insulating film 32 on the silicon carbide layer 20.
  • annealing for impurity activation is performed at a temperature of 1600 to 1800 ° C., for example. It was.
  • the carbon layer of the cap material was removed by oxygen plasma ashing.
  • sacrificial oxidation by plasma oxidation was performed as shown in FIG. Specifically, after performing predetermined cleaning, the surface of the silicon carbide layer 20 is subjected to plasma oxidation to form an oxide film 31, and the oxide film 31 is removed with diluted hydrofluoric acid.
  • the front surface is oxidized and the back surface is also oxidized.
  • the ion implantation has to be performed in consideration of the thickness removed by the sacrificial oxidation when the ion implantation is performed on the back contact region 26.
  • sacrificial oxidation by the plasma oxidation there is almost no oxidation on the back surface. Therefore, there is no need to consider removal by sacrificial oxidation when ion implantation is performed on the back contact region 26, and it is sufficient to perform ion implantation at a concentration at which contact with the electrode is desired in the vicinity of the outermost surface of the back surface. This effect facilitates making good contact with the electrode.
  • a gate oxide film 32 is formed on the semiconductor substrate.
  • a deposited oxide film having a thickness of 50 nm was formed, and oxynitriding was performed at 1300 ° C. for 30 minutes.
  • a gate material film 41 was deposited, and the gate material film 41 was etched to form a gate electrode 42 of the MOS transistor.
  • a through hole is formed at the boundary between the base region 22 and the source region 23, and the source base contact is made to the boundary between the base region 22 and the source region 23 and the back contact region 26, respectively.
  • a process for forming a contact for the common electrode 55 and the drain electrode 54 (including a silicidation process) and a process for forming a wiring are performed to complete the semiconductor device of FIG.
  • SYMBOLS 10 Silicon carbide substrate, 20 ... Silicon carbide layer, 21 ... Silicon carbide epitaxial layer, 22 ... Base region, 23 ... Source region, 24 ... Drain region, 25 ... Base contact region, 26 ... Back contact region, 31 ... Sacrificial oxidation Films 32... Gate insulating film 41. Gate material film 42. Gate electrode 51. Source electrode 52. Drain electrode 53. Base contact electrode 54. Drain electrode 55 55 Source-base contact common electrode 60. Carbon film

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Abstract

　チャネル移動度を低下させることなく、Vthを高くすることが出来るSiC-MOSFET製造方法を提供するために、ゲート絶縁膜を形成する前に、（ａ）炭化珪素基板を、プラズマ酸化に代表される低温酸化法で酸化して、シリコン酸化膜を形成する。次いで（ｂ）前記シリコン酸化膜の除去をする。前記（ａ）及び（ｂ）の工程を一回以上繰り返した後、（ｃ）ゲート絶縁膜を形成する。

Description

炭化珪素半導体装置の製造方法
　本発明は、炭化珪素半導体装置の製造方法で用いる犠牲酸化膜に関するものである。
　このSiC-MOSFETの一般的な製造方法について説明する。まず、SiC基板上にSiCのエピタキシャル層を形成し、ドレイン領域、ベース領域、ソース領域にドーパントとなる不純物をイオン注入する。次にイオン注入した不純物を活性化アニールする。アニール時には、SiC基板のSiが昇華しないようにキャップ材として、例えば耐熱性に優れた炭素膜を堆積させ、1600℃以上の温度で熱処理する。その後、キャップ材の炭素層を酸素プラズマアッシングや酸素雰囲気中でSiC基板が殆ど酸化されない、例えば900℃前後の熱処理により除去する。しかし、キャップ材と基板が反応し、形成される炭素化合物を完全には除去しきれない。この炭素化合物は、ゲート絶縁膜信頼性の劣化要因となる。そのため、ゲート絶縁膜を形成する界面を高温で熱酸化し、シリコン酸化膜（犠牲酸化膜）を形成した後、そのシリコン酸化膜を希釈フッ酸で除去する、いわゆる犠牲酸化を行うことで、反応した炭素化合物を除去する方法が一般に用いられている。その後、ゲート絶縁膜工程、シリサイド電極工程、層間絶縁膜形成工程を経てSiC-MOSFETが完成する。
　このように形成されるSiC-MOSFETの多くはVthが低く、ノーマリーオンとなる。しかし、現状のSi-IGBTの閾値電圧(Vth)は約5～5.5Vであり、これをSiC-MOSFETで置き換えるためには5V以上の閾値電圧(Vth)が要求される。Vthを高くする手段として、例えば、チャネルが形成されるベース領域のドーパント濃度を濃くする方法がある。
　一方、低損失なデバイスを実現するためには移動度を向上させて、オン抵抗を低くすることが重要である。しかし、現状のSiC-MOSFETでは、シリコン酸化膜/炭化珪素のいわゆるMOS界面に多数の界面準位が存在するため、チャネル移動度が低くなる。そのため、MOS界面特性を向上させ、チャネル移動度を高くする必要がある。チャネル移動度を高くする手段として、例えば、ゲート酸化膜に堆積酸化膜を適用して、酸窒化処理をする方法がある(非特許文献１)。
M. Noborio, J. Suda, S. Beljakowa, M. Krieger, and T. Kimoto, phys. stat. sol. (a) 206, 2374 (2009)
　しかしながら、上記方法でVthやチャネル移動度を高くした場合には以下に説明する技術課題が存在する。
　Vthを高くするために、チャネルが形成されるベース領域のドーパント濃度を濃くする方法では、Vthは高く出来るが、高い不純物濃度の影響でチャネル移動度が低下してしまう。
　チャネル移動度を向上させるために、ゲート酸化膜に堆積酸化膜を適用して、酸窒化処理をする方法では、チャネル移動度は向上するが、Vthが低下してしまう。
　本発明の目的は、高いチャネル移動度と高いＶｔｈを両立したＳｉＣ-ＭＯＳＦＥＴを提供することである。
　我々はゲート絶縁膜を形成する前の犠牲酸化工程を色々と検討した結果、高温の熱酸化の代わりに、プラズマ酸化を行うことでVthが高くなることを見出した。すなわち、従来の熱酸化による犠牲酸化をプラズマ酸化に置き換えることでSiC-MOSFETのチャネル移動度を低下させることなく、5V以上のVthを得ることが出来る。
　本願において開示される発明のうち、代表的なものの概要を簡単に説明すれば、次のとおりである。
　すなわち、本発明による半導体装置の製造方法は、ゲート絶縁膜を形成する前に、（ａ）炭化珪素基板を、プラズマ酸化に代表される低温酸化法で酸化して、シリコン酸化膜を形成する。次いで（ｂ）前記シリコン酸化膜の除去をする。前記（ａ）及び（ｂ）の工程を一回以上繰り返した後、（ｃ）ゲート絶縁膜を形成する。
　本発明によれば、高いチャネル移動度と高いＶｔｈを両立したＳｉＣ-ＭＯＳＦＥＴを提供することである。
実施例１における炭化珪素半導体装置の断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例１における炭化珪素半導体装置のドレイン電流のゲート電圧依存性を、比較例とともに示す図である。 実施例１における炭化珪素半導体装置のチャネル移動度のゲート電圧依存性を、比較例とともに示す図である。 実施例１における炭化珪素半導体装置のチャネル移動度のピーク値とゲート閾値電圧との関係を、比較例とともに示す表である。 実施例２における炭化珪素半導体装置の断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。 実施例２における炭化珪素半導体装置の製造工程の一部を示す断面図である。
　以下、本発明の実施例を図面に基づいて詳細に説明する。
　なお、実施例を説明するための全図において、同一部材には原則として同一の符号を付し、その繰り返しの説明は省略する。特に異なる実施例間で機能が対応するものについては、形状、不純物濃度や結晶性等で違いがあっても同じ符号を付すこととする。
　以下では、ゲート絶縁膜を形成する界面に対して酸化を行ってシリコン酸化膜を形成し、そのシリコン酸化膜を希釈フッ酸で除去し、上記処理を一回以上繰り返す工程を「犠牲酸化」と呼称する。
　実施例1と実施例2では、図１と図６に示すような、いわゆるＭＯＳ（Metal-Oxide-Semiconductor）構造を備えた炭化珪素半導体装置について説明する。
　図１と図６にＭＯＳ構造を備えた半導体装置への適用例を示す。図１はソース２３とドレイン２４を基板表面と平行な方向に配置した（以下、横ＭＯＳ）構造、図６はソース２３とドレイン２６を基板表面と垂直な方向に配置した（以下、縦ＭＯＳ）構造である。
　［横ＭＯＳ構造］
　図１において、炭化珪素半導体装置である炭化珪素ＭＯＳＦＥＴは、炭化珪素基板１０と、炭化珪素基板１０上に形成された炭化珪素層２０と、炭化珪素層２０上に形成された絶縁膜３２と、絶縁膜３２上に形成されたゲート電極４２と、炭化珪素層２０上に形成されたソース電極５１およびドレイン電極５２およびベースコンタクト電極５３とを有する。
　炭化珪素層２０は、炭化珪素エピタキシャル層２１と、イオン注入領域またはエピタキシャル層であるベース領域２２と、イオン注入領域であるソース領域２３とドレイン領域２４とベースコンタクト領域２５から形成される。
　ここで、ｎ型としたい領域へ注入する不純物は、例えば窒素(Ｎ)イオンを、ｐ型としたい領域へ注入する不純物は、例えばボロン(Ｂ)またはアルミニウム(Ａｌ)イオンを用いる。図１(a)ではｐ型のベース領域２２の内部に、トランジスタのソース領域２３とドレイン領域２４となるｎ+領域とｐ+型のベースコンタクト領域２５が形成されている。
　炭化珪素層２０の表面には、ゲート絶縁膜３２とソース電極５１とドレイン電極５２とベースコンタクト電極５３が形成されている。
　ソース電極５１、ドレイン電極５２、ベースコンタクト電極５３はそれぞれソース領域２３、ドレイン領域２４、ベースコンタクト領域２５と接続されている。
　炭化珪素層２０上のゲート絶縁膜３２を介して、ソース領域２３およびドレイン領域２４の一部を覆うように、ゲート電極４２が形成されている。
　［横ＭＯＳ構造の製造方法］
　次に上記横MOS構造の製造方法について説明する。
　図２(a)から図２(k)は、本実施例１の横ＭＯＳトランジスタを製造する際の各工程における断面図である。なお、前記断面図は、煩雑さを避けるため、当該工程における主要部位の構成のみを示すもので、正確な断面図には相当しない。 
　まず、図２(a)に示すように、n型炭化珪素基板１０の上に炭化珪素エピタキシャル層２１を積層した。
　次に、図２(b)に示すように、炭化珪素エピタキシャル層２１の表層部に、Ａｌイオンを注入し、ｐ型ベース領域２２を形成した。なお、ベースコンタクト領域２５に注入するイオンはBイオンでも良く、炭化珪素エピタキシャル層２１の上にｐ型の炭化珪素エピタキシャル層をさらに成膜してｐ型ベース領域２２としてもよい。
　次に、ソース領域２３、ドレイン領域２４にイオン注入するためにマスクをして、図２(c)に示すように、ソース領域２３、ドレイン領域２４に、Ｎイオンを注入した。その後、上記マスクを除去した。
　次に、ベースコンタクト領域２５にイオン注入するためにマスクをして、図２(d)に示すように、ベースコンタクト領域２５に、Ａｌイオンを注入した。なお、ベースコンタクト領域２５に注入するイオンはBイオンでも良い。その後、上記マスクを除去した。
　続いて、図２(e)に示すように、炭化珪素基板１０および炭化珪素層２０の周囲に不純物活性化アニールのキャップ材として炭素膜６０を堆積させた。その後、例えば1600から1800℃の温度で不純物活性化アニールを行う。本実施例では不純物活性化アニールを1700℃で60秒間行った。
　次に、図２(f)に示すように、キャップ材の炭素層を酸素プラズマアッシングにより除去した。この時、キャップ材の炭素と基板が反応して形成された炭素化合物を完全には除去しきれないため、プラズマ酸化による犠牲酸化を行った。具体的には、所定の洗浄を行った後、図２(g)に示すように、炭化珪素層２０の表面をプラズマ酸化して、酸化膜３１を形成する。そして、その後酸化膜３１を希釈フッ酸によって除去する。上記工程、いわゆる犠牲酸化工程を、１回以上繰り返し行う。犠牲酸化工程において炭化珪素層２０の除去厚さが、薄いと前記炭素化合物を除去しきれず、厚いとイオン注入領域の不純物濃度に影響が出るため3nm～30nmが好ましい。従来の熱酸化を用いる犠牲酸化工程では、イオン注入領域であるソース領域２３とドレイン領域２４とベースコンタクト領域２５と炭化珪素エピタキシャル層２１ではそれぞれ酸化レートが異なるため、炭化珪素層２０とゲート酸化膜３２の界面に段差が生じる。この段差はゲート絶縁膜に対する電界集中等のデバイス特性劣化に繋がる。本発明のプラズマ酸化を用いる手法では段差の無い均一な界面を形成することが出来、良好なデバイス特性が得られる。本実施例では、前記酸化膜３１の形成に500℃以下の温度でICP(Inductive Coupled Plasma)法によるプラズマ酸化を用いた。本実施例では、上記工程、いわゆる犠牲酸化を繰り返し行い、犠牲酸化によって炭化珪素層２０の除去された厚さが、例えば10nmになるようにした。
　次に、図２(h)に示すように、前記半導体基板上にゲート酸化膜３２を形成する。本実施例では厚さ50nmの堆積酸化膜を形成し、酸窒化処理を1300℃で30分間行った。
　続いて、図２(i)に示すように、厚さ200ｎｍのｎ型多結晶シリコン膜からなるゲート材料膜４１を堆積した。
　続いて、図２(j)に示すように、レジストをマスクにゲート材料膜４１をエッチングし、ＭＯＳトランジスタのゲート電極４２を形成した。
　続いて、図２(k)に示すように、ソース領域２３、ドレイン領域２４、ベースコンタクト領域２５の上に位置するゲート材料膜にスルーホールを形成し、ソース領域２３、ドレイン領域２４、ベースコンタクト領域２５へ、それぞれ、ソース電極５１、ドレイン電極５２、ベースコンタクト電極５３のコンタクトを形成する工程（シリサイド化工程も含む）、配線を形成する工程を行い図１の半導体装置が完成する。
　［SiC-MOSFETのデバイス評価］
　図３～５に、犠牲酸化にプラズマ酸化を用いた仕様（以下、プラズマ酸化仕様と略す。）と、参考として犠牲酸化に従来の熱酸化法を用いた仕様（以下、熱酸化仕様と略す。）のSiC-MOSFETのデバイス評価結果を示す。
　図３に実施例１における炭化珪素半導体装置のドレイン電流のゲート電圧依存性(IdVg特性)を示す。「Thermal Oxidation」が熱酸化膜を用いた場合、「Plasma Oxidation」がプラズマ酸化膜を用いた場合の特性線である。図３に示すように、プラズマ酸化仕様のVthは熱酸化仕様よりも高くなった。具体的に示すと、熱酸化仕様はVth=4.3Vでありプラズマ酸化仕様はVth=6.6Vと、プラズマ酸化仕様の方が約2.3V高くなった。
　図４に実施例１における炭化珪素半導体装置のチャネル移動度μのゲート電圧依存性を示す。「Thermal Oxidation」が熱酸化膜を用いた場合、「Plasma Oxidation」がプラズマ酸化膜を用いた場合の特性線である。図４の横軸はゲート電圧Vgからゲート閾値電圧Vthを引いた値である。図４に示すように、チャネル移動度の最大値は熱酸化仕様ではμ=21.8 ｃm2/V・sであり、プラズマ酸化仕様はμ=21.1ｃm2/V・sと、前記２仕様間での差異は殆ど無い。
　図５にVthとチャネル移動度μの値を纏めた表を示す。「Thermal Oxidation」が熱酸化膜を用いた場合、「Plasma Oxidation」がプラズマ酸化膜を用いた場合のデータである。図５を見て判るように、プラズマ酸化仕様は、熱酸化仕様に比べて、チャネル移動度は殆ど変わらずにVthが約2.3V高くなった。　このように、通常のＭＯＳトランジスタを製造する工程において、従来の熱酸化による犠牲酸化膜を、プラズマ酸化膜に置き換えることで、SiC-MOSFETのチャネル移動度を変動させることなく（熱酸化膜と同程度の移動度を保持）、Vthを高くすることが可能となることがわかる。
　また本実施例１では、ｎ型炭化珪素単結晶の半導体基板を用いたが、ｐ型炭化珪素基板を用いても良い。この場合は、ＭＯＳ構造を形成するための各領域への不純物イオン打ち込みの極性を逆にすることでＭＯＳ構造を形成することができる。
　以下は、図６に示した縦ＭＯＳ構造への適用について述べる。ただし、実施例１に示した部材と同一部材の繰り返しの説明は省略する。
　［縦MOS構造］
　図６において、炭化珪素半導体装置である炭化珪素ＭＯＳＦＥＴは、炭化珪素基板１０と、炭化珪素基板１０の内部に形成されたイオン注入領域である裏面コンタクト領域２６と、裏面コンタクト領域２６上に形成されたドレイン電極５４と、炭化珪素基板１０上に形成されたドレイン電極５４及び炭化珪素層２０と、炭化珪素層２０上に形成された絶縁膜３２と、絶縁膜３２上に形成されたゲート電極４２と、炭化珪素層２０上に形成されたソースベースコンタクト共通電極５５を有する。炭化珪素層２０は、炭化珪素エピタキシャル層２１と、イオン注入領域であるベース領域２２、ソース領域２３から形成される。
　ここで、ｎ型としたい領域へ注入する不純物は、例えば窒素（N）イオンを、ｐ型としたい領域へ注入する不純物は、例えばボロン（B）または、アルミニウム（Al）イオンを用いる。例えば図では炭化珪素基板１０の内部にｐ+型の裏面コンタクト領域２６が形成され、実施例１と同様にｎ＋型のソース領域２３が形成されている。
　炭化珪素層２０の表面には、ゲート絶縁膜３２とソースベースコンタクト共通電極５５が形成されている。炭化珪素層２０の裏面には、ドレイン電極５４が形成されている。
　ソースベースコンタクト共通電極５５はベース領域２２とソース領域２３に接続されている。ドレイン電極５４は裏面コンタクト領域２６と接続されている。
　炭化珪素層２０上のゲート絶縁膜３２を介して、ｎ型ソース領域２３の一部を覆うように、ゲート電極４０が形成されている。
　［縦MOS構造の製造方法］
　次に上記縦MOS構造の製造方法について説明する。ただし、実施例１に示した製造方法と同一の製造方法の繰り返しの詳細な説明は省略する。図７(a)から図７(j)は、本実施例２の縦ＭＯＳトランジスタを製造する際の各工程における断面図である。なお、前記断面図は、煩雑さを避けるため、当該工程における主要部位の構成のみを示すもので、正確な断面図には相当しない。 
　まず、図７(a)に示すように、炭化珪素エピタキシャル層２１を積層した。
　次に、図７(b)、図７(c)、図７(d)に示すように、ｐ型ベース領域２２とｎ型ソース領域２３と裏面コンタクト領域２６にイオンを注入した。また、注入に用いるイオン種は裏面コンタクト領域２６では、Ａｌイオンを注入し、ｐ型ベース領域２２とｎ型ソース領域２３は実施例1と同様である。なお、裏面コンタクト領域２６に注入するイオンはBイオンでも良い。
　続いて、図７(e)に示すように、炭化珪素基板１０および炭化珪素層２０の表面に炭素膜60を堆積させた後、例えば1600から1800℃の温度で不純物活性化用のアニールを行った。
　次に、キャップ材の炭素層を酸素プラズマアッシングにより除去した。この時、キャップ材の炭素と基板が反応して形成された炭素化合物を完全には除去しきれないため、図７(f)に示すように、プラズマ酸化による犠牲酸化を行った。具体的には、所定の洗浄を行った後、炭化珪素層２０の表面をプラズマ酸化して、酸化膜３１を形成し、酸化膜３１を希釈フッ酸によって除去する。また、熱酸化による犠牲酸化を用いると表面が酸化されると同時に裏面も酸化される。そのため、裏面コンタクト領域２６にイオン注入する際に犠牲酸化によって除去される厚さを考慮し、イオン注入しなければならなかった。上記プラズマ酸化による犠牲酸化を用いると、裏面の酸化が殆ど無い。従って、裏面コンタクト領域２６にイオン注入する際に犠牲酸化による除去を考慮する必要がなく、裏面の最表面付近に電極とコンタクトさせたい濃度でイオン注入すればよい。この効果により、電極と良好なコンタクトを取るのが容易となる。
　次に、図７(g)に示すように、前記半導体基板上にゲート酸化膜３２を形成する。本実施例では厚さ50nmの堆積酸化膜を形成し、酸窒化処理を1300℃で30分間行った。
　続いて、図７(h)(i)に示すように、ゲート材料膜４１を堆積し、ゲート材料膜４１をエッチングし、ＭＯＳトランジスタのゲート電極４２を形成した。
　続いて、図７(j)に示すように、ベース領域２２とソース領域２３の境界にスルーホールを形成し、ベース領域２２とソース領域２３の境界、裏面コンタクト領域２６へ、それぞれ、ソースベースコンタクト共通電極５５、ドレイン電極５４のコンタクトを形成する工程（シリサイド化工程も含む）、配線を形成する工程を行い図６の半導体装置が完成する。
　本実施例２の構成および製造方法によっても、実施例１と同様に、縦MOS構造のMOSトランジスタにおけるゲート絶縁膜下部の形成方法だけを変更することで、移動度を変動させることなく、Vthを上げることが可能である。
　１０…炭化珪素基板、２０…炭化珪素層、２１…炭化珪素エピタキシャル層、２２…ベース領域、２３…ソース領域、２４…ドレイン領域、２５…ベースコンタクト領域、２６…裏面コンタクト領域、３１…犠牲酸化膜、３２…ゲート絶縁膜、４１…ゲート材料膜、４２…ゲート電極、５１…ソース電極、５２…ドレイン電極、５３…ベースコンタクト電極、５４…ドレイン電極、５５…ソースベースコンタクト共通電極、６０…炭素膜

Claims (6)

  1. 　炭化珪素層の上にゲート酸化膜を備えた炭化珪素半導体装置の製造方法において、
    　前記炭化珪素層上にキャップ材を形成した後、アニールをする工程と、
    　前記キャップ材を除去した後に熱酸化温度よりも低温の酸化法による犠牲酸化膜を形成する工程と、
    　前記犠牲酸化膜を除去した後に、ゲート酸化膜を形成する工程とを備えた炭化珪素半導体装置の製造方法。
  2. 　請求項１において、
    　前記キャップ材は炭素膜であることを特徴とする炭化珪素半導体装置の製造方法。
  3. 　請求項２において、
    　前記キャップ材を形成する前に、不純物イオンを注入する工程を備え、
    　前記アニールは、前記不純物イオンを活性する温度以上でなされることを特徴とする炭化珪素半導体装置の製造方法。
  4. 　請求項３において、
    　前記ソース領域の不純物濃度と前記ベース領域の不純物濃度とが異なるように前記不純物イオンが注入され、
    　前記犠牲酸化膜の膜厚が3nm以上30nm以下であることを特徴とする炭化珪素半導体装置の製造方法。
  5. 　請求項２において、
    　前記犠牲酸化膜は500度以下で形成することを特徴とする炭化珪素半導体装置の製造方法。
  6. 　請求項５において、
    　前記犠牲酸化膜はプラズマ酸化で形成することを特徴とする炭化珪素半導体装置の製造方法。
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