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JP4151634B2 - SEMICONDUCTOR DEVICE AND ITS MANUFACTURING METHOD, CIRCUIT BOARD, ELECTRO-OPTICAL DEVICE, AND ELECTRONIC DEVICE - Google Patents

SEMICONDUCTOR DEVICE AND ITS MANUFACTURING METHOD, CIRCUIT BOARD, ELECTRO-OPTICAL DEVICE, AND ELECTRONIC DEVICE Download PDF

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JP4151634B2 JP2004276596A JP2004276596A JP4151634B2 JP 4151634 B2 JP4151634 B2 JP 4151634B2 JP 2004276596 A JP2004276596 A JP 2004276596A JP 2004276596 A JP2004276596 A JP 2004276596A JP 4151634 B2 JP4151634 B2 JP 4151634B2
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Description

本発明は半導体装置とその製造方法、回路基板、電気光学装置および電子機器に関するものである。   The present invention relates to a semiconductor device and a manufacturing method thereof, a circuit board, an electro-optical device, and an electronic apparatus.

表示体装置の基板上に駆動用ICを実装する接続方法としては、例えばCOG(Chip On Glass)接続が知られている。このCOG接続では、例えばAuメッキバンプを駆動用ICに形成し、異方性導電膜(ACF)や異方性導電ペースト(ACP)を用いて駆動用ICを実装するといった方法が採られている。このような方法において、Auメッキバンプの形成については、半導体素子上にTiW/Auなどのシード層をスパッタし、レジストをパターニングした後に、高さ20μm程度の電解Auメッキを施すことで行っている。
ところが、近年では前記駆動用ICの電極が狭ギャップ化(狭ピッチ化)するのに伴い、高アスペクトのレジスト形成、あるいはシード層のエッチングなど、安定したバンプ形成が困難になってきている。また、電極ギャップ寸法が異方性導電膜(ACF)中の導電性微粒子の寸法に近くなり、したがってこの導電性微粒子によってショートが起こる可能性も生じている。
As a connection method for mounting the driving IC on the substrate of the display device, for example, COG (Chip On Glass) connection is known. In this COG connection, for example, an Au plated bump is formed on the driving IC, and the driving IC is mounted using an anisotropic conductive film (ACF) or anisotropic conductive paste (ACP). . In such a method, Au plating bumps are formed by sputtering a seed layer such as TiW / Au on a semiconductor element and patterning a resist, followed by electrolytic Au plating with a height of about 20 μm. .
However, in recent years, as the electrodes of the driving IC have narrowed (narrow pitch), it has become difficult to form stable bumps such as high aspect resist formation or seed layer etching. In addition, the electrode gap size is close to the size of the conductive fine particles in the anisotropic conductive film (ACF), and therefore there is a possibility that a short circuit occurs due to the conductive fine particles.

このような背景のもとで、特許文献1には、電極と離れた位置に樹脂製の突起部を設け、突起部の表面を覆って電極に接続する接続パターンを導電層とし、突起電極を形成する技術が開示されている。この技術によれば、Auメッキバンプに比べて薄い金属膜のパターニングを行えばよく、したがってエッチング用のレジストについてはアスペクト比を低くすることができることから、狭ギャップ化(狭ピッチ化)が可能になる。
また、導電性微粒子によるショートの危険性についても、導電性微粒子が存在しない熱硬化性封止樹脂などを用いることで対応が可能になる。
特開平2−272737号公報
Under such a background, Patent Document 1 discloses that a resin-made protrusion is provided at a position away from the electrode, and a connection pattern that covers the surface of the protrusion and is connected to the electrode is a conductive layer. A forming technique is disclosed. According to this technology, it is only necessary to pattern a metal film that is thinner than that of Au-plated bumps. Therefore, the aspect ratio of the etching resist can be reduced, so that a narrow gap (narrow pitch) is possible. Become.
Further, the danger of short-circuit due to the conductive fine particles can be dealt with by using a thermosetting sealing resin or the like in which no conductive fine particles exist.
JP-A-2-272737

ところで、特許文献1記載の突起電極を有する半導体装置をガラス基板等に封止樹脂を介して接合する際には、樹脂製の突起部を変形させ、弾性変形による反発力を発生させる必要がある。そして、この突起部の変形状態をガラス基板表面から確認するために、突起部の形状は半球状あるいは半円柱状とすることが望ましい。   By the way, when a semiconductor device having a protruding electrode described in Patent Document 1 is bonded to a glass substrate or the like via a sealing resin, it is necessary to deform a resin-made protruding portion and generate a repulsive force due to elastic deformation. . And in order to confirm the deformation | transformation state of this protrusion part from the glass substrate surface, it is desirable for the shape of a protrusion part to be a hemispherical shape or a semi-cylinder shape.

図17(a)は半球状のバンプ電極8を有する半導体装置の要部を拡大した断面図である。符号1は半導体素子(図示せず)を形成した基板(半導体装置としての半導体基板)、符号2は基板1上に電気信号の入出力を行うために設けられた電極、符号3は基板1の能動面を保護するために設けられた保護膜(パッシベーション膜)、符号4は樹脂で形成された突起体からなるコア、符号5は電極2から引き出されてコア4の頂部を覆うようにパターン形成された配線部である。
このような半導体装置をガラス基板11に接合するために、バンプ電極8を押圧すると、図17(b)に示したように、コア4の頂部のみならず底部が大きく屈曲する。特に、コア4の底部においては、コア4の外表面と基板1との成す角度θがコア4の変形によって鋭角になるので、コア4の底部を被覆するように形成された配線部5に大きな歪が生じて破断や剥離が起きる心配がある。
FIG. 17A is an enlarged cross-sectional view of a main part of a semiconductor device having a hemispherical bump electrode 8. Reference numeral 1 is a substrate (semiconductor substrate as a semiconductor device) on which a semiconductor element (not shown) is formed, reference numeral 2 is an electrode provided on the substrate 1 for inputting and outputting electrical signals, and reference numeral 3 is a substrate 1. Protective film (passivation film) provided to protect the active surface, 4 is a core made of a resin-made protrusion, and 5 is a pattern formed so as to be drawn from the electrode 2 and cover the top of the core 4 It is the wiring part made.
When the bump electrode 8 is pressed to join such a semiconductor device to the glass substrate 11, not only the top portion of the core 4 but also the bottom portion thereof is greatly bent as shown in FIG. In particular, at the bottom of the core 4, the angle θ formed between the outer surface of the core 4 and the substrate 1 becomes an acute angle due to the deformation of the core 4, so that the wiring portion 5 formed so as to cover the bottom of the core 4 is large. There is a concern that distortion may occur and breakage or peeling may occur.

本発明は前記事情に鑑みてなされたもので、その目的とするところは、異方性導電膜を用いることなく、狭ギャップ化(狭ピッチ化)が可能で接続信頼性の高い半導体装置とその製造方法、および回路基板、電気光学装置、電子機器を提供することを目的としている。   The present invention has been made in view of the above circumstances, and an object of the present invention is to provide a semiconductor device having a high connection reliability and a narrow gap (narrow pitch) without using an anisotropic conductive film. It is an object to provide a manufacturing method, a circuit board, an electro-optical device, and an electronic apparatus.

前記の目的を達成するために本発明の半導体装置は、半導体素子が形成された基板と、基板上に形成された電極と、この電極よりも突出した樹脂製突起からなるコアと、前記電極に電気的に接続され、かつコアの頂部に至る配線部とからなるバンプ電極と、を少なくとも有する半導体装置であって、コアの頂部側の弾性率が底部側の弾性率よりも小さいことを特徴とする。
In order to achieve the above object, a semiconductor device according to the present invention includes a substrate on which a semiconductor element is formed , an electrode formed on the substrate, a core made of a resin protrusion protruding from the electrode, and the electrode. A bump device comprising at least a bump electrode that is electrically connected and has a wiring portion reaching the top of the core, characterized in that the elastic modulus on the top side of the core is smaller than the elastic modulus on the bottom side. To do.

本発明の半導体装置にあっては、バンプ電極を実装すべき基板に押圧して樹脂製のコアを弾性変形させることにより、基板とバンプ電極とを面接触させて電気的接続を行うものであるので、異方性導電膜や異方性導電接着剤などが不要となる。よって、隣接電極間あるいは隣接端子間での短絡のない信頼性の高い接続を行うことができる。また、異方性導電膜や異方性導電接着剤などの材料は高価であるので、これらの材料を不要とすることにより、製造コストの低減に寄与することができる。   In the semiconductor device of the present invention, the bump electrode is pressed against the substrate to be mounted, and the resin core is elastically deformed, whereby the substrate and the bump electrode are brought into surface contact to perform electrical connection. Therefore, an anisotropic conductive film or an anisotropic conductive adhesive is not necessary. Therefore, a highly reliable connection without a short circuit between adjacent electrodes or adjacent terminals can be performed. In addition, since materials such as an anisotropic conductive film and an anisotropic conductive adhesive are expensive, making these materials unnecessary can contribute to a reduction in manufacturing cost.

実装の際にバンプ電極は弾性変形状態となるが、本発明の半導体装置にあっては、コアの頂部側の弾性率が底部側のそれよりも小さいので、コアの頂部側だけが選択的に変形することとなる。これに対してコアの底部側では変形の度合いが少なく、元の形状を保持している。特にコアの底部において、コアの外表面と基板とのなす角度が鋭角になることがなくなり、コアの底部に配設された配線部に応力がかかり難くなる。よって配線部の破断や剥離などの接続不良の心配がなくなるので、より一層信頼性の高い接続を行うことができる。   The bump electrode is in an elastically deformed state at the time of mounting, but in the semiconductor device of the present invention, since the elastic modulus on the top side of the core is smaller than that on the bottom side, only the top side of the core is selectively used. It will be deformed. On the other hand, on the bottom side of the core, the degree of deformation is small and the original shape is maintained. In particular, at the bottom of the core, the angle formed between the outer surface of the core and the substrate does not become an acute angle, and stress is not easily applied to the wiring portion disposed on the bottom of the core. Therefore, since there is no fear of connection failure such as breakage or peeling of the wiring portion, it is possible to perform connection with higher reliability.

本発明の半導体装置にあっては、基板には、半導体素子が形成され、コアは略半球状とすることが好ましい。
このようにすれば、コアを例えばガラス基板上の端子に接合させた際に、無荷重のときの配線部の接触部分がほぼ点になり、したがって接続時の加圧による接触面積の変化が大きくなり、その測定が容易になり、実装を確実かつ安易に行うことができる。
またコアを略半球状とすると、コアの底部でのコア外表面と基板との成す角度θ を鈍角にすることができ、コアが変形してもθ は鋭角になり難くなり、配線部の破断および剥れの可能性を極力低減することができる。
In the semiconductor device of the present invention, it is preferable that a semiconductor element is formed on the substrate and the core is substantially hemispherical.
In this way, when the core is bonded to, for example, a terminal on a glass substrate, the contact portion of the wiring portion when there is no load becomes almost a point, and therefore the change in the contact area due to pressure during connection is large. Therefore, the measurement becomes easy, and mounting can be performed reliably and easily.
Also, if the core is substantially hemispherical, the angle θ formed between the outer surface of the core and the substrate at the bottom of the core can be made obtuse, and even if the core is deformed, θ is less likely to be an acute angle and the wiring portion In addition, the possibility of peeling can be reduced as much as possible.

本発明の半導体装置にあっては、前記電極を複数設け、前記コアを略半円柱状とし、前記電極に接続する複数の配線部を前記コアの頂部に設けることが好ましい。このようにすれば、コアを略半球状とした場合と全く同様に、無荷重の時と接続の際の加圧時とで配線部の接触面積が大きく異なるので、その測定が容易となり、実装を確実かつ安易に行うことができるうえに、コアの外表面と基板との成す角度を鈍角とすることができ、好適である。   In the semiconductor device of the present invention, it is preferable that a plurality of the electrodes are provided, the core is substantially semi-cylindrical, and a plurality of wiring portions connected to the electrodes are provided on the top of the core. In this way, the contact area of the wiring part differs greatly between when no load is applied and when pressure is applied during connection, just as when the core is substantially hemispherical. This is preferable because the angle between the outer surface of the core and the substrate can be made obtuse.

本発明の半導体装置にあっては、コアは樹脂にフィラーが分散されてなり、このフィラーの分散密度は頂部側より底部側が高いことを特徴とする。
樹脂にフィラーを分散させるとその弾性率を所望に変化させることができるので、コア中のフィラーの分散密度を異ならしめることにより、各コアの部位において所定の弾性率にすることができる。フィラーの分散密度を頂部側に比べて底部側で高くすれば、底部側の弾性率が大きくなるので、頂部のみが選択的に弾性変形しやすくなる。よって、バンプ電極の底部での変形がなくなり、そこに配設された配線部の破断および剥離の可能性を低減できる。
In the semiconductor device of the present invention, the core is characterized in that a filler is dispersed in a resin, and the dispersion density of the filler is higher on the bottom side than on the top side.
When the filler is dispersed in the resin, the elastic modulus can be changed as desired. Therefore, by making the dispersion density of the filler in the core different, a predetermined elastic modulus can be obtained at each core portion. If the dispersion density of the filler is increased on the bottom side as compared with the top side, the elastic modulus on the bottom side increases, so that only the top is easily selectively elastically deformed. Therefore, there is no deformation at the bottom of the bump electrode, and the possibility of breakage and peeling of the wiring portion disposed there can be reduced.

本発明の半導体装置にあっては、前記コアは第1のコア上に第2のコアを積層してなり、第1のコアの弾性率は第2のコアの弾性率よりも大きいことを特徴とする。
弾性率の大きな第1のコア上に弾性率の小さな第2のコアを積層すれば、バンプ電極の頂部側のみを選択的に弾性変形させることができる。よって、バンプ電極の底部での変形がなくなり、そこに配設された配線部の破断および剥離の可能性を低減できる。
In the semiconductor device of the present invention, the core is formed by stacking the second core on the first core, and the elastic modulus of the first core is larger than the elastic modulus of the second core. And
If the second core having a small elastic modulus is laminated on the first core having a large elastic modulus, only the top side of the bump electrode can be selectively elastically deformed. Therefore, there is no deformation at the bottom of the bump electrode, and the possibility of breakage and peeling of the wiring portion disposed there can be reduced.

本発明の半導体装置にあっては、前記バンプ電極の底部の外周縁を被覆する凸部からなる保護部を設けることを特徴とする。
実装時にコアが弾性変形した際に、配線部で最も屈曲の度合いが大きくて破断の起こりやすい部位であるバンプ電極の底部の外周縁に凸部を設けて保護部とし、この保護部で配線部を被覆する。コアが弾性変形する方向であるコアの外周縁に保護部を設けることにより、この方向へのコアの変形を阻害して、配線部が大きく屈曲するのを防止する。さらに配線部は保護部によって被覆されて半導体基板上に強力に接着される。よってコアの底部における配線部の破断および剥離の可能性を低減できる。
The semiconductor device according to the present invention is characterized in that a protective part comprising a convex part covering the outer peripheral edge of the bottom part of the bump electrode is provided.
When the core is elastically deformed at the time of mounting, a convex portion is provided on the outer peripheral edge of the bottom of the bump electrode, which is the portion where the degree of bending is the largest in the wiring portion and is likely to break, and this is used as a protective portion. Coating. By providing the protective portion on the outer peripheral edge of the core, which is the direction in which the core is elastically deformed, the deformation of the core in this direction is inhibited and the wiring portion is prevented from being greatly bent. Furthermore, the wiring part is covered with the protection part and is strongly bonded onto the semiconductor substrate. Therefore, the possibility of breakage and peeling of the wiring portion at the bottom of the core can be reduced.

本発明の半導体装置の製造方法は、半導体素子が形成された基板と、基板上に形成された電極と、この電極よりも突出した樹脂製突起からなるコアと、電極に電気的に接続され、かつコアの頂部に至る配線部とからなるバンプ電極と、を少なくとも有する半導体装置の製造方法であって、感光性絶縁樹脂にフィラーを分散させてなる樹脂液を基板上に塗布する工程と、該樹脂液が塗布された基板を静置して、樹脂液中で前記フィラーを沈降させる工程と、フィラーが沈降した樹脂液層に露光処理、現像処理を施してパターニングするとともに、露光処理の際の露光条件を調整することにより、樹脂液層を上面が凸形状の曲面となるパターンのコアに形成する工程と、電極上から前記コアの頂部にまで延びるパターンを有する配線部を形成する工程とを有することを特徴とする。

The method for manufacturing a semiconductor device of the present invention includes a substrate on which a semiconductor element is formed , an electrode formed on the substrate, a core made of a resin protrusion protruding from the electrode, and an electrode electrically connected to the electrode, And a bump electrode comprising at least a wiring portion extending to the top of the core, and a method of manufacturing a semiconductor device having at least a resin liquid in which a filler is dispersed in a photosensitive insulating resin; and The substrate coated with the resin liquid is allowed to stand, and the filler is allowed to settle in the resin liquid, and the resin liquid layer on which the filler has settled is subjected to exposure processing and development processing for patterning, and during the exposure processing. By adjusting the exposure conditions, the step of forming the resin liquid layer on the core of the pattern whose upper surface is a convex curved surface and the wiring portion having a pattern extending from the top of the electrode to the top of the core are formed. And having a degree.

本発明の回路基板は、前記の半導体装置が実装されたことを特徴としている。
この回路基板によれば、前述したように狭ギャップ化(狭ピッチ化)が可能な半導体装置を実装しているので、高密度実装が可能になる。また、接続信頼性が高いものとなり、さらにコストの低減化が図られたものとなる。
The circuit board of the present invention is characterized in that the semiconductor device is mounted.
According to this circuit board, since the semiconductor device capable of narrowing the gap (narrow pitch) is mounted as described above, high-density mounting is possible. In addition, the connection reliability is high, and the cost is further reduced.

本発明の電気光学装置は、前記の半導体装置、または前記の回路基板が実装されたことを特徴としている。
この電気光学装置によれば、前述したように高密度実装が可能となり、また接続信頼性が高く、かつコストの低減化が図られたものとなる。
The electro-optical device of the present invention is characterized in that the semiconductor device or the circuit board is mounted.
According to this electro-optical device, as described above, high-density mounting is possible, connection reliability is high, and cost is reduced.

本発明の電子機器は、前記の回路基板、または前記の電気光学装置を備えたことを特徴としている。
この電子機器によれば、前述したように高密度実装が可能になり、また接続信頼性が高いものとなり、さらにコストの低減化が図られたものとなる。
An electronic apparatus according to the present invention includes the circuit board or the electro-optical device.
According to this electronic device, as described above, high-density mounting is possible, connection reliability is high, and cost is further reduced.

以下、本発明を詳しく説明する。
図1(a)は、本発明の半導体装置の第1の実施形態としての、半導体素子を形成した基板(半導体基板)の部分平面図であり、図1(b)は図1(a)におけるA−A線矢視断面図、図1(c)は図1(a)におけるB−B線矢視断面図である。なお、本実施形態における基板としては、多数の半導体チップを形成した状態のシリコンウエハ等の半導体基板であってもよく、また、個々の半導体チップからなるものであってもよい。また、半導体チップの場合には、一般的には直方体(立方体を含む)であるが、その形状は限定されず、球状であってもよい。
The present invention will be described in detail below.
FIG. 1A is a partial plan view of a substrate (semiconductor substrate) on which a semiconductor element is formed as a first embodiment of the semiconductor device of the present invention, and FIG. 1B is a diagram in FIG. FIG. 1C is a cross-sectional view taken along the line AA, and FIG. 1C is a cross-sectional view taken along the line BB in FIG. The substrate in the present embodiment may be a semiconductor substrate such as a silicon wafer in which a large number of semiconductor chips are formed, or may be composed of individual semiconductor chips. In the case of a semiconductor chip, it is generally a rectangular parallelepiped (including a cube), but its shape is not limited and may be spherical.

図1(a)〜(c)中、符号1は半導体素子(図示せず)を形成した基板(半導体装置としての半導体基板)、符号2は基板1上に電気信号の入出力を行うために設けられた電極、符号3は基板1の能動面を保護するために設けられた保護膜(パッシベーション膜)、符号4は感光性絶縁樹脂で形成され電極2とほぼ同一ピッチに配置された突起体としてのコア、符号5は電極2及びコア4の表面(頂部面)を覆うように形成された配線部である。   In FIGS. 1A to 1C, reference numeral 1 denotes a substrate (semiconductor substrate as a semiconductor device) on which a semiconductor element (not shown) is formed, and reference numeral 2 denotes an electric signal input / output on the substrate 1. The provided electrode, reference numeral 3 is a protective film (passivation film) provided to protect the active surface of the substrate 1, and reference numeral 4 is a protrusion formed of a photosensitive insulating resin and arranged at substantially the same pitch as the electrode 2. Reference numeral 5 denotes a wiring portion formed so as to cover the surfaces (top surfaces) of the electrode 2 and the core 4.

電極2は、例えばスパッタリングによって成膜され、さらにレジスト等を用いて所定の形状(例えば、矩形形状)にパターニングされたものである。このような電極2は、基板1の端縁近傍に所定のピッチで複数形成されている。なお、この電極2は、本実施形態ではAlで形成されているものとするが、Al以外にも、例えばTi(チタン)層、TiN(窒化チタン)層、AlCu(アルミニウム/銅)層、及びTiN層(キャップ層)を順に積層した構造であってもよい。さらに、電極2は、前記の構成に限られず、必要とされる電気的特性、物理的特性、及び化学的特性に応じて適宜変更してもよい。   The electrode 2 is formed by sputtering, for example, and further patterned into a predetermined shape (for example, rectangular shape) using a resist or the like. A plurality of such electrodes 2 are formed in the vicinity of the edge of the substrate 1 at a predetermined pitch. In addition, although this electrode 2 shall be formed with Al in this embodiment, other than Al, for example, Ti (titanium) layer, TiN (titanium nitride) layer, AlCu (aluminum / copper) layer, and A structure in which TiN layers (cap layers) are sequentially stacked may be used. Furthermore, the electrode 2 is not limited to the above-described configuration, and may be appropriately changed according to required electrical characteristics, physical characteristics, and chemical characteristics.

保護膜3は、電極2の周辺部を覆い、その開口内に電極2を露出させたもので、SiO2(酸化珪素)、SiN(窒化珪素)、ポリイミド樹脂等によって形成されたものであり、厚みが例えば1μm程度に形成されたものである。ここで、電極2を露出させる開口については、従来の半導体装置における開口より十分小さくしてもよく、具体的には1辺を5〜10μm程度とする正方形(または矩形)とすることができる。このように開口を小さくすることにより、通常の電極形成部分の面積に後述する突起電極8を十分な大きさで形成することができるようになる。なお、その場合に電極2の大きさについては、従来通りの大きさにしておいてもよく、また保護膜3の開口に合わせて小さくしてもよい。   The protective film 3 covers the periphery of the electrode 2 and exposes the electrode 2 in the opening thereof, and is formed of SiO2 (silicon oxide), SiN (silicon nitride), polyimide resin, or the like, and has a thickness. Is formed to about 1 μm, for example. Here, the opening through which the electrode 2 is exposed may be sufficiently smaller than the opening in the conventional semiconductor device. Specifically, the opening may be a square (or a rectangle) having one side of about 5 to 10 μm. By reducing the opening in this way, the protruding electrode 8 described later can be formed in a sufficient size in the area of a normal electrode forming portion. In this case, the size of the electrode 2 may be a conventional size, or may be reduced in accordance with the opening of the protective film 3.

コア4は、基板1の能動面側に、電極2より例えば10〜20μm程度突出する高さに形成された突起体であって、本実施の形態においては、図1(a)に示すように平面視したときの直径が20〜50μm程度の半球状のものである。このようなコア4は、電極2と同じ方向に複数配列されて形成されたもので、電極2とほぼ同一ピッチに配置されたものである。
コア4にはフィラー13が分散されており、その分散密度はコア4の頂部側に比べて底部側(基板1の能動面側)で高い。コア4内でのフィラー13の分散密度を異ならせることによって、コア4の頂部側の弾性率と底部側の弾性率とを異ならせることができる。すなわちフィラー13が高密度で分散されたコア4の底部側では、フィラー13が低密度で分散された頂部側に比較して、高い弾性率を有するようになる。つまり、コア4の底部側はその頂部側に比べて弾性変形し難い硬い突起体となるわけである。
The core 4 is a protrusion formed on the active surface side of the substrate 1 at a height protruding from the electrode 2 by, for example, about 10 to 20 μm. In this embodiment, as shown in FIG. It has a hemispherical shape having a diameter of about 20 to 50 μm when viewed in plan. A plurality of such cores 4 are formed in the same direction as the electrodes 2 and are arranged at substantially the same pitch as the electrodes 2.
Fillers 13 are dispersed in the core 4, and the dispersion density is higher on the bottom side (active surface side of the substrate 1) than on the top side of the core 4. By making the dispersion density of the filler 13 in the core 4 different, the elastic modulus on the top side and the elastic modulus on the bottom side of the core 4 can be made different. That is, the bottom side of the core 4 in which the filler 13 is dispersed at a high density has a higher elastic modulus than the top side in which the filler 13 is dispersed at a low density. That is, the bottom side of the core 4 is a hard protrusion that is less likely to be elastically deformed than the top side.

コア4は感光性絶縁樹脂によって形成されたもので、具体的にはアクリル樹脂やフェノール樹脂、シリコーン樹脂、ポリイミド樹脂、シリコーン変性ポリイミド樹脂、エポキシ樹脂などからなる。
フィラー13は絶縁性樹脂からなり、上記コア4を形成する感光性絶縁樹脂よりも高弾性率で高比重の材料からなる。具体的には、シリカ、アルミナ等を例示することができる。フィラー13の形状は球状、繊維状など、特に限定されるものではないが、直径0.1〜5μmの球状フィラーが好適である。また、コア4を構成する樹脂全体に対するフィラー13の分散濃度は添加するフィラーの種類と粒径によって適宜選択することができるが、硬化前の塗布液の状態で5〜70重量%とすることが好ましい。フィラーの添加量が多すぎたり、あるいは少なすぎるとコア4の弾性率を頂部側と底部側との間で有意義な差を生じさせることができないためである。
The core 4 is formed of a photosensitive insulating resin, and specifically includes an acrylic resin, a phenol resin, a silicone resin, a polyimide resin, a silicone-modified polyimide resin, an epoxy resin, or the like.
The filler 13 is made of an insulating resin and is made of a material having a higher elastic modulus and a higher specific gravity than the photosensitive insulating resin forming the core 4. Specifically, silica, alumina and the like can be exemplified. The shape of the filler 13 is not particularly limited, such as spherical or fibrous, but a spherical filler having a diameter of 0.1 to 5 μm is suitable. Further, the dispersion concentration of the filler 13 with respect to the whole resin constituting the core 4 can be appropriately selected depending on the kind and particle size of the filler to be added, but it is 5 to 70% by weight in the state of the coating liquid before curing. preferable. This is because if the amount of filler added is too large or too small, a significant difference in the elastic modulus of the core 4 cannot be produced between the top side and the bottom side.

なお、コア4を構成する感光性絶縁樹脂の中では、特に露光条件によって形状制御が可能であるアクリル樹脂が、露光条件の調整によって所望形状へのパターニングが容易になることから好適とされ、したがって本実施形態では、感光性絶縁樹脂として特に露光条件によって形状制御が可能であるアクリル樹脂を用いている。加えてフィラー13としては、コア4をなすアクリル樹脂液中に容易に分散できるうえに、樹脂液層を硬化前に静置してフィラー13を沈降させることでその分散密度を異ならしめる工程において、フィラー13の沈降条件を制御しやすいという観点から、直径3μmのシリカ製のビーズを用いている。   Among the photosensitive insulating resins constituting the core 4, an acrylic resin whose shape can be controlled depending on the exposure conditions is preferable because it can be easily patterned into a desired shape by adjusting the exposure conditions. In this embodiment, an acrylic resin whose shape can be controlled depending on the exposure conditions is used as the photosensitive insulating resin. In addition, the filler 13 can be easily dispersed in the acrylic resin liquid forming the core 4, and in addition, the resin liquid layer is allowed to stand before curing and the filler 13 is allowed to settle to vary its dispersion density. From the viewpoint of easily controlling the sedimentation conditions of the filler 13, beads made of silica having a diameter of 3 μm are used.

配線部5は、本実施形態では図1(c)に示すように第1の導電層6と第2の導電層7とから形成されている。第1の導電層6は、後述するように電解メッキによって形成される第2の導電層7の下地(シード層)となるもので、例えばTiWとこれの上に形成するAuとの積層構造、あるいはCrとこれの上に形成するAuとの積層構造が好適とされている。ただし、このような構造以外にも、例えばAu、TiW、Cu、Ni、Pd、Al、Cr、Ti、W、NiV、鉛フリーはんだ等の金属を単独で用いた構造、または、これらの金属のいくつかを積層した構造を採用することができる。   In the present embodiment, the wiring portion 5 is formed of a first conductive layer 6 and a second conductive layer 7 as shown in FIG. The first conductive layer 6 serves as a base (seed layer) for the second conductive layer 7 formed by electrolytic plating as will be described later. For example, a laminated structure of TiW and Au formed thereon, Alternatively, a laminated structure of Cr and Au formed thereon is suitable. However, in addition to such a structure, for example, a structure using a single metal such as Au, TiW, Cu, Ni, Pd, Al, Cr, Ti, W, NiV, lead-free solder, or the like of these metals A structure in which several layers are stacked can be employed.

第2の導電層7は、第1の導電層6上に電解メッキによって選択的に形成されたもので、電極2よりも耐腐食性の高い材料、例えばAuによって厚さ0.5μm〜10μm程度、好ましくは2μm程度に形成されたものである。このような構成により、第2の導電層7は電極2の腐食を防止し、電気的不良の発生を防止する機能をも備えたものとなっている。
そして、これら第1の導電層6と第2の導電層7とからなる積層パターンにより、電極2に接続し、かつコア4の頂部にまで延びる本発明の配線部5が形成され、特にコア4とこれの上に形成された配線部5とにより、バンプ電極8が形成されている。
The second conductive layer 7 is selectively formed on the first conductive layer 6 by electrolytic plating, and is made of a material having higher corrosion resistance than the electrode 2, for example, Au, and has a thickness of about 0.5 μm to 10 μm. Preferably, it is formed to have a thickness of about 2 μm. With such a configuration, the second conductive layer 7 has a function of preventing corrosion of the electrode 2 and occurrence of electrical failure.
The wiring pattern 5 of the present invention connected to the electrode 2 and extending to the top of the core 4 is formed by the laminated pattern composed of the first conductive layer 6 and the second conductive layer 7. And the bump electrode 8 is formed by the wiring part 5 formed on this.

図2は図1に示したバンプ電極8をガラス等の基板11に端子電極12を介して実装した状態を示した要部拡大図であって、図1(c)に対応した断面図、すなわち図1(a)におけるB−B線矢視断面図に対応する断面図である。バンプ電極8は基板11に実装されるにあたって、ガラス基板11上に設けられた端子電極12に対して押圧されて、弾性変形した状態で図示しない封止樹脂によって固定されている。本発明の半導体装置にあっては、コア4の底部側にはフィラー13が高密度で分散されているので、その頂部側に比べて弾性率が高くなり、弾性変形しにくい。配線部5が端子電極12と充分に接続可能な程度にバンプ電極8の頂部側のみが選択的に弾性変形する。すなわち、実装すべき基板11との確実な接続を行う目的でバンプ電極8の頂部付近を大きく変形させても、底部側での大きな弾性変形が起こらない。さらにコア4の底部の外表面と基板1とのなす角θが実装時に鋭角になることがないので、そこに配設された配線部5には歪が発生することがなく、破断や剥離などの心配がなくなる。よって信頼性の高い接続が可能となる。   2 is an enlarged view of a main part showing a state in which the bump electrode 8 shown in FIG. 1 is mounted on a substrate 11 such as glass via the terminal electrode 12, and is a cross-sectional view corresponding to FIG. It is sectional drawing corresponding to the BB arrow sectional drawing in Fig.1 (a). When the bump electrode 8 is mounted on the substrate 11, the bump electrode 8 is pressed against the terminal electrode 12 provided on the glass substrate 11 and is elastically deformed and fixed by a sealing resin (not shown). In the semiconductor device of the present invention, since the filler 13 is dispersed at a high density on the bottom side of the core 4, the elastic modulus is higher than that on the top side and the elastic deformation is difficult. Only the top side of the bump electrode 8 is selectively elastically deformed to such an extent that the wiring part 5 can be sufficiently connected to the terminal electrode 12. That is, even if the vicinity of the top of the bump electrode 8 is greatly deformed for the purpose of reliable connection with the substrate 11 to be mounted, no large elastic deformation occurs on the bottom side. Furthermore, since the angle θ formed between the outer surface of the bottom of the core 4 and the substrate 1 does not become an acute angle during mounting, the wiring portion 5 disposed there is not distorted and is not broken or peeled off. No worries. Therefore, a highly reliable connection is possible.

また本発明の半導体装置にあっては、バンプ電極8の形状を略半球状としているために、実装すべき基板11へバンプ電極8を押圧する前後で大きく接触面積が異なるために、基板11の裏面からバンプ電極8と端子電極12との接触面積を視認しやすく、実装時の接続状態の検査が容易である。加えて実装時の応力をバンプ電極8の頂部側により一層、集中することができ、コア4の底部側での変形をより低減することができて好適である。   In the semiconductor device of the present invention, since the shape of the bump electrode 8 is substantially hemispherical, the contact area differs greatly before and after the bump electrode 8 is pressed against the substrate 11 to be mounted. It is easy to visually recognize the contact area between the bump electrode 8 and the terminal electrode 12 from the back surface, and it is easy to inspect the connection state during mounting. In addition, the stress at the time of mounting can be further concentrated on the top side of the bump electrode 8, and deformation on the bottom side of the core 4 can be further reduced, which is preferable.

次に、本発明の半導体装置の製造方法について、特に前記構成の基板1にバンプ電極8を形成する工程を中心にして、図3〜図10を参照して説明する。なお、図3〜図10は、図1(c)に対応した断面図、すなわち図1(a)におけるB−B線矢視断面図に対応する断面図である。   Next, a method for manufacturing a semiconductor device according to the present invention will be described with reference to FIGS. 3 to 10, particularly focusing on the step of forming the bump electrode 8 on the substrate 1 having the above-described configuration. 3-10 is sectional drawing corresponding to FIG.1 (c), ie, sectional drawing corresponding to the BB arrow sectional drawing in Fig.1 (a).

まず、図3に示すように、基板1の能動面上の所定位置に複数の電極2を配列した状態に形成し、さらにこれら電極2を露出させた状態に保護膜3を形成する。この保護膜3の形成については、まず、SiO(酸化珪素)やSiN(窒化珪素)等による成膜を行い、続いてこれの上にスピンコート法、ディッピング法、スプレーコート法等によってレジスト層を形成し、さらに所定のパターンが形成されたマスクを用いてレジスト層に露光処理及び現像処理を施し、所定形状のレジストパターン(図示せず)を形成する。その後、このレジストパターンをマスクにして前記膜のエッチングを行い、電極2を露出させる開口を形成し、保護膜3を得る。ここで、エッチングにはドライエッチングを用いるのが好ましく、ドライエッチングとしては反応性イオンエッチング(RIE:Reactive Ion Etching)が好適に用いられる。ただし、エッチングとしてウェットエッチングを用いることもできる。なお、このようにして開口を形成した後には、剥離液等を用いてレジストパターンを除去する。 First, as shown in FIG. 3, a plurality of electrodes 2 are formed in a predetermined position on the active surface of the substrate 1, and a protective film 3 is formed in a state where these electrodes 2 are exposed. For the formation of the protective film 3, first, a film is formed by SiO 2 (silicon oxide), SiN (silicon nitride) or the like, and then a resist layer is formed thereon by a spin coat method, a dipping method, a spray coat method or the like. Then, the resist layer is exposed and developed using a mask on which a predetermined pattern is formed to form a resist pattern (not shown) having a predetermined shape. Thereafter, the film is etched using the resist pattern as a mask to form an opening for exposing the electrode 2 to obtain the protective film 3. Here, dry etching is preferably used for the etching, and reactive ion etching (RIE) is preferably used as the dry etching. However, wet etching can also be used as etching. Note that after the opening is formed in this manner, the resist pattern is removed using a stripping solution or the like.

次に、図4に示すように保護膜3上にコア4を構成する既述の樹脂にフィラー13を分散させた樹脂液を塗布して樹脂液層4aを形成する。例えば、フィラー13として粒径3μmのシリカを、ポジ型レジストとなるアクリル樹脂中に30重量%の含有量で分散させた樹脂液を10〜20μm程度に塗布して樹脂液層4aを形成する。この樹脂液層4a中では、フィラー13は満遍なく分散されているので、これを室温で10分間静置すると、樹脂よりも比重の大きなフィラー13は基板1へ向かって沈降して、樹脂液層4aの下側に溜まる。よって、樹脂液層4aの上層と下層とでフィラー13の分散密度を変えることができる。ついで、樹脂液層4aをプリベークして、図5に示したように、樹脂液層4a中のフィラー13の沈降を固定する。   Next, as shown in FIG. 4, a resin liquid layer 4a is formed by applying a resin liquid in which the filler 13 is dispersed in the above-described resin constituting the core 4 on the protective film 3. For example, the resin liquid layer 4a is formed by applying a resin liquid in which silica having a particle diameter of 3 μm as the filler 13 is dispersed in an acrylic resin serving as a positive resist at a content of 30% by weight to about 10 to 20 μm. Since the filler 13 is evenly dispersed in the resin liquid layer 4a, when the filler 13 is allowed to stand at room temperature for 10 minutes, the filler 13 having a specific gravity larger than that of the resin settles toward the substrate 1, and the resin liquid layer 4a. Accumulate on the underside. Therefore, the dispersion density of the filler 13 can be changed between the upper layer and the lower layer of the resin liquid layer 4a. Next, the resin liquid layer 4a is pre-baked to fix the sedimentation of the filler 13 in the resin liquid layer 4a as shown in FIG.

次に、図5に示したように、この樹脂液層4a上にマスク9を所定位置に位置決めして、これを配置する。マスク9としては、例えばCr等の遮光膜を形成したガラス板からなるもので、形成する半球状の突起体となるコア4の、平面形状に対応した円形の開口9aを有したものが用いられる。なお、マスク9の位置決めについては、その開口9aが前記コア4の形成箇所に位置するように行う。   Next, as shown in FIG. 5, the mask 9 is positioned at a predetermined position on the resin liquid layer 4a and disposed. The mask 9 is made of, for example, a glass plate on which a light-shielding film such as Cr is formed, and a mask 4 having a circular opening 9a corresponding to the planar shape of the core 4 serving as a hemispherical protrusion to be formed is used. . The positioning of the mask 9 is performed so that the opening 9a is positioned at the location where the core 4 is formed.

次いで、このマスク9上に紫外光を照射し、開口9a内に露出する前記樹脂液層4aを露光する。ただし、この露光に際しては、その露光条件を調整することにより、現像後に得られる樹脂液層4aからなるパターンを、その上面が凸形状の曲面となるパターンにする。
具体的には、樹脂液層4aの材質や厚さに対して、標準的な露光量より十分に少ない量で露光する、いわゆるアンダー露光を行う。なお、実際に行う露光(アンダー露光)としては、例えば標準的な露光量の半分程度で行う。
Next, the mask 9 is irradiated with ultraviolet light to expose the resin liquid layer 4a exposed in the opening 9a. However, in this exposure, by adjusting the exposure conditions, the pattern made of the resin liquid layer 4a obtained after development is changed to a pattern whose upper surface is a convex curved surface.
Specifically, so-called underexposure is performed in which the material and thickness of the resin liquid layer 4a are exposed in an amount sufficiently smaller than the standard exposure amount. The actual exposure (underexposure) is performed, for example, at about half of the standard exposure amount.

このようにして露光を行うと、マスク9の開口9a内に露出する樹脂液層4aでは、開口9aの中心から周辺部に行くに連れて漸次露光量が少なくなる。したがって、このようにして露光処理を行った後、現像処理を行うと、開口9a内に露出した樹脂液層4aにおいても、露光量が少なくなったことで生じた未露光部分が現像され、除去される。すなわち、樹脂液層4aは開口9aの中心から周辺部に行くに連れてその表層側の露光の度合いが漸次少なくなることから、この露光の度合いが少なくなって未露光部分となった樹脂が現像・除去される。その結果、樹脂液層4aは図6に示すように上面が凸形状の曲面となるパターン、つまり半球状の突起体のコア4となるのである。   When exposure is performed in this manner, the amount of exposure gradually decreases in the resin liquid layer 4a exposed in the opening 9a of the mask 9 from the center of the opening 9a to the periphery. Therefore, when the development process is performed after the exposure process is performed in this manner, the unexposed part generated by the reduced exposure amount is developed and removed even in the resin liquid layer 4a exposed in the opening 9a. Is done. That is, as the resin liquid layer 4a goes from the center of the opening 9a to the peripheral portion, the degree of exposure on the surface layer side gradually decreases. -Removed. As a result, as shown in FIG. 6, the resin liquid layer 4a becomes a pattern whose upper surface is a convex curved surface, that is, a core 4 of a hemispherical protrusion.

このようにしてフィラー13が分散されたコア4を形成し、他の部分の樹脂液層4aを除去したら、図7に示すように、電極2及びコア4の上面を含む基板1の表面全面に、スパッタリング(スパッタ法)によってCr、Auをこの順に積層し、第1の導電層6を形成する。この第1の導電層6の厚さとしては、例えばCrが30nm程度、Auが200nm程度とされる。   After forming the core 4 in which the filler 13 is dispersed in this way and removing the resin liquid layer 4a in other portions, as shown in FIG. 7, the entire surface of the substrate 1 including the upper surfaces of the electrode 2 and the core 4 is formed. Then, Cr and Au are laminated in this order by sputtering (sputtering method) to form the first conductive layer 6. The thickness of the first conductive layer 6 is, for example, about 30 nm for Cr and about 200 nm for Au.

次いで、第1の導電層6上の全面にレジストをスピンコート法、ディッピング法、スプレーコート法等によって塗布し、レジスト層を形成する。そして、第2の導電層7の平面形状(平面パターン)に対応したマスクを用いてレジスト層に露光処理及び現像処理を施し、これを所定形状にパターニングすることにより、図8に示すように形成する第2の導電層7のパターン、すなわち配線部5のパターン形状に対応する開口形状を有したレジストパターン10を形成する。   Next, a resist is applied to the entire surface of the first conductive layer 6 by spin coating, dipping, spray coating, or the like to form a resist layer. Then, the resist layer is exposed to light and developed using a mask corresponding to the planar shape (planar pattern) of the second conductive layer 7 and patterned into a predetermined shape to form the resist layer as shown in FIG. A resist pattern 10 having an opening shape corresponding to the pattern of the second conductive layer 7, that is, the pattern shape of the wiring portion 5 is formed.

次いで、前記第1の導電層6のレジストパターン10に覆われない部分、すなわち露出した第1の導電層6をシード層として、電解メッキ処理を施し、図9に示すようにこのメッキ層によって所望パターン、すなわち電極2上からコア4の頂部にまで延びる配線部5のパターンの第2の導電層6を形成する。ここで、電解メッキ処理としては、第1の導電層6より厚いAuメッキ層を形成する処理、例えば厚さ2μm程度の厚さのAuメッキ層を形成する処理が採用される。続いて、図10に示すように第1の導電層6上に残留したレジストパターン7を除去する。   Next, an electroplating process is performed using the exposed portion of the first conductive layer 6 that is not covered with the resist pattern 10, that is, the exposed first conductive layer 6 as a seed layer. A second conductive layer 6 having a pattern, that is, a pattern of the wiring part 5 extending from the electrode 2 to the top of the core 4 is formed. Here, as the electrolytic plating process, a process of forming an Au plating layer thicker than the first conductive layer 6, for example, a process of forming an Au plating layer having a thickness of about 2 μm is employed. Subsequently, the resist pattern 7 remaining on the first conductive layer 6 is removed as shown in FIG.

その後、前記第2の導電層7に覆われていない部分、すなわち非配線部となる部分の第1の導電層6をエッチングによって除去し、図1(c)に示したように第1の導電層6と第2の導電層7とからなる積層パターンを形成する。そして、これによって電極2上からコア4の頂部にまで延びて形成された、積層パターンからなる配線部5を形成するとともに、特にコア4とこれの上に形成された配線部5とからバンプ電極8を形成する。
その後、必要に応じてダイシングによって個片化することにより、本発明の半導体装置を得る。
Thereafter, the portion of the first conductive layer 6 that is not covered by the second conductive layer 7, that is, the portion that becomes the non-wiring portion is removed by etching, and the first conductive layer is removed as shown in FIG. A laminated pattern composed of the layer 6 and the second conductive layer 7 is formed. Then, the wiring portion 5 formed of a laminated pattern is formed so as to extend from the electrode 2 to the top of the core 4, and in particular, the bump electrode is formed from the core 4 and the wiring portion 5 formed thereon. 8 is formed.
Thereafter, the semiconductor device of the present invention is obtained by dicing into pieces as needed.

なお、第1の導電層6のエッチングについては、第2の導電層7をマスクにしてこれに覆われない部分の第1の導電層6を選択的にエッチングするのが望ましく、その場合のエッチングとしては、ドライエッチング、ウェットエッチングのいずれも採用可能である。
また、レジストパターンによるマスクを形成し、これを用いてエッチングを行うようにしてもよい。
As for the etching of the first conductive layer 6, it is desirable to selectively etch the portion of the first conductive layer 6 that is not covered with the second conductive layer 7 as a mask. For example, either dry etching or wet etching can be employed.
Alternatively, a mask made of a resist pattern may be formed and used for etching.

このようにして得られた半導体装置にあっては、例えばこれを表示体装置のガラス基板上に実装する場合、その接続方法としてCOG(Chip On Glass)接続が好適に用いられる。その際、本発明に係る半導体装置では、端子間の接続信頼性を評価する検査方法として、以下のような方法を採用することができる。
まずコア4と配線部5とからなるバンプ電極8上に、前記ガラス基板11をその透明な端子電極12がバンプ電極8上に当接するようにして載せる。すると、この状態では、バンプ電極8に対してほとんど荷重がかからないほぼ無荷重の状態となるので、端子電極12に接触するバンプ電極8の接触部分はほとんど点となり、その接触面積が十分に小となる。
In the semiconductor device thus obtained, for example, when this is mounted on a glass substrate of a display device, COG (Chip On Glass) connection is preferably used as the connection method. At that time, in the semiconductor device according to the present invention, the following method can be adopted as an inspection method for evaluating the connection reliability between the terminals.
First, the glass substrate 11 is placed on the bump electrode 8 composed of the core 4 and the wiring portion 5 so that the transparent terminal electrode 12 is in contact with the bump electrode 8. Then, in this state, since almost no load is applied to the bump electrode 8, the contact portion of the bump electrode 8 that contacts the terminal electrode 12 becomes almost a point, and the contact area is sufficiently small. Become.

次いで、この状態から熱硬化性封止樹脂を用いて基板1とガラス基板11との間に熱硬化性封止樹脂を充填して接続のための加熱加圧を行う。すると、バンプ電極8は弾性変形可能なコア4によって形成されていることから、この加熱加圧によってバンプ電極8のその接触部分が潰れるようにして広がり、面となって接触面積が大きくなる。この際に、コア4にはフィラー13が分散されており、その分散密度が頂部側に比べて底部側で高くなるようにされているので、バンプ電極8の頂部の接触部分のみが選択的に弾性変形を起こして潰れ、底部側での変形はほとんど発生しない。   Next, from this state, the thermosetting sealing resin is filled between the substrate 1 and the glass substrate 11 using the thermosetting sealing resin, and heating and pressurization for connection are performed. Then, since the bump electrode 8 is formed by the elastically deformable core 4, the contact portion of the bump electrode 8 expands by being crushed by this heating and pressurization, and the surface becomes a contact area. At this time, since the filler 13 is dispersed in the core 4 and the dispersion density is higher on the bottom side than on the top side, only the contact portion at the top of the bump electrode 8 is selectively selected. It is crushed by causing elastic deformation, and almost no deformation on the bottom side occurs.

したがって、例えば光学顕微鏡を用いて透明基板12側からバンプ電極8の頂部の接触部分をそれぞれ観察し、その接触面積の変化を測定することにより、端子間、すなわち端子電極12とバンプ電極8との間の接続状態が分かるようになる。よって、このように接続信頼性の検査を容易に行うことができることから、この検査工程を経て得られた端子間接続構造は、高い接続信頼性を有するものとなる。加えて、バンプ電極8の底部での弾性変形が少ないので、そこに配設された配線部5がコア4から剥離したり、変形によって破断する心配がなくなり、より一層と高い接続信頼性を有するものとなる。   Therefore, for example, by observing the contact portion of the top of the bump electrode 8 from the transparent substrate 12 side using an optical microscope, and measuring the change in the contact area, between the terminals, that is, between the terminal electrode 12 and the bump electrode 8 The connection state between them will be understood. Therefore, since the connection reliability can be easily inspected in this way, the inter-terminal connection structure obtained through this inspection process has high connection reliability. In addition, since the elastic deformation at the bottom of the bump electrode 8 is small, there is no fear that the wiring portion 5 disposed there will be peeled off from the core 4 or broken due to the deformation, and the connection reliability is further improved. It will be a thing.

加えて、このような半導体装置の製造方法にあっては、コア4を形成してこれの上に配線部5を設け、バンプ電極8を形成しているので、配線部5として薄い金属膜のパターニングを行えばよいことなどから、狭ギャップ化(狭ピッチ化)を可能にすることができる。
またコア4を、その上面が凸形状の曲面となる半球状に形成するので、前述したような端子間の接続信頼性を評価する検査方法を好適に採用することができ、したがってこの検査工程を経て得られた端子間接続構造の接続信頼性を高めることができる。
さらに、従来のような導電性微粒子の変形を測定する必要なく、前記検査を行うことができることから、端子間の接続に異方性導電膜や異方性導電ペーストを用いる必要がなくなり、したがって端子間接続のためのコストを低減することができる。
In addition, in such a method of manufacturing a semiconductor device, since the core 4 is formed, the wiring portion 5 is provided thereon, and the bump electrode 8 is formed, a thin metal film is formed as the wiring portion 5. Narrow gaps (narrow pitches) can be made possible by performing patterning.
Further, since the core 4 is formed in a hemispherical shape whose upper surface is a convex curved surface, the above-described inspection method for evaluating the connection reliability between the terminals can be suitably employed. The connection reliability of the inter-terminal connection structure obtained through this can be improved.
Furthermore, since it is possible to perform the inspection without measuring the deformation of the conductive fine particles as in the prior art, it is not necessary to use an anisotropic conductive film or anisotropic conductive paste for the connection between the terminals. The cost for inter-connection can be reduced.

さらにコア4の頂部側と底部側との弾性率を異ならしめる目的でフィラー13の分散密度を異ならしめる方法として、フィラー13が自然に沈降するのを利用するので、特別な設備や工程を必要とせず、従来の製造プロセスの若干の変更のみで高い接続信頼性を有する半導体装置を製造可能とすることができる。   Furthermore, as a method of making the dispersion density of the filler 13 different for the purpose of making the elastic modulus of the top side and the bottom side of the core 4 different, since the filler 13 naturally settles, special equipment and processes are required. However, it is possible to manufacture a semiconductor device having high connection reliability with only a slight modification of the conventional manufacturing process.

本発明の半導体装置の製造方法にあっては、互いに異なる成膜法によって第1の導電性6と第2の導電層7とを積層して配線部5を形成するのみならず、単一の成膜法によってもよい。すなわちコア4を形成した後に、例えばスパッタ法で基板1の全面にCr、Auをこの順に成膜・積層して配線部5となる導電層13を形成してもよい。このようにして製造された半導体装置にあっては、コア4を単一の配線部5が被覆するものとなる。
このような半導体装置にあっても、前記第1の実施形態と同様に、狭ギャップ化(狭ピッチ化)を可能にし、端子間接続構造の接続信頼性を高めることができ、さらに端子間接続のためのコストを低減することができる。
In the manufacturing method of the semiconductor device of the present invention, not only the first conductive layer 6 and the second conductive layer 7 are stacked by the different film forming methods to form the wiring portion 5, A film forming method may be used. That is, after the core 4 is formed, the conductive layer 13 to be the wiring portion 5 may be formed by depositing and laminating Cr and Au in this order on the entire surface of the substrate 1 by, for example, sputtering. In the semiconductor device manufactured in this way, the core 4 is covered with the single wiring portion 5.
Even in such a semiconductor device, as in the first embodiment, it is possible to reduce the gap (narrow pitch), improve the connection reliability of the inter-terminal connection structure, and further connect the inter-terminal connection. The cost for can be reduced.

なお、本発明においては、第1の導電層6、第2の導電層7、導電層13の形成材料として、前記の金属材料、すなわちAu、TiW、Cu、Ni、Pd、Al、Cr、Ti、W、NiV、鉛フリーはんだ等に限定されることなく、導電性樹脂を用いることもできる。その場合に、この導電性樹脂からなる導電層のパターニング法としては、前記のフォトリソグラフィー法に加え、印刷法等を採用することができる。   In the present invention, the metal material, that is, Au, TiW, Cu, Ni, Pd, Al, Cr, Ti, is used as a material for forming the first conductive layer 6, the second conductive layer 7, and the conductive layer 13. Without being limited to W, NiV, lead-free solder, etc., a conductive resin can also be used. In that case, as a patterning method of the conductive layer made of the conductive resin, a printing method or the like can be employed in addition to the photolithography method.

次に、本発明の半導体装置の第2の実施形態について説明する。
この第2の実施形態が上述の第1の実施形態と異なるところは、コア4の底部側での弾性率を頂部側での弾性率に比べて大きくする目的で、図11(a)に示したように、高弾性率の材料からなる大容積の第1のコア41の上に、この第1のコア41より低弾性率の材料からなる小容積の第2のコア42を載積したところである。
このようにすると、図11(b)に示したように、半導体装置を実装する際にバンプ電極8を実装すべき基板11の端子電極12に押圧した際に、第2のコア42が第1のコア41に比べて弾性変形し易くなるので、バンプ電極8の頂部のみが選択的に弾性変形し、その底部では歪の荷重がかかりにくくなる。よって、配線部5が破断したり、剥離することがなくなり、接続信頼性の高いものとなる。
Next, a second embodiment of the semiconductor device of the present invention will be described.
This second embodiment is different from the first embodiment described above in order to increase the elastic modulus on the bottom side of the core 4 compared to the elastic modulus on the top side, as shown in FIG. As described above, when the second core 42 having a small volume made of a material having a lower elastic modulus than the first core 41 is mounted on the first core 41 having a large volume made of a material having a high elastic modulus. is there.
Thus, as shown in FIG. 11B, when the semiconductor device is mounted, when the bump electrode 8 is pressed against the terminal electrode 12 of the substrate 11 to be mounted, the second core 42 is in the first state. Therefore, only the top of the bump electrode 8 is selectively elastically deformed, and a strain load is hardly applied at the bottom. Therefore, the wiring part 5 is not broken or peeled off, and the connection reliability is high.

なお、本実施の形態にあっては、第1のコア41と第2のコア42との境界面で大きな変形が起きて、この部位の配線部5の破断が心配されるが、第1のコア41と第2のコアの接合部が成す角度θ4が鈍角になるように第2のコア42を積層すれば、コア4が大きく弾性変形した際にも、角度θ4が鋭角になることがない。よって、この部位の配線部5に大きな屈曲が起きることがなく、破断や剥離の心配がないので、接続信頼性の高いものとすることができる。   In the present embodiment, a large deformation occurs at the boundary surface between the first core 41 and the second core 42, and there is a concern that the wiring portion 5 at this part is broken. If the second core 42 is laminated so that the angle θ4 formed by the joint portion between the core 41 and the second core becomes an obtuse angle, the angle θ4 does not become an acute angle even when the core 4 is greatly elastically deformed. . Therefore, the wiring portion 5 at this portion does not bend greatly and there is no fear of breakage or peeling, so that the connection reliability can be made high.

第2のコア42は第1のコア41よりも小容積となるようにすることが好ましい。バンプ電極8の全体形状を頂部側に向かって小さくなるようにすれば、実装の際の押圧時に先端部分の頂部側で応力の集中が起きるので、保護すべき底部側に歪の応力が加わり難くなり、配線部5の破断や剥離を防止できるためである。   It is preferable that the second core 42 has a smaller volume than the first core 41. If the overall shape of the bump electrode 8 is made smaller toward the top side, stress concentration occurs on the top side of the tip when pressing during mounting, so that it is difficult to apply strain stress on the bottom side to be protected. This is because breakage and peeling of the wiring portion 5 can be prevented.

第1のコア41を構成する樹脂としては、感光性の絶縁樹脂の中でも比較的弾性率の高いアクリル樹脂やフェノール樹脂などを例示することができ、第2のコア42としては、上記第1のコア41よりも弾性率の小さな感光性絶縁樹脂であれば特に限定されないが、たとえばウレタン樹脂などを例示することができる。また、第1のコア41と第2のコア42を構成する樹脂を同素材とし、第1のコア41にフィラーを添加してその弾性率を高くしてもよい。
このようなコア4は、上記第1の実施の形態のコア4と全く同様にして、第1のコア41をフォトリソグラフィーで形成した後に、第2のコア42を同様にフォトリソグラフィーによって形成することができる。
Examples of the resin constituting the first core 41 include acrylic resins and phenol resins having a relatively high elastic modulus among the photosensitive insulating resins. The second core 42 includes the first core 41 and the first core 41. Although it will not specifically limit if it is a photosensitive insulating resin whose elastic modulus is smaller than the core 41, For example, a urethane resin etc. can be illustrated. Further, the resin constituting the first core 41 and the second core 42 may be made of the same material, and a filler may be added to the first core 41 to increase its elastic modulus.
In such a core 4, the first core 41 is formed by photolithography in the same manner as the core 4 of the first embodiment, and then the second core 42 is formed by photolithography in the same manner. Can do.

次に、本発明の半導体装置の第3の実施形態について図12を参照して説明する。本実施形態が上述の第1および第2の実施形態と異なるところは、バンプ電極8の底部に保護部43を配設したところである。この保護部43は配線部5が屈曲する部位を覆うようにバンプ電極8の底部の外周縁上に配設された凸部からなる。
保護部43の構成材料は絶縁性の樹脂であれば特に限定されるものではなく、コア4と同材料であっても異材料であってもよい。また、その弾性率はコア4より大きいことが好ましいが、等しくてもよい。また保護部43は少なくとも配線部5を被覆するように配設されていれば充分であるが、バンプ電極8の底部外周縁の全体を覆うように配設されていてもよい。
Next, a third embodiment of the semiconductor device of the present invention will be described with reference to FIG. The present embodiment is different from the first and second embodiments described above in that a protective portion 43 is provided at the bottom of the bump electrode 8. The protective portion 43 is a convex portion disposed on the outer peripheral edge of the bottom portion of the bump electrode 8 so as to cover a portion where the wiring portion 5 is bent.
The constituent material of the protection part 43 is not particularly limited as long as it is an insulating resin, and may be the same material as the core 4 or a different material. The elastic modulus is preferably larger than that of the core 4, but may be equal. Further, it is sufficient that the protective portion 43 is disposed so as to cover at least the wiring portion 5, but it may be disposed so as to cover the entire outer peripheral edge of the bottom of the bump electrode 8.

このような保護部43を設けることにより、バンプ電極8の底部に歪の応力が働いても、隣接する保護部43によって、その部位のコア4の弾性変形が阻止されることとなるので、配線部5が鋭角に屈曲することがなくなる。よってこの部位での配線部5の破断を防止でき、接続信頼性の高い半導体装置とすることができる。
さらに配線部5はこの保護部43で被覆されているので基板1に対して高強度で接着されることになり、配線部5の剥離を防止する。
By providing such a protective portion 43, even if a strain stress acts on the bottom of the bump electrode 8, the adjacent protective portion 43 prevents the core 4 at that portion from being elastically deformed. The portion 5 is not bent at an acute angle. Therefore, breakage of the wiring portion 5 at this portion can be prevented, and a semiconductor device with high connection reliability can be obtained.
Furthermore, since the wiring part 5 is covered with the protective part 43, it is bonded to the substrate 1 with high strength, and the wiring part 5 is prevented from being peeled off.

本発明の半導体装置にあっては、上述のいずれの実施形態においても、コア4の形状を半球状でなく半円柱状としてもよい。
この半円柱状のコア4は、その長さ方向が電極2の配列方向に平行となるようにして形成する。そして配線部5については、複数の電極2に対して接続する複数の配線部5が、それぞれコア4の頂部に載るように配設される。
In the semiconductor device of the present invention, the core 4 may have a semi-cylindrical shape instead of a hemispherical shape in any of the above-described embodiments.
The semi-cylindrical core 4 is formed such that its length direction is parallel to the arrangement direction of the electrodes 2. And about the wiring part 5, the some wiring part 5 connected with respect to the some electrode 2 is arrange | positioned so that it may each mount on the top part of the core 4. FIG.

このような半円柱状の突起体15を形成するには、特に感光性絶縁樹脂からなる層を露光する際、マスクとして、その開口が長方形のものを用意する。ここで、この長方形の開口の長辺と短辺と比は、3:1以上、すなわち短辺の長さを1とすると、長辺の長さが3以上の長さとなるような開口とする。
そして、第1の実施形態と同様にして、樹脂層上にマスクをする。なお、マスクの位置決めについて、その開口が突起体の形成箇所に位置するようにして行うのは、前記実施形態と同様である。
In order to form such a semi-cylindrical protrusion 15, a mask having a rectangular opening is prepared as a mask particularly when a layer made of a photosensitive insulating resin is exposed. Here, the ratio of the long side to the short side of the rectangular opening is 3: 1 or more, that is, when the length of the short side is 1, the length of the long side is 3 or more. .
Then, a mask is formed on the resin layer in the same manner as in the first embodiment. Note that the positioning of the mask is performed so that the opening is located at the position where the protrusion is formed, as in the above embodiment.

次いで、このマスク上に紫外光を照射し、開口内に露出する前記樹脂層を露光する。この露光に際しても、第1の実施形態と同様に、その露光条件を調整することにより、現像後に得られる樹脂層からなるパターンを、その上面が凸形状の曲面となるパターンにする。具体的には、前述したようなアンダー露光を行う。
このようにして露光を行うと、マスクの開口内に露出する樹脂層では、特に開口が細長い長方形となっているため、長辺と平行となる中心線から長辺側に行くに連れて漸次露光量が少なくなる。したがって、このようにして露光処理を行った後、現像処理を行うと、開口内に露出した樹脂層においても、露光量が少なくなったことで生じた未露光部分が現像され、除去される。すなわち、樹脂層は開口の中心線から長辺側に行くに連れてその表層側の露光の度合いが漸次少なくなることから、この露光の度合いが少なくなって未露光部分となった樹脂が現像・除去される。その結果、樹脂層は上面が凸形状の曲面となるパターン、つまり細長い半円柱状のコア4となるのである。
Next, the resin layer exposed in the opening is exposed by irradiating the mask with ultraviolet light. In this exposure, as in the first embodiment, by adjusting the exposure conditions, the pattern made of the resin layer obtained after development is changed to a pattern whose upper surface is a convex curved surface. Specifically, under exposure as described above is performed.
When the exposure is performed in this way, the resin layer exposed in the opening of the mask has an elongated rectangular shape, so that the exposure is gradually performed from the center line parallel to the long side toward the long side. The amount is reduced. Therefore, when the development process is performed after the exposure process is performed in this manner, even in the resin layer exposed in the opening, the unexposed part generated by the decrease in the exposure amount is developed and removed. That is, as the resin layer goes from the center line of the opening to the long side, the degree of exposure on the surface layer side gradually decreases. Removed. As a result, the resin layer becomes a pattern whose upper surface is a convex curved surface, that is, an elongated semi-cylindrical core 4.

このようにしてコア4を形成したら、以下、第1の実施形態と同様にして配線部5を形成し、これによってコア4とこれの上に形成された配線部5とからなるバンプ電極8を形成する。なお、配線部5の形成については、前記各実施形態で行った方法の他、前述した導電性樹脂を用いた方法を採用してもよい。
その後、必要に応じてダイシングによって個片化することにより、本発明の半導体装置を得る。
After the core 4 is formed in this way, the wiring portion 5 is formed in the same manner as in the first embodiment, whereby the bump electrode 8 composed of the core 4 and the wiring portion 5 formed thereon is formed. Form. In addition, about formation of the wiring part 5, you may employ | adopt the method using the conductive resin mentioned above other than the method performed in said each embodiment.
Thereafter, the semiconductor device of the present invention is obtained by dicing into pieces as needed.

このような半導体装置にあっても、前記各実施形態と全く同様に、狭ギャップ化(狭ピッチ化)を可能にし、端子間接続構造の接続信頼性を高めることができ、さらに端子間接続のためのコストを低減することができる。
また、特にコア4を半円柱状とし、電極2に接続する複数の配線部5をコア4の頂部に形成しているので、前述した端子間の接続信頼性を評価する検査時において、このコア4を例えばガラス基板上の端子に接合させた際に、無荷重のときの配線部5の接触部分がほぼ線になる。したがって、コアを半球状にした第1の実施形態と同様に、接続時の加熱加圧による接触面積の変化を大きくすることができ、これによりその測定を容易にすることができる。
Even in such a semiconductor device, it is possible to reduce the gap (narrow pitch), increase the connection reliability of the inter-terminal connection structure, and to improve the connection between the terminals. Cost can be reduced.
In particular, since the core 4 has a semi-cylindrical shape and a plurality of wiring portions 5 connected to the electrode 2 are formed on the top of the core 4, this core is used at the time of inspection for evaluating the connection reliability between the terminals described above. For example, when 4 is bonded to a terminal on a glass substrate, the contact portion of the wiring portion 5 when there is no load is substantially a line. Therefore, similarly to the first embodiment in which the core is hemispherical, the change in the contact area due to heating and pressurization at the time of connection can be increased, thereby facilitating the measurement.

図13は、本発明の回路基板及び電気光学装置の一実施形態としての、液晶表示装置の概略構成を示す斜視図である。図13に示す液晶表示装置は、電気光学パネルとしてのカラーの液晶パネル51と、この液晶パネル51に接続されたCOF(Chip On Film)式の回路基板100とを備えて構成されたものであり、回路基板100は、本発明の半導体装置101を備えて構成されたものである。このような構成のもとに、回路基板100は本発明の回路基板の一実施形態となっており、また液晶表示装置は本発明の電気光学装置の一実施形態となっている。なお、前記液晶表示装置においては、バックライト等の照明装置やその他の付帯機器が、必要に応じて液晶パネル51に付設されるようになっている。また、回路基板100としては、COF式のものに限定されることなく、COB(Chip On Board)のものを用いることもできる。   FIG. 13 is a perspective view showing a schematic configuration of a liquid crystal display device as an embodiment of the circuit board and the electro-optical device of the present invention. The liquid crystal display device shown in FIG. 13 includes a color liquid crystal panel 51 as an electro-optical panel and a COF (Chip On Film) circuit board 100 connected to the liquid crystal panel 51. The circuit board 100 includes the semiconductor device 101 of the present invention. Based on such a configuration, the circuit board 100 is an embodiment of the circuit board of the present invention, and the liquid crystal display device is an embodiment of the electro-optical device of the present invention. In the liquid crystal display device, an illumination device such as a backlight and other incidental devices are attached to the liquid crystal panel 51 as necessary. Further, the circuit board 100 is not limited to the COF type, and a COB (Chip On Board) type can also be used.

また、本発明は、前記COF式のものやCOB式のもの以外にも、表示体パネル(液晶パネル)上に直接ドライバーIC等を実装するCOG(Chip On Glass)式の電気光学装置にも適用可能である。図14に、COG式液晶表示装置の一例を示す。
この図において、電気光学装置としての液晶表示装置50は、金属板から成る枠状のシールドケース68と、電気光学パネルとしての液晶パネル52と、液晶駆動用LSI58と、液晶パネル52と液晶駆動用LSI58の能動面に形成されたバンプとをCOG実装方式によって互いに電気的に接続するための図示しないACF(Anisotropic Conductive Film :異方性導電膜)と、全体の強度を保つための保持部材172とを有して構成されている。
In addition to the COF type and the COB type, the present invention is also applicable to a COG (Chip On Glass) type electro-optical device in which a driver IC or the like is mounted directly on a display panel (liquid crystal panel). Is possible. FIG. 14 shows an example of a COG type liquid crystal display device.
In this figure, a liquid crystal display device 50 as an electro-optical device includes a frame-shaped shield case 68 made of a metal plate, a liquid crystal panel 52 as an electro-optical panel, a liquid crystal driving LSI 58, a liquid crystal panel 52, and a liquid crystal driving device. An ACF (Anisotropic Conductive Film) (not shown) for electrically connecting the bumps formed on the active surface of the LSI 58 to each other by a COG mounting method, and a holding member 172 for maintaining the overall strength It is comprised.

この液晶パネル52は、一方の面に第1透明電極層を設けた0.7mm厚のソーダガラスからなる第1基板53と、一方の面に第2の透明電極層を設けた0.7mm厚のソーダガラスからなる第2基板54とが、第1透明電極層と第2透明電極層とが相対向するようにして貼り合わされ、さらに、これらの基板間に液晶組成物が封入されたことにより、形成されている。そして、COG用ACFによって液晶駆動用LSI58が一方の基板54上に直接、電気的に接続されており、このようにして、COG型の液晶パネル52が形成されている。ここで、前記液晶駆動用LSI58は、前記半導体装置の製造方法によって製造されている。   The liquid crystal panel 52 includes a first substrate 53 made of soda glass having a thickness of 0.7 mm provided with a first transparent electrode layer on one surface, and a thickness of 0.7 mm provided with a second transparent electrode layer on one surface. The second substrate 54 made of soda glass is bonded so that the first transparent electrode layer and the second transparent electrode layer face each other, and the liquid crystal composition is sealed between these substrates. Is formed. The liquid crystal driving LSI 58 is directly and electrically connected to the one substrate 54 by the COG ACF, and thus the COG type liquid crystal panel 52 is formed. Here, the liquid crystal driving LSI 58 is manufactured by the manufacturing method of the semiconductor device.

なお、電気光学装置としては、液晶表示装置以外にも例えば有機EL表示装置に用いることができる。図15は、本発明による電気光学装置としての有機EL表示装置に設けられる有機ELパネルの断面図である。有機ELパネル(電気光学パネル)30は、基板31上にマトリクス状にTFT(Thin Film Transistor)32を形成し、さらにその上に複数の積層体33を形成して概略構成されたものである。TFT32は、ソース電極、ゲート電極、及びドレイン電極を有したもので、ゲート電極及びソース電極は、例えば図1に示した突起電極8の何れかと電気的に接続されている。前記積層体33は、陽極層34、正孔注入層35、発光層36、及び陰極層37を含んで構成されたものである。前記陽極層34は、TFT32のドレイン電極と接続されており、TFT32がオン状態にあるときに電流が、TFT32のソース電極及びドレイン電極を介して陽極層34に供給されるようになっている。   In addition to the liquid crystal display device, the electro-optical device can be used for an organic EL display device, for example. FIG. 15 is a cross-sectional view of an organic EL panel provided in an organic EL display device as an electro-optical device according to the present invention. The organic EL panel (electro-optical panel) 30 is generally configured by forming TFTs (Thin Film Transistors) 32 in a matrix on a substrate 31 and further forming a plurality of stacked bodies 33 thereon. The TFT 32 has a source electrode, a gate electrode, and a drain electrode, and the gate electrode and the source electrode are electrically connected to, for example, one of the protruding electrodes 8 shown in FIG. The laminated body 33 includes an anode layer 34, a hole injection layer 35, a light emitting layer 36, and a cathode layer 37. The anode layer 34 is connected to the drain electrode of the TFT 32, and current is supplied to the anode layer 34 via the source electrode and the drain electrode of the TFT 32 when the TFT 32 is in the ON state.

以上の構成の有機ELパネル30において、陽極層34から正孔注入層35を介して発光層36に注入された正孔(ホール)と、陰極層37から発光層36に注入された電子とが発光層36内において再結合して生ずる光は、基板31側から射出される。   In the organic EL panel 30 configured as described above, holes injected from the anode layer 34 into the light emitting layer 36 through the hole injection layer 35 and electrons injected from the cathode layer 37 into the light emitting layer 36 are generated. Light generated by recombination in the light emitting layer 36 is emitted from the substrate 31 side.

次に、本実施形態の電気光学装置が搭載される電子機器について説明する。以上に説明した電気光学装置としての液晶表示装置、CPU(中央処理装置)等を備えたマザーボード、キーボード、ハードディスク等の電子部品を筐体内に組み込むことで、例えば図16に示すノート型のパーソナルコンピュータ60(電子機器)が製造される。   Next, an electronic apparatus in which the electro-optical device according to this embodiment is mounted will be described. By incorporating electronic components such as a liquid crystal display device as an electro-optical device described above, a motherboard having a CPU (central processing unit), a keyboard, and a hard disk into the housing, for example, a notebook personal computer shown in FIG. 60 (electronic equipment) is manufactured.

図16は、本発明の一実施形態による電子機器としてのノート型コンピュータを示す外観図である。図16において61は筐体であり、62は液晶表示装置(電気光学装置)であり、63はキーボードである。なお、図16においては、液晶表示装置を備えるノート形コンピュータを示しているが、液晶表示装置に代えて有機EL表示装置を備えていても良い。   FIG. 16 is an external view showing a notebook computer as an electronic apparatus according to an embodiment of the present invention. In FIG. 16, 61 is a housing, 62 is a liquid crystal display device (electro-optical device), and 63 is a keyboard. Note that FIG. 16 shows a notebook computer provided with a liquid crystal display device, but an organic EL display device may be provided instead of the liquid crystal display device.

また、前記実施形態では、電子機器としてノート型コンピュータを例に挙げて説明したが、これらに限らず、携帯電話、液晶プロジェクタ、マルチメディア対応のパーソナルコンピュータ(PC)及びエンジニアリング・ワークステーション(EWS)、ページャ、ワードプロセッサ、テレビ、ビューファインダ型又はモニタ直視型のビデオテープレコーダ、電子手帳、電子卓上計算機、カーナビゲーション装置、POS端末、タッチパネルを備えた装置等の電子機器に適用することが可能である。   In the above-described embodiment, a notebook computer has been described as an example of an electronic device. However, the present invention is not limited thereto, and is not limited to a mobile phone, a liquid crystal projector, a multimedia-compatible personal computer (PC), and an engineering workstation (EWS). It can be applied to electronic devices such as pagers, word processors, televisions, viewfinder type or monitor direct-view type video tape recorders, electronic notebooks, electronic desk calculators, car navigation devices, POS terminals, and devices equipped with touch panels. .

以上、本発明の実施形態による半導体装置及びその製造方法、電気光学装置、並びに電子機器について説明したが、本発明は前記実施形態に制限されることなく、本発明の範囲内で自由に変更が可能である。
例えば前述した実施の形態の「半導体チップ」や「半導体素子」を「電子素子」に置き換えて、電子部品を製造することもできる。このような電子素子を使用して製造される電子部品として、例えば、光素子、抵抗器、コンデンサ、コイル、発振器、フィルタ、温度センサ、サーミスタ、バリスタ、ボリューム又はヒューズなどがある。
As described above, the semiconductor device and the manufacturing method thereof, the electro-optical device, and the electronic apparatus according to the embodiment of the present invention have been described. Is possible.
For example, the “semiconductor chip” or “semiconductor element” in the above-described embodiment can be replaced with “electronic element” to manufacture an electronic component. Examples of electronic components manufactured using such electronic elements include optical elements, resistors, capacitors, coils, oscillators, filters, temperature sensors, thermistors, varistors, volumes, and fuses.

(a)〜(c)は本発明の半導体装置の概略構成図である。(A)-(c) is a schematic block diagram of the semiconductor device of this invention. 図1に示した半導体装置の要部断面図である。FIG. 2 is a fragmentary cross-sectional view of the semiconductor device shown in FIG. 1. 図1に示した半導体装置の製造工程図である。FIG. 2 is a manufacturing process diagram of the semiconductor device shown in FIG. 1. 図1に示した半導体装置の製造工程図である。FIG. 2 is a manufacturing process diagram of the semiconductor device shown in FIG. 1. 図1に示した半導体装置の製造工程図である。FIG. 2 is a manufacturing process diagram of the semiconductor device shown in FIG. 1. 図1に示した半導体装置の製造工程図である。FIG. 2 is a manufacturing process diagram of the semiconductor device shown in FIG. 1. 図1に示した半導体装置の製造工程図である。FIG. 2 is a manufacturing process diagram of the semiconductor device shown in FIG. 1. 図1に示した半導体装置の製造工程図である。FIG. 2 is a manufacturing process diagram of the semiconductor device shown in FIG. 1. 図1に示した半導体装置の製造工程図である。FIG. 2 is a manufacturing process diagram of the semiconductor device shown in FIG. 1. 図1に示した半導体装置の製造工程図である。FIG. 2 is a manufacturing process diagram of the semiconductor device shown in FIG. 1. (a)、(b)はいずれも第2の実施形態の概略断面図である。(A), (b) is a schematic sectional drawing of 2nd Embodiment. (a)、(b)はいずれも第3の実施形態の概略断面図である。(A), (b) is a schematic sectional drawing of 3rd Embodiment. 本発明に係る液晶表示装置の概略構成を示す斜視図である。1 is a perspective view showing a schematic configuration of a liquid crystal display device according to the present invention. COG式液晶表示装置の一例を示す分解斜視図である。It is a disassembled perspective view which shows an example of a COG type liquid crystal display device. 本発明に係る有機ELパネルの断面図である。It is sectional drawing of the organic electroluminescent panel which concerns on this invention. 本発明の電子機器を示す外観図である。It is an external view which shows the electronic device of this invention. (a)、(b)はいずれも従来の半導体装置の概略断面図である。(A), (b) is a schematic sectional drawing of the conventional semiconductor device.

符号の説明Explanation of symbols

2…電極、4…コア、41…第1のコア、42…第2のコア、5…配線部、8…バンプ電極、13…フィラー、100…回路基板、101…半導体装置、60…電子機器。

DESCRIPTION OF SYMBOLS 2 ... Electrode, 4 ... Core, 41 ... 1st core, 42 ... 2nd core, 5 ... Wiring part, 8 ... Bump electrode, 13 ... Filler, 100 ... Circuit board, 101 ... Semiconductor device, 60 ... Electronic device .

Claims (10)

半導体素子が形成された基板と、前記基板上に形成された電極と、この電極よりも突出した樹脂製突起からなるコアと、前記電極に電気的に接続され、かつ前記コアの頂部に至る配線部とからなるバンプ電極と、を少なくとも有する半導体装置であって、
前記コアの頂部側の弾性率が底部側の弾性率よりも小さいことを特徴とする半導体装置。
A substrate on which a semiconductor element is formed, an electrode formed on the substrate, a core made of a resin protrusion protruding from the electrode, and a wiring electrically connected to the electrode and reaching the top of the core A semiconductor device having at least a bump electrode comprising:
A semiconductor device characterized in that an elastic modulus on the top side of the core is smaller than an elastic modulus on the bottom side.
前記基板には、半導体素子が形成され、
前記コアが略半球状とされていることを特徴とする請求項1記載の半導体装置。
A semiconductor element is formed on the substrate,
The semiconductor device according to claim 1, wherein the core is substantially hemispherical.
前記電極が複数設けられ、前記コアが略半円柱状とされ、前記電極に接続する複数の配線部が前記コアの頂部に設けられていることを特徴とする請求項1記載の半導体装置。
2. The semiconductor device according to claim 1, wherein a plurality of the electrodes are provided, the core is formed in a substantially semi-cylindrical shape, and a plurality of wiring portions connected to the electrodes are provided on a top portion of the core.
前記コアは樹脂にフィラーが分散されてなり、該フィラーの分散密度は頂部側より底部側が高いことを特徴とする請求項1ないし請求項3のいずれか一項に記載の半導体装置。
4. The semiconductor device according to claim 1, wherein a filler is dispersed in the core, and a dispersion density of the filler is higher on the bottom side than on the top side. 5.
前記コアは第1のコア上に第2のコアを積層してなり、第1のコアの弾性率は第2のコアの弾性率よりも大きいことを特徴とする請求項1ないし請求項4のいずれか一項に記載の半導体装置。
5. The core according to claim 1, wherein the core is formed by laminating a second core on the first core, and the elastic modulus of the first core is larger than the elastic modulus of the second core. The semiconductor device as described in any one.
前記バンプ電極の底部の外周縁を被覆する凸部からなる保護部を設けたことを特徴とする請求項1ないし請求項5のいずれか一項に記載の半導体装置。
6. The semiconductor device according to claim 1, further comprising a protective portion including a convex portion covering an outer peripheral edge of a bottom portion of the bump electrode.
半導体素子が形成された基板と、前記基板上に形成された電極と、この電極よりも突出した樹脂製突起からなるコアと、前記電極に電気的に接続され、かつ前記コアの頂部に至る配線部とからなるバンプ電極と、を少なくとも有する半導体装置の製造方法であって、
感光性絶縁樹脂にフィラーを分散させてなる樹脂液を前記基板上に塗布する工程と、
該樹脂液が塗布された前記基板を静置して、前記樹脂液中で前記フィラーを沈降させる工程と、
前記フィラーが沈降した樹脂液層に露光処理、現像処理を施してパターニングするとともに、露光処理の際の露光条件を調整することにより、前記樹脂液層を上面が凸形状の曲面となるパターンのコアに形成する工程と、
前記電極上から前記コアの頂部にまで延びるパターンを有する配線部を形成する工程とを有することを特徴とする半導体装置の製造方法。
A substrate on which a semiconductor element is formed, an electrode formed on the substrate, a core made of a resin protrusion protruding from the electrode, and a wiring electrically connected to the electrode and reaching the top of the core A bump electrode composed of a portion, and a manufacturing method of a semiconductor device having at least
Applying a resin liquid in which a filler is dispersed in a photosensitive insulating resin on the substrate;
Allowing the substrate coated with the resin liquid to stand and allowing the filler to settle in the resin liquid;
The resin liquid layer on which the filler has settled is subjected to exposure processing and development processing and patterned, and by adjusting exposure conditions during the exposure processing, the resin liquid layer has a pattern core whose upper surface is a convex curved surface Forming the step,
Forming a wiring portion having a pattern extending from the top of the electrode to the top of the core.
請求項1ないし請求項6のいずれか一項に記載の半導体装置が実装されたことを特徴とする回路基板。
7. A circuit board on which the semiconductor device according to claim 1 is mounted.
請求項1ないし請求項6のいずれか一項に記載の半導体装置、または請求項8記載の回路基板が実装されたことを特徴とする電気光学装置。
An electro-optical device comprising the semiconductor device according to claim 1 or the circuit board according to claim 8 mounted thereon.
請求項8記載の回路基板、または請求項9記載の電気光学装置を有することを特徴とする電子機器。 An electronic apparatus comprising the circuit board according to claim 8 or the electro-optical device according to claim 9.
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