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KR970007653A - 외부기억장치 및 그의 메모리 액세스 제어방법 - Google Patents

외부기억장치 및 그의 메모리 액세스 제어방법 Download PDF

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KR970007653A
KR970007653A KR1019960028077A KR19960028077A KR970007653A KR 970007653 A KR970007653 A KR 970007653A KR 1019960028077 A KR1019960028077 A KR 1019960028077A KR 19960028077 A KR19960028077 A KR 19960028077A KR 970007653 A KR970007653 A KR 970007653A
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다카유키 다무라
시게마사 시오타
구니히로 가타야마
마사시 나이토
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가나이 츠토무
히다치세사쿠쇼 가부시키가이샤
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Publication date
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Abstract

임의의 바이트폭을 갖는 섹터데이타를 섹터단위로 연속액세스할 때 섹터데이타의 에러검출 및 에러정정을 고속으로 처리하기 위한 외부기억장치에 관한 것으로, 단일 에러정정수단에 의해 에러검출 및 정정을 실행하면서 메모리액세스를 고속화하기 위해, 호스트가 라이트하는 섹터데이타는 일시 라이트버퍼에 저장되고, 마이크로프로세서는 라이트버퍼에 저장된 액세스데이타가 기수번째의 섹터데이타인 경우에는 제1 메모리에, 우수번째의 섹터데이타인 경우에는 제2메모리에 저장하고, 호스트가 섹터데이타를 리드할 때에는 데이타전환수단에 있어서 제1메모리에서 리드한 N번째의 섹터데이타를 시스템버스에 대해 출력함과 동시에 제2메모리에서 리드한 N+1번째의 섹터데이타(호스트컴퓨터가 다음에 리드할 섹터데이타)를 에러정정수단에 대해 출력하는 구성으로 하였다.
이러한 구성으로 하는 것에 의해, 에러검출 및 에러정정에 필요로 하는 시간을 단축하고 또한 고속의 메모리액세스를 실현할 수 있다.

Description

외부기억장치 및 그의 메모리 액세스 제어방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 외부기억장치의 시스템구성을 도시한 블럭도, 제2도는 시스템인터페이스부(13)의 구성을 도시한 블럭도, 제3도는 데이타전환수단(11)의 구성을 도시한 블럭도.

Claims (28)

  1. 호스트 컴퓨터와의 인터페이스를 담당하는 시스템 인터페이스부, 섹터데이타를 저장하는 제1메모리 기억영역 및 제2메모리 기억영역, 상기 섹터데이타에 대해서 에러검출 및 에러정정을 실행하는 에러정정수단 및 상기 제1메모리기억영역 및 상기 제2메모리 기억영역에 대한 섹터데이타의 리드 및 라이트동작을 제어하는 제어수단을 구비하고, 상기제어수단은 상기 호스트컴퓨터로 부터의 라이트커맨드에 응답해서 상기 라이트커맨드에 부수하는 여러개의 섹터데이타를섹터단위로 교대로 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역에 저장하고, 상기 제어수단은 상기 호스트컴퓨터로 부터의 리드커맨드에 응답해서 상기 리드커맨드에 의해 요구된 여러개의 섹터데이타중 첫 번째의 섹터데이타를 상기제1메모리 기억영역 및 상기 제2메모리 기억영역에서 리드하고 리드한 섹터데이타를 상기 에러정정수단에 저장한 후, 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역중의 한쪽에서 N번째(N은 자연수)의 섹터데이타를 상기 시스템 인터페이스부로 전송하는 동안 다른쪽에서 N+1번째의 섹터데이타를 상기 에러정정수단으로 전송하도록, 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타를 동시에 리드하는 것을 특징으로 하는 외부기억장치.
  2. 제1항에 있어서, 상기 데이타전환수단은 상기 시스템 인터페이스부 및 상기 에러정정수단중의 한쪽에 상기제1메모리 기억영역의 섹터데이타를 선택적으로 접속하는 제1의 구성과 상기 시스템 인터페이스부 및 상기 에러정정수단중의 다른쪽에 상기 제2메모리 기억영역의 섹터데이타를 선택적으로 접속하는 제2의 구성을 갖고, 상기 제어수단은 다음의 리드클럭사이클시에 상기 시스템 인터페이스부에 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타가 선택적으로 접속되도록 상기 데이타전환수단을 전환하는 것에 의해 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타의 리드를 선택적으로 제어하는 것을 특징으로 하는 외부기억장치.
  3. 제1항에 있어서, 상기 호스트컴퓨터로 부터의 라이트 섹터데이타를 일시적으로 저장하는 라이트버퍼를 더포함하고, 상기 라이트 섹터데이타는 상기 라이트버퍼를 거쳐서 상기 제1메모리 기억영역 및 상기 제2메모리에 저장되는것을 특징으로 하는 외부기억장치.
  4. 제1항에 있어서, 상기 제어수단은 상기 리드커맨드 다음의 제1의 리드클럭 사이클동안 상기 제1섹터데이타를 리드하도록 구성되고, 또 상기 제어수단은 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역중의 한쪽에서 N번째(N은 자연수)의 섹터데이타를 상기 시스템 인터페이스부로 전송하는 동안 다른쪽에서 N+1번째의 섹터데이타를 상기 에러정정수단으로 전송하도록 상기 리드커맨드 다음의 제2의 리드클럭 사이클동안 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타를 동시에 리드하는 것을 특징으로 하는 외부기억장치.
  5. 제1항에 있어서, 상기 제어수단은 상기 에러정정수단에 의한 데이타 에러의 검출시에 에러정정이 가능하도록 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타를 동시에 리드하는 것을 일시적으로 중단하고, 에러정정이 없는지 또는 에러정정이 완료했는지의 판정시에만 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타를 동시에 연속해서 리드할 수 있도록 한 구성을 갖는 것을 특징으로 하는 외부기억장치.
  6. 제1항에 있어서, 상기 에러정정수단은 상기 시스템 인터페이스부와 상기 호스트컴퓨터를 접속하는 시스템버스의 버스폭보다 큰 데이타 비트의 스루풋을 갖는 것을 특징으로 하는 외부기억장치.
  7. 제1항에 있어서, 상기 제1메모리 기억영역과 상기 제2메모리 기억영역은 각각 시스템버스의 버스폭과 동일한 메모리 버스폭을 갖는 독립된 정적기억장치에 의해 마련된 것을 특징으로 하는 외부기억장치.
  8. 제1항에 있어서, 상기 제1메모리 기억영역과 상기 제2메모리 기억영역은 시스템버스의 버스폭보다 큰 메모리 버스폭을 갖는 단일 정정기억장치에 있어서 서로 대향하는 상위 및 하위의 기억비트인 것을 특징으로 하는 외부기억장치.
  9. 호스트 컴퓨터와의 인터페이스를 담당하는 시스템 인터페이스부, 섹터데이타를 저장하고 메모리버스폭이시스템버스폭의 2배인 메모리버스를 갖는 메모리 및 상기 섹터데이타에 대해 에러검출 및 에러정정을 실행하는 에러정정수단 및 상기 메모리에 대한 섹터데이타의 리드 및 라이트동작을 제어하는 제어수단을 포함하고, 상기 제어수단은 상기호스트컴퓨터로부터의 라이트커맨드에 응답해서 상기 라이트커맨드에 부수하는 기수번째 섹터데이타를 상기 메모리버스의상위측 및 하위측중의 한쪽에 의해 액세스되는 메모리위치에 저장하고 또한 상기 라이트커맨드에 부수하는 기수번째 섹터데이타를 상기 메모리버스의 상위측 및 하위측중의 다른쪽에 의해서 액세스되는 메모리위치에 저장하며, 상기 제어수단은상기 호스트컴퓨터로 부터의 리드커맨드에 응답해서 상기 리드커맨드에 의해 요구된 여러개의 섹터데이타중 첫 번째의 섹터데이타를 상기 메모리버스의 상기 상위측 및 상기 하위측중의 한쪽을 사용해서 리드하고 리드한 섹터데이타를 상기 에러정정수단으로 공급한 후, 상기 메모리버스의 상기 상위측 및 상기 하위측중의 한쪽에서 N번째(N은 자연수)의 섹터데이타를 상기 시스템 인터페이스부로 전송하는 동안 다른쪽에서 N+1번째의 섹터데이타를 상기 에러정정수단으로 전송하도록상기 메모리버스의 상기 상위측 및 상기 하위측 모두를 사용해서 섹터데이타를 동시에 리드하는 것을 특징으로 하는 외부기억장치.
  10. 제9항에 있어서, 상기 데이타전환수단은 상기 시스템 인터페이스부 및 상기 에러정정수단중의 한쪽에 상기 메모리버스의 상기 상위측의 섹터데이타를 선택적으로 접속하는 제1의 구성과 상기 시스템 인터페이스부 및 상기 에러정정수단중의 다른쪽에 상기 메모리버스의 상기 하위측의 섹터데이타를 선택적으로 접속하는 제2의 구성을 갖고, 상기 제어수단은 다음의 리드클럭사이클시에 상기 시스템 인터페이스부에 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타가 선택적으로 접속되도록 상기 데이타전환수단을 전환하는 것에 의해, 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타의 리드를 선택적으로 제어하는 것을 특징으로 하는 외부기억장치.
  11. 제9항에 있어서, 상기 호스트컴퓨터로 부터의 라이트 섹터데이타를 일시적으로 저장하는 라이트버퍼를 더포함하고, 상기 라이트 섹터데이타는 상기 라이트버퍼를 거쳐서 상기 메모리에 저장되는 것을 특징으로 하는 외부기억장치.
  12. 제9항에 있어서, 상기 제어수단은 상기 리드커맨드 다음의 제1의 리드클럭 사이클시에 상기 제1섹터데이타를 리드하도록 구성되고, 또 상기 제어수단은 상기 메모리버스의 상기 상위측 및 상기 하위측중의 한쪽에서 N번째(N은자연수)의 섹터데이타를 상기 시스템 인터페이스부로 전송하는 동안 다른쪽에서 N+1번째의 섹터데이타를 상기 에러정정수단으로 전송하도록 상기 리드커맨드 다음의 제2의 리드클럭 사이클시에는 상기 메모리버스의 상기 상위측 및 상기 하위측모두를 사용해서 섹터데이타를 동시에 리드하는 것을 특징으로 하는 외부기억장치.
  13. 제9항에 있어서, 상기 제어수단은 상기 에러정정수단에 의한 데이타 에러의 검출시에 에러정정이 가능하도록 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타를 동시에 리드하는 것을 일시적으로 중단하고, 에러정정이 없는지 또는 에러정정이 완료했는지의 판정시에만 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타를 동시에 연속해서 리드할 수 있도록 한 구성을 갖는 것을 특징으로 하는 외부기억장치.
  14. 제9항에 있어서, 상기 에러정정수단은 상기 시스템 인터페이스부와 상기 호스트컴퓨터를 접속하는 시스템버스의 버스폭보다 큰 데이타 비트의 스루풋을 갖는 것을 특징으로 하는 외부기억장치.
  15. 호스트 컴퓨터와의 인터페이스를 담당하는 시스템 인퍼페이스부, 섹터데이타를 저장하는 제1메모리 기억영역 및 제2메모리 기억영역과 상기 섹터데이타에 대해서 에러검출 및 에러정정을 실행하는 에러정정수단을 구비한 외부기억장치의 메모리 액세스 제어방법으로서, 호스트컴퓨터로 부터의 라이트커맨드에 응답해서 상기 라이트커맨드에 부수하는 여러개의 섹터데이타를 섹터단위로 교대로 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역에 저장하는 스텝과상기 호스트컴퓨터로부터의 리드커맨드에 응답해서 상기 리드커맨드에 의해 요구된 여러개의 섹터데이타중 첫 번째의 섹터데이타를 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역에서 리드하고 리드한 섹터데이타를 상기 에러정정수단에 저장한 후, 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역중의 한쪽에서 N번째(N은 자연수)의 섹터데이타를 상기 시스템 인터페이스부로 전송하는 동안 다른쪽에서 N+1번째의 섹터데이타를 상기 에러정정수단으로 전송하도록 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타를 동시에 리드하는 스텝을 포함하는 것을 특징으로 하는 메모리 액세스 제어방법.
  16. 제15항에 있어서, 상기 데이타 전환수단은 상기 시스템 인터페이스부 및 상기 에러정정수단중의 한쪽에상기 제1메모리 기억영역의 섹터데이타를 선택적으로 접속하는 제1의 구성과 상기 시스템 인터페이스부 및 상기 에러정정수단중의 다른쪽에 상기 제2메모리 기억영역의 섹터데이타를 선택적으로 접속하는 제2의 구성을 갖고, 상기 제어방법은다음의 리드클럭사이클시에 상기 시스템 인터페이스부에 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타가 선택적으로 접속되도록 상기 데이타전환수단을 전환하는 것에 의해 상기 제1메모리 기억영역 및 상기 제2메모리기억영역의 섹터데이타의 리드를 선택적으로 제어하는 스텝을 더 포함하는 것을 특징으로 하는 메모리 액세스 제어방법.
  17. 제15항에 있어서, 상기 호스트컴퓨터로 부터의 라이트 섹터데이타를 일시적으로 저장하는 라이트버퍼를 더 포함하고, 상기 라이트 스텝시에 상기 라이트 섹터데이타는 상기 라이트버퍼를 거쳐서 상기 제1메모리 기억영역 및 상기 제2메모리에 저장되는 것을 특징으로 하는 메모리 액세스 제어방법.
  18. 제16항에 있어서, 상기 리드 스텝은 상기 리드커맨드 다음의 제1의 리드클럭 사이클동안 상기 제1섹터데이타를 리드하고, 또한 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역중의 한쪽에서 (N번째 N은 자연수)의 섹터데이타를 상기 시스템 인터페이스부로 전송하는 동안 다른쪽에서 N+1번째의 섹터데이타를 상기 에러정정수단으로 전송하도록 상기 리드커맨드 다음의 제2의 리드클럭 사이클동안 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타를 동시에 리드하는 것을 특징으로 하는 메모리 액세스 제어방법.
  19. 제15항에 있어서, 상기 리드스텝은 상기 에러정정수단에 의한 데이타에러의 검출시에 에러정정이 가능하도록 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타를 동시에 리드하는 것을 일시적으로 중단하고,에러정정이 없는지 또는 에러정정이 완료했는지의 판정시에만 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타를 동시에 연속해서 리드할 수 있도록 한 것을 특징으로 하는 메모리 액세스 제어방법.
  20. 제15항에 있어서, 상기 에러정정수단은 상기 시스템 인터페이스부와 상기 호스트컴퓨터를 접속하는 시스템버스의 버스폭보다 큰 데이타 비트의 스루풋을 갖는 것을 특징으로 하는 메모리 액세스 제어방법.
  21. 제15항에 있어서, 상기 제1메모리 기억영역과 상기 제2메모리 기억영역에는 각각 시스템버스의 버스폭과 동일한 메모리 버스폭을 갖는 독립된 정적기억장치가 마련되는 것을 특징으로 하는 메모리 액세스 제어방법.
  22. 제15항에 있어서, 상기 제1메모리 기억영역과 상기 제2메모리 기억영역은 시스템버스의 버스폭보다 큰 메모리 버스폭을 갖는 1개의 정정기억장치에 있어서 서로 대향하는 상위 및 하위의 기억비트인 것을 특징으로 하는 메모리액세스 제어방법.
  23. 호스트 컴퓨터와의 인터페이스를 담당하는 시스템 인터페이스부, 섹터데이타를 저장하고 메모리버스폭이시스템버스폭의 2배인 메모리버스를 갖는 메모리 및 상기 섹터데이타에 대해서 에러검출 및 에러정정을 실행하는 에러정정수단을 구비한 외부기억장치의 메모리 액세스 제어방법으로서, 상기 호스트컴퓨터로 부터의 라이트커맨드에 응답해서상기 라이트커맨드에 부수하는 여러개의 섹터데이타를 섹터단위로 교대로 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역에 저장하는 스텝과 상기 호스트컴퓨터로 부터의 리드커맨드에 응답해서 상기 리드커맨드에 의해 요구된 여러개의 섹터데이타중 첫 번째의 섹터데이타를 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역중의 하나에서 리드하고 리드한 섹터데이타를 상기 에러정정수단에 저장한 후, 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역중의 한쪽에서 N번째(N은 자연수)의 섹터데이타를 상기 시스템 인터페이스부로 전송하는 동안 다른쪽에서 N+1번째의 섹터데이타를 상기 에러정정수단으로 진송하도록 상기 제1메모리 기억영역 및 상기 제2메모리 기억영역의 섹터데이타를 동시에 리드하는 스텝을 포함하는 것을 특징으로 하는 메모리 액세스 제어방법.
  24. 제23항에 있어서, 상기 시스템 인터페이스부 및 상기 에러정정수단중의 한쪽에 상기 메모리버스의 상기상위측의 섹터데이타를 선택적으로 접속하는 제1의 구성과 상기 시스템 인터페이스부 및 상기 에러정정수단중의 다른쪽에상기 메모리버스의 상기 하위측의 섹터데이타를 선택적으로 접속하는 제2의 구성을 갖고, 상기 방법은 다음의 리드클럭사이클시에 상기 시스템 인터페이스부에 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타가 선택적으로 접속되도록 상기 데이타전환수단을 전환하는 것에 의해, 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타의 리드를선택적으로 제어하는 스텝을 더 포함하는 것을 특징으로 하는 메모리 액세스 제어방법.
  25. 제23항에 있어서, 상기 호스트컴퓨터로 부터의 라이트 섹터데이타를 일시적으로 저장하는 라이트버퍼를더 포함하고, 상기 라이트 스텝시에 상기 라이트 섹터데이타는 상기 라이트버퍼를 거쳐서 상기 메모리에 저장되는 것을특징으로 하는 메모리 액세스 제어방법.
  26. 제23항에 있어서, 상기 리드스텝은 상기 리드커맨드 다음의 제1의 리드클럭 사이클시에 상기 제1섹터데이타를 리드하고, 또 상기 메모리버스의 상기 상위측 및 상기 하위측중의 한쪽에서 N번째(N은 자연수)의 섹터데이타를 상기시스템 인터페이스부로 전송하는 동안 다른쪽에서 N+1번째의 섹터데이타를 상기 에러정정수단으로 전송하도록 상기 리드커맨드 다음의 제2의 리드클럭 사이클시에는 상기 메모리버스의 상기 상위측 및 상기 하위측 모두를 사용해서 섹터데이타를 동시에 리드하는 것을 특징으로 하는 메모리 액세스 제어방법.
  27. 제23항에 있어서, 상기 리드스텝은 상기 에러정정수단에 의한 데이타 에러의 검출시에 에러정정이 가능하도록 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타를 동시에 리드하는 것을 일시적으로 중단하고, 에러정정이 없는지 또는 에러정정이 완료했는지의 판정시에만 상기 메모리버스의 상기 상위측 및 상기 하위측의 섹터데이타를 동시에 연속해서 리드할 수 있도록 한 것을 특징으로 하는 메모리 액세스 제어방법.
  28. 제23항에 있어서, 상기 에러정정수단은 상기 시스템 인터페이스부와 상기 호스트컴퓨터를 접속하는 시스템버스의 버스폭보다 큰 데이타 비트의 스루풋을 갖는 것을 특징으로 하는 메모리 액세스 제어방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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