JP2013021239A - Photoelectric conversion element - Google Patents
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Abstract
Description
この発明は、光電変換素子に関するものである。 The present invention relates to a photoelectric conversion element.
従来、光を電気に変換する太陽電池として特許文献1に記載の太陽電池が知られている。 Conventionally, the solar cell of patent document 1 is known as a solar cell which converts light into electricity.
この太陽電池は、n型単結晶シリコンと、真性非晶質シリコンと、p型非晶質シリコンと、透明導電膜と、裏面電極とを備える。 This solar cell includes n-type single crystal silicon, intrinsic amorphous silicon, p-type amorphous silicon, a transparent conductive film, and a back electrode.
真性非晶質シリコンは、n型単結晶シリコンの一主面に形成される。p型非晶質シリコンは、真性非晶質シリコン上に真性非晶質シリコンに接して形成される。透明導電膜は、p型非晶質シリコン上にp型非晶質シリコンに接して形成される。裏面電極は、透明導電膜と反対側において、n型単結晶シリコンに接して形成される。 Intrinsic amorphous silicon is formed on one main surface of n-type single crystal silicon. The p-type amorphous silicon is formed on the intrinsic amorphous silicon in contact with the intrinsic amorphous silicon. The transparent conductive film is formed on the p-type amorphous silicon in contact with the p-type amorphous silicon. The back electrode is formed in contact with the n-type single crystal silicon on the side opposite to the transparent conductive film.
しかし、従来の太陽電池のように、透明導電膜に接してp型非晶質シリコンを形成した場合、透明導電膜とp型非晶質シリコンとの間に正孔に対してエネルギー障壁が形成される。その結果、光励起された正孔は、p型非晶質シリコンから透明導電膜へ効率良く伝導することが困難になり、太陽電池の曲線因子(FF:Fill Factor)が低下する。また、上記のエネルギー障壁は、太陽電池内の拡散電位を低下させ、太陽電池の開放電圧を低下させる。 However, when p-type amorphous silicon is formed in contact with the transparent conductive film as in a conventional solar cell, an energy barrier is formed against holes between the transparent conductive film and the p-type amorphous silicon. Is done. As a result, it becomes difficult to efficiently conduct the photoexcited holes from the p-type amorphous silicon to the transparent conductive film, and the fill factor (FF) of the solar cell is lowered. Moreover, said energy barrier reduces the diffusion potential in a solar cell, and reduces the open circuit voltage of a solar cell.
そこで、この発明は、上記のエネルギー障壁による太陽電池の特性低下を解決すると言う新規な課題に着目してなされたものであり、変換効率を向上可能な光電変換素子を提供するものである。 Accordingly, the present invention has been made paying attention to a novel problem of solving the deterioration of the characteristics of the solar cell due to the energy barrier, and provides a photoelectric conversion element capable of improving the conversion efficiency.
この発明の実施の形態によれば、光電変換素子は、光電変換部と、i型半導体膜と、p型半導体膜と、n型半導体膜と、透明導電膜とを備える。光電変換部は、結晶シリコンからなる。i型半導体膜は、光電変換部に接して形成される。p型半導体膜は、i型半導体膜に接して形成される。n型半導体膜は、p型半導体膜に接して形成される。透明導電膜は、n型半導体膜に接して形成される。そして、p型半導体膜およびn型半導体膜の一方は、非晶質相からなり、p型半導体膜およびn型半導体膜の他方は、微結晶相または非晶質相からなる。 According to the embodiment of the present invention, the photoelectric conversion element includes a photoelectric conversion unit, an i-type semiconductor film, a p-type semiconductor film, an n-type semiconductor film, and a transparent conductive film. The photoelectric conversion unit is made of crystalline silicon. The i-type semiconductor film is formed in contact with the photoelectric conversion unit. The p-type semiconductor film is formed in contact with the i-type semiconductor film. The n-type semiconductor film is formed in contact with the p-type semiconductor film. The transparent conductive film is formed in contact with the n-type semiconductor film. One of the p-type semiconductor film and the n-type semiconductor film is made of an amorphous phase, and the other of the p-type semiconductor film and the n-type semiconductor film is made of a microcrystalline phase or an amorphous phase.
この発明の実施の形態による光電変換素子においては、光電変換部において光励起された電子は、光電変換部から外部のリード線および透明導電膜を介してn型半導体膜へ到達する。また、光電変換部において光励起された正孔は、i型半導体膜を介してp型半導体膜へ到達する。そして、n型半導体膜とp型半導体膜との界面に再結合準位が存在するため、n型半導体膜とp型半導体膜との界面における電子および正孔の再結合が促進される。また、n型半導体膜とp型半導体膜とからなるn/p接合は、n型半導体膜とp型半導体膜との界面に存在する再結合準位に起因して整流特性を殆ど示さず、p型半導体膜/i型半導体膜/光電変換部からなる接合における内部電位の低下を抑制する。その結果、光電変換素子の開放電圧および曲線因子が向上する。 In the photoelectric conversion element according to the embodiment of the present invention, the electrons photoexcited in the photoelectric conversion unit reach the n-type semiconductor film from the photoelectric conversion unit via the external lead wire and the transparent conductive film. Further, the holes photoexcited in the photoelectric conversion unit reach the p-type semiconductor film through the i-type semiconductor film. Since a recombination level exists at the interface between the n-type semiconductor film and the p-type semiconductor film, recombination of electrons and holes at the interface between the n-type semiconductor film and the p-type semiconductor film is promoted. An n / p junction composed of an n-type semiconductor film and a p-type semiconductor film exhibits almost no rectification characteristics due to a recombination level existing at the interface between the n-type semiconductor film and the p-type semiconductor film, A decrease in internal potential at the junction composed of the p-type semiconductor film / i-type semiconductor film / photoelectric conversion portion is suppressed. As a result, the open circuit voltage and the fill factor of the photoelectric conversion element are improved.
従って、光電変換素子の変換効率を向上できる。 Therefore, the conversion efficiency of the photoelectric conversion element can be improved.
本発明の実施の形態について図面を参照しながら詳細に説明する。なお、図中同一または相当部分には同一符号を付してその説明は繰返さない。 Embodiments of the present invention will be described in detail with reference to the drawings. In the drawings, the same or corresponding parts are denoted by the same reference numerals and description thereof will not be repeated.
この明細書において、「非晶質相」とは、シリコン(Si)原子等がランダムに配列された状態を言う。また、「微結晶相」とは、Si原子等のランダムなネットワークの中に粒径が10〜100nm程度であるSi等の結晶粒が存在する状態を言う。更に、アモルファスシリコンを「a−Si」と表記するが、この表記は、実際には、水素(H)原子が含まれていることを意味する。アモルファスシリコンカーバイド(a−SiC)、アモルファスシリコンゲルマニウム(a−SiGe)、アモルファスゲルマニウム(a−Ge)、微結晶シリコンカーバイド(μc−SiC)、微結晶シリコン(μc−Si)、微結晶シリコンゲルマニウム(μc−SiGe)、および微結晶ゲルマニウム(μc−Ge)についても、同様に、H原子が含まれていることを意味する。 In this specification, the “amorphous phase” refers to a state in which silicon (Si) atoms and the like are randomly arranged. The “microcrystalline phase” refers to a state in which crystal grains such as Si having a grain diameter of about 10 to 100 nm exist in a random network such as Si atoms. Furthermore, although amorphous silicon is described as “a-Si”, this notation actually means that hydrogen (H) atoms are included. Amorphous silicon carbide (a-SiC), amorphous silicon germanium (a-SiGe), amorphous germanium (a-Ge), microcrystalline silicon carbide (μc-SiC), microcrystalline silicon (μc-Si), microcrystalline silicon germanium ( Similarly, μc-SiGe) and microcrystalline germanium (μc-Ge) mean that H atoms are contained.
図1は、この発明の実施の形態による光電変換素子の構成を示す断面図である。図1を参照して、この発明の実施の形態による光電変換素子10は、透明導電膜1と、n型半導体膜2と、p型半導体膜3と、i型半導体膜4と、光電変換部5とを備える。
FIG. 1 is a cross-sectional view showing a configuration of a photoelectric conversion element according to an embodiment of the present invention. Referring to FIG. 1, a
透明導電膜1は、例えば、ITO(Indium Tin Oxide)、SnO2およびZnO等からなる。 The transparent conductive film 1 is made of, for example, ITO (Indium Tin Oxide), SnO 2, ZnO, or the like.
n型半導体膜2は、透明導電膜1に接して配置される。そして、n型半導体膜2は、p型半導体膜3が非晶質相からなる場合、非晶質相または微結晶相からなる。また、n型半導体膜2は、p型半導体膜3が微結晶相からなる場合、非晶質相からなる。
The n-
p型半導体膜3は、n型半導体膜2に接して配置される。そして、p型半導体膜3は、n型半導体膜2が非晶質相からなる場合、非晶質相または微結晶相からなる。また、p型半導体膜3は、n型半導体膜2が微結晶相からなる場合、非晶質相からなる。
The p-
i型半導体膜4は、p型半導体膜3に接して配置される。そして、i型半導体膜4は、非晶質相からなる。
The i-type semiconductor film 4 is disposed in contact with the p-
光電変換部5は、i型半導体膜4に接して配置される。そして、光電変換部5は、単結晶シリコンまたは多結晶シリコンからなる。即ち、光電変換部5は、結晶シリコンからなる。
The
光電変換素子10においては、太陽光は、透明導電膜1側から光電変換素子10に入射される。
In the
光電変換素子10は、i型半導体膜4、p型半導体膜3、n型半導体膜2および透明導電膜1を光電変換部5上に順次積層して製造される。
The
上述したように、n型半導体膜2およびp型半導体膜3の一方が非晶質相からなり、かつ、n型半導体膜2およびp型半導体膜3の他方が非晶質相または微結晶相からなるので、n型半導体膜2とp型半導体膜3との界面には、再結合準位が存在する。また、n型半導体膜2とp型半導体膜3とからなる接合は、n型半導体膜2/p型半導体膜3界面に存在する再結合準位に起因して整流特性を殆ど示さないので、p型半導体膜3/i型半導体膜4/光電変換部5内の拡散電位の低下が抑制される。
As described above, one of the n-
その結果、光電変換部5で光励起された正孔は、キャリア拡散および拡散電位によってp型半導体膜3へ移動し、n型半導体膜2とp型半導体膜3との界面に到達する。また、光電変換部5で光励起された電子は、光電変換部5から外部のリード線(図示せず)および透明導電膜1を介してn型半導体膜2に到達する。そして、電子と正孔は、n型半導体膜2とp型半導体膜3との界面において、再結合準位を介して再結合する。これによって、光電流Iphが光電変換素子10に流れる。
As a result, the holes photoexcited by the
このように、n型半導体膜2を透明導電膜1とp型半導体膜3との間に設けることによって、光電変換部5で光励起された正孔は、n型半導体膜2とp型半導体膜3との界面で電子と効率良く再結合する。
As described above, by providing the n-
従って、透明導電膜に接してp型半導体膜を形成したときに形成されるエネルギー障壁による拡散電位の低下および曲線因子の低下が抑制され、光電変換素子10の変換効率を向上できる。
Therefore, the decrease in the diffusion potential and the decrease in the fill factor due to the energy barrier formed when the p-type semiconductor film is formed in contact with the transparent conductive film can be suppressed, and the conversion efficiency of the
n型半導体膜2が非晶質相からなり、p型半導体膜3が微結晶相からなる場合、p型半導体膜3/i型半導体膜4/光電変換部5内の拡散電位は、p型半導体膜3が非晶質相からなる場合よりも大きくなるので、開放電圧Vocを大きくできる。また、p型半導体膜3が微結晶相からなる場合、p型半導体膜3の抵抗は、p型半導体膜3が非晶質相からなる場合よりも低くなるので、曲線因子FFを改善できる。その結果、光電変換素子10の変換効率を更に向上できる。
When the n-
以下、光電変換素子10の実施例について説明する。光電変換素子10を具体的に実現する場合、n型半導体膜2、p型半導体膜3およびi型半導体膜4は、n型半導体膜2およびp型半導体膜3の一方が非晶質相からなり、かつ、n型半導体膜2およびp型半導体膜3の他方が非晶質相または微結晶相からなる条件下において、表1に示す各材料からなる。
Hereinafter, examples of the
(実施例1)
図2は、実施例1における光電変換素子の構成を示す断面図である。図2を参照して、光電変換素子10Aは、集電電極9と、透明導電膜11と、n型非晶質膜21と、p型非晶質膜31と、i型非晶質膜41と、光電変換部51と、絶縁層61と、裏面電極62とを備える。
Example 1
FIG. 2 is a cross-sectional view illustrating a configuration of the photoelectric conversion element according to the first embodiment. Referring to FIG. 2,
i型非晶質膜41、p型非晶質膜31、n型非晶質膜21、透明導電膜11および集電電極9は、光電変換部51上に順次積層される。絶縁層61および裏面電極62は、透明導電膜11と反対側において、光電変換部51上に順次積層される。
The i-type
集電電極9は、例えば、銀(Ag)からなり、透明導電膜11の表面に櫛型に形成される。
The
透明導電膜11は、例えば、SnO2からなる。n型非晶質膜21は、例えば、n型a−Siからなり、膜厚は、例えば、5nmである。また、n型非晶質膜21中のリン(P)濃度は、5×1020cm−3〜7×1020cm−3である。そして、n型非晶質膜21は、透明導電膜11に接する。
The transparent
p型非晶質膜31は、例えば、p型a−Siからなり、膜厚は、例えば、10nmである。そして、p型非晶質膜31は、n型非晶質膜21に接する。
The p-type
i型非晶質膜41は、例えば、i型a−Siからなり、膜厚は、例えば、10nmである。そして、i型非晶質膜41は、p型非晶質膜31に接する。
The i-type
光電変換部51は、例えば、面方位が(100)であり、比抵抗が0.1〜1.0Ω・cmであるn型単結晶シリコンからなり、厚みは、例えば、200〜300μmである。そして、光電変換部51は、i型非晶質膜41に接する。
The
絶縁層61は、例えば、二酸化シリコン(SiO2)とシリコンナイトライド(SiN)との2層構造からなる。そして、絶縁層61は、SiO2が光電変換部51に接するように光電変換部51の表面に形成される。
The insulating
裏面電極62は、例えば、アルミニウム(Al)からなる。そして、裏面電極62は、絶縁層61に形成されたスルーホールを介して光電変換部51に接するとともに絶縁層61を覆う。
The
このように、光電変換素子10Aは、光電変換素子10のn型半導体膜2、p型半導体膜3およびi型半導体膜4の全てに非晶質膜を用いて光電変換素子10を具体化したものである。
As described above, the
光電変換素子10Aの製造方法について説明する。光電変換素子10Aは、プラズマ装置を用いてプラズマCVD(Chemical Vapour Deposition)法によって製造される。
A method for manufacturing the
プラズマ装置は、仕込室と、反応室CB1〜CB3と、取出室と、整合器と、RF電源とを備える。仕込室、反応室CB1〜CB3および取出室は、直線的に配置されている。そして、仕込室と反応室CB1との間、反応室CB1と反応室CB2との間、反応室CB2と反応室CB3との間、および反応室CB3と取出室との間は、仕切バルブで仕切られている。また、仕込室から反応室CB1、反応室CB2、反応室CB3および取出室へシリコンウェハを順次搬送する搬送機構がプラズマ装置に備えられている。 The plasma apparatus includes a preparation chamber, reaction chambers CB1 to CB3, an extraction chamber, a matching unit, and an RF power source. The charging chamber, the reaction chambers CB1 to CB3, and the take-out chamber are linearly arranged. A partition valve is used to partition between the charging chamber and the reaction chamber CB1, between the reaction chamber CB1 and the reaction chamber CB2, between the reaction chamber CB2 and the reaction chamber CB3, and between the reaction chamber CB3 and the take-out chamber. It has been. In addition, the plasma apparatus is provided with a transfer mechanism for sequentially transferring silicon wafers from the preparation chamber to the reaction chamber CB1, the reaction chamber CB2, the reaction chamber CB3, and the take-out chamber.
仕込室は、加熱機構と排気機構とを備える。加熱機構は、シリコンウェハを所定の温度に昇温する。排気機構は、仕込室内のガスを排気し、仕込室の到達圧力を、例えば、1×10−5Pa以下に設定する。 The charging chamber includes a heating mechanism and an exhaust mechanism. The heating mechanism raises the temperature of the silicon wafer to a predetermined temperature. The exhaust mechanism exhausts the gas in the preparation chamber, and sets the ultimate pressure in the preparation chamber to, for example, 1 × 10 −5 Pa or less.
反応室CB1〜CB3の各々は、平行平板電極と、加熱機構と、排気機構とを備える。加熱機構は、シリコンウェハを所定の温度に昇温する。排気機構は、反応室CB1〜CB3内のガスを排気し、反応室CB1〜CB3の到達圧力を、例えば、1×10−5Pa以下に設定する。平行平板電極は、整合器を介してRF電源に接続される。 Each of the reaction chambers CB1 to CB3 includes a parallel plate electrode, a heating mechanism, and an exhaust mechanism. The heating mechanism raises the temperature of the silicon wafer to a predetermined temperature. The exhaust mechanism exhausts the gases in the reaction chambers CB1 to CB3, and sets the ultimate pressure in the reaction chambers CB1 to CB3 to, for example, 1 × 10 −5 Pa or less. The parallel plate electrodes are connected to an RF power source through a matching unit.
取出室は、排気機構を備える。排気機構は、取出室内のガスを排気し、取出室の到達圧力を、例えば、1×10−5Pa以下に設定する。 The take-out chamber includes an exhaust mechanism. The exhaust mechanism exhausts the gas in the extraction chamber and sets the ultimate pressure in the extraction chamber to, for example, 1 × 10 −5 Pa or less.
仕込室、反応室CB1〜CB3、および取出室の各排気機構は、ターボ分子ポンプ、メカニカルブースタポンプおよびロータリーポンプからなる。ターボ分子ポンプ、メカニカルブースタポンプおよびロータリーポンプは、ターボ分子ポンプが仕込室、反応室CB1〜CB3および取出室に最も近くなるように仕込室、反応室CB1〜CB3、および取出室に直列的に連結されている。そして、各排気機構は、ターボ分子ポンプ、メカニカルブースタポンプおよびロータリーポンプによって仕込室、反応室CB1〜CB3および取出室内のガスを排気し、またはメカニカルブースタポンプおよびロータリーポンプによって仕込室、反応室CB1〜CB3および取出室内のガスを排気する。 Each exhaust mechanism of the preparation chamber, the reaction chambers CB1 to CB3, and the take-out chamber includes a turbo molecular pump, a mechanical booster pump, and a rotary pump. The turbo molecular pump, mechanical booster pump and rotary pump are connected in series to the charging chamber, reaction chambers CB1 to CB3, and the extraction chamber so that the turbo molecular pump is closest to the charging chamber, reaction chambers CB1 to CB3 and the extraction chamber. Has been. Each exhaust mechanism exhausts the gas in the charging chamber, reaction chambers CB1 to CB3 and the extraction chamber by a turbo molecular pump, a mechanical booster pump and a rotary pump, or the charging chamber and reaction chamber CB1 by a mechanical booster pump and a rotary pump. The gas in CB3 and the extraction chamber is exhausted.
RF電源は、例えば、13.56MHzのRF電力を整合器を介して反応室CB1〜CB3の平行平板電極に印加する。 The RF power source applies, for example, RF power of 13.56 MHz to the parallel plate electrodes of the reaction chambers CB1 to CB3 via the matching unit.
光電変換素子10Aの製造が開始されると、光電変換部51としてのn型単結晶シリコンからなるシリコンウェハをエタノール等で超音波洗浄して脱脂し、その後、シリコンウェハをフッ酸中に浸漬してn型単結晶シリコンの表面に形成された自然酸化膜を除去するとともに、n型単結晶シリコンの表面を水素で終端する。
When manufacture of the
なお、n型単結晶シリコンの表面をテクスチャ化する場合、シリコンウェハをエタノール等で超音波洗浄した後、シリコンウェハの表面をアルカリを用いて化学的に異方性エッチングし、n型単結晶シリコンの表面をテクスチャ化する。その後、上述したようにフッ酸を用いて自然酸化膜を除去するとともに、n型単結晶シリコンの表面を水素で終端する。 When texturing the surface of n-type single crystal silicon, the silicon wafer is ultrasonically cleaned with ethanol or the like, and then the silicon wafer surface is chemically anisotropically etched using an alkali to obtain n-type single crystal silicon. Texture the surface. Thereafter, the natural oxide film is removed using hydrofluoric acid as described above, and the surface of the n-type single crystal silicon is terminated with hydrogen.
シリコンウェハの洗浄が終了すると、シリコンウェハをプラズマ装置の仕込室の基板ホルダー上に配置する。 When the cleaning of the silicon wafer is completed, the silicon wafer is placed on the substrate holder in the preparation chamber of the plasma apparatus.
そして、仕込室の排気機構は、1×10−5Pa以下に仕込室内のガスを排気し、仕込室の加熱機構は、シリコンウェハ(n型単結晶シリコン)の温度を200℃に設定するように基板ホルダーを加熱する。また、反応室CB1〜CB3の加熱機構も、シリコンウェハ(n型単結晶シリコン)の温度を200℃に設定するように基板ホルダーを加熱する。 The charging chamber exhaust mechanism exhausts the gas in the charging chamber to 1 × 10 −5 Pa or less, and the charging chamber heating mechanism sets the temperature of the silicon wafer (n-type single crystal silicon) to 200 ° C. Heat the substrate holder. Further, the heating mechanism of the reaction chambers CB1 to CB3 also heats the substrate holder so that the temperature of the silicon wafer (n-type single crystal silicon) is set to 200 ° C.
シリコンウェハ(n型単結晶シリコン)の温度が200℃に達すると、仕込室と反応室CB1との間の仕切バルブが開けられ、シリコンウェハ(n型単結晶シリコン)は、仕込室から反応室CB1へ搬送される。 When the temperature of the silicon wafer (n-type single crystal silicon) reaches 200 ° C., the partition valve between the charging chamber and the reaction chamber CB1 is opened, and the silicon wafer (n-type single crystal silicon) is moved from the charging chamber to the reaction chamber. Transported to CB1.
n型非晶質膜21、p型非晶質膜31およびi型非晶質膜41を形成するときの材料ガスの流量を表2に示す。
Table 2 shows the flow rate of the material gas when forming the n-type
シリコンウェハ(n型単結晶シリコン)が反応室CB1へ搬送されると、10sccmのシラン(SiH4)ガスと、100sccmの水素(H2)ガスとを反応室CB1に流し、反応室CB1の圧力を13.3Pa〜665Paの範囲に設定する。そして、RF電源は、16〜80mW/cm2の範囲のRFパワーを整合器を介して平行平板電極に印加する。これによって、反応室CB1内でプラズマが発生し、i型非晶質膜41としてのi型a−Siがn型単結晶シリコンの一主面上に堆積される。
When the silicon wafer (n-type single crystal silicon) is transferred to the reaction chamber CB1, 10 sccm of silane (SiH 4 ) gas and 100 sccm of hydrogen (H 2 ) gas are allowed to flow into the reaction chamber CB1, and the pressure in the reaction chamber CB1 is increased. Is set in the range of 13.3 Pa to 665 Pa. The RF power source applies RF power in the range of 16 to 80 mW / cm 2 to the parallel plate electrodes through the matching unit. Thereby, plasma is generated in the reaction chamber CB1, and i-type a-Si as the i-type
i型非晶質膜41の膜厚が10nmになると、反応室CB1の平行平板電極へのRFパワーの印加を停止するとともに、SiH4ガスおよびH2ガスの反応室CB1への供給を停止し、排気機構によって1×10−5Pa以下に反応室CB1を真空引きする。そして、仕切バルブを開け、i型非晶質膜41/n型単結晶シリコンを反応室CB1から反応室CB2へ搬送する。
When the film thickness of the i-type
i型非晶質膜41/n型単結晶シリコンが反応室CB2へ搬送されると、2sccmのSiH4ガスと、42sccmのH2ガスと、水素希釈された12sccmのジボラン(B2H6)ガスとを反応室CB2に流し、反応室CB2の圧力を13.3Pa〜665Paの範囲に設定する。そして、RF電源は、16〜80mW/cm2の範囲のRFパワーを整合器を介して平行平板電極に印加する。なお、水素希釈されたB2H6ガスの濃度は、0.1%である。
When the i-type
これによって、反応室CB2内でプラズマが発生し、p型非晶質膜31としてのp型a−Siがi型非晶質膜41上に堆積される。
As a result, plasma is generated in the reaction chamber CB2, and p-type a-Si as the p-type
p型非晶質膜31の膜厚が10nmになると、反応室CB2の平行平板電極へのRFパワーの印加を停止するとともに、SiH4ガス、H2ガスおよびB2H6ガスの反応室CB2への供給を停止し、排気機構によって1×10−5Pa以下に反応室CB2を真空引きする。そして、仕切バルブを開け、p型非晶質膜31/i型非晶質膜41/n型単結晶シリコンを反応室CB2から反応室CB3へ搬送する。
When the thickness of the p-type
p型非晶質膜31/i型非晶質膜41/n型単結晶シリコンが反応室CB3へ搬送されると、20sccmのSiH4ガスと、150sccmのH2ガスと、水素希釈された50sccmのホスフィン(PH3)ガスとを反応室CB3に流し、反応室CB3の圧力を13.3Pa〜665Paの範囲に設定する。そして、RF電源は、16〜80mW/cm2の範囲のRFパワーを整合器を介して平行平板電極に印加する。
When the p-type
これによって、反応室CB3内でプラズマが発生し、n型非晶質膜21としてのn型a−Siがp型非晶質膜31上に堆積される。なお、水素希釈されたPH3ガスの濃度は、0.2%である。
As a result, plasma is generated in the
n型非晶質膜21の膜厚が5nmになると、反応室CB3の平行平板電極へのRFパワーの印加を停止するとともに、SiH4ガス、H2ガスおよびPH3ガスの反応室CB3への供給を停止し、排気機構によって1×10−5Pa以下に反応室CB3を真空引きする。そして、仕切バルブを開け、n型非晶質膜21/p型非晶質膜31/i型非晶質膜41/n型単結晶シリコンを反応室CB3から取出室へ搬送する。
When the thickness of the n-type
そして、取出室でn型非晶質膜21/p型非晶質膜31/i型非晶質膜41/n型単結晶シリコンを室温まで冷却した後、n型非晶質膜21/p型非晶質膜31/i型非晶質膜41/n型単結晶シリコンを取出室から取出し、n型非晶質膜21/p型非晶質膜31/i型非晶質膜41/n型単結晶シリコンをスパッタリング装置にセットする。
Then, after cooling the n-type
そして、スパッタリング法によって透明導電膜11としてのSnO2をn型非晶質膜21上に形成し、その後、金属マスクを用いてスパッタリング法によって集電電極9としてのAgを透明導電膜11上に形成する。
Then, SnO 2 as the transparent
引き続いて、透明導電膜11と反対側のn型単結晶シリコンの表面にスパッタリング法によってSiO2およびSiNを順次積層する。
Subsequently, SiO 2 and SiN are sequentially laminated on the surface of the n-type single crystal silicon opposite to the transparent
そうすると、集電電極9/透明導電膜11/n型非晶質膜21/p型非晶質膜31/i型非晶質膜41/n型単結晶シリコン/SiO2/SiNをスパッタリング装置から取り出す。そして、集電電極9/透明導電膜11/n型非晶質膜21/p型非晶質膜31/i型非晶質膜41/n型単結晶シリコン/SiO2/SiNのSiNの表面にレジストを塗布し、その塗布したレジストをフォトリソグラフィによって所定のパターンにパターンニングする。
Then, collecting
その後、レジストパターンをマスクとしてSiO2/SiNをエッチングする。SiO2/SiNのエッチングは、化学的なウェットエッチングでも、プラズマを用いたドライエッチングでもよい。 Thereafter, SiO 2 / SiN is etched using the resist pattern as a mask. The etching of SiO 2 / SiN may be chemical wet etching or dry etching using plasma.
そして、レジストパターンを除去し、エッチングされたSiO2/SiNの全面に蒸着等によって裏面電極(Al)を形成する。これによって、光電変換素子10Aが完成する。
Then, the resist pattern is removed, and a back electrode (Al) is formed on the entire surface of the etched SiO 2 / SiN by vapor deposition or the like. Thereby, the
このように、光電変換素子10Aは、i型非晶質膜41、p型非晶質膜31およびn型非晶質膜21をプラズマCVD法によって光電変換部51の一主面上に順次積層し、その後、スパッタリング法によって透明導電膜11(SnO2)および集電電極9(Ag)をn型非晶質膜21上に順次積層し、絶縁層61(SiO2/SiN)および裏面電極62(Al)を光電変換部51の他方の表面上に順次積層することによって製造される。
As described above, the
図3は、図2に示す光電変換素子10Aのエネルギーバンド図である。なお、図3においては、集電電極9、絶縁層61および裏面電極62が省略されている。
FIG. 3 is an energy band diagram of the
図3を参照して、n型非晶質膜21およびp型非晶質膜31は、1.8eVの光学バンドギャップおよび0.20eVの活性化エネルギーを有し、i型非晶質膜41は、1.74eVの光学バンドギャップおよび0.73eVの活性化エネルギーを有し、光電変換部51としてのn型単結晶シリコンは、1.1eVの光学バンドギャップおよび0.4〜0.5eVの活性化エネルギーを有する。
Referring to FIG. 3, n-type
その結果、p型非晶質膜31およびi型非晶質膜41は、ヘテロ接合を形成し、i型非晶質膜41およびn型単結晶シリコン(光電変換部51)も、ヘテロ接合を形成する。
As a result, the p-type
また、n型非晶質膜21は、n型a−Siからなり、p型非晶質膜31は、p型a−Siからなる。そして、n型非晶質膜21(n型a−Si)は、プラズマCVD法によってp型非晶質膜31(p型a−Si)に接してp型非晶質膜31(p型a−Si)上に堆積される。その結果、n型非晶質膜21(n型a−Si)の堆積時に、n型非晶質膜21(n型a−Si)中のP原子とp型非晶質膜31(p型a−Si)中のボロン(B)原子とが相互に拡散する。従って、n型非晶質膜21とp型非晶質膜31との界面には、再結合準位が存在する。そして、この再結合準位が存在するために、n型非晶質膜21とp型非晶質膜31とからなる接合(n/p接合)は、殆ど整流特性を示さない。その結果、p型非晶質膜31/i型非晶質膜41/n型単結晶シリコン(光電変換部51)からなるpin接合の拡散電位(=内部電位Vbi)は、殆ど低下しない。
The n-type
更に、i型非晶質膜41をp型非晶質膜31とn型単結晶シリコン(光電変換部51)との間に挿入することによって、p型非晶質膜31中のB原子と、n型単結晶シリコン(光電変換部51)中のP原子とが相互に混入するのを防止するとともに、n型単結晶シリコン(光電変換部51)の表面に存在するダングリングボンドをH原子によって終端する。その結果、p型非晶質膜31/i型非晶質膜41界面およびi型非晶質膜41/n型単結晶シリコン(光電変換部51)界面におけるキャリア(電子および正孔)の再結合が低減される。
Further, by inserting the i-type
更に、絶縁層61のSiO2は、n型単結晶シリコン(光電変換部51)に接するため、n型単結晶シリコン(光電変換部51)/絶縁層61(SiO2)界面における電子および正孔の再結合が低減される。 Furthermore, since SiO 2 of the insulating layer 61 is in contact with the n-type single crystal silicon (photoelectric conversion portion 51), electrons and holes at the interface of the n-type single crystal silicon (photoelectric conversion portion 51) / insulating layer 61 (SiO 2 ). Recombination is reduced.
そうすると、n型単結晶シリコン(光電変換部51)において光励起された正孔は、キャリア拡散によってi型非晶質膜41側へ移動し、内部電位Vbiによってp型非晶質膜31へ移動する。また、n型単結晶シリコン(光電変換部51)において光励起された電子は、キャリア拡散によって裏面電極62側へ移動する。
Then, the photoexcited holes in the n-type single crystal silicon (photoelectric conversion unit 51) move to the i-type
そして、電子は、裏面電極62、外部のリード線(図示せず)および透明導電膜11を介してn型非晶質膜21へ到達する。この場合、n型非晶質膜21とp型非晶質膜31との界面には、電子に対するエネルギー障壁φnが存在するので、n型非晶質膜21中の電子は、p型非晶質膜31へ移動することができない。
Then, the electrons reach the n-type
また、p型非晶質膜31とn型非晶質膜21との界面には、正孔に対するエネルギー障壁φpが存在するので、p型非晶質膜31中の正孔は、透明導電膜11へ移動することができない。
Further, the interface between the p-type
その結果、電子および正孔は、n型非晶質膜21とp型非晶質膜31との界面における再結合準位を介して効率的に再結合する。上述したように、n型非晶質膜21中のP濃度は、5×1020cm−3〜7×1020cm−3であるので、n型非晶質膜21とp型非晶質膜31との界面における再結合準位が多くなり、電子および正孔は、この再結合準位を介して効率的に再結合する。これによって、光電変換素子10Aには、光電流Iphが流れ、曲線因子FFは、p型非晶質膜31が透明導電膜11に接する場合よりも改善される。
As a result, electrons and holes recombine efficiently through recombination levels at the interface between the n-type
また、上述したように、n型非晶質膜21およびp型非晶質膜31からなるn/p接合は、内部電位Vbiを殆ど低下させず、内部電位Vbiによる電子と正孔との分離効果が大きいので、光電流Iphが零になるときの電圧(開放電圧Voc)は、p型非晶質膜31が透明導電膜11に接する場合よりも大きくなる。
Further, as described above, the n / p junction composed of the n-type
従って、n型非晶質膜21を透明導電膜11とp型非晶質膜31との間に設けることによって光電変換素子10Aの変換効率を向上できる。
Therefore, the conversion efficiency of the
そして、光電変換素子10Aにおいては、n型非晶質膜21の膜厚と、p型非晶質膜31の膜厚と、i型非晶質膜41の膜厚との合計は、25nmである。従って、n型半導体膜2、p型半導体膜3およびi型半導体膜4の全てに非晶質膜を適用することによって、熱拡散によってp/n接合を形成する従来の結晶シリコン系の光電変換素子に比べ、接合深さが浅くなるとともに、光電変換素子10Aの厚み方向におけるドーパント(B)の分布が急峻になる。
In the
その結果、光電変換部51(n型単結晶シリコン)の厚み方向の全領域において入射光によって電子および正孔を生成することができ、n型非晶質膜21/p型非晶質膜31界面における電子と正孔との再結合の促進との相乗効果によって短絡電流密度を大きくできる。
As a result, electrons and holes can be generated by incident light in the entire region in the thickness direction of the photoelectric conversion unit 51 (n-type single crystal silicon), and the n-type
なお、n型非晶質膜21は、n型a−Si以外にn型a−SiC,n型a−SiGe,n型a−Geのいずれかからなっていてもよい。この場合、n型a−SiCは、SiH4ガス、メタン(CH4)ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型a−SiGeは、SiH4ガス、ゲルマン(GeH4)ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型a−Geは、GeH4ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。
The n-type
また、p型非晶質膜31は、p型a−Si以外にp型a−SiC,p型a−SiGe,p型a−Geのいずれかからなっていてもよい。この場合、p型a−SiCは、SiH4ガス、CH4ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型a−SiGeは、SiH4ガス、GeH4ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型a−Geは、GeH4ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。
The p-type
更に、i型非晶質膜41は、i型a−Si以外にi型a−SiC,i型a−SiGeのいずれかからなっていてもよい。この場合、i型a−SiCは、SiH4ガス、CH4ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。i型a−SiGeは、SiH4ガス、GeH4ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。
Further, the i-type
なお、i型非晶質膜41としては、i型a−Geも想定されるが、i型a−Geは、n型単結晶シリコンよりも光学バンドギャップが小さいので、i型a−Geをi型非晶質膜41として用いた場合、開放電圧Vocの向上が困難である。光電変換素子10Aにおいては、i型非晶質膜41の光学バンドギャップが開放電圧Vocを支配的に決定するからである。
Note that i-type a-Ge is also assumed as the i-type
そこで、この発明の実施の形態においては、n型単結晶シリコン(光電変換部51)の光学バンドギャップよりも大きいi型a−SiC,i型a−Si,i型a−SiGeをi型非晶質膜41として用いることにした。
Therefore, in the embodiment of the present invention, i-type a-SiC, i-type a-Si, and i-type a-SiGe, which are larger than the optical band gap of n-type single crystal silicon (photoelectric conversion unit 51), are converted into i-type non-crystal. The
また、n型非晶質膜21、p型非晶質膜31およびi型非晶質膜41にa−Si等を適用することによって、n型非晶質膜21、p型非晶質膜31およびi型非晶質膜41は、プラズマCVD法によって200℃程度の低温で連続して光電変換部51(n型単結晶シリコン)上に積層される。また、絶縁層61および裏面電極62も、200℃以下の温度でスパッタリング法によって光電変換部51(n型単結晶シリコン)上に積層される。その結果、光電変換部51としてのn型単結晶シリコンの品質が熱ダメージによって劣化するのを防止できる。
Further, by applying a-Si or the like to the n-type
このように、実施例1においては、n型非晶質膜21、p型非晶質膜31およびi型非晶質膜41は、表1に示すa−SiC,a−Si,a−SiGe,a−Ge等の非晶質材料からなる。
As described above, in Example 1, the n-type
そして、p型非晶質膜31がp型a−SiGeからなり、i型非晶質膜41がi型a−Siからなる場合等のように、p型非晶質膜31の光学バンドギャップがi型非晶質膜41の光学バンドギャップよりも小さい場合、光電変換素子10Aのエネルギーバンド図において、p型a−SiGeの価電子帯の端がi型a−Siの価電子帯の端よりもエネルギー的に低くなる。即ち、p型a−SiGeの価電子帯の端は、図3の紙面において、i型a−Siの価電子帯の端よりも上側に位置する。その結果、光電変換部51(n型単結晶シリコン)において光励起された正孔は、p型非晶質膜31へ到達した後、p型非晶質膜31に閉じ込められ、n型非晶質膜21/p型非晶質膜31界面において、電子と正孔との再結合が促進される。
Then, as in the case where the p-type
従って、p型非晶質膜31の光学バンドギャップがi型非晶質膜41の光学バンドギャップよりも小さくなる非晶質材料を用いて光電変換素子10Aを作製することによって、光電変換素子10Aの変換効率を向上可能である。
Therefore, by producing the
なお、実施例1における光電変換素子10Aの光電変換部51は、n型多結晶シリコンからなっていてもよい。この場合、n型多結晶シリコンは、例えば、0.1〜数Ω・cmの比抵抗および200〜300μmの厚みを有する。
In addition, the
そして、n型多結晶シリコンを光電変換部51に適用した場合、好ましくは、200℃以下の温度でn型多結晶シリコンを水素プラズマ処理し、その後、i型非晶質膜41、p型非晶質膜31およびn型非晶質膜21をプラズマCVD法によってn型多結晶シリコン上に順次積層して光電変換素子10Aを作製する。これによって、n型多結晶シリコンの粒界がH原子によってパッシベートされ、粒界におけるキャリア(電子および正孔)の再結合を低減できる。
When n-type polycrystalline silicon is applied to the
また、n型多結晶シリコンの表面は、凹凸構造(テクスチャ構造)になっていてもよい。この場合、プラズマエッチングおよび反応性イオンエッチング等によってn型多結晶シリコンの表面を凹凸化する。 Further, the surface of the n-type polycrystalline silicon may have an uneven structure (texture structure). In this case, the surface of the n-type polycrystalline silicon is roughened by plasma etching, reactive ion etching, or the like.
(実施例2)
図4は、実施例2における光電変換素子の構成を示す断面図である。図4を参照して、実施例2における光電変換素子10Bは、光電変換素子10Aの光電変換部51を光電変換部71に代えたものであり、その他は、光電変換素子10Aと同じである。
(Example 2)
FIG. 4 is a cross-sectional view illustrating a configuration of a photoelectric conversion element in Example 2. With reference to FIG. 4, the
このように、光電変換素子10Bは、光電変換素子10Aと同様に、光電変換素子10のn型半導体膜2、p型半導体膜3およびi型半導体膜4の全てに非晶質膜を用いて光電変換素子10を具体化したものである。
As described above, the
光電変換部71は、例えば、面方位が(100)であり、比抵抗が0.1〜1.0Ω・cmであるp型単結晶シリコンからなり、厚みは、例えば、200〜300μmである。そして、光電変換部71は、その一方の表面がi型非晶質膜41に接するとともに、他方の表面が絶縁層61および裏面電極62に接する。
The
このように、光電変換素子10Bは、i型非晶質膜41、p型非晶質膜31、n型非晶質膜21、透明導電膜11および集電電極9を光電変換部71(p型単結晶シリコン)の一方の表面に順次積層し、絶縁層61および裏面電極62を光電変換部71(p型単結晶シリコン)の他方の表面に順次積層した構造からなる。
As described above, the
光電変換素子10Bの製造方法について説明する。光電変換部71としてのp型単結晶シリコンからなるシリコンウェハを上述した方法によって洗浄する。この場合、p型単結晶シリコンの表面は、光電変換部51としてのn型単結晶シリコンと同様にテクスチャ化されてもよい。
A method for manufacturing the
そして、シリコンウェハ(p型単結晶シリコン)をプラズマ装置内にセットし、プラズマCVD法によって上述した条件を用いてi型非晶質膜41、p型非晶質膜31およびn型非晶質膜21をp型単結晶シリコン(光電変換部71)上に順次積層する。
Then, a silicon wafer (p-type single crystal silicon) is set in the plasma apparatus, and the i-type
その後、透明導電膜11および集電電極9を上述した方法によって、n型非晶質膜21上に順次積層する。そして、絶縁層61および裏面電極62を上述した方法によってp型単結晶シリコン(光電変換部71)の他方の表面に順次積層する。
Thereafter, the transparent
これによって、光電変換素子10Bが完成する。
Thereby, the
光電変換素子10Bのエネルギーバンド図は、図3に示す光電変換素子10Aのエネルギーバンド図とほぼ同じであり、光電変換素子10Bにおける発電機構は、光電変換素子10Aと同じである。
The energy band diagram of the
従って、電子および正孔は、n型非晶質膜21とp型非晶質膜31との界面における再結合準位を介して効率良く再結合する。
Accordingly, electrons and holes are efficiently recombined through recombination levels at the interface between the n-type
また、光電変換素子10Bにおいても、n型非晶質膜21とp型非晶質膜31とからなるn/p接合は、上述した理由によって、p型非晶質膜31/i型非晶質膜41/p型単結晶シリコン(光電変換部71)からなる接合の内部電位Vbiを殆ど低下させない。
Also in the
その結果、光電変換部71としてp型単結晶シリコンを用いた場合も、開放電圧Vocおよび曲線因子FFが向上し、光電変換素子10Bの変換効率を向上できる。
As a result, even when p-type single crystal silicon is used as the
なお、実施例2における光電変換素子10Bの光電変換部71は、p型多結晶シリコンからなっていてもよい。この場合、p型多結晶シリコンは、例えば、0.1〜数Ω・cmの比抵抗および200〜300μmの厚みを有する。
In addition, the
そして、p型多結晶シリコンを光電変換部71に適用した場合、好ましくは、200℃以下の温度でp型多結晶シリコンを水素プラズマ処理し、その後、i型非晶質膜41、p型非晶質膜31およびn型非晶質膜21をプラズマCVD法によってp型多結晶シリコン上に順次積層して光電変換素子10Bを作製する。これによって、p型多結晶シリコンの粒界がH原子によってパッシベートされ、粒界におけるキャリア(電子および正孔)の再結合を低減できる。
When p-type polycrystalline silicon is applied to the
また、p型多結晶シリコンの表面は、凹凸構造(テクスチャ構造)になっていてもよい。この場合、プラズマエッチングおよび反応性イオンエッチング等によってp型多結晶シリコンの表面を凹凸化する。 Further, the surface of the p-type polycrystalline silicon may have an uneven structure (texture structure). In this case, the surface of the p-type polycrystalline silicon is roughened by plasma etching, reactive ion etching, or the like.
光電変換素子10Bについてのその他の説明は、光電変換素子10Aについての説明と同じである。
The other description about the
(実施例3)
図5は、実施例3における光電変換素子の構成を示す断面図である。図5を参照して、光電変換素子10Cは、図2に示す光電変換素子10Aのp型非晶質膜31をp型微結晶膜81に代えたものであり、その他は、光電変換素子10Aと同じである。
(Example 3)
FIG. 5 is a cross-sectional view illustrating a configuration of a photoelectric conversion element in Example 3. Referring to FIG. 5,
このように、光電変換素子10Cは、光電変換素子10のn型半導体膜2およびi型半導体膜4に非晶質膜を用い、光電変換素子10のp型半導体膜3に微結晶膜を用いて光電変換素子10を具体化したものである。
Thus, the
p型微結晶膜81は、例えば、p型μc−Siからなり、膜厚は、例えば、10nmである。そして、p型微結晶膜81は、n型非晶質膜21およびi型非晶質膜41に接してn型非晶質膜21とi型非晶質膜41との間に配置される。
The p-
このように、光電変換素子10Cは、i型非晶質膜41、p型微結晶膜81、n型非晶質膜21、透明導電膜11および集電電極9を光電変換部51(n型単結晶シリコン)の一方の表面に順次積層し、絶縁層61および裏面電極62を光電変換部51(n型単結晶シリコン)の他方の表面に順次積層した構造からなる。
As described above, the photoelectric conversion element 10C includes the i-type
光電変換素子10Cの製造方法について説明する。n型非晶質膜21、p型微結晶膜81およびi型非晶質膜41を形成するときの材料ガスの流量を表3に示す。
A method for manufacturing the photoelectric conversion element 10C will be described. Table 3 shows the flow rates of the material gases when forming the n-type
光電変換部51としてのn型単結晶シリコンからなるシリコンウェハを上述した方法によって洗浄する。そして、シリコンウェハ(n型単結晶シリコン)をプラズマ装置内にセットし、プラズマCVD法によって上述した条件を用いてi型非晶質膜41をn型単結晶シリコン(光電変換部51)上に堆積する。
A silicon wafer made of n-type single crystal silicon as the
その後、2sccmのSiH4ガスと、140sccmのH2ガスと、水素希釈された12sccmのB2H6ガスとを材料ガスとしてプラズマCVD法によってp型微結晶膜81をi型非晶質膜41/n型単結晶シリコン(光電変換部51)上に堆積する。この場合、反応室CB2内の圧力は、13.3Pa〜665Paの範囲であり、RFパワーは、16〜80mW/cm2の範囲である。
Thereafter, the p-
そして、p型微結晶膜81の膜厚が10nmになると、RFパワーの平行平板電極への印加およびSiH4ガス、H2ガスおよびB2H6ガスの反応室CB2への供給を停止する。
When the thickness of the p-
引き続いて、プラズマCVD法によって上述した条件を用いてn型非晶質膜21をp型微結晶膜81/i型非晶質膜41/n型単結晶シリコン(光電変換部51)上に堆積する。
Subsequently, the n-type
その後、透明導電膜11および集電電極9を上述した方法によって、n型非晶質膜21上に順次積層する。そして、絶縁層61および裏面電極62を上述した方法によってn型単結晶シリコン(光電変換部51)の他方の表面に順次積層する。
Thereafter, the transparent
これによって、光電変換素子10Cが完成する。 Thereby, the photoelectric conversion element 10C is completed.
光電変換素子10Cにおいては、n型非晶質膜21(n型a−Si)は、プラズマCVD法によってp型微結晶膜81(p型μc−Si)に接してp型微結晶膜81(p型μc−Si)上に堆積される。その結果、n型非晶質膜21(n型a−Si)中のP原子と、p型微結晶膜81(p型μc−Si)中のB原子とが相互に拡散する。従って、n型非晶質膜21/p型微結晶膜81には、再結合準位が存在する。
In the photoelectric conversion element 10C, the n-type amorphous film 21 (n-type a-Si) is in contact with the p-type microcrystalline film 81 (p-type μc-Si) by a plasma CVD method. deposited on p-type [mu] c-Si). As a result, the P atoms in the n-type amorphous film 21 (n-type a-Si) and the B atoms in the p-type microcrystalline film 81 (p-type μc-Si) diffuse to each other. Therefore, the n-type
また、p型微結晶膜81は、上述したp型非晶質膜31よりも大きい1.97eVの光学バンドギャップおよびp型非晶質膜31(=p型a−Si)よりも小さい活性化エネルギーを有する。その結果、光電変換素子10Cのエネルギーバンド図は、p型微結晶膜81の伝導帯の端が図3に示すエネルギーバンド図におけるp型非晶質膜31(=p型a−Si)の伝導帯の端よりも上側に位置するエネルギーバンド図になる。
The p-
そうすると、光励起された電子および正孔は、n型非晶質膜21/p型微結晶膜81界面における再結合準位を介して効率的に再結合し、p型微結晶膜81/i型非晶質膜41/n型単結晶シリコン(光電変換部51)からなるpin接合の内部電位は、p型半導体膜3が非晶質相からなる場合よりも大きくなり、p型半導体膜3の導電率は、p型半導体膜3が非晶質相からなる場合よりも高くなる。その結果、開放電圧Vocおよび曲線因子FFの向上によって光電変換素子10Cの変換効率を光電変換素子10Aの変換効率よりも向上できる。特に、曲線因子FFの向上は、p型微結晶膜81の高い導電率による直列抵抗の低下と、n型非晶質膜21/p型微結晶膜81界面における電子および正孔の再結合の促進との相乗効果によるものである。
Then, the photoexcited electrons and holes are efficiently recombined via the recombination level at the interface of the n-type
p型微結晶膜81は、p型μc−Si以外に、表1に示すようにp型μc−SiC,p型μc−SiGe,p型μc−Geのいずれかからなっていてもよい。そして、p型μc−SiCは、SiH4ガス、CH4ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型μc−SiGeは、SiH4ガス、GeH4ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型μc−Geは、GeH4ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。この場合、SiH4ガスとCH4ガスとB2H6ガスとの合計流量とH2ガスの流量との比[SiH4+CH4+B2H6]/[H2]は、1/10以下に設定される。また、p型μc−SiGe,p型μc−GeをプラズマCVD法によって形成する場合も、ガス流量比は、同様に設定される。
In addition to p-type μc-Si, p-
上述したように、p型μc−SiC,p型μc−Si,p型μc−SiGe,p型μc−Geは、SiH4ガス等をH2ガスによって希釈した条件でプラズマCVD法によって形成されるので、プラズマ中の水素イオン等による下地層(=n型非晶質膜21)へのダメージによって、n型非晶質膜21の欠陥密度を増加させることができる。その結果、n型非晶質膜21/p型微結晶膜81界面における電子および正孔の再結合を促進できる。
As described above, p-type μc-SiC, p-type μc-Si, p-type μc-SiGe, and p-type μc-Ge are formed by a plasma CVD method under the condition that SiH 4 gas or the like is diluted with H 2 gas. Therefore, the defect density of the n-type
なお、実施例3においては、光電変換素子10Aから光電変換素子10Bへの変更と同じ変更を光電変換素子10Cに対して適用してもよい。この場合、光電変換部71は、p型単結晶シリコンまたはp型多結晶シリコンからなる。そして、p型単結晶シリコンまたはp型多結晶シリコンの表面は、凹凸構造(テクスチャ構造)になっていてもよい。
In Example 3, the same change as the change from the
光電変換素子10Cについてのその他の説明は、光電変換素子10Aについての説明と同じである。
The other description about the photoelectric conversion element 10C is the same as the description about the
(実施例4)
図6は、実施例4における光電変換素子の構成を示す断面図である。図6を参照して、光電変換素子10Dは、図2に示す光電変換素子10Aのn型非晶質膜21をn型微結晶膜91に代えたものであり、その他は、光電変換素子10Aと同じである。
Example 4
FIG. 6 is a cross-sectional view illustrating a configuration of a photoelectric conversion element in Example 4. Referring to FIG. 6,
このように、光電変換素子10Dは、光電変換素子10のp型半導体膜3およびi型半導体膜4に非晶質膜を用い、n型半導体膜2に微結晶膜を用いて光電変換素子10を具体化したものである。
As described above, the
n型微結晶膜91は、例えば、n型μc−Siからなり、膜厚は、例えば、5nmである。そして、n型微結晶膜91は、透明導電膜11およびp型非晶質膜31に接して透明導電膜11とp型非晶質膜31との間に配置される。
The n-
このように、光電変換素子10Dは、i型非晶質膜41、p型非晶質膜31、n型微結晶膜91、透明導電膜11および集電電極9を光電変換部51(n型単結晶シリコン)の一方の表面に順次積層し、絶縁層61および裏面電極62を光電変換部51(n型単結晶シリコン)の他方の表面に順次積層した構造からなる。
As described above, the
光電変換素子10Dの製造方法について説明する。n型微結晶膜91、p型非晶質膜31およびi型非晶質膜41を形成するときの材料ガスの流量を表4に示す。
A method for manufacturing the
光電変換部51としてのn型単結晶シリコンからなるシリコンウェハを上述した方法によって洗浄する。そして、シリコンウェハ(n型単結晶シリコン)をプラズマ装置内にセットし、プラズマCVD法によって上述した条件を用いてi型非晶質膜41およびp型非晶質膜31をn型単結晶シリコン(光電変換部51)上に順次堆積する。
A silicon wafer made of n-type single crystal silicon as the
その後、4sccmのSiH4ガスと、250sccmのH2ガスと、水素希釈された25sccmのPH3ガスとを材料ガスとしてプラズマCVD法によってn型微結晶膜91をp型非晶質膜31/i型非晶質膜41/n型単結晶シリコン(光電変換部51)上に堆積する。この場合、反応室CB3内の圧力は、13.3Pa〜665Paの範囲であり、RFパワーは、16〜80mW/cm2の範囲である。
Thereafter, the n-
そして、n型微結晶膜91の膜厚が5nmになると、RFパワーの平行平板電極への印加およびSiH4ガス、H2ガスおよびPH3ガスの反応室CB3への供給を停止する。
When the thickness of the n-
引き続いて、透明導電膜11および集電電極9を上述した方法によってn型微結晶膜91上に順次積層する。そして、絶縁層61および裏面電極62を上述した方法によってn型単結晶シリコン(光電変換部51)の他方の表面に順次積層する。
Subsequently, the transparent
これによって、光電変換素子10Dが完成する。
Thereby, the
光電変換素子10Dは、n型微結晶膜91がp型非晶質膜31に直接接合したn/p接合を備える。そして、n型微結晶膜91(n型μc−Si)は、プラズマCVD法によってp型非晶質膜31(p型a−Si)に接してp型非晶質膜31(p型a−Si)上に堆積される。その結果、n型微結晶膜91(n型μc−Si)の堆積時に、n型微結晶膜91(n型μc−Si)中のP原子と、型非晶質膜31(p型a−Si)中のB原子とが相互に拡散する。従って、n型微結晶膜91/p型非晶質膜31界面に再結合準位が存在する。
The
そして、n型微結晶膜91/p型非晶質膜31からなるn/p接合は、n型微結晶膜91/p型非晶質膜31界面における再結合準位に起因してp型非晶質膜31/i型非晶質膜41/n型単結晶シリコン(光電変換部51)からなるpin接合の内部電位の低下を抑制する。また、電子および正孔は、n型微結晶膜91/p型非晶質膜31界面において効率的に再結合する。
The n / p junction composed of the n-
従って、開放電圧Vocおよび曲線因子FFの向上によって光電変換素子10Dの変換効率を向上できる。
Therefore, the conversion efficiency of the
n型微結晶膜91は、n型μc−Si以外に、表1に示すようにn型μc−SiC,n型μc−SiGe,n型μc−Geのいずれかからなっていてもよい。そして、n型μc−SiCは、SiH4ガス、CH4ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型μc−SiGeは、SiH4ガス、GeH4ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型μc−Geは、GeH4ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。この場合、SiH4ガスとCH4ガスとPH3ガスとの合計流量とH2ガスの流量との比[SiH4+CH4+PH3]/[H2]は、1/10以下に設定される。また、n型μc−SiGe,n型μc−GeをプラズマCVD法によって形成する場合も、ガス流量比は、同様に設定される。
In addition to n-type μc-Si, n-
なお、実施例4においては、光電変換素子10Aから光電変換素子10Bへの変更と同じ変更を光電変換素子10Dに対して適用してもよい。この場合、光電変換部71は、p型単結晶シリコンまたはp型多結晶シリコンからなる。そして、p型単結晶シリコンまたはp型多結晶シリコンの表面は、凹凸構造(テクスチャ構造)になっていてもよい。
In Example 4, the same change as the change from the
光電変換素子10Dについてのその他の説明は、光電変換素子10Aについての説明と同じである。
The other description about the
(実施例5)
図7は、実施例5における光電変換素子の構成を示す断面図である。図7を参照して、光電変換素子10Eは、図2に示す光電変換素子10Aの絶縁層61および裏面電極62をi型非晶質膜101、n型非晶質膜111、透明導電膜121および集電電極131に代えたものであり、その他は、光電変換素子10Aと同じである。
(Example 5)
FIG. 7 is a cross-sectional view illustrating a configuration of a photoelectric conversion element in Example 5. Referring to FIG. 7,
このように、光電変換素子10Eは、光電変換素子10Aと同じように、光電変換素子10のn型半導体膜2、p型半導体膜3およびi型半導体膜4の全てに非晶質膜を用いて光電変換素子10を具体化したものである。
As described above, the
i型非晶質膜101は、例えば、i型a−Siからなり、膜厚は、例えば、10nmである。そして、i型非晶質膜101は、光電変換部51(n型単結晶シリコン)に接する。
The i-type
n型非晶質膜111は、例えば、n型a−Siからなり、膜厚は、例えば、10nmである。そして、n型非晶質膜111は、i型非晶質膜101に接する。
The n-type
透明導電膜121は、例えば、SnO2からなる。そして、透明導電膜121は、n型非晶質膜111に接する。
The transparent
集電電極131は、例えば、Agからなり、透明導電膜121に接して櫛型に形成される。
The
このように、光電変換素子10Eは、光電変換部51としてのn型単結晶シリコンの両面を非晶質膜で覆った構造からなる。
As described above, the
光電変換素子10Eの製造方法について説明する。i型非晶質膜41、p型非晶質膜31、n型非晶質膜21、i型非晶質膜101およびn型非晶質膜111を形成するときの材料ガスの流量を表5に示す。
A method for manufacturing the
光電変換部51としてのn型単結晶シリコンからなるシリコンウェハを上述した方法によって洗浄し、その洗浄したシリコンウェハ(n型単結晶シリコン)をプラズマ装置にセットする。この場合、n型単結晶シリコンの表面は、凹凸構造(テクスチャ構造)になっていてもよい。
A silicon wafer made of n-type single crystal silicon as the
そして、プラズマCVD法によって上述した条件を用いてi型非晶質膜41、p型非晶質膜31およびn型非晶質膜21をn型単結晶シリコン(光電変換部51)の一方の表面上に順次積層する。
Then, the i-type
そして、n型非晶質膜21/p型非晶質膜31/i型非晶質膜41/n型単結晶シリコン(光電変換部51)をプラズマ装置から取り出し、n型非晶質膜21/p型非晶質膜31/i型非晶質膜41/n型単結晶シリコン(光電変換部51)の表裏を裏返してプラズマ装置にセットする。
Then, the n-type
その後、n型単結晶シリコン(光電変換部51)/i型非晶質膜41/p型非晶質膜31/n型非晶質膜21が反応室CB1へ搬送されると、10sccmのSiH4ガスと100sccmのH2ガスとを反応室CB1へ供給し、反応室CB1の圧力を13.3Pa〜665Paの範囲に設定し、平行平板電極に16〜80mW/cm2の範囲のRFパワーを印加する。これによって、反応室CB1内でプラズマが発生し、i型非晶質膜101がn型単結晶シリコン(光電変換部51)の他方の表面上に堆積される。
Thereafter, when the n-type single crystal silicon (photoelectric conversion part 51) / i-type
そして、i型非晶質膜101の膜厚が10nmになると、RFパワーの平行平板電極への印加を停止するとともに、SiH4ガスおよびH2ガスの反応室CB1への供給を停止する。
When the thickness of the i-type
その後、i型非晶質膜101/n型単結晶シリコン(光電変換部51)/i型非晶質膜41/p型非晶質膜31/n型非晶質膜21を反応室CB3へ搬送する。そして、20sccmのSiH4ガスと150sccmのH2ガスと水素希釈された50sccmのPH3ガスとを反応室CB3へ供給し、反応室CB3の圧力を13.3Pa〜665Paの範囲に設定し、平行平板電極に16〜80mW/cm2の範囲のRFパワーを印加する。これによって、反応室CB3内でプラズマが発生し、n型非晶質膜111がi型非晶質膜101上に堆積される。
Thereafter, the i-type
そして、n型非晶質膜111の膜厚が10nmになると、RFパワーの平行平板電極への印加を停止するとともに、SiH4ガス、H2ガスおよびPH3ガスの反応室CB3への供給を停止する。
When the thickness of the n-type
その後、n型非晶質膜111/i型非晶質膜101/n型単結晶シリコン(光電変換部51)/i型非晶質膜41/p型非晶質膜31/n型非晶質膜21をプラズマ装置から取り出してスパッタリング装置にセットする。
Thereafter, n-type
そして、透明導電膜11としてのSnO2および集電電極9としてのAgを上述した方法によってn型非晶質膜21上に順次積層する。
Then, SnO 2 as the transparent
引き続いて、透明導電膜121としてのSnO2および集電電極131としてのAgを上述した方法によってn型非晶質膜111上に順次積層する。
Subsequently, SnO 2 as the transparent
これによって、光電変換素子10Eが完成する。
Thereby, the
図8は、図7に示す光電変換素子10Eのエネルギーバンド図である。なお、図8においては、集電電極9,131が省略されている。また、図8においては、p型非晶質膜31/i型非晶質膜41/n型単結晶シリコン(光電変換部51)からなるpin接合の内部電位を“Vbi1”と表記し、n型単結晶シリコン(光電変換部51)/i型非晶質膜101/n型非晶質膜111からなる接合の内部電位を“Vbi2”と表記する。
FIG. 8 is an energy band diagram of the
図8を参照して、n型非晶質膜21、p型非晶質膜31、i型非晶質膜41およびn型単結晶シリコン(光電変換部51)の部分のエネルギーバンド図については、図3において説明したとおりである。
Referring to FIG. 8, the energy band diagram of the n-type
i型非晶質膜101としてのi型a−Siは、1.74eVの光学バンドギャップおよび0.73eVの活性化エネルギーを有するので、n型単結晶シリコン(光電変換部51)/i型非晶質膜101界面は、ヘテロ接合になる。そして、n型単結晶シリコン(光電変換部51)/i型非晶質膜101界面においては、バンドの不連続が存在する。
Since i-type a-Si as the i-type
また、n型非晶質膜111としてのn型a−Siは、1.80eVの光学バンドギャップおよび0.20eVの活性化エネルギーを有するので、i型非晶質膜101/n型非晶質膜111界面も、ヘテロ接合になる。
In addition, since n-type a-Si as the n-type
そして、n型単結晶シリコン(光電変換部51)/i型非晶質膜101/n型非晶質膜111からなる接合には、内部電位Vbi2が発生する。
An internal potential Vbi2 is generated at the junction made of n-type single crystal silicon (photoelectric conversion portion 51) / i-type
更に、i型非晶質膜101をn型非晶質膜111とn型単結晶シリコン(光電変換部51)との間に挿入することによって、n型非晶質膜111/i型非晶質膜101界面およびi型非晶質膜101/n型単結晶シリコン(光電変換部51)界面におけるキャリア(電子および正孔)の再結合が低減される。
Further, by inserting the i-type
そうすると、n型単結晶シリコン(光電変換部51)において光励起された電子は、キャリア拡散によってi型非晶質膜101側へ移動し、内部電界Vbi2によって透明導電膜121へ効率的に到達する。また、n型単結晶シリコン(光電変換部51)において光励起された正孔は、キャリア拡散によってi型非晶質膜41側へ移動し、内部電位Vbi1によってp型非晶質膜31へ効率的に到達する。
Then, the photoexcited electrons in the n-type single crystal silicon (photoelectric conversion unit 51) move to the i-type
そして、電子は、集電電極131、外部のリード線(図示せず)、集電電極9および透明導電膜11を介してn型非晶質膜21へ到達する。
Then, the electrons reach the n-type
そうすると、n型非晶質膜21/p型非晶質膜31界面において、電子は、再結合準位を介して正孔と効率的に再結合する。
Then, at the interface of the n-type
また、上述したようにn型非晶質膜21およびp型非晶質膜31からなるn/p接合は、内部電位Vbi1の低下を抑制する。
Further, as described above, the n / p junction composed of the n-type
従って、開放電圧Vocおよび曲線因子FFの向上によって光電変換素子10Eの変換効率を向上できる。
Therefore, the conversion efficiency of the
また、光電変換素子10Eは、i型非晶質膜41、p型非晶質膜31、n型非晶質膜21、透明導電膜11および集電電極9をn型単結晶シリコン(光電変換部51)の一方の表面上に順次積層し、i型非晶質膜101、n型非晶質膜111、透明導電膜121および集電電極131をn型単結晶シリコン(光電変換部51)の他方の表面上に順次積層した構造からなる。そして、i型非晶質膜41、p型非晶質膜31、n型非晶質膜21、透明導電膜11、集電電極9、i型非晶質膜101、n型非晶質膜111、透明導電膜121および集電電極131は、200℃以下の温度で形成される。
Further, the
従って、熱ダメージによるn型単結晶シリコン(光電変換部51)の品質劣化を防止できる。 Therefore, quality deterioration of the n-type single crystal silicon (photoelectric conversion unit 51) due to thermal damage can be prevented.
更に、光電変換素子10Eは、n型非晶質膜21を除いて、n型単結晶シリコン(光電変換部51)を中心として対称な構造からなる。従って、n型単結晶シリコン(光電変換部51)に印加される熱歪も対称になり、熱歪による光電変換素子10Eの反りを防止できる。
Further, the
i型非晶質膜101は、i型a−Si以外に、i型a−SiC,i型a−SiGeのいずれかからなっていてもよい。ここで、i型a−Geが除外されている理由は、上述した理由と同じである。また、n型非晶質膜111は、n型a−Si以外に、n型a−SiC,n型a−SiGe,n型a−Geのいずれかからなっていてもよい。
The i-type
これらのi型a−SiC,i型a−SiGe,n型a−SiC,n型a−SiGe,n型a−Geは、上述したようにプラズマCVD法によって形成される。 These i-type a-SiC, i-type a-SiGe, n-type a-SiC, n-type a-SiGe, and n-type a-Ge are formed by plasma CVD as described above.
なお、実施例5においては、光電変換素子10Eの光電変換部51は、p型単結晶シリコン、n型多結晶シリコンおよびp型多結晶シリコンのいずれかからなっていてもよい。この場合、p型単結晶シリコン、n型多結晶シリコンおよびp型多結晶シリコンは、その表面が凹凸構造(テクスチャ構造)になっていてもよい。
In Example 5, the
そして、光電変換部51がn型多結晶シリコンまたはp型多結晶シリコンからなる場合、好ましくは、n型多結晶シリコンまたはp型多結晶シリコンの一方の表面をプラズマ処理した後に、i型非晶質膜41、p型非晶質膜31、n型非晶質膜21、透明導電膜11および集電電極9をプラズマCVD法によってn型多結晶シリコンまたはp型多結晶シリコンの一方の表面上に順次積層し、その後、n型多結晶シリコンまたはp型多結晶シリコンの他方の表面をプラズマ処理した後に、i型非晶質膜101、n型非晶質膜111、透明導電膜121および集電電極131をn型多結晶シリコンまたはp型多結晶シリコンの他方の表面上に順次積層する。これによって、n型多結晶シリコンまたはp型多結晶シリコンの粒界をH原子によってパッシベートでき、n型多結晶シリコンまたはp型多結晶シリコンの粒界におけるキャリア(電子および正孔)の再結合を低減できる。
When the
また、光電変換素子10Aから光電変換素子10C,10Dのいずれかへの変更と同じ変更を光電変換素子10Eに対して適用してもよい。
Further, the same change as the change from the
更に、光電変換素子10Eにおいては、n型非晶質膜111に代えてn型微結晶膜を適用してもよい。この場合、n型微結晶膜は、n型μc−SiC,n型μc−Si,n型μc−SiGe,n型μc−Geからなる。そして、n型μc−SiC,n型μc−Si,n型μc−SiGe,n型μc−Geは、200℃以下の温度においてプラズマCVD法によってi型非晶質膜101上に堆積される。従って、熱ダメージによって光電変換部51(単結晶シリコンまたは多結晶シリコン)の品質が劣化するのを防止できる。また、熱歪による光電変換素子10Eの反りを防止できる。
Further, in the
上記においては、n型非晶質膜21のP濃度は、5×1020cm−3〜7×1020cm−3であると説明したが、この発明の実施の形態においては、これに限らず、n型非晶質膜21のP濃度は、5×1020cm−3〜7×1020cm−3よりも低くてもよい。
In the above description, the P concentration of the n-type
n型非晶質膜21のP濃度が5×1020cm−3〜7×1020cm−3よりも低くても、n型非晶質膜21とp型非晶質膜31(またはp型微結晶膜81)との界面に再結合準位が存在し、電子および正孔の再結合が促進され、内部電位Vbiの低下が抑制されるからである。
Even if the P concentration of the n-type
光電変換素子10Eについてのその他の説明は、光電変換素子10Aの説明と同じである。
The other description about the
[p型半導体膜3の改良]
p型半導体膜3は、非晶質相からなる層Aと、微結晶相からなる層Bとからなっていてもよい。
[Improvement of p-type semiconductor film 3]
The p-
層Aは、例えば、p型a−Siからなり、層Bは、例えば、p型μc−Siからなる。そして、層Aは、n型半導体膜2側に配置され、層Bは、i型半導体膜4側に配置される。
The layer A is made of, for example, p-type a-Si, and the layer B is made of, for example, p-type μc-Si. The layer A is disposed on the n-
このように、p型半導体膜3を2つの層A,Bによって構成することによって、n型半導体膜2/p型半導体膜3からなる接合が整流特性を殆ど示さなくなり、かつ、層B(=p型μc−Si)/i型半導体膜4/光電変換部5(n型単結晶シリコン、p型単結晶シリコン、n型多結晶シリコンおよびp型多結晶シリコンのいずれか)からなる接合が形成される。その結果、n型半導体膜2と層A(=p型a−Si)との界面における電子および正孔の再結合が促進されるとともに、上記接合の内部電位が向上する。
Thus, by forming the p-
従って、開放電圧Vocおよび曲線因子FFの向上によって光電変換素子10の変換効率を向上できる。
Therefore, the conversion efficiency of the
また、層Aの膜厚と層Bの膜厚との合計は、p型半導体膜3が単層からなる場合の膜厚と同じであっても、異なっていてもよい。更に、層Aの膜厚は、層Bの膜厚と同じであってもよく、層Bの膜厚と異なっていてもよい。
Further, the sum of the film thickness of the layer A and the film thickness of the layer B may be the same as or different from the film thickness when the p-
層Aの膜厚と層Bの膜厚との合計がp型半導体膜31の膜厚よりも厚くても、層Bに用いられる微結晶膜の光吸収係数は、層Aに用いられる非晶質膜の光吸収係数よりも小さいので、光電変換部5へ入射する太陽光の強度をp型半導体膜3が非晶質膜からなる場合の強度と同じに保持できる。その結果、層Bの膜厚を層Aの膜厚よりも厚く設定すれば、p型半導体膜3/i型半導体膜4/光電変換部5からなる接合の内部電位を更に強くしてn型半導体膜2と層A(=p型a−Si)との界面における電子および正孔の再結合を促進できる。
Even if the sum of the thickness of the layer A and the thickness of the layer B is larger than the thickness of the p-
また、層Aの膜厚と層Bの膜厚との合計がp型半導体膜3の膜厚と同じである場合、2つの層A,Bの透過光量は、p型半導体膜3が非晶質膜からなる場合よりも多くなるので、短絡電流密度Jscを大きくできる。このように、層Aの膜厚と層Bの膜厚との合計がp型半導体膜3の膜厚と同じである場合、電子と正孔との再結合を促進し、p型半導体膜3/i型半導体膜4/光電変換部5からなる接合の内部電位の低下を抑制したまま、短絡電流密度Jscを大きくできる。
Further, when the sum of the film thickness of the layer A and the film thickness of the layer B is the same as the film thickness of the p-
なお、層A,Bの組み合わせは、p型a−Si/p型μc−Siに拘わらず、(p型a−SiC,p型a−Si,p型a−SiGe,p型a−Geのいずれか)/(p型μc−SiC,p型μc−Si,p型μc−SiGe,p型μc−Geのいずれか)であればよい。 The combination of the layers A and B is (p-type a-SiC, p-type a-Si, p-type a-SiGe, p-type a-Ge, regardless of p-type a-Si / p-type μc-Si. Any) / (any of p-type μc-SiC, p-type μc-Si, p-type μc-SiGe, p-type μc-Ge).
今回開示された実施の形態はすべての点で例示であって制限的なものではないと考えられるべきである。本発明の範囲は、上記した実施の形態の説明ではなくて特許請求の範囲によって示され、特許請求の範囲と均等の意味および範囲内でのすべての変更が含まれることが意図される。 The embodiment disclosed this time should be considered as illustrative in all points and not restrictive. The scope of the present invention is shown not by the above description of the embodiments but by the scope of claims for patent, and is intended to include meanings equivalent to the scope of claims for patent and all modifications within the scope.
この発明は、光電変換素子およびそれを備えた積層型光電変換素子に適用される。 The present invention is applied to a photoelectric conversion element and a stacked photoelectric conversion element including the photoelectric conversion element.
1,11,121 透明導電膜、2 n型半導体膜、3 p型半導体膜、4 i型半導体膜、5,51,71 光電変換部、9,131 集電電極、10,10A,10B,10C,10D,10E 光電変換素子、21,111 n型非晶質膜、31 p型半導体膜、41,101 i型非晶質膜、61 絶縁層、62 裏面電極、81 p型微結晶膜、91 n型微結晶膜。 1, 11, 121 Transparent conductive film, 2 n-type semiconductor film, 3 p-type semiconductor film, 4 i-type semiconductor film, 5, 51, 71 Photoelectric conversion part, 9, 131 Current collecting electrode, 10, 10A, 10B, 10C , 10D, 10E photoelectric conversion element, 21, 111 n-type amorphous film, 31 p-type semiconductor film, 41, 101 i-type amorphous film, 61 insulating layer, 62 back electrode, 81 p-type microcrystalline film, 91 n-type microcrystalline film.
Claims (8)
前記光電変換部に接して形成されたi型半導体膜と、
前記i型半導体膜に接して形成されたp型半導体膜と、
前記p型半導体膜に接して形成されたn型半導体膜と、
前記n型半導体膜に接して形成された透明導電膜とを備え、
前記p型半導体膜および前記n型半導体膜の一方は、非晶質相からなり、
前記p型半導体膜および前記n型半導体膜の他方は、微結晶相または非晶質相からなる、光電変換素子。 A photoelectric conversion unit made of crystalline silicon;
An i-type semiconductor film formed in contact with the photoelectric conversion unit;
A p-type semiconductor film formed in contact with the i-type semiconductor film;
An n-type semiconductor film formed in contact with the p-type semiconductor film;
A transparent conductive film formed in contact with the n-type semiconductor film,
One of the p-type semiconductor film and the n-type semiconductor film is made of an amorphous phase,
The other of the p-type semiconductor film and the n-type semiconductor film is a photoelectric conversion element made of a microcrystalline phase or an amorphous phase.
前記p型半導体膜は、p型アモルファスシリコンからなり、
前記n型半導体膜は、n型アモルファスシリコンからなる、請求項4に記載の光電変換素子。 The i-type semiconductor film is made of i-type amorphous silicon,
The p-type semiconductor film is made of p-type amorphous silicon,
The photoelectric conversion element according to claim 4, wherein the n-type semiconductor film is made of n-type amorphous silicon.
前記p型半導体膜およびn型半導体膜の一方は、非晶質相からなり、
前記p型半導体膜およびn型半導体膜の他方は、微結晶相からなる、請求項1から請求項3のいずれか1項に記載の光電変換素子。 The i-type semiconductor film is composed of an amorphous phase,
One of the p-type semiconductor film and the n-type semiconductor film is composed of an amorphous phase,
4. The photoelectric conversion element according to claim 1, wherein the other of the p-type semiconductor film and the n-type semiconductor film is made of a microcrystalline phase. 5.
前記p型半導体膜は、p型微結晶シリコンからなり、
前記n型半導体膜は、n型アモルファスシリコンからなる、請求項6に記載の光電変換素子。 The i-type semiconductor film is made of i-type amorphous silicon,
The p-type semiconductor film is made of p-type microcrystalline silicon,
The photoelectric conversion element according to claim 6, wherein the n-type semiconductor film is made of n-type amorphous silicon.
前記p型半導体膜は、p型アモルファスシリコンからなり、
前記n型半導体膜は、n型微結晶シリコンからなる、請求項6に記載の光電変換素子。 The i-type semiconductor film is made of i-type amorphous silicon,
The p-type semiconductor film is made of p-type amorphous silicon,
The photoelectric conversion element according to claim 6, wherein the n-type semiconductor film is made of n-type microcrystalline silicon.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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JP2011155213A JP2013021239A (en) | 2011-07-13 | 2011-07-13 | Photoelectric conversion element |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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Application Number | Title | Priority Date | Filing Date |
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-
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