DE112015005395T5 - Flüssigkristallanzeigevorrichtung und Gate-Treiber hierfür - Google Patents
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- 239000004973 liquid crystal related substance Substances 0.000 title claims abstract description 27
- 239000003990 capacitor Substances 0.000 claims description 14
- 238000000034 method Methods 0.000 abstract description 8
- 238000005516 engineering process Methods 0.000 description 5
- 239000010409 thin film Substances 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 2
- 230000000295 complement effect Effects 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 230000000750 progressive effect Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
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- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
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- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
- G09G3/3611—Control of matrices with row and column drivers
- G09G3/3674—Details of drivers for scan electrodes
- G09G3/3677—Details of drivers for scan electrodes suitable for active matrices only
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- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C19/00—Digital stores in which the information is moved stepwise, e.g. shift registers
- G11C19/18—Digital stores in which the information is moved stepwise, e.g. shift registers using capacitors as main elements of the stages
- G11C19/182—Digital stores in which the information is moved stepwise, e.g. shift registers using capacitors as main elements of the stages in combination with semiconductor elements, e.g. bipolar transistors, diodes
- G11C19/184—Digital stores in which the information is moved stepwise, e.g. shift registers using capacitors as main elements of the stages in combination with semiconductor elements, e.g. bipolar transistors, diodes with field-effect transistors, e.g. MOS-FET
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C19/00—Digital stores in which the information is moved stepwise, e.g. shift registers
- G11C19/28—Digital stores in which the information is moved stepwise, e.g. shift registers using semiconductor elements
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- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2310/00—Command of the display device
- G09G2310/02—Addressing, scanning or driving the display screen or processing steps related thereto
- G09G2310/0264—Details of driving circuits
- G09G2310/0267—Details of drivers for scan electrodes, other than drivers for liquid crystal, plasma or OLED displays
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2310/00—Command of the display device
- G09G2310/02—Addressing, scanning or driving the display screen or processing steps related thereto
- G09G2310/0264—Details of driving circuits
- G09G2310/0286—Details of a shift registers arranged for use in a driving circuit
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G2310/00—Command of the display device
- G09G2310/08—Details of timing specific for flat panels, other than clock recovery
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- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- Crystallography & Structural Chemistry (AREA)
- Chemical & Material Sciences (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Shift Register Type Memory (AREA)
- Liquid Crystal Display Device Control (AREA)
- Thin Film Transistor (AREA)
- Liquid Crystal (AREA)
Abstract
Die vorliegende Erfindung offenbart eine Flüssigkristallanzeigevorrichtung und einen Gate-Treiber hierfür. Der Gate-Treiber umfasst mehrere Schieberegisterschaltungen, wobei die mehreren Schieberegisterschaltungen in Reihe kaskadiert sind, wobei jede Schieberegisterschaltung eine erste Pull-Up-Schaltung, eine zweite Pull-Up-Schaltung, eine erste Pull-Down-Schaltung, eine zweite Pull-Down-Schaltung und eine Pull-Down-Steuerschaltung umfasst. Die erste Pull-Up-Schaltung und die zweite Pull-Up-Schaltung sind zwischen dem Gateansteuersignal und dem Gateansteuersignal-Ausgangsanschluss einer vorhergehenden Stufe in Reihe geschaltet, wobei die erste Pull-Down-Schaltung, die zweite Pull-Down-Schaltung und die Pull-Down-Steuerschaltung mit der ersten Pull-Up-Schaltung und der zweiten Pull-Up-Schaltung parallel geschaltet sind, wobei die Pull-Down-Steuerschaltung mit dem Gateansteuersignal, der ersten Pull-Down-Schaltung, der zweiten Pull-Down-Schaltung, dem ersten Spannungspegel und dem zweiten Spannungspegel einer vorhergehenden Stufe gekoppelt ist, wobei die erste Pull-Down-Schaltung und die zweite Pull-Down-Schaltung gemäß dem Gateansteuersignal einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung gesteuert werden. Durch die obige Lösung ist die Erfindung für das CMOS-Verfahren geeignet. Auf diese Weise kann die Stabilität der Schaltung verbessert werden.
Description
- Gebiet der Erfindung
- Die vorliegende Erfindung betrifft das Gebiet der Flüssigkristallanzeigetechnologie und insbesondere eine Flüssigkristallanzeigevorrichtung und einen Gate-Treiber hierfür.
- Stand der Technik
- Bei der GOA-Schaltungstechnologie (Gate driver on array) wird ein herkömmlicher Array-Prozess der Flüssigkristallanzeigevorrichtung zur Herstellung einer Gateabtasttreiberschaltung auf einem Arraysubstrat verwendet, um dadurch ein Ansteuermodus für eine progressive Abtastung zu erreichen. Durch die GOA-Schaltung können Flüssigkristallanzeigevorrichtungen die Vorteile der reduzierten Herstellungskosten und einer Gestaltung, die sich durch schmale Ränder auszeichnet, bieten. Daher wird die GOA-Schaltung für eine Vielzahl von Anzeigevorrichtungen verwendet. Die GOA-Schaltung muss zwei Grundfunktionen erfüllen: Die erste besteht im Eingeben von Gate-Ansteuerimpulsen, um die Gateleitungen in einem Panel anzusteuern und dadurch die TFT (Dünnschichttransistoren) in einem Anzeigebereich einzuschalten, damit gewährleistet ist, dass die Gateleitungen das Aufladen der Pixel steuern können; und die zweite betrifft die Funktion des Schieberegisters: Wenn das Ausgeben eines n-ten Gate-Ansteuerimpulses abgeschlossen ist, kann das anschließende Ausgeben des (n + 1)-ten Gate-Ansteuerimpulses mittels einer Taktsteuerung ausgeführt werden, wobei die Übertragung darauf basierend weiter durchgeführt wird.
- Die GOA-Schaltung umfasst eine Pull-Up-Schaltung, eine Pull-Up-Steuerschaltung, eine Pull-Down-Schaltung, eine Pull-Down-Steuerschaltung und eine Boost-Schaltung, die zum Anheben des elektrischen Potenzials dient. Insbesondere ist die Pull-Up-Schaltung für das Ausgeben eines eingegebenen Taktsignals an ein Gate eines Dünnschichttransistors zur Verwendung als Treibersignal einer Flüssigkristallanzeigevorrichtung zuständig. Die Pull-Up-Steuerschaltung dient zur Steuerung des Einschaltens der Pull-Up-Schaltung, wobei die Arbeit in der Regel durch einen von der GOA-Schaltung einer vorhergehenden Stufe übertragenen Signal gewährleistet wird. Die Pull-Down-Schaltung ist zuständig dafür, dass nach dem Ausgeben des Abtastsignals ein Abtastsignal (nämlich das elektrische Potenzial des Gates eines Dünnschichttransistors) schnell auf einen niedrigen Spannungspegel gezogen wird, d. h. das Potenzial des Gates des Dünnschichttransistors wird auf einen niedrigen Spannungspegel gebracht. Die Pull-Down-Halteschaltung dient zum Halten des Abtastsignals und eines Signals der Pull-Up-Schaltung (im Allgemeinen als Q-Knotensignal bezeichnet) im ausgeschalteten Zustand (d. h. bei einem vorgegebenen negativen elektrischen Potenzial), wobei in der Regel zwei Pull-Down-Halteschaltungen abwechselnd arbeiten. Die Boost-Schaltung dient zum erneuten Aufheben des elektrischen Potenzials, um das normale Ausgeben von G(N) der Pull-Up-Schaltung zu gewährleisten.
- Für verschiedene GOA-Schaltungen können unterschiedliche Herstellungsprozesse verwendet werden. Das LTPS-Verfahren (Niedertemperatur-Polysilizium) weist die Vorteile einer hohen Elektronenbeweglichkeit und einer ausgereiften Technologie auf und kommt mittlerweile bei den meisten kleinen und mittelgroßen Anzeigevorrichtungen zum Einsatz. Das LTPS-Verfahren auf Basis der CMOS-Technologie (sich ergänzender Metall-Oxid-Halbleiter) weist die Vorteile des geringen Stromverbrauchs, der hohen Elektronenbeweglichkeit, der hohen Rauschtoleranz usw. auf und wird daher von Panel-Herstellern zunehmend verwendet. Daher besteht die Notwendigkeit, eine sich auf Basis der CMOS-Technologie für das LTPS-Verfahren eignende GOA-Schaltung zu entwickeln.
- Aufgabe der Erfindung
- Die Ausführungsbeispiele der vorliegenden Erfindung stellen eine Flüssigkristallanzeigevorrichtung und einen Gate-Treiber hierfür bereit, die für das CMOS-Verfahren geeignet sind. Auf diese Weise kann die Stabilität der Schaltung verbessert werden.
- Die vorliegende Erfindung stellt einen Gate-Treiber bereit, der mehrere Schieberegisterschaltungen umfasst, wobei die mehreren Schieberegisterschaltungen in Reihe kaskadiert sind, wobei jede Schieberegisterschaltung eine erste Pull-Up-Schaltung, eine zweite Pull-Up-Schaltung, eine erste Pull-Down-Schaltung, eine zweite Pull-Down-Schaltung und eine Pull-Down-Steuerschaltung umfasst, wobei die erste Pull-Up-Schaltung und die zweite Pull-Up-Schaltung zwischen dem Gateansteuersignal und dem Gateansteuersignal-Ausgangsanschluss einer vorhergehenden Stufe in Reihe geschaltet sind, wobei die erste Pull-Down-Schaltung, die zweite Pull-Down-Schaltung und die Pull-Down-Steuerschaltung mit der ersten Pull-Up-Schaltung und der zweiten Pull-Up-Schaltung parallel geschaltet sind, wobei die Pull-Down-Steuerschaltung mit dem Gateansteuersignal, der ersten Pull-Down-Schaltung, der zweiten Pull-Down-Schaltung, dem ersten Spannungspegel und dem zweiten Spannungspegel einer vorhergehenden Stufe gekoppelt ist, wobei die erste Pull-Down-Schaltung und die zweite Pull-Down-Schaltung gemäß dem Gateansteuersignal einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung gesteuert werden.
- Hierbei umfasst die Schieberegisterschaltung ferner eine erste Kapazität und eine zweite Kapazität; wobei die erste Pull-Up-Schaltung einen ersten Transistor umfasst, wobei das Gate und die Source des ersten Transistors mit dem Gateansteuersignal einer vorhergehenden Stufe verbunden sind; wobei die zweite Pull-Up-Schaltung einen zweiten Transistor umfasst, wobei das Gate des zweiten Transistors mit dem Drain des ersten Transistors verbunden ist, wobei die Source des zweiten Transistors mit dem ersten Taktsignal verbunden ist, wobei das Drain des zweiten Transistors mit dem Gateansteuersignal-Ausgangsanschluss verbunden ist; wobei die Kapazität zwischen das Drain und das Gate des zweiten Transistors geschaltet ist; wobei die erste Pull-Down-Schaltung einen dritten Transistor umfasst, wobei die Source des dritten Transistors mit dem Gateansteuersignal-Ausgangsanschluss verbunden ist, wobei das Drain des dritten Transistors mit dem ersten Spannungspegel verbunden ist; wobei die zweite Pull-Down-Schaltung einen vierten Transistor umfasst, wobei die Source des vierten Transistors mit dem Drain des ersten Transistors verbunden ist, wobei das Drain des vierten Transistors mit dem ersten Spannungspegel verbunden ist; wobei ein Anschluss der zweiten Kapazität mit dem ersten Spannungspegel verbunden ist, wobei der andere Anschluss der zweiten Kapazität mit dem Gate des dritten Transistors und dem Gate des vierten Transistors verbunden ist.
- Hierbei umfasst die Pull-Down-Steuerschaltung Folgendes: einen fünften Transistor, wobei das Gate des fünften Transistors mit dem Gateansteuersignal der vorhergehenden Stufe verbunden ist, wobei die Source des fünften Transistors mit dem ersten Spannungspegel verbunden ist, wobei das Drain des fünften Transistors mit dem Gate des dritten Transistors und mit dem Gate des vierten Transistors verbunden ist; einen sechsten Transistor, wobei das Gate des sechsten Transistors mit dem Gateansteuersignal einer vorhergehenden Stufe verbunden ist, wobei die Source des sechsten Transistors mit dem ersten Spannungspegel verbunden ist; einen siebten Transistor, wobei das Gate des siebten Transistors mit dem Drain des sechsten Transistors verbunden ist, wobei die Source des siebten Transistors mit dem zweiten Spannungspegel verbunden ist, wobei das Drain des siebten Transistors mit dem Drain des fünften Transistors verbunden ist; eine dritte Kapazität, wobei die dritte Kapazität zwischen die Source und das Gate des siebten Transistors geschaltet ist; einen achten Transistor, wobei das Gate und das Drain des achten Transistors mit dem zweiten Spannungspegel verbunden sind, wobei die Source des achten Transistors mit dem Drain des sechsten Transistors verbunden ist.
- Hierbei ist der erste Spannungspegel ein hoher Spannungspegel und der zweite Spannungspegel ein niedriger Spannungspegel.
- Hierbei sind der erste Transistor, der zweite Transistor, der dritte Transistor, der vierte Transistor, der fünfte Transistor, der sechste Transistor, der siebte Transistor und der achte Transistor allesamt P-Typ-MOS-Transistoren.
- Die vorliegende Erfindung stellt ferner eine Flüssigkristallanzeigevorrichtung bereit, die eine Flüssigkristallanzeigetafel und einen Gate-Treiber umfasst, wobei der Gate-Treiber mit der Flüssigkristallanzeigetafel verbunden ist und zur Bereitstellung der Abtastansteuersignale für die Flüssigkristallanzeigetafel dient, wobei der Gate-Treiber mehrere Schieberegisterschaltungen umfasst, wobei die mehreren Schieberegisterschaltungen in Reihe kaskadiert sind, wobei jede Schieberegisterschaltung eine erste Pull-Up-Schaltung, eine zweite Pull-Up-Schaltung, eine erste Pull-Down-Schaltung, eine zweite Pull-Down-Schaltung und eine Pull-Down-Steuerschaltung umfasst. Die erste Pull-Up-Schaltung und die zweite Pull-Up-Schaltung sind zwischen dem Gateansteuersignal und dem Gateansteuersignal-Ausgangsanschluss einer vorhergehenden Stufe in Reihe geschaltet, wobei die erste Pull-Down-Schaltung, die zweite Pull-Down-Schaltung und die Pull-Down-Steuerschaltung mit der ersten Pull-Up-Schaltung und der zweiten Pull-Up-Schaltung parallel geschaltet sind, wobei die Pull-Down-Steuerschaltung mit dem Gateansteuersignal, der ersten Pull-Down-Schaltung, der zweiten Pull-Down-Schaltung, dem ersten Spannungspegel und dem zweiten Spannungspegel einer vorhergehenden Stufe gekoppelt ist, wobei die erste Pull-Down-Schaltung und die zweite Pull-Down-Schaltung gemäß dem Gateansteuersignal einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung gesteuert werden.
- Hierbei weist die Schieberegisterschaltung ferner eine erste Kapazität und eine zweite Kapazität auf; wobei die erste Pull-Up-Schaltung einen ersten Transistor umfasst, wobei das Gate und die Source des ersten Transistors mit dem Gateansteuersignal einer vorhergehenden Stufe verbunden sind; wobei die zweite Pull-Up-Schaltung einen zweiten Transistor umfasst, wobei das Gate des zweiten Transistors mit dem Drain des ersten Transistors verbunden ist, wobei die Source des zweiten Transistors mit dem ersten Taktsignal verbunden ist, wobei das Drain des zweiten Transistors mit dem Gateansteuersignal-Ausgangsanschluss verbunden ist; wobei die Kapazität zwischen das Drain und das Gate des zweiten Transistors geschaltet ist; wobei die erste Pull-Down-Schaltung einen dritten Transistor umfasst, wobei die Source des dritten Transistors mit dem Gateansteuersignal-Ausgangsanschluss verbunden ist, wobei das Drain des dritten Transistors mit dem ersten Spannungspegel verbunden ist; wobei die zweite Pull-Down-Schaltung einen vierten Transistor umfasst, wobei die Source des vierten Transistors mit dem Drain des ersten Transistors verbunden ist, wobei das Drain des vierten Transistors mit dem ersten Spannungspegel verbunden ist; wobei ein Anschluss der zweiten Kapazität mit dem ersten Spannungspegel verbunden ist, wobei der andere Anschluss der zweiten Kapazität mit dem Gate des dritten Transistors und dem Gate des vierten Transistors verbunden ist.
- Hierbei umfasst die Pull-Down-Steuerschaltung Folgendes: einen fünften Transistor, wobei das Gate des fünften Transistors mit dem Gateansteuersignal der vorhergehenden Stufe verbunden ist, wobei die Source des fünften Transistors mit dem ersten Spannungspegel verbunden ist, wobei das Drain des fünften Transistors mit dem Gate des dritten Transistors und mit dem Gate des vierten Transistors verbunden ist; einen sechsten Transistor, wobei das Gate des sechsten Transistors mit dem Gateansteuersignal einer vorhergehenden Stufe verbunden ist, wobei die Source des sechsten Transistors mit dem ersten Spannungspegel verbunden ist; einen siebten Transistor, wobei das Gate des siebten Transistors mit dem Drain des sechsten Transistors verbunden ist, wobei die Source des siebten Transistors mit dem zweiten Spannungspegel verbunden ist, wobei das Drain des siebten Transistors mit dem Drain des fünften Transistors verbunden ist; eine dritte Kapazität, wobei die dritte Kapazität zwischen die Source und das Gate des siebten Transistors geschaltet ist; einen achten Transistor, wobei das Gate und das Drain des achten Transistors mit dem zweiten Spannungspegel verbunden sind, wobei die Source des achten Transistors mit dem Drain des sechsten Transistors verbunden ist.
- Hierbei ist der erste Spannungspegel ein hoher Spannungspegel und der zweite Spannungspegel ein niedriger Spannungspegel.
- Hierbei sind der erste Transistor, der zweite Transistor, der dritte Transistor, der vierte Transistor, der fünfte Transistor, der sechste Transistor, der siebte Transistor und der achte Transistor allesamt P-Typ-MOS-Transistoren.
- Unter Anwendung der oben genannten Lösungen können mit der Erfindung die folgenden Vorteile erzielt werden: Die erfindungsgemäße Pull-Down-Steuerschaltung ist mit dem Gateansteuersignal, der ersten Pull-Down-Schaltung, der zweiten Pull-Down-Schaltung, dem ersten Spannungspegel und dem zweiten Spannungspegel einer vorhergehenden Stufe gekoppelt, wobei die erste Pull-Down-Schaltung und die zweite Pull-Down-Schaltung gemäß dem Gateansteuersignal einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung gesteuert werden. Durch die obige Lösung ist die Erfindung für das CMOS-Verfahren geeignet. Auf diese Weise kann die Stabilität der Schaltung verbessert werden.
- Nachfolgend wird die Erfindung unter Bezugnahme auf die Figuren in schematischer Darstellung näher im Detail beschrieben. Es zeigt:
-
1 eine schematische strukturelle Darstellung eines Ausführungsbeispiels des erfindungsgemäßen Gate-Treibers; -
2 ein Schaltbild der Schieberegisterschaltung gemäß1 ; -
3 ein simuliertes Zeitdiagramm des Gate-Treibers gemäß1 ; -
4 eine schematische strukturelle Darstellung eines Ausführungsbeispiels der erfindungsgemäßen Flüssigkristallanzeigevorrichtung. - Siehe
1 , welche eine schematische strukturelle Darstellung eines Ausführungsbeispiels des erfindungsgemäßen Gate-Treibers zeigt. Wie in1 gezeigt, umfasst der Gate-Treiber10 im vorliegenden Ausführungsbeispiel mehrere Schieberegisterschaltungen11 , wobei die mehreren Schieberegisterschaltungen11 in Reihe kaskadiert sind. - Siehe
2 . Die Schieberegisterschaltung11 umfasst eine erste Pull-Up-Schaltung111 , eine zweite Pull-Up-Schaltung112 , eine erste Pull-Down-Schaltung113 , eine zweite Pull-Down-Schaltung114 , eine Pull-Down-Steuerschaltung115 , eine erste Kapazität C1, eine zweite Kapazität C2 und eine dritte Kapazität C3. Hierbei sind die erste Pull-Up-Schaltung111 und die zweite Pull-Up-Schaltung112 zwischen dem Gateansteuersignal G(n – 1) und dem Gateansteuersignal-Ausgangsanschluss G(n) einer vorhergehenden Stufe in Reihe geschaltet, wobei die erste Pull-Down-Schaltung113 , zweite Pull-Down-Schaltung114 und Pull-Down-Steuerschaltung115 mit der ersten Pull-Up-Schaltung111 und zweiten Pull-Up-Schaltung112 parallel geschaltet sind, wobei die Pull-Down-Steuerschaltung115 mit dem Gateansteuersignal G(n – 1), der ersten Pull-Down-Schaltung113 , der zweiten Pull-Down-Schaltung114 , dem ersten Spannungspegel Vgh und dem zweiten Spannungspegel Vgl einer vorhergehenden Stufe gekoppelt ist, wobei die erste Pull-Down-Schaltung113 und die zweite Pull-Down-Schaltung114 gemäß dem Gateansteuersignal G(n – 1) einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung115 gesteuert werden. - Hierbei umfasst die erste Pull-Up-Schaltung
111 einen ersten Transistor T1, wobei das Gate und die Source des ersten Transistors T1 mit dem Gateansteuersignal G(n – 1) einer vorhergehenden Stufe verbunden sind; wobei die zweite Pull-Up-Schaltung112 einen zweiten Transistor T2 umfasst, wobei das Gate des zweiten Transistors T2 mit dem Drain des ersten Transistors T1 verbunden ist, wobei die Source des zweiten Transistors T2 mit dem ersten Taktsignal CK verbunden ist, wobei das Drain des zweiten Transistors T2 mit dem Gateansteuersignal-Ausgangsanschluss G(n) verbunden ist; wobei die erste Kapazität C1 zwischen das Gate und das Drain des zweiten Transistors T2 geschaltet ist; wobei die erste Pull-Down-Schaltung113 einen dritten Transistor T3 umfasst, wobei die Source des dritten Transistors T3 mit dem Gateansteuersignal-Ausgangsanschluss G(n) verbunden ist, wobei das Drain des dritten Transistors T3 mit dem ersten Spannungspegel Vgh verbunden ist; wobei die zweite Pull-Down-Schaltung114 einen vierten Transistor T4 umfasst, wobei die Source des vierten Transistors T4 mit dem Drain des ersten Transistors T1 verbunden ist, wobei das Drain des vierten Transistors T4 mit dem ersten Spannungspegel Vgh verbunden ist; wobei ein Anschluss der zweiten Kapazität C2 mit dem ersten Spannungspegel Vgh verbunden ist, wobei der andere Anschluss der zweiten Kapazität C2 jeweils mit dem Gate des dritten Transistors T3 und dem Gate des vierten Transistors T4 verbunden ist. Die Pull-Down-Steuerschaltung115 ist mit dem Gateansteuersignal G(n – 1), dem Gate des dritten Transistors T3, dem Gate des vierten Transistors T4, dem ersten Spannungspegel Vgh und dem zweiten Spannungspegel Vgl einer vorhergehenden Stufe gekoppelt, wobei der Betrieb des dritten Transistors T3 und des vierten Transistors T4 gemäß dem Gateansteuersignal G(n – 1) einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung115 gesteuert wird, nämlich um das Ein- und Ausschalten des dritten Transistors T3 und des vierten Transistors T4 zu steuern. - Hierbei umfasst die Pull-Down-Steuerschaltung
115 einen fünften Transistor T5, einen sechsten Transistor T6, einen siebten Transistor T7 und einen achten Transistor T8, wobei das Gate des fünften Transistors T5 mit dem Gateansteuersignal G(n – 1) der vorhergehenden Stufe verbunden ist, wobei die Source des fünften Transistors T5 mit dem ersten Spannungspegel Vgh verbunden ist, wobei das Drain des fünften Transistors T5 mit dem Gate des dritten Transistors T3 und mit dem Gate des vierten Transistors T4 verbunden ist; wobei das Gate des sechsten Transistors T6 mit dem Gateansteuersignal G(n – 1) einer vorhergehenden Stufe verbunden ist, wobei die Source des sechsten Transistors T6 mit dem ersten Spannungspegel Vgh verbunden ist; wobei das Gate des siebten Transistors T7 mit dem Drain des sechsten Transistors T6 verbunden ist, wobei die Source des siebten Transistors T7 mit dem zweiten Spannungspegel Vgl verbunden ist, wobei das Drain des siebten Transistors T7 mit dem Drain des fünften Transistors T5 verbunden ist; wobei die dritte Kapazität C3 zwischen die Source und das Gate des siebten Transistors T7 geschaltet ist; wobei das Gate und das Drain des achten Transistors T8 mit dem zweiten Spannungspegel Vgl verbunden sind, wobei die Source des achten Transistors T8 mit dem Drain des sechsten Transistors T6 verbunden ist. - Im vorliegenden Ausführungsbeispiel ist vorzugsweise der erste Spannungspegel Vgh ein hoher Spannungspegel und der zweite Spannungspegel Vgl ein niedriger Spannungspegel. Der erste Transistor T1, der zweite Transistor T2, der dritte Transistor T3, der vierte Transistor T4, der fünfte Transistor T5, der sechste Transistor T6, der siebte Transistor T7 und der achte Transistor T8 sind allesamt P-Typ-MOS-Transistoren. In anderen Ausführungsbeispielen kann ein Fachmann auf diesem Gebiet für die obigen Transistoren auch andere Feldeffekttransistoren wie N-Typ-MOS-Transistoren verwenden.
- Ein Betriebsprinzip des Gate-Treibers
10 wird nachfolgend unter Bezugnahme auf3 , die ein simuliertes Zeitdiagramm zeigt, detailliert beschrieben. - Beim ersten Zeitpunkt t1 befindet sich das Gateansteuersignal G(n – 1) einer vorhergehenden Stufe auf einem niedrigen Spannungspegel, wobei der erste Transistor T1 eingeschaltet wird und sich das erste Taktsignal CK auf einem hohen Spannungspegel befindet und sich das Gate des zweiten Transistors T2 auf einem niedrigen Spannungspegel befindet und der zweite Transistor T2 eingeschaltet wird, wobei sowohl der fünfte Transistor T5 als auch der sechste Transistor T6 eingeschaltet werden und sich sowohl das Gate des siebten Transistors T7 als auch die Source des achten Transistors T8 auf einem hohen Spannungspegel befinden und der siebte Transistor T7 ausgeschaltet wird und der achte Transistor T8 eingeschaltet wird; wobei sich sowohl das Gate des dritten Transistors T3 als auch das Gate des vierten Transistors T4 auf einem hohen Spannungspegel befinden und sowohl der dritte Transistor T3 als auch der vierte Transistor T4 ausgeschaltet werden. Daher ist das Ausgangssignal des Gateansteuersignal-Ausgangsanschlusses G(n) gleich wie das erste Taktsignal CK, d. h. das Ausgangssignal des Gateansteuersignal-Ausgangsanschlusses G(n) befindet sich auf einem hohen Spannungspegel.
- Beim zweiten Zeitpunkt t2 wechselt das Gateansteuersignal G(n – 1) einer vorhergehenden Stufe von einem niedrigen Spannungspegel auf einen hohen Spannungspegel, wobei der erste Transistor T1 ausgeschaltet wird und das erste Taktsignal CK von einem hohen Spannungspegel auf einen niedrigen Spannungspegel wechselt und der zweite Transistor T2 eingeschaltet wird; wobei der fünfte Transistor T5, der sechste Transistor T6, der siebte Transistor T7 und der achte Transistor T8 allesamt ausgeschaltet werden und sowohl der dritte Transistor T3 als auch der vierte Transistor T4 ausgeschaltet werden. Daher ist das Ausgangssignal des Gateansteuersignal-Ausgangsanschlusses G(n) gleich wie das erste Taktsignal CK, d. h. das Ausgangssignal des Gateansteuersignal-Ausgangsanschlusses G(n) wechselt von einem hohen Spannungspegel auf einen niedrigen Spannungspegel.
- Beim dritten Zeitpunkt t3 befindet sich das Gateansteuersignal G(n – 1) einer vorhergehenden Stufe auf einem hohen Spannungspegel, wobei der erste Transistor T1 ausgeschaltet wird und sich das erste Taktsignal CK auf einem niedrigen Spannungspegel befindet und der zweite Transistor T2 eingeschaltet wird; wobei der fünfte Transistor T5, der sechste Transistor T6, der siebte Transistor T7 und der achte Transistor T8 allesamt ausgeschaltet werden; wobei sowohl der dritte Transistor T3 als auch der vierte Transistor T4 ausgeschaltet werden. Daher ist das Ausgangssignal des Gateansteuersignal-Ausgangsanschlusses G(n) gleich wie das erste Taktsignal CK, d. h. das Ausgangssignal des Gateansteuersignal-Ausgangsanschlusses G (n) befindet sich auf einem niedrigen Spannungspegel.
- Beim vierten Zeitpunkt t4 befindet sich das Gateansteuersignal G(n – 1) einer vorhergehenden Stufe auf einem hohen Spannungspegel, wobei der erste Transistor T1 ausgeschaltet wird und das erste Taktsignal CK von einem niedrigen Spannungspegel auf einen hohen Spannungspegel wechselt und der zweite Transistor T2 eingeschaltet wird; wobei sowohl der fünfte Transistor T5 als auch der sechste Transistor T6 ausgeschaltet werden und der achte Transistor T8 eingeschaltet wird und der siebte Transistor T7 eingeschaltet wird und sowohl das Gate des dritten Transistors T3 als auch das Gate des vierten Transistors T4 sich auf einem niedrigen Spannungspegel befinden, wodurch sowohl der dritte Transistor T3 als auch der vierte Transistor T4 eingeschaltet werden und das Ausgangssignal des Gateansteuersignal-Ausgangsanschlusses G(n) dauerhaft auf einem hohen Spannungspegel gehalten wird.
- Im vorliegenden Ausführungsbeispiel ist die Pull-Down-Steuerschaltung
115 mit dem Gateansteuersignal G(n – 1), dem Gate des dritten Transistors T3, dem Gate des vierten Transistors T4, dem ersten Spannungspegel Vgh und dem zweiten Spannungspegel Vgl einer vorhergehenden Stufe gekoppelt, wobei der dritte Transistor T3 und der vierte Transistor T4 gemäß dem Gateansteuersignal G(n – 1) einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung115 gesteuert werden. Die Erfindung ist für das CMOS-Verfahren geeignet. Auf diese Weise kann die Stabilität der Schaltung verbessert und die Anzahl der Taktsignale reduziert werden. - Die vorliegende Erfindung stellt ferner eine Flüssigkristallanzeigevorrichtung bereit, wie in
4 gezeigt ist. Die im vorliegenden Ausführungsbeispiel offenbarte Flüssigkristallanzeigevorrichtung20 umfasst eine Flüssigkristallanzeigetafel21 und einen Gate-Treiber22 . Der Gate-Treiber22 ist mit der Flüssigkristallanzeigetafel21 verbunden, wobei der Gate-Treiber22 zur Bereitstellung der Abtastansteuersignale für die Flüssigkristallanzeigetafel21 dient. Der Gate-Treiber22 ist gleich wie der im obigen Ausführungsbeispiel beschriebene Gate-Treiber10 und wird daher hier nicht wiederholt beschrieben. - Zusammenfassend lässt sich festhalten, dass die erfindungsgemäße Pull-Down-Steuerschaltung mit dem Gateansteuersignal, dem Gate des dritten Transistors, dem Gate des vierten Transistors, dem ersten Spannungspegel und dem zweiten Spannungspegel einer vorhergehenden Stufe gekoppelt ist, wobei der dritte Transistor und der vierte Transistor gemäß dem Gateansteuersignal einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung gesteuert werden. Die Erfindung ist für das CMOS-Verfahren geeignet. Auf diese Weise kann die Stabilität der Schaltung verbessert werden.
- Die vorstehende Beschreibung stellt nur ein bevorzugtes Ausführungsbeispiel der Erfindung dar und soll nicht die Schutzansprüche beschränken. Alle gleichwertigen Änderungen und Modifikationen, die gemäß der Beschreibung und den Zeichnungen der Erfindung von einem Fachmann auf diesem Gebiet vorgenommen werden können, fallen in den Schutzumfang der vorliegenden Erfindung. Der Schutzumfang der Erfindung wird durch die beigefügten Ansprüche bestimmt.
Claims (10)
- Ein Gate-Treiber, bei dem der Gate-Treiber mehrere Schieberegisterschaltungen umfasst, wobei die mehreren Schieberegisterschaltungen in Reihe kaskadiert sind, wobei jede Schieberegisterschaltung eine erste Pull-Up-Schaltung, eine zweite Pull-Up-Schaltung, eine erste Pull-Down-Schaltung, eine zweite Pull-Down-Schaltung und eine Pull-Down-Steuerschaltung umfasst, wobei die erste Pull-Up-Schaltung und die zweite Pull-Up-Schaltung zwischen dem Gateansteuersignal und dem Gateansteuersignal-Ausgangsanschluss einer vorhergehenden Stufe in Reihe geschaltet sind, wobei die erste Pull-Down-Schaltung, die zweite Pull-Down-Schaltung und die Pull-Down-Steuerschaltung mit der ersten Pull-Up-Schaltung und der zweiten Pull-Up-Schaltung parallel geschaltet sind, wobei die Pull-Down-Steuerschaltung mit dem Gateansteuersignal, der ersten Pull-Down-Schaltung, der zweiten Pull-Down-Schaltung, dem ersten Spannungspegel und dem zweiten Spannungspegel einer vorhergehenden Stufe gekoppelt ist, wobei die erste Pull-Down-Schaltung und die zweite Pull-Down-Schaltung gemäß dem Gateansteuersignal einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung gesteuert werden.
- Gate-Treiber nach Anspruch 1, bei dem die Schieberegisterschaltung ferner eine erste Kapazität und eine zweite Kapazität umfasst; wobei die erste Pull-Up-Schaltung einen ersten Transistor umfasst, wobei das Gate und die Source des ersten Transistors mit dem Gateansteuersignal einer vorhergehenden Stufe verbunden sind; wobei die zweite Pull-Up-Schaltung einen zweiten Transistor umfasst, wobei das Gate des zweiten Transistors mit dem Drain des ersten Transistors verbunden ist, wobei die Source des zweiten Transistors mit dem ersten Taktsignal verbunden ist, wobei das Drain des zweiten Transistors mit dem Gateansteuersignal-Ausgangsanschluss verbunden ist; wobei die Kapazität zwischen das Drain und das Gate des zweiten Transistors geschaltet ist; wobei die erste Pull-Down-Schaltung einen dritten Transistor umfasst, wobei die Source des dritten Transistors mit dem Gateansteuersignal-Ausgangsanschluss verbunden ist, wobei das Drain des dritten Transistors mit dem ersten Spannungspegel verbunden ist; wobei die zweite Pull-Down-Schaltung einen vierten Transistor umfasst, wobei die Source des vierten Transistors mit dem Drain des ersten Transistors verbunden ist, wobei das Drain des vierten Transistors mit dem ersten Spannungspegel verbunden ist; wobei ein Anschluss der zweiten Kapazität mit dem ersten Spannungspegel verbunden ist, wobei der andere Anschluss der zweiten Kapazität mit dem Gate des dritten Transistors und dem Gate des vierten Transistors verbunden ist.
- Gate-Treiber nach Anspruch 2, bei dem die Pull-Down-Steuerschaltung Folgendes umfasst: einen fünften Transistor, wobei das Gate des fünften Transistors mit dem Gateansteuersignal der vorhergehenden Stufe verbunden ist, wobei die Source des fünften Transistors mit dem ersten Spannungspegel verbunden ist, wobei das Drain des fünften Transistors mit dem Gate des dritten Transistors und mit dem Gate des vierten Transistors verbunden ist; einen sechsten Transistor, wobei das Gate des sechsten Transistors mit dem Gateansteuersignal einer vorhergehenden Stufe verbunden ist, wobei die Source des sechsten Transistors mit dem ersten Spannungspegel verbunden ist; einen siebten Transistor, wobei das Gate des siebten Transistors mit dem Drain des sechsten Transistors verbunden ist, wobei die Source des siebten Transistors mit dem zweiten Spannungspegel verbunden ist, wobei das Drain des siebten Transistors mit dem Drain des fünften Transistors verbunden ist; eine dritte Kapazität, wobei die dritte Kapazität zwischen die Source und das Gate des siebten Transistors geschaltet ist; einen achten Transistor, wobei das Gate und das Drain des achten Transistors mit dem zweiten Spannungspegel verbunden sind, wobei die Source des achten Transistors mit dem Drain des sechsten Transistors verbunden ist.
- Gate-Treiber nach Anspruch 3, bei dem der erste Spannungspegel ein hoher Spannungspegel und der zweite Spannungspegel ein niedriger Spannungspegel ist.
- Gate-Treiber nach Anspruch 4, bei dem der erste Transistor, der zweite Transistor, der dritte Transistor, der vierte Transistor, der fünfte Transistor, der sechste Transistor, der siebte Transistor und der achte Transistor allesamt P-Typ-MOS-Transistoren sind.
- Eine Flüssigkristallanzeigevorrichtung, bei der die Flüssigkristallanzeigevorrichtung eine Flüssigkristallanzeigetafel und einen Gate-Treiber umfasst, wobei der Gate-Treiber mit der Flüssigkristallanzeigetafel verbunden ist und zur Bereitstellung der Abtastansteuersignale für die Flüssigkristallanzeigetafel dient, wobei der Gate-Treiber mehrere Schieberegisterschaltungen umfasst, wobei die mehreren Schieberegisterschaltungen in Reihe kaskadiert sind, wobei jede Schieberegisterschaltung eine erste Pull-Up-Schaltung, eine zweite Pull-Up-Schaltung, eine erste Pull-Down-Schaltung, eine zweite Pull-Down-Schaltung und eine Pull-Down-Steuerschaltung umfasst, wobei die erste Pull-Up-Schaltung und die zweite Pull-Up-Schaltung zwischen dem Gateansteuersignal und dem Gateansteuersignal-Ausgangsanschluss einer vorhergehenden Stufe in Reihe geschaltet sind, wobei die erste Pull-Down-Schaltung, die zweite Pull-Down-Schaltung und die Pull-Down-Steuerschaltung mit der ersten Pull-Up-Schaltung und der zweiten Pull-Up-Schaltung parallel geschaltet sind, wobei die Pull-Down-Steuerschaltung mit dem Gateansteuersignal, der ersten Pull-Down-Schaltung, der zweiten Pull-Down-Schaltung, dem ersten Spannungspegel und dem zweiten Spannungspegel einer vorhergehenden Stufe gekoppelt ist, wobei die erste Pull-Down-Schaltung und die zweite Pull-Down-Schaltung gemäß dem Gateansteuersignal einer vorhergehenden Stufe von der Pull-Down-Steuerschaltung gesteuert werden.
- Flüssigkristallanzeigevorrichtung nach Anspruch 6, bei der die Schieberegisterschaltung ferner eine erste Kapazität und eine zweite Kapazität aufweist; wobei die erste Pull-Up-Schaltung einen ersten Transistor umfasst, wobei das Gate und die Source des ersten Transistors mit dem Gateansteuersignal einer vorhergehenden Stufe verbunden sind; wobei die zweite Pull-Up-Schaltung einen zweiten Transistor umfasst, wobei das Gate des zweiten Transistors mit dem Drain des ersten Transistors verbunden ist, wobei die Source des zweiten Transistors mit dem ersten Taktsignal verbunden ist, wobei das Drain des zweiten Transistors mit dem Gateansteuersignal-Ausgangsanschluss verbunden ist; wobei die Kapazität zwischen das Drain und das Gate des zweiten Transistors geschaltet ist; wobei die erste Pull-Down-Schaltung einen dritten Transistor umfasst, wobei die Source des dritten Transistors mit dem Gateansteuersignal-Ausgangsanschluss verbunden ist, wobei das Drain des dritten Transistors mit dem ersten Spannungspegel verbunden ist; wobei die zweite Pull-Down-Schaltung einen vierten Transistor umfasst, wobei die Source des vierten Transistors mit dem Drain des ersten Transistors verbunden ist, wobei das Drain des vierten Transistors mit dem ersten Spannungspegel verbunden ist; wobei ein Anschluss der zweiten Kapazität mit dem ersten Spannungspegel verbunden ist, wobei der andere Anschluss der zweiten Kapazität mit dem Gate des dritten Transistors und dem Gate des vierten Transistors verbunden ist.
- Flüssigkristallanzeigevorrichtung nach Anspruch 7, bei der die Pull-Down-Steuerschaltung Folgendes umfasst: einen fünften Transistor, wobei das Gate des fünften Transistors mit dem Gateansteuersignal der vorhergehenden Stufe verbunden ist, wobei die Source des fünften Transistors mit dem ersten Spannungspegel verbunden ist, wobei das Drain des fünften Transistors mit dem Gate des dritten Transistors und mit dem Gate des vierten Transistors verbunden ist; einen sechsten Transistor, wobei das Gate des sechsten Transistors mit dem Gateansteuersignal einer vorhergehenden Stufe verbunden ist, wobei die Source des sechsten Transistors mit dem ersten Spannungspegel verbunden ist; einen siebten Transistor, wobei das Gate des siebten Transistors mit dem Drain des sechsten Transistors verbunden ist, wobei die Source des siebten Transistors mit dem zweiten Spannungspegel verbunden ist, wobei das Drain des siebten Transistors mit dem Drain des fünften Transistors verbunden ist; eine dritte Kapazität, wobei die dritte Kapazität zwischen die Source und das Gate des siebten Transistors geschaltet ist; einen achten Transistor, wobei das Gate und das Drain des achten Transistors mit dem zweiten Spannungspegel verbunden sind, wobei die Source des achten Transistors mit dem Drain des sechsten Transistors verbunden ist.
- Flüssigkristallanzeigevorrichtung nach Anspruch 8, bei der der erste Spannungspegel ein hoher Spannungspegel und der zweite Spannungspegel ein niedriger Spannungspegel ist.
- Flüssigkristallanzeigevorrichtung nach Anspruch 9, bei der der erste Transistor, der zweite Transistor, der dritte Transistor, der vierte Transistor, der fünfte Transistor, der sechste Transistor, der siebte Transistor und der achte Transistor allesamt P-Typ-MOS-Transistoren sind.
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201410850940.X | 2014-12-30 | ||
CN201410850940.XA CN104517577B (zh) | 2014-12-30 | 2014-12-30 | 液晶显示装置及其栅极驱动器 |
PCT/CN2015/070517 WO2016106823A1 (zh) | 2014-12-30 | 2015-01-12 | 液晶显示装置及其栅极驱动器 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE112015005395T5 true DE112015005395T5 (de) | 2017-08-24 |
DE112015005395B4 DE112015005395B4 (de) | 2021-01-21 |
Family
ID=52792792
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE112015005395.6T Active DE112015005395B4 (de) | 2014-12-30 | 2015-01-12 | Flüssigkristallanzeigevorrichtung und Gate-Treiber hierfür |
Country Status (8)
Country | Link |
---|---|
US (1) | US9620073B2 (de) |
JP (1) | JP6472525B2 (de) |
KR (1) | KR101989721B1 (de) |
CN (1) | CN104517577B (de) |
DE (1) | DE112015005395B4 (de) |
GB (1) | GB2547577B (de) |
RU (1) | RU2673701C1 (de) |
WO (1) | WO2016106823A1 (de) |
Families Citing this family (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN104809978B (zh) * | 2015-05-21 | 2017-05-17 | 京东方科技集团股份有限公司 | 移位寄存器单元、驱动方法、栅极驱动电路及显示装置 |
CN105741802B (zh) * | 2016-03-28 | 2018-01-30 | 京东方科技集团股份有限公司 | 移位寄存器单元及其驱动方法、栅极驱动电路、显示装置 |
CN106097978B (zh) * | 2016-08-19 | 2018-08-03 | 京东方科技集团股份有限公司 | 移位寄存单元、移位寄存器、栅极驱动电路和显示装置 |
CN106128397B (zh) | 2016-08-31 | 2019-03-15 | 深圳市华星光电技术有限公司 | 一种goa驱动单元及驱动电路 |
CN106205538A (zh) * | 2016-08-31 | 2016-12-07 | 深圳市华星光电技术有限公司 | 一种goa驱动单元及驱动电路 |
CN107452318B (zh) * | 2017-09-20 | 2020-04-28 | 京东方科技集团股份有限公司 | 复位控制模块、其驱动方法及移位寄存器单元、显示装置 |
CN108039150B (zh) * | 2017-11-16 | 2020-05-19 | 武汉华星光电半导体显示技术有限公司 | 移位寄存电路及移位寄存单元 |
CN108172165B (zh) * | 2018-01-03 | 2019-12-10 | 京东方科技集团股份有限公司 | 移位寄存器电路、驱动方法和显示装置 |
CN108231024B (zh) * | 2018-01-07 | 2019-12-10 | 苏州市相城区黄桥工业园经济发展有限公司 | 一种用于振动环境的液晶显示装置 |
TWI690931B (zh) * | 2019-03-08 | 2020-04-11 | 友達光電股份有限公司 | 閘極驅動電路以及移位暫存器的控制方法 |
TWI731820B (zh) * | 2020-12-08 | 2021-06-21 | 友達光電股份有限公司 | 移位暫存電路 |
Family Cites Families (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100242244B1 (ko) * | 1997-08-09 | 2000-02-01 | 구본준 | 스캐닝 회로 |
KR100803163B1 (ko) * | 2001-09-03 | 2008-02-14 | 삼성전자주식회사 | 액정표시장치 |
US7486269B2 (en) * | 2003-07-09 | 2009-02-03 | Samsung Electronics Co., Ltd. | Shift register, scan driving circuit and display apparatus having the same |
JP2008131407A (ja) * | 2006-11-22 | 2008-06-05 | Matsushita Electric Ind Co Ltd | 固体撮像素子およびそれを用いた撮像装置 |
TWI380274B (en) * | 2008-02-21 | 2012-12-21 | Chunghwa Picture Tubes Ltd | Shift register and liquid crystal display (lcd) |
TWI386904B (zh) * | 2008-05-12 | 2013-02-21 | Chimei Innolux Corp | 平面顯示器 |
CN101533623A (zh) * | 2009-02-26 | 2009-09-16 | 深圳华映显示科技有限公司 | 可抑制临界电压漂移的闸极驱动电路 |
BR112012000498A2 (pt) * | 2009-07-10 | 2020-08-11 | Sharp Kabushiki Kaisha | dispositivo de exibição |
CN101673582B (zh) * | 2009-10-28 | 2013-03-20 | 友达光电股份有限公司 | 移位缓存器电路 |
US20120242630A1 (en) * | 2009-12-28 | 2012-09-27 | Sharp Kabushiki Kaisha | Shift register |
US8537094B2 (en) * | 2010-03-24 | 2013-09-17 | Au Optronics Corporation | Shift register with low power consumption and liquid crystal display having the same |
TWI433459B (zh) * | 2010-07-08 | 2014-04-01 | Au Optronics Corp | 雙向移位暫存器 |
KR101552420B1 (ko) * | 2011-05-23 | 2015-09-10 | 샤프 가부시키가이샤 | 주사 신호선 구동 회로, 그것을 구비한 표시 장치 및 주사 신호선의 구동 방법 |
TWI527007B (zh) * | 2011-11-25 | 2016-03-21 | 元太科技工業股份有限公司 | 驅動電路 |
CN102629461A (zh) * | 2012-02-21 | 2012-08-08 | 北京京东方光电科技有限公司 | 移位寄存器、阵列基板驱动电路及显示装置 |
TWI473059B (zh) * | 2013-05-28 | 2015-02-11 | Au Optronics Corp | 移位暫存器電路 |
CN103680453B (zh) * | 2013-12-20 | 2015-09-16 | 深圳市华星光电技术有限公司 | 阵列基板行驱动电路 |
CN103928007B (zh) * | 2014-04-21 | 2016-01-20 | 深圳市华星光电技术有限公司 | 一种用于液晶显示的goa电路及液晶显示装置 |
CN104064160B (zh) * | 2014-07-17 | 2016-06-15 | 深圳市华星光电技术有限公司 | 具有自我补偿功能的栅极驱动电路 |
-
2014
- 2014-12-30 CN CN201410850940.XA patent/CN104517577B/zh active Active
-
2015
- 2015-01-12 DE DE112015005395.6T patent/DE112015005395B4/de active Active
- 2015-01-12 US US14/433,657 patent/US9620073B2/en active Active
- 2015-01-12 GB GB1706904.8A patent/GB2547577B/en active Active
- 2015-01-12 KR KR1020177021417A patent/KR101989721B1/ko active IP Right Grant
- 2015-01-12 JP JP2017534660A patent/JP6472525B2/ja active Active
- 2015-01-12 RU RU2017125765A patent/RU2673701C1/ru active
- 2015-01-12 WO PCT/CN2015/070517 patent/WO2016106823A1/zh active Application Filing
Also Published As
Publication number | Publication date |
---|---|
RU2673701C1 (ru) | 2018-11-29 |
JP2018508809A (ja) | 2018-03-29 |
GB2547577A (en) | 2017-08-23 |
CN104517577B (zh) | 2016-10-12 |
JP6472525B2 (ja) | 2019-02-20 |
US20160343334A1 (en) | 2016-11-24 |
KR101989721B1 (ko) | 2019-06-14 |
GB201706904D0 (en) | 2017-06-14 |
GB2547577B (en) | 2021-07-14 |
CN104517577A (zh) | 2015-04-15 |
WO2016106823A1 (zh) | 2016-07-07 |
KR20170138075A (ko) | 2017-12-14 |
US9620073B2 (en) | 2017-04-11 |
DE112015005395B4 (de) | 2021-01-21 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
R012 | Request for examination validly filed | ||
R082 | Change of representative |
Representative=s name: LANGPATENT ANWALTSKANZLEI IP LAW FIRM, DE |
|
R079 | Amendment of ipc main class |
Free format text: PREVIOUS MAIN CLASS: G09G0003360000 Ipc: G09G0003200000 |
|
R016 | Response to examination communication | ||
R018 | Grant decision by examination section/examining division | ||
R020 | Patent grant now final |