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KR20210080686A - 표시 장치 - Google Patents

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KR20210080686A
KR20210080686A KR1020190171892A KR20190171892A KR20210080686A KR 20210080686 A KR20210080686 A KR 20210080686A KR 1020190171892 A KR1020190171892 A KR 1020190171892A KR 20190171892 A KR20190171892 A KR 20190171892A KR 20210080686 A KR20210080686 A KR 20210080686A
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KR
South Korea
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line
area
pixel
column
pixels
Prior art date
Application number
KR1020190171892A
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English (en)
Inventor
이상훈
강기녕
김태우
양태훈
최종현
Original Assignee
삼성디스플레이 주식회사
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Filing date
Publication date
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Priority to US16/907,476 priority patent/US11552146B2/en
Priority to EP20197628.9A priority patent/EP3839932A1/en
Priority to CN202011101696.9A priority patent/CN113013178A/zh
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Abstract

본 발명의 일 실시예에 따르면, 표시 장치는, 제1 영역 및 상기 제1 영역을 둘러싸는 제2 영역을 포함하는, 기판; 상기 기판 상의 상기 제2 영역에 배치되며, 제1 열을 따라 나란하게 배열된 제1 화소와 제2 화소, 및 상기 제1 열과 평행한 제2 열을 따라 나란하게 배열된 제3 화소와 제4 화소를 포함하는, 복수의 화소들; 및 복수의 라인들을 포함하고, 상기 복수의 라인들은, 상기 제1 열을 따라 연장되어 상기 제1 화소와 전기적으로 연결된 제1 라인, 상기 제1 열을 따라 연장되어 상기 제2 화소와 전기적으로 연결된 제2 라인, 상기 제2 열을 따라 연장되어 상기 제3 화소와 전기적으로 연결된 제3 라인, 및 상기 제2 열을 따라 연장되어 상기 제4 화소와 전기적으로 연결된 제4 라인을 포함하고, 상기 제1 라인 및 상기 제2 라인은, 상기 제1 열과 직교하는 제1 행 상에 위치하는 제1 지점을 중심으로 상호 이격되고, 상기 제3 라인 및 상기 제4 라인은, 상기 제1 행과 평행하고 상기 제1 행과 이격된 제2 행 상에 위치하는 제2 지점을 중심으로 상호 이격되며, 상기 제1 행과 상기 제2 행은 상기 제1 영역을 지날 수 있다. 그 외에 다양한 실시예들이 가능하다.

Description

표시 장치 {DISPLAY DEVICE}
본 발명의 다양한 실시예는 표시 장치에 관한 것이다.
표시 장치는 그 용도가 다양해지고 있다. 또한, 표시 장치의 두께가 얇아지고 무게가 가벼워 그 사용의 범위가 광범위해지고 있는 추세이다.
표시 장치는 이미지를 출력하는 표시 영역이 차지하는 면적을 확대하는 한편, 표시 장치와 접목 또는 연계하여 다양한 기능들을 사용할 수 있도록 점차 개발되는 추세이다.
표시 장치에 접목 또는 연계하여 다양한 기능을 제공하기 위한 일 방안으로, 표시 장치는 표시 영역의 내측에 카메라 또는 센서 등의 컴포넌트를 배치하고, 컴포넌트의 원활한 동작을 위해 컴포넌트의 배치 위치에 대응하여 광 투과도가 상대적으로 높게 형성된 컴포넌트 영역을 구비할 수 있다.
다양한 실시예에 따르면, 표시 장치는, 제1 영역 및 상기 제1 영역을 둘러싸는 제2 영역을 포함하는, 기판; 상기 기판 상의 상기 제2 영역에 배치되며, 제1 열을 따라 나란하게 배열된 제1 화소와 제2 화소, 및 상기 제1 열과 평행한 제2 열을 따라 나란하게 배열된 제3 화소와 제4 화소를 포함하는, 복수의 화소들; 및 복수의 라인들을 포함하고, 상기 복수의 라인들은, 상기 제1 열을 따라 연장되어 상기 제1 화소와 전기적으로 연결된 제1 라인, 상기 제1 열을 따라 연장되어 상기 제2 화소와 전기적으로 연결된 제2 라인, 상기 제2 열을 따라 연장되어 상기 제3 화소와 전기적으로 연결된 제3 라인, 및 상기 제2 열을 따라 연장되어 상기 제4 화소와 전기적으로 연결된 제4 라인을 포함하고, 상기 제1 라인 및 상기 제2 라인은, 상기 제1 열과 직교하는 제1 행 상에 위치하는 제1 지점을 중심으로 상호 이격되고, 상기 제3 라인 및 상기 제4 라인은, 상기 제1 행과 평행하고 상기 제1 행과 이격된 제2 행 상에 위치하는 제2 지점을 중심으로 상호 이격되며, 상기 제1 행과 상기 제2 행은 상기 제1 영역을 지날 수 있다.
상기 제1 라인 및 상기 제3 라인은, 상기 기판의 일측에 배치된 제1 스캔 구동회로로부터 연장되고, 상기 제2 라인 및 상기 제4 라인은 상기 기판의 타측에 배치된 제2 스캔 구동회로로부터 연장될 수 있다.
상기 기판은, 상기 제2 영역을 둘러싸는 제3 영역을 더 포함하고, 상기 제1 스캔 구동회로 및 상기 제2 스캔 구동회로는 상기 제3 영역에 배치될 수 있다.
상기 복수의 라인들은, 스캔 라인 또는 발광 제어 라인 중 적어도 하나를 포함할 수 있다.
상기 복수의 화소들은, 상기 제1 열과 평행한 제3 열을 따라 나란하게 배열된 제5 화소 및 제6 화소를 더 포함하고, 상기 복수의 라인들은, 상기 제3 열을 따라 연장되어 상기 제5 화소와 연결된 제5 라인 및 상기 제3 열을 따라 연장되어 상기 제6 화소와 연결된 제6 라인을 더 포함하며, 상기 제5 라인 및 상기 제6 라인은, 상기 제1 행과 나란하게 이격되고 상기 제1 영역을 지나는 제3 행 상에 위치하는 제3 지점을 중심으로 상호 이격될 수 있다.
상기 복수의 화소들은, 상기 제1 열과 평행한 제4 열을 따라 배열되되 상기 제1 영역을 중심으로 상호 이격된 제7 화소 및 제8 화소를 더 포함할 수 있다.
상기 제4 열은 상기 제1 영역을 지날 수 있다.
상기 제1 라인 및 상기 제3 라인은, 서로 다른 길이를 가질 수 있다.
상기 제1 라인 및 상기 제2 라인은, 서로 다른 길이를 가질 수 있다.
상기 제1 라인과 연결된 화소의 개수는 상기 제3 라인과 연결된 화소의 개수와 상이할 수 있다.
상기 제1 라인 및 상기 제3 라인의 폭은, 상기 제1 라인 및 상기 제3 라인의 길이에 대응할 수 있다.
상기 제1 지점 및 상기 제2 지점은, 이웃하는 두 화소들 사이에 위치할 수 있다.
상기 복수의 화소들은, 화소전극, 대향전극 및 상기 화소전극과 상기 대향전극 사이의 발광층을 포함하는 표시요소를 각각 포함하고, 상기 대향전극은 일체로 형성되되 상기 제1 영역에 대응하는 홀을 포함할 수 있다.
본 발명의 다양한 실시예에 따른 표시 장치는, 제1 영역 및 상기 제1 영역을 둘러싸는 제2 영역을 포함하는 기판; 상기 제2 영역에 배치되는 복수의 화소들; 및 제1 방향을 향해 상호 평행하게 연장되어, 상기 복수의 화소들과 전기적으로 연결된, 복수의 라인들을 포함하고, 상기 복수의 라인들은, 상기 제1 방향과 직교하는 방향으로 상기 제1 영역에 대응하는 제2 영역의 일부 영역에서, 각각 단선(disconnected)될 수 있다.
상기 복수의 라인들 각각은, 상기 제2 영역의 상기 일부 영역에서 불규칙적으로 단선될 수 있다.
상기 복수의 라인들 각각은, 상기 단선된 지점을 기준으로, 일 부분은 제1 스캔 구동회로로부터 연장되고, 나머지 부분은 제2 스캔 구동회로로부터 연장될 수 있다.
상기 기판은 상기 제2 영역을 둘러싸는 제3 영역을 더 포함하고, 상기 제1 스캔 구동회로 및 상기 제2 스캔 구동회로는 상기 제3 영역에 배치될 수 있다.
상기 복수의 라인들 중 인접하는 두 복수의 라인들은, 상기 제1 스캔 구동회로로부터 상기 단선된 부분까지의 길이가 서로 다를 수 있다.
상기 복수의 라인들의 일 부분의 폭은, 상기 제1 스캔 구동회로로부터 상기 단선된 부분까지에 길이에 대응할 수 있다.
상기 복수의 라인들은, 스캔 라인 또는 발광 제어 라인 중 적어도 하나를 포함할 수 있다.
본 발명의 다양한 실시예들에 따르면, 표시 영역의 면적이 극대화되고, 표시 특성이 개선된 표시 장치를 제공할 수 있다.
도 1은 본 발명의 일 실시예에 따른 전자 장치를 개략적으로 나타낸 사시도이다.
도 2는 본 발명의 일 실시예에 따른 표시 장치를 나타낸 단면도이다.
도 3은 본 발명의 일 실시예에 따른 표시 패널을 개략적으로 나타낸 평면도이다.
도 4는 본 발명의 일 실시예에 따른 표시 패널에 구비된 어느 하나의 화소회로를 나타낸 등가 회로도이다.
도 5는 본 발명의 일 실시예에 따른 표시 패널의 평면도이다.
도 6은 도 5의 VI 를 확대한 평면도이다.
도 7은 본 발명의 일 실시예에 따른 표시 패널을 구체적으로 도시한 단면도이다.
본 발명은 다양한 변환을 가할 수 있고 여러 가지 실시예를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 상세한 설명에 상세하게 설명하고자 한다. 본 발명의 효과 및 특징, 그리고 그것들을 달성하는 방법은 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 다양한 형태로 구현될 수 있다.
이하, 첨부된 도면을 참조하여 본 발명의 실시예들을 상세히 설명하기로 하며, 도면을 참조하여 설명할 때 동일하거나 대응하는 구성 요소는 동일한 도면부호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.
이하의 실시예에서, 제1, 제2 등의 용어는 한정적인 의미가 아니라 하나의 구성 요소를 다른 구성 요소와 구별하는 목적으로 사용되었다.
이하의 실시예에서, 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.
이하의 실시예에서, 포함하다 또는 가지다 등의 용어는 명세서상에 기재된 특징, 또는 구성요소가 존재함을 의미하는 것이고, 하나 이상의 다른 특징들 또는 구성요소가 부가될 가능성을 미리 배제하는 것은 아니다.
이하의 실시예에서, 막, 영역, 구성 요소 등의 부분이 다른 부분 위에 또는 상에 있다고 할 때, 다른 부분의 바로 위에 있는 경우뿐만 아니라, 그 중간에 다른 막, 영역, 구성 요소 등이 개재되어 있는 경우도 포함한다.
도면에서는 설명의 편의를 위하여 구성 요소들이 그 크기가 과장 또는 축소될 수 있다. 예컨대, 도면에서 나타난 각 구성의 크기 및 두께는 설명의 편의를 위해 임의로 나타내었으므로, 본 발명이 반드시 도시된 바에 한정되지 않는다.
어떤 실시예가 달리 구현 가능한 경우에 특정한 공정 순서는 설명되는 순서와 다르게 수행될 수도 있다. 예를 들어, 연속하여 설명되는 두 공정이 실질적으로 동시에 수행될 수도 있고, 설명되는 순서와 반대의 순서로 진행될 수 있다.
본 명세서에서 "A 및/또는 B"는 "A"이거나, "B"이거나, "A 및 B"인 경우를 포함할 수 있다. 그리고, "A 및 B 중 적어도 하나"는 "A"이거나, "B"이거나, "A 및 B"인 경우를 포함할 수 있다. 또한, "A, B, 또는 C 중 적어도 하나"는 "A"이거나, "B"이거나, "C"이거나, "A 및 B 중 적어도 하나"이거나, "A 및 C 중 적어도 하나"이거나, "B 및 C 중 적어도 하나"이거나, "A, B, 및 C"인 경우를 포함할 수 있다.
이하의 실시예에서, 막, 영역, 구성 요소 등이 연결되었다고 할 때, 막, 영역, 구성 요소들이 직접적으로 연결된 경우, 또는/및 막, 영역, 구성요소들 중간에 다른 막, 영역, 구성 요소들이 개재되어 간접적으로 연결된 경우도 포함한다. 예컨대, 본 명세서에서 막, 영역, 구성 요소 등이 전기적으로 연결되었다고 할 때, 막, 영역, 구성 요소 등이 직접 전기적으로 연결된 경우, 및/또는 그 중간에 다른 막, 영역, 구성 요소 등이 개재되어 간접적으로 전기적 연결된 경우를 나타낸다.
x행, y행 및 z행은 직교 좌표계 상의 세 행으로 한정되지 않고, 이를 포함하는 넓은 의미로 해석될 수 있다. 예를 들어, x행, y행 및 z행은 서로 직교할 수도 있지만, 서로 직교하지 않는 서로 다른 방향을 지칭할 수도 있다.
도 1은 본 발명의 일 실시예에 따른 표시 장치를 개략적으로 도시한 사시도이다.
도 1을 참조하면, 표시 장치(1)는 제1 영역(A1), 제2 영역(A2), 및 제3 영역(A3)을 포함할 수 있다.
제1 영역(A1)은 표시 장치(1)의 내측에 구비된 컴포넌트에 대응하여 광 투과율이 상대적으로 높게 형성된 영역을 포함할 수 있다. 예를 들어 제1 영역(A1)은, 컴포넌트로부터 외부로 출력되거나, 외부에서 컴포넌트를 향해 입사되는 빛이 투과될 수 있는 투과 영역(transmission area)으로 이해될 수 있다. 예컨대 상기 제1 영역(A1)은 컴포넌트 영역, 센서 영역, 또는 개구 영역으로 지칭될 수 있다.
제2 영역(A2)은 화소들이 배치된 영역으로 정의될 수 있다. 표시 장치(1)는 제2 영역(A2)에 배치된 복수의 화소들로부터 방출되는 빛을 이용하여, 소정의 이미지 정보를 제공할 수 있다. 예컨대 제2 영역(A2)은 표시 영역으로 지칭될 수 있다.
제2 영역(A2)은 제1 영역(A1)을 적어도 부분적으로 둘러싸도록 배치될 수 있다. 일 실시예로서, 제2 영역(A2)은, 도 1에 도시된 바와 같이 제1 영역(A1)을 전체적으로 둘러쌀 수 있다.
제2 영역(A2)은 제3 영역(A3)의 내측에 위치할 수 있다.
예컨대, 제1 영역(A1)은 제2 영역(A2)에 의해 둘러싸일 수 있으며, 제2 영역(A2)은 제3 영역(A3)에 의해 둘러싸일 수 있다.
제3 영역(A3)은 제2 영역(A2)에 배치된 화소들에 전기적 신호를 제공하는 회로 구성들이 배치된 영역을 포함할 수 있다.
도 1에서, 제1 영역(A1) 및 제3 영역(A3)은, 빛을 방출할 수 있는 화소들이 배치되지 않은 비표시 영역에 해당할 수 있다.
도 1에서는 제1 영역(A1)이 실질적으로 사각형 형태인 제2 영역(A2)의 일측(우상측)에 배치된 것을 도시하고 있으나 본 발명은 이에 한정되지 않는다.
예를 들어, 제2 영역(A2)의 형상은 원형, 타원, 또는 삼각형이나 오각형 등과 같은 다각형일 수 있으며, 제1 영역(A1)의 위치 및 개수도 다양하게 변경될 수 있다. 예를 들어 제1 영역(A1)은, 제2 영역(A2)의 평면(예: x-y 평면)을 기준으로 좌상측에 배치될 수 있으며, 제1 영역(A1)은 제2 영역(A2)의 내측에 복수 개로 구비될 수도 있다.
이하에서는, 본 발명의 일 실시예에 따른 표시 장치(1)로서, 유기 발광 표시 장치를 예로 하여 설명하지만, 본 발명의 표시 장치는 이에 제한되지 않는다.
예컨대 다른 실시예로서, 표시 장치(1)는 무기 발광 표시 장치(Inorganic Light Emitting Display 또는 무기 EL 표시 장치)이거나, 양자점 발광 표시 장치(Quantum dot Light Emitting Display)와 같은 표시 장치일 수 있다.
예를 들어, 표시 장치(1)에 구비된 표시요소의 발광층은 유기물을 포함하거나, 무기물을 포함하거나, 양자점을 포함하거나, 유기물과 양자점을 포함하거나, 또는 무기물과 양자점을 포함할 수 있다.
전술한 표시 장치(1)는 휴대폰(mobile phone), 노트북, 스마트 워치와 같은 다양한 종류의 전자 기기일 수 있다.
도 2는 본 발명의 일 실시예에 따른 표시 장치를 나타낸 단면도이다. 예컨대 도 2는, 도 1의 I-I'선에 따른 단면에 대응할 수 있다.
도 2를 참조하면, 표시 장치(1)는, 표시 패널(10)과, 표시 패널(10) 상에 배치되는 입력감지층(40) 및/또는 광학 기능층(50)을 포함할 수 있으며, 이들 구성은 윈도우(60)로 커버될 수 있다.
윈도우(60)는 광학 투명 점착제(optical clear adhesive)와 같은 점착층(OCA)을 통해 그 아래의 구성, 예컨대 광학 기능층(50)(또는, 입력감지층(40))과 결합될 수 있다.
표시 장치(1)는 표시 패널(10)의 하부에 컴포넌트(20)를 포함할 수 있다.
컴포넌트(20)는 빛을 이용하는 전자 요소를 포함할 수 있다. 예컨대 컴포넌트(20)는 가시광, 적외선광, 자외선광 등의 다양한 파장대역의 빛을 이용하는 소자를 포함할 수 있다. 예를 들어 컴포넌트(20)는 외부로부터의 빛을 이용하여 이미지 정보를 획득하는 카메라 모듈을 포함할 수 있다.
표시 패널(10)은, 화소들로부터 출력되는 빛을 통해 외부에 이미지를 제공할 수 있다. 복수의 화소들은 제2 영역(A2)에 배치될 수 있으며, 각 화소들은 표시요소 및 이와 연결된 화소회로를 포함할 수 있다. 표시요소는, 예컨대 유기발광다이오드 또는 퀀텀닷 유기발광다이오드를 포함할 수 있다.
입력감지층(40)은 표시 패널(10) 위에 배치될 수 있다. 입력감지층(40)은, 외부의 입력, 예를 들어, 터치 이벤트에 따른 좌표정보를 획득할 수 있다.
입력감지층(40)은 감지전극(sensing electrode 또는 touch electrode) 및 감지전극과 연결된 트레이스 라인(trace line)들을 포함할 수 있다. 상기 입력감지층(40)은 뮤추얼 캡 방식 또는 셀프 캡 방식으로 외부 입력을 감지할 수 있다.
일 실시예에서 입력감지층(40)은 표시 패널(10)과 별도로 형성된 후 광학 투명 접착제(optical clear adhesive)와 같은 별도의 접착층을 통해 표시 패널(10)과 접착될 수 있다. 다른 실시예에서, 입력감지층(40)은 표시 패널(10) 상에 직접 형성될 수도 있다. 예컨대 입력감지층(40)은 표시 패널(10)을 형성하는 공정 이후에 연속적으로 표시 패널(10) 상에 형성될 수 있다. 이 경우 입력감지층(40)은 표시 패널(10)의 일부로 이해될 수 있으며, 입력감지층(40)과 표시 패널(10) 사이에는 접착층이 개재되지 않을 수 있다.
입력감지층(40)은 도 2에 도시된 바와 같이 표시 패널(10)과 광학 기능층(50) 사이에 개재될 수 있으나, 또 다른 실시예로서, 입력감지층(40)은 광학 기능층(50) 위에 배치될 수도 있다.
광학 기능층(50)은 반사 방지층을 포함할 수 있다. 반사 방지층은 윈도우(60)를 통해 외부에서 표시 패널(10)을 향해 입사하는 빛의 반사율을 감소시킬 수 있다. 반사 방지층은 위상지연자(retarder) 및 편광자(polarizer)를 포함할 수 있다.
위상지연자는 필름타입 또는 액정 코팅타입일 수 있고, λ/2 위상지연자 및/또는 λ/4 위상지연자를 포함할 수 있다. 편광자는 필름타입 또는 액정 코팅타입일 수 있다. 필름타입은 연신형 합성수지 필름을 포함하고, 액정 코팅타입은 소정의 배열로 배열된 액정들을 포함할 수 있다. 위상지연자 및 편광자는 보호필름을 더 포함할 수 있다. 예컨대 위상지연자 및 편광자 자체 또는 보호필름이 반사방지 층의 베이스층으로 정의될 수 있다. 다른 실시예로, 반사 방지층은 블랙매트릭스와 컬러필터들을 포함할 수 있다. 컬러필터들은 표시 패널(10)의 화소들 각각에서 방출되는 빛의 색상을 고려하여 배열될 수 있다.
또 다른 실시예로, 반사 방지층은 상쇄간섭 구조물을 포함할 수 있다. 상쇄간섭 구조물은 서로 다른 층 상에 배치된 제1 반사층과 제2 반사층을 포함할 있다. 제1 반사층 및 제2 반사층에서 반사된 제1 반사광과 제2 반사광은 상쇄 간섭될 수 있고, 그에 따라 외부광 반사율이 감소될 수 있다.
광학 기능층(50)은 렌즈층을 포함할 수 있다. 렌즈층은 표시 패널(10)에서 방출되는 빛의 출광 효율을 향상시키거나, 색편차를 줄일 수 있다. 렌즈층은 오목하거나 볼록한 렌즈 형상을 가지는 층을 포함하거나, 또는/및 굴절률이 서로 다른 복수의 층을 포함할 수 있다. 광학 기능층(50)은 전술한 반사 방지층 및 렌즈층을 모두 포함하거나, 이들 중 어느 하나를 포함할 수 있다.
일 실시예에서, 광학 기능층(50)은 표시 패널(10) 및/또는 입력감지층(40)을 형성하는 공정 이후에 연속적으로 형성될 수 있다. 이 경우, 광학 기능층(50) 표시 패널(10) 및/또는 입력감지층(40) 사이에 별도의 접착층이 개재되지 않을 수 있다.
표시 패널(10), 입력감지층(40), 및/또는 광학 기능층(50)은 제2 영역(A2)에 대응하는 개구를 포함할 수 있다. 이와 관련하여, 도 2에는 표시 패널(10), 입력감지층(40), 및 광학 기능층(50)이 각각 제1 내지 제3 홀(10H, 40H, 50H)를 포함하며, 제1 내지 제3 홀(10H, 40H, 50H)들이 서로 중첩되는 구조를 도시한다.
다른 실시예로, 표시 패널(10), 입력감지층(40), 또는 광학 기능층(50) 중 적어도 하나는 홀을 포함하지 않을 수 있다. 예컨대, 표시 패널(10), 입력감지층(40), 및 광학 기능층(50) 중 어느 하나, 또는 두 개의 구성요소는 홀을 포함하지 않을 수 있다.
표시 장치(1)가 스마트 워치나 차량용 계기판으로 이용되는 경우, 컴포넌트(20)는 시계 바늘이나 소정의 정보(예, 차량 속도 등)를 지시하는 바늘과 같은 부재일 수 있다. 표시 장치(1)가 시계 바늘이나 차량용 계기판을 포함하는 경우, 컴포넌트(20)는 윈도우(60)를 관통하여 외부로 노출될 수 있으며, 이 경우 윈도우(60)는, 도 2에 도시된 것과 달리, 제2 영역(A2)에 대응하는 개구를 포함할 수 있다.
컴포넌트(20)는 전술한 바와 같이 표시 패널(10)의 기능과 관계된 구성요소(들)를 포함하거나, 표시 패널(10)의 심미감을 증가시키는 액세서리를 포함할 수 있다.
도 3은 본 발명의 일 실시예에 따른 표시 패널을 개략적으로 나타낸 평면도이고, 도 4는 본 발명의 일 실시예에 따른 표시 패널에 구비된 어느 하나의 화소회로를 나타낸 등가 회로도이다.
도 3 및 도 4를 참조하면, 표시 패널(10)은, 제2 영역(A2)에 배치된 복수의 화소(P)들을 포함할 수 있다. 화소(P)들은 유기발광다이오드와 같은 표시요소를 포함할 수 있다. 각 화소(P)는 유기발광다이오드를 통해 예컨대, 적색, 녹색, 청색 또는 백색의 빛을 방출할 수 있다. 본 명세서에서의 화소(P)라 함은 전술한 바와 같이 적색, 녹색, 청색, 백색 중 어느 하나의 색상의 빛을 방출하는 화소로 이해될 수 있다.
화소(P)는 도 4에 도시된 바와 같이 화소회로(PC) 및 화소회로(PC)에 전기적으로 연결된 유기발광다이오드(OLED)를 포함할 수 있다. 화소회로(PC)는 복수의 박막트랜지스터들 및 스토리지 커패시터(storage capacitor)를 포함할 수 있다. 박막트랜지스터들 및 스토리지 커패시터는 신호라인(SL, SL-1, EL, DL), 초기화전압라인(VL), 및 구동전압라인(PL)에 연결될 수 있다.
복수의 박막트랜지스터는, 구동 박막트랜지스터(driving TFT, T1), 스위칭 박막트랜지스터(switching TFT, T2), 보상 박막트랜지스터(T3), 제1 초기화 박막트랜지스터(T4), 동작제어 박막트랜지스터(T5), 발광제어 박막트랜지스터(T6) 및 제2 초기화 박막트랜지스터(T7)를 포함할 수 있다.
신호라인은 스캔신호(Sn)를 전달하는 스캔라인(SL), 제1 초기화 박막트랜지스터(T4)와 제2 초기화 박막트랜지스터(T7)에 이전 스캔신호(Sn-1)를 전달하는 이전 스캔라인(SL-1), 동작제어 박막트랜지스터(T5) 및 발광제어 박막트랜지스터(T6)에 발광제어신호(En)를 전달하는 발광제어라인(EL), 스캔라인(SL)과 교차하며 데이터신호(Dm)를 전달하는 데이터라인(DL)을 포함할 수 있다.
구동전압라인(PL)은 구동 박막트랜지스터(T1)에 구동전압(ELVDD)을 전달할 수 있다. 초기화전압라인(VL)은 구동 박막트랜지스터(T1) 및 화소전극을 초기화하는 초기화전압(Vint)을 전달할 수 있다.
구동 박막트랜지스터(T1)의 구동 게이트전극(G1)은 스토리지 커패시터(Cst)의 제1 스토리지 축전판(Cst1)에 연결되고, 구동 박막트랜지스터(T1)의 구동 소스전극(S1)은 동작제어 박막트랜지스터(T5)를 경유하여 하부 구동전압라인(PL)에 연결되며, 구동 박막트랜지스터(T1)의 구동 드레인전극(D1)은 발광제어 박막트랜지스터(T6)를 경유하여 표시요소(OLED)의 화소전극과 전기적으로 연결될 수 있다. 구동 박막트랜지스터(T1)는 스위칭 박막트랜지스터(T2)의 스위칭 동작에 따라 데이터신호(Dm)를 전달받아 표시요소(OLED)에 구동전류(IOLED)를 공급할 수 있다.
스위칭 박막트랜지스터(T2)의 스위칭 게이트전극(G2)은 스캔라인(SL)에 연결되고, 스위칭 박막트랜지스터(T2)의 스위칭 소스전극(S2)은 데이터라인(DL)에 연결되며, 스위칭 박막트랜지스터(T2)의 스위칭 드레인전극(D2)은 구동 박막트랜지스터(T1)의 구동 소스전극(S1)에 연결되어 동작제어 박막트랜지스터(T5)를 경유하여 하부 구동전압라인(PL)과 연결될 수 있다. 스위칭 박막트랜지스터(T2)는 스캔라인(SL)을 통해 전달받은 스캔신호(Sn)에 따라 턴-온되어 데이터라인(DL)으로 전달된 데이터신호(Dm)를 구동 박막트랜지스터(T1)의 구동 소스전극(S1)으로 전달하는 스위칭 동작을 수행할 수 있다.
보상 박막트랜지스터(T3)의 보상 게이트전극(G3)은 스캔라인(SL)에 연결되고, 보상 박막트랜지스터(T3)의 보상 소스전극(S3)은 구동 박막트랜지스터(T1)의 구동 드레인전극(D1)에 연결되며 발광제어 박막트랜지스터(T6)를 경유하여 표시요소 (OLED)의 화소전극과 연결될 수 있다. 보상 박막트랜지스터(T3)의 보상 드레인전극(D3)은 스토리지 커패시터(Cst)의 제1 스토리지 축전판(Cst1), 제1 초기화 박막트랜지스터(T4)의 제1 초기화 드레인전극(D4) 및 구동 박막트랜지스터(T1)의 구동 게이트전극(G1)에 연결될 수 있다. 보상 박막트랜지스터(T3)는 스캔라인(SL)을 통해 전달받은 스캔신호(Sn)에 따라 턴-온되고 구동 박막트랜지스터(T1)의 구동 게이트전극(G1)과 구동 드레인전극(D1)을 전기적으로 연결하여 구동 박막트랜지스터(T1)를 보상할 수 있다.
제1초기화 박막트랜지스터(T4)의 제1초기화 게이트전극(G4)은 이전 스캔라인(SL-1)에 연결되고, 제1초기화 박막트랜지스터(T4)의 제1초기화 소스전극(S4)은 제2초기화 박막트랜지스터(T7)의 제2초기화 드레인전극(D7)과 초기화전압라인(VL)에 연결될 수 있다. 제1초기화 박막트랜지스터(T4)의 제1초기화 드레인전극(D4)은 스토리지 커패시터(Cst)의 제1 스토리지 축전판(Cst1), 보상 박막트랜지스터(T3)의 보상 드레인전극(D3) 및 구동 박막트랜지스터(T1)의 구동 게이트전극(G1)에 연결될 수 있다. 제1초기화 박막트랜지스터(T4)는 이전 스캔라인(SL-1)을 통해 전달받은 이전 스캔신호(Sn-1)에 따라 턴-온되어 초기화전압(Vint)을 구동 박막트랜지스터(T1)의 구동 게이트전극(G1)에 전달하여 구동 박막트랜지스터(T1)의 구동 게이트전극(G1)의 전압을 초기화시킬 수 있다.
동작제어 박막트랜지스터(T5)의 동작제어 게이트전극(G5)은 발광제어라인(EL)에 연결되며, 동작제어 박막트랜지스터(T5)의 동작제어 소스전극(S5)은 하부 구동전압라인(PL)과 연결될 수 있다. 동작제어 박막트랜지스터(T5)의 동작제어 드레인전극(D5)은 구동 박막트랜지스터(T1)의 구동 소스전극(S1) 및 스위칭 박막트랜지스터(T2)의 스위칭 드레인전극(D2)과 연결될 수 있다.
발광제어 박막트랜지스터(T6)의 발광제어 게이트전극(G6)은 발광제어라인(EL)에 연결되고, 발광제어 박막트랜지스터(T6)의 발광제어 소스전극(S6)은 구동 박막트랜지스터(T1)의 구동 드레인전극(D1) 및 보상 박막트랜지스터(T3)의 보상 소스전극(S3)에 연결될 수 있다. 발광제어 박막트랜지스터(T6)의 발광제어 드레인전극(D6)은 제2초기화 박막트랜지스터(T7)의 제2초기화 소스전극(S7) 및 표시요소(OLED)의 화소전극에 전기적으로 연결될 수 있다.
동작제어 박막트랜지스터(T5) 및 발광제어 박막트랜지스터(T6)는 발광제어라인(EL)을 통해 전달받은 발광제어신호(En)에 따라 동시에 턴-온되어, 구동전압(ELVDD)이 표시요소(OLED)에 전달되어 표시요소(OLED)에 구동전류(IOLED)가 흐르도록 할 수 있다.
제2초기화 박막트랜지스터(T7)의 제2초기화 게이트전극(G7)은 이전 스캔라인(SL-1)에 연결되고, 제2초기화 박막트랜지스터(T7)의 제2초기화 소스전극(S7)은 발광제어 박막트랜지스터(T6)의 발광제어 드레인전극(D6) 및 표시요소(OLED)의 화소전극에 연결될 수 있다. 제2초기화 박막트랜지스터(T7)의 제2초기화 드레인전극(D7)은 제1초기화 박막트랜지스터(T4)의 제1초기화 소스전극(S4) 및 초기화전압라인(VL)에 연결될 수 있다. 제2초기화 박막트랜지스터(T7)는 이전 스캔라인(SL-1)을 통해 전달받은 이전 스캔신호(Sn-1)에 따라 턴-온되어 표시요소(OLED)의 화소전극을 초기화할 수 있다.
도 4에서는 초기화 박막트랜지스터(T4)와 제2 초기화 박막트랜지스터(T7)가 이전 스캔라인(SL-1)에 연결된 경우를 도시하였으나, 본 발명은 이에 한정되지 않는다. 예컨대 다른 실시예로서, 제1초기화 박막트랜지스터(T4)는 이전 스캔라인(SL-1)에 연결되어 이전 스캔신호(Sn-1)에 따라 구동되고, 제2초기화 박막트랜지스터(T7)는 별도의 신호라인(예컨대, 이후 스캔라인)에 연결되어 상기 신호라인에 전달되는 신호에 따라 구동될 수 있다.
스토리지 커패시터(Cst)의 제2 스토리지 축전판(Cst2)은 구동전압라인(PL)에 연결되며, 표시요소(OLED)의 대향전극은 공통전압(ELVSS)에 연결될 수 있다. 이에 따라, 표시요소(OLED)는 구동 박막트랜지스터(T1)로부터 구동전류(IOLED)를 전달받아 발광함으로써 이미지를 출력할 수 있다.
도 4에서는 보상 박막트랜지스터(T3)와 초기화 박막트랜지스터(T4)가 듀얼 게이트전극을 갖는 것으로 도시하고 있으나, 보상 박막트랜지스터(T3)와 초기화 박막트랜지스터(T4)는 한 개의 게이트전극을 가질 수 있다.
다시 도 3을 참조하면, 각 화소(P)는 비표시 영역(NDA), 예컨대 제2 영역(A2)을 둘러싸는 제3 영역(A3)에 배치된 구동회로들과 전기적으로 연결될 수 있다. 제3 영역(A3)에는 제1 스캔 구동회로(110), 제2 스캔 구동회로(120), 단자(140), 데이터 구동회로(150), 제1 전원공급배선(160), 및 제2 전원공급배선(170) 중 적어도 하나가 배치될 수 있다.
제1 스캔 구동회로(110)는 스캔라인(SL)을 통해 각 화소(P)에 스캔 신호를 제공할 수 있다. 제1 스캔 구동회로(110)는 발광제어라인(EL)을 통해 각 화소에 발광 제어 신호를 제공할 수 있다.
제2 스캔 구동회로(120)는 제2 영역(A2)을 사이에 두고 제1 스캔 구동회로(110)와 나란하게 배치될 수 있다.
제2 영역(A2)에 배치된 화소(P)들 중 일부는 제1 스캔 구동회로(110)와 전기적으로 연결될 수 있다. 제1 스캔 구동회로(110)와 연결되지 않은 다른 화소(P)들은 제2 스캔 구동회로(120)와 전기적으로 연결될 수 있다.
다른 실시예로서, 제1 스캔 구동회로(110) 또는 제2 스캔 구동회로(120) 중 어느 하나는 생략될 수 있다.
단자(140)는 기판(100)의 일 측에 배치될 수 있다. 단자(140)는 절연층에 의해 덮이지 않고 노출되어 인쇄회로기판(PCB)과 전기적으로 연결될 수 있다. 인쇄회로기판(PCB)의 단자(PCB-P)는 표시 패널(10)의 단자(140)와 전기적으로 연결될 수 있다.
인쇄회로기판(PCB)은, 제어부(미도시)의 신호 또는 전원을 표시 패널(10)로 전달할 수 있다. 인쇄회로기판(PCB)은 제어부에서 생성된 제어 신호를 제1 스캔 구동회로(110) 및 제2 스캔 구동회로(120)에 전달할 수 있다.
제어부는 제1 연결배선(161) 및 제2 연결배선(171)을 통해 제1 전원공급배선(160) 및 제2 전원공급배선(170)에 각각 제1 전원전압(ELVDD)과 제2 전원전압(ELVSS)을 제공할 수 있다.
제1 전원전압(ELVDD)은 제1 전원공급배선(160)과 연결된 구동전압라인(PL)을 통해 각 화소(P)에 제공되고, 제2 전원전압(ELVSS)은 제2 전원공급배선(170)과 연결된 화소(P)의 대향전극에 제공될 수 있다.
데이터 구동회로(150)는 데이터라인(DL)에 전기적으로 연결될 수 있다. 데이터 구동회로(150)의 데이터 신호는 단자(140)에 연결된 연결배선(151) 및 연결배선(151)과 연결된 데이터라인(DL)을 통해 각 화소(P)에 제공될 수 있다.
도 3은 데이터 구동회로(150)가 인쇄회로기판(PCB)에 배치된 것을 도시하지만, 다른 실시예로, 데이터 구동회로(150)는 기판(100) 상에 배치될 수 있다. 예컨대, 데이터 구동회로(150)는 단자(140)와 제1 전원공급배선(160) 사이에 배치될 수 있다.
제1 전원공급배선(160)은 제2 영역(A2)을 사이에 두고 x 방향을 따라 나란하게 연장된 제1 서브배선(162) 및 제2 서브배선(163)을 포함할 수 있으며, 제2 영역(A2)을 가로지르도록 연장된 구동전압라인(PL)은 제1 서브배선(162) 및 제2 서브배선(163)에 연결될 수 있다. 제2 전원공급배선(170)은 일 측이 개방된 루프 형상으로 제2 영역(A2)을 부분적으로 둘러쌀 수 있다. 제1 전원공급배선(160)이 각 화소(P)에 제1전원(ELVDD)을 제공하고, 제2 전원공급배선(170)이 각 화소(P)에 제2전원(ELVSS)을 제공할 수 있음은 전술한 바와 같다.
도 5는 본 발명의 일 실시예에 따른 표시 패널의 평면도로서, 도 3의 표시 패널(10)에서 복수의 라인들의 배치 구조를 구체적으로 도시한 도면이다. 도 6은 도 5의 VI를 확대한 평면도이다.
도 5 및 도 6을 참조하면, 표시 패널(10)은 기판(100)의 제3 영역(A3)에 배치되는 구동회로들과, 상기 구동회로들로부터 연장되어, 제2 영역(A2)에 배치된 화소들과 전기적으로 연결된 복수의 라인(L)들을 포함할 수 있다.
예컨대, 복수의 라인(L)들은 도 3 및 도 4를 참조하여 설명한 스캔라인(SL), 발광제어라인(EL), 데이터라인(DL), 구동전압라인(PL), 또는 초기화전압라인(VL)) 중 적어도 하나를 포함할 수 있다.
도 5에서는, 제3 영역(A3)에 제1 스캔 구동회로(110) 및 제2 스캔 구동회로(120)가 배치되고, 제1 스캔 구동회로(110) 또는 제2 스캔 구동회로(120)로부터 연장된 다수의 라인(L)들을 도시한다. 이 경우 상기 다수의 라인(L)들은, 스캔라인(SL) 또는 발광제어라인(EL) 중 적어도 하나에 해당할 수 있다.
기판(100)의 제2 영역(A2)의 내측에는 제1 영역(A1)이 위치할 수 있다. 제1 영역(A1)은 표시 패널(10)의 아래에 구비된 컴포넌트(20, 도 2 참조)에 대응하여 투과율이 상대적으로 높게 형성된 영역으로, 제1 영역(A1)에는 화소(P) 또는 화소(P)와 연결된 라인들이 배치되지 않을 수 있다. 예를 들어 제2 영역(A2)에 배치된 화소(P)들과 연결된 라인들은 제1 영역(A1) 주변에서, 제1 영역(A1)의 외곽을 따라 우회하거나, 또는 제1 영역(A1)을 중심으로 단선(disconnected)될 수 있다.
복수의 라인들이 제1 영역(A1)의 주변에서 우회할 경우, 다수의 라인들이 제1 영역(A1)의 외곽을 따라 제1 영역(A1)의 주변부에 배치되어야 하므로, 제1 영역(A1)의 주변부에는 상기 우회 라인들에 기인한 비표시 영역이 형성될 수 있다. 따라서 복수의 라인들 중 일부는, 상기 비표시 영역을 행소하고, 화소(P)가 배치되는 제2 영역(A2)의 면적을 극대화하기 위하여, 제1 영역(A1) 주변에서 단선될 수 있다.
한편, 제1 영역(A1)은 제2 영역(A2) 내에서 편측에 배치될 수 있다. 예를 들어 제1 영역(A1)은 표시 패널(10)의 기판(100)에서 평면의 중심을 기준으로 좌측 또는 우측에 편향되어 배치될 수 있다.
제1 영역(A1)이 제2 영역(A2)의 편측에 배치되고, 제1 영역(A1)의 주변에서 스캔라인(SL) 또는 발광제어라인(EL) 중 적어도 하나의 라인들이 단선되는 경우, 단선된 지점을 기준으로 좌우의 두 라인들 간의 길이 차이에 따라 RC delay가 발생하게 되며, 상기 단선된 라인들과 연결된 각 화소(P)들은 서로 다른 휘도 특성을 가질 수 있다.
예를 들어, 제1 영역(A1)이 도 5에 도시된 바와 같이 제2 영역(A2) 내측의 우측부에 배치될 경우, 제1 영역(A1)을 기준으로 좌측의 단선 라인 부분과 연결된 화소는 제1 영역(A1)을 기준으로 우측의 단선 라인 부분과 연결된 화소보다, 동일한 광 출력 조건에서, 상대적으로 더 큰 휘도 값을 갖는 광을 출력할 수 있다.
따라서, 상기 단선된 라인들에 기인한 단선 지점 양측의 화소 간 휘도 차이를 최소화하기 위하여 소정의 보상 설계, 예컨대 감마(gamma) 보정이 표시 패널(10)에 적용될 수 있다.
본 발명의 다양한 실시예에 따르면, 표시 패널(10)은 상기 보상 설계를 보다 용이하게 적용하기 위하여, 제2 영역(A2)에 배치된 전체 라인(L)들이 모두 단선된 구조를 가질 수 있다.
도 5 및 도 6에 도시된 바와 같이, 복수의 라인(L)들은, 제1 방향(예: x 방향)으로 상호 평행하게 연장되어, 각 라인(L)에 해당하는 열에 배치된 화소(P)들과 전기적으로 연결될 수 있다.
라인(L)들은, 상기 제1 방향과 직교하는 제2 방향(예: y 방향)으로 제1 영역(A1)의 외곽부에 대응하는 제2 영역(A2)의 일부 영역, 즉 도 5에 도시된 WA1 범위에 대응하는 제2 영역(A2)의 일부 영역 내에서, 각각 단선될 수 있다.
각각의 라인(L)이 단선되는 지점은, WA1 범위에 대응하는 제2 영역(A2)의 일부 영역 내에서, 라인 별로 불규칙적으로 형성될 수 있다. 즉 각 라인들은 지그재그 형태로 단선될 수 있으며, 그에 따라 인접하는 라인(L)들은 단선된 지점이 제2 방향을 기준으로 서로 대응하지 않을 수 있다.
단선된 라인(L)의 각 부분들은, 제1 스캔 구동회로(110) 또는 제2 스캔 구동회로(120)와 전기적으로 연결될 수 있다.
예를 들어, 단선된 라인(L)의 일 부분, 예컨대 단선된 지점을 기준으로 좌측 부분은 제1 스캔 구동회로(110)와 연결될 수 있다. 또한, 상기 단선된 라인(L)의 나머지 부분, 예컨대 단선된 지점을 기준으로 우측 부분은, 제2 스캔 구동회로(120)와 연결될 수 있다.
제2 방향을 따라 나란히 배치된 인접하는 두 라인(L)들은, 제1 스캔 구동회로(110)로부터 각 라인(L)의 단선된 부분까지의 거리가 서로 다를 수 있다.
본 발명의 실시예에 따르면, 각 라인(L)들은, 일부 범위 내에서 불규칙적으로 단선됨으로써, 단선된 지점을 기준으로 양측 화소들 간의 휘도 차이가 시인되는 것을 최소화할 수 있다.
이하 도 6을 참조하여 보다 구체적으로 설명하도록 한다.
제1 라인(L1)은 제1 화소(P1)를 포함하는 복수의 화소들과 전기적으로 연결될 수 있다. 제2 라인(L2)은 제2 화소(P2)를 포함하는 복수의 화소들과 전기적으로 연결될 수 있다.
제1 라인(L1)과 연결된 화소들 및 제2 라인(L2)과 연결된 화소들은, 제1 열(R1)을 따라 나란하게 배열될 수 있으며, 제1 라인(L1)과 제2 라인(L2)은 제1 지점(SP1)을 중심으로 상호 이격될 수 있다. 제1 영역(A1)이 표시 패널(10)에서 편측에 배치되므로, 하나의 열에 배치된 두 라인, 예컨대 제1 라인(L1)과 제2 라인(L2)은 서로 다른 길이를 가질 수 있다.
한편, 제3 라인(L3)은 제3 화소(P3)를 포함하는 복수의 화소들과 전기적으로 연결될 수 있다. 제4 라인(L4)은 제4 화소(P4)를 포함하는 복수의 화소들과 전기적으로 연결될 수 있다.
상기 제3 라인(L3)과 연결된 화소들 및 상기 제4 라인(L4)과 연결된 화소들은, 제1 열(R1)과 평행한 제2 열(R2)을 따라 나란하게 배열될 수 있다. 제3 라인(L3)과 제4 라인(L4)은 제2 지점(SP2)을 중심으로 상호 이격될 수 있다.
또한, 제5 라인(L5)은 제5 화소(P5)를 포함하는 복수의 화소들과 전기적으로 연결될 수 있으며, 제6 라인(L6)은 제6 화소(P6)를 포함하는 복수의 화소들과 전기적으로 연결될 수 있다.
상기 제5 라인(L5)과 연결된 화소들 및 상기 제6 라인(L6)과 연결된 화소들은, 상기 제1 열(R1)과 평행한 제3 열(R3)을 따라 나란하게 배열될 수 있다. 제5 라인(L5)과 제6 라인(L6)은 제3 지점(SP3)을 중심으로 상호 이격될 수 있다.
제1 지점(SP1)은 제1 열(R1)과 직교하는 제1 행(C1) 상에 위치할 수 있다. 제2 지점(SP2)은 제2 열(R2)과 직교하는 제2 행(C2) 상에 위치할 수 있다. 상기 제1 행(C1)과 제2 행(C2)은 평행할 수 있으며, 서로 교차하지 않을 수 있다. 제3 지점(SP3)은 제3 열(R3)과 직교하는 제3 행(C3) 상에 위치하며, 제3 행(C3)은 제1 행(C1)과 및 제2 행(C2) 평행할 수 있다.
제1 행(C1), 제2 행(C2), 및 제3 행(C3)은 각각 제1 영역(A1)을 지날 수 있다. 즉, 제1 라인(L1)과 제2 라인(L2)이 이격된 제1 지점(SP1)과 제3 라인(L3)과 제4 라인(L4)이 이격된 제2 지점(SP2), 그리고 제5 라인(L5)과 제6 라인(L6)이 이격된 제3 지점(SP3)은 각각 다른 행 상에 위치하며, 제1 지점(SP1), 제2 지점(SP2), 및 제3 지점(SP3)은 각각 제1 영역(A1)의 폭(WA1)에 대응하는 제2 영역(A2)의 일부 영역 내에 위치할 수 있다.
제7 라인(L7)은 제7 화소(P7)를 포함하는 복수의 화소들과 전기적으로 연결될 수 있다. 제8 라인(L8)은 제8 화소(P8)를 포함하는 복수의 화소들과 전기적으로 연결될 수 있다. 제7 라인(L7)과 연결된 화소들 및 제8 라인(L8)과 연결된 화소들은, 제1 열(R1)과 평행하며 제1 영역(A1)을 지나는 제4 열(R4)을 따라 나란하게 배열되되, 제1 영역(A1)을 중심으로 이격될 수 있다. 상기 제7 라인(L7)과 제8 라인(L8) 역시 제1 영역(A1)을 중심으로 상호 이격될 수 있다.
제1 영역(A1)을 기준으로 좌측 편에 배치된 화소들과 연결된 라인들, 예컨대 도 6에서 제1 라인(L1), 제3 라인(L3), 제5 라인(L5), 및 제7 라인(L7)은, 제3 영역(A3)의 좌측에 배치된 제1 스캔 구동회로(110)로부터 연장될 수 있다. 또한, 제1 영역(A1)을 기준으로 우측 편에 배치된 화소들과 연결된 라인들, 예컨대 도 6에서 제2 라인(L2), 제4 라인(L4), 제6 라인(L6), 및 제8 라인(L8)은, 제3 영역(A3)의 우측에 배치된 제2 스캔 구동회로(120)로부터 연장될 수 있다.
제1 스캔 구동회로(110)로부터 연장된 라인들 중 인접하는 두 라인, 예컨대 제1 라인(L1)과 제3 라인(L3)은, 서로 다른 길이를 가질 수 있다. 또한, 제1 라인(L1)과 연결된 화소들의 수와 제3 라인(L3)과 연결된 화소들의 수는 상이할 수 있다. 제2 스캔 구동회로(120)로부터 연장된 라인들 중 인접하는 두 라인, 예컨대 제2 라인(L2)과 제4 라인(L4) 역시 서로 다른 길이를 가질 수 있으며, 다른 개수의 화소들과 각각 연결될 수 있다.
일 실시예에 따르면, 인접하는 두 라인 간의 라인의 폭은 서로 다를 수 있다. 예를 들어, 제1 라인(L1)은 제1 폭(HL1)을 가지며, 제3 라인(L3)은 제3 폭(HL3)을 가고, 제5 라인(L5)은 제5 폭(HL5)을 가질 수 있다.
라인들의 각각의 폭은, 각 라인의 길이에 대응할 수 있다. 예를 들어, 제1 스캔 구동회로(110)로부터 제1 지점(SP1)까지의 제1 라인(L1)의 길이가 제1 스캔 구동회로(110)로부터 제2 지점(SP2)까지의 제3 라인(L3)의 길이보다 짧을 경우, 상기 제1 라인(L1)의 폭(HL1)은 제3 라인(L3)의 폭(HL3)보다 클 수 있다. 또한, 제1 스캔 구동회로(110)로부터 제1 지점(SP1)까지의 제1 라인(L1)의 길이가 제1 스캔 구동회로(110)로부터 제3 지점(SP3)까지의 제5 라인(L5)의 길이보다 긴 경우, 상기 제1 라인(L1)의 폭(HL1)은 제5 라인(L5)의 폭(HL5)보다 작을 수 있다. 예를 들어, 복수의 라인(L)들 각각은 실질적으로 동일한 면적을 가질 수 있다.
도 7은 본 발명의 일 실시예에 따른 표시 패널을 구체적으로 도시한 단면도이다. 예를 들어 도 7은 도 6의 제7 화소(P7)와 제8 화소(P8)에 따른 단면도에 대응할 수 있다.
도 7을 참조하면, 표시 패널(10)은, 하부 기판(100), 상부 기판(200), 및 상기 하부 기판(100)과 상부 기판(200) 사이에 개재되는 표시층(300)을 포함할 수 있다.
표시층(300)은 제7 화소(P7) 및 제8 화소(P8)를 포함하는 복수의 화소들을 포함할 수 있다. 각각의 화소들은, 박막트랜지스터(TFT)를 포함하는 화소회로(PC), 및 각 화소회로(PC)와 전기적으로 연결되는 표시요소(예: OLED)을 포함할 수 있다. 화소들은 제2 영역(A2)에 배치될 수 있으며, 제1 영역(A1) 주변에서 이웃하는 두 화소, 예컨대 제7 화소(P7) 및 제8 화소(P8)는 제1 영역(A1)을 중심으로 상호 이격되어 제2 영역(A2)에 배치될 수 있다.
박막트랜지스터(TFT)는 비정질실리콘, 다결정실리콘 또는 유기반도체물질을 포함하는 반도체층(A), 게이트전극(G), 소스전극(S) 및 드레인전극(D)을 포함할 수 있다.
반도체층(A)은 비정질 실리콘(amorphous silicon)을 포함할 수 있다. 다른 실시예로, 반도체층(A)은 인듐(In), 갈륨(Ga) 스태늄(Sn), 지르코늄(Zr), 바나듐(V), 하프늄(Hf) 카드뮴(Cd), 게르마늄(Ge) 크롬(Cr), 티타늄(Ti), 및/또는 아연(Zn)을 포함하는 산화물 반도체를 포함할 수 있다. 예를 들어, 반도체층(A)은 IGZO(Indium Gallium Zinc Oxide), ZTO(Zinc Tin Oxide), ZIO(Zinc Indium Oxide)와 같은 산화물 반도체를 포함할 수 있다.
게이트전극(G)은 게이트절연층(310)을 사이에 두고 반도체층(A) 상에 배치될 수 있다. 게이트전극(G)은 몰리브덴(Mo), 알루미늄(Al), 구리(Cu), 티타늄(Ti) 등을 포함하며 단층 또는 다층으로 이루어질 수 있다. 일 예로, 게이트전극(G)은 Mo의 단층일 수 있다.
게이트절연층(310)은 실리콘산화물(SiO2), 실리콘질화물(SiNx), 실리콘산질화물(SiON), 알루미늄산화물(Al2O3), 티타늄산화물(TiO2), 탄탈산화물(Ta2O5), 하프늄산화물(HfO2), 또는 아연산화물(ZnO2) 등을 포함할 수 있다.
소스전극(S) 및/또는 드레인전극(D)은 층간절연층(320)을 사이에 두고 게이트전극(G) 상에 배치될 수 있다. 소스전극(S) 및/또는 드레인전극(D)은 몰리브덴(Mo), 알루미늄(Al), 구리(Cu), 티타늄(Ti) 등을 포함하며 단층 또는 다층으로 이루어질 수 있다. 일 예로, 소스전극(S) 및/또는 드레인전극(D)은 Ti/Al/Ti의 다층 구조로 이루어질 수 있다.
평탄화층(330)은 소스전극(S) 및/또는 드레인전극(D) 상면을 덮으며, 화소전극(350)이 평탄하게 형성될 수 있도록 평탄한 상면을 가질 수 있다. 평탄화층(330)은 유기 물질로 이루어진 막이 단층 또는 다층으로 형성될 수 있다. 평탄화층(330)은 BCB(Benzocyclobutene), 폴리이미드(polyimide), HMDSO(Hexamethyldisiloxane), Polymethylmethacrylate(PMMA)나, Polystylene(PS)과 같은 일반 범용고분자, 페놀계 그룹을 갖는 고분자 유도체, 아크릴계 고분자, 이미드계 고분자, 아릴에테르계 고분자, 아마이드계 고분자, 불소계고분자, p-자일렌계 고분자, 비닐알콜계 고분자 및 이들의 블렌드 등을 포함할 수 있다. 평탄화층(330)은 무기 물질을 포함할 수 있다. 평탄화층(330)은 실리콘산화물(SiO2), 실리콘질화물(SiNx), 실리콘산질화물(SiON), 알루미늄산화물(Al2O3), 티타늄산화물(TiO2), 탄탈산화물(Ta2O5), 하프늄산화물(HfO2), 또는 아연산화물(ZnO2)등을 포함할 수 있다. 평탄화층(330)이 무기 물질로 구비되는 경우, 경우에 따라서 화학적 평탄화 폴리싱을 진행할 수 있다. 한편, 평탄화층(330)은 유기물질 및 무기물질을 모두 포함할 수도 있다.
화소전극(350)은 (반)투광성 전극 또는 반사 전극일 수 있다. 일부 실시예에서, 화소전극(350)은 Ag, Mg, Al, Pt, Pd, Au, Ni, Nd, Ir, Cr 및 이들의 화합물 등으로 형성된 반사막과, 반사막 상에 형성된 투명 또는 반투명 전극층을 구비할 수 있다. 투명 또는 반투명 전극층은 인듐틴산화물(ITO; indium tin oxide), 인듐아연산화물(IZO; indium zinc oxide), 아연산화물(ZnO; zinc oxide), 인듐산화물(In2O3; indium oxide), 인듐갈륨산화물(IGO; indium gallium oxide) 및 알루미늄아연산화물(AZO; aluminum zinc oxide)를 포함하는 그룹에서 선택된 적어도 하나 이상을 구비할 수 있다. 일부 실시예에서, 화소전극(350)은 ITO/Ag/ITO로 적층된 구조로 구비될 수 있다.
평탄화층(330) 상에는 화소정의막(340)이 배치될 수 있다. 화소정의막(340)은 화소전극(350)의 중앙부에 대응하는 개구를 가짐으로써 각 화소의 발광영역을 정의하는 역할을 할 수 있다. 또한, 화소정의막(340)은 화소전극(350)의 가장자리와 화소전극(350) 상부의 대향전극(370)의 사이의 거리를 증가시킴으로써 화소전극(350)의 가장자리에서 아크 등이 발생하는 것을 방지하는 역할을 할 수 있다. 화소정의막(340)은 폴리이미드, 폴리아마이드(Polyamide), 아크릴 수지, 벤조사이클로부텐, HMDSO(hexamethyldisiloxane) 및 페놀 수지 등과 같은 유기 절연 물질로, 스핀 코팅 등의 방법으로 형성될 수 있다.
표시요소(OLED)의 중간층(360)은 유기발광층을 포함할 수 있다. 유기발광층은 적색, 녹색, 청색, 또는 백색의 빛을 방출하는 형광 또는 인광 물질을 포함하는 유기물을 포함할 수 있다. 유기발광층은 저분자 유기물 또는 고분자 유기물일 수 있으며, 유기발광층의 아래 및 위에는, 홀 수송층(HTL; hole transport layer), 홀 주입층(HIL; hole injection layer), 전자 수송층(ETL; electron transport layer) 및 전자 주입층(EIL; electron injection layer) 등과 같은 기능층이 선택적으로 더 배치될 수 있다. 중간층(360)은 복수의 화소전극(350)들 각각에 대응하여 배치될 수 있다. 그러나, 이에 한정되지 않는다. 중간층(360)은 복수의 화소전극(350)들에 걸쳐서 일체인 층을 포함할 수 있는 등 다양한 변형이 가능하다.
대향전극(370)은 투광성 전극 또는 반사 전극일 수 있다. 일부 실시예에서, 대향전극(370)은 투명 또는 반투명 전극일 수 있으며, Li, Ca, LiF/Ca, LiF/Al, Al, Ag, Mg 및 이들의 화합물을 포함하는 일함수가 작은 금속 박막으로 형성될 수 있다. 또한, 금속 박막 위에 ITO, IZO, ZnO 또는 In2O3 등의 TCO(transparent conductive oxide)막이 더 배치될 수 있다. 대향전극(370)은 중간층(360)과 화소정의막(340)의 상부에 배치될 수 있다. 대향전극(370)은 복수의 표시요소(OLED)들을 커버하도록 일체(一體)로 형성되되 제1 영역(A1)에 대응하는 홀(370H)을 포함할 수 있다.
도 7을 참조하면, 제1 영역(A1)에는 화소회로(PC) 및/또는 표시요소(OLED)가 배치되지 않을 수 있다. 제1 영역(A1) 주변의 이웃하는 제7 화소(P7)와 제8 화소(P8)의 화소회로(PC)들은 제1 영역(A1)에 대응하는 제1 홀(300H)을 중심으로 상호 이격될 수 있다. 또한, 상기 제7 화소(P7)와 제8 화소(P8)의 표시요소(OLED)들은, 제1 영역(A1)에 대응하는 제1 홀(300H)을 중심으로 상호 이격될 수 있다.
제1 홀(300H)은, 표시층(300)에 구비된 복수의 층들을 관통하여 형성될 수 있다. 일 실시예로서, 제1 홀(300H)은, 게이트절연층(310), 층간절연층(320), 평탄화층(330), 화소정의막(340), 및 대향전극(370)의 적층체를 관통할 수 있다. 예컨대 제1 홀(300H)은 서로 중첩하는 게이트절연층(310), 층간절연층(320), 평탄화층(330), 화소정의막(340), 및 대향전극(370)의 각각의 홀들로 형성될 수 있다.
제1 홀(300H)의 폭(W300)은, 게이트절연층(310), 층간절연층(320), 평탄화층(330), 화소정의막(340), 및 대향전극(370)에 구비된 각각의 홀들 중 작은 크기를 갖는 홀의 폭에 의해 정의될 수 있다. 이와 관련하여 도 7은 게이트절연층(310)의 폭이 제1 홀(300H)을 정의하는 것으로 도시되어 있으나, 다른 실시예로서 평탄화층(330)이 그 아래의 층들(310, 320)의 측면을 커버하고, 제1 홀(300H)은 상기 평탄화층(330)에 구비된 홀의 폭에 의해 정의될 수도 있다.
제1 홀(300H)의 폭(W300)은 제1 영역(A1)에 대응하여 하부 기판(100) 아래에 구비된 컴포넌트(20)의 폭(W0)보다 클 수 있다. 제1 홀(300H)은 컴포넌트(20)로부터 방출된 빛이나 컴포넌트(20)를 향해 입사되는 빛을 흡수하거나 반사하지 않도록 형성된 것일 수 있다.
본 발명의 실시예들에 따른 화소들은 도 7에서 설명한 제7 화소(P7) 또는 제8 화소(P8)와 동일한 구성을 가질 수 있다.
이와 같이 본 발명은 도면에 도시된 일 실시예를 참고로 하여 설명하였으나 이는 예시적인 것에 불과하며 당해 분야에서 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 실시예의 변형이 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.
1: 표시 장치
10: 표시 패널
20: 컴포넌트
A1: 제1 영역
A2: 제2 영역
A3: 제3 영역
110: 제1 스캔 구동회로
120: 제2 스캔 구동회로

Claims (20)

  1. 제1 영역 및 상기 제1 영역을 둘러싸는 제2 영역을 포함하는, 기판;
    상기 기판 상의 상기 제2 영역에 배치되며, 제1 열을 따라 나란하게 배열된 제1 화소와 제2 화소, 및 상기 제1 열과 평행한 제2 열을 따라 나란하게 배열된 제3 화소와 제4 화소를 포함하는, 복수의 화소들; 및
    복수의 라인들을 포함하고, 상기 복수의 라인들은,
    상기 제1 열을 따라 연장되어 상기 제1 화소와 전기적으로 연결된 제1 라인, 상기 제1 열을 따라 연장되어 상기 제2 화소와 전기적으로 연결된 제2 라인, 상기 제2 열을 따라 연장되어 상기 제3 화소와 전기적으로 연결된 제3 라인, 및 상기 제2 열을 따라 연장되어 상기 제4 화소와 전기적으로 연결된 제4 라인을 포함하고,
    상기 제1 라인 및 상기 제2 라인은, 상기 제1 열과 직교하는 제1 행 상에 위치하는 제1 지점을 중심으로 상호 이격되고, 상기 제3 라인 및 상기 제4 라인은, 상기 제1 행과 평행하고 상기 제1 행과 이격된 제2 행 상에 위치하는 제2 지점을 중심으로 상호 이격되며,
    상기 제1 행과 상기 제2 행은 상기 제1 영역을 지나는, 표시 장치.
  2. 제 1 항에 있어서,
    상기 제1 라인 및 상기 제3 라인은, 상기 기판의 일측에 배치된 제1 스캔 구동회로로부터 연장되고,
    상기 제2 라인 및 상기 제4 라인은 상기 기판의 타측에 배치된 제2 스캔 구동회로로부터 연장된, 표시 장치.
  3. 제 2 항에 있어서,
    상기 기판은, 상기 제2 영역을 둘러싸는 제3 영역을 더 포함하고,
    상기 제1 스캔 구동회로 및 상기 제2 스캔 구동회로는 상기 제3 영역에 배치되는, 표시 장치.
  4. 제 1 항에 있어서,
    상기 복수의 라인들은, 스캔 라인 또는 발광 제어 라인 중 적어도 하나를 포함하는, 표시 장치.
  5. 제 1 항에 있어서,
    상기 복수의 화소들은, 상기 제1 열과 평행한 제3 열을 따라 나란하게 배열된 제5 화소 및 제6 화소를 더 포함하고,
    상기 복수의 라인들은, 상기 제3 열을 따라 연장되어 상기 제5 화소와 연결된 제5 라인 및 상기 제3 열을 따라 연장되어 상기 제6 화소와 연결된 제6 라인을 더 포함하며,
    상기 제5 라인 및 상기 제6 라인은, 상기 제1 행과 나란하게 이격되고 상기 제1 영역을 지나는 제3 행 상에 위치하는 제3 지점을 중심으로 상호 이격된, 표시 장치.
  6. 제 1 항에 있어서,
    상기 복수의 화소들은, 상기 제1 열과 평행한 제4 열을 따라 배열되되 상기 제1 영역을 중심으로 상호 이격된 제7 화소 및 제8 화소를 더 포함하는, 표시 장치.
  7. 제 6 항에 있어서,
    상기 제4 열은 상기 제1 영역을 지나는, 표시 장치.
  8. 제 1 항에 있어서,
    상기 제1 라인 및 상기 제3 라인은, 서로 다른 길이를 갖는, 표시 장치.
  9. 제 1 항에 있어서,
    상기 제1 라인 및 상기 제2 라인은, 서로 다른 길이를 갖는, 표시 장치.
  10. 제 1 항에 있어서,
    상기 제1 라인과 연결된 화소의 개수는 상기 제3 라인과 연결된 화소의 개수와 상이한, 표시 장치.
  11. 제 1 항에 있어서,
    상기 제1 라인 및 상기 제3 라인의 폭은, 상기 제1 라인 및 상기 제3 라인의 길이에 대응하는, 표시 장치.
  12. 제 1 항에 있어서,
    상기 제1 지점 및 상기 제2 지점은, 이웃하는 두 화소들 사이에 위치하는, 표시 장치.
  13. 제 1 항에 있어서,
    상기 복수의 화소들은, 화소전극, 대향전극 및 상기 화소전극과 상기 대향전극 사이의 발광층을 포함하는 표시요소를 각각 포함하고,
    상기 대향전극은 상기 제2 영역에 대응하도록 일체로 구비되되 상기 제1 영역에 대응하는 홀을 포함하는, 표시 장치.
  14. 제1 영역 및 상기 제1 영역을 둘러싸는 제2 영역을 포함하는 기판;
    상기 제2 영역에 배치되는 복수의 화소들; 및
    제1 방향을 향해 상호 평행하게 연장되어, 상기 복수의 화소들과 전기적으로 연결된, 복수의 라인들을 포함하고,
    상기 복수의 라인들은, 상기 제2 영역 내에 위치하고
    상기 제1 방향과 직교하는 방향으로 상기 제1 영역에 대응하는 제2 영역의 일부 영역에서, 각각 단선(disconnected)된, 표시 장치.
  15. 제 14 항에 있어서,
    상기 복수의 라인들 각각은,
    상기 제2 영역의 상기 일부 영역에서 지그재그 형태로 단선된, 표시 장치.
  16. 제 14 항에 있어서,
    상기 복수의 라인들 각각은,
    상기 단선된 지점을 기준으로, 일 부분은 제1 스캔 구동회로로부터 연장되고, 나머지 부분은 제2 스캔 구동회로로부터 연장된, 표시 장치.
  17. 제 16 항에 있어서,
    상기 기판은 상기 제2 영역을 둘러싸는 제3 영역을 더 포함하고,
    상기 제1 스캔 구동회로 및 상기 제2 스캔 구동회로는 상기 제3 영역에 배치되는, 표시 장치.
  18. 제 16 항에 있어서,
    상기 복수의 라인들 중 인접하는 두 복수의 라인들은,
    상기 제1 스캔 구동회로로부터 상기 단선된 부분까지의 길이가 서로 다른, 표시 장치.
  19. 제 16 항에 있어서,
    상기 복수의 라인들의 일 부분의 폭은, 상기 제1 스캔 구동회로로부터 상기 단선된 부분까지에 길이에 대응하는, 표시 장치.
  20. 제 14 항에 있어서,
    상기 복수의 라인들은, 스캔 라인 또는 발광 제어 라인 중 적어도 하나를 포함하는, 표시 장치.
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