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JPS6016420A - 選択的エピタキシヤル成長方法 - Google Patents

選択的エピタキシヤル成長方法

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Publication number
JPS6016420A
JPS6016420A JP58125236A JP12523683A JPS6016420A JP S6016420 A JPS6016420 A JP S6016420A JP 58125236 A JP58125236 A JP 58125236A JP 12523683 A JP12523683 A JP 12523683A JP S6016420 A JPS6016420 A JP S6016420A
Authority
JP
Japan
Prior art keywords
epitaxial growth
semiconductor layer
insulating film
opening
aperture
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58125236A
Other languages
English (en)
Inventor
Shiro Hine
日根 史郎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP58125236A priority Critical patent/JPS6016420A/ja
Priority to US06/624,361 priority patent/US4579621A/en
Publication of JPS6016420A publication Critical patent/JPS6016420A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 この発明は選択的エピタキシャル成長方法に関するもの
である。
〔従来技術〕
シリコン半導体基板上への半導体層の選択的エピタキシ
ャル成長方法の従来例による主要工程を第1図(4)な
いしくC)に示しである。すなわち、従来方法では、ま
ず第1図(A)のように、第1導電形のシリコン基板(
11の主面上に酸化シリコン(SinlI)。
窒化シリコン(SiaN4)膜などの絶縁膜(2)を形
成し、かつ第2図(13)に示すとおシ、写真蝕刻法な
どによシこの絶縁膜(2)を選択的に除去して開口部(
3)を形成し、同部分の基板(1)面を露出させる。次
に第1図(Qにみられるように、残された絶縁膜(2)
をマスクにして、圧応炉内圧力が100Torrのもと
に、各開口部(2)内に第1または第2導電形の半導体
層(4)をエピタキシャル成長させる。こ\で減圧下で
の選択的エピタキシャル成長は、常圧下でのそれに比較
して、その選択性ならびに平坦性の優れていることが判
っている。
ところでこのようにして選択的に成長させるエピタキシ
ャル半導体層(4)は、その周辺に欠陥が導入され易い
性質を有しておシ、これが良好な特性の半導体素子を形
成することを困難にしているものであった。
〔発明の概要〕
発明者は従来のこのような半導体層の周辺に導入される
欠陥の程度が、絶縁膜の開口部形成の際のエツチング方
法によって大きく異なることを見出し、これがために同
エツチング方法を工夫して、欠陥を導入し難い開口部の
形成をなすことにょシ、良好なエピタキシャル成長によ
る半導体層を得られるようにしたものである。
〔発明の実施例〕
以下、この発明方法の一実施例につき、第2図(4)、
(B)を参照して詳細に説明する。
これらの第2図(4)、(B)において前記第1図(4
)ないしくQと同一符号は同一または相当部分を示して
いる。
まず第2図囚は、 5inBからなる絶縁膜(2)を、
弗酸溶液によるエツチング(以下ウェットエツチングと
称する)で開口形成させて開口部(5)とし、この開口
部(5)内に前記エピタキシャル成長によって半導体層
(6)を形成させた場合の断面図であり、また第2図(
B)は、同絶縁膜(2)を異方性ドライエツチングによ
り開口形成させて開口部(7)とし、これに同様に半導
体層(8)を形成させた場合の断面図である。
こ\で周知のように前記前者でのウェットエツチングに
よる開口部(5)の断面形状は、同第2図(A)からも
明らかなように、開口端面が滑らかな傾斜面に形成され
る。そしてこのようにして得た開口部(5)内に、その
絶縁膜(2)と同程度の層厚の半導体層(61t−エピ
タキシャル成長さぜた場合、この半導体層(6)での周
辺部は、絶縁膜(2)の上をはうように結晶の成長がな
されることになり、同周辺部内の成長層にX印で示す結
晶欠陥(6a)が導入され易くガって、この結晶欠陥(
6a)がその後の半導体素子形成を阻害し、得られる半
導体素子の特性を損なうものであった。
これに対し、前記後者での異方性ドライエツチングによ
る開口部(7)の断面形状は、同第2図(B)からも明
らかなように、開口端面が基板(1)の主面に対しては
ゾ垂直に形成されること\なり、この開口部(7)内に
同様に半導体層(8)をエピタキシャル成長させた場合
には、その周辺部に導入される欠陥の数が極めて少なく
なシ、この半導体層(8)に半導体素子を形成したとき
、その半導体素子の特性を良好に保持し得るのである。
〔発明の効果〕
以上詳述したようにこの発明方法によるときは、基板上
に形成される絶縁膜の選択的開口に異方性エツチングを
利用し、かつその開口部内への半導体層の形成に減圧下
での選択的エピタキシャル成長を採用したから、得られ
る半導体層の選択性ならびに平坦性を確保できて、半導
体素子の高密度集積化に役立つと共に、半導体層形成時
の周辺部結晶欠陥の導入が排除されて、特性の良好な半
導体素子を高歩留シで得られるなどの特長がある。
【図面の簡単な説明】
第1図(4)ないしくC)は従来例による選択的エピタ
キシャル成長法の一例の主要工程を順次に示すそれぞれ
断面図、第2図(4)およびψ)はこの発明の一実施例
による選択的エピタキシャル成長法を、ウェットおよび
ドライエツチングによって得た開口部に施して形成した
それぞれの場合の半導体層を示す断面図である。 fil−・・・基板、(21−・・Φ絶縁膜、(31、
(51および(7)・・Φ・開口部、(41、(61お
よび(8)・・・・半導体層、(6a)・・・・結晶欠
陥。 代理人 大 岩 増 雄 手続補正書(自発) 特許庁長官殿 1、事件の表示 特願昭58−125236号2、発明
の名称 選択的エピタキシャル成長方法 3、補正をする者 事件との関係 特許出願人 住 所 東京都千代田区丸の内二丁目2番3号名 称 
(601)三菱電機株式会社 代表者片山仁八部 4、代理人 住 所 東京都千代田区丸の内二丁目2番3号(2)図
面の第1図、第2図を別紙の通シ補正する。 明 細 書 (全文補正) 1、発明の名称 選択的エピタキシャル成長方法 2、特許請求の範囲 半導体基板の主面上に形成された絶縁膜を、異方性ドラ
イエツチングによシ選択的に開口させて開口部を形成さ
せると共に、この開口部内に、前記絶縁膜をマスクにし
て、少なくとも100Torr以下の減圧下で半導体層
をエピタキシャル成長させることを特徴とする選択的エ
ピタキシャル成長方法。 3、発明の詳細な説明 〔発明の技術分野〕 この発明は選択的エピタキシャル成長方法に関するもの
である。 〔従来技術〕 シリコン半導体基板上への半導体層の選択的エピタキシ
ャル成長方法の従来例による主要工程を第1回込)ない
しい)に示しである。すなわち、従来シリコン基板(1
)の主面上に酸化シリコン(8i0z)。 窒化シリコン(5iaN4)膜などの絶縁膜(2)を形
成し、かつ第1回申)に示すとおシ、写真製版によって
所定の領域以外をレジスト(3)で覆い、しかる後に弗
酸を含む溶液でエツチングして第1図(C)のように絶
縁膜(2)を選択的に除去して開口部(4)を形成し、
同部分の基板(1)面を露出させる。次に第1図の)に
みられるように、残された絶縁膜(2)をマスクにして
、圧応炉内圧力が100Torrのもとに、開口部(4
)内に第1または第2導電形の半導体層(5)をエピタ
キシャル成長させる。こ\で減圧下での選択的エピタキ
シャル成長は、常圧下でのそれに比較して、その選択性
ならびに平坦性の優れていることが判っている。 ところでこのようにして選択的に成長させるエピタキシ
ャル半導体層(5(は、テーパのついた絶縁膜の開口部
(41内で成長していくときに欠陥(主として積層欠陥
) (5a)をその周辺に導入し易い性質を有しておシ
、これが良好な特性の半導体素子を形成することを困難
にしているものであった。 〔発明の概要〕 発明者は従来のこのような半導体層の周辺に導入される
欠陥の程度が、絶縁膜の開口部形成の際のエツチング方
法によって大きく異なることを見出し、これがために同
エツチング方法を工夫して、欠陥を導入し難い開口部の
形成をなすことによシ、良好なエピタキシャル成長によ
る半導体層を得られるようにしたものである。 〔発明の実施例〕 以下、この発明方法の一実施例につき、第2図(A)な
いしい)を参照して詳細に説明する。 これらの第2図体)ないしい)において前記第1図(A
)ないし0)と同一符号は同一または相当部分を示して
いる。 まず、第2図(4)に示すように、基板(11に絶縁膜
(2)を形成した後、第2図(n)に示すように写真製
版によって所定の領域以外をレジスト(3)で覆い、次
いで第2図C)に示すように、CF4とH2の混合ガス
をエッチャントとして平行平板型異方性ドライエツチン
グ装置を用いて絶縁膜(2)に開口部(6)を設け、し
かる後レジスト(3)を除去する。次いで第2図O)に
示すように、減圧下で開口部(6)に半導体層(7)を
エピタキシャル成長させる。このようにして基板(1)
の主面に対し垂直な開口端面を形成した開口部(6)内
に半導体層(7)をエピタキシャル成長させることによ
シ、その周辺部に導入する欠陥の数が極めて少ない半導
体層を形成することができる。 なおエピタキシャル成長は、H2をキャリヤ・ガスとし
、ジクロルシラン5iH2C4z ヲシリコンンースと
し、圧力100 Torr以下、温度900〜1100
℃で行なう。 〔発明の効果〕 以上詳述したようにこの発明方法によるときは、基板上
に形成される絶縁膜の選択的開口に異方性ドライエツチ
ングを利用し、かつその開口部内への半導体層の形成に
減圧下での選択的エピタキシャル成長を採用したことに
よシ、エピタキシャル成長によって生成される半導体層
における積層欠陥は、ウェットエツチングによる場合が
IPm程度であるのに対して5000A以下となシ、特
性の良好な半導体を高歩留シで得ることができる。 4、図面の簡単な説明 第1図体)ないしり)は従来例による選択的エピタキシ
ャル成長法における主要工程の断面図、第2図(A)〜
0)はこの発明の選択的エピタキシャル成長法の一実施
例における主要工程の断面図である。 +11・・・・基板、(2)・・・・絶縁膜、(3)・
・・・レジス)、(61・・・拳闘口部、(7)・・・
・半導体層。 代理人大岩増雄 第1図 第 2 図

Claims (1)

    【特許請求の範囲】
  1. 半導体基板の主面上に形成された絶縁膜を、異方性ドラ
    イエツチングによシ選択的に開口させて開口部を形成さ
    せると共に、この開口部内に、前記絶縁膜をマスクにし
    て、少なくともIQQTorr以下の減圧下で半導体層
    をエピタキシャル成長させることを特徴とする選択的エ
    ピタキシャル成長方法。
JP58125236A 1983-07-08 1983-07-08 選択的エピタキシヤル成長方法 Pending JPS6016420A (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP58125236A JPS6016420A (ja) 1983-07-08 1983-07-08 選択的エピタキシヤル成長方法
US06/624,361 US4579621A (en) 1983-07-08 1984-06-25 Selective epitaxial growth method

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58125236A JPS6016420A (ja) 1983-07-08 1983-07-08 選択的エピタキシヤル成長方法

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JPS6016420A true JPS6016420A (ja) 1985-01-28

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Application Number Title Priority Date Filing Date
JP58125236A Pending JPS6016420A (ja) 1983-07-08 1983-07-08 選択的エピタキシヤル成長方法

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