JP4917249B2 - 半導体装置及び半導体装置の製造方法 - Google Patents
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Description
(i)配線と同層に設けられた配線層
(ii)配線の上部または下部に接続するビアと同層に設けられたビア層
また、(i)の上部には、CMP保護膜を設けることができる。CMP保護膜としては、SiCN、SiO2、SiC、SiN等の材料が好ましく用いられる。さらに、(ii)の下部には、拡散防止膜を設けることができる。拡散防止膜としては、SiCN、SiC等、炭素含有の材料が好ましく用いられる。
上記構成の層間絶縁膜において、(i)配線層の炭素組成をc1とし、(ii)ビア層の炭素組成をc2として、
c1>c2
と設定することができる。こうすることにより、金属材料の存在比が高い配線層においては炭素の組成を高くして層間絶縁膜の誘電率を低く保つとともに、金属材料の存在比が低いビア層においては炭素の組成を低くして、層間絶縁膜とCMP保護膜や拡散防止膜等の他の絶縁膜との密着性を向上させることができる。
図1は、本実施の形態における半導体装置200の構成を示す断面図である。図1(a)は、シングルダマシン法で形成された配線構造を示す。
半導体装置200は、半導体基板(不図示)上に形成されたSiCN膜202と、その上に形成された第一のSiOC膜204と、その上に形成されたSiO2膜206と、その上に形成されたSiCN膜208と、その上に形成された第二のSiOC膜210と、その上に形成されたSiO2膜212と、その上に形成されたSiCN膜214とを含む。第一のSiOC膜204にはバリア膜216およびビア218が形成され、第二のSiOC膜210にはバリア膜220および配線金属膜222が形成される。
また、SiCN膜やSiO2膜との密着性を良好にするためには、(SiOC膜中の炭素の組成)/(SiOC膜中の金属部材の存在比)が14以下となるようにすることが好ましい。
まず、基板(不図示)上に下地絶縁膜201を設け、その上に、プラズマCVD法により、SiCN膜202(たとえば膜厚50nm)を成膜する。次に、SiCN膜202上に、トリメチルシランガスを流しながら、プラズマCVD法により第一のSiOC膜204(たとえば膜厚300nm)を成膜する。第一のSiOC膜204の成膜条件は、他の状況に応じて適宜設定することができるが、たとえば、温度:350℃、圧力:4Torr、RFパワー:600Wにおいて、O2:500sccm、He:300sccm、トリメチルシラン:100〜1000sccmとすることができる。
ここで、半導体装置300は、下地絶縁膜301と、SiCN膜302と、SiOC膜304と、SiCN膜306と、SiOC膜308と、SiCN膜310と、SiOC膜312とを含む。SiOC膜304には、バリア膜314および配線金属膜316が形成される。SiOC膜308には、バリア膜318およびビア320が形成される。SiOC膜312には、配線金属膜324およびバリア膜322、配線金属膜326、配線金属膜328、および配線金属膜330が形成される。
図4は、本実施の形態における半導体装置200の構成を示す断面図である。
図4(a)は、シングルダマシン法で形成された配線構造を示す。ここで、半導体装置200は、第一の実施の形態において、図1(a)に示した構成に加えて、第三のSiOC膜240aおよび第四のSiOC膜240bを含む。また、図1(a)に示した構成の第一のSiOC膜204にかえて第五のSiOC膜242を含む。本実施の形態において、第一および第二の実施の形態と同様の構成要素には同様の符号を付し、適宜説明を省略する。
試料は以下のようにして作製した。まず、半導体基板上に下地絶縁膜を設け、その上にプラズマCVD法により、SiCN膜(膜厚50nm)を形成した。その後、SiCN膜上にプラズマCVD法により、SiOC膜(膜厚300nm)を形成した。SiOC膜の成膜条件は、温度:350℃、圧力:4Torr、RFパワー:600Wにおいて、O2:500sccm、He:300sccmとし、トリメチルシラン:800sccm、1200sccm、1500sccmとして、膜中の炭素の組成がそれぞれ15%、18%、20%となるようにした。その後、SiOC膜上にレジスト膜を形成し、リソグラフィー技術およびエッチング技術により、配線溝を形成した。つづいて、レジスト膜を除去した。次いで、配線溝内にスパッタリング法によりTa/TaN膜を形成した。その後、バリア膜上において、配線溝を埋め込むように、電解めっき法により配線金属膜を形成した。つづいて、配線溝外部に形成された不要な配線金属膜およびバリア膜をCMPにより除去し、半導体装置を製造した。このようにして形成した半導体装置を所定の大きさに切断して複数の切片とした。各切片におけるSiCN膜とSiOC膜との接面における金属の割合は、マスクの設計に基づいて算出した。20個の切片についてそれぞれ検査を行い、剥がれが生じた切片の個数を求めた。
201 下地絶縁膜
202 SiCN膜
204 第一のSiOC膜
206 SiO2膜
208 SiCN膜
210 第二のSiOC膜
212 SiO2膜
214 SiCN膜
216 バリア膜
218 ビア
220 バリア膜
222 配線金属膜
224 バリア膜
226 配線金属膜
240a 第三のSiOC膜
240b 第四のSiOC膜
242 第五のSiOC膜
300 半導体装置
301 下地絶縁膜
302 SiCN膜
304 SiOC膜
306 SiCN膜
308 SiOC膜
310 SiCN膜
312 SiOC膜
314 バリア膜
316 配線金属膜
318 バリア膜
320 ビア
322 バリア膜
324 配線金属膜
326 配線金属膜
328 配線金属膜
330 配線金属膜
Claims (7)
- 半導体基板と、
前記半導体基板上に設けられ、SiOC、メチルシルセスキオキサン(MSQ)、水素化メチルシルセスキオキサン(MHSQ)、もしくは有機ポリシロキサンからなる絶縁層、または当該絶縁膜をポーラス化した層からなる層間絶縁膜と、
前記半導体基板上において、前記層間絶縁膜を上下から挟んで当該層間絶縁膜の一方の面および他方の面にそれぞれ接して設けられ、SiCN膜又はSiO2膜からなる第一の絶縁膜および第二の絶縁膜と、
前記層間絶縁膜内に設けられ、前記第一の絶縁膜および前記第二の絶縁膜にそれぞれ接するとともに前記層間絶縁膜内で互いに接続されたビアおよび配線と、
を含み、
前記層間絶縁膜において、前記配線が形成された層における炭素の組成が、前記配線が形成されていない層における炭素の組成よりも高いことを特徴とする半導体装置。 - 請求項1に記載の半導体装置において、
前記層間絶縁膜の前記配線が形成されていない層において、前記第一の絶縁膜との界面に、他の領域よりも炭素の組成が低い膜が形成されたことを特徴とする半導体装置。 - 請求項1または2に記載の半導体装置において、
前記層間絶縁膜の前記配線が形成された層において、前記第二の絶縁膜との界面に、他の領域よりも炭素の組成が低い膜が形成されたことを特徴とする半導体装置。 - 半導体基板と、
前記半導体基板上に設けられ、SiOC、メチルシルセスキオキサン(MSQ)、水素化メチルシルセスキオキサン(MHSQ)、もしくは有機ポリシロキサンからなる絶縁層、または当該絶縁膜をポーラス化した層からなる層間絶縁膜、前記半導体基板上において、前記層間絶縁膜を上下から挟んで当該層間絶縁膜の一方の面および他方の面にそれぞれ接して設けられ、SiCN膜又はSiO2膜からなる第一の絶縁膜および第二の絶縁膜、前記層間絶縁膜内に設けられ、前記第一の絶縁膜および前記第二の絶縁膜にそれぞれ接するとともに前記層間絶縁膜内で互いに接続されたビアおよび配線、が複数積層して形成された多層配線構造と、
を含み、
前記多層配線構造において、複数の前記層間絶縁膜の前記配線が形成された層における炭素の組成の平均値が、前記配線が形成されていない層における炭素の組成の平均値よりも高いことを特徴とする半導体装置。 - 請求項1〜4のいずれか一項に記載の半導体装置において、
前記層間絶縁膜、前記ビア、前記第二の絶縁膜、及び前記配線を含む配線層が多層積層された多層配線構造を有しており、
前記第二の絶縁膜は、前記層間絶縁膜の下面に設けられており、
互いに積層されている2つの前記配線層において、上側に位置している前記配線層の前記第二の絶縁膜が、下側に位置している前記配線層の前記第一の絶縁膜となっており、
前記複数の層間絶縁膜は、当該層間絶縁膜と接する前記第二の絶縁膜との界面における前記ビア及び前記配線の存在比が前記複数の層間絶縁膜中の前記ビア及び前記配線の存在比の平均値以下の場合、前記界面における炭素の組成が11原子%以下となるように構成されたことを特徴とする半導体装置。 - 請求項5に記載の半導体装置において、
複数の前記層間絶縁膜は、それぞれ、当該層間絶縁膜中の前記前記ビア及び前記配線の存在比が前記平均値より大きい場合、当該層間絶縁膜中の炭素の組成の平均値が11原子%より大きくなるように構成されたことを特徴とする半導体装置。 - 請求項1乃至6いずれかに記載の半導体装置において、
前記層間絶縁膜は、CVD法で形成されたSiOC膜であることを特徴とする半導体装置。
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US9214385B2 (en) * | 2009-12-17 | 2015-12-15 | Globalfoundries Inc. | Semiconductor device including passivation layer encapsulant |
US8349746B2 (en) * | 2010-02-23 | 2013-01-08 | Applied Materials, Inc. | Microelectronic structure including a low k dielectric and a method of controlling carbon distribution in the structure |
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US6251770B1 (en) * | 1999-06-30 | 2001-06-26 | Lam Research Corp. | Dual-damascene dielectric structures and methods for making the same |
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US6756674B1 (en) * | 1999-10-22 | 2004-06-29 | Lsi Logic Corporation | Low dielectric constant silicon oxide-based dielectric layer for integrated circuit structures having improved compatibility with via filler materials, and method of making same |
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US6440878B1 (en) * | 2000-04-03 | 2002-08-27 | Sharp Laboratories Of America, Inc. | Method to enhance the adhesion of silicon nitride to low-k fluorinated amorphous carbon using a silicon carbide adhesion promoter layer |
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US6383912B1 (en) * | 2000-10-23 | 2002-05-07 | Honeywell International, Inc. | Fabrication method of integrated circuits with multiple low dielectric-constant intermetal dielectrics |
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US6570256B2 (en) * | 2001-07-20 | 2003-05-27 | International Business Machines Corporation | Carbon-graded layer for improved adhesion of low-k dielectrics to silicon substrates |
US6887780B2 (en) * | 2001-08-31 | 2005-05-03 | Intel Corporation | Concentration graded carbon doped oxide |
JP2003124307A (ja) * | 2001-10-15 | 2003-04-25 | Matsushita Electric Ind Co Ltd | 半導体装置及びその製造方法 |
US20030155657A1 (en) * | 2002-02-14 | 2003-08-21 | Nec Electronics Corporation | Manufacturing method of semiconductor device |
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WO2004107434A1 (ja) * | 2003-05-29 | 2004-12-09 | Nec Corporation | 配線構造およびその製造方法 |
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