[go: up one dir, main page]
More Web Proxy on the site http://driver.im/

JP2666859B2 - 目合せ用バーニヤパターンを備えた半導体装置 - Google Patents

目合せ用バーニヤパターンを備えた半導体装置

Info

Publication number
JP2666859B2
JP2666859B2 JP63298606A JP29860688A JP2666859B2 JP 2666859 B2 JP2666859 B2 JP 2666859B2 JP 63298606 A JP63298606 A JP 63298606A JP 29860688 A JP29860688 A JP 29860688A JP 2666859 B2 JP2666859 B2 JP 2666859B2
Authority
JP
Japan
Prior art keywords
vernier
pattern
main
semiconductor device
misalignment
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP63298606A
Other languages
English (en)
Other versions
JPH02143544A (ja
Inventor
昭三 西本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP63298606A priority Critical patent/JP2666859B2/ja
Priority to EP89312286A priority patent/EP0370834B1/en
Priority to US07/441,522 priority patent/US5017514A/en
Priority to DE68929150T priority patent/DE68929150T2/de
Publication of JPH02143544A publication Critical patent/JPH02143544A/ja
Application granted granted Critical
Publication of JP2666859B2 publication Critical patent/JP2666859B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Classifications

    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03FPHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F7/00Photomechanical, e.g. photolithographic, production of textured or patterned surfaces, e.g. printing surfaces; Materials therefor, e.g. comprising photoresists; Apparatus specially adapted therefor
    • G03F7/70Microphotolithographic exposure; Apparatus therefor
    • G03F7/70483Information management; Active and passive control; Testing; Wafer monitoring, e.g. pattern monitoring
    • G03F7/70591Testing optical components
    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03FPHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F7/00Photomechanical, e.g. photolithographic, production of textured or patterned surfaces, e.g. printing surfaces; Materials therefor, e.g. comprising photoresists; Apparatus specially adapted therefor
    • G03F7/70Microphotolithographic exposure; Apparatus therefor
    • G03F7/70483Information management; Active and passive control; Testing; Wafer monitoring, e.g. pattern monitoring
    • G03F7/70605Workpiece metrology
    • G03F7/70616Monitoring the printed patterns
    • G03F7/70633Overlay, i.e. relative alignment between patterns printed by separate exposures in different layers, or in the same layer in multiple exposures or stitching
    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03FPHOTOMECHANICAL PRODUCTION OF TEXTURED OR PATTERNED SURFACES, e.g. FOR PRINTING, FOR PROCESSING OF SEMICONDUCTOR DEVICES; MATERIALS THEREFOR; ORIGINALS THEREFOR; APPARATUS SPECIALLY ADAPTED THEREFOR
    • G03F9/00Registration or positioning of originals, masks, frames, photographic sheets or textured or patterned surfaces, e.g. automatically
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2223/00Details relating to semiconductor or other solid state devices covered by the group H01L23/00
    • H01L2223/544Marks applied to semiconductor devices or parts
    • H01L2223/54453Marks applied to semiconductor devices or parts for use prior to dicing
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10STECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10S438/00Semiconductor device manufacturing: process
    • Y10S438/975Substrate or mask aligning feature

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は半導体装置の製造過程において使用される目
合せ用のバーニヤパターンを備えた半導体装置に関す
る。
[従来の技術] 従来、この種の目合せ用バーニヤパターンは、第2図
に示すように、棒状のパターンをその幅方向に複数個等
間隔で配列して、半導体装置上に形成されていた。この
バーニヤパターンは、例えば、コンタクト孔の下地パタ
ーンに整合するようにアルミニウム配線のホトレジスト
パターンを位置合せする等、半導体装置製造の主要工程
で周知の写真食刻技術によって下地パターンに整合する
ように当該工程のホトレジストパターンを位置合せする
際に使用される。即ち、目ずれ量を数値化するために、
間隔が相互に異なる下地パターン1及び目合せパターン
2をそれらが位置合せされた状態で第2図に示すように
中央で重なり合うようにしておき、相互の位置ずれが生
じたときに、その目ずれ量を下地パターン1の間隔と目
合せパターン2の間隔との間の差で除算して得られた数
値に相当する番数だけ中央から離れた部分で下地パター
ン1と目合せパターン2とが重なり合うようになってい
る。なお、第2図に示すパターンは横方向に配列されて
いて、この横方向の目ずれを検出できるものであり、縦
方向の目ずれの検出のために、第2図に示すパターンを
90度回転させたパターンから構成される別のバーニヤが
同じく半導体装置上に設けられている。
[発明が解決しようとする課題] しかしながら、位置合せ装置の機構に起因して、目ず
れの要素としては、単なる平行移動の外に、回転直交性
及び像倍率の変化に起因する成分がある。そして、近年
の微細化された半導体装置にとってこれらの平行移動以
外の成分が無視できない大きさになってきた。これらの
目ずれはウエハ各点における目ずれ量から逆算して補正
を加えることにより除去することもできる。しかし、近
時、半導体装置の大規模化が進んでチップサイズが大き
くなっているため、前述の成分が存在すると、目ずれ方
向及び量がチップの各部で相互に異なる状態が発生する
ので、チップ中央部で最も目ずれ量が少なくなるように
して目ずれが小さい部分の面積を極大化する必要が生じ
ている。このためには、チップの中央部に縦横両方向の
バーニヤを設けることが最も好ましいが、実際上、チッ
プの中央部にはバーニヤを設けるのに十分な場所がない
ため、次善の策として、縦方向の目ずれを読み取るバー
ニヤはチップの縦方向外周部の中央に、また横方向の目
ずれを読み取るバーニヤは同じく横方向外周部の略々中
央に設けている。
その結果、縦方向バーニヤと横方向バーニヤとの距離
が大きく離れてしまう。これにより、製造過程におい
て、目ずれ量のでき上がりをチェックする工程に要する
時間が長くなり、生産ラインの処理能力を低下させてし
まうという欠点がある。
この問題を解決する方法として、縦方向バーニヤと同
じ位置に横方向のバーニヤを設け、横方向のバーニヤと
同じ位置に縦方向のバーニヤを設けることも考えられる
が、これには次に示す2つの欠点がある。即ち、第1に
場所をとるという欠点があり、第2に本来その場所でよ
り正しいバーニヤ、換言すれば、そこで目合せをすれば
チップのより大きな面積で目合せができるバーニヤが縦
方向又は横方向のどちらであるのかがわからないため、
誤認を誘うという欠点がある。
本発明はかかる問題点に鑑みてなされたものであっ
て、目合せの作業性が優れていると共に、バーニヤ形成
面積の増大を抑制することができ、誤認等のミスも回避
することができる目合せ用バーニヤパターンを備えた半
導体装置を提供することを目的とする。
[課題を解決するための手段] 本発明に係る目合せ用バーニヤパターンを備えた半導
体装置は、第1方向の目ずれを検出するのに有利な位置
にこの第1方向に目ずれ検出能力を有するパターンの第
1の主バーニヤと、第2方向に目ずれ検出能力を有する
パターンであって前記第1主バーニヤより分解能力が低
い第1副バーニヤとが配置されており、第2方向の目ず
れを検出するために有利な位置にこの第2方向に目ずれ
検出能力を有するパターンの第2主バーニヤと、第1方
向に目ずれ検出能力を有するパターンであって前記第2
主バーニヤより分解能力が低い第2副バーニヤとが配置
されていることを特徴とする。
[作用] 本発明においては、主バーニヤの近傍にこの主バーニ
ヤより目が粗く、分解能が低い副バーニヤを設けてあ
る。このため、顕微鏡の一視野内で、粗い副バーニヤを
使用して良品か不良品かの判断ができる一方、主バーニ
ヤを使用して正確に目合せ位置にフィードバックするこ
とができる。これにより、作業性が向上すると共に、主
バーニヤと副バーニヤとは間隔が相異するため、両者を
誤認することはない。また、副バーニヤは目が粗い分、
小型化できるため、省スペースとなる。
[実施例] 次に、本発明の実施例について添付の図面を参照して
説明する。
第1図は本発明の実施例を示すバーニヤパターンの平
面図である。このバーニヤパターンは半導体装置の横方
向の目ずれを検出するのに有利な位置に配置されてい
る。主バーニヤ3はこの横方向の目ずれ検出能力を有
し、その下地パターン1aは横方向に相互間に間隔をおい
て配列されている。この下地パターン1aは縦方向に延長
する棒状をなし、9本の下地パターン1aの相互間の中心
間隔は10.0μmである。一方、目合せパターン2の中心
間隔は9.9μmとなっており、従って、主バーニヤ3は
横方向に−0.4μmから+0.4μmまで、0.1μmの精度
で目ずれを検出する能力を有する。
また、この主バーニヤ3に近接する位置には副バーニ
ヤ4が配設されている。この副バーニヤ4は縦方向の目
ずれを検出する能力を有し、その下地パターン1bは縦方
向に配列されており、5本の下地パターン1bの中心間隔
は10.0μmである。一方、副バーニヤ4の目合せパター
ン2bは中心間隔が9.8μmとなっており、従って、副バ
ーニヤ4は縦方向に−0.4μmから+0.4μmまで、0.2
μmの精度で目ずれを検出することができる。
なお、上記主バーニヤ3及び副バーニヤ4とは別に、
半導体装置の縦方向の目ずれを検出するのに有利な位置
には、第1図のバーニヤを90゜回転させた形状の別の主
バーニヤ及び副バーニヤが設けられている。
このように構成された半導体装置の目合せ用バーニヤ
パターンにおいては、正確な読みとり補正のデータを得
るためのバーニヤは主バーニヤ3であるが、この主バー
ニヤ3は副バーニヤ4と大きさが異なるため、両者を誤
認することはない。
また、ウエハの目ずれを読みとり、製品の良否を判断
する工程においては、顕微鏡視野は1チップに対して1
箇所に合せるだけで十分である。即ち、このように、顕
微鏡視野を1チップ1箇所合せるだけで、主バーニヤ3
及び副バーニヤ4の双方が視野内に入るため、これらを
使用して精度は粗いがウエハの目ずれを読み取り、製品
の良否を判断することができる。
一方、ウエハ上で複数の点を観察する場合等は縦方向
用バーニヤと横方向用バーニヤとに相互に顕微鏡視野を
合わせるようにする。これによって、作業能率を落とす
ことなく正確な目ずれの選別作業を行うことができる。
また、副バーニヤ4は目を粗くした結果として小型化で
き、従来の一方向について1個のバーニヤのみを設けた
場合に対して、そのバーニヤの所要面積の増大を低く抑
制することができる。
[発明の効果] 以上説明したように、本発明によれば、主バーニヤの
近傍にこの主バーニヤより目が粗く、分解能力が低い副
バーニヤを設け、これらの主バーニヤ及び副バーニヤの
組み合わせを、第1方向の目ずれ検出用及び第2方向の
目ずれ検出用の双方について設けたから、顕微鏡の一視
野内で、直交する二方向の目ずれを、一方は目合せ装置
にフィードバックできる程度に正確に、他方は良品か不
良品かの判断が可能な程度の粗さで、とらえることがで
きる。これにより、チップサイズが大型化した半導体装
置に対しても、誤認の問題を生じることなく、目合せの
作業性を著しく向上させることができると共に、副バー
ニヤは目が粗くてもよいため、小型にすることができ、
その設置のためのスペースは小さくて足りる。
【図面の簡単な説明】
第1図は本発明の実施例に係る半導体装置の一群のバー
ニヤを示す平面図、第2図は従来の半導体装置のバーニ
ヤを示す平面図である。 1,1a,1b;下地パターン、2,2a,2b;目合せパターン、3;主
バーニヤ、4;副バーニヤ

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項1】1つのチップの周辺部のうち異なった2箇
    所の周辺部にそれぞれ第1及び第2の目合わせバーニヤ
    パターンを設け、前記第1の目合わせバーニヤパターン
    は第1の方向にパターンが配置された第1主バーニヤと
    前記第1の方向とは直交した方向の第2の方向にパター
    ンが前記第1主バーニヤのパターン間隔よりも広く配置
    された第1副バーニヤが配置され、前記第2の目合わせ
    バーニヤパターンは前記第2の方向にパターンが配置さ
    れた第2主バーニヤと前記第1の方向にパターンが前記
    第2主バーニヤのパターン間隔よりも広く配置された第
    2副バーニヤが配置されていることを特徴とする目合わ
    せ用バーニヤパターンを備えた半導体装置。
JP63298606A 1988-11-25 1988-11-25 目合せ用バーニヤパターンを備えた半導体装置 Expired - Lifetime JP2666859B2 (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP63298606A JP2666859B2 (ja) 1988-11-25 1988-11-25 目合せ用バーニヤパターンを備えた半導体装置
EP89312286A EP0370834B1 (en) 1988-11-25 1989-11-27 Method of manufacturing a semiconductor device
US07/441,522 US5017514A (en) 1988-11-25 1989-11-27 Method of manufacturing a semiconductor device using a main vernier pattern formed at a right angle to a subsidiary vernier pattern
DE68929150T DE68929150T2 (de) 1988-11-25 1989-11-27 Verfahren zur Herstellung einer Halbleitervorrichtung

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP63298606A JP2666859B2 (ja) 1988-11-25 1988-11-25 目合せ用バーニヤパターンを備えた半導体装置

Publications (2)

Publication Number Publication Date
JPH02143544A JPH02143544A (ja) 1990-06-01
JP2666859B2 true JP2666859B2 (ja) 1997-10-22

Family

ID=17861904

Family Applications (1)

Application Number Title Priority Date Filing Date
JP63298606A Expired - Lifetime JP2666859B2 (ja) 1988-11-25 1988-11-25 目合せ用バーニヤパターンを備えた半導体装置

Country Status (4)

Country Link
US (1) US5017514A (ja)
EP (1) EP0370834B1 (ja)
JP (1) JP2666859B2 (ja)
DE (1) DE68929150T2 (ja)

Families Citing this family (60)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0444307A (ja) * 1990-06-12 1992-02-14 Nec Corp 半導体装置の製造方法
JPH04234930A (ja) * 1991-01-10 1992-08-24 Shimano Inc 釣り用リール
JPH0724278B2 (ja) * 1991-01-10 1995-03-15 信越半導体株式会社 パターンシフト測定方法
US5422479A (en) * 1991-01-25 1995-06-06 Canon Kabushiki Kaisha Optical type encoder for position detection
US5298761A (en) * 1991-06-17 1994-03-29 Nikon Corporation Method and apparatus for exposure process
ES2042382B1 (es) * 1991-10-30 1996-04-01 Consejo Superior Investigacion Estructura de test para la medida del desalineamiento entre niveles en tecnologias microelectronicas, basada en transistores mos con puerta triangular
US5296917A (en) * 1992-01-21 1994-03-22 Mitsubishi Denki Kabushiki Kaisha Method of monitoring accuracy with which patterns are written
US5478782A (en) * 1992-05-25 1995-12-26 Sony Corporation Method bonding for production of SOI transistor device
JP3039210B2 (ja) * 1993-08-03 2000-05-08 日本電気株式会社 半導体装置の製造方法
US5457880A (en) * 1994-02-08 1995-10-17 Digital Equipment Corporation Embedded features for monitoring electronics assembly manufacturing processes
US5385289A (en) * 1994-02-08 1995-01-31 Digital Equipment Corporation Embedded features for registration measurement in electronics manufacturing
KR0168772B1 (ko) * 1994-03-10 1999-02-01 김주용 포토마스크 및 그를 이용한 반도체 장치 제조 방법
KR950029845A (ko) * 1994-04-01 1995-11-24 김주용 레티클 및 이를 이용한 레티클의 회전오차 측정방법
EP0737330B1 (en) * 1994-06-02 1999-03-10 Koninklijke Philips Electronics N.V. Method of repetitively imaging a mask pattern on a substrate, and apparatus for performing the method
US5923041A (en) * 1995-02-03 1999-07-13 Us Commerce Overlay target and measurement procedure to enable self-correction for wafer-induced tool-induced shift by imaging sensor means
KR970003401A (ko) * 1995-06-20 1997-01-28 김주용 디스톨션 체크용 레티클
US5872042A (en) * 1996-08-22 1999-02-16 Taiwan Semiconductor Manufacturing Company, Ltd. Method for alignment mark regeneration
DE19652974A1 (de) * 1996-12-19 1998-06-25 Alsthom Cge Alcatel Verfahren zur Kontrolle der Genauigkeit beim mehrstufigen Ätzen
US6465322B2 (en) 1998-01-15 2002-10-15 Koninklijke Philips Electronics N.V. Semiconductor processing methods and structures for determining alignment during semiconductor wafer processing
JP3287321B2 (ja) * 1998-12-03 2002-06-04 日本電気株式会社 半導体装置の製造方法
US6130173A (en) * 1998-03-19 2000-10-10 Lsi Logic Corporation Reticle based skew lots
US6327513B1 (en) 1998-04-16 2001-12-04 Vlsi Technology, Inc. Methods and apparatus for calculating alignment of layers during semiconductor processing
US5919714A (en) * 1998-05-06 1999-07-06 Taiwan Semiconductor Manufacturing Company, Ltd. Segmented box-in-box for improving back end overlay measurement
US6150231A (en) * 1998-06-15 2000-11-21 Siemens Aktiengesellschaft Overlay measurement technique using moire patterns
US6042972A (en) * 1998-06-17 2000-03-28 Siemens Aktiengesellschaft Phase shift mask having multiple alignment indications and method of manufacture
JP2000133576A (ja) * 1998-10-28 2000-05-12 Nec Corp 位置ずれ計測マーク及び位置ずれ計測方法
JP2001022049A (ja) * 1999-07-09 2001-01-26 Fujitsu Ltd マスク製作方法及びマスクパターンデータ作成装置並びに記録媒体
KR100611041B1 (ko) * 2000-02-17 2006-08-09 엘지.필립스 엘시디 주식회사 대면적 액정표시장치를 위한 포토마스크와 어레이기판제작방법
US6462818B1 (en) 2000-06-22 2002-10-08 Kla-Tencor Corporation Overlay alignment mark design
US7068833B1 (en) * 2000-08-30 2006-06-27 Kla-Tencor Corporation Overlay marks, methods of overlay mark design and methods of overlay measurements
US7541201B2 (en) 2000-08-30 2009-06-02 Kla-Tencor Technologies Corporation Apparatus and methods for determining overlay of structures having rotational or mirror symmetry
US6486954B1 (en) 2000-09-01 2002-11-26 Kla-Tencor Technologies Corporation Overlay alignment measurement mark
US6864589B2 (en) * 2001-03-30 2005-03-08 Sharp Laboratories Of America, Inc. X/Y alignment vernier formed on a substrate
US7804994B2 (en) * 2002-02-15 2010-09-28 Kla-Tencor Technologies Corporation Overlay metrology and control method
US20030160163A1 (en) * 2002-02-25 2003-08-28 Alan Wong Optical metrology target design for simultaneous measurement of multiple periodic structures
US6815128B2 (en) * 2002-04-01 2004-11-09 Micrel, Inc. Box-in-box field-to-field alignment structure
US7075639B2 (en) 2003-04-25 2006-07-11 Kla-Tencor Technologies Corporation Method and mark for metrology of phase errors on phase shift masks
US7346878B1 (en) 2003-07-02 2008-03-18 Kla-Tencor Technologies Corporation Apparatus and methods for providing in-chip microtargets for metrology or inspection
US7608468B1 (en) * 2003-07-02 2009-10-27 Kla-Tencor Technologies, Corp. Apparatus and methods for determining overlay and uses of same
KR100597634B1 (ko) * 2004-04-13 2006-07-05 삼성전자주식회사 커패시터를 가지는 반도체 메모리 소자 및 그의 형성방법
KR100546167B1 (ko) * 2004-08-11 2006-01-24 주식회사 하이닉스반도체 Sti cmp 공정에서 발생하는 잔여 질화막 두께변화량 감소 방법 및 이를 이용한 반도체 소자의 소자분리막 제조 방법
FR2875624A1 (fr) * 2004-09-23 2006-03-24 St Microelectronics Sa Generation deterministe d'un numero d'identifiant d'un circuit integre
KR100663347B1 (ko) * 2004-12-21 2007-01-02 삼성전자주식회사 중첩도 측정마크를 갖는 반도체소자 및 그 형성방법
US7557921B1 (en) 2005-01-14 2009-07-07 Kla-Tencor Technologies Corporation Apparatus and methods for optically monitoring the fidelity of patterns produced by photolitographic tools
US7898662B2 (en) * 2006-06-20 2011-03-01 Asml Netherlands B.V. Method and apparatus for angular-resolved spectroscopic lithography characterization
US20080036984A1 (en) * 2006-08-08 2008-02-14 Asml Netherlands B.V. Method and apparatus for angular-resolved spectroscopic lithography characterization
US8665417B2 (en) * 2008-06-11 2014-03-04 Asml Netherlands B.V. Apparatus and method for inspecting a substrate
US8988653B2 (en) * 2009-08-20 2015-03-24 Asml Netherlands B.V. Lithographic apparatus, distortion determining method, and patterning device
US9927718B2 (en) 2010-08-03 2018-03-27 Kla-Tencor Corporation Multi-layer overlay metrology target and complimentary overlay metrology measurement systems
US10890436B2 (en) 2011-07-19 2021-01-12 Kla Corporation Overlay targets with orthogonal underlayer dummyfill
JP2015079830A (ja) * 2013-10-16 2015-04-23 三菱電機株式会社 光半導体装置、光半導体装置の製造方法、及び光モジュールの製造方法
CN104979330B (zh) * 2014-04-10 2018-07-13 上海和辉光电有限公司 具有偏移量测量标记的多层结构及其偏移量的测量方法
NL2017466A (en) * 2015-09-30 2017-04-05 Asml Netherlands Bv Metrology method, target and substrate
US10451412B2 (en) 2016-04-22 2019-10-22 Kla-Tencor Corporation Apparatus and methods for detecting overlay errors using scatterometry
US10510676B2 (en) * 2017-11-30 2019-12-17 Taiwan Semiconductor Manufacturing Company, Ltd. System and method for aligned stitching
CN108196408B (zh) * 2017-12-28 2021-03-23 Tcl华星光电技术有限公司 Coa基板的测试键以及使用其的测试方法
CN110071093B (zh) * 2018-01-23 2020-11-27 瀚宇彩晶股份有限公司 显示面板
WO2019166078A1 (de) * 2018-02-27 2019-09-06 Ev Group E. Thallner Gmbh Markenfeld, verfahren und vorrichtung zur bestimmung von positionen
US10705436B2 (en) * 2018-09-27 2020-07-07 Taiwan Semiconductor Manufacturing Co., Ltd. Overlay mark and method of fabricating the same
CN111398314A (zh) * 2020-05-25 2020-07-10 鹤山市中富兴业电路有限公司 一种基于游标的双面pcb检测模块以及对位方法

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE2226149A1 (de) * 1971-11-02 1973-05-10 Halbleiterwerk Frankfurt Oder Verfahren zum erkennen der groesse von lage-, winkel- und ueberdeckungsfehlern bei der herstellung und anwendung von schablonen in der halbleitertechnik
DE2952106C2 (de) * 1979-12-22 1982-11-04 Dr. Johannes Heidenhain Gmbh, 8225 Traunreut Lichtelektrische inkrementale Längen- oder Winkelmeßeinrichtung
US4529314A (en) * 1980-04-18 1985-07-16 Harris Corporation Method of measuring misalignment between levels on a substrate
JPS57101710A (en) * 1980-12-17 1982-06-24 Nec Corp Method of measuring distorsion of projected image and exposing mask used therefore
US4405238A (en) * 1981-05-20 1983-09-20 Ibm Corporation Alignment method and apparatus for x-ray or optical lithography
JPS5883853A (ja) * 1981-11-13 1983-05-19 Nippon Kogaku Kk <Nikon> 投影光学系のディストーシヨン検査方法
US4538105A (en) * 1981-12-07 1985-08-27 The Perkin-Elmer Corporation Overlay test wafer
FR2538923A1 (fr) * 1982-12-30 1984-07-06 Thomson Csf Procede et dispositif d'alignement optique de motifs dans deux plans rapproches dans un appareil d'exposition comprenant une source de rayonnement divergent
JPS59134826A (ja) * 1983-01-21 1984-08-02 Hitachi Ltd バ−ニヤパタ−ン
US4547446A (en) * 1983-06-20 1985-10-15 The Perkin-Elmer Corporation Motion measurement and alignment method and apparatus
US4606643A (en) * 1983-06-20 1986-08-19 The Perkin-Elmer Corporation Fine alignment system
DE3372673D1 (en) * 1983-09-23 1987-08-27 Ibm Deutschland Process and device for mutually aligning objects
JPS6085523A (ja) * 1983-10-17 1985-05-15 Fujitsu Ltd マスク形成方法
US4623257A (en) * 1984-12-28 1986-11-18 At&T Bell Laboratories Alignment marks for fine-line device fabrication
JPS62273725A (ja) * 1986-05-21 1987-11-27 Toshiba Corp マスク合わせ精度評価用バ−ニアパタ−ン
JPS62273724A (ja) * 1986-05-21 1987-11-27 Toshiba Corp マスク合わせ精度評価用バ−ニアパタ−ン
US4742233A (en) * 1986-12-22 1988-05-03 American Telephone And Telgraph Company Method and apparatus for automated reading of vernier patterns
JPS63260045A (ja) * 1987-04-17 1988-10-27 Hitachi Ltd バ−ニアパタ−ン

Also Published As

Publication number Publication date
EP0370834A3 (en) 1991-09-04
DE68929150T2 (de) 2000-09-21
JPH02143544A (ja) 1990-06-01
US5017514A (en) 1991-05-21
DE68929150D1 (de) 2000-03-09
EP0370834A2 (en) 1990-05-30
EP0370834B1 (en) 2000-02-02

Similar Documents

Publication Publication Date Title
JP2666859B2 (ja) 目合せ用バーニヤパターンを備えた半導体装置
US5262258A (en) Process of manufacturing semiconductor devices
US5696835A (en) Apparatus and method for aligning and measuring misregistration
JP2001339049A (ja) 半導体装置、フォトマスクおよび半導体装置の製造方法
US5721619A (en) Misregistration detecting marks for pattern formed on semiconductor substrate
US6271919B1 (en) Semiconductor device and alignment apparatus and alignment method for same
US8847416B2 (en) Multi-layer chip overlay target and measurement
CN102103336A (zh) 基于机器视觉对准的高精度对准标记结构
US9329495B2 (en) Overlay metrology system and method
JPS60210839A (ja) レチクルおよびその検査方法
US6636312B1 (en) Multi-pitch vernier for checking alignment accuracy
JP2595962B2 (ja) 半導体装置
US20050244729A1 (en) Method of measuring the overlay accuracy of a multi-exposure process
JPH0657381B2 (ja) 穴加工位置の補正方法
KR20240058416A (ko) 이미지 기반 오버레이 측정용 오버레이 마크, 이를 이용한 오버레이 측정 방법, 오버레이 측정 장치, 및 반도체 소자의 제조방법
TWI421961B (zh) 晶圓的檢測方法
KR100408722B1 (ko) 스탭퍼 정렬마크
KR20230003846A (ko) 오버레이 마크 및 이를 이용한 오버레이 계측방법 및 반도체 디바이스 제조방법
JP2764925B2 (ja) 半導体装置の製造方法
KR20230003843A (ko) 오버레이 마크 및 이를 이용한 오버레이 계측방법 및 반도체 디바이스 제조방법
JP2001033942A (ja) フォトマスク、露光装置、および半導体ウェーハ
KR20240126587A (ko) 이미지 기반 오버레이 측정용 오버레이 마크, 이를 이용한 오버레이 측정 방법, 오버레이 측정 장치, 및 반도체 소자의 제조방법
KR100795665B1 (ko) 반도체 장치 검사 방법
CN116088282A (zh) 套刻标记结构及套刻偏移检测方法
US5317338A (en) Visual measurement technique and test pattern for aperture offsets in photoplotters

Legal Events

Date Code Title Description
S111 Request for change of ownership or part of ownership

Free format text: JAPANESE INTERMEDIATE CODE: R313117

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20080627

Year of fee payment: 11

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090627

Year of fee payment: 12

EXPY Cancellation because of completion of term
FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20090627

Year of fee payment: 12