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TWI404671B - 微機電元件 - Google Patents

微機電元件 Download PDF

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TWI404671B
TWI404671B TW096109622A TW96109622A TWI404671B TW I404671 B TWI404671 B TW I404671B TW 096109622 A TW096109622 A TW 096109622A TW 96109622 A TW96109622 A TW 96109622A TW I404671 B TWI404671 B TW I404671B
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TW
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substrate
circuit
mems
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TW096109622A
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TW200740687A (en
Inventor
Richard Ian Laming
Mark Begbie
Original Assignee
Wolfson Microelectronics Plc
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Publication date
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Description

微機電元件
本發明係關於一種微機電元件。
隨著科技的進步，消費性電子產品不斷地朝向小型化發展，同時其效能與功能亦不斷地在提升，而此一趨勢可由各類型的消費性電子產品如行動電話、筆記型電腦、MP3播放器與個人數位助理(PDA)等產品所使用之科技的發展上察覺。以行動電話產業為例，現行對於行動電話的要求不斷地朝向輕薄短小、強大功能與低成本的方向演進。因此，整合各類型電子電路之功能，並將上述功能與傳感器元件如麥克風與揚聲器相結合，實為現行產業的發展方向。
為滿足上述需求，目前已發展出以微機電技術為基礎的傳感器元件，例如用於偵測或產生壓力/聲波的電容式傳感器，或是用於偵測加速度之電容式傳感器。現階段的產業發展係不斷地朝向藉由整合微機電元件與用以運算與處理微機電元件所傳遞之資訊的電子電路，以消除傳感器與電子電路間的介面，並進而達到微型化與低成本之目標，而其所面臨的挑戰之一為確保整合後之元件依然能夠在各種不同的操作狀況下保持穩定運作。特別是在會巨幅地影響元件的靈敏度/表現的不同溫度範圍狀況下，必須確保元件對不同溫度能夠具有相對較低的變動性。另外，在製作微機電元件的過程中亦必須提升其與互補式金氧半導體(CMOS)元件製程的相容性。而為提升相容性，必須作到可使用與傳統電子元件相同材料與相同製程來製作微機電元件程度的整合，此為本發明提出之兩項主要目的。
在現行技術中，微型化的矽麥克風已廣泛地被應用，而其主要運作原理為使用一可因應聲波變化作相對運動之微小且可彎曲之隔膜(diaphragm)或薄膜(membrane)。薄膜一般具有導電特性或包含一電極，同時藉由一與薄膜緊密連結且具有穿孔之背板導體與薄膜構成一可變電容，以偵測薄膜之微幅撓曲。上述由薄膜與背板導體所產生之電容值會被量測出並成為傳感器之輸出訊號。傳感器之靈敏度與薄膜的硬度具有相關性：對於一固定聲壓而言，硬度較小之薄膜會產生較大的撓曲，使得電容值產生較大的變化。同時傳感器之靈敏度對於溫度變化的相關性則視薄膜之硬度與溫度的函數關係。
傳統傳感器之電容值介於1－10皮法拉(pF)，然而實際上聲音訊號所產生之電容值變化低於上述數值約略到5個級數(order)。為了量測電容值，對麥克風之一電極施加一偏壓(bias voltage)，例如10V之偏壓，並將另一電極連接至一高輸入阻抗(約10G Ω)之前置放大電路(pre－amplifier)。電壓V、電荷Q與電容C具有如關係式Q＝CV的關係，因此偏壓可於電容中產生一電荷。一般而言，與聲音頻率相關之時間標度(time scale)遠小於電容中電荷消散時間(charge dissipation time)，因此電荷Q可視為常數，藉此當兩電極的距離因受到聲波影響而改變時，會反應在兩電極之間的電位變化上，如此一來即可藉由前置放大電路加以量測。
由於聲音訊號所引發之電容值改變量非常小，元件必須具備極高的靈敏度，因此必須避免電路元件與傳感器之間產生雜散電容(stray capacitance)。再者，在設計上亦希望能直接將傳感器與電子電路整合，以達到微型化與低成本的優勢，甚至達到完全整合的程度，使元件具有數位處理的能力。為了達到上述目標，在傳感器的製作上製程與材料必須與電子元件，特別是CMOS元件的製程與材料相容。例如，應避免使用金，以防止金造成污染並影響接面(junction)，而宜使用一般材料與製程，同時須避免使元件承受400℃以上之製程溫度。
先前技藝中存在幾種不同薄膜懸浮結構設計及其實施方式，且其靈敏度隨設計不同而有極大的差別。
在先前技藝中，Kabir et al.(參考資料1)提出一種微機電麥克風之實施方式，其中其薄膜係由厚矽層所構成，且薄膜之邊緣可作微幅地運動。薄膜係以類活塞(piston－like)方式運動且其靈敏度視薄膜之慣性質量與彈性邊緣(sprung edge)的硬度不同而定。然而在此實施方式中，薄膜的厚度相當厚，使得元件的靈敏度較低。此外，使用金材料的背板的作法排除了在製作上與CMOS元件製程直接整合的可能性。
Scheeper et al.(參考資料2)提出了另一種微機電麥克風之實施方式，其中薄膜係以如鼓皮般被拉撐著，因此靈敏度係視薄膜之張力與厚度而定。在使用氮化矽薄膜並考慮其尺寸的情況下，由於薄膜之應力、背板之氣孔密度與薄背板的使用，造成麥克風的靈敏度偏低。
Pederson et al.(參考資料3)提出一種與CMOS電子電路整合之麥克風。在此實施方式中，薄膜與背板之材質係使用聚亞醯胺(polyimide)，使得薄膜的應力降低。另外，背板的厚度較厚亦可增加背板的硬度。然而，由於聚亞醯胺之熱膨漲係數較高，並非製作元件的較佳材料。
Cunningham et al.(參考資料4)提出了一種使用氮化矽薄膜的微機電麥克風元件。在此實施方式中，薄膜之外圍部分具有皺摺設計，以降低內應力並使薄膜之連結較為鬆散。然而，此種設計需進行額外步驟因此成本較高。
Loeppert et al.(參考資料5)提出了一種具有自由懸浮(free float)結構且無應力之薄膜，其中薄膜係利用靜電固定於一支撐環上。在此實施方式中，元件之靈敏度係視薄膜之厚度與材料參數而定，然而其製程較為複雜因此成本較高。另外，由於薄膜必須自由懸浮，因此其無法如拉撐之薄膜般具有較薄之厚度。再者，儘管薄膜本身不具應力，但若在薄膜上沉積有電極的情況下還是會產生差應力(differential stress)，而導致靈敏度受到限制。
根據本發明之第一作法，提供了一種微機電元件，包含有：一傳感器具有至少一固定於一基底上之薄膜；以及一電子介面裝置(electrical interface means)用以使電子訊號與薄膜之運動產生關聯。傳感器另包含有應力緩衝結構(stress alleviating formation)位於薄膜之範圍內，且應力緩衝結構至少在部分程度上使薄膜與基底之膨漲或收縮脫鉤。
根據本發明之實施例，應力緩衝結構係位於薄膜之範圍內，且並未破壞薄膜或造成薄膜破裂。
較佳地，應力緩衝結構包含有穿透薄膜平面之孔洞(hole)，而應力緩衝結構亦可不設置孔洞，而包含有溝槽，其係指在薄膜上具有縮減之厚度，但未穿透薄膜平面的區域。因此應力緩衝結構可視為與薄膜共平面(in－plane)。根據本發明之一實施例，可另形成一層或複數層覆蓋層(covering layer)，覆蓋或密封住應力緩衝結構。例如，薄膜上可形成複數個被一薄金屬層密封之孔洞或溝槽。覆蓋層的作用在於減少或阻擋氣流。
應力緩衝結構可位於一延伸至薄膜周邊之應力釋放區(stress release region)中。較佳地，薄膜係固定於基底上使得應力釋放區至少與基底部分重疊。因此，應力釋放區較佳至少部分位於基底內。
根據本發明之第二作法，提供了一種微機電元件，包含有一傳感器具有至少一設於一基底上之薄膜；以及一電子介面裝置用以使電子訊號與薄膜之運動產生關聯，其中薄膜之熱膨漲係數與矽的熱膨漲係數大體上接近相匹配。
傳感器可包含有一由複數種材料構成之複合薄膜結構。例如，複合薄膜結構可包含有例如由金屬/氮化物/金屬或氮化物/金屬/氮化物構成之三明治結構，且三明治結構中包含一第一電極。根據本實施例，複合薄膜結構較佳地係僅設在電極區域，複合薄膜結構可包含一由鋁/氮化矽/鋁組成之三明治結構，其厚度可分別為例如50/400/50奈米，如此一來可平衡鋁與氮化矽之間膨漲/應力之不協調(mismatch)，也因此可使因不同材料層之應力不同導致薄膜拱起的情況減到最低。除了上述結構之外，三明治結構亦可由二層氮化矽層夾一鋁電極所構成，其中各層厚度可分別為例如200/50/200奈米。根據本發明此作法，包含有複合薄膜結構之主要材料的熱膨漲係數在選擇上係為了使複合薄膜結構之組合熱膨漲係數與矽材料之熱膨漲係數相匹配。
根據本發明之第三作法，提供了一種微機電元件，包含一傳感器具有至少一固定於一基底上之薄膜，以及一電子介面裝置用以使電子訊號與薄膜之運動產生關聯，其中傳感器另包含有一背板，且背板具有另一電子介面裝置，用以使電子訊號與薄膜之運動產生關聯。設置背板的作用在於背板於薄膜之間形成一腔穴(cavity)，且背板的硬度係設定為大於薄膜的硬度的10倍以上。
根據本發明之第四作法，提供了一種微機電元件，包含一傳感器具有至少一固定於一基底之薄膜、一電子介面裝置用以使電子訊號與薄膜之運動產生關聯，以及一應力脫鉤裝置(stress decoupling means)用以至少部分地使傳感器與基底脫鉤。
根據上述作法之一實施例，係藉由控制薄膜的形狀以形成應力脫鉤裝置，在此實施例中薄膜可被固定於基底上，但係以薄膜之平面與基底之上表面分離的方式固定。然而除上述方式外，亦可利用控制薄膜形狀的方式使薄膜的剖面輪廓產生一空槽(trough)或不連續區段，而此一區段的作用如同一力釋放區段(stress release section)，可使得傳感器在應力上與基底脫鉤，而不受基底之影響。
根據本發明之第五作法，提供了一種微機電元件，包含一傳感器具有至少一固定於一基底之薄膜，以及一電子介面裝置用以使電子訊號與薄膜之運動產生關聯，其中薄膜係以分離薄膜之平面與基底之上表面的方式固定於基底上。
根據本發明之另一作法，提供了一種微機電元件，包含一傳感器具有至少一固定於一基底之薄膜，以及一電子介面裝置用以使電子訊號與薄膜之運動產生關聯，其中傳感器包含複數個應力緩衝結構位於薄膜之範圍內，且應力緩衝結構至少部分地使薄膜與基底之膨漲或收縮脫鉤。
本發明任一作法之元件可具有一與電子介面裝置連接運作之電子電路，以形成一整合之元件。
另外，本發明可提供設置有本發明各實施例所揭示之元件在內的微機電麥克風、壓力感測器或超音波感測器。
本發明之一較佳實施例提供了一種微機電元件，包含有一具有電路區之基底，電路區與基底被一絕緣暨保護層所保護以形成一晶圓結構。電路區包含有電路內連接(circuit interconnect)，而絕緣暨保護層具有蝕刻出之連接端點大體上對應電路內連接。微機電元件另包含有一薄膜，部分覆蓋絕緣暨保護層且在結構上與一第一電極相接以形成一具有一第一側與一第二側之薄膜結構。第一電極係透過一連接端點與上述電路區之其中之一連接運作。微機電元件另包含有一穿孔之背板，且背板與薄膜結構之第一側形成一腔穴。背板與薄膜結構構成一感應結構，且一第二電極透過一連接端點與電路區之其中之一連接運作。微機電元件另具有一孔洞穿透晶圓結構，且孔洞大體上對應薄膜結構之第一側，其中薄膜結構具有共平面之應力釋放孔洞，設置於薄膜結構之周圍。
以下將配合本發明之圖式說明本發明之各較佳實施例。
第1a圖為本發明第一實施例之示意圖，其顯示了一作為電容式麥克風1002之微機電元件的剖面示意圖。本發明之元件製作係由一矽材質之基底110開始(在此實施例中，使用矽基底係為了與CMOS電子電路整合，但亦可視需要使用其它材質之基底與其它電子製作技術)。為了處理麥克風1002輸出之訊號，元件係與利用標準CMOS製程製作於基底110上之電路區111電性連接。電路區111包含有鋁內連線(aluminum circuit interconnect)113，且藉由連接端點(interconnect point)114與麥克風1002電性連接。另外為了保護電路區111，電路區111與基底110之其它部分上覆蓋一由氧化矽基絕緣暨保護層(silica based insulating and protective layer)112。連接端點114係指蝕刻氧化矽基絕緣暨保護層112所產生之曝露出部分鋁內連線層113之孔洞。
麥克風1002本身係由一可彎曲之薄膜116與一堅硬之背板118所製作出，其中薄膜116在結構上係連接至一第一電極115，背板118在結構上則連接至一第二電極117，而薄膜116與背板118之間則存在一氣隙(air gap)121，藉以容許薄膜116因應聲波造成之壓力差以產生相對之運動。第一電極115係透過一連接端點114與電路區111之其中之一電性連接。在結構上，第一電極115係與薄膜116連接，且懸浮於基底110之一開口120上。基底110之開口120的設置使得薄膜116可因應聲波造成之壓力差產生相對之運動。薄膜116的材質可為氮化矽或其它任何適用於製作微機電元件之薄膜的材質，例如多晶矽。另外，薄膜116亦可為金屬/氮化物/金屬或氮化物/金屬/氮化物構成之三明治結構的一部分。在本實施例中，第一電極115的較佳材料為鋁但不限於此，該領域具通常知識者應知悉第一電極115的材料可包含任何導電性材料例如鋁矽(AlSi)、鋁矽銅(AlSiCu)、鈦(Ti)、鈦化鎢(Tiw)、銅(Cu)、鎳(Ni)、鎳鉻(NiCr)、鉻(Cr)、鉑(Pt)、鉭(Ta)或鈀(Pd)等適用於作為電極之等材料。
第二電極117係附於一剛性結構層或背板118，並懸浮於薄膜116之上。第二電極117在結構上係與背板118連接，且透過一連接端點114與電路區111之其中之一電性連接。在本實施例中，第二電極117的較佳材料為鋁但不限於此，該領域具通常知識者應知悉第二電極117的材料可包含任何導電性材料例如鋁矽(AlSi)、鋁矽銅(AlSiCu)、鈦(Ti)、鈦化鎢(Tiw)、銅(Cu)、鎳(Ni)、鎳鉻(NiCr)、鉻(Cr)、鉑(Pt)、鉭(Ta)或鈀(Pd)等適用於作為電極之等材料。另外，為了避免背板118與薄膜116之間形成密閉空間而影響麥克風正常運作，背板118上設置有通氣孔(vent holes)119，以容許氣體分子自由運動。
第1b圖係為本發明第一實施例之上視圖。如第1b圖所示，由於薄膜116之周圍部分受限於其無法作較大幅度的運動，其電容值相較之下為一固定值，因此第一電極115並未完全覆蓋薄膜116。在本發明第一實施例中，第一電極115的直徑約為薄膜116之直徑的70%，而實際上即使第一電極115的直徑低於薄膜116的直徑之55%亦可運作，且該領域具通常知識者應知悉在其它數值比例下亦可發揮類似的效果。第一電極115係利用一由薄膜116之邊緣延伸出之微小的電極凸出部(electrode tab)122連接鋁內連線層113，藉此透過連接端點114電性連接至一電路區111。
本發明第一實施例利用控制薄膜116之應力以及使薄膜116與第一電極115之組合熱膨漲係數與矽之熱膨漲係數相匹配的方式，達到減少微機電麥克風之溫度相依性與增進靈敏度的目標。由於薄膜116與基底110之熱膨漲係數差異會使薄薄116產生應力，且因為元件的敏感度與薄膜應力呈反比關係，因此選擇相對低的薄膜應力可提升元件的靈敏度。然而，在習知元件中溫度的細微變化可能導致元件靈敏度的大幅改變，或是導致薄膜張力完全釋放而造成元件失效。鑑於此本發明之第一實施例意欲解決此一問題。
本實施例利用控制氮化矽薄膜116之沉積製程的製程參數，藉以調整形成之薄膜116的應力，來達到上述目標。首先，沉積並圖案化一鋁層形成第一電極115，並選擇製程參數將沉積之薄膜116的張應力控制在5－50 MPa的範圍內。由於矽基底的熱膨漲係數一般較氮化矽之熱膨漲係數高，在沒有沉積電極的狀況下薄膜的張力會隨著溫度升高而增加。相較之下，鋁或其它電極材料之熱膨漲係數較矽基底之熱膨漲係數為高，因此本實施例使用一複合薄膜結構，並使其由薄膜與電極之熱膨漲係數共同構成之組合熱膨漲係數與矽基底之熱膨漲係數接近相匹配。請參考表一，表一列出了本實施例之較佳材料的特性(資料出處：P.R Scheeper,”A silicon condenser microphone：materials and technology”ISBN 90－9005899－0,page 54)。
薄膜116與第一電極115個別的厚度，可利用下列鋁厚度(tal)與氮化矽厚度(tsn)的厚度比值公式求出：
其中t為結構元件之厚度、E為楊氏係數、α為熱膨漲係數、v為波森比(poisson’s ratio)，而下標al、sn、si分別表示鋁、氮化矽與矽。由上式得出第一電極115的厚度約近似於氮化矽隔膜層116的厚度的七分之一，而若欲更精確的估算，則必須考量電極的面積與各材料的波森比並利用數值模擬方式計算。另外由於材料參數與製程條件亦具有相關性，因此材料參數係經由實驗結果所得出。此外，為了避免不同層材料之間的應力差導致薄膜變曲，可使用金屬/氮化物/金屬或氮化物/金屬/氮化物構成的三明治結構。而為了確保獲致最佳化的元件靈敏度，在本實施例中背板118一般具有較薄膜116十倍以上的硬度。為了避免背板118的厚度過厚，背板118亦可具有較薄膜116為高的應力。
以下針對第一實施例之運作過程加以說明。當一縱向之壓力波進入麥克風時，薄膜116會受到壓力波造成之音波的影響，產生微幅的形變而偏離其平衡位置。在此狀況下，第一電極(下電極)115與第二電極(下電極)117之間距會產生相對應之改變，造成兩電極之間電容值的改變，而電路區111可偵測出此一電容值變化。
第2a圖與第2b圖為本發明第二實施例之示意圖，其中第2a圖為一具高靈敏度與低溫度相依性之微機電麥克風227的剖面示意圖，第2b圖為一上視圖。
第二實施例之微機電麥克風的架構與前述實施例類似，然而藉由蝕刻薄膜216之周圍區域形成之應力釋放結構(stress release structure)，使得麥克風227之靈敏度與溫度變化具有相對較低的相關性。應力釋放結構有效地減少了此區域的楊氏係數(Young’s modulus)。
請參考第2b圖與第3圖，第一電極215在結構上係與薄膜216相連。第一電極115係利用一電極凸出部222與一連接端點114與鋁內連線層113電性連接。應力釋放孔洞(stress release hole)223係藉由蝕穿薄膜216方式形成，並位於薄膜216之周圍的應力釋放區226。另外本實施例之作法移除了應力釋放孔洞223下方之一小部分的絕緣暨保護層112，形成了一外圍腔穴(perimeter cavity)225，以減少(damp)通過薄膜216的氣流310。此外，薄膜216與基底110的間距非常接近，藉此可提供低頻率響應。應力釋放區226可大體上與基底110重疊，或亦延伸出基底110之邊緣224而使得應力釋放孔洞223的區域至少部分與微機電麥克風之開口120重疊。
第4圖顯示了部分之應力釋放孔洞223以及其周圍之應力模擬狀況，其中第4圖下方之應力指標(stress indication bar)顯示了應力值由左至右的量值為0－100 MPa。本模擬係利用與第二實施例之薄膜相同之薄片(slice)所獲致。在本模擬中，薄片之長度為500微米、寬度為10微米，厚度則為0.4微米，但並不限於此而可為其它尺寸。另外，薄片之二側平面係藉由對稱之力量加以固定。如第4圖所示，應力釋放孔洞223包含有三行孔洞，且在本模擬中孔洞為橢圓形，其沿長軸(major axis)方向之長度為24微米，而沿短軸(minor axis)方向之長度為6微米。然而，應力釋放孔洞223可為其它形狀，例如圓形。與未設置應力釋放孔洞之薄膜的模擬應力狀況(未顯示)相比較，未設置應力釋放孔洞之薄膜之應力值與其在沉積形成時的應力值相當，為25 MPa，而由本模擬結果可知大部分之薄膜應力值已降至4 MPa，而僅應力釋放孔洞223附近的應力略有上升。
其它的模擬結果顯示應力釋放孔洞223可將應力值大約縮減為原來的1/5，例如對一直徑為5毫米之薄膜而言，未設置應力釋放孔洞233時之應力為100 MPa，而設置應力釋放孔洞233後之應力約為20 MPa。另外，在未設置應力釋放孔洞233時應力的增加與溫度變化之關係估計約為0.2 MPa/℃，而在設置應力釋放孔洞233時應力與溫度變化的關係則變為約0.04 MPa/℃。上述結果顯示了設置應力釋放孔洞可以使元件之靈敏度增加5倍，且相較於習知元件，本實施例之元件在靈敏度處於可比較之基凖下時，靈敏度與溫度相關性亦可大幅減小。
第5圖為本發明第三實施例之微機電麥克風500之示意圖。第一電極(薄膜電極)715係透過一連接端點114連接至一電路區111，而第二電極(背板電極)717係透過另一連接端點114連接至另一電路區111。在本實施例中，薄膜716係貼附於一堅硬之背板718上，且背板718之應力與基底110之應力無關聯。由第5圖可知，傳感器之薄膜716係固定於基底110之上，且使得薄膜716之作動平面(working plane)與基底110之上表面不相連，亦即薄膜716之作動平面與基底110之上表面呈不連續狀。一般而言，薄膜716的厚度約介於0.3－1微米，背板718的厚度則介於3－10微米，上述厚度參數確保了背板718的強度足以支撐薄膜716。同樣地如第5圖所示，背板718與薄膜716形成一感應結構(sensor structure)，由於感應結構與基底110之間所包含的應力釋放區722使得感應結構與基底110之應力脫鉤。應力釋放區722在水平之x方向與y方向上(基底的運作方向，亦即熱膨漲/收縮方向)相對而言較為柔軟，而在垂直之z方向上較為堅硬，藉此保持高靈敏度。設置於背板718與基底110之間的應力釋放區722大幅地縮減了背板的應力，使其可依溫度的變化而膨漲或收縮。一般而言，沉積之薄膜716的殘留張應力約介於10－50 MPa，而由於背板718與薄膜716匹配之熱膨漲係數，靈敏度與溫度的相關性因而大幅減少。
以下配合第6圖與第7a－7e圖說明製作本發明第一實施例之方法。如第6圖之步驟s111與第7a圖所示，於一CMOS矽晶圓或基底110上利用標準製程如離子佈植、微影、沉積與蝕刻等製作出電路區111。電路區111可包含有任何可與微機電麥克風電性連接溝通之電路。例如，電路區111可包含有前置放大電路，以放大麥克風之輸出訊號。電路區111亦可選擇性地包含一類比數位訊號轉換電路(analogue－to－digital converter,ADC)，用以將麥克風或前置放大電路之輸出訊號轉換為數位訊號。另外，電路區111亦可包含下列電路之其中之一或全部：電荷幫浦電路(charge－pump)、濾波電路(filer)、多工電路(multiplexer)、數位訊號處理電路與收發電路(transmitter/receiver)等。然而該領域具通常知識者應知悉任何可與麥克風電性連接溝通之電路均可包含於電路區111之內。
電路區111之鋁內連線層113一般係利用濺鍍製程製作。為了保護鋁內連線層113，再於鋁內連線層113上形成一氧化矽基絕緣暨保護層112。另外，亦可形成一蝕刻停止層，例如利用電漿增強化學氣相沉積製程沉積氮化矽或氧化矽，其中蝕刻停止層之材質不限於純氧化矽，亦可為可於低溫沉積之硼磷矽玻璃(BPSG)。
在本實施例中，第二電極(上電極)117與第一電極(下電極)115為鋁電極，而在此狀況下電極可能於蝕刻基底之開口時被侵蝕，因此可利用蝕刻停止層加以保護，而蝕刻停止層可於後續製程中輕易利用如溼蝕刻加以去除。
為了完成微機電麥克風與電路區111之電性連接，可利用使用阻擋層(resist)與四氟化碳/氫氣(CF4 /H2 )之混合氣體的乾蝕刻蝕穿部分摻雜之氧化矽層以如第7b圖所示曝露出連接端點114。
如步驟s112所示，沉積第一電極115，例如使用Oxford Plasma Lab機台濺鍍鋁，將功率設在1000W，壓力設在2.7 mTorr，並通入流量為50 sccm(standard cubic centimeters per minute)之氬氣。在目標厚度設定為1000埃的狀況下，實際沉積出之電極厚度約為976埃。除上述作法之外，第一電極115亦可於步驟s111製作電路區111時一併加以沉積。沉積第一電極115之方法較佳為使用濺鍍，其原因在濺鍍之製程溫度相較於其它方法如熱蒸鍍(thermal evaporation)為低，而此作法亦確保本實施例之方法可與CMOS製程相容。另外，在使用鋁以外之材料沉積的狀況下，本方法亦具有可精確控制沉積之薄膜的組成的優點。
濺鍍係全面性之沉積製程，因此沉積出之薄膜必須利用微影技術定義出第一電極115之形狀。使用一Brewer Science CEE 6000塗佈機台以2500 rpm之轉速將一光阻(Shipley SPR350)旋轉塗佈於晶圓上，再於90℃下進行一軟烤(soft bake)。接著利用曝光以形成預定電極圖案，再於110℃下進行一曝光後烘烤。隨後再利用MF－26A顯影劑進行顯影。接著利用Plade Wet Deck蝕刻機台中，在50℃下使用Rockwood鋁蝕刻液進行60秒之蝕刻製程，將未被光阻保護之鋁蝕除以形成第一電極115。上述製程參數與條件僅為範例，該領域具通常知識者應知悉其它任何與CMOS製程相容之微影與蝕刻技術均可視需要加以應用。例如電極的材料可為鋁(Al)、鋁矽(AlSi)、鋁矽銅(AlSiCu)、鈦(Ti)、鈦化鎢(Tiw)、銅(Cu)、鎳(Ni)、鎳鉻(NiCr)、鉻(Cr)、鉑(Pt)、鉭(Ta)或鈀(Pd)等。
如步驟s113與第7b圖所示，接著利用電漿增強化學氣相沉積形成一薄膜116，且透過給予適當之壓力、溫度、射頻與直流偏壓，並通入適當的混合氣體以獲致所欲之組成與應力特性。薄膜116的沉積係於300℃下通入流量為40 sccm之矽烷(silane,SiH4)、40 sccm之氨氣(Ammonia)及1400 sccm之氮氣加以達成。電漿增強化學氣相沉積製程之射頻功率可為20W，並可以每6秒交替變換之高頻(13.56 MHz)與低頻(400 kHz)以變頻方式進行。為了定義薄膜116之形狀，還需使用光阻並使用四氟化碳/氫氣之混合氣體進行乾蝕刻。薄膜116之材料可為例如氮化矽或多晶矽。
接著利用一犧牲層910以形成懸浮之背板118。犧牲層910(如第7c圖所示)將於步驟s119時被去除，以定義出腔穴(氣隙)121。為了確保與CMOS製程的相容性，犧牲層910可由能利用乾式方式輕易加以去除之各種材料所構成，且此一作法具有在犧牲層910去除後不需進行額外步驟或清洗的優點。聚亞醯胺由於可輕易旋轉塗佈於基底，並可利用氧氣電漿去除，因此為作為犧牲層的較佳材料。若利用上述方式去除犧牲層，則將基底載入一反應室並設定電漿，再將氧氣通入反應室，電漿中的氧氣會與有機之犧牲層反應產生揮發性的氧化物，並由反應室中被移除。然而值得說明的是，犧牲層910亦可為其它材料如多晶矽。
如步驟s114所示，利用CEE 100旋轉塗佈機台在轉速為3000 rpm下進行旋轉塗佈，將一聚亞醯胺層旋轉塗佈於晶圓上以形成一均勻覆蓋塗層(conformal coating)。接著在常壓下的空氣中以200℃烘烤30分鐘，再於常壓下通入氮氣以300℃烘烤30分鐘。犧牲層之材料可使用Hitachi Dupont聚亞醯胺(PI2610)，而聚亞醯胺可使用HD VM651作為塗底層。在設定犧牲層之目標厚度為20,000埃的狀況下，實際沉積出之厚度約為21,514埃。值得說明的是上述製程參數僅為範例，該領域具通常知識者應知悉其它任何適用於在基底上沉積聚亞醯胺之製程條件均可視需要加以應用。
隨後利用Brewer Science CEE 6000塗佈機台進行一微影製程以定義犧牲層的形狀，將HPR206光阻以700 rpm之轉速旋轉塗佈於晶圓上，並於100℃進行軟烤。接著不進行曝光後烘烤並利用MF－26A顯影劑進行顯影。隨後利用Plasmatherm反應性離子蝕刻(RIE)機台以500W之功率進行反應性離子蝕刻以去除犧牲層910之曝光部分。圖案化後之犧牲層910定義出腔穴121的形狀，且犧牲層910將於後續步驟s118時被去除。
如步驟s115與第7d圖所示，沉積並圖案化一第二電極(上電極)117與一堅硬之氮化矽結構層，即背板118。第二電極117係利用濺鍍鋁的方式形成，如同步驟s112時製作第一電極115的方式與參數。背板118係利用Surface Technology Systems(STS)電漿增強化學氣相沉積機台在300℃之溫度與900 mTorr之壓力下以電漿增強化學氣相沉積製程加以形成。氮化矽的沉積係藉由於反應室中通入混合氣體的方式加以形成。氣體的種類與流量為：氮氣(流量為1960 sccm)；矽烷(流量為40 sccm)；氨氣(流量為40 sccm)。為了達到預定之應力，製程的射頻功率設定為20W，並以高頻(13.56 MHz)與低頻(400kHz)交錯方式進行。然而值得說明的是該領域具通常知識者應知悉上述製程氣體成分與參數僅為範例。接著藉由類似步驟s112的作法利用微影暨蝕刻技術圖案化氮化矽以定義出通氣孔119。通氣孔119可容許氣體自由進行腔穴以使得薄膜可因應聲波產生動作。為了於後續製程中保護薄膜，接著於晶圓上方旋轉塗佈一層厚度約數微米的阻擋層，阻擋層除了可保護薄膜外，亦可避免通氣孔119被後續單體化製程時可能產生之碎片堵塞。
如步驟s116與第8圖所示，為了容許薄膜可因應音波而自由運動，接著利用約8微米厚之阻擋層進行乾蝕刻以於基底110相對於電路區111與背板118之另一側形成音孔(sound port hole)120。乾蝕刻之方式為在Surface Technology Systems Inductively Coupled Plasma(STS ICP)機台中通入六氟化硫(SF6 )/八氟環丁烷(C4 F8 )進行反應性離子蝕刻。於反應性離子蝕刻蝕除位於薄膜下方之矽基底110之後，接著再利用無水氫氟酸蒸氣(anhydrous HF vapour)蝕除氧化矽基絕緣暨保護層112。除了乾蝕刻方式之外，亦可利用溼蝕刻蝕刻矽基底110形成音孔120，在此狀況下利用光阻於晶圓之背面製作出一圖案，並將此圖案轉移至一先形成於晶圓背面之薄膜層，例如熱氧化層或氮化矽層，且此薄膜層具有不為溼蝕刻藥劑侵蝕之特性。上述圖案通常為方形，且於晶圓之晶格面對應。溼蝕刻係利用一包含有22%之氫氧化四甲基銨(TMAH)與78%之水組成之水溶液進行，以於對應薄膜處形成一較小之方形開口。如步驟s117所示，將包含有複數微機電麥克風之晶圓進行切割，使得切割出之單一晶粒僅包含有一個元件(或一組可發揮特定功能之元件)，此一步驟稱為單體化。值得說明的是在本文中所述之元件可包含有微機電麥克風與電路區。單體化係於去除犧牲層之步驟s118之前進行。本實施例之方法具有下列優點：首先犧牲層在單體化過程中提供了薄膜結構上的支撐；另外阻擋層避免通氣孔119被後續單體化製程時可能產生之碎片堵塞。
本發明進行單體化之方法可為下列方式之任一者：利用高轉速鑽石切割刀具；進行雷射切割；或於晶圓上沿著晶軸方向形成切割道並將晶圓沿晶軸方向分裂。本發明單體化較佳的方式為利用Disco DAD 680切割機台並採用寬度為30微米之切割刀具，此一作法具有低成本且不似雷射切割會產生高溫與形成切割道會產生過大應力的缺點。本實施例單體化係將基底之底部貼附至一載具上，用以支撐基底。載具通常使用耐高溫膠帶，而耐高溫膠帶可為任何可承受去除犧牲層步驟之製程溫度的材質。在單體化過程中，犧牲層910提供薄膜支撐與保護，而阻擋層則避免通氣孔119被後續單體化製程時可能產生之碎片堵塞。在單體化製程後，切割出之單一晶粒僅包含有一個元件(或一組可發揮特定功能之元件)，且各晶粒大體上具有平直的側壁。
如步驟s118所示，接著去除犧牲層910，此一步驟稱為灰化(ashing)製程。此時單體化後之基底仍貼附於膠帶上，接著再將基底固定於一切割框架(dicing frame)上並利用氧氣電漿製程去除阻擋層與聚亞醯胺。通常氧氣電漿製程係於150℃進行約3小時(40%氧氣、350 W、660 mTorr)。然而，該領域具通常知識者應知悉其它任何適用於去除聚亞醯胺犧牲層之製程條件均可視需要加以應用。例如利用高溫直接晶圓加熱方式，並利用混入氮氣之氧氣電漿去除聚亞醯胺犧牲層。另外，若利用其它方式如使用低溫微波輔助電漿(microwave assisted plasma)蝕刻，則可能需額外進行一150－200℃的回火(anneal)步驟，以控制鋁的應力。
最後如步驟s119與第8圖所示，以手工方式藉由真空吸盤(vacuum pad)將微機電麥克風自切割膠帶上移除，並將微機電麥克風固定於一封膠體1108中。另外，上述作法亦可由使用自動選放(automated pick and place)系統的作法取代。封裝體1108可為任何適用於電性連接能夠與麥克風電性溝通之元件的封裝體。
為了確保與CMOS製程的相容性，在微機電麥克風元件的製作過程中必須嚴格控制製程溫度，例如將製程溫度限制在400℃以下。
第8圖顯示了本發明第一實施例之微機電麥克風的外觀示意圖。麥克風晶片1000係藉由一適合之黏著劑固定於封裝體1008之貼片區(chip mounting area)1003內。麥克風1002透過電路區11電性連接至晶片接觸墊(chip contact pad)1006，而晶片接觸墊1006則透過導線1001以拉線方式連接至設置於封裝接觸墊區1004之封裝接觸墊(package contact pad)1007。導線1001之材質例如可為金，或亦可為鋁。然而，該領域具通常知識者應知悉其它適用於作導線之材質均可用以本發明電性連接晶片接觸墊1006與封裝接觸墊1007。封裝接觸墊1007電性連接至封裝接腳(package contact)1009以對外電性連接至一印刷電路板。儘管第8圖中封裝接腳1009的數目為8個，但該領域具通常知識者應知悉封裝接觸墊1007與封裝接腳1009的數目亦可加以變更。
麥克風的一般尺寸如下：直徑約1毫米、薄膜厚度約0.3－1微米、電極厚度約0.1微米、背板厚度約2－5微米。
值得說明的是該領域具通常知識者應暸解上述本發明第一實施例之方法並不侷限於製作微機電麥克風。例如，上述方法可省略步驟s116蝕刻基底下方之開口的步驟，以製作一超音波傳感器(ultrasonic transducer)。在沒有背面開口的情況下，背板與電極即形成薄膜的一部分。在適當的尺寸選擇下(尺寸以較前段所述之尺寸為薄為較佳)，背板/電極可如超音波傳感器般被驅動。若將開口再密封，則可形成一浸入式傳感器(immersion transducer)。另外在沒有背面開口或在開口再密封的情況下，電容對於絕對壓力的反應較靈敏，而非對差壓。再者，上述方法亦可用於製作壓力感測器，或一元件陣列，其中元件陣列可包含麥克風、超音波傳感器與壓力感測器之任一者或全部。上述元件陣列搭配適當的電路與訊號處理將可作為指向性之麥克風之用。
以下配合第6圖與第7a－7e圖說明製作本發明第二實施例製作元件之方法，其中第二實施例與第一實施例類似，故相同部分不再贅述。在第二實施例中，應力釋放孔洞係利用Plaamatherm反應性離子蝕刻機台蝕穿薄膜所形成，此一步驟係於步驟s115與步驟s116之間進行。本製程的製程參數較佳為使用750 W之功率與60 mTorr之壓力，另外通入流量為60 sccm之四氟化碳與10 sccm之氫氣，然而該領域具通常知識者應知悉其它製程參數與條件亦可應用。
根據本發明之第二實施例，製作外圍腔穴225的方法之一為使用無水氫氟酸蒸氣蝕刻矽加以形成，而此一步驟可於步驟s116製作基底之背面開口的步驟後進行。無水氫氟酸蒸氣會等向性地蝕刻矽，而腔穴的大小由製程時間決定。在本實施例中，電極材料必須選擇耐氫氟酸材料，例如鋁矽。另外，該領域具通常知識者應暸解在可達到相同目的之情況下，本發明之製程順序可視需要加以變更，且第二實施例之方法製作出之元件亦可如第8圖所示以類似第一實施例之作法固定於一封裝體。
該領域具通常知識者應知悉上述第二實施例之方法並不侷限於製作微機電麥克風。例如，上述方法可省略步驟s116蝕刻基底下方之開口的步驟，以製作一超音波傳感器(ultrasonic transducer)。在沒有背面開口的情況下，背板與電極即形成薄膜的一部分。在適當的尺寸選擇下(尺寸以較前段所述之尺寸為薄為較佳)，背板/電極可如超音波傳感器般被驅動。若將開口再密封，則可形成一浸入式傳感器(immersion transducer)。另外在沒有背面開口或在開口再密封的情況下，電容對於絕對壓力的反應較靈敏，而非對差壓。再者，上述方法亦可用於製作壓力感測器，或一元件陣列，其中元件陣列可包含麥克風、超音波傳感器與壓力感測器之任一者或全部。上述元件陣列搭配適當的電路與訊號處理將可作為指向性之麥克風之用。
以下配合第6圖與第7a－7e圖說明製作本發明第三實施例製作元件之方法，其中第三實施例與第一實施例類似，故相同部分不再贅述。在第三實施例中，於步驟s112沉積第一電極之前，先於基底上旋轉塗佈一厚聚亞醯胺層。接著利用微影技術圖案化厚聚亞醯胺層以於薄膜與背面下方形成一應力釋放結構。另外該領域具通常知識者應暸解第三實施例之方法製作出之元件亦可如第8圖所示以類似第一實施例之作法固定於一封裝體。
該領域具通常知識者應暸解上述各實施例所製作出之部分或所有元件可加以組合應用以減少微機電元件對溫度的相依性。此外，上述各實施例之方法可用於製作一元件陣列，其中元件陣列可包含有第一實施例之麥克風；第一實施例之超音波傳感器；第一實施例之壓力感測器；第二實施例之麥克風；第二實施例之超音波傳感器；以及第三實施例之麥克風之其中部分或所有之元件。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
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1002．．．電容式麥克風
110．．．基底
111．．．電路區
112．．．氧化矽基絕緣暨保護層
113．．．鋁內連線
114．．．連接端點
115．．．第一電極
116．．．薄膜
117．．．第二電極
118．．．背板
119．．．通氣孔
120．．．開口
122．．．電極凸出部
215．．．第一電極
216．．．薄膜
222．．．電極凸出部
223．．．應力釋放孔洞
224．．．邊緣
225．．．外圍腔穴
226．．．應力釋放區
310．．．氣流
500．．．微機電麥克風
715．．．第一電極
716．．．薄膜
717．．．第二電極
718．．．背板
722．．．應力釋放區
910．．．犧牲層
11．．．電路區
1000．．．麥克風晶片
1001．．．導線
1002．．．麥克風
1003．．．貼片區
1004．．．封裝接觸墊區
1006．．．晶片接觸墊
1007．．．封裝接觸墊
1008．．．封裝體
1009．．．封裝接腳
第1a圖與第1b圖為本發明第一實施例之示意圖；第2a圖與第2b圖為了本發明第二實施例之示意圖；第3圖為第二實施例之應力釋放孔洞之放大示意圖；第4圖顯示了第二實施例之薄膜薄片的應力模擬狀況；第5圖為本發明第三實施例之示意圖；第6圖為製作本發明第一實施例之微機電麥克風之流程圖；第7a圖至第7e圖為製作本發明第一實施例之微機電麥克風之方法示意圖；第8圖為第1a圖與第1b圖之微機電麥克風固定於一封裝體上之示意圖。
1002．．．電容式麥克風
110．．．基底
111．．．電路區
112．．．氧化矽基絕緣暨保護層
113．．．鋁內連線
114．．．連接端點
115．．．第一電極
116．．．薄膜
117．．．第二電極
118．．．背板
119．．．通氣孔
120．．．開口
122．．．電極凸出部

Claims (88)

  1. 一種微機電元件，包含有：一傳感器，包括一薄膜以及一基底；一電子介面裝置，用以使電子訊號與該薄膜之運動產生關聯；一基底開口貫穿該基底；以及複數個應力緩衝結構位於該薄膜之周圍之一應力釋放區中，且該等應力緩衝結構至少部分地使該薄膜與該基底之膨漲或收縮脫鉤，其中該等應力緩衝結構包括該薄膜中之孔洞或溝槽，且並未破壞該薄膜或造成該薄膜破裂；其中該薄膜係固定於該基底上使得該應力釋放區至少與該基底部分重疊，以減少通過該薄膜之氣流。
  2. 如請求項1所述之微機電元件，另包含有一覆蓋層將至少一或更多之該等孔洞或溝槽密封。
  3. 如請求項2所述之微機電元件，其中該應力緩衝結構大體上位於該傳感器與該基底之間。
  4. 如請求項3所述之微機電元件，其中該等應力緩衝結構於大體上垂直該基底之方向的硬度大於在該基底之平面方向的硬度。
  5. 如請求項1所述之微機電元件，其中該傳感器另包含有一背板，該背板具有另一電子介面裝置，用以使電子訊號與該薄膜之運動產生關聯，且該背板與該薄膜之間具有一腔穴。
  6. 如請求項5所述之微機電元件，其中該薄膜與該背板之間的腔穴係藉由移除一犧牲層所達成。
  7. 如請求項6所述之微機電元件，其中該犧牲層之材質係為聚亞醯胺。
  8. 如請求項6所述之微機電元件，其中該犧牲層之材質係為低溫氧化矽。
  9. 請求項6所述之微機電元件，其中移除該犧牲層係藉由一乾蝕刻達成。
  10. 如請求項9所述之微機電元件，其中該乾蝕刻包含有氧氣電漿蝕刻。
  11. 如請求項10所述之微機電元件，其中該氧氣電漿係部分地或主要地由微波所產生。
  12. 如請求項6所述之微機電元件，其中移除該犧牲層係 利用高溫直接晶圓加熱，並通入混入氮氣之氧氣電漿達成。
  13. 如請求項5所述之微機電元件，其中該背板具有穿孔，以使得空氣可穿透該背板。
  14. 如請求項1所述之微機電元件，其中該基底包含有一電子電路，與該電子介面裝置連接運作。
  15. 如請求項14所述之微機電元件，其中該電子電路包含複數個互補式金氧半導體電路。
  16. 如請求項15所述之微機電元件，其中該等互補式金氧半導體電路包含一個或多個選自電荷幫浦電路、濾波電路、類比數位訊號轉換電路、數位訊號處理電路、收發電路與多工電路之電路。
  17. 如請求項14所述之微機電元件，其中該電子電路與該薄膜位於不同一層。
  18. 如請求項14所述之微機電元件，其中該電子電路與該薄膜位於同一層。
  19. 如請求項1所述之微機電元件，其中該微機電元件之 製程溫度未超過400℃。
  20. 如請求項1所述之微機電元件，其中該薄膜之材料係為氮化矽。
  21. 如請求項1所述之微機電元件，其中該薄膜之材料係為多晶矽。
  22. 如請求項1所述之微機電元件，其中該電子介面裝置之材料包含有一種或多種選自於鋁、鋁矽、鋁矽銅、鈦、鈦化鎢、銅、鎳、鎳鉻、鉻、鉑、鉭或鈀之材料。
  23. 如請求項1所述之微機電元件，其中該基底之材料為矽。
  24. 一種微機電元件，包含有：一傳感器，具有一薄膜固定於一基底上，該傳感器包含有至少一電極在結構上與該薄膜連接而形成一複合薄膜結構，該複合薄膜結構包含有複數材料，各材料具有一熱膨漲係數，且該複合薄膜結構之組合熱膨漲係數，相較於該複合薄膜結構之任何主要材料之熱膨漲係數，更為接近與矽之熱膨漲係數相匹配；以及一電子介面裝置，用以使電子訊號與該薄膜之運動產生關 聯；其中該薄膜之熱膨漲係數與矽之熱膨漲係數大體上接近相匹配。
  25. 如請求項24所述之微機電元件，其中該複合薄膜結構包含有一三明治結構，其包含複數材料，且該三明治結構包含有一電極。
  26. 如請求項25所述之微機電元件，其中該三明治結構為金屬/氮化物/金屬結構。
  27. 如請求項25所述之微機電元件，其中該三明治結構為氮化物/金屬/氮化物結構。
  28. 如請求項24所述之微機電元件，其中該傳感器另包含有一背板，該背板具有另一電子介面裝置，用以使電子訊號與該薄膜之運動產生關聯，且該背板與該薄膜之間具有一腔穴。
  29. 如請求項28所述之微機電元件，其中該背板之張應力較該薄膜之張應力為高。
  30. 如請求項28所述之微機電元件，其中該薄膜與該背板之間的腔穴係藉由移除一犧牲層所達成。
  31. 如請求項30所述之微機電元件，其中該犧牲層之材質係為聚亞醯胺。
  32. 如請求項30所述之微機電元件，其中該犧牲層之材質係為低溫氧化矽。
  33. 如請求項30所述之微機電元件，其中移除該犧牲層係藉由一乾蝕刻達成。
  34. 如請求項33所述之微機電元件，其中該乾蝕刻包含有氧氣電漿蝕刻。
  35. 如請求項34所述之微機電元件，其中該氧氣電漿係部分地或主要地由微波所產生。
  36. 如請求項30所述之微機電元件，其中移除該犧牲層係利用高溫直接晶圓加熱，並通入混入氮氣之氧氣電漿達成。
  37. 如請求項28所述之微機電元件，其中該背板具有穿孔，以使得空氣可穿透該背板。
  38. 如請求項24所述之微機電元件，其中該基底包含有一 電子電路，與該電子介面裝置連接運作。
  39. 如請求項38所述之微機電元件，其中該電子電路包含複數個互補式金氧半導體電路。
  40. 如請求項39所述之微機電元件，其中該等互補式金氧半導體電路包含一個或多個選自電荷幫浦電路、濾波電路、類比數位訊號轉換電路、數位訊號處理電路、收發電路與多工電路之電路。
  41. 如請求項38所述之微機電元件，其中該電子電路與該薄膜位於不同一層。
  42. 如請求項38所述之微機電元件，其中該電子電路與該薄膜位於同一層。
  43. 如請求項24所述之微機電元件，其中該微機電元件之製程溫度未超過400℃。
  44. 如請求項24所述之微機電元件，其中該薄膜之材料係為氮化矽。
  45. 如請求項24所述之微機電元件，其中該薄膜之材料係為多晶矽。
  46. 如請求項24所述之微機電元件，其中該電子介面裝置之材料包含有一種或多種選自於鋁、鋁矽、鋁矽銅、鈦、鈦化鎢、銅、鎳、鎳鉻、鉻、鉑、鉭或鈀之材料。
  47. 如請求項24所述之微機電元件，其中該基底之材料為矽。
  48. 一種微機電元件，包含有：一傳感器，具有一薄膜固定於一基底上；以及一電子介面裝置，用以使電子訊號與該薄膜之運動產生關聯；其中該傳感器另包含有一背板，該背板具有另一電子介面裝置，用以使電子訊號與該薄膜之運動產生關聯，且該背板與該薄膜之間具有一腔穴；其中該背板之硬度至少大於該薄膜之硬度的10倍以上。
  49. 如請求項48所述之微機電元件，其中該背板或該薄膜之硬度S係由下列關係式S=TS×t決定，其中TS為該背板或該薄膜的張應力，t為該背板或該薄膜之厚度。
  50. 如請求項48所述之微機電元件，其中該基底包含有一電子電路，與該電子介面裝置連接運作。
  51. 如請求項50所述之微機電元件，其中該電子電路包含複數個互補式金氧半導體電路。
  52. 如請求項51所述之微機電元件，其中該等互補式金氧半導體電路包含一個或多個選自電荷幫浦電路、濾波電路、類比數位訊號轉換電路、數位訊號處理電路、收發電路與多工電路之電路。
  53. 如請求項50所述之微機電元件，其中該電子電路與該薄膜位於不同一層。
  54. 如請求項50所述之微機電元件，其中該電子電路與該薄膜位於同一層。
  55. 如請求項48所述之微機電元件，其中該薄膜與該背板之間的腔穴係藉由移除一犧牲層所達成。
  56. 如請求項55所述之微機電元件，其中該犧牲層之材質係為聚亞醯胺。
  57. 如請求項55所述之微機電元件，其中該犧牲層之材質係為低溫氧化矽。
  58. 如請求項55所述之微機電元件，其中移除該犧牲層係藉由一乾蝕刻達成。
  59. 如請求項58所述之微機電元件，其中該乾蝕刻包含有氧氣電漿蝕刻。
  60. 如請求項59所述之微機電元件，其中該氧氣電漿係部分地或主要地由微波所產生。
  61. 如請求項55所述之微機電元件，其中移除該犧牲層係利用高溫直接晶圓加熱，並通入混入氮氣之氧氣電漿達成。
  62. 如請求項48所述之微機電元件，其中該薄膜之材料係為氮化矽。
  63. 如請求項48所述之微機電元件，其中該薄膜之材料係為多晶矽。
  64. 如請求項48所述之微機電元件，其中該背板具有穿孔，以使得空氣可穿透該背板。
  65. 如請求項48所述之微機電元件，其中該電子介面裝置之材料包含有一種或多種選自於鋁、鋁矽、鋁矽銅、 鈦、鈦化鎢、銅、鎳、鎳鉻、鉻、鉑、鉭或鈀之材料。
  66. 如請求項48所述之微機電元件，其中該基底之材料為矽。
  67. 一種微機電元件，包含有：一傳感器，包括一薄膜以及一基底；一電子介面裝置，用以使電子訊號與該薄膜之運動產生關聯；一基底開口貫穿該基底；以及複數個應力緩衝結構位於該薄膜之周圍之一應力釋放區中，且該等應力緩衝結構至少部分地使該薄膜與該基底之膨漲或收縮脫鉤，其中該等應力緩衝結構包括該薄膜中之孔洞或溝槽，且並未破壞該薄膜或造成該薄膜破裂；其中該薄膜係固定於該基底上，使得該應力釋放區至少與該基底部分重疊，以減少通過該薄膜之氣流，且該薄膜之一平面係與該基底之一上表面分離。
  68. 如請求項67所述之微機電元件，其中該應力釋放區位於該傳感器與該基底之間。
  69. 如請求項67所述之微機電元件，其中該傳感器另包含 有一背板，該背板具有另一電子介面裝置，用以使電子訊號與該薄膜之運動產生關聯，且該背板與該薄膜之間具有一腔穴。
  70. 如請求項69所述之微機電元件，其中該薄膜與該背板之間的腔穴係藉由移除一犧牲層所達成。
  71. 如請求項70所述之微機電元件，其中該犧牲層之材質係為聚亞醯胺。
  72. 如請求項70所述之微機電元件，其中該犧牲層之材質係為低溫氧化矽。
  73. 如請求項70所述之微機電元件，其中移除該犧牲層係藉由一乾蝕刻達成。
  74. 如請求項73所述之微機電元件，其中該乾蝕刻包含有氧氣電漿蝕刻。
  75. 如請求項74所述之微機電元件，其中該氧氣電漿係部分地或主要地由微波所產生。
  76. 如請求項70所述之微機電元件，其中移除該犧牲層係利用高溫直接晶圓加熱，並通入混入氮氣之氧氣電漿 達成。
  77. 如請求項69所述之微機電元件，其中該背板具有穿孔，以使得空氣可穿透該背板。
  78. 如請求項67所述之微機電元件，其中該基底包含有一電子電路，與該電子介面裝置連接運作。
  79. 如請求項78所述之微機電元件，其中該電子電路包含複數個互補式金氧半導體電路。
  80. 如請求項79所述之微機電元件，其中該等互補式金氧半導體電路包含一個或多個選自電荷幫浦電路、濾波電路、類比數位訊號轉換電路、數位訊號處理電路、收發電路與多工電路之電路。
  81. 如請求項78所述之微機電元件，其中該電子電路與該薄膜位於不同一層。
  82. 如請求項78所述之微機電元件，其中該電子電路與該薄膜位於同一層。
  83. 如請求項67所述之微機電元件，其中該微機電元件之製程溫度未超過400℃。
  84. 如請求項67所述之微機電元件，其中該薄膜之材料係為氮化矽。
  85. 如請求項67所述之微機電元件，其中該薄膜之材料係為多晶矽。
  86. 如請求項67所述之微機電元件，其中該背板具有穿孔，以使得空氣可穿透該背板。
  87. 如請求項67所述之微機電元件，其中該電子介面裝置之材料包含有一種或多種選自於鋁、鋁矽、鋁矽銅、鈦、鈦化鎢、銅、鎳、鎳鉻、鉻、鉑、鉭或鈀之材料。
  88. 如請求項67所述之微機電元件，其中該基底之材料為矽。
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