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KR930015937A - 디지탈 간이 교환시스템에서 신호의 다중화와 역다중화 시스템 - Google Patents

디지탈 간이 교환시스템에서 신호의 다중화와 역다중화 시스템 Download PDF

Info

Publication number
KR930015937A
KR930015937A KR1019910025059A KR910025059A KR930015937A KR 930015937 A KR930015937 A KR 930015937A KR 1019910025059 A KR1019910025059 A KR 1019910025059A KR 910025059 A KR910025059 A KR 910025059A KR 930015937 A KR930015937 A KR 930015937A
Authority
KR
South Korea
Prior art keywords
register
digital
parallel
multiplexing
clock
Prior art date
Application number
KR1019910025059A
Other languages
English (en)
Other versions
KR100210685B1 (ko
Inventor
김규태
Original Assignee
백중영
금성통신 주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 백중영, 금성통신 주식회사 filed Critical 백중영
Priority to KR1019910025059A priority Critical patent/KR100210685B1/ko
Publication of KR930015937A publication Critical patent/KR930015937A/ko
Application granted granted Critical
Publication of KR100210685B1 publication Critical patent/KR100210685B1/ko

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Classifications

    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04Q—SELECTING
    • H04Q11/00—Selecting arrangements for multiplex systems
    • H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Time-Division Multiplex Systems (AREA)

Abstract

다중화 선로의 전송속도와 코덱 또는 디지탈 트랜시버의 전송 속도가 다른 경우에도 디지탈 신호를 다중화하고 역다중화 할 수 있도록 하기 위하여, 다중화 선로 클럭에 의해 쉬프트된 데이타를 저장해서 병렬로 내보내는 레지스터(610), 레지스터(610)에 의해 병렬로 들어온 데이타를 포트 클럭에 의해 코덱이나 디지탈 트랜시버로 내보내는 레지스터(620), 포트클럭에의 의해 쉬프트된 데이타를 저장해서 병렬로 내보내는 레지스터(640), 레지스터(640)에 의해 병렬로 들어온 데이타를 다중화 선로 클럭에 의해 다중화 선로에 시리얼로 내보내는 레지스터(630)를 특징으로 하는 디지탈 신호의 다중화와 역다중화 시스템.

Description

디지탈 간이 교환시스템에서 신호의 다중화와 역다중화 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명 디지탈간이 교환기의 시스템 구성도, 제3도는 제2도 디지탈 신호의 다중화, 역다중화부의 상세도.

Claims (1)

  1. 다중화 선로의 전송속도와의 코덱 또는 디지탈 트랜시버의 전송 속도가 다른 경우에도 디지탈 신호를 다중화하고 역다중화 할 수 있도록 하기 위하여, 다중화 선로 클럭에 의해 쉬프트된 데이타를 저장해서 병렬로 내보내는 레지스터(610), 레지스터(610)에 의해 병렬로 들어온 데이타를 포트 클럭에 의해 코덱이나 디지탈 트랜시버로 내보내는 레지스터(620), 포트클럭에의 의해 쉬프트된 데이타를 저장해서 병렬로 내보내는 레지스터(640), 레지스터(640)에 의해 병렬로 들어온 데이타를 다중화 선로 클럭에 의해 다중화 선로에 시리얼로 내보내는 레지스터(630)를 특징으로 하는 디지탈 신호의 다중화와 역다중화 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910025059A 1991-12-30 1991-12-30 디지탈 간이교환시스템의 신호다중화/역다중화 제어장치 KR100210685B1 (ko)

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Publication Number Publication Date
KR930015937A true KR930015937A (ko) 1993-07-24
KR100210685B1 KR100210685B1 (ko) 1999-07-15

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