KR900003719A - 타이머 시스템 - Google Patents
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제시된 실시예가 그 일부분을 이루는 싱글-칩 마이크로 컴퓨터의 블록 선도.
제2a 내지 2b도는 본 발명의 제시된 실시예를 포함하는 타이머의 메노리 맵을 도시한 도면.
제3도는 제시된 실시예의 타이머의 주요 구성부를 도시한 블록 선도.
Claims (2)
- 최소한 두 개의 타이머 기준 신호에 응답하는 타이머에 있어서, 포획 레지스터와, 부합 레지스터와, 상기 최소한 두 개의 타이머 기준 신호중 하나를 선택하기 위한 제1타이머 기준 선택 수단과, 상기 최소 한 두 개의 타이머 기준 신호중 하나를 선택하기 위한 제2타이머 기준 선택 수단과, 타이머로의 입력 및 상기 제1타이머 기준 선택 수단에 응답하여 상기 제1타이머 기준 선택 수단에 의해 선택된 타이머 기준 신호의 값의 표현을 상기 포획 레지스터에 로드시키는 포획 논리 수단과, 상기 부합 레지스터의 내용 및 상기 제2타이머 기준 선택 수단에 의해 선택된 타이머 기준 신호의 값에 응답하여 만약 상기 제2타이머 기준 선택 수단에 의해 선택된 타이머 기준 신호의 값과 부합 레지스터의 내용 사이에 선정된 관계식이 존재한다면 부합 출력을 발생시키는 부합 논리 수단을 구비하는 것을 특징으로 하는 타이머.
- 제1 및 제2카운트 레지스터와 타이머 채널을 구비하는 시스템에 있어서, 타이머 채널은, 포획 레지스터와, 부합 레지스터와, 상기 최소한 두 개의 타이머 기준 신호중 하나를 선택하기 위한 제1타이머 기준 선택 수단과, 상기 최소한 두 개의 타이머 기준 신호중 하나를 선택하기 위한 제2타이머 기준 선택 수단과, 타이머로의 입력 및 상기 제1 타이머 기준 선택 수단에 응답하여 상기 제1타이머 기준 선택 수단에 의해 선택된 타이머 기준 신호의 값의 표현을 상기 포획 레저스터에 로드시키는 포획 논리 수단과, 상기 부합 레지스터의 내용 및 상기 제2타이머 기준 선택 수단에 의해 선택된 타이머 기준 신호의 값에 응답하여 만양 상기 제2타이머 기준 선택 수단에 의해 선택된 타이머 기준 신호의 값과 부합 레지스터의 내용 사이에 선정된 관계식이 존재한다면 부합 출력을 발생시키는 부합 논리 수단을 구비하는 것을 특징으로 하는 타이머 시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (3)
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