KR100589378B1 - 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법과플라즈마 표시 장치 - Google Patents
플라즈마 디스플레이 패널의 구동 장치 및 구동 방법과플라즈마 표시 장치 Download PDFInfo
- Publication number
- KR100589378B1 KR100589378B1 KR1020030074251A KR20030074251A KR100589378B1 KR 100589378 B1 KR100589378 B1 KR 100589378B1 KR 1020030074251 A KR1020030074251 A KR 1020030074251A KR 20030074251 A KR20030074251 A KR 20030074251A KR 100589378 B1 KR100589378 B1 KR 100589378B1
- Authority
- KR
- South Korea
- Prior art keywords
- voltage
- electrode
- electrodes
- period
- transistor
- Prior art date
Links
Images
Classifications
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/22—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources
- G09G3/28—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using luminous gas-discharge panels, e.g. plasma panels
- G09G3/288—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using luminous gas-discharge panels, e.g. plasma panels using AC panels
- G09G3/291—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using luminous gas-discharge panels, e.g. plasma panels using AC panels controlling the gas discharge to control a cell condition, e.g. by means of specific pulse shapes
- G09G3/292—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using luminous gas-discharge panels, e.g. plasma panels using AC panels controlling the gas discharge to control a cell condition, e.g. by means of specific pulse shapes for reset discharge, priming discharge or erase discharge occurring in a phase other than addressing
- G09G3/2927—Details of initialising
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/22—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources
- G09G3/28—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using luminous gas-discharge panels, e.g. plasma panels
- G09G3/288—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters using controlled light sources using luminous gas-discharge panels, e.g. plasma panels using AC panels
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- Power Engineering (AREA)
- Plasma & Fusion (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Abstract
플라즈마 표시 장치에서는 리셋 기간에서 유지 전극에 제5 전압을 인가한 상태에서 주사 전극에 제1 전압에서 제2 전압까지 상승하는 파형을 인가하고 주사 전극의 전압을 제3 전압까지 감소시킨다. 그리고 나서 유지 전극에 상기 제5 전압보다 높은 제6 전압을 인가한 상태에서 주사 전극에 상기 제3 전압에서 제4 전압까지 하강하는 파형을 인가한다. 이때, 상기 제1 전압과 상기 제5 전압의 차 또는 상기 제3 전압과 상기 제5 전압의 차 중 적어도 하나가 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압의 크기보다 크게 한다. 이와 같이 하면, 리셋 기간에서 강방전을 방지할 수 있으며, 리셋 시간을 단축시킬 수 있다.
플라즈마 디스플레이 패널, 리셋 기간, 리셋 파형
Description
도 1은 일반적인 플라즈마 디스플레이 패널의 일부 사시도이다.
도 2는 일반적인 플라즈마 디스플레이 패널의 전극 배열도이다.
도 3은 종래 기술에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 4는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 5는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 6은 도 5에 도시한 구동 파형을 인가하는데 사용되는 회로도의 일예를 나타내는 도면이다.
도 7은 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 8은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
본 발명은 플라즈마 디스플레이 패널(plasma display panel; PDP)의 구동장치 및 구동 방법, 플라즈마 표시 장치에 관한 것으로, 특히 구동 전압 마진 확대 및 안정적인 방전 특성을 실현할 수 있는 플라즈마 디스플레이 패널의 구동 장치 및 방법과 플라즈마 표시 장치에 관한 것이다.
최근 평면 디스플레이 장치 중에서 PDP는 다른 디스플레이 장치에 비해 휘도 및 발광 효율이 높고 시야각이 넓다는 장점으로 인하여 평면 디스플레이 장치로서 각광을 받고 있다.
플라즈마 디스플레이 패널은 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백 만개 이상의 화소가 매트릭스 형태로 배열되어 있다. 먼저 도 1 및 도 2를 참조하여 플라즈마 디스플레이 패널의 구조에 대하여 설명한다.
도 1은 플라즈마 디스플레이 패널의 일부 사시도이며, 도 2는 플라즈마 디스플레이 패널의 전극 배열도를 나타낸다.
도 1에 나타낸 바와 같이, 플라즈마 디스플레이 패널은 서로 마주보며 떨어져 있는 두 개의 유리 기판(1, 6)을 포함한다. 유리 기판(1) 위에는 주사 전극(4)과 유지 전극(5)이 쌍을 이루어 평행하게 형성되어 있으며, 주사 전극(4)과 유지 전극(5)은 유전체층(2) 및 보호막(3)으로 덮여 있다. 유리 기판(6) 위에는 복수의 어드레스 전극(8)이 형성되어 있으며, 어드레스 전극(8)은 절연체층(7)으로 덮여 있다. 어드레스 전극(8) 사이에 있는 절연체층(7) 위에는 어드레스 전극(8)과 격벽(9)이 형성되어 있다. 또한 절연체층(7)의 표면 및 격벽(9)의 양측면에 형광체(10)가 형성되어 있다. 유리 기판(1, 6)은 주사 전극(4)과 어드레스 전극(8) 및 유지 전극(5)과 어드레스 전극(8)이 직교하도록 방전 공간(11)을 사이에 두고 대향하여 배치되어 있다. 어드레스전극(8)과, 쌍을 이루는 주사 전극(4)과 유지 전극(5)과의 교차부에 있는 방전 공간(11)이 방전 셀(12)을 형성한다.
그리고 도 2에 나타낸 바와 같이, 플라즈마 디스플레이 패널의 전극은 n×m의 매트릭스 구조를 가지고 있다. 복수의 어드레스 전극(A1-Am)이 세로 방향으로 배열되어 있고 가로 방향으로 복수의 주사 전극(Y1-Yn) 및 유지 전극(X1
-Xn)이 쌍으로 배열되어 있다.
일반적으로 플라즈마 디스플레이 패널은 1 프레임이 복수의 서브필드로 나누어져 구동되며, 서브필드의 조합에 의해 계조가 표현된다. 일반적으로 각 서브필드는 리셋 기간(reset period), 어드레스 기간(address period), 유지 기간(sustain period)으로 이루어진다. 리셋 기간은 이전의 유지방전으로 형성된 벽 전하를 소거하고 다음의 어드레스 방전을 안정적으로 수행하기 위해 벽 전하를 셋업(setup) 하는 역할을 한다. 어드레스 기간은 패널에서 켜지는 셀과 켜지지 않는 셀을 선택하여 켜지는 셀(어드레싱된 셀)에 벽 전하를 쌓아두는 동작을 수행하는 기간이다. 유지 기간은 어드레싱된 셀에 실제로 화상을 표시하기 위한 유지방전을 수행하는 기간이다.
도 3은 종래 기술에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 3에 나타낸 바와 같이, 상승 램프 기간에서는 어드레스 전극(A) 및 유지 전극(X)을 0V로 유지한 상태에서 Vs 전압에서 Vset 전압을 향하여 완만하게 상승하는 램프 전압이 주사 전극(Y)에 인가된다. 이 전압이 상승하는 동안 모든 방전 셀에서는 주사 전극(Y)으로부터 어드레스 전극(A) 및 유지 전극(X)으로 각각 1회째의 미약한 리셋 방전이 일어난다.
이어서, 하강 램프 기간에서는 유지 전극(X)을 Vb1 전압으로 유지한 상태에서 Vs 전압에서 -Vnf전압까지 완만하게 하강하는 램프 전압을 주사 전극(Y)에 인가한다. 이 램프 전압이 하강하는 동안 다시 모든 방전 셀에서는 2회째의 미약한 리셋 방전이 일어난다.
즉, 리셋 기간(Pr)에서는 상승하는 램프 전압에 의해 모든 방전셀이 방전되어 주사 전극(Y)에는 많은 양의 음 전하가 축적되고 어드레스 전극(A)에는 많은 양의 양 전하가 축적된다. 다음으로 주사 전극(Y)에 하강하는 램프 전압이 인가되어 방전셀이 벽전하 구조를 유지하며 음(-)의 전위 레벨(Vnf)로 전위를 내려준다. 이때, 상승하는 램프 전압에 의해 방전셀에 형성된 벽전하가 소거된다.
일반적으로 고효율의 플라즈마 디스플레이 패널을 구현하기 위해 방전 가스 중 제논(Xe)의 비율을 향상시켜 발광 효율 및 휘도를 증가시키고 있다. 그러나 제논의 비율이 증가함에 따라 구동 전압이 상승하고 따라서 리셋 기간에서 실제로 리 셋 방전을 일으킬 수 있는 주사 전극(Y)과 유지 전극(X) 사이에 더 높은 전압차를 요구하게 된다.
그러나, 제논의 비율 증가에 따라 종래와 같은 리셋 파형에서는 리셋 방전이 잘 발생되지 않는 문제점이 있었다. 따라서, 리셋 방전이 불안정해지고 그로 인하여 정상적인 표시를 행할 수 없게 되는 문제점이 발생된다.
본 발명이 이루고자 하는 기술적 과제는 상기와 같은 문제점을 해결하기 위한 것으로서, 리셋 기간에서 구동 전압 마진 확보 및 오방전을 방지하기 위한 플라즈마 디스플레이 패널의 구동 장치 및 방법과 플라즈마 표시 장치를 제공하고자 하는 데 있다.
본 발명의 하나의 특징에 따르면, 제1 전극 및 제2 전극과, 상기 제1 전극 및 제2 전극 사이에 방전 셀이 형성되는 플라즈마 디스플레이 패널의 구동 방법이 제공된다. 이 구동 방법은, 리셋 기간에서, 상기 제2 전극에 제5 전압을 인가한 상태에서 상기 제1 전극의 전압을 제1 전압에서 제2 전압까지 완만하게 상승시키는 단계, 상기 제2 전극에 상기 제5 전압을 인가한 상태에서 상기 제1 전극에 상기 제2 전압보다 낮은 제3 전압을 인가하는 단계, 그리고 상기 제2 전극에 상기 제5 전압보다 높은 제6 전압을 인가한 상태에서 상기 제1 전극의 전압을 상기 제3 전압에서 제4 전압까지 완만하게 하강시키는 단계를 포함하며, 상기 제1 전압과 상기 제5 전압의 차 또는 상기 제3 전압과 상기 제5 전압의 차 중 적어도 하나가 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압의 크기보다 크다.
그리고, 상기 제1 전압이 상기 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압보다 높은 전압일 수 있으며, 상기 제3 전압이 상기 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압보다 높은 전압일 수도 있으며, 상기 제1 전압 및 제3 전압이 상기 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압보다 높은 전압일 수 있다.
삭제
본 발명의 다른 특징에 따르면, 복수의 주사 전극을 포함하는 플라즈마 디스플레이 패널의 구동장치가 제공된다. 이 구동 장치는, 제1 전압을 공급하는 제1 전원과 상기 복수의 주사 전극 사이에 연결되어 있는 제1 트랜지스터, 상기 제1 전압보다 낮은 제2 전압을 공급하는 제2 전원과 상기 복수의 주사 전극 사이에 연결되어 있는 제2 트랜지스터, 상기 제1 트랜지스터 및 제2 트랜지스터의 접점에 일단이 연결되고 타단이 제3 전압을 공급하는 제3 전원에 연결되어 있는 커패시터, 상기 제1 트랜지스터 및 제2 트랜지스터의 접점과 상기 복수의 주사 전극 사이에 연결되어 있는 제3 트랜지스터, 상기 제3 트랜지스터와 상기 복수의 주사 전극 사이에 연결되어 있는 제4 트랜지스터, 상기 커패시터의 타단과 상기 제3 트랜지스터 및 제4 트랜지스터의 접점 사이에 연결되어 있는 제5 트랜지스터, 그리고 상기 제3 트랜지스터와 제4 트랜지스터의 접점과 상기 제1 전압보다 높은 제4 전압을 공급하는 제4 전원 사이에 연결되어 있는 제6 트랜지스터를 포함한다.
삭제
삭제
본 발명의 또 다른 특징에 의하면, 제1 기판 위에 각각 나란히 형성되는 복수의 제1 전극 및 복수의 제2 전극, 그리고 상기 제1 전극 및 상기 제2 전극에 교차하며 제2 기판 위에 형성되는 복수의 어드레스 전극을 포함하는 플라즈마 디스플레이 패널, 그리고 리셋 기간에서 상기 복수의 제2 전극에 제5 전압을 인가한 상태에서 상기 복수의 제1 전극에 제1 전압에서 제2 전압까지 완만하게 상승하는 파형을 인가한 후 상기 복수의 제1 전극에 상기 제2 전압보다 낮은 제3 전압을 인가하고, 상기 복수의 제2 전극에 상기 제5 전압보다 높은 제6 전압을 인가한 상태에서 상기 복수의 제1 전극에 상기 제3 전압에서 제4 전압까지 완만하게 하강하는 파형을 인가하는 구동 회로를 포함하는 플라즈마 표시 장치가 제공된다. 이때, 상기 제1 전압과 상기 제5 전압의 차 또는 상기 제3 전압과 상기 제5 전압의 차 중 적어도 하나가 유지 기간에서 상기 복수의 제1 전극과 상기 복수의 제2 전극에 인가되는 유지 방전 펄스의 높은 전압의 크기보다 크다.
이제 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동 방법에 대하여 도면을 참고로 하여 상세하게 설명한다.
우선, 아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세하게 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시에에 한정되지 않는다. 본 발명을 설명함에 있어서, 관련된 공지기능 혹은 구성에 대한 구체적이 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단된 경우 그 상세한 설명은 생략하였다.
도4는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널을 나타내는 도면이다.
도 4에 나타낸 바와 같이, 본 발명의 실시예에 따른 플라즈마 디스플레이 패 널은 플라즈마 패널(100), 제어부(200), 어드레스 구동부(300), 유지전극 구동부(400) 및 주사전극 구동부(500)를 포함한다.
플라즈마 패널(100)은 열 방향으로 배열되어 있는 다수의 어드레스 전극(A1~Am), 행 방향으로 지그재그로 배열되어 있는 다수의 유지 전극(X1~Xn) 및 주사 전극(Y1~Yn)을 포함한다.
제어부(200)는 외부로부터 영상신호를 수신하여 어드레스 구동 제어 신호, 유지 전극 구동 제어 신호 및 주사 전극 구동 제어 신호를 출력한다.
어드레스 구동부(300)는 제어부(200)로부터 어드레스 구동 제어 신호를 수신하여 표시하고자 하는 방전 셀을 선택하기 위한 표시 데이터 신호를 각 어드레스 전극에 인가한다.
유지 전극 구동부(400)는 제어부(200)로부터 유지 전극 구동 제어 신호를 수신하여 유지 전극에 구동 전압을 인가한다.
주사 전극 구동부(500)는 제어부(200)로부터 주사 전극 구동 제어 신호를 수신하여 주사 전극에 구동 전압을 인가한다.
본 발명의 실시 예에 따르면, 리셋 기간 동안 주사 전극 구동부(500)는 상승 램프 기간 동안 주사 전극에 제1 전압에서 제2 전압까지 상승하는 파형을 인가하고, 하강 램프 기간 동안 주사 전극에 제3 전압에서 제4 전압까지 하강하는 파형을 인가한다. 이때, 제1 전압 또는 제3 전압 중 적어도 하나의 전압이 유지 기간에서의 유지방전 펄스 전압보다 높게 인가한다.
도 5는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형 도이다.
본 발명의 제1 실시예에 따른 구동 파형에서 각 서브필드는 리셋 기간(Pr), 어드레스 기간(Pa) 및 유지 기간(Ps)을 포함한다. 그리고 리셋 기간(Pr
)은 상승 램프 기간(Pr1) 및 하강 램프 기간(Pr2)으로 이루어진다.
리셋 기간(Pr)의 상승 램프 기간(Pr1)은 주사 전극(Y), 유지 전극(X) 및 어드레스 전극(A)에 벽 전하를 형성하는 기간이며, 하강 램프 기간(Pr2)은 상승 램프 기간(Pr1)에서 형성된 벽 전하를 일부 소거하여 어드레스 방전에 용이하도록 하는 기간이다. 그리고 어드레스 기간(Pa)은 복수의 방전 셀 중 유지 기간에서 유지방전을 일으킬 방전 셀을 선택하는 기간이다. 유지 기간(Ps)은 주사 전극(Y)과 유지 전극(X)에 차례로 유지 펄스를 인가하여 어드레스 기간(Pa)에서 선택된 방전 셀을 유지방전시키는 기간이다.
그리고 플라즈마 디스플레이 패널에는 각 기간(Pr, Pa, Ps)에서 주사 전극(Y) 및 유지 전극(Y)에 구동 전압을 인가하는 주사/유지 구동 회로, 그리고 어드레스 전극(A)에 구동 전압을 인가하는 어드레스 구동 회로가 연결되어 하나의 표시 장치를 이룬다.
도 5를 보면, 리셋 기간(Pr)의 상승 램프 기간(Pr1)에서는 어드레스 전극(A) 및 유지 전극(X)을 0V로 유지한 상태에서 Vpr 전압에서 Vset 전압을 향하여 완만하게 상승하는 램프 전압이 주사 전극(Y)에 인가된다. Vpr 전압은 유지기간에서 유지 전극(X) 및 주사 전극(Y)에 교대로 인가되는 유지방전펄스 전압(Vs)의 레벨보다 높은 전압이다. 이와 같이 전압이 상승하는 동안 모든 방전 셀에서는 주사 전극(Y)으로부터 어드레스 전극(A) 및 유지 전극(X)으로 각각 1회째의 미약한 리셋 방전이 일어난다. 그 결과, 주사 전극(Y)에 (-) 벽 전하가 축적되고, 동시에 어드레스 전극(A) 및 유지 전극(X)에는 (+) 벽 전하가 축적된다.
한편, 리셋 기간(Pr)의 상승 램프 기간(Pr1)에서 주사 전극(Y)에 인가하는 전압(Vpr)과 유지 전극(X)에 인가하는 전압(=0V)의 차가 방전 개시 전압을 넘을 경우에는 강한 방전이 발생할 수 있다. 따라서, 주사 전극(Y)에 인가하는 전압의 값을 적절하게 조절하여야 한다.
이처럼, 본 발명의 제1 실시예에서는 주사 전극(Y)에 도 3에서보다 높은 Vpr 전압을 인가함으로써 종래보다 주사 전극(Y)과 유지 전극(X)의 전위차가 커지게 되고 따라서 도 3에서보다 리셋 방전을 더 빨리 일어나며 그 결과 리셋 기간을 단축시킬 수 있게 되고 효율의 플라즈마 디스플레이 패널에서 리셋 기간(Pr)에서 리셋 방전을 안정적으로 일으킬 수 있게 된다.
여기서, 벽 전하란 각 전극에 가깝게 방전 셀의 벽(예를 들어, 유전체층)에 형성되어 전극에 축적되는 전하를 말한다. 이러한 벽 전하는 실제로 전극 자체에 접촉되지는 않지만, 여기서는 벽 전하가 전극에 "형성됨", "축적됨" 또는 "쌓임"과 같이 설명된다. 또한 벽 전압은 벽 전하에 의해서 방전 셀의 벽에 형성되는 전위차를 말한다.
이어서, 하강 램프 기간(Pr2)에서는 유지 전극(X)을 Vb1 전압으로 유지한 상태에서 Vs 전압에서 -Vnf전압까지 완만하게 하강하는 램프 전압을 주사 전극(Y)에 인가한다. 이 램프 전압이 하강하는 동안 다시 모든 방전 셀에서는 2회째의 미약한 리셋 방전이 일어난다. 그 결과, 주사 전극(Y)의 (-) 벽 전하가 감소하고 유지 전극(X)과 어드레스 전극(A)의 (+) 벽 전하가 감소한다.
그리고 어드레스 기간(Pa)에서는 다른 주사 전극(Y)을 Vsch 전압으로 유지한 상태에서 주사 전극(Y)에 순차적으로 -Vnf전압보다 낮은 -Vscl 전압을 인가하여 주사 전극(Y)을 선택한다. 그리고 -Vscl 전압이 인가된 주사 전극(Y)에 의해 형성되는 방전 셀 중 선택하고자 하는 방전 셀을 형성하는 어드레스 전극(A)에 어드레스 전압(Va)이 인가된다. 그리고 주사 전극(Y)을 Vsch 전압을 인가할 때 유지 전극(X)에 Vb1 전압보다 높은 Vb2 전압을 인가한다.
한편, 어드레스 기간(Pa)에서 주사 전극(Y)에 인가하는 전압(-Vscl)과 유지 전극에 인가하는 전압(Vb2)의 차(ㅿV=|-Vscl-Vnf|)가 방전 개시 전압(V
f)넘을 경우 선택하고자 하는 방전 셀이 아닌 곳에서 방전이 발생하여 오방전이 발생할 수 있 다. 따라서, 선택하고자 하는 방전 셀을 적절하게 방전시키기 위해서는 어드레스 기간에서의 유지 전극(X)에 인가하는 전압(Ve) 및 주사 전극(Y)에 인가하는 전압의 값을 적절하게 조절하여야 한다.
다음, 유지 기간(Ps)에서는 주사 전극(Y)과 유지 전극(X)에 차례로 서스테인 펄스(이하, 유지방전 펄스라 함)가 인가된다. 유지방전 펄스는 주사 전극(Y)과 유지 전극(X)의 전압차가 교대로 Vs 전압 및 -Vs 전압이 되도록 하는 펄스이다. 어드레스 기간(Pa)에서 어드레스 방전에 의해 주사 전극(Y)과 유지 전극(X) 사이에 벽 전압이 형성되어 있으면, 벽 전압과 Vs 전압에 의해 주사 전극(Y)과 유지 전극(X)에서 방전이 일어난다.
도 6은 본 발명의 제1 실시예인 도 5에 도시한 구동 파형을 인가하는데 사용되는 회로도의 일예를 나타내는 도면이다. 이하에는 본 발명의 실시예에 따라 리셋 기간에서의 구동 동작만을 설명한다. 아래에서 패널 커패시터(Cp)는 X 전극과 Y 전극 사이의 커패시턴스 성분을 등가적으로 나타낸 것이다.
본 발명의 제1 실시에에 따른 주사전극 구동부(500)에 따르면, Vs 전압을 공급하는 전원(Vs)과 패널 커패시터(Cp)의 제1 단자(즉, 주사 전극(Y), 이하 주사 전극(Y)이라 함))사이에 트랜지스터(Ys)가 연결되어 있으며, 접지 전압을 공급하는 전원(0)과 주사 전극(Y) 사이에 트랜지스터(Yg)가 연결되어 있다. 두 트랜지스터(Ys, Yg) 사이의 접점과 주사 전극(Y) 사이에 트랜지스터(Ypp)가 연결되어 있으며 두 트랜지스터(Ys, Yg) 사이의 접점에 제1단이 연결된 커패시터(Cset)의 제2단이 (Vset-Vs) 전압을 공급하는 전원(Vset-Vs)에 연결되어 있다. 이때, 트랜지스터(Yg)가 턴온되어 커패시터(C1)에는 전압(Vset-Vs)이 충전된다. 그리고 커패시터(Cset)의 제2단에 다이오드(D1)의 캐소드가 연결되어 있고 전원(Vset-Vs)에 다이오드(D1)의 애노드가 연결되어 있으며 다이오드(D1)의 캐소드와 주사 전극(Y) 사이에 트랜지스터(Yrr)가 연결되어 있다. 또한 Vpr 전압을 공급하는 전원(Vpr)과 주사 전극(Y) 사이에 트랜지스터(Ypr)가 연결되어 있으며 Vnf 전압을 공급하는 전원(Vnf)과 주사 전극(Y) 사이에 트랜지스터(Yfr)가 연결되어 있다. 두 트랜지스터(Ypr, Ynf) 사이에 트랜지스터(Ynp)가 연결되어 있다. 그리고 트랜지스터(Vnf)와 주사 전극(Y) 사이에 다이오드(D)가 연결되어 있다.
그리고 이들 트랜지스터(Ys, Yg, Yrr, Ypp, Ypr, Yfr, Ynp)는 하나 또는 다수의 트랜지스터가 연결되어 형성될 수 있다. 여기서, 이들 트랜지스터는 바디 다이오드를 가지는 전계 효과 트랜지스터로 이루어질 수 있으며, 동일 또는 유사한 기능을 하는 다른 트랜지스터로 이루어질 수 있다. 이와 같은 구동회로는 Vpr 전위이 Vs 전위보다 높아져도 전류 역류가 발생하지 않고 안정적으로 리셋 펄스를 생성할 수 있다.
이와 같이 형성되어 있는 본 발명의 제1 실시예에 따른 리셋방전 구동 회로는 아래와 같이 4가지 모드로 동작한다.
먼저, 모드 1이 시작되기 전에 모드 0과 같은 경로를 통해 커패시터(Cset)에는 Vset-Vs 전압이 충전되어 있는 것으로 가정한다. 이와 같은 전압의 충전은 트랜 지스터(Yg)를 턴온시킴으로써 쉽게 수행할 수 있다.
모드 1에서는 트랜지스터(Ypr, Ynp)를 턴온시키고 나머지 트랜지스터들은 모두 턴오프한다. 이와 같이 하면 본 발명의 제1 실시예에서와 같이 리셋 기간에서 전위차에 의해 첫 번째 리셋 방전이 일어나는 시간을 단축시키기 위해 인가되는 전압이 도3에서의 Vs 전압보다 높은 Vpr 전압으로 주사 전극에 인가한다.
모드 2에서는 트랜지스터(Ys, Yrr, Ynp)를 턴온시키고 나머지 트랜지스터들은 모두 턴오프한다. 그러면, 주사 전극(Y)에 Vs 전압이 공급되고, 커패시터(C1)에는 전압(Vset-Vs)이 미리 충전되어 있기 때문에, 커패시터(C1)의 제2단 전압은 Vset으로 된다. 그리고, 커패시터(C1)의 제2단 전압(Vset)은 트랜지스터(Yrr)를 통해 주사 전극(Y)에 공급한다.
모드 3에서는 트랜지스터(Ys, Ypp, Ynp)를 턴온시키고 나머지 트랜지스터들은 모두 턴 오프한다. 그러면, 주사 전극(Y)에 Vs 전압이 인가한다.
모드 4에서는 트랜지스터(Yfr)만 턴온시킨다. 그러면 주사 전극(Y)에 Vs 전압에서 Vnf 전압까지 램프로 하강하는 전압이 인가된다.
이상에서 설명한 바와 같이, 본 발명의 제1 실시예의 리셋 구동방법에 따르면, 램프 상승 기간에서 첫 번째 리셋 방전이 일어나는 시점에서의 주사 전극에 Vs 전압보다 높은 Vpr 전압을 인가하여 주사전극 및 유지전극 사이의 전위차를 증가시킨 다.
그리고 본 발명의 제1 실시예에서는 도 5에 나타낸 것처럼 리셋 기간(Pr)의 상승 램프 기간(Pr1)에서 주사 전극(Y)에 인가하는 전압(Vpr)을 유지방전 펄스 전압보다 높게 인가하였지만 이와는 다르게도 할 수 있다. 아래에서는 이러한 실시예에 대해서 도 7 및 도 8을 참조하여 설명한다.
도 7은 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다. 여기서, 어드레스 기간(Pa) 및 유지 기간(Ps)에서의 구동 동작은 도 5에서와 동일하므로 생략한다.
도 7에 나타낸 바와 같이 리셋 기간(Pr)의 상승 램프 기간(Pr1)에서는 어드레스 전극(A) 및 유지 전극(X)을 0V로 유지한 상태에서 Vs 전압에서 Vset 전압을 향하여 완만하게 상승하는 램프 전압을 주사 전극(Y)에 인가한다. 그리고, 리셋 기간(Pr)의 하강 램프 기간(Pr2)에서 Vpr 전압에서 -Vnf 전압을 향하여 완만하게 하강하는 램프 전압을 주사 전극(Y)에 인가한다. Vpr 전압은 유지기간에서 유지 전극(X) 및 어드레스 전극(Y)에 교대로 인가되는 유지방전펄스 전압(Vs)의 레벨보다 높은 전압이다.
이와 같이 본 발명의 제2 실시예에서는 하강 램프 기간(Pr2)에서 인가되는 하강 램프 전압의 시작시점에 도 3에서보다 높은 전압을 인가함으로써 안정적으로 리셋 방전을 발생시킬 수 있다. 상승 램프 기간(Pr1) 후에 Vset 전압으로부터 V
s 전압까지 급격하게 떨어지면, 그 부분에서 강방전이 발생하는 경우가 있다. 이 강방전은 오방전의 원인이 될 가능성이 있어 PDP의 표시 품질을 현저하게 저하시킬 수가 있다. 따라서 본 발명의 제2 실시예에서와 같이 Vpr 전압을 Vs 전압보다 높게 설정함으로써 급격하게 전압이 떨어지는 것을 억제하여 강방전을 방지할 수가 있다.
아래에서는 본 발명의 제2 실시예에 따른 리셋 구동 방법을 도 6을 참조하여 설명한다.
본 발명의 제2 실시예에 따른 리셋 파형은 먼저, 모드 1(M1)이 시작되기 전에 모드 0(M0)과 같은 경로를 통해 커패시터(Cset)에는 Vset-Vs 전압이 충전되어 있는 것으로 가정한다. 이와 같은 전압의 충전은 트랜지스터(Yg)를 턴온시킴으로써 쉽게 수행할 수 있다.
먼저, 모드 1에서는 트랜지스터(Ys, Ypp, Ynp)를 턴온시키고 나머지 트랜지스터들은 모두 턴오프한다. 그러면, 주사 전극(Y)에 Vs 전압이 인가된다.
다음, 모드 2에서는 트랜지스터(Ys, Yrr, Ynp)를 턴온시키고 나머지 트랜지스터들은 모두 턴오프한다. 그러면, 주사 전극(Y)에 Vs 전압이 공급되고, 커패시터(C1)에는 전압(Vset-Vs)이 미리 충전되어 있기 때문에, 커패시터(C1)의 제2 단자의 전압은 Vset으로 된다. 그리고, 커패시터(C1)의 제2 단자의 전압(Vset)의 전압은 트랜지스터(Yrr)를 통해 주사 전극(Y)에 공급된다.
그리고 모드 3에서는 트랜지스터(Ypr, Ynp)를 턴온시키고 나머지 트랜지스터들은 모두 턴오프한다. 이와 같이 하면 본 발명의 제2 실시예에서와 같이 도3에서의 Vs 전압보다 높은 Vpr 전압으로 주사 전극에 인가된다.
그리고 모드 4에서는 트랜지스터(Yfr)만 턴온시킨다. 그러면 Vpr 전압에서 Vnf 전압까지 램프로 하강하는 전압이 주사 전극(Y)에 공급된다.
도 8은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다. 여기서, 어드레스 기간(Pa) 및 유지 기간(Ps)에서의 구동 동작은 도 5에서와 동일하므로 생략한다.
도 8에 나타낸 바와 같이 리셋 기간(Pr)의 어드레스 전극(A) 및 유지 전극(X)을 0V로 유지한 상태에서 Vpr 전압에서 Vset 전압을 향하여 완만하게 상승하는 램프 전압이 주사 전극(Y)에 인가된다. 그리고 하강 램프 기간(Pr2)에서 Vpr 전압에서 -Vnf 전압을 향하여 완만하게 하강하는 램프 전압을 주사 전극(Y)에 인가한다. Vpr 전압은 유지기간에서 유지 전극(X) 및 어드레스 전극(Y)에 교대로 인가되는 유지방전펄스 전압(Vs)의 레벨보다 높은 전압이다. 이와 같이 함으로써 앞에서 설명한 것과 같이 리셋 방전이 더 빨리 일어나게 되고 따라서 리셋 시간을 단축시킬 수 있으며 오방전을 방지할 수가 있다.
아래에서는 본 발명의 제3 실시예에 따른 리셋 구동 방법을 도 6을 참조하여 설명한다.
본 발명의 제3 실시예에 따른 리셋 파형은 먼저, 모드 1(M1)이 시작되기 전에 모드 0(M0)과 같은 경로를 통해 커패시터(Cset)에는 Vset-Vs 전압이 충전되어 있는 것으로 가정한다. 이와 같은 전압의 충전은 트랜지스터(Yg)를 턴온시킴으로써 쉽게 수행할 수 있다.
먼저, 모드 1에서는 트랜지스터(Ypr, Ynp)를 턴온시키고 나머지 트랜지스터들은 모두 턴오프한다. 이와 같이 하면 본 발명의 제2 실시예에서와 같이 도3에서의 Vs 전압보다 높은 Vpr 전압으로 주사 전극에 인가된다.
다음, 모드 2에서는 트랜지스터(Ys, Yrr, Ynp)를 턴온시키고 나머지 트랜지스터들은 모두 턴오프한다. 그러면, 커패시터(C1)의 제1 단자에 Vs 전압이 공급되고, 커패시터(C1)에는 전압(Vset-Vs)이 미리 충전되어 있기 때문에, 커패시터(C1)의 제2 단자의 전압은 Vset으로 된다. 그리고, 커패시터(C1)의 제2 단자의 전압(Vset)의 전압은 트랜지스터(Yrr)를 통해 주사 전극(Y)에 공급된다.
그리고 모드 3에서는 트랜지스터(Ypr, Ynp)를 턴온시키고 나머지 트랜지스터 들은 모두 턴오프한다. 이와 같이 하면 본 발명의 제2 실시예에서와 같이 도3에서의 Vs 전압보다 높은 Vpr 전압으로 주사 전극에 인가된다.
그리고 모드 4에서는 트랜지스터(Yfr)만 턴온시킨다. 그러면 Vpr 전압에서 Vnf 전압까지 램프로 하강하는 전압이 주사 전극(Y)에 공급된다.
이상에서 살펴본 바와 같이 본 발명의 제1 내지 제3 실시예에 따른 리셋 구동 방법에 따르면 유지전극 및 주사 전극, 주사전극 및 어드레스 전극 간 전위차를 크게 함으로써 구동 전압 마진이 확대될 수 있고 리셋 방전을 안정적으로 수행할 수 있으며 리셋 시간을 단축시킬 수가 있다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
이상에서 설명한 바와 같이 본 발명에 의하면, 리셋 기간에서 구동 전압 마진이 확대되고 안정적인 리셋 방전이 이루어질 수 있다.
Claims (15)
- 제1 전극 및 제2 전극과, 상기 제1 전극 및 제2 전극 사이에 방전 셀이 형성되는 플라즈마 디스플레이 패널의 구동방법에 있어서,리셋 기간에서,상기 제2 전극에 제5 전압을 인가한 상태에서 상기 제1 전극의 전압을 제1 전압에서 제2 전압까지 완만하게 상승시키는 단계,상기 제2 전극에 상기 제5 전압을 인가한 상태에서 상기 제1 전극에 상기 제2 전압보다 낮은 제3 전압을 인가하는 단계, 그리고상기 제2 전극에 상기 제5 전압보다 높은 제6 전압을 인가한 상태에서 상기 제1 전극의 전압을 상기 제3 전압에서 제4 전압까지 완만하게 하강시키는 단계를 포함하며,상기 제1 전압과 상기 제5 전압의 차 또는 상기 제3 전압과 상기 제5 전압의 차 중 적어도 하나가 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압의 크기보다 큰 플라즈마 디스플레이 패널의 구동 방법.
- 제1항에 있어서,상기 제1 전압이 상기 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압보다 높은 전압인 플라즈마 디스플레이 패널의 구동 방법.
- 제1항에 있어서,상기 제3 전압이 상기 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압보다 높은 전압인 플라즈마 디스플레이 패널의 구동 방법.
- 제1항에 있어서,상기 제1 전압 및 제3 전압이 상기 유지 기간에서 상기 제1 전극에 인가되는 전압 중 높은 전압보다 높은 전압인 플라즈마 디스플레이 패널의 구동 방법.
- 삭제
- 복수의 주사 전극을 포함하는 플라즈마 디스플레이 패널의 구동장치에 있어서,제1 전압을 공급하는 제1 전원과 상기 복수의 주사 전극 사이에 연결되어 있는 제1 트랜지스터,상기 제1 전압보다 낮은 제2 전압을 공급하는 제2 전원과 상기 복수의 주사 전극 사이에 연결되어 있는 제2 트랜지스터,상기 제1 트랜지스터 및 제2 트랜지스터의 접점에 일단이 연결되고 타단이 제3 전압을 공급하는 제3 전원에 연결되어 있는 커패시터,상기 제1 트랜지스터 및 제2 트랜지스터의 접점과 상기 복수의 주사 전극 사이에 연결되어 있는 제3 트랜지스터,상기 제3 트랜지스터와 상기 복수의 주사 전극 사이에 연결되어 있는 제4 트랜지스터,상기 커패시터의 타단과 상기 제3 트랜지스터 및 제4 트랜지스터의 접점 사이에 연결되어 있는 제5 트랜지스터, 그리고상기 제3 트랜지스터와 제4 트랜지스터의 접점과 상기 제1 전압보다 높은 제4 전압을 공급하는 제4 전원 사이에 연결되어 있는 제6 트랜지스터를 포함하는 플라즈마 디스플레이 패널의 구동 장치.
- 제6항에 있어서,상기 제1 전압은 유지 기간에서 상기 주사 전극에 인가되는 전압 중 높은 전압과 동일한 전압인 플라즈마 디스플레이 패널의 구동 장치.
- 제6항에 있어서,어드레스 기간에서 선택하고자 하는 셀의 주사 전극에 인가되는 전압을 공급하는 제5 전원과 상기 복수의 주사 전극 사이에 연결되어 있는 제7 트랜지스터를 더 포함하는 플라즈마 디스플레이 패널의 구동 장치.
- 제8항에 있어서,상기 제3 전원과 상기 커패시터 사이에 연결되어 있는 제1 다이오드; 및상기 제7 트랜지스터와 상기 복수의 주사 전극 사이에 연결되어 있는 제2 다이오드를 더 포함하는 플라즈마 디스플레이 패널의 구동 장치.
- 제9항에 있어서,상기 제3 전압은 상기 복수의 주사 전극에 인가되는 최고 전압과 상기 제1 전압의 차와 동일한 레벨의 전압인 플라즈마 디스플레이 패널의 구동 장치.
- 삭제
- 제1 기판 위에 각각 나란히 형성되는 복수의 제1 전극 및 복수의 제2 전극, 그리고 상기 제1 전극 및 상기 제2 전극에 교차하며 제2 기판 위에 형성되는 복수의 어드레스 전극을 포함하는 플라즈마 디스플레이 패널, 그리고리셋 기간에서 상기 복수의 제2 전극에 제5 전압을 인가한 상태에서 상기 복수의 제1 전극에 제1 전압에서 제2 전압까지 완만하게 상승하는 파형을 인가한 후 상기 복수의 제1 전극에 상기 제2 전압보다 낮은 제3 전압을 인가하고, 상기 복수의 제2 전극에 상기 제5 전압보다 높은 제6 전압을 인가한 상태에서 상기 복수의 제1 전극에 상기 제3 전압에서 제4 전압까지 완만하게 하강하는 파형을 인가하는 구동 회로를 포함하며,상기 제1 전압과 상기 제5 전압의 차 또는 상기 제3 전압과 상기 제5 전압의 차 중 적어도 하나가 유지 기간에서 상기 복수의 제1 전극과 상기 복수의 제2 전극에 인가되는 유지 방전 펄스의 높은 전압의 크기보다 큰 플라즈마 표시 장치.
- 제12항에 있어서,상기 제1 전압의 크기가 상기 유지 방전 펄스의 높은 전압의 크기보다 큰 플라즈마 표시 장치.
- 제12항에 있어서,상기 제3 전압의 크기가 상기 유지 방전 펄스의 높은 전압의 크기보다 큰 플라즈마 표시 장치.
- 제12항에 있어서,상기 제1 전압 및 제3 전압의 크기가 상기 유지방전 펄스의 높은 전압의 크기보다 큰 플라즈마 표시 장치.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020030074251A KR100589378B1 (ko) | 2003-10-23 | 2003-10-23 | 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법과플라즈마 표시 장치 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020030074251A KR100589378B1 (ko) | 2003-10-23 | 2003-10-23 | 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법과플라즈마 표시 장치 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20050038935A KR20050038935A (ko) | 2005-04-29 |
KR100589378B1 true KR100589378B1 (ko) | 2006-06-13 |
Family
ID=37241241
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020030074251A KR100589378B1 (ko) | 2003-10-23 | 2003-10-23 | 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법과플라즈마 표시 장치 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100589378B1 (ko) |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100829249B1 (ko) * | 2005-09-26 | 2008-05-14 | 엘지전자 주식회사 | 플라즈마 디스플레이 장치 및 그의 구동 방법 |
KR100794162B1 (ko) * | 2006-01-12 | 2008-01-11 | 엘지전자 주식회사 | 플라즈마 디스플레이 장치 |
-
2003
- 2003-10-23 KR KR1020030074251A patent/KR100589378B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR20050038935A (ko) | 2005-04-29 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR100551008B1 (ko) | 플라즈마 디스플레이 패널과 그의 구동 방법 | |
KR100589314B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100578816B1 (ko) | 플라즈마 표시 장치와 그의 구동방법 | |
JP4118866B2 (ja) | プラズマディスプレイパネルの駆動装置及び駆動方法並びにプラズマディスプレイパネル | |
US7542015B2 (en) | Driving device of plasma display panel | |
US7576710B2 (en) | Plasma display panel and driving method thereof | |
KR100667360B1 (ko) | 플라즈마 디스플레이 장치 및 그의 구동 방법 | |
KR100493623B1 (ko) | 플라즈마 디스플레이 패널의 구동장치 | |
KR100560481B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100589378B1 (ko) | 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법과플라즈마 표시 장치 | |
KR100589377B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100542518B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100570680B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 장치 | |
KR100570610B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100551037B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100578832B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100458567B1 (ko) | 멀티 레벨의 구동 전압을 발생하는 플라즈마 디스플레이패널의 구동 장치 및 그 구동 방법 | |
KR100740100B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR20050040558A (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR20050023462A (ko) | 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법 | |
KR100578835B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR20050038932A (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100508953B1 (ko) | 플라즈마 디스플레이 패널과 그의 구동 장치 | |
KR100560513B1 (ko) | 플라즈마 디스플레이 패널의 구동 방법 및 플라즈마 표시장치 | |
KR100563072B1 (ko) | 플라즈마 디스플레이 패널의 구동방법 및 구동장치 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
LAPS | Lapse due to unpaid annual fee |