KR100499088B1 - 플라즈마 디스플레이 패널의 구동방법 및 장치 - Google Patents
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Abstract
본 발명은 초기화를 안정화함과 아울러 어드레스기간을 줄이도록 한 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
이 플라즈마 디스플레이 패널의 구동방법 및 장치는 제1 전극과 제2 전극에 1차 초기화파형을 공급하여 셀들에 1차 쓰기 방전과 1차 소거방전을 일으켜 상기 셀들을 1차 초기화하고 상기 제1 전극과 상기 제2 전극에 2차 초기화파형을 공급하여 상기 셀들에 2차 쓰기 방전과 2차 소거방전을 일으켜 상기 셀들을 2차 초기화한 후에, 제3 전극들에 데이터를 공급하고 상기 제1 및 제2 전극 중 적어도 어느 하나에 스캔펄스를 공급하여 상기 셀들을 선택하고 상기 제1 전극들과 상기 제2 전극들에 교대로 서스테인펄스를 공급하여 표시를 행하게 된다.
Description
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 초기화를 안정화함과 아울러 어드레스기간을 줄이도록 한 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 한다)은 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 방전할 때 발생하는 자외선이 형광체를 발광시킴으로써 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 화질이 향상되고 있다.
도 1을 참조하면, 종래의 3전극 교류 면방전형 PDP의 방전셀은 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과, 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과 직교하는 어드레스전극(X1 내지 Xm)을 구비한다.
스캔전극(Y1 내지 Yn), 서스테인전극(Z) 및 어드레스전극(X1 내지 Xm)의 교차부에는 적색, 녹색 및 청색 중 어느 하나를 표시하기 위한 셀(1)이 형성된다. 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)은 도시하지 않은 상부기판 상에 형성된다. 상부기판에는 도시하지 않은 유전체층과 MgO 보호층이 적층된다. 어드레스전극(X1 내지 Xm)은 도시하지 않은 하부기판 상에 형성된다. 하부기판 상에는 수평으로 인접한 셀들 간에 광학적, 전기적 혼신을 방지하기 위한 격벽이 형성된다. 하부기판과 격벽 표면에는 진공자외선에 의해 여기되어 가시광을 방출하는 형광체가 형성된다. 상부기판과 하부기판 사이의 방전공간에는 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1 내지 SF8) 각각은 전술한 바와 같이, 리셋기간, 어드레스기간 및 서스테인기간으로 나누어지게 된다. 각 서브필드의 리셋기간과 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간과 그에 할당되는 서스테인펄스의 수는 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 3은 두 개의 서브필드에 공급되는 PDP의 구동파형을 나타낸다.
도 3을 참조하면, PDP는 전화면을 초기화시키기 위한 리셋기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 구동된다.
리셋기간에 있어서, 셋업기간(SU)에는 모든 스캔전극들(Y)에 상승 램프파형(Ramp-up)이 동시에 공급된다. 이와 동시에, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 공급된다. 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에서 스캔전극(Y)과 어드레스전극(X) 사이와 스캔전극(Y)과 서스테인전극(Z) 사이에는 빛이 거의 발생되지 않는 암방전(Dark discharge)이 일어난다. 이 셋업방전에 의해 어드레스전극(X)과 서스테인전극(Z) 상에는 정극성(+)의 벽전하가 쌓이게 되며, 스캔전극(Y) 상에는 부극성(-)의 벽전하가 쌓이게 된다.
셋다운기간(SD)에는 상승 램프파형(Ramp-up)이 공급된 후, 상승 램프파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지기 시작하여 기저전압(GND) 또는 부극성의 특정 전압레벨까지 떨어지는 하강 램프파형(Ramp-dn)이 스캔전극들(Y)에 동시에 공급된다. 이와 동시에, 서스테인전극(Z)에는 정극성의 서스테인전압(Vs)이 공급되고, 어드레스전극(X)에는 0[V]가 공급된다. 이렇게 하강 램프파형(Ramp-dn)이 공급될 때, 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 암방전이 일어난다. 또한, 스캔전극(Y)과 어드레스전극(Z) 사이에서는 하강 램프파형(Ramp-dn)이 떨어지는 구간에서 방전이 일어나지 않고 하강 램프파형(Ramp-dn)의 하한점에서 암방전이 일어난다. 이러한 셋다운기간(SD)에 일어나는 방전에 의해 셋업기간(SU)에 발생된 벽전하들 중에서 어드레스방전에 불필요한 과도한 벽전하를 소거시키게 된다. 셋업기간(SU)과 셋다운기간(SD)에서의 벽전하 변화를 살펴보면, 어드레스전극(X) 상의 벽전하 변화는 거의 없으며, 스캔전극(Y)의 부극성(-) 벽전하가 감소한다. 반면에, 서스테인전극(Z)의 벽전하는 셋업기간(SU)에서의 극성이 정극성이었으나, 스캔전극(Y)의 부극성(-) 벽전하의 감소분만큼 자신에게 부극성 벽전하가 쌓이면서 셋다운기간(SD)에서 그 극성이 부극성으로 반전된다.
어드레스기간에는 부극성 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 공급됨과 동시에 스캔펄스(scan)에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 공급된다. 스캔펄스(scan)와 데이터펄스(data)의 전압차와 리셋기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 공급되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 서스테인전압(Vs)이 공급될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다. 이 어드레스기간 동안 서스테인전극(Z)에는 정극성 직류전압(Zdc)이 공급된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 공급된다. 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 공급될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전 즉, 표시방전이 발생된다.
서스테인방전이 완료된 후에는 펄스폭과 전압레벨이 작은 소거 램프파형(ramp-ers)이 서스테인전극(Z)에 공급되어 전화면의 셀들 내에 잔류하는 벽전하를 소거시키게 된다.
그런데 종래의 PDP는 리셋기간 동안 스캔전극(Y)과 서스테인전극(Z) 사이에 방전이 일어남과 동시에 스캔전극(Y)과 어드레스전극(X) 사이에 방전이 일어나게 하지만 그 초기화방전이 셀 내의 이전 벽전하 상태나 방전가스의 조성에 따라 불안정하게 되는 문제점이 있다. 또한, 종래의 PDP는 효율을 높이기 위하여 방전가스에서 Xe의 함량을 높이게 되면 어드레스방전의 지연시간 즉, 어드레스 지터값(Address jitter) 값이 커지게 되므로 그 만큼 어드레스기간이 길어지게 된다. 결과적으로, 종래의 PDP는 초기화가 불안정하고 고속구동이 어렵다.
따라서, 본 발명의 목적은 초기화를 안정화함과 아울러 어드레스기간을 줄이도록 한 PDP의 구동방법 및 장치를 제공함에 있다.
상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 PDP의 구동방법은 제1 전극과 제2 전극에 1차 초기화파형을 공급하여 셀들에 1차 쓰기 방전과 1차 소거방전을 일으켜 상기 셀들을 1차 초기화하는 단계와; 상기 제1 전극과 상기 제2 전극에 2차 초기화파형을 공급하여 상기 셀들에 2차 쓰기 방전과 2차 소거방전을 일으켜 상기 셀들을 2차 초기화하는 단계와; 제3 전극들에 데이터를 공급하고 상기 제1 및 제2 전극 중 적어도 어느 하나에 스캔펄스를 공급하여 상기 셀들을 선택하는 단계와; 상기 제1 전극들과 상기 제2 전극들에 교대로 서스테인펄스를 공급하여 표시를 행하는 단계를 포함한다.
상기 1차 초기화파형은 상기 제1 전극에 공급되는 1차 상승 램프파형 및 1차 하강 램프파형과; 상기 1차 하강 램프파형에 동기되어 상기 제2 전극에 공급되는 구형파를 포함한다.
상기 2차 초기화파형은 상기 제1 전극과 상기 제2 전극에 동시에 공급되는 2차 상승 램프파형 및 2차 하강 램프파형을 포함한다.
상기 제1 전극에 공급되는 상기 1차 상승 램프파형과 상기 2차 상승 래프파형의 전압은 다른 것을 특징으로 한다.
상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 전압은 서브필드에 따라 다른 것을 특징으로 한다.
상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 공급기간과 상기 2차 상승 래프파형의 공급기간은 다른 것을 특징으로 한다.
상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 공급기간은 서브필드에 따라 다른 것을 특징으로 한다.
상기 제1 전극에 공급되는 상기 1차 상승 램프파형과 상기 2차 상승 래프파형의 기울기는 다른 것을 특징으로 한다.
상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 기울기는 서브필드에 따라 다른 것을 특징으로 한다.
상기 제1 전극에 공급되는 상기 2차 상승 램프파형의 기울기는 서브필드에 따라 다른 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 구동방법은 제1 전극에 공급되는 1차 상승 램프파형 및 1차 하강 램프파형을 공급하고, 상기 1차 하강 램프파형에 동기되어 제2 전극에 구형파를 공급하여 상기 제1 전극과 상기 제2 전극 사이에 면방전을 일으킴과 동시에 상기 제1 전극 및 상기 제2 전극 중 적어도 어느 하나와 상기 제3 전극 사이에 대향방전을 일으켜 상기 셀들을 1차 초기화하는 단계와; 상기 제1 전극과 상기 제2 전극에 2차 초기화파형을 공급하여 상기 제1 전극과 상기 제3 전극 사이에 대향방전을 일으킴과 동시에 상기 제2 전극과 상기 제3 전극 사이에 대향방전을 일으켜 상기 셀들을 2차 초기화하는 단계와; 상기 제3 전극들에 데이터를 공급하고 상기 제1 전극과 상기 제2 전극 중 적어도 어느 하나에 스캔펄스를 공급하여 상기 제1 전극과 상기 제2 전극 중 적어도 어느 하나와 상기 제3 전극 사이에 대향 방전을 일으킴으로써 셀을 선택하는 단계와; 상기 제1 전극들과 상기 제2 전극들에 교대로 서스테인펄스를 공급하여 상기 제1 전극들과 상기 제2 전극들 사이에 면방전을 일으킴으로써 표시를 행하는 단계를 포함한다.
본 발명의 실시예에 따른 PDP의 구동장치는 제1 전극과 제2 전극에 1차 초기화파형을 공급하여 셀들에 1차 쓰기 방전과 1차 소거방전을 일으켜 상기 셀들을 1차 초기화하고 상기 제1 전극과 상기 제2 전극에 2차 초기화파형을 공급하여 상기 셀들에 2차 쓰기 방전과 2차 소거방전을 일으켜 상기 셀들을 2차 초기화하기 위한 초기화 구동부와; 제3 전극들에 데이터를 공급하고 상기 제1 및 제2 전극 중 적어도 어느 하나에 스캔펄스를 공급하여 상기 셀을 선택하는 셀 선택 구동부와; 상기 제1 전극들과 상기 제2 전극들에 교대로 서스테인펄스를 공급하여 표시를 행하기 위한 표시 구동부를 구비한다.
상기 초기화 구동부는 1차 상승 램프파형 및 1차 하강 램프파형을 상기 제1 전극에 공급하고 상기 1차 하강 램프파형에 동기되는 구형파를 상기 제2 전극에 공급하는 것을 특징으로 한다.
상기 초기화 구동부는 2차 상승 램프파형 및 2차 하강 램프파형을 상기 제1 전극과 상기 제2 전극에 동시에 공급하는 것을 특징으로 한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부한 도면들을 참조한 실시예들에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 4 내지 도 12를 참조하여 본 발명의 바람직한 실시예들에 대하여 설명하기로 한다.
도 4 및 도 5를 참조하면, 본 발명의 제1 실시예에 따른 PDP의 구동방법은 초기화파형을 스캔전극들(Y)에 2회 연속 공급하는 리셋기간과, 셀을 선택하기 위한 어드레스기간 및 선택된 셀에 대하여 표시를 행하기 위한 서스테인기간을 포함한다.
리셋기간은 스캔전극들(Y)과 서스테인전극들(Z) 사이에 방전을 일으킴과 아울러 스캔전극들(Y)과 어드레스전극들(X) 사이에 방전을 일으키기 위한 1차 리셋기간(rst1)과, 스캔전극들(Y)과 어드레스전극들(X) 사이에 방전을 일으킴과 아울러 서스테인전극들(Y)과 어드레스전극들(X) 사이에 방전을 일으키기 위한 2차 리셋기간(rst2)을 포함한다.
1차 리셋기간(rst1)의 초기 t1 기간 동안, 스캔전극들(Y)에는 대략 서스테인전압(Vs)부터 셋업전압(Vsetup)까지 소정 기울기로 상승하는 상승 램프파형(Ruy1)이 공급되고 서스테인전극들(Z)과 어드레스전극들(X)에는 기저전압(GND)이나 0V가 공급된다. 그러면 전화면의 셀들 내에서 스캔전극들(Y)과 서스테인전극들(Z) 사이에 쓰기 암방전이 일어남과 동시에 스캔전극들(Y)과 어드레스전극들(X) 사이에 쓰기 암방전이 일어나게 된다. 이러한 1차 셋업 방전의 결과로 스캔전극들(Y) 상에는 부극성의 벽전하들이 쌓이게 되고 서스테인전극들(Z)과 어드레스전극들(X) 상에는 정극성의 벽전하들이 쌓이게 된다.
1차 리셋기간(rst1)의 t2 기간 동안, 스캔전극들(Y)에는 대략 서스테인전압(Vs)부터 부극성 전압까지 하강하는 하강 램프파형(Rdy1)이 공급되고 서스테인전극(Z)에는 정극성 전압의 구형파펄스(Rsq)가 공급된다. 여기서, 하강 램프파형(Rdy1)의 부극성 전압은 스캔전압(Vscan)으로 선택될 수 있으며, 구형파펄스(Rsq)의 전압은 서스테인전압(Vs)으로 선택될 수 있다. 이 t2 기간 동안, 어드레스전극(X)은 0[V]나 기저전압(GND)을 유지한다. 그러면 스캔전극들(Y)과 어드레스전극들(X) 사이에 그리고 스캔전극들(Z)과 서스테인전극들(Z) 사이에 소거 암방전이 발생된다. 이 셋다운 방전의 결과로, 각 전극들(X, Y, Z) 상의 벽전하들이 일부 소거된다.
이러한 1차 리셋기간(rst1)은 스캔전극들(Y)과 서스테인전극들(Z) 상에 부극성 벽전하를 균일하게 쌓고 어드레스전극들 상에 정극성 벽전하를 쌓음으로써 이어지는 2 차 리셋기간의 초기화 구동을 안정화시키게 된다.
1차 리셋기간(rst)이 끝나고 소정의 휴지기간 동안 각 전극들(X, Y, Z)에는 기저전압(GND)이나 0[V]가 공급된다.
2차 리셋기간(rst2)의 초기 t3 기간 동안, 스캔전극들(Y)과 서스테인전극들(Z)에는 대략 서스테인전압(Vs)부터 셋업전압(Vsetup)까지 소정 기울기로 상승하는 상승 램프파형(Ruy2, Ruz)이 동시에 공급된다. 이 때, 어드레스전극(X)은 0[V]나 기저전압(GND)을 유지한다. 이렇게 스캔전극들(Y)과 서스테인전극들(Z)에 상승 램프파형(Ruy2, Ruz)이 동시에 공급되면 1차 초기화된 셀들 내에서 스캔전극들(Y)과 어드레스전극들(X) 사이에 그리고 서스테인전극들(Z)과 어드레스전극들(X) 사이에 2차 쓰기 암방전이 동시에 일어나게 된다. 그 결과 스캔전극들(Y)과 서스테인전극들(Z) 각각에 부극성의 벽전하가 쌓이게 되고 어드레스전극들(X) 상에 정극성의 벽전하가 쌓이게 된다.
2차 리셋기간(rst2)의 t4 기간 동안 스캔전극들(Y)에는 대략 서스테인전압(Vs)부터 부극성 전압까지 하강하는 하강 램프파형(Rdy2)이 공급됨과 동시에 서스테인전극들(Z)에는 대략 서스테인전압(Vs)부터 0[V]나 기저전압(GND)까지 하강하는 하강 램프파형(Rdz)이 공급된다. 이 때 어드레스전극(X)은 0[V]나 기저전압(GND)을 유지한다. 이러한 하강 램프파형(Rdy2, Rdz)에 의해 스캔전극(Y)과 어드레스전극(X) 사이 그리고 서스테인전극(Z)과 어드레스전극(X) 사이에 2차 소거 암방전이 발생된다. 이 2차 셋다운 방전의 결과로, 어드레스방전에 불필요한 과도 벽전하가 소거된다. 그리고 전 셀들 내에는 균일한 벽전하가 잔류하게 된다.
일반적으로 적색, 녹색 및 청색의 서브픽셀은 형광체물질의 특성에 따라 방전개시전압(Firing voltage)에서 편차를 가지게 된다. 스캔전극들(Y)에 공급되는 2차 하강 램프파형(Rdy2)이 부극성 전압까지 하강하면 적색, 녹색 및 청색의 서브픽셀에서 나타나는 방전개시전압의 편차에 관계없이 방전개시조건을 균일하게 할 수 있다. 따라서, 2차 하강 램프파형(Rdy2)에 의한 소거 암방전은 전셀들 내에서의 방전조건을 균일하게 하여 구동마진을 높이게 된다.
2차 리셋기간의 초기화에 의해 스캔전극들(Y)과 서스테인전극(Z) 간에 전위차가 거의 없고 그 전극들(Y, Z) 상에 각각 형성된 벽전하양이 거의 동일하게 유지되기 때문에 PDP를 50℃ 이상의 고온환경에서 사용하더라도 어드레스방전이 개시되기 전의 벽전하 변동에 의해 발생되는 오방전이 일어나지 않는다.
결과적으로 2차 리셋기간(rst2)은 전 셀들의 초기화를 균일하게 하여 어드레스 구동을 안정화시키고 구동마진을 높이는 역할을 한다.
리셋기간 후의 벽전하분포면에서 본 발명의 PDP와 종래의 PDP를 비교하면, 종래의 PDP는 상승 램프파형이 도 3과 같이 스캔전극들(Y)에만 인가되어 스캔전극들(Y)과 서스테인전극들(Z) 사이에서 일어나는 면방전의 결과로 전계가 집중되는 스캔전극들(Y)과 서스테인전극들(Z)의 마주보는 변주위에만 벽전하가 쌓이게 된다. 이에 비하여, 본 발명의 PDP는 2차 리셋기간(rst)에서 상승 램프파형(Ruy1, Ruz1)이 스캔전극들(Y)과 서스테인전극들(Z)에 동시에 인가되어 스캔전극들(Y)과 서스테인전극들(Z) 사이에 전위차가 거의 없으므로 스캔전극들(Y)과 어드레스전극들(X) 사이에 그리고 서스테인전극들(Z)과 어드레스전극들(X) 사이에 대향방전이 일어나게 되어 스캔전극들(Y)과 서스테인전극들(Z)의 거의 전면적에서 벽전하가 쌓이게 된다. 이 때문에 본 발명의 PDP는 스캔전극들(Y) 상에 부극성의 벽전하를 충분히 쌓고 어드레스전극들(X) 상에 정극성의 벽전하를 충분히 쌓음으로써 어드레스방전에 필요한 스캔전압(Vscan)과 데이터전압(Vd)을 낮출 수 있고 어드레스 방전의 지연을 줄일 수 있다.
어드레스기간 동안, 스캔전극들(Y)과 서스테인전극들(Z)에는 정극성의 바이어스전압(Vscan-com, Vz-com)이 공급된다. 그리고 바이어스전압(Vscan-com)으로부터 스캔전압(Vscan)까지 떨어지는 스캔펄스(scan)가 스캔전극들(Y)에 순차적으로 공급되고 그 스캔펄스(scan)에 동기되어 데이터전압(Vd)의 데이터펄스가 어드레스전극들(X)에 공급된다. 스캔전극들(Y)과 서스테인전극들(Z)에 공급되는 바이어스전압(Vscan-com, Vz-com)은 동일하게 설정되거나 다르게 설정될 수 있다. 예컨대, 서스테인전극들(Z)에 공급되는 바이어스전압(Vz-com)이 스캔전극들(Z)에 공급되는 바이어스전압(Vscan-com)보다 높게 설정되면 어드레스기간 동안 서스테인전극들(Z)에 더 많은 양의 부극성 벽전하가 쌓일 수 있다. 이렇게 서스테인전극들(Z)에 많은 양의 부극성 벽전하가 쌓이게 되면 서스테인전극들(Z)에 첫 번째 서스테인펄스(sus)가 공급될 때 서스테인전극들(Z)과 스캔전극들(Y) 사이의 전압차가 더 커지게 되므로 방전이 쉽고 안정되게 일어나게 되므로 서스테인 구동마진이 그 만큼 높아지게 된다. 스캔펄스(scan)와 데이터펄스(data)의 전압차와 리셋기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 공급되는 온셀(on-cell) 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 온셀들 내에는 서스테인전압(Vs)이 공급될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 공급된다. 어드레스방전에 의해 선택된 온셀들은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 공급될 때마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전이 발생된다.
마지막 서스테인펄스(sus)가 서스테인전극들(Z)에 공급되어 서스테인방전이 종료된 후에는 스캔전극들(Y)과 서스테인전극들(Z)에 소거 램프파형(ersy, ersz)이 연속으로 공급된다. 소거 램프파형(ersy, ersz)은 서스테인방전에 의해 생성된 벽전하들을 소거시키는 역할을 한다. 이 소거 램프파형(ersy, ersz)은 스캔전극(Z)과 서스테인전극(Z) 중 어느 하나에 공급될 수도 있고 생략될 수도 있다. 예컨대, 본원 출원인에 의해 기출원된 특허출원 제10-2000-0012669호, 특허출원 제10-2000-0053214호, 특허출원 제10-2001-0003003호, 특허출원 제10-2001-0006492호, 특허출원 제10-2002-0082512호, 특허출원 제10-2002-0082513호, 특허출원 제10-2002-0082576호 등을 통하여 제안된 소위 'SWSE(Selective Witing and Selective Erasure) 방식'에서 선택적 쓰기 서브필드에 본 발명이 적용되면 선택적 쓰기 서브필드의 마지막 서브필드에서는 소거 램프파형(ersy, ersz)이 생략된다.
도 6은 본 발명의 제2 실시예에 따른 PDP의 구동방법을 나타낸다.
도 6을 참조하면, 본 발명의 제2 실시예에 따른 PDP의 구동방법은 한 프레임기간 내에 배치된 서브필드들에 따라 초기화전압을 다르게 제어한다.
m(단, m은 임의의 양의 정수) 번째 서브필드에 있어서, 1차 리셋기간(rst1)은 t1 기간과 t2 기간을 포함한다. t1 기간에는 스캔전극들(Y)에 대략 서스테인전압(Vs)으로부터 셋업전압(Vsetup)까지 상승하는 1차 상승 램프파형(Ruym1)이 공급되고 서스테인전극들(Z)에는 기저전압(GND)이나 0[V]가 공급된다. t2 기간에는 스캔전극들(Y)에 대략 서스테인전압(Vs)부터 부극성 전압까지 하강하는 1차 하강 램프파형(Rdym1)이 공급되고 서스테인전극들(Z)에 정극성 전압의 구형파펄스(Rsq)가 공급된다.
m 번째 서브필드에 있어서, 2차 리셋기간(rst2)은 t3 기간과 t4 기간을 포함한다. 이 2차 리셋기간(rst2)에는 스캔전극들(Y)에 1차 리셋기간(rst1)과 동일한 파형이 공급된다. 이에 비하여, t3 기간 동안 서스테인전극들(Z)에는 셋업전압(Vsetup)까지 상승하는 상승 램프파형(Ruym1)이 공급되고 t4 기간 동안 대략 서스테인전압(Vs)부터 기저전압(GND)이나 0[V]까지 하강하는 하강 램프파형(Rdz)이 공급된다.
n(단, n은 m과 다른 양의 정수) 번째 서브필드에 있어서, 리셋기간의 1차 리셋기간(rst1)에는 스캔전극들(Y)에 셋업전압(Vsetup)과 다른 제2 셋업전압(Vsetup2)이 공급되고 2차 리셋기간(rst2)에는 스캔전극들(Y)에 셋업전압(Vsetup)이 공급된다. 여기서, 제2 셋업전압(Vsetup2)은 셋업전압(Vsetup)보다 낮다. 서스테인전극들(Z)에는 n 번째 서브필드의 리셋기간 동안 m 번째 서브필드의 리셋기간과 동일한 파형이 공급된다.
이러한 m 번째 서브필드와 n 번째 서브필드의 리셋기간 동안 어드레스전극들(X)에는 기저전압(GND)이나 0[V]가 공급된다.
m 번째 서브필드와 n 번째 서브필드에 있어서, 어드레스기간과 서스테인기간의 구동파형과 그에 따른 동작은 실질적으로 이전 실시예와 동일하므로 이에 대한 상세한 설명을 생략하기로 한다.
이 실시예는 콘트라스트를 높이기 위하여 한 프레임기간 내에 배치된 다수의 서브필드들 중에서 적어도 하나의 서브필드들의 셋업전압을 낮춤으로써 콘트라스트를 높이게 된다. 즉, 본 발명의 제2 실시예에 따른 PDP의 구동방법은 2차 리셋의 초기화구동을 안정화시키기 위한 1차 초기화파형에서 상승 램프파형의 전압을 일부 서브필드에서 낮추어 셋업방전을 약하게 일으킨다. 셋업방전이 약하게 일어나면 그 만큼 셀 내에서의 발광양이 작아지므로 콘트라스트비에서 흑레벨이 낮아지게 되어 콘트라스특성이 높아지게 된다.
m 번째 서브필드는 한 프레임기간 내에 배치된 서브필드들 중에서 초기에 배치되는 적어도 하나의 서브필드로 선택될 수 있으며, n 번째 서브필드는 한 프레임기간 내에 배치된 서브필드들 중에서 m 번째 서브필드를 제외한 적어도 하나의 서브필드로 선택될 수 있다. 또한, m 번째 서브필드와 n 번째 서브필드는 교대로 또는 주기적으로 배치될 수도 있다.
본 발명의 제2 실시예에 따른 PDP의 구동방법은 도시하지 않았지만 1차 리셋기간의 셋업전압뿐만 아니라 2차 리셋기간의 셋업전압을 서브필드에 따라 다르게 제어할 수 있다.
도 7은 본 발명의 제3 실시예에 따른 PDP의 고동방법을 나타낸다.
도 7을 참조하면, 본 발명의 제3 실시예에 따른 PDP의 구동방법은 한 프레임기간 내에 배치된 서브필드들에 따라 리셋기간을 다르게 제어한다.
m 번째 서브필드는 도 6의 m 번째 서브필드와 실질적으로 동일하다.
n 번째 서브필드의 1차 리셋기간(rstn1)은 콘트라스트의 개선과 구동시간을 줄이기 위하여 m 번째 서브필드의 1차 리셋기간(rstm1)보다 작게 설정된다. 이를 위하여, n 번째 서브필드의 1차 리셋기간(rstn1) 동안 스캔전극들(Y)에 공급되는 1차 상승 램프파형(Ruyn1)의 기울기는 m 번째 서브필드의 1 차 상승 램프파형(Ruym1)과 동일하고 셋업전압(Vsetup)이 유지되는 유지기간이 m 번째 서브필드의 1차 상승 램프파형(Ruym1)보다 짧게 된다. n 번째 서브필드의 2차 리셋기간(rstn2), 어드레스기간 및 서스테인기간 동안 스캔전극들(Y)에 공급되는 구동파형은 m 번째 서브필드와 실질적으로 동일하다.
n 번째 서브필드 동안 서스테인전극들(Z)에는 m 번째 서브필드와 동일한 동일한 파형이 공급된다.
이러한 m 번째 서브필드와 n 번째 서브필드의 리셋기간 동안 어드레스전극들(X)에는 기저전압(GND)이나 0[V]가 공급된다.
m 번째 서브필드는 한 프레임기간 내에 배치된 서브필드들 중에서 초기에 배치되는 적어도 하나의 서브필드로 선택될 수 있으며, n 번째 서브필드는 한 프레임기간 내에 배치된 서브필드들 중에서 m 번째 서브필드를 제외한 적어도 하나의 서브필드로 선택될 수 있다. 또한, m 번째 서브필드와 n 번째 서브필드는 교대로 또는 주기적으로 배치될 수도 있다.
도 8은 본 발명의 제4 실시예에 따른 PDP의 고동방법을 나타낸다.
도 8을 참조하면, 본 발명의 제4 실시예에 따른 PDP의 구동방법은 한 프레임기간 내에 배치된 서브필드들에 따라 초기화전압과 리셋기간을 다르게 제어한다.
m 번째 서브필드는 도 6의 m 번째 서브필드와 실질적으로 동일하다.
n 번째 서브필드의 1차 리셋기간(rstn1)은 콘트라스트의 개선과 구동시간을 줄이기 위하여 m 번째 서브필드의 1차 리셋기간(rstm1)보다 작게 설정되고, 낮은 셋업전압(Vsetup2)의 1차 상승 램프파형들(Rdyn1)이 스캔전극들(Z)에 공급된다. 이를 위하여, n 번째 서브필드의 1차 리셋기간(rstn1) 동안 스캔전극들(Y)에 공급되는 1차 상승 램프파형(Ruyn1)은 대략 서스테인전압(Vs)부터 상승하기 시작하여 m번째 서브필드의 1차 상승 램프파형(Ruym1)과 동일한 기울기로 셋업전압(Vsetup) 보다 낮은 제2 셋업전압(Vsetup2)까지 상승하게 된다. n 번째 서브필드의 2차 리셋기간(rstn2), 어드레스기간 및 서스테인기간 동안 스캔전극들(Y)에 공급되는 구동파형은 m 번째 서브필드와 실질적으로 동일하다.
n 번째 서브필드 동안 서스테인전극들(Z)에는 m 번째 서브필드와 동일한 동일한 파형이 공급된다.
이러한 m 번째 서브필드와 n 번째 서브필드의 리셋기간 동안 어드레스전극들(X)에는 기저전압(GND)이나 0[V]가 공급된다.
m 번째 서브필드는 한 프레임기간 내에 배치된 서브필드들 중에서 초기에 배치되는 적어도 하나의 서브필드로 선택될 수 있으며, n 번째 서브필드는 한 프레임기간 내에 배치된 서브필드들 중에서 m 번째 서브필드를 제외한 적어도 하나의 서브필드로 선택될 수 있다. 또한, m 번째 서브필드와 n 번째 서브필드는 교대로 또는 주기적으로 배치될 수도 있다.
도 9는 본 발명의 제5 실시예에 따른 PDP의 고동방법을 나타낸다.
도 9를 참조하면, 본 발명의 제5 실시예에 따른 PDP의 구동방법은 콘트라스트 특성과 초기화구동의 안정화를 고려하여 1차 리셋기간(rst1)과 2차 리셋기간(rst2) 각각에서 상승 램프파형(Ruym1, Ruym2, Ruyn1, Ruyn2)과 하강 램프파형(Rdym1, Rdym2, Rdyn1, Rdyn2)의 기울기를 다르게 제어한다.
1차 리셋기간(rst1)의 t1 기간에는 스캔전극들(Y)에 대략 서스테인전압(Vs)으로부터 셋업전압(Vsetup)까지 상승하는 1차 상승 램프파형(Ruym1)이 공급되고 서스테인전극들(Z)에는 기저전압(GND)이나 0[V]가 공급된다. t2 기간에는 스캔전극들(Y)에 대략 서스테인전압(Vs)부터 부극성 전압까지 하강하는 1차 하강 램프파형(Rdym1)이 공급되고 서스테인전극들(Z)에 정극성 전압의 구형파펄스(Rsq)가 공급된다. 1차 상승 램프파형(Ruym1)과 1차 하강 램프파형(Rdym1)은 콘트라스트특성과 2차 리셋기간의 초기조건에서 셀의 균일성을 고려하여 그 기울기가 조정될 수 있다.
m 번째 서브필드에 있어서, 2차 리셋기간(rst2)의 t3 기간에는 1차 상승 램프파형(Rupm1)과 다른 기울기로 대략 서스테인전압(Vs)으로부터 셋업전압(Vsetup)까지 상승하는 1차 상승 램프파형(Ruym1)이 스캔전극들(Y)에 공급되고 서스테인전극들(Z)에는 기저전압(GND)이나 0[V]가 공급된다. t4 기간에는 1차 상승 램프파형(Rupm1)과 다른 기울기로 대략 서스테인전압(Vs)부터 부극성 전압까지 하강하는 1차 하강 램프파형(Rdym1)이 스캔전극들(Y)에 공급되고 서스테인전극들(Z)에 정극성 전압의 구형파펄스(Rsq)가 공급된다. 이러한 2차 상승 램프파형(Ruym2)과 2차 하강 램프파형(Rdym2)의 기울기는 셀들의 초기화 균일성과 어드레스 구동의 안정화를 고려하여 선택된다.
n 번째 서브필드의 상승 램프파형들(Ruyn1, Ruyn2)과 하강 램프파형들(Rdyn1, Rdyn2)은 콘트라스트특성, 구동속도 셀의 초기화 균일성 등을 고려하여 m 번째 서브필드에서 발생되는 초기화 파형들(Ruyn1, Ruyn2, Rdyn1, Rdyn2)과 다른 기울기로 스캔전극들(Y)에 공급될 수 있다.
도 10 및 도 11은 본 발명의 제6 및 제7 실시예에 따른 PDP의 고동방법을 나타낸다.
도 10 및 도 11본 발명의 제1 실시예에 따른 PDP의 구동방법은 콘트라스트 특성과 초기화구동의 안정화를 고려하여 1차 리셋기간(rst1)의 셋다운전압(V1, V3)과 2차 리셋기간(rst2)의 셋다운전압(V2, V4)을 다르게 한다.
1차 리셋기간(rst1)의 t1 기간, 2차 리셋기간(rst2)의 t3 기간, 어드레스기간 및 서스테인기간은 도 4의 실시예와 실질적으로 동일하므로 그에 대한 상세한 설명을 생략하기로 한다.
1차 리셋기간(rst1)의 t2 기간 동안에 스캔전극들(Y)에 공급되는 1차 하강 램프파형(Rdy1)의 셋다운 전압(V1)이 도 10과 같이 낮아지게 되면 1차 소거 암방전이 그 만큼 더 크게 발생하고 그 결과, 2차 리셋기간 전에 전 셀들 내에서 스캔전극들(Y)과 서스테인전극들(Z) 상의 벽전하 균일성이 더 향상된다. 따라서, 2차 리셋기간의 초기화 균일성이 향상되어 2차 리셋 동작이 보다 안정화된다.
이에 반하여, 2차 리셋기간(rst2)의 t2 기간 동안에 스캔전극들(Y)에 공급되는 2차 하강 램프파형(Rdy2)의 셋다운 전압(V4)이 도 11과 같이 낮아지게 되면 2차 소거 암방전이 그 만큼 더 크게 발생하고 그 결과, 어드레스기간 전에 전 셀들 내에서 스캔전극들(Y)과 서스테인전극들(Z) 상의 벽전하 균일성이 더 향상된다. 따라서, 2차 리셋기간의 초기화 균일성이 향상되어 어드레스동작이 보다 안정화된다.
도 10 및 도 11에 있어서 n 번째 서브필드의 셋다운전압은 콘트라스트특성, 구동속도 셀의 초기화 균일성 등을 고려하여 m 번째 서브필드의 셋다운전압과 다르게 설정될 수 있다.
도 12는 본 발명의 실시예에 따른 PDP의 구동장치를 나타낸다.
도 12를 참조하면, 본 발명의 실시예에 따른 PDP의 구동장치는 PDP의 어드레스전극들(X1 내지 Xm)에 데이터를 공급하기 위한 데이터구동부(122)와, 스캔전극들(Y1 내지 Yn)을 구동하기 위한 스캔구동부(123)와, 공통전극인 서스테인전극(Z)을 구동하기 위한 서스테인구동부(124)와, 각 구동부(122, 123, 124)를 제어하기 위한 타이밍콘트롤러(121)와, 각 구동부(122, 123, 124)에 필요한 구동전압을 공급하기 위한 구동전압 발생부(125)를 구비한다.
데이터구동부(122)에는 도시하지 않은 역감마보정회로, 오차확산회로 등에 의해 역감마보정 및 오차확산 된 후, 서브필드맵핑회로에 의해 각 서브필드에 맵핑된 데이터가 공급된다. 이 데이터구동부(122)는 타이밍콘트롤러(121)로부터의 타이밍제어신호(CTRX)에 응답하여 데이터를 샘플링하고 래치한 다음, 그 데이터를 어드레스전극들(X1 내지 Xm)에 공급하게 된다.
스캔구동부(123)는 타이밍 콘트롤러(121)의 제어 하에 리셋기간 동안 도 6 내지 도 11에 도시된 초기화파형들(Ruy1, Rdy1, Ruy2, Rdy2, Ruym1, Rdym1, Ruym2, Rdym2, Ruyn1, Rdyn1, Ruyn2, Rdyn2) 중에서 적어도 어느 하나를 스캔전극들(Y1 내지 Yn)에 공급한다. 그리고 스캔구동부(123)는 어드레스기간 동안 스캔펄스를 스캔전극들(Y1 내지 Yn)에 순차적으로 공급하고 서스테인기간 동안 서스테인펄스를 스캔전극들(Y1 내지 Yn)에 공급한다.
서스테인구동부(124)는 타이밍 콘트롤러(121)의 제어 하에 리셋기간 동안 도 6 내지 도 11에 도시된 초기화파형들(Rsq, Ruz, Rdz)을 서스테인전극들(Z)에 공급한다. 또한, 서스테인구동부(124)는 어드레스기간 동안 바이어스전압(Vz-com)을 서스테인전극들(Z)에 공급하고 서스테인기간 동안 스캔구동부(123)와 교대로 동작하여 서스테인펄스를 서스테인전극들(Z)에 공급하게 된다.
타이밍 콘트롤러(121)는 수직/수평 동기신호를 입력받고 각 구동부에 필요한 타이밍제어신호(CTRX, CTRY, CTRZ)를 발생하고 그 타이밍제어신호(CTRX, CTRY, CTRZ)를 해당 구동부(122, 123, 124)에 공급함으로써 각 구동부(122, 123, 124)를 제어한다. 데이터 제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링클럭, 래치제어신호, 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 스캔 제어신호(CTRY)에는 스캔구동부(123) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다. 그리고 서스테인 제어신호(CTRZ)에는 서스테인구동부(124) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다.
구동전압 발생부(125)는 셋업전압(Vsetup, Vsetup2), 어드레스 바이어스전압(Vscan-com, Vz-com), 스캔전압(Vscan), 서스테인전압(Vs), 셋다운전압(V1 내지 V4, Vz), 데이터전압(Vd)을 발생한다. 이러한 구동전압들은 방전가스의 조성이나 방전셀 구조에 따라 변할 수 있다.
상술한 바와 같이, 본 발명에 따른 PDP의 구동방법 및 장치는 스캔전극들과 서스테인전극들에 거의 동일한 파형을 공급하여 PDP의 셀들을 초기화하기 전에 전셀 내의 균일성을 확보하고 초기화방전의 구동을 안정화하기 위하여 상기 셀들에 대하여 1차 초기화를 진행하게 된다. 그 결과, 본 발명에 따른 PDP의 구동방법 및 장치는 PDP의 초기화를 안정화시키고 어드레스 구동마진을 높여 어드레스기간을 줄임으로써 PDP를 고속으로 구동할 수 있게 한다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 전극배치를 개략적으로 나타내는 평면도이다.
도 2는 256 계조를 구현하기 위한 8 비트 디폴트 코드의 프레임 구성을 나타내는 도면이다.
도 3은 종래의 플라즈마 디스플레이 패널을 구동하기 위한 구동 파형을 나타내는 파형도이다.
도 4는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 5는 도 4에 도시된 리셋기간에서 셀 내에서의 벽전하 분포의 변화를 개략적으로 나타내는 도면이다.
도 7은 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
삭제
도 8은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 9는 본 발명의 제4 실시예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 10은 본 발명의 제5 실시예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 11은 본 발명의 제6 실시예에 따른 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 12는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 나타내는 블록도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
121 : 타이밍 콘트롤러 122 : 데이터 구동부
123 : 스캔 구동부 124 : 서스테인 구동부
125 : 구동전압 발생부
Claims (21)
- 삭제
- 제1 및 제2 전극을 각각 포함한 다수의 전극쌍이 형성된 상판과 상기 다수의 전극쌍과 교차하는 다수의 제3 전극이 형성된 하판을 구비하며 상기 전극들의 교차부에 셀들이 형성되는 플라즈마 디스플레이 패널을 구동하기 위한 방법에 있어서,상기 제1 전극에 공급되는 1차 상승 램프파형 및 1차 하강 램프파형을 공급하고, 상기 1차 하강 램프파형에 동기되어 상기 제2 전극에 구형파를 공급하여 상기 셀들에 1차 쓰기 방전과 1차 소거방전을 일으켜 상기 셀들을 1차 초기화하는 단계와;상기 제1 전극과 상기 제2 전극에 2차 초기화파형을 공급하여 상기 셀들에 2차 쓰기 방전과 2차 소거방전을 일으켜 상기 셀들을 2차 초기화하는 단계와;상기 제3 전극들에 데이터를 공급하고 상기 제1 및 제2 전극 중 적어도 어느 하나에 스캔펄스를 공급하여 상기 셀들을 선택하는 단계와;상기 제1 전극들과 상기 제2 전극들에 교대로 서스테인펄스를 공급하여 표시를 행하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제 2 항에 있어서,상기 2차 초기화파형은,상기 제1 전극과 상기 제2 전극에 동시에 공급되는 2차 상승 램프파형 및 2차 하강 램프파형을 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제 3 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형과 상기 2차 상승 래프파형의 전압은 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제 4 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 전압은 서브필드에 따라 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제 3 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 공급기간과 상기 2차 상승 래프파형의 공급기간은 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제 6 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 공급기간은 서브필드에 따라 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제 3 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형과 상기 2차 상승 래프파형의 기울기는 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제 8 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 기울기는 서브필드에 따라 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제 8 항에 있어서,상기 제1 전극에 공급되는 상기 2차 상승 램프파형의 기울기는 서브필드에 따라 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 제1 및 제2 전극을 각각 포함한 다수의 전극쌍이 형성된 상판과 상기 다수의 전극쌍과 교차하는 다수의 제3 전극이 형성된 하판을 구비하며 상기 전극들의 교차부에 셀들이 형성되는 플라즈마 디스플레이 패널을 구동하기 위한 방법에 있어서,상기 제1 전극에 공급되는 1차 상승 램프파형 및 1차 하강 램프파형을 공급하고, 상기 1차 하강 램프파형에 동기되어 상기 제2 전극에 구형파를 공급하여 상기 제1 전극과 상기 제2 전극 사이에 면방전을 일으킴과 동시에 상기 제1 전극 및 상기 제2 전극 중 적어도 어느 하나와 상기 제3 전극 사이에 대향방전을 일으켜 상기 셀들을 1차 초기화하는 단계와;상기 제1 전극과 상기 제2 전극에 2차 초기화파형을 공급하여 상기 제1 전극과 상기 제3 전극 사이에 대향방전을 일으킴과 동시에 상기 제2 전극과 상기 제3 전극 사이에 대향방전을 일으켜 상기 셀들을 2차 초기화하는 단계와;상기 제3 전극들에 데이터를 공급하고 상기 제1 전극과 상기 제2 전극 중 적어도 어느 하나에 스캔펄스를 공급하여 상기 제1 전극과 상기 제2 전극 중 적어도 어느 하나와 상기 제3 전극 사이에 대향 방전을 일으킴으로써 셀을 선택하는 단계와;상기 제1 전극들과 상기 제2 전극들에 교대로 서스테인펄스를 공급하여 상기 제1 전극들과 상기 제2 전극들 사이에 면방전을 일으킴으로써 표시를 행하는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
- 삭제
- 제1 및 제2 전극을 각각 포함한 다수의 전극쌍이 형성된 상판과 상기 다수의 전극쌍과 교차하는 다수의 제3 전극이 형성된 하판을 구비하며 상기 전극들의 교차부에 셀들이 형성되는 플라즈마 디스플레이 패널을 구동하기 위한 장치에 있어서,상기 제1 전극에 공급되는 1차 상승 램프파형 및 1차 하강 램프파형을 공급하고, 상기 1차 하강 램프파형에 동기되어 상기 제2 전극에 구형파를 공급하여 상기 셀들에 1차 쓰기 방전과 1차 소거방전을 일으켜 상기 셀들을 1차 초기화하고 상기 제1 전극과 상기 제2 전극에 2차 초기화파형을 공급하여 상기 셀들에 2차 쓰기 방전과 2차 소거방전을 일으켜 상기 셀들을 2차 초기화하기 위한 초기화 구동부와;상기 제3 전극들에 데이터를 공급하고 상기 제1 및 제2 전극 중 적어도 어느 하나에 스캔펄스를 공급하여 상기 셀을 선택하는 셀 선택 구동부와;상기 제1 전극들과 상기 제2 전극들에 교대로 서스테인펄스를 공급하여 표시를 행하기 위한 표시 구동부를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
- 제 13 항에 있어서,상기 초기화 구동부는,2차 상승 램프파형 및 2차 하강 램프파형을 상기 제1 전극과 상기 제2 전극에 동시에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
- 제 14 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형과 상기 2차 상승 래프파형의 전압은 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
- 제 15 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 전압은 서브필드에 따라 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
- 제 14 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 공급기간과 상기 2차 상승 래프파형의 공급기간은 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
- 제 17 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 공급기간은 서브필드에 따라 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
- 제 14 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형과 상기 2차 상승 래프파형의 기울기는 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
- 제 19 항에 있어서,상기 제1 전극에 공급되는 상기 1차 상승 램프파형의 기울기는 서브필드에 따라 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
- 제 19 항에 있어서,상기 제1 전극에 공급되는 상기 2차 상승 램프파형의 기울기는 서브필드에 따라 다른 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
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