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JPS6392029A - 樹脂封止型半導体装置 - Google Patents

樹脂封止型半導体装置

Info

Publication number
JPS6392029A
JPS6392029A JP61238442A JP23844286A JPS6392029A JP S6392029 A JPS6392029 A JP S6392029A JP 61238442 A JP61238442 A JP 61238442A JP 23844286 A JP23844286 A JP 23844286A JP S6392029 A JPS6392029 A JP S6392029A
Authority
JP
Japan
Prior art keywords
aluminum
pad electrode
bonding
semiconductor device
bonding pad
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP61238442A
Other languages
English (en)
Inventor
Isao Ichimura
功 市村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP61238442A priority Critical patent/JPS6392029A/ja
Publication of JPS6392029A publication Critical patent/JPS6392029A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item

Landscapes

  • Formation Of Insulating Films (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は樹脂封止型半導体装置に関し、特に半導体チッ
プ表面のパッジベージ璽ン膿の改良に関する。
〔従来の技術〕
従来、この種の半導体装置における半導体チップはプラ
ズマ成長さ;n、fcシリコン窒化膜等にエクパッシベ
ーシlンさnる。すなわち、半導体チップ全面にこの耐
湿性の保諌膜全形成した後、ボンディング・パッド部分
全エツチング除去し、その後、リード・フレームへのボ
ンディング接続上行なってから樹脂封止さnる。
〔発明が解決しようとする問題点〕
従って、上述した従来の賓脂封止型半導体装置はボンデ
ィング響バット部分にはパッジページ〕ン膜が存在しな
い梠造のものとなり、樹脂封止へ′全侵透した外部の水
分全リード・フレームおよび謳 ワイヤーの界面勾・伝わらせ、アルミ・パッド電極全溶
出せしめる欠点を有する。
本発明の目的は、上記の欠点に鑑み、アルミ句パッド電
極のボンディング・パッド部に対するパッシペーション
摸全備え友樹脂封止塑半導体装置を提供することである
と前記半導体チップ士に設けらnるアルミ・ボンディン
グ・パッドN&と、前記アルミ・ボンディング・ボッド
電極とリード9フレームの外部リードと′に接続する金
ボンディングやワイヤと、前記アルミ・ボンディング・
パッドN極の縁端部および金ポンディング・ワイヤのボ
ンディング面を除く電極全面tそnぞn被覆するシリコ
ン窒化膜および化成アルミナ膜からなるパッシベーショ
ン膜とを備えることを含む。
〔実施例〕
以下図面を参照して本発明の詳細な説明する。
第1(凶は本発明の一実施例を示す要部断面図である。
本実施例に工nば半導体装置10は、リード・フレーム
1と、こnにダイボンディングさnた半導体チップ2と
半導体チップ2上のアルミ・ボンディング・パッド1!
極4と、このアルミ・ボンディング・パッド電極4とリ
ード・フレーム1の外部リード9とを接続する金ポンデ
ィ/グ・ワイヤ6と、ワイヤ接続後リード・フレーム1
全電極端子として陽=W比さnたアルミ串ボンディング
・パッド電極4の化成アルミナ(AL20s )領域8
と、最上層のアルミ配−3と、シリコン窒化膜からなる
パッシベーション膜5と、a1脂封脂矛ス゛7と會含む
本実施例に工ILば、アルミ・ボンディング・パッド電
極4の縁端部は従来の同じく窒化膜からなルハッシベー
シ曹ン膜で被櫟さn%また。金ボンディング・ワイヤ直
下を除くボンディング・パッド部分は化成アルミナ膜8
で被覆さtしるので樹脂封止オス゛7から侵透した外部
水分にエフアルミ・パッド電極4が侵さn浴出するなど
の事故上発生せしめることはない。すなわち、半等体長
盆の信頼性を著しく向上せしめることができる。
〔発明の効果〕
以上詳細に説明し7eJ:うに5本発例に=Jシは従来
露出されたままとなっていン′こアルミ・パッド電極の
ポンディング部分音化成アルミナ(Alz Os)で充
分被覆する構造としたのでアルミ °パッド電極に対す
るパッシベーション膜果を著しく高めることができ、樹
脂型半導体装置の信頼性向上に格段の効果音あげること
ができる。
【図面の簡単な説明】
第1図は本発す弓の−′:A飽何j七示す要部断面図で
ある。 1・・・・・・リード9フレーム、2・・・・・・半導
体チップ、3・・・・・・最上層のアルミ配線、4・・
・・・・アルミ優ポンディング・パッド電極、5・・・
・・・窒化膜からなるパッシベーション膜、6・・・・
・・金ボンディング・ワイヤ、7・・・・・・樹脂封止
矛)′、8・・・・・・化成アルミナ(AtzOs)1
1.9・・・・・・リード・フレームの外部リード、1
0・・・・・・樹脂封止半導体装置。 代理人 弁理士  内  原    晋1′ ・、−2
:/−m−リード・フし一ム 2−一−キ4石トー手ッフ・ 3−・−羊上檜刀フルミ紀射V

Claims (1)

    【特許請求の範囲】
  1. リード・フレーム上に固着される半導体チップと、前記
    半導体チップ上に設けられるアルミ・ボンディング・パ
    ッド電極と、前記アルミ・ボンディング・パッド電極と
    リード・フレームの外部リードとを接続する金ボンディ
    ング・ワイヤと、前記アルミ・ボンディング・パッド電
    極の縁端部および金ボンディング・ワイヤのボンディン
    グ面を除く電極全面をそれぞれ被覆するシリコン窒化膜
    および化成アルミナ膜からなるパッシベーション膜とを
    備えることを特徴とする樹脂封止型半導体装置。
JP61238442A 1986-10-06 1986-10-06 樹脂封止型半導体装置 Pending JPS6392029A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP61238442A JPS6392029A (ja) 1986-10-06 1986-10-06 樹脂封止型半導体装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP61238442A JPS6392029A (ja) 1986-10-06 1986-10-06 樹脂封止型半導体装置

Publications (1)

Publication Number Publication Date
JPS6392029A true JPS6392029A (ja) 1988-04-22

Family

ID=17030283

Family Applications (1)

Application Number Title Priority Date Filing Date
JP61238442A Pending JPS6392029A (ja) 1986-10-06 1986-10-06 樹脂封止型半導体装置

Country Status (1)

Country Link
JP (1) JPS6392029A (ja)

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56125850A (en) * 1980-03-06 1981-10-02 Toshiba Corp Manufacture of semiconductor device
JPS5742139A (en) * 1980-08-27 1982-03-09 Hitachi Ltd Semiconductor device

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56125850A (en) * 1980-03-06 1981-10-02 Toshiba Corp Manufacture of semiconductor device
JPS5742139A (en) * 1980-08-27 1982-03-09 Hitachi Ltd Semiconductor device

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