JPH10288973A - 面放電型プラズマディスプレイパネルの駆動方法 - Google Patents
面放電型プラズマディスプレイパネルの駆動方法Info
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- JPH10288973A JPH10288973A JP9114467A JP11446797A JPH10288973A JP H10288973 A JPH10288973 A JP H10288973A JP 9114467 A JP9114467 A JP 9114467A JP 11446797 A JP11446797 A JP 11446797A JP H10288973 A JPH10288973 A JP H10288973A
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of Gas Discharge Display Tubes (AREA)
Abstract
(57)【要約】
【課題】 面放電型プラズマディスプレイパネルの駆動
方法において、誤放電を防止し、表示特性を向上させる
ことを目的とする。 【解決手段】 マトリクス表示のラインに対応しかつ誘
電体層で覆われた複数の行電極対と、行電極対と直交す
る方向に配列され各交差部にて画素を形成する列電極と
を有し、ライン毎に順次走査パルスを行電極対の一方に
印加するとともに表示データパルスを列電極にして表示
データに応じて点灯及び消灯画素を選択するアドレス期
間と、行電極対に放電維持パルスを印加して点灯及び消
灯画素を維持する維持放電期間とを用いて表示を行う面
放電型プラズマディスプレイパネルの駆動方法であっ
て、アドレス期間において印加される走査パルスの幅を
変化させたことを特徴とする。
方法において、誤放電を防止し、表示特性を向上させる
ことを目的とする。 【解決手段】 マトリクス表示のラインに対応しかつ誘
電体層で覆われた複数の行電極対と、行電極対と直交す
る方向に配列され各交差部にて画素を形成する列電極と
を有し、ライン毎に順次走査パルスを行電極対の一方に
印加するとともに表示データパルスを列電極にして表示
データに応じて点灯及び消灯画素を選択するアドレス期
間と、行電極対に放電維持パルスを印加して点灯及び消
灯画素を維持する維持放電期間とを用いて表示を行う面
放電型プラズマディスプレイパネルの駆動方法であっ
て、アドレス期間において印加される走査パルスの幅を
変化させたことを特徴とする。
Description
【０００１】
【発明の属する技術分野】本発明は、面放電型プラズマ
ディスプレイパネル（ＰＤＰ）の駆動方法に関する。
ディスプレイパネル（ＰＤＰ）の駆動方法に関する。
【０００２】
【従来の技術】近年、表示装置の大型化に伴い、薄型の
表示装置が要求され、各種の薄型の表示装置が提供され
ている。その１つにＡＣＰＤＰが知られている。
表示装置が要求され、各種の薄型の表示装置が提供され
ている。その１つにＡＣＰＤＰが知られている。
【０００３】係るＡＣＰＤＰは、列電極（アドレス電
極）及び列電極と直交し一対にて１行（１走査ライン）
を構成する行電極（維持電極）を備えており、これら列
電極及び行電極対各々は放電空間に対して誘電体層で覆
われており、列電極及び行電極対の各交点に放電セル
（画素）が形成されている。なお、行電極は、透明電極
とそれに積層されたバス電極とから構成されている。
極）及び列電極と直交し一対にて１行（１走査ライン）
を構成する行電極（維持電極）を備えており、これら列
電極及び行電極対各々は放電空間に対して誘電体層で覆
われており、列電極及び行電極対の各交点に放電セル
（画素）が形成されている。なお、行電極は、透明電極
とそれに積層されたバス電極とから構成されている。
【０００４】図４は、係るＡＣＰＤＰの従来の各種駆動
パルスの印加タイミングを示す図である。図４におい
て、先ず、正極性のリセットパルスＲＰｘを全ての維持
電極である行電極Ｘ１〜Ｘｎに印加すると同時に、負電
圧のリセットパルスＲＰｙを行電極Ｙ１〜Ｙｎの各々に
印加する。かかるリセットパルスの印加によりＰＤＰの
全ての行電極対間に放電が生じる。かかる放電により、
各画素セル内において荷電粒子が発生し、その放電終息
後に壁電荷が蓄積形成される（一斉リセット期間）。こ
こで、リセットパルスＲＰｘ、ＲＰｙは、表示に関係な
いリセットパルスによる放電発光を抑え、コントラスト
を向上させるために立ち上がり時間の長い（長時定数）
パルスを用いている。
パルスの印加タイミングを示す図である。図４におい
て、先ず、正極性のリセットパルスＲＰｘを全ての維持
電極である行電極Ｘ１〜Ｘｎに印加すると同時に、負電
圧のリセットパルスＲＰｙを行電極Ｙ１〜Ｙｎの各々に
印加する。かかるリセットパルスの印加によりＰＤＰの
全ての行電極対間に放電が生じる。かかる放電により、
各画素セル内において荷電粒子が発生し、その放電終息
後に壁電荷が蓄積形成される（一斉リセット期間）。こ
こで、リセットパルスＲＰｘ、ＲＰｙは、表示に関係な
いリセットパルスによる放電発光を抑え、コントラスト
を向上させるために立ち上がり時間の長い（長時定数）
パルスを用いている。
【０００５】次に各行電極Ｙ１〜Ｙｎに走査パルス（選
択消去パルス）ＳＰを印加する直前にプライミングパル
スＰＰを印加することによりプライミング粒子を放電空
間内に再形成してアドレス動作を安定させた後、各行毎
の画素データに対応した画素データパルスＤＰ１〜ＤＰ
ｎを順次、アドレス電極である列電極Ｄ１〜Ｄｍに印加
する。上記画素データパルスＤＰ１〜ＤＰｎはそれぞれ
の印加タイミングに同期して走査パルスＳＰを行電極Ｙ
１〜Ｙｎへ順次印加して行く。この際、かかる画素デー
タパルスＤＰ、及び走査パルスＳＰがそれぞれ列電極及
び行電極に同時に印加された画素セルにのみ放電が生じ
て、上記一斉リセット期間にて形成された壁電荷の大半
が消滅する。
択消去パルス）ＳＰを印加する直前にプライミングパル
スＰＰを印加することによりプライミング粒子を放電空
間内に再形成してアドレス動作を安定させた後、各行毎
の画素データに対応した画素データパルスＤＰ１〜ＤＰ
ｎを順次、アドレス電極である列電極Ｄ１〜Ｄｍに印加
する。上記画素データパルスＤＰ１〜ＤＰｎはそれぞれ
の印加タイミングに同期して走査パルスＳＰを行電極Ｙ
１〜Ｙｎへ順次印加して行く。この際、かかる画素デー
タパルスＤＰ、及び走査パルスＳＰがそれぞれ列電極及
び行電極に同時に印加された画素セルにのみ放電が生じ
て、上記一斉リセット期間にて形成された壁電荷の大半
が消滅する。
【０００６】一方、走査パルスＳＰが印加されたものの
画素データパルスＤＰが印加されない画素セルにおいて
は、上述の如き放電が生じないので、上記一斉リセット
期間にて形成された所望の量の壁電荷はそのまま残留す
る。つまり、上記一斉リセット期間にて形成された所望
の量の壁電荷は、画素データの内容に応じて選択的に消
去されるのである（アドレス期間）。
画素データパルスＤＰが印加されない画素セルにおいて
は、上述の如き放電が生じないので、上記一斉リセット
期間にて形成された所望の量の壁電荷はそのまま残留す
る。つまり、上記一斉リセット期間にて形成された所望
の量の壁電荷は、画素データの内容に応じて選択的に消
去されるのである（アドレス期間）。
【０００７】次に、正極性の維持パルスＩＰｘを連続し
て行電極Ｘ１〜Ｘｎのそれぞれに印加すると共に、かか
る維持パルスＩＰｘの印加タイミングとは、ずれたタイ
ミングにて正極性の維持パルスＩＰｙを連続して行電極
Ｙ１〜Ｙｎのそれぞれに印加する。
て行電極Ｘ１〜Ｘｎのそれぞれに印加すると共に、かか
る維持パルスＩＰｘの印加タイミングとは、ずれたタイ
ミングにて正極性の維持パルスＩＰｙを連続して行電極
Ｙ１〜Ｙｎのそれぞれに印加する。
【０００８】かかる維持パルスが連続して印加されてい
る期間にわたり上記壁電荷が残留したままになっている
画素セルのみが放電発光を維持する（維持放電期間）。
なお、この維持放電行程において、最初に、すなわち維
持パルスＩＰｘの第１番目に行電極Ｘ１〜Ｘｎに印加さ
れる維持パルスは後続する維持パルスに比してパルス幅
を長めに設定してあるが、この理由を以下に説明する。
る期間にわたり上記壁電荷が残留したままになっている
画素セルのみが放電発光を維持する（維持放電期間）。
なお、この維持放電行程において、最初に、すなわち維
持パルスＩＰｘの第１番目に行電極Ｘ１〜Ｘｎに印加さ
れる維持パルスは後続する維持パルスに比してパルス幅
を長めに設定してあるが、この理由を以下に説明する。
【０００９】放電が生じると、放電空間内にプライミン
グ粒子が発生するが時間が経過すると共に減少してい
く。プライミング粒子の数が減少するほどパルスの印加
から最初の放電が生じるまでの時間（放電形成遅れ時
間）及び各画素セルの放電開始時間のばらつき（放電統
計遅れ時間）が増大する。すると、維持放電期間の最初
に印加される放電維持パルスで放電が生じなくなり、そ
れ以降印加される放電維持パルスによって放電しない可
能性が高くなる。
グ粒子が発生するが時間が経過すると共に減少してい
く。プライミング粒子の数が減少するほどパルスの印加
から最初の放電が生じるまでの時間（放電形成遅れ時
間）及び各画素セルの放電開始時間のばらつき（放電統
計遅れ時間）が増大する。すると、維持放電期間の最初
に印加される放電維持パルスで放電が生じなくなり、そ
れ以降印加される放電維持パルスによって放電しない可
能性が高くなる。
【００１０】そこで、最初に印加される放電維持パルス
のパルス幅をそれ以降印加される放電維持パルスより長
く、すなわち、放電形成遅れ時間、放電統計遅れ時間及
び放電そのものに必要な時間の総和より長くすることに
より、最初に印加される放電維持パルスで確実に放電を
生じさせることが可能となる。
のパルス幅をそれ以降印加される放電維持パルスより長
く、すなわち、放電形成遅れ時間、放電統計遅れ時間及
び放電そのものに必要な時間の総和より長くすることに
より、最初に印加される放電維持パルスで確実に放電を
生じさせることが可能となる。
【００１１】次に、消去パルスＥＰを行電極Ｙ１〜Ｙｎ
のそれぞれに印加することにより、行電極Ｘ１〜Ｘｎ及
びＹ１〜Ｙｎ上に形成された壁電荷を消滅させ、点灯及
び消灯画素セルでの壁電荷の状態を略均一にする（壁電
荷消去期間）。以上の如く、かかる面放電型プラズマデ
ィスプレイパネルの駆動方法においては、全行電極に一
斉に、立ち上がりが緩やかな波形を有する第１リセット
パルスを印加して一斉リセットを実行し、維持放電行程
においては第１番目に行電極に印加する維持パルスのパ
ルス幅を長く設定することによって、面放電型プラズマ
ディスプレイパネルを発光表示するようにしている。
のそれぞれに印加することにより、行電極Ｘ１〜Ｘｎ及
びＹ１〜Ｙｎ上に形成された壁電荷を消滅させ、点灯及
び消灯画素セルでの壁電荷の状態を略均一にする（壁電
荷消去期間）。以上の如く、かかる面放電型プラズマデ
ィスプレイパネルの駆動方法においては、全行電極に一
斉に、立ち上がりが緩やかな波形を有する第１リセット
パルスを印加して一斉リセットを実行し、維持放電行程
においては第１番目に行電極に印加する維持パルスのパ
ルス幅を長く設定することによって、面放電型プラズマ
ディスプレイパネルを発光表示するようにしている。
【００１２】
【発明が解決しようとする課題】上述の駆動方法では、
長時定数のリセットパルスを用いることによりリセット
放電を弱めてコントラストを向上させている。しかしな
がら、長時定数のリセットパルスを用いるとリセット放
電が弱いので空間内に形成されるプライミング粒子（荷
電粒子）の量が少ない。そこで、走査パルスＳＰの直前
にプライミングパルスＰＰを印加することによりリセッ
ト放電にて得られ時間経過と共に減少してしまったプラ
イミング粒子を放電空間内に再形成してアドレス動作を
安定させるようにしている。
長時定数のリセットパルスを用いることによりリセット
放電を弱めてコントラストを向上させている。しかしな
がら、長時定数のリセットパルスを用いるとリセット放
電が弱いので空間内に形成されるプライミング粒子（荷
電粒子）の量が少ない。そこで、走査パルスＳＰの直前
にプライミングパルスＰＰを印加することによりリセッ
ト放電にて得られ時間経過と共に減少してしまったプラ
イミング粒子を放電空間内に再形成してアドレス動作を
安定させるようにしている。
【００１３】一方、高精細のＰＤＰを表示するために
は、アドレス期間における表示データの書込みを高速に
する必要があるがアドレス期間において少なくとも最初
に走査されるラインを含むライン群付近では、プライミ
ングパルスＰＰによるプライミング放電のタイミングが
ばらつき、その直後に印加される選択消去パルスによる
選択消去放電が不安定になる。
は、アドレス期間における表示データの書込みを高速に
する必要があるがアドレス期間において少なくとも最初
に走査されるラインを含むライン群付近では、プライミ
ングパルスＰＰによるプライミング放電のタイミングが
ばらつき、その直後に印加される選択消去パルスによる
選択消去放電が不安定になる。
【００１４】これは、最初に走査されるラインを含むラ
イン群より後に走査されるラインでは、直前に隣接する
上のラインでプライミング放電（及び選択消去放電）が
生じているので、隣接する上のラインより多量のプライ
ミング粒子を受け取り放電しやすい状態となっているが
最初に走査されるラインでは、プライミング粒子が少な
く、放電しにくい状態となっていることに起因してい
る。本発明は、上記の問題を解決するためになされたも
のであり、誤放電を防止し、表示特性を向上させること
を目的とする。
イン群より後に走査されるラインでは、直前に隣接する
上のラインでプライミング放電（及び選択消去放電）が
生じているので、隣接する上のラインより多量のプライ
ミング粒子を受け取り放電しやすい状態となっているが
最初に走査されるラインでは、プライミング粒子が少な
く、放電しにくい状態となっていることに起因してい
る。本発明は、上記の問題を解決するためになされたも
のであり、誤放電を防止し、表示特性を向上させること
を目的とする。
【００１５】
【課題を解決するための手段】請求項１に記載の発明
は、マトリクス表示のラインに対応しかつ誘電体層で覆
われた複数の行電極対と、行電極対と直交する方向に配
列され各交差部にて画素を形成する列電極とを有し、ラ
イン毎に順次走査パルスを行電極対の一方に印加すると
ともに表示データパルスを列電極にして表示データに応
じて点灯及び消灯画素を選択するアドレス期間と、行電
極対に放電維持パルスを印加して点灯及び消灯画素を維
持する維持放電期間とを用いて表示を行う面放電型プラ
ズマディスプレイパネルの駆動方法であって、アドレス
期間において印加される走査パルスの幅を変化させたこ
とを特徴とする。
は、マトリクス表示のラインに対応しかつ誘電体層で覆
われた複数の行電極対と、行電極対と直交する方向に配
列され各交差部にて画素を形成する列電極とを有し、ラ
イン毎に順次走査パルスを行電極対の一方に印加すると
ともに表示データパルスを列電極にして表示データに応
じて点灯及び消灯画素を選択するアドレス期間と、行電
極対に放電維持パルスを印加して点灯及び消灯画素を維
持する維持放電期間とを用いて表示を行う面放電型プラ
ズマディスプレイパネルの駆動方法であって、アドレス
期間において印加される走査パルスの幅を変化させたこ
とを特徴とする。
【００１６】請求項２に記載の発明は、請求項１記載の
面放電型プラズマディスプレイパネルの駆動方法であっ
て、走査パルスは、選択書込みパルスからなり、アドレ
ス期間において、表示データパルスと選択書込みパルス
により、壁電荷を選択的に形成して点灯及び消灯画素を
選択し、少なくとも最初に走査されるラインを含むライ
ン群に印加される選択書込みパルスの幅に比してその後
に走査されるラインに印加される走査パルスの幅を広く
したことを特徴とする。
面放電型プラズマディスプレイパネルの駆動方法であっ
て、走査パルスは、選択書込みパルスからなり、アドレ
ス期間において、表示データパルスと選択書込みパルス
により、壁電荷を選択的に形成して点灯及び消灯画素を
選択し、少なくとも最初に走査されるラインを含むライ
ン群に印加される選択書込みパルスの幅に比してその後
に走査されるラインに印加される走査パルスの幅を広く
したことを特徴とする。
【００１７】請求項３に記載の発明は、請求項１記載の
面放電型プラズマディスプレイパネルの駆動方法であっ
て、走査パルスは、プライミングパルスとその直後に印
加される選択消去パルスとからなり、アドレス期間の前
に全画素に対して壁電荷を一旦形成する一斉リセット期
間を設けると共にアドレス期間において、表示データパ
ルスと選択消去パルスにより、壁電荷を選択的に消去し
て点灯及び消灯画素を選択し、少なくとも最初に走査さ
れるラインを含むライン群に印加されるプライミングパ
ルスの幅をその後に走査されるラインに印加されるプラ
イミングパルスの幅に比して広くしたことを特徴とす
る。
面放電型プラズマディスプレイパネルの駆動方法であっ
て、走査パルスは、プライミングパルスとその直後に印
加される選択消去パルスとからなり、アドレス期間の前
に全画素に対して壁電荷を一旦形成する一斉リセット期
間を設けると共にアドレス期間において、表示データパ
ルスと選択消去パルスにより、壁電荷を選択的に消去し
て点灯及び消灯画素を選択し、少なくとも最初に走査さ
れるラインを含むライン群に印加されるプライミングパ
ルスの幅をその後に走査されるラインに印加されるプラ
イミングパルスの幅に比して広くしたことを特徴とす
る。
【００１８】
【作用】本発明による面放電型プラズマディスプレイパ
ネルの駆動方法では、少なくとも最初に走査されるライ
ンを含むライン群に印加されるプライミングパルス（走
査パルス）の幅をその後に走査されるラインに印加され
るプライミングパルスの幅に比して広くしたことによ
り、最初に走査されるラインに対して後続のライン群の
走査時間を速くすることができる。
ネルの駆動方法では、少なくとも最初に走査されるライ
ンを含むライン群に印加されるプライミングパルス（走
査パルス）の幅をその後に走査されるラインに印加され
るプライミングパルスの幅に比して広くしたことによ
り、最初に走査されるラインに対して後続のライン群の
走査時間を速くすることができる。
【００１９】
【発明の実施の形態】図１は、本発明による駆動方法で
駆動される面放電型ＰＤＰの構造を示す図である。図１
に示されるように放電空間７を介して対向配置された一
対のガラス基板１，２の表示面側のガラス基板１の内面
に互いに平行に隣接配置された一対の行電極Ｘ，Ｙ、行
電極Ｘ，Ｙを覆う壁電荷形成用の誘電体層５、誘電体層
５を覆うＭｇＯからなる保護層６がそれぞれ設けられて
いる。なお、行電極Ｘ，Ｙは、それぞれ幅の広い帯状の
透明導電膜からなる透明電極４とその導電性を補うため
に積層された幅の狭い帯状の金属膜からなるバス電極
（金属膜）３とから構成されている。
駆動される面放電型ＰＤＰの構造を示す図である。図１
に示されるように放電空間７を介して対向配置された一
対のガラス基板１，２の表示面側のガラス基板１の内面
に互いに平行に隣接配置された一対の行電極Ｘ，Ｙ、行
電極Ｘ，Ｙを覆う壁電荷形成用の誘電体層５、誘電体層
５を覆うＭｇＯからなる保護層６がそれぞれ設けられて
いる。なお、行電極Ｘ，Ｙは、それぞれ幅の広い帯状の
透明導電膜からなる透明電極４とその導電性を補うため
に積層された幅の狭い帯状の金属膜からなるバス電極
（金属膜）３とから構成されている。
【００２０】一方、背面側のガラス基板２の内面上には
維持電極Ｘ、Ｙと直交する方向に複数のアドレス電極Ｄ
が配置され、それぞれのアドレス電極Ｄの間をストライ
プ状の隔壁（リブ）１０によって分離され、アドレス電
極Ｄを被覆して蛍光体層８が形成されている。また、表
示面側のガラス基板１の維持電極Ｘ、Ｙと背面側の基板
２のアドレス電極Ｄは互いに対向配置され、隔壁１０間
に設けられた放電空間７に希ガスを注入し、封入され
る。
維持電極Ｘ、Ｙと直交する方向に複数のアドレス電極Ｄ
が配置され、それぞれのアドレス電極Ｄの間をストライ
プ状の隔壁（リブ）１０によって分離され、アドレス電
極Ｄを被覆して蛍光体層８が形成されている。また、表
示面側のガラス基板１の維持電極Ｘ、Ｙと背面側の基板
２のアドレス電極Ｄは互いに対向配置され、隔壁１０間
に設けられた放電空間７に希ガスを注入し、封入され
る。
【００２１】上述したように、表示面側のガラス基板１
の維持電極Ｘ、Ｙと背面側のガラス基板２のアドレス電
極Ｄの交点を中心として画素セル（放電セルを含む）が
形成されるので、面放電型ＰＤＰは複数の画素セルを有
し、画像の表示が可能となる。
の維持電極Ｘ、Ｙと背面側のガラス基板２のアドレス電
極Ｄの交点を中心として画素セル（放電セルを含む）が
形成されるので、面放電型ＰＤＰは複数の画素セルを有
し、画像の表示が可能となる。
【００２２】次に、図２にＰＤＰを駆動する本発明の第
１の実施形態による駆動方法にかかる駆動波形の一例を
示す。（選択消去アドレス法に適用した例） 図２において、先ず、正極性のリセットパルスＲＰｘを
全ての維持電極である行電極Ｘ１〜Ｘｎに印加すると同
時に、負電圧のリセットパルスＲＰｙを行電極Ｙ１〜Ｙ
ｎの各々に印加する。かかるリセットパルスの印加によ
りＰＤＰ１１（図１）の全ての行電極対間に放電が生じ
る。
１の実施形態による駆動方法にかかる駆動波形の一例を
示す。（選択消去アドレス法に適用した例） 図２において、先ず、正極性のリセットパルスＲＰｘを
全ての維持電極である行電極Ｘ１〜Ｘｎに印加すると同
時に、負電圧のリセットパルスＲＰｙを行電極Ｙ１〜Ｙ
ｎの各々に印加する。かかるリセットパルスの印加によ
りＰＤＰ１１（図１）の全ての行電極対間に放電が生じ
る。
【００２３】かかる放電により、各画素セル内において
荷電粒子が発生し、その放電終息後に壁電荷が蓄積形成
される（一斉リセット期間）。ここで、リセットパルス
ＲＰｘ、ＲＰｙは、表示に関係ないリセットパルスによ
る放電発光を抑え、コントラストを向上させるために立
ち上がり時間の長い（長時定数）パルスを用いている。
荷電粒子が発生し、その放電終息後に壁電荷が蓄積形成
される（一斉リセット期間）。ここで、リセットパルス
ＲＰｘ、ＲＰｙは、表示に関係ないリセットパルスによ
る放電発光を抑え、コントラストを向上させるために立
ち上がり時間の長い（長時定数）パルスを用いている。
【００２４】次に各行電極Ｙ１〜Ｙｎに走査パルスＳＰ
を印加する直前にプライミングパルスＰＰを印加するこ
とによりプライミング粒子を放電空間内に再形成してア
ドレス動作を安定させた後、各行毎の画素データに対応
した画素データパルスＤＰ１〜ＤＰｎを順次、アドレス
電極である列電極Ｄ１〜Ｄｍに印加する。上記画素デー
タパルスＤＰ１〜ＤＰｎはそれぞれの印加タイミングに
同期して走査パルスＳＰを行電極Ｙ１〜Ｙｎへ順次印加
して行く。この際、かかる画素データパルスＤＰ、及び
走査パルスＳＰがそれぞれ列電極及び行電極に同時に印
加された画素セルにのみ放電が生じて、上記一斉リセッ
ト期間にて形成された壁電荷の大半が消滅する。
を印加する直前にプライミングパルスＰＰを印加するこ
とによりプライミング粒子を放電空間内に再形成してア
ドレス動作を安定させた後、各行毎の画素データに対応
した画素データパルスＤＰ１〜ＤＰｎを順次、アドレス
電極である列電極Ｄ１〜Ｄｍに印加する。上記画素デー
タパルスＤＰ１〜ＤＰｎはそれぞれの印加タイミングに
同期して走査パルスＳＰを行電極Ｙ１〜Ｙｎへ順次印加
して行く。この際、かかる画素データパルスＤＰ、及び
走査パルスＳＰがそれぞれ列電極及び行電極に同時に印
加された画素セルにのみ放電が生じて、上記一斉リセッ
ト期間にて形成された壁電荷の大半が消滅する。
【００２５】一方、走査パルスＳＰが印加されたものの
画素データパルスＤＰが印加されない画素セルにおいて
は、上述の如き放電が生じないので、上記一斉リセット
期間にて形成された所望の量の壁電荷はそのまま残留す
る。つまり、上記一斉リセット期間にて形成された所望
の量の壁電荷は、画素データの内容に応じて選択的に消
去されるのである（アドレス期間）。
画素データパルスＤＰが印加されない画素セルにおいて
は、上述の如き放電が生じないので、上記一斉リセット
期間にて形成された所望の量の壁電荷はそのまま残留す
る。つまり、上記一斉リセット期間にて形成された所望
の量の壁電荷は、画素データの内容に応じて選択的に消
去されるのである（アドレス期間）。
【００２６】次に、正極性の維持パルスＩＰｘを連続し
て行電極Ｘ１〜Ｘｎのそれぞれに印加すると共に、かか
る維持パルスＩＰｘの印加タイミングとは、ずれたタイ
ミングにて正極性の維持パルスＩＰｙを連続して行電極
Ｙ１〜Ｙｎのそれぞれに印加する。かかる維持パルスが
連続して印加されている期間にわたり上記壁電荷が残留
したままになっている画素セルのみが放電発光を維持す
る（維持放電期間）。
て行電極Ｘ１〜Ｘｎのそれぞれに印加すると共に、かか
る維持パルスＩＰｘの印加タイミングとは、ずれたタイ
ミングにて正極性の維持パルスＩＰｙを連続して行電極
Ｙ１〜Ｙｎのそれぞれに印加する。かかる維持パルスが
連続して印加されている期間にわたり上記壁電荷が残留
したままになっている画素セルのみが放電発光を維持す
る（維持放電期間）。
【００２７】なお、この維持放電行程において、最初
に、すなわち維持パルスＩＰｘの第１番目に行電極Ｘ１
〜Ｘｎに印加される維持パルスは後続する維持パルスに
比してパルス幅を長めに設定してあるが、この理由は従
来の技術で説明したように以下の通りである。
に、すなわち維持パルスＩＰｘの第１番目に行電極Ｘ１
〜Ｘｎに印加される維持パルスは後続する維持パルスに
比してパルス幅を長めに設定してあるが、この理由は従
来の技術で説明したように以下の通りである。
【００２８】放電が生じると、放電空間内にプライミン
グ粒子が発生するが時間が経過すると共に減少してい
く。プライミング粒子の数が減少するほどパルスの印加
から最初の放電が生じるまでの時間（放電形成遅れ時
間）及び各画素セルの放電開始時間のばらつき（放電統
計遅れ時間）が増大する。すると、維持放電期間の最初
に印加される放電維持パルスで放電が生じなくなり、そ
れ以降印加される放電維持パルスによって放電しない可
能性が高くなる。
グ粒子が発生するが時間が経過すると共に減少してい
く。プライミング粒子の数が減少するほどパルスの印加
から最初の放電が生じるまでの時間（放電形成遅れ時
間）及び各画素セルの放電開始時間のばらつき（放電統
計遅れ時間）が増大する。すると、維持放電期間の最初
に印加される放電維持パルスで放電が生じなくなり、そ
れ以降印加される放電維持パルスによって放電しない可
能性が高くなる。
【００２９】そこで、最初に印加される放電維持パルス
のパルス幅をそれ以降印加される放電維持パルスより長
く、すなわち、放電形成遅れ時間、放電統計遅れ時間及
び放電そのものに必要な時間の総和より長くすることに
より、最初に印加される放電維持パルスで確実に放電を
生じさせることが可能となる。
のパルス幅をそれ以降印加される放電維持パルスより長
く、すなわち、放電形成遅れ時間、放電統計遅れ時間及
び放電そのものに必要な時間の総和より長くすることに
より、最初に印加される放電維持パルスで確実に放電を
生じさせることが可能となる。
【００３０】次に、消去パルスＥＰを行電極Ｙ１〜Ｙｎ
のそれぞれに印加することにより、行電極Ｘ１〜Ｘｎ及
びＹ１〜Ｙｎ上に形成された壁電荷を消滅させ、点灯及
び消灯画素セルでの壁電荷の状態を略均一にする（壁電
荷消去期間）。
のそれぞれに印加することにより、行電極Ｘ１〜Ｘｎ及
びＹ１〜Ｙｎ上に形成された壁電荷を消滅させ、点灯及
び消灯画素セルでの壁電荷の状態を略均一にする（壁電
荷消去期間）。
【００３１】以上の如く、かかる面放電型プラズマディ
スプレイパネルの駆動方法においては、全行電極に一斉
に、立ち上がりが緩やかな波形を有する第１リセットパ
ルスを印加して一斉リセットを実行し、維持放電行程に
おいては第１番目に行電極に印加する維持パルスのパル
ス幅を長く設定することによって、面放電型プラズマデ
ィスプレイパネルを発光表示するようにしている。
スプレイパネルの駆動方法においては、全行電極に一斉
に、立ち上がりが緩やかな波形を有する第１リセットパ
ルスを印加して一斉リセットを実行し、維持放電行程に
おいては第１番目に行電極に印加する維持パルスのパル
ス幅を長く設定することによって、面放電型プラズマデ
ィスプレイパネルを発光表示するようにしている。
【００３２】ここで行電極Ｙ１は最初に走査されるライ
ンであり、行電極Ｙ１に印加されるプライミングパルス
ＰＰの幅は、後に走査される行電極Ｙ２に印加されるプ
ライミングパルスＰＰの幅に比して広くしてある。図２
ではさらに後に続く行電極Ｙｎに印加されるプライミン
グパルスＰＰの幅はその前のプライミングパルスＰＰの
幅よりも小さい場合を示している。
ンであり、行電極Ｙ１に印加されるプライミングパルス
ＰＰの幅は、後に走査される行電極Ｙ２に印加されるプ
ライミングパルスＰＰの幅に比して広くしてある。図２
ではさらに後に続く行電極Ｙｎに印加されるプライミン
グパルスＰＰの幅はその前のプライミングパルスＰＰの
幅よりも小さい場合を示している。
【００３３】このように最初に走査されるラインを含む
ライン群に印加されるプライミングパルスの幅をその後
に走査されるラインに印加されるプライミングパルスの
幅に比して広くしたことにより、最初に走査されるライ
ンに対して前述したプライミングパルスＰＰによるプラ
イミング放電のタイミングがばらつき、その直後に印加
される走査パルスＳＰによる選択消去放電が不安定にな
ることを避け、後続のライン群の走査パルスＳＰによる
選択消去放電が安定なラインではプライミングパルスＰ
Ｐの幅を狭くすることにより走査時間を速くすることが
でき、高速走査が必要な高精細のディスプレイを可能に
することができる。
ライン群に印加されるプライミングパルスの幅をその後
に走査されるラインに印加されるプライミングパルスの
幅に比して広くしたことにより、最初に走査されるライ
ンに対して前述したプライミングパルスＰＰによるプラ
イミング放電のタイミングがばらつき、その直後に印加
される走査パルスＳＰによる選択消去放電が不安定にな
ることを避け、後続のライン群の走査パルスＳＰによる
選択消去放電が安定なラインではプライミングパルスＰ
Ｐの幅を狭くすることにより走査時間を速くすることが
でき、高速走査が必要な高精細のディスプレイを可能に
することができる。
【００３４】上述の説明ではプライミングパルスの幅を
変化させる例を示したが選択消去パルス（走査パルス）
の幅を同様に変化させるようにしてもよい。また、プラ
イミングパルスの幅を順次変化させる例を示したが選択
消去パルスの幅を同様に変化させるようにしてもよい。
最初に走査されるラインと後続するラインのプライミン
グパルスの幅を変えることにより上述の説明と同様の効
果を得ることができる。
変化させる例を示したが選択消去パルス（走査パルス）
の幅を同様に変化させるようにしてもよい。また、プラ
イミングパルスの幅を順次変化させる例を示したが選択
消去パルスの幅を同様に変化させるようにしてもよい。
最初に走査されるラインと後続するラインのプライミン
グパルスの幅を変えることにより上述の説明と同様の効
果を得ることができる。
【００３５】次に、図３に図１のＰＤＰを駆動する本発
明の第２の実施形態による駆動方法にかかる駆動波形の
一例を示す。（選択書込みアドレス法に適用した例） 図３の場合は、一斉リセット期間では、リセットパルス
ＲＰにより、全画素に対して壁電荷を一旦形成した後行
電極Ｘに印加する消去パルスＥＰにより壁電荷を消去し
て全画素を初期化している。この状態では放電空間にプ
ライミング粒子が数多く存在し、放電しやすい状態とな
っている。アドレス期間では、表示データパルスＤＰと
走査パルス（選択書込みパルス）ＳＰにより、選択的に
壁電荷を蓄積して点灯画素と消灯画素を選択している。
明の第２の実施形態による駆動方法にかかる駆動波形の
一例を示す。（選択書込みアドレス法に適用した例） 図３の場合は、一斉リセット期間では、リセットパルス
ＲＰにより、全画素に対して壁電荷を一旦形成した後行
電極Ｘに印加する消去パルスＥＰにより壁電荷を消去し
て全画素を初期化している。この状態では放電空間にプ
ライミング粒子が数多く存在し、放電しやすい状態とな
っている。アドレス期間では、表示データパルスＤＰと
走査パルス（選択書込みパルス）ＳＰにより、選択的に
壁電荷を蓄積して点灯画素と消灯画素を選択している。
【００３６】この例の場合、少なくとも最初に走査され
るラインを含むライン群に印加される選択書込みパルス
（走査パルス）の幅はその後に走査されるラインに印加
される選択書込みパルスの幅に比して狭くすることがで
きる。
るラインを含むライン群に印加される選択書込みパルス
（走査パルス）の幅はその後に走査されるラインに印加
される選択書込みパルスの幅に比して狭くすることがで
きる。
【００３７】すなわち、少なくとも最初に走査されるラ
インを含むライン群とその後に走査されるライン群とで
走査パルスＳＰの幅を変えている。具体的には、少なく
とも最初に走査されるラインを含むライン群に対する走
査時間をその後に走査されるライン群に対する走査時間
に比して短くしている。
インを含むライン群とその後に走査されるライン群とで
走査パルスＳＰの幅を変えている。具体的には、少なく
とも最初に走査されるラインを含むライン群に対する走
査時間をその後に走査されるライン群に対する走査時間
に比して短くしている。
【００３８】このような選択書込みアドレス法に適用し
た場合でも、少なくとも最初に走査されるラインを含む
ライン群の走査パルスＳＰの幅を短くすることにより、
全体の走査時間を短くすることができる。このような選
択書込みアドレス法を用いた場合にも図２に示した選択
消去アドレス法に適用した例と同様の作用効果が得られ
る。
た場合でも、少なくとも最初に走査されるラインを含む
ライン群の走査パルスＳＰの幅を短くすることにより、
全体の走査時間を短くすることができる。このような選
択書込みアドレス法を用いた場合にも図２に示した選択
消去アドレス法に適用した例と同様の作用効果が得られ
る。
【００３９】
【発明の効果】本発明によれば、面放電型プラズマディ
スプレイパネルの駆動方法において、少なくとも最初に
走査されるラインを含むライン群に印加されるプライミ
ングパルスの幅をその後に走査されるラインに印加され
るプライミングパルスの幅に比して広くしたことによ
り、最初に走査されるラインに対して後続のライン群の
走査時間を速くすることができ、高速走査が必要な高精
細のディスプレイを可能にすることができる。
スプレイパネルの駆動方法において、少なくとも最初に
走査されるラインを含むライン群に印加されるプライミ
ングパルスの幅をその後に走査されるラインに印加され
るプライミングパルスの幅に比して広くしたことによ
り、最初に走査されるラインに対して後続のライン群の
走査時間を速くすることができ、高速走査が必要な高精
細のディスプレイを可能にすることができる。
【図１】本発明の第１の実施形態による駆動方法で駆動
される面放電型ＰＤＰの斜視図である。
される面放電型ＰＤＰの斜視図である。
【図２】図１のＰＤＰを駆動する本発明の第１の実施形
態による駆動方法にかかる駆動波形の一例を示す図であ
る。（選択消去アドレス法に適用した例）
態による駆動方法にかかる駆動波形の一例を示す図であ
る。（選択消去アドレス法に適用した例）
【図３】図１のＰＤＰを駆動する本発明の第２の実施形
態による駆動方法にかかる駆動波形の一例を示す図であ
る。（選択書込みアドレス法に適用した例）
態による駆動方法にかかる駆動波形の一例を示す図であ
る。（選択書込みアドレス法に適用した例）
【図４】ＡＣＰＤＰの従来の各種駆動パルスの印加タイ
ミングを示す図である。
ミングを示す図である。
１，２ ・・・・・ ガラス基板 ３ ・・・・・ バス電極（金属膜） ４ ・・・・・ 透明電極 ５ ・・・・・ 誘電体層 ６ ・・・・・ 保護層 ７ ・・・・・ 放電空間 ８ ・・・・・ 蛍光体層 １０ ・・・・・ 隔壁 １１ ・・・・・ ＰＤＰ Ｄ ・・・・・ 列電極（アドレス電極） ＲＰｘ，ＲＰｙ ・・・・・ リセットパルス Ｘ，Ｙ ・・・・・ 行電極（維持電極） ＤＰ１〜ＤＰｎ ・・・・・ 画素データパルス Ｄ１〜Ｄｍ ・・・・・ 列電極 ＥＰ ・・・・・ 消去パルス ＰＰ ・・・・・ 走査パルス（プライミングパルス） ＳＰ ・・・・・ 走査パルス（選択消去パルス又は選
択書込みパルス）
択書込みパルス）
Claims (3)
- 【請求項１】 マトリクス表示のラインに対応しかつ誘
電体層で覆われた複数の行電極対と、前記行電極対と直
交する方向に配列され各交差部にて画素を形成する列電
極とを有し、前記ライン毎に順次走査パルスを前記行電
極対の一方に印加するとともに表示データパルスを前記
列電極にして表示データに応じて点灯及び消灯画素を選
択するアドレス期間と、前記行電極対に放電維持パルス
を印加して前記点灯及び消灯画素を維持する維持放電期
間とを用いて表示を行う面放電型プラズマディスプレイ
パネルの駆動方法であって、 前記アドレス期間において印加される走査パルスの幅を
変化させたことを特徴とする面放電型プラズマディスプ
レイパネルの駆動方法。 - 【請求項２】 前記走査パルスは、選択書込みパルスか
らなり、前記アドレス期間において、前記表示データパ
ルスと選択書込みパルスにより、壁電荷を選択的に形成
して点灯及び消灯画素を選択し、少なくとも最初に走査
されるラインを含むライン群に印加される選択書込みパ
ルスの幅に比してその後に走査されるラインに印加され
る走査パルスの幅を広くしたことを特徴とする請求項１
記載の面放電型プラズマディスプレイパネルの駆動方
法。 - 【請求項３】 前記走査パルスは、プライミングパルス
とその直後に印加される選択消去パルスとからなり、前
記アドレス期間の前に全画素に対して壁電荷を一旦形成
する一斉リセット期間を設けると共に前記アドレス期間
において、前記表示データパルスと選択消去パルスによ
り、前記壁電荷を選択的に消去して点灯及び消灯画素を
選択し、少なくとも最初に走査されるラインを含むライ
ン群に印加されるプライミングパルスの幅をその後に走
査されるラインに印加されるプライミングパルスの幅に
比して広くしたことを特徴とする請求項１記載の面放電
型プラズマディスプレイパネルの駆動方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11446797A JP3517551B2 (ja) | 1997-04-16 | 1997-04-16 | 面放電型プラズマディスプレイパネルの駆動方法 |
| US09/052,973 US5982344A (en) | 1997-04-16 | 1998-04-01 | Method for driving a plasma display panel |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11446797A JP3517551B2 (ja) | 1997-04-16 | 1997-04-16 | 面放電型プラズマディスプレイパネルの駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10288973A true JPH10288973A (ja) | 1998-10-27 |
| JP3517551B2 JP3517551B2 (ja) | 2004-04-12 |
Family
ID=14638471
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11446797A Expired - Fee Related JP3517551B2 (ja) | 1997-04-16 | 1997-04-16 | 面放電型プラズマディスプレイパネルの駆動方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5982344A (ja) |
| JP (1) | JP3517551B2 (ja) |
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| JP2004004841A (ja) * | 2002-05-22 | 2004-01-08 | Thomson Licensing Sa | 表示装置に表示するためのビデオ画像処理方法 |
| WO2004086340A1 (ja) * | 2003-03-24 | 2004-10-07 | Matsushita Electric Industrial Co., Ltd. | プラズマディスプレイパネルの駆動方法 |
| KR100784510B1 (ko) | 2005-12-30 | 2007-12-11 | 엘지전자 주식회사 | 플라즈마 디스플레이 장치 및 그의 구동방법 |
| KR100816202B1 (ko) | 2006-11-27 | 2008-03-21 | 삼성에스디아이 주식회사 | 플라즈마 디스플레이 장치 및 그 구동 방법 |
| US7714806B2 (en) | 2004-11-10 | 2010-05-11 | Lg Electronics Inc. | Plasma display apparatus and driving method thereof |
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| JP3710592B2 (ja) * | 1997-04-24 | 2005-10-26 | 三菱電機株式会社 | プラズマディスプレイの駆動方法 |
| JP3596846B2 (ja) * | 1997-07-22 | 2004-12-02 | パイオニア株式会社 | プラズマディスプレイパネルの駆動方法 |
| JP3406508B2 (ja) | 1998-03-27 | 2003-05-12 | シャープ株式会社 | 表示装置および表示方法 |
| JP4210805B2 (ja) * | 1998-06-05 | 2009-01-21 | 株式会社日立プラズマパテントライセンシング | ガス放電デバイスの駆動方法 |
| JP3424587B2 (ja) * | 1998-06-18 | 2003-07-07 | 富士通株式会社 | プラズマディスプレイパネルの駆動方法 |
| EP0982707A1 (en) * | 1998-08-19 | 2000-03-01 | Deutsche Thomson-Brandt Gmbh | Method and apparatus for processing video pictures, in particular for large area flicker effect reduction |
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| JP3466098B2 (ja) | 1998-11-20 | 2003-11-10 | 富士通株式会社 | ガス放電パネルの駆動方法 |
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| KR100793094B1 (ko) * | 2005-09-23 | 2008-01-10 | 엘지전자 주식회사 | 플라즈마 디스플레이 장치 및 그의 구동 방법 |
| US20070159469A1 (en) * | 2006-01-06 | 2007-07-12 | Thomson Licensing | Method and apparatus for processing video pictures, in particular for large area flicker effect reduction |
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1997
- 1997-04-16 JP JP11446797A patent/JP3517551B2/ja not_active Expired - Fee Related
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- 1998-04-01 US US09/052,973 patent/US5982344A/en not_active Expired - Fee Related
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