JPH04257110A - Laminated chip l-type filter - Google Patents
Laminated chip l-type filterInfo
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Landscapes
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Abstract
Description
【0001】0001
【産業上の利用分野】本発明は、EMIフィルタとして
用いられるインダクタとコンデンサから構成された積層
チップL型フィルタ、特にEMIを除去するとともにサ
ージ吸収能力を備えた積層チップL型フィルタに関する
。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a multilayer chip L-type filter that is composed of an inductor and a capacitor and is used as an EMI filter, and more particularly to a multilayer chip L-type filter that removes EMI and has a surge absorption ability.
【0002】0002
【従来の技術】従来から、それぞれ単独の積層チップイ
ンダクタ及び積層チップバリスタは知られている。また
積層チップ部品のEMI除去用L型フィルタとして、■
積層チップコイル1素子と積層チップコンデンサ1素子
とを積層してワンチップに搭載し、同時焼成して一体化
したもの、■チップインダクタ1素子と積層コンデンサ
1素子とを組み合わせて接着又は埋め込んでワンチップ
に搭載し、一体化したもの等があった。これらの積層チ
ップL型フィルタは、チップインダクタ1素子と積層コ
ンデンサ1素子とを組み合わせてL型等価回路を構成し
、EMI除去用フィルタとして使用されている。2. Description of the Related Art Conventionally, individual multilayer chip inductors and multilayer chip varistors have been known. Also, as an L-type filter for removing EMI from laminated chip components, ■
One element of a multilayer chip coil and one element of a multilayer chip capacitor are laminated and mounted on one chip, and then fired simultaneously and integrated. ■One element of a chip inductor and one element of a multilayer capacitor are combined and bonded or embedded into one. There were some that were integrated into a chip. These multilayer chip L-type filters form an L-type equivalent circuit by combining one chip inductor element and one multilayer capacitor element, and are used as EMI removal filters.
【0003】0003
【発明が解決しようとする課題】しかしながら、上記の
従来の積層チップL型フィルタは、いずれの場合もチッ
プインダクタ1素子と積層コンデンサ1素子とを組み合
わせたものであり、サージ吸収効果がない。そのため、
上記の従来の積層チップL型フィルタを使用したワープ
ロ、パソコン等の電子機器においてキーボード等からデ
ータを入力する場合には、人体からでる静電気が入るの
を阻止できず、IC,LSI等を損傷するおそれがあっ
た。However, the conventional multilayer chip L-type filters described above are each a combination of one chip inductor element and one multilayer capacitor element, and do not have a surge absorption effect. Therefore,
When inputting data from a keyboard, etc. in electronic devices such as word processors and personal computers that use the above-mentioned conventional multilayer chip L-type filter, static electricity from the human body cannot be prevented from entering, which can damage ICs, LSIs, etc. There was a risk.
【0004】本発明は、このような事情に鑑みてなされ
たものであり、小型であって、EMIをよく除去すると
ともにサージ吸収能力を備えた積層チップL型フィルタ
を提供することを目的としている。The present invention was made in view of the above circumstances, and an object of the present invention is to provide a multilayer chip L-type filter that is small in size, effectively removes EMI, and has surge absorption ability. .
【0005】[0005]
【課題を解決するための手段】本発明に係る積層チップ
L型フィルタは、帯状導体線路が形成されたフェライト
シートが積層されてなる積層チップインダクタ1素子と
、対向電極を有するバリスタシートが積層されてなる積
層チップコンデンサ1素子とからなり、この積層チップ
コンデンサに対向する前記積層チップインダクタの面に
は帯状導体線路が形成されていないフェライトシートが
介在して前記積層チップインダクタと前記積層チップコ
ンデンサとは積層されて一体化されていることを特徴と
する。また、前記積層チップコンデンサに対向する前記
積層チップインダクタの面には対向電極が形成されてい
ないバリスタシートが介在していることを特徴とする。[Means for Solving the Problems] A multilayer chip L-type filter according to the present invention includes a multilayer chip inductor element formed by stacking ferrite sheets on which strip-shaped conductor lines are formed, and a varistor sheet having a counter electrode. A ferrite sheet on which no band-shaped conductor line is formed is interposed on the surface of the multilayer chip inductor facing the multilayer chip capacitor, so that the multilayer chip inductor and the multilayer chip capacitor are connected to each other. is characterized by being laminated and integrated. Further, the multilayer chip inductor is characterized in that a varistor sheet on which a counter electrode is not formed is interposed on a surface of the multilayer chip inductor that faces the multilayer chip capacitor.
【0006】[0006]
【作用】上記のように構成された本発明に係る積層チッ
プL型フィルタは、インダクタは帯状導体線路のターン
数、フェライトシートの材質等を変えることによりイン
ダクタンス値を変更できるので、所望の値のものを容易
に選択できるとともに、小型にできる。コンデンサにつ
いてもバリスタシートの材質、厚み、対向して形成され
た電極の面積を変えることにより、容量を変更できるの
で所望のものを容易に選択できるとともに、小型にでき
る。また、帯状導体線路が形成されていないフェライト
シート又はバリスタシートがインダクタとコンデンサ間
に介在している等により、層の密着性をよくして磁束の
もれを減らすのでインダクタンスを増加させ小型化が図
れるとともに、実装密度も高めることができ、寄生イン
ダクタンスや浮遊容量等による影響が少なくなり、減衰
特性のバラツキが少ない周波数特性のよい信頼性の高い
フィルタとなる。また、サージ電圧が発生した場合は、
コンデンサとしてのバリスタ素子により吸収され、高電
圧によりIC,LSI等が損傷するおそれがなくなる。[Function] In the multilayer chip L-type filter according to the present invention configured as described above, the inductance value of the inductor can be changed by changing the number of turns of the strip conductor line, the material of the ferrite sheet, etc., so that a desired value can be obtained. You can easily select items and make them smaller. As for the capacitor, the capacitance can be changed by changing the material and thickness of the varistor sheet, and the area of the opposing electrodes, so a desired capacitor can be easily selected and the capacitor can be made smaller. In addition, a ferrite sheet or a varistor sheet on which no strip conductor line is formed is interposed between the inductor and the capacitor, which improves the adhesion of the layers and reduces leakage of magnetic flux, increasing inductance and making it possible to downsize. In addition, the packaging density can be increased, and the influence of parasitic inductance, stray capacitance, etc. can be reduced, resulting in a highly reliable filter with good frequency characteristics and less variation in attenuation characteristics. Also, if a surge voltage occurs,
It is absorbed by the varistor element as a capacitor, eliminating the risk of damaging ICs, LSIs, etc. due to high voltage.
【0007】[0007]
【実施例】以下、本発明の実施例を図面に基づいて説明
する。図において、1は積層チップL型フィルタで、積
層チップインダクタ2と積層チップコンデンサ3とが積
層され一体化され、外形が直方体に形成され、電極が表
面に形成されている。積層チップインダクタ2は、図3
に示すように、帯状導体線路4a,4bがそれぞれ形成
されたフェライトシート2d,2e及びフェライトシー
ト2a,2b,2c,2fが積層されて一体化されて形
成されている。積層チップコンデンサ3は、それぞれ対
向第1及び第2電極7a,7bが形成されたバリスタシ
ート3a,3b及びバリスタシート3c〜3eが積層さ
れて一体化されて形成されている。積層チップインダク
タ2はその積層チップコンデンサ3に対向する面の電極
がないフェライトシート2fを介して積層チップコンデ
ンサ3と積層されて一体化されている。Embodiments Hereinafter, embodiments of the present invention will be explained based on the drawings. In the figure, reference numeral 1 denotes a multilayer chip L-type filter, in which a multilayer chip inductor 2 and a multilayer chip capacitor 3 are laminated and integrated, the outer shape is a rectangular parallelepiped, and electrodes are formed on the surface. The multilayer chip inductor 2 is shown in Figure 3.
As shown in FIG. 2, ferrite sheets 2d, 2e and ferrite sheets 2a, 2b, 2c, 2f on which band-shaped conductor lines 4a, 4b are formed, respectively, are laminated and integrated. The multilayer chip capacitor 3 is formed by laminating and integrating varistor sheets 3a and 3b and varistor sheets 3c to 3e on which opposing first and second electrodes 7a and 7b are formed, respectively. The multilayer chip inductor 2 is laminated and integrated with the multilayer chip capacitor 3 via a ferrite sheet 2f having no electrode on the surface facing the multilayer chip capacitor 3.
【0008】フェライトシート2a〜2fは、Mn−Z
n系フェライト、Ni−Zn系フェライト等の磁性体の
粉末から成形される。フェライトシート2a,2b,2
cと帯状導体線路4a,4bが形成されたフェライトシ
ート2d,2eと、このフェライトシート2eとバリス
タシート3aの間に介在するフェライトシート2fとが
積層されて一体化されて積層チップインダクタ1素子を
形成している。帯状導体線路4aはフェライトシート2
dの表面に概略コの字状にこのシート2dの3辺に沿っ
て屈曲されてインダクタに形成され、その一方の端は図
3上で左側の端縁に沿って形成された引出し電極6aに
接続され、やや短く形成された他方の端にはスルーホー
ル5が設けられている。フェライトシート2dと隣接す
るフェライトシート2eには、帯状導体線路4bが帯状
導体線路4aと同様にして屈曲して形成されている。こ
の帯状導体線路4bは、スルーホール5に対向する位置
の近辺に一端が位置し、他方の端は図3上で右側の端縁
に沿って形成された引出し電極6bに接続されている。
帯状導体線路4a,4bが形成されたフェライトシート
2d,2e・・・を順次重ね合わせて帯状導体線路4a
,4b,・・・を順次接続すると、巻き数の多い所望の
インダクタンスのインダクタを形成することができる。
帯状導体線路も引出し電極も形成されていないフェライ
トシート2fを介して積層チップコンデンサ3を積層す
る。この電極の形成されていないフェライトシート又は
バリスタシートの層は密着性を高めるとともに磁束のも
れを減らすため、複数枚であっても差し支えない。[0008] The ferrite sheets 2a to 2f are Mn-Z
It is molded from powder of magnetic material such as n-type ferrite and Ni-Zn-type ferrite. Ferrite sheets 2a, 2b, 2
ferrite sheets 2d and 2e on which band-shaped conductor lines 4a and 4b are formed, and a ferrite sheet 2f interposed between the ferrite sheet 2e and the varistor sheet 3a are laminated and integrated to form one multilayer chip inductor element. is forming. The strip-shaped conductor line 4a is a ferrite sheet 2
The sheet 2d is bent along three sides of the sheet 2d in a roughly U-shape on the surface of d to form an inductor, and one end thereof is connected to the extraction electrode 6a formed along the left edge in FIG. A through hole 5 is provided at the other connected and slightly short end. On the ferrite sheet 2e adjacent to the ferrite sheet 2d, a band-shaped conductor line 4b is bent in the same manner as the band-shaped conductor line 4a. One end of the strip-shaped conductor line 4b is located near a position facing the through hole 5, and the other end is connected to a lead electrode 6b formed along the right edge in FIG. The ferrite sheets 2d, 2e, on which the band-shaped conductor lines 4a, 4b are formed, are sequentially overlapped to form the band-shaped conductor line 4a.
, 4b, . . . , it is possible to form an inductor with a large number of turns and a desired inductance. A multilayer chip capacitor 3 is laminated via a ferrite sheet 2f on which neither a strip conductor line nor an extraction electrode is formed. There may be a plurality of layers of ferrite sheets or varistor sheets without electrodes in order to improve adhesion and reduce leakage of magnetic flux.
【0009】積層チップコンデンサ3は、図3に示すよ
うに、バリスタシート3a〜3eが順次積層一体化され
て積層チップインダクタ1素子が形成されている。バリ
スタシート3a,3bにはそれぞれ対向第1及び第2電
極7a,7bが形成されている。バリスタシート3aの
対向第1電極7aに接続して引出し電極8aが1辺の端
縁に沿って形成され、バリスタシート3bの対向第2電
極7bから引出し電極9a,9bが2箇所引出し電極8
aと離れた位置の端部に延びて形成されている。As shown in FIG. 3, the multilayer chip capacitor 3 has varistor sheets 3a to 3e sequentially laminated and integrated to form one multilayer chip inductor element. Opposed first and second electrodes 7a and 7b are formed on the varistor sheets 3a and 3b, respectively. An extraction electrode 8a is formed along the edge of one side connected to the opposing first electrode 7a of the varistor sheet 3a, and extraction electrodes 9a and 9b are connected to the opposing second electrode 7b of the varistor sheet 3b at two locations.
It is formed so as to extend to the end at a position away from a.
【0010】バリスタシート3a〜3eは、非直線性抵
抗性を有した酸化亜鉛(ZnO)系、酸化錫(SnO2
)系、チタン酸バリウム(BaTiO3 )系、チタ
ン酸ストロンチウム(SrTiO3 )系等の各種の粉
末材料から成形される。積層チップインダクタ2と積層
チップコンデンサ3のそれぞれの1素子が、積層一体化
された直方体のブロックとされ、外部電極10a,10
b及び11が、図1に示すようにして形成される。この
ようにして図2に示す等価回路の積層チップL型フィル
タが得られる。シートの成形は、特に制限されず、粉末
プレス法、押出法、流し込み法、シート法等の任意の成
形方法で行われる。電極の形成は、特に制限されず、塗
布、印刷、メッキ、スパッタリング等の任意の方法で行
われる。The varistor sheets 3a to 3e are made of zinc oxide (ZnO) or tin oxide (SnO2) having non-linear resistance.
), barium titanate (BaTiO3), and strontium titanate (SrTiO3). One element each of the multilayer chip inductor 2 and the multilayer chip capacitor 3 is formed into a rectangular parallelepiped block that is laminated and integrated, and external electrodes 10a, 10
b and 11 are formed as shown in FIG. In this way, a multilayer chip L-type filter having the equivalent circuit shown in FIG. 2 is obtained. Forming of the sheet is not particularly limited, and may be performed by any forming method such as a powder press method, an extrusion method, a casting method, or a sheet method. Formation of the electrode is not particularly limited, and may be performed by any method such as coating, printing, plating, or sputtering.
【0011】この積層チップL型フィルタのインダクタ
2は、帯状導体線路4a,4bと所望の値のインダクタ
を形成するように複数本接続すればよい。このように帯
状導体線路の形成されたフェライトシートを順次スルー
ホールを介して接続して導通することにより所望の値の
ものを得ることができるとともに、小型にすることがで
きる。また、コンデンサ3もバリスタシートの材質、厚
み及び対向電極面積等を変えて積層することにより所望
の容量のものを得ることができるとともに、小型にする
ことができる。この積層チップL型フィルタはインダク
タ1素子とコンデンサ1素子とから構成され、EMIを
良く除去するとともにコンデンサをバリスタで構成して
いるのでサージ電圧等の異常な電圧が負荷しても、バリ
スタの非直線性抵抗によりコンデンサの抵抗が急激に減
少し,接続されたアースに電流を流してIC,LSI等
に異常な電圧がかからないようにできる。A plurality of inductors 2 of this laminated chip L-type filter may be connected to the strip conductor lines 4a and 4b so as to form an inductor of a desired value. By sequentially connecting the ferrite sheets on which strip-shaped conductor lines are formed in this manner through through holes to establish conduction, a desired value can be obtained and the device can be made smaller. Furthermore, by stacking the capacitor 3 while changing the material, thickness, counter electrode area, etc. of the varistor sheets, a desired capacitance can be obtained and the capacitor 3 can be made smaller. This multilayer chip L-type filter is composed of one inductor element and one capacitor element, and it effectively removes EMI, and since the capacitor is composed of a varistor, even if abnormal voltages such as surge voltages are loaded, the varistor's The linear resistance rapidly reduces the resistance of the capacitor, allowing current to flow through the connected ground and preventing abnormal voltage from being applied to ICs, LSIs, etc.
【0012】図4は、外部電極の他の形成例を示す斜視
図であり、図3の引出し電極9a,9bに接続した帯状
の外部電極11aが積層チップL型フィルタの周囲に巻
かれて角環形に形成されている。このようにすることに
より、寄生インダクタンス等の影響を少なくする。図5
は、図3の引出し電極8aを右側に形成した場合の等価
回路を示した回路図である。出力インピーダンスが高い
場合には、このような等価回路のフィルタに形成して使
用する。FIG. 4 is a perspective view showing another example of forming an external electrode, in which a band-shaped external electrode 11a connected to the extraction electrodes 9a and 9b of FIG. It is formed in a ring shape. By doing so, the influence of parasitic inductance etc. is reduced. Figure 5
3 is a circuit diagram showing an equivalent circuit when the extraction electrode 8a of FIG. 3 is formed on the right side. When the output impedance is high, a filter with such an equivalent circuit is formed and used.
【0013】以上のように、積層チップインダクタ1素
子と積層チップコンデンサ1素子とからなる本発明に係
る積層チップL型フィルタは、寄生インダクタンスや分
布容量等による影響が少なくなり、減衰特性のバラツキ
が少ない周波数特性のよい信頼性の高いEMIフィルタ
となる。また、サージ電圧が発生した場合は、バリスタ
により吸収される。従って、本発明に係る積層チップL
型フィルタは、EMIをよく除去するとともに、サージ
電圧が流れてもよく吸収して高電圧によりIC,LSI
等が損傷するおそれがなくなる。As described above, the multilayer chip L-type filter according to the present invention, which is composed of one multilayer chip inductor and one multilayer chip capacitor, is less affected by parasitic inductance, distributed capacitance, etc., and has less variation in attenuation characteristics. This results in a highly reliable EMI filter with good frequency characteristics. Furthermore, when a surge voltage occurs, it is absorbed by the varistor. Therefore, the laminated chip L according to the present invention
The type filter not only removes EMI well, but also absorbs surge voltage well and protects ICs and LSIs due to high voltage.
etc., there is no risk of damage.
【0014】なお、上記実施例において積層チップイン
ダクタのコンデンサに対向する面に電極のないシートを
介在している例について説明したが、積層チップコンデ
ンサのインダクタに対向する面としてもよい。また、電
極のないフェライトシートとバリスタシートをそれぞれ
インダクタ側とコンデンサ側に介在させるようにしても
よい。また、フェライトシート、バリスタシートは粉末
から成形するものについて説明したが、粉末から成形す
るものに限られず、厚膜や薄膜を形成したものを用いて
もよい。その他、本発明は上記実施例に限定されず要旨
を逸脱しない範囲において種々の変更、修正実施が可能
である。[0014] In the above embodiment, an example has been described in which a sheet having no electrode is interposed on the surface of the multilayer chip inductor facing the capacitor, but the sheet may be interposed on the surface facing the inductor of the multilayer chip capacitor. Further, a ferrite sheet and a varistor sheet without electrodes may be interposed on the inductor side and the capacitor side, respectively. Furthermore, although the ferrite sheet and varistor sheet have been described as being molded from powder, they are not limited to those molded from powder, and thick or thin films may be used. In addition, the present invention is not limited to the above embodiments, and various changes and modifications can be made without departing from the scope of the invention.
【0015】[0015]
【発明の効果】本発明に係る積層チップL型フィルタは
、インダクタとコンデンサの選択もそれぞれ比較的容易
にでき、種々の組合わせが可能であり、小型で面実装タ
イプであり、寄生インダクタンスや浮遊容量等による影
響が少なくなり、減衰特性のバラツキの少ない高性能ノ
イズ除去能力とサージ吸収能力とを有する。[Effects of the Invention] The multilayer chip L-type filter according to the present invention allows selection of inductors and capacitors relatively easily, various combinations are possible, is small and surface-mounted, and has low parasitic inductance and stray inductance. It is less affected by capacitance, etc., and has high-performance noise removal ability and surge absorption ability with less variation in attenuation characteristics.
【0016】[0016]
【図1】 本発明に係る積層チップL型フィルタの斜
視図である。FIG. 1 is a perspective view of a multilayer chip L-type filter according to the present invention.
【図2】 その等価回路図である。FIG. 2 is an equivalent circuit diagram thereof.
【図3】 その一部の構成を示す分解斜視図である。FIG. 3 is an exploded perspective view showing the configuration of a part thereof.
【図4】 本発明の外部電極の他の実施例を示す斜視
図であるFIG. 4 is a perspective view showing another embodiment of the external electrode of the present invention.
【図5】 本発明の他の実施例の等価回路図である。FIG. 5 is an equivalent circuit diagram of another embodiment of the present invention.
1 積層チップL型フィルタ。 2 積層チップインダクタ。 2a〜2f フェライトシート。 3 積層チップコンデンサ。 3a〜3e バリスタシート。 4a,4b 帯状導体線路。 7a 対向第1電極。 7b 対向第2電極。 1. Multilayer chip L-type filter. 2. Multilayer chip inductor. 2a-2f Ferrite sheet. 3. Multilayer chip capacitor. 3a-3e Barista seat. 4a, 4b Strip conductor line. 7a Opposing first electrode. 7b Opposing second electrode.
Claims (2)
シートが積層されてなる積層チップインダクタ1素子と
、対向電極が形成されたバリスタシートが積層されてな
る積層チップコンデンサ1素子とからなり、この積層チ
ップコンデンサに対向する前記積層チップインダクタの
面には帯状導体線路が形成されていないフェライトシー
トが介在して前記積層チップインダクタと前記積層チッ
プコンデンサとは積層されて一体化されていることを特
徴とする積層チップL型フィルタ。Claim 1: Consists of one multilayer chip inductor element made of laminated ferrite sheets on which band-shaped conductor lines are formed, and one multilayer chip capacitor element made of laminated varistor sheets on which counter electrodes are formed, and this laminated The multilayer chip inductor and the multilayer chip capacitor are laminated and integrated by interposing a ferrite sheet on which a strip conductor line is not formed on the surface of the multilayer chip inductor facing the chip capacitor. Multilayer chip L-type filter.
前記積層チップインダクタの面には対向電極が形成され
ていないバリスタシートが介在していることを特徴とす
る請求項1の積層チップL型フィルタ。2. The multilayer chip L-type filter according to claim 1, wherein a varistor sheet on which a counter electrode is not formed is interposed on a surface of the multilayer chip inductor facing the multilayer chip capacitor.
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Country | Link |
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JP (1) | JPH04257110A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006216636A (en) * | 2005-02-02 | 2006-08-17 | Tdk Corp | Composite laminated electronic component |
JP2006245258A (en) * | 2005-03-03 | 2006-09-14 | Tdk Corp | Compound laminated electronic component |
-
1991
- 1991-02-09 JP JP6088891A patent/JPH04257110A/en active Pending
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2006216636A (en) * | 2005-02-02 | 2006-08-17 | Tdk Corp | Composite laminated electronic component |
JP2006245258A (en) * | 2005-03-03 | 2006-09-14 | Tdk Corp | Compound laminated electronic component |
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