JP7367755B2 - 品質最適化デブロッキングを実行するためのイメージ処理デバイス及び方法 - Google Patents
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Description
[頭文字の定義]
[参照番号のリスト]
実施形態1
ブロック符号でエンコードされたイメージの第1符号化ブロック(401)と第2符号化ブロック(402)との間のブロックエッジ(403、800)をデブロッキングするための、イメージエンコーダ(600)及び/又はイメージデコーダ(700)における使用のためのイメージ処理デバイス(501、601、701)であって、イメージ処理デバイス(501、601、701)は、ブロックエッジ(403、800)をフィルタリングするためのフィルタ(502、602、702)を備え、ブロックエッジ(403、800)からのデブロッキング範囲であってブロックエッジ(403、800)に対して垂直となるデブロッキング範囲内のフィルタリング対象の画素の少なくともいくつかに対して、
画素の元の画素値及び少なくとも1つのさらなる画素値からフィルタリングされる画素値を決定し、
ブロックエッジ(403、800)からの画素の距離に依存する画素のクリッピング値を決定し、
クリッピング値を用いてフィルタリングされる画素値をクリッピングして、結果としてデブロッキングされた画素値が得られる
ように構成される。
実施形態2
クリッピング値は、元の画素値とデブロッキングされた画素値との間で最大限許容される変化量である、実施形態1のイメージ処理デバイス(501、601、701)。
実施形態3
クリッピング値を用いてフィルタリングされる画素値をクリッピングして、結果としてデブロッキングされた画素値が得られることは、
フィルタリングされる画素値とデブロッキングされた画素値との間の差の絶対値が画素のクリッピング値を越えない場合、デブロッキングされた画素値をフィルタリングされる画素値に設定することと、
フィルタリングされる画素値が、元の画素値プラスクリッピング値を超える場合、デブロッキングされた画素値を、元の画素値プラス画素のクリッピング値に設定することと、
フィルタリングされる画素値が、元の画素値マイナスクリッピング値より小さい場合、デブロッキングされた画素値を、元の画素値マイナス画素のクリッピング値に設定することと
を有する、実施形態1又は2のイメージ処理デバイス(501、601、701)。
実施形態4
フィルタ(502、602、702)は、関数又はルックアップテーブルを用いることにより、ブロックエッジ(403、800)からの画素の距離に依存する画素のクリッピング値を決定するように適合される、実施形態1から3のうちのいずれかのイメージ処理デバイス(501、601、701)。
実施形態5
フィルタ(502、602、702)は、ブロックエッジ(403、800)からの画素の距離を拡大しつつ単調に減少する関数を用いることにより、ブロックエッジ(403、800)からの画素の距離に依存する画素のクリッピング値を決定するように適合される、実施形態1から3のうちのいずれかのイメージ処理デバイス(501、601、701)。
実施形態6
関数は指数関数である、実施形態5のイメージ処理デバイス(501、601、701)。
実施形態7
関数は、tc'=tc+(tc>>i)であり、tc'はクリッピング値であり、tcは一定値であり、iは、ブロックエッジ(403、800)からの画素の距離であり、>>は、右シフトを示す、実施形態6のイメージ処理デバイス(501、601、701)。
実施形態8
関数は線形関数である、実施形態5のイメージ処理デバイス(501、601、701)。
実施形態9
関数はtc'=tc+(tc-(i*x)であり、tc'はクリッピング値であり、tcは一定値であり、iは、ブロックエッジ(403、800)からの画素の距離であり、xは一定値である、実施形態8のイメージ処理デバイス(501、601、701)。
実施形態10
実施形態1から9のうちのいずれかのイメージ処理デバイス(501、601、701)であって、フィルタ(502、602、702)は、ブロックエッジ(403、800)からのデブロッキング範囲であって、ブロックエッジ(403、800)に対して垂直となるデブロッキング範囲内のフィルタリング対象の各画素に対して、
画素の元の画素値及び少なくとも1つのさらなる画素値からフィルタリングされる画素値を決定し、ブロックエッジ(403、800)から画素の距離に依存する画素のクリッピング値を決定し、クリッピング値を用いてフィルタリングされる画素値をクリッピングして、結果としてデブロッキングされた画素値が得られるように適合される。
実施形態11
フィルタ(502、602、702)は、垂直方向のブロックエッジ(403、800)の場合、決定画素列の数がブロックエッジ(403、800)を囲むブロック内の画素列の数より小さいということに基づいて、及び、水平方向のブロックエッジ(403、800)の場合、決定画像行の数がブロックエッジ(403、800)を囲むブロック内の画素行の数より小さいということに基づいて、ブロックエッジ(403、800)がフィルタリングされる必要があるかどうかを決定することであって、フィルタ(502、602、702)は、ブロックエッジ(403、800)からのデブロッキング範囲内の決定画素行又は決定画素列にはないフィルタリング対象の各画素に対して、デブロッキング範囲がブロックエッジ(403、800)に対して垂直となるように適合される、決定することと、
画素の元の画素値及び少なくとも1つのさらなる画素値からフィルタリングされる画素値を決定することと、
ブロックエッジ(403、800)からの画素の距離に依存する画素のクリッピング値を決定することと、
クリッピング値を用いてフィルタリングされる画素値をクリッピングして、結果として、デブロッキングされた画素値が得られることと
を行うように適合され、
フィルタ(502、602、702)は、ブロックエッジ(403、800)からのデブロッキング範囲であって、ブロックエッジ(403、800)に対して垂直となるデブロッキング範囲内の決定画素行又は決定画素列にあるフィルタリング対象の各画素に対して、
画素の元の画素値及び少なくとも1つのさらなる画素値からフィルタリングされる画素値を決定することと、
一定のクリッピング値を用いてフィルタリングされる画素値をクリッピングして、結果として、デブロッキングされた画素値が得られることと
を行うように適合される、実施形態1から9のうちのいずれかのイメージ処理デバイス(501、601、701)。
実施形態12
フィルタ(502、602、702)は、1個、又は、少なくとも2個、又は、少なくとも3個、又は、少なくとも4個、又は、少なくとも5個、又は、少なくとも6個、又は、少なくとも7個、又は、少なくとも8個、又は、少なくとも9個、又は、少なくとも10個、又は、少なくとも11個、又は、少なくとも12個、又は、少なくとも13個、又は、少なくとも14個、又は、少なくとも15個、又は、少なくとも16個の画素のフィルタタップ長を有する、実施形態1から11のうちのいずれかのイメージ処理デバイス(501、601、701)。
実施形態13
実施形態1から12のうちのいずれかのイメージ処理デバイス(501、601、701)を備える、イメージをエンコードするためのエンコーダ。
実施形態14
実施形態1から12のうちのいずれかのイメージ処理デバイス(501、601、701)を備える、イメージをデコードするためのデコーダ。
実施形態15
ブロック符号でエンコードされたイメージの第1符号化ブロックと第2符号化ブロックとの間のブロックエッジ(403、800)をデブロッキングするためのデブロッキング方法であって、方法は、ブロックエッジ(403、800)からのデブロッキング範囲であって、ブロックエッジ(403、800)に対して垂直となるデブロッキング範囲内のフィルタリング対象となる画素の少なくともいくつかに対して、
画素の元の画素値及び少なくとも1つのさらなる画素値からフィルタリングされる画素値を決定する段階(1000)と、
ブロックエッジ(403、800)からの画素の距離に依存する画素のクリッピング値を決定する段階(1001)と、
クリッピング値を用いてフィルタリングされる画素値をクリッピングして、結果としてデブロッキングされた画素値が得られる(1002)と
を備える方法。
実施形態16
実施形態15のデブロッキング方法を備える、イメージをエンコードするためのエンコーディング方法。
実施形態17
実施形態15のデブロッキング方法を備える、イメージをデコードするためのデコーディング方法。
実施形態18
コンピュータプログラムがコンピュータ上で動作する場合、実施形態15から17のうちのいずれかに係る方法を実行するためのプログラムコードを備えるコンピュータプログラム製品。
Claims (16)
- イメージの第1のブロックと第2のブロックとの間のブロックエッジをデブロッキングするために、イメージエンコーダ及び/又はイメージデコーダにおける使用のためのイメージ処理デバイスであって、前記イメージ処理デバイスは、前記ブロックエッジをフィルタリングするためのフィルタを備え、前記ブロックエッジからのデブロッキング範囲内のフィルタリング対象の少なくとも1つの画素に対して、
前記画素の元の画素値からフィルタリングされる画素値を決定し、
ルックアップテーブルを用いることにより、前記ブロックエッジからの前記画素の距離に依存する前記画素のクリッピング値を決定し、
前記画素の前記クリッピング値を用いて前記フィルタリングされる画素値をクリッピングして、結果としてデブロッキングされた画素値が得られる
ように構成され、
前記フィルタは、垂直方向のブロックエッジの場合、前記ブロックエッジを囲むブロック内の画素列の数より少ない数の決定画素列に基づいて、及び、水平方向のブロックエッジの場合、前記ブロックエッジを囲む前記ブロック内の画素行の数より少ない数の決定画素行に基づいて、ブロックエッジがフィルタリングされる必要があるかどうかを決定するように構成され、
前記フィルタは、前記ブロックエッジからのデブロッキング範囲内の決定画素行又は決定画素列にはないフィルタリング対象のそれぞれの画素であって、前記デブロッキング範囲が前記ブロックエッジに対して垂直である、それぞれの画素に対して、
前記画素の元の画素値及び前記少なくとも1つのさらなる画素値から前記フィルタリングされる画素値を決定することと、
前記ブロックエッジからの前記画素の前記距離に依存する前記画素の前記クリッピング値を決定することと、
前記クリッピング値を用いて前記フィルタリングされる画素値をクリッピングして、結果として、前記デブロッキングされた画素値が得られることと
を行うように構成され、
前記フィルタは、前記ブロックエッジからのデブロッキング範囲内の決定画素行又は決定画素列にあるフィルタリング対象のそれぞれの画素であって、前記デブロッキング範囲が前記ブロックエッジに対して垂直である、それぞれの画素に対して、
前記画素の元の画素値及び前記少なくとも1つのさらなる画素値から前記フィルタリングされる画素値を決定することと、
一定のクリッピング値を用いて前記フィルタリングされる画素値をクリッピングして、結果として前記デブロッキングされた画素値が得られることと
を行うように構成される、
イメージ処理デバイス。 - 前記クリッピング値は、前記元の画素値と前記デブロッキングされた画素値との間で最大限許容される変化量である、請求項1に記載のイメージ処理デバイス。
- 前記クリッピング値を用いて前記フィルタリングされる画素値を前記クリッピングして、結果として前記デブロッキングされた画素値が得られることは、
前記フィルタリングされる画素値と前記元の画素値との間の差の絶対値が前記画素の前記クリッピング値を越えない場合、前記デブロッキングされた画素値を前記フィルタリングされる画素値に設定すること、
前記フィルタリングされる画素値が前記元の画素値プラス前記クリッピング値を超える場合、前記デブロッキングされた画素値を、前記元の画素値プラス前記画素の前記クリッピング値に設定すること、又は、
前記フィルタリングされる画素値が、前記元の画素値マイナス前記クリッピング値より小さい場合、前記デブロッキングされた画素値を前記元の画素値マイナス前記画素の前記クリッピング値に設定すること
を含む、請求項1又は2に記載のイメージ処理デバイス。 - 前記クリッピング値は、前記ブロックエッジからの前記画素の前記距離の単調に減少する関数である、請求項1から3のいずれか一項に記載のイメージ処理デバイス。
- 前記単調に減少する関数は指数関数である、請求項4に記載のイメージ処理デバイス。
- 前記関数は、tc'=tc+(tc>>i)であり、tc'は前記クリッピング値であり、tcは一定値であり、iは、前記ブロックエッジからの前記画素の前記距離であり、>>は、右シフトを示す、請求項5に記載のイメージ処理デバイス。
- 前記フィルタは、少なくとも2個、又は、少なくとも3個、又は、少なくとも4個、又は、少なくとも5個、又は、少なくとも6個、又は、少なくとも7個、又は、少なくとも8個、又は、少なくとも9個、又は、少なくとも10個、又は、少なくとも11個、又は、少なくとも12個、又は、少なくとも13個、又は、少なくとも14個、又は、少なくとも15個、又は、少なくとも16個の画素のフィルタタップ長を有する、請求項1から6のいずれか一項に記載のイメージ処理デバイス。
- 前記デブロッキング範囲は、前記ブロックエッジに対して垂直であるラインにおける画素の数である、請求項1から6のいずれか一項に記載のイメージ処理デバイス。
- 前記フィルタは、前記画素の前記元の画素値及び少なくとも1つのさらなる画素値からフィルタリングされる画素値を決定するように構成される、請求項1から6のいずれか一項に記載のイメージ処理デバイス。
- イメージの第1のブロックと第2のブロックとの間のブロックエッジをデブロッキングするために、イメージエンコーダ及び/又はイメージデコーダにおける使用のためのイメージ処理デバイスであって、前記イメージ処理デバイスは、前記ブロックエッジをフィルタリングするためのフィルタを備え、前記ブロックエッジからのデブロッキング範囲内のフィルタリング対象の少なくとも1つの画素に対して、
前記画素の元の画素値からフィルタリングされる画素値を決定し、
前記画素のクリッピング値を用いて前記フィルタリングされる画素値をクリッピングして、結果としてデブロッキングされた画素値が得られる
ように構成され、
前記クリッピング値は、前記ブロックエッジからの前記画素の距離に依存し、
前記フィルタは、垂直方向のブロックエッジの場合、前記ブロックエッジを囲むブロック内の画素列の数より少ない数の決定画素列に基づいて、及び、水平方向のブロックエッジの場合、前記ブロックエッジを囲む前記ブロック内の画素行の数より少ない数の決定画素行に基づいて、ブロックエッジがフィルタリングされる必要があるかどうかを決定するように構成され、
前記フィルタは、前記ブロックエッジからのデブロッキング範囲内の決定画素行又は決定画素列にはないフィルタリング対象のそれぞれの画素であって、前記デブロッキング範囲が前記ブロックエッジに対して垂直である、それぞれの画素に対して、
前記画素の元の画素値及び前記少なくとも1つのさらなる画素値から前記フィルタリングされる画素値を決定することと、
前記ブロックエッジからの前記画素の前記距離に依存する前記画素の前記クリッピング値を決定することと、
前記クリッピング値を用いて前記フィルタリングされる画素値をクリッピングして、結果として、前記デブロッキングされた画素値が得られることと
を行うように構成され、
前記フィルタは、前記ブロックエッジからのデブロッキング範囲内の決定画素行又は決定画素列にあるフィルタリング対象のそれぞれの画素であって、前記デブロッキング範囲が前記ブロックエッジに対して垂直である、それぞれの画素に対して、
前記画素の元の画素値及び前記少なくとも1つのさらなる画素値から前記フィルタリングされる画素値を決定することと、
一定のクリッピング値を用いて前記フィルタリングされる画素値をクリッピングして、結果として前記デブロッキングされた画素値が得られることと
を行うように構成される、
イメージ処理デバイス。 - 請求項1から10のいずれか一項に記載のイメージ処理デバイスを備える、イメージをエンコードするためのエンコーダ。
- 請求項1から10のいずれか一項に記載のイメージ処理デバイスを備える、イメージをデコードするためのデコーダ。
- ブロック符号でエンコードされたイメージの第1のブロックと第2のブロックとの間のブロックエッジをデブロッキングするためのデブロッキング方法であって、
垂直方向のブロックエッジの場合、前記ブロックエッジを囲むブロック内の画素列の数より少ない数の決定画素列に基づいて、及び、水平方向のブロックエッジの場合、前記ブロックエッジを囲む前記ブロック内の画素行の数より少ない数の決定画素行に基づいて、ブロックエッジがフィルタリングされる必要があるかどうかを決定する段階と、
前記ブロックエッジからのデブロッキング範囲内の決定画素行又は決定画素列にはないフィルタリング対象のそれぞれの画素であって、前記デブロッキング範囲が前記ブロックエッジに対して垂直である、それぞれの画素に対して、
前記画素の元の画素値及び前記少なくとも1つのさらなる画素値からフィルタリングされる画素値を決定する段階と、
前記ブロックエッジからの前記画素の距離に依存する前記画素のクリッピング値を決定する段階と、
前記クリッピング値を用いて前記フィルタリングされる画素値をクリッピングして、結果として、前記デブロッキングされた画素値が得られる段階であって、前記クリッピング値は、前記ブロックエッジからの前記画素の距離に依存する、段階と
を備え、
前記デブロッキング方法は、
前記ブロックエッジからのデブロッキング範囲内の決定画素行又は決定画素列にあるフィルタリング対象のそれぞれの画素であって、前記デブロッキング範囲が前記ブロックエッジに対して垂直である、それぞれの画素に対して、
前記画素の元の画素値及び前記少なくとも1つのさらなる画素値から前記フィルタリングされる画素値を決定する段階と、
一定のクリッピング値を用いて前記フィルタリングされる画素値をクリッピングして、結果として前記デブロッキングされた画素値が得られる段階と
をさらに備える方法。 - 請求項13に記載の方法を備える、イメージをエンコードするためのエンコーディング方法。
- 請求項13に記載の方法を備える、イメージをデコードするためのデコーディング方法。
- プロセッサに、請求項13に記載の方法を実行させるためのプログラム。
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