JP6136165B2 - 電子回路 - Google Patents
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Description
20、22 直流電流経路
C1−C7 キャパシタ
L1−L17 分布定数線路
R1−R14 抵抗
Tb 直流電源
Claims (9)
- 第1端子、第2端子および高周波信号が入力する制御端子を有し、前記第1端子がグランドに接続されFETからなる第1トランジスタと、
第1端子、第2端子および制御端子を有し、前記制御端子が前記第1トランジスタの第2端子に高周波的に接続され、前記第1トランジスタの第2端子から出力された高周波信号が前記制御端子に入力する第2トランジスタと、
一端が前記第2トランジスタの第1端子に、他端がグランドに接続され、前記第2トランジスタの第1端子を高周波的に接地させる第1キャパシタと、
一端が前記第1トランジスタの第2端子と前記第2トランジスタの制御端子との間の第1ノードに接続され、他端が前記第2トランジスタの第1端子と前記第1キャパシタの一端との間の第2ノードに接続された第1抵抗と、
前記第2トランジスタの第2端子、第1端子、前記第2ノード、前記第1抵抗および前記第1ノードを介し前記第1トランジスタの第2端子に直流電流を供給する第1電流経路と、
第1端子、第2端子および高周波信号が入力しない制御端子を有しFETからなり前記第1端子がグランドに接続され、前記第1トランジスタと同じゲート幅を有する第4トランジスタと、一端が前記第4トランジスタの第2端子に接続され他端が前記第2ノードに接続され前記第1抵抗と同じ抵抗値を有する第3抵抗と、を備え、前記第2ノードに接続され前記第1電流経路とグランドとの間に前記第1トランジスタに並列に接続された第1分流回路と、
を具備することを特徴とする電子回路。 - 前記第2トランジスタはFETからなり、前記第1トランジスタのゲート幅は、前記第2トランジスタのゲート幅よりも小さいことを特徴とする請求項1記載の電子回路。
- 第1端子、第2端子および制御端子を有し、前記制御端子が前記第2トランジスタの第2端子に高周波的に接続され、前記第2トランジスタの第2端子から出力された高周波信号が前記制御端子に入力する第3トランジスタと、
一端が前記第3トランジスタの第1端子に、他端がグランドに接続され、前記第3トランジスタの第1端子を高周波的に接地させる第2キャパシタと、
一端が前記第2トランジスタの第2端子と前記第3トランジスタの制御端子との間の第3ノードに接続され、他端が前記第3トランジスタの第1端子と前記第2キャパシタの一端との間の第4ノードに接続された第2抵抗と、
前記第3トランジスタの第2端子、第1端子、前記第4ノード、前記第2抵抗および前記第3ノードを介し前記第2トランジスタの第2端子に直流電流を供給する第2電流経路と、
前記第4ノードに接続され前記第2電流経路とグランドとの間に前記第2トランジスタに並列に接続された第2分流回路と、
を具備することを特徴とする請求項1または2記載の電子回路。 - 前記第3トランジスタはFETからなり、前記第2トランジスタのゲート幅は、前記第3トランジスタのゲート幅よりも小さいことを特徴とする請求項3記載の電子回路。
- 一端が前記第1トランジスタの第1端子に接続され、他端がグランドに接続された第6抵抗と、
一端が前記第1トランジスタの制御端子に接続され、他端がグランドに接続された第7抵抗と、
を具備し、
前記第1分流回路は、一端が前記第4トランジスタの第1端子に接続され他端がグランドに接続され前記第6抵抗と同じ抵抗値を有する第8抵抗と、一端が前記第4トランジスタの制御端子に接続され他端がグランドに接続され前記第7抵抗と同じ抵抗値を有する第9抵抗と、を備えることを特徴とする請求項1から4のいずれか一項記載の電子回路。 - 一端が前記第1分流回路に、他端が前記第2ノードに接続された信号の波長の1/8以上かつ3/8以下の長さを有する第1分布定数線路を具備することを特徴とする請求項1から5のいずれか一項記載の電子回路。
- 前記第2分流回路は、前記第2トランジスタと同じゲート幅を有する第5トランジスタと、前記第1トランジスタと同じゲート幅を有する第6トランジスタと、を備えることを特徴とする請求項3または4記載の電子回路。
- 前記第2分流回路は、前記第5トランジスタと前記第4ノードとの間に設けられた第4抵抗と、前記第5トランジスタと前記第6トランジスタとの間に設けられた第5抵抗と、を備えることを特徴とする請求項7記載の電子回路。
- 一端が前記第2分流回路に、他端が前記第4ノードに接続された信号の波長の1/8以上かつ3/8以下の長さを有する第2分布定数線路を具備することを特徴とする請求項3または4記載の電子回路。
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