[go: up one dir, main page]
More Web Proxy on the site http://driver.im/

JP5301126B2 - 半導体装置及びその製造方法 - Google Patents

半導体装置及びその製造方法 Download PDF

Info

Publication number
JP5301126B2
JP5301126B2 JP2007215190A JP2007215190A JP5301126B2 JP 5301126 B2 JP5301126 B2 JP 5301126B2 JP 2007215190 A JP2007215190 A JP 2007215190A JP 2007215190 A JP2007215190 A JP 2007215190A JP 5301126 B2 JP5301126 B2 JP 5301126B2
Authority
JP
Japan
Prior art keywords
sealing resin
relay substrate
semiconductor
semiconductor chip
adhesive
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2007215190A
Other languages
English (en)
Other versions
JP2009049249A (ja
Inventor
正徳 小野寺
Original Assignee
スパンション エルエルシー
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by スパンション エルエルシー filed Critical スパンション エルエルシー
Priority to JP2007215190A priority Critical patent/JP5301126B2/ja
Priority to US12/196,156 priority patent/US8749039B2/en
Publication of JP2009049249A publication Critical patent/JP2009049249A/ja
Application granted granted Critical
Publication of JP5301126B2 publication Critical patent/JP5301126B2/ja
Priority to US14/271,115 priority patent/US9312252B2/en
Expired - Fee Related legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/50Multistep manufacturing processes of assemblies consisting of devices, each device being of a type provided for in group H01L27/00 or H01L29/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
    • H01L21/56Encapsulations, e.g. encapsulation layers, coatings
    • H01L21/563Encapsulation of active face of flip-chip device, e.g. underfilling or underencapsulation of flip-chip, encapsulation preform on chip or mounting substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • H01L23/3107Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
    • H01L23/3121Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation
    • H01L23/3128Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed a substrate forming part of the encapsulation the substrate having spherical bumps for external connection
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/28Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
    • H01L23/31Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape
    • H01L23/3107Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the arrangement or shape the device being completely enclosed
    • H01L23/3135Double encapsulation or coating and encapsulation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/10Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers
    • H01L25/105Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices having separate containers the devices being of a type provided for in group H01L27/00
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L2224/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • H01L2224/161Disposition
    • H01L2224/16151Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/16221Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/16225Disposition the bump connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32151Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/32221Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/32225Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73203Bump and layer connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73201Location after the connecting process on the same surface
    • H01L2224/73203Bump and layer connectors
    • H01L2224/73204Bump and layer connectors the bump connector being embedded into the layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73253Bump and layer connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/10All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
    • H01L2225/1005All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/1011All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
    • H01L2225/1017All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support
    • H01L2225/1023All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement the lowermost container comprising a device support the support being an insulating substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2225/00Details relating to assemblies covered by the group H01L25/00 but not provided for in its subgroups
    • H01L2225/03All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00
    • H01L2225/10All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers
    • H01L2225/1005All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00
    • H01L2225/1011All the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/648 and H10K99/00 the devices having separate containers the devices being of a type provided for in group H01L27/00 the containers being in a stacked arrangement
    • H01L2225/1047Details of electrical connections between containers
    • H01L2225/1052Wire or wire-like electrical connections
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/10Bump connectors ; Manufacturing methods related thereto
    • H01L24/15Structure, shape, material or disposition of the bump connectors after the connecting process
    • H01L24/16Structure, shape, material or disposition of the bump connectors after the connecting process of an individual bump connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L24/28Structure, shape, material or disposition of the layer connectors prior to the connecting process
    • H01L24/29Structure, shape, material or disposition of the layer connectors prior to the connecting process of an individual layer connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L24/42Wire connectors; Manufacturing methods related thereto
    • H01L24/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L24/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L24/00Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
    • H01L24/73Means for bonding being of different types provided for in two or more of groups H01L24/10, H01L24/18, H01L24/26, H01L24/34, H01L24/42, H01L24/50, H01L24/63, H01L24/71
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/03Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
    • H01L25/04Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
    • H01L25/065Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00
    • H01L25/0655Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L27/00 the devices being arranged next to each other
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/00014Technical content checked by a classifier the subject-matter covered by the group, the symbol of which is combined with the symbol of this group, being disclosed without further technical details
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/01Chemical elements
    • H01L2924/01079Gold [Au]
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/06Polymers
    • H01L2924/078Adhesive characteristics other than chemical
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/151Die mounting substrate
    • H01L2924/153Connection portion
    • H01L2924/1531Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface
    • H01L2924/15311Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a ball array, e.g. BGA
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191Disposition
    • H01L2924/19101Disposition of discrete passive components
    • H01L2924/19107Disposition of discrete passive components off-chip wires

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Manufacturing & Machinery (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)

Description

本発明は、一の半導体パッケージの上に他の半導体パッケージを積層した、いわゆるマルチチップパッケージ型の半導体装置に係るものである。
近年、電子機器の小型化・高機能化に伴い、半導体チップの実装密度を高めた半導体装置が多数開発されている。図1は従来例に係るマルチチップパッケージ型の半導体装置90の構成を示した図である。第1半導体パッケージ50の上に、第2半導体パッケージ92が接着剤30を介して実装されている。
第1半導体パッケージ50の構成は以下の通りである。第1中継基板12の上面に、第1ダイ接着剤15を介して第1半導体チップ10が実装されている。第1半導体チップ10は、第1中継基板12の上面に設けられた第1基板電極18と、第1ワイヤ19により電気的に接続されている。第1半導体チップ10及び第1ワイヤ19は、第1中継基板12の上面に設けられた第1封止樹脂14により封止されている。
第2半導体パッケージ92の構成は以下の通りである。第2中継基板82に第2半導体チップ80が第2ダイ接着剤85を介して実装されている。第2半導体チップ80は、第2中継基板82に設けられた第2基板電極88と、第2ワイヤ89により電気的に接続されている。第2半導体チップ80及び第2ワイヤ89は、第2封止樹脂84により封止されている。
第1半導体パッケージ50及び第2半導体パッケージ92は、第1基板電極18と第2基板電極88とを接続する第3ワイヤ72により電気的に接続されている。第1中継基板12の上面には、第1半導体パッケージ50及び第2半導体パッケージ92を封止する第3封止樹脂70が設けられている。第1中継基板12の下面には、外部接続端子44が設けられている。
従来例に係る半導体装置90では、複数の半導体パッケージを垂直方向に重ねて実装しているため、半導体装置の実装密度を高めることができる。また、予め試験により良品と判別された半導体パッケージのみを選別して実装することができるため、半導体装置の製造歩留まりを向上させることができる。
特許文献1には、このようなマルチチップパッケージ型の半導体装置が多数示されている。
特表2006−502596号公報
従来例に係るマルチチップパッケージ型の半導体装置は、樹脂封止された第1半導体パッケージに、同じく樹脂封止された第2半導体パッケージを重ねて実装するものである。また、第2半導体パッケージ92は、第2半導体チップ80がワイヤボンディングにより第2中継基板82と電気的に接続されている。このように、第2半導体パッケージ92は第2ワイヤ89及び第2封止樹脂84を備えているため低背化に限界があり、半導体装置90全体を低背化することが困難であった。
また、第2封止樹脂84と第3封止樹脂70とは樹脂同士であるため密着性が良好でなく、境界面78において剥離が発生し、半導体装置90における構造上の信頼性が低下するという課題があった。
本発明は上記課題に鑑みてなされたものであり、マルチチップパッケージ型の半導体装置の低背化を行うことを目的とする。また、マルチチップパッケージ型の半導体装置の信頼性を向上させることを他の目的とする。
本発明は、第1半導体チップと、前記第1半導体チップが上面に実装された第1中継基板と、前記第1中継基板の上面に設けられ、前記第1半導体チップを封止する第1封止樹脂と、前記第1封止樹脂の上面に実装された第2半導体チップと、前記第2半導体チップがフリップチップボンディングにより実装された第2中継基板と、前記第1中継基板の上面に設けられ、前記第1封止樹脂、前記第2半導体チップ、及び前記第2中継基板を封止する第2封止樹脂と、を具備し、前記第2半導体チップは、前記第2中継基板に実装された面と反対側の面を下にして、前記第1封止樹脂の上面に接着剤を介して実装されていることを特徴とする半導体装置である。本発明によれば、第2中継基板にフリップチップボンディングにより実装された第2半導体チップが、接着剤を介して第1封止樹脂の上面に直接実装されている。このため、樹脂封止された第2半導体チップを実装する場合に比べ、半導体装置を低背化することができる。また、部材同士の密着性を向上させることができる。
上記構成において、前記第1封止樹脂及び前記第2中継基板の間の領域に、少なくとも前記第2半導体チップの側面を覆って設けられた支持材を具備する構成とすることができる。この構成によれば、第2封止樹脂における未充填部分やボイドの発生を抑制し、第2基板電極と第2ワイヤとの接続性を向上させることができる。
上記構成において、前記支持材は、前記第1封止樹脂及び前記第2中継基板の間の領域全体に設けられている構成とすることができる。この構成によれば、第2封止樹脂における未充填部分やボイドの発生をさらに抑制し、第2基板電極と第2ワイヤとの接続性をさらに向上させることができる。
上記構成において、前記接着剤は、前記第1封止樹脂及び前記第2中継基板の間の領域に、少なくとも前記第2半導体チップの側面を覆って設けられている構成とすることができる。この構成によれば、第2封止樹脂における未充填部分やボイドの発生を抑制し、第2基板電極と第2ワイヤとの接続性を向上させることができる。また、支持材を用いる場合に比べて部材の数を削減することができる。
上記構成において、前記接着剤は、前記第1封止樹脂及び前記第2中継基板の間の領域全体に設けられている構成とすることができる。この構成によれば、第2封止樹脂における未充填部分やボイドの発生をさらに抑制し、第2基板電極と第2ワイヤとの接続性をさらに向上させることができる。
上記構成において、前記第2中継基板における、前記第2半導体チップが実装された面に設けられた試験電極を具備する構成とすることができる。この構成によれば、試験電極を設ける位置の選択性が向上するため、設計の自由度を高めることができる。
上記構成において、前記第2中継基板には前記第2半導体チップが複数実装され、前記複数の第2半導体チップのうち少なくとも1つが、前記接着剤を介して前記第1封止樹脂の上面に実装されている構成とすることができる。
本発明は、第1中継基板の上面に実装された第1半導体チップを封止する第1封止樹脂の上面に、第2中継基板にフリップチップボンディングにより実装された第2半導体チップを、前記第2中継基板に実装された面と反対側の面を下にして、接着剤を介して実装する工程と、前記第1中継基板の上面に、前記第1封止樹脂、前記第2半導体チップ、及び前記第2中継基板を封止する第2封止樹脂を形成する工程と、を具備することを特徴とする半導体装置の製造方法である。本発明によれば、第2中継基板にフリップチップボンディングにより実装された第2半導体チップを、接着剤を介して第1封止樹脂の上面に直接実装する。このため、樹脂封止された第2半導体チップを実装する場合に比べ、半導体装置を低背化することができる。また、第2封止樹脂を形成する際の、部材同士の密着性を向上させることができる。
上記構成において、前記第2半導体チップを前記第1封止樹脂の上面に前記接着剤を介して実装する工程は、前記第1封止樹脂の上面に前記接着剤を供給する工程と、前記第2半導体チップを前記接着剤に接触させた後さらに押圧し、前記第1封止樹脂及び前記第2中継基板の間の領域に前記接着剤を充填する工程と、を含む構成とすることができる。この構成によれば、第2封止樹脂を形成する際に未充填部分やボイドの発生を抑制することができる。また、第2ワイヤをワイヤボンディングする際の安定性を向上させることができる。また、別途支持材を充填する場合に比べて部材の数を削減することができる。
上記構成において、前記第1封止樹脂及び前記第2中継基板の間の領域に前記接着剤を充填する工程は、前記接着剤を前記第1封止樹脂及び前記第2中継基板の間の領域全体に充填する構成とすることができる。この構成によれば、第2封止樹脂を形成する際に未充填部分やボイドの発生をさらに抑制することができる。また、第2ワイヤをワイヤボンディングする際の安定性をさらに向上させることができる。
上記構成において、前記第2半導体チップを前記第1封止樹脂の上面に前記接着剤を介して実装する工程の後、前記第1封止樹脂及び前記第2中継基板の間の領域に、少なくとも前記第2半導体チップの側面を覆って支持材を充填する工程を具備する構成とすることができる。この構成によれば、第2封止樹脂を形成する際に未充填部分やボイドの発生を抑制することができる。また、第2ワイヤをワイヤボンディングする際の安定性を向上させることができる。
上記構成において、前記第1封止樹脂及び前記第2中継基板の間の領域に前記支持材を充填する工程は、前記支持材を前記第1封止樹脂及び前記第2中継基板の間の領域全体に充填する構成とすることができる。この構成によれば、第2封止樹脂を形成する際に未充填部分やボイドの発生をさらに抑制することができる。また、第2ワイヤをワイヤボンディングする際の安定性をさらに向上させることができる。
上記構成において、前記第2半導体チップを前記第1封止樹脂の上面に前記接着剤を介して実装する工程は、前記第2中継基板に実装された複数の前記第2半導体チップのうち少なくとも1つを、前記第2中継基板に実装された面と反対側の面を下にして、前記第1封止樹脂の上面に前記接着剤を介して実装する構成とすることができる。この構成によれば、第2中継基板に第2半導体チップが複数実装されている場合であっても、第2半導体チップを第1封止樹脂の上面に実装することができる。
本発明によれば、第2中継基板にフリップチップボンディングにより実装された第2半導体チップが、接着剤を介して第1封止樹脂の上面に直接実装されている。このため、樹脂封止された第2半導体チップを実装する場合に比べ、半導体装置を低背化することができる。また、部材同士の密着性を向上させることができる。
以下、図面を用い本発明に係る実施例について説明する。
図2(a)〜図2(d)を参照に、実施例1に係る半導体装置100の製造方法について説明する。従来例に係る半導体装置(図1)と共通の構成には同一の符号を付し、詳細な説明を省略する。
図2(a)を参照に、第1半導体チップ10が実装された第1半導体パッケージ50の上面に、例えばシリコーン系樹脂からなる接着剤30を供給する。第1半導体パッケージ50の構成は図1に示されたものと同じであり、例えばシリコンからなる第1半導体チップ10が、例えばポリイミド系樹脂からなる第1中継基板12の上面に実装され、例えばエポキシ系樹脂からなる第1封止樹脂14により封止されている。接着剤30は、第1封止樹脂14の上面に供給する。接着剤30には、他にも絶縁性のエポキシ系樹脂やアクリル系樹脂などを用いることができるが、熱伝導性の高いシリコーン系樹脂を用いることが好ましい。
図2(b)を参照に、第1半導体パッケージ50における第1封止樹脂14の上面に、接着剤30を介して第2半導体パッケージ52を実装する。第2半導体パッケージ52の構成は、図1に示される従来例の第2半導体パッケージ92とは異なる。第2半導体パッケージ52は、第2半導体チップ20が、第2中継基板22にフリップチップボンディングにより実装されている。第2半導体チップ20と第2中継基板22とは、例えば金からなるバンプ電極23により電気的に接続されており、第2半導体チップ20及び第2中継基板22の間の領域には、例えばエポキシ系の樹脂からなるアンダーフィル材21が充填されている。第2中継基板22には、外部と電気的な接続を行うための基板電極28が設けられている。基板電極28は例えば銅からなり、その一部は第2半導体パッケージの電気的試験を行う際に使用する試験電極27となっている。第2半導体パッケージ52は、第2半導体チップ20における、第2中継基板に実装された面と反対側の面を下にして、第1封止樹脂14の上面に実装する。
図2(c)を参照に、第1基板電極18と第2基板電極28とを、例えば金からなる第2ワイヤ42により接続する。これにより、第1半導体パッケージ50と第2半導体パッケージ52とが電気的に接続される。
図2(d)を参照に、第1中継基板12の上面に、第1半導体パッケージ50及び第2半導体パッケージ52を封止する第2封止樹脂40を形成する。第2封止樹脂40は例えばエポキシ系の絶縁性樹脂を用い、少なくとも第1封止樹脂14、第2半導体チップ20、及び第2中継基板22を封止するように形成する。また、第1中継基板12の下面に設けられた、例えば銅からなる電極パッドの表面に、例えば錫銀系の半田からなる半田ボールを設け、外部接続端子44を形成する。さらに、第1中継基板12及び第2封止樹脂40を、例えばダイシング装置により所定の位置で切断する。以上の工程により、実施例1に係る半導体装置100が完成する。
図3は実施例1に係る半導体装置100の構成を示した図である。第1半導体チップ10が、第1中継基板12の上面に第1ダイ接着剤15を介して実装されている。第1半導体チップ10は、第1中継基板12の上面に設けられた第1基板電極18と第1ワイヤ19により電気的に接続されている。第1半導体チップ10及び第1ワイヤ19は、第1中継基板12の上面に設けられた第1封止樹脂14により封止されている。
第2半導体チップ20は、第2中継基板22にフリップチップボンディングにより実装されている。第2半導体チップ20と第2中継基板22とは、バンプ電極23により電気的に接続されており、第2半導体チップ20及び第2中継基板22の間の領域には、アンダーフィル材21が充填されている。第2中継基板22には、外部と電気的な接続を行うための基板電極28が設けられており、その一部は第2半導体パッケージの電気的試験を行うための試験電極27となっている。
第2半導体チップ20は、第2中継基板22と反対側の面を下にして、第1封止樹脂14の上面に接着剤30を介して実装されている。第1中継基板12の上面には、第1封止樹脂14、第2半導体チップ20、及び第2中継基板22を封止する第2封止樹脂40が設けられている。また、第1基板電極18と第2基板電極28とは第2ワイヤ42により電気的に接続されており、第1中継基板12の下面には、第1基板電極18と電気的に接続された外部接続端子44が設けられている。
実施例1に係る半導体装置100は、樹脂封止された第1半導体パッケージ50の上に、樹脂封止されていない第2半導体パッケージ52を重ねて実装したものである。また、第2半導体パッケージ52は第2半導体チップ20が第2中継基板22にフリップチップボンディングにより実装されている。このため、従来からあるマルチチップパッケージ型の半導体装置に比べて、上側に実装する半導体パッケージを、封止樹脂とワイヤ(図1における第2封止樹脂84及び第2ワイヤ89に相当)の分だけ薄くすることができる。これにより、封止樹脂及びワイヤに起因するパッケージ厚の増大を改善し、半導体装置全体を低背化することができる。
また、図2(b)から(d)を参照に、樹脂封止されていない第2半導体パッケージ52を第1半導体パッケージ50に実装した後、第2封止樹脂40により全体を樹脂封止している。このため、図1に示したような境界面78における封止樹脂同士の剥離が発生せず、第2半導体パッケージ52と第2封止樹脂40との密着性を向上させることができる。その結果、半導体装置の信頼性を向上させることができる。
また、図1を参照に、従来例に係る半導体装置90では第2半導体パッケージ92が樹脂封止されているため、試験用電極を設ける位置は第2中継基板82の片面(樹脂封止された面の反対側)に限られていた。実施例1に係る半導体装置100では、樹脂封止されていない第2半導体パッケージ52を用いるため、試験電極27を第2中継基板22の任意の面に設けることができる。例えば図3に示すように、第2中継基板22における、第2半導体チップ20が実装された面と同じ面に、試験電極27を設けることができる。これにより、試験電極27を設ける位置の選択性が広がるため、設計の自由度を高めることができる。また、設計の自由度を高めることにより、第2基板電極28の汚染や第2半導体チップ20の破損を防止するための対策を講じることができる。
実施例2は、第1封止樹脂及び第2中継基板の間の領域に支持材を充填した例である。図4(a)〜図4(d)を参照に、実施例2に係る半導体装置101の製造方法について説明する。実施例1に係る半導体装置100の製造方法(図2(a)〜(d))と共通の構成には同一の符号を付し、詳細な説明を省略する。
図4(a)を参照に、半導体パッケージ50における第1封止樹脂14の上面に、第2半導体パッケージ52における第2半導体チップ20を、接着剤30を介して実装する。図示するように、第2半導体チップ20の横方向の長さは、第1封止樹脂14の上面及び第2中継基板22における横方向の長さより小さい。すなわち、第2半導体チップ20は、第1封止樹脂14及び第2中継基板22に比べて小さい。また、第2半導体チップ20は第2中継基板22にフリップチップボンディングにより実装されており、第1封止樹脂14及び第2中継基板22の間に空間が生じている。
図4(b)を参照に、第1封止樹脂14及び第2中継基板22の間の領域に、支持材32を充填する。支持材32は絶縁系のエポキシ系樹脂、アクリル系樹脂、シリコーン系樹脂などを用いることができるが、熱伝導性の高いシリコーン系樹脂を用いることが好ましい。また、充填が容易な半液化状態の樹脂を用いることが好ましい。支持材32は、少なくとも第2半導体チップ20の側面を覆って充填すればよいが、図4(b)に示すように第1封止樹脂14及び第2中継基板22の間の領域全体に充填することが好ましい。
図4(c)を参照に、第1基板電極18と第2基板電極28とを、第2ワイヤ42により接続する。図4(d)を参照に、第1中継基板12の上面に第2封止樹脂40を形成する。さらに、外部接続端子44を形成し所定の位置で切断を行う。図4(c)以降の工程は実施例1と共通である。以上の工程により、実施例2に係る半導体装置101が完成する。
図5は実施例2に係る半導体装置101の構成を示した図である。第2半導体チップ20は、第2中継基板22及び第1封止樹脂14に比べ、垂直方向から見た場合の大きさが小さい。第1封止樹脂14及び第2中継基板22の間の領域には、支持材32が設けられている。その他の構成は実施例1(図3)と同じである。
図2(d)を参照に、実施例1では第1封止樹脂14及び第2中継基板22の間の空間に第2封止樹脂40を流し入れていた。このため、この空間が小さい場合や、第2中継基板22が第2半導体チップ20からはみ出す長さ(オーバーハング量)が大きい場合には、第2封止樹脂40が奥まで十分に到達せずに、未充填部分やボイドが生じる場合があった。図4(d)を参照に、実施例2に係る半導体装置101は、第1封止樹脂14及び第2中継基板22の間の空間に支持材32が充填されている。このため、この空間に第2封止樹脂40を形成する必要がなく、第2封止樹脂40の未充填部分やボイドの発生を抑制することができる。
また、第2中継基板22のオーバーハング量が大きい場合、第2中継基板22にたわみが生じやすく、熱の伝導性も低下するため安定したワイヤボンディングを行うことが難しい。図4(c)を参照に、実施例2では第1封止樹脂14及び第2中継基板22の間の空間に支持材32が充填されているため、第2中継基板22への熱の伝導性を向上させることができる。また、第2中継基板22の機械的な強度を強化し、ワイヤボンディングツールの圧力によるたわみの発生を抑制することができる。これにより、ワイヤボンディングの安定性を向上させることができ、第2基板電極28と第2ワイヤ42との接続信頼性を向上させることができる。
図6を参照に、支持材32は少なくとも第2半導体チップ20の側面を覆って設けられていればよいが、図5のように支持材32は第1封止樹脂14及び第2中継基板22の間の領域全体に設けられていることが好ましい。これにより、ワイヤボンディングの安定性をさらに向上させ、第2基板電極28と第2ワイヤ42との接続信頼性をさらに向上させることができる。
実施例3は接着剤が支持材を兼ねる例である。図7(a)〜図7(d)を参照に、実施例3に係る半導体装置102の製造方法について説明する。実施例1に係る半導体装置100の製造方法(図2(a)〜(d))と共通の構成には同一の符号を付し、詳細な説明を省略する。
図7(a)を参照に、第1封止樹脂14の上面に接着剤30aを供給する。接着剤30aは実施例2における支持材の役割を兼ねるため、第1封止樹脂14及び第2中継基板22の間の領域を充填するために十分な量の接着剤30aを供給する。
図7(b)を参照に、第2半導体パッケージ52における第2半導体チップ20を、接着剤30aを介して第1封止樹脂14の上面に実装する。ここで、第2半導体チップ20を接着剤30aに接触させた後さらに押圧し、第1封止樹脂14及び第2中継基板22の間の領域に接着剤30aを充填させる。接着剤30aは、少なくとも第2半導体チップ20の側面を覆うように充填させればよいが、図7(b)に示すように第1封止樹脂14及び第2中継基板22の間の領域全体に充填させることが好ましい。
図7(c)を参照に、第1基板電極18と第2基板電極28とを、第2ワイヤ42により接続する。図7(d)を参照に、第1中継基板12の上面に第2封止樹脂40を形成する。さらに、外部接続端子44を形成し所定の位置で切断を行う。図7(c)以降の工程は実施例1と共通である。以上の工程により、実施例3に係る半導体装置102が完成する。
図8は実施例3に係る半導体装置102の構成を示した図である。第1封止樹脂14の上面に、接着剤30aを介して第2半導体チップ20が実装されている。接着剤30aはさらに、第1封止樹脂14及び第2中継基板22の間の領域にも設けられている。その他の構成は実施例1(図3)と同じである。
実施例3に係る半導体装置102は、第1封止樹脂14及び第2中継基板22の間の領域に接着剤30aが設けられている。これにより、接着剤30aが実施例2における支持材32と同じ役割を果たすため、実施例2の場合と同様に第2封止樹脂40の未充填部分やボイドの発生を抑制することができる。また、図7(c)におけるワイヤボンディングの安定性を向上させ、第2基板電極28と第2ワイヤ42との接続信頼性を向上させることができる。
また、実施例3では接着剤30aが実施例2における支持材32の役割を兼ねているため、支持材32を新たに設ける必要がない。これにより、部材の数を削減し、製造工程を単純化することができる。
図9に示すように、接着剤30aは少なくとも第2半導体チップ20の側面を覆って設けられていればよいが、図8のように第1封止樹脂14及び第2中継基板22の間の領域全体に設けられていることが好ましい。接着剤30aの側面は、押圧時の圧力により歪んでいてもよく、さらにその一部が第1封止樹脂14の側面にはみ出していてもよい。また、接着剤30aにはエポキシ系樹脂、アクリル系樹脂、シリコーン系樹脂などを用いることができるが、熱伝導性の高いシリコーン系樹脂を用いることが好ましい。
実施例4は、複数の第2半導体チップが実装された第2中継基板を、第2半導体パッケージとして用いる例である。
図10は実施例4に係る半導体装置103の構成を示した図である。第2中継基板22には、第2半導体チップ20が2つ実装されている。2つの第2半導体チップ20は、それぞれがフリップチップボンディングにより第2中継基板22に実装され、接着剤30を介して第1封止樹脂14の上面に実装されている。第1封止樹脂14及び第2中継基板22の間の領域における、第2半導体チップ20が設けられていない領域には、支持材32が設けられている。その他の構成は実施例1(図3)と同じである。
第2中継基板22に実装される第2半導体チップ20の数は、複数であれば3以上であってもよい。また、複数の第2半導体チップ20は、図11に示すように少なくとも1つが接着剤30を介して第1封止樹脂14の上面に実装されていればよい。このように、複数の第2半導体チップ20が実装された第2中継基板22を、第2半導体パッケージ52として用いることができる。
また、図11に示すように複数の第2半導体チップ20の一部が接着剤30を介して第1封止樹脂14の上面に直接実装されていない場合でも、第1封止樹脂14と第2中継基板22との間に設けられた支持材32により、第2半導体チップ20及び第2中継基板22を安定して支持することができる。支持材32は、実施例3のように接着剤30aが支持材32を兼ねる構成としてもよい。
以上、本発明の好ましい実施例について詳述したが、本発明は係る特定の実施例に限定されるものではなく、特許請求の範囲に記載された本発明の要旨の範囲内において、種々の変形・変更が可能である。
図1は従来例に係る半導体装置の断面図である。 図2(a)〜(d)は実施例1に係る半導体装置の製造方法を示した図である。 図3は実施例1に係る半導体装置の断面図である。 図4(a)〜(d)は実施例2に係る半導体装置の製造方法を示した図である。 図5は実施例2に係る半導体装置の断面図である。 図6は実施例2に係る他の半導体装置の断面図である。 図7(a)〜(d)は実施例3に係る半導体装置の製造方法を示した図である。 図8は実施例3に係る半導体装置の断面図である。 図9は実施例3に係る他の半導体装置の断面図である。 図10は実施例4に係る半導体装置の断面図である。 図11は実施例4に係る他の半導体装置の断面図である。
符号の説明
10 第1半導体チップ
12 第1中継基板
14 第1封止樹脂
15 第1ダイ接着剤
18 第1基板電極
19 第1ワイヤ
20 第2半導体チップ
21 アンダーフィル材
22 第2中継基板
23 バンプ電極
27 試験電極
28 第2基板電極
30 接着剤
32 支持材
40 第2封止樹脂
42 第2ワイヤ
44 外部接続端子
50 第1半導体パッケージ
52 第2半導体パッケージ
100 半導体装置

Claims (11)

  1. 第1半導体チップと、
    前記第1半導体チップが上面に実装された第1中継基板と、
    前記第1中継基板の上面に設けられ、前記第1半導体チップを封止する第1封止樹脂と、
    前記第1封止樹脂の上面に実装された第2半導体チップと、
    前記第2半導体チップがフリップチップボンディングにより実装された第2中継基板と、
    前記第1中継基板の上面に設けられ、前記第1封止樹脂、前記第2半導体チップ、及び前記第2中継基板を封止する第2封止樹脂と、
    を具備し、
    前記第2半導体チップは、前記第2中継基板に実装された面と反対側の面を下にして、前記第1封止樹脂の上面に接着剤を介して実装され
    前記第2中継基板には前記第2半導体チップが複数実装され、前記複数の第2半導体チップのうち少なくとも1つが、前記接着剤を介して前記第1封止樹脂の上面に実装されていることを特徴とする半導体装置。
  2. 前記第1封止樹脂及び前記第2中継基板の間の領域に、少なくとも前記第2半導体チップの側面を覆って設けられた支持材を具備することを特徴とする請求項1に記載の半導体装置。
  3. 前記支持材は、前記第1封止樹脂及び前記第2中継基板の間の領域全体に設けられていることを特徴とする請求項2に記載の半導体装置。
  4. 前記接着剤は、前記第1封止樹脂及び前記第2中継基板の間の領域に、少なくとも前記第2半導体チップの側面を覆って設けられていることを特徴とする請求項1に記載の半導体装置。
  5. 前記接着剤は、前記第1封止樹脂及び前記第2中継基板の間の領域全体に設けられていることを特徴とする請求項4に記載の半導体装置。
  6. 前記第2中継基板における、前記第2半導体チップが実装された面に設けられた試験電極を具備することを特徴とする請求項1から5のうちいずれか1項に記載の半導体装置。
  7. 第1中継基板の上面に実装された第1半導体チップを封止する第1封止樹脂の上面に、第2中継基板にフリップチップボンディングにより実装された第2半導体チップを、前記第2中継基板に実装された面と反対側の面を下にして、接着剤を介して実装する工程と、
    前記第1中継基板の上面に、前記第1封止樹脂、前記第2半導体チップ、及び前記第2中継基板を封止する第2封止樹脂を形成する工程と、
    を具備し、
    前記第2半導体チップを前記第1封止樹脂の上面に前記接着剤を介して実装する工程は、前記第2中継基板に実装された複数の前記第2半導体チップのうち少なくとも1つを、前記第2中継基板に実装された面と反対側の面を下にして、前記第1封止樹脂の上面に前記接着剤を介して実装することを特徴とする半導体装置の製造方法。
  8. 前記第2半導体チップを前記第1封止樹脂の上面に前記接着剤を介して実装する工程は、
    前記第1封止樹脂の上面に前記接着剤を供給する工程と、
    前記第2半導体チップを前記接着剤に接触させた後さらに押圧し、前記第1封止樹脂及び前記第2中継基板の間の領域に前記接着剤を充填する工程と、
    を含むことを特徴とする請求項に記載の半導体装置の製造方法。
  9. 前記第1封止樹脂及び前記第2中継基板の間の領域に前記接着剤を充填する工程は、前記接着剤を前記第1封止樹脂及び前記第2中継基板の間の領域全体に充填することを特徴とする請求項に記載の半導体装置の製造方法。
  10. 前記第2半導体チップを前記第1封止樹脂の上面に前記接着剤を介して実装する工程の後、前記第1封止樹脂及び前記第2中継基板の間の領域に、少なくとも前記第2半導体チップの側面を覆って支持材を充填する工程を具備することを特徴とする請求項に記載の半導体装置の製造方法。
  11. 前記第1封止樹脂及び前記第2中継基板の間の領域に前記支持材を充填する工程は、前記支持材を前記第1封止樹脂及び前記第2中継基板の間の領域全体に充填することを特徴とする請求項10に記載の半導体装置の製造方法。
JP2007215190A 2007-08-21 2007-08-21 半導体装置及びその製造方法 Expired - Fee Related JP5301126B2 (ja)

Priority Applications (3)

Application Number Priority Date Filing Date Title
JP2007215190A JP5301126B2 (ja) 2007-08-21 2007-08-21 半導体装置及びその製造方法
US12/196,156 US8749039B2 (en) 2007-08-21 2008-08-21 Semiconductor device having chip mounted on an interposer
US14/271,115 US9312252B2 (en) 2007-08-21 2014-05-06 Method of manufacturing a semiconductor device having a chip mounted on an interposer

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP2007215190A JP5301126B2 (ja) 2007-08-21 2007-08-21 半導体装置及びその製造方法

Publications (2)

Publication Number Publication Date
JP2009049249A JP2009049249A (ja) 2009-03-05
JP5301126B2 true JP5301126B2 (ja) 2013-09-25

Family

ID=40501190

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2007215190A Expired - Fee Related JP5301126B2 (ja) 2007-08-21 2007-08-21 半導体装置及びその製造方法

Country Status (2)

Country Link
US (2) US8749039B2 (ja)
JP (1) JP5301126B2 (ja)

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2005123542A (ja) * 2003-10-20 2005-05-12 Genusion:Kk 半導体装置のパッケージ構造およびパッケージ化方法
US9899794B2 (en) * 2014-06-30 2018-02-20 Texas Instruments Incorporated Optoelectronic package
US9929085B2 (en) 2016-06-02 2018-03-27 Globalfoundries Inc. Integrated circuit structure having deep trench capacitor and through-silicon via and method of forming same
US9892970B2 (en) 2016-06-02 2018-02-13 Globalfoundries Inc. Integrated circuit structure having deep trench capacitor and through-silicon via and method of forming same
US11024616B2 (en) * 2019-05-16 2021-06-01 Taiwan Semiconductor Manufacturing Company, Ltd. Package structure and method of manufacturing the same

Family Cites Families (21)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5786273A (en) 1995-02-15 1998-07-28 Matsushita Electric Industrial Co., Ltd. Semiconductor device and associated fabrication method
JP4075204B2 (ja) * 1999-04-09 2008-04-16 松下電器産業株式会社 積層型半導体装置
KR100334577B1 (ko) 1999-08-06 2002-05-03 윤종용 사진공정의 해상도를 능가하는 트렌치를 절연막내에 형성하는방법
JP2001320014A (ja) * 2000-05-11 2001-11-16 Seiko Epson Corp 半導体装置及びその製造方法
KR100652370B1 (ko) 2000-06-15 2006-11-30 삼성전자주식회사 플로팅 바디효과를 제거한 반도체 메모리소자 및 그제조방법
JP2002093937A (ja) * 2000-09-19 2002-03-29 Matsushita Electric Ind Co Ltd Csp、csp実装テスト方法及びcspソケット構造
JP3463038B2 (ja) 2000-11-14 2003-11-05 Necエレクトロニクス株式会社 半導体装置の製造方法
US20030040152A1 (en) 2001-08-22 2003-02-27 Chen-Chin Liu Method of fabricating a NROM cell to prevent charging
US6940152B2 (en) 2002-02-21 2005-09-06 Matsushita Electric Industrial Co., Ltd. Semiconductor storage device and its manufacturing method
US7057269B2 (en) * 2002-10-08 2006-06-06 Chippac, Inc. Semiconductor multi-package module having inverted land grid array (LGA) package stacked over ball grid array (BGA) package
KR100465632B1 (ko) 2002-12-21 2005-01-13 주식회사 하이닉스반도체 반도체 소자의 비트라인 형성방법
JP4123027B2 (ja) * 2003-03-31 2008-07-23 セイコーエプソン株式会社 半導体装置の製造方法
JP2005209882A (ja) * 2004-01-22 2005-08-04 Renesas Technology Corp 半導体パッケージ及び半導体装置
US7745918B1 (en) * 2004-11-24 2010-06-29 Amkor Technology, Inc. Package in package (PiP)
WO2006106569A1 (ja) * 2005-03-31 2006-10-12 Spansion Llc 積層型半導体装置及びその製造方法
DE102005029804A1 (de) 2005-06-27 2007-01-04 Robert Bosch Gmbh Verfahren zum Abgleichen eines Schichtwiderstandes sowie ein Schichtwiderstand und ein Dehnungsmesselement
JP4871280B2 (ja) * 2005-08-30 2012-02-08 スパンション エルエルシー 半導体装置およびその製造方法
JP4833697B2 (ja) 2005-12-01 2011-12-07 本田技研工業株式会社 コネクティングロッドの製造方法及び装置
JP4435102B2 (ja) 2006-03-13 2010-03-17 株式会社東芝 不揮発性半導体記憶装置の製造方法
TWI317993B (en) * 2006-08-18 2009-12-01 Advanced Semiconductor Eng Stackable semiconductor package
US7901987B2 (en) * 2008-03-19 2011-03-08 Stats Chippac Ltd. Package-on-package system with internal stacking module interposer

Also Published As

Publication number Publication date
US20090206462A1 (en) 2009-08-20
JP2009049249A (ja) 2009-03-05
US9312252B2 (en) 2016-04-12
US20140256088A1 (en) 2014-09-11
US8749039B2 (en) 2014-06-10

Similar Documents

Publication Publication Date Title
JP5529371B2 (ja) 半導体装置及びその製造方法
US6919627B2 (en) Multichip module
US7619305B2 (en) Semiconductor package-on-package (POP) device avoiding crack at solder joints of micro contacts during package stacking
US20070111379A1 (en) Pre-molded leadframe and method therefor
US8133759B2 (en) Leadframe
JP4871280B2 (ja) 半導体装置およびその製造方法
US20070210425A1 (en) Integrated circuit package system
US20100270667A1 (en) Semiconductor package with multiple chips and substrate in metal cap
WO2002103793A1 (fr) Dispositif a semi-conducteurs et procede de fabrication associe
JP2009105334A (ja) 半導体装置及びその製造方法
US20070093000A1 (en) Pre-molded leadframe and method therefor
US20060220208A1 (en) Stacked-type semiconductor device and method of manufacturing the same
JP5301126B2 (ja) 半導体装置及びその製造方法
JP2010010269A (ja) 半導体装置、半導体装置製造用中間体およびそれらの製造方法
JP2010147225A (ja) 半導体装置及びその製造方法
US8018075B2 (en) Semiconductor package, method for enhancing the bond of a bonding wire, and method for manufacturing a semiconductor package
KR20080044518A (ko) 반도체 패키지 및 이의 제조 방법
KR20130030935A (ko) 반도체 장치
KR101332857B1 (ko) 반도체 패키지 및 그 제조 방법
JP2012146882A (ja) 半導体装置
KR20090011564A (ko) 반도체 패키지 제조 방법
KR20080020372A (ko) 듀얼 다이 패키지
CN107978584B (zh) 芯片封装结构及其制造方法
CN115249669A (zh) 双芯片半导体封装及其制备方法
JP2014011396A (ja) 半導体装置の実装構造および半導体装置の実装方法

Legal Events

Date Code Title Description
RD04 Notification of resignation of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7424

Effective date: 20100327

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20100819

RD03 Notification of appointment of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7423

Effective date: 20100819

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20120821

RD03 Notification of appointment of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7423

Effective date: 20120829

A601 Written request for extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A601

Effective date: 20121120

A602 Written permission of extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A602

Effective date: 20121126

A601 Written request for extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A601

Effective date: 20121220

A602 Written permission of extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A602

Effective date: 20121226

A601 Written request for extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A601

Effective date: 20130121

A602 Written permission of extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A602

Effective date: 20130124

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20130221

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20130426

A601 Written request for extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A601

Effective date: 20130524

A602 Written permission of extension of time

Free format text: JAPANESE INTERMEDIATE CODE: A602

Effective date: 20130529

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20130619

R150 Certificate of patent or registration of utility model

Ref document number: 5301126

Country of ref document: JP

Free format text: JAPANESE INTERMEDIATE CODE: R150

Free format text: JAPANESE INTERMEDIATE CODE: R150

S111 Request for change of ownership or part of ownership

Free format text: JAPANESE INTERMEDIATE CODE: R313111

R350 Written notification of registration of transfer

Free format text: JAPANESE INTERMEDIATE CODE: R350

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250

LAPS Cancellation because of no payment of annual fees