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JP2819742B2 - 混成集積回路装置 - Google Patents

混成集積回路装置

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Publication number
JP2819742B2
JP2819742B2 JP5548790A JP5548790A JP2819742B2 JP 2819742 B2 JP2819742 B2 JP 2819742B2 JP 5548790 A JP5548790 A JP 5548790A JP 5548790 A JP5548790 A JP 5548790A JP 2819742 B2 JP2819742 B2 JP 2819742B2
Authority
JP
Japan
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chip
conductor
mounting
electrode
component
Prior art date
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Expired - Lifetime
Application number
JP5548790A
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English (en)
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JPH03256392A (ja
Inventor
勝利 藤田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP5548790A priority Critical patent/JP2819742B2/ja
Publication of JPH03256392A publication Critical patent/JPH03256392A/ja
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  • Structures For Mounting Electric Components On Printed Circuit Boards (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は混成集積回路装置に関し、特にチップ型回路
部品を搭載する混成集積回路装置に関する。
〔従来の技術〕
従来、この種の混成集積回路装置は、第３図に示すよ
うに、チップ型回路部品24の相対向する両側面の電極a2
5,電極b26を、直接、搭載基板21上の導体a22,導体b27と
接触させる方法をとっており、搭載基板21に搭載するチ
ップ型回路部品24の向きにより、占有面積に制限があっ
た。
〔発明が解決しようとする課題〕
上述した従来の混成集積装置は、チップ型回路部品の
搭載の向きに制限がある為、チップ型回路部品の搭載基
板上での占有面積が大きくなり、結果として、混成集積
回路装置の外形サイズが大きくなるという欠点を有す
る。
本発明の目的は、外形サイズの小さい混成集積回路装
置を提供することにある。
〔課題を解決するための手段〕
本発明は、相対向する両側面に電極を有するチップ型
回路部品を搭載する混成集積回路装置において、前記チ
ップ型回路部品を搭載基板上で前記チップ型回路部品の
搭載部の占有面積を最小にする向きで前記搭載基板上に
搭載し、前記搭載基板上の導体と直接接触する事ができ
ない前記チップ型回路部品の一方の電極がワイヤボンデ
ィング法により接続されている。
〔実施例〕
次に、本発明の実施例について図面を参照して説明す
る。
第１図は本発明の第１の実施例の側面図である。
第１の実施例は、第１図に示すように、搭載基板１に
印刷された導体a2の上に、導電性ペースト３を使って、
チップ型回路部品４が搭載され、かつ、電極a5と導体a2
との接続がとられ、電極b6と導体b7は、ワイヤボンディ
ング法により、ワイヤ８によって接続をとられた構造と
なっている。これにより、チップ型部品４は、その搭載
基板１上での占有面積が最小となる向きで、搭載する事
ができる。
例えば、外形サイズが、高さ2.0mm×縦1.25mm×横0.7
mmで、2.0mm方向の相対向する両側面に電極a5,b6がある
チップ型回路部品４の場合、従来の占有面積2.5mm2に対
し、本実施例では、搭載ランドとステッチランドの距離
を0.5mm,ワイヤ径を0.03mmとして、1.6mm2となり従来の
2/3以下にすることができる。
第２図は本発明の第２の実施例の側面図である。
第２の実施例は、第２図に示すように、導体a12と導
体b17の間に、導体a15と導体b17とが絶縁されるべき導
体に接続された他の搭載部品19が存在する場合の例であ
る。
この実施例では、他の搭載部品19の上空でのチップ型
回路部品14と導体b17との接続が可能な為、搭載基板１
の印刷導体のクロス配線を避ける事ができるという利点
がある。
〔発明の効果〕
以上説明したように本発明は、チップ型回路部品と基
板上の印刷導体とをワイヤボンディング法によって接続
することにより、チップ型部品の基板上での占有面積を
最小にする事ができ、結果として、混成集積回路装置の
外形サイズをより小さくする事ができるという効果があ
る。
【図面の簡単な説明】
第１図は本発明の第１の実施例の側面図、第２図は本発
明の第２の実施例の側面図、第３図は従来のチップ型回
路部品を搭載した混成集積回路装置の一例の側面図であ
る。 1,11,21……搭載基板、2,12,22……導体ａ、3,13,23…
…導電性ペースト、4,14,24……チップ型回路部品、5,1
5,25……電極ａ、6,16,26……電極ｂ、7,17,27……導体
ｂ、8,18……ワイヤ、19……他の搭載部品。

Claims (1)

    (57)【特許請求の範囲】
  1. 【請求項１】相対向する両側面に電極を有するチップ型
    回路部品を搭載する混成集積回路装置において、前記チ
    ップ型回路部品を搭載基板上で前記チップ型回路部品の
    搭載部の占有面積を最小にする向きで前記搭載基板上に
    搭載し、前記搭載基板上の導体と直接接触する事ができ
    ない前記チップ型回路部品の一方の電極をワイヤボンデ
    ィング法により接続した事を特徴とする混成集積回路装
    置。
JP5548790A 1990-03-06 1990-03-06 混成集積回路装置 Expired - Lifetime JP2819742B2 (ja)

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JPH03256392A JPH03256392A (ja) 1991-11-15
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