JP2551680B2 - 位置検出装置 - Google Patents
位置検出装置Info
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- JP2551680B2 JP2551680B2 JP2142834A JP14283490A JP2551680B2 JP 2551680 B2 JP2551680 B2 JP 2551680B2 JP 2142834 A JP2142834 A JP 2142834A JP 14283490 A JP14283490 A JP 14283490A JP 2551680 B2 JP2551680 B2 JP 2551680B2
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- Japan
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- synchronization
- value
- resolver
- detecting device
- signal
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- Measurement Of Length, Angles, Or The Like Using Electric Or Magnetic Means (AREA)
- Transmission And Conversion Of Sensor Element Output (AREA)
Description
【発明の詳細な説明】 （産業上の利用分野） 本発明は、位置や角度等の検出のために工作機械等に
用いられる位置検出装置に関する。
用いられる位置検出装置に関する。
（従来の技術） 第５図は、レゾルバを用いて位置検出を行なう従来の
位置検出装置のブロック図である。また、第６図（Ａ）
〜（Ｆ）は、従来の位置検出装置の動作を表わすタイミ
ングチャートである。クロックジェネレータ７は第６図
（Ａ）に示すように励磁タイミング信号及びホールド信
号としての同期信号CLK1を100us周期5us幅で発生し、そ
の同期信号CLK1は励磁回路２及びサンプルホールド回路
３へ送られる。励磁回路２は、同図（Ｂ）に示すよう
に、入力されている同期信号CLK1が“1"レベルの間正の
パルス電圧を発生し、同期信号CLK1が“0"レベルに下が
ったとき正のパルス電圧と同じ面積の負のパルス電圧を
発生し、軸倍角Ｘのレゾルバ１のロータ側のロータ側コ
イルを励磁する。レゾルバ１は、励磁により同図（Ｃ）
及び（Ｄ）に示すようにロータ回転角の正弦値及び余弦
値のそれぞれに比例した２つの回転角信号Sa,Sbを発生
する。サンプルホールド回路３は、同図（Ｅ）及び
（Ｆ）に示すように同期信号CLK1の立ち上がりのタイミ
ングで回転角信号Sa,Sbをホールドし、そのときのホー
ルドレベルSa1,Sb1をA/D（アナログ／デジタル）変換器
４に送る。A/D変換器４は、アナログ信号であるホール
ドレベルSa1,Sb1をその電圧レベルに比例したデジタル
値DA,DBに変換して内挿演算部５へ送る。内挿演算部５
は、デジタル値DA,DBの値に基づいて（１）式に示す演
算を行ない、レゾルバロータ1/X回転以内のアブソリュ
ート位置を０〜255の値で表現して下位データPsとす
る。
位置検出装置のブロック図である。また、第６図（Ａ）
〜（Ｆ）は、従来の位置検出装置の動作を表わすタイミ
ングチャートである。クロックジェネレータ７は第６図
（Ａ）に示すように励磁タイミング信号及びホールド信
号としての同期信号CLK1を100us周期5us幅で発生し、そ
の同期信号CLK1は励磁回路２及びサンプルホールド回路
３へ送られる。励磁回路２は、同図（Ｂ）に示すよう
に、入力されている同期信号CLK1が“1"レベルの間正の
パルス電圧を発生し、同期信号CLK1が“0"レベルに下が
ったとき正のパルス電圧と同じ面積の負のパルス電圧を
発生し、軸倍角Ｘのレゾルバ１のロータ側のロータ側コ
イルを励磁する。レゾルバ１は、励磁により同図（Ｃ）
及び（Ｄ）に示すようにロータ回転角の正弦値及び余弦
値のそれぞれに比例した２つの回転角信号Sa,Sbを発生
する。サンプルホールド回路３は、同図（Ｅ）及び
（Ｆ）に示すように同期信号CLK1の立ち上がりのタイミ
ングで回転角信号Sa,Sbをホールドし、そのときのホー
ルドレベルSa1,Sb1をA/D（アナログ／デジタル）変換器
４に送る。A/D変換器４は、アナログ信号であるホール
ドレベルSa1,Sb1をその電圧レベルに比例したデジタル
値DA,DBに変換して内挿演算部５へ送る。内挿演算部５
は、デジタル値DA,DBの値に基づいて（１）式に示す演
算を行ない、レゾルバロータ1/X回転以内のアブソリュ
ート位置を０〜255の値で表現して下位データPsとす
る。
DA≧０かつDB≧０かつDA≦DBのとき θ＝256×（tan-1（DA/DB）/2π） DA≧０かつDB≧０かつDA＞DBのとき θ＝64−256×（tan-1（DB/DA）/2π） DA≧０かつDB＜０かつDA＞−DBのとき θ＝64＋256×（tan-1（−DB/DA）/2π） DA≧０かつDB＜０かつDA＜−DBのとき θ＝128−256×（tan-1（−DA/DB）/2π） DA＜０かつDB＜０かつ−DA≦−DBのとき θ＝128＋256×（tan-1（DA/DB）/2π） DA＜０かつDB＜０かつ−DA＞−DBのとき θ＝192−256×（tan-1（DB/DA）/2π） DA＜０かつDB≧０かつ−DA≧−DBのとき θ＝192＋256×（tan-1（−DB/DA）/2π） DA＜０かつDB≧０かつ−DA＜DBのとき θ＝256−256×（tan-1（−DA/DB）/2π） 多回転計数部６は、前回のアブソリュート位置，今回
のアブソリュート位置，前回の多回転位置及び今回の多
回転位置をそれぞれPs′,Ps,Cr′及びCrとしたときに
（２）式に示す演算を行ない、今回の多回転位置である
上位データCrを算出する。
のアブソリュート位置，前回の多回転位置及び今回の多
回転位置をそれぞれPs′,Ps,Cr′及びCrとしたときに
（２）式に示す演算を行ない、今回の多回転位置である
上位データCrを算出する。
Ps′−Ps≧128の場合Cr＝Cr′＋１ Ps′−Ps≦−128の場合Cr＝Cr′−１ ……（２） 更に、多回転計数部６は、（３）式に示す演算を行な
うことにより高分解能で多回転にわたる位置データPoを
出力する。
うことにより高分解能で多回転にわたる位置データPoを
出力する。
Po＝256＊Cr＋Ps ……（３） 一方、上述の方法とは別の方法として、上記の多回転
計数部６の代わりにレゾルバ１の回転軸を減速機構によ
って減速させ、軸倍角１の第２のレゾルバの軸に入力す
ることによってレゾルバ１のロータの1/X回転を越える
範囲のアブソリュート位置を検出し、両方のレゾルバの
値を組み合せて高分解能で多回転にわたる位置データを
検出する方法がある。
計数部６の代わりにレゾルバ１の回転軸を減速機構によ
って減速させ、軸倍角１の第２のレゾルバの軸に入力す
ることによってレゾルバ１のロータの1/X回転を越える
範囲のアブソリュート位置を検出し、両方のレゾルバの
値を組み合せて高分解能で多回転にわたる位置データを
検出する方法がある。
（発明が解決しようとする課題） ところが、上述した従来の前者の位置検出装置では、
多回転計数部６は、前回のレゾルバロータの1/X回転以
内のアブソリュート位置に基づいて演算を行なっている
ため、励磁タイミング信号でありホールド信号である同
期信号CLK1の１周期以内にレゾルバ１が1/（2X）回転以
上回転すると誤検出してしまう。ここで、同期信号CLK1
の周期である上位データ検出周期をＴ、レゾルバの軸倍
角をＸとすると、最高応答回転数であるRMAXは（４）式
に示すようになる。
多回転計数部６は、前回のレゾルバロータの1/X回転以
内のアブソリュート位置に基づいて演算を行なっている
ため、励磁タイミング信号でありホールド信号である同
期信号CLK1の１周期以内にレゾルバ１が1/（2X）回転以
上回転すると誤検出してしまう。ここで、同期信号CLK1
の周期である上位データ検出周期をＴ、レゾルバの軸倍
角をＸとすると、最高応答回転数であるRMAXは（４）式
に示すようになる。
この（４）式から導かれるように高分解能化するため
に軸倍角Ｘを大きくすると最高応答回転数RMAXは小さく
なる。また、A/D変換器４の分解能を大きくして高分解
能化すると、A/D変換器４でかかる変換時間が長くなる
ため検出周期Ｔが大きくなり、やはり最高応答回転数R
MAXは小さくなるとともに併せて高価な装置となる。こ
のように、一般の位置検出装置において高分解能化と高
速回転化は相対するものであり両立しないという問題点
があった。また、後者の複数のレゾルバを用いる方法で
は、高速回転には対応できるもののレゾルバを複数用い
ているため、内挿などの処理時間が長くなるのに伴ない
検出周期が長くなり、かつコストが高く、またサイズ及
び消費電力が共に大きくなるという問題点があった。
に軸倍角Ｘを大きくすると最高応答回転数RMAXは小さく
なる。また、A/D変換器４の分解能を大きくして高分解
能化すると、A/D変換器４でかかる変換時間が長くなる
ため検出周期Ｔが大きくなり、やはり最高応答回転数R
MAXは小さくなるとともに併せて高価な装置となる。こ
のように、一般の位置検出装置において高分解能化と高
速回転化は相対するものであり両立しないという問題点
があった。また、後者の複数のレゾルバを用いる方法で
は、高速回転には対応できるもののレゾルバを複数用い
ているため、内挿などの処理時間が長くなるのに伴ない
検出周期が長くなり、かつコストが高く、またサイズ及
び消費電力が共に大きくなるという問題点があった。
本発明は上述のような事情から成されたものであり、
本発明の目的は、レゾルバにパルス状の励磁波形を加え
る位置検出装置において、高分解能でありながら位置検
出周期は従来のままを保ちつつ高速回転にも対応可能な
安価かつ小型でしかも低消費電力の位置検出装置を提供
することにある。
本発明の目的は、レゾルバにパルス状の励磁波形を加え
る位置検出装置において、高分解能でありながら位置検
出周期は従来のままを保ちつつ高速回転にも対応可能な
安価かつ小型でしかも低消費電力の位置検出装置を提供
することにある。
（課題を解決するための手段） 本発明は、位置や角度等の検出のために工作機械等に
用いられている位置検出装置に関するものであり、本発
明の上記目的は、レゾルバにパルス状の励磁信号を加え
ることにより位置検出を行なう位置検出装置において、
前記励磁信号に同期した同期信号を発生する同期信号発
生手段と、前記同期信号に同期させて記憶した前記レゾ
ルバの出力の２値化した値に基づいて位置情報の演算を
行なう第１演算手段とを具備することによって達成され
る。また、レゾルバにパルス状の励磁信号を加えること
により位置検出を行なう位置検出装置において、第１同
期信号及び第２同期信号を発生する同期信号発生手段
と、前記第１同期信号に同期させて記憶した前記レゾル
バの出力の２値化した値に基づいて位置情報の演算を行
なう第１演算手段と、前記第２同期信号に同期させてサ
ンプルホールドした前記レゾルバの２つの出力値に基づ
いて位置情報の演算を行なう第２演算手段と、前記第１
演算手段及び前記第２演算手段により求められたそれぞ
れの位置情報の桁合せを行ない位置検出値を求める桁合
せ演算手段とを具備することによって達成される。
用いられている位置検出装置に関するものであり、本発
明の上記目的は、レゾルバにパルス状の励磁信号を加え
ることにより位置検出を行なう位置検出装置において、
前記励磁信号に同期した同期信号を発生する同期信号発
生手段と、前記同期信号に同期させて記憶した前記レゾ
ルバの出力の２値化した値に基づいて位置情報の演算を
行なう第１演算手段とを具備することによって達成され
る。また、レゾルバにパルス状の励磁信号を加えること
により位置検出を行なう位置検出装置において、第１同
期信号及び第２同期信号を発生する同期信号発生手段
と、前記第１同期信号に同期させて記憶した前記レゾル
バの出力の２値化した値に基づいて位置情報の演算を行
なう第１演算手段と、前記第２同期信号に同期させてサ
ンプルホールドした前記レゾルバの２つの出力値に基づ
いて位置情報の演算を行なう第２演算手段と、前記第１
演算手段及び前記第２演算手段により求められたそれぞ
れの位置情報の桁合せを行ない位置検出値を求める桁合
せ演算手段とを具備することによって達成される。
（作用） 本発明にあっては、レゾルバの励磁信号とレゾルバの
２つの出力を２値化した値を記憶するタイミングとを同
期させ、記憶した値に基づいて計数条件を決定しその条
件に基づいて計数して上位データとしているので従来の
サンプルホールド手段やA/D（アナログ／デジタル）変
換手段や内挿手段による制限よりも短い周期で上位デー
タが検出できるので、より高速回転に対応できる。ま
た、レゾルバの励磁信号とレゾルバの２つの出力をサン
プルホールドするタイミングとを同期させ、サンプルホ
ールド手段の出力をA/D変換して内挿することにより下
位データを作り、その下位データと上位データを桁合せ
しているので、低速から高速まで高分解能で多回転にわ
たる位置検出が可能となる。さらに、計数手段に入力さ
れるアップまたはダウンのパルス間の第１同期信号の数
を計数し、その計数値によって同期信号の周期を変化さ
せており、またレゾルバの励磁時間がレゾルバの周波数
応答によって規定される最小の時間であるので、不必要
なレゾルバへの励磁が省かれて消費電力が小さくでき
る。
２つの出力を２値化した値を記憶するタイミングとを同
期させ、記憶した値に基づいて計数条件を決定しその条
件に基づいて計数して上位データとしているので従来の
サンプルホールド手段やA/D（アナログ／デジタル）変
換手段や内挿手段による制限よりも短い周期で上位デー
タが検出できるので、より高速回転に対応できる。ま
た、レゾルバの励磁信号とレゾルバの２つの出力をサン
プルホールドするタイミングとを同期させ、サンプルホ
ールド手段の出力をA/D変換して内挿することにより下
位データを作り、その下位データと上位データを桁合せ
しているので、低速から高速まで高分解能で多回転にわ
たる位置検出が可能となる。さらに、計数手段に入力さ
れるアップまたはダウンのパルス間の第１同期信号の数
を計数し、その計数値によって同期信号の周期を変化さ
せており、またレゾルバの励磁時間がレゾルバの周波数
応答によって規定される最小の時間であるので、不必要
なレゾルバへの励磁が省かれて消費電力が小さくでき
る。
（実施例） 以下、図面に基づいて本発明の実施例について詳細に
説明する。
説明する。
第１図は本発明の位置検出装置の一実施例のブロック
図である。また、第２図（Ａ）〜（Ｍ）及び第３図
（Ａ）〜（Ｌ）は、それぞれ高速回転時及び低速回転時
のタイミングチャートである。第１図において、サンプ
ルホールド回路3,A/D変換器４及び内挿演算部５は、従
来と構成が同一であるので説明を省略する。そこで、先
ずクロックジェネレータ17は、第２図（Ａ）及び（Ｂ）
に示すような第１同期信号CLK0と第２同期信号CLK0′を
発生させる。発生させる信号のオン時間はレゾルバ１の
周波数応答によって規定される最小の一定時間であり、
発振周期算出回路15の指令に基づいて周期が変化する。
クロックジェネレータ17から出力された第１の同期信号
CLK0は励磁回路2,第１記憶回路10及び第２記憶回路11に
入力され、一定周期の第２同期信号CLK0′はサンプルホ
ールド回路３及び第３記憶回路16に入力される。レゾル
バ１から出力される２つの回転角信号Sa,Sbはそれぞれ
コンパレータ８及びコンパレータ９により零検出され、
第２図（Ｆ）及び（Ｇ）に示すようなパルス信号SA,SB
として得られる。第１記憶回路10は、第１同期信号CLK0
のタイミングでパルス信号SA,SBを記憶すると共に同図
（Ｈ）及び（Ｉ）に示すようなパルス信号SA1,SB1とし
て第２記憶回路11及びデコーダ12に対して出力する。第
２記憶回路11は、第１同期信号CLK0のタイミングで第１
記憶回路10の値すなわち前回のパルス信号SA1,SB1を記
憶すると共に同図（Ｊ）及び（Ｋ）に示すようなパルス
信号SA2,SB2としてデコーダ12に対して出力する。デコ
ーダ12は第４図に示すような４つのインバータ1211,121
2,1213,1214,2つのナンド回路1221,1222,2つのアンド回
路1231,1232及び１つのノア回路124で構成される論理回
路で成り、第１記憶回路10及び第２記憶回路11から入力
されるパルス信号SA1,SB1,SA2,SB2の値に基づいて論理
演算を行ない、第２図（Ｌ）及び（Ｍ）に示すようなカ
ウントアップパルスSU及びカウントダウンパルスSD並び
に４倍カウントの第１ビットPa及び第２ビットPbを出力
する。アップ／ダウンカウンタ13は、デコーダ12から入
力されるカウントアップパルスSU及びカウントダウンパ
ルスSDに基づいて計数を行ない計数値Csとして出力す
る。第３記憶回路16は、第２同期信号CLK0′からデコー
ダ12のデコード時間だけ遅れたタイミングで第１ビット
Pa,第２ビットPb及び計数値Csを記憶すると共に記憶値
をそれぞれPa′,Pb′,Cs′として桁合せ演算回路14に対
して出力する。桁合せ演算回路14は、内挿演算部５より
入力されるレゾルバロータの1/X回転以内の２進化した
アブソリュート位置の最上位ビットPmと第３記憶回路16
より入力されるサンプルホールド回路３のホールドタイ
ミングと同期した４倍カウントの第１ビットPa′及び第
２ビットPb′を利用して上位データCs′の増減の変わり
目での修正値を（５）式に基づいて求める。
図である。また、第２図（Ａ）〜（Ｍ）及び第３図
（Ａ）〜（Ｌ）は、それぞれ高速回転時及び低速回転時
のタイミングチャートである。第１図において、サンプ
ルホールド回路3,A/D変換器４及び内挿演算部５は、従
来と構成が同一であるので説明を省略する。そこで、先
ずクロックジェネレータ17は、第２図（Ａ）及び（Ｂ）
に示すような第１同期信号CLK0と第２同期信号CLK0′を
発生させる。発生させる信号のオン時間はレゾルバ１の
周波数応答によって規定される最小の一定時間であり、
発振周期算出回路15の指令に基づいて周期が変化する。
クロックジェネレータ17から出力された第１の同期信号
CLK0は励磁回路2,第１記憶回路10及び第２記憶回路11に
入力され、一定周期の第２同期信号CLK0′はサンプルホ
ールド回路３及び第３記憶回路16に入力される。レゾル
バ１から出力される２つの回転角信号Sa,Sbはそれぞれ
コンパレータ８及びコンパレータ９により零検出され、
第２図（Ｆ）及び（Ｇ）に示すようなパルス信号SA,SB
として得られる。第１記憶回路10は、第１同期信号CLK0
のタイミングでパルス信号SA,SBを記憶すると共に同図
（Ｈ）及び（Ｉ）に示すようなパルス信号SA1,SB1とし
て第２記憶回路11及びデコーダ12に対して出力する。第
２記憶回路11は、第１同期信号CLK0のタイミングで第１
記憶回路10の値すなわち前回のパルス信号SA1,SB1を記
憶すると共に同図（Ｊ）及び（Ｋ）に示すようなパルス
信号SA2,SB2としてデコーダ12に対して出力する。デコ
ーダ12は第４図に示すような４つのインバータ1211,121
2,1213,1214,2つのナンド回路1221,1222,2つのアンド回
路1231,1232及び１つのノア回路124で構成される論理回
路で成り、第１記憶回路10及び第２記憶回路11から入力
されるパルス信号SA1,SB1,SA2,SB2の値に基づいて論理
演算を行ない、第２図（Ｌ）及び（Ｍ）に示すようなカ
ウントアップパルスSU及びカウントダウンパルスSD並び
に４倍カウントの第１ビットPa及び第２ビットPbを出力
する。アップ／ダウンカウンタ13は、デコーダ12から入
力されるカウントアップパルスSU及びカウントダウンパ
ルスSDに基づいて計数を行ない計数値Csとして出力す
る。第３記憶回路16は、第２同期信号CLK0′からデコー
ダ12のデコード時間だけ遅れたタイミングで第１ビット
Pa,第２ビットPb及び計数値Csを記憶すると共に記憶値
をそれぞれPa′,Pb′,Cs′として桁合せ演算回路14に対
して出力する。桁合せ演算回路14は、内挿演算部５より
入力されるレゾルバロータの1/X回転以内の２進化した
アブソリュート位置の最上位ビットPmと第３記憶回路16
より入力されるサンプルホールド回路３のホールドタイ
ミングと同期した４倍カウントの第１ビットPa′及び第
２ビットPb′を利用して上位データCs′の増減の変わり
目での修正値を（５）式に基づいて求める。
（▲▼′はPaを反転した値） 更に、桁合せ演算回路14は、（５）に基づいて求めた
Cs″と内挿演算部５の出力Psとを合せることにより位置
データPoを演算して出力する。尚、Pa′,Pb′を上位デ
ータCs′の下位ビットに使用することにより内挿演算を
行なうことなくレゾルバロータの1/X回転の1/4の分解能
で広範囲な位置データを得ることもできる。発振周期算
出回路15は、デコーダ12から入力されるカウントアップ
パルスSU又はカウントダウンパルスSDのパルス間の第１
同期信号CLK0を計算し、回転軸の回転数に応じて第１の
同期信号CLK0の発振周期を算出してクロックジェネレー
タ17に指令する。クロックジェネレータ17における第１
同期信号CLK0は、下位データを検出可能な最小周期100
μＳと上位データを検出可能な最小周期10μＳの２つの
周期で発振可能であり、第２周忌信号CLK0′は100μＳ
で固定周期である。
Cs″と内挿演算部５の出力Psとを合せることにより位置
データPoを演算して出力する。尚、Pa′,Pb′を上位デ
ータCs′の下位ビットに使用することにより内挿演算を
行なうことなくレゾルバロータの1/X回転の1/4の分解能
で広範囲な位置データを得ることもできる。発振周期算
出回路15は、デコーダ12から入力されるカウントアップ
パルスSU又はカウントダウンパルスSDのパルス間の第１
同期信号CLK0を計算し、回転軸の回転数に応じて第１の
同期信号CLK0の発振周期を算出してクロックジェネレー
タ17に指令する。クロックジェネレータ17における第１
同期信号CLK0は、下位データを検出可能な最小周期100
μＳと上位データを検出可能な最小周期10μＳの２つの
周期で発振可能であり、第２周忌信号CLK0′は100μＳ
で固定周期である。
第３図は、第１周期信号CLK0の周期が100μＳである
低速時のタイミングチャートであり、上述した上位デー
タの場合と同様の処理手順により、下位データを算出す
ることが可能である。
低速時のタイミングチャートであり、上述した上位デー
タの場合と同様の処理手順により、下位データを算出す
ることが可能である。
（発明の効果） 以上のように本発明の位置検出装置によれば、軸倍角
Ｘのレゾルバを用いた場合、上位データがレゾルバロー
タの1/X回転に４回の励磁パルスが必要なことより、第
１同期信号CLK0の周期である上位データ検出周期をＴ′
とすると最高回転数Ｒ′MAXは（６）式で表され、従来
の最高応答回転数RMAXと比較すると、従来の上位データ
検出周期ＴはA/D変換と内挿などにかかる時間のため100
μＳ程度であるのに対して、本発明の周期Ｔ′は10μＳ
であるので（４）式と（６）式より本発明の最高応答回
転数は５倍程度速くなる。
Ｘのレゾルバを用いた場合、上位データがレゾルバロー
タの1/X回転に４回の励磁パルスが必要なことより、第
１同期信号CLK0の周期である上位データ検出周期をＴ′
とすると最高回転数Ｒ′MAXは（６）式で表され、従来
の最高応答回転数RMAXと比較すると、従来の上位データ
検出周期ＴはA/D変換と内挿などにかかる時間のため100
μＳ程度であるのに対して、本発明の周期Ｔ′は10μＳ
であるので（４）式と（６）式より本発明の最高応答回
転数は５倍程度速くなる。
また、１つのレゾルバのみで低速から高速まで高分解
能で多回転にわたり位置検出が可能となる。更に、レゾ
ルバへの励磁部分を１つとし、低速時は励磁回数を減ら
すと共に検出に必要な時間のみ励磁することで低消費電
力化が可能となる。また、１つのレゾルバと数個の電子
回路のみで構成されるので安価で小型になる。
能で多回転にわたり位置検出が可能となる。更に、レゾ
ルバへの励磁部分を１つとし、低速時は励磁回数を減ら
すと共に検出に必要な時間のみ励磁することで低消費電
力化が可能となる。また、１つのレゾルバと数個の電子
回路のみで構成されるので安価で小型になる。
第１図は本発明の位置検出装置における一実施例のブロ
ック図、第２図は高速時のタイミングチャート、第３図
は低速時のタイミングチャート、第４図はデコーダ12の
内部論理回路、第５図は従来の位置検出装置の構成を示
すブロック図、第６図は従来の位置検出装置におけるタ
イムチャートである。 １……レゾルバ、２……励磁回路、３……サンプルホー
ルド回路、４……A/D変換器、５……内挿演算部、６…
…多回転計数部、7,17……クロックジェネレータ、8,9
……コンパレータ、10,11,16……記憶回路、12……デコ
ーダ、13……アップ／ダウンカウンタ、14……桁合せ演
算回路、15……発振周期算出回路。
ック図、第２図は高速時のタイミングチャート、第３図
は低速時のタイミングチャート、第４図はデコーダ12の
内部論理回路、第５図は従来の位置検出装置の構成を示
すブロック図、第６図は従来の位置検出装置におけるタ
イムチャートである。 １……レゾルバ、２……励磁回路、３……サンプルホー
ルド回路、４……A/D変換器、５……内挿演算部、６…
…多回転計数部、7,17……クロックジェネレータ、8,9
……コンパレータ、10,11,16……記憶回路、12……デコ
ーダ、13……アップ／ダウンカウンタ、14……桁合せ演
算回路、15……発振周期算出回路。
Claims (7)
- 【請求項１】レゾルバにパルス状の励磁信号を加えるこ
とにより位置検出を行なう位置検出装置において、前記
励磁信号に同期した第１同期信号及び第２同期信号を発
生する同期信号発生手段と、前記第１同期信号に同期さ
せて記憶した前記レゾルバの出力の２値化した値に基づ
いて位置情報の演算を行なう第１演算手段とを具備した
ことを特徴とする位置検出装置。 - 【請求項２】前記第１演算手段は、前期レゾルバから出
力されたロータ回転角の正弦値及び余弦値のそれぞれに
比例した２つの出力値を２値化するコンパレータと、前
期同期信号に同期して前記コンパレータの出力値を記憶
する第１記憶手段と、前記同期信号に同期して前記第１
記憶手段の記憶値を記憶する第２記憶手段と、前期第１
記憶手段及び第２記憶手段に記憶されたそれぞれの記憶
値のパターンに基づいてアップ又はダウンカウントする
計数手段とで構成される請求項１に記載の位置検出装
置。 - 【請求項３】前記同期信号発生手段は、前記レゾルバの
運動速度に応答して前記同期信号を発生するようにした
請求項１に記載の位置検出装置。 - 【請求項４】レゾルバにパルス状の励磁信号を加えるこ
とにより位置検出を行なう位置検出装置において、前記
励磁信号に同期した第１同期信号及び第２同期信号を発
生する同期信号発生手段と、前記第１同期信号に同期さ
せて記憶した前記レゾルバの出力の２値化した値に基づ
いて位置情報の演算を行なう第１演算手段と、前記第２
同期信号に同期させてサンプルホールドした前記レゾル
バの２つの出力値に基づいて位置情報の演算を行なう第
２演算手段と、前記第１演算手段及び前記第２演算手段
により求められたそれぞれの位置情報の桁合せを行ない
位置検出値を求める桁合せ演算手段とを具備したことを
特徴とする位置検出装置。 - 【請求項５】前記第１演算手段は、前期レゾルバから出
力されたロータ回転角の正弦値及び余弦値のそれぞれに
比例した２つの出力値を２値化するコンパレータと、前
期第１同期信号に同期して前記コンパレータの出力値を
記憶する第１記憶手段と、前記第１同期信号に同期して
前記第１記憶手段の記憶値を記憶する第２記憶手段と、
前期第１記憶手段及び第２記憶手段に記憶されたそれぞ
れの記憶値のパターンに基づいてアップ又はダウンカウ
ントする計数手段とで構成される請求項４に記載の位置
検出装置。 - 【請求項６】前記第２演算手段は、前記サンプルホール
ドを行なうサンプルホールド手段と、前記サンプルホー
ルド手段によりホールドされたアナログ値をデジタル値
に変換する変換手段と、前記変換手段からの２つの出力
値に基づいて前期レゾルバの回転位置情報を求める内挿
手段とで構成される請求項４に記載の位置検出装置。 - 【請求項７】前記同期信号発生手段は、前記レゾルバの
運動速度に応答して前記第１同期信号を発生するように
した請求項４に記載の位置検出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2142834A JP2551680B2 (ja) | 1990-05-31 | 1990-05-31 | 位置検出装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2142834A JP2551680B2 (ja) | 1990-05-31 | 1990-05-31 | 位置検出装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0436614A JPH0436614A (ja) | 1992-02-06 |
| JP2551680B2 true JP2551680B2 (ja) | 1996-11-06 |
Family
ID=15324699
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2142834A Expired - Fee Related JP2551680B2 (ja) | 1990-05-31 | 1990-05-31 | 位置検出装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2551680B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE19937737C2 (de) * | 1999-08-10 | 2003-10-30 | Pilz Gmbh & Co | Vorrichtung zum sicheren Überwachen der Drehbewegung einer Welle |
| US8872511B2 (en) | 2009-07-24 | 2014-10-28 | Toyota Jidosha Kabushiki Kaisha | Angle of rotation detection device |
-
1990
- 1990-05-31 JP JP2142834A patent/JP2551680B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0436614A (ja) | 1992-02-06 |
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