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JP2020527865A - 高温熱処理に適した磁気トンネル接合 - Google Patents

高温熱処理に適した磁気トンネル接合 Download PDF

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Abstract

本書に記載の実施形態は、バッファ層と、バッファ層の上に配置されたシード層と、シード層の上に配置された第1のピンニング層と、第1のピンニング層の上に配置された合成フェリ磁性体(SyF)結合層と、SyF結合層の上に配置された第2のピンニング層と、第2のピンニング層の上に配置された構造ブロック層と、構造ブロック層の上に配置された磁気基準層と、磁気基準層の上に配置されたトンネルバリア層と、トンネルバリア層の上に配置された磁気ストレージ層と、磁気ストレージ層の上に配置された一又は複数の層を含むキャッピング層と、キャッピング層の上に配置されたハードマスクと、を含み、キャッピング層、バッファ層、及びSyF結合層のうちの少なくとも1つはRuから作られていない、基板の上に磁気トンネル接合(MTJ)構造を形成するために利用される膜スタックを提供する。【選択図】図1

Description

[0001] 本開示の実施形態は、スピン注入磁気ランダムアクセスメモリ(STT−MRAM)アプリケーションで用いられる構造の製造方法に関する。より具体的には、本開示の実施形態は、MRAMアプリケーションのための磁気トンネル接合構造の製造方法に関する。
[0002] 磁気ランダムアクセスメモリ(MRAM)は、電子電荷の代わりに抵抗値を用いてデータを記憶するMRAMセルのアレイを含むタイプのメモリデバイスである。概して、各MRAMセルは磁気トンネル接合(MTJ)構造を含む。MTJ構造は一般的に、2つの強磁性層が薄い非磁性誘電体(例えば、絶縁トンネリング層)によって分離されている構成を有する磁性層のスタック(積層体)を含む。最上部電極と底部電極は、電流が最上部電極と底部電極との間を流れうるように、MTJ構造を挟み込むために利用される。
[0003] MRAMセルのうちの1タイプは、スピン注入磁気ランダムアクセスメモリ(STT−MRAM)である。このような製造処理フローでは、高いトンネル磁気抵抗(TMR)比を生成しつつ、高温バックエンド熱処理を維持するため、安定した磁気トンネル接合(MTJ)スタックが必要となる。MTJスタックは、その後の層の接着とシーディング(seeding)を改善するため、バッファ層から始まることが多い。MTJスタックはまた、第1のピンニング層(pinning layer)と第2のピンニング層を逆平行に連結するため、合成フェリ磁性体(SyF)結合層を含む。キャッピング層は、ハードマスクエッチングの際に、スタックを腐食から保護し、エッチング停止層として機能する貴金属材料で終わるMTJスタックの上部で利用される。
[0004] 従来のSTT−MRAMデバイスの製造中には、強磁性層並びにデバイス構造に挟まれた絶縁体材料の結晶化を支援するため、多くの場合、膜層堆積処理の直後に熱アニーリング処理が行われる。アニーリング処理中の熱エネルギーが十分でない、或いは温度制御が正確でない場合には、膜結合の構造又は特性が望ましくない状態で形成されることがある。例えば、アニーリング処理中に、温度制御が不正確であったり、熱拡散が望ましくないほど変動すると、膜層の結晶化が不十分になり、意図した性能を満たすことができないデバイスの不具合を引き起こす。
[0005] 従来の方法は、その後の層の接着及びシーディングを目的として、Ta(タンタル)及び/又はRu(ルテニウム)ベースのバッファ層を使用する。しかしながら、バッファ層は容易に分離される。底部接触部のテクスチャ(texture)は、バッファを介してMTJ膜スタックのテクスチャに影響を及ぼす傾向があり、スタックのTMR比及び磁気特性に有害となる。すなわち、テクスチャの粗さが基板/底部の接触層からMTJ膜スタックの他の層まで運ばれる。Ruはまた、SyF結合層及びキャッピング層を製造する従来の方法でも使用される。しかしながら、Ruは、酸素イオンと結合するため、MgOベースのトンネルバリア層に向って拡散する傾向がある。このような有害な拡散は、膜スタックのTMR比を低下させる。この影響は、高い温度での熱処理中に深刻になる。
[0006] したがって、当該技術では、STT−MRAMアプリケーションのMTJ構造を大量生産で製造するための方法及び装置の改良が必要となる。高いTMR比と、高いSyF結合、ピンド層(pinned layer)及び基準層の高い垂直磁気異方性、及びフリー層の制御可能な垂直磁気異方性などの磁気特性を確保しつつ、高温熱処理を維持できる、MTJスタックの改良も必要となる。
[0007] 本開示の実施形態は、MRAMアプリケーションで、特にスピン注入磁気ランダムアクセスメモリ(STT−MRAM)アプリケーションで、基板上に磁気トンネル接合(MTJ)構造を製造するための方法を提供する。いくつかの実施形態は、MTJ構造のための膜スタックの組成を提供する。
[0008] 一実施形態では、基板上に磁気トンネル接合(MTJ)構造を形成するために利用される膜スタックが提供される。膜スタックは、バッファ層と、バッファ層の上に配置されたシード層と、シード層の上に配置された第1のピンニング層と、第1のピンニング層の上に配置された合成フェリ磁性体(SyF)結合層と、SyF結合層の上に配置された第2のピンニング層と、第2のピンニング層の上に配置された構造ブロック層と、構造ブロック層の上に配置された磁気基準層と、磁気基準層の上に配置されたトンネルバリア層と、トンネルバリア層の上に配置された磁気ストレージ層と、磁気ストレージ層の上に配置された、一又は複数の層を含むキャッピング層と、キャッピング層の上に配置されたハードマスクと、を含み、キャッピング層、バッファ層、及びSyF結合層のうちの少なくとも1つはRuから作られていない。
[0009] 別の実施形態では、基板上に磁気トンネル接合(MTJ)構造を形成するために利用される膜スタックが提供される。膜スタックは、CoFeB含有層を含むバッファ層と、バッファ層の上に配置されたシード層と、シード層の上に配置された第1のピンニング層と、第1のピンニング層の上に配置された、Ir含有層を含む合成フェリ磁性体(SyF)結合層と、SyF結合層の上に配置された第2のピンニング層と、第2のピンニング層の上に配置された構造ブロック層と、構造ブロック層の上に配置された磁気基準層と、磁気基準層の上に配置されたトンネルバリア層と、トンネルバリア層の上に配置された磁気ストレージ層と、磁気ストレージ層の上に配置された、一又は複数の層を含むキャッピング層と、キャッピング層の上に配置されたハードマスクと、を含み、キャッピング層、バッファ層、及びSyF結合層のうちの少なくとも1つはRuから作られていない。
[0010] 別の実施形態では、基板上に磁気トンネル接合(MTJ)構造を形成するために利用される膜スタックが提供される。膜スタックはバッファ層を含み、バッファ層は、ホウ素の重量%が約20%を超えるCoFeB含有層と、バッファ層の上に配置されたシード層と、シード層の上に配置された第1のピンニング層と、第1のピンニング層の上に配置されたIr含有層を含む合成フェリ磁性体(SyF)結合層と、SyF結合層の上に配置された第2のピンニング層と、第2のピンニング層の上に配置された構造ブロック層と、構造ブロック層の上に配置された磁気基準層と、磁気基準層の上に配置されたトンネルバリア層と、トンネルバリア層の上に配置された磁気ストレージ層と、磁気ストレージ層の上に配置された、一又は複数の層を含み、キャッピング層の最上層がIr含有層であるキャッピング層と、キャッピング層の上に配置されたハードマスクと、を含み、キャッピング層、バッファ層、及びSyF結合層のうちの少なくとも1つはRuから作られていない。
[0011] 上述の本開示の特徴を詳しく理解しうるように、上記で簡単に要約した本開示のより詳細な説明が、実施形態を参照することによって得られ、一部の実施形態は付随する図面に示されている。しかしながら、添付図面は例示的な実施形態を示しているにすぎず、従って、本開示の範囲を限定すると見なすべきではなく、その他の等しく有効な実施形態も許容されうることに留意されたい。
いくつかの実施形態による、磁気トンネル接合(MTJ)構造の製造方法を示す図である。 いくつかの実施形態による、膜スタックの一部の概略図を示す。 いくつかの実施形態による、膜スタックの一部の概略図を示す。 いくつかの実施形態による、膜スタックの一部の概略図を示す。 いくつかの実施形態による、キャッピング層の概略図を示す。 いくつかの実施形態による、キャッピング層の概略図を示す。 いくつかの実施形態による、キャッピング層の概略図を示す。 いくつかの実施形態による、キャッピング層の概略図を示す。
[0020] 理解を容易にするために、可能な場合には、複数の図に共通する同一の要素を指し示すのに、同一の参照番号を使用した。一実施形態の要素及び特徴は、さらなる記述がなくとも、他の実施形態に有益に組み込まれうると、想定される。しかしながら、添付の図面は本開示の典型的な実施形態のみを示すものであり、したがって、本開示の範囲を限定するものと見なすべきではなく、本開示は他の等しく有効な実施形態も許容しうることに留意されたい。
[0021] 本開示の実施形態は、一般的に、MRAMアプリケーション用の基板上に配置された膜スタックからMTJ構造を形成するための装置及び方法を提供する。装置及び方法は、膜スタックでの材料層のパターニング後に実施される熱処理によって、所望の結晶度を有する膜スタックから材料層の膜特性を形成することを含む。パターニング中、側壁安定化処理層は、膜スタックの側壁に沿って形成されうる。したがって、パターニング処理及び側壁安定化堆積処理後の熱処理を実施することによって、熱処理によって供給される熱エネルギーは、膜スタックに形成された隣接する材料層に対して垂直ではなく、側壁安定化処理層に向って横方向外向きに、ドーパントを材料層の中へ効率的に拡散しうる。こうすることによって、隣接する材料から潜在的に交差拡散しうるドーパントによる損傷や干渉をうけることなく、膜スタック内の材料層の制御可能な結晶化度を得ることができる。所望の結晶化度でパターニングされアニールされた膜スタックは、MRAMアプリケーションに望ましい寸法と特徴を有するMTJ構造を形成するのに使用されうる。
[0022] 図1は、本開示の一実施形態によるMRAMアプリケーション用に基板上にMTJ構造を作るための処理100のフロー図を示している。いくつかの実施形態では、処理100は処理フローを、操作101〜106は個別の処理を表わしている。処理100は、プラズマ処理チャンバ及び熱処理チャンバ、或いは他の好適なプラズマ浸漬イオン注入システム、又は他の製造業者のものを含むエッチングチャンバで実行されるように構成されている。処理100はまた、PVDチャンバ、CVDチャンバ、リソグラフィツールなどの他のツールも使用しうる。
[0023] 処理100は、膜スタックが上部に配置された基板を提供することにより、操作101から始まる。いくつかの実施形態では、基板は、金属又はガラス、シリコン、誘電体バルク材料及び金属合金、又は複合ガラス、結晶シリコン(例えばSi<100>又はSi<111>)、酸化ケイ素、歪みシリコン、シリコンゲルマニウム、ゲルマニウム、ドープされた又はドープされていないポリシリコン、ドープされた又はドープされていないシリコンウエハ、パターン形成された又はパターン形成されていないウエハシリコンオンインシュレータ(SOI)、炭素がドープされた酸化ケイ素、窒化ケイ素、ドープされたシリコン、ゲルマニウム、ヒ化ガリウム、ガラス、サファイアなどの材料を含む。基板は、様々な寸法(例えば約200mm、約300mm、約450mm、又はその他の直径)を有してよく、また、長方形又は正方形のパネルであることもある。別途明記されない限り、本書に記載の実施例は、直径200mm、直径300mm、又は直径450mmの基板上で実行される。一実施形態では、基板は、基板上に配置された膜スタックを含む。
[0024] ピンド磁気層、オプションの構造分離層、トンネルバリア層、磁気ストレージ層、磁気基準層、及びキャッピング層は、PVDプロセスなどの任意の好適な技術及び任意の好適な方法によって形成されうることに留意されたい。これらの層を形成するために用いられうるシステムの一例としては、Applied Materials Inc.(カリフォルニア州サンタクララ)から入手可能なEndura(登録商標)PVDシステムがある。他の製造業者から入手可能なものを含む他の処理システムも本開示を実践するよう適合しうると、想定される。
[0025] 操作102でMTJスタック堆積を実行する前に、トランジスタ又は相互接続層を形成する他の処理が存在しうることが、当業者には知られている。操作106でパターニング後のアニールを実施した後、残りの相互接続層と接触パッドを完成させるための操作など、追加の操作が実行されうる。
[0026] 操作102〜104では、MTJスタック堆積、パターニング前のアニール、及びMTJパターニングが実行される。これらの操作には、下位の基板が露出するまで、エッチングマスク層(図示せず)によって、基板から露出され画定される膜スタックの一部を除去するように実施されるパターニング処理(例えば、エッチング処理)が含まれる。膜スタックをパターニングするためのパターニング処理には、各層に含まれる材料に従って、様々な層をエッチングするため、様々な混合ガス又はエッチャントを供給するように構成されたいくつかのステップ、或いは様々な方法が含まれる。パターニング中、エッチング混合ガス、或いは様々なエッチング核種を含むいくつかの混合ガスは、基板から膜スタックの一部を除去するため、基板表面に連続的に供給される。操作104でのパターニング処理の終点は、時間又は他の適切な方法によって制御されうる。例えば、パターニング処理は、基板が露出するまで、約200秒間ないし約10分間実行された後に終了となりうる。連続的なパターニング処理は、終点検出器(例えば、OES検出器又は必要に応じた他の好適な検出器)からの判定によって、終了されてもよい。
[0027] 操作104でのパターニング処理中に膜スタックが除去された基板の一部の上に、カプセル封止及び絶縁層を形成するため、さらなる堆積処理が実施されうる。カプセル封止は、良好なステップカバレッジと気密を可能にするもので、多くの場合、窒化ケイ素ベースの材料からなる。絶縁は多くの場合、酸化物ベースの材料からなり、典型的には、カプセル封止よりもかなり厚い。絶縁層は、絶縁層内に相互接続構造を形成するための一連のエッチング及び堆積処理(例えば、バックエンド処理)後に、デバイス構造製造処理を完了しうる、任意の好適な絶縁材料であってよい。一実施例では、絶縁層は酸化ケイ素層又は他の好適な材料である。
[0028] 操作106では、熱アニーリング処理が実施される。アニーリングに用いられうるシステムの一例としては、Applied Materials Inc.(カリフォルニア州サンタクララ)から入手可能な急速熱アニールチャンバがある。他の製造業者から入手可能なものを含む他の処理システムも本開示を実践するよう適合しうると、想定される。熱アニーリング処理は、膜スタックの格子構造、特に膜スタックに含まれる磁気ストレージ層と磁気基準層を修復、圧縮、強化するために実施される。熱アニーリング処理後、磁気ストレージ層と磁気基準層は、ほぼ一平面内に結晶方向を有する、結晶化した磁気ストレージ層と結晶化した磁気基準層に変化しうる。磁気ストレージ層と磁気基準層の所望の結晶化が得られるため、MTJデバイス製造のための膜スタックの電気特性全体が改善される。
[0029] いくつかの実施形態では、アプリケーションに応じて、操作103及び106(或いは他の同等のアニール処理)が用いられうる。
[0030] 以下で説明するように、本開示のMTJ膜スタックは、持続的な高温熱処理と電気及び磁気特性の改善を可能にする。
[0031] 図2A〜図2Cの各々は、幾つかの実施形態による、膜スタックの一部の概略図を個別に示している。200は基板である。204は、いくつかの実施形態でパターニングされた底部電極である。図2A〜図2Cには描かれていないが、他の層、例えば、一又は複数の層の形態のトランジスタ及び相互接続構造は、いくつかの実施形態により、基板200と底部接触部204との間に配置されうる。図2Bに描かれた膜スタックと図2Cに描かれた膜スタックとの違いは、バッファ層205/205’、シード層210/210’、及び第1のピンニング層215/215’である。いくつかの実施形態では、膜スタックには、底部接触部、バッファ層、シード層、第1のピンニング層、合成フェリ磁性体(SyF)結合層、第2のピンニング層、構造ブロック層、磁気基準層、トンネルバリア層、磁気ストレージ層、キャッピング層、及びハードマスクのうちの一又は複数が含まれる。いくつかの実施形態では、これらの層の各々は、個別に一又は複数の層を含む。
[0032] いくつかの実施形態では、また、図2A〜図2Cに示したように、磁気トンネル接合(MTJ)構造の形成に利用される膜スタックは、底部接触部204の上に配置される。MTJ構造は、底部接触部204の上に配置されたバッファ層205/205’と、バッファ層205/205’の上に配置されたシード層210/210’と、シード層210/210’の上に配置された第1のピンニング層215/215’と、第1のピンニング層215/215’の上に配置された合成フェリ磁性体(SyF)結合層220と、SyF結合層220の上に配置された第2のピンニング層225と、第2のピンニング層225の上に配置された構造ブロック層230と、構造ブロック層230の上に配置された磁気基準層235と、磁気基準層235の上に配置されたトンネルバリア層240と、トンネルバリア層240の上に配置された磁気ストレージ層245と、磁気ストレージ層245の上に配置された、一又は複数の層を含むキャッピング層250と、キャッピング層250の上に配置されたハードマスク255と、を含み、キャッピング層、バッファ層、及びSyF結合層のうちの少なくとも1つはRuから作られていない。
[0033] 膜スタックは、底部接触部204の上に配置されたバッファ層205/205’を含む。バッファ層205/205’は、底部接触部204とシード層210/210’との間に挟まれうる。MTJ膜スタックは、その後の層の接着とシーディングを改善するため、バッファ層から始まることが多い。いくつかの実施形態では、バッファ層205/205’は一又は複数の層を含む。いくつかの実施形態では、バッファ層はRuから作られていない。
[0034] いくつかの実施形態では、バッファ層はCoFeB含有層205a/205a’を含む。バッファ層内のホウ素(B)の重量%(wt%)は、約10wt%〜約40wt%の間に、好ましくは約20wt%〜40wt%の間に、より好ましくは約25wt%〜約40wt%の間になる。バッファ層内の鉄のwt%は、約20wt%〜約60wt%の間に、好ましくは40wt%〜60wt%の間に、より好ましくは約45wt%〜約60wt%の間になる。CoFeB含有層205a/205a’の厚みは、約0Å〜約20Åの間に、好ましくは約10Åになる。
[0035] いくつかの実施形態では、バッファ層205/205’は、TaN含有層205b/205b’及び/又はTa含有層205c/205c’を含みうる。TaN含有層205b/205b’とTa含有層205c/205c’は、CoFeB層の上に堆積されうる。TaN含有層205b/205b’とTa含有層205c/205c’は、CoFeB層の下に交互に堆積されうる。TaN含有層とTa含有層の厚みは、約0Å〜約40Åの間に、好ましくは約15Åになる。
[0036] 膜スタックは、バッファ層205/205’の上に配置されたシード層210/210’を含む。シード層210/210’は、バッファ層205/205’と第1のピンニング層215/215’との間に挟まれうる。
[0037] いくつかの実施形態では、シード層210は、Pt含有層、Ir含有層、及びRu含有層のうちの一又は複数を含む。Pt含有層、Ir含有層、及びRu含有層のうちの一又は複数を含むシード層210の厚みは、約0Å〜約60Åの間に、好ましくは約25Åになる。いくつかの実施形態では、シード層210が、Pt含有層、Ir含有層、及びRu含有層のうちの一又は複数を含むとき、バッファ層のCoFeB含有層205aは、バッファ層のTaN含有層205b(及び/又はTa含有層205c)の下に配置される。
[0038] いくつかの実施形態では、シード層210’はNiCr含有層を含む。NiCr含有層を有するシード層210’の厚みは、約0Å〜約100Åの間に、好ましくは約50Åになる。いくつかの実施形態では、シード層がNiCr含有層を含むとき、バッファ層のCoFeB含有層205a’は、バッファ層のTaN含有層205b’(及び/又はTa含有層205c’)の上に配置される。
[0039] いくつかの実施形態では、膜スタックは、シード層210/210’の上に配置された第1のピンニング層215/215’を含む。第1のピンニング層215/215’は、シード層210/210’とSyF結合層220との間に挟まれうる。第1のピンニング層215/215’は一又は複数の層を含みうる。第1のピンニング層は、ホウ素ドーパント、酸素ドーパントなどのドーパントを含む金属合金、或いは他の好適な材料など、いくつかの磁気材料から構成されうる。金属合金は、Ni含有材料、Pt含有材料、Ru含有材料、Co含有材料、Ta含有材料、及びPd含有材料を含みうる。磁気材料の好適な例には、Ru、Ta、Co、Pt、Ni、TaN、NiFeO、NiFeB、CoFeOB、CoFeB、CoFe、NiOB、CoBO、FeBO、CoFeNiB、CoPt、CoPd、CoNi、及びTaOなどがある。
[0040] 幾つかの実施形態では、第1のピンニング層215は、Co/Pt含有層215aの上に配置されたCo含有層215bを含む。Co含有層215bの厚みは、約0Å〜10Åの間に、好ましくは約5Åになる。Co/Pt含有層215aは、次式からなる組成を有しうる。
[Co(x)/Pt(y)
ここで、xは約0Å〜約10Åの間の、好ましくは約0.5Å〜約7Åの間のCoの厚みを有し、yは約0Å〜約10Åの間の、好ましくは約0.5Å〜約8Åの間のPtの厚みを有し、mは約3〜約10の間の整数で、mは膜スタック内で繰り返し形成されるCo/Pt含有層215aの数を表す。例えば、xが5Å、yが3Åで、mが整数2のとき、これはCo層(5Å)/Pt層(3Å)/Co層(5Å)/Pt層(3Å)となるCo/Pt層を表わす。
[0041] いくつかの実施形態では、第1のピンニング層215’は、Co/Ni含有層215a’の上に堆積されたCo含有層215b’を含む。Co含有層215bの厚みは、約0Å〜10Åの間に、好ましくは約5Åになる。Co/Ni含有層215a’は、次式からなる組成を有しうる。
[Co(x1)/Ni(y1)
ここで、x1は約0Å〜約10Åの間の、好ましくは約0.5Å〜約7Åの間のCoの厚みを有し、y1は約0Å〜約10Åの間の、好ましくは約0.5Å〜約8Åの間のNiの厚みを有し、nは約1〜約10の間の整数で、nは膜スタック内で繰り返し形成されるCo/Pt含有層215aの数を表す。
[0042] いくつかの実施形態では、第1のピンニング層215はCo/Pt含有層215aを含み、シード層210はPt含有層、Ir含有層、及びRu含有層のうちの一又は複数を含む。
[0043] いくつかの実施形態では、第1のピンニング層215’はCo/Ni含有層215a’を含み、シード層210はNiCr含有層を含む。
[0044] 膜スタックは、第1のピンニング層215/215’の上に配置された合成フェリ磁性体(SyF)結合層220を含む。いくつかの実施形態では、SyF結合層220は、第1のピンニング層215/215’と第2のピンニング層225との間に挟まれている。SyF結合層220は、第1のピンニング層と第2のピンニング層を非平行に結合するために使用される。いくつかの実施形態では、SyF結合層220は、Ir含有層、Ru含有層、Rh含有層、及びCr含有層のうちの一又は複数を含む。好ましくは、SyF結合層はIr含有層である。好ましくは、SyF結合層はRuから作られていない。SyF結合層220の厚みは、約3Å〜約10Åの間になる。SyF結合層がRu含有層の場合には、層の厚みは、好ましくは約4Å〜約5Åの間に、或いは約7Å〜約9Åの間になる。SyF結合層がIr含有層の場合には、層の厚みは、好ましくは約4Å〜約6Åの間になる。
[0045] 膜スタックは、SyF結合層220の上に配置されたマルチ材料層225を含む。いくつかの実施形態では、第2のピンニング層225は、SyF結合層220と構造ブロック層230との間に挟まれている。第2のピンニング層225は、一又は複数の層を含みうる。第2のピンニング層は、ホウ素ドーパント、酸素ドーパントなどのドーパントを含む金属合金、或いは他の好適な材料など、いくつかの磁気材料から構成されうる。金属合金は、Ni含有材料、Pt含有材料、Ru含有材料、Co含有材料、Ta含有材料、及びPd含有材料を含みうる。磁気材料の好適な例には、Ru、Ta、Co、Pt、Ni、TaN、NiFeO、NiFeB、CoFeOB、CoFeB、CoFe、NiOB、CoBO、FeBO、CoFeNiB、CoPt、CoPd、CoNi、及びTaOなどがある。
[0046] いくつかの実施形態では、第2のピンニング層225は、Co/Pt含有層215aの上に配置されたCo含有層225bを含む。Co含有層225bの厚みは、約0Å〜約10Åの間に、好ましくは約5Åになる。Co/Pt含有層215aは、次式からなる組成を有しうる。
[Co(x2)/Pt(y2)
ここで、x2は約0Å〜約10Åの間の、好ましくは約0.5Å〜約7Åの間のCoの厚みを有し、y2は約0Å〜約10Åの間の、好ましくは約0.5Å〜約8Åの間のPtの厚みを有し、pは約0〜約5の間の整数で、pは膜スタック内で繰り返し形成されるCo/Pt含有層225aの数を表す。
[0047] 膜スタックは、第2のピンニング層225の上に配置された構造ブロック層230を含む。いくつかの実施形態では、構造ブロック層230は、第2のピンニング層225と磁気基準層235との間に挟まれている。いくつかの実施形態では、構造ブロック層230は一又は複数の層を含む。いくつかの実施形態では、構造ブロック層230は、金属含有材料又は磁気材料のうちの一又は複数(例えば、Mo、Ta、W、CoFe、及びCoFeB)を含み、好ましくは、Ta含有層、Mo含有層、及びW含有層のうちの一又は複数の金属含有材料又は磁気材料を含む第2のピンニング層225の厚みは、約0Å〜約8Åの間に、好ましくは約4Åになる。
[0048] 膜スタックは、オプションの材料層230の上に堆積したマルチ材料層235を含む。いくつかの実施形態では、磁気基準層235は、構造ブロック層230とトンネルバリア層240との間に挟まれている。いくつかの実施形態では、磁気基準層235は一又は複数の層を含む。磁気基準層235は、ホウ素ドーパント、酸素ドーパントなどのドーパントを含む金属合金、或いは他の好適な材料など、いくつかの磁気材料から構成されうる。金属合金は、Ni含有材料、Pt含有材料、Ru含有材料、Co含有材料、Ta含有材料、及びPd含有材料を含みうる。磁気材料の好適な例には、Ru、Ta、Co、Pt、Ni、TaN、NiFeO、NiFeB、CoFeOxB、CoFeB、CoFe、NiOB、CoBO、FeBO、CoFeNiB、CoPt、CoPd、CoNi、及びTaOなどがある。
[0049] いくつかの実施形態では、磁気基準層235の一又は複数の層はCoFeB含有層を含む。磁気基準層内のホウ素(B)の重量%(wt%)は、約10wt%〜約40wt%の間に、好ましくは約20wt%〜40wt%の間に、より好ましくは約25wt%〜約40wt%の間になる。磁気基準層内の鉄のwt%は、約20wt%〜約60wt%の間に、好ましくは40wt%〜60wt%の間に、より好ましくは約45wt%〜約60wt%の間になる。磁気基準層235の厚みは、約5Å〜約20Åの間に、好ましくは10Åになる。
[0050] いくつかの実施形態では、膜スタックは、磁気基準層235の上に配置されたトンネルバリア層240を含む。いくつかの実施形態では、トンネルバリア層240は、磁気基準層235と磁気ストレージ層245との間に挟まれている。トンネルバリア層240は酸化物バリア層になりうる。トンネルバリア層240には、MgO、HfO、TiO、TaO、Al、又は他の好適な材料が含まれる。いくつかの実施形態では、トンネルバリア層240は、約1Å〜約15Åの間の、好ましくは約10Åの厚みを有するMgOを含みうる。トンネルバリア層240は、急速熱アニール(RTP)処理を用いて、堆積中又は堆積後にアニールされうる。
[0051] いくつかの実施形態では、膜スタックは、トンネルバリア層240の上に配置された磁気ストレージ層245を含む。いくつかの実施形態では、磁気ストレージ層245は、トンネルバリア層240とキャッピング層250との間に挟まれている。磁気ストレージ層245は、ホウ素ドーパント、酸素ドーパントなどのドーパントを含む金属合金、或いは他の好適な材料など、いくつかの磁気材料から構成されうる。金属合金は、Ni含有材料、Pt含有材料、Ru含有材料、Co含有材料、Ta含有材料、及び/又はPd含有材料を含みうる。磁気材料の好適な例には、Ru、Ta、Co、Pt、Ni、TaN、NiFeO、NiFeB、CoFeOB、CoFeB、CoFe、NiOB、CoBO、FeBO、CoFeNiB、CoPt、CoPd、CoNi、及びTaOなどがある。
[0052] いくつかの実施形態では、磁気ストレージ層245は、CoFeB、CoFeNiB、Ta、Mo又はW、これらの組み合わせ、或いは他の好適な層になりうる。例えば、図2に描かれた実施形態では、磁気ストレージ層245は、中間層245bを挟み込む第1のCoFeB含有層245aと第2のCoFeB含有層245aを含む。第1のCoFeB含有層245aは、約5Å〜約20Åの間の、好ましくは約10Åの厚みを有しうる。第1のCoFeB含有層245a内のホウ素(B)の重量%(wt%)は、約10wt%〜約40wt%の間に、好ましくは約20wt%〜40wt%の間に、より好ましくは約25wt%〜約40wt%の間になる。第1のCoFeB含有層245a内の鉄のwt%は、約20wt%〜約60wt%の間に、好ましくは40wt%〜60wt%の間に、より好ましくは約45wt%〜約60wt%の間になる。
[0053] 第2のCoFeB含有層245cは、約5Å〜約20Åの間の、好ましくは約10Åの厚みを有しうる。第2のCoFeB含有層245c内のホウ素(B)の重量%(wt%)は、約10wt%〜約40wt%の間に、好ましくは約20wt%〜40wt%の間に、より好ましくは約25wt%〜約40wt%の間になる。第2のCoFeB含有層245a内の鉄のwt%は、約20wt%〜約60wt%の間に、好ましくは40wt%〜60wt%の間に、より好ましくは約45wt%〜約60wt%の間になる。
[0054] 磁気ストレージ層245の中間層245bは、Ta含有層、Mo含有層、及びW含有層のうちの少なくとも1つからなる複数の層を含みうる。中間層245bは、約0Å〜約8Åの間の、例えば約3Åの厚みを有しうる。
[0055] 膜スタックは、磁気ストレージ層245の上に配置されたキャッピング層250を含む。いくつかの実施形態では、キャッピング層250は、磁気ストレージ層245とハードマスク255との間に挟まれている。キャッピング層は、ハードマスクエッチングの際に、スタックを腐食から保護し、エッチング停止層として機能する貴金属材料で終わるMTJスタックの最上部で利用される。いくつかの実施形態では、キャッピング層250は一又は複数の層を含む。
[0056] いくつかの実施形態では、キャッピング層250は、第1の層250a、第2の層250b、第3の層250c、及び第4の層250dを含む。
[0057] 第1の層250aは、MgO又は他の好適な材料などの、酸素含有層の一又は複数の層を含みうる。好ましくは、酸素含有層はMgOである。第1の層250aは、約0Å〜約15Åの間の、例えば約7Åの厚みを有しうる。第2の層250bは、CoFeBの一又は複数の層を含みうる。チャネル層212は、約0Å〜約50Åの間の、例えば約8Åの厚みを有しうる。第2の層250bのホウ素(B)の重量%(wt%)は、約10wt%〜約40wt%の間に、好ましくは約20wt%〜40wt%の間に、より好ましくは、約25wt%〜約40wt%の間になりうる。第2の層250bの鉄のwt%は、約20wt%〜約60wt%の間、好ましくは約40wt%〜60wt%の間、より好ましくは、約45wt%〜約60wt%の間になりうる。
[0058] 第3の層250cは、Ta含有材料の一又は複数の層を含みうる。第3の層250cは、約0Å〜約30Åの間の、例えば約10Åの厚みを有しうる。第4の層250dは、一又は複数のIr含有層及びRu含有層を、好ましくは一又は複数のIr含有層を含みうる。第4の層250dは、約0Å〜約50Åの間の、例えば約30Åの厚みを有しうる。
[0059] いくつかの実施形態では、キャッピング層250の一又は複数の層は、Ir含有層の一又は複数の層、Ru含有層の一又は複数の層、或いはこれらの組み合わせを含む。
[0060] いくつかの実施形態では、キャッピング層250の一又は複数の層は、Ir含有層、Ru含有層、Ta含有層、CoFeB含有層、Mo含有層、W含有層、及び酸素含有層(例えば、MgO)のうちの一又は複数を含む。好ましくは、Ir含有層又はRu含有層(より好ましくはIr含有層)は、ハードマスクエッチング停止として、キャッピング層の最上層になる。いくつかの実施形態では、キャッピング層はRuから作られていない。
[0061] いくつかの実施形態では、キャッピング層はオプション層250xを含む。オプション層は、第1の層250aと第2の層250bとの間に配置されうる。オプション層250xは、Ir含有層及び/又はRu含有層、好ましくはIrの一又は複数の層を含みうる。オプション層250xは、約0Å〜約30Åの間の、例えば約20Åの厚みを有しうる。
[0062] いくつかの実施形態では、キャッピング層250がオプション層250xを含むときには、第2の層250bは使用されない。このような実施形態では、オプション層250xは第1の層250aの上にある。いくつかの実施形態では、オプション層250xは第1の層250aの直上に配置される。いくつかの実施形態では、追加の層が250xの上に配置されうる。
[0063] いくつかの実施形態では、キャッピング層はオプション層250xと第1の層250aを含む。この実施形態では、例えば、キャッピング層はIr及び/又はRu含有層と酸素含有層であってよく、Ir及び/又はRu含有層は酸素含有層の上に位置する。他の実施形態では、キャッピング層は、オプション層250x、第1の層250a、並びに、第2の層250b、第3の層250c、及び第4の層250dのうちの一又は複数を含み、オプション層250xは酸素含有層250aの直上に配置されている。
[0064] 図3A〜図3Dは、上述のように、キャッピング層250の様々な非排他的な実施形態を示している。
[0065] 例えば、図3Aでは、キャッピング層250は第1の層250aを含み、オプション層250xは第1の層250aの上に配置され、第2の層250bはオプション層250xの上に配置され、第3の層250cは第2の層250bの上に配置され、第4の層250dは第3の層250cの上に配置されている。これらの層の各々に対する材料、組成、厚みの範囲は上述のとおりである。
[0066] 図3Bの実施例では、キャッピング層250は第1の層250aを含み、第2の層250bは第1の層250aの上に配置され、第3の層250cは第2の層250bの上に配置され、第4の層250dは第3の層250cの上に配置されている。これらの層の各々に対する材料、組成、厚みの範囲は上述のとおりである。
[0067] 図3Cの実施例では、キャッピング層250は第1の層250aを含み、オプション層250xは第1の層250aの上に配置され、第3の層250cはオプション層250xの上に配置され、第4の層250dは第3の層250cの上に配置されている。これらの層の各々に対する材料、組成、厚みの範囲は上述のとおりである。
[0068] 図3Cの実施例では、キャッピング層250は第1の層250aを含み、オプション層250xは第1の層250aの上に配置されている。これらの層の各々に対する材料、組成、厚みの範囲は上述のとおりである。
[0069] 図2A〜図2Cは例示的なMTJ膜スタックを示しており、バッファ層、SyF結合層、及びキャッピング層のうちの一又は複数はRuから作られていない。いくつかの実施形態では、MTJ膜スタックはCoFeBベースのバッファ層205/205’を含み、オプションにより一部のTaN及び/又はTaを含みうる。CoFeB層は、TaN及び/又はTaを含む層の上又は下に配置されうる。CoFeBベースのバッファ層のホウ素のwt%は、約10wt%を、好ましくは約25wt%を超えていなければならない。いくつかの実施形態では、Ir、Ru、Rh、及び/又はCrはSyF結合層220として使用されてよく、好ましくはIrはSyF結合層である。いくつかの実施形態では、Ir及び/又はRuは、キャッピング層250の最上層金属になりうる。Irは、好ましくはキャッピング層250の最上層金属になる。
[0070] Ru含有バッファ層の代わりにCoFeBベースのバッファ層を使用することで、最高450°Cの温度でアニーリングした後、優れた磁気ピンニングを有するトンネル磁気抵抗(TMR)が増加することが示された。ピンド層及び基準層の高いSyF結合、高い垂直磁気異方性、及びフリー層の制御可能な垂直磁気異方性が実現される。CoFeBバッファ層(25wt%のホウ素を含む)を実装するいくつかの実施形態は、従来のTa/Ru/Taバッファ層よりも10%を超えるTMR(%)の改善を示している。CoFeB層は、底部接触部からMTJ膜スタックへの搬送による粗度の増加をブロックする。
[0071] 加えて、SyF結合層とキャッピング層でRuをIrに代えることによっても、最高450°Cの温度でアニーリングした後にTMR(%)が増加することが示された。Ir含有SyF結合層を実装するいくつかの実施形態は、従来のRu含有SyF結合層よりも10%を超えるTMR(%)の改善を示している。さらに、SyF結合層とキャッピング層のRuを除去することによって、膜のTMRは、MgOに向かうRu拡散を除去することによって強化される。RuOよりもIrOの高い熱安定性は、拡散を除去する役割を果たす可能性がある。
[0072] 図2A〜図2Cなどの構成は、従来の膜スタックよりも利点をもたらす。第1の利点は、高温の熱処理であってもバッファが非晶質の状態に留まることと、底部接触からテクスチャをブロックすることである。第2の利点は、Irによってもたらされるピンニング層の間の強力な逆平行結合である。第3の利点は、新しいバッファ層を使用すること、及びスタックからのRuの除去によるTMRの改善である。これらの利点は、高いMTJ性能(高いTMR、高いSyF結合、ピンド層と基準層の高い垂直磁気異方性、及びフリー層の制御可能な垂直磁気異方性)と製造性の改善をもたらす。MTJ膜スタックは、STT−MRAMアプリケーション用のメモリセル、並びにMTJをユニット構成ブロックとして使用する他のメモリ及び論理デバイスの製造に使用することができる。物理的気相堆積システム(ENDURA(登録商標)STT MRAM)は、高性能STT−MRAMチップ用のMTJ膜スタックの堆積に使用可能である。本書に記載のように、高温熱処理を維持できるMTJ膜スタックは、MTJの電気特性と磁気特性の両方を改善する。
[0073] 表1及び表2は、基板上に磁気トンネル接合(MTJ)構造を形成するために利用される膜スタックのための例示的な組成を示している。ハードマスク層及び底部接触層の材料、組成、及び厚みは当業者に知られている。
[0074] キャッピング層内の付加的な(及びオプションの)Ir及び/又はRu層は、上述のように(250xで表される)、酸素含有層の最上部に配置されうる。この層の厚みは、約0Å〜約30Åの間になりうる。いくつかの実施形態では、付加的なIr及び/又はRu層が使用されるときには、キャッピング層のCoFeB層は使用されない。
Figure 2020527865
Figure 2020527865
[0075] 発明は本書で詳細な実施形態を参照して説明されているが、これらの実施形態は本発明の原理及び用途の例示にすぎないことを、理解されたい。本発明の趣旨及び範囲から逸脱することなく、本発明の方法及び装置に様々な改変及び変形を行いうることが、当業者には明らかになろう。ゆえに、本発明は、付随する特許請求の範囲及びその均等物に含まれる改変例及び変形例を含むことが意図されている。

Claims (15)

  1. 基板上に磁気トンネル接合(MTJ)構造を形成するために利用される膜スタックであって、
    バッファ層と、
    前記バッファ層の上に配置されたシード層と、
    前記シード層の上に配置された第1のピンニング層と、
    前記第1のピンニング層の上に配置された合成フェリ磁性体(SyF)結合層と、
    前記SyF結合層の上に配置された第2のピンニング層と、
    前記第2のピンニング層の上に配置された構造ブロック層と、
    前記構造ブロック層の上に配置された磁気基準層と、
    前記磁気基準層の上に配置されたトンネルバリア層と、
    前記トンネルバリア層の上に配置された磁気ストレージ層と、
    前記磁気ストレージ層の上に配置された、一又は複数の層を含むキャッピング層と、
    前記キャッピング層の上に配置されたハードマスクと、
    を含み、
    前記キャッピング層、前記バッファ層、及び前記SyF結合層のうちの少なくとも1つはRuから作られていない、膜スタック。
  2. 前記キャッピング層は、Ir含有層、Ru含有層、またはこれらの組み合わせのうちの一又は複数を含む、請求項1に記載の膜スタック。
  3. 前記キャッピング層は酸素含有層をさらに含む、請求項2に記載の膜スタック。
  4. 前記キャッピング層はCoFeB含有層をさらに含む、請求項3に記載の膜スタック。
  5. 前記キャッピング層はTa含有層をさらに含む、請求項3に記載の膜スタック。
  6. 前記キャッピング層は、
    最上層としての、Ir含有層、Ru含有層、又はこれらの組み合わせと、
    酸素含有層とを含み、
    前記最上層は前記酸素含有層の直上に配置される、請求項3に記載の膜スタック。
  7. 前記キャッピング層は、
    最上層としてのIr含有層と、
    W含有層、酸素含有層、前記酸素含有層の直上に配置された第2のIr含有層、CoFeB含有層、Ta含有層、及びMo含有層のうちの一又は複数とを含む、請求項1に記載の膜スタック。
  8. 前記SyF結合層はIr含有層を含む、請求項1に記載の膜スタック。
  9. 前記バッファ層はCoFeB含有層を含む、請求項1に記載の膜スタック。
  10. 前記バッファ層のホウ素の重量%は、約20重量%〜40重量%の間になる、請求項9に記載の膜スタック。
  11. 前記シード層は、(a)NiCr含有層、又は(b)Pt含有層、Ir含有層、及びRu含有層のうちの一又は複数を含む、請求項1に記載の膜スタック。
  12. 前記シード層はNiCr含有層を含み、
    前記バッファ層は、TaN含有層とTa含有層のうちの一又は複数をさらに含み、前記バッファ層の前記CoFeB含有層は、前記バッファ層のTaN含有層及び前記バッファ層のTa含有層の一又は複数の上に配置される、請求項9に記載の膜スタック。
  13. 前記シード層は、Pt含有層、Ir含有層、及びRu含有層のうちの一又は複数を含み、
    前記バッファ層はTaN含有層とTa含有層のうちの一又は複数をさらに含み、前記バッファ層の前記CoFeB含有層は、前記バッファ層の前記TaN含有層と前記バッファ層の前記Ta含有層のうちの一又は複数の下に配置される、請求項9に記載の膜スタック。
  14. 基板上に磁気トンネル接合(MTJ)構造を形成するために利用される膜スタックであって、
    CoFeB含有層を含むバッファ層と、
    前記バッファ層の上に配置されたシード層と、
    前記シード層の上に配置された第1のピンニング層と、
    前記第1のピンニング層の上に配置された、Ir含有層を含む合成フェリ磁性体(SyF)結合層と、
    前記SyF結合層の上に配置された第2のピンニング層と、
    前記第2のピンニング層の上に配置された構造ブロック層と、
    前記構造ブロック層の上に配置された磁気基準層と、
    前記磁気基準層の上に配置されたトンネルバリア層と、
    前記トンネルバリア層の上に配置された磁気ストレージ層と、
    前記磁気ストレージ層の上に配置された、一又は複数の層を含むキャッピング層と、
    前記キャッピング層の上に配置されたハードマスクと、
    を含み、
    前記キャッピング層、前記バッファ層、及び前記SyF結合層のうちの少なくとも1つはRuから作られていない、膜スタック。
  15. 前記キャッピング層は、最上層としてIr含有層を含む、請求項14に記載の膜スタック。
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Families Citing this family (35)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US10255935B2 (en) 2017-07-21 2019-04-09 Applied Materials, Inc. Magnetic tunnel junctions suitable for high temperature thermal processing
US10636964B2 (en) * 2018-03-30 2020-04-28 Applied Materials, Inc. Magnetic tunnel junctions with tunable high perpendicular magnetic anisotropy
US10957849B2 (en) 2018-05-24 2021-03-23 Applied Materials, Inc. Magnetic tunnel junctions with coupling-pinning layer lattice matching
US10910557B2 (en) 2018-09-14 2021-02-02 Applied Materials, Inc. Apparatus and methods of fabricating a magneto-resistive random access memory (MRAM) device
CN111816760B (zh) * 2019-04-11 2023-07-14 上海磁宇信息科技有限公司 一种磁性随机存储器磁性存储单元及其形成方法
US11456411B2 (en) * 2019-07-02 2022-09-27 HeFeChip Corporation Limited Method for fabricating magnetic tunneling junction element with a composite capping layer
WO2021011144A1 (en) * 2019-07-16 2021-01-21 Applied Materials, Inc. Magnetic tunnel junction stack with data retention
US12108684B2 (en) 2019-07-21 2024-10-01 HeFeChip Corporation Limited Magnetic tunneling junction element with a composite capping layer and magnetoresistive random access memory device using the same
US11049537B2 (en) 2019-07-29 2021-06-29 Applied Materials, Inc. Additive patterning of semiconductor film stacks
JP2021044429A (ja) * 2019-09-12 2021-03-18 キオクシア株式会社 磁気記憶装置
CN112635655A (zh) * 2019-10-08 2021-04-09 上海磁宇信息科技有限公司 一种磁性隧道结覆盖层及其制作工艺
CN112635651A (zh) * 2019-10-08 2021-04-09 上海磁宇信息科技有限公司 磁性隧道结结构及磁性随机存储器
CN112635652B (zh) * 2019-10-08 2023-05-26 上海磁宇信息科技有限公司 磁性随机存储器的磁性隧道结结构
CN112652709A (zh) * 2019-10-10 2021-04-13 上海磁宇信息科技有限公司 磁性隧道结的种子层形成方法
CN112652702B (zh) * 2019-10-10 2023-12-22 上海磁宇信息科技有限公司 磁性随机存储器的磁性隧道结结构
US11522126B2 (en) * 2019-10-14 2022-12-06 Applied Materials, Inc. Magnetic tunnel junctions with protection layers
CN112736193A (zh) * 2019-10-14 2021-04-30 上海磁宇信息科技有限公司 磁性隧道结结构及其磁性随机存储器
CN112736194A (zh) * 2019-10-14 2021-04-30 上海磁宇信息科技有限公司 磁性隧道结结构及磁性随机存储器
CN112864308B (zh) * 2019-11-12 2023-04-28 上海磁宇信息科技有限公司 磁性隧道结结构及磁性随机存储器
CN112802959A (zh) * 2019-11-13 2021-05-14 上海磁宇信息科技有限公司 磁性隧道结结构及磁性随机存储器
US11871679B2 (en) 2021-06-07 2024-01-09 Western Digital Technologies, Inc. Voltage-controlled magnetic anisotropy memory device including an anisotropy-enhancing dust layer and methods for forming the same
US11404632B2 (en) 2019-11-22 2022-08-02 Western Digital Technologies, Inc. Magnetoresistive memory device including a magnesium containing dust layer
US11404193B2 (en) 2019-11-22 2022-08-02 Western Digital Technologies, Inc. Magnetoresistive memory device including a magnesium containing dust layer
US11056640B2 (en) 2019-11-22 2021-07-06 Western Digital Technologies, Inc. Magnetoresistive memory device including a high dielectric constant capping layer and methods of making the same
US10991407B1 (en) 2019-11-22 2021-04-27 Western Digital Technologies, Inc. Magnetoresistive memory device including a high dielectric constant capping layer and methods of making the same
US11839162B2 (en) 2019-11-22 2023-12-05 Western Digital Technologies, Inc. Magnetoresistive memory device including a plurality of reference layers
US11005034B1 (en) 2019-11-22 2021-05-11 Western Digital Technologies, Inc. Magnetoresistive memory device including a high dielectric constant capping layer and methods of making the same
US11361805B2 (en) 2019-11-22 2022-06-14 Western Digital Technologies, Inc. Magnetoresistive memory device including a reference layer side dielectric spacer layer
CN112928203B (zh) * 2019-12-05 2023-04-07 上海磁宇信息科技有限公司 多层覆盖层的磁性隧道结结构及磁性随机存储器
CN112928204B (zh) * 2019-12-05 2023-06-02 上海磁宇信息科技有限公司 提升磁性隧道结自由层垂直各向异性的覆盖层结构单元
CN113013325B (zh) * 2019-12-19 2023-04-07 上海磁宇信息科技有限公司 具漏磁场平衡层的磁性隧道结单元及磁性随机存储器
CN113140670A (zh) * 2020-01-16 2021-07-20 上海磁宇信息科技有限公司 一种磁性隧道结垂直反铁磁层及随机存储器
CN113346007A (zh) * 2020-03-02 2021-09-03 上海磁宇信息科技有限公司 磁性隧道结结构及其磁性随机存储器
US11889702B2 (en) 2021-06-07 2024-01-30 Western Digital Technologies, Inc. Voltage-controlled magnetic anisotropy memory device including an anisotropy-enhancing dust layer and methods for forming the same
US11887640B2 (en) 2021-06-07 2024-01-30 Western Digital Technologies, Inc. Voltage-controlled magnetic anisotropy memory device including an anisotropy-enhancing dust layer and methods for forming the same

Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2012195373A (ja) * 2011-03-15 2012-10-11 Fujitsu Ltd 磁気デバイス及び製造方法
JP2013115412A (ja) * 2011-12-01 2013-06-10 Sony Corp 記憶素子、記憶装置
JP2014022730A (ja) * 2012-07-17 2014-02-03 Samsung Electronics Co Ltd 磁気素子及びその製造方法
JP2014030030A (ja) * 2008-06-20 2014-02-13 Canon Anelva Corp スピンバルブ型トンネル磁気抵抗素子の製造方法
US20140145792A1 (en) * 2012-11-27 2014-05-29 Headway Technologies, Inc. Free Layer with Out-of-Plane Anisotropy for Magnetic Device Applications
WO2016189772A1 (ja) * 2015-05-22 2016-12-01 キヤノンアネルバ株式会社 磁気抵抗効果素子
WO2017086481A1 (ja) * 2015-11-18 2017-05-26 国立大学法人東北大学 磁気トンネル接合素子及び磁気メモリ

Family Cites Families (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6574079B2 (en) * 2000-11-09 2003-06-03 Tdk Corporation Magnetic tunnel junction device and method including a tunneling barrier layer formed by oxidations of metallic alloys
US6831312B2 (en) 2002-08-30 2004-12-14 Freescale Semiconductor, Inc. Amorphous alloys for magnetic devices
US7449345B2 (en) * 2004-06-15 2008-11-11 Headway Technologies, Inc. Capping structure for enhancing dR/R of the MTJ device
US8609262B2 (en) * 2009-07-17 2013-12-17 Magic Technologies, Inc. Structure and method to fabricate high performance MTJ devices for spin-transfer torque (STT)-RAM application
CN102024224A (zh) 2009-09-11 2011-04-20 阿里巴巴集团控股有限公司 实现商品最优时间上架和/或下架的电子商务系统及方法
FR2976396B1 (fr) * 2011-06-07 2013-07-12 Commissariat Energie Atomique Empilement magnetique et point memoire comportant un tel empilement
JP5856490B2 (ja) * 2012-01-20 2016-02-09 ルネサスエレクトロニクス株式会社 磁気抵抗効果素子及び磁気メモリ
US9093639B2 (en) * 2012-02-21 2015-07-28 Western Digital (Fremont), Llc Methods for manufacturing a magnetoresistive structure utilizing heating and cooling
US8981505B2 (en) * 2013-01-11 2015-03-17 Headway Technologies, Inc. Mg discontinuous insertion layer for improving MTJ shunt
US10008663B1 (en) * 2017-04-19 2018-06-26 Avalanche Technology, Inc. Perpendicular magnetic fixed layer with high anisotropy
US9496489B2 (en) * 2014-05-21 2016-11-15 Avalanche Technology, Inc. Magnetic random access memory with multilayered seed structure
KR101596584B1 (ko) * 2014-07-15 2016-02-24 한양대학교 산학협력단 자기터널접합을 위한 구조 및 그를 포함하는 자기터널접합과 자기 메모리
US9337412B2 (en) 2014-09-22 2016-05-10 Spin Transfer Technologies, Inc. Magnetic tunnel junction structure for MRAM device
US9647204B2 (en) 2014-12-05 2017-05-09 International Business Machines Corporation Spin torque MRAM based on Co, Ir synthetic antiferromagnetic multilayer
US9634237B2 (en) 2014-12-23 2017-04-25 Qualcomm Incorporated Ultrathin perpendicular pinned layer structure for magnetic tunneling junction devices
KR101739640B1 (ko) 2015-02-23 2017-05-24 고려대학교 산학협력단 다층 자성 박막 스택 및 이를 포함하는 비휘발성 메모리 소자
WO2016148394A1 (ko) * 2015-03-18 2016-09-22 한양대학교 산학협력단 메모리 소자
US10580964B2 (en) * 2015-03-18 2020-03-03 Industry-University Cooperation Foundation Hanyang University Memory device
US9337415B1 (en) * 2015-03-20 2016-05-10 HGST Netherlands B.V. Perpendicular spin transfer torque (STT) memory cell with double MgO interface and CoFeB layer for enhancement of perpendicular magnetic anisotropy
US11245069B2 (en) 2015-07-14 2022-02-08 Applied Materials, Inc. Methods for forming structures with desired crystallinity for MRAM applications
EP3933948A1 (en) * 2015-12-10 2022-01-05 Everspin Technologies, Inc. Magnetoresistive stack, seed region therefor and method of manufacturing same
US10255935B2 (en) 2017-07-21 2019-04-09 Applied Materials, Inc. Magnetic tunnel junctions suitable for high temperature thermal processing

Patent Citations (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2014030030A (ja) * 2008-06-20 2014-02-13 Canon Anelva Corp スピンバルブ型トンネル磁気抵抗素子の製造方法
JP2012195373A (ja) * 2011-03-15 2012-10-11 Fujitsu Ltd 磁気デバイス及び製造方法
JP2013115412A (ja) * 2011-12-01 2013-06-10 Sony Corp 記憶素子、記憶装置
JP2014022730A (ja) * 2012-07-17 2014-02-03 Samsung Electronics Co Ltd 磁気素子及びその製造方法
US20140145792A1 (en) * 2012-11-27 2014-05-29 Headway Technologies, Inc. Free Layer with Out-of-Plane Anisotropy for Magnetic Device Applications
WO2016189772A1 (ja) * 2015-05-22 2016-12-01 キヤノンアネルバ株式会社 磁気抵抗効果素子
WO2017086481A1 (ja) * 2015-11-18 2017-05-26 国立大学法人東北大学 磁気トンネル接合素子及び磁気メモリ

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