JP2010512004A5 - - Google Patents
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Claims (3)
- 第1導電性タイプ材料から成る基板;
該基板上に形成されたゲート誘電体層と、該ゲート誘電体層上に形成されたデュアル仕事関数ゲート導体層とを含むトランスファゲートデバイス、
該デュアル仕事関数ゲート導体層は、第1導電性タイプ材料から成る第1ドープ領域及び第2導電性タイプ材料から成る第2ドープ領域を含む;
入射する光に応答して電荷キャリヤを捕集するための、前記トランスファゲートデバイスの前記第1ドープ領域に隣接する基板表面に又は該基板表面の下側に形成されたフォトセンシングデバイス;
前記トランスファゲートデバイスの前記第2ドープ領域に隣接する前記基板表面に形成された、第2導電性タイプ材料から成る拡散領域、
該トランスファゲートデバイスは、前記フォトセンシングデバイスと前記拡散領域との間の電荷移動を可能にするチャネル領域を形成している;及び
前記トランスファゲートデバイスの第1導電性タイプ材料から成る前記第1ドープ領域と、前記トランスファゲートデバイスの第2導電性タイプ材料から成る前記第2ドープ領域とを電気的にカップリングするための、前記デュアル仕事関数ゲート導体層の最上部に形成されたシリサイド構造
を含んで成るアクティブピクセルセンサ(APS)セル構造であって、
前記シリサイド構造が、面積寸法で、前記デュアル仕事関数ゲート導体層の面積寸法よりも小さいアクティブピクセルセンサ(APS)セル構造。 - 前記APSセル構造が、アクティブピクセルセンサ(APS)セル構造をそれぞれ含んでいる各ピクセルを有するCMOS画像センサのピクセルアレイに含まれ、そして当該CMOS画像センサが、画像捕獲装置に含まれる、請求項1に記載のAPSセル構造。
- 第1導電性タイプ材料から成る基板を用意すること;
該基板上に形成されたゲート誘電体層及び該ゲート誘電体層上に形成されたデュアル仕事関数ゲート導体層を含むトランスファゲートデバイスを形成すること、
該デュアル仕事関数ゲート導体層は、第1導電性タイプ材料から成る第1ドープ領域及び第2導電性タイプ材料から成る第2ドープ領域を含む;
前記トランスファゲートデバイスの前記第1ドープ領域に隣接する基板表面に又は該基板表面の下側に形成された、入射する光に応答して電荷キャリヤを捕集するための、フォトセンシングデバイスを形成すること;
前記トランスファゲートデバイスの前記第2ドープ領域に隣接する前記基板表面ところに、第2導電性タイプ材料から成る拡散領域を形成すること、
前記トランスファゲートデバイスは、前記フォトセンシングデバイスと前記拡散領域との間の電荷移動を可能にするチャネル領域を形成する;そして
前記トランスファゲートデバイスの第1導電性タイプ材料から成る前記第1ドープ領域と、前記トランスファゲートデバイスの第2導電性タイプ材料から成る前記第2ドープ領域とを電気的にカップリングするための、前記デュアル仕事関数ゲート導体層の最上部にシリサイド構造を形成すること
を含んで成るアクティブピクセルセンサ(APS)セル構造を形成する方法であって、
前記シリサイド構造が、面積寸法で、前記デュアル仕事関数ゲート導体層の面積寸法よりも小さいアクティブピクセルセンサ(APS)セル構造を形成する方法。
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