JP2009545169A - 半導体バッファ構造体内の歪み層 - Google Patents
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Abstract
【選択図】図2B
Description
Claims (70)
- 基板と、
前記基板上に形成された、傾斜部分を含む緩和バッファ層と、
前記緩和バッファ層の前記傾斜部分内部の少なくとも1つの歪み遷移層とを備える、半導体ワークピース。 - 少なくとも1つの前記歪み遷移層が、
前記緩和バッファ層の熱膨張収縮係数と前記基板の熱膨張収縮係数との差分に起因する前記ワークピースの反りの大きさを低減する、請求項1記載のワークピース。 - 少なくとも1つの前記歪み遷移層が、
前記緩和バッファ層の熱膨張収縮係数と前記基板の熱膨張収縮係数との差分に起因するワークピース内の応力の一部に対抗する傾向がある、請求項1記載のワークピース。 - 前記緩和バッファ層が、2〜10μm間の厚さを有する、請求項1記載のワークピース。
- 前記歪み遷移層が、1〜10nm間の厚さを有する、請求項1記載のワークピース。
- 前記歪み遷移層が、6〜8nm間の厚さを有する、請求項1記載のワークピース。
- 前記歪み遷移層が、歪みシリコンを含む、請求項1記載のワークピース。
- 前記歪み遷移層が、歪みシリコンゲルマニウムを含む、請求項1記載のワークピース。
- 前記緩和バッファ層が、シリコン及びゲルマニウムを含む、請求項1記載のワークピース。
- 前記緩和バッファ層内の最高ゲルマニウム濃度が、15%〜25%間である、請求項9記載のワークピース。
- 前記緩和バッファ層の前記傾斜部分内部に1つまたは2つの前記歪み遷移層を備える、請求項10記載のワークピース。
- 前記緩和バッファ層の前記傾斜部分が、
前記基板上に形成された、前記緩和バッファ層の第1の部分と、
前記緩和バッファ層の前記第1の部分の前記基板から遠位の表面上に形成された第1の歪み遷移層と、
前記第1の歪み遷移層上に形成された、前記緩和バッファ層の第2の部分と、を備え、
前記緩和バッファ層の前記第1の部分内部のゲルマニウム濃度が、前記基板から遠位の表面において前記基板に隣接する表面における濃度より高く、
前記緩和バッファ層の前記第2の部分内部のゲルマニウム濃度が、前記第1の歪み遷移層から遠位の表面において前記第1の歪み遷移層に隣接する表面における濃度より高い、請求項10記載のワークピース。 - 前記緩和バッファ層の前記傾斜部分が、さらに、
前記緩和バッファ層の前記第2の部分の、前記第1の歪み遷移層から遠位の表面上に形成される第2の歪み遷移層と、
前記第2の歪み遷移層上に形成される前記緩和バッファ層の第3の部分と、を備え、
前記緩和バッファ層の前記第3の部分内部のゲルマニウム濃度が、前記第2の歪み遷移層から遠位の表面において前記第2の歪み遷移層に隣接する表面における濃度より高い、請求項12記載のワークピース。 - 前記緩和バッファ層内の最高ゲルマニウム濃度が、25%〜35%間である、請求項9記載のワークピース。
- 前記緩和バッファ層の前記傾斜部分内部に2つまたは3つの歪み遷移層を備える、請求項14記載のワークピース。
- 前記緩和バッファ層内の最高ゲルマニウム濃度が、35%〜45%間である、請求項9記載のワークピース。
- 前記緩和バッファ層の前記傾斜部分内部に3つ〜5つの歪み遷移層を備える、請求項16記載のワークピース。
- 前記緩和バッファ層の前記傾斜部分内の少なくとも1つの前記歪み遷移層の前記基板に近位の表面におけるゲルマニウム濃度が、前記歪み遷移層の前記基板から遠位の表面におけるゲルマニウム濃度と同じである、請求項9記載のワークピース。
- 少なくとも1つの前記歪み遷移層が、前記緩和バッファ層の上面付近の貫通転位密度を104/cm2未満に下げるように構成される、請求項1記載のワークピース。
- 少なくとも1つの前記歪み遷移層が、前記緩和バッファ層の上面付近の貫通転位密度を4×103/cm2未満に下げるように構成される、請求項1記載のワークピース。
- 前記緩和バッファ層上に形成された歪み活性層をさらに備える、請求項1記載のワークピース。
- 前記歪み活性層が、シリコンを含む、請求項21記載のワークピース。
- 前記歪み活性層の上面付近の貫通転位密度が、104/cm2未満である、請求項21記載のワークピース。
- 前記歪み活性層の上面付近の貫通転位密度が、4×103/cm2未満である、請求項21記載のワークピース。
- 前記緩和バッファ層が、脆弱領域を備え
前記脆弱領域が、前記ワークピースの分割を容易にするように構成される、請求項1記載のワークピース。 - 前記脆弱領域が、水素でドープされる、請求項25記載のワークピース。
- 基板と、
前記基板上に形成された、傾斜部分を含む緩和バッファ層と、
前記緩和バッファ層の前記傾斜部分内部の少なくとも1つの歪み遷移層とを備える集積回路。 - 基板と、
前記基板上に形成された緩和バッファ層と、
前記緩和バッファ層内部の少なくとも1つの歪み遷移層とを備え、
少なくとも1つの前記歪み遷移層が、前記緩和バッファ層の上面付近の貫通転位密度を104/cm2未満に下げるように構成される半導体ワークピース。 - 前記緩和バッファ層上に形成された歪み活性層をさらに備え、
前記歪み活性層の上面付近の貫通転位密度が、104/cm2未満である、請求項28記載のワークピース。 - 基板を準備する工程と、
前記基板上に緩和バッファ層を堆積する工程と、
前記緩和バッファ層を堆積する間に、前記緩和バッファ層の上面付近の貫通転位密度を104/cm2未満に下げるように構成される少なくとも1つの歪み遷移層を堆積する工程と、を含む半導体ワークピースの製造方法。 - 前記ワークピースを冷却する工程をさらに含み、
少なくとも1つの前記歪み遷移層が、冷却の間に、前記緩和バッファ層と前記基板との熱収縮の差分に起因するワークピースの反りの大きさを低減するように構成される、請求項30記載の方法。 - 前記ワークピースを冷却する工程をさらに含み、
少なくとも1つの前記歪み遷移層が、冷却の間に、前記緩和バッファ層の熱膨張収縮係数と前記基板の熱膨張収縮係数との差分に起因するワークピース内の応力の一部に対抗する傾向がある、請求項30記載の方法。 - 前記緩和バッファ層を堆積する前記工程が、
シリコン及びゲルマニウムをエピタキシャル堆積反応器内で堆積する工程を含む、請求項30記載の方法。 - 少なくとも1つの前記歪み遷移層を堆積する前記工程が、
前記エピタキシャル堆積反応器内でシリコンを堆積する工程を含む、請求項33記載の方法。 - 少なくとも1つの前記歪み遷移層を堆積する前記工程が、
前記エピタキシャル堆積反応器内でシリコン及びゲルマニウムを堆積する工程を含み、
前記ゲルマニウム濃度が、少なくとも1つの前記歪み遷移層において、前記歪み遷移層に隣接する前記緩和バッファ層の表面における濃度よりも低い、請求項33記載の方法。 - 前記緩和バッファ層内の最高ゲルマニウム濃度が、15%〜25%間である、請求項33記載のワークピース。
- 前記緩和バッファ層を堆積する前記工程が、1つまたは2つの前期歪み遷移層を堆積する工程を含む、請求項36記載の方法。
- 前記緩和バッファ層を堆積する前記工程が、
シリコン前駆体及びゲルマニウム前駆体を流すことによって前記緩和バッファ層の第1の部分を堆積する工程と、
前記緩和バッファ層の前記第1の部分の堆積後、前記ゲルマニウム前駆体を流すことを停止して第1の歪み遷移層を堆積する工程と、
前記第1の歪み遷移層の堆積後、前記ゲルマニウム前駆体を流すことを再開して前記緩和バッファ層の第2の部分を堆積する工程と、を含み、
前記緩和バッファ層の前記第1の部分内のゲルマニウム濃度が、前記緩和バッファ層の前記第1の部分が堆積されるにつれて高くなり、
前記緩和バッファ層の前記第2の部分内のゲルマニウム濃度が、前記緩和バッファ層の前記第2の部分が堆積されるにつれて高くなる、請求項36記載の方法。 - 前記緩和バッファ層を堆積する前記工程が、さらに、
前記緩和バッファ層の前記第2の部分の堆積後、前記ゲルマニウム前駆体を流すことを停止して第2の歪み遷移層を堆積する工程と、
前記第2の歪み遷移層の堆積後、前記ゲルマニウム前駆体を流すことを再開して前記緩和バッファ層の第3の部分を堆積する工程とを含み、
前記緩和バッファ層の前記第3の部分内のゲルマニウム濃度が、前記緩和バッファ層の前記第3の部分が堆積されるにつれて高くなる、請求項38記載の方法。 - 前記緩和バッファ層内の最高ゲルマニウム濃度が、25%〜35%間である、請求項33記載のワークピース。
- 前記緩和バッファ層を堆積する前記工程が、2つまたは3つの前記歪み遷移層を堆積する工程を含む、請求項40記載の方法。
- 前記緩和バッファ層内の最高ゲルマニウム濃度が、35%〜45%間である、請求項33記載のワークピース。
- 前記緩和バッファ層を堆積する前記工程が、3つ〜5つの前記歪み遷移層を堆積する工程を含む、請求項40記載の方法。
- 少なくとも1つの前記歪み遷移層が、貫通転位密度を4×103/cm2未満に下げるように構成される、請求項30記載の方法。
- 前記緩和バッファ層上に歪み活性層を堆積する工程をさらに含む、請求項30記載の方法。
- 前記歪み活性層がシリコンを含む、請求項45記載の方法。
- 前記歪み活性層が、104/cm2未満の貫通転位密度を有する、請求項45記載の方法。
- 前記歪み活性層が、4×103/cm2未満の貫通転位密度を有する、請求項45記載の方法。
- 前記歪み活性層を受入れ側基板へ移動する工程をさらに含む、請求項45記載の方法。
- 前記歪み活性層を受入れ側基板へ移動する前記工程が、
前記歪み活性層の堆積後、ワークピースの分割を容易にするように構成される脆弱領域を前記緩和バッファ層内に形成する工程と、
前記歪み活性層の堆積後、受入れ側基板を歪み活性層に関連づけて複合構造体を形成する工程と、
前記複合構造体を、前記緩和バッファ層内の前記脆弱領域において分割する工程を含む、請求項49記載の方法。 - 前記緩和バッファ層内に前記脆弱領域を形成する前記工程が、水素を埋め込む工程を含む、請求項50記載の方法。
- 前記緩和バッファ層を堆積する前記工程が、
少なくとも1つの前記歪み遷移層の底面付近の前記緩和バッファ層内に濃縮ゲルマニウムを堆積する工程と、
少なくとも1つの前記歪み遷移層の上面付近の前記緩和バッファ層内に前記濃縮ゲルマニウムを堆積する工程と、を含む、請求項33記載の方法。 - 請求項30記載の方法により製造される集積回路。
- 半導体ワークピースの製造方法であって、
基板を準備する工程と、
シリコン前駆体及びゲルマニウム前駆体を流しながら前記緩和バッファ層の成長する第1の部分内のゲルマニウム濃度を高めることによって前記基板上に前記緩和バッファ層の前記第1の部分を堆積する工程と、
前記緩和バッファ層の前記第1の部分の堆積後、前記ゲルマニウム前駆体を流すことを停止すると同時に前記シリコン前駆体を流し続ける工程と、
前記ゲルマニウム前駆体を流すことを停止した後、前記ゲルマニウム前駆体を流すことを再開しかつ前記緩和バッファ層の成長する第2の部分内のゲルマニウム濃度を高めることによって前記緩和バッファ層の前記第2の部分を堆積する工程を含む製造方法。 - 前記緩和バッファ層の成長する前記第1の部分内の前記ゲルマニウム濃度を高める前記工程が、前記シリコン前駆体を流すことを減らす工程を含む、請求項54記載の方法。
- 前記緩和バッファ層の成長する前記第1の部分内の前記ゲルマニウム濃度を高める前記工程が、前記ゲルマニウム前駆体を流すことを増やす工程を含む、請求項54記載の方法。
- 前記ゲルマニウム前駆体を流すことを停止する持続時間が、0.1〜10秒間である、請求項54記載の方法。
- 前記ゲルマニウム前駆体を流すことを停止する持続時間が、0.5〜5秒間である、請求項54記載の方法。
- 前記ゲルマニウム前駆体を流すことを停止する持続時間が、前記ワークピースを保持する回転可能なサセプタが少なくとも1回転する時間である、請求項54記載の方法。
- 前記ゲルマニウム前駆体を流すことを停止する前記工程が、歪みシリコンを堆積する工程を含む、請求項54記載の方法。
- 堆積される前記歪みシリコンの厚さが、1〜10nm間である、請求項60記載の方法。
- 堆積される前記歪みシリコンの厚さが、6〜8nm間である、請求項60記載の方法。
- 前記ゲルマニウム前駆体を流すことを停止する前記工程が、歪みシリコンゲルマニウムを堆積する工程を含む、請求項54記載の方法。
- 前記緩和バッファ層上に歪み活性層を堆積する工程をさらに含む、請求項54記載の方法。
- 前記歪み活性層が、シリコンを含む、請求項64記載の方法。
- 前記歪み活性層を受入れ側基板へ移動する工程をさらに含む、請求項64記載の方法。
- 前記歪み活性層を前記受入れ側基板へ移動する前記工程が、
前記歪み活性層を堆積する前に、前記ワークピースの分割を容易にするように構成される脆弱領域を前記緩和バッファ層内に生成する工程と、
前記歪み活性層の堆積後、前記受入れ側基板を前記歪み活性層に関連づけて複合構造体を形成する工程と、
前記複合構造体を、前記緩和バッファ層内の前記脆弱領域において分割する工程を含む、請求項66記載の方法。 - 前記緩和バッファ層内に前記脆弱領域を生成する前記工程が、水素を埋め込む工程を含む、請求項67記載の方法。
- 前記緩和バッファ層の前記第2の部分を堆積する前記工程が、前記歪み遷移層の底面に近接する前記緩和バッファ層の前記第1の部分内のゲルマニウム濃度が、前記歪み遷移層の上面に近接する前記緩和バッファ層の前記第2の部分内のゲルマニウム濃度と同じであるようにゲルマニウム前駆体を流す工程を含む、請求項54記載の方法。
- 請求項54記載の方法により製造される集積回路。
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