[go: up one dir, main page]
More Web Proxy on the site http://driver.im/

JP2009177161A - 絶縁膜の形成方法 - Google Patents

絶縁膜の形成方法 Download PDF

Info

Publication number
JP2009177161A
JP2009177161A JP2008327944A JP2008327944A JP2009177161A JP 2009177161 A JP2009177161 A JP 2009177161A JP 2008327944 A JP2008327944 A JP 2008327944A JP 2008327944 A JP2008327944 A JP 2008327944A JP 2009177161 A JP2009177161 A JP 2009177161A
Authority
JP
Japan
Prior art keywords
film
silicon
metal
nitrogen
atoms
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2008327944A
Other languages
English (en)
Inventor
Yusuke Fukuchi
祐介 福地
Naotake Kitano
尚武 北野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Canon Anelva Corp
Canon Inc
Original Assignee
Canon Anelva Corp
Canon Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Canon Anelva Corp, Canon Inc filed Critical Canon Anelva Corp
Priority to JP2008327944A priority Critical patent/JP2009177161A/ja
Publication of JP2009177161A publication Critical patent/JP2009177161A/ja
Pending legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02142Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing silicon and at least one metal element, e.g. metal silicate based insulators or metal silicon oxynitrides
    • H01L21/02148Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing silicon and at least one metal element, e.g. metal silicate based insulators or metal silicon oxynitrides the material containing hafnium, e.g. HfSiOx or HfSiON
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02142Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing silicon and at least one metal element, e.g. metal silicate based insulators or metal silicon oxynitrides
    • H01L21/02159Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing silicon and at least one metal element, e.g. metal silicate based insulators or metal silicon oxynitrides the material containing zirconium, e.g. ZrSiOx
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/02227Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process
    • H01L21/02247Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by nitridation, e.g. nitridation of the substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/02227Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process
    • H01L21/02252Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by plasma treatment, e.g. plasma oxidation of the substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02296Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02318Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment
    • H01L21/02337Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour
    • H01L21/0234Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment treatment by exposure to a gas or vapour treatment by exposure to a plasma
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/28Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
    • H01L21/28008Making conductor-insulator-semiconductor electrodes
    • H01L21/28017Making conductor-insulator-semiconductor electrodes the insulator being formed after the semiconductor body, the semiconductor being silicon
    • H01L21/28158Making the insulator
    • H01L21/28167Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation
    • H01L21/28194Making the insulator on single crystalline silicon, e.g. using a liquid, i.e. chemical oxidation by deposition, e.g. evaporation, ALD, CVD, sputtering, laser deposition
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/314Inorganic layers
    • H01L21/3143Inorganic layers composed of alternated layers or of mixtures of nitrides and oxides or of oxinitrides, e.g. formation of oxinitride by oxidation of nitride layers
    • H01L21/3145Inorganic layers composed of alternated layers or of mixtures of nitrides and oxides or of oxinitrides, e.g. formation of oxinitride by oxidation of nitride layers formed by deposition from a gas or vapour
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/314Inorganic layers
    • H01L21/316Inorganic layers composed of oxides or glassy oxides or oxide based glass
    • H01L21/31604Deposition from a gas or vapour
    • H01L21/31641Deposition of Zirconium oxides, e.g. ZrO2
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/31Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
    • H01L21/314Inorganic layers
    • H01L21/316Inorganic layers composed of oxides or glassy oxides or oxide based glass
    • H01L21/31604Deposition from a gas or vapour
    • H01L21/31645Deposition of Hafnium oxides, e.g. HfO2
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02123Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
    • H01L21/02126Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC
    • H01L21/0214Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material containing Si, O, and at least one of H, N, C, F, or other non-metal elements, e.g. SiOC, SiOC:H or SiONC the material being a silicon oxynitride, e.g. SiON or SiON:H
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02109Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates
    • H01L21/02112Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer
    • H01L21/02172Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing at least one metal element, e.g. metal oxides, metal nitrides, metal oxynitrides or metal carbides
    • H01L21/02175Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing at least one metal element, e.g. metal oxides, metal nitrides, metal oxynitrides or metal carbides characterised by the metal
    • H01L21/02181Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing at least one metal element, e.g. metal oxides, metal nitrides, metal oxynitrides or metal carbides characterised by the metal the material containing hafnium, e.g. HfO2
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02225Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
    • H01L21/02227Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process
    • H01L21/0223Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate
    • H01L21/02233Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate of the semiconductor substrate or a semiconductor layer
    • H01L21/02236Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate of the semiconductor substrate or a semiconductor layer group IV semiconductor
    • H01L21/02238Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a process other than a deposition process formation by oxidation, e.g. oxidation of the substrate of the semiconductor substrate or a semiconductor layer group IV semiconductor silicon in uncombined form, i.e. pure silicon
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/02104Forming layers
    • H01L21/02107Forming insulating materials on a substrate
    • H01L21/02296Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer
    • H01L21/02318Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment
    • H01L21/02321Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer
    • H01L21/02323Forming insulating materials on a substrate characterised by the treatment performed before or after the formation of the layer post-treatment introduction of substances into an already existing insulating layer introduction of oxygen

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Power Engineering (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Plasma & Fusion (AREA)
  • Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • General Chemical & Material Sciences (AREA)
  • Formation Of Insulating Films (AREA)
  • Insulated Gate Type Field-Effect Transistor (AREA)
  • Physical Vapour Deposition (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

【課題】高誘電率ゲート絶縁膜としての使用に適し、高誘電率窒化金属シリケート膜を含んでなる絶縁膜を形成する。
【解決手段】金属原子及びシリコン原子が酸化反応を生じ難い雰囲気中にてスパッタ法によりシリコン基体101上に金属及びシリコンからなる膜102を堆積する第1の工程と、膜102を窒素プラズマを用いて窒化して窒素、金属及びシリコンからなる膜103を形成する第2の工程と、膜103を酸素プラズマを用いて酸化して窒化金属シリケート膜104を形成する第3の工程とを含む。第1の工程の終了から第2の工程の開始までの間、膜102を、その酸化反応が生じ難い雰囲気中に保持する。第3の工程により、膜104の下のシリコン基体101の表層部を酸化してシリコン酸化膜105を形成する。金属は、少なくともハフニウム及びジルコニウムのうちのいずれかを含む。
【選択図】図1

Description

本発明は、絶縁膜の形成方法に関するものであり、とくに半導体装置における高誘電率ゲート絶縁膜としての使用に適する窒化金属シリケートを含む絶縁膜の形成方法に関する。
MOS(Metal Oxide Semiconductor)型トランジスタなどの半導体装置は、動作速度の高速化を達成する為、チャンネル長の縮小が進められてきた。しかし、チャンネル長を縮小しすぎるとゲート絶縁膜の静電容量が低下し、トランジスタのスイッチング動作ができなくなる。このため、ゲート絶縁膜を薄膜化することで、トランジスタのスイッチング動作が可能な静電容量を得てきた。従来、MOS型トランジスタのゲート絶縁膜の材料としては、容易な製造工程で良好な界面特性を得る事が可能なシリコン酸化膜(SiO)が用いられてきた。しかし、ゲート絶縁膜の膜厚が数nm程度にまで薄くなるにつれ、トンネル電流によるゲートリークが大量に発生するようになり、消費電力増大が問題となってきている。この問題を克服する手段として、SiOの比誘電率ε=3.9よりも高い比誘電率を有する材料を用いてゲート絶縁膜を形成する方法が提案されている。このような材料からなる絶縁膜は高誘電率絶縁膜(High−k絶縁膜)と呼ばれている。High−k絶縁膜では、比誘電率が高いほど、シリコン酸化膜と同等の静電容量を得るのに必要な膜厚を厚くすることが可能となる。これによりリーク電流の増加を抑制することが可能となる。
High−k絶縁膜の材料の候補としては、例えばZrOやHfOなどの金属酸化物が挙げられている。従来、このような金属酸化物を基体の表面上に堆積する方法として、特開2004−140292号公報(特許文献1)に記載の有機金属化学気相堆積(MOCVD)法が知られている。MOCVD法では、金属錯体原料を原料槽に入れてヒーターで加熱して液体状態にし、キャリアガスを原料槽内に流入させることにより、原料を気化して反応室へと運ぶ。反応室に運ばれた原料は加熱された基体の表面上に堆積され、これにより成膜が行われる。
しかし、MOCVD法によって成膜された膜は、有機原料に由来した炭素や水素などの不純物を多く含む膜である。そのような不純物の影響により、MOCVD法で成膜された膜はリーク電流が多く発生しやすいという問題を有していた。MOCVD法のような原料由来の不純物を含むことが少ない金属酸化物を基体に堆積する別の方法として、スパッタ法が知られている。スパッタ法ではターゲット表面に、例えばプラズマによってイオン化したArなどの希ガスを衝突させることで、ターゲットを構成する原子を弾き飛ばし、それを基体表面に堆積させる。このためMOCVDに比べ堆積した膜中の不純物の含有量が少ない。また異なる元素からなる複数のターゲットを用いてスパッタを行うことにより、様々な組成の膜を容易に形成することが可能である。例えば、金属からなるターゲットとSi(シリコン)からなるターゲットとを用い、それらのターゲットを同時にスパッタすることで、金属及びシリコンからなる膜が堆積される。そのような膜を酸化する事で金属シリケート膜の形成が容易に可能となる。
図5を用いて、スパッタ法を適用した従来のHigh−k絶縁膜の製造方法について説明する。ここで、201は単結晶シリコンなどからなる基体、202はシリコン酸化膜、203は金属及びシリコンからなる膜、204は金属シリケート膜、205は窒化金属シリケート膜である。
図5(a)に示す工程において、まず公知のRCA洗浄法などにより基体201の表面の汚染物などを除去し、基体201の表面にシリコン原子を露出させる。
次に、図5(b)に示す工程では、基体201の表面を酸化し、シリコン酸化膜202を形成する。なお、基体201を酸化する方法は、熱酸化法及びラジカル酸化法など良好なシリコン界面が得られるものであればいかなる方法であっても良い。
次に、図5(c)に示す工程において、金属からなるターゲットとシリコンからなるターゲットとを用いたスパッタを行うことによって、シリコン酸化膜202の表面に、金属とシリコンとからなる膜203を堆積する。
さらに、図5(d)に示す工程では、酸素ラジカルによって金属とシリコンとからなる膜203を酸化することで、金属シリケート膜204を形成する。なお、金属及びシリコンからなる膜203の酸化は、熱酸化法ではなく、低温で酸化が可能なラジカル酸化法で行うことができる。一般に金属酸化膜や金属シリケート膜はシリコン酸化膜に比べ熱的安定性が低い。高温で酸化処理が行われる熱酸化法では、アモルファス状態である金属シリケート膜が結晶化する虞がある。結晶化が生じた金属シリケート膜はリーク電流が発生しやすい。そこで、低温での処理が可能なラジカル酸化が好適である。酸素ラジカルを発生する手段としては、プラズマ励起、或いは光励起など、活性な酸素ラジカルを生成できるものであれば、いかなる発生方法を用いても良い。或いは、スパッタを行う際、酸素などの酸化反応性ガスを導入しながらスパッタを行う、所謂リアクティブスパッタを行ってもよい。この場合、ターゲットからスパッタされた原子が酸化され、酸化物として基体上に堆積されるため、スパッタ後の酸化工程を省略することが可能となる。
次に、図5(e)に示す工程において、金属シリケート膜204の窒化を行い、窒化金属シリケート膜205を形成する。金属シリケート膜204を窒化することにより、熱的安定性が改善され、またゲート絶縁膜の上に形成される電極からの不純物の拡散を抑えることが可能となる。金属シリケート膜204を窒化する場合、窒素プラズマを用いて窒化を行うことができる。窒素プラズマを用いることで、熱窒化に比べ低い温度で金属シリケート膜の窒化を行うことができる。また、熱窒化を行う場合には、窒素原子が基体201の表面の近傍すなわちシリコンとの界面の近傍にまで拡散し、チャンネル移動度の低下などの性能劣化を引き起こす虞がある。これに対し、プラズマ窒化では、シリケート膜の表面近傍のみを選択的に窒化することが可能な為、そのような劣化を引き起こし難い。
スパッタ法を適用した従来のHigh−k絶縁膜製造の他の例について、図6を用いて説明する。
図6(a)に示す工程において、まず公知のRCA洗浄法などにより基体201の表面の汚染物などを除去し、基体201の表面にシリコン原子を露出させる。
次に、図6(b)に示す工程で、金属からなるターゲットとシリコンからなるターゲットとを用いたスパッタを行うことによって、基体201の表面に、金属とシリコンとからなる膜203を堆積する。
さらに、図6(c)に示す工程では、金属およびシリコンからなる膜203を酸化することで、金属シリケート膜204を形成する。このとき、酸化種の一部が基体201に到達することで基体の表層部のシリコンを酸化し、基体201と金属シリケート膜204との間にシリコン酸化膜202が形成される。
さらに図6(d)に示す工程で、金属シリケート膜204の窒化を行い、窒化金属シリケート膜205を形成する。
これによって、図5で説明した方法により得られるものと同じような構造を有するHigh−k絶縁膜を形成することができる。
一方、特開平11−168096号公報(特許文献2)には、高誘電酸化膜の特性を劣化させることなくシリコン層上に直接、高誘電性酸化膜を形成する方法が開示されている。ここでは、シリコン層上に高誘電窒化膜を形成した後、当該高誘電窒化膜を酸化して高誘電酸化膜に変化させている。しかし、これは、高誘電酸化膜を形成するものであり、窒化金属シリケート膜を形成するものではない。
特開2004−140292号公報 特開平11−168096号公報
ところで、金属及びシリコンからなる膜中における酸素の拡散は、非常に速く、図5及び図6に示す方法では、金属及びシリコンからなる膜を酸化する工程において、酸素が金属及びシリコンからなる膜を突き抜けて下地にまで拡散しやすい。それにより下地のシリコンからなる基体が酸化されシリコン酸化膜及びこれを含む絶縁膜の膜厚増加(増膜)を引き起こし、設計どおりの各膜の膜厚を得るのが困難であるという問題があった。このように、従来は、シリコン酸化膜の膜厚制御性ひいてはそれを含む絶縁膜の膜厚制御性が悪かったので、それに対する対策が望まれていた。
さらに、金属シリケート膜の窒化を行った場合に生ずる問題点について以下に述べる。
金属材料としてHf(ハフニウム)を用いて形成したHfシリケート膜をプラズマ窒化したときの窒素原子濃度を、XPS(X線光電子分光)により測定した。このときのHfシリケート膜中に含まれるHf原子とSi原子との組成比は、1:1であった。比較として、同じ窒化条件でシリコン酸化膜を窒化したものについても、同様にして窒素原子濃度の測定を行った。その結果、シリコン酸化膜中に導入された窒素原子の面密度が6.5x1015atoms/cmであったのに対し、Hfシリケート膜中に導入された窒素原子の面密度は1.2x1015atoms/cmであった。このように、同じ条件で窒化したにも拘わらず、Hfシリケート膜の場合は、シリコン酸化膜の場合よりも導入された窒素原子の量が少なかった。Hfシリケート膜中への窒素原子の導入量を増やすため、窒化時間を長くするなど窒化条件の検討を行ったが、シリコン酸化膜に対する窒化に比べて窒素原子が膜中へ導入し難いことが分かった。このような結果は、金属としてHfを用いた金属シリケート膜の場合だけに見られるものではなく、Zrなど他の金属を用いた金属シリケート膜の場合についても同様であった。また、窒化方法をプラズマ窒化法の代わりに熱窒化法で行っても同様の結果であった。さらに、シリケート膜中のSi原子に対する金属原子の組成比が高いほど、窒化しにくいということが分かった。
このように、従来、金属の組成比が高いシリケート膜を高濃度に窒化するのが困難であったので、それに対する種々の対策が望まれていた。
本発明は、以上のような技術的課題に鑑みて、高誘電率ゲート絶縁膜としての使用に適し、高誘電率窒化金属シリケート膜を含んでなる絶縁膜を形成することを目的とするものである。
本発明により、上記の目的を達成するものとして、
シリコン基体の上に窒化金属シリケートを含む絶縁膜を形成する絶縁膜の形成方法であって、
前記シリコン基体の上に金属及びシリコンからなる膜を、非酸化雰囲気中でスパッタ法により堆積する第1の工程と、
前記金属及びシリコンからなる膜を窒化して窒素、金属及びシリコンからなる膜を形成する第2の工程と、
前記窒素、金属及びシリコンからなる膜を酸化して窒化金属シリケート膜を形成する第3の工程と、を有することを特徴とする絶縁膜の形成方法、
が提供される。
本発明においては、好ましくは、前記金属は、少なくともハフニウム及びジルコニウムのうちのいずれかを含む。
本発明においては、好ましくは、前記第1の工程の終了から前記第2の工程の開始までの間、前記金属及びシリコンからなる膜を、その酸化反応が生じ難い雰囲気(非酸化雰囲気)中に保持する。本発明においては、好ましくは、前記第2の工程で、少なくとも窒素原子を含むプラズマを用いて、前記金属及びシリコンからなる膜を窒化する。本発明においては、好ましくは、前記第3の工程で、少なくとも酸素原子を含むプラズマを用いて、前記窒素、金属及びシリコンからなる膜を酸化する。本発明においては、好ましくは、前記第3の工程で、マイクロ波プラズマ源を用いて、前記窒素、金属及びシリコンからなる膜を酸化する。
本発明においては、好ましくは、前記第3の工程により、前記窒素、金属及びシリコンからなる膜の下の前記シリコン基体の表層部を酸化してシリコン酸化膜を形成する。本発明においては、好ましくは、前記第1の工程において、前記シリコン基体の表層部を酸化してシリコン酸化膜を形成し、該シリコン酸化膜上に前記金属及びシリコンからなる膜を堆積する。
また、本発明により、上記の目的を達成するものとして、
シリコン基体の上に窒化金属シリケートを含む絶縁膜を形成する絶縁膜の形成方法であって、
前記シリコン基体の上に窒素、金属及びシリコンからなる膜を、非酸化雰囲気中で、少なくとも窒素原子を含むガスを用いたリアクティブスパッタ法により堆積する第1の工程と、
前記窒素、金属及びシリコンからなる膜を酸化して窒化金属シリケート膜を形成する第2の工程と、を有することを特徴とする絶縁膜の形成方法、
が提供される。
本発明においては、好ましくは、前記金属は、少なくともハフニウム及びジルコニウムのうちのいずれかを含む。
本発明においては、好ましくは、前記第2の工程で、少なくとも酸素原子を含むプラズマを用いて、前記窒素、金属及びシリコンからなる膜を酸化する。本発明においては、好ましくは、前記第2の工程で、マイクロ波プラズマ源を用いて、前記窒素、金属及びシリコンからなる膜を酸化する。
本発明においては、好ましくは、前記第2の工程により、前記窒素、金属及びシリコンからなる膜の下の前記シリコン基体の表層部を酸化してシリコン酸化膜を形成する。本発明においては、好ましくは、前記第1の工程において、前記シリコン基体の表層部を酸化してシリコン酸化膜を形成し、該シリコン酸化膜上に前記窒素、金属及びシリコンからなる膜を堆積する。
本発明によれば、高誘電率ゲート絶縁膜としての使用に適し、熱的安定性に優れ高い比誘電率を有する窒化金属シリケート膜を含んでなる絶縁膜の形成が可能となる。
以下、図面を参照しながら、本発明による絶縁膜の形成方法の実施形態を詳細に説明する。全図にわたって、同一または類似の部材または部分には、同様な参照符号が付されている。これらの実施形態の説明により、本発明の特徴および利点が一層明らかになるであろう。
(実施形態1)
図1は、本発明の第一の実施形態を説明するための工程断面図である。ここで、101はシリコン基体であり、少なくともその表面にはシリコン原子が露出している。102は金属及びシリコンからなる膜、103は窒化された金属及びシリコンからなる膜すなわち窒素、金属及びシリコンからなる膜、104は窒化金属シリケート膜、105はシリコン酸化膜である。絶縁膜は、窒化金属シリケート膜104とシリコン酸化膜105とにより形成される。ここで、シリコン酸化膜105が存在するこことで、界面特性が向上し、絶縁膜の電気的絶縁性が高められる。但し、シリコン酸化膜105は、窒化金属シリケート膜104より比誘電率が小さいので、シリコン酸化膜105の膜厚は、窒化金属シリケート膜104の膜厚より小さくするのが好ましい。例えば、窒化金属シリケート膜104の膜厚は1nm〜5nmが好ましく、1.5nm〜3nmがより好ましい。また、シリコン酸化膜105の膜厚は0.5nm〜2nmが好ましく、0.5nm〜1.5nmがより好ましい。
シリコン基体101は、例えば(100)面方位を有する単結晶シリコンからなり、さらにリンがドープされ、抵抗値が0.1Ω・cmから10Ω・cmまでの範囲に制御されたもの等を使用することができる。なお、本発明においては、シリコン基体101は、上記の例に限らず、膜が堆積される表面にシリコン原子が露出しているものであれば、上記以外の異なる面方位、ドーパント及び抵抗値を有するものであっても良い。また、例えば、シリコン以外の材料からなる基材上に、エピタキシャル法によりシリコンを成長させた物などであっても良い。
図1(a)の工程では、まず公知のRCA洗浄法などにより、シリコン基体101の表面の金属、有機物、パーティクル及び自然酸化膜等を除去し、清浄なシリコン原子を表面に露出させる。
次に、図1(b)の工程(第1の工程)において、シリコン基体101の表面上に、スパッタ法によって金属及びシリコンからなる膜102を、金属原子及びシリコン原子が酸化反応を生じ難い雰囲気(非酸化雰囲気)中において堆積する。
本発明において、非酸化性雰囲気とは、Si基体101が酸化しない雰囲気を意味する。非酸化性雰囲気は、希ガスであるHe,Ne,Ar,Kr,Xe、および反応性ガスであるN2のうち少なくとも1つから構成されることが好ましい。また、非酸化性雰囲気の酸素分圧は1×10−5Pa以下であることが好ましい。
金属及びシリコンからなる膜102に含まれる金属原子とシリコン原子の組成比は、絶縁膜化した後の比誘電率値が希望する値となるように、適宜変えることが可能である。金属及びシリコンからなる膜102に含まれるシリコン原子の濃度(含有率)は、10原子%以上であるのが良い。このように金属原子とシリコン原子との合計に対するシリコン原子の割合を10原子%以上とすることで、膜の耐熱性が向上し膜中の結晶成長を抑制することが可能となる。更に、後述の窒化時に膜中に取り込まれる窒素の量を多くすることが可能となる。尚、この工程で金属原子とシリコン原子とを堆積する間、金属原子とシリコン原子との組成比は必ずしも一定である必要はなく、深さ方向で組成比が変化したものであっても良い。
堆積させる金属としては、例えばAl、Sr、Ba、Sc、Y、Ti、Zr、Hf及びTaなどの他、La及びCeなどのランタノイド系金属などが挙げられる。ハフニウム(Hf)及びジルコニウム(Zr)の少なくとも一方を選ぶのが好ましい。Hf或いはZrは、絶縁膜化したときに高い比誘電率が得られる上に、熱的安定性にも優れている。また、堆積させる金属は、単一元素のみからなるもの及び複数の金属元素からなるもののいずれであっても良い。また、異なる元素の金属膜を積層させたものであっても良い。金属及びシリコンからなる膜102を堆積する間及び堆積後においては、金属原子及びシリコン原子が酸化反応を生じにくくするため、例えば雰囲気の酸素分圧を十分低くするのが好ましい。具体的には酸素分圧は1×10−5Pa以下であることが好ましい。すなわち、第1の工程の終了から後述の第2の工程の開始までの間、金属及びシリコンからなる膜を、その酸化反応が生じ難い雰囲気中に保持するのが好ましい。
次に図1(c)の工程(第2の工程)において、金属及びシリコンからなる膜102の窒化を行い、窒素、金属及びシリコンからなる膜103を形成する。酸化されていない状態の金属及びシリコンは容易に窒化され、従来のように酸化された状態の金属シリケート膜を窒化する場合に比べ、高濃度に窒素原子を膜中に導入することが可能となる。例えば、窒素、金属及びシリコンからなる膜103における窒素原子の濃度(含有率)を1原子%以上25原子%以下とすることができる。
なお、図1(b)の工程で堆積した金属及びシリコンからなる膜102を、窒化処理を行う迄の間に酸化されることがない様に、酸化反応の生じ難い雰囲気中に保持するのが好ましい。すなわち、第1の工程の終了から第2の工程の開始までの間、金属及びシリコンからなる膜102を、その酸化反応が生じ難い雰囲気中に保持するのが好ましい。例えば、スパッタ処理を行う処理装置と窒化処理を行う処理装置との間を直接、或いは高真空に減圧されたロードロック室を介して接続する。これにより、金属及びシリコンからなる膜102が形成されたシリコン基体101を、酸化雰囲気に曝されないようにして、基体搬送手段により搬送することができる。或いは、スパッタ処理と窒化処理を同じ処理装置内で連続的に行い、金属及びシリコンからなる膜102が酸化雰囲気に曝されないようにするのが好ましい。或いは、スパッタ処理の終了後にシリコン基体101を処理装置外に搬出する場合は、希ガスや窒素ガスなどの不活性ガスを十分満たした経路のみを通過させるようにしても良い。これらの例に限らず、金属及びシリコンからなる膜102が酸化されないものであれば、いかなる手段を用いても良い。
金属及びシリコンからなる膜102を窒化する方法は、熱窒化法及びプラズマ窒化法など、いかなる方法であってもよいが、プラズマ窒化が好ましい。高温の熱処理で窒化した場合、膜が相分離して金属シリサイドといった金属結晶を膜中に形成し、不均質化する虞がある。これに対し、プラズマ窒化では、低温で金属及びシリコンからなる膜102を窒化することが可能であるため、均一なアモルファス状態を維持することができる。プラズマにより窒化を行う場合、プラズマ源としては、ICP、ヘリコン、ECR、マイクロ波及び表面波などのいかなる方式のものをも用いることが可能である。窒化に用いる窒素含有ガスとしては、N、NH、N、ヘキサメチルジシラザン(HMDS)などが挙げられる。また、窒素含有ガスには、He、Ne、Ar、Kr及びXeなどの希ガスを添加してもよい。
次に、図1の(d)に示す工程(第3の工程)において、窒素、金属及びシリコンからなる膜103の酸化を行う。これにより、窒化処理によって完全に窒化されていなかった膜103中の金属原子或いはシリコン原子が酸化される。また、金属原子及びシリコン原子と結合している窒素原子の一部が酸素原子と置換される反応、或いは酸素原子が金属−窒素結合間及びシリコン−窒素結合間などに挿入される反応などによっても、酸化が行われる。このような酸化反応により、窒化金属シリケート膜104が形成される。
また、酸化を行っている間、酸素の一部は拡散によって膜103を突き抜け、その下のシリコン基体101の表層部を酸化してシリコン酸化膜105を形成する。
従来の方法では、酸化処理は窒化処理の前に行われ、金属及びシリコンからなる膜中において酸素の拡散は大きいため、酸化処理の際に酸素の突き抜けが起こりやすい。このため、下地のシリコン基体が過剰に酸化されてシリコン酸化膜の急激な増膜を引き起こしやすく、薄い膜厚のシリコン酸化膜を制御性良く形成するのが困難であった。
これに対して、本発明では、酸化処理は窒化処理の後に行われ、窒化された金属及びシリコンからなる膜103中における酸素の拡散は従来の窒化されていない金属及びシリコンからなる膜に比べ小さい。このため、本発明では、酸化処理に際して酸素が下地へと急激に突き抜けるのが抑制される。かくして、本発明は、従来の方法に比べ、下地のシリコン基体101の表層部を酸化して形成されるシリコン酸化膜105の膜厚制御性に優れている。
窒化された金属及びシリコンからなる膜103を酸化する方法としては、熱酸化法及びプラズマ酸化など、いかなる方法であってもよいが、プラズマ酸化を用いるのが好ましい。低温で酸化可能なプラズマ酸化を用いることで、形成される窒化金属シリケート膜104中の結晶成長を抑制することが可能となる。プラズマにより酸化を行う場合、プラズマ源としては、40MHz以上の高周波を用いるプラズマを使用することが好ましく、さらに、例えば表面波干渉プラズマなどのマイクロ波プラズマ源を用いることが特に好ましい。マイクロ波プラズマは電子温度がおよそ2eV以下と低く、またマイクロ波プラズマをプラズマ源とする処理装置では、基板へのイオン入射エネルギーを低くすることができる。このような低電子温度のプラズマ源の装置で酸化を行うことで下地のシリコン基体101の過剰な酸化を抑制しながら金属及びシリコンからなる膜103の酸化を行なうことができる。なお、酸化に用いられる酸素含有ガスとしては、例えばO、HO、NO、NO、NOなどが挙げられる。また、これらのガスを混合したものや、酸素含有ガスをH、N、He、Ne、Ar、Ke及びXeなどの希ガスで希釈したものであっても良い。
かくして形成される窒化金属シリケート膜104は、高い窒素濃度(窒素含有率)及び高い比誘電率を有するとともに、熱的安定性に優れており、高誘電率ゲート絶縁膜として用いるのに好適である。例えば、窒素濃度(含有率)を1原子%以上20原子%以下とすることができる。また、比誘電率を10以上20以下とすることができる。また、本発明による絶縁膜の形成方法は、従来の方法に比べ膜厚とくにシリコン酸化膜の膜厚の制御性が高いという特徴をもつ。
(実施形態2)
次に、本発明の第二の実施形態について、図2を参照して詳細に説明する。この図において、図1のものと同様な部分または部材には、同一の符号が付されており、ここではその説明を省略する。
図2(a)の工程では、図1(a)の工程と同様にして、清浄なシリコン原子を表面に露出させる。
次に、図2(b)の工程において、シリコン基体101の表層部のシリコンを酸化してシリコン酸化膜105を形成する。これにより、シリコン基体101のシリコンと絶縁膜を構成するシリコン酸化膜105との良好な界面を得る。シリコン基体101の表層部を酸化する方法としては、熱酸化法など、良好なシリコン界面が得られる手法が挙げられる。例えば、熱酸化法としては、ホットウォール熱酸化炉、或いは赤外ランプ急速熱酸化装置などによる酸化が適用可能である。熱酸化炉で酸化を行う場合、ドライ酸化や、酸素ガスをアルゴンガス或いは窒素ガスなどのキャリアガスと共に純水中を通したガスによって酸化を行うウェット酸化のいずれの方法を用いても良い。または、酸素ガスと水素ガスとを用いた燃焼酸化(パイロジェニック)法などであってもよい。上記の例以外に、酸化に用いられる酸素含有ガスとしては、O、HO、NO、NO及びNOなどが挙げられる。
次に、図2(c)の工程において、シリコン酸化膜105上に、スパッタ法によって金属及びシリコンからなる膜102を、金属原子及びシリコン原子が酸化反応を生じ難い雰囲気中において堆積する。これは、シリコン酸化膜105が介在していることを除いて、図1(b)の工程と同様である。
尚、図2(b)の工程及び図2(c)の工程により、本発明の第1の工程が構成される。
次に、図2(d)の工程(第2の工程)において、図1(c)の工程と同様にして、金属及びシリコンからなる膜102の窒化を行い、窒素、金属及びシリコンからなる膜103を形成する。
次に、図2(e)に示す工程(第3の工程)において、図1(d)の工程と同様にして、窒化された金属及びシリコンからなる膜103の酸化を行い、窒化金属シリケート膜104を形成する。
また、酸化を行っている間、酸素の一部は拡散によって膜103を突き抜ける。しかしシリコン酸化膜105とシリコン基体101との界面にまでは達しない。
酸化膜換算膜厚(EOT)が1nm以下を達成する為には、実施形態1が最適である。しかし、EOTが1nmより大きい場合には、本実施形態2のように、例えば急速熱酸化法により、1nm程度のシリコン酸化膜を形成してから金属及びシリコンからなる膜を成膜し、これを窒化したのち酸化することが好ましい。これは、シリコンとシリコン酸化膜との良好な界面を得ることができるからである。すなわち、前述のようにシリコンと熱酸化により形成されたシリコン酸化膜との界面は良好である。さらにこのようにして形成されたシリコン酸化膜は膜質も良く緻密であり酸素を通過させにくいため、1nm程度の酸化膜を増膜させることがないので、シリコンとシリコン酸化膜との界面は良好に保持される。
(実施形態3)
次に、本発明の第三の実施形態について、図3を参照して詳細に説明する。この図において、図1または図2のものと同様な部分または部材には、同一の符号が付されており、ここではその説明を省略する。
図3(a)の工程では、図1(a)または図2(a)の工程と同様にして、清浄なシリコン原子を表面に露出させる。
次に、図3(b)の工程(第1の工程)において、シリコン基体101上に窒化された金属及びシリコンからなる膜すなわち窒素、金属及びシリコンからなる膜103を堆積する。ここでは、金属原子及びシリコン原子が酸化反応を生じ難い雰囲気中で、少なくとも窒素原子を含む反応ガスを用いたリアクティブスパッタ法により、窒素、金属及びシリコンからなる膜103を堆積する。
窒素、金属及びシリコンからなる膜103中に含まれる金属原子とシリコン原子の組成比は、絶縁膜化した後の比誘電率値が希望する値となるように、適宜変えることが可能である。窒素、金属及びシリコンからなる膜103に含まれる金属原子とシリコン原子との合計に対するシリコン原子の割合は、10原子%以上であるのが良い。このようにすることで、膜の耐熱性が向上し膜中の結晶成長を抑制することが可能となる。尚、この工程での堆積膜形成の間、金属原子とシリコン原子との組成比は必ずしも一定である必要はなく、深さ方向で組成比が変化したものであっても良い。
窒素、金属及びシリコンからなる膜103中には、高濃度に窒素原子を導入することが可能である。例えば、窒素、金属及びシリコンからなる膜103における窒素原子の濃度(含有率)を1原子%以上30原子%以下とすることができる。
堆積させる金属としては、例えばAl、Sr、Ba、Sc、Y、Ti、Zr、Hf及びTaなどの他、La及びCeなどのランタノイド系金属などが挙げられる。Hf及びZrの少なくとも一方を選ぶのが好ましい。Hf或いはZrは、絶縁膜化したときに高い比誘電率が得られる上に、熱的安定性にも優れている。また、堆積させる金属は、単一元素のみからなるもの及び複数の金属元素からなるもののいずれであっても良い。また、異なる元素の金属膜を積層させたものであっても良い。リアクティブスパッタ法による堆積膜形成の間、金属原子及びシリコン原子が酸化反応を生じにくくするため、例えば酸素分圧が十分低い環境を維持するのが好ましい。具体的には酸素分圧は1×10−5Pa以下であることが好ましい。
次に、図3の(c)に示す工程(第2の工程)において、窒素、金属及びシリコンからなる膜103の酸化を行う。これにより、リアクティブスパッタ処理によって完全に窒化されていなかった膜103中の金属原子或いはシリコン原子が酸化される。また、金属原子及びシリコン原子と結合している窒素原子の一部が酸素原子と置換される反応、或いは酸素原子が金属−窒素結合間及びシリコン−窒素結合間などに挿入される反応などによっても、酸化が行われる。このような酸化反応により、窒化金属シリケート膜104が形成される。
また、酸化を行っている間、酸素の一部は拡散によって膜103を突き抜け、その下のシリコン基体101の表層部を酸化してシリコン酸化膜105を形成する。
従来の方法では、酸化処理は窒化処理の前に行われ、金属及びシリコンからなる膜中において酸素の拡散は大きいため、酸化処理の際に酸素の突き抜けが起こりやすい。このため、下地のシリコン基体が過剰に酸化されてシリコン酸化膜の急激な増膜を引き起こしやすく、薄い膜厚のシリコン酸化膜を制御性良く形成するのが困難であった。
これに対して、本発明では、酸化処理は窒化された金属及びシリコンからなる膜103の形成の後に行われ、窒素、金属及びシリコンからなる膜103中における酸素の拡散は従来の窒化されていない金属及びシリコンからなる膜に比べ小さい。このため、本発明では、酸化処理に際して酸素が下地へと急激に突き抜けるのが抑制される。かくして、本発明は、従来の方法に比べ、下地のシリコン基体101の表層部を酸化して形成されるシリコン酸化膜105の膜厚制御性に優れている。
窒化された金属及びシリコンからなる膜103を酸化する方法としては、熱酸化法及びプラズマ酸化など、いかなる方法であってもよいが、プラズマ酸化を用いるのが好ましい。低温で酸化可能なプラズマ酸化を用いることで、形成される窒化金属シリケート膜104中の結晶成長を抑制することが可能となる。プラズマにより酸化を行う場合、プラズマ源としては、40MHz以上の高周波を用いるプラズマを使用することが好ましく、さらに、例えば表面波干渉プラズマなどのマイクロ波プラズマ源を用いることが特に好ましい。マイクロ波プラズマは電子温度が2eV以下と低く、またマイクロ波プラズマを用いた処理装置では基板へのイオン入射エネルギーを低くすることができる。このような低電子温度のプラズマ源の装置で酸化を行うことで下地のシリコン基体101の過剰な酸化を抑制しながら金属及びシリコンからなる膜103の酸化を行なうことができる。酸化に用いられる酸素含有ガスとしては、例えばO、HO、NO、NO、NOなどが挙げられる。また、これらのガスを混合したものや、酸素含有ガスをH、N、He、Ne、Ar、Ke及びXeなどの希ガスで希釈したものであっても良い。
かくして形成される窒化金属シリケート膜104は、第一の実施形態のものと同様に、高い窒素濃度及び高い比誘電率を有するとともに、熱的安定性に優れており、高誘電率ゲート絶縁膜として用いるのに好適である。
例えば、窒化金属シリケート膜104における窒素濃度(含有率)を1原子%以上25原子%以下とすることができる。
また、本発明による絶縁膜の形成方法は、従来の方法に比べ、工程数を削減し、電気的膜厚(酸化膜換算膜厚)の薄い絶縁膜を制御性良く形成することができ、膜厚の制御性が高いという特徴をもつ。
(実施形態4)
次に、本発明の第四の実施形態について、図4を参照して詳細に説明する。この図において、図1〜図3のものと同様な部分または部材には、同一の符号が付されており、ここではその説明を省略する。
図4(a)の工程では、図1(a)、図2(a)及び図3(a)の工程と同様にして、清浄なシリコン原子を表面に露出させる。
次に、図4(b)の工程において、図2(b)の工程と同様にして、シリコン基体101の表層部のシリコンを酸化してシリコン酸化膜105を形成する。これにより、シリコン基体101のシリコンと絶縁膜を構成するシリコン酸化膜105との良好な界面を得る。
次に、図4(c)の工程において、図3(b)の工程と同様にして、シリコン酸化膜105上に窒化された金属及びシリコンからなる膜すなわち窒素、金属及びシリコンからなる膜103を堆積する。ここでは、金属原子及びシリコン原子が酸化反応を生じ難い雰囲気中で、少なくとも窒素原子を含む反応ガスを用いたリアクティブスパッタ法により、窒素、金属及びシリコンからなる膜103を堆積する。
尚、図4(b)の工程及び図4(c)の工程により、本発明の第1の工程が構成される。
次に、図4の(d)に示す工程(第2の工程)において、図3(c)の工程と同様にして、窒素、金属及びシリコンからなる膜103の酸化を行う。これにより、リアクティブスパッタ処理によって完全に窒化されていなかった膜103中の金属原子或いはシリコン原子が酸化される。また、金属原子及びシリコン原子と結合している窒素原子の一部が酸素原子と置換される反応、或いは酸素原子が金属−窒素結合間及びシリコン−窒素結合間などに挿入される反応などによっても、酸化が行われる。このような酸化反応により、窒化金属シリケート膜104が形成される。
また、酸化を行っている間、酸素の一部は拡散によって膜103を突き抜ける。
EOTが1nm以下を達成する為には実施形態3が最適である。しかし、EOTが1nmより大きい場合には本実施形態4のように、例えば急速熱酸化法により、1nm程度のシリコン酸化膜を形成してから金属とシリコンからなる膜を成膜し、これを窒化したのち酸化することが好ましい。これはシリコンとシリコン酸化膜との良好な界面を得ることができるからである。すなわち、前述のようにシリコンと熱酸化により形成されたシリコン酸化膜との界面は良好である。さらにこのようにして形成されたシリコン酸化膜は膜質も良く緻密であり酸素を通過させにくいため、1nm程度の酸化膜を増膜させることがないので、シリコンとシリコン酸化膜との界面は良好に保持される。
以下、実施例を挙げて本発明の絶縁膜形成方法の具体的な適用例を説明するが、本発明はこれら実施例に限定されるものではない。
[実施例1]
本実施例は、図1の実施形態に従って実施した。シリコン基体101として、直径200mmのP型単結晶シリコン基板を使用した。
まず、シリコン基体101の表面をRCA洗浄により洗浄し、不純物や、自然酸化膜の除去を行った。
次に、シリコン基体101を図示しないRFマグネトロン方式のスパッタ装置内に搬送した。なお、スパッタ装置のターゲットにはHf及びSiを用いた。シリコン基体をスパッタ装置内に搬送した後、スパッタ装置内の排気を行い2x10−6Paまで減圧した。また、シリコン基体101を、加熱手段により加熱し、300℃に保持した。これらにより、膜堆積中にHf及びSiを酸化させる虞のある酸素や水分などをスパッタ装置外へと排気した。続いて、スパッタ装置内に5sccmの流量でArガスを導入し、スパッタ装置内を0.2Paに保持した。続いて、それぞれのターゲットに高周波電圧を印加してプラズマを生成し、ターゲットを構成するHf及びSiの原子のスパッタを行った。それぞれのターゲットにおいてスパッタされたHf及びSiの原子は、ターゲットに対向する位置に支持されたシリコン基体101の方へと飛散し、シリコン基板101上に堆積された。この処理によって、膜厚1nmのHf及びSiからなる膜102が形成された。このとき、堆積した膜中に含まれるHfに対するSiの組成比すなわちHf原子とSi原子との合計に対するSi原子の割合は30%であった。
次に、シリコン基体101の表面に形成された膜102を窒化する為、表面波励起により窒素プラズマを発生する図示しないプラズマ窒化装置内に膜102付のシリコン基体101を搬送した。なお前記スパッタ装置とプラズマ窒化装置は、複数の工程を連続で行う為のクラスター装置を構成するモジュールの一つであり、各装置間にて基体を搬送するエリアは高真空に常時保持されていた。このため、スパッタ処理を行った後に窒化処理を行うまでの間、スパッタされたHf及びSiが装置内に残存する酸素などにより酸化され難い雰囲気内に基体が保持された。
プラズマ窒化装置において、200sccmの流量でNガスを導入した。さらに、プラズマ窒化装置内の圧力を26Paに保持した。このとき、シリコン基体101は、基体を支持すると共に該基体を加熱可能なヒーターを内蔵するステージによって、200℃に保持された。その後、2.45GHzのマイクロ波を図示しないアンテナから放射し、装置内外を隔離する図示しない誘電体を介してプラズマ窒化装置内に導入して、表面波プラズマを生成した。かくして励起された窒素プラズマによって、シリコン基体101の表面に形成されたHf及びSiからなる膜102の窒化を行って、窒化されたHf及びSiからなる膜すなわちN、Hf及びSiからなる膜103を形成した。膜103における窒素原子の濃度(含有率)は25%であった。
次に、同じくクラスター装置を構成する図示しないプラズマ酸化装置へと膜103付の基体101を搬送し、酸化処理をおこなった。プラズマ酸化装置は、前記のプラズマ窒化装置と同様に表面波励起プラズマによって酸素プラズマを発生する装置であった。プラズマ酸化装置において、1000sccmの流量でOガスを導入した。プラズマ酸化装置内の圧力を133Paに保持した。このとき、シリコン基体101は、基体を支持すると共に該基体を加熱可能なヒーターを内蔵するステージによって、350℃に保持された。その後、2.45GHzのマイクロ波を図示しないアンテナから放射し、装置内外を真空隔離する図示しない誘電体を介してプラズマ酸化装置内に導入し表面波プラズマを生成した。かくして励起された酸素プラズマによって、シリコン基体101上の窒化されたHf及びSiからなる膜103の酸化を行い窒化されたHfシリケート膜104を形成した。更に、この酸化によりシリコン基体101の表層部のSiが酸化されてシリコン酸化膜105が形成された。
かくして形成した膜をTEMにより断面観察を行ったところ、シリコン基体101上に膜厚0.7nmの薄いシリコン酸化膜105が形成され、更にその上に膜厚1.6nmの窒化されたHfシリケート膜104が形成されていることが確認された。更に、XPSにより窒化されたHfシリケート膜104に含まれる窒素濃度を測定したところ、19原子%と高濃度の窒素が膜中に導入されていることが確認された。
[実施例2]
本実施例は、図2の実施形態に従って実施した。シリコン基体101として、直径200mmのP型単結晶シリコン基板を使用した。
まず、実施例1と同様にして、シリコン基体101の表面をRCA洗浄により洗浄し、不純物や、自然酸化膜の除去を行った。
次に、シリコン基体101を図示しない急速熱酸化装置に搬送し、酸素雰囲気中において1000℃の熱酸化を行った。この熱酸化により、膜厚1.4nmのシリコン酸化膜105がシリコン基体101上に形成された。
次に、膜105付のシリコン基体101をスパッタ装置内に搬送し、実施例1と同様にして、スパッタ処理を行い、シリコン酸化膜105上に膜厚1nmのHf及びSiからなる膜102を形成した。このとき、堆積した膜中に含まれるHfに対するSiの組成比すなわちHf原子とSi原子との合計に対するSi原子の割合は30%であった。
次に、膜105,102付のシリコン基体101をプラズマ窒化装置内に搬送し、実施例1と同様にして、窒素プラズマによりHf及びSiからなる膜102の窒化を行った。これにより、窒化されたHf及びSiからなる膜すなわちN、Hf及びSiからなる膜103を形成した。膜103における窒素原子の濃度(含有率)は25%であった。
次に、膜105,103付のシリコン基体101をプラズマ酸化装置内に搬送し、実施例1と同様にして、酸素プラズマによりN、Hf及びSiからなる膜103の酸化を行った。これにより、窒化Hfシリケート膜104を形成した。
かくして形成した膜をTEMにより断面観察を行ったところ、シリコン基体101上に膜厚1.4nmのシリコン酸化膜105が形成され、更にその上に膜厚1.6nmの窒化されたHfシリケート膜104が形成されていることが確認された。従って、プラズマ酸化によるシリコン酸化膜105の増膜が起きていないことが確認された。
[実施例3]
本実施例は、図3の実施形態に従って実施した。シリコン基体101として、直径200mmのP型単結晶シリコン基板を使用した。
まず、実施例1及び2と同様にして、シリコン基体101の表面をRCA洗浄により洗浄し、不純物や、自然酸化膜の除去を行った。
次に、シリコン基体101をスパッタ装置内に搬送した。なお、スパッタ装置のターゲットにはHf及びSiを用いた。シリコン基体をスパッタ装置内に搬送した後、スパッタ装置内の排気を行い2x10−6Paまで減圧した。またシリコン基体101を加熱手段により加熱し、300℃に保持した。これらにより、膜堆積中にHf及びSiを酸化させる虞のある酸素や水分などをスパッタ装置外へと排気した。続いて、スパッタ装置内にArガスを流量5sccmで、及びNガスを0.5sccmの流量でそれぞれ導入し、スパッタ装置内を0.2Paに保持した。続いて、それぞれのターゲットに高周波電圧を印加してプラズマを生成し、ターゲットを構成するHf及びSiの原子のスパッタを行った。それぞれのターゲットにおいてスパッタされたHf及びSiの原子は、プラズマ中の窒素原子と反応し窒化物となって、シリコン基板101上に堆積された。このリアクティブスパッタ処理によって、膜厚1.5nmの窒化されたHf及びSiからなる膜すなわちN、Hf及びSiからなる膜103が形成された。このとき、堆積した膜中に含まれるHfに対するSiの組成比すなわちHf原子とSi原子との合計に対するSi原子の割合は30%であった。膜103における窒素原子の濃度(含有率)は28原子%であった。
次に、実施例1と同様にして、酸素プラズマによりN、Hf及びSiからなる膜103の酸化を行って、窒化Hfシリケート膜104を形成した。更に、この酸化によりシリコン基体101の表層部のSiが酸化されてシリコン酸化膜105が形成された。
かくして形成した膜をTEMにより断面観察を行ったところ、シリコン基体101上に膜厚0.6nmの薄いシリコン酸化膜105の層が形成され、更にその上に膜厚1.6nmの窒化されたHfシリケート膜104が形成されていることが確認された。更に、XPSにより窒化されたHfシリケート膜104に含まれる窒素濃度を測定したところ、23原子%と高濃度の窒素が膜中に導入されていることが確認された。
[実施例4]
本実施例は、図4の実施形態に従って実施した。シリコン基体101として、直径200mmのP型単結晶シリコン基板を使用した。
まず、実施例1〜3と同様にして、シリコン基体101の表面をRCA洗浄により洗浄し、不純物や、自然酸化膜の除去を行った。
次に、実施例2と同様にして、シリコン基体101を熱酸化して、膜厚1.4nmのシリコン酸化膜105を形成した。
次に、膜105付のシリコン基体101をスパッタ装置内に搬送し、実施例3と同様にして、リアクティブスパッタ処理を行った。これにより、シリコン酸化膜105上に膜厚1.5nmの窒化されたHf及びSiからなる膜すなわちN、Hf及びSiからなる膜103が形成された。このとき、堆積した膜中に含まれるHfに対するSiの組成比すなわちHf原子とSi原子との合計に対するSi原子の割合は30%であった。膜103における窒素原子の濃度(含有率)は28原子%であった。
次に、実施例2と同様にして、酸素プラズマによりN、Hf及びSiからなる膜103の酸化を行って、窒化Hfシリケート膜104を形成した。
かくして形成した膜をTEMにより断面観察を行ったところ、シリコン基体101上に膜厚1.4nmのシリコン酸化膜105が形成され、更にその上に膜厚1.6nmの窒化されたHfシリケート膜104が形成されていることが確認された。従って、プラズマ酸化によるシリコン酸化膜105の増膜が起きていないことが確認された。
[実施例5]
本実施例では、本発明による絶縁膜の形成方法に従い成膜した高誘電率絶縁膜の電気的特性評価を行った。
シリコン基体101として、(100)面方位を有する単結晶シリコンからなり、さらにリンがドープされ、抵抗値が約0.1Ω・cmのものを使用した。まず、シリコン基体101の表面をLOCOS法により素子分離した後、上記の実施例2と同様の方法で高誘電率絶縁膜を形成した。その後、窒素雰囲気内にて1000℃で5秒のアニールを行った。次に、絶縁膜の上に金からなる電極を形成してMOSキャパシタを製作し、C−V特性及びI−V特性を評価した。
その結果、絶縁膜の酸化膜換算膜厚は1.61nmであり、フラットバンド電圧は0.33Vであり、C−Vカーブのヒステリシスは30mVであった。また、リーク電流値は2.4x10−6A/cm(Vg=−1V)と良好な結果が得られた。
本発明による絶縁膜の製造方法の第一の実施形態を説明するための工程断面図である。 本発明による絶縁膜の製造方法の第二の実施形態を説明するための工程断面図である。 本発明による絶縁膜の製造方法の第三の実施形態を説明するための工程断面図である。 本発明による絶縁膜の製造方法の第四の実施形態を説明するための工程断面図である。 従来の高誘電率絶縁膜の製造方法の一例を説明するための工程断面図である。 従来の高誘電率絶縁膜の製造方法の他の一例を説明するための工程断面図である。
符号の説明
101 シリコン基体
102 金属及びシリコンからなる膜
103 窒化された金属及びシリコンからなる膜
104 窒化金属シリケート膜
105 シリコン酸化膜

Claims (14)

  1. シリコン基体の上に窒化金属シリケートを含む絶縁膜を形成する絶縁膜の形成方法であって、
    前記シリコン基体の上に金属及びシリコンからなる膜を、非酸化雰囲気中でスパッタ法により堆積する第1の工程と、
    前記金属及びシリコンからなる膜を窒化して窒素、金属及びシリコンからなる膜を形成する第2の工程と、
    前記窒素、金属及びシリコンからなる膜を酸化して窒化金属シリケート膜を形成する第3の工程と、を有することを特徴とする絶縁膜の形成方法。
  2. 前記金属は、少なくともハフニウム及びジルコニウムのうちのいずれかを含むことを特徴とする、請求項1に記載の絶縁膜の形成方法。
  3. 前記第1の工程の終了から前記第2の工程の開始までの間、前記金属及びシリコンからなる膜を、非酸化雰囲気中に保持することを特徴とする、請求項1又は2に記載の絶縁膜の形成方法。
  4. 前記第2の工程で、少なくとも窒素原子を含むプラズマを用いて、前記金属及びシリコンからなる膜を窒化することを特徴とする、請求項1〜3のいずれか一項に記載の絶縁膜の形成方法。
  5. 前記第3の工程で、少なくとも酸素原子を含むプラズマを用いて、前記窒素、金属及びシリコンからなる膜を酸化することを特徴とする、請求項1〜4のいずれか一項に記載の絶縁膜の形成方法。
  6. 前記第3の工程で、マイクロ波プラズマ源を用いて、前記窒素、金属及びシリコンからなる膜を酸化することを特徴とする、請求項5に記載の絶縁膜の形成方法。
  7. 前記第3の工程により、前記窒素、金属及びシリコンからなる膜の下の前記シリコン基体の表層部を酸化してシリコン酸化膜を形成することを特徴とする、請求項1〜6のいずれか一項に記載の絶縁膜の形成方法。
  8. 前記第1の工程において、前記シリコン基体の表層部を酸化してシリコン酸化膜を形成し、該シリコン酸化膜の上に前記金属及びシリコンからなる膜を堆積することを特徴とする、請求項1〜7のいずれか一項に記載の絶縁膜の形成方法。
  9. シリコン基体の上に窒化金属シリケートを含む絶縁膜を形成する絶縁膜の形成方法であって、
    前記シリコン基体の上に窒素、金属及びシリコンからなる膜を、非酸化雰囲気中で、少なくとも窒素原子を含むガスを用いたリアクティブスパッタ法により堆積する第1の工程と、
    前記窒素、金属及びシリコンからなる膜を酸化して窒化金属シリケート膜を形成する第2の工程と、を有することを特徴とする絶縁膜の形成方法。
  10. 前記金属は、少なくともハフニウム及びジルコニウムのうちのいずれかを含むことを特徴とする、請求項9に記載の絶縁膜の形成方法。
  11. 前記第2の工程で、少なくとも酸素原子を含むプラズマを用いて、前記窒素、金属及びシリコンからなる膜を酸化することを特徴とする、請求項9又は10に記載の絶縁膜の形成方法。
  12. 前記第2の工程で、マイクロ波プラズマ源を用いて、前記窒素、金属及びシリコンからなる膜を酸化することを特徴とする、請求項11に記載の絶縁膜の形成方法。
  13. 前記第2の工程により、前記窒素、金属及びシリコンからなる膜の下の前記シリコン基体の表層部を酸化してシリコン酸化膜を形成することを特徴とする、請求項9〜12のいずれか一項に記載の絶縁膜の形成方法。
  14. 前記第1の工程において、前記シリコン基体の表層部を酸化してシリコン酸化膜を形成し、該シリコン酸化膜の上に前記窒素、金属及びシリコンからなる膜を堆積することを特徴とする、請求項9〜13のいずれか一項に記載の絶縁膜の形成方法。
JP2008327944A 2007-12-27 2008-12-24 絶縁膜の形成方法 Pending JP2009177161A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP2008327944A JP2009177161A (ja) 2007-12-27 2008-12-24 絶縁膜の形成方法

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2007336731 2007-12-27
JP2008327944A JP2009177161A (ja) 2007-12-27 2008-12-24 絶縁膜の形成方法

Publications (1)

Publication Number Publication Date
JP2009177161A true JP2009177161A (ja) 2009-08-06

Family

ID=40799025

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2008327944A Pending JP2009177161A (ja) 2007-12-27 2008-12-24 絶縁膜の形成方法

Country Status (4)

Country Link
US (1) US8148275B2 (ja)
JP (1) JP2009177161A (ja)
KR (1) KR101024961B1 (ja)
CN (1) CN101471254B (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011071313A (ja) * 2009-09-25 2011-04-07 Technical Research & Development Institute Ministry Of Defence 絶縁膜形成方法、絶縁膜形成装置及び半導体装置
JP2012156565A (ja) * 2012-05-22 2012-08-16 Technical Research & Development Institute Ministry Of Defence 絶縁膜形成方法、絶縁膜形成装置及び半導体装置
KR20210053241A (ko) * 2019-11-01 2021-05-11 어플라이드 머티어리얼스, 인코포레이티드 Finfet 형성을 위한 캡 산화

Families Citing this family (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2009031232A1 (ja) * 2007-09-07 2009-03-12 Canon Anelva Corporation スパッタリング方法および装置
JP4465413B1 (ja) 2008-10-31 2010-05-19 キヤノンアネルバ株式会社 誘電体膜、誘電体膜の製造方法、半導体装置、および、記録媒体
KR101126650B1 (ko) * 2008-10-31 2012-03-26 캐논 아네르바 가부시키가이샤 유전체막의 제조 방법
JP4584356B2 (ja) * 2008-12-26 2010-11-17 キヤノンアネルバ株式会社 基板処理方法、基板処理装置、mos−fetの製造方法、不揮発メモリの製造方法、およびコンピュータ読み取り可能な記録媒体
JP5247619B2 (ja) * 2009-07-28 2013-07-24 キヤノンアネルバ株式会社 誘電体膜、誘電体膜を用いた半導体装置の製造方法及び半導体製造装置
CN102074469B (zh) * 2009-11-25 2012-04-11 中国科学院微电子研究所 一种用于pmos器件的金属栅功函数的调节方法
JP2011151366A (ja) 2009-12-26 2011-08-04 Canon Anelva Corp 誘電体膜の製造方法
JP5937297B2 (ja) * 2010-03-01 2016-06-22 キヤノンアネルバ株式会社 金属窒化膜、該金属窒化膜を用いた半導体装置、および半導体装置の製造方法
CN104538444B (zh) * 2010-03-05 2018-02-23 万国半导体股份有限公司 带有沟槽‑氧化物‑纳米管超级结的器件结构及制备方法
KR20120064966A (ko) 2010-12-10 2012-06-20 에스케이하이닉스 주식회사 반도체 장치 제조 방법
JP5458177B2 (ja) 2010-12-28 2014-04-02 キヤノンアネルバ株式会社 半導体装置の製造方法および装置
CN105762107A (zh) * 2014-12-18 2016-07-13 中芯国际集成电路制造(上海)有限公司 半导体结构的形成方法
TWI726951B (zh) 2015-12-17 2021-05-11 美商應用材料股份有限公司 處理氮化物膜之方法

Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000058832A (ja) * 1998-07-15 2000-02-25 Texas Instr Inc <Ti> オキシ窒化ジルコニウム及び/又はハフニウム・ゲ―ト誘電体
JP2003179049A (ja) * 2001-12-11 2003-06-27 Matsushita Electric Ind Co Ltd 絶縁膜形成方法、半導体装置及びその製造方法
JP2003289139A (ja) * 2002-03-27 2003-10-10 Toshiba Corp 電界効果トランジスタ
JP2004241725A (ja) * 2003-02-07 2004-08-26 Toshiba Corp 半導体装置およびその製造方法
JP2005317647A (ja) * 2004-04-27 2005-11-10 Toshiba Corp 半導体装置及びその製造方法
JP2005322900A (ja) * 2004-04-09 2005-11-17 Tokyo Electron Ltd ゲート絶縁膜の形成方法ならびにコンピュータ読取可能な記憶媒体およびコンピュータプログラム
JP2006086511A (ja) * 2004-08-17 2006-03-30 Nec Electronics Corp 半導体装置
JP2006237371A (ja) * 2005-02-25 2006-09-07 Canon Anelva Corp high−K誘電膜上に金属ゲートを蒸着する方法及び、high−K誘電膜と金属ゲートとの界面を向上させる方法、並びに、基板処理システム
JP2006344837A (ja) * 2005-06-09 2006-12-21 Matsushita Electric Ind Co Ltd 半導体装置及びその製造方法
JP2007194645A (ja) * 2003-02-12 2007-08-02 Matsushita Electric Ind Co Ltd 半導体装置の製造方法

Family Cites Families (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH11168096A (ja) 1997-12-04 1999-06-22 Sony Corp 高誘電酸化膜の形成方法
JP2001332547A (ja) 2000-03-17 2001-11-30 Toshiba Corp 半導体装置及び半導体装置の製造方法
JP4102072B2 (ja) * 2002-01-08 2008-06-18 株式会社東芝 半導体装置
JP4643884B2 (ja) 2002-06-27 2011-03-02 ルネサスエレクトロニクス株式会社 半導体装置およびその製造方法
JP2004140292A (ja) 2002-10-21 2004-05-13 Tokyo Electron Ltd 誘電体膜の形成方法
US20050153571A1 (en) 2003-11-17 2005-07-14 Yoshihide Senzaki Nitridation of high-k dielectric films
JP5221121B2 (ja) 2007-12-27 2013-06-26 キヤノン株式会社 絶縁膜の形成方法
US8012822B2 (en) 2007-12-27 2011-09-06 Canon Kabushiki Kaisha Process for forming dielectric films

Patent Citations (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000058832A (ja) * 1998-07-15 2000-02-25 Texas Instr Inc <Ti> オキシ窒化ジルコニウム及び/又はハフニウム・ゲ―ト誘電体
JP2003179049A (ja) * 2001-12-11 2003-06-27 Matsushita Electric Ind Co Ltd 絶縁膜形成方法、半導体装置及びその製造方法
JP2003289139A (ja) * 2002-03-27 2003-10-10 Toshiba Corp 電界効果トランジスタ
JP2004241725A (ja) * 2003-02-07 2004-08-26 Toshiba Corp 半導体装置およびその製造方法
JP2007194645A (ja) * 2003-02-12 2007-08-02 Matsushita Electric Ind Co Ltd 半導体装置の製造方法
JP2005322900A (ja) * 2004-04-09 2005-11-17 Tokyo Electron Ltd ゲート絶縁膜の形成方法ならびにコンピュータ読取可能な記憶媒体およびコンピュータプログラム
JP2005317647A (ja) * 2004-04-27 2005-11-10 Toshiba Corp 半導体装置及びその製造方法
JP2006086511A (ja) * 2004-08-17 2006-03-30 Nec Electronics Corp 半導体装置
JP2006237371A (ja) * 2005-02-25 2006-09-07 Canon Anelva Corp high−K誘電膜上に金属ゲートを蒸着する方法及び、high−K誘電膜と金属ゲートとの界面を向上させる方法、並びに、基板処理システム
JP2006344837A (ja) * 2005-06-09 2006-12-21 Matsushita Electric Ind Co Ltd 半導体装置及びその製造方法

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011071313A (ja) * 2009-09-25 2011-04-07 Technical Research & Development Institute Ministry Of Defence 絶縁膜形成方法、絶縁膜形成装置及び半導体装置
JP2012156565A (ja) * 2012-05-22 2012-08-16 Technical Research & Development Institute Ministry Of Defence 絶縁膜形成方法、絶縁膜形成装置及び半導体装置
KR20210053241A (ko) * 2019-11-01 2021-05-11 어플라이드 머티어리얼스, 인코포레이티드 Finfet 형성을 위한 캡 산화
KR102527891B1 (ko) 2019-11-01 2023-04-28 어플라이드 머티어리얼스, 인코포레이티드 Finfet 형성을 위한 캡 산화

Also Published As

Publication number Publication date
CN101471254A (zh) 2009-07-01
US8148275B2 (en) 2012-04-03
KR20090071503A (ko) 2009-07-01
US20090170344A1 (en) 2009-07-02
CN101471254B (zh) 2012-09-19
KR101024961B1 (ko) 2011-03-25

Similar Documents

Publication Publication Date Title
KR101024961B1 (ko) 절연막의 형성방법
TWI450338B (zh) 場效電晶體之閘極介電質的製造方法
US7217659B2 (en) Process for producing materials for electronic device
TWI415193B (zh) 用以製造場效電晶體之閘極介電質的方法
US7964514B2 (en) Multiple nitrogen plasma treatments for thin SiON dielectrics
US7446052B2 (en) Method for forming insulation film
JP4512098B2 (ja) 半導体装置の製造方法及び基板処理装置
JP4408653B2 (ja) 基板処理方法および半導体装置の製造方法
KR101024962B1 (ko) 절연막의 형성방법
US7622402B2 (en) Method for forming underlying insulation film
JP5247619B2 (ja) 誘電体膜、誘電体膜を用いた半導体装置の製造方法及び半導体製造装置
KR100942106B1 (ko) 플라즈마 질화 처리 방법, 반도체 장치의 제조 방법 및플라즈마 처리 장치
JP5264163B2 (ja) 絶縁膜の形成方法
WO2004107451A1 (ja) Mis型電界効果トランジスタを備える半導体装置及びその製造方法並びに金属酸化膜の形成方法
JP2009158783A (ja) 絶縁膜の形成方法
JP5039396B2 (ja) 半導体装置の製造方法
JP2002540628A (ja) 低バッファ酸化膜を有する高誘電率の誘電スタックの製作方法
KR100966388B1 (ko) 금속 실리케이트막의 형성 방법 및 기록 매체
JP2005079563A (ja) 電子デバイスの製造方法
TWI739176B (zh) 在半導體元件中形成用於改良有效氧化物厚度之結構的方法
KR100373165B1 (ko) 게이트 유전체막이 적용되는 반도체 소자의 제조 방법
WO2007124197A2 (en) Method for forming silicon oxynitride materials
JP2010003843A (ja) 絶縁膜の形成方法および半導体装置の製造方法
JP2005123471A (ja) トランジスタの製造方法

Legal Events

Date Code Title Description
RD04 Notification of resignation of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7424

Effective date: 20100617

RD05 Notification of revocation of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7425

Effective date: 20100730

RD04 Notification of resignation of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7424

Effective date: 20101227

A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20111214

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20120517

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20120528

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20120726

RD03 Notification of appointment of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7423

Effective date: 20120919

RD05 Notification of revocation of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7425

Effective date: 20121016

RD05 Notification of revocation of power of attorney

Free format text: JAPANESE INTERMEDIATE CODE: A7425

Effective date: 20121102

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20121122

A521 Request for written amendment filed

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20130121

A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20130430