JP2003308052A5 - 液晶表示装置の駆動回路および液晶表示装置 - Google Patents
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【特許請求の範囲】
【請求項１】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項２】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路は互いに並列に接続され、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項３】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路の出力により画像信号をサンプリングする半導体表示装置の駆動回路であって、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項４】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路の出力により画像信号をサンプリングする半導体表示装置の駆動回路であって、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路は互いに並列に接続され、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項５】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路の出力により走査線を順に選択する半導体表示装置の駆動回路であって、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項６】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路の出力により走査線を順に選択する半導体表示装置の駆動回路であって、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路は互いに並列に接続され、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項７】
請求項１乃至請求項６のいずれか一項において、
前記複数のＮチャネル型ＴＦＴそれぞれ及び前記複数のＰチャネル型ＴＦＴそれぞれは、チャネル幅が１００μｍ以下であることを特徴とする液晶表示装置の駆動回路。
【請求項８】
請求項１乃至請求項７のいずれか一項において、
前記駆動回路を有する液晶表示装置。
【請求項１】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項２】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路は互いに並列に接続され、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項３】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路の出力により画像信号をサンプリングする半導体表示装置の駆動回路であって、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項４】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路の出力により画像信号をサンプリングする半導体表示装置の駆動回路であって、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路は互いに並列に接続され、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項５】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路の出力により走査線を順に選択する半導体表示装置の駆動回路であって、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項６】
シフトレジスタ回路と、前記シフトレジスタ回路の出力に接続されたバッファ回路とを有し、
前記バッファ回路の出力により走査線を順に選択する半導体表示装置の駆動回路であって、
前記バッファ回路は、複数のインバータ回路を有し、
前記複数のインバータ回路は互いに並列に接続され、
前記複数のインバータ回路それぞれは、複数のＮチャネル型ＴＦＴと複数のＰチャネル型ＴＦＴとを有し、
前記複数のＮチャネル型ＴＦＴは互いに並列に接続され、
前記複数のＰチャネル型ＴＦＴは互いに並列に接続されていることを特徴とする液晶表示装置の駆動回路。
【請求項７】
請求項１乃至請求項６のいずれか一項において、
前記複数のＮチャネル型ＴＦＴそれぞれ及び前記複数のＰチャネル型ＴＦＴそれぞれは、チャネル幅が１００μｍ以下であることを特徴とする液晶表示装置の駆動回路。
【請求項８】
請求項１乃至請求項７のいずれか一項において、
前記駆動回路を有する液晶表示装置。
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