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JP2001035868A - 非絶縁型半導体装置の製造方法 - Google Patents

非絶縁型半導体装置の製造方法

Info

Publication number
JP2001035868A
JP2001035868A JP20728599A JP20728599A JP2001035868A JP 2001035868 A JP2001035868 A JP 2001035868A JP 20728599 A JP20728599 A JP 20728599A JP 20728599 A JP20728599 A JP 20728599A JP 2001035868 A JP2001035868 A JP 2001035868A
Authority
JP
Japan
Prior art keywords
resin
semiconductor device
mold
manufacturing
lead frame
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP20728599A
Other languages
English (en)
Inventor
Yuki Yamamoto
祐樹 山本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP20728599A priority Critical patent/JP2001035868A/ja
Publication of JP2001035868A publication Critical patent/JP2001035868A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
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    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/73Means for bonding being of different types provided for in two or more of groups H01L2224/10, H01L2224/18, H01L2224/26, H01L2224/34, H01L2224/42, H01L2224/50, H01L2224/63, H01L2224/71
    • H01L2224/732Location after the connecting process
    • H01L2224/73251Location after the connecting process on different surfaces
    • H01L2224/73265Layer and wire connectors

Landscapes

  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
  • Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)

Abstract

(57)【要約】 【課題】 樹脂封止後の樹脂ばり取り工程を省略できる
非絶縁型半導体装置を提供する。 【解決手段】 ペレット1,ボンディングワイヤー3を
接続され放熱板を有するリードフレーム2と、樹脂4を
封入する封入金型7,8とを備えた非絶縁型半導体装置
の製造方法において、樹脂4の封入時、放熱板の外周と
封入金型とをかじらせ、放熱板面への樹脂もれを防止す
る。封入金型は、上型7および下型8の封入金型からな
り、上型7の封入金型は、樹脂4を樹脂ゲートから流入
させる。リードフレーム2の放熱板面外周にテーパ部を
設け、下型7の封入金型の放熱板接触箇所に凹部9を設
ける。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、非絶縁型半導体装
置の製造方法に関し、特に、放熱板面への樹脂漏れを防
止した非絶縁型半導体装置の製造方法に関する。
【0002】
【従来の技術】一般に、非絶縁型の半導体装置では、放
熱板面に樹脂ばりを除去することが重要な要素の一つと
なっている。
【0003】図6,図7は、従来の非絶縁型半導体装置
の製造方法を示す断面図である。
【0004】図6は、従来の半導体装置を示す断面図で
あり、図7は、従来の半導体装置におけるリードフレー
ムの拡大図である。まず、図6に示すように、ペレット
1,ワイヤー3,電極部11が接続されたリードフレー
ム2を上下の封入金型(下型7,上型8)で挟んで固定
し、樹脂4を注入している。このときの状態は図7の拡
大図により詳細に示している。尚、放熱板面を露出させ
るため、放熱板と金型とを密着させて放熱板面へ樹脂4
が流れ込まないようにしている。樹脂4を封入後、放熱
板についた樹脂ばりを除去するため、水と研磨剤とを放
熱板面にあてて除去している。
【0005】上述した樹脂流入を防止した従来例とし
て、特許第2731123号公報記載の半導体装置があ
る。この半導体装置は、溝と溝とにより形成される突起
により樹脂漏れを阻止するものである。また、特公平7
−114213号公報記載の半導体装置用リードフレー
ムは、リードフレームの放熱板側面に、金型に押し潰さ
れて放熱板側面と金型との間の隙間の一部を埋める突起
を形成している。
【0006】
【発明が解決しようとする課題】しかしながら、上述し
た従来の製造方法では、放熱板に10μm程度の凹凸が
あったため、封入時、封入金型と放熱板との間に隙間が
でき、放熱面を樹脂で覆った製品ができたため、樹脂封
入後の樹脂ばり取り工程でも全ての製品の樹脂ばりが除
去できないという問題があった。
【0007】そこで、本発明の目的は、上記問題を解決
するために、樹脂封止後の樹脂ばり取り工程を省略でき
る非絶縁型半導体装置の製造方法を提供することにあ
る。
【0008】
【課題を解決するための手段】上記目的を達成するため
に、本発明の非絶縁型半導体装置の製造方法は、ペレッ
ト,ボンディングワイヤーを接続され放熱板を有するリ
ードフレームと、樹脂を封入する封入金型とを備えた非
絶縁型半導体装置の製造方法において、樹脂の封入時、
放熱板の外周と封入金型とをかじらせ、放熱板面への樹
脂もれを防止したことを特徴とする。
【0009】また、封入金型は、上型および下型の封入
金型からなるのが好ましい。
【0010】さらに、上型の封入金型の樹脂ゲートから
樹脂を流入させるのが好ましい。
【0011】またさらに、リードフレームの放熱板面外
周にテーパ部を設け、下型の封入金型の放熱板接触箇所
に凹部を設けるのが好ましい。
【0012】また、リードフレームの放熱板面外周にテ
ーパ部を設け、下型の封入金型の放熱板接触箇所に凸部
を設けるのが好ましい。
【0013】さらに、樹脂封入後の樹脂ばり取り工程を
省略するのが好ましい。
【0014】
【発明の実施の形態】次に、図面を参照して、本発明の
実施例について詳細に説明する。
【0015】図1〜図4は、本発明の非絶縁型半導体装
置の製造方法の実施例を示す断面図である。図1は上面
図であり、図2は下面図である。図3は図1のA−A’
断面図であり、図4は図1のB−B’断面図である。
【0016】まず、図1,図2に示すように、封入金型
の上型7の樹脂ゲート10より樹脂4を流入させる。ま
た、本発明の非絶縁型半導体装置の全体構成は、図3に
示すように、ペレット1,リードフレーム2,ボンディ
ングワイヤー3,樹脂4,ソルダー5より構成され、リ
ードフレーム2が放熱板を有する非絶縁型半導体装置に
おいて、リードフレーム2の放熱板面外周にテーパ部6
を設け、封入金型のうち下型8の封入金型の放熱板接触
箇所に凹部9を設けている。
【0017】次に、図3,図4を参照して、本発明の実
施例の動作について説明する。
【0018】この半導体の製造に当たっては、図3に示
すように、ペレット1を搭載し、ボンディングワイヤー
3でペレット1と電極部11とを接続したリードフレー
ム2を、上型7,下型8の封入金型にて挟み、図4に示
すように、上型7の封入金型に設けられた樹脂ゲート1
0から樹脂4を注入している。
【0019】次に、本発明の他の実施例について説明す
る。
【0020】図5は、本発明の非絶縁型半導体装置の他
の実施例を示す断面図である。上述した実施例では、下
型封入金型8の放熱板接触箇所を凹部9としていたが、
凸部としても適応することができる。すなわち、下型封
入金型8の放熱板接触箇所を凸部とすることができる。
その際の製造方法を図5に示す。本実施例では、ペレッ
ト1,リードフレーム2,ボンディングワイヤー3,樹
脂4,ソルダー5より構成され、放熱板を有する非絶縁
型半導体装置に関し、リードフレーム2の放熱板面外周
にテーパ部6を設け、下型8の封入金型の放熱板接触箇
所に凸部12を設けている。
【0021】従って、本実施例における半導体装置の製
造方法に当たっては、ペレット1を搭載し、ボンディン
グワイヤー3でペレット1と電極部11とを接続したリ
ードフレーム2を、上型7,下型8の封入金型にて挟
み、上型7の封入金型に設けられた樹脂ゲート10から
樹脂4を注入している。樹脂4の封入時、リードフレー
ム2の放熱板面外周のテーパ部6を下型8の封入金型の
凸部12でかじらせるため、放熱板面への樹脂4の流れ
込みを抑え、樹脂封入後の樹脂ばり取り工程を削除でき
る。
【0022】
【発明の効果】以上説明したように、本発明の非絶縁型
半導体装置の製造方法により、樹脂封入時、リードフレ
ーム2の放熱板面外周のテーパ部を下型の封入金型の凹
部でかじらせるため、放熱板面への樹脂の流れ込みを抑
え、樹脂封入後の樹脂ばり取り工程を削除できるという
効果を奏する。
【図面の簡単な説明】
【図1】本発明の実施例を示す上面図である。
【図2】本発明の実施例を示す下面図である。
【図3】図1のA−A’断面図である。
【図4】図1のB−B’断面図である。
【図5】本発明の他の実施例を示す断面図である。
【図6】従来の半導体装置を示す断面図である。
【図7】従来の半導体装置におけるリードフレームの拡
大図である。
【符号の説明】
1 ペレット 2 リードフレーム 3 ボンディングワイヤー 4 樹脂 5 ソルダー 6 放熱板テーパ部 7 下型(下型の封入金型) 8 上型(上型のの封入金型) 9 下型の凹部 10 樹脂ゲート 11 電極部 12 下型の凸部

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】ペレット,ボンディングワイヤーを接続さ
    れ放熱板を有するリードフレームと、樹脂を封入する封
    入金型とを備えた非絶縁型半導体装置の製造方法におい
    て、 前記樹脂の封入時、前記放熱板の外周と前記封入金型と
    をかじらせ、前記放熱板面への樹脂もれを防止したこと
    を特徴とする非絶縁型半導体装置の製造方法。
  2. 【請求項2】前記封入金型は、上型および下型の封入金
    型からなることを特徴とする、請求項1に記載の非絶縁
    性半導体装置の製造方法。
  3. 【請求項3】前記上型の封入金型の樹脂ゲートから前記
    樹脂を流入させることを特徴とする、請求項2に記載の
    非絶縁性半導体装置の製造方法。
  4. 【請求項4】前記リードフレームの放熱板面外周にテー
    パ部を設け、前記下型の封入金型の放熱板接触箇所に凹
    部を設けることを特徴とする、請求項2または3に記載
    の非絶縁性半導体装置の製造方法。
  5. 【請求項5】前記リードフレームの放熱板面外周にテー
    パ部を設け、前記下型の封入金型の放熱板接触箇所に凸
    部を設けることを特徴とする、請求項2または3に記載
    の非絶縁性半導体装置の製造方法。
  6. 【請求項6】前記樹脂封入後の樹脂ばり取り工程を省略
    することを特徴とする、請求項1〜5のいずれかに記載
    の非絶縁性半導体装置の製造方法。
JP20728599A 1999-07-22 1999-07-22 非絶縁型半導体装置の製造方法 Pending JP2001035868A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2004032233A1 (en) * 2002-10-07 2004-04-15 Koninklijke Philips Electronics N.V. Semiconductor device and method of manufacturing thereof
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