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EP0021062B1 - Verfahren zur Vornahme einer Plausibilitätsprüfung bezüglich aufeinanderfolgend auftretender Zeitinformationen in Verkehrssignalanlagen - Google Patents

Verfahren zur Vornahme einer Plausibilitätsprüfung bezüglich aufeinanderfolgend auftretender Zeitinformationen in Verkehrssignalanlagen Download PDF

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Publication number
EP0021062B1
EP0021062B1 EP80102905A EP80102905A EP0021062B1 EP 0021062 B1 EP0021062 B1 EP 0021062B1 EP 80102905 A EP80102905 A EP 80102905A EP 80102905 A EP80102905 A EP 80102905A EP 0021062 B1 EP0021062 B1 EP 0021062B1
Authority
EP
European Patent Office
Prior art keywords
store
time information
memory
content
traffic
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
EP80102905A
Other languages
English (en)
French (fr)
Other versions
EP0021062A2 (de
EP0021062A3 (en
Inventor
Horst Ing.-Grad. Schnippert
Heinrich Dipl.-Ing. Brunner
Bálint Dipl.-Ing. Kéry
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Siemens AG
Original Assignee
Siemens AG
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Siemens AG filed Critical Siemens AG
Priority to AT80102905T priority Critical patent/ATE12706T1/de
Publication of EP0021062A2 publication Critical patent/EP0021062A2/de
Publication of EP0021062A3 publication Critical patent/EP0021062A3/de
Application granted granted Critical
Publication of EP0021062B1 publication Critical patent/EP0021062B1/de
Expired legal-status Critical Current

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    • G—PHYSICS
    • G04—HOROLOGY
    • G04G—ELECTRONIC TIME-PIECES
    • G04G9/00—Visual time or date indication means
    • G04G9/0005—Transmission of control signals
    • G04G9/0011—Transmission of control signals using coded signals
    • G—PHYSICS
    • G04—HOROLOGY
    • G04R—RADIO-CONTROLLED TIME-PIECES
    • G04R20/00—Setting the time according to the time information carried or implied by the radio signal
    • G04R20/08—Setting the time according to the time information carried or implied by the radio signal the radio signal being broadcast from a long-wave call sign, e.g. DCF77, JJY40, JJY60, MSF60 or WWVB
    • G04R20/12—Decoding time data; Circuits therefor
    • G—PHYSICS
    • G08—SIGNALLING
    • G08G—TRAFFIC CONTROL SYSTEMS
    • G08G1/00—Traffic control systems for road vehicles
    • G08G1/07—Controlling traffic signals

Definitions

  • the invention relates to a method according to the preamble of the claim.
  • the periodically transmitted time information is initially recorded in a first memory at the receiving end.
  • the time information previously held in the first memory is transferred to a second memory and changed there adding the time period that elapses between two time information transmissions.
  • the contents of the two memories are then compared. If this comparison shows agreement, a counter is switched on. If the memory comparison does not match the contents of the memory, the counter is reset. Only when a certain counter reading has been reached is this evaluated as receiving undisturbed time information and now the second memory is separated from the memory comparison and the content of the second memory is changed autonomously in the rhythm of the time periods between two time information by the amount of this time period.
  • the respective content of the second memory then serves as time information that can be used by the receiver.
  • the object of the present invention is therefore to develop a method of the type mentioned at the outset in such a way that time information received and assessed as correct is available for controlling the traffic signal system.
  • the circuit arrangement shown in the drawing comprises a time information receiving device consisting of a receiver Rec and a decoder Dec connected downstream of this receiver Rec.
  • the receiver Rec may be a radio receiver that is connected on the input side to an antenna Ant, which can be a ferrite antenna, for example.
  • the receiver Rec may be designed such that it receives, for example, the time information respectively transmitted by the time stamp and normal frequency transmitter DCF 77.
  • This time information occurs serially; it includes second, minute, hour, calendar day, weekday, calendar month and year information.
  • the present invention is not limited to the serial reception of time information of the type under consideration. Rather, the present invention can also process time information that occurs in a different manner in the manner to be considered in more detail below.
  • the receiver Rec could also be designed in such a way that it records time information supplied to it in parallel on the input side.
  • the decoder Dec which converts the time information received from the receiver Rec into a form suitable for subsequent further processing, has two outputs a1 and a2.
  • the output a1 comprises a plurality of individual outputs, which are connected via a corresponding multi-core line Lz to a corresponding number of individual inputs of a memory input ez1 of a first memory M1.
  • the actual time information that is to say the complete time information contained in the time information received by the receiver Rec, appears at the output a1 of the decoder Dec.
  • pulses may occur in a certain rhythm, which are passed on via a line Lm. If one starts from the reception of the time information transmitted by the transmitter DCF 77, the pulses occurring at the output a2 of the decoder Dec will be so-called minute pulses, which thus occur at the end of each minute of the transmitter concerned.
  • the line Lm connected to the output a2 of the decoder Dec is connected to an enable input en1 of the said first memory M1.
  • This memory M1 - which will have such a storage capacity that it will be able to store the time information supplied to its memory input ez1 - is released for storing the time information present at its just mentioned memory input ez1 when its release input en1 has a corresponding pulse as an enable pulse is fed.
  • Two logic circuits Vs1, Vs2, each with one input side and a comparator Com, with its one input side ev1, are connected to the output side of the memory M1 designated az1.
  • the logic circuits Vs1, Vs2 and the comparator Com are each connected to the output side az1 of the memory M1 via a plurality of connecting lines with their input sides mentioned. This is indicated by slashes crossing the connecting lines in question.
  • the logic circuits Vs1, Vs2 it should also be noted that these contain a plurality of logic elements which - as indicated in the drawing - may be formed by AND gates, for example.
  • the logic circuit Vs1 is connected on the output side to the input side ez2 of a second memory M2 via a corresponding plurality of connecting lines.
  • This memory M2 which has a corresponding memory capacity as the memory M1, is with ei nem separate control input ec connected to the already mentioned line Lm.
  • a pulse supplied to this control input ec of the memory M2 has the effect that the memory content of the memory M2 - that is to say the time information contained in this memory M2 - is increased by a fixed time value, for example by one minute.
  • the memory M2 is connected on the output side via a plurality of lines to an input ev2 of the comparator Com having a corresponding number of individual inputs.
  • the comparator Com is connected with a release input em to the line Lm already mentioned above.
  • This control input em of the comparator Com is designed in such a way that the comparator Com is able to carry out a comparison process with respect to the time information at its inputs ev1 and ev2 only when the trailing edge of a pulse occurring on the line Lm occurs.
  • the comparator Com has two outputs av1 and av2.
  • the comparator Com then outputs a certain output signal (binary signal “H”) from the output av1 when it determines a match between the time information supplied to it on the input side for a comparison. For this reason, an equals sign is also indicated at the output av1 of the comparator Com.
  • the comparator Com then outputs a specific output signal (binary signal “H”) from its output av2 when it detects an inequality between the time information supplied to it on the input side for a comparison. For this reason, an inequality sign is also indicated at the output av2 of the comparator Com.
  • the comparator Com is connected with its output av1 to an input of the logic circuit Vs2. With its other output av2, the comparator Com is connected to an input of the logic circuit Vs1.
  • a certain output signal (binary signal “H”) is emitted from the respective output av1 or av2 of the comparator Com, either the logic circuit Vs2 or the logic circuit Vs1 is made capable of being transmitted for the transmission of time information supplied to it on the input side.
  • the logic circuit Vs2 is connected on the output side via a plurality of lines to the memory input side ez3 of a third memory M3.
  • this memory M3 contains the current time information for the circuit arrangement under consideration.
  • the memory M3 is connected to an enable input en3 in the present case at the output of a counter Cnt, which is connected on the input side to the output av2 of the comparator Com.
  • the memory M3 is connected on the output side to a control input ed of a control device Con, which controls the processing of traffic signal programs in a traffic signal system to which it belongs. From this traffic signal system, only two signal generators Sg1 and Sg2 are indicated, to which corresponding control signals are supplied by the control device Con. These signal transmitters may each contain, for example, a green signal lamp (indicated by a circle with a vertical line in the drawing) and a red signal lamp (indicated by a circle with a horizontal line in the drawing).
  • the control device Con is connected to an input / output eam with a program memory PROM which contains the traffic signal programs to be used in each case, which are selected in accordance with the time information supplied by the memory M3 and processed in the control device Con.
  • the programs in question can be permanently stored in the program memory PROM, or they can be supplied to the program memory PROM from time to time by a traffic control center superordinate to several traffic signal systems. It is important for the present case, however, that the program memory PROM contains different traffic signal programs, which have to be processed at different times for the traffic signal system in question.
  • the program memory PROM can contain, for example, a holiday traffic signal program and a weekday traffic signal program in order to do justice to the different traffic conditions in the area of the associated traffic signal system on public holidays and weekdays.
  • this output signal has the effect that the logic circuit Vs1 is capable of being transmitted for the time information provided by the memory M1.
  • the relevant time information thus enters the memory M2, which then has the same memory content as the memory M1.
  • the comparator Com is no longer effective in order to compare the corrected memory content of the memory M2 with the memory content of the memory M1 chen.
  • the comparator Com carries out a corresponding comparison if a further pulse has been emitted from the output a2 of the decoder Dec via the line Lm. This is the case after the receiver Rec has received further time information which has also been decoded accordingly by the decoder Dec.
  • the occurrence of a pulse on the line Lm causes the new time information now present to be stored in the memory M1.
  • the pulse occurring on the line Lm causes the "old" time information still contained in the memory M2 to be increased by a fixed time value, for example by one minute.
  • the ratios are chosen such that the specified time value is equal to the difference between two time information items recorded in succession by the receiver Rec.
  • the comparator Com will now determine a match between the signals or time information it has compared with one another as a result of the last considered processes in the memories M1 and M2.
  • the result of this is that the logic circuit Vs2 then becomes capable of transmission, as a result of which the “new” time information still contained in the memory M1 is stored in the memory M3 as current time information.
  • the time information required for the selection and processing of a traffic signal program from the program memory PROM is thus available for the control device Con of the traffic signal system. This time information has been subjected to a plausibility check.
  • the time information stored in the memory M1 is only stored in the memory M3 as current time information if it has a fixed relationship to the time information previously recorded and stored in the memory M2.
  • the comparator Com determines in the course of carrying out a comparison between two pieces of time information that these are not in the previously mentioned fixed relationship to one another - that is to say are unequal - this in turn causes the logic circuit Vs1 to be made transferable.
  • the time information contained in the memory M1 is thus stored in the memory M2, so that both memories M1 and M2 then again contain the same time information stored.
  • the occurrence of any inequality between the time information compared with each other is counted by the counter Cnt connected to the output av2 of the comparator Com.
  • the arrangement may be such that the counter Cnt emits an error signal when a certain counter position is reached, for example when the counter position 2 which is used, for example, to block or delete the memory M3.
  • the counter Cnt can be connected to the output av1 of the comparator Com with a reset input.

Landscapes

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  • General Physics & Mathematics (AREA)
  • Traffic Control Systems (AREA)
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  • Mobile Radio Communication Systems (AREA)
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  • Road Signs Or Road Markings (AREA)
  • Indicating And Signalling Devices For Elevators (AREA)
  • Circuits Of Receivers In General (AREA)

Description

  • Die Erfindung bezieht sich auf ein Verfahren entsprechend dem Oberbegriff des Patentanspruches.
  • Ein solches Verfahren ist ohne Bezug auf Verkehrssignalanlagen aus der DE-A-1 416 202 bekannt.
  • Bei dem bekannten Verfahren werden die periodisch ausgesandten Zeitinformationen empfangsseitig zunächst in einem ersten Speicher festgehalten. Vor dem Einspeichern einer neuen Zeitinformation in den ersten Speicher wird die bisher im ersten Speicher festgehaltene Zeitinformation auf einen zweiten Speicher übertragen und dort unter Addition der Zeitspanne, die zwischen zwei Zeitinformationsübertragungen verstreicht, verändert. Danach erfolgt ein Vergleich der Speicherinhalte der beiden Speicher. Ergibt dieser Vergleich Übereinstimmung, so wird ein Zähler weitergeschaltet. Ergibt der Speichervergleich keine Übereinstimmung der Speicherinhalte, so wird der Zähler zurückgestellt. Erst wenn ein bestimmter Zählerstand erreicht ist, wird dies als Empfang ungestörter Zeitinformationen ausgewertet und nun der zweite Speicher vom Speichervergleich abgetrennt und der Inhalt des zweiten Speichers autonom im Rhythmus der zwischen zwei Zeitinformationen liegenden Zeitspannen um den Betrag dieser Zeitspannen verändert. Der jeweilige Inhalt des zweiten Speichers dient dann als empfangsseitig verwertbare Zeitinformation.
  • Bei der Veränderung des Inhalts des zweiten Speichers kann es aber zu Störungen kommen.
  • Aufgabe vorliegender Erfindung ist es daher, ein Verfahren der eingangs genannten Art derart weiterzubilden, dass eine empfangene und als richtig bewertete Zeitinformation zur Steuerung der Verkehrssignalanlage zur Verfügung steht.
  • Erfindungsgemäss ergibt sich die Lösung dieser Aufgabe durch eine den kennzeichnenden Merkmalen des Patentanspruches entsprechende Ausbildung des Verfahrens.
  • Ein Ausführungsbeispiel der Erfindung wird nachstehend anhand einer Figur noch näher erläutert.
  • Die in der Zeichnung dargestellte Schaltungsanordnung umfasst eine Zeitinformations-Empfangseinrichtung, bestehend aus einem Empfänger Rec und einem diesem Empfänger Rec nachgeschalteten Decoder Dec. Der Empfänger Rec mag ein Funkempfänger sein, der eingangsseitig mit einer Antenne Ant verbunden ist, die beispielsweise eine Ferritantenne sein kann. Der Empfänger Rec mag so ausgelegt sein, dass er beispielsweise die von dem Zeitmarken- und Normalfrequenzsender DCF 77 jeweils ausgesendeten Zeitinformationen empfängt. Diese Zeitinformationen treten seriell auf; sie umfassen Sekunden-, Minuten-, Stunden-, Kalendertags-, Wochentags-, Kalendermonats- und Jahres-Informationen. An dieser Stelle sei angemerkt, dass die vorliegende Erfindung nicht auf den seriellen Empfang von Zeitinformationen der gerade betrachteten Art beschränkt ist. Vielmehr kann die vorliegende Erfindung auch in anderer Art und Weise auftretende Zeitinformationen in der nachstehend noch näher zu betrachtenden Weise verarbeiten. So könnte der Empfänger Rec auch derart ausgelegt sein, dass er jeweils parallel ihm eingangsseitig zugeführte Zeitinformationen aufnimmt.
  • Der Decoder Dec, der die von dem Empfänger Rec jeweils empfangenen Zeitinformationen in für eine anschliessende Weiterverarbeitung geeignete Form umsetzt, weist zwei Ausgänge a1 und a2 auf. Der Ausgang a1 umfasst dabei eine Mehrzahl von Einzelausgängen, die über eine entsprechende mehradrige Leitung Lz mit einer entsprechenden Anzahl von Einzeleingängen eines Speichereingangs ez1 eines ersten Speichers M1 verbunden sind. An dem Ausgang a1 des Decoders Dec treten die eigentlichen Zeitinformationen auf, also die vollständigen Zeitangaben, die in den von dem Empfänger Rec jeweils empfangenen Zeitinformationen enthalten sind. An dem anderen Ausgangs a2 des Decoders Dec mögen in einem bestimmten Rhythmus Impulse auftreten, die über eine Leitung Lm weitergeleitet werden. Geht man vom Empfang der von dem Sender DCF 77 ausgesendeten Zeitinformationen aus, so werden die am Ausgang a2 des Decoders Dec auftretenden Impulse sogenannte Minutenimpulse sein, die also am Ende jeder Sendeminute des betreffenden Senders auftreten.
  • Die am Ausgang a2 des Decoders Dec angeschlossene Leitung Lm ist an einem Freigabeeingang en1 des genannten ersten Speichers M1 angeschlossen. Dieser Speicher M1 - der eine solche Speicherkapazität haben wird, dass er die seinem Speichereingang ez1 jeweils zugeführte Zeitinformation zu speichern vermag - wird für eine Einspeicherung der an seinem gerade erwähnten Speichereingang ez1 jeweils anliegenden Zeitinformation dann freigegeben, wenn seinem Freigabeeingang en1 ein entsprechender Impuls als Freigabeimpuls zugeführt wird. An der mit az1 bezeichneten Ausgangsseite des Speichers M1 sind zwei Verknüpfungsschaltungen Vs1, Vs2 mit ihrer jeweils einen Eingangsseite und ein Vergleicher Com mit seiner einen Eingangsseite ev1 angeschlossen. Die Verknüpfungsschaltungen Vs1, Vs2 und der Vergleicher Com sind mit ihren erwähnten Eingangsseiten jeweils über eine Mehrzahl von Verbindungsleitungen mit der Ausgangsseite az1 des Speichers M1 verbunden. Dies ist durch die betreffende Verbindungsleitungen kreuzende Schrägstriche angedeutet. Bezüglich der Verknüpfungsschaltungen Vs1, Vs2 sei noch angemerkt, dass diese eine Mehrzahl von Verknüpfungsgliedern enthalten, welche - wie in der Zeichnung angedeutet - beispielsweise durch UND-Glieder gebildet sein mögen.
  • Die Verknüpfungsschaltung Vs1 ist ausgangsseitig über eine entsprechende Mehrzahl von Verbindungsleitungen mit der Eingangsseite ez2 eines zweiten Speichers M2 verbunden. Dieser Speicher M2, der eine entsprechende Speicherkapazität aufweist wie der Speicher M1, ist mit einem gesonderten Steuereingang ec mit der bereits erwähnten Leitung Lm verbunden. Ein diesem Steuereingang ec des Speichers M2 zugeführter Impuls bewirkt, dass der Speicherinhalt des Speichers M2 - also die in diesem Speicher M2 enthaltene Zeitinformation - um einen festgelegten Zeitwert, beispielsweise um eine Minute, erhöht wird.
  • Der Speicher M2 ist ausgangsseitig über eine Mehrzahl von Leitungen mit einem eine entsprechende Anzahl von Einzeleingängen aufweisenden Eingang ev2 des Vergleichers Com verbunden. Der Vergleicher Com ist mit einem Freigabeeingang em an der oben bereits erwähnten Leitung Lm angeschlossen. Dieser Steuereingang em des Vergleichers Com ist so ausgelegt, dass der Vergleicher Com erst mit Auftreten der Rückflanke eines auf der Leitung Lm auftretenden Impulses hin einen Vergleichsvorgang bezüglich der an seinen Eingängen ev1 und ev2 liegenden Zeitinformationen vorzunehmen vermag.
  • Der Vergleicher Com weist zwei Ausgänge av1 und av2 auf. Von dem Ausgang av1 gibt der Vergleicher Com dann ein bestimmtes Ausgangssignal (Binärsignal «H») ab, wenn er eine Übereinstimmung zwischen den ihm eingangsseitig jeweils für einen Vergleich zugeführten Zeitinformationen feststellt. Aus diesem Grunde ist an dem Ausgang av1 des Vergleichers Com auch ein Gleichheitszeichen angedeutet. Von seinem Ausgang av2 gibt der Vergleicher Com dann ein bestimmtes Ausgangssignal (Binärsignal «H») ab, wenn er eine Ungleichheit zwischen den ihm eingangsseitig für einen Vergleich jeweils zugeführten Zeitinformationen feststellt. Aus diesem Grunde ist an dem Ausgang av2 des Vergleichers Com auch ein Ungleichheitszeichen angedeutet.
  • Der Vergleicher Com ist mit seinem Ausgang av1 mit einem Eingang der Verknüpfungsschaltung Vs2 verbunden. Mit seinem anderen Ausgang av2 ist der Vergleicher Com mit einem Eingang der Verknüpfungsschaltung Vs1 verbunden. Auf die Abgabe eines bestimmten Ausgangssignals (Binärsignal «H») von dem jeweiligen Ausgang av1 bzw. av2 des Vergleichers Com hin ist entweder die Verknüpfungsschaltung Vs2 oder die Verknüpfungsschaltung Vs1 für die Übertragung von ihr eingangsseitig zugeführten Zeitinformationen übertragungsfähig gemacht.
  • Die Verknüpfungsschaltung Vs2 ist ausgangsseitig über eine Mehrzahl von Leitungen mit der Speichereingangsseite ez3 eines dritten Speichers M3 verbunden. Dieser Speicher M3 enthält, wie noch ersichtlich werden wird, die für die betrachtete Schaltungsanordnung jeweils aktuelle Zeitinformation. Der Speicher M3 ist mit einem Freigabeeingang en3 im vorliegenden Fall am Ausgang eines Zählers Cnt angeschlossen, der eingangsseitig an dem Ausgang av2 des Vergleichers Com angeschlossen ist.
  • Der Speicher M3 ist ausgangsseitig an einem Steuereingang ed einer Steuereinrichtung Con angeschlossen, die die Abwicklung von Verkehrssignalprogrammen in einer Verkehrssignalanlage steuert, der sie zugehörig ist. Von dieser Verkehrssignalanlage sind im übrigen lediglich zwei Signalgeber Sg1 und Sg2 angedeutet, denen entsprechende Steuersignale von der Steuereinrichtung Con zugeführt werden. Diese Signalgeber mögen beispielsweise jeweils eine grüne Signallampe (in der Zeichnung durch einen Kreis mit einem senkrechten Strich angedeutet) und eine rote Signallampe (in der Zeichnung durch einen Kreis mit einem waagrechten Strich angedeutet) enthalten. Die Steuereinrichtung Con ist mit einem Eingang/Ausgang eam mit einem Programmspeicher PROM verbunden, der die jeweils zu benutzenden Verkehrssignalprogramme enthält, die nach Massgabe der von dem Speicher M3 jeweils zugeführten Zeitinformationen ausgewählt und in der Steuereinrichtung Con verarbeitet werden. Die betreffenden Programme können in dem Programmspeicher PROM fest eingespeichert sein, oder aber sie können dem Programmspeicher PROM von einer mehreren Verkehrssignalanlagen übergeordneten Verkehrszentrale von Zeit zu Zeit zugeführt werden. Von Bedeutung für den vorliegenden Fall ist dabei jedoch, dass der Programmspeicher PROM jeweils unterschiedliche Verkehrssignalprogramme enthält, die zu verschiedenen Zeiten für die betreffende Verkehrssignalanlage abzuwickeln sind. Im einfachsten Fall kann der Programmspeicher PROM beispielsweise ein Feiertags-Verkehrssignalprogramm und ein Werktags-Verkehrssignalprogramm enthalten, um den an Feiertagen und Werktagen vorliegenden unterschiedlichen Verkehrsbedingungen im Bereich der zugehörigen Verkehrssignalanlage gerecht zu werden.
  • Im folgenden wird die Arbeitsweise der in der Zeichnung dargestellten Anordnung näher erläutert. Zu diesem Zweck sei angenommen, dass sich in den Speichern M1, M2 und M3 zunächst keinerlei Zeitinformation befindet. Wird nunmehr durch den Empfänger Rec eine Zeitinformation empfangen, so wird diese Zeitinformation in den Speicher M1 eingespeichert. Zugleich damit wird der Inhalt des Speichers M2 um einen bestimmten festgelegten Zeitwert erhöht. Da der Speicherinhalt des Speichers M2 zunächst Null war, wird sich in diesem Speicher M2 sodann lediglich der für eine Erhöhung vorgesehene Zeitwert befinden. Dieser Zeitwert wird am Ende des auf der Leitung Lm auftretenden Impulses in dem Vergleicher Com mit der in dem Speicher M1 enthaltenen Zeitinformation verglichen. Da anzunehmen ist, dass der Vergleicher Com dabei eine Ungleichheit zwischen den miteinander verglichenen Signalen feststellt, gibt er an seinem Ausgang av2 ein bestimmtes Ausgangssignal (Binärsignal «H») ab. Das Auftreten dieses Ausgangssignals bewirkt, dass die Verknüpfungsschaltung Vs1 für die vom Speicher M1 abgegebene Zeitinformation übertragungsfähig ist. Die betreffende Zeitinformation gelangt somit in den Speicher M2 hinein, der daraufhin den gleichen Speicherinhalt besitzt wie der Speicher M1. Der Vergleicher Com ist zu diesem Zeitpunkt jedoch nicht mehr wirksam, um den korrigierten Speicherinhalt des Speichers M2 mit dem Speicherinhalt des Speichers M1 zu vergleichen. Einen entsprechenden Vergleich führt der Vergleicher Com jedoch aus, wenn vom Ausgang a2 des Decoders Dec ein weiterer Impuls über die Leitung Lm abgegeben worden ist. Dies ist der Fall, nachdem der Empfänger Rec eine weitere Zeitinformation empfangen hat, die auch von dem Decoder Dec entsprechend decodiert worden ist. In diesem Fall bewirkt das Auftreten eines Impulses auf der Leitung Lm, dass die nunmehr vorliegende neue Zeitinformation in den Speicher M1 eingespeichert wird. Ausserdem bewirkt der auf der Leitung Lm auftretende Impulse, dass die in dem Speicher M2 noch enthaltene «alte» Zeitinformation um einen festgelegten Zeitwert, beispielsweise um eine Minute, erhöht wird. Dabei seien die Verhältnisse so gewählt, dass der erwähnte festgelegte Zeitwert gleich der Differenz zwischen zwei von dem Empfänger Rec aufeinanderfolgend aufgenommenen Zeitinformationen ist.
  • Durch die zuletzt betrachteten Vorgänge in den Speichern M1 und M2 wird der Vergleicher Com nunmehr eine Übereinstimmung zwischen den durch ihn miteinander verglichenen Signalen bzw. Zeitinformationen feststellen. Dies hat zur Folge, dass daraufhin die Verknüpfungsschaltung Vs2 übertragungsfähig wird, wodurch die in dem Speicher M1 noch enthaltene «neue» Zeitinformation als aktuelle Zeitinformation in den Speicher M3 eingespeichert wird. Damit steht also für die Steuereinrichtung Con der Verkehrssignalanlage die für die Auswahl und Verarbeitung eines Verkehrssignalprogramms aus dem Programmspeicher PROM erforderliche Zeitinformation zur Verfügung. Diese Zeitinformation ist dabei einer Plausibilitätsprüfung unterzogen worden. Wie erläutert, wird die in dem Speicher M1 eingespeicherte Zeitinformation nur dann als aktuelle Zeitinformation in den Speicher M3 eingespeichert, wenn sie zu der zuvor aufgenommenen und in dem Speicher M2 gespeicherten Zeitinformation in einer festgelegten Beziehung steht.
  • Stellt der Vergleicher Com im Zuge der Durchführung eines Vergleichs zwischen zwei Zeitinformationen fest, dass diese nicht in der zuvor erwähnten festgelegten Beziehung zueinander stehen - also ungleich sind -so bewirkt er wiederum, dass die Verknüpfungsschaltung Vs1 übertragungsfähig gemacht wird. Damit wird die in dem Speicher M1 enthaltene Zeitinformation in den Speicher M2 eingespeichert, so dass dann wieder beide Speicher M1 und M2 dieselbe Zeitinformation gespeichert enthalten.
  • Durch den am Ausgang av2 des Vergleichers Com angeschlossenen ZähIerCnt wird das Auftreten jeder Ungleichheit zwischen den jeweils miteinander verglichenen Zeitinformationen gezählt Die Anordnung mag dabei so getroffen sein, dass der Zähler Cnt bei Erreichen einer bestimmten Zählerstellung, beispielsweise bei der Zählerstellung 2, ein Fehlermeldesignal abgibt, welches beispielsweise zur Sperrung oder Löschung des Speichers M3 herangezogen wird. Der Zähler Cnt kann mit einem Rückstelleingang am Ausgang av1 des Vergleichers Com angeschlossen sein.
  • Durch die vorstehend erläuterte Verfahrensweise bei der in der Zeichnung dargestellten Schaltungsanordnung ist also sichergestellt, dass nur solche Zeitinformationen für die Steuereinrichtung Con der Verkehrssignalanlage bereitgestellt werden, bezüglich derer eine Plausibilität dafür vorliegt, dass sie auch richtig sind. Auf diese Weise können entweder in der betrachteten Schaltungsanordnung auftretende Fehler oder im Zuge der Übertragung der jeweiligen Zeitinformation auftretende Störungen erkannt werden, die nicht nur eine einmalige Verfälschung einer Zeitinformation bewirken, sondern die eine mehrmalige Zeitinformationsverfälschung hervorrufen.
  • Abschliessend sei noch bemerkt, dass für die Realisierung der erläuterten Schaltungsanordnung ein Mikroprozessor bzw. ein Mikrocomputer verwendet werden kann.

Claims (1)

1. Verfahren zur Überprüfung aufeinanderfolgend empfangener, von einer zentralen Stelle, insbesondere einem Funksender, ausgesandter Zeitinformationen, die in örtlich voneinander getrennten Verkehrssignalanlagen jeweils zur zeitgerechten Steuerung dieser Anlagen einzelnen Verkehrssignalprogrammen entsprechend verwendet werden, bei dem ein erster und ein zweiter Speicher (M1, M2) verwendet werden, wobei der erste Speicher (M1) zur Aufnahme der jeweils zuletzt empfangenen Zeitinformation dient, und die vom ersten Speicher (M1) auf den zweiten Speicher (M2) übertragene Zeitinformation im zweiten Speicher (M2) jeweils um den Betrag der Zeitspanne zwischen zwei aufeinanderfolgend empfangenen Zeitinformationen verändert wird, und bei dem die Inhalte des ersten und des zweiten Speichers (M1, M2) periodisch im Takt der aufeinanderfolgenden Zeitinformationen miteinander verglichen werden, dadurch gekennzeichnet, dass unter Verwendung eines dritten Speichers (M3) bei jedem eine Übereinstimmung ergebenden Vergleich der Inhalte des ersten und zweiten Speichers (M1, M2) der Inhalt des ersten Speichers (M1) auf den dritten Speicher (M3) und lediglich bei einem eine Nichtübereinstimmung ergebenden solchen Vergleich der Inhalt des ersten Speichers (M1) auf den zweiten Speicher (M2) übertragen wird, und dass der Inhalt des dritten Speichers (M3) zur Steuerung der Programmabwicklung der Verkehrssignalanlage verwendet wird.
EP80102905A 1979-06-07 1980-05-23 Verfahren zur Vornahme einer Plausibilitätsprüfung bezüglich aufeinanderfolgend auftretender Zeitinformationen in Verkehrssignalanlagen Expired EP0021062B1 (de)

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Application Number Priority Date Filing Date Title
AT80102905T ATE12706T1 (de) 1979-06-07 1980-05-23 Verfahren zur vornahme einer plausibilitaetspruefung bezueglich aufeinanderfolgend auftretender zeitinformationen in verkehrssignalanlagen.

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Application Number Priority Date Filing Date Title
DE19792923121 DE2923121A1 (de) 1979-06-07 1979-06-07 Verfahren und schaltungsanordnung zur vornahme einer plausibilitaetspruefung bezueglich aufeinanderfolgend auftretender zeitinformationen in verkehrssignalanlagen
DE2923121 1979-06-07

Publications (3)

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Application Number Title Priority Date Filing Date
EP80102905A Expired EP0021062B1 (de) 1979-06-07 1980-05-23 Verfahren zur Vornahme einer Plausibilitätsprüfung bezüglich aufeinanderfolgend auftretender Zeitinformationen in Verkehrssignalanlagen

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Country Link
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