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CN115035858A - 像素电路及其驱动方法、显示面板 - Google Patents

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CN115035858A CN202210753229.7A CN202210753229A CN115035858A CN 115035858 A CN115035858 A CN 115035858A CN 202210753229 A CN202210753229 A CN 202210753229A CN 115035858 A CN115035858 A CN 115035858A
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Abstract

本申请实施例提供了像素电路及其驱动方法、显示面板，像素电路包括：驱动模块，其控制端与第一节点电连接；阈值补偿模块，与第一扫描信号线、第一节点和驱动模块的第一端电连接；第一开关模块，与第一发光控制信号线和驱动模块的第一端电连接；第二开关模块，与第二发光控制信号线、第一开关模块的第二端和发光元件的第一极电连接；稳压模块，与恒定电压信号线和目标节点电连接，目标节点为第二开关模块的第一端与第一开关模块的第二端的连接节点，稳压模块用于维持目标节点的电位；在发光阶段，第一开关模块导通，第二开关模块导通，发光元件发光。本申请实施例能够减小像素电路中部分节点的漏电流，提高显示面板亮度的稳定性和均一性。

Description

像素电路及其驱动方法、显示面板
技术领域
本申请属于显示技术领域，尤其涉及一种像素电路及其驱动方法、显示面板。
背景技术
有机发光二极管(Organic Light Emitting Diode，OLED)显示面板可以包括呈阵列排布的多个子像素，子像素可以包括像素电路和发光元件，像素电路中设有多个晶体管，基于多个晶体管的相互配合，像素电路向发光元件传输驱动电流，以驱动发光元件发光。
然而，经本申请的发明人研究发现，像素电路中部分节点漏电严重，导致像素电路传输的驱动电流偏离其标准值，进而使发光元件的发光亮度出现偏差。此外，当不同行子像素中的像素电路的漏电时间不同时，导致不同行子像素中的发光元件的亮度出现差异，即亮度不均的问题。
发明内容
本申请实施例提供了一种像素电路及其驱动方法、显示面板，能够减小像素电路中部分节点的漏电流，提高显示面板亮度的稳定性和均一性。
第一方面，本申请实施例提供了一种像素电路，像素电路包括：驱动模块，驱动模块的控制端与第一节点电连接；阈值补偿模块，阈值补偿模块的控制端与第一扫描信号线电连接，阈值补偿模块的第一端与第一节点电连接，阈值补偿模块的第二端与驱动模块的第一端电连接；第一开关模块，第一开关模块的控制端与第一发光控制信号线电连接，第一开关模块的第一端与驱动模块的第一端电连接；第二开关模块，第二开关模块的控制端与第二发光控制信号线电连接，第二开关模块的第一端与第一开关模块的第二端电连接，第二开关模块的第二端与发光元件的第一极电连接；稳压模块，稳压模块的第一端与恒定电压信号线电连接，稳压模块的第二端与目标节点电连接，目标节点为第二开关模块的第一端与第一开关模块的第二端的连接节点，稳压模块用于维持目标节点的电位；在发光阶段，第一开关模块响应于第一发光控制信号线的导通电平而导通，第二开关模块响应于第二发光控制信号线的导通电平而导通，发光元件发光。
第二方面，本申请实施例提供了一种像素电路的驱动方法，像素电路包括如第一方面提供的像素电路，驱动方法包括：在发光阶段，向第一发光控制信号线提供导通电平，向第二发光控制信号线的导通电平，以使驱动模块的第一端的电压信号通过导通的第一开关模块传输至目标节点。
第三方面，本申请实施例提供了一种显示面板，显示面板包括如第一方面提供的像素电路。
本申请实施例的像素电路及其驱动方法、显示面板，增设第一开关模块和稳压模块，第一开关模块与驱动模块的第一端(即输出端)电连接，稳压模块与第一开关模块和第二开关模块之间的目标节点电连接。在发光阶段，第一开关模块响应于第一发光控制信号线的导通电平而导通，第二开关模块响应于第二发光控制信号线的导通电平而导通，使得目标节点的电位与驱动模块的第一端的电位相等，稳压模块维持目标节点的电位。由于驱动模块的第一端的电位与第一节点(与驱动模块的控制端连接的节点)的电位之间的压差较小，所以目标节点的电位与第一节点的电位之间的压差较小，因此可以有效减小第一节点通过阈值补偿模块向目标节点漏电流，进而有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，提高显示面板亮度的均一性。
附图说明
为了更清楚地说明本申请实施例的技术方案，下面将对本申请实施例中所需要使用的附图作简单的介绍，对于本领域普通技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。
图1为像素电路的一种电路示意图；
图2为本申请实施例提供的像素电路的一种电路示意图；
图3为本申请实施例提供的像素电路的另一种电路示意图；
图4为本申请实施例提供的像素电路的一种驱动时序示意图；
图5为本申请实施例提供的像素电路的另一种驱动时序示意图；
图6为本申请实施例提供的像素电路的又一种电路示意图；
图7为本申请实施例提供的像素电路的又一种电路示意图；
图8为本申请实施例提供的像素电路的又一种电路示意图；
图9为本申请实施例提供的像素电路的又一种电路示意图；
图10为本申请实施例提供的像素电路的又一种驱动时序示意图；
图11为本申请实施例提供的像素电路的又一种驱动时序示意图；
图12为本申请实施例提供的像素电路的又一种电路示意图；
图13为本申请实施例提供的像素电路的又一种电路示意图；
图14为本申请实施例提供的像素电路的又一种电路示意图；
图15为本申请实施例提供的像素电路的又一种驱动时序示意图；
图16为本申请实施例提供的像素电路所在的显示面板的一种电路示意图；
图17为本申请实施例提供的像素电路所在的显示面板的另一种电路示意图；
图18为本申请实施例提供的像素电路所在的显示面板的又一种电路示意图；
图19为本申请实施例提供的像素电路所在的显示面板的一种局部剖面示意图；
图20为本申请实施例提供的像素电路所在的显示面板的另一种局部剖面示意图；
图21为本申请实施例提供的像素电路所在的显示面板的另一种局部剖面示意图；
图22为本申请实施例提供的像素电路的驱动方法的一种流程示意图；
图23为本申请实施例提供的像素电路的驱动方法的另一种流程示意图；
图24为本申请实施例提供的显示面板的一种结构示意图。
具体实施方式
下面将详细描述本申请的各个方面的特征和示例性实施例，为了使本申请的目的、技术方案及优点更加清楚明白，以下结合附图及具体实施例，对本申请进行进一步详细描述。应理解，此处所描述的具体实施例仅意在解释本申请，而不是限定本申请。对于本领域技术人员来说，本申请可以在不需要这些具体细节中的一些细节的情况下实施。下面对实施例的描述仅仅是为了通过示出本申请的示例来提供对本申请更好的理解。
需要说明的是，在本文中，诸如第一和第二等之类的关系术语仅仅用来将一个实体或者操作与另一个实体或操作区分开来，而不一定要求或者暗示这些实体或操作之间存在任何这种实际的关系或者顺序。而且，术语“包括”、“包含”或者其任何其他变体意在涵盖非排他性的包含，从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那些要素，而且还包括没有明确列出的其他要素，或者是还包括为这种过程、方法、物品或者设备所固有的要素。在没有更多限制的情况下，由语句“包括……”限定的要素，并不排除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。
应当理解，本文中使用的术语“和/或”仅仅是一种描述关联对象的关联关系，表示可以存在三种关系，例如，A和/或B，可以表示：单独存在A，同时存在A和B，单独存在B这三种情况。另外，本文中字符“/”，一般表示前后关联对象是一种“或”的关系。
需要说明的是，本申请实施例中的晶体管既可以为N型晶体管，也可以为P型晶体管。对于N型晶体管来说，导通电平为高电平，截止电平为低电平。即，N型晶体管的栅极为高电平时，其第一极和第二极之间导通，N型晶体管的栅极为低电平时，其第一极和第二极之间关断。对于P型晶体管来说，导通电平为低电平，截止电平为高电平。即，P型晶体管的控制极为低电平时，其第一极和第二极之间导通，P型晶体管的控制端为高电平时，其第一极和第二极之间关断。在具体实施时，上述各晶体管的栅极作为其控制极，并且，根据各晶体管的栅极的信号以及其类型，可以将其第一极作为源极，第二极作为漏极，或者将其第一极作为漏极，第二极作为源极，在此不做区分，另外本发明实施例中的导通电平和截止电平均为泛指，导通电平是指任何能够使晶体管导通的电平，截止电平是指任何能够使晶体管截止/关断的电平。
在本申请实施例中，术语“电连接”可以是指两个组件直接电连接，也可以是指两个组件之间经由一个或多个其它组件电连接。
在本申请实施例中，第一节点、第二节点和第三节点只是为了便于描述电路结构而定义的，第一节点、第二节点和第三节点并不是一个实际的电路单元。
在不脱离本申请的精神或范围的情况下，在本申请中能进行各种修改和变化，这对于本领域技术人员来说是显而易见的。因而，本申请意在覆盖落入所对应权利要求(要求保护的技术方案)及其等同物范围内的本申请的修改和变化。需要说明的是，本申请实施例所提供的实施方式，在不矛盾的情况下可以相互组合。
在阐述本申请实施例所提供的技术方案之前，为了便于对本申请实施例理解，本申请首先对现有技术中存在的问题进行具体说明：
图1为像素电路的一种电路示意图。如图1所示，像素电路可以包括驱动晶体管M1’、数据写入晶体管M2’、阈值补偿晶体管M3’和发光控制晶体管M4’。驱动晶体管M1’的栅极与第一节点N1电连接，驱动晶体管M1’的第一极与第三节点N3电连接。受晶体管阈值偏移特性的影响，晶体管无法完全关断。因此，在发光元件D的第一极的电位低于第一节点N1的电位时，第一节点N1的电荷会通过阈值补偿晶体管M3’、第三节点N3和发光控制晶体管M4’传输至发光元件D的第一极，即第一节点N1向发光元件D的第一极漏电流，使得第一节点N1的电位降低。随着第一节点N1的电位降低，驱动晶体管M1’的开关程度增大，使得驱动晶体管M1’的驱动电流增大，发光元件D越来越亮，即发光元件的发光亮度偏离期望的目标亮度。
此外，经本申请的发明人进一步研究发现，目前的一些类型的显示装置(如混合TFT显示装置)，因为驱动子像素发光需要多组扫描驱动信号线，所以为了缩小边框尺寸，通常会采用一驱二设计。其中，混合TFT显示装置(Hybrid TFT Display，HTD)即像素电路中具有氧化铟镓锌(IGZO)为有源层的薄膜晶体管(Thin Film Transistor，TFT)和多晶硅为有源层的TFT的显示装置。一驱二设计，即显示装置的扫描驱动电路包括多个级联的移位寄存器，每个移位寄存器可以与相邻两行扫描信号线电连接，每行扫描信号线可以与一行子像素中的像素电路电连接。举例而言，如图1所示，阈值补偿晶体管M3’的栅极与扫描信号线S1’电连接，同一个移位寄存器可以与相邻两行扫描信号线S1’电连接。相邻两行扫描信号线S1’中，第i行扫描信号线S1’与第i行像素电路中的阈值补偿晶体管M3’的栅极电连接，第i+1行扫描信号线S1’与第i+1行像素电路中的阈值补偿晶体管M3’的栅极电连接，i为正整数。
这样一来，对于第i行像素电路而言，在第i行像素电路写入数据信号至第i行像素电路写入数据信号的这段时间(即一行时间)内，扫描信号线S1一直输出导通电平，第i行像素电路中的阈值补偿晶体管M3’一直处于导通状态。在发光元件D发光前的一段时间，发光控制晶体管M4’处于导通状态，且发光元件D的第一极的电位低于第一节点N1的电位。因此，第一节点N1会通过导通的阈值补偿晶体管M3’、第三节点N3和导通的发光控制晶体管M4’传输至发光元件D的第一极，即第一节点N1向发光元件D的第一极漏电流。而对于第i+1行像素电路而言，在第i行像素电路写入数据信号之后，扫描信号线S1’会在较短的时间内切换为输出截止电平，即第i+1行像素电路中的阈值补偿晶体管M3’会很快关闭。因此，第i行像素电路中的第一节点N1的漏电量会大于第i+1行像素电路中的第一节点N1的漏电量，导致第i行像素电路连接的发光元件D相对偏亮、第i+1行像素电路连接的发光元件D相对偏暗，出现隔行的亮暗线。尤其对于一些可穿戴的显示装置而言，一行时间长达30～50us，第i行像素电路与第i+1行像素电路中的第一节点N1的漏电量差异更加明显，进而导致相邻行发光元件的亮度差异更加明显。
鉴于发明人的上述研究发现，本申请实施例提供了一种像素电路及其驱动方法、显示面板，能够解决相关技术中存在的发光元件的发光亮度偏离期望的目标亮度及相邻行发光元件的亮度差异明显的技术问题。
本申请实施例的技术构思在于：在像素电路中增设第一开关模块和稳压模块，第一开关模块与驱动模块的第一端(即输出端)电连接，稳压模块与第一开关模块和第二开关模块之间的目标节点电连接。在发光阶段，第一开关模块响应于第一发光控制信号线的导通电平而导通，第二开关模块响应于第二发光控制信号线的导通电平而导通，使得目标节点的电位与驱动模块的第一端的电位相等，稳压模块维持目标节点的电位。由于驱动模块的第一端的电位与第一节点(与驱动模块的控制端连接的节点)的电位之间的压差较小，所以目标节点的电位与第一节点的电位之间的压差较小，因此可以有效减小第一节点通过阈值补偿模块向目标节点漏电流，进而有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，提高显示面板亮度的均一性。
下面首先对本申请实施例所提供的像素电路进行介绍。
图2为本申请实施例提供的像素电路的一种电路示意图。如图2所示，本申请实施例提供的像素电路20可以包括驱动模块201、阈值补偿模块202、第一开关模块203、第二开关模块204和稳压模块205。驱动模块201的控制端与第一节点N1电连接。阈值补偿模块202的控制端与第一扫描信号线S1电连接，阈值补偿模块202的第一端与第一节点N1电连接，阈值补偿模块202的第二端与驱动模块201的第一端电连接。为了便于说明，不妨将驱动模块201的第一端连接的节点称作第三节点N3。在阈值补偿阶段，阈值补偿模块202响应于第一扫描信号线S1传输的导通电平而导通，用于将驱动模块201的第一端与驱动模块201的控制端连通，以实现驱动模块201的阈值电压的补偿。
第一开关模块203的控制端与第一发光控制信号线EM1电连接，第一开关模块203的第一端与驱动模块201的第一端(即第三节点N3)电连接。第二开关模块204的控制端与第二发光控制信号线EM2电连接，第二开关模块204的第一端与第一开关模块203的第二端电连接，第二开关模块204的第二端与发光元件D的第一极电连接。其中，发光元件D的第一极可以为发光元件D的阳极。发光元件D的阳极可以由各种导电材料形成。例如，发光元件D的阳极可以根据它的用途形成为透明电极或反射电极。当阳极形成为透明电极时，例如可以由氧化铟锡(ITO)、氧化铟锌(IZO)、氧化锌(ZnO)或氧化铟(In2O3)形成。当阳极形成为反射电极时，例如可以由银(Ag)、镁(Mg)、铝(Al)、铂(Pt)、钯(Pd)、金(Au)、镍(Ni)、钕(Nd)、铱(Ir)、铬(Cr)或者它们的混合物形成。
稳压模块205的第一端与恒定电压信号线V1电连接，稳压模块205的第二端与目标节点Nm电连接。其中，目标节点Nm为第二开关模块204的第一端与第一开关模块203的第二端的连接节点，即目标节点Nm同时与第二开关模块204的第一端和第一开关模块203的第二端电连接。恒定电压信号线V1向稳压模块205的第一端提供恒定电压信号，从而使得稳压模块能够维持目标节点Nm的电位。在一些示例中，恒定电压信号线V1可以为输出正向电压信号的正向电压信号线，如+3V、+5V或其他正数电压值的正向电压信号。在另一些示例中，恒定电压信号线V1也可以为输出负向电压信号的负向电压信号线，如-3V、-5V或其他负数电压值的负向电压信号，本申请实施例对此不作限定。
在发光阶段，第一开关模块203响应于第一发光控制信号线EM1的导通电平而导通，第二开关模块204响应于第二发光控制信号线EM2的导通电平而导通，发光元件D发光。第三节点N3的电压信号(即电荷)通过导通的第一开关模块203传输至目标节点Nm，使得目标节点Nm的电位与驱动模块201的第一端(即第三节点N3)的电位相等，稳压模块205维持目标节点Nm的电位。例如，经过在一些试验中测量，在发光阶段，第一节点N1的电位大概在1～2伏特，第三节点N3的电位大概在1.5伏特，即第一节点N1的电位与第三节点N3的电位之间的压差仅在-0.5～0.5伏特，而相关技术中第一节点N1的电位与发光元件D的第一极的电位之间的压差在4～5伏特。显然，第一节点N1的电位与第三节点N3的电位之间的压差明显小于第一节点N1的电位与发光元件D的第一极的电位之间的压差。
由于驱动模块201的第一端(即第三节点N3)的电位与第一节点N1的电位之间的压差较小，而目标节点Nm的电位与驱动模块201的第一端(即第三节点N3)的电位相等，所以目标节点Nm的电位与第一节点N1的电位之间的压差较小，因此可以有效减小第一节点N1通过阈值补偿模块向目标节点Nm漏电流，进而有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，提高显示面板亮度的均一性。
举例而言，例如在本帧第一开关模块203导通将第三节点N3的电荷传输至目标节点Nm之后，直至下一帧第一开关模块203导通再次将第三节点N3的电荷传输至目标节点Nm的这段时间(称作第一时间段)，目标节点Nm的电位一直维持目标电位，目标电位即在本帧的发光阶段时第三节点N3的电位。那么，在第一时间段内，由于目标节点Nm的电位与第一节点N1的电位之间的压差较小，因此可以有效减小第一节点N1通过阈值补偿模块向目标节点Nm漏电流。
图3为本申请实施例提供的像素电路的另一种电路示意图。如图3所示，根据本申请的一些实施例，可选地，驱动模块201可以包括驱动晶体管MT，阈值补偿模块202可以包括阈值补偿晶体管M0，第一开关模块203可以包括第一晶体管M1，第二开关模块204可以包括第二晶体管M2，稳压模块205可以包括第一存储电容C1，其中：
驱动晶体管MT的栅极与第一节点N1电连接，驱动晶体管MT的第一极与第三节点N3电连接。
阈值补偿晶体管M0的栅极与第一扫描信号线S1电连接，阈值补偿晶体管M0的第一极与第一节点N1电连接，阈值补偿晶体管M0的第二极与第三节点N3电连接。
第一晶体管M1的栅极与第一发光控制信号线EM1电连接，第一晶体管M1的第一极与第三节点N3电连接。第二晶体管M2的栅极与第二发光控制信号线EM2电连接，第二晶体管M2的第一极与第一晶体管M1的第二极电连接，第二晶体管M2的第二极与发光元件D的第一极电连接。
第一存储电容C1的第一极板与恒定电压信号线V1电连接，第一存储电容C1的第二极板与目标节点Nm电连接。
在发光阶段，第一晶体管M1响应于第一发光控制信号线EM1的导通电平而导通，第二晶体管M2响应于第二发光控制信号线EM2的导通电平而导通。第三节点N3的电压信号通过导通的第一晶体管M1传输至目标节点Nm，使得目标节点Nm的电位与第三节点N3的电位相等，第一存储电容C1维持目标节点Nm的电位。由于第三节点N3的电位与第一节点N1的电位之间的压差较小，而目标节点Nm的电位与第三节点N3的电位相等，所以目标节点Nm的电位与第一节点N1的电位之间的压差较小，因此可以有效减小第一节点N1通过阈值补偿晶体管向目标节点Nm漏电流，进而有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，提高显示面板亮度的均一性。
图4为本申请实施例提供的像素电路的一种驱动时序示意图。如图4所示，根据本申请的一些实施例，可选地，一帧时间T可以包括可以初始化阶段t1、阈值补偿阶段t2和发光阶段t3。其中，一帧时间T可以理解为像素电路20所在的显示面板显示一帧画面的时间。结合图2所示，在初始化阶段t1，第一扫描信号线S1、第一发光控制信号线EM1和第二发光控制信号线EM2均输出截止电平。在阈值补偿阶段t2，第一扫描信号线S1输出导通电平，阈值补偿模块202导通，实现驱动模块201的阈值电压补偿。在发光阶段t3，第一发光控制信号线EM1和第二发光控制信号线EM2输出导通电平，第一开关模块203和第二开关模块204导通，发光元件D发光。
在初始化阶段t1、阈值补偿阶段t2和发光阶段t3中的不同阶段，第一节点N1的电位是不同的。在图4所示实施例中，第一目标阶段时的目标节点Nm的电位与发光阶段t3时的第一节点N1的电位之间的差值的绝对值可以小于4伏特。其中，第一目标阶段可以包括从本帧的发光阶段t3至下一帧的发光阶段t3。即，在本帧第一开关模块203导通将第三节点N3的电荷传输至目标节点Nm直至下一帧第一开关模块203导通再次将第三节点N3的电荷传输至目标节点Nm的这段时间，目标节点Nm的电位一直维持目标电位，目标电位即在本帧的发光阶段时第三节点N3的电位。
在本申请实施例中，目标节点Nm的电位与发光阶段t3时的第一节点N1的电位之间的差值的绝对值可以小于4伏特，即小于相关技术中第一节点N1的电位与发光元件D的第一极的电位之间的压差。如此一来，可以保证目标节点Nm的电位与第一节点N1的电位之间的压差较小，因此可以有效减小第一节点N1通过阈值补偿晶体管向目标节点Nm漏电流，进而有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，提高显示面板亮度的均一性。
如图2或图3所示，根据本申请的一些实施例，可选地，第一发光控制信号线EM1与第二发光控制信号线EM2可以复用。具体地，如图4所示，在一些实施例中，第一发光控制信号线EM1输出的电压信号与第二发光控制信号线EM2输出的电压信号可以相同，即第一开关模块203和第二开关模块204同时导通和同时关断。因此，在一些实施例中，第一发光控制信号线EM1与第二发光控制信号线EM2可以复用。
如此一来，可以减少像素电路所在显示面板中的走线数量以及减少移位寄存器的数量，节省布线空间，有利于实现窄边框。
图5为本申请实施例提供的像素电路的另一种驱动时序示意图。如图5所示，与图4所示实施例不同的是，根据本申请的另一些实施例，可选地，一帧时间T可以包括初始化阶段t1、阈值补偿阶段t2、发光阶段t3和重置阶段t4，第i帧的重置阶段t4位于第i帧的发光阶段t3之后及第i+1帧的初始化阶段t1之前，即介于第i帧的发光阶段t3与第i+1帧的初始化阶段t1之间，i为正整数。
结合图2所示，在重置阶段t4，阈值补偿模块202响应于第一扫描信号线S1的导通电平而导通，第一开关模块203响应于第一发光控制信号线EM1的导通电平而导通，第一节点N1的电压信号(即电荷)依次通过阈值补偿模块202和第一开关模块203传输至目标节点Nm。在重置阶段t4，由于第一节点N1的电位还未被复位，所以在重置阶段t4时的第一节点N1的电位与在发光阶段t3时的第一节点N1的电位相同或相近。因此，在第i帧的重置阶段t4，目标节点Nm的电位与会第i帧的发光阶段t3时的第一节点N1的电位相同或相近，稳压模块205维持目标节点Nm的电位，直至第i+1帧的发光阶段t3第一开关模块203导通再次将第三节点N3的电荷传输至目标节点Nm。即，在第i帧的发光阶段至第i帧的重置阶段，目标节点Nm的电位与第i帧的发光阶段t3时的第三节点N3的电位相同；在第i帧的重置阶段至第i+1帧的发光阶段，目标节点Nm的电位与第i帧的发光阶段t3时的第一节点N1的电位相同或相近。
由于相邻帧中的第一节点N1的电位变化较小，所以第i帧的发光阶段t3时的第一节点N1的电位与第i+1帧的发光阶段t3时的第一节点N1的电位之间的压差较小。而如上分析，在发光阶段，第三节点N3的电位与第一节点N1的电位之间的压差较小。因此，无论目标节点Nm的电位是与第三节点N3的电位相同，还是与上一帧的发光阶段t3时的第一节点N1的电位相同，至少在本帧的发光阶段，可以使得目标节点Nm的电位与第一节点N1的电位之间的压差较小，因此可以有效减小第一节点N1通过阈值补偿模块向目标节点Nm漏电流，进而有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，提高显示面板亮度的均一性。
如图5所示，在重置阶段t4，第二发光控制信号线EM2可以输出截止电平，使得第二开关模块204关断，一方面，可以保证第一节点N1的电荷顺利存储至稳压模块，而不会通过第二开关模块204流失，使得目标节点的电位达到第一节点N1的电位；另一方面可以避免发光元件D被点亮。也就是说，如图5所示实施例中，第一发光控制信号线EM1输出的电压信号与第二发光控制信号线EM2输出的电压信号不同。因此，结合图2所示，在一些实施例中，第一发光控制信号线EM1与第二发光控制信号线EM2为不同的信号线。至少在重置阶段t4，第一发光控制信号线EM1传输的信号与第二发光控制信号线EM2传输的信号不同。例如，在重置阶段t4，第一发光控制信号线EM1传输导通电平，第二发光控制信号线EM2传输截止电平。
图6为本申请实施例提供的像素电路的又一种电路示意图。如图6所示，根据本申请的一些实施例，可选地，像素电路20还可以包括第三开关模块601，第三开关模块601的控制端与第二扫描信号线S2电连接，第三开关模块601的第一端与阈值补偿模块202的第二端电连接，第三开关模块601的第二端与驱动模块201的第一端(即第三节点N3)电连接。在发光阶段，第三开关模块601响应于第二扫描信号线S2的截止电平而截止。
如此一来，由于第三开关模块601位于阈值补偿模块202和第三节点N3之间，所以在发光阶段，第三开关模块601关断，可以进一步减小第一节点N1通过阈值补偿模块202向目标节点Nm漏电流，进一步有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，进一步提高显示面板亮度的均一性。
图7为本申请实施例提供的像素电路的又一种电路示意图。如图7所示，根据本申请的一些实施例，可选地，像素电路20还可以包括第一复位模块701，第一复位模块701的控制端与第三扫描信号线S3电连接，第一复位模块701的第一端与参考电压信号线Vref电连接，第一复位模块701的第二端与稳压模块205的第二端电连接。在发光阶段t3之前，例如在初始化阶段t1或者阈值补偿阶段t2，第一复位模块701响应于第三扫描信号线S3的导通电平而导通，将参考电压信号线Vref的参考电压信号传输至稳压模块205的第二端，以对稳压模块205的第二端进行复位。
如此一来，在发光阶段t3之前，通过对稳压模块205的第二端进行复位，可以保证在发光阶段t3，第三节点N3的电位成功写入至目标节点Nm，或者保证在重置阶段t4，第一节点N1的电位成功写入至目标节点Nm。
图8为本申请实施例提供的像素电路的又一种电路示意图。如图8所示，根据本申请的一些实施例，可选地，像素电路20还可以包括数据写入模块801、第二复位模块802、第三复位模块803、发光控制模块804和第二存储电容C2。
数据写入模块801的控制端与第四扫描信号线S4电连接，数据写入模块801的第一端与数据电压信号线data电连接，数据写入模块801的第二端与驱动模块201的第二端电连接，数据写入模块801用于将数据电压信号线data的数据电压信号传输至驱动模块201的第二端，以将数据电压信号写入像素电路。为了便于说明，驱动模块201的第二端连接的节点称作第二节点N2。
第二复位模块802的控制端与第五扫描信号线S5电连接，第二复位模块802的第一端与参考电压信号线Vref电连接，第二复位模块802的第二端与第一节点N1电连接，第二复位模块802用于将参考电压信号线Vref的参考电压信号传输至第一节点N1，以对第一节点N1进行复位。
第三复位模块803的控制端与第六扫描信号线S6电连接，第三复位模块803的第一端与参考电压信号线Vref电连接，第三复位模块803的第二端与发光元件D的第一极电连接，第三复位模块803用于将参考电压信号线Vref的参考电压信号传输至发光元件D的第一极，以对发光元件D的第一极进行复位。
发光控制模块804的控制端与第二发光控制信号线EM2电连接，发光控制模块804的第一端与第一电源电压信号线PVDD电连接，发光控制模块804的第二端与驱动模块201的第二端(即第二节点N2)电连接。其中，第一电源电压信号线PVDD用于提供正向电压信号，如+3.3V或其他正数电压值的电压信号。
第二存储电容C2的第一极板与第一电源电压信号线PVDD电连接，第二存储电容C2的第二极板与第一节点N1电连接，第二存储电容C2用于维持第一节点N1的电位。
继续参见图8，在一些具体的实施例中，可选地，阈值补偿模块202和第二复位模块802中的至少一者可以包括N型晶体管，驱动模块201、数据写入模块801、第二复位模块802、第三复位模块803和发光控制模块804中的至少一者包括P型晶体管。例如，在一些具体示例中，阈值补偿模块202可以为N型晶体管，或者，第二复位模块802可以为N型晶体管，或者，阈值补偿模块202和第二复位模块802两者均可以为N型晶体管。
如此一来，由于相对于P型晶体管，N型晶体管的漏电流更小，所以在阈值补偿模块202和第二复位模块802中的至少一者为N型晶体管时，可以进一步减小第一节点N1的漏电流，进一步有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，进一步提高显示面板亮度的均一性。
继续参见图8，在一些具体的实施例中，可选地，阈值补偿模块202和第二复位模块802中的至少一者可以包括氧化物薄膜晶体管(Oxide thin film transistor)。示例性地，氧化物薄膜晶体管的有源层为氧化铟镓锌(indium gallium zinc oxide，IGZO)，氧化物薄膜晶体管为IGZO-TFT。驱动模块201、数据写入模块801、第二复位模块802、第三复位模块803和发光控制模块804中的至少一者包括低温多晶硅薄膜晶体管(Low temperaturepolysilicon thin film transistor，LTPS-TFT)。
如此一来，由于氧化物薄膜晶体管的漏电流更小，所以在阈值补偿模块202和第二复位模块802中的至少一者为N型晶体管时，可以进一步减小第一节点N1的漏电流，进一步有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，进一步提高显示面板亮度的均一性。
图9为本申请实施例提供的像素电路的又一种电路示意图。如图9所示，根据本申请的一些实施例，可选地，数据写入模块801可以包括第三晶体管M3，第三晶体管M3的栅极与第四扫描信号线S4电连接，第三晶体管M3的第一极与数据电压信号线data电连接，第三晶体管M3的第二极与驱动模块201的第二端(即第二节点N2)电连接，第三晶体管M3用于将数据电压信号线data的数据电压信号传输至驱动模块201的第二端，以将数据电压信号写入像素电路。
第二复位模块802可以包括第四晶体管M4，第四晶体管M4的栅极与第五扫描信号线S5电连接，第四晶体管M4的第一极与参考电压信号线Vref电连接，第四晶体管M4的第二极与发光元件D的第一极电连接，第四晶体管M4用于将参考电压信号线Vref的参考电压信号传输至第一节点N1，以对第一节点N1进行复位。
第三复位模块803可以包括第五晶体管M5，第五晶体管M5的栅极与第六扫描信号线S6电连接，第五晶体管M5的第一极与参考电压信号线Vref电连接，第五晶体管M5的第二极与发光元件D的第一极电连接，第五晶体管M5用于将参考电压信号线Vref的参考电压信号传输至发光元件D的第一极，以对发光元件D的第一极进行复位。
发光控制模块804可以包括第六晶体管M6，第六晶体管M6的栅极与第二发光控制信号线EM2电连接，第六晶体管M6的第一极与第一电源电压信号线PVDD电连接，第六晶体管M6的第二极与驱动模块201的第二端(即第二节点N2)电连接，用于控制发光元件D发光。
为了便于理解，下面结合图9所示的像素电路以及图10和图11所示的驱动时序对于像素电路的工作过程进行说明。
图10为本申请实施例提供的像素电路的又一种驱动时序示意图。如图10所示，根据本申请的一些实施例，可选地，一帧时间T可以包括可以初始化阶段t1、阈值补偿阶段t2和发光阶段t3。
在初始化阶段t1，第五扫描信号线S5输出导电电平，第四扫描信号线S4、第六扫描信号线S6、第一发光控制信号线EM1和第二发光控制信号线EM2输出截止电平，第四晶体管M4响应于第五扫描信号线S5传输的导通电平而导通，第四晶体管M4用于将参考电压信号线Vref的参考电压信号传输至第一节点N1，以对第一节点N1进行复位。
在阈值补偿阶段t2，第一扫描信号线S1、第四扫描信号线S4和第六扫描信号线S6输出导通电平，第一发光控制信号线EM1和第二发光控制信号线EM2输出截止电平。阈值补偿晶体管M0响应于第一扫描信号线S1传输的导通电平而导通，第三晶体管M3响应于第四扫描信号线S4传输的导通电平而导通，实现数据电压信号的写入和阈值电压的补偿。第五晶体管M5响应于第六扫描信号线S6传输的导通电平而导通，用于将参考电压信号线Vref的参考电压信号传输至发光元件D的第一极，以对发光元件D的第一极进行复位。
在发光阶段t3，第一发光控制信号线EM1和第二发光控制信号线EM2输出导通电平，第一扫描信号线S1、第四扫描信号线S4、第五扫描信号线S5和第六扫描信号线S6输出截止电平。第一晶体管M1响应于第一发光控制信号线EM1传输的导通电平而导通，第二晶体管M2和第六晶体管M6响应于第二发光控制信号线EM2传输的导通电平而导通，第三节点N3的电压信号通过导通的第一晶体管M1传输至目标节点Nm，使得目标节点Nm的电位与第三节点N3的电位相等，第一存储电容C1维持目标节点Nm的电位。同时，驱动晶体管MT的驱动电流通过第一晶体管M1和第二晶体管M2传输至发光元件D的第一极，发光元件D发光。
在一些具体的示例中，可选地，第四扫描信号线S4和第六扫描信号线S6可以复用，从而可以减少像素电路所在显示面板中的走线数量以及减少移位寄存器的数量，节省布线空间，有利于实现窄边框。
在一些具体的示例中，可选地，第六扫描信号线S6可以不复用第四扫描信号线S4，而且在初始化阶段t1，第六扫描信号线S6输出导通电平；在阈值补偿阶段t2，第六扫描信号线S6输出截止电平，从而在初始化阶段t1对发光元件D的第一极进行复位。
图11为本申请实施例提供的像素电路的又一种驱动时序示意图。如图11所示，与图10所示实施例不同的是，根据本申请的另一些实施例，可选地，一帧时间T还可以包括重置阶段t4，第i帧的重置阶段t4位于第i帧的发光阶段t3之后及第i+1帧的初始化阶段t1之前，即介于第i帧的发光阶段t3与第i+1帧的初始化阶段t1之间，i为正整数。
在重置阶段t4，第一扫描信号线S1和第一发光控制信号线EM1输出导通电平，第四扫描信号线S4、第五扫描信号线S5、第六扫描信号线S6和第二发光控制信号线EM2输出截止电平。阈值补偿晶体管M0响应于第一扫描信号线S1的导通电平而导通，第一晶体管M1响应于第一发光控制信号线EM1的导通电平而导通，第一节点N1的电压信号(即电荷)依次通过阈值补偿晶体管M0和第一晶体管M1传输至目标节点Nm。第二晶体管M2响应于第二发光控制信号线EM2的截止电平而截止，避免发光元件D被点亮。
图11所示实施例中的初始化阶段t1、阈值补偿阶段t2和发光阶段t3与图10所示实施例中的初始化阶段t1、阈值补偿阶段t2和发光阶段t3的过程相同或相近，为了描述简洁，在此不再赘述。
图12为本申请实施例提供的像素电路的又一种电路示意图。如图12所示，根据本申请的一些实施例，可选地，第三开关模块601可以包括第七晶体管M7，第七晶体管M7的栅极与第二扫描信号线S2电连接，第七晶体管M7的第一极与阈值补偿晶体管M0的第二极电连接，第七晶体管M7的第二极与第三节点N3电连接。在发光阶段，第七晶体管M7响应于第二扫描信号线S2的截止电平而截止。
如此一来，由于第七晶体管M7位于阈值补偿晶体管M0和第三节点N3之间，所以在发光阶段，第七晶体管M7关断，可以进一步减小第一节点N1通过阈值补偿晶体管M0向目标节点Nm漏电流，进一步有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，进一步提高显示面板亮度的均一性。
继续如图12所示，根据本申请的一些实施例，可选地，第一复位模块701可以包括第八晶体管M8，第八晶体管M8的栅极与第三扫描信号线S3电连接，第八晶体管M8的第一极与参考电压信号线Vref电连接，第八晶体管M8的第二端与第一存储电容C1的第二极板电连接。在发光阶段t3之前，如在初始化阶段t1或者阈值补偿阶段t2，第八晶体管M8响应于第三扫描信号线S3的导通电平而导通，将参考电压信号线Vref的参考电压信号传输至第一存储电容C1的第二极板，以对第一存储电容C1的第二极板进行复位。
如此一来，在发光阶段t3之前，通过对第一存储电容C1的第二极板进行复位，可以保证在发光阶段t3，第三节点N3的电位成功写入至目标节点Nm，或者保证在重置阶段t4，第一节点N1的电位成功写入至目标节点Nm。
图13为本申请实施例提供的像素电路的又一种电路示意图。如图13所示，根据本申请的一些实施例，可选地，第六晶体管M6可以包括串联设置的第一子晶体管M61和第二子晶体管M62，第一子晶体管M61的栅极和第二子晶体管M62的栅极均与第二发光控制信号线EM2电连接，第一子晶体管M61的第一极与第一电源电压信号线PVDD电连接，第一子晶体管M61的第二极与第二子晶体管M62的第一极电连接，第二子晶体管M61的第二极与驱动模块201的第二端(即第二节点N2)电连接。
如此一来，第一子晶体管M61和第二子晶体管M62构成双栅晶体管，能够减小第一电源电压信号线PVDD的电流，进而降低发光元件D的亮度，以补偿因第一节点N1漏电流对于发光元件D的亮度的影响，使得发光元件D的亮度接近期望的目标亮度。
经本申请的发明人进一步研究发现，在显示面板切换画面时，如由黑态切换为白色画面时，驱动晶体管的阈值电压Vth由于磁滞效应，会出现阈值电压Vth的实际偏移量与期望的目标偏移量之间存在偏差的问题，如阈值电压Vth偏移过大，进而导致发光元件的亮度无法达到预设亮度，影响了显示面板的显示效果。
鉴于上述发现，本申请考虑对于驱动晶体管的阈值电压Vth进行调节，以减小阈值电压Vth的实际偏移量与期望的目标偏移量之间的偏差，改善显示面板的显示效果。
图14为本申请实施例提供的像素电路的又一种电路示意图。如图14所示，根据本申请的一些实施例，可选地，像素电路20还可以包括偏置补偿模块1401，偏置补偿模块1401的控制端与第七扫描信号线S7电连接，偏置补偿模块1401的第一端与偏置补偿电压信号线V2电连接，偏置补偿模块1401的第二端与驱动模块201的第二端(即第二节点N2)电连接。
图15为本申请实施例提供的像素电路的又一种驱动时序示意图。结合图14和图15所示，发光阶段t3包括第一阶段t31和第二阶段t32，在第一阶段t31，偏置补偿模块1401响应于第七扫描信号线S7的导通电平而导通，将偏置补偿电压信号线V2的偏置补偿电压信号传输至驱动模块201的第二端，以对驱动模块201的阈值电压进行补偿。在第二阶段t32，第一开关模块203响应于第一发光控制信号线EM1的导通电平而导通，第二开关模块204响应于第二发光控制信号线EM2的导通电平而导通，发光元件D发光。
如此一来，通过偏置补偿电压来调节驱动模块201的阈值电压Vth，使得在驱动发光元件D发光之前提前对驱动模块201的阈值电压Vth进行调节，减小阈值电压Vth的实际偏移量与期望的目标偏移量之间的偏差，改善显示面板的显示效果。
继续参见图14，在一些具体的实施例中，可选地，偏置补偿模块1401可以包括第八晶体管M8，第八晶体管M8的栅极与第七扫描信号线S7电连接，第八晶体管M8的第一极与偏置补偿电压信号线V2电连接，第八晶体管M8的第二极与驱动模块201的第二端(即第二节点N2)电连接。在第一阶段t31，第八晶体管M8响应于第七扫描信号线S7的导通电平而导通，将偏置补偿电压信号线V2的偏置补偿电压信号传输至驱动模块201的第二端，以对驱动模块201的阈值电压进行补偿。
根据本申请的一些实施例，可选地，像素电路20所在的显示面板可以采取一驱二设计。图16为本申请实施例提供的像素电路所在的显示面板的一种电路示意图。结合图2和图16所示，在一些具体的实施例中，可选地，显示面板160可以包括第一扫描驱动电路1601，第一扫描驱动电路1601可以输出第一扫描驱动信号，用于控制像素电路中的晶体管的导通/截止。第一扫描驱动电路1601可以包括多个级联的第一移位寄存器1601a，即第j+1个第一移位寄存器1601a的输入端与第j个第一移位寄存器1601a的输出端电连接，j为正整数。每个第一移位寄存器1601a可以通过第一扫描信号线S1与相邻的两行像素电路中的阈值补偿模块202电连接，一行像素电路对应一条第一扫描信号线S1，一行像素电路包括多个像素电路20。
如此一来，通过一个第一移位寄存器1601a为相邻的两行像素电路提供第一扫描驱动信号，可以减少第一移位寄存器1601a的数量，在降低生产成本的同时，有利于实现窄边框。
图17为本申请实施例提供的像素电路所在的显示面板的另一种电路示意图。结合图9和图17所示，在一些具体的实施例中，可选地，显示面板160还可以包括第二扫描驱动电路1602，第二扫描驱动电路1602可以输出第二扫描驱动信号，用于控制像素电路中的晶体管的导通/截止。第二扫描驱动电路1602包括多个级联的第二移位寄存器1602a，即第j+1个第二移位寄存器1602a的输入端与第j个第二移位寄存器1602a的输出端电连接，j为正整数。每个第二移位寄存器1602a可以通过第五扫描信号线S5与相邻的两行像素电路中的第二复位模块802电连接，一行像素电路对应一条第五扫描信号线S5，一行像素电路包括多个像素电路20。
如此一来，通过一个第二移位寄存器1602a为相邻的两行像素电路提供第二扫描驱动信号，可以减少第二移位寄存器1602a的数量，在降低生产成本的同时，有利于实现窄边框。
需要说明的是，为了便于示出，第一扫描驱动电路1601和第二扫描驱动电路1602分别在两幅附图中示出，但是实际中，显示面板160可以同时包括第一扫描驱动电路1601和第二扫描驱动电路1602。
图18为本申请实施例提供的像素电路所在的显示面板的又一种电路示意图。结合图9和图18所示，与图16所示实施例和图17所示实施例不同的是，在另一些具体的实施例中，可选地，在第一扫描信号线S1和第五扫描信号线S5输出的扫描信号相同或相近(如幅宽和周期相同或相近)的情况下，同一个移位寄存器可以分别连接第一扫描信号线S1和第五扫描信号线S5。具体而言，显示面板160可以包括扫描驱动电路1801，扫描驱动电路1801包括多个级联的移位寄存器1801a，即第j+1个移位寄存器1801a的输入端与第j个移位寄存器1801a的输出端电连接，j为正整数。每个移位寄存器1801a可以通过第一扫描信号线S1与第j行像素电路中的阈值补偿模块202电连接、且通过第五扫描信号线S5与第j+1行像素电路中的第二复位模块802电连接，一行像素电路包括多个像素电路20，j为正整数。
如此一来，通过一个移位寄存器1801a为相邻的两行像素电路提供扫描驱动信号，可以减少移位寄存器1801a的数量，在降低生产成本的同时，有利于实现窄边框。
下面结合一些具体的实施例对于像素电路20的膜层分布进行详细说明。
图19为本申请实施例提供的像素电路所在的显示面板的一种局部剖面示意图。结合图3和图19所示，根据本申请的一些实施例，像素电路20可以应用于显示面板160之中。可选地，第二晶体管M2的第一极与第一晶体管M1的第二极之间通过第一走线L1电连接，第一走线L1可以位于显示面板160的第一导电层D1，恒定电压信号线V1可以位于显示面板160的第二导电层D2。第一存储电容C1的第一极板a可以位于第一导电层D1，且第一存储电容C1的第一极板a复用第一走线L1。和/或，第一存储电容C1的第二极板b可以位于第二导电层D2，且第一存储电容C1的第二极板b可以复用恒定电压信号线V1。即，在图19所示实施例中，第一存储电容C1可以为寄生电容，从而减少第一存储电容C1对于布线空间的占用，且有利于生产工艺的简化。
图20为本申请实施例提供的像素电路所在的显示面板的另一种局部剖面示意图。结合图3和图20所示，根据本申请的另一些实施例，可选地，显示面板160包括第一导电层D1、第二导电层D2和第三导电层D3，沿垂直于显示面板所在平面的方向Z，第一存储电容C1的第一极板a可以位于第三导电层D3，且第一存储电容C1的第一极板a与第二晶体管M2的第一极或第一晶体管M1的第二极电连接。第一存储电容C1的第二极板b可以位于第二导电层D2，且与位于第二导电层D2的恒定电压信号线V1电连接。即，在图20所示实施例中，第一存储电容C1也可以为额外增设的存储电容，本申请实施例对此不作限定。
图21为本申请实施例提供的像素电路所在的显示面板的另一种局部剖面示意图。结合图3和图21所示，根据本申请的一些实施例，可选地，像素电路20可以应用于显示面板160之中。沿垂直于显示面板所在平面的方向Z上，显示面板160可以包括层叠设置的衬底01、第一金属层m1、第二金属层m2和第三金属层m3。驱动模块201可以包括驱动晶体管MT，第一开关模块203可以包括第一晶体管M1，第二开关模块204可以包括第二晶体管M2，稳压模块205可以包括第一存储电容C1。驱动晶体管MT的栅极、第一晶体管M1的栅极与第二晶体管M2的栅极均可以位于第一金属层m1。驱动晶体管MT的第一极和第二极、第一晶体管M1的第一极和第二极与第二晶体管M2的第一极和第二极均可以位于第三金属层m3。第一存储电容C1的第一极板a和第二极板b分别位于第一金属层m1、第二金属层m2和第三金属层m3中的不同膜层。例如，第一存储电容C1的第一极板a位于第二金属层m2，第一存储电容C1的第二极板b位于第三金属层m3。再例如，第一存储电容C1的第一极板a位于第一金属层m1，第一存储电容C1的第二极板b位于第三金属层m3。
基于上述实施例提供的像素电路20，相应地，本申请实施例还提供了一种像素电路的驱动方法的具体实现方式。像素电路的驱动方法可以应用于如上述实施例提供的像素电路20。
图22为本申请实施例提供的像素电路的驱动方法的一种流程示意图。
如图22所示，本申请实施例提供的像素电路的驱动方法包括以下步骤：
S101、在发光阶段，向第一发光控制信号线提供导通电平，向第二发光控制信号线的导通电平，以使驱动模块的第一端的电压信号通过导通的第一开关模块传输至目标节点。
需要说明的是，步骤S101的具体实现过程已在上文中详细描述，为了描述简洁，在此不再赘述。
本申请实施例提供的像素电路的驱动方法，在发光阶段，第一开关模块响应于第一发光控制信号线的导通电平而导通，第二开关模块响应于第二发光控制信号线的导通电平而导通，第三节点的电压信号(即电荷)通过导通的第一开关模块传输至目标节点，使得目标节点的电位与驱动模块的第一端(即第三节点)的电位相等，由于驱动模块的第一端(即第三节点)的电位与第一节点的电位之间的压差较小，而目标节点的电位与驱动模块的第一端(即第三节点)的电位相等，所以目标节点的电位与第一节点的电位之间的压差较小，因此可以有效减小第一节点通过阈值补偿模块向目标节点漏电流，进而有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，提高显示面板亮度的均一性。
根据本申请的一些实施例，可选地，一帧时间包括初始化阶段、数据写入阶段、发光阶段和重置阶段，第i帧的重置阶段位于第i帧的发光阶段之后及第i+1帧的初始化阶段之前，i为正整数。图23为本申请实施例提供的像素电路的驱动方法的另一种流程示意图。如图23所示，本申请实施例提供的像素电路的驱动方法还包括以下步骤：
S102、在重置阶段，向第一扫描信号线提供导通电平，向第一发光控制信号线提供导通电平，以使第一节点的电压信号依次通过阈值补偿模块和第一开关模块传输至目标节点。
需要说明的是，步骤S102的具体实现过程已在上文中详细描述，为了描述简洁，在此不再赘述。
在重置阶段，阈值补偿模块响应于第一扫描信号线的导通电平而导通，第一开关模块响应于第一发光控制信号线的导通电平而导通，第一节点的电压信号(即电荷)依次通过阈值补偿模块和第一开关模块传输至目标节点。由于相邻帧中的第一节点N1的电位变化较小，所以第i帧的发光阶段时的第一节点N1的电位与第i+1帧的发光阶段时的第一节点N1的电位之间的压差较小。而如上分析，在发光阶段，第三节点N3的电位与第一节点N1的电位之间的压差较小。因此，无论目标节点Nm的电位是与第三节点N3的电位相同，还是与上一帧的发光阶段时的第一节点N1的电位相同，至少在本帧的发光阶段，可以使得目标节点Nm的电位与第一节点N1的电位之间的压差较小，因此可以有效减小第一节点N1通过阈值补偿模块向目标节点Nm漏电流，进而有效避免发光元件的发光亮度偏离期望的目标亮度，提高显示面板亮度的稳定性；同时改善甚至消除不同行发光元件之间的亮度差异，提高显示面板亮度的均一性。
如图14所示，根据本申请的一些实施例，可选地，像素电路20还可以包括偏置补偿模块1401，偏置补偿模块1401的控制端与第七扫描信号线S7电连接，偏置补偿模块1401的第一端与偏置补偿电压信号线V2电连接，偏置补偿模块1401的第二端与驱动模块201的第二端(即第二节点N2)电连接。
相应地，发光阶段可以包括第一阶段和第二阶段。S101、在发光阶段，向第一发光控制信号线提供导通电平，向第二发光控制信号线的导通电平，具体包括以下步骤：
在第一阶段，向第七扫描信号线提供导通电平，以使偏置补偿电压信号线的偏置补偿电压信号通过导通的偏置补偿模块传输至驱动模块的第二端，对驱动模块的阈值电压进行补偿；
在第二阶段，向第一发光控制信号线提供导通电平，向第二发光控制信号线提供导通电平，以使驱动模块的第一端的电压信号通过导通的第一开关模块和第二开关模块传输至目标节点。
如此一来，通过偏置补偿电压来调节驱动模块201的阈值电压Vth，使得在驱动发光元件D发光之前提前对驱动模块201的阈值电压Vth进行调节，减小阈值电压Vth的实际偏移量与期望的目标偏移量之间的偏差，改善显示面板的显示效果。
基于上述实施例提供的像素电路20，相应地，本申请实施例还提供了一种显示面板。图24为本申请实施例提供的显示面板的一种结构示意图。如24所示，本申请实施例提供的显示面板160可以包括如上述实施例提供的像素电路20。在一些具体示例中，可选地，显示面板160包括但不限于OLED显示面板。
如图18所示，根据本申请的一些实施例，可选地，显示面板160还可以包括扫描驱动电路1801，扫描驱动电路1801包括多个级联的移位寄存器1801a，多个级联的移位寄存器1801a沿第一方向Y依次排布，一个移位寄存器1801a可以通过扫描信号线与相邻的N行像素电路电连接，一行像素电路包括沿第二方向X依次排布的多个像素电路20，第一方向与第二方向交叉，N≥2且为整数。
结合图2和图16所示，在一些具体的实施例中，可选地，显示面板160可以包括第一扫描驱动电路1601，第一扫描驱动电路1601可以输出第一扫描驱动信号，用于控制像素电路中的晶体管的导通/截止。第一扫描驱动电路1601可以包括多个级联的第一移位寄存器1601a，即第j+1个第一移位寄存器1601a的输入端与第j个第一移位寄存器1601a的输出端电连接，j为正整数。每个第一移位寄存器1601a可以通过第一扫描信号线S1与相邻的两行像素电路中的阈值补偿模块202电连接，一行像素电路对应一条第一扫描信号线S1，一行像素电路包括多个像素电路20。
如此一来，通过一个第一移位寄存器1601a为相邻的两行像素电路提供第一扫描驱动信号，可以减少第一移位寄存器1601a的数量，在降低生产成本的同时，有利于实现窄边框。
如图8所示，在一些具体的实施例中，可选地，像素电路可以包括第二复位模块802，第二复位模块802的控制端与第五扫描信号线S5电连接，第二复位模块802的第一端与参考电压信号线Vref电连接，第二复位模块802的第二端与第一节点N1电连接，第二复位模块802用于将参考电压信号线Vref的参考电压信号传输至第一节点N1，以对第一节点N1进行复位。
结合图8和图17所示，在一些具体的实施例中，可选地，显示面板160还可以包括第二扫描驱动电路1602，第二扫描驱动电路1602可以输出第二扫描驱动信号，用于控制像素电路中的晶体管的导通/截止。第二扫描驱动电路1602包括多个级联的第二移位寄存器1602a，即第j+1个第二移位寄存器1602a的输入端与第j个第二移位寄存器1602a的输出端电连接，j为正整数。每个第二移位寄存器1602a可以通过第五扫描信号线S5与相邻的两行像素电路中的第二复位模块802电连接，一行像素电路对应一条第五扫描信号线S5，一行像素电路包括多个像素电路20。
如此一来，通过一个第二移位寄存器1602a为相邻的两行像素电路提供第二扫描驱动信号，可以减少第二移位寄存器1602a的数量，在降低生产成本的同时，有利于实现窄边框。
结合图9和图18所示，在一些具体的实施例中，可选地，在第一扫描信号线S1和第五扫描信号线S5输出的扫描信号相同或相近(如幅宽和周期相同或相近)的情况下，同一个移位寄存器可以分别连接第一扫描信号线S1和第五扫描信号线S5。具体而言，显示面板160可以包括扫描驱动电路1801，扫描驱动电路1801包括多个级联的移位寄存器1801a，即第j+1个移位寄存器1801a的输入端与第j个移位寄存器1801a的输出端电连接，j为正整数。每个移位寄存器1801a可以通过第一扫描信号线S1与第j行像素电路中的阈值补偿模块202电连接、且通过第五扫描信号线S5与第j+1行像素电路中的第二复位模块802电连接，一行像素电路包括多个像素电路20，j为正整数。
如此一来，通过一个移位寄存器1801a为相邻的两行像素电路提供扫描驱动信号，可以减少移位寄存器1801a的数量，在降低生产成本的同时，有利于实现窄边框。
应当理解的是，本申请实施例附图提供的像素电路和显示面板的具体结构仅仅是一些示例，并不用于限定本申请。另外，在不矛盾的情况下，本申请提供的上述各实施例可以相互结合。
依照本申请如上文所述的实施例，这些实施例并没有详尽叙述所有的细节，也不限制该申请仅为所述的具体实施例。显然，根据以上描述，可作很多的修改和变化。本说明书选取并具体描述这些实施例，是为了更好地解释本申请的原理和实际应用，从而使所属技术领域技术人员能很好地利用本申请以及在本申请基础上的修改使用。本申请仅受权利要求书及其全部范围和等效物的限制。
需要明确的是，本说明书中的各个实施例均采用递进的方式描述，各个实施例之间相同或相似的部分互相参见即可，每个实施例重点说明的都是与其他实施例的不同之处。对于显示面板实施例和显示装置实施例而言，相关之处可以参见像素驱动电路实施例和阵列基板实施例的说明部分。本申请并不局限于上文所描述并在图中示出的特定结构。本领域的技术人员可以在领会本申请的精神之后，作出各种改变、修改和添加。并且，为了简明起见，这里省略对已知技术的详细描述。
本领域技术人员应能理解，上述实施例均是示例性而非限制性的。在不同实施例中出现的不同技术特征可以进行组合，以取得有益效果。本领域技术人员在研究附图、说明书及权利要求书的基础上，应能理解并实现所揭示的实施例的其他变化的实施例。在权利要求书中，术语“包括”并不排除其他结构；数量涉及“一个”但不排除多个；术语“第一”、“第二”用于标示名称而非用于表示任何特定的顺序。权利要求中的任何附图标记均不应被理解为对保护范围的限制。某些技术特征出现在不同的从属权利要求中并不意味着不能将这些技术特征进行组合以取得有益效果。

Claims (29)

1.一种像素电路，其特征在于，包括：
驱动模块，所述驱动模块的控制端与第一节点电连接；
阈值补偿模块，所述阈值补偿模块的控制端与第一扫描信号线电连接，所述阈值补偿模块的第一端与所述第一节点电连接，所述阈值补偿模块的第二端与所述驱动模块的第一端电连接；
第一开关模块，所述第一开关模块的控制端与第一发光控制信号线电连接，所述第一开关模块的第一端与所述驱动模块的第一端电连接；
第二开关模块，所述第二开关模块的控制端与第二发光控制信号线电连接，所述第二开关模块的第一端与所述第一开关模块的第二端电连接，所述第二开关模块的第二端与发光元件的第一极电连接；
稳压模块，所述稳压模块的第一端与恒定电压信号线电连接，所述稳压模块的第二端与目标节点电连接，所述目标节点为所述第二开关模块的第一端与所述第一开关模块的第二端的连接节点，所述稳压模块用于维持所述目标节点的电位；
在发光阶段，所述第一开关模块响应于所述第一发光控制信号线的导通电平而导通，所述第二开关模块响应于所述第二发光控制信号线的导通电平而导通，所述发光元件发光。
2.根据权利要求1所述的像素电路，其特征在于，一帧时间包括初始化阶段、阈值补偿阶段和发光阶段；
第一目标阶段时的所述目标节点的电位与所述发光阶段时的所述第一节点的电位之间的差值的绝对值小于4伏特，所述第一目标阶段包括从本帧的所述发光阶段至下一帧的所述发光阶段。
3.根据权利要求1所述的像素电路，其特征在于，所述驱动模块的第一端还与第三节点电连接；
在所述发光阶段，所述第三节点的电压信号通过所述第一开关模块传输至所述目标节点。
4.根据权利要求3所述的像素电路，其特征在于，所述第一发光控制信号线与所述第二发光控制信号线复用。
5.根据权利要求1所述的像素电路，其特征在于，一帧时间包括初始化阶段、阈值补偿阶段、发光阶段和重置阶段，第i帧的所述重置阶段位于所述第i帧的所述发光阶段之后及第i+1帧的所述初始化阶段之前，i为正整数；
在所述重置阶段，所述阈值补偿模块响应于所述第一扫描信号线的导通电平而导通，所述第一开关模块响应于所述第一发光控制信号线的导通电平而导通，所述第一节点的电压信号依次通过所述阈值补偿模块和所述第一开关模块传输至所述目标节点。
6.根据权利要求5所述的像素电路，其特征在于，所述第一发光控制信号线与所述第二发光控制信号线为不同的信号线；
至少在所述重置阶段，所述第一发光控制信号线传输的信号与所述第二发光控制信号线传输的信号不同。
7.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括第三开关模块，所述第三开关模块的控制端与第二扫描信号线电连接，所述第三开关模块的第一端与所述阈值补偿模块的第二端电连接，所述第三开关模块的第二端与所述驱动模块的第一端电连接；
在所述发光阶段，所述第三开关模块响应于所述第二扫描信号线的截止电平而截止。
8.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括第一复位模块，所述第一复位模块的控制端与第三扫描信号线电连接，所述第一复位模块的第一端与参考电压信号线电连接，所述第一复位模块的第二端与所述稳压模块的第二端电连接；
在所述发光阶段之前，所述第一复位模块响应于所述第三扫描信号线的导通电平而导通，将所述参考电压信号线的参考电压信号传输至所述稳压模块的第二端，以对所述稳压模块的第二端进行复位。
9.根据权利要求1所述的像素电路，其特征在于，所述第一开关模块包括第一晶体管，所述第二开关模块包括第二晶体管，所述稳压模块包括第一存储电容，其中：
所述第一晶体管的栅极与所述第一发光控制信号线电连接，所述第一晶体管的第一极与所述驱动模块的第一端电连接；
所述第二晶体管的栅极与所述第二发光控制信号线电连接，所述第二晶体管的第一极与所述第一晶体管的第二极电连接，所述第二晶体管的第二极与所述发光元件的第一极电连接；
所述第一存储电容的第一极板与所述恒定电压信号线电连接，所述第一存储电容的第二极板与所述目标节点电连接。
10.根据权利要求9所述的像素电路，其特征在于，所述像素电路应用于显示面板之中；
所述第二晶体管的第一极与所述第一晶体管的第二极之间通过第一走线电连接，所述第一走线位于所述显示面板的第一导电层，所述恒定电压信号线位于所述显示面板的第二导电层；
所述第一存储电容的第一极板位于所述第一导电层，且所述第一存储电容的第一极板复用所述第一走线；和/或，所述第一存储电容的第二极板位于所述第二导电层，且所述第一存储电容的第二极板复用所述恒定电压信号线。
11.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括：
数据写入模块，所述数据写入模块的控制端与第四扫描信号线电连接，所述数据写入模块的第一端与数据电压信号线电连接，所述数据写入模块的第二端与所述驱动模块的第二端电连接，用于将所述数据电压信号线的数据电压信号传输至所述驱动模块的第二端；
第二复位模块，所述第二复位模块的控制端与第五扫描信号线电连接，所述第二复位模块的第一端与参考电压信号线电连接，所述第二复位模块的第二端与所述第一节点电连接，用于将所述参考电压信号线的参考电压信号传输至所述第一节点，以对所述第一节点进行复位；
第三复位模块，所述第三复位模块的控制端与第六扫描信号线电连接，所述第三复位模块的第一端与所述参考电压信号线电连接，所述第三复位模块的第二端与所述发光元件的第一极电连接，用于将所述参考电压信号线的参考电压信号传输至所述发光元件的第一极，以对所述发光元件的第一极进行复位；
发光控制模块，所述发光控制模块的控制端与所述第二发光控制信号线电连接，所述发光控制模块的第一端与第一电源电压信号线电连接，所述发光控制模块的第二端与所述驱动模块的第二端电连接；
第二存储电容，所述第二存储电容的第一极板与所述第一电源电压信号线电连接，所述第二存储电容的第二极板与所述第一节点电连接。
12.根据权利要求11所述的像素电路，其特征在于，所述阈值补偿模块和所述第二复位模块中的至少一者包括N型晶体管，所述驱动模块、所述数据写入模块和所述发光控制模块中的至少一者包括P型晶体管。
13.根据权利要求1所述的像素电路，其特征在于，所述像素电路应用于所述显示面板之中，所述显示面板包括第一扫描驱动电路，所述第一扫描驱动电路包括多个级联的第一移位寄存器，一个所述第一移位寄存器通过所述第一扫描信号线与相邻的两行所述像素电路中的所述阈值补偿模块电连接，一行所述像素电路对应一条所述第一扫描信号线，一行所述像素电路包括多个所述像素电路。
14.根据权利要求11所述的像素电路，其特征在于，所述像素电路应用于所述显示面板之中，所述显示面板包括第二扫描驱动电路，所述第二扫描驱动电路包括多个级联的第二移位寄存器，一个所述第二移位寄存器通过所述第五扫描信号线与相邻的两行所述像素电路中的所述第二复位模块电连接，一行所述像素电路对应一条所述第五扫描信号线，一行所述像素电路包括多个所述像素电路。
15.根据权利要求11所述的像素电路，其特征在于，所述像素电路应用于所述显示面板之中，所述显示面板包括扫描驱动电路，所述扫描驱动电路包括多个级联的移位寄存器，一个所述移位寄存器通过所述第一扫描信号线与第j行所述像素电路中的所述阈值补偿模块电连接、且通过所述第五扫描信号线与第j+1行所述像素电路中的所述第二复位模块电连接，一行所述像素电路包括多个所述像素电路，j为正整数。
16.根据权利要求11所述的像素电路，其特征在于，
所述数据写入模块包括第三晶体管，所述第三晶体管的栅极与所述第四扫描信号线电连接，所述第三晶体管的第一极与所述数据电压信号线电连接，所述第三晶体管的第二极与所述驱动模块的第二端电连接；
所述第二复位模块包括第四晶体管，所述第四晶体管的栅极与所述第五扫描信号线电连接，所述第四晶体管的第一极与所述参考电压信号线电连接，所述第四晶体管的第二极与所述发光元件的第一极电连接；
所述第三复位模块包括第五晶体管，所述第五晶体管的栅极与所述第六扫描信号线电连接，所述第五晶体管的第一极与所述参考电压信号线电连接，所述第五晶体管的第二极与所述发光元件的第一极电连接；
所述发光控制模块包括第六晶体管，所述第六晶体管的栅极与所述第二发光控制信号线电连接，所述第六晶体管的第一极与所述第一电源电压信号线电连接，所述第六晶体管的第二极与所述驱动模块的第二端电连接。
17.根据权利要求16所述的像素电路，其特征在于，所述第六晶体管包括串联设置的第一子晶体管和第二子晶体管，所述第一子晶体管的栅极和所述第二子晶体管的栅极均与所述第二发光控制信号线电连接，所述第一子晶体管的第一极与所述第一电源电压信号线电连接，所述第一子晶体管的第二极与所述第二子晶体管的第一极电连接，所述第二子晶体管的第二极与所述驱动模块的第二端电连接。
18.根据权利要求1所述的像素电路，其特征在于，所述像素电路还包括偏置补偿模块，所述偏置补偿模块的控制端与第七扫描信号线电连接，所述偏置补偿模块的第一端与偏置补偿电压信号线电连接，所述偏置补偿模块的第二端与所述驱动模块的第二端电连接；
所述发光阶段包括第一阶段和第二阶段，在所述第一阶段，所述偏置补偿模块响应于所述第七扫描信号线的导通电平而导通，将所述偏置补偿电压信号线的偏置补偿电压信号传输至所述驱动模块的第二端，以对所述驱动模块的阈值电压进行补偿；
在所述第二阶段，所述第一开关模块响应于所述第一发光控制信号线的导通电平而导通，所述第二开关模块响应于所述第二发光控制信号线的导通电平而导通，所述发光元件发光。
19.根据权利要求18所述的像素电路，其特征在于，所述偏置补偿模块包括第八晶体管，所述第八晶体管的栅极与所述第七扫描信号线电连接，所述第八晶体管的第一极与所述偏置补偿电压信号线电连接，所述第八晶体管的第二极与所述驱动模块的第二端电连接。
20.根据权利要求1所述的像素电路，其特征在于，所述像素电路应用于显示面板之中，沿垂直于所述显示面板所在平面的方向上，所述显示面板包括层叠设置的衬底、第一金属层、第二金属层和第三金属层；
所述驱动模块包括驱动晶体管，所述第一开关模块包括第一晶体管，所述第二开关模块包括第二晶体管，所述稳压模块包括第一存储电容；
所述驱动晶体管的栅极、所述第一晶体管的栅极与所述第二晶体管的栅极均位于所述第一金属层；所述驱动晶体管的第一极和第二极、所述第一晶体管的第一极和第二极与所述第二晶体管的第一极和第二极均位于所述第三金属层；
所述第一存储电容的第一极板和第二极板分别位于所述第一金属层、所述第二金属层和所述第三金属层中的不同膜层。
21.一种像素电路的驱动方法，其特征在于，所述像素电路包括如权利要求1至20中任一项所述的像素电路，所述驱动方法包括：
在发光阶段，向所述第一发光控制信号线提供导通电平，向所述第二发光控制信号线的导通电平，以使所述驱动模块的第一端的电压信号通过导通的所述第一开关模块传输至所述目标节点。
22.根据权利要求21所述的驱动方法，其特征在于，一帧时间包括初始化阶段、数据写入阶段、发光阶段和重置阶段，第i帧的所述重置阶段位于所述第i帧的所述发光阶段之后及第i+1帧的所述初始化阶段之前，i为正整数；
所述驱动方法还包括：
在所述重置阶段，向所述第一扫描信号线提供导通电平，向所述第一发光控制信号线提供导通电平，以使所述第一节点的电压信号依次通过所述阈值补偿模块和所述第一开关模块传输至所述目标节点。
23.根据权利要求21所述的驱动方法，其特征在于，所述像素电路还包括偏置补偿模块，所述偏置补偿模块的控制端与第七扫描信号线电连接，所述偏置补偿模块的第一端与偏置补偿电压信号线电连接，所述偏置补偿模块的第二端与所述驱动模块的第二端电连接；
所述发光阶段包括第一阶段和第二阶段；所述在发光阶段，向所述第一发光控制信号线提供导通电平，向所述第二发光控制信号线的导通电平，具体包括：
在所述第一阶段，向所述第七扫描信号线提供导通电平，以使所述偏置补偿电压信号线的偏置补偿电压信号通过导通的所述偏置补偿模块传输至所述驱动模块的第二端，对所述驱动模块的阈值电压进行补偿；
在所述第二阶段，向所述第一发光控制信号线提供导通电平，向所述第二发光控制信号线提供导通电平，以使所述驱动模块的第一端的电压信号通过导通的所述第一开关模块和所述第二开关模块传输至所述目标节点。
24.一种显示面板，其特征在于，包括如权利要求1至20中任一项所述的像素电路。
25.根据权利要求24所述的显示面板，其特征在于，所述显示面板还包括扫描驱动电路，所述扫描驱动电路包括多个级联的移位寄存器，所述多个级联的移位寄存器沿第一方向依次排布，一个所述移位寄存器与相邻的N行像素电路电连接，一行像素电路包括沿第二方向依次排布的多个像素电路，所述第一方向与所述第二方向交叉，N≥2且为整数。
26.根据权利要求24所述的显示面板，其特征在于，所述显示面板包括第一扫描驱动电路，所述第一扫描驱动电路包括多个级联的第一移位寄存器，一个所述第一移位寄存器通过所述第一扫描信号线与相邻的两行所述像素电路中的所述阈值补偿模块电连接，一行所述像素电路对应一条所述第一扫描信号线，一行所述像素电路包括多个所述像素电路。
27.根据权利要求24所述的显示面板，其特征在于，所述像素电路还包括第二复位模块，所述第二复位模块的控制端与第五扫描信号线电连接，所述第二复位模块的第一端与参考电压信号线电连接，所述第二复位模块的第二端与所述第一节点电连接，用于将所述参考电压信号线的参考电压信号传输至所述第一节点，以对所述第一节点进行复位。
28.根据权利要求27所述的显示面板，其特征在于，所述显示面板包括第二扫描驱动电路，所述第二扫描驱动电路包括多个级联的第二移位寄存器，一个所述第二移位寄存器通过所述第五扫描信号线与相邻的两行所述像素电路中的所述第二复位模块电连接，一行所述像素电路对应一条所述第五扫描信号线，一行所述像素电路包括多个所述像素电路。
29.根据权利要求27所述的显示面板，其特征在于，所述显示面板包括扫描驱动电路，所述扫描驱动电路包括多个级联的移位寄存器，一个所述移位寄存器通过所述第一扫描信号线与第j行所述像素电路中的所述阈值补偿模块电连接、且通过所述第五扫描信号线与第j+1行所述像素电路中的所述第二复位模块电连接，一行所述像素电路包括多个所述像素电路，j为正整数。
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