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TWI425471B - 顯示面板及其閘極驅動電路以及閘極驅動電路驅動方法 - Google Patents

顯示面板及其閘極驅動電路以及閘極驅動電路驅動方法 Download PDF

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TWI425471B
TWI425471B TW100121270A TW100121270A TWI425471B TW I425471 B TWI425471 B TW I425471B TW 100121270 A TW100121270 A TW 100121270A TW 100121270 A TW100121270 A TW 100121270A TW I425471 B TWI425471 B TW I425471B
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TW
Taiwan
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gate driving
gate
potential
charge sharing
driving unit
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TW100121270A
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Inventor
Chun Huan Chang
Wan Jung Chen
Yu Chung Yang
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Au Optronics Corp
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Description

顯示面板及其閘極驅動電路以及閘極驅動電路驅動方法
本發明是有關於顯示技術領域，且特別是有關於一種顯示面板及其閘極驅動電路以及閘極驅動電路驅動方法。
目前，平面顯示器例如液晶顯示面板因具有高畫質、體積小、重量輕及應用範圍廣等優點而被廣泛應用於行動電話、筆記型電腦、桌上型顯示裝置以及電視等消費性電子產品，並已經逐漸取代傳統的陰極射線管(CRT)顯示器而成為顯示器的主流。
請參閱圖1A及圖1B，其中圖1A繪示出一種應用於採用充電及電荷分享(charge and sharing)像素架構之顯示面板的閘極驅動電路之內部結構及其輸出的多個驅動電位於單個畫面幀週期F(m)內的波形，圖1B繪示出單個像素的電路結構示意圖。
如圖1A所示，閘極驅動電路包括充電閘極驅動單元串列與電荷分享閘極驅動單元串列；其中，充電閘極驅動單元串列包括串接的充電閘極驅動單元Ch[1]~Ch[n]與偽(dummy)充電閘極驅動單元Ch[DM1]~Ch[DM4]；電荷分享閘極驅動單元串列包括串接的延遲分享閘極驅動單元SR[DMA]~SR[DMB]、電荷分享閘極驅動單元SR[1]~SR[n]與偽電荷分享閘極驅動單元SR[DM1]~SR[DM4]。充電閘極驅動單元串列接收起始脈衝ST並逐級產生輸出電位，從而使充電閘極驅動單元Ch[1]~Ch[n]循序輸出充電閘極驅動電位G(1)~G(n)來決定對應像素是否從資料線上接收顯示資料；電荷分享閘極驅動單元串列接收起始脈衝ST後先於延遲分享閘極驅動單元SR[DMA]~SR[DMB]內傳遞，再循序傳遞至各個電荷分享閘極驅動單元SR[1]~SR[n]以循序輸出電荷分享閘極驅動電位S(1)~S(n)來決定對應像素是否進行內部電荷分享。
對於充電閘極驅動單元串列與電荷分享閘極驅動單元串列所驅動的多個像素，如圖1B所示，單個像素包括次子像素101及主子像素103；次子像素101中的像素電晶體M1電性耦接至閘極線例如GL[n]及資料線例如DL[q]並接受充電閘極驅動電位G(n)之控制來決定導通/截止狀態；主子像素103中的像素電晶體M2電性耦接至相同的閘極線GL[n]及資料線DL[q]並接受充電閘極驅動電位G(n)之控制來決定導通/截止狀態。並且，主子像素103中的像素電晶體M2更透過電荷分享電晶體M3電性耦接至次子像素101，而電荷分享電晶體M3電性耦接至電荷分享控制線例如SGL[n]以接受電荷分享閘極驅動電位S(n)之控制來決定導通/截止狀態，從而當電荷分享電晶體M3處於導通狀態時，次子像素101與主子像素103進行電荷分享，以藉此達成改善大視角色偏(color washout)之目的。
從圖1A還可以得知：每級充電閘極驅動單元例如Ch[n-2]會接收後二級充電閘極驅動單元Ch[n]輸出並回傳的充電閘極驅動電位G(n)之控制以決定截止輸出充電閘極驅動電位G(n-2)之時機。然而，由於回拉線路跨越其他多級充電閘極驅動單元及電荷分享閘極驅動單元，不僅增加電路繞線空間，還會增加功耗，且寄生電阻-電容(RC)增加的結果甚至會影響到本級充電閘極驅動單元的輸出波形好壞。
本發明的目的之一是提供一種顯示面板的閘極驅動電路，以克服先前技術中存在的技術缺陷。
本發明的再一目的是提供一種顯示面板的結構。
本發明的又一目的是提供一種閘極驅動電路驅動方法。
本發明實施例提出的一種顯示面板的閘極驅動電路，適於驅動具有多個像素的顯示面板。其中，閘極驅動電路包括第一閘極驅動單元串列與第二閘極驅動單元串列。第一閘極驅動單元串列包括串接的多個第一閘極驅動單元並接收起始脈衝，這些第一閘極驅動單元產生輸出電位以驅動像素，且每一第一閘極驅動單元所驅動的像素與其他第一閘極驅動單元所驅動的像素不同。第二閘極驅動單元串列包括串接的多個第二閘極驅動單元並接收上述起始脈衝，這些第二閘極驅動單元產生輸出電位以驅動像素，且每一第二閘極驅動單元所驅動的像素與其他第二閘極驅動單元所驅動的像素不同。再者，上述第二閘極驅動單元之一的輸出電位被提供至上述第一閘極驅動單元之一以決定是否禁能第一閘極驅動單元的輸出電位。
在本發明的實施例中，上述之提供輸出電位至第一閘極驅動單元的第二閘極驅動單元與接收此輸出電位的第一閘極驅動單元係可用以驅動同一像素。又或者，上述之提供輸出電位至第一閘極驅動單元的第二閘極驅動單元所驅動的像素，較接收此輸出電位的第一閘極驅動單元所驅動的像素在同一幀畫面中更晚被更新。
在本發明實施例中，上述之第一閘極驅動單元的輸出電位例如係用於控制像素進行充電操作，而這些第二閘極驅動單元的輸出電位例如係用於控制像素進行電荷分享操作。
本發明實施例提出的一種顯示面板包括多條資料線、多條閘極線、多條電荷分享控制線、多個像素、第一閘極驅動單元串列以及第二閘極驅動單元串列。這些閘極線與這些資料線交叉設置，這些電荷分享控制線與這些閘極線並行設置，這些像素中至少有一者同時電性耦接至這些資料線之一、這些閘極線之一以及這些電荷分享控制線之一，這些閘極線控制與其電性耦接的像素是否從與這些像素電性耦接的資料線接收資料，而這些電荷分享控制線控制與其電性耦接的像素是否進行像素內部的電荷分享。第一閘極驅動單元串列包括串接的多個第一閘極驅動單元並接收起始脈衝，而這些第一閘極驅動單元產生驅動電位，且每一第一閘極驅動單元電性耦接於這些閘極線之一；第二閘極驅動單元串列包括串接的多個第二閘極驅動單元，第二閘極驅動單元串列接收上述起始脈衝並逐級產生輸出波形循序傳遞於這些第二閘極驅動單元中，且每一第二閘極驅動單元驅動這些電荷分享控制線之一。再者，這些第二閘極驅動單元之一輸出的驅動電位被提供至這些第一閘極驅動單元之一的下拉電路以控制是否下拉此第一閘極驅動單元的輸出電位。
在本發明的實施例中，上述之電性耦接至這些像素之一的閘極線是否由致能轉為禁能，係可由電性耦接至同一像素的電荷分享控制線的電位所決定。
在本發明的實施例中，上述之電性耦接至這些像素之一的閘極線是否由致能轉為禁能，係可由在此閘極線被致能之後才被這些電荷分享控制線之一的致能電位所決定。
在本發明的實施例中，上述之電荷分享控制線之一與由此電荷分享控制線的電位所決定是否從致能轉為禁能的閘極線係相鄰設置。
本發明實施例另提出的一種閘極驅動電路驅動方法，適於驅動包括第一閘極驅動單元串列及第二閘極驅動單元串列之閘極驅動電路，而第一閘極驅動單元串列包括串接的多個第一閘極驅動單元，第二閘極驅動單元串列包括串接的多個第二閘極驅動單元。本實施例中的閘極驅動電路驅動方法包括步驟：致能這些第一閘極驅動單元之一者，輸出充電閘極驅動電位以驅動第一像素進行充電操作；以及致能這些第二閘極驅動單元之一者，輸出電荷分享閘極驅動電位；以及提供此電荷分享閘極驅動電位給被致能的第一閘極驅動單元從致能轉為禁能。其中，電荷分享閘極驅動電位係使第一像素或使在同一畫面幀週期比第一像素更晚被驅動進行充電操作的第二像素進行電荷分享操作。
本發明實施例藉由使第二閘極驅動單元串列中之各個第二閘極驅動單元的輸出電位接受第一閘極驅動單元串列中之第一閘極驅動單元的相應者的輸出電位之控制從致能轉為禁能，因此一方面可避免一次跨多級的回傳，使寄生電阻-電容降低、充電閘極驅動電位的波形較佳以及整體功耗下降，並可減少靜電放電(ESD)打傷機會；另一方面可免除多級(例如兩級)偽驅動單元，增加佈局(layout)空間。
為讓本發明之上述和其他目的、特徵和優點能更明顯易懂，下文特舉較佳實施例，並配合所附圖式，作詳細說明如下。
請參閱圖2，其繪示出相關於本發明實施例的一種顯示面板的局部結構示意圖。於本實施例中，顯示面板100例如為液晶顯示面板等各種主動式驅動顯示面板，其包括閘極驅動電路10、多條像素P、多條資料線例如DL[q]及DL[q+1]、多條閘極線GL[1]~GL[n]以及多條電荷分享控制線SGL[1]~SGL[n]。各條資料線DL[q]及DL[q+1]用於向像素P提供顯示資料，各條閘極線GL[1]~GL[n]電性耦接至閘極驅動電路10並與資料線DL[q]及DL[q+1]交叉設置，各條電荷分享控制線SGL[1]~SGL[n]電性耦接至閘極驅動電路10並與閘極線GL[1]~GL[n]平行設置，每一像素P同時電性耦接至資料線DL[q]及DL[q+1]之一、閘極線GL[1]~GL[n]之一以及電荷分享控制線SGL[1]~SGL[n]之一，以藉此由對應的閘極線決定是否從資料線上接收顯示資料並由對應的電荷分享控制線決定是否進行像素內部的電荷分享。各個像素P中包括多個可相互進行電荷分享的子像素，例如兩個子像素，此兩個子像素的電路結構可參閱前述相關於圖1B的敘述，故不再贅述。
請參閱圖3A及圖3B，其中圖3A繪示出圖2所示顯示面板100的閘極驅動電路10之內部結構實施型態及其輸出的驅動電位於單個畫面幀週期F(m)內的波形，圖3B繪示出圖3A中單個充電閘極驅動單元的內部電路結構示意圖。
如圖3A所示，閘極驅動電路10包括充電閘極驅動單元串列(第一閘極驅動單元串列)110以及電荷分享閘極驅動單元串列(第二閘極驅動單元串列)130。充電閘極驅動單元串列110包括串接的充電閘極驅動單元(第一閘極驅動單元)Ch[1]~Ch[n]與偽充電閘極驅動單元Ch[DM1]~Ch[DM2]，充電閘極驅動單元串列110接收起始脈衝ST並逐級產生輸出電位，以藉此使充電閘極驅動單元Ch[1]~Ch[n]循序輸出充電閘極驅動電位G(1)~G(n)分別至閘極線GL[1]~GL[n]來控制對應像素P是否從對應的資料線上接收顯示資料。電荷分享閘極驅動單元串列130包括串接的延遲分享閘極驅動單元SR[DMA]~SR[DMB]、電荷分享閘極驅動單元(第二閘極驅動單元)SR[1]~SR[n]與偽電荷分享閘極驅動單元SR[DM1]~SR[DM4]，電荷分享閘極驅動單元串列130接收起始脈衝ST後先傳遞於延遲分享閘極驅動單元SR[DMA]~SR[DMB]中，再逐級產生輸出電位循序傳遞於電荷分享閘極驅動單元SR[1]~SR[n]，以藉此使電荷分享閘極驅動單元SR[1]~SR[n]循序輸出電荷分享閘極驅動電位S(1)~S(n)分別至電荷分享控制線SGL[1]~SGL[n]來控制對應像素P是否進行像素內部電荷分享。
承上述，對於驅動同一像素P的充電閘極驅動單元例如Ch[n]與電荷分享閘極驅動單元SR[n]，後者輸出的電荷分享閘極驅動電位S(n)係被提供至前者以決定是否禁能前者輸出的充電閘極驅動電位G(n)之電位，亦即決定是否停止充電以完成電荷分享；在此，驅動同一像素P的充電閘極驅動單元與電荷分享閘極驅動單元所分別控制的閘極線與電荷分享控制線係分設於像素P的兩側且相鄰設置。從圖3A中的波形圖可以得知：用於驅動同一像素P的充電閘極驅動電位例如G(n)與電荷分享閘極驅動電位S(n)的有效作用時間相互不重疊，而相鄰兩個充電閘極驅動電位例如G(n-1)與G(n)的有效作用時間係部分重疊(例如重疊50%)，相鄰兩個電荷分享閘極驅動電位例如S(n-1)與S(n)的有效作用時間亦係部分重疊。在此需要說明的是，圖3A中各個充電閘極驅動電位G(1)~G(n)與電荷分享閘極驅動電位S(1)~S(n)的波形係為考慮閘極驅動電路10內部電路之影響而得的模擬波形，然而理論上各個驅動電位G(1)~G(n)及S(1)~S(n)的波形為理想方波。
如圖3B所示，充電閘極驅動單元串列110中，各個充電閘極驅動單元Ch[1]~Ch[n]及偽充電閘極驅動單元Ch[DM1]~Ch[DM2]的任意者例如Ch[3]包括致能控制電路11、上拉電路13、穩定電路15以及下拉電路17。致能控制電路11用於致能上拉電路13，例如包括串接的電晶體T11及T12，電晶體T12的閘極接收致能電位，例如前二級充電閘極驅動單元Ch[1]的節點Q處的電位，電晶體T12的源/汲極接收時脈電位CK，電晶體T11的閘極電性耦接至電晶體T12的汲/源極；電晶體T11的源/汲極接收前二級充電閘極驅動單元Ch[1]輸出的充電閘極驅動電位G(1)，電晶體T11的汲/源極電性耦接至節點Q。上拉電路13例如包括電晶體T21，電晶體T21的閘極電性耦接至節點Q以由節點Q處的電位決定是否導通電晶體T21，電晶體T21的源/汲極接收另一時脈電位XCK，且電晶體T21的汲/源極作為充電閘極驅動電位G(3)的輸出端。穩定電路15用於穩定節點Q處與電晶體T21的汲/源極之電位，其通常包括有多個電晶體以及電容等電路元件。下拉電路17例如包括電晶體T31及T41，其皆接受由電荷分享閘極驅動單元SR[3]輸出的電荷分享閘極驅動電位S(3)之致能控制而在特定時段內分別將節點Q處與電晶體T21的汲/源極之電位拉至預設電位例如Vss，亦即將充電閘極驅動單元Ch[3]輸出的充電閘極驅動電位G(3)的電位從致能轉為禁能。本實施例中，時脈電位CK與XCK係互為反相電位，亦即時脈電位CK為高電位時，時脈電位XCK對應為低電位，反之時脈電位XCK為高電位時，時脈電位CK對應為低電位。
比較圖3A與先前技術中的圖1A可知：本發明實施例之充電閘極驅動單元串列110中的各個充電閘極驅動單元(例如Ch[3])係採用電荷分享閘極驅動單元串列130中與其相鄰的電荷分享閘極驅動單元(例如SR[3])輸出的電荷分享閘極驅動電位S(3)來致能其下拉電路17，而非如圖1A所示採用後二級的充電閘極驅動單元Ch[5]所輸出的充電閘極驅動電位G(5)作為下拉致能電位來致能其下拉電路，無需跨越其他級充電閘極驅動單元及其他級電荷分享閘極驅動單元，因此可避免一次跨多級的回傳，可使寄生電阻-電容降低、充電閘極驅動電位的波形較佳以及整體功耗下降，並可減少靜電放電打傷機會。此外，本發明實施例中的充電閘極驅動單元串列110僅需採用兩級偽充電閘極驅動單元，其相較於圖1A中採用四級偽充電閘極驅動單元為少，故可增加佈局空間。
請參閱圖3C，其繪示出圖3A所示閘極驅動電路10之內部結構的另一觀察視角。如圖3C所示，閘極驅動電路10中的充電閘極驅動單元Ch[1]~Ch[n]與電荷分享閘極驅動單元SR[1]~SR[n])構成多級閘極驅動器GD[1]~GD[n]，每級閘極驅動器包括驅動同一像素P的充電閘極驅動單元(例如Ch[3])與電荷分享閘極驅動單元(例如SR[3])，並且各級閘極驅動器中的充電閘極驅動單元例如Ch[3]輸出的充電閘極驅動電位G(3)是否從致能轉為禁能係由同級閘極驅動器GD[3]中的電荷分享閘極驅動單元SR[3]輸出的電荷分享閘極驅動電位S(3)所控制。
於上述實施例中，各個充電閘極驅動單元(例如Ch[3])所控制的閘極線GL[3]係接受與其驅動同一像素P的電荷分享閘極驅動單元SR[3](亦即同級閘極驅動器中的電荷分享閘極驅動單元)之控制從致能轉為禁能，並且此同一像素P的充電閘極驅動電位G(3)之電位被禁能之同時，其被致能開始進行電荷分享；然本發明並不以此為限，亦可採用後級電荷分享閘極驅動單元來達成閘極線從致能轉為禁能，只要其滿足【閘極線是否由致能轉為禁能，係由在此閘極線被致能之後才被致能的電荷分享控制線的電位所決定】即可。例如，在本發明其他實施例中，可採用電荷分享閘極驅動單元SR[4]來控制充電閘極驅動單元Ch[3]所控制的閘極線GL[3]從致能轉為禁能。
具體可一併參閱圖2、圖4A及圖4B，其中圖4繪示出圖2所示顯示面板100的閘極驅動電路10之內部結構另一實施型態及其輸出的驅動電位於單個畫面幀週期F(m)內的波形，圖4B繪示出圖4A中單個充電閘極驅動單元的內部電路結構示意圖。如圖4A所示，充電閘極驅動單元串列210，類似於圖3A中的充電閘極驅動單元串列110而包括串接的充電閘極驅動單元Ch[1]~Ch[n]與偽充電閘極驅動單元Ch[DM1]~Ch[DM2]，不同之處在於：各個充電閘極驅動單元Ch[1]~Ch[n]係採用與其驅動同一像素P的電荷分享閘極驅動單元之後一級電荷分享閘極驅動單元輸出的電荷分享閘極驅動電位來禁能其輸出。例如圖4B所示，充電閘極驅動單元Ch[3]採用電荷分享閘極驅動單元SR[4]輸出的電荷分享閘極驅動電位S(4)來致能其下拉電路17，以藉此禁能其輸出；在此，於同一畫面幀週期F(m)內，電荷分享閘極驅動單元SR[4]所驅動的像素P較充電閘極驅動單元Ch[3]所驅動的像素P更晚被驅動。
請參閱圖4C，其繪示出圖4A所示閘極驅動電路10之內部結構的另一觀察視角。如圖4C所示，閘極驅動電路10中的充電閘極驅動單元Ch[1]~Ch[n]與電荷分享閘極驅動單元SR[1]~SR[n])構成多級閘極驅動器GD[1]~GD[n]，每級閘極驅動器包括驅動同一像素P的充電閘極驅動單元(例如Ch[3])與電荷分享閘極驅動單元(例如SR[3])，並且各級閘極驅動器中的充電閘極驅動單元例如Ch[3]輸出的充電閘極驅動電位G(3)是否從致能轉為禁能係由後級閘極驅動器GD[4](未標示)中的電荷分享閘極驅動單元SR[4]輸出的電荷分享閘極驅動電位S(4)所控制。
雖然本發明已以較佳實施例揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。
ST．．．起始脈衝
SR[DMA]、SR[DMB]．．．延遲分享閘極驅動單元
SR[1]~SR[n]．．．電荷分享閘極驅動單元
SR[DM1]~SR[DM4]．．．偽電荷分享閘極驅動單元
Ch[1]~Ch[n]．．．充電閘極驅動單元
Ch[DM1]~Ch[DM4]．．．偽充電閘極驅動單元
G(1)~G(n)．．．充電閘極驅動電位
S(1)~S(n)．．．電荷分享閘極驅動電位
F(m)．．．畫面幀週期
DL[q]、DL[q+1]．．．資料線
GL[1]~GL[n]．．．閘極線
GD[1]~GD[n]．．．閘極驅動器
SGL[1]~SGL[n]．．．電荷分享控制線
M1、M2．．．像素電晶體
M3．．．電荷分享電晶體
101．．．次子像素
103．．．主子像素
100．．．顯示面板
10．．．閘極驅動電路
110、210．．．充電閘極驅動單元串列
130．．．電荷分享閘極驅動單元串列
CK、XCK．．．時脈電位
T11、T12、T21、T31、T41．．．電晶體
Q．．．節點
11．．．致能控制電路
13．．．上拉電路
15．．．穩定電路
17．．．下拉電路
Vss．．．預設電位
圖1A繪示出一種應用於採用充電及電荷分享像素架構之顯示面板的閘極驅動電路之內部結構及其輸出的驅動電位於單個畫面幀週期F(m)內的波形。
圖1B繪示出單個像素的電路結構示意圖。
圖2繪示出相關於本發明實施例的一種顯示面板的局部結構示意圖。
圖3A繪示出圖2所示顯示面板的閘極驅動電路之內部結構實施型態及其輸出的驅動電位於單個畫面幀週期F(m)內的波形。
圖3B繪示出圖3A中單個充電閘極驅動單元的內部電路結構示意圖。
圖3C繪示出圖3A所示閘極驅動電路之內部結構的另一觀察視角。
圖4A繪示出圖2所示顯示面板的閘極驅動電路之內部結構另一實施型態及其輸出的驅動電位於單個畫面幀週期F(m)內的波形。
圖4B繪示出圖4A中單個充電閘極驅動單元的內部電路結構示意圖。
圖4C繪示出圖4A所示閘極驅動電路10之內部結構的另一觀察視角。
ST．．．起始脈衝
10．．．閘極驅動電路
110．．．充電閘極驅動單元串列
Ch[1]~Ch[n]．．．充電閘極驅動單元
Ch[DM1]~Ch[DM2]．．．偽充電閘極驅動單元
G(1)~G(n)．．．充電閘極驅動電位
130．．．電荷分享閘極驅動單元串列
SR[DMA]、SR[DMB]．．．延遲分享閘極驅動單元
SR[1]~SR[n]．．．電荷分享閘極驅動單元
SR[DM1]~SR[DM4]．．．偽電荷分享閘極驅動單元
S(1)~S(n)．．．電荷分享閘極驅動電位
F(m)．．．畫面幀週期

Claims (11)

  1. 一種顯示面板的閘極驅動電路，適於驅動具有多個像素的顯示面板，該閘極驅動電路包括：一第一閘極驅動單元串列，包括串接的多個第一閘極驅動單元，該第一閘極驅動單元串列接收一起始脈衝，而該些第一閘極驅動單元產生輸出電位以驅動像素，且每一該些第一閘極驅動單元所驅動的像素與其他第一閘極驅動單元所驅動的像素不同；以及一第二閘極驅動單元串列，包括串接的多個第二閘極驅動單元，該第二閘極驅動單元串列接收該起始脈衝，而該些第二閘極驅動單元產生輸出電位以驅動像素，且每一該些第二閘極驅動單元所驅動的像素與其他第二閘極驅動單元所驅動的像素不同，其中，該些第二閘極驅動單元之一的輸出電位被提供至該些第一閘極驅動單元之一以決定是否禁能該第一閘極驅動單元的輸出電位。
  2. 如申請專利範圍第1項所述的閘極驅動電路，其中提供輸出電位至該第一閘極驅動單元的該第二閘極驅動單元與接收該輸出電位的該第一閘極驅動單元係用以驅動同一像素。
  3. 如申請專利範圍第1項所述的閘極驅動電路，其中提供輸出電位至該第一閘極驅動單元的該第二閘極驅動單元所驅動的像素，較接收該輸出電位的該第一閘極驅動單元所驅動的像素在同一幀畫面中更晚被更新。
  4. 如申請專利範圍第1項所述的閘極驅動電路，其中該些第一閘極驅動單元的輸出電位係用於控制像素進行充電操作，該些第二閘極驅動單元的輸出電位係用於控制像素進行電荷分享操作。
  5. 一種顯示面板，包括：多條資料線；多條閘極線，與該些資料線交叉設置；多條電荷分享控制線，與該些閘極線並行設置；多個像素，該些像素中至少有一者同時電性耦接至該些資料線之一、該些閘極線之一以及該些電荷分享控制線之一，該些閘極線控制電性耦接的像素是否從與該像素電性耦接的資料線接收資料，而該些電荷分享控制線控制電性耦接的像素是否進行像素內部的電荷分享；一第一閘極驅動單元串列，包括串接的多個第一閘極驅動單元，該第一閘極驅動單元串列接收一起始脈衝，而該些第一閘極驅動單元產生驅動電位，且每一該些第一閘極驅動單元電性耦接於些閘極線之一；以及一第二閘極驅動單元串列，包括串接的多個第二閘極驅動單元，該第二閘極驅動單元串列接收該起始脈衝，而該些第二閘極驅動單元產生驅動電位，且每一該些第二閘極驅動單元電性耦接於該些電荷分享控制線之一，其中，該些第二閘極驅動單元之一輸出的驅動電位被提供至該些第一閘極驅動單元之一的下拉電路以控制是否下拉該第一閘極驅動單元的輸出電位。
  6. 如申請專利範圍第5項所述的顯示面板，其中電性耦接至該些像素之一的閘極線是否由致能轉為禁能，係由電性耦接至同一像素的電荷分享控制線的電位所決定。
  7. 如申請專利範圍第5項所述的顯示面板，其中電性耦接至該些像素之一的閘極線是否由致能轉為禁能，係由在該閘極線被致能之後才被該些電荷分享控制線之一的致能電位所決定。
  8. 如申請專利範圍第5項所述的顯示面板，其中該些電荷分享控制線之一與由該電荷分享控制線的電位所決定是否從致能轉為禁能的閘極線係相鄰設置。
  9. 一種閘極驅動電路驅動方法，可適於驅動一閘極驅動電路，該閘極閘極驅動電路包括：一第一閘極驅動單元串列及一第二閘極驅動單元串列，且該第一閘極驅動單元串列包括串接的多個第一閘極驅動單元，以及該第二閘極驅動單元串列包括串接的多個第二閘極驅動單元，其中，該閘極驅動電路驅動方法包括：致能該些第一閘極驅動單元中之一者，輸出一充電閘極驅動電位以驅動一第一像素進行充電操作；致能該些第二閘極驅動單元中之一者，輸出一電荷分享閘極驅動電位；以及提供該電荷分享閘極驅動電位給該被致能的第一閘極驅動單元，進而將該被致能的第一閘極驅動單元從致能轉為禁能。
  10. 如申請專利範圍第9項所述的閘極驅動電路驅動方法，其中，該電荷分享閘極驅動電位係使該第一像素進行一電荷分享操作。
  11. 如申請專利範圍第9項所述的閘極驅動電路驅動方法，其中，該電荷分享閘極驅動電位係使在同一畫面幀週期內比該第一像素更晚被驅動進行充電操作的一第二像素進行電荷分享操作。
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