KR940012840A - 금속 산화물 반도체 전계 효과 트랜지스터의 스위치 오프를 제어하기 위한 회로 장치 - Google Patents
금속 산화물 반도체 전계 효과 트랜지스터의 스위치 오프를 제어하기 위한 회로 장치 Download PDFInfo
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Abstract
전기 부하(ZL)의 공급 회로(10)에 배치된 금속 산화물 회로 반도체 (MOS) 전계 효과 트랜지스터 (TO)의 스위치 오프를 제어하기 위한 회로 장치는 과전류 검출수단 (12)와 그것에 의해 제어될 수 있는 방전 회로 (14)를 포함한다. 방전 회로 (14)를 통해 예정가능한 시정수는 게이트-소스 전압 (UGS)의 함수로서 변하는 값으로 가정하고, 방전 회로 (14)는 저항 (R)의 병렬 장치 및 복수의 다이오드 (Dl-Dn)를 직렬로 한 다이오드 장치를 포함한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 공급 회로에 포함되는 금속 산화물 반도체 전계 효과 트랜지스터를 스위치 오프하기 위한, 제1도에 따른 공급 회로에 배치된 본 발명에 따른 회로 장치의 회로 원리를 도시하는 도면.
제3도는 게이트-소스 전압의 함수로서 제2도에 따른 공급 회로에 배치되는 금속 산화물 반도체 전계 효과 트랜지스터의 드레인-소스 저항값을 나타내는 그래프.
제4도는 본 발명에 따른 회로 장치에 의해 발생되는 금속 산화물 반도체 전계 효과 트랜지스터의 스위치 오프 또는 방전 중의 게이트 전압의 시간 프로필을 도시하는 도면.
Claims (8)
- 전기 부하(ZL)의 공급 회로(10)에 배치되고 하측 구동기(LSD)로서 기능하는 금속 산화물 회로 반도체(MOS) 전계 효과 트랜지스터(TO)의 스위치 오프를 제어하고, 과전류 검출 수단(12) 및 과전류 상태에서 예정할 수 있는 시정수(t)에 따라 상기 과전류 검출 수단(12)에 의해 제어되고 게이트 소스 캐패스턴스(CGS)에 저장된 전하를 방전하기 위한 상기 MOS 전계 효과 트랜지스터(TO)의 게이트 단자(G) 와 소스 단자(S) 사이에 있는 방전회로(14) 를 포함하는 회로 장치에 있어서, 상기 방전 회로(14)에 의해 예정될 수 있는 상기 시정수(t)는 상기 MOS 전계 효과 트랜지스터(TO)가 게이트-소스 전압(UGS)의 변화에 따라 드레인-소스 저항(RDS)의 실질적 변화가 없는 상부 전압 범위(B-C)와 상기 드레인-소스 저항(RDS)가 상기 게이트-소스 전압(UGS)에 따라 변하는 하부 전압 범위(A-B) 사이에 배치되는 게이트-소스 전압(UGSB)을 나타내자 마자 2개의 상이한 값 사이에서 스위치 가능하고, 상기 시정수(t)는 상기 게이트-소스 전압(UGS)가 상기 상부 전압 범위(B-C) 내에 있는 한 비교적 낮은 값(t1)을 가지며, 상기 게이트-소스 전압(UGS)가 상기 하부 전압 범위(A-B)에 배치되자마자 비교적 높은 값(t2)로 되는 것을 특징으로 하는 회로 장치.
- 제1항에 있어서, 상기 방전 회로(14)에 의해 예정될 수 있는 상기 시정수(t)는 상기 상부 전압 범위(B-C)내의 게이트-소스 전압(USG)에 대해 제로 영역 내의 값(t1)을 갖는 것을 특징으로 하는 회로 장치.
- 제1항 또는 제2항에 있어서, 상기 방전 회로(14)는 상기 과전압 검출 수단(12)에 의해 제어되고 상기 MOS전계 효과 트랜지스터(TO)의 게이트 단자(G)와 소스 단자(S) 사이에 삽입되어 있는 전자 스위치(S)를 통해 스위치될 수 있는 것을 특징으로 하는 회로 장치.
- 제1항 내지 제3항 중의 어느 한 항에 있어서, 상기 방전 회로(14)가 하나 이상의 음저항(R)을 갖는 저항 장치와 직렬 회로화된 하나 이상의 다이오드(Dl-Dn)의 다이오드 장치의 병렬 회로를 포함하는 것을 특징으로 하는 회로 장치.
- 제4항에 있어서, 상기 다이오드 장치(Dl-Dn)의 순방향 전압(n·UD)가 상부와 하부 전압 범위(각각 B-C와 A-B)사이에 있는 상기 게이트-소스 전압(UGSB)의 함수로서 선택되는 것을 특징으로 하는 회로 장치.
- 제1항 내지 제5항 중의 어느 한 항에 있어서, 상기 MOS 전계 효과 트랜지스터(TO)가 소스 회로에서 상기 전기 부하(ZL)에 접속되는 것을 특징으로 하는 회로 장치.
- 제6항에 있어서, 상기 저항 장치(R)과 상기 병렬 다이오드 장치(Dl-Dn)을 포함하는 상기 방전 회로(14)는 상기 과전류 검출 수단(12)에 의해 상기 MOS 전계 효과 트랜지스터(TO)의 상기 게이트 단자(G) 및 상기 소스 단자(S)에 직접 접속되고, 상기 다이오드 장치(Dl-Dn)의 상기 순방향 전압(n·UD)는 상부와 하부 전압 범위(각각 B-C와 A-B) 사이에 있는 상기 게이트-소스 전압(UGSB)와 동일하게 선택되는 것을 특징으로 하는 회로 장치.
- 제7항에 있어서, 상기 과전압 검출 수단(12)는 단락 회로 검출기 수단인 것을 특징으로 하는 회로 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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