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KR20230033772A - 표시 패널 및 이를 포함하는 표시 장치 - Google Patents

표시 패널 및 이를 포함하는 표시 장치 Download PDF

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KR20230033772A
KR20230033772A KR1020210116273A KR20210116273A KR20230033772A KR 20230033772 A KR20230033772 A KR 20230033772A KR 1020210116273 A KR1020210116273 A KR 1020210116273A KR 20210116273 A KR20210116273 A KR 20210116273A KR 20230033772 A KR20230033772 A KR 20230033772A
Authority
KR
South Korea
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panel area
scan
panel
display
sub
Prior art date
Application number
KR1020210116273A
Other languages
English (en)
Inventor
이민직
한예슬
조정옥
최광현
Original Assignee
엘지디스플레이 주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
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Priority to CN202211074666.2A priority patent/CN115731790A/zh
Priority to US17/901,300 priority patent/US20230075073A1/en
Priority to JP2022139292A priority patent/JP7434468B2/ja
Priority to EP22193444.1A priority patent/EP4155866B1/en
Priority to TW111133239A priority patent/TWI857341B/zh
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Abstract

본 발명은 Z형으로 폴딩(Folding) 되는 표시 패널의 메인 바디(Main Body) 두께를 감소시키고, 언폴딩(Unfolding) 시에 한 손으로 핸들링 할 수 있는 표시 패널 및 이를 포함하는 표시 장치에 관한 것이다.
이를 실현하기 위해, 본 명세서의 실시예는, 표시부의 바깥 쪽에 외곽 바디를 추가하여, 이를 통해 폴딩 영역과 표시부가 보호되고, 표시부의 표면이 투명 플라스틱에 의해 보호되며, 외곽 바디가 손잡이 역할을 할 수 있다.
따라서, 본 명세서의 실시예에 따르면, 표시 패널의 메인 바디 두께가 감소되고, 언폴딩 시 한 손으로 핸들링 할 수 있으며, 충격에 취약한 부분을 보호할 수 있는 효과가 있다.

Description

표시 패널 및 이를 포함하는 표시 장치{Display panel and display device including the same}
본 발명은 인 폴딩 영역(In Folding Area)과 아웃 폴딩 영역(Out Folding Area)이 공존하는 Z 폴딩형 표시 패널(Z Folding display panel) 및 이를 포함하는 표시 장치에 관한 것이다.
일반적으로, Z-폴딩 표시장치는 폴딩 시 Z자 형태를 경유해 폴딩 상태가 되며, 휴대용 디스플레이 장치로 구현될 수 있다.
또한, Z-폴딩 표시장치는 인 폴딩 영역과 아웃 폴딩 영역이 공존하는 폴딩 시에도 화면이 나타나며, 언폴딩(Unfolding) 시에는 와이드(Wide) 화면을 구현하는 장점이 있다.
또한, Z-폴딩 표시장치는 표시 영역에 유기전계 발광다이오드(이하 OLED)를 통하여 영상을 표출하는 유기발광 표시장치로 구현될 수 있다.
유기발광 표시장치는 구동 박막트랜지스터의 게이트 전극에 데이터 전압이 인가되면, 게이트-소스 간 전압에 따라 드레인-소스 간 전류가 흐르게 되어, 유기전계 발광다이오드에 공급된다. 이러한 유기발광 표시장치는 구동 박막트랜지스터에 의해 유기전계 발광다이오드에 흐르는 전류의 양을 조절하여 영상의 계조를 표시한다.
전술한 유기발광 표시장치는 각 픽셀에 탑재된 TFT 소자로 OLED 소자에 인가되는 전류 양을 조절하여 자체 발광하는 OLED의 밝기를 조절하고 있다.
그런데, 유기발광 표시장치로 구현되는 표시 장치는, 외곽(Outer) 화면의 경우 외부에 노출되어 있어, 외부 충격이나 휴대 시에 긁힘에 매우 취약하다는 단점이 있다.
또한, 표시 장치는 멀티 폴딩(Multi-Folding) 방식의 스마트 폰으로 구현된 Z-폴딩형 표시 장치의 경우, 폴딩 시 폰(Phone)의 두께 증가에 의한 디자인 디메리트(Design Demerit)가 발생되고 있다.
이를 해결하기 위해, 표시 패널의 메인 바디(Main Body)의 두께를 감소시키는 경우에, 배터리 용량이 축소되는 문제점과, 언폴딩(Unfolding) 시 화면 크기가 커져 한 손으로 핸들링(Handling) 하기가 쉽지 않는 문제점도 발생하고 있다.
그리고, 카메라의 경우 두께의 축소가 매우 어려워 카메라가 메인 바디의 외부로 돌출되어 손상되기 쉽거나 미관상 좋지 않은 문제점이 발생되고 있다.
이에, 본 명세서의 발명자는 전술한 문제점을 해결하기 위해, 멀티 폴딩 방식의 단말기에 대하여 카메라가 외부로 돌출되지 않게 하고, 충격에 매우 취약한 부분을 보호할 수 있는 표시 패널을 발명하였다.
또한, 본 명세서의 발명자는 상기 표시 패널을 포함하고, 표시부의 바깥 쪽에 외곽 바디를 추가하여, 이를 통해 폴딩 영역과 표시부가 보호되고, 표시부의 표면이 투명 플라스틱에 의해 보호되며, 외곽 바디가 손잡이 역할을 하는 표시 장치를 발명하였다.
상기한 본 발명의 목적들은 이상에서 언급한 목적으로 제한되지 않으며, 언급되지 않은 본 발명의 다른 목적 및 장점들은 하기의 설명에 의해서 이해될 수 있고, 본 발명의 실시예에 의해 보다 분명하게 이해될 것이다. 또한, 본 발명의 목적 및 장점들은 특허 청구 범위에 나타낸 수단 및 그 조합에 의해 실현될 수 있음을 쉽게 알 수 있을 것이다.
본 명세서의 실시예에 따른 표시 장치는, 제1 패널 영역과 제2 패널 영역 및 제3 패널 영역이 Z 형상을 경유해 폴딩되고, 각 패널 영역은 전면에 표시 영역을 구비하고 후면에 비표시 영역을 구비할 수 있다.
또한, 본 명세서의 실시예에 따른 표시 장치는, 제1 패널 영역과 제2 패널 영역이 제1 힌지 결합부를 통해 힌지 결합되고, 제2 패널 영역과 제3 패널 영역이 제2 힌지 결합부를 통해 힌지 결합될 수 있다.
또한, 본 명세서의 실시예에 따른 표시 장치는, 폴딩 시 제1 패널 영역의 제1 후면과 제2 패널 영역의 제2 후면이 서로 마주 보도록 제1 패널 영역에 제2 패널 영역이 대응하고, 제2 패널 영역의 제2 전면과 제3 패널 영역의 제3 전면이 마주 보도록 제2 패널 영역에 제3 패널 영역이 대응되게 폴딩될 수 있다.
또한, 본 명세서의 실시예에 따른 표시 장치는, 제1 패널 영역의 제1 전면에 형성된 제1 표시부와, 제2 패널 영역의 제2 전면에 형성된 제2 표시부, 및 제3 패널 영역의 제3 전면에 형성된 제3 표시부가 연이어 일체로 형성될 수 있다.
또한, 본 명세서의 실시예에 따른 표시 장치는, 상기 제1 표시부와 상기 제2 표시부 및 상기 제3 표시부 각각이 복수의 서브 화소들에 하나의 행마다 1개씩의 스캔 배선이 배치되고, 복수의 서브 화소들에 하나의 열마다 2개씩의 데이터 배선들이 배치될 수 있다.
본 발명의 실시예에 따르면, 표시부의 외곽에 배치된 외곽 바디와, 외곽 바디로부터 유출되는 투명 커버에 의해 표시부를 보호하고, 외부 충격이나 이동 시에 표시부의 파손을 방지할 수 있다.
또한, 본 발명은 언폴딩(Unfolding) 시 화면의 크기가 커지더라도 외곽 바디를 한 손으로 잡고 핸들링(Handling) 하기가 쉬워짐에 따라 사용 편리성이 높아지는 장점이 있다.
또한, 본 발명은 카메라나 펜, 배터리 등을 외곽 바디에 배치함으로써 표시 패널의 메인 바디(Main Body)의 두께를 낮출 수 있다.
또한, 본 발명에 따른 Z 폴딩형 표시 패널에서는 수직 방향으로 연속된 2 개의 화소의 데이터 입력부가 일측 데이터 라인과 다른측 데이터 라인에 각각 연결됨으로써 인터레이스 방식으로 구동될 수 있다.
또한, 본 발명에 따른 Z 폴딩형 표시 패널에서는 인터레이스 방식으로 구동될 때, 홀수 프레임(Odd Frame)과 짝수 프레임(Even Frame)으로 나뉘어, 각 하프 프레임(Half Frame) 동안 각각 데이터 신호가 입력될 수 있다.
또한, 본 발명에 따른 Z 폴딩형 표시 패널에서는 프로그레시브(Progressive) 방식으로 구동될 때, 4 개의 스캔 라인 단위로 동작하되, 첫째 라인, 셋째 라인, 둘째 라인, 넷째 라인 순으로 데이터 신호가 입력될 수 있다.
따라서, 본 발명에 의하면, 2 수평 기간(2H) 구동에 의한 센싱 타임(Sensing time) 증가로 고속 구동이 가능한 효과가 있다.
그리고, 본 발명에 따른 Z 폴딩형 표시 패널에서는, 인터레이스 구동을 위한 저주파수 구동 시 플리커 문제를 해결할 수 있다.
본 명세서의 효과는 이상에서 언급한 효과에 제한되지 않으며, 언급되지 않은 또 다른 효과는 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.
상술한 효과와 더불어 본 발명의 구체적인 효과는 이하 발명을 실시하기 위한 구체적인 사항을 설명하면서 함께 기술한다.
도 1은 본 명세서의 실시예에 따른 표시 장치의 외관 형상을 개략적으로 나타낸 사시도이다.
도 2는 본 명세서의 실시예에 따른 표시 장치의 폴딩 시 투명 커버에 의해 표시면이 보호되는 예를 측면에서 바라 본 측면도이다.
도 3은 본 명세서의 실시예에 따른 표시 장치의 언폴딩 시 측면에서 바라 본 측면도이다.
도 4는 본 명세서의 실시예에 따른 표시 장치의 폴딩 시 투명 커버가 슬라이딩 된 예를 나타낸 측면도이다.
도 5는 본 명세서의 실시예에 따른 제1 내지 제3 패널 영역을 각각 분해하여 측면에서 바라 본 단면도이다.
도 6은 본 명세서의 실시예에 따른 표시 장치의 폴딩 시 전면부를 나타낸 구성도이다.
도 7은 본 명세서의 실시예에 따른 표시 장치의 폴딩 시 후면부를 나타낸 구성도이다.
도 8은 본 명세서의 실시예에 따른 표시 장치에서 제3 패널 영역과 외곽 바디 간의 전기적 연결 관계를 나타낸 구성도이다.
도 9는 본 명세서의 실시예에 따른 표시 장치의 제3 패널 영역과 외곽 바디의 인쇄회로기판 간의 접촉 상태를 나타낸 구성도이다.
도 10은 본 명세서의 실시예에 따른 표시 장치가 폴딩 상태일 때 영상을 디스플레이하는 예를 나타낸 도면이다.
도 11은 본 명세서의 실시예에 따른 표시 장치가 언폴딩 상태일 때 영상을 디스플레이하는 예를 나타낸 도면이다.
도 12는 본 명세서의 실시예에 따른 표시 장치에서 제3 패널 영역의 구성을 개략적으로 나타낸 구성도이다.
도 13은 임의의 화소 구성을 개략적으로 나타낸 구성도이다.
도 14는 본 명세서의 실시예에 따른 제3 패널 영역에서 하나의 서브 화소에 대한 회로 구성 예를 나타낸 회로도이다.
도 15는 본 명세서의 실시예에 따른 제3 패널 영역의 인터레이스 방식 구동 타이밍도를 나타낸 도면이다.
도 16은 본 명세서의 실시예에 따른 제3 패널 영역의 프로그레시브 방식 구동 타이밍도를 나타낸 도면이다.
전술한 목적, 특징 및 장점은 첨부된 도면을 참조하여 상세하게 후술되며, 이에 따라 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 본 발명의 기술적 사상을 용이하게 실시할 수 있을 것이다. 본 발명을 설명함에 있어서 본 발명과 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우에는 상세한 설명을 생략한다. 이하, 첨부된 도면을 참조하여 본 발명에 따른 바람직한 실시예를 상세히 설명하기로 한다. 도면에서 동일한 참조부호는 동일 또는 유사한 구성요소를 가리키는 것으로 사용된다.
또한 어떤 구성요소가 다른 구성요소에 "연결", "결합" 또는 "접속"된다고 기재된 경우, 상기 구성요소들은 서로 직접적으로 연결되거나 또는 접속될 수 있지만, 각 구성요소 사이에 다른 구성요소가 "개재"되거나, 각 구성요소가 다른 구성요소를 통해 "연결", "결합" 또는 "접속"될 수도 있는 것으로 이해되어야 할 것이다.
다른 정의가 없다면, 본 명세서에서 사용되는 모든 용어(기술 및 과학적 용어를 포함)는 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 공통적으로 이해될 수 있는 의미로 사용될 수 있을 것이다. 또 일반적으로 사용되는 사전에 정의되어 있는 용어들은 명백하게 특별히 정의되어 있지 않은 한 이상적으로 또는 과도하게 해석되지 않는다.
이하에서는, 본 발명의 몇몇 실시예에 따른 표시 패널 및 이를 포함하는 표시 장치를 설명하도록 한다.
도 1은 본 명세서의 실시예에 따른 표시 장치의 외관 형상을 개략적으로 나타낸 사시도이고, 도 2는 본 명세서의 실시예에 따른 표시 장치의 폴딩 시 투명 커버에 의해 표시면이 보호되는 예를 측면에서 바라 본 측면도이다. 도 3은 본 명세서의 실시예에 따른 표시 장치의 언폴딩 시 측면에서 바라 본 측면도이다. 도 4는 본 명세서의 실시예에 따른 표시 장치의 폴딩 시 투명 커버가 슬라이딩 된 예를 나타낸 측면도이고, 도 5는 본 명세서의 실시예에 따른 제1 내지 제3 패널 영역을 각각 분해하여 측면에서 바라 본 단면도이다.
도 1 내지 도 5를 참조하면, 본 명세서의 실시예에 따른 표시 장치(100)는, 제1 패널 영역(110), 제2 패널 영역(120), 제3 패널 영역(130)을 포함할 수 있다.
제1 패널 영역(110)은 제1 전면(110a)과 제1 후면(110b)을 구비할 수 있다. 제1 전면(110a)은 제1 후면(110b)과 동일한 면적을 가지거나 그 보다 더 작은 면적을 가질 수 있다.
제1 패널 영역(110)은 제1 전면(110a)에 제1 표시부(112)를 포함할 수 있다. 제1 표시부(112)는 제1 전면(110a)과 동일한 면적을 가지거나 그 보다 더 작은 면적을 가질 수 있다.
제2 패널 영역(120)은 제2 전면(120a)과 제2 후면(120b)을 구비할 수 있다. 제2 전면(120a)은 제2 후면(120b)과 동일한 면적을 가지거나 그 보다 더 작은 면적을 가질 수 있다.
제2 패널 영역(120)은 제2 전면(120a)에 제2 표시부(122)를 포함할 수 있다. 제2 표시부(122)는 제2 전면(120a)과 동일한 면적을 가지거나 그 보다 더 작은 면적을 가질 수 있다.
제3 패널 영역(130)은 제3 전면(130a)과 제3 후면(130b)을 구비할 수 있다. 제3 전면(130a)은 제3 후면(130b)과 동일한 면적을 가지거나 그 보다 더 작은 면적을 가질 수 있다.
제3 패널 영역(130)은 제3 전면(130a)에 제3 표시부(132)를 포함할 수 있다. 제3 표시부(132)는 제3 전면(130a)과 동일한 면적을 가지거나 그 보다 더 작은 면적을 가질 수 있다.
제1 패널 영역(110), 제2 패널 영역(120), 및 제3 패널(130)은 도면에 표시하지는 않았지만, 각각 영상을 표시하는 표시 영역(Active Area; AA)과, 표시 영역에 신호를 공급하는 비표시 영역(Non-active Area; NA)을 포함할 수 있다.
제1 패널 영역(110)은 제1 표시부(112)를 포함할 수 있다. 제1 패널 영역(110)은 제1 표시부(112)와 면적이 동일하거나, 제1 표시부(112)의 면적보다 더 큰 면적을 가질 수 있다.
제2 패널 영역(120)은 제2 표시부(122)를 포함할 수 있다. 제2 패널 영역(120)은 제2 표시부(122)와 면적이 동일하거나, 제2 표시부(122)의 면적보다 더 큰 면적을 가질 수 있다.
제3 패널 영역(120)은 제3 표시부(132)를 포함할 수 있다. 제3 패널 영역(130)은 제3 표시부(132)와 면적이 동일하거나, 제3 표시부(132)의 면적보다 더 큰 면적을 가질 수 있다.
제1 패널 영역(110), 제2 패널 영역(120) 및 제3 패널 영역(130)은 전술한 바와 같이 동일한 크기와 면적을 가짐에 따라 그 내부의 구조도 동일하거나 유사하게 구성될 수 있다. 따라서, 제1 패널 영역(110), 제2 패널 영역(120) 및 제3 패널 영역(130)이 동일한 구조를 가지는 것으로 가정하고, 제3 패널 영역(130)을 예로 들어 설명하기로 한다.
제3 패널 영역(130)은 그 내부에 기판을 포함하고, 그 기판 위에 차광층과 버퍼층이 배치될 수 있다. 즉, 기판 위에 차광층, 그 차광층 위에 버퍼층이 배치될 수 있다.
기판은, 폴리메틸메타 아크릴레이트(PMMA:Polymethylmethacrylate), 염화비닐, 아크릴계 수지, 폴리카보네이트(PC:polycarbonate)계, 폴리에틸렌 테레프탈레이트(PET:polyethylene therephtalate)계, 폴리에틸렌 (PE:polyethylene)계, 폴리스티렌(PS:polystyryene)계, 폴리프로필렌(PP:Polyporpylene)계, 폴리이미드(PI:Polyimide)계 수지, 유리, 실리카(silica) 등으로 형성될 수 있다.
차광층은 외부의 빛이 유입되는 것을 차단하기 위하여, 차광 기능을 갖는 금속 재료로 형성될 수 있다. 차광층은 몰리브덴(Mo), 알루미늄(Al), 크롬(Cr), 텅스텐(W), 티타늄(Ti), 니켈(Ni), 네오디뮴(Nd) 및 구리(Cu) 등의 금속 중 어느 하나 또는 이들의 합금으로 이루어진 단일층 또는 복층 구조로 형성될 수 있다.
버퍼층은 기판의 상부와 차광층의 상부에 형성될 수 있다. 기판 상에서 차광층을 덮는 버퍼층은 기판으로부터 유입되는 수분, 산소 등을 포함하는 이물질을 차단하기 위하여, 단일 절연층 또는 복수의 절연층이 적층된 구조로 형성된다. 버퍼층은 산화 실리콘(SiOx), 질화 실리콘(SiNx), 산화 알루미늄(AlOx) 등과 같은 무기 절연 물질이 단층 또는 복층 구조로 형성될 수 있다.
제3 패널 영역(130)은 최상부층에 제3 표시부(132)가 배치될 수 있다.
제3 표시부(130)는 행마다 배치된 복수의 스캔 배선들(Scan Lines)과 열마다 배치된 복수의 데이터 배선들(Data Lines)이 교차하고, 각 교차점에 각 화소(Pixel)를 정의할 수 있다. 각 화소는 적어도 하나 이상의 서브 화소를 포함할 수 있다. 따라서, 각 교차점에 서브 화소들이 배치될 수 있다.
예를 들면, 제3 패널 영역(130)은 유기 기판 또는 플라스틱 기판 상에 복수의 스캔 배선들 및 복수의 데이터 배선들이 교차하여 형성되고, 스캔 배선 및 데이터 배선이 교차하는 지점에 각각 적색(Red), 녹색(Green) 및 청색(Blue)에 해당하는 서브 화소들이 정의될 수 있다. 하나 이상의 서브 화소를 포함하는 하나의 화소를 '단위 화소'라 칭할 수 있다.
이 때, 서브 화소들 각각은 유기전계 발광 다이오드(OLED)를 구비할 수 있다. 복수의 스캔 배선들은 복수의 서브 화소들에 행마다 배치될 수 있고, 복수의 데이터 배선들은 복수의 서브 화소들에 열마다 배치될 수 있다. 따라서, 복수의 서브 화소들은 발광 다이오드(OLED)가 행과 열로 배치될 수 있다.
여기서, 유기전계 발광 다이오드(OLED)는 간단히 '발광 다이오드(OLED)', '발광 다이오드(EL), '발광 소자(EL)', 'EL' 또는 'OLED'라 칭할 수 있다.
또한, 제3 패널 영역(130)의 제3 표시부(132)에는 데이터 배선과 평행한 방향으로 형성되는 전원선이 형성되어 각 서브 화소들과 연결될 수 있다.
또한, 도시하지는 않았지만 각 서브 화소들은 적어도 하나의 유기전계 발광다이오드, 캐패시터, 스위칭 박막트랜지스터 및 구동 박막트랜지스터를 포함할 수 있다. 구동 박막트랜지스터는 '구동 트랜지스터', '구동 스위치', '구동 소자' 등으로 칭할 수 있다.
여기서, 발광 다이오드(OLED)는 구동 박막트랜지스터의 게이트-소스 전극 사이의 전압에 따라 조절되는 전류량으로 발광한다. 발광 다이오드(OLED)의 애노드 전극은 고전위 전압 전원측에 연결되고, 캐소드 전극은 저전위 전압 전원측에 연결된다. 애노드 전극과 캐소드 전극 사이에는 유기 화합물층이 구비된다.
유기 화합물층은 정공 주입층(Hole Injection layer, HIL), 정공 수송층(Hole transport layer, HTL), 발광층(Emission layer, EML), 전자 수송층(Electron transport layer, ETL) 및 전자 주입층(Electron Injection layer, EIL)을 포함할 수 있으나 이에 한정되지 않는다. 예를 들어, 탠덤(Tandem) 구조에 따라 서로 다른 색을 발광하는 2개 이상의 유기 화합물층이 적층될 수도 있다. 발광 다이오드(OLED)에 전류가 흐를 때 정공 수송층(HTL)을 통과한 정공과 전자 수송층(ETL)을 통과한 전자가 발광층(EML)으로 이동하여 여기자가 형성되고, 그 결과 발광층(EML)이 가시광을 방출할 수 있다.
또한, 도시하지는 않았지만, 구동 박막트랜지스터 및 스위칭 박막트랜지스터들은 게이트 배선 및 제어신호 공급배선과 데이터 배선에 연결될 수 있다. 따라서, 게이트 배선에 입력되는 게이트 전압에 따라 스위칭 박막트랜지스터들이 도통되고, 동시에 데이터 배선에 입력되는 데이터 전압을 구동 박막트랜지스터로 전달한다. 캐패시터는 박막트랜지스터와 전원선 사이에 연결되며, 박막트랜지스터로부터 전송되는 데이터 전압으로 충전되어 1 프레임 동안 유지하게 된다.
박막트랜지스터는 PMOS형 LTPS(Low Temperature Poly Silicon) TFT로 구현될 수 있고, 이를 통해 원하는 응답 특성을 확보할 수 있다. 예를 들어, 박막트랜지스터들 중에서 적어도 하나의 트랜지스터는 턴-오프 때 누설 전류 특성이 좋은 NMOS형 또는 PMOS형 옥사이드(Oxide) TFT로 구현되고, 나머지 트랜지스터들은 응답 특성이 좋은 PMOS형 LTPS TFT로 구현될 수도 있다.
제1 패널 영역(110)은 제1 표시부(112)를 포함하고, 제2 패널 영역(120)은 제2 표시부(122)를 포함하며, 제3 패널 영역(130)은 제3 표시부(132)를 포함할 수 있다. 이때, 제1 표시부(112), 제2 표시부(122) 및 제3 표시부(132)는 모두 동일한 구조를 가질 수 있다. 제1 표시부(112)를 비롯하여 제2 표시부(122) 및 제3 표시부(132)에 대한 상세 구조는 이후에 설명하기로 한다.
제2 패널 영역(120)은 제1 패널 영역(110)과 경계에서 폴딩 상태일 때, 제2 후면(120b)이 제1 패널 영역(110)의 제1 후면(110b)과 마주보며 제1 패널 영역(110)에 대응할 수 있다.
제1 힌지 결합부(140)는 제1 패널 영역(110)의 일측단과 제2 패널 영역(120)의 타측단을 힌지 결합할 수 있다. 예를 들어, 도 1에서, 제1 패널 영역(110)의 좌측단이 제2 패널 영역(120)의 우측단과 제1 힌지 결합부(140)를 통하여 힌지 결합할 수 있다.
제3 패널 영역(130)은 제2 패널 영역(120)과 경계에서 폴딩 상태일 때, 제3 전면(130a)이 제2 패널 영역(120)의 제2 전면(120a)과 마주보며 제2 패널 영역(120)에 대응할 수 있다.
제2 힌지 결합부(150)는 제2 패널 영역(120)의 일측단과 제3 패널 영역(130)의 타측단을 힌지 결합할 수 있다. 예를 들어, 도 1에서, 제2 패널 영역(120)의 좌측단은 제3 패널 영역(130)의 우측단과 제2 힌지 결합부(150)를 통하여 힌지 결합할 수 있다.
제3 패널 영역(130)의 좌측단은 세로 폭과 동일한 폭으로 연장되어 외곽 바디(160)를 형성하거나, 외곽 바디(160)와 결합될 수 있다. 예를 들면, 외곽 바디(160)는 제3 패널 영역(130)의 세로 폭과 동일한 폭으로 제3 패널 영역(130)의 좌측단으로부터 연장되어 형성될 수 있다. 이때, 외곽 바디(160)는 제3 패널 영역(130)보다 더 큰 두께와 높이를 가질 수 있다.
도 1에서, 제1 패널 영역(110), 제2 패널 영역(120) 및 제3 패널 영역(130)은 연이어 일체로 형성될 수 있다. 즉, 제1 패널 영역(110)의 제1 표시부(112), 제2 패널 영역(120)의 제2 표시부(122) 및 제3 패널 영역(130)의 제3 표시부(132)는 모두 연이어 일체로 형성될 수 있다. 예를 들면, 제1 패널 영역(110)의 제1 전면(110a)에 형성된 제1 표시부(112)와 제2 패널 영역(120)의 제2 전면(120a)에 형성된 제2 표시부(122) 및 제3 패널 영역(130)의 제3 전면(130a)에 형성된 제3 표시부(132)는 모두 연이어 일체로 형성될 수 있다.
제1 패널 영역(110)과 제2 패널 영역(120)의 사이에는 제1 힌지 결합부(140)가 배치될 수 있다. 이에, 제1 패널 영역(110)과 제2 패널 영역(120)은 힌지 동작에 의해 폴딩되거나 언폴딩 될 수 있다.
따라서, 제1 표시부(112)와 제2 표시부(122)의 경계는 휘어져서 폴딩되거나 펼쳐져서 언폴딩 될 수 있다.
제2 패널 영역(120)과 제3 패널 영역(130)의 사이에는 제2 힌지 결합부(150)가 배치될 수 있다. 이에, 제2 패널 영역(120)과 제3 패널 영역(130)은 힌지 동작에 의해 폴딩되거나 언폴딩 될 수 있다.
따라서, 제2 표시부(122)와 제3 표시부(132)의 경계는 휘어져서 폴딩되거나 펼쳐져서 언폴딩 될 수 있다.
제1 패널 영역(110)과 제2 패널 영역(120) 및 제3 패널 영역(130)이 언폴딩 된 경우에, 제1 표시부(112), 제2 표시부(122) 및 제3 표시부(132)는 모두 연이어 일체로 형성되어 있으므로, 하나의 화면으로 동작할 수 있다.
이때, 하나의 화면에 표시될 영상은 3 개의 화면 영상으로 분할되어, 제1 화면 영상은 제1 표시부(112)에 표시되고, 제2 화면 영상은 제2 표시부(122)에 표시되며, 제3 화면 영상은 제3 표시부(132)에 표시될 수 있다.
외곽 바디(160)는 제3 패널 영역(130)보다 더 큰 두께와 높이를 가지므로, 제1 패널 영역(110)과 제2 패널 영역(120) 및 제3 패널 영역(130)이 언폴딩 된 경우에 손잡이 역할을 할 수 있다.
본 발명의 실시예에서는 외곽 바디(160)가 제3 패널 영역(130)으로부터 연장되어 형성되는 것으로 예시하였으나, 이에 한정되지 않고, 예컨대, 그 반대쪽에 위치하는 제1 패널 영역(110)으로부터 연장되어 형성되는 것으로도 실시할 수 있다.
외곽 바디(160)는, 제1 패널 영역(110)과 제2 패널 영역(120) 및 제3 패널 영역(130)이 폴딩 상태일 때, 제1 패널 영역(110)의 일측단과 제2 패널 영역(120)의 타측단 및 제1 힌지 결합부(140)를 감싸며 마주 보는 형상을 가질 수 있다.
외곽 바디(160)에는 투명 커버(170)가 삽입되는 삽입구(162)가 형성되고, 외곽 바디(160)의 내부에는 삽입구(162)로 삽입된 투명 커버(170)를 수용하기 위한 수용 공간(164)이 형성될 수 있다.
제1 패널 영역(110)과 제2 패널 영역(120) 및 제3 패널 영역(130)이 폴딩 상태일 때, 제일 하층부에 제3 패널 영역(130)이 위치하고, 제3 패널 영역(130) 위에 제2 패널 영역(120)이 위치하며, 제2 패널 영역(120) 위에 제1 패널 영역(110)이 위치할 수 있다.
제1 패널 영역(110)과 제2 패널 영역(120) 및 제3 패널 영역(130)이 폴딩 상태일 때, 제일 상층부에 제1 패널 영역(110)이 위치하고, 제1 패널 영역(110)의 상부에 투명 커버(170)가 위치할 수 있다.
투명 커버(170)는 제1 패널 영역(110)의 제1 전면(110a)을 덮도록 위치할 수 있다. 즉, 투명 커버(170)는 외곽 바디(160)의 삽입구(162)로부터 돌출되어 제1 패널 영역(110)의 상부에 배치된 제1 표시부(112)를 덮도록 위치할 수 있다.
외곽 바디(160)와 일체로 형성된 제3 패널 영역(130)의 하단부에는 투명 커버(170)를 이동시키기 위해 투명 커버(170)와 연결된 무빙 홀더(Moving Holder)(134)가 구비될 수 있다.
또한, 제3 패널 영역(130)의 하단부에는 무빙 홀더(134)의 이동 경로를 제공하는 무빙 레일(Moving Rail)(136)이 형성될 수 있다.
무빙 레일(136)은 무빙 홀더(134)의 일부가 삽입되는 홈(groove) 형태로 투명 커버(170)의 이동 거리만큼 길게 형성될 수 있다. 즉, 무빙 홀더(134)와 투명 커버(170)가 연결되어 있어, 무빙 홀더(134)가 이동하는 거리만큼 투명 커버(170)가 외곽 바디(160)의 삽입구(162)로부터 돌출되거나 삽입될 수 있다.
무빙 홀더(134)가 무빙 레일(136)을 따라 일측에서 타측으로 이동하는 경우에, 투명 커버(170)가 삽입구(162)로 삽입되어 수용 공간(164)에 위치할 수 있다. 예를 들어, 무빙 홀더(134)는 도 4와 같이, 무빙 레일(136)을 따라 좌측(단)에서 우측(단)으로 이동하는 경우, 투명 커버(170)가 외곽 바디(160)의 삽입구(162)로 삽입되어 수용 공간(164) 내에 위치하게 되는 것이다.
한편, 무빙 홀더(134)가 무빙 레일(136)을 따라 타측에서 일측으로 이동하는 경우에, 투명 커버(170)가 삽입구(162)로부터 돌출되어 제3 패널 영역(130)의 제3 전면(130a)을 덮을 수 있다. 예를 들어, 도 4와 같이 위치한 무빙 홀더(134)는 무빙 레일(136)을 따라 도 2와 같이 우측(단)에서 좌측(단)으로 이동하는 경우, 무빙 홀더(134)에 연결된 투명 커버(170)가 외곽 바디(160)의 삽입구(162)로부터 돌출되어 제1 패널 영역(110)의 제1 표시부(112)를 덮는 상태에 위치하게 되는 것이다.
외곽 바디(160)는, 터치 펜(Touch Pen)을 삽입시켜 보관하기 위한 보관 홀(166)을 구비할 수 있다. 즉, 외곽 바디(160)는 내부에 있는 수용 공간(164) 내에 터치 펜의 길이와 동일하거나 그 보다 더 긴 길이를 갖는 보관 홀(116)을 구비할 수 있다. 따라서, 사용자는 외곽 바디(160)의 보관 홀(166)에 구비된 터치 펜을 이용하여, 폴딩 시에 제1 표시부(112)의 화면 상에 또는 언폴딩 시에 제1 표시부(112) 내지 제3 표시부(132)가 이루는 화면 상에 터치 입력을 용이하게 실행할 수 있다.
도 6은 본 명세서의 실시예에 따른 표시 장치의 폴딩 시 전면부를 나타낸 구성도이고, 도 7은 본 명세서의 실시예에 따른 표시 장치의 폴딩 시 후면부를 나타낸 구성도이다.
도 6 및 도 7을 참조하면, 본 발명의 실시예에 따른 표시 장치(100)에서 외곽 바디(160)는 카메라(180), 스피커(182), 조명부(Flash Unit; 184) 및 조도계(186)를 포함할 수 있다.
카메라(180)는 외부 객체를 촬영하여 영상을 얻기 위한 것으로서, 렌즈 부분이 외곽 바디(160)의 관통홀을 통해 시인되도록 위치하고, 내부 회로는 외곽 바디(160)의 수용 공간(164) 내에 배치될 수 있다.
스피커(182)는 음향 출력을 위한 것으로서, 별도의 이어폰 잭을 삽입하기 위한 삽입홀을 포함할 수 있다.
조명부(184)는 조명을 출력하는 것으로서, 예컨대, 야간에 카메라(180)의 동작 시에 구동될 수 있다.
조도계(186)는 주변 밝기를 검출하는 것으로서, 예컨대, 조도 센서를 통해 주변 밝기를 검출하여, 야간인 경우에 카메라(180)의 작동시 자동으로 조명부(184)를 동작시킬 때 이용될 수 있다.
도 8은 본 명세서의 실시예에 따른 표시 장치에서 제3 패널 영역과 외곽 바디 간의 전기적 연결 관계를 나타낸 구성도이고, 도 9는 본 명세서의 실시예에 따른 표시 장치의 제3 패널 영역과 외곽 바디의 인쇄회로기판 간의 접촉 상태를 나타낸 구성도이다.
도 8 및 도 9를 참조하면, 본 발명의 실시예에 따른 표시 장치(100)의 외곽 바디(160)는 수용 공간(164) 내에 인쇄회로기판(PCB; 190)을 포함할 수 있다.
인쇄회로기판(190)은 외곽 바디(160)의 내부에 구비되고, 카메라(180), 스피커(182), 조명부(184) 및 조도계(186)와 전기적으로 연결될 수 있다.
인쇄회로기판(190)은 제3 패널 영역(130)의 제3 표시부(132)에 연성 인쇄회로기판(FPCB; 194)을 통하여 전기적으로 연결될 수 있다.
인쇄회로기판(PCB; 190)은 적어도 하나 이상의 컨택홀(Contact Hole; 192)이 형성될 수 있다. 인쇄회로기판(PCB)(190)은 적어도 하나 이상의 컨택홀(192)을 통하여 연성 인쇄회로기판(FPCB)(194)과 전기적으로 연결될 수 있다.
연성 인쇄회로기판(FPCB; 194)은 인쇄회로기판(PCB)(190)과 제3 패널 영역(130)을 연결시키거나 또는 인쇄회로기판(PCB)(190)과 제3 패널 영역(130)의 제3 표시부(132)를 전기적으로 연결시킬 수 있다.
연성 인쇄회로기판(194)은 일측이 제3 패널 영역(130)의 제3 표시부(132)에 전기적으로 접촉되고, 타측이 인쇄회로기판(PCB; 190)에 적어도 하나 이상의 컨택홀(192)을 통하여 전기적으로 접촉될 수 있다.
인쇄회로기판(PCB; 190)에는 카메라(180)를 관통시키는 관통홀이 형성될 수 있다. 외곽 바디(160)에도 카메라(180)가 시인되도록 하는 관통홀이 외측면에 형성될 수 있다. 따라서 카메라(180)는 외곽 바디(160)의 내부에 있는 수용 공간(164)에 위치하고, 관통홀을 통하여 인쇄회로기판(PCB; 190)을 관통하고, 외곽 바디(160)의 외측면의 관통홀을 통하여 외부로 시인될 수 있다.
도 10은 본 명세서의 실시예에 따른 표시 장치가 폴딩 상태일 때 영상을 디스플레이하는 예를 나타낸 도면이고, 도 11은 본 명세서의 실시예에 따른 표시 장치가 언폴딩 상태일 때 영상을 디스플레이하는 예를 나타낸 도면이다.
도 10을 참조하면, 본 발명의 실시예에 따른 표시 장치(100)는, 제1 패널 영역(110)과 제2 패널 영역(120) 및 제3 패널 영역(130)이 폴딩 상태일 때, 제3 패널 영역(130)이 최상부에 위치할 수 있다.
이때, 표시 장치(100)는 좌측단에 외곽 바디(160)가 위치하고, 우측에는 제3 패널 영역(130)이 위치할 수 있다.
따라서, 제3 패널 영역(130)은 제3 표시부(132)를 통하여 영상을 디스플레이 할 수 있다.
이때, 제3 표시부(132)에서 디스플레이되는 영상은, 가로와 세로의 크기에 따라 제3 표시부(132)의 면적에 대응하는 면적을 갖는 하나의 영상일 수 있다. 즉, 3 개의 화면 영상으로 분할되지 않은 하나의 화면 영상일 수 있다.
도 11을 참조하면, 표시 장치(100)는 제1 패널 영역(110)과 제2 패널 영역(120) 및 제3 패널 영역(130)이 언폴딩 상태일 때, 제1 표시부(112)와 제2 표시부(122) 및 제3 표시부(132)가 연이어 일체로 된 하나의 화면을 이룰 수 있다.
여기서, 하나의 화면은, 제1 표시부(112)의 가로 및 세로의 크기에 따른 제1 면적과, 제2 표시부(122)의 가로 및 세로의 크기에 따른 제2 면적 및 제3 표시부(132)의 가로 및 세로의 크기에 따른 제3 면적을 합한 면적을 갖는 화면일 수 있다.
이때, 제1 표시부(112)와 제2 표시부(122) 및 제3 표시부(132)를 통해 디스플레이되는 영상은, 각각 제1 면적에 대응하는 제1 영상과, 제2 면적에 대응하는 제2 영상 및 제3 면적에 대응하는 제3 영상으로 분할된 분할 영상들일 수 있다.
따라서, 표시 장치(100)는 제1 영상이 제1 표시부(112)에서 출력되고, 제2 영상이 제2 표시부(122)에서 출력되며, 제3 영상이 제3 표시부(132)에서 출력 됨으로써 하나의 영상으로 디스플레이 할 수 있다.
도 12는 본 명세서의 실시예에 따른 표시 장치에서 제3 패널 영역의 구성을 개략적으로 나타낸 구성도이고, 도 13은 임의의 화소 구성을 개략적으로 나타낸 구성도이다.
도 12를 참조하면, 본 발명의 실시예에 따른 제3 패널 영역(130)은, 표시 영역(AA)과, 표시 영역 이외의 비표시 영역(NA)을 포함할 수 있다.
이때, 제1 패널 영역(110) 및 제2 패널 영역(120)도 제3 패널 영역(130)과 동일한 구조를 가지며, 이하에서 설명하는 제3 패널 영역(130)의 구성들은 제1 패널 영역(110) 및 제2 패널 영역(120)에 동일하게 적용할 수 있다.
표시 영역(AA)은 행과 열로 배치된 복수의 서브 화소(Pixel; PX)들을 포함하는 제3 표시부(132)를 포함할 수 있다. 따라서 제1 패널 영역(110)의 표시 영역은 제1 표시부(112)를 포함하고, 제2 패널 영역(120)의 표시 영역은 제2 표시부(122)를 포함할 수 있다.
제3 표시부(132)는 복수의 스캔 배선들(Scan Lines; Scan #1 ~ Scan #n) 및 복수의 데이터 배선들(Data Lines; D1_1, D1_2 ~ Dn_1, Dn_2)이 교차하여 배치되고, 각 교차점에 각 서브 화소(PX)를 정의할 수 있다. 이 때, 각 서브 화소(PX)는 유기전계 발광 다이오드(OLED)를 구비할 수 있다.
예를 들면, 제3 표시부(132)는 유리 기판 또는 플라스틱 기판 상에 복수의 스캔 배선(Scan #1 ~ Scan #n) 및 복수의 데이터 배선(D1_1, D1_2 ~ Dn_1, Dn_2)이 교차하여 형성되고, 스캔 배선(Scan #1 ~ Scan #n) 및 데이터 배선(D1_1, D1_2 ~ Dn_1, Dn_2)이 교차하는 지점에 각각 적색(Red), 녹색(Green) 및 청색(Blue)에 해당하는 서브 화소(R, G, B)들이 정의될 수 있다.
복수의 스캔 배선들(Scan #1 ~ Scan #n)은, 도 13에 도시된 바와 같이 복수의 서브 화소들에 각 행마다 스캔 배선 1 개씩 배치될 수 있다.
복수의 데이터 배선들(D1_1, D1_2 ~ Dn_1, Dn_2)은, 도 13에 도시된 바와 같이 복수의 서브 화소들에 각 열마다 데이터 배선 2 개씩 배치될 수 있다.
각 배선들은 스캔 구동부(30) 및 데이터 구동부(40)와 연결될 수 있다. 또한, 제3 표시부(132)에는 데이터 배선들(D1_1, D1_2 ~ Dn_1, Dn_2)과 평행한 방향으로 전원전압 공급배선들(ELVDD, Vini, ELVSS)이 더 형성되어 각 서브 화소들과 연결될 수 있다.
임의의 서브 화소(PX)는 도 13에 도시된 바와 같이, 적어도 하나 이상의 서브 화소(R1, G1~G2, B1)를 포함할 수 있다. 하나의 서브 화소(G)는 적어도 하나 이상의 부 서브 화소(G1, G2)를 포함할 수 있다.
제3 표시부(132)는 각 행마다 1 개의 스캔 배선(Scan #1)이 배치되고, 각 열마다 2 개의 데이터 배선들, 예를 들어, 일 측(Left)의 데이터 배선(D1_1)과, 다른 측(Right)의 데이터 배선(D1_2)이 배치될 수 있다. 즉, 하나의 서브 화소(R1)는 1 개의 스캔 배선(Scan #1)과 2 개의 데이터 배선들(D1_1, D1_2)이 배치되는 것이다.
제3 표시부(132)는 각 열마다 배치된 2 개의 데이터 배선들 중 일 측(Left)의 데이터 배선(D1_1)을 선택하는 제1 먹스(MUX 1) 및 각 열마다 배치된 2 개의 데이터 배선들 중 다른 측(Right)의 데이터 배선(D1_2)을 선택하는 제2 먹스(MUX 2)를 포함할 수 있다.
제3 표시부(132)는 각 열마다 배치된 일 측(Left)의 데이터 배선(D1_1)과 각 행에 배치된 스캔 배선(Scan #1, Scan #2)을 스위칭 연결하는 제1 및 제2 스캔 스위치(T-Sc1, T-Sc2)와, 각 열마다 배치된 다른 측(Right)의 데이터 배선(D1_2)과 각 행에 배치된 스캔 배선(Scan #3, Scan #4)을 스위칭 연결하는 제3 및 제4 스캔 스위치(T-Sc3, T-Sc4)를 포함할 수 있다. 여기서, 제1 스캔 스위치(T-Sc1) 내지 제4 스캔 스위치(T-Sc4)는 예를 들면, 박막 트랜지스터(TFT)로 구현될 수 있다.
제1 및 제2 스캔 스위치(T-Sc1, T-Sc2)는 복수의 서브 화소들에서 일 측(Left)의 데이터 배선(D1_1)을 따라 수직 방향으로 연속된 2 개의 서브 화소들, 예를 들면, 적색의 제1 부 서브 화소(R1) 및 청색의 제1 부 서브 화소(B1)에 배치될 수 있다. 여기서, 일 측(Left)의 데이터 배선(D1_1)을 따라 수직 방향으로 연속된 2 개의 서브 화소들은 서로 다른 색상의 부 서브 화소(R1, B1)이거나, 서로 동일한 색상의 부 서브 화소(G3, G4)일 수 있다.
제3 및 제4 스캔 스위치(T-Sc3, T-Sc4)는 복수의 서브 화소들에서 다른 측(Right)의 데이터 배선(D1_2)을 따라 수직 방향으로 연속된 2 개의 서브 화소들, 예를 들면, 적색의 제2 부 서브 화소(R2) 및 청색의 제2 부 서브 화소(B2)에 배치될 수 있다. 여기서, 다른 측(Right)의 데이터 배선(D1_2)을 따라 수직 방향으로 연속된 2 개의 서브 화소들은 서로 다른 색상의 부 서브 화소(R2, B2)이거나, 서로 동일한 색상의 부 서브 화소(G1, G2)일 수 있다.
제1 및 제2 스캔 스위치(T-Sc1, T-Sc2)와 제3 및 제4 스캔 스위치(T-Sc3, T-Sc4)는 복수의 서브 화소에 대하여 수직 방향으로 2 행씩 좌측과 우측으로 서로 번갈아 가며 배치될 수 있다.
제1 먹스(MUX 1)는, 일 측(Left)의 데이터 배선(D1_1)에 제1 전극이 연결되고, 제1 선택 신호를 인가하기 위한 제1 먹스 배선(MUX 1)에 게이트 전극이 연결되며, 제1 전원(ELVDD)에 제2 전극이 연결되는 제1 먹스 스위치(T-MX1)를 포함할 수 있다.
제1 먹스 스위치(T-MX1)는, 제1 먹스 배선(MUX1)을 통해 게이트 전극으로 제1 선택 신호가 인가됨에 따라 턴 온(Turn On)되어, 제2 전극을 통해 인가된 제1 전원(ELVDD)을 제1 전극을 통해 일 측(Left)의 데이터 배선(D1_1)에 인가할 수 있다.
제2 먹스(MUX 2)는, 다른 측(Right)의 데이터 배선(D1_2)에 제1 전극이 연결되고, 제2 선택 신호를 인가하기 위한 제2 먹스 배선(MUX2)에 게이트 전극이 연결되며, 제1 전원에 제2 전극이 연결되는 제2 먹스 스위치(T-MX2)를 포함할 수 있다.
제2 먹스 스위치(T-MX2)는, 제2 먹스 배선(MUX2)을 통해 게이트 전극으로 제2 선택 신호가 인가됨에 따라 턴 온(Turn On)되어, 제2 전극을 통해 인가된 제1 전원(ELVDD)을 제1 전극을 통해 다른 측(Right)의 데이터 배선(D1_2)에 인가할 수 있다.
또한, 각 서브 화소들은 적어도 하나의 유기전계 발광다이오드(OLED), 캐패시터(Cst), 스위칭 박막트랜지스터(T1, T2) 및 구동 박막트랜지스터(Tdr)를 포함할 수 있다. 여기서, 유기전계 발광다이오드(OLED)는 제 1 전극(정공주입 전극)과 유기 화합물층 및 제 2 전극(전자주입 전극)으로 이루어질 수 있다.
유기 화합물층은 실제 발광이 이루어지는 발광층 이외에 정공 또는 전자의 캐리어를 발광층까지 효율적으로 전달하기 위한 다양한 유기층들을 더 포함할 수 있다. 이러한 유기층들은 제 1 전극과 발광층 사이에 위치하는 정공 주입층 및 정공 수송층, 제 2 전극과 발광층 사이에 위치하는 전자 주입층 및 전자 수송층일 수 있다.
비표시 영역(NA)은 제3 표시부(132)의 이면 내부에 위치할 수 있으며, 휘도 제어부(10), 스캔 구동부(30), 데이터 구동부(40), 발광 제어부(50), 전원부(60) 및 타이밍 제어부(70)를 포함할 수 있다.
휘도 제어부(10)는 복수의 감마 데이터들을 각각 포함하는 복수의 감마 세트들 중에서 선택되는 하나의 감마 세트를 데이터 구동부(40)에 제공하고, 선택된 감마 세트에 대응하는 디밍 데이터를 발광 제어부(50)에 제공할 수 있다.
스캔 구동부(30)는 복수의 스캔 배선들(Scan #1 ~ Scan #n)에 스캔 신호를 인가할 수 있다. 예를 들면, 스캔 구동부(30)는 게이트 제어 신호(GCS)에 대응하여 각 서브 화소들에 게이트 전압을 하나의 수평선 단위씩 순차적으로 인가할 수 있다. 이러한 스캔 구동부(30)는 1 수평 기간(H)마다 하이레벨의 게이트 전압을 순차적으로 출력하는 다수의 스테이지를 갖는 쉬프트 레지스터로 구현될 수 있다.
데이터 구동부(40)는 복수의 데이터 배선들(D1_1, D1_2 ~ Dn_1, Dn_2)에 데이터 신호를 인가할 수 있다. 예를 들면, 데이터 구동부(40)는 타이밍 제어부(70)로부터 인가되는 디지털 파형의 영상 신호를 입력받아 각 서브 화소가 처리할 수 있는 계조값을 갖는 아날로그 전압 형태의 데이터 전압으로 변환하고, 또한 입력되는 데이터 제어 신호(DCS)에 대응하여 데이터 배선들(D1_1, D1_2 ~ Dn_1, Dn_2)을 통해 각 서브 화소에 데이터 전압을 공급할 수 있다. 여기서, 데이터 구동부(40)는 기준전압 공급부(미도시)로부터 공급되는 다수의 기준전압을 이용하여 영상 신호를 데이터 전압으로 변환할 수 있다.
또한, 데이터 구동부(40)는, 30Hz 구동 모드 시의 저전위 전압(ELVSS) 및 초기화 전압(Vini)과, 60Hz 구동 모드 시의 저전위 전압(ELVSS) 및 초기화 전압(Vini)을 서로 다른 값으로 표시패널(120)에 인가할 수 있다. 예를 들면, 데이터 구동부(40)는 30Hz 구동 모드 시에는 서로 동일한 값을 갖는 저전위 전압(ELVSS)과 초기화 전압(Vini)을 표시 패널(20)에 제공할 수 있다. 그러나, 데이터 구동부(40)는 60Hz 구동 모드 시에는 60Hz 구동 모드 시의 저전위 전압(ELVSS) 및 초기화 전압(Vini)과 서로 다른 값을 갖는 저전위 전압(ELVSS)과 초기화 전압(Vini)을 표시 패널(20)에 제공할 수 있다. 예를 들면, 데이터 구동부(40)는 60Hz 구동 모드 시에 저전위 전압(ELVSS)과 초기화 전압(Vini)의 차이가 일정 기준 이상이 되는 저전위 전압(ELVSS)과 초기화 전압(Vini)을 제3 표시부(132)에 제공할 수 있다.
또한, 데이터 구동부(40)는, 휘도 제어부(10)로부터 선택된 하나의 감마 세트를 제공받으면, 룩업 테이블(look-up Table)에 근거하여 선택된 하나의 감마 세트에 대응하는 저전위 전압(ELVSS) 및 초기화 전압(Vini)을 제3 표시부(132)에 제공할 수 있다.
발광 제어부(50)는 발광 제어 신호(EM #1 ~ EM #n)를 복수의 서브 화소들에 인가할 수 있다.
전원부(60)는 고전위 전압(ELVDD), 저전위 전압(ELVSS) 및 초기화 전압(Vini)을 각 서브 화소들에 제공할 수 있다.
타이밍 제어부(70)는 스캔 구동부(30) 및 데이터 구동부(40)를 제어할 수 있다. 예를 들면, 타이밍 제어부(70)는 외부로부터 인가되는 영상 신호와, 클럭 신호, 수직 및 수평 동기신호 등의 타이밍 신호를 인가받아, 게이트 제어 신호(GCS) 및 데이터 제어 신호(DCS)를 생성하여 스캔 구동부(30) 및 데이터 구동부(40)에 제공할 수 있다.
여기서, 수평 동기신호는 화면의 한 라인을 표시하는 데 걸리는 시간을 나타내고, 수직 동기신호는 한 프레임의 화면을 표시하는 데 걸리는 시간을 나타낸다. 또한, 클록 신호는 게이트 및 각 구동부의 제어신호의 생성 기준이 되는 신호이다.
한편, 타이밍 제어부(70)는 외부의 시스템과 소정의 인터페이스를 통해 연결되어 그로부터 출력되는 영상 관련 신호와 타이밍 신호를 잡음 없이 고속으로 수신할 수 있다. 이러한 인터페이스로는 LVDS(Low Voltage Differential Signal) 방식 또는 TTL(Transistor-Transistor Logic) 인터페이스 방식 등이 이용될 수 있다.
도 14는 본 발명의 실시예에 따른 제3 패널 영역에서 하나의 서브 화소에 대한 회로 구성 예를 나타낸 회로도이다.
도 14를 참조하면, 본 발명의 실시예에 따른 제3 패널 영역(130)의 제3 표시부(132)에서, 하나의 서브 화소(PX)는 다수의 박막트랜지스터(T1~T6), 유기전계 발광 다이오드(OLED), 구동 박막트랜지스터(Tdr) 및 내부 보상 회로를 포함할 수 있다.
여기서, 유기전계 발광 다이오드(OLED)는 간단히 '발광 다이오드(OLED)', '발광 다이오드(EL), '발광 소자(EL)', 'EL' 또는 'OLED'로 표기할 수 있다. 또한, 구동 박막트랜지스터(Tdr)는 '구동 트랜지스터(Tdr)', '구동 스위치(Tdr)' 등으로 표기할 수 있다.
서브 화소(PX)에 포함되는 박막트랜지스터들(T1~T6, Tdr)은 PMOS형 LTPS(Low Temperature Poly Silicon) TFT로 구현될 수 있고, 이를 통해 원하는 응답 특성을 확보할 수 있다. 예를 들어, 박막트랜지스터들(T1~T6) 중에서 적어도 하나의 트랜지스터는 턴-오프 때 누설 전류 특성이 좋은 NMOS형 또는 PMOS형 옥사이드(Oxide) TFT로 구현되고, 나머지 트랜지스터들은 응답 특성이 좋은 PMOS형 LTPS TFT로 구현될 수도 있다.
OLED는 구동 박막트랜지스터(Tdr)의 게이트-소스 사이의 전압(Vgs)에 따라 조절되는 전류량으로 발광한다. OLED의 애노드 전극은 노드 P8에 연결되고, OLED의 캐소드 전극은 저전위 전원 전압(ELVSS)에 연결된다. 애노드 전극과 캐소드 전극 사이에는 유기 화합물층이 구비된다.
유기 화합물층은 정공 주입층(Hole Injection layer, HIL), 정공 수송층(Hole transport layer, HTL), 발광층(Emission layer, EML), 전자 수송층(Electron transport layer, ETL) 및 전자 주입층(Electron Injection layer, EIL)을 포함할 수 있으나 이에 한정되지 않는다. 예를 들어, 탠덤(Tandem) 구조에 따라 서로 다른 색을 발광하는 2개 이상의 유기 화합물층이 적층될 수도 있다. 발광 다이오드(OLED)에 전류가 흐를 때 정공 수송층(HTL)을 통과한 정공과 전자 수송층(ETL)을 통과한 전자가 발광층(EML)으로 이동하여 여기자가 형성되고, 그 결과 발광층(EML)이 가시광을 방출할 수 있다.
구동 박막트랜지스터(Tdr)는 게이트 전극과 소스 전극 사이의 전압(Vgs)에 따라 OLED에 흐르는 전류를 조절하는 구동 소자이다. 구동 박막트랜지스터(Tdr)는, 게이트 전극이 노드 P5에 접속되고, 제1 전극과 제2 전극 중 하나는 노드 P2에 연결되고 다른 하나는 노드 P6에 연결될 수 있다. 구동 트랜지스터(Tdr)의 게이트 전극과 소스 전극 사이의 전압(Vgs)은 노드 P5와 노드 P6 사이에 걸리는 전압이다.
또한, 노드 P5와 노드 P6 사이에는 n번째 제1 스캔 신호(S1(n))에 의해 구동되는 제1 박막트랜지스터(T1)가 연결될 수 있다. 즉, 제1 박막트랜지스터(T1)는 제1 전극과 제2 전극 중 하나는 노드 P5에 연결되고 다른 하나는 노드 P6에 연결되며, 게이트 전극은 n번째 제1 스캔 신호(S1(n))를 인가받기 위한 배선이 연결될 수 있다.
또한, 노드 P2에는 데이터 배선(Vdata)에 연결된 제2 박막트랜지스터(T2)가 연결될 수 있다. 즉, 제2 박막트랜지스터(T2)는 제1 전극과 제2 전극 중 하나는 데이터 배선(Vdata)에 연결되고(P1), 다른 하나는 노드 P2에 연결되며, 게이트 전극은 n번째 제1 스캔 신호(S1(n))를 인가받기 위한 배선이 연결될 수 있다.
따라서, 제1 박막트랜지스터(T1) 및 제2 박막트랜지스터(T2)는 n번째 제1 스캔 신호(S1(n))에 의해 스위칭 턴 온(Turn On) 된다.
또한, 구동 트랜지스터(Tdr)의 게이트 전극은 스토리지 캐패시터(Cst)의 일 전극(P4)에 연결될 수 있다. 스토리지 캐패시터(Cst)의 다른 전극(P3)은 제1 전원인 고전위 전원(VDD)이 연결될 수 있다.
또한, 구동 트랜지스터(Tdr)의 제1 전극(P2)과 스토리지 캐패시터(Cst)의 다른 전극(P3) 사이에 제3 박막트랜지스터(T3)가 연결될 수 있다. 즉, 제3 박막트랜지스터(T3)는 제1 전극과 제2 전극 중 하나는 노드 P2에 연결되고, 다른 하나는 노드 P3에 연결되며, 게이트 전극은 발광 제어 신호(EM)를 인가받기 위한 배선이 연결될 수 있다.
또한, 구동 트랜지스터(Tdr)의 제2 전극(P6)과 OLED의 애노드 전극(P8) 사이에는 제4 박막트랜지스터(T4)가 연결될 수 있다. 즉, 제4 박막트랜지스터(T4)는 제1 전극과 제2 전극 중 하나는 노드 P6에 연결되고, 다른 하나는 노드 P8에 연결되며, 게이트 전극은 발광 제어 신호(EM)를 인가받기 위한 배선이 연결될 수 있다.
따라서, 제3 박막트랜지스터(T3) 및 제4 박막트랜지스터(T4)는 발광 제어 신호(EM)에 의해 스위칭 턴 온(Turn On) 된다.
또한, 스토리지 캐패시터(Cst)의 일 전극(P4)에는 제5 박막트랜지스터(T5)가 연결될 수 있다. 즉, 제5 박막트랜지스터(T5)는 제1 전극과 제2 전극 중 하나는 노드 P4에 연결되고, 다른 하나는 제1 초기화 전압 라인(Vini1)에 연결되며, 게이트 전극(P9)은 n-4번째 제2 스캔 신호(S2(n-4))가 인가되는 배선이 연결될 수 있다.
또한, OLED의 애노드 전극(P8)에는 제6 박막트랜지스터(T6)가 연결될 수 있다. 즉, 제6 박막트랜지스터(T6)는 제1 전극과 제2 전극 중 하나는 노드 P8에 연결되고, 다른 하나는 제2 초기화 전압 라인(Vini2)에 연결되며, 게이트 전극은 n-4번째 제2 스캔 신호(S2(n-4))가 인가되는 배선이 연결될 수 있다.
보상 회로는 구동 트랜지스터(Tdr)의 문턱 전압 변화를 보상하기 위해 게이트-소스 사이의 전압(Vgs)을 샘플링 하기 위한 것으로, 제1 내지 제6 박막트랜지스터들(T1~T6)과 스토리지 커패시터(Cst)를 포함하여 구성될 수 있다.
구동 트랜지스터(Tdr)는 데이터 신호(Vdata)에 기초하여 발광 다이오드(OLED)를 흐르는 전류를 조절할 수 있다. 이 때, 전류의 크기에 따라 OLED의 휘도가 조절될 수 있다. 발광 제어 트랜지스터인 제3 및 제4 박막트랜지스터(T3, T4)는 구동 트랜지스터(Tdr) 및 발광 다이오드(OLED)와 연결되어 OLED의 발광을 제어할 수 있다.
구체적으로, 발광 제어 라인으로부터 공급되는 발광 제어 신호(EM)에 응답하여, 발광 제어 트랜지스터인 제3 및 제4 박막트랜지스터(T3, T4)가 턴-온되면 구동 트랜지스터(Tdr)에 흐르는 전류가 OLED로 전달되어 OLED가 발광할 수 있고, 제3 및 제4 박막트랜지스터(T3, T4)가 턴-오프되면 구동 트랜지스터(Tdr)에 흐르는 전류가 OLED로 전달되지 않아 OLED가 발광하지 않을 수 있다.
이와 같이, 구동 트랜지스터(Tdr)에서 공급되는 전류의 크기 및 발광 제어 트랜지스터(T3, T4)가 턴-온 되는 시간에 의해 표시 장치의 휘도가 결정될 수 있다.
도 15는 본 명세서의 실시예에 따른 제3 패널 영역의 인터레이스 방식 구동 타이밍도를 나타낸 도면이다.
도 12 내지 도 15를 참조하면, 본 명세서의 실시예에 따른 제3 패널 영역(130)은, 인터레이스 방식으로 동작 시에, 하나의 프레임(Frame)에 대하여, 제1 하프 프레임(First Half Frmae)과 제2 하프 프레임(Second Half Frame)으로 구분하고, 제1 하프 프레임 동안 홀수(Odd) 번째 행에 위치한 부 서브 화소들(R1, R2)을 동작하고, 제2 하프 프레임 동안 짝수(Even) 번째 행에 위치한 부 서브 화소들(B1, B2)을 동작한다.
즉, 제3 패널 영역(130)은 하나의 프레임에서 제1 하프 프레임 동안 홀수(Odd) 프레임으로 동작하고, 제2 하프 프레임 동안 짝수(Even) 프레임으로 동작하는 것이다.
예를 들면, 제1 하프 프레임 동안, 제1 먹스(MUX1)는 로우(Low) 신호에 의해 스위칭 온(ON) 되고, 제2 먹스(MUX2)는 하이(High) 신호에 의해 스위칭 오프(OFF) 된다. 일 측(Left)의 데이터 배선(D1_1) 및 다른 측(Right)의 데이터 배선(D1_2)에는 모두 로우(Low) 신호가 인가된다. 이때, n-1번째 제1 스캔 신호(Scan #1)는 2 수평 기간(2H) 동안 로우(Low) 신호로 스캔 배선에 인가된다. 이에, 제1 스캔 스위치(T-Sc1)가 턴 온 되어, 일 측(Left)의 데이터 배선(D1_1)으로부터 로우(Low) 신호가 홀수 번째 제1행에 위치한 적색의 제1 부 서브 화소(R1)에 인가된다. 따라서, 홀수 번째 제1행에 위치한 적색의 제1 부 서브 화소(R1)가 발광 구동된다.
이어, 제1 먹스(MUX1)는 하이(High) 신호에 의해 스위칭 오프(OFF)되고, 제2 먹스(MUX2)는 로우(Low) 신호에 의해 스위칭 온(ON) 된다. 일 측(Left)의 데이터 배선(D1_1) 및 다른 측(Right)의 데이터 배선(D1_2)에는 모두 로우(Low) 신호가 인가된다. 이때, n번째 제3 스캔 신호(Scan #3)는 2 수평 기간(2H) 동안 로우(Low) 신호로 스캔 배선에 인가된다. 이에, 제3 스캔 스위치(T-Sc3)가 턴 온 되어, 다른 측(Right)의 데이터 배선(D1_2)으로부터 로우(Low) 신호가 홀수 번째 제3행에 위치한 적색의 제2 부 서브 화소(R2)에 인가된다. 따라서, 홀수 번째 제3행에 위치한 적색의 제2 부 서브 화소(R2)가 발광 구동된다.
여기서, n-1번째 제1 스캔 신호(Scan #1)는 처음 2 수평 기간(2H) 동안 로우 레벨 상태이고, n번째 제3 스캔 신호(Scan #3)는 제2 먹스(MUX2)가 하이 신호에서 로우 신호로 전환될 때 2 수평 기간(2H) 동안 로우 레벨 상태이다. 즉, 제1 부 서브 화소(R1)에서 제2 부 서브 화소(R2)로 전환될 때에 n-1번째 제1 스캔 신호(Scan #1)의 로우 신호와 n번째 제3 스캔 신호(Scan #3)의 로우 신호는 1 수평 기간(1H) 동안 중첩하는 것이다. 따라서, 제1 부 서브 화소(R1)에서 제2 부 서브 화소(R2)로 전환될 때에 플리커 현상이 발생되지 않는다.
한편, 제2 하프 프레임 동안, 제1 먹스(MUX1)는 로우(Low) 신호에 의해 스위칭 온(ON) 되고, 제2 먹스(MUX2)는 하이(High) 신호에 의해 스위칭 오프(OFF) 된다. 일 측(Left)의 데이터 배선(D1_1) 및 다른 측(Right)의 데이터 배선(D1_2)에는 모두 로우(Low) 신호가 인가된다. 이때, n+1번째 제2 스캔 신호(Scan #2)는 2 수평 기간(2H) 동안 로우(Low) 신호로 스캔 배선에 인가된다. 이에, 제2 스캔 스위치(T-Sc2)가 턴 온 되어, 일 측(Left)의 데이터 배선(D1_1)으로부터 로우(Low) 신호가 짝수 번째 제2행에 위치한 청색의 제1 부 서브 화소(B1)에 인가된다. 따라서, 짝수 번째 제2행에 위치한 청색의 제1 부 서브 화소(B1)가 발광 구동된다.
이어, 제1 먹스(MUX1)는 하이(High) 신호에 의해 스위칭 오프(OFF)되고, 제2 먹스(MUX2)는 로우(Low) 신호에 의해 스위칭 온(ON) 된다. 일 측(Left)의 데이터 배선(D1_1) 및 다른 측(Right)의 데이터 배선(D1_2)에는 모두 로우(Low) 신호가 인가된다. 이때, n+2번째 제4 스캔 신호(Scan #4)는 2 수평 기간(2H) 동안 로우(Low) 신호로 스캔 배선에 인가된다. 이에, 제4 스캔 스위치(T-Sc4)가 턴 온 되어, 다른 측(Right)의 데이터 배선(D1_2)으로부터 로우(Low) 신호가 짝수 번째 제4행에 위치한 적색의 제2 부 서브 화소(B2)에 인가된다. 따라서, 짝수 번째 제4행에 위치한 적색의 제2 부 서브 화소(B2)가 발광 구동된다.
이때, n+1번째 제2 스캔 신호(Scan #2)는 2 수평 기간(2H) 동안 로우 레벨 상태이고, n+2번째 제4 스캔 신호(Scan #4)는 제2 먹스(MUX2)가 하이 신호에서 로우 신호로 전환될 때 2 수평 기간(2H) 동안 로우 레벨 상태이다. 즉, 청색(B)의 제1 부 서브 화소(B1)에서 제2 부 서브 화소(B2)로 전환될 때에 n+1번째 제2 스캔 신호(Scan #2)와 n+2번째 제4 스캔 신호(Scan #4)는 로우 신호로 1 수평 기간(1H) 동안 중첩하는 것이다. 따라서, 청색(B)의 제1 부 서브 화소(B1)에서 제2 부 서브 화소(B2)로 전환될 때에 플리커 현상이 발생되지 않는다.
전술한 바와 같이, 본 명세서의 실시예에 따른 제3 패널 영역(130)은, 인터레이스 방식으로 동작 시에, 하나의 서브 화소에서 다른 서브 화소로 구동이 전환될 때에 플리커 현상이 발생되지 않음을 알 수 있다.
도 16은 본 명세서의 실시예에 따른 제3 패널 영역의 프로그레시브 방식 구동 타이밍도를 나타낸 도면이다.
도 12 내지 도 14 및 도 16을 참조하면, 본 명세서의 실시예에 따른 제3 패널 영역(130)은, 프로그레시브 방식으로 동작 시에, 하나의 프레임 동안에 또는 하나의 하프(1/2) 프레임 동안에, 먼저 제1 스캔 신호(Scan #1)에 의해 제1 서브 화소(R)의 제1 부 서브 화소(R1)가 동작하고, 두번째로 제3 스캔 신호(Scan #3)에 의해 제1 서브 화소(R)의 제2 부 서브 화소(R2)가 동작하고, 세번째로 제2 스캔 신호(Scan #2)에 의해 제3 서브 화소(B)의 제1 부 서브 화소(B1)가 동작하고, 네번째로 제4 스캔 신호(Scan #4)에 의해 제3 서브 화소(B)의 제2 부 서브 화소(B2)가 동작한다.
즉, 본 명세서의 실시예에 따른 제3 패널 영역(130)은, 프로그레시브 방식으로 구동되는 경우, 하나의 프레임 동안 또는 하나의 하프 프레임 동안, 복수의 서브 화소에서 4행 단위로 데이터 신호가 인가되되, 먼저 제1 행(Scan #1)의 화소들로 데이터 신호가 인가되고, 다음으로 제3 행(Scan #3)의 화소들로 데이터 신호가 인가되고, 다음으로 제2 행(Scan #2)의 화소들로 데이터 신호가 인가되고, 다음으로 제4 행(Scan #4)의 화소들로 데이터 신호가 인가되는 것이다.
예를 들면, 처음 하프(1/2) 프레임 동안, 제1 먹스(MUX1)는 로우(Low) 신호에 의해 스위칭 온(ON) 되고, 제2 먹스(MUX2)는 하이(High) 신호에 의해 스위칭 오프(OFF) 된다. 일 측(Left)의 데이터 배선(D1_1)에는 로우(Low) 신호가 인가되고, 다른 측(Right)의 데이터 배선(D1_2)에는 하이(High) 신호가 인가된다. 이때, n-2번째 제1 스캔 신호(Scan #1)는 2 수평 기간(2H) 동안 로우(Low) 신호로 스캔 배선에 인가된다. 이에, 제1 스캔 스위치(T-Sc1)가 턴 온 되어, 일 측(Left)의 데이터 배선(D1_1)으로부터 로우(Low) 신호가 2 수평 기간(2H) 동안 제1 서브 화소(R)의 제1 부 서브 화소(R1)에 인가된다. 따라서, 제1 스캔 라인에 연결된 제1 서브 화소(R)의 제1 부 서브 화소(R1)가 발광 구동된다.
이어, 제1 먹스(MUX1)는 하이(High) 신호에 의해 스위칭 오프(OFF)되고, 제2 먹스(MUX2)는 로우(Low) 신호에 의해 스위칭 온(ON) 된다. 일 측(Left)의 데이터 배선(D1_1) 및 다른 측(Right)의 데이터 배선(D1_2)에는 모두 로우(Low) 신호가 인가된다. 이때, n-1번째 제3 스캔 신호(Scan #3)는 2 수평 기간(2H) 동안 로우(Low) 신호로 스캔 배선에 인가된다. 이에, 제3 스캔 스위치(T-Sc3)가 턴 온 되어, 다른 측(Right)의 데이터 배선(D1_2)으로부터 로우(Low) 신호가 2 수평 기간(2H) 동안 제1 서브 화소(R)의 제2 부 서브 화소(R2)에 인가된다. 따라서, 제3 스캔 라인에 연결된 제1 서브 화소(R)의 제2 부 서브 화소(R2)가 발광 구동된다.
두번째 하프(1/2) 프레임 동안, 제1 먹스(MUX1)는 로우(Low) 신호에 의해 스위칭 온(ON) 되고, 제2 먹스(MUX2)는 하이(High) 신호에 의해 스위칭 오프(OFF) 된다. 일 측(Left)의 데이터 배선(D1_1)에는 하이(High) 신호가 인가되고, 다른 측(Right)의 데이터 배선(D1_2)에는 로우(Low) 신호가 인가된다. 이때, n번째 제2 스캔 신호(Scan #2)는 2 수평 기간(2H) 동안 로우(Low) 신호로 스캔 배선에 인가된다. 이에, 제2 스캔 스위치(T-Sc2)가 턴 온 되어, 일 측(Left)의 데이터 배선(D1_1)으로부터 로우(Low) 신호가 2 수평 기간(2H) 동안 제3 서브 화소(B)의 제1 부 서브 화소(B1)에 인가된다. 따라서, 제2 스캔 라인에 연결된 제3 서브 화소(B)의 제1 부 서브 화소(B1)가 발광 구동된다.
이어, 제1 먹스(MUX1)는 하이(High) 신호에 의해 스위칭 오프(OFF)되고, 제2 먹스(MUX2)는 로우(Low) 신호에 의해 스위칭 온(ON) 된다. 일 측(Left)의 데이터 배선(D1_1) 및 다른 측(Right)의 데이터 배선(D1_2)에는 모두 하이(high) 신호가 인가된다. 이때, n+1번째 제4 스캔 신호(Scan #4)는 두 수평 기간(2H) 동안 로우(Low) 신호로 스캔 배선에 인가된다. 이에, 제4 스캔 스위치(T-Sc4)가 턴 온 되어, 다른 측(Right)의 데이터 배선(D1_2)으로부터 로우(Low) 신호가 두 수평 기간(2H) 동안 제3 서브 화소(B)의 제2 부 서브 화소(B2)에 인가된다. 따라서, 제4 스캔 라인에 연결된 제3 서브 화소(B)의 제2 부 서브 화소(B2)가 발광 구동된다.
여기서, n-2번째 제1 스캔 신호(Scan #1)는 2 수평 기간(2H) 동안 로우 레벨 상태이고, n-1번째 제3 스캔 신호(Scan #3)는 제2 먹스(MUX2)가 하이 신호에서 로우 신호로 전환될 때부터 2 수평 기간(2H) 동안 로우 레벨 상태이다. 즉, 제1 서브 화소(R)의 제1 부 서브 화소(R1)에서 제2 부 서브 화소(R2)로 전환될 때에 2 수평 기간(2H) 동안 n-2번째 제1 스캔 신호(Scan #1)의 로우 신호와 n-1번째 제3 스캔 신호(Scan #3)의 로우 신호는 1 수평 기간(1H) 동안 중첩하는 것이다. 따라서, 제1 부 서브 화소(R1)에서 제2 부 서브 화소(R2)로 전환될 때에 플리커 현상이 발생되지 않는다.
또한, 제3 서브 화소(B)에서 제1 부 서브 화소(B1)에서 제2 부 서브 화소(B2)로 구동이 전환될 때에도, 1 수평 기간(1H) 동안 n번째 제2 스캔 신호(Scan #2)의 로우 신호와 n+1번째 제4 스캔 신호(Scan #4)의 로우 신호는 중첩한다. 따라서, 제3 서브 화소(B)의 제1 부 서브 화소(B1)에서 제2 부 서브 화소(B2)로 전환될 때에도 플리커 현상이 발생되지 않는다.
전술한 바와 같이, 본 명세서의 실시예에 따른 제3 패널 영역(130)은, 프로그레시브 방식으로 동작 시에도 하나의 서브 화소에서 다른 서브 화소로 구동이 전환될 때에 플리커 현상이 발생되지 않음을 알 수 있다.
전술한 바와 같이, 본 명세서의 실시예에 따르면, 행과 열로 배치된 복수의 서브 화소들에 행마다 게이트 배선이 1 개씩 배치되고, 열마다 데이터 배선이 2 개씩 배치되며, 2 개의 데이터 배선들 중 제1 먹스(MUX1)를 통해 일측의 데이터 배선(D1_1)을 선택하고, 제2 먹스(MUX2)를 통해 다른측의 데이터 배선(D1_2)을 선택할 수 있는 표시 패널(20)을 제공할 수 있다.
또한, 본 명세서의 실시예에 따르면, 전술한 구성의 표시 패널(20)을 포함하고, 각 열마다 제1 및 제2 스캔 스위치를 통해 일 측의 데이터 배선과 각 행에 배치된 게이트 배선을 스위칭 연결하고, 각 열마다 제3 및 제4 스캔 스위치를 통해 다른 측의 데이터 배선과 각 행에 배치된 게이트 배선을 스위칭 연결하며, 제1 및 제2 스캔 스위치와 상기 제3 및 제4 스캔 스위치는, 복수의 서브 화소에서 2 행씩 서로 번갈아 가며 배치되고, 스캔 구동부를 통해 복수의 게이트 배선에 스캔 신호를 인가하고, 데이터 구동부를 통해 복수의 데이터 배선에 데이터 신호를 인가하며, 타이밍 제어부를 통해 스캔 구동부 및 데이터 구동부를 제어할 수 있는 표시 장치(100)를 제공할 수 있다.
전술한 바와 같이 본 발명에 의하면, 표시 패널이 저속 모드(30Hz)로 구동될 경우에 홀수(Odd) 프레임과 짝수(Even) 프레임으로 나누어 각각 데이터 전압이 인가되도록 하는 인터레이스 방식으로 구동되고, 고속 모드(60~120Hz)로 구동될 경우에 4행씩 스캔하되, 제1행 다음 제3행, 그 다음 제2행, 그 다음 제4행으로 스캔하여 데이터 전압이 인가되는 프로그레시브 방식으로 구동되도록 하는 표시 장치를 제공할 수 있다.
이상과 같이 본 발명에 대해서 예시한 도면을 참조로 하여 설명하였으나, 본 명세서에 개시된 실시 예와 도면에 의해 본 발명이 한정되는 것은 아니며, 본 발명의 기술사상의 범위 내에서 통상의 기술자에 의해 다양한 변형이 이루어질 수 있음은 자명하다. 아울러 앞서 본 발명의 실시 예를 설명하면서 본 발명의 구성에 따른 작용 효과를 명시적으로 기재하여 설명하지 않았을 지라도, 해당 구성에 의해 예측 가능한 효과 또한 인정되어야 함은 당연하다.
10 : 휘도 제어부 OLED : 발광 다이오드
30 : 스캔 구동부 40 : 데이터 구동부
50 : 발광 제어부 60 : 전원부
70 : 타이밍 제어부 100 : 표시 장치
110 : 제1 패널 영역 110a : 제1 전면
110b : 제1 후면 112 : 제1 표시부
120 : 제2 패널 영역 120a : 제2 전면
120b : 제2 후면 122 : 제2 표시부
130 : 제3 패널 영역 130a : 제3 전면
130b : 제3 후면 132 : 제3 표시부
134 : 무빙 홀더 136 : 무빙 레일
140 : 제1 힌지 결합부 150 : 제2 힌지 결합부
160 : 외곽 바디 162 : 삽입구
164 : 수용 공간 166 : 보관 홀
170 : 투명 커버 180 : 카메라
182 : 스피커 184 : 조명부
186 : 조도계 190 : PCB
192 : 컨택홀 194 : FPCB
PX : 서브 화소 AA : 표시 영역
NA : 비표시 영역
Scan #1 ~ Scan #n : 스캔 배선 CH : 컨택홀
D1_1, D1_2 ~ Dn_1, Dn_2 : 데이터 배선
Tdr : 구동 박막트랜지스터 T-Sc1 ~ T-Sc4 : 스캔 스위치
R, G, B : 서브 화소 T-MX1, T-MX2 : 먹스 스위치
R1~R4, G1~G4, B1~B4 : 부 서브 화소

Claims (19)

  1. 제1 전면과 제1 후면을 구비하는 제1 패널 영역;
    제2 전면과 제2 후면을 구비하고, 상기 제1 패널 영역과 경계에서 폴딩 상태일 때, 상기 제2 후면이 상기 제1 후면과 마주보며 상기 제1 패널에 대응하는 제2 패널 영역;
    제3 전면과 제3 후면을 구비하고, 상기 제2 패널 영역과 경계에서 폴딩 상태일 때, 상기 제3 전면이 상기 제2 전면과 마주보며 상기 제2 패널에 대응하는 제3 패널 영역;
    상기 제1 패널 영역의 일측단과 상기 제2 패널 영역의 타측단을 힌지 결합하는 제1 힌지 결합부; 및
    상기 제2 패널 영역의 일측단과 상기 제3 패널 영역의 타측단을 힌지 결합하는 제2 힌지 결합부를 포함하고,
    상기 제1 패널 영역, 상기 제2 패널 영역 및 상기 제3 패널 영역은 연이어 일체로 형성된 표시 패널.
  2. 제 1 항에 있어서,
    상기 제3 패널 영역과 동일한 폭으로 상기 제3 패널 영역의 일측단으로부터 연장되고, 상기 제3 패널 영역보다 더 큰 두께와 높이를 갖는 외곽 바디; 및
    상기 제1 패널 영역의 상기 제1 전면을 덮는 투명 커버;
    를 더 포함하는 표시 패널.
  3. 제 2 항에 있어서,
    상기 외곽 바디는,
    상기 제1 패널 영역과 상기 제2 패널 영역 및 상기 제3 패널 영역이 폴딩 상태일 때, 상기 제1 패널 영역의 일측단과 상기 제2 패널 영역의 타측단 및 상기 제1 힌지 결합부를 감싸며 마주 보는 형상을 갖는, 표시 패널.
  4. 제 2 항에 있어서,
    상기 외곽 바디에는 상기 투명 커버가 삽입되는 삽입구가 형성되고,
    상기 외곽 바디의 내부에는 상기 삽입구로 삽입된 상기 투명 커버를 수용하기 위한 수용 공간이 형성된, 표시 패널.
  5. 제 4 항에 있어서,
    상기 외곽 바디와 일체로 형성된 상기 제3 패널 영역의 하단부에는 상기 투명 커버를 이동시키기 위해 상기 투명 커버와 연결된 무빙 홀더(Moving Holder)가 구비되고, 상기 무빙 홀더의 이동 경로를 제공하는 무빙 레일(Moving Rail) 이 형성된 표시 패널.
  6. 제 5 항에 있어서,
    상기 무빙 홀더가 상기 무빙 레일을 따라 일측에서 타측으로 이동하는 경우에, 상기 투명 커버가 상기 삽입구로 삽입되어 상기 수용 공간에 위치하는, 표시 패널.
  7. 제 5 항에 있어서,
    상기 무빙 홀더가 상기 무빙 레일을 따라 타측에서 일측으로 이동하는 경우에, 상기 투명 커버가 상기 삽입구로부터 돌출되어 상기 제3 패널 영역의 상기 제3 전면을 덮는, 표시 패널.
  8. 제 2 항에 있어서,
    상기 외곽 바디는, 터치 펜(Touch Pen)을 삽입시켜 보관하기 위한 보관 홀을 구비하는, 표시 패널.
  9. 제 2 항에 있어서,
    상기 외곽 바디는,
    외부 객체를 촬영하여 영상을 얻기 위한 카메라;
    음향 출력을 위한 스피커;
    조명을 출력하는 조명부; 및
    주변 밝기를 검출하기 위한 조도계;
    를 더 구비하는, 표시 패널.
  10. 제 9 항에 있어서,
    상기 외곽 바디의 내부에 구비되고, 상기 카메라, 상기 스피커, 상기 조명부 및 상기 조도계와 전기적으로 연결된 인쇄회로기판(Printed Circuit Board, PCB);
    을 더 포함하는, 표시 패널.
  11. 제 10 항에 있어서,
    상기 인쇄회로기판(PCB)과 상기 제3 패널 영역 또는 상기 제3 패널 영역의 제3 표시부를 전기적으로 연결시키는 연성 인쇄회로기판(Flexible Printed Circuit Board, FPCB);
    을 더 포함하는, 표시 패널.
  12. 제 1 항에 있어서,
    상기 인쇄회로기판(PCB)은 적어도 하나 이상의 컨택홀(Contact Hole)이 형성되고, 상기 적어도 하나 이상의 컨택홀을 통하여 상기 연성 인쇄회로기판(FPCB)과 전기적으로 연결된, 표시 패널.
  13. 제1 전면에 제1 표시부가 형성된 제1 패널 영역; 제2 전면에 제2 표시부가 형성되며 상기 제1 패널 영역에 대응하는 제2 패널 영역; 제3 전면에 제3 표시부가 형성되며 상기 제2 패널 영역에 대응하는 제3 패널 영역; 상기 제1 패널 영역과 상기 제2 패널 영역을 힌지 결합하는 제1 힌지 결합부; 및 상기 제2 패널 영역과 상기 제3 패널 영역을 힌지 결합하는 제2 힌지 결합부를 포함하는 표시 패널;
    상기 제1 패널 영역, 상기 제2 패널 영역 및 상기 제3 패널 영역은, 각각 표시 영역(AA)과 비표시 영역(NA)을 포함하고,
    상기 제1 표시부와 상기 제2 표시부 및 상기 제3 표시부는 연이어 일체로 형성되고, 각각 복수의 스캔 배선들 및 복수의 데이터 배선들이 교차하여 배치되고 각 교차점에 유기발광 다이오드를 구비하는 각 화소를 정의하고,
    상기 각 비표시 영역은, 상기 복수의 스캔 배선들에 스캔 신호를 인가하는 스캔 구동부, 상기 복수의 데이터 배선들에 데이터 신호를 인가하는 데이터 구동부, 상기 각 화소에 고전위 전압, 저전위 전압 및 초기화 전압을 제공하는 전원부, 및 상기 스캔 구동부와 상기 데이터 구동부를 제어하는 타이밍 제어부를 포함하는, 표시 장치.
  14. 제 13 항에 있어서,
    상기 화소는, 행과 열로 배치된 복수의 서브 화소들을 포함하고,
    상기 복수의 서브 화소들에 행마다 1개씩 스캔 배선이 배치되고, 상기 복수의 서브 화소들에 열마다 2개씩 데이터 배선이 배치되고,
    상기 각 열마다 배치된 2 개의 데이터 배선들 중 일 측의 데이터 배선이 제1 먹스(MUX 1)에 의해 선택되고, 상기 각 열마다 배치된 2 개의 데이터 배선들 중 다른 측의 데이터 배선이 제2 먹스(MUX 2)에 의해 선택되고,
    상기 각 열마다 배치된 상기 일 측의 데이터 배선과 상기 각 행에 배치된 스캔 배선이 제1 및 제2 스캔 스위치에 의해 스위칭 연결되고, 상기 각 열마다 배치된 상기 다른 측의 데이터 배선과 상기 각 행에 배치된 스캔 배선이 제3 및 제4 스캔 스위치에 의해 스위칭 연결되는, 표시 장치.
  15. 제 14 항에 있어서,
    상기 제1 및 제2 스캔 스위치는 상기 복수의 서브 화소들에서 상기 일 측의 데이터 배선을 따라 수직 방향으로 연속된 2 개의 서브 화소마다 배치되고,
    상기 제3 및 제4 스캔 스위치는 상기 복수의 서브 화소들에서 상기 다른 측의 데이터 배선을 따라 수직 방향으로 연속된 2 개의 서브 화소마다 배치되는, 표시 장치.
  16. 제 14 항에 있어서,
    상기 제1 먹스(MUX 1)는,
    상기 일 측의 데이터 배선에 제1 전극이 연결되고, 제1 선택 신호를 인가하기 위한 제1 먹스 배선에 게이트 전극이 연결되며, 제1 전원에 제2 전극이 연결되는 제1 먹스 스위치;
    를 포함하는 표시 장치.
  17. 제 16 항에 있어서,
    상기 제1 먹스 스위치는, 상기 제1 먹스 배선을 통해 상기 게이트 전극으로 상기 제1 선택 신호가 인가됨에 따라 턴 온(Turn On)되어, 상기 제2 전극을 통해 인가된 제1 전원을 상기 제1 전극을 통해 상기 일 측의 데이터 배선에 인가하는, 표시 장치.
  18. 제 14 항에 있어서,
    상기 제2 먹스(MUX 2)는,
    상기 다른 측의 데이터 배선에 제1 전극이 연결되고, 제2 선택 신호를 인가하기 위한 제2 먹스 배선에 게이트 전극이 연결되며, 제1 전원에 제2 전극이 연결되는 제2 먹스 스위치;
    를 포함하는 표시 장치.
  19. 제 18 항에 있어서,
    상기 제2 먹스 스위치는, 상기 제2 먹스 배선을 통해 상기 게이트 전극으로 상기 제2 선택 신호가 인가됨에 따라 턴 온(Turn On)되어, 상기 제2 전극을 통해 인가된 제1 전원을 상기 제1 전극을 통해 상기 다른 측의 데이터 배선에 인가하는, 표시 장치.
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