KR20150015681A - 표시 장치 및 그것의 구동 방법 - Google Patents
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Abstract
표시 장치는, 복수의 게이트 라인들과 복수의 데이터 라인들에 각각 연결된 복수의 픽셀들 및 타이밍 컨트롤러를 포함하며, 복수의 픽셀들 각각은 제1 서브 픽셀 및 제2 서브 픽셀을 포함한다. 타이밍 컨트롤러는, 상기 영상 신호가 제1 타입의 영상 신호일 때 매 프레임마다 고계조 곡선 및 저계조 곡선 중 어느 하나에 번갈아 대응하는 제1 데이터 신호 및 제2 데이터 신호를 제1 서브 픽셀 및 제2 서브 픽셀로 제공하고, 상기 영상 신호가 제2 타입의 영상 신호일 때 상기 고계조 곡선에 대응하는 제1 데이터 신호를 상기 제1 서브 픽셀로 제공하고, 상기 저계조 곡선에 대응하는 제2 데이터 신호를 상기 제2 서브 픽셀로 제공한다.
Description
본 발명은 표시 장치 및 그것의 구동 방법에 관한 것이다.
표시 장치 가운데 하나인 액정 표시 장치는 슬림한 디자인, 저소비 전력, 고해상도 등의 장점이 있으며, 최근 노트북 컴퓨터, 모니터, 광고용 디스플레이, 텔레비전 등 다양한 응용 분야에 사용되고 있다.
이러한 액정 표시 장치는 액정의 이방성으로 인해 화면을 관찰하는 방향에 따라서 명암과 색상이 다르게 보이는 단점을 갖는다. 최근 좁은 시야각을 개선하기 위하여 광시야각 특성을 갖는 액정 표시 장치에 대한 필요성이 증대되고 있다.
따라서 본 발명의 목적은 광시야각 특성을 가지며, 화질이 개선된 액정 표시 장치 및 그것의 구동 방법을 제공하는데 있다.
이와 같은 목적을 달성하기 위한 본 발명의 일 특징에 의하면, 표시 장치는: 복수의 게이트 라인들과 복수의 데이터 라인들에 각각 연결된 복수의 픽셀들을 포함하며, 복수의 픽셀들 각각은 제1 서브 픽셀 및 제2 서브 픽셀을 포함하는 표시 패널과, 상기 복수의 게이트 라인들을 구동하는 게이트 드라이버와, 상기 복수의 데이터 라인들을 구동하는 데이터 드라이버, 그리고 상기 게이트 드라이버 및 상기 데이터 드라이버를 제어하며, 외부로부터 입력된 영상 신호에 응답해서 상기 제1 서브 픽셀 및 상기 제2 서브 픽셀을 위한 제1 데이터 신호 및 제2 데이터 신호를 출력하는 타이밍 컨트롤러를 포함한다.
이 실시예에 있어서, 상기 영상 신호가 제1 타입의 영상 신호일 때 상기 제1 데이터 신호 및 상기 제2 데이터 신호는 매 프레임마다 고계조 곡선 및 저계조 곡선 중 어느 하나에 번갈아 대응하고, 상기 영상 신호가 제2 타입의 영상 신호일 때 상기 제1 데이터 신호는 상기 고계조 곡선에 대응하고, 상기 제2 데이터 신호는 상기 저계조 곡선에 대응한다.
이 실시예에 있어서, 상기 타이밍 컨트롤러는, 이전 프레임의 상기 영상 신호와 현재 프레임의 상기 영상 신호가 서로 다른 신호일 때 상기 영상 신호를 상기 제1 타입의 영상 신호로 판별하고, 상기 이전 프레임의 상기 영상 신호와 상기 현재 프레임의 영상 신호가 동일한 신호일 때 상기 영상 신호를 상기 제2 타입의 영상 신호로 판별한다.
이 실시예에 있어서, 상기 타이밍 컨트롤러는, 상기 영상 신호를 상기 고계조 곡선 및 상기 저계조 곡선에 대응하는 제1 동적 데이터 신호 및 제2 동적 데이터 신호로 변환하는 제1 변환부와, 상기 영상 신호를 상기 고계조 곡선 및 상기 저계조 곡선에 대응하는 제1 정적 데이터 신호 및 제2 정적 데이터 신호로 변환하는 제2 변환부와, 상기 이전 프레임의 상기 영상 신호와 상기 현재 프레임의 영상 신호를 비교하고, 비교 결과에 대응하는 선택 신호를 출력하는 영상 판별부, 및 상기 제1 동적 데이터 신호, 상기 제2 동적 데이터 신호, 상기 제1 정적 데이터 신호 및 상기 제2 정적 데이터 신호를 입력받고, 상기 선택 신호에 응답해서 상기 제1 데이터 신호 및 상기 제2 데이터 신호를 출력하는 선택 회로를 포함한다.
이 실시예에 있어서, 상기 제1 변환부는, 제1 프레임동안 상기 고계조 곡선에 각각 대응하는 상기 제1 동적 데이터 신호 및 상기 제2 동적 데이터 신호를 출력하고, 제2 프레임동안 상기 저계조 곡선에 각각 대응하는 상기 제1 동적 데이터 신호 및 상기 제2 동적 데이터 신호를 출력하되, 상기 제1 프레임과 상기 제2 프레임은 시간적으로 연속한다.
이 실시예에 있어서, 상기 제2 변환부는, 상기 고계조 곡선에 대응하는 상기 제1 정적 데이터 신호를 출력하고, 상기 저계조 곡선에 대응하는 상기 제2 정적 데이터 신호를 출력한다.
이 실시예에 있어서, 상기 제1 변환부는, 상기 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 고계조 신호를 출력하는 고계조 변환부와, 상기 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 저계조 신호를 출력하는 저계조 변환부, 및 매 프레임마다 상기 고계조 신호 및 상기 저계조 신호 중 어느 하나를 상기 제1 동적 데이터 신호 및 상기 제2 동적 데이터 신호로서 출력하는 선택기를 포함한다.
이 실시예에 있어서, 상기 제2 변환부는, 상기 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 상기 제1 정적 데이터 신호를 출력하는 고계조 변환부와, 상기 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 상기 제2 정정 데이터 신호를 출력하는 저계조 변환부를 포함한다.
이 실시예에 있어서, 상기 타이밍 컨트롤러는 픽셀 단위로 상기 이전 프레임의 상기 영상 신호와 상기 현재 프레임의 상기 영상 신호를 비교한다.
이 실시예에 있어서, 상기 타이밍 컨트롤러는, 상기 영상 신호를 제1 영상 신호 및 제2 영상 신호로 변환하는 더블 프레임 변환부와, 상기 제1 영상 신호 및 상기 제2 영상 신호를 매 프레임마다 번갈아 상기 고계조 곡선 및 상기 저계조 곡선에 대응하는 동적 데이터 신호로 변환하는 제1 변환부와, 상기 선택 신호에 응답해서 상기 제1 영상 신호 및 상기 동적 데이터 신호 중 어느 하나를 중간 데이터 신호로 출력하는 제1 선택기와, 상기 중간 데이터 신호를 상기 고계조 곡선에 대응하는 제1 정적 데이터 신호 및 상기 저계조 곡선에 대응하는 제2 정적 데이터 신호로 변환하는 제2 변환부, 및 상기 제1 정적 데이터 신호, 상기 제2 정적 데이터 신호 및 상기 중간 데이터 신호를 입력받고, 상기 선택 신호에 응답해서 상기 제1 데이터 신호 및 상기 제2 데이터 신호를 출력하는 제2 선택기를 포함한다.
이 실시예에 있어서, 상기 제1 변환부는, 상기 제1 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 고계조 신호를 출력하는 고계조 변환부와, 상기 제2 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 저계조 신호를 출력하는 저계조 변환부, 및 매 프레임마다 상기 고계조 신호 및 상기 저계조 신호 중 어느 하나를 상기 동적 데이터 신호로서 출력하는 제3 선택기를 포함한다.
이 실시예에 있어서, 상기 제2 변환부는, 상기 중간 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 상기 제1 정적 데이터 신호를 출력하는 고계조 변환부, 및 상기 중간 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 상기 제2 정적 데이터 신호를 출력하는 저계조 변환부를 포함한다.
이 실시예에 있어서, 상기 타이밍 컨트롤러는, 상기 영상 신호를 제1 영상 신호 및 제2 영상 신호로 변환하는 더블 프레임 변환부와, 상기 제1 영상 신호 및 상기 제2 영상 신호를 제1 동적 데이터 신호 및 제2 동적 데이터 신호로 변환하는 제1 변환부와, 상기 중간 데이터 신호를 상기 고계조 곡선에 대응하는 제1 정적 데이터 신호 및 상기 저계조 곡선에 대응하는 제2 정적 데이터 신호로 변환하는 제2 변환부, 및 상기 제1 동적 데이터 신호, 상기 제2 동적 데이터 신호, 상기 제1 정적 데이터 신호 및 상기 제2 정적 데이터 신호를 입력받고, 상기 선택 신호에 응답해서 상기 제1 데이터 신호 및 상기 제2 데이터 신호를 출력하는 선택기를 포함한다.
이 실시예에 있어서, 상기 제1 변환부는, 상기 제1 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 고계조 신호를 출력하는 고계조 변환부와, 상기 제2 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 저계조 신호를 출력하는 저계조 변환부, 및 상기 고계조 신호 및 상기 저계조 신호를 상기 제1 동적 데이터 신호 및 상기 제2 동적 데이터 신호로 출력하는 출력부를 포함한다. 상기 출력부는 제1 프레임동안 상기 고계조 신호를 상기 제1 동적 데이터 신호로 출력하고, 상기 저계조 신호를 상기 제2 동적 데이터 신호로 출력하고, 상기 제1 프레임과 연속하는 제2 프레임동안 상기 저계조 신호를 상기 제1 동적 데이터 신호로 출력하고, 상기 고계조 신호를 상기 제2 동적 데이터 신호로 출력한다.
이 실시예에 있어서, 상기 제1 서브 픽셀은 상기 복수의 게이트 라인들 중 제1 게이트 라인 및 상기 복수의 데이터 라인들 중 제1 데이터 라인과 연결되고, 상기 제2 서브 픽셀은 상기 제1 게이트 라인 및 상기 복수의 데이터 라인들 중 제2 데이터 라인과 연결된다.
이 실시예에 있어서, 상기 제1 서브 픽셀은, 상기 제1 데이터 라인과 제1 노드 사이에 연결되고, 상기 제1 게이트 라인과 연결된 게이트를 갖는 제1 트랜지스터, 및 상기 제1 노드와 공통 전압 사이에 연결된 액정 커패시터를 포함한다.
이 실시예에 있어서, 상기 제2 서브 픽셀은, 상기 제2 데이터 라인과 제2 노드 사이에 연결되고, 상기 제1 게이트 라인과 연결된 게이트를 갖는 제2 트랜지스터, 및 상기 제2 노드와 공통 전압 사이에 연결된 액정 커패시터를 포함한다.
본 발명의 다른 특징에 의하면, 표시 장치의 구동 방법은: 영상 신호를 수신하는 단계와, 상기 영상 신호를 제1 영상 신호 및 제2 영상 신호로 변환하는 단계와, 상기 제1 영상 신호의 타입을 판별하는 단계와, 상기 제1 영상 신호가 제1 타입의 영상 신호일 때 매 프레임마다 고계조 곡선 및 저계조 곡선 중 어느 하나에 번갈아 대응하는 제1 데이터 신호 및 제2 데이터 신호를 출력하는 단계, 및 상기 제1 영상 신호가 제2 타입의 영상 신호일 때 상기 고계조 곡선에 대응하는 상기 제1 데이터 신호 및 상기 저계조 곡선에 대응하는 상기 제2 데이터 신호를 출력하는 단계를 포함한다.
이 실시예에 있어서, 상기 제1 영상 신호의 타입을 판별하는 단계는, 상기 현재 프레임의 상기 제1 영상 신호와 상기 이전 프레임의 상기 제1 영상 신호가 서로 다를 때 상기 제1 영상 신호를 상기 제1 타입의 영상 신호로 판별하고, 상기 현재 프레임의 상기 제1 영상 신호와 상기 이전 프레임의 상기 제1 영상 신호가 서로 같을 때 상기 제1 영상 신호를 상기 제2 타입의 영상 신호로 판별하는 것을 포함한다.
이 실시예에 있어서, 상기 제1 영상 신호 및 상기 제2 영상 신호 각각의 주파수는 상기 영상 신호의 주파수보다 2배 빠르다.
이 실시예에 있어서, 상기 표시 장치는 제1 서브 픽셀 및 제2 서브 픽셀을 포함하는 적어도 하나의 픽셀을 포함하며, 상기 제1 데이터 신호를 상기 제1 서브 픽셀로 제공하고, 상기 제2 데이터 신호를 상기 제2 서브 픽셀로 제공하는 단계를 더 포함한다.
이와 같은 본 발명의 S-PVA 모드 표시 장치는 프레임 단위로 서로 다른 계조 곡선에 대응하는 데이터 신호를 이용하여 영상을 표시함으로써 측면 시인성이 개선될 수 있다. 특히, 정지 영상이 표시될 때 각 서브 픽셀은 매 프레임마다 동일한 계조 곡선에 대응하는 데이터 신호를 표시하므로 영상의 플리커 현상을 방지할 수 있다. 따라서, 측면 시인성을 개선하면서도 표시 품질이 향상될 수 있다.
도 1은 본 발명의 실시예에 따른 표시장치의 평면도이다.
도 2는 도 1에 도시된 어느 하나의 픽셀의 회로 구성을 예시적으로 보여주는 도면이다.
도 3은 도 2에 도시된 제1 서브 픽셀 및 제2 서브 픽셀 내 액정 커패시터들의 형상의 일 예를 보여주는 도면이다.
도 4는 도 1에 도시된 타이밍 컨트롤러의 구성을 보여주는 블록도이다.
도 5는 도 4에 도시된 제1 변환부의 구성을 보여주는 블록도이다.
도 6은 도 4에 도시된 제2 변환부의 구성을 보여주는 블록도이다.
도 7은 고계조 곡선 및 저계조 곡선을 보여주는 도면이다.
도 8은 영상 신호가 동영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 9는 영상 신호가 정지 영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 10은 외부로부터 제공되는 영상 신호가 정지 영상에서 동영상으로 변화될 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 11은 외부로부터 제공되는 영상 신호에 따라서 표시 패널에 구비된 픽셀들로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 12는 도 1에 도시된 타이밍 컨트롤러의 본 발명의 다른 실시예에 따른 구성을 보여주는 블록도이다.
도 13은 본 발명의 또다른 실시예에 따른 타이밍 컨트롤러의 구성을 보여주는 블록도이다.
도 14는 영상 신호가 동영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 15는 영상 신호가 정지 영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 16은 표시 장치에 구비되는 타이밍 컨트롤러의 본 발명의 실시예에 따른 동작 수순을 보여주는 타이밍도이다.
도 2는 도 1에 도시된 어느 하나의 픽셀의 회로 구성을 예시적으로 보여주는 도면이다.
도 3은 도 2에 도시된 제1 서브 픽셀 및 제2 서브 픽셀 내 액정 커패시터들의 형상의 일 예를 보여주는 도면이다.
도 4는 도 1에 도시된 타이밍 컨트롤러의 구성을 보여주는 블록도이다.
도 5는 도 4에 도시된 제1 변환부의 구성을 보여주는 블록도이다.
도 6은 도 4에 도시된 제2 변환부의 구성을 보여주는 블록도이다.
도 7은 고계조 곡선 및 저계조 곡선을 보여주는 도면이다.
도 8은 영상 신호가 동영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 9는 영상 신호가 정지 영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 10은 외부로부터 제공되는 영상 신호가 정지 영상에서 동영상으로 변화될 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 11은 외부로부터 제공되는 영상 신호에 따라서 표시 패널에 구비된 픽셀들로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 12는 도 1에 도시된 타이밍 컨트롤러의 본 발명의 다른 실시예에 따른 구성을 보여주는 블록도이다.
도 13은 본 발명의 또다른 실시예에 따른 타이밍 컨트롤러의 구성을 보여주는 블록도이다.
도 14는 영상 신호가 동영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 15는 영상 신호가 정지 영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 16은 표시 장치에 구비되는 타이밍 컨트롤러의 본 발명의 실시예에 따른 동작 수순을 보여주는 타이밍도이다.
이하 본 발명의 실시예를 첨부된 도면들을 참조하여 상세히 설명한다.
도 1은 본 발명의 실시예에 따른 표시장치의 평면도이다.
도 1은 본 발명의 실시예에 따른 표시 장치를 보여주는 블록도이다. 이하 설명에서는 표시 장치의 일 예로 액정 표시 장치를 도시하고 설명하나, 본 발명은 액정 표시 장치에 한정되지 않고, 다양한 표시 장치에 적용될 수 있다.
도 1을 참조하면, 표시 장치(100)는 표시 패널(110), 타이밍 컨트롤러(120), 게이트 드라이버(130), 데이터 드라이버(140) 그리고 메모리(150)를 포함한다.
표시 패널(110)은 복수의 데이터 라인들(DL1-DL2m) 및 데이터 라인들(DL1-DL2m)에 교차하여 배열된 복수의 게이트 라인들(GL1-GLn) 그리고 그들의 교차 영역에 배열된 복수의 픽셀들을 포함한다. 도 1에서는 데이터 라인들(DL1, DL2) 및 게이트 라인(GL1)과 연결된 픽셀(PX11)만을 도시하였다. 이 실시예에서 표시 패널(110)은 S-PVA(Super-Patterned Vertical Alighment) 모드로 구현된다. S-PVA(Super-Patterned Vertical Alighment) 모드 표시 패널(110)은 하나의 픽셀이 2개의 서브 픽셀들을 포함하고, 2개의 서브 픽셀들에 서로 다른 데이터 신호들을 제공할 수 있다. 표시 패널(110)에 구비되는 픽셀의 구체적인 구성은 추후 상세히 설명된다.
타이밍 컨트롤러(120)는 외부로부터 영상 신호(RGB) 및 이의 표시를 제어하기 위한 제어 신호들(CTRL) 예를 들면, 수직 동기 신호, 수평 동기 신호, 메인 클럭 신호 및 데이터 인에이블 신호 등을 제공받는다. 타이밍 컨트롤러(120)는 제어 신호들(CTRL)에 기초하여 영상 신호(RGB)를 표시 패널(110)의 동작 조건에 맞게 처리한 제1 데이터 신호(DATA1), 제2 데이터 신호(DATA2) 및 제1 제어 신호(CONT1)를 데이터 드라이버(140)로 제공하고, 제2 제어 신호(CONT2)를 게이트 드라이버(130)로 제공한다. 제1 제어 신호(CONT1)는 클럭 신호, 극성 반전 신호 및 라인 래치 신호를 포함하고, 제2 제어 신호(CONT2)는 수직 동기 시작 신호, 출력 인에이블 신호 그리고 게이트 펄스 신호 등을 포함할 수 있다. 또한 타이밍 컨트롤러(120)의 구체적인 구성 및 동작은 추후 상세히 설명된다.
게이트 드라이버(130)는 타이밍 컨트롤러(120)로부터의 제2 제어 신호(CONT2)에 응답해서 게이트 라인들(GL1-GLn)을 구동한다. 게이트 드라이버(130)는 IC(Integrated circuit) 칩으로 구현되어서 칩 온 글라스(Chip On Glass: COG) 방식으로 표시 패널(110) 상에 실장되거나, 표시 패널(110)에 부착된 필름(미 도시됨) 상에 칩 온 필름(Chip On Film: COF) 방식으로 실장될 수 있다. 다른 예에서, 게이트 드라이버(130)는 집적 회로 칩뿐만 아니라 비정질-실리콘 스위칭 트랜지스터(amorphous Silicon Thin Film Transistor a-Si TFT)를 이용한 ASG(Amorphous silicon gate), 산화물 반도체, 결정질 반도체, 다결정 반도체 등을 이용한 회로로 구현될 수도 있다.
데이터 드라이버(140)는 타이밍 컨트롤러(120)로부터의 제1 데이터 신호(DATA1), 제2 데이터 전압(DATA2) 및 제1 제어 신호(CONT1)에 응답해서 데이터 라인들(DL1-DL2m)을 구동한다. 이 실시예에서, 표시 패널(110)에 배열되는 데이터 라인들(DL1-DL2m)의 수는 하나의 게이트 라인에 연결된 픽셀들의 수(m)의 2배 즉, 2×m이다.
메모리(150)는 타이밍 컨트롤러(120)의 동작에 필요한 데이터를 저장한다. 예컨대, 메모리(150)는 외부로부터 입력되는 영상 신호(RGB)를 저장하거나, 룩업 테이블로 사용될 수 있다.
도 2는 도 1에 도시된 어느 하나의 픽셀의 회로 구성을 예시적으로 보여주는 도면이다.
도 2를 참조하면, 픽셀(PXij)은 i번째 게이트 라인(GLi), j번째 데이터 라인(DLj) 및 j+1번째 데이터 라인(DLj+1)에 연결된다. 픽셀(PXij)은 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)을 포함한다.
제1 서브 픽셀(PXa)은 스위칭 트랜지스터(Qa) 및 액정 커패시터(CLCa)를 포함한다. 스위칭 트랜지스터(Qa)는 데이터 라인(DLj)과 액정 커패시터(CLCa)의 일단 사이에 연결되고, 게이트 라인(GLi)과 연결된 게이트 단자를 갖는다. 액정 커패시터(CLCa)의 타단은 공통 전압과 연결될 수 있다.
제2 서브 픽셀(PXb)은 스위칭 트랜지스터(Qb) 및 액정 커패시터(CLCb)를 포함한다. 스위칭 트랜지스터(Qb)는 데이터 라인(DLj+1)과 액정 커패시터(CLCb)의 일단 사이에 연결되고, 게이트 라인(GLi)과 연결된 게이트 단자를 갖는다. 액정 커패시터(CLCb)의 타단은 공통 전압과 연결될 수 있다.
도 3은 도 2에 도시된 제1 서브 픽셀 및 제2 서브 픽셀 내 액정 커패시터들의 형상의 일 예를 보여주는 도면이다.
도 3을 참조하면, 제1 서브 픽셀(PXa) 내 액정 커패시터(CLCa)와 제2 서브 픽셀(PXb) 내 액정 커패시터(CLCb)는 인접하게 배열된다. 액정 커패시터(CLCa)와 액정 커패시터(CLCb)를 나누는 경계는 게이트 라인(GLi)에 대하여 45°를 이루는 부분과 수직을 이루는 부분으로 구분되고, 이중 45°를 이루는 부분이 수직을 이루는 부분에 비하여 길다. 또한, 액정 커패시터(CLCa)와 액정 커패시터(CLCb)는 게이트 라인(GLi)과 데이터 라인들(DLj, DLj+1)이 교차하여 정의하는 픽셀 영역을 상하로 이등분하는 선에 대하여 실질적으로 거울상 대칭을 이루고 있다.
도 4는 도 1에 도시된 타이밍 컨트롤러의 구성을 보여주는 블록도이다.
도 4를 참조하면, 타이밍 컨트롤러(120)는 더블 프레임 변환부(121), 제1 변환부(122), 제2 변환부(123), 선택기(124) 및 영상 판별부(125)를 포함한다.
더블 프레임 변환부(121)는 외부로부터 입력되는 영상 신호(RGB)를 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)로 변환한다. 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)는 영상 신호(RGB)와 동일한 신호이며, 영상 신호(RGB)에 비해 2배 빠른 주파수를 갖는다. 예컨대, 영상 신호(RGB)의 주파수가 60Hz인 경우, 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2) 각각의 주파수는 120Hz이다.
제1 변환부(122)는 더블 프레임 변환부(121)로부터의 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)를 입력받고, 저계조 곡선 및 고계조 곡선에 대응하는 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)를 출력한다.
제2 변환부(123)는 더블 프레임 변환부(121)로부터의 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)를 입력받고, 저계조 곡선 및 고계조 곡선에 대응하는 제1 정적 데이터 신호(SDA1) 및 제2 정적 데이터 신호(SDA2)를 출력한다.
제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)에 대한 저계조 곡선 및 고계조 곡선에 대응하는 제1 동적 데이터 신호(MDA1), 제2 동적 데이터 신호(MDA2), 제1 정적 데이터 신호(SDA1) 및 제2 정적 데이터 신호(SDA2)는 도 1에 도시된 메모리(150)에 룩업 테이블로 저장될 수 있다. 이 경우, 제1 변환부(122) 및 제2 변환부(123)는 메모리(150)를 참조하여 제1 동적 데이터 신호(MDA1), 제2 동적 데이터 신호(MDA2), 제1 정적 데이터 신호(SDA1) 및 제2 정적 데이터 신호(SDA2)를 출력한다. 다른 예에서, 제1 변환부(122) 및 제2 변환부(123) 각각이 룩업 테이블로 구현될 수 있다.
영상 판별부(125)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 비교하고, 선택 신호(SEL)를 출력한다. 예컨대, 영상 판별부(125)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 다를 때 현재 프레임의 제1 영상 신호(RGB1)를 동영상으로 판별해서 제1 레벨의 선택 신호(SEL)를 출력한다. 영상 판별부(125)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 같을 때 현재 프레임의 제1 영상 신호(RGB1)를 정지 영상으로 판별해서 제2 레벨의 선택 신호(SEL)를 출력한다. 이하 설명에서 한 프레임은 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)의 주기를 의미하며, 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)의 주파수는 영상 신호(RGB)의 주파수보다 2배 빠르다.
선택기(124)는 제1 변환부(122)로부터의 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2) 그리고 제2 변환부(123)로부터의 제1 정적 데이터 신호(SDA1) 및 제2 정적 데이터 신호(SDA2)를 입력받고, 영상 판별부(125)로부터의 선택 신호(SEL)에 응답해서 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 출력한다.
예컨대, 선택 신호(SEL)가 제1 레벨인 경우, 선택기(124)는 제1 변환부(122)로부터의 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로서 출력한다. 선택 신호(SEL)가 제2 레벨인 경우, 선택기(124)는 제2 변환부(123)로부터의 제1 정적 데이터 신호(SDA1) 및 제2 정적 데이터 신호(SDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로서 출력한다.
도 5는 도 4에 도시된 제1 변환부의 구성을 보여주는 블록도이다.
도 5를 참조하면, 제1 변환부(122)는 고계조 변환부(122_1), 저계조 변환부(122_2) 및 선택기(122_3)를 포함한다. 고계조 변환부(122_1)는 제1 영상 신호(RGB1)를 고계조 곡선에 대응하는 고계조 신호(HDA)로 변환한다. 저계조 변환부(122_2)는 제2 영상 신호(RGB2)를 저계조 곡선에 대응하는 저계조 신호(LDA)로 변환한다. 선택기(122_3)는 프레임 신호(F)에 응답해서 고계조 변환부(122_1)로부터의 고계조 신호(HDA) 및 저계조 변환부(122_2)로부터의 저계조 신호(LDA) 중 어느 하나를 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA)로서 출력한다. 선택기(122_3)는 프레임 신호(F)에 응답해서 매 프레임마다 고계조 신호(HDA) 및 저계조 신호(LDA) 중 어느 하나를 선택한다. 예컨대, 홀수 번째 프레임동안 선택기(122_3)는 고계조 변환부(122_1)로부터의 고계조 신호(HDA)를 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA)로서 출력한다. 짝수 번째 프레임동안 선택기(122_3)는 저계조 변환부(122_2)로부터의 저계조 신호(LDA)를 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)로서 출력한다. 이 예에서, 제1 변환부(122)로부터 출력되는 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)는 동일한 신호이다.
도 6은 도 4에 도시된 제2 변환부의 구성을 보여주는 블록도이다.
도 6을 참조하면, 제2 변환부(123)는 고계조 변환부(123_1) 및 저계조 변환부(123_2)를 포함한다. 고계조 변환부(123_1)는 제1 영상 신호(RGB1)를 고계조 곡선에 대응하는 제1 정적 데이터 신호(SDA1)로 변환한다. 저계조 변환부(123_2)는 제2 영상 신호(RGB2)를 저계조 곡선에 대응하는 제2 정적 데이터 신호(SDA2)로 변환한다.
도 7은 고계조 곡선 및 저계조 곡선을 보여주는 도면이다.
도 7을 참조하면, 고계조 곡선(HGC) 및 저계조 곡선(LGC)은 계조 별 휘도를 나타낸다. 예컨대, 영상 신호(RGB)의 계조가 Gk인 경우, 제1 프레임(F1) 동안 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)로 고계조 곡선(HGC)에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 각각 제공한다. 계속해서 제2 프레임(F2)동안 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)로 저계조 곡선(LGC)에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 각각 제공한다. 따라서 제1 프레임(F1) 동안 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)에 표시되는 고계조 휘도(LH)와 제2 프레임(F2) 동안 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)에 표시되는 저계조 휘도(LL)에 의해서 사용자는 계조 곡선(GC)에 대응하는 휘도(L)로 인식할 수 있다.
고계조 곡선(HGC)은 표시 패널(110)의 측면에서의 시인성이 높은 휘도에 해당하며, 저계조 곡선(LGC)은 패널(110)의 정면에서의 시인성이 높은 휘도에 해당한다. 따라서, 매 프레임마다 번갈아 고계조 곡선(HGC) 및 저계조 곡선(LGC)에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)로 제공함으로써 사용자의 위치에 따른 시인성의 차이를 감소시킬 수 있다. 그 결과, 표시 장치(100)의 시인성을 전체적으로 향상시킬 수 있다.
이와 같이 매 프레임마다 휘도를 변경하는 기술은 동영상의 경우에는 문제되지 않으나 정지 영상 또는 일정한 패턴을 갖는 특정 영상에서는 화면이 깜박이는 플리커로 인식될 수 있다.
도 8은 영상 신호가 동영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 4 및 도 8을 참조하면, 영상 판별부(125)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 비교하고, 선택 신호(SEL)를 출력한다. 예컨대, 영상 판별부(125)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 다를 때 현재 프레임의 제1 영상 신호(RGB1)를 동영상으로 판별해서 제1 레벨의 선택 신호(SEL)를 출력한다. 선택기(124)는 제1 레벨의 선택 신호(SEL)에 응답해서 제1 변환부(122)로부터 출력되는 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로서 출력한다.
제1 변환부(122)는 홀수 번째 프레임들(F1, F3)에서 제1 영상 신호(RGB1)를 도 7에 도시된 고계조 곡선(HGC)에 대응하는 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)로서 출력한다. 제1 변환부(122)는 짝수 번째 프레임들(F2, F2)에서 제2 영상 신호(RGB2)를 도 7에 도시된 저계조 곡선(LGC)에 대응하는 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)로서 출력한다.
픽셀(PXij) 내 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)은 매 프레임마다 고계조 곡선(HGC) 및 저계조 곡선(LGC)에 대응하는 휘도의 영상을 번갈아 표시하게 된다.
도 9는 영상 신호가 정지 영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 4 및 도 9를 참조하면, 영상 판별부(125)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 비교하고, 선택 신호(SEL)를 출력한다. 영상 판별부(125)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 같을 때 현재 프레임의 제1 영상 신호(RGB1)를 정지 영상으로 판별해서 제2 레벨의 선택 신호(SEL)를 출력한다. 선택기(124)는 제2 레벨의 선택 신호(SEL)에 응답해서 제2 변환부(123)로부터 출력되는 제1 정적 데이터 신호(SDA1) 및 제2 정적 데이터 신호(SDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로서 출력한다.
제2 변환부(123)는 제1 영상 신호(RGB1)를 도 7에 도시된 고계조 곡선(HGC)에 대응하는 제1 정적 데이터 신호(SDA1)로 변환해서 출력하고, 제2 영상 신호(RGB2)를 저계조 곡선(LGC)에 대응하는 제2 정적 데이터 신호(SDA2)로서 출력한다.
따라서 픽셀(PXij) 내 제1 서브 픽셀(PXa)은 고계조 곡선(HGC)에 대응하는 휘도의 영상을 표시하고, 제2 서브 픽셀(PXb)은 저계조 곡선(LGC)에 대응하는 휘도의 영상을 표시하게 된다. 정지 영상이 입력될 때, 하나의 픽셀(PXij) 내 제1 서브 픽셀(PXa)과 제2 서브 픽셀(PXb)이 고계조 곡선(HGC)에 대응하는 휘도의 영상과 저계조 곡선(LGC)에 대응하는 휘도의 영상을 동시에 표시함으로써 표시 패널(110)의 시인성을 향상시킴과 아울러 플리커가 발생하는 것을 방지할 수 있다.
도 10은 외부로부터 제공되는 영상 신호가 정지 영상에서 동영상으로 변화될 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 4 및 도 10을 참조하면, 제1 프레임(F1) 및 제2 프레임(F2)에서 제1 영상 신호(RGB1)가 정지 영상으로 판별될 때 픽셀(PXij) 내 제1 서브 픽셀(PXa)은 고계조 곡선(HGC)에 대응하는 휘도의 영상을 표시하고, 제2 서브 픽셀(PXb)은 저계조 곡선(LGC)에 대응하는 휘도의 영상을 표시한다. 제3 프레임(F3)에서 제1 영상 신호(RGB1)가 동영상으로 판별될 때 픽셀(PXij) 내 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)은 고계조 곡선(HGC)에 대응하는 휘도의 영상을 표시한다. 또한 제4 프레임(F4)에서 제1 영상 신호(RGB1)가 동영상으로 판별될 때 픽셀(PXij) 내 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)은 저계조 곡선(HGC)에 대응하는 휘도의 영상을 표시한다.
특히, 타이밍 컨트롤러(120)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 픽셀 단위로 비교하고, 비교 결과에 따라서 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 출력할 수 있다. 그러므로 매 픽셀마다 최적의 영상을 표시할 수 있다.
도 11은 외부로부터 제공되는 영상 신호에 따라서 표시 패널에 구비된 픽셀들로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 4 및 도 11을 참조하면, 제1 프레임(F1)동안 표시 패널(110)의 제1 영역(A1) 내 픽셀들로 제공되는 영상 신호가 정지 영상으로 판별된 경우, 제1 영역(A1) 내 픽셀들로 제공되는 제1 데이터 신호(DATA1)는 고계조 곡선(HGC)에 대응하는 신호이고, 제2 데이터 신호(DATA2)는 저계조 곡선(LGC)에 대응하는 신호이다. 제1 프레임(F1)동안 표시 패널(110)의 제2 영역(A2) 내 픽셀들로 제공되는 영상 신호가 동영상 영상으로 판별된 경우, 제2 영역(A2) 내 픽셀들로 제공되는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)는 모두 고계조 곡선(HGC)에 대응하는 신호이다.
제1 프레임(F1)과 연속하는 제2 프레임(F2)동안 표시 패널(110)의 제1 영역(A1) 내 픽셀들로 제공되는 영상 신호가 정지 영상으로 판별된 경우, 제1 영역(A1) 내 픽셀들로 제공되는 제1 데이터 신호(DATA1)는 고계조 곡선(HGC)에 대응하는 신호이고, 제2 데이터 신호(DATA2)는 저계조 곡선(LGC)에 대응하는 신호이다. 한편, 제2 프레임(F2)동안 표시 패널(110)의 제2 영역(A2) 내 픽셀들로 제공되는 영상 신호가 동영상 영상으로 판별된 경우, 제2 영역(A2) 내 픽셀들로 제공되는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)는 모두 저계조 곡선(LGC)에 대응하는 신호이다.
이와 같이, 정지 영상이 표시되는 제1 영역(A1) 내 제1 서브 픽셀 및 제2 서브 픽셀로 제공되는 제1 데이터 신호(DATA1)는 고계조 곡선(HGC)에 대응하는 신호이고, 제2 데이터 신호(DATA2)는 저계조 곡선(LGC)에 대응하는 신호이다. 정지 영상이 표시되는 동안 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)는 변경되지 않으므로 플리커가 발생하는 것을 방지할 수 있다.
한편, 동영상이 표시되는 제2 영역(A2) 내 제1 서브 픽셀 및 제2 서브 픽셀로 제공되는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)는 고계조 곡선(HGC)에 대응하는 신호에서 저계조 곡선(LGC)에 대응하는 신호로 변경된다. 매 프레임마다 번갈아 고계조 곡선(HGC) 및 저계조 곡선(LGC)에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 제1 서브 픽셀 및 제2 서브 픽셀로 제공함으로써 사용자의 위치에 따른 시인성의 차이를 감소시킬 수 있다. 그 결과, 표시 패널(110)의 시인성을 전체적으로 향상시킬 수 있다.
도 12는 도 1에 도시된 타이밍 컨트롤러의 본 발명의 다른 실시예에 따른 구성을 보여주는 블록도이다.
도 12를 참조하면, 타이밍 컨트롤러(220)는 더블 프레임 변환부(221), 제1 변환부(222), 제1 선택기(223), 제2 변환부(224), 제2 선택기(225) 및 영상 판별부(226)를 포함한다.
더블 프레임 변환부(221)는 외부로부터 입력되는 영상 신호(RGB)를 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)로 변환한다. 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)는 영상 신호(RGB)와 동일한 신호이며, 영상 신호(RGB)에 비해 2배 빠른 주파수를 갖는다. 예컨대, 영상 신호(RGB)의 주파수가 60Hz인 경우, 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2) 각각의 주파수는 120Hz이다.
제1 변환부(222)는 더블 프레임 변환부(221)로부터의 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)를 입력받고, 동적 데이터 신호(MDA)를 출력한다. 제1 변환부(222)는 고계조 변환부(222_1), 저계조 변환부(222_2) 및 선택기(222_3)를 포함한다. 고계조 변환부(222_1)는 제1 영상 신호(RGB1)를 도 7에 도시된 고계조 곡선(HGC)에 대응하는 고계조 신호(HDA)로 변환한다. 저계조 변환부(222_2)는 제2 영상 신호(RGB2)를 도 7에 도시된 저계조 곡선(LGC)에 대응하는 저계조 신호(LDA)로 변환한다. 선택기(222_3)는 프레임 신호(F)에 응답해서 고계조 신호(HDA) 및 저계조 신호(LDA) 중 어느 하나를 동적 데이터 신호(MDA)로서 출력한다. 따라서, 제1 변환부(222)는 매 프레임마다 고계조 신호(HDA) 및 저계조 신호(LDA)중 어느 하나를 번갈아 동적 데이터 신호(MDA)로서 출력한다.
영상 판별부(226)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 비교하고, 선택 신호(SEL)를 출력한다. 예컨대, 영상 판별부(226)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 다를 때 현재 프레임의 제1 영상 신호(RGB1)를 동영상으로 판별해서 제1 레벨의 선택 신호(SEL)를 출력한다. 영상 판별부(226)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 같을 때 현재 프레임의 제1 영상 신호(RGB1)를 정지 영상으로 판별해서 제2 레벨의 선택 신호(SEL)를 출력한다.
제1 선택기(223)는 인버터(223_1)를 통해 반전된 선택 신호(SEL)에 응답해서 제1 영상 신호(RGB1) 및 동적 데이터 신호(MDA) 중 어느 하나를 중간 데이터 신호(IDA)로서 출력한다. 즉, 제1 영상 신호(RGB1)가 정지 영상인 것으로 판별될 때 제1 선택기(223)는 제1 영상 신호(RGB1)를 중간 데이터 신호(IDA)로서 출력하고, 제1 영상 신호(RGB1)가 동영상인 것으로 판별될 때 제1 선택기(223)는 동적 데이터 신호(MDA)를 중간 데이터 신호(IDA)로서 출력한다.
제2 변환부(224)는 고계조 변환부(224_1) 및 저계조 변환부(224_2)를 포함한다. 고계조 변환부(224_1)는 중간 데이터 신호(IDA)를 도 7에 도시된 고계조 곡선(HGC)에 대응하는 제1 정적 데이터 신호(SDA1)로 변환한다. 저계조 변환부(224_2)는 중간 데이터 신호(IDA)를 도 7에 도시된 저계조 곡선(LGC)에 대응하는 제2 정적 데이터 신호(SDA2)로 변환한다.
제2 선택기(225)는 선택기들(225_1, 225_2)을 포함한다. 선택기(225_1)는 영상 판별부(226)로부터의 선택 신호(SEL)에 응답해서 중간 데이터 신호(IDA) 및 제1 정적 데이터 신호(SDA1) 중 어느 하나를 제1 데이터 신호(DATA1)로서 출력한다. 선택기(225_2)는 영상 판별부(226)로부터의 선택 신호(SEL)에 응답해서 중간 데이터 신호(IDA) 및 제2 정적 데이터 신호(SDA2) 중 어느 하나를 제2 데이터 신호(DATA2)로서 출력한다.
예컨대, 선택 신호(SEL)가 제1 레벨인 경우, 선택기들(225_1, 225_2)은 선택기(223)로부터의 중간 데이터 신호(IDA)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로서 출력한다. 따라서, 제1 영상 신호(RGB1)가 동영상일 때 타이밍 컨트롤러(220)는 매 프레임마다 번갈아 고계조 곡선(HGC) 및 저계조 곡선(LGC) 중 어느 하나에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 출력한다.
선택 신호(SEL)가 제2 레벨인 경우, 선택기(225_1)는 고계조 변환부(324_1)로부터의 제1 정적 데이터 신호(SDA1)를 제1 데이터 신호(DATA1)로 출력하고, 선택기(225_2)는 저계조 변환부(324_2)로부터의 제2 정적 데이터 신호(SDA2)를 제2 데이터 신호(DATA2)로 출력한다. 따라서, 제1 영상 신호(RGB1)가 정지 영상일 때 타이밍 컨트롤러(220)는 고계조 곡선(HGC)에 대응하는 제1 데이터 신호(DATA1)를 출력하고, 저계조 곡선(LGC)에 대응하는 제2 데이터 신호(DATA2)를 출력한다.
도 13은 본 발명의 또다른 실시예에 따른 타이밍 컨트롤러의 구성을 보여주는 블록도이다.
도 13을 참조하면, 타이밍 컨트롤러(320)는 더블 프레임 변환부(321), 제1 변환부(322), 제1 선택기(323), 제2 변환부(323), 제2 선택기(325) 및 영상 판별부(326)를 포함한다.
더블 프레임 변환부(321)는 외부로부터 입력되는 영상 신호(RGB)를 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)로 변환한다. 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)는 영상 신호(RGB)와 동일한 신호이며, 영상 신호(RGB)에 비해 2배 빠른 주파수를 갖는다. 예컨대, 영상 신호(RGB)의 주파수가 60Hz인 경우, 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2) 각각의 주파수는 120Hz이다.
제1 변환부(322)는 고계조 변환부(322_1) 및 저계조 변환부(322_2)를 포함한다. 고계조 변환부(322_1)는 제1 영상 신호(RGB1)를 도 7에 도시된 고계조 곡선(HGC)에 대응하는 고계조 신호(HDA)로 변환한다. 저계조 변환부(322_2)는 제2 영상 신호(RGB2)를 도 7에 도시된 저계조 곡선(LGC)에 대응하는 저계조 신호(LDA)로 변환한다.
제1 선택기(323)는 고계조 신호(HDA) 및 저계조 신호(LDA)를 입력받고, 프레임 신호(F)에 응답해서 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)를 출력한다. 제1 선택기(323)는 선택기들(323_1, 323_2)을 포함한다. 선택기(323_1)는 프레임 신호(F)에 응답해서 고계조 변환부(322_1)로부터의 고계조 신호(HDA) 및 저계조 변환부(322_2)로부터의 저계조 신호(LDA) 중 어느 하나를 제1 동적 데이터 신호(MDA1)로서 출력한다. 선택기(323_2)는 프레임 신호(F)에 응답해서 고계조 변환부(322_1)로부터의 고계조 신호(HDA) 및 저계조 변환부(322_2)로부터의 저계조 신호(LDA) 중 어느 하나를 제2 동적 데이터 신호(MDA2)로서 출력한다.
따라서, 제1 선택기(323)는 매 프레임마다 고계조 신호(HDA) 및 저계조 신호(LDA) 중 어느 하나를 번갈아 제1 동적 데이터 신호(MDA)로서 출력하고, 제2 선택기(323)는 매 프레임마다 저계조 신호(LDA) 및 고계조 신호(HDA) 중 어느 하나를 번갈아 제2 동적 데이터 신호(MDA)로서 출력한다.
제2 변환부(324)는 고계조 변환부(324_1) 및 저계조 변환부(324_2)를 포함한다. 고계조 변환부(324_1)는 제1 영상 신호(RGB1)를 도 7에 도시된 고계조 곡선(HGC)에 대응하는 제1 정적 데이터 신호(SDA1)로 변환한다. 저계조 변환부(224_2)는 제1 영상 신호(RGB1)를 도 7에 도시된 저계조 곡선(LGC)에 대응하는 제2 정적 데이터 신호(SDA2)로 변환한다.
영상 판별부(326)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 비교하고, 선택 신호(SEL)를 출력한다. 예컨대, 영상 판별부(226)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 다를 때 현재 프레임의 제1 영상 신호(RGB1)를 동영상으로 판별해서 제1 레벨의 선택 신호(SEL)를 출력한다. 영상 판별부(326)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 같을 때 현재 프레임의 제1 영상 신호(RGB1)를 정지 영상으로 판별해서 제2 레벨의 선택 신호(SEL)를 출력한다.
제2 선택기(325)는 선택기들(325_1, 325_2)을 포함한다. 선택기(325_1)는 영상 판별부(326)로부터의 선택 신호(SEL)에 응답해서 제1 동적 데이터 신호(MDA1) 및 제1 정적 데이터 신호(SDA1) 중 어느 하나를 제1 데이터 신호(DATA1)로서 출력한다. 선택기(325_2)는 영상 판별부(326)로부터의 선택 신호(SEL)에 응답해서 제2 동적 데이터 신호(MDA2) 및 제2 정적 데이터 신호(SDA2) 중 어느 하나를 제2 데이터 신호(DATA2)로서 출력한다.
예컨대, 선택 신호(SEL)가 제1 레벨인 경우, 선택기들(325_1, 325_2)은 제1 동적 데이터 신호(MDA1)를 제1 데이터 신호(DATA1)로 출력하고, 제2 동적 데이터 신호(MDA2)를 제2 데이터 신호(DATA2)로서 출력한다. 따라서, 제1 영상 신호(RGB1)가 동영상일 때 타이밍 컨트롤러(320)는 매 프레임마다 번갈아 고계조 곡선(HGC) 및 저계조 곡선(LGC) 중 어느 하나에 대응하는 제1 데이터 신호(DATA1) 및 저계조 곡선(LGC) 및 고계조 곡선(HGC) 중 어느 하나에 대응하는 제2 데이터 신호(DATA2)를 출력한다.
선택 신호(SEL)가 제2 레벨인 경우, 선택기(325_1)는 고계조 변환부(324_1)로부터의 제1 정적 데이터 신호(SDA1)를 제1 데이터 신호(DATA1)로 출력하고, 선택기(325_2)는 저계조 변환부(324_1)로부터의 제2 정적 데이터 신호(SDA2)를 제2 데이터 신호(DATA2)로 출력한다. 따라서, 제1 영상 신호(RGB1)가 정지 영상일 때 타이밍 컨트롤러(220)는 고계조 곡선(HGC)에 대응하는 제1 데이터 신호(DATA1)를 출력하고, 저계조 곡선(LGC)에 대응하는 제2 데이터 신호(DATA2)를 출력한다.
도 14는 영상 신호가 동영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 13 및 도 14를 참조하면, 영상 판별부(326)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 비교하고, 선택 신호(SEL)를 출력한다. 예컨대, 영상 판별부(336)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 다를 때 현재 프레임의 제1 영상 신호(RGB1)를 동영상으로 판별해서 제1 레벨의 선택 신호(SEL)를 출력한다. 선택기(325)는 제1 레벨의 선택 신호(SEL)에 응답해서 선택기(323_1)로부터 출력되는 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로서 출력한다.
선택기(323_1)는 홀수 번째 프레임들(F1, F3)에서 고계조 변환부(322_1)로부터의 고계조 신호(HDA)를 제1 동적 데이터 신호(MDA1)로서 출력하고, 짝수 번째 프레임들(F2, F4)에서 저계조 변환부(322_2)로부터의 저계조 신호(LDA)를 제1 동적 데이터 신호(MDA1)로서 출력한다.
선택기(323_2)는 홀수 번째 프레임들(F1, F3)에서 저계조 변환부(322_2)로부터의 저계조 신호(LDA)를 제2 동적 데이터 신호(MDA2)로서 출력하고, 짝수 번째 프레임들(F2, F4)에서 고계조 변환부(322_1)로부터의 고계조 신호(HDA)를 제2 동적 데이터 신호(MDA2)로서 출력한다.
그러므로 픽셀(PXij) 내 제1 서브 픽셀(PXa)은 고계조 곡선(HGC) 및 저계조 곡선(LGC)에 대응하는 휘도의 영상을 매 프레임마다 번갈아 표시하고, 제2 서브 픽셀(PXb)은 저계조 곡선(LGC) 및 고계조 곡선(HGC)에 대응하는 휘도의 영상을 매 프레임마다 번갈아 표시한다.
고계조 곡선(HGC)은 도 1에 도시된 표시 패널(110)의 측면에서의 시인성이 높은 휘도에 해당하며, 저계조 곡선(LGC)은 패널(110)의 정면에서의 시인성이 높은 휘도에 해당한다. 따라서, 매 프레임마다 번갈아 고계조 곡선(HGC) 및 저계조 곡선(LGC)에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)로 제공함으로써 사용자의 위치에 따른 시인성의 차이를 감소시킬 수 있다. 더욱이, 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)로 서로 다른 계조 곡선에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 제공함으로써 표시 패널(110)의 측면 시인성을 더욱 향상시킬 수 있다. 그 결과, 표시 장치(100)의 시인성을 전체적으로 향상시킬 수 있다.
도 15는 영상 신호가 정지 영상일 때 표시 패널에 구비된 소정 픽셀로 제공되는 제1 데이터 신호 및 제2 데이터 신호의 예를 설명하기 위한 도면이다.
도 14 및 도 15를 참조하면, 영상 판별부(326)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 비교하고, 선택 신호(SEL)를 출력한다. 영상 판별부(326)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 같을 때 현재 프레임의 제1 영상 신호(RGB1)를 정지 영상으로 판별해서 제2 레벨의 선택 신호(SEL)를 출력한다. 제2 선택기(325)는 제2 레벨의 선택 신호(SEL)에 응답해서 제2 변환부(123)로부터 출력되는 제1 정적 데이터 신호(SDA1) 및 제2 정적 데이터 신호(SDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로서 출력한다.
제2 변환부(123)는 제1 영상 신호(RGB1)를 도 7에 도시된 고계조 곡선(HGC)에 대응하는 제1 정적 데이터 신호(SDA1)로 변환해서 출력하고, 제2 영상 신호(RGB2)를 저계조 곡선(LGC)에 대응하는 제2 정적 데이터 신호(SDA2)로서 출력한다.
따라서 픽셀(PXij) 내 제1 서브 픽셀(PXa)은 고계조 곡선(HGC)에 대응하는 휘도의 영상을 표시하고, 제2 서브 픽셀(PXb)은 저계조 곡선(LGC)에 대응하는 휘도의 영상을 표시하게 된다. 정지 영상이 입력될 때, 하나의 픽셀(PXij) 내 제1 서브 픽셀(PXa)과 제2 서브 픽셀(PXb)이 고계조 곡선(HGC)에 대응하는 휘도의 영상과 저계조 곡선(LGC)에 대응하는 휘도의 영상을 동시에 표시함으로써 표시 패널(110)의 시인성을 향상시킴과 아울러 플리커가 발생하는 것을 방지할 수 있다.
도 16은 표시 장치에 구비되는 타이밍 컨트롤러의 본 발명의 실시예에 따른 동작 수순을 보여주는 타이밍도이다. 설명의 편의를 위하여 도 2, 도 4를 참조하여 표시 장치의 동작을 설명한다.
도 2, 도 4 및 도 16을 참조하면, 표시 장치에 구비되는 타이밍 컨트롤러(120)는 외부로부터 영상 신호(RGB)를 수신한다(단계 S400). 더블 프레임 변환부(121)는 수신된 영상 신호(RGB)를 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)로 변환한다(S410). 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2)는 영상 신호(RGB)와 동일한 신호이며, 영상 신호(RGB)에 비해 2배 빠른 주파수를 갖는다. 예컨대, 영상 신호(RGB)의 주파수가 60Hz인 경우, 제1 영상 신호(RGB1) 및 제2 영상 신호(RGB2) 각각의 주파수는 120Hz이다.
영상 판별부(125)는 현재 프레임의 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)를 비교해서 제1 영상 신호(RGB1)가 동영상인 지를 판별한다(단계 S420). 예컨대, 영상 판별부(125)는 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 다를 때 현재 프레임의 제1 영상 신호(RGB1)를 동영상으로 판별하고, 제1 영상 신호(RGB1)와 이전 프레임의 제1 영상 신호(P_RGB1)가 서로 같을 때 현재 프레임의 제1 영상 신호(RGB1)를 정지 영상으로 판별한다.
만일 제1 영상 신호(RGB1)가 동영상으로 판별되면, 제1 변환부(122)로부터의 제1 동적 데이터 신호(MDA) 및 제2 동적 데이터 신호(MDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로 각각 출력한다. 제1 동적 데이터 신호(MDA1)는 도 7에 도시된 고계조 곡선(HGC)에 대응하는 신호이고, 제2 동적 데이터 신호(MDA2)는 도 7에 도시된 저계조 곡선(LGC)에 대응하는 신호이다.
만일 제1 영상 신호(RGB1)가 동영상으로 판별되면, 제1 변환부(122)로부터의 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로 각각 출력한다. 홀수 번째 프레임에서 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)는 도 7에 도시된 고계조 곡선(HGC)에 각각 대응하는 신호이고, 짝수 번째 프레임에서 제1 동적 데이터 신호(MDA1) 및 제2 동적 데이터 신호(MDA2)는 도 7에 도시된 저계조 곡선(LGC)에 각각 대응하는 신호이다.
그러므로, 타이밍 컨트롤러(120)는 홀수 번째 프레임에서 고계조 곡선(HGC)에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 출력하고(단계 S430), 짝수 번째 프레임에서 저계조 곡선(LGC)에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 출력한다(단계 S460).
고계조 곡선(HGC)은 표시 패널의 측면에서의 시인성이 높은 휘도에 해당하며, 저계조 곡선(LGC)은 패널의 정면에서의 시인성이 높은 휘도에 해당한다. 따라서, 매 프레임마다 번갈아 고계조 곡선(HGC) 및 저계조 곡선(LGC)에 대응하는 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)를 제1 서브 픽셀(PXa) 및 제2 서브 픽셀(PXb)로 번갈아 제공함으로써 사용자의 위치에 따른 시인성의 차이를 감소시킬 수 있다. 그 결과, 표시 장치의 시인성을 전체적으로 향상시킬 수 있다.
만일 제1 영상 신호(RGB1)가 정지 영상으로 판별되면, 제2 변환부(123)로부터의 제1 정적 데이터 신호(SDA1) 및 제2 정적 데이터 신호(SDA2)를 제1 데이터 신호(DATA1) 및 제2 데이터 신호(DATA2)로 각각 출력한다. 제1 정적 데이터 신호(SDA1)는 고계조 곡선(HGC)에 대응하는 신호이고, 제2 정적 데이터 신호(SDA2)는 저계조 곡선(LGC)에 각각 대응하는 신호이다.
그러므로, 타이밍 컨트롤러(120)는 홀수 번째 프레임에서 고계조 곡선(HGC)에 대응하는 제1 데이터 신호(DATA1) 및 저계조 곡선(LGC)에 대응하는 제2 데이터 신호(DATA2)를 출력하고(단계 S450), 짝수 번째 프레임에서 저계조 곡선(LGC)에 대응하는 제2 데이터 신호(DATA2)를 출력한다(단계 S460).
제1 영상 신호(RGB1)가 정지 영상인 동안 도 2에 도시된 제1 서브 픽셀(PXa)로 고계조 곡선(HGC)에 대응하는 제1 데이터 신호(DATA1)를 제공하고, 제2 서브 픽셀(PXb)로 저계조 곡선(LGC)에 대응하는 제2 데이터 신호(DATA2)를 제공함으로써 플리커 현상을 방지할 수 있다.
100: 표시 장치 110: 표시 패널
120: 타이밍 컨트롤러 130: 게이트 드라이버
140: 데이터 드라이버 150: 메모리
121: 더블 프레임 변환부 122: 제1 변환부
123: 제2 변환부 124: 선택기
125: 영상 판별부 122_1, 123_1: 고계조 변환부
122_2,123_2: 저계조 변환부 122_3: 선택기
221: 더블 프레임 변환부 222: 제1 변환부
223: 제1 선택기 224: 제2 변환부
225: 제2 선택기 226: 영상 판별부
120: 타이밍 컨트롤러 130: 게이트 드라이버
140: 데이터 드라이버 150: 메모리
121: 더블 프레임 변환부 122: 제1 변환부
123: 제2 변환부 124: 선택기
125: 영상 판별부 122_1, 123_1: 고계조 변환부
122_2,123_2: 저계조 변환부 122_3: 선택기
221: 더블 프레임 변환부 222: 제1 변환부
223: 제1 선택기 224: 제2 변환부
225: 제2 선택기 226: 영상 판별부
Claims (20)
- 복수의 게이트 라인들과 복수의 데이터 라인들에 각각 연결된 복수의 픽셀들을 포함하며, 복수의 픽셀들 각각은 제1 서브 픽셀 및 제2 서브 픽셀을 포함하는 표시 패널과;
상기 복수의 게이트 라인들을 구동하는 게이트 드라이버와;
상기 복수의 데이터 라인들을 구동하는 데이터 드라이버; 그리고
상기 게이트 드라이버 및 상기 데이터 드라이버를 제어하며, 외부로부터 입력된 영상 신호에 응답해서 상기 제1 서브 픽셀 및 상기 제2 서브 픽셀을 위한 제1 데이터 신호 및 제2 데이터 신호를 출력하는 타이밍 컨트롤러를 포함하되;
상기 영상 신호가 제1 타입의 영상 신호일 때 상기 제1 데이터 신호 및 상기 제2 데이터 신호는 매 프레임마다 고계조 곡선 및 저계조 곡선 중 어느 하나에 번갈아 대응하고,
상기 영상 신호가 제2 타입의 영상 신호일 때 상기 제1 데이터 신호는 상기 고계조 곡선에 대응하고, 상기 제2 데이터 신호는 상기 저계조 곡선에 대응하는 것을 특징으로 하는 표시 장치. - 제 1 항에 있어서,
상기 타이밍 컨트롤러는,
이전 프레임의 상기 영상 신호와 현재 프레임의 상기 영상 신호가 서로 다른 신호일 때 상기 영상 신호를 상기 제1 타입의 영상 신호로 판별하고, 상기 이전 프레임의 상기 영상 신호와 상기 현재 프레임의 영상 신호가 동일한 신호일 때 상기 영상 신호를 상기 제2 타입의 영상 신호로 판별하는 것을 특징으로 하는 표시 장치. - 제 2 항에 있어서,
상기 타이밍 컨트롤러는,
상기 영상 신호를 상기 고계조 곡선 및 상기 저계조 곡선에 대응하는 제1 동적 데이터 신호 및 제2 동적 데이터 신호로 변환하는 제1 변환부와;
상기 영상 신호를 상기 고계조 곡선 및 상기 저계조 곡선에 대응하는 제1 정적 데이터 신호 및 제2 정적 데이터 신호로 변환하는 제2 변환부와;
상기 이전 프레임의 상기 영상 신호와 상기 현재 프레임의 영상 신호를 비교하고, 비교 결과에 대응하는 선택 신호를 출력하는 영상 판별부; 및
상기 제1 동적 데이터 신호, 상기 제2 동적 데이터 신호, 상기 제1 정적 데이터 신호 및 상기 제2 정적 데이터 신호를 입력받고, 상기 선택 신호에 응답해서 상기 제1 데이터 신호 및 상기 제2 데이터 신호를 출력하는 선택 회로를 포함하는 것을 특징으로 하는 표시 장치. - 제 3 항에 있어서,
상기 제1 변환부는, 제1 프레임동안 상기 고계조 곡선에 각각 대응하는 상기 제1 동적 데이터 신호 및 상기 제2 동적 데이터 신호를 출력하고, 제2 프레임동안 상기 저계조 곡선에 각각 대응하는 상기 제1 동적 데이터 신호 및 상기 제2 동적 데이터 신호를 출력하되,
상기 제1 프레임과 상기 제2 프레임은 시간적으로 연속하는 것을 특징으로 하는 표시 장치. - 제 3 항에 있어서,
상기 제2 변환부는, 상기 고계조 곡선에 대응하는 상기 제1 정적 데이터 신호를 출력하고, 상기 저계조 곡선에 대응하는 상기 제2 정적 데이터 신호를 출력하는 것을 특징으로 하는 표시 장치. - 제 3 항에 있어서,
상기 제1 변환부는,
상기 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 고계조 신호를 출력하는 고계조 변환부와;
상기 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 저계조 신호를 출력하는 저계조 변환부; 및
매 프레임마다 상기 고계조 신호 및 상기 저계조 신호 중 어느 하나를 상기 제1 동적 데이터 신호 및 상기 제2 동적 데이터 신호로서 출력하는 선택기를 포함하는 것을 특징으로 하는 표시 장치. - 제 3 항에 있어서,
상기 제2 변환부는,
상기 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 상기 제1 정적 데이터 신호를 출력하는 고계조 변환부와;
상기 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 상기 제2 정정 데이터 신호를 출력하는 저계조 변환부를 포함하는 것을 특징으로 하는 표시 장치. - 제 2 항에 있어서,
상기 타이밍 컨트롤러는 픽셀 단위로 상기 이전 프레임의 상기 영상 신호와 상기 현재 프레임의 상기 영상 신호를 비교하는 것을 특징으로 하는 표시 장치. - 제 2 항에 있어서,
상기 타이밍 컨트롤러는,
상기 영상 신호를 제1 영상 신호 및 제2 영상 신호로 변환하는 더블 프레임 변환부와;
상기 제1 영상 신호 및 상기 제2 영상 신호를 매 프레임마다 번갈아 상기 고계조 곡선 및 상기 저계조 곡선에 대응하는 동적 데이터 신호로 변환하는 제1 변환부와;
상기 선택 신호에 응답해서 상기 제1 영상 신호 및 상기 동적 데이터 신호 중 어느 하나를 중간 데이터 신호로 출력하는 제1 선택기와;
상기 중간 데이터 신호를 상기 고계조 곡선에 대응하는 제1 정적 데이터 신호 및 상기 저계조 곡선에 대응하는 제2 정적 데이터 신호로 변환하는 제2 변환부; 및
상기 제1 정적 데이터 신호, 상기 제2 정적 데이터 신호 및 상기 중간 데이터 신호를 입력받고, 상기 선택 신호에 응답해서 상기 제1 데이터 신호 및 상기 제2 데이터 신호를 출력하는 제2 선택기를 포함하는 것을 특징으로 하는 표시 장치. - 제 9 항에 있어서,
상기 제1 변환부는,
상기 제1 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 고계조 신호를 출력하는 고계조 변환부와;
상기 제2 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 저계조 신호를 출력하는 저계조 변환부; 및
매 프레임마다 상기 고계조 신호 및 상기 저계조 신호 중 어느 하나를 상기 동적 데이터 신호로서 출력하는 제3 선택기를 포함하는 것을 특징으로 하는 표시 장치. - 제 9 항에 있어서,
상기 제2 변환부는,
상기 중간 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 상기 제1 정적 데이터 신호를 출력하는 고계조 변환부; 및
상기 중간 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 상기 제2 정적 데이터 신호를 출력하는 저계조 변환부를 포함하는 것을 특징으로 하는 표시 장치. - 제 11 항에 있어서,
상기 타이밍 컨트롤러는,
상기 영상 신호를 제1 영상 신호 및 제2 영상 신호로 변환하는 더블 프레임 변환부와;
상기 제1 영상 신호 및 상기 제2 영상 신호를 제1 동적 데이터 신호 및 제2 동적 데이터 신호로 변환하는 제1 변환부와;
상기 중간 데이터 신호를 상기 고계조 곡선에 대응하는 제1 정적 데이터 신호 및 상기 저계조 곡선에 대응하는 제2 정적 데이터 신호로 변환하는 제2 변환부; 및
상기 제1 동적 데이터 신호, 상기 제2 동적 데이터 신호, 상기 제1 정적 데이터 신호 및 상기 제2 정적 데이터 신호를 입력받고, 상기 선택 신호에 응답해서 상기 제1 데이터 신호 및 상기 제2 데이터 신호를 출력하는 선택기를 포함하는 것을 특징으로 하는 표시 장치. - 제 12 항에 있어서,
상기 제1 변환부는,
상기 제1 영상 신호를 입력받고, 상기 고계조 곡선에 대응하는 고계조 신호를 출력하는 고계조 변환부와;
상기 제2 영상 신호를 입력받고, 상기 저계조 곡선에 대응하는 저계조 신호를 출력하는 저계조 변환부; 및
상기 고계조 신호 및 상기 저계조 신호를 상기 제1 동적 데이터 신호 및 상기 제2 동적 데이터 신호로 출력하는 출력부를 포함하되,
상기 출력부는 제1 프레임동안 상기 고계조 신호를 상기 제1 동적 데이터 신호로 출력하고, 상기 저계조 신호를 상기 제2 동적 데이터 신호로 출력하고, 상기 제1 프레임과 연속하는 제2 프레임동안 상기 저계조 신호를 상기 제1 동적 데이터 신호로 출력하고, 상기 고계조 신호를 상기 제2 동적 데이터 신호로 출력하는 것을 특징으로 하는 표시 장치. - 제 1 항에 있어서,
상기 제1 서브 픽셀은 상기 복수의 게이트 라인들 중 제1 게이트 라인 및 상기 복수의 데이터 라인들 중 제1 데이터 라인과 연결되고,
상기 제2 서브 픽셀은 상기 제1 게이트 라인 및 상기 복수의 데이터 라인들 중 제2 데이터 라인과 연결되는 것을 특징으로 하는 표시 장치. - 제 14 항에 있어서,
상기 제1 서브 픽셀은,
상기 제1 데이터 라인과 제1 노드 사이에 연결되고, 상기 제1 게이트 라인과 연결된 게이트를 갖는 제1 트랜지스터; 및
상기 제1 노드와 공통 전압 사이에 연결된 액정 커패시터를 포함하는 것을 특징으로 하는 표시 장치. - 제 14 항에 있어서,
상기 제2 서브 픽셀은,
상기 제2 데이터 라인과 제2 노드 사이에 연결되고, 상기 제1 게이트 라인과 연결된 게이트를 갖는 제2 트랜지스터; 및
상기 제2 노드와 공통 전압 사이에 연결된 액정 커패시터를 포함하는 것을 특징으로 하는 표시 장치. - 영상 신호를 수신하는 단계와;
상기 영상 신호를 제1 영상 신호 및 제2 영상 신호로 변환하는 단계와;
상기 제1 영상 신호의 타입을 판별하는 단계와;
상기 제1 영상 신호가 제1 타입의 영상 신호일 때 매 프레임마다 고계조 곡선 및 저계조 곡선 중 어느 하나에 번갈아 대응하는 제1 데이터 신호 및 제2 데이터 신호를 출력하는 단계; 및
상기 제1 영상 신호가 제2 타입의 영상 신호일 때 상기 고계조 곡선에 대응하는 상기 제1 데이터 신호 및 상기 저계조 곡선에 대응하는 상기 제2 데이터 신호를 출력하는 단계를 포함하는 것을 특징으로 하는 표시 장치의 구동 방법. - 제 17 항에 있어서,
상기 제1 영상 신호의 타입을 판별하는 단계는,
상기 현재 프레임의 상기 제1 영상 신호와 상기 이전 프레임의 상기 제1 영상 신호가 서로 다를 때 상기 제1 영상 신호를 상기 제1 타입의 영상 신호로 판별하고,
상기 현재 프레임의 상기 제1 영상 신호와 상기 이전 프레임의 상기 제1 영상 신호가 서로 같을 때 상기 제1 영상 신호를 상기 제2 타입의 영상 신호로 판별하는 것을 포함하는 것을 특징으로 하는 표시 장치의 구동 방법. - 제 17 항에 있어서,
상기 제1 영상 신호 및 상기 제2 영상 신호 각각의 주파수는 상기 영상 신호의 주파수보다 2배 빠른 것을 특징으로 하는 표시 장치의 구동 방법. - 제 17 항에 있어서,
상기 표시 장치는 제1 서브 픽셀 및 제2 서브 픽셀을 포함하는 적어도 하나의 픽셀을 포함하며,
상기 제1 데이터 신호를 상기 제1 서브 픽셀로 제공하고, 상기 제2 데이터 신호를 상기 제2 서브 픽셀로 제공하는 단계를 더 포함하는 것을 특징으로 하는 표시 장치의 구동 방법.
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