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KR20070115522A - Modem in Mobile Communication System and Interface Method Therefor - Google Patents

Modem in Mobile Communication System and Interface Method Therefor Download PDF

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Publication number
KR20070115522A
KR20070115522A KR1020060050085A KR20060050085A KR20070115522A KR 20070115522 A KR20070115522 A KR 20070115522A KR 1020060050085 A KR1020060050085 A KR 1020060050085A KR 20060050085 A KR20060050085 A KR 20060050085A KR 20070115522 A KR20070115522 A KR 20070115522A
Authority
KR
South Korea
Prior art keywords
data
digital signal
modem
signal processor
channel decoder
Prior art date
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Withdrawn
Application number
KR1020060050085A
Other languages
Korean (ko)
Inventor
강환민
김헌기
류준상
이정길
Original Assignee
삼성전자주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 삼성전자주식회사 filed Critical 삼성전자주식회사
Priority to KR1020060050085A priority Critical patent/KR20070115522A/en
Publication of KR20070115522A publication Critical patent/KR20070115522A/en
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
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Abstract

본 발명은 이동 통신 시스템에서의 SDR 기반의 기저 대역 모뎀 및 이를 위한 인터페이스 방법에 관한 것으로, 본 발명의 기저 대역 모뎀은 소프트웨어 기반으로 복수의 무선 표준을 지원하는 모뎀으로, 상기 복수의 무선 표준 중 지정된 표준에 따라 재구성되는 송수신 필터와 채널 디코더를 구비하는 하드웨어 블록과, 상기 하드웨어 블록과 연동되고 상기 지정된 표준에 따라 소정 시스템 파라미터를 변경하여 상기 하드웨어 블록을 재구성하는 디지털 신호 처리부를 포함함을 특징으로 한다. 상기 기저 대역 모뎀내의 인터페이스 방법은 변복조 및 채널 추정을 수행하는 디지털 신호 처리부에서 채널 디코딩할 데이터 발생시 채널 디코더로부터 상기 데이터의 전송여부를 확인하는 제1과정과, 상기 디지털 신호 처리부에서 상기 데이터가 전송 준비가 완료되면 상기 데이터를 상기 채널 디코더로 전송하는 제 2과정과, 상기 채널 디코더에서 상기 데이터의 디코딩이 완료되면 상기 디지털 신호 처리부로 인터럽트 신호 전송후, 상기 디코딩된 데이터를 전송하는 제 3과정을 포함함을 특징으로 한다.The present invention relates to an SDR-based baseband modem and an interface method for the same in a mobile communication system. The baseband modem of the present invention is a modem that supports a plurality of wireless standards based on software and is designated among the plurality of wireless standards. And a hardware block including a transmission / reception filter and a channel decoder reconfigured according to a standard, and a digital signal processor interworking with the hardware block and reconfiguring the hardware block by changing a predetermined system parameter according to the specified standard. . The interface method in the baseband modem includes a first process of confirming whether or not the data is transmitted from a channel decoder when a data to be decoded is generated by a digital signal processor that performs modulation and demodulation and channel estimation, and the digital signal processor prepares the data for transmission. And a second process of transmitting the data to the channel decoder when the data decoding is completed, and a third process of transmitting the decoded data after transmitting an interrupt signal to the digital signal processor when decoding of the data is completed in the channel decoder. It is characterized by.

본 발명은 DSP를 이용하여 SDR 시스템을 구현할 때, 하드웨어와 소프트웨어의 역할을 효율적으로 분담함으로써, 지속적으로 변하는 표준에 대해서 빠르게 대처할 수 있고, 저전력에 대한 방안 및 효율적인 단말 모뎀을 구현할 수 있는 효과가 있다.When the SDR system is implemented using a DSP, the present invention efficiently shares the roles of hardware and software, thereby quickly coping with constantly changing standards, and has an effect of implementing a low power scheme and an efficient terminal modem. .

Description

이동 통신 시스템에서의 모뎀 및 이를 위한 인터페이스 방법{MODEM IN MOBILE COMMUNICATION SYSTEM AND INTERFACING METHOD THEREOF}MODEM IN MOBILE COMMUNICATION SYSTEM AND INTERFACING METHOD THEREOF}

도 1은 이동 통신 시스템의 단말에서의 일반적인 모뎀 구조를 나타낸 도면1 illustrates a general modem structure in a terminal of a mobile communication system.

도 2는 본 발명에 따라 SDR 단말 모뎀내의 CC를 나타낸 도면2 is a diagram illustrating a CC in an SDR terminal modem according to the present invention.

도 3은 본 발명에 따른 SDR 모뎀을 나타낸 도면3 illustrates an SDR modem according to the present invention.

도 4는 본 발명의 실시예에 따른 SDR 모뎀을 나타낸 도면4 illustrates an SDR modem according to an embodiment of the present invention.

도 5a 및 도 5b는 본 발명의 SDR 모뎀에서의 인터페이스 방법을 나타낸 신호 흐름도5A and 5B are signal flow diagrams illustrating an interface method in an SDR modem of the present invention.

본 발명은 이동 통신 시스템에서의 모뎀에 관한 것으로, 특히 이동 통신 시스템에서의 SDR 기반의 기저 대역 모뎀 및 이를 위한 인터페이스 방법에 관한 것이다.The present invention relates to a modem in a mobile communication system, and more particularly, to an SDR-based baseband modem and an interface method therefor in a mobile communication system.

최근 이동 통신 시스템은 2세대 및 3세대 서비스는 물론, 무선 LAN, 휴대 인터넷, 블루투스(Bluetooth), 홈네트워크(Home Network), 애드혹 네트워크(Ad-hoc Network), 디지털 방송 등 다양한 방식의 무선 및 이동통신 서비스가 사용자에게 많은 편리성을 제공하고는 있다. 그러나 다른 측면에서 이종 표준 및 이종 프로토콜이 혼재함에 따른 사용자의 혼란도 큰 문제시 되고 있다. 더욱이 음성은 물론 데이터, 텍스트, 이미지, 오디오, 비디오 등 매우 다양한 서비스가 사용자 개인의 선택에 의해 제공될 수 있는 환경이 요구되고 있다.In recent years, mobile communication systems are not only second generation and third generation services, but also wireless and mobile in various ways such as wireless LAN, portable Internet, Bluetooth, Home Network, Ad-hoc Network, digital broadcasting, etc. Communication services provide a lot of convenience to users. However, the confusion of users due to the mixed heterogeneous standards and heterogeneous protocols is also a big problem. Furthermore, there is a demand for an environment in which a wide variety of services such as data, text, images, audio, and video as well as voice can be provided by a user's personal choice.

최근 4세대 이동 통신 서비스를 위한 연구개발 및 다양한 표준화 작업이 활발히 진행되고 있는 가운데, 몇 가지 주요 이슈를 살펴보면 다음과 같다. 첫째, 서비스의 통합(Convergence)을 들 수 있겠다. 즉 차세대 이동 통신 시스템에서 요구되는 부분은 올 아이피(All-IP) 기반의 코어(core) 네트워크와, 어디서나 접속이 가능함(Always being connected)을 목표로 하여 어디에서나 서비스 접속 즉 유비쿼터스 접속(Ubiquitous Access)이 가능하고 어디에서도 끊김이 없는 접속(Seamless Access)을 구현하고자 하는 부분, 그리고 첨단 통신 단말기 간 가까운 범위 내에서의 연결(Short Range Connectivity)을 실현하는 부분이 요구된다. 둘째, 재구성이 가능한(Reconfigurable) 네트워크 및 단말기에 대한 요구의 등장이라 하겠다. 이를 통해 상호 운영성(Interoperability)은 물론 다양하고 재미있는 응용이 가능해 질 것이다. 마지막으로, 사용자 개개인에 대한 맞춤형 서비스가 요구되고 있는데, 여기에는 컨텐츠, 가격, 그리고 서비스 품질(Quality Of Service : QoS) 등을 포함한다.Recently, R & D and various standardization work for 4G mobile communication service are actively progressing. Here are some major issues. First is the convergence of services. In other words, the next-generation mobile communication system requires all-IP based core networks and ubiquitous access from anywhere with the goal of always being connected. Where possible, there is a need to implement seamless access and to achieve short range connectivity between advanced communication terminals. Second, the emergence of demand for reconfigurable networks and terminals. This will enable interoperability as well as a variety of interesting applications. Finally, customized services for individual users are required, which include content, price, and quality of service (QoS).

이렇듯 4세대 이동 통신 시스템에 단말은 다양한 프로토콜에 대해 적용되는 모뎀을 구비하여야 한다. 그러면 현재 일반적인 이동 통신 시스템의 단말의 모뎀을 살펴보기로 한다.As described above, the terminal in the fourth generation mobile communication system should be provided with a modem applied for various protocols. Next, a modem of a terminal of a general mobile communication system will be described.

도 1은 이동 통신 시스템의 단말에서의 일반적인 모뎀 구조를 나타낸 도면으로, ASIC(Application Specific Integrated Circuit) 블록 송신부를 나타낸 도면이다.FIG. 1 is a diagram illustrating a general modem structure in a terminal of a mobile communication system, and illustrates an ASIC block transmitter.

도 1을 참조하면, 마이크로프로세서부(10)는 전체 기저대역 처리부(20)와 RF 처리부(30)를 제어하는 기능을 한다. 단말의 기저대역 처리부(20)는 마이크로프로세서부(10)에 의해서 생성된 신호처리 메시지를 버퍼(21)에 저장하고, 채널 부호기(22)를 통해 데이터를 채널 부호화 및 인터리빙 한 후, 변조기(23) 및 필터(24)를 통해 부호화된 신호를 변조하여 필터링한다. 이와 같이 송신 신호는 대역 처리를 통해서 기저대역 신호로 변환되어 디지털 아날로그 변환기(Digital to Analog Convertor : DAC)(31)를 통해 디지털 신호로 변환된다. 이후, 변환된 디지털 신호는 고주파 변조기(32) 및 전력 증폭기(33)를 통해 고주파 변환되어 듀플렉서(40) 및 안테나(50)를 거쳐 송신된다.Referring to FIG. 1, the microprocessor unit 10 functions to control the entire baseband processor 20 and the RF processor 30. The baseband processor 20 of the terminal stores the signal processing message generated by the microprocessor unit 10 in the buffer 21, and after channel encoding and interleaving data through the channel encoder 22, the modulator 23. And the coded signal through the filter 24 is modulated and filtered. In this manner, the transmission signal is converted into a baseband signal through band processing and converted into a digital signal through a digital to analog converter (DAC) 31. Thereafter, the converted digital signal is high frequency converted through the high frequency modulator 32 and the power amplifier 33 and transmitted through the duplexer 40 and the antenna 50.

상술한 바와 같은 종래의 단말 모뎀은 저전력을 위해서 ASIC 형태의 하드웨어 기반으로 하고 있기 때문에 유연성이 떨어진다.The conventional terminal modem as described above is inflexible because it is based on the hardware of the ASIC type for low power.

즉 종래의 단말 모뎀은 ASIC 형태로 구현되어 있기 때문에, 새롭게 개발이 진행 중인 다양한 규격에 적응하기 위해 하드웨어를 새롭게 디자인을 해야 하며, 표준간, 지역간의 상호 접속(Seamless roaming)을 위해 여러 표준에 맞게 각각 개발이 되어진 ASIC 칩들을 모두 하나의 단말기에 넣어야만 한다. 그러나 이러한 경우, ASIC 칩은 하드웨어로 구성되는 고가의 장비이므로 단말 모뎀에서 요구되는 조 건인 저전력, 소형화, 저가격 등에 많은 문제점에 봉착하게 된다. 게다가 처음부터 복수 표준을 지원하기 위한 ASIC을 새롭게 개발을 해야 할 경우 너무 많은 개발 기간과 비용이 든다는 문제점을 갖고 있다.That is, the conventional terminal modem is implemented in the form of ASIC, so it is necessary to redesign the hardware to adapt to various standards under development, and to meet the various standards for seamless roaming between standards. Each developed ASIC chip must be put into one terminal. However, in this case, since the ASIC chip is an expensive device composed of hardware, many problems such as low power, miniaturization, and low price are required. In addition, the need for new development of ASICs to support multiple standards from the outset is too much development time and cost.

또한 기존 ASIC 형태의 단말 모뎀 구조는 다양한 표준이 공존하고, 사용자의 다중모드 단말에 대한 요구가 늘어남에 따라 유연성있게 대처하기가 힘든 실정이다. 특히 표준이 아직 미확정인 경우, 지속적으로 변하는 스펙(Spec)으로 ASIC을 구현하기에는 너무 많은 위험요소가 있고, 표준이 완성되기 까지 기다려야 하기 때문에 시장의 요구에 적절하게 대응하기가 매우 어려운 문제점이 발생한다.In addition, the existing ASIC-type terminal modem structure coexists with various standards, and it is difficult to flexibly cope with user's demand for multi-mode terminal. In particular, if the standard is still undecided, there are too many risks to implement ASICs with constantly changing specifications, and it is very difficult to properly respond to market demands because the standards have to be waited for to be completed. .

따라서 본 발명의 목적은 이동 통신 시스템에서의 다양한 형태의 시스템에 적용이 가능한 유연성있는 기저 대역 모뎀 및 그 모뎀내의 인터페이스 방법을 제공함에 있다.Accordingly, an object of the present invention is to provide a flexible baseband modem applicable to various types of systems in a mobile communication system and an interface method therein.

본 발명의 다른 목적은 이동 통신 시스템에서 효율성이 높은 기저 대역 모뎀 및 그 모뎀내의 인터페이스 방법을 제공함에 있다.Another object of the present invention is to provide a baseband modem having high efficiency in a mobile communication system and an interface method therein.

본 발명의 또다른 목적은 이동 통신 시스템에서 가격 경쟁력을 갖는 기적 대역 모뎀 및 그 모뎀내의 인터페이스 방법을 제공함에 있다. It is another object of the present invention to provide a miracle band modem and an interface method within the modem, which are cost competitive in a mobile communication system.

본 발명의 또다른 목적은 이동 통신 시스템에서 고속, 저전력 DSP와 재구성 가능한 프로세서(Reconfigurable Processor)을 이용하여 소프트웨어와 하드웨어 모뎀의 역할을 효율적으로 분배할 수 있는 모뎀 및 그에 따른 인터페이스 방법을 제 공함에 있다.Another object of the present invention is to provide a modem and an interface method for efficiently distributing the roles of software and hardware modem by using a high speed, low power DSP and a reconfigurable processor in a mobile communication system. .

상술한 바를 달성하기 위한 본 발명은 소프트웨어 기반으로 복수의 무선 표준을 지원하는 이동 단말의 모뎀에 있어서, 상기 복수의 무선 표준 중 지정된 표준에 따라 재구성되는 송수신 필터와 채널 디코더를 구비하는 하드웨어 블록과, 상기 하드웨어 블록과 연동되고 상기 지정된 표준에 따라 소정 시스템 파라미터를 변경하여 상기 하드웨어 블록을 재구성하는 디지털 신호 처리부를 포함함을 특징으로 한다.According to an aspect of the present invention, there is provided a modem of a mobile terminal that supports a plurality of wireless standards based on software, comprising: a hardware block including a transmit / receive filter and a channel decoder reconfigured according to a specified standard among the plurality of wireless standards; And a digital signal processor interworking with the hardware block and reconfiguring the hardware block by changing a predetermined system parameter according to the specified standard.

상기 하드웨어 블록은 송수신 신호를 디지털 및 아날로그 신호로 변환하는 아날로그 코어부와, 상기 아날로그 코어로부터 전송된 신호를 필터링을 수행하는 필터부와, 상기 디지털 신호 처리부로부터 전송된 신호에 대해 채널 디코딩을 수행하는 하드웨어 가속기를 포함함을 특징으로 한다.The hardware block may include an analog core unit for converting transmission / reception signals into digital and analog signals, a filter unit for filtering a signal transmitted from the analog core, and a channel decoding for the signal transmitted from the digital signal processor. It includes a hardware accelerator.

상기 디지털 신호 처리부는 상기 수신 신호에 대한 변복조 및 채널 추정을 수행함을 특징으로 한다.The digital signal processor may perform demodulation and channel estimation on the received signal.

상술한 바를 달성하기 위한 본 발명은 소프트웨어 기반으로 복수의 무선 표준을 지원하는 이동 단말의 모뎀내의 인터페이스 방법에 있어서, 변복조 및 채널 추정을 수행하는 디지털 신호 처리부에서 채널 디코딩할 데이터 발생시 채널 디코더로부터 상기 데이터의 전송여부를 확인하는 제1과정과, 상기 디지털 신호 처리부에서 상기 데이터가 전송 준비가 완료되면 상기 데이터를 상기 채널 디코더로 전송하는 제 2과정과, 상기 채널 디코더에서 상기 데이터의 디코딩이 완료되면 상기 디지털 신호 처리부로 인터럽트 신호 전송후, 상기 디코딩된 데이터를 전송하는 제 3 과정을 포함함을 특징으로 한다.According to an aspect of the present invention, there is provided an interface method in a modem of a mobile terminal that supports a plurality of wireless standards based on software, and wherein the data is generated from a channel decoder when data is to be decoded by a digital signal processor that performs modulation and demodulation and channel estimation. A first step of confirming whether or not to transmit the data, a second step of transmitting the data to the channel decoder when the data is ready to be transmitted by the digital signal processor, and when the decoding of the data is completed by the channel decoder, And after transmitting the interrupt signal to the digital signal processor, transmitting the decoded data.

상기 제 1과정은 상기 디지털 신호 처리부에서 상기 채널 디코더의 입력버퍼의 상태를 확인하는 과정과, 상기 디지털 신호 처리부에서 상기 데이터의 전송 방향을 확인하는 과정을 포함함을 특징으로 한다.The first process may include checking a state of an input buffer of the channel decoder in the digital signal processor, and checking a transmission direction of the data in the digital signal processor.

이하 본 발명의 바람직한 실시 예들의 상세한 설명이 첨부된 도면들을 참조하여 설명될 것이다. 도면들 중 동일한 구성들은 가능한 한 어느 곳에서든지 동일한 부호들을 나타내고 있음을 유의하여야 한다. 하기 설명에서 구체적인 특정사항들이 나타나고 있는데, 이는 본 발명의 보다 전반적인 이해를 돕기 위해 제공된 것이다. 그리고 본 발명을 설명함에 있어, 관련된 공지 기능 혹은 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명을 생략한다.DETAILED DESCRIPTION Hereinafter, detailed descriptions of preferred embodiments of the present invention will be described with reference to the accompanying drawings. It should be noted that the same components in the figures represent the same numerals wherever possible. Specific details are set forth in the following description, which is provided to aid a more general understanding of the invention. In the following description of the present invention, if it is determined that a detailed description of a related known function or configuration may unnecessarily obscure the subject matter of the present invention, the detailed description thereof will be omitted.

본 발명에서는 4세대 이동 통신 서비스에서 요구되는 부분을 기술적 측면, 서비스 측면, 산업적 측면에서 만족하기 위해 소프트웨어 기반 라디오(Software Defined Radio : SDR) 기술을 사용한다. 상기 SDR 기술은 첨단 디지털 신호처리 기술과 고성능 디지털 신호처리 소자를 기반으로 하드웨어 수정 없이 모듈화된 소프트웨어 변경만으로 단일의 송수신 시스템을 통해 다수의 무선 통신 규격을 통합·수용하기 위한 무선 접속 기반 기술이다.In the present invention, a software defined radio (SDR) technology is used to satisfy a part required in the fourth generation mobile communication service in technical, service, and industrial aspects. The SDR technology is a wireless connection-based technology for integrating and accepting multiple wireless communication standards through a single transmission / reception system with only a modular software change without hardware modification based on advanced digital signal processing technology and high performance digital signal processing device.

이에 따라 본 발명은 다양한 표준을 가지는 이동 통신 시스템에 적용할 수 있는 시스템을 구현하기 위해 재구성이 가능한 SDR 기반의 단말 모뎀을 제안한다. 이하 설명에서는 기저 대역 처리를 위한 SDR 기반의 단말 모뎀을 SDR 모뎀이라 칭하기로 한다. 본 발명에서의 SDR 모뎀을 구현하기 위해서 필터와 채널 디코더와 같이 단순 반복적이고, 연산량이 많은 일부 블록을 하드웨어로 구현한다. 즉 상기 SDR 기반의 단말 모뎀을 효율적으로 구현하기 위해 고성능, 저전력의 디지털 신호 프로세서(Digital Signal Processor : DSP)와 유연성이 뛰어난 컴패니언 칩(Companion Chip : CC)을 결합하여 구현함을 특징으로 한다. 여기서 상기 CC는 본 발명에서 제안한 칩으로 재구성이 가능한 SDR 기반의 칩을 의미한다.Accordingly, the present invention proposes a reconfigurable SDR based terminal modem to implement a system applicable to a mobile communication system having various standards. In the following description, an SDR-based terminal modem for baseband processing will be referred to as an SDR modem. In order to implement the SDR modem in the present invention, some blocks, such as a filter and a channel decoder, which are simple, repetitive and have a large amount of computation, are implemented in hardware. That is, in order to efficiently implement the SDR-based terminal modem, a high performance, low power digital signal processor (DSP) and a flexible companion chip (Companion Chip: CC) are implemented. Here, CC refers to an SDR-based chip that can be reconfigured into a chip proposed in the present invention.

이하 설명에서는 상기 CC에 대해 우선 설명한 후, 상기 CC와 DSP가 연동된 구조의 기저대역 모뎀을 설명하기로 한다. In the following description, the CC will be described first, and then a baseband modem having a structure in which the CC and the DSP are interworked will be described.

도 2는 본 발명에 따라 SDR 기반의 단말 모뎀에 사용되는 CC(200)를 나타낸 도면이다.2 is a diagram illustrating a CC (200) used for an SDR-based terminal modem in accordance with the present invention.

도 2를 참조하면, CC(200)는 아날로그 코어부(210), 필터부(220), 하드웨어 가속기(Hardware Accelerator)(230)를 포함한다. 상기 아날로그 코어부(210)는 아날로그 신호를 디지털 신호로 변환하는 변환기(Analog to Digital Converter : ADC), 디지털 신호를 아날로그 신호로 변환하는 변환기(Digital to Analog Converter : DAC) 등이 포함될 수 있다. 상기 필터부(220)는 재구성이 가능한 프론트 엔드단(Reconfigurable front-end)으로서, 보간 필터(Interpolation Filter), 데시메이션 필터(Decimation Filter)등이 포함될 수 있다.Referring to FIG. 2, the CC 200 includes an analog core unit 210, a filter unit 220, and a hardware accelerator 230. The analog core unit 210 may include a converter for converting an analog signal into a digital signal (Analog to Digital Converter (ADC)), a converter for converting a digital signal into an analog signal (Digital to Analog Converter (DAC)) and the like. The filter unit 220 is a reconfigurable front end, and may include an interpolation filter, a decimation filter, and the like.

상기 하드웨어 가속기(230)도 재구성이 가능한 블록으로서, 채널 디코더 등 이 포함 될 수 있다. The hardware accelerator 230 may also be a reconfigurable block, and may include a channel decoder.

상기와 같이 본 발명의 CC(200)중 필터부(220)와 하드웨어 가속기(230)는 CDMA 시스템, WCDMA 시스템, OFDM 시스템 등을 유연하게 구현할 수 있도록 각 블록들이 시스템에 맞게 재구성이 가능하도록 설계 될 수 있다.As described above, the filter unit 220 and the hardware accelerator 230 of the CC 200 of the present invention may be designed such that each block can be reconfigured according to the system to flexibly implement a CDMA system, a WCDMA system, an OFDM system, and the like. Can be.

그러면 본 발명의 CC(200)를 이용하는 SDR 모뎀을 설명하기로 한다.Next, an SDR modem using the CC 200 of the present invention will be described.

도 3은 본 발명에 따른 기저 대역 모뎀(300)을 나타낸 도면으로, 상기 CC(200)와 DSP 칩(240)을 결합된 구조를 나타내었다. 도 3을 참조하면, 본 발명의 기저대역 모뎀(300)은 상기 CC(200)와 DSP(310)와 연동하여 하나의 통신 모뎀으로 동작하는 구조를 갖는다.3 is a diagram illustrating a baseband modem 300 according to the present invention, and shows a structure in which the CC 200 and the DSP chip 240 are combined. Referring to FIG. 3, the baseband modem 300 of the present invention has a structure in which the baseband modem 300 operates as one communication modem in conjunction with the CC 200 and the DSP 310.

상기 CC(200)는 SDR 기반의 통신 모뎀을 구현하기 위해 재구성이 가능한 칩으로 구성되고, 단순 반복적이면서 연산량이 많은 부분을 담당한다. 상기 DSP(310)은 데이터 처리 방법에 있어 연산식이 매우 복잡하고 자주 바뀌는 데이터 처리를 담당하게 된다. 즉 단순 반복적이면서 연산량이 많은 부분을 재구성이 가능한 CC을 적용하고, 연산식이 복잡하면서 연산량이 많은 부분을 DSP(310)에 처리함으로써 다양한 표준을 지원하고, 유연성 및 효율성을 높일 수 있게 된다. 예컨대 상기 CC는 송수신 필터 및 디코더와 같은 블록을 구현하고, 상기 DSP에서는 변조 및 채널 추정 연산등을 담당할 수 있다.The CC 200 is configured as a reconfigurable chip to implement an SDR-based communication modem, and is responsible for a simple repetitive and a large amount of computation. The DSP 310 is responsible for data processing in which a calculation formula is very complicated and frequently changes in a data processing method. In other words, by applying a CC that can be reconfigured for a simple iterative and a large amount of calculation, and processing a large amount of arithmetic and a large amount of calculation to the DSP 310 to support a variety of standards, it is possible to increase the flexibility and efficiency. For example, the CC implements a block such as a transmission / reception filter and a decoder, and the DSP may be responsible for modulation and channel estimation operations.

여기서 상기 CC는 시스템 파라미터(System Parameter)의 변경만으로 다양한 표준에 적합한 재구성 가능한 필터(Reconfigurable Filter) 및 채널 디코더(Reconfigurable Channel Decoder) 형태의 재구성 가능한 프로세 서(Reconfigurable Processor)로 구현된다. 이러한 시스템 파라미터는 DSP에서 레지스터(Register)값으로 설정해주면 구성(Configuration)이 변경될 수 있는 구조를 갖는다.Here, the CC is implemented as a reconfigurable processor in the form of a reconfigurable filter and a channel decoder reconfigurable channel suitable for various standards only by changing a system parameter. Such a system parameter has a structure in which the configuration can be changed by setting the register value in the DSP.

그러면 본 발명에 따른 모뎀을 실제 적용한 일례를 다음의 도 4를 이용하여 설명하기로 한다.Next, an example of actually applying a modem according to the present invention will be described with reference to FIG. 4.

도 4에 도시된 바와 같이, 본 발명의 SDR 모뎀(300)은 다음과 같이 각각 적용할 수 있다. 도 3의 아날로그 코어부(210) 부분은 ADC(201), DAC(203)로 나타내고, 필터부(220)는 재구성이 가능한 수신 필터(Reconfigurable Rx filter)(221)와 송신 필터(Reconfigurable Tx filter)(223)로 나눠서 나타낼 수 있다. 하드웨어 가속기(230)는 재구성이 가능한 채널 디코더(Reconfigurable Channel Decoder)라 나타낼 수 있다.As shown in Figure 4, the SDR modem 300 of the present invention can be applied to each as follows. The analog core part 210 of FIG. 3 is represented by the ADC 201 and the DAC 203, and the filter part 220 is a reconfigurable Rx filter 221 and a reconfigurable Tx filter. Can be divided by (223). The hardware accelerator 230 may be referred to as a reconfigurable channel decoder.

도 4의 SDR 모뎀(400)을 이용하여 이동 통신 시스템의 데이터 처리 방법을 설명한다. 도 4를 참조하면, RF단(Radio Frequency)(미도시)에서 수신된 I/Q 신호는 ADC(201)에 의해서 샘플링과 양자화가 되어 디지털 신호로 변환된다. 상기 변환된 디지털 신호는 수신 필터(221)로 입력되어 각 표준에 정의된 수신 필터에 의해 필터링 되고, 상기 필터 출력 신호를 DSP(310)로 전달한다. 상기 DSP(310)는 상기 수신 필터(221)로부터 전달된 신호를 이동 통신 시스템에 사용되는 복조 방법에 따라 복조 및 채널 추정 기능등을 수행한다. 상기 복조된 신호는 다시 채널 디코딩을 위해서 본 발명의 CC의 채널 디코더(330)로 전송된다. 상기 채널 디코더(330)는 상기 전송된 신호를 디코딩한후 디코딩 데이터를 다시 DSP(310)로 전송하면 모든 통 신 시스템에 대한 수신 과정을 마치게 된다. 이러한 과정은 DSP 코드의 변경만으로 모든 이동 통신 시스템에 적용될 수 있다. 예를 들어, CDMA용 DSP 코드를 다운로드하면 CDMA 방식으로 DSP가 동작하고, GSM용 DSP 코드를 다운로드하면 GSM 방식으로 DSP가 동작한다. 그러므로 DSP는 소프트웨어의 교체만으로써 ASIC에서 담당하는 모뎀과 동일하게 구현될 수 있다. 여기서 송신 방법은 수신 방법과 역으로 수행하면 되므로 생략하기로 한다.The data processing method of the mobile communication system will be described using the SDR modem 400 of FIG. Referring to FIG. 4, an I / Q signal received at an RF stage (not shown) is sampled and quantized by the ADC 201 and converted into a digital signal. The converted digital signal is input to the reception filter 221 and filtered by the reception filter defined in each standard, and transmits the filter output signal to the DSP 310. The DSP 310 performs a demodulation and channel estimation function according to a demodulation method used in a mobile communication system for the signal transmitted from the reception filter 221. The demodulated signal is again transmitted to the channel decoder 330 of the CC of the present invention for channel decoding. The channel decoder 330 decodes the transmitted signal and transmits the decoded data back to the DSP 310 to complete the reception process for all communication systems. This process can be applied to all mobile communication systems only by changing the DSP code. For example, when the DSP code for CDMA is downloaded, the DSP operates in the CDMA manner, and when the DSP code for GSM is downloaded, the DSP operates in the GSM manner. Thus, the DSP can be implemented just like the modem in the ASIC by replacing software. In this case, since the transmission method is performed in the inverse of the reception method, it will be omitted.

상술한 바와 같이 본 발명에 따른 SDR 모뎀(400)은 필터(220) 및 디코더(230)와 같은 하드웨어 블록을 재구성이 가능한 CC(200)로 구현하고, 변조 및 채널 추정등의 복잡한 연산량 처리를 전담하는 DSP(310)을 연동하는 구조이다. 이에 따라 상기 CC(200)와 DSP(310)과의 인터페이스 방법이 필요하다. 이에 대해서는 다음의 도 5a 및 도 5b를 이용하여 설명하기로 한다.As described above, the SDR modem 400 according to the present invention implements a hardware block such as the filter 220 and the decoder 230 as a reconfigurable CC 200, and is responsible for processing complex calculations such as modulation and channel estimation. It is a structure for interlocking the DSP 310. Accordingly, an interface method between the CC 200 and the DSP 310 is required. This will be described with reference to FIGS. 5A and 5B.

도 5a 및 도 5b는 본 발명의 SDR 모뎀에서의 인터페이스 방법을 나타낸 신호 흐름도로, 채널 디코더(230)와 DSP(310)간의 경우를 나타내었다. 여기서 상기 채널 디코더(230)는 와이맥스/와이브로(WiMax/WiBro) 시스템의 채널 디코더인 컨벌루션 터보 코드(Convolutional Turbo Code : CTC)라고 가정하였고, 상기 DSP(310)은 ARM 코어(Advanced RISC Machine)가 내장되어 있고, PSD(Parallel Streaming Data) 인터페이스 및 MPMC(Multi-Port Memory Controller) 인터페이스를 갖고 있다고 가정하였다. 상기 PSD(Parallel Streaming Data) 인터페이스라 함은 데이터 클럭(Clock)에 따라 16비트(bit) 또는 그 이상의 데이터 비트가 동시에 전송되는 인터페이스이다. 본 발명에서 제안하는 것은 CC(200)과 DSP(310) 간의 다량의 데이터 전송을 위해서는 PSD 인터페이스를 주로 사용하고, CC(200)의 레지스터(Register)를 리드/라이트(Read/Write) 할 경우에는 MPMC 인터페이스를 주로 사용하는 것을 제안한다. 그러나 전송하고자 하는 데이터 전송량 및 속도에 따라서 MPMC 인터페이스를 데이터 전송을 위한 인터페이스로도 사용될 수 있다.5A and 5B are signal flow diagrams illustrating an interface method of the SDR modem according to the present invention, and show a case between the channel decoder 230 and the DSP 310. Here, the channel decoder 230 is assumed to be a convolutional turbo code (CTC), which is a channel decoder of a WiMax / WiBro system, and the DSP 310 has an ARM core (Advanced RISC Machine) embedded therein. It is assumed that the system has a Parallel Streaming Data (PSD) interface and a Multi-Port Memory Controller (MPMC) interface. The Parallel Streaming Data (PSD) interface is an interface through which 16 bits or more data bits are simultaneously transmitted according to a data clock. In the present invention, the PSD interface is mainly used for transferring a large amount of data between the CC 200 and the DSP 310, and in the case of reading / writing a register of the CC 200, It is suggested to mainly use the MPMC interface. However, depending on the amount and speed of data transmission, the MPMC interface can also be used as an interface for data transmission.

WiMax/WiBro 시스템은 한 프레임(Frame) 내에는 Map 정보를 알려 주는 다운링크 맵(DownLink MAP : DL MAP) 데이터와 다운로드 맵 버스트(DownLink Burst : DL Burst) 데이터가 존재하는데, 모두 채널 디코딩을 위해서 DSP(310)의 신호 처리 결과를 상기 CC(310)로 전송해야 한다. WiMax/WiBro 시스템의 특성상 DL Map 데이터가 먼저 발생하고, DL Burst 데이터가 나중에 발생한다. 이러한 DL Map과 DL Burst 데이터에 대한 전송 순서를 각각 도 5a 및 도 5b로 나타내었다.The WiMax / WiBro system has downlink map (DL MAP) data and download map burst (DL Burst) data indicating the map information in one frame. The signal processing result of 310 should be transmitted to the CC 310. Due to the characteristics of the WiMax / WiBro system, DL Map data occurs first, and DL Burst data occurs later. The transmission order for the DL Map and DL Burst data is shown in FIGS. 5A and 5B, respectively.

도 5a를 이용하여 DL MAP에 대한 인터페이스 방법을 설명하면, 우선 500단계에서와 같이 DSP(310)에서 DL Map 데이터가 발생하면, CC(200)의 채널 디코더(230)로 데이터 전송을 위한 직접 메모리 접속(Transmitter Direct Memory Access : Tx DMA)을 설정한다. 그런 후 DSP(310)는 501단계에서 CC(200)로부터 채널 디코더(230)의 입력버퍼가 비었는지를 알려 주는 레지스터(Register) 값을 리드(Read)한다. 상기 채널 디코더(230)의 입력버퍼가 비었으면, 상기 DSP(310)는 502단계에서 PSD 인터페이스의 방향 설정을 위한 레지스터에 값을 라이트(Write)한다. 또한 503단계에서와 같이 전송할 데이터의 블록 크기를 위한 채널 디코더(230)에게 알려주기 위해서 레지스터값을 라이트(Write)한다. 그런후 상기 DSP(310)는 504단계에서 상기 CC(200)에 데이터 전송을 위한 시작 명령(CTC_START_CMD)을 전송 한다.Referring to FIG. 5A, an interface method for DL MAP is described. First, when DL Map data is generated in the DSP 310 as in step 500, a direct memory for data transmission to the channel decoder 230 of the CC 200 is described. Set the access (Transmitter Direct Memory Access: Tx DMA). Thereafter, the DSP 310 reads a register value indicating whether the input buffer of the channel decoder 230 is empty from the CC 200 in step 501. If the input buffer of the channel decoder 230 is empty, the DSP 310 writes a value to a register for setting the direction of the PSD interface in step 502. In addition, the register value is written to inform the channel decoder 230 for the block size of the data to be transmitted as in step 503. Thereafter, the DSP 310 transmits a start command CTC_START_CMD for data transmission to the CC 200 in step 504.

상기 시작 명령을 수신한 CC(200)는 505단계에서 상기 DSP(310)로 PSD 클럭(PSD Clock)을 인에이블(Enable) 신호를 전송한다. 그러면 상기 DSP(310)은 506단계에서 디코딩할 데이터를 CC(200)내의 채널 디코더 버퍼로 전송한다. DL MAP 데이터가 완전히 전송되면, DSP(310)는 DL MAP 디코딩 결과를 받기 위해서 수신 DMA(Rx DMA)를 설정하고, PSD의 방향을 CC(200)에서 DSP(310) 쪽으로 변경한다.Upon receiving the start command, the CC 200 transmits a PSD clock (Enable) signal to the DSP 310 in step 505. Then, the DSP 310 transmits the data to be decoded in step 506 to the channel decoder buffer in the CC 200. When the DL MAP data is transmitted completely, the DSP 310 sets up a receive DMA (Rx DMA) to receive the DL MAP decoding result, and changes the direction of the PSD from the CC 200 to the DSP 310.

상기 DL MAP 데이터를 전송 받은 채널 디코더(230)는 디코딩 완료 후, 509단계 및 510단계에서와 같이 PSD 인터페이스를 통해서 PSD 클럭 인에이블(PSD Clock Enable)을 전송한 후, 디코딩이 완료된 데이터를 DSP(310)로 전송한다. 상기 디코딩이 완료된 DL Map 데이터가 DSP(310)로 전송이 완료되면, 상기 CC(200)는 511단계에서 외부 인터럽터(External Interrupt)를 이용하여 DSP(310)에게 알려 준다. 상기 DSP(310)는 인터럽터를 받으면, 512단계에서 디코딩된 DL Map 데이터를 DSP(310)에서 처리되는 MAP 디코더로 전달하고, Tx DMA 설정 및 PSD의 방향을 변경한다.After receiving the DL MAP data, the channel decoder 230 transmits the PSD clock enable through the PSD interface as in steps 509 and 510, and then decodes the decoded data. 310). When the decoded DL Map data is transmitted to the DSP 310, the CC 200 informs the DSP 310 by using an external interrupter in step 511. Upon receiving the interrupt, the DSP 310 transmits the DL Map data decoded in step 512 to the MAP decoder processed by the DSP 310, and changes the Tx DMA setting and the direction of the PSD.

다음으로 도 5b를 이용하여 DL 버스트 데이터에 관한 인터페이스 방법을 설명한다. 도 5b를 참조하면, 상기 DSP(310)는 513단계에서와 같이 DL Burst 데이터가 존재하면, 514단계에서 상기 CC(200)로부터 전송되는 레지스터값(CTC_RDY)을 통해 채널 디코더(230)의 입력버퍼가 비었는지를 확인한다. 그런후 상기 DSP(310)는 515단계에서 전송할 데이터의 블록 크기를 위한 레지스터값(TR_BLK_NUM)을 라이트(Write)한 후, 516단계에서 CC(200)으로 데이터 전송을 위한 시작 명 령(CTC_START_CMD)을 내린다. 상기 시작 명령을 수신한 CC(200)는 517단계에서 PSD 클럭 인에이블을 상기 DSP(310)로 전송한다. 상기 PSD 클럭 인에이블을 수신한 DSP(310)는 518단계에서 DL 버스트 데이터를 CC(200)내의 채널 디코더(230)로 전송한다. 그런 후 상기 채널 디코더(230)는 519단계에서 상기 DL 버스트 데이터의 디코딩 동작을 수행한다.Next, an interface method related to DL burst data will be described with reference to FIG. 5B. Referring to FIG. 5B, if there is DL Burst data as in step 513, the DSP 310 inputs the buffer of the channel decoder 230 through the register value CTC_RDY transmitted from the CC 200 in step 514. Check to see if it is empty. Then, the DSP 310 writes the register value TR_BLK_NUM for the block size of the data to be transmitted in step 515, and then, in step 516, the start command CTC_START_CMD for data transmission to the CC 200. Get off. Upon receiving the start command, the CC 200 transmits a PSD clock enable to the DSP 310 in step 517. Upon receiving the PSD clock enable, the DSP 310 transmits DL burst data to the channel decoder 230 in the CC 200 in step 518. Thereafter, the channel decoder 230 performs a decoding operation of the DL burst data in step 519.

WiMax/WiBro 시스템의 데이터 구성상, 디코딩된 DL 버스트 데이터는 LMAC으로 전송하게 된다. 예를 들어, LMAC이 CC(200)내의 또 다른 재구성 프로세서(Reconfigurable Processor)로 구현되어 있다면, 상기 디코딩된 DL 버스트 데이터는 CC(200) 내부에서 LMAC 블록으로 전송되고 LMAC 블록에 데이터가 다 전송되면 인터럽트로 LMAC에 알려주게 된다. LMAC으로 전송된 데이터는 LMAC 프로세싱을 거친후, 최종적으로 MPMC 인터페이스로 ARM에 의해서 외부 메모리에 저장되게 된다.Due to the data structure of the WiMax / WiBro system, the decoded DL burst data is transmitted to the LMAC. For example, if the LMAC is implemented as another reconfigurable processor in the CC 200, the decoded DL burst data is transmitted to the LMAC block inside the CC 200 and the data is transmitted to the LMAC block. The interrupt will inform the LMAC. The data sent to the LMAC is processed by LMAC and finally stored in external memory by the ARM through the MPMC interface.

이후 상기 DSP(310)에서 DL Burst 데이터가 발생하면 상기 514단계 내지 518단계를 지속적으로 반복 수행하면 된다.Thereafter, if DL Burst data is generated in the DSP 310, steps 514 to 518 may be repeatedly performed.

한편 본 발명의 상세한 설명에서는 구체적인 실시 예에 관해 설명하였으나, 본 발명의 범위에서 벗어나지 않는 한도 내에서 여러 가지 변형이 가능함은 물론이다. 그러므로 본 발명의 범위는 설명된 실시 예에 국한되어 정해져서는 안되며 후술하는 특허청구의 범위뿐 아니라 이 특허청구의 범위와 균등한 것들에 의해서 정해져야 한다.Meanwhile, in the detailed description of the present invention, specific embodiments have been described, but various modifications are possible without departing from the scope of the present invention. Therefore, the scope of the present invention should not be limited to the described embodiments, but should be determined not only by the scope of the following claims, but also by the equivalents of the claims.

따라서 본 발명은 DSP를 이용하여 SDR 시스템을 구현할 때, 하드웨어와 소프트웨어의 역할을 효율적으로 분담함으로써, 지속적으로 변하는 표준에 대해서 빠르게 대처할 수 있고, 저전력에 대한 방안 및 효율적인 단말 모뎀을 구현할 수 있는 효과가 있다.Therefore, when the SDR system is implemented using a DSP, the present invention efficiently divides the roles of hardware and software, thereby rapidly coping with constantly changing standards, and has an effect of implementing a low power scheme and an efficient terminal modem. have.

Claims (5)

소프트웨어 기반으로 복수의 무선 표준을 지원하는 이동 단말의 모뎀에 있어서,In the modem of a mobile terminal that supports a plurality of wireless standards based on software, 상기 복수의 무선 표준 중 지정된 표준에 따라 재구성되는 송수신 필터와 채널 디코더를 구비하는 하드웨어 블록과,A hardware block including a transmit / receive filter and a channel decoder reconfigured according to a specified standard among the plurality of wireless standards; 상기 하드웨어 블록과 연동되고 상기 지정된 표준에 따라 소정 시스템 파라미터를 변경하여 상기 하드웨어 블록을 재구성하는 디지털 신호 처리부를 포함함을 특징으로 하는 모뎀.And a digital signal processor interworking with the hardware block and reconfiguring the hardware block by changing a predetermined system parameter according to the specified standard. 제 1항에 있어서, 상기 하드웨어 블록은,The method of claim 1, wherein the hardware block, 송수신 신호를 디지털 및 아날로그 신호로 변환하는 아날로그 코어부와,An analog core unit for converting transmission / reception signals into digital and analog signals, 상기 아날로그 코어로부터 전송된 신호를 필터링을 수행하는 필터부와,A filter unit for filtering the signal transmitted from the analog core; 상기 디지털 신호 처리부로부터 전송된 신호에 대해 채널 디코딩을 수행하는 하드웨어 가속기를 포함함을 특징으로 하는 모뎀.And a hardware accelerator for performing channel decoding on the signal transmitted from the digital signal processor. 제 1항에 있어서, 상기 디지털 신호 처리부는,The method of claim 1, wherein the digital signal processing unit, 상기 수신 신호에 대한 변복조 및 채널 추정을 수행함을 특징으로 하는 모 뎀.And demodulating and performing channel estimation on the received signal. 소프트웨어 기반으로 복수의 무선 표준을 지원하는 이동 단말의 모뎀에서의 인터페이스 방법에 있어서,An interface method in a modem of a mobile terminal supporting a plurality of wireless standards based on software, 변복조 및 채널 추정을 수행하는 디지털 신호 처리부에서 채널 디코딩할 데이터 발생시 채널 디코더로부터 상기 데이터의 전송여부를 확인하는 제1과정과,A first step of confirming whether or not the data is transmitted from a channel decoder when data to be channel decoded is generated by a digital signal processor performing modulation and demodulation and channel estimation; 상기 디지털 신호 처리부에서 상기 데이터가 전송 준비가 완료되면 상기 데이터를 상기 채널 디코더로 전송하는 제 2과정과,A second process of transmitting the data to the channel decoder when the digital signal processor is ready to transmit the data; 상기 채널 디코더에서 상기 데이터의 디코딩이 완료되면 상기 디지털 신호 처리부로 인터럽트 신호 전송후, 상기 디코딩된 데이터를 전송하는 제 3과정을 포함함을 특징으로 하는 인터페이스 방법.And a third step of transmitting the decoded data after transmitting the interrupt signal to the digital signal processing unit when the decoding of the data is completed in the channel decoder. 제 4항에 있어서, 상기 제 1과정은,The method of claim 4, wherein the first process comprises: 상기 디지털 신호 처리부에서 상기 채널 디코더의 입력버퍼의 상태를 확인하는 과정과,Checking a state of an input buffer of the channel decoder by the digital signal processor; 상기 디지털 신호 처리부에서 상기 데이터의 전송 방향을 확인하는 과정을 포함함을 특징으로 하는 인터페이스 방법.And confirming the transmission direction of the data in the digital signal processor.
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