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KR102668136B1 - 표시모듈 - Google Patents

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KR102668136B1
KR102668136B1 KR1020160168817A KR20160168817A KR102668136B1 KR 102668136 B1 KR102668136 B1 KR 102668136B1 KR 1020160168817 A KR1020160168817 A KR 1020160168817A KR 20160168817 A KR20160168817 A KR 20160168817A KR 102668136 B1 KR102668136 B1 KR 102668136B1
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나현재
구자승
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삼성디스플레이 주식회사
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Priority to TW106143108A priority patent/TWI753061B/zh
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Abstract

표시모듈은 표시패널 및 상기 표시패널 상에 배치된 터치감지유닛을 포함한다. 상기 터치감지유닛은 제1 방향으로 연장되고, 제1 개구 면적를 갖는 제1 터치전극, 상기 제1 터치전극과 교차하는 제2 방향으로 연장되고, 상기 제1 터치전극보다 길이가 길고, 상기 제1 개구 면적보다 큰 제2 개구 면적을 갖는 제2 터치전극 및 상기 제1 터치전극과 상기 제2 터치전극을 절연시키는 터치 절연층을 포함한다.

Description

표시모듈{DISPLAY MODULE}
본 발명은 표시모듈에 관한 것으로, 좀 더 구체적으로 터치감지유닛이 표시패널에 직접 배치된 표시모듈에 관한 것이다.
텔레비전, 휴대 전화, 태블릿 컴퓨터, 네비게이션, 게임기 등과 같은 멀티 미디어 장치에 사용되는 다양한 표시장치들이 개발되고 있다. 표시장치들은 입력장치로써 키보드 또는 마우스 등을 포함한다. 또한, 최근에 표시장치들은 입력장치로써 터치패널을 구비한다.
본 발명의 목적은 터치 감도가 향상된 터치감지유닛 일체형 표시모듈을 제공하는 것이다.
본 발명의 일 실시예에 따른 표시모듈은 베이스 면을 제공하는 표시패널 및 상기 베이스 면 상에 직접 배치된 터치감지유닛을 포함한다. 상기 터치감지유닛은 제1 방향으로 연장되고, 제1 개구 면적를 갖는 제1 터치전극, 상기 제1 터치전극과 교차하는 제2 방향으로 연장되고, 상기 제1 터치전극보다 길이가 길고, 상기 제1 개구 면적보다 큰 제2 개구 면적을 갖는 제2 터치전극 및 상기 제1 터치전극과 상기 제2 터치전극을 절연시키는 터치 절연층을 포함한다.
상기 제1 터치전극과 상기 제2 터치전극 각각은 메쉬선들을 포함할 수 있다.
상기 제1 터치전극의 상기 메쉬선들이 배치된 유효면적과 상기 제2 터치전극의 상기 메쉬선들이 배치된 유효면적은 실질적으로 동일할 수 있다.
상기 표시패널은 서로 이격된 복수 개의 발광영역들과 상기 복수 개의 발광영역들 사이에 배치된 비발광영역을 포함할 수 있다. 상기 메쉬선들은 상기 비발광영역에 중첩할 수 있다.
상기 제1 개구 면적은 적어도 하나의 제1 개구부에 의해 정의되고, 상기 제2 개구 면적은 적어도 하나의 제2 개구부에 의해 정의되고, 상기 제1 개구부 내측에 배치된 제1 더미 전극 및 상기 제2 개구부 내측에 배치된 제2 더미 전극을 더 포함할 수 있다.
상기 제1 개구부는 복수 개 제공되고, 상기 제1 더미 전극은 상기 제1 개구부들마다 배치될 수 있다.
상기 제1 더미 전극 및 상기 제2 더미 전극 각각은 메쉬선들을 포함할 수 있다.
상기 제1 터치전극은 상기 제1 방향으로 나열된 Y개(여기서 Y는 2 이상의 자연수)의 제1 센서부들 및 상기 제1 센서부들 중 인접한 제1 센서부들을 연결하는 제1 연결부들을 포함하고, 상기 제1 센서부들마다 적어도 하나의 제1 개구부가 정의될 수 있다. 상기 제2 터치전극은 상기 제2 방향으로 나열된 X개의 제2 센서부들(여기서 X는 Y보다 큰 자연수) 및 상기 제2 센서부들 중 인접한 제2 센서부들을 연결하는 제2 연결부들을 포함하고, 상기 제2 센서부들마다 적어도 하나의 제2 개구부가 정의될 수 있다.
상기 제1 터치전극은 제1 외곽면적을 가지고, 상기 제2 터치전극은 제2 외곽면적을 가지며, 상기 제2 외곽면적은 제1 외곽면적 대비 약 X/Y×100(%)일 수 있다.
상기 제1 센서부들 각각은 제1 외곽면적을 가지고, 상기 제2 센서부들 각각은 제2 외곽면적을 갖는다. 상기 제1 센서부들 각각은 제1 외곽면적에서 상기 적어도 하나의 제1 개구부의 면적을 제외한 제1 유효면적을 갖고, 상기 제2 센서부들 각각은 제2 외곽면적에서 상기 적어도 하나의 제2 개구부의 면적을 제외한 제2 유효면적을 갖는다. 상기 제2 유효면적은 상기 제1 유효면적보다 작다.
상기 제2 유효면적은 상기 제1 유효면적 대비 약 Y/X×100(%)일 수 있다.
상기 제1 유효면적은 상기 제1 외곽면적 대비 10 % 내지 70 % 이고, 상기 제2 유효면적은 상기 제2 외곽면적 대비 30 % 내지 90 % 일 수 있다.
상기 제1 외곽면적과 상기 제2 외곽면적은 실질적으로 동일할 수 있다.
상기 터치 절연층은 제1 터치 절연층 및 제2 터치 절연층을 포함할 수 있다. 상기 제1 연결부들과 상기 제2 연결부들 중 어느 하나의 연결부들은 상기 베이스 면 상에 배치되고, 상기 제1 터치 절연층은 상기 어느 하나의 연결부들 상에 배치되며, 상기 제1 센서부들, 상기 제2 센서부들, 및 상기 제1 연결부들과 상기 제2 연결부들 중 다른 하나의 연결부들은 상기 제1 터치 절연층 상에 배치되고, 상기 제2 터치 절연층은 상기 제1 센서부들, 상기 제2 센서부들, 및 다른 하나의 연결부들 상에 배치될 수 있다.
상기 적어도 하나의 제1 개구부는 2개의 제1 개구부들로 제공되고, 상기 제1 센서부들 각각은 상기 2개의 제1 개구부들을 에워싸는 테두리부분 및 상기 2개의 제1 개구부들 사이에 배치된 다이렉트 패스부분을 포함할 수 있다. 상기 다이렉트 패스부분은 상기 제1 터치전극의 연장선 상에 배치될 수 있다.
상기 제1 터치전극의 일단에 연결된 제1 터치 신호라인 및 상기 제2 터치전극의 양단에 각각 연결된 제2 터치 신호라인들을 더 포함할 수 있다.
상기 표시패널 및 상기 터치감지유닛은 벤딩축(BX)에 기초하여 벤딩될 수 있다.
상기 표시패널은 상기 제1 터치전극과 절연층들을 사이에 두고 배치된 캐소드를 포함할 수 있다. 상기 절연층들의 두께의 합은 0.5 마이크로미터 내지 30 마이크로미터일 수 있다.
상기 표시패널은 베이스층, 상기 베이스층 상의 회로 소자층, 상기 회로 소자층 상의 표시 소자층 및 상기 표시 소자층 상의 박막 봉지층을 포함하고, 상기 표시 소자층은 제1 전극, 상기 제1 전극 상의 유기발광층, 상기 유기발광층과 상기 박막 봉지층 사이에 배치된 제2 전극을 포함할 수 있다.
상기 제1 터치전극과 상기 제2 전극 사이의 거리는 0.5 마이크로미터 내지 30 마이크로미터일 수 있다.
본 발명의 일 실시예에 따른 표시모듈은 베이스 면을 제공하는 표시패널 및 상기 베이스 면 상에 직접 배치된 터치감지유닛을 포함한다. 상기 터치감지유닛은, 제1 방향으로 연장되고, 제1 외곽면적 및 제1 개구 면적를 갖는 제1 터치전극 및 상기 제1 터치전극과 교차하는 제2 방향으로 연장되고, 상기 제1 외곽면적보다 큰 제2 외곽면적을 갖고 상기 제1 개구 면적보다 큰 제2 개구 면적을 갖는 제2 터치전극을 포함한다.
상술한 바에 따르면, 터치전극들에 개구부들이 정의됨으로써 표시패널에 배치된 전극들과의 노이즈가 감소될 수 있다. 터치전극들과 유기발광다이오드의 캐소드 사이의 기생 커패시턴스가 감소되기 때문이다. 폴더블 표시모듈과 같이, 박막 봉지층의 두께가 감소되더라도 신호 대 잡음 비율을 증가시킬 수 있다.
길이가 다른 제1 터치전극과 제2 터치전극 사이에는 캐소드에 의해 발생하는 노이즈의 편차가 발생할 수 있다. 제1 터치전극과 제2 터치전극에 면적이 다른 개구부들을 형성함으로써 노이즈 편차를 감소시킬 수 있다.
도 1a 내지 도 1c는 본 발명의 일 실시예에 따른 표시모듈의 사시도이다.
도 2는 본 발명의 일 실시예에 따른 표시모듈의 단면도이다.
도 3은 본 발명의 일 실시예에 따른 표시패널의 평면도이다.
도 4는 본 발명의 일 실시예에 따른 화소의 등가회로도이다.
도 5는 본 발명의 일 실시예에 따른 표시패널의 확대된 단면도이다.
도 6a은 본 발명의 일 실시예에 따른 터치감지유닛의 단면도이다.
도 6b은 본 발명의 일 실시예에 따른 터치감지유닛의 평면도이다.
도 7a는 본 발명의 일 실시예에 따른 터치감지유닛의 제1 도전층의 평면도이다.
도 7b는 본 발명의 일 실시예에 따른 터치감지유닛의 제2 도전층의 평면도이다.
도 7c는 본 발명의 일 실시예에 따른 터치감지유닛의 부분 단면도이다.
도 8a는 본 발명의 일 실시예에 따른 터치감지유닛의 부분 평면도이다.
도 8b는 도 8a의 부분 확대도이다.
도 8c는 도 8b의 부분 확대도이다.
도 9a는 본 발명의 일 실시예에 따른 터치감지유닛의 부분 평면도이다.
도 9b는 제1 터치전극과 제2 터치전극의 외곽면적을 나타낸 평면도이다.
도 9c는 제1 터치전극과 제2 터치전극의 개구면적을 나타낸 평면도이다.
도 9d는 제1 터치전극과 제2 터치전극의 유효면적을 나타낸 평면도이다.
도 9e는 제1 센서부와 제2 센서부를 도시한 평면도이다.
도 10은 본 발명의 일 실시예에 따 른제1 센서부와 제2 센서부를 도시한 평면도이다.
도 11은 본 발명의 일 실시예에 따른 제1 센서부와 제2 센서부를 도시한 평면도이다.
이하, 도면을 참조하여 본 발명의 실시예들을 설명한다. 본 명세서에서, 어떤 구성요소(또는 영역, 층, 부분 등)가 다른 구성요소 "상에 있다", "연결 된다", 또는 "결합 된다"고 언급되는 경우에 그것은 다른 구성요소 상에 직접 연결/결합될 수 있거나 또는 그들 사이에 제3의 구성요소가 배치될 수도 있다는 것을 의미한다.
동일한 도면부호는 동일한 구성요소를 지칭한다. 또한, 도면들에 있어서, 구성요소들의 두께, 비율, 및 치수는 기술적 내용의 효과적인 설명을 위해 과장된 것이다. "및/또는"은 연관된 구성들이 정의할 수 있는 하나 이상의 조합을 모두 포함한다.
제1, 제2 등의 용어는 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안 된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용된다. 예를 들어, 본 발명의 권리 범위를 벗어나지 않으면서 제1 구성요소는 제2 구성요소로 명명될 수 있고, 유사하게 제2 구성요소도 제1 구성요소로 명명될 수 있다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.
또한, "아래에", "하측에", "위에", "상측에" 등의 용어는 도면에 도시된 구성들의 연관관계를 설명하기 위해 사용된다. 상기 용어들은 상대적인 개념으로, 도면에 표시된 방향을 기준으로 설명된다.
"포함하다" 또는 "가지다" 등의 용어는 명세서 상에 기재된 특징, 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성요소, 부분품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.
도 1a 내지 도 1c는 본 발명의 일 실시예에 따른 표시모듈(DM)의 사시도이다. 도 2는 본 발명의 일 실시예에 따른 표시모듈(DM)의 단면도이다.
도 1a 내지 도 1c에 도시된 것과 같이, 이미지(IM)가 표시되는 표시면(IS)은 제1 방향축(DR1) 및 제2 방향축(DR2)이 정의하는 면과 평행한다. 표시면(IS)의 법선 방향, 즉 표시모듈(DM)의 두께 방향은 제3 방향축(DR3)이 지시한다. 각 부재들의 전면(또는 상면)과 배면(또는 하면)은 제3 방향축(DR3)에 의해 구분된다. 그러나, 제1 내지 제3 방향축들(DR1, DR2, DR3)이 지시하는 방향은 상대적인 개념으로서 다른 방향으로 변환될 수 있다. 이하, 제1 내지 제3 방향들은 제1 내지 제3 방향축들(DR1, DR2, DR3)이 각각 지시하는 방향으로 동일한 도면 부호를 참조한다.
도 1a 내지 도 1c에 도시된 것과 같이, 표시모듈(DM)은 동작 형태에 따라 정의되는 복수 개의 영역들을 포함할 수 있다. 표시모듈(DM)은 벤딩축(BX)에 기초하여(on the basis of) 벤딩되는 벤딩영역(BA), 비벤딩되는 제1 비벤딩영역(NBA1), 및 제2 비벤딩영역(NBA2)을 포함할 수 있다. 도 1b에 도시된 것과 같이, 표시모듈(DM)은 제1 비벤딩영역(NBA1)의 표시면(IS)과 제2 비벤딩영역(NBA2)의 표시면(IS)이 마주하도록 내측 벤딩(inner-bending)될 수 있다. 도 1c에 도시된 것과 같이, 표시모듈(DM)은 표시면(IS)이 외부에 노출되도록 외측 벤딩(outer-bending)될 수도 있다. 도 1a 내지 도 1c에 도시된 것과 같이, 벤딩과 펼쳐짐이 반복적으로 표시모듈은 폴더블 표시모듈로 정의될 수 있다.
본 발명의 일 실시예에서 표시모듈(DM)은 복수 개의 벤딩영역(BA)을 포함할 수 있다. 뿐만 아니라, 사용자가 표시모듈(DM)를 조작하는 형태에 대응하게 벤딩영역(BA)이 정의될 수 있다. 예컨대, 벤딩영역(BA)은 도 1b 및 도 1c와 달리 제1 방향축(DR2)에 평행하게 정의될 수 있고, 대각선 방향으로 정의될 수도 있다. 벤딩영역(BA)의 면적은 고정되지 않고, 곡률반경에 따라 결정될 수 있다. 본 발명의 일 실시예에서 표시모듈(DM)은 도 1a 및 도 1b에 도시된 동작모드만 반복되도록 구성될 수도 있다.
본 발명의 일 실시예에서 폴더블 표시모듈(DM)을 도시하였으나, 이에 제한되지 않는다. 표시모듈(DM)은 곡면형 표시면 또는 서로 다른 방향을 지시하는 복수 개의 표시영역들을 포함하는 입체형 표시면(다각 기둥형 표시면)을 포함할 수도 있다. 또한, 본 발명의 일 실시예에서 표시모듈(DM)은 플랫한 리지드 표시모듈일 수 있다. 또한, 엣지 영역이 밴딩된 벤딩형 표시모듈일 수 있다.
본 실시예에서 휴대 전화에 적용된 표시모듈(DM)을 도시하였으나 이에 제한되지 않는다. 본 발명의 일 실시예에서 표시모듈(DM)은 텔레비전, 모니터 등과 같은 대형 전자장치를 비롯하여, 테블릿, 자동차 네비게이션, 게임기, 스마트 와치 등과 같은 중소형 전자장치 등에 적용될 수 있다.
도 1a 내지 도 1c에 도시된 것과 같이, 표시면(IS)은 이미지(IM)가 표시되는 표시영역(DM-DA) 및 표시영역(DM-DA)에 인접한 비표시영역(DM-NDA)을 포함한다. 비표시영역(DM-NDA)은 이미지가 표시되지 않는 영역이다. 도 1a 내지 도 1c에는 이미지(IM)의 일 예로 아이콘 이미지들을 도시하였다. 일 예로써, 표시영역(DM-DA)은 사각형상일 수 있다. 비표시영역(DM-NDA)은 표시영역(DM-DA)을 에워싸을 수 있다. 다만, 이에 제한되지 않고, 표시영역(DM-DA)의 형상과 비표시영역(DM-NDA)의 형상은 상대적으로 디자인될 수 있다.
도 2는 본 발명의 일 실시예에 따른 표시모듈(DM)의 단면도이다. 도 2는 제2 방향축(DR2)과 제3 방향축(DR3)이 정의하는 단면을 도시하였다.
도 2에 도시된 것과 같이, 표시모듈(DM)은 표시패널(DP)과 터치감지유닛(TS, 또는 터치감지층)을 포함한다. 표시패널(DP)은 이미지를 생성하고, 터치감지유닛(TS)은 외부입력(터치 이벤트)의 좌표정보를 획득한다. 별도로 도시하지 않았으나, 본 발명의 일 실시예에 따른 표시모듈(DM)은 표시패널(DP)의 하면에 배치된 보호부재, 터치감지유닛(TS)의 상면 상에 배치된 반사방지부재 및/또는 윈도우 부재를 더 포함할 수 있다.
표시패널(DP)은 발광형 표시패널일 수 있고, 특별히 제한되지 않는다. 예컨대, 표시패널(DP)은 유기발광 표시패널 또는 퀀텀닷 발광 표시패널일 수 있다. 유기발광 표시패널은 발광층이 유기발광물질을 포함한다. 퀀텀닷 발광 표시패널은 발광층이 퀀텀닷, 및 퀀텀로드를 포함한다. 이하, 표시패널(DP)은 유기발광 표시패널로 설명된다.
표시패널(DP)은 베이스층(SUB), 베이스층(SUB) 상에 배치된 회로 소자층(DP-CL), 표시 소자층(DP-OLED), 및 박막 봉지층(TFE)을 포함한다. 별도로 도시되지 않았으나, 표시패널(DP)은 반사방지층, 굴절률 조절층 등과 같은 기능성층들을 더 포함할 수 있다.
베이스층(SUB)은 플렉서블 필름을 포함할 수 있다. 베이스층(SUB)은 플라스틱 기판, 유리 기판, 메탈 기판, 또는 유/무기 복합재료 기판 등을 포함할 수 있다. 도 1을 참조하여 설명한 표시영역(DM-DA)과 비표시영역(DM-NDA)은 베이스층(SUB)에 동일하게 정의될 수 있다.
회로 소자층(DP-CL)은 적어도 하나의 중간 절연층과 회로 소자를 포함한다. 중간 절연층은 적어도 하나의 중간 무기막과 적어도 하나의 중간 유기막을 포함한다. 상기 회로 소자는 신호라인들, 화소의 구동회로 등을 포함한다. 코팅, 증착 등에 의한 절연층 형성공정과 포토리소그래피 공정에 의한 도전체층 및/또는 반도체층의 패터닝 공정을 통해 회로 소자층(DP-CL)이 형성될 수 있다.
표시 소자층(DP-OLED)은 유기발광 다이오드들을 포함할 수 있다. 표시 소자층(DP-OLED)은 화소 정의막과 같은 유기막을 더 포함할 수 있다.
박막 봉지층(TFE)은 표시 소자층(DP-OLED)을 밀봉한다. 박막 봉지층(TFE)은 적어도 하나의 무기막(이하, 봉지 무기막)을 포함한다. 박막 봉지층(TFE)은 적어도 하나의 유기막(이하, 봉지 유기막)을 더 포함할 수 있다. 봉지 무기막은 수분/산소로부터 표시 소자층(DP-OLED)을 보호하고, 봉지 유기막은 먼지 입자와 같은 이물질로부터 표시 소자층(DP-OLED)을 보호한다. 봉지 무기막은 실리콘 나이트라이드층, 실리콘 옥시 나이트라이드층 및 실리콘 옥사이드층, 티타늄옥사이드층, 또는 알루미늄옥사이드층 등을 포함할 수 있다. 봉지 유기막은 아크릴 계열 유기층을 포함할 수 있고, 이에 제한되지 않는다.
터치감지유닛(TS)은 표시패널(DP)이 제공하는 베이스 면 상에 직접 배치될 수 있다. 본 명세서에서 "직접 배치된다"는 것은 별도의 접착층을 이용하여 부착하는 것을 제외하며, 연속공정에 의해 형성된 것을 의미한다. 베이스 면은 박막 봉지층(TFE)의 상면일 수 있고, 박막 봉지층(TFE) 상에 배치된 또 다른 기능층의 상면일 수 있다. 베이스 면은 특별히 제한되지 않고, 연속공정에 의해 형성된 표시패널(DP)의 최 상측면이면 충분하다. 한편, 터치감지유닛(TS)이 표시패널(DP)이 제공하는 베이스 면 상에 직접 배치됨으로써 터치패널의 베이스기판이 생략되어 표시모듈(DM)의 두께가 감소된다.
터치감지유닛(TS)은 다층구조를 가질 수 있다. 터치감지유닛(TS)은 단층 또는 다층의 도전층을 포함할 수 있다. 터치감지유닛(TS)은 적어도 하나의 절연층을 포함할 수 있다.
터치감지유닛(TS)은 예컨대, 정전용량 방식으로 외부입력을 감지할 수 있다. 본 발명에서 터치감지유닛(TS)의 동작방식은 특별히 제한되지 않고, 본 발명의 일 실시예에서 터치감지유닛(TS)은 전자기 유도방식 또는 압력 감지방식으로 외부입력을 감지할 수도 있다.
도 3은 본 발명의 일 실시예에 따른 표시패널(DP)의 평면도이다. 도 4는 본 발명의 일 실시예에 따른 화소(PX)의 등가회로도이다. 도 5는 본 발명의 일 실시예에 따른 표시패널(DP)의 확대된 단면도이다.
도 3에 도시된 것과 같이, 표시패널(DP)은 평면상에서 표시영역(DA)과 비표시영역(NDA)을 포함한다. 본 실시예에서 비표시영역(NDA)은 표시영역(DA)의 테두리를 따라 정의될 수 있다. 표시패널(DP)의 표시영역(DA) 및 비표시영역(NDA)은 도 1에 도시된 표시모듈(DM)의 표시영역(DM-DA) 및 비표시영역(DM-NDA)에 각각 대응한다. 표시패널(DP)의 표시영역(DA) 및 비표시영역(NDA)은 표시모듈(DM)의 표시영역(DM-DA) 및 비표시영역(DM-NDA)과 반드시 동일할 필요는 없고, 표시패널(DP)의 구조/디자인에 따라 변경될 수 있다.
표시패널(DP)은 구동회로(GDC), 복수 개의 신호라인들(SGL) 및 복수 개의 화소들(PX)을 포함할 수 있다. 복수 개의 화소들(PX)은 표시영역(DA)에 배치된다. 화소들(PX) 각각은 유기발광 다이오드와 그에 연결된 화소 구동회로를 포함한다. 구동회로(GDC), 복수 개의 신호라인들(SGL), 및 화소 구동회로는 도 2에 도시된 회로 소자층(DP-CL)에 포함될 수 있다.
구동회로(GDC)는 주사 구동회로를 포함할 수 있다. 주사 구동회로(GDC)는 복수 개의 주사 신호들을 생성하고, 복수 개의 주사 신호들을 후술하는 복수 개의 주사 라인들(GL)에 순차적으로 출력한다.　주사 구동회로(GDC)는 화소들(PX)의 구동회로에 또 다른 제어 신호를 더 출력할 수 있다.
주사 구동회로(GDC)는 화소들(PX)의 구동회로와 동일한 공정, 예컨대 LTPS(Low Temperature Polycrystaline Silicon) 공정 또는 LTPO(Low Temperature Polycrystalline Oxide) 공정을 통해 형성된 복수 개의 박막 트랜지스터들을 포함할 수 있다.
복수 개의 신호라인들(SGL)은 주사 라인들(GL), 데이터 라인들(DL), 전원 라인(PL), 및 제어신호 라인(CSL)을 포함한다. 주사 라인들(GL)은 복수 개의 화소들(PX) 중 대응하는 화소(PX)에 각각 연결되고, 데이터 라인들(DL)은 복수 개의 화소들(PX) 중 대응하는 화소(PX)에 각각 연결된다. 전원 라인(PL)은 복수 개의 화소들(PX)에 연결된다. 제어신호 라인(CSL)은 주사 구동회로(GDC)에 제어신호들을 제공할 수 있다.
표시패널(DP)은 신호라인들(SGL)의 말단에 연결된 신호패드들(DP-PD)을 포함한다. 신호패드들(DP-PD)은 일종의 회로 소자일 수 있다. 비표시영역(NDA) 중 신호패드들(DP-PD)이 배치된 영역은 패드영역(NDA-PD)으로 정의된다. 패드영역(NDA-PD)에는 후술하는 터치 신호라인들(SL1-1 내지 내지 SL1-5 및 내지 SL2-1 내지 SL2-4)에 연결되는 더미 터치 패드들(TS-DPD)이 더 배치될 수 있다. 신호패드들(DP-PD) 및 더미 터치 패드들(TS-DPD)은 후술하는 주사 라인(GL, 도 5 참조) 또는 데이터 라인(DL, 도 5 참조)과 동일한 공정을 통해 동일한 층 상에 배치될 수 있다.
도 4에는 어느 하나의 주사 라인(GL)과 어느 하나의 데이터 라인(DL), 및 전원 라인(PL)에 연결된 화소(PX)를 예시적으로 도시하였다. 화소(PX)의 구성은 이에 제한되지 않고 변형되어 실시될 수 있다.
유기발광 다이오드(OLED)는 전면 발광형 다이오드이거나, 배면 발광형 다이오드일 수 있다. 화소(PX)는 유기발광 다이오드(OLED)를 구동하기 위한 화소 구동회로로써 제1 트랜지스터(T1, 또는 스위칭 트랜지스터), 제2 트랜지스터(T2, 또는 구동 트랜지스터), 및 커패시터(Cst)를 포함한다. 제1 전원 전압(ELVDD)은 제2 트랜지스터(T2)에 제공되고, 제2 전원 전압(ELVSS)은 유기발광 다이오드(OLED)에 제공된다. 제2 전원 전압(ELVSS)은 제1 전원 전압(ELVDD) 보다 낮은 전압일 수 있다.
제1 트랜지스터(T1)는 주사 라인(GL)에 인가된 주사 신호에 응답하여 데이터 라인(DL)에 인가된 데이터 신호를 출력한다. 커패시터(Cst)는 제1 트랜지스터(T1)로부터 수신한 데이터 신호에 대응하는 전압을 충전한다.
제2 트랜지스터(T2)는 유기발광 다이오드(OLED)에 연결된다. 제2 트랜지스터(T2)는 커패시터(Cst)에 저장된 전하량에 대응하여 유기발광 다이오드(OLED)에 흐르는 구동전류를 제어한다.
도 5는 도 4에 도시된 등가회로에 대응하는 표시패널(DP)의 부분 단면을 도시하였다. 베이스층(SUB) 상에 회로 소자층(DP-CL), 표시 소자층(DP-OLED), 및 박막 봉지층(TFE)이 순차적으로 배치된다.
회로 소자층(DP-CL)은 적어도 하나의 무기막, 적어도 하나의 유기막, 및 회로 소자를 포함한다. 회로 소자층(DP-CL)은 무기막인 버퍼막(BFL), 제1 중간 무기막(10) 및 제2 중간 무기막(20)을 포함하고, 유기막인 중간 유기막(30)을 포함할 수 있다.
상기 무기막들은 실리콘 나이트라이드, 실리콘 옥시 나이트라이드 및 실리콘 옥사이드 등을 포함할 수 있다. 상기 유기막은 아크릴계 수지, 메타크릴계 수지, 폴리이소프렌, 비닐계 수지, 에폭시계 수지, 우레탄계 수지, 셀룰로오스계 수지, 실록산계 수지, 폴리이미드계 수지, 폴리아미드계 수지 및 페릴렌계 수지 중 적어도 어느 하나를 포함할 수 있다. 회로 소자는 도전성 패턴들 및/또는 반도체 패턴들을 포함한다.
버퍼막(BFL)은 베이스층(SUB)과 도전성 패턴들 또는 반도체 패턴들의 결합력을 향상시킨다. 별도로 도시되지 않았으나, 이물질이 유입되는 것을 방지하는 배리어층이 베이스층(SUB)의 상면에 더 배치될 수도 있다. 버퍼막(BFL)과 배리어층은 선택적으로 배치/생략될 수 있다.
버퍼막(BFL) 상에 제1 트랜지스터(T1)의 반도체 패턴(OSP1: 이하 제1 반도체 패턴), 제2 트랜지스터(T2)의 반도체 패턴(OSP2: 이하 제2 반도체 패턴)이 배치된다. 제1 반도체 패턴(OSP1) 및 제2 반도체 패턴(OSP2)은 아몰포스 실리콘, 폴리 실리콘, 금속 산화물 반도체에서 선택될 수 있다.
제1 반도체 패턴(OSP1) 및 제2 반도체 패턴(OSP2) 상에 제1 중간 무기막(10)이 배치된다. 제1 중간 무기막(10) 상에는 제1 트랜지스터(T1)의 제어 전극(GE1: 이하, 제1 제어전극) 및 제2 트랜지스터(T2)의 제어 전극(GE2: 이하, 제2 제어전극)이 배치된다. 제1 제어 전극(GE1) 및 제2 제어 전극(GE2)은 주사 라인들(GL, 도 5a 참조)과 동일한 포토리소그래피 공정에 따라 제조될 수 있다.
제1 중간 무기막(10) 상에는 제1 제어 전극(GE1) 및 제2 제어 전극(GE2)을 커버하는 제2 중간 무기막(20)이 배치된다. 제2 중간 무기막(20) 상에 제1 트랜지스터(T1)의 입력전극(DE1: 이하, 제1 입력전극) 및 출력전극(SE1: 제1 출력전극), 제2 트랜지스터(T2)의 입력전극(DE2: 이하, 제2 입력전극) 및 출력전극(SE2: 제2 출력전극)이 배치된다.
제1 입력전극(DE1)과 제1 출력전극(SE1)은 제1 중간 무기막(10) 및 제2 중간 무기막(20)을 관통하는 제1 관통홀(CH1)과 제2 관통홀(CH2)을 통해 제1 반도체 패턴(OSP1)에 각각 연결된다. 제2 입력전극(DE2)과 제2 출력전극(SE2)은 제1 중간 무기막(10) 및 제2 중간 무기막(20)을 관통하는 제3 관통홀(CH3)과 제4 관통홀(CH4)을 통해 제2 반도체 패턴(OSP2)에 각각 연결된다. 한편, 본 발명의 다른 실시예에서 제1 트랜지스터(T1) 및 제2 트랜지스터(T2) 중 일부는 바텀 게이트 구조로 변형되어 실시될 수 있다.
제2 중간 무기막(20) 상에 제1 입력전극(DE1), 제2 입력전극(DE2), 제1 출력전극(SE1), 및 제2 출력전극(SE2)을 커버하는 중간 유기막(30)이 배치된다. 중간 유기막은 평탄면을 제공할 수 있다.
중간 유기막(30) 상에는 표시 소자층(DP-OLED)이 배치된다. 표시 소자층(DP-OLED)은 화소정의막(PDL) 및 유기발광 다이오드(OLED)를 포함할 수 있다. 화소정의막(PDL)은 중간 유기막(30)과 같이 유기물질을 포함할 수 있다. 중간 유기막(30) 상에 제1 전극(AE)이 배치된다. 제1 전극(AE)은 중간 유기막(30)을 관통하는 제5 관통홀(CH5)을 통해 제2 출력전극(SE2)에 연결된다. 화소정의막(PDL)에는 개구부(OP)가 정의된다. 화소정의막(PDL)의 개구부(OP)는 제1 전극(AE)의 적어도 일부분을 노출시킨다.
화소(PX)는 평면 상에서 화소 영역에 배치될 수 있다. 화소 영역은 발광영역(PXA)과 발광영역(PXA)에 인접한 비발광영역(NPXA)을 포함할 수 있다. 비발광영역(NPXA)은 발광영역(PXA)을 에워싸을수 있다. 본 실시예에서 발광영역(PXA)은 개구부(OP)에 의해 노출된 제1 전극(AE)의 일부영역에 대응하게 정의되었다.
정공 제어층(HCL)은 발광영역(PXA)과 비발광영역(NPXA)에 공통으로 배치될 수 있다. 별도로 도시되지 않았으나, 정공 제어층(HCL)과 같은 공통층은 복수 개의 화소들(PX, 도 3 참조)에 공통으로 형성될 수 있다.
정공 제어층(HCL) 상에 발광층(EML)이 배치된다. 발광층(EML)은 개구부(OP)에 대응하는 영역에 배치될 수 있다. 즉, 발광층(EML)은 복수 개의 화소들(PX) 각각에 분리되어 형성될 수 있다. 발광층(EML)은 유기물질 및/또는 무기물질을 포함할 수 있다. 본 실시예에서 패터닝된 발광층(EML)을 예시적으로 도시하였으나, 발광층(EML)은 복수 개의 화소들(PX)에 공통적으로 배치될 수 있다. 이때, 발광층(EML)은 백색 광을 생성할 수 있다. 또한, 발광층(EML)은 다층구조를 가질 수 있다.
발광층(EML) 상에 전자 제어층(ECL)이 배치된다. 별도로 도시되지 않았으나, 전자 제어층(ECL)은 복수 개의 화소들(PX, 도 3 참조)에 공통으로 형성될 수 있다.
전자 제어층(ECL) 상에 제2 전극(CE)이 배치된다. 제2 전극(CE)은 복수 개의 화소들(PX)에 공통적으로 배치된다.
제2 전극(CE) 상에 박막 봉지층(TFE)이 배치된다. 박막 봉지층(TFE)은 복수 개의 화소들(PX)에 공통적으로 배치된다. 본 실시예에서 박막 봉지층(TFE)은 제2 전극(CE)을 직접 커버한다. 본 발명의 일 실시예에서, 박막 봉지층(TFE)과 제2 전극(CE) 사이에는, 제2 전극(CE)을 커버하는 캡핑층이 더 배치될 수 있다. 이때 박막 봉지층(TFE)은 캡핑층을 직접 커버할 수 있다.
도 6a은 본 발명의 일 실시예에 따른 터치감지유닛(TS)의 단면도이다. 도 6b은 본 발명의 일 실시예에 따른 터치감지유닛의 평면도이다. 도 7a은 본 발명의 일 실시예에 따른 터치감지유닛(TS)의 제1 도전층의 평면도이다. 도 7b은 본 발명의 일 실시예에 따른 터치감지유닛(TS)의 제2 도전층의 평면도이다. 도 7c은 본 발명의 일 실시예에 따른 터치감지유닛(TS)의 단면도이다. 도 6a에는 표시패널(DP, 도 5 참조)의 구성으로써 제2 전극(CE) 및 박막 봉지층(TFE)이 도시되었다. 도 7c는 도 6b의 I-I'에 대응하는 단면을 도시하였다.
도 6a에 도시된 것과 같이, 터치감지유닛(TS)은 제1 도전층(TS-CL1), 제1 절연층(TS-IL1, 이하 제1 터치 절연층), 제2 도전층(TS-CL2), 및 제2 절연층(TS-IL2, 이하 제2 터치 절연층)을 포함한다. 본 실시예에서 제1 도전층(TS-CL1)은 박막 봉지층(TFE) 상에 직접 배치된다. 이에 제한되지 않고, 제1 도전층(TS-CL1)과 박막 봉지층(TFE) 사이에는 또 다른 무기층 또는 유기층이 더 배치될 수 있다. 본 발명의 일 실시예에서 제2 터치 절연층(TS-IL2)은 생략되고, 광학부재 또는 접착층 등이 제2 터치 절연층(TS-IL2)의 보호기능을 대신할 수 있다.
제1 도전층(TS-CL1) 및 제2 도전층(TS-CL2) 각각은 단층구조를 갖거나, 제3 방향축(DR3)을 따라 적층된 다층구조를 가질 수 있다. 단층구조의 도전층은 금속층 또는 투명 도전층을 포함할 수 있다. 금속층은 몰리브덴, 은, 티타늄, 구리, 알루미늄, 및 이들의 합금을 포함할 수 있다. 투명 도전층은 ITO(indium tin oxide), IZO(indium zinc oxide), ZnO(zinc oxide), ITZO(indium tin zinc oxide) 등과 같은 투명한 전도성 산화물을 포함할 수 있다. 그밖에 투명 도전층은 PEDOT, 금속 나노 와이어, 그라핀을 포함할 수 있다.
다층구조의 도전층은 다층의 금속층들을 포함할 수 있다. 다층의 금속층들은 예컨대 티타늄/알루미늄/티타늄의 3층 구조를 가질 수 있다. 다층구조의 도전층은 단층의 금속층 및 투명 도전층을 포함할 수 있다. 다층구조의 도전층은 다층의 금속층들 및 투명 도전층을 포함할 수 있다.
제1 도전층(TS-CL1) 및 제2 도전층(TS-CL2) 각각은 복수 개의 도전 패턴들을 포함한다. 도전 패턴들은 터치전극들 및 터치 신호라인들을 포함할 수 있다.
제1 터치 절연층(TS-IL1) 및 제2 터치 절연층(TS-IL2) 각각은 무기물 또는 유기물을 포함할 수 있다. 제1 터치 절연층(TS-IL1) 및 제2 터치 절연층(TS-IL2) 중 적어도 어느 하나는 무기막을 포함할 수 있다. 무기막은 알루미늄 옥사이드, 티타늄 옥사이드, 실리콘 옥사이드 실리콘옥시나이트라이드, 지르코늄옥사이드, 및 하프늄 옥사이드 중 적어도 하나를 포함할 수 있다.
제1 터치 절연층(TS-IL1) 및 제2 터치 절연층(TS-IL2) 중 적어도 어느 하나는 유기막을 포함할 수 있다. 유기막은 아크릴계 수지, 메타크릴계 수지, 폴리이소프렌, 비닐계 수지, 에폭시계 수지, 우레탄계 수지, 셀룰로오스계 수지, 실록산계 수지, 폴리이미드계 수지, 폴리아미드계 수지 및 페릴렌계 수지 중 적어도 어느 하나를 포함할 수 있다.
도 6b에 도시된 것과 같이, 터치감지유닛(TS)은 제1 터치전극들(TE1-1 내지 TE1-5), 제1 터치전극들(TE1-1 내지 TE1-5)에 연결된 제1 터치 신호라인들(SL1-1 내지 SL1-5), 제2 터치전극들(TE2-1 내지 TE2-4), 제2 터치전극들(TE2-1 내지 TE2-4)에 연결된 제2 터치 신호라인들(SL2-1 내지 SL2-4), 및 제1 터치 신호라인들(SL1-1 내지 SL1-5)과 제2 터치 신호라인들(SL2-1 내지 SL2-4)에 연결된 터치 패드들(TS-PD)를 포함할 수 있다. 제1 터치전극들(TE1-1 내지 TE1-5)과 제2 터치전극들(TE2-1 내지 TE2-4)은 서로 교차한다. 제1 터치전극들(TE1-1 내지 TE1-5)은 제2 방향(DR2)으로 나열되며, 각각이 제1 방향(DR1)으로 연장된 형상이다.
제1 터치전극들(TE1-1 내지 TE1-5) 각각은 제1 길이를 갖고, 제2 터치전극들(TE2-1 내지 TE2-4) 각각은 제2 길이를 갖는다. 제1 길이는 제1 방향(DR1)으로 연장된 길이이며, 제2 길이는 제2 방향(DR2)으로 연장된 길이이며, 제2 길이는 제1 길이보다 크다. 도 7a 내지 도 7c를 참조하여 후술하는 것과 같이, 제2 터치전극들(TE2-1 내지 TE2-4)이 제1 터치전극들(TE1-1 내지 TE1-5)보다 더 많은 개수의 센서부들을 포함하기 때문에, 제2 터치전극들(TE2-1 내지 TE2-4)이 제1 터치전극들(TE1-1 내지 TE1-5)보다 큰 길이를 갖는다.
제1 터치 신호라인들(SL1-1 내지 SL1-5)은 제1 터치전극들(TE1-1 내지 TE1-5)의 일단에 각각 연결된다. 제2 터치 신호라인들(SL2-1 내지 SL2-4)은 제2 터치전극들(TE2-1 내지 TE2-4)의 양단에 각각 연결된다. 본 발명의 일 실시예에서 제1 터치 신호라인들(SL1-1 내지 SL1-5) 역시 제1 터치전극들(TE1-1 내지 TE1-5)의 양단에 연결될 수 있다. 본 발명의 일 실시예에서 제2 터치 신호라인들(SL2-1 내지 SL2-4)은 제2 터치전극들(TE2-1 내지 TE2-4)의 일단에만 각각 연결될 수 있다.
본 발명의 일 실시예에서 제1 터치 신호라인들(SL1-1 내지 SL1-5), 제2 터치 신호라인들(SL2-1 내지 SL2-4) 및 터치 패드들(TS-PD)은 별도로 제조되어 결합되는 회로 기판등에 의해 대체될 수도 있다. 본 발명의 일 실시예에서 터치 패드들(TS-PD)은 생략되고, 제1 터치 신호라인들(SL1-1 내지 SL1-5) 및 제2 터치 신호라인들((SL2-1 내지 SL2-4)은 도 3에 도시된 더미 터치 패드들(TS-DPD)에 연결될 수 있다.
터치감지유닛(TS)은 뮤추얼 캡 방식 또는 셀프 캡 방식으로 외부 입력을 감지할 수 있다. 도 6b에 도시되지 않았으나, 터치감지유닛(TS)은 적어도 하나의 터치 절연층을 포함한다.
도 6b에 도시된 것과 같이, 제1 터치전극들(TE1-1 내지 TE1-5) 각각은 제1 센서부들(SP1) 및 제1 연결부들(CP1)을 포함한다. 제2 터치전극들(TE2-1 내지 TE2-4) 각각은 제2 센서부들(SP2) 및 제2 연결부들(CP2)을 포함한다.
제1 센서부들(SP1)은 제1 방향(DR1)을 따라 나열되고, 제2 센서부들(SP2)은 제2 방향(DR2)을 따라 나열된다. 제1 연결부들(CP1) 각각은 인접한 제1 센서부들(SP1)을 연결하고, 제2 연결부들(CP2) 각각은 인접한 제2 센서부들(SP2)을 연결한다.
제1 터치전극들(TE1-1 내지 TE1-5)보다 길이가 긴 제2 터치전극들(TE2-1 내지 TE2-4)은 더 많은 개수의 센서부들과 연결부들을 포함한다. 그에 따라 제2 터치전극들(TE2-1 내지 TE2-4)은 제1 터치전극들(TE1-1 내지 TE1-5)보다 더 큰 외곽면적을 가질 수 있다. 여기서 "외곽면적"이란 터치전극의 외곽선이 정의하는 면적이다. 본 실시예에서 제1 센서부(SP1)와 제2 센서부(SP2)의 외곽면적은 서로 동일할 수 있다. 따라서, 제1 터치전극들(TE1-1 내지 TE1-5)과 제2 터치전극들(TE2-1 내지 TE2-4)의 외곽면적은 각각의 센서부 개수에 비례할 수 있다.
도 6b에는 5개의 제1 센서부들(SP1)을 포함하는 제1 터치전극들(TE1-1 내지 TE1-5)과 6개의 제2 센서부들(SP2)을 포함하는 제2 터치전극들(TE2-1 내지 TE2-4)을 예시적으로 도시하였다. 5개의 제1 센서부들(SP1) 중 양단에 배치된 2개 제1 센서부들(이하, 제1 하프 센서부)은 중앙에 배치된 제1 센서부 대비 1/2 크기를 가질 수 있다. 6개의 제2 센서부들(SP2) 중 양단에 배치된 2개 제2 센서부들(이하, 제2 하프 센서부)은 중앙에 배치된 제2 센서부 대비 1/2 크기를 가질 수 있다. 상술한 2개의 제1 하프 센서부들과 2개의 제2 하프 센서부들은 후술하는 외곽면적, 개구면적, 유효면적을 개산함에 있어서 1개의 센서부로 취급된다.
도 7a 내지 도 7c에 도시된 것과 같이, 박막 봉지층(TFE) 상에 제1 연결부들(CP1)이 배치된다. 제1 연결부들(CP1)은 투명 도전성 산화물 및/또는 금속을 포함할 수 있다. 본 실시예에서 제1 연결부들(CP1)은 다층의 금속층을 포함할 수 있다. 본 발명의 일 실시예에서 제1 연결부들(CP1)을 대신하여 제2 연결부들(CP2)이 박막 봉지층(TFE) 상에 배치될 수도 있다.
박막 봉지층(TFE) 상에 제1 연결부들(CP1)을 커버하는 제1 터치 절연층(TS-IL1)이 배치된다. 제1 터치 절연층(TS-IL1)에는 제1 연결부들(CP1)을 노출시키는 콘택홀들(CH10)이 정의된다.
제1 터치 절연층(TS-IL1) 상에 제1 센서부들(SP1)과 제2 센서부들(SP2)이 배치된다. 또한, 제1 터치 절연층(TS-IL1) 상에 제2 연결부들(CP2)이 배치된다. 동일한 포토리소그래피 공정을 통해 형성된 제2 센서부들(SP2)과 제2 연결부들(CP2)은 일체의 형상을 갖는다.
제1 센서부들(SP1), 제2 센서부들(SP2) 및 제2 연결부들(CP2)은 투명 도전성 산화물 및/또는 금속을 포함할 수 있다. 본 실시예에서 제1 센서부들(SP1), 제2 센서부들(SP2) 및 제2 연결부들(CP2)은 다층의 금속층, 예컨대 Ti/Al/Ti 금속층들을 포함할 수 있다.
제1 터치 절연층(TS-IL1) 상에 제1 터치 신호라인들(SL1-1 내지 SL1-5) 및 제2 터치 신호라인들(SL2-1 내지 SL2-4)이 배치된다. 제1 터치 신호라인들(SL1-1 내지 SL1-5) 및 제2 터치 신호라인들(SL2-1 내지 SL2-4)은 제1 센서부들(SP1)과 동일한 공정에 의해 형성될 수 있고, 동일한 적층 구조를 가질 수 있다.
본 실시예에와 같이, 제2 도전층(TS-CL2)이 제1 센서부들(SP1)와 제2 센서부들(SP2)을 포함함으로써, 표시패널(DP)의 제2 전극(CE)과의 거리를 좀 더 멀리 유지할 수 있다. 제1 도전층(TS-CL1)이 제1 센서부들(SP1)와 제2 센서부들(SP2)을 포함하는 터치감지유닛 대비하여, 본 실시예에 따른 터치감지유닛은 제2 전극(CE)과 제1 센서부들(SP1) 및 제2 센서부들(SP2) 사이의 기생 커패시턴스(Cbc)를 감소시킬 수 있다.
제2 전극(CE)과 제1 센서부들(SP1) 및 제2 센서부들(SP2) 사이의 거리는 0.5 마이크로미터 내지 5 마이크로미터일 수 있다. 제2 전극(CE)과 제1 센서부들(SP1) 및 제2 센서부들(SP2) 사이에 배치된 절연층, 예컨대, 도 6a에 도시된 박막 봉지층(TFE)과 제1 터치 절연층(TS-IL1)의 두께의 합이 0.5 마이크로미터 내지 30 마이크로미터일 수 있다. 표시패널의 플렉서블리티를 높이기 위하여 제2 전극(CE)과 제1 센서부들(SP1) 및 제2 센서부들(SP2) 사이에 배치된 절연층의 두께는 0.5 마이크로미터 내지 10 마이크로미터, 더 바람직하게는 0.5 마이크로미터 내지 5 마이크로미터일 수 있다.
도 1a 내지 도 1c를 참조하여 설명한 것과 같이, 폴더블 표시모듈은 두께가 얇을수록 폴딩시 발생하는 내부 구성들의 크랙을 방지할 수 있다. 본 실시예에서, 얇은 두께의 박막 봉지층(TFE)과 제1 터치 절연층(TS-IL1)을 적용하더라도 제2 도전층(TS-CL2)이 제1 센서부들(SP1)와 제2 센서부들(SP2)을 포함함으로써 기생 커패시턴스를 감소시킬 수 있다.
다만, 이에 제한되지 않고, 본 발명의 일 실시예에서 제1 도전층(TS-CL1)의 구성들과 제2 도전층(TS-CL2)의 구성들은 서로 바뀔 수 있다. 예컨대, 제1 터치 절연층(TS-IL1)의 상측에 제2 연결부들(CP2)이 배치되고, 터치 절연층(TS-IL1)의 하측에 제1 센서부들(SP1), 제2 센서부들(SP2), 및 제1 연결부들(CP1)이 배치될 수 있다.
도 8a는 본 발명의 일 실시예에 따른 터치감지유닛의 부분 평면도이다. 도 8b는 도 8a의 부분 확대도이다. 도 8c는 도 8b의 부분 확대도이다. 도 8a는 2개의 제1 센서부들(SP1)과 2개의 제2 센서부들(SP2)에 대응하는 영역을 확대 도시하였다. 도 8b는 8a의 AA영역을, 도 8c는 도 8b의 BB영역을 확대 도시하였다.
도 8a에 도시된 것과 같이, 제1 센서부(SP1)는 제1 중심부분(CTP1)과 제1 테두리부분(EP1)을 포함하고, 제2 센서부(SP2)는 제2 중심부분(CTP2)과 제2 테두리부분(EP2)을 포함한다. 제1 중심부분(CTP1)에는 적어도 하나의 제1 개구부들(SP-OP1)이 정의되고, 제2 중심부분(CTP2)에는 적어도 하나의 제2 개구부들(SP-OP2)이 정의된다. 도 8a에는 매트릭스 형태로 배치된 16개의 제1 개구부들(SP-OP1)과 매트릭스 형태로 배치된 36개의 제2 개구부들(SP-OP2)이 예시적으로 도시되었다. 본 발명의 일 실시예에서 제1 개구부들(SP-OP1)은 제2 개구부들(SP-OP2)과 동일한 개수로 제공될 수 있고, 이때 제1 개구부들(SP-OP1)은 제2 개구부들(SP-OP2)보다 작은 면적을 갖는다.
제1 센서부(SP1)과 제2 센서부(SP2) 각각에 개구부들이 정의됨으로써 도 7c를 참조하여 설명한 제2 전극(CE)과 제1 센서부들(SP1) 및 제2 센서부들(SP2) 사이의 기생 커패시턴스, 다시 말해 제2 전극(CE)과 제1 터치전극들(TE1-1 내지 TE1-5, 도 6b 참조) 및 제2 터치전극들(TE2-1 내지 TE2-4, 도 6b 참조) 사이의 기생 커패시턴스가 감소될 수 있다.
제1 센서부(SP1)와 제2 센서부(SP2)가 인접한 제1 테두리부분(EP1)과 제2 테두리부분(EP2)에는 개구부를 형성하지 않음으로써, 제1 센서부(SP1)와 제2 센서부(SP2) 사이의 커패시턴스 변화량값이 기준값 이상 유지될 수 있다. 제1 센서부(SP1)와 제2 센서부(SP2) 사이의 대향 면적이 커패시턴스에 더 큰 영향을 미치기 때문이다. 커패시턴스 변화량값은 터치 이벤트가 발생하기 전의 커패시턴스와 터치 이벤트가 발생한 후의 커패시턴스의 차이값이다.
제1 개구부들(SP-OP1)에 의해 제1 터치전극들(TE1-1 내지 TE1-5)은 제1 개구면적을 갖고, 제2 개구부들(SP-OP2)에 의해 제2 터치전극들(TE2-1 내지 TE2-4)은 제2 개구면적을 갖는다. 제1 개구면적은 제1 개구부들(SP-OP1)의 전체면적의 합으로 정의되고, 제2 개구면적은 제2 개구부들(SP-OP2)의 전체면적의 합으로 정의된다.
도 8a에 도시된 것과 같이, 제2 센서부(SP2)가 제1 센서부(SP1)보다 더 많은 개수의 개구부들을 구비하기 때문에 제2 개구면적은 제1 개구면적보다 크다. 제1 터치전극들(TE1-1 내지 TE1-5)보다 외곽면적이 더 큰 제2 터치전극들(TE2-1 내지 TE2-4)에 더 큰 개구면적을 형성하여, 제1 터치전극들(TE1-1 내지 TE1-5) 및 제2 터치전극들(TE2-1 내지 TE2-4)에 미치는 기생커패시턴스의 편차를 감소시킬 수 있다.
제1 터치전극들(TE1-1 내지 TE1-5)과 제2 터치전극들(TE2-1 내지 TE2-4)은 기생커패시턴스를 감소시키기 위해 메쉬형상을 가질 수 있다. 이하, 제1 터치전극들(TE1-1 내지 TE1-5)과 제2 터치전극들(TE2-1 내지 TE2-4)에 대해 좀 더 상세히 설명한다.
도 8b 및 도 8c에 도시된 것과 같이, 제1 센서부(SP1)와 제2 센서부(SP2)는 메쉬선들을 포함할 수 있다. 별도로 도시하지 않았으나, 제1 연결부(CP1)와 제2 연결부(CP2) 역시 메쉬선들을 포함할 수 있다.
도 8c에 도시된 것과 같이, 제2 센서부(SP2)는 발광영역들(PXA-R, PXA-G, PXA-B)에 비중첩하고, 비발광영역(NPXA)에 중첩한다. 발광영역들(PXA-R, PXA-G, PXA-B)은 도 5의 발광영역(PXA)과 같이 정의될 수 있다. 제2 센서부(SP2)의 메쉬선들은 복수 개의 메쉬홀들(TS-OPR, TS-OPG, TS-OPB)을 정의한다. 메쉬선들의 선폭은 수 마이크로미터 내지 수 나노미터일 수 있다. 제2 센서부(SP2)에는 복수 개의 메쉬홀들(TS-OPR, TS-OPG, TS-OPB)이 정의된다. 복수 개의 메쉬홀들(TS-OPR, TS-OPG, TS-OPB)은 발광영역들(PXA-R, PXA-G, PXA-B)에 일대일 대응할 수 있다.
발광영역들(PXA-R, PXA-G, PXA-B)은 서로 이격되어 배치되고, 발광영역들(PXA-R, PXA-G, PXA-B) 사이에 비발광영역(NPXA)이 배치된다. 발광영역들(PXA-R, PXA-G, PXA-B)마다 유기발광 다이오드들(OLED)이 배치된다. 발광영역들(PXA-R, PXA-G, PXA-B)은 유기발광 다이오드들(OLED)에서 생성되는 광의 컬러에 따라 몇개의 그룹으로 구분될 수 있다. 도 8c에는 발광 컬러에 따라 3개의 그룹으로 구분되는 발광영역들(PXA-R, PXA-G, PXA-B)을 도시하였다.
발광영역들(PXA-R, PXA-G, PXA-B)은 유기발광 다이오드(OLED, 도 5 참조)의 발광층(EML, 도 6c 참조)에서 발광하는 컬러에 따라 다른 면적을 가질 수 있다. 유기발광 다이오드의 종류에 따라 발광영역들(PXA-R, PXA-G, PXA-B)의 면적이 결정될 수 있다.
복수 개의 메쉬홀들(TS-OPR, TS-OPG, TS-OPB)은 서로 다른 면적을 갖는 몇개 그룹들로 구분될 수 있다. 복수 개의 메쉬홀들(TS-OPR, TS-OPG, TS-OPB)은 대응하는 발광영역들(PXA-R, PXA-G, PXA-B)에 따라 3개의 그룹으로들로 구분될 수 있다.
이상에서, 메쉬홀들(TS-OPR, TS-OPG, TS-OPB)이 발광영역들(PXA-R, PXA-G, PXA-B)에 일대일 대응하는 것으로 도시하였으나, 이에 제한되지 않는다. 하나의 메쉬홀은(TS-OPR, TS-OPG, TS-OPB)은 2 이상의 발광영역들(PXA-R, PXA-G, PXA-B)에 대응할 수 있다.
발광영역들(PXA-R, PXA-G, PXA-B)의 면적이 다양한 것을 예시적으로 도시하였으나, 이에 제한되지 않는다. 발광영역들(PXA-R, PXA-G, PXA-B)의 크기는 서로 동일할 수 있고, 또한 메쉬홀들(TS-OPR, TS-OPG, TS-OPB)의 크기도 서로 동일할 수 있다.
도 8b에 도시된 것과 같이, 제1 개구부들(SP-OP1) 내측에 제1 더미전극들(DM1)이 배치되고, 제2 개구부들(SP-OP2) 내측에 제2 더미전극들(DM2)이 배치될 수 있다. 제1 개구부들(SP-OP1)마다 제1 더미전극들(DM1)이 배치되고, 제2 개구부들(SP-OP2)마다 제2 더미전극들(DM2)이 배치될 수 있다.
제1 더미전극들(DM1)과 제2 더미전극들(DM2)은 플로팅 전극일 수 있다. 따라서, 터치전극들의 기생 커패시턴스에 영향을 미치지 않는다. 제1 더미전극들(DM1)과 제2 더미전극들(DM2)이 제1 개구부들(SP-OP1)와 제2 개구부들(SP-OP2)에 배치됨으로써 개구부들의 외부광 반사율을 터치전극의 다른 영역의 반사율과 유사한 수준으로 증가시킨다.
도 8b에 도시된 것과 같이, 제1 더미전극들(DM1)과 제2 더미전극들(DM2)은 메쉬선들을 포함할 수 있다. 구체적으로 도시하지 않았으나, 제1 더미전극들(DM1)과 제2 더미전극들(DM2)은 도 8c에 도시된 제2 센서부(SP2)의 메쉬선들과 동일한 특징을 가질 수 있다.
도 9a는 본 발명의 일 실시예에 따른 터치감지유닛(TS)의 부분 평면도이다. 도 9b는 제1 터치전극(TE1-4)과 제2 터치전극(TE1-2)의 외곽면적을 나타낸 평면도이다. 도 9c는 제1 터치전극(TE1-4)과 제2 터치전극(TE2-2)의 개구면적을 나타낸 평면도이다. 도 9d는 제1 터치전극(TE1-4)과 제2 터치전극(TE2-2)의 유효면적을 나타낸 평면도이다. 도 9e는 제1 센서부(SP1)와 제2 센서부(SP2)를 도시한 평면도이다.
도 9a 내지 도 9e는 도 6b에 도시된 제1 터치전극들(TE1-1 내지 TE1-5) 중 네번째 제1 터치전극(TE1-4)과 제2 터치전극들(TE2-1 내지 TE2-4) 중 두번째 제2 터치전극(TE2-2)을 예시적으로 도시하였다.
도 9a 및 도 9b에 도시된 것과 같이, 제2 터치전극(TE2-2)은 제1 터치전극(TE1-4)보다 큰 외곽면적(헤칭으로 표시된 면적)을 갖는다. 제2 터치전극(TE2-2)과 제1 터치전극(TE1-4)이 구비한 센서부의 개수에 따라 제2 터치전극(TE2-2)과 제1 터치전극(TE1-4)의 면적이 결정될 수 있다.
도 9a에서 제2 터치전극(TE2-2)은 5개의 제2 센서부에 대응하는 외곽면적을 갖고, 제1 터치전극(TE1-4)은 4개의 제2 센서부에 대응하는 외곽면적을 갖는다. 본 실시예에서, 제2 센서부(SP2)와 제1 센서부(SP1)는 동일한 외곽면적 및 동일한 형상을 가질 수 있다.
도 9a 및 도 9c에 도시된 것과 같이, 제2 터치전극(TE2-2)의 개구면적(헤칭으로 표시된 면적, 이하 제2 개구면적)은 제1 터치전극(TE1-4)의 개구면적(헤칭으로 표시된 면적, 이하 제1 개구면적) 보다 크다. 도 9d에서 설명하는 제1 유효면적과 제2 유효면적이 실질적으로 동일하도록 제1 개구면적과 제2 개구면적을 정의할 수 있다.
도 9d에 도시된 제2 터치전극(TE2-2)의 유효면적(헤칭으로 표시된 면적, 이하 제2 유효면적)은 제1 터치전극(TE1-4)의 유효면적(헤칭으로 표시된 면적, 이하 제1 유효면적)과 실질적으로 동일할 수 있다. 제1 유효면적 및 제2 유효면적은 도 9b를 참조한 제1 외곽면적 및 제2 외곽면적에서 도 9c를 참조한 제1 개구면적과 제2 개구면적을 각각 감산한 면적일 수 있다. 또한, 유효면적은 도 8a 내지 도 8c를 참조하여 설명한 메쉬선들이 배치되는 면적일 수 있다.
여기서 "유효면적이 실질적으로 동일하다"는 것은 제1 센서부(SP1) 및 제2 센서부(SP2) 대비 상대적으로 작은 면적을 갖는 제1 연결부들(CP1)의 면적 및 제2 연결부들(CP2)의 면적을 유효면적에 포함시켜서 동일하다는 것을 의미한다.
제1 터치전극(TE1-4)과 제2 터치전극(TE2-2)의 유효면적이 동일함으로써, 도 7c를 참조하여 설명한 제1 터치전극(TE1-4)과 제2 터치전극(TE2-2)에 미치는 기생 커패시턴스(Cbc, 도 7c 참조)의 편차를 감소시킬 수 있다.
제1 유효면적과 제2 유효면적이 실질적으로 동일하지 않더라도 기생 커패시턴스(Cbc)의 편차를 감소시키기 위해 제1 유효면적은 제2 유효면적 대비 95% 내지 105% 인 것이 바람직하다.
도 9e를 참조하여 제1 센서부(SP1) 및 제2 센서부(SP2)의 유효면적에 대해 설명한다. 앞서 설명한 것과 같이, 제1 센서부(SP1)와 제2 센서부(SP2)의 외곽면적 및 형상은 서로 동일할 수 있다. 제2 터치전극(TE2-2)이 X 개의 제2 센서부(SP2)를 포함하고, 제1 터치전극(TE1-4)이 Y 개의 제1 센서부(SP1)를 포함할 때, 제2 터치전극(TE2-2)은 제1 터치전극(TE1-4) 대비 약 X/Y×100(%)의 외곽면적을 가질 수 있다. 도 9b에 도시된 제2 터치전극(TE2-2)은 제1 터치전극(TE1-4) 대비 약 125(%)의 외곽면적을 가질 수 있다.
제2 터치전극(TE2-2)과 제1 터치전극(TE1-4)이 실질적으로 동일한 유효면적을 갖기 위해서, 제2 센서부(SP2)은 제1 센서부(SP1) 대비 약 Y/X×100(%)의 유효면적을 가질 수 있다. 도 9b에 도시된 제2 센서부(SP2)는 제1 센서부(SP1) 대비 약 80(%)의 유효면적을 가질 수 있다.
상기 제1 유효면적은 상기 제1 외곽면적 대비 10 % 내지 70 % 이고, 상기 제2 유효면적은 상기 제2 외곽면적 대비 30 % 내지 90 % 일 수 있다. 도 9e에는 동일한 형상의 제1 개구부들(SP-OP1)과 제2 개구부들(SP-OP2)을 도시하였으나, 이에 제한되지 않는다.
도 6a 내지 도 9e를 참조하여 설명한 터치감지유닛(TS)에 있어서, 터치전극의 외곽면적의 결정인자를 터치전극의 길이에 한정하였으나, 본원 발명은 이에 제한되지 않는다. 본 발명의 일 실시예에서 2 터치전극들(TE2-1 내지 TE2-4)의 제2 길이는 제1 터치전극들(TE1-1 내지 TE1-5)의 제1 길이보다 크지 않을 수도 있다. 본 발명의 일 실시예에서 제1 터치전극이 제1 외곽면적 및 제1 개구 면적를 가질 때, 제2 터치전극이 상기 제1 외곽면적보다 큰 제2 외곽면적을 갖고 상기 제1 개구 면적보다 큰 제2 개구 면적을 가질 수도 있다.
도 10은 본 발명의 일 실시예에 따른 제1 센서부(SP10)와 제2 센서부(SP20)를 도시한 평면도이다. 도 11은 본 발명의 일 실시예에 따른 제1 센서부(SP100)와 제2 센서부(SP200)를 도시한 평면도이다. 이하, 도 1 내지 도 9e을 참조하여 설명한 구성과 동일한 구성에 대한 상세한 설명은 생략한다.
도 10에 도시된 제1 센서부(SP10)와 제2 센서부(SP20)는 도 9e에 도시된 제1 센서부(SP10)와 제2 센서부(SP20) 대비 제1 테두리부분(EP1)과 제2 테두리부분(EP2)만을 포함하는 것과 같다. 제1 센서부(SP10)와 제2 센서부(SP20)에는 하나의 제1 개구부(SP-OP10) 및 제2 개구부(SP-OP20)가 각각 정의된다. 제1 개구부(SP-OP10) 및 제2 개구부(SP-OP20) 내측에는 제1 더미전극(DM10)과 제2 더미전극(DM20)이 각각 배치된다.
제1 센서부(SP10), 제2 센서부(SP20), 제1 더미전극(DM10) 및 제2 더미전극(DM20)은 메쉬 형상을 가질 수 있다. 제1 센서부(SP10)를 포함하는 제1 터치전극과 제2 센서부(SP20)를 포함하는 제2 터치전극의 유효면적은 실질적으로 동일할 수 있다.
도 11에 도시된 제1 센서부(SP100)는 제1 테두리부분(EP1)과 제1 다이렉트 패스부분(DP1)을 포함하고, 제2 센서부(SP200)는 제2 테두리부분(EP2)과 제2 다이렉트 패스부분(DP2)을 포함할 수 있다. 제1 센서부(SP100)와 제2 센서부(SP200) 각각에는 2개의 개구부들이 정의될 수 있다.
제1 개구부들(SP-OP101, SP-OP102)은 제1 테두리부분(EP1)에 의해 에워싸이고, 제1 다이렉트 패스부분(DP1)을 사이에 두고 이격될 수 있다. 제2 개구부들(SP-OP201, SP-OP202)은 제2 테두리부분(EP2)에 의해 에워싸이고, 제2 다이렉트 패스부분(DP2)을 사이에 두고 이격될 수 있다. 제1 다이렉트 패스부분(DP1)은 제1 터치전극(TE1-4, 도 9a 참조)의 연장선(TE1-EL) 상에 배치되고, 제2 다이렉트 패스부분(DP2)은 제2 터치전극(TE2-2, 도 9a 참조)의 연장선(TE2-EL) 상에 배치될 수 있다. 제1 다이렉트 패스부분(DP1)과 제2 다이렉트 패스부분(DP2)은 센서부에 형성된 개구부들에 의해 전류패스가 차단 또는 우회되는 것을 방지한다.
제1 개구부들(SP-OP101, SP-OP102)에는 제1 더미전극들(DM10-1, DM10-2)이 배치되고, 제2 개구부들(SP-OP201, SP-OP202)에는 제2 더미전극들(DM20-1, DM20-2)이 배치될 수 있다.
제1 센서부(SP100), 제2 센서부(SP200), 제1 더미전극(DM10-1, DM10-2) 및 제2 더미전극(DM20-1, DM20-2)은 메쉬 형상을 가질 수 있다. 제1 센서부(SP100) 포함하는 제1 터치전극과 제2 센서부(SP200)를 포함하는 제2 터치전극의 유효면적은 실질적으로 동일할 수 있다.
이상에서는 본 발명의 바람직한 실시예를 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자 또는 해당 기술 분야에 통상의 지식을 갖는 자라면, 후술될 특허청구범위에 기재된 본 발명의 사상 및 기술 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허청구범위에 의해 정하여져야만 할 것이다.
T1: 제1 박막 트랜지스터 T2: 제2 박막 트랜지스터
OLED: 유기발광 다이오드 TFE: 박막 봉지층
TE: 터치 전극 SL: 터치 신호라인
SP: 센서부 CP: 연결부

Claims (20)

  1. 베이스 면을 제공하는 표시패널; 및
    상기 베이스 면 상에 직접 배치된 터치감지유닛을 포함하고,
    상기 터치감지유닛은,
    제1 방향으로 연장되고, 제1 개구 면적를 갖는 제1 터치전극;
    상기 제1 터치전극과 교차하는 제2 방향으로 연장되고, 상기 제1 터치전극보다 길이가 길고, 상기 제1 개구 면적보다 큰 제2 개구 면적을 갖는 제2 터치전극; 및
    상기 제1 터치전극과 상기 제2 터치전극을 절연시키는 터치 절연층을 포함하는 표시모듈.
  2. 제1 항에 있어서,
    상기 제1 터치전극과 상기 제2 터치전극 각각은 메쉬선들을 포함하는 표시모듈.
  3. 제2 항에 있어서,
    상기 제1 터치전극의 상기 메쉬선들이 배치된 유효면적과 상기 제2 터치전극의 상기 메쉬선들이 배치된 유효면적은 실질적으로 동일한 표시모듈.
  4. 제2 항에 있어서,
    상기 표시패널은 서로 이격된 복수 개의 발광영역들과 상기 복수 개의 발광영역들 사이에 배치된 비발광영역을 포함하고,
    상기 메쉬선들은 상기 비발광영역에 중첩하는 표시모듈.
  5. 제1 항에 있어서,
    상기 제1 개구 면적은 적어도 하나의 제1 개구부에 의해 정의되고, 상기 제2 개구 면적은 적어도 하나의 제2 개구부에 의해 정의되고,
    상기 제1 개구부 내측에 배치된 제1 더미 전극 및 상기 제2 개구부 내측에 배치된 제2 더미 전극을 더 포함하는 표시모듈.
  6. 제5 항에 있어서,
    상기 제1 개구부는 복수 개 제공되고, 상기 제1 더미 전극은 상기 제1 개구부들마다 배치된 표시모듈.
  7. 제5 항에 있어서,
    상기 제1 더미 전극 및 상기 제2 더미 전극 각각은 메쉬선들을 포함하는 표시모듈.
  8. 제1 항에 있어서,
    상기 제1 터치전극은 상기 제1 방향으로 나열된 Y개(여기서 Y는 2 이상의 자연수)의 제1 센서부들 및 상기 제1 센서부들 중 인접한 제1 센서부들을 연결하는 제1 연결부들을 포함하고, 상기 제1 센서부들마다 적어도 하나의 제1 개구부가 정의되고,
    상기 제2 터치전극은 상기 제2 방향으로 나열된 X개의 제2 센서부들(여기서 X는 Y보다 큰 자연수) 및 상기 제2 센서부들 중 인접한 제2 센서부들을 연결하는 제2 연결부들을 포함하고, 상기 제2 센서부들마다 적어도 하나의 제2 개구부가 정의된 표시모듈.
  9. 제8 항에 있어서,
    상기 제1 터치전극은 제1 외곽면적을 가지고, 상기 제2 터치전극은 제2 외곽면적을 가지며,
    상기 제2 외곽면적은 제1 외곽면적 대비 X/Y×100(%)인 표시모듈.
  10. 제8 항에 있어서,
    상기 제1 센서부들 각각은 제1 외곽면적을 가지고, 상기 제2 센서부들 각각은 제2 외곽면적을 가지며,
    상기 제1 센서부들 각각은 제1 외곽면적에서 상기 적어도 하나의 제1 개구부의 면적을 제외한 제1 유효면적을 갖고,
    상기 제2 센서부들 각각은 제2 외곽면적에서 상기 적어도 하나의 제2 개구부의 면적을 제외한 제2 유효면적을 갖고,
    상기 제2 유효면적은 상기 제1 유효면적보다 작은 표시모듈.
  11. 제10 항에 있어서,
    상기 제2 유효면적은 상기 제1 유효면적 대비 Y/X×100(%)의 표시모듈.
  12. 제10 항에 있어서,
    상기 제1 유효면적은 상기 제1 외곽면적 대비 10 % 내지 70 % 이고,
    상기 제2 유효면적은 상기 제2 외곽면적 대비 30 % 내지 90 % 인 표시모듈.
  13. 제10 항에 있어서,
    상기 제1 외곽면적과 상기 제2 외곽면적은 실질적으로 동일한 표시모듈.
  14. 제8 항에 있어서,
    상기 터치 절연층은 제1 터치 절연층 및 제2 터치 절연층을 포함하고,
    상기 제1 연결부들과 상기 제2 연결부들 중 어느 하나의 연결부들은 상기 베이스 면 상에 배치되고, 상기 제1 터치 절연층은 상기 어느 하나의 연결부들 상에 배치되며, 상기 제1 센서부들, 상기 제2 센서부들, 및 상기 제1 연결부들과 상기 제2 연결부들 중 다른 하나의 연결부들은 상기 제1 터치 절연층 상에 배치되고, 상기 제2 터치 절연층은 상기 제1 센서부들, 상기 제2 센서부들, 및 다른 하나의 연결부들 상에 배치된 표시모듈.
  15. 제8 항에 있어서,
    상기 적어도 하나의 제1 개구부는 2개의 제1 개구부들로 제공되고,
    상기 제1 센서부들 각각은 상기 2개의 제1 개구부들을 에워싸는 테두리부분 및 상기 2개의 제1 개구부들 사이에 배치된 다이렉트 패스부분을 포함하고, 상기 다이렉트 패스부분은 상기 제1 터치전극의 연장선 상에 배치된 표시모듈.
  16. 제1 항에 있어서,
    상기 제1 터치전극의 일단에 연결된 제1 터치 신호라인 및 상기 제2 터치전극의 양단에 각각 연결된 제2 터치 신호라인들을 더 포함하는 표시모듈.
  17. 제1 항에 있어서,
    상기 표시패널 및 상기 터치감지유닛은 벤딩축(BX)에 기초하여 벤딩되는 것을 특징으로하는 표시모듈.
  18. 제1 항에 있어서,
    상기 표시패널은 상기 제1 터치전극과 절연층들을 사이에 두고 배치된 캐소드를 포함하고,
    상기 절연층들의 두께의 합은 0.5 마이크로미터 내지 30 마이크로미터인 표시모듈.
  19. 제1 항에 있어서,
    상기 표시패널은 베이스층, 상기 베이스층 상의 회로 소자층, 상기 회로 소자층 상의 표시 소자층 및 상기 표시 소자층 상의 박막 봉지층을 포함하고,
    상기 표시 소자층은 제1 전극, 상기 제1 전극 상의 유기발광층, 상기 유기발광층과 상기 박막 봉지층 사이에 배치된 제2 전극을 포함하고,
    상기 제1 터치전극과 상기 제2 전극 사이의 거리는 0.5 마이크로미터 내지 30 마이크로미터인 표시모듈.
  20. 베이스 면을 제공하는 표시패널; 및
    상기 베이스 면 상에 직접 배치된 터치감지유닛을 포함하고,
    상기 터치감지유닛은,
    제1 방향으로 연장되고, 제1 외곽면적 및 제1 개구 면적를 갖는 제1 터치전극; 및
    상기 제1 터치전극과 교차하는 제2 방향으로 연장되고, 상기 제1 외곽면적보다 큰 제2 외곽면적을 갖고 상기 제1 개구 면적보다 큰 제2 개구 면적을 갖는 제2 터치전극을 포함하는 표시모듈.
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