KR102124127B1 - 표시장치 및 소비전력 저감 방법 - Google Patents
표시장치 및 소비전력 저감 방법 Download PDFInfo
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Abstract
본 발명은 수면모드에서 소비전력 저감 표시장치 및 소비전력 저감 방법에 관한 것으로서, 본 발명에 따른 소비전력 저감방법은, 출력 영상 데이터 신호에 따라 표시패널에 출력 영상이 표시되는 정상 구동모드 단계; 수면모드 명령에 따라, 세트에서 표시장치로 전송되는 클락 신호 및 영상 데이터 신호를 제 1 전압으로 유지하는 수면모드 단계; 상기 수면모드가 시작되는 시간을 시작점으로 수면모드 시간을 측정하는 단계; 측정된 상기 수면모드 기간이 제 1기준시간을 초과하면, 상기 세트의 레지스터 값을 변경하고, 변경된 레지스터 값에 따라 상기 클락 신호를 제2 전압으로 유지하는 클락 오프모드 단계를 포함한다.
Description
본 발명은 능동 형 유기발광 다이오드(AMOLED) 표시장치의 수면모드 에서 소비전력을 저감하기 위한 기술에 관한 것이다.
일반적으로 종래에는 AMOLED표시장치의 소비전력을 저감하는 방법으로 구동전압 변화 및 휘도 변화에 따른 소비전력을 저감하는 방법을 사용하였으며, 특히 종래 소비전력을 저감하는 방법은 구동 상태(Normal Mode)에서 소비전력을 저감하는 방법이 대부분이고, 수면모드(Sleep Mode)상태 에서의 소비전력을 줄이는 방법에 대한 기술은 제한적이다.
종래AMOLED 표시장치의 수면모드(Sleep Mode)상태에서 소비전력을 저감하기 위한 기능으로는 깊은 수면모드(Ultra Low Power State, ULPS; Deep Sleep Mode)방법이 사용되고 있으나, 적용이 제한적이며, 깊은 수면모드에 진입하기 위한 별도의 레지스터 구성 및 절차가 필요하다는 문제가 있다.
종래 AMOLED 표시장치를 포함한 세트에서 수면모드(Sleep Mode)로 진입할 경우, 세트 대부분의 파워블록(Power block) 및 PLL(Phase Locked Loop)은 오프 상태가 되며, 오실레이터(Oscillator) 및 일부 I/O핀 들만 제한적으로 사용된다.
하지만, 세트와 디스플레이 모듈(Display Module)이 연계된 DSI(Display Serial Interface) 인터페이스의 경우에는, 수면모드(Sleep Mode)로 진입하더라도 완전히 오프 상태가 아닌 상태로 유지되어 드라이버 아이씨(Driver IC) 내부에서 수십~수백 μA의 전류소모가 발생하게 된다.
따라서, 수면모드를 지속적으로 유지할 경우, 드라이버 아이씨(Driver IC) 내부에서 불필요한 소비전력이 소모되는 문제점이 있다.
본 발명은 상술한 문제점을 극복하기 위한 것으로서, 본 발명의 목적은 오실레이터(Oscillator) 레지스터의 제어로써 클락을 보다 효율적으로 관리하여 수면모드에서 소비전력을 최소화하기 위함이다.
또한, 세트의 오실레이터 오프를 통한 소비전력 감소 및 수면모드 상태의 절전모드를 지속시간에 따라 적응적으로 변환함으로써, 지속적인 수면모드 상태에서의 소비전력 효율을 크게 향상시키기 위함이다.
본 발명에 따른 소비전력 저감방법은, 출력 영상 데이터 신호에 따라 표시패널에 출력 영상이 표시되는 정상 구동모드 단계;
수면모드 명령에 따라, 세트에서 표시장치로 전송되는 클락 신호 및 영상 데이터 신호를 제 1 전압으로 유지하는 수면모드 단계; 상기 수면모드가 시작되는 시간을 시작점으로 수면모드 시간을 측정하는 단계; 측정된 상기 수면모드 기간이 제 1기준시간을 초과하면, 상기 세트의 레지스터 값을 변경하고, 변경된 레지스터 값에 따라 상기 클락 신호를 제2 전압으로 유지하는 클락 오프모드 단계를 포함한다.
또한, 본 발명에 따른 소비전력 저감방법은, 상기 클락오프 모드가 시작되는 시간을 시작점으로 클락오프 모드 기간을 측정하는 단계; 및 측정된 상기 수면모드 기간이 제 2기준시간을 초과하면 상기 클락 신호 및 영상 데이터 신호를 상기 제2 전압으로 유지하는 깊은 수면모드 단계를 더 포함한다.
또한, 본 발명에 따른 소비전력 저감방법은, 측정된 상기 수면모드 기간이 제 1기준시간을 초과하면 상기 클락 오프 모드 단계로 이동하며, 제1 기준시간 이하이면 수면모드 단계를 유지한다.
또한, 본 발명에 따른 소비전력 저감방법은, 상기 측정된 클락 오프모드 기간이 제 2기준시간을 초과하면 상기 깊은수면 모드 단계로 이동하며, 제2 기준시간 이하이면 수면모드 단계를 유지한다.
또한, 본 발명에 따른 소비전력 저감 표시장치는, 모드 명령을 결정하고, 결정한 모드 명령에 따라 클락 또는 데이터 레인에 인가되는 전압 중 적어도 하나 이상의 전압을 변경하는 세트;
출력 영상 데이터 신호를 생성하여 데이터 구동부에 전송하는 신호 제어부; 게이트 구동부로부터 순차로 전달된 게이트 신호에 응답하여, 상기 출력 영상 데이터에 대응하는 데이터 전압을 표시 패널에 인가하는 데이터 구동부; 및 상기 데이터 구동부의 데이터 전압에 따라 출력 영상을 표시하는 표시 패널을 포함한다.
또한, 본 발명에 따른 세트는 상기, 신호 제어부에 클락 신호를 전송하는 오실레이터; 상기 오실레이터를 제어하는 레지스터; 상기 모드 명령에 따라 상기 레지스터 값을 변경하고 변경된 레지스터 값에 따라 상기 오실레이터를 제어하는 CPU를 포함한다.
또한, 본 발명에 따른 모드 명령은 수면 모드이고, 상기 CPU는 상기 수면 모드 명령에 따라 상기 클락 레인과 데이터 레인에 제 1 전압을 인가하여 수면모드로 진입한다.
또한, 본 발명에 따른 모드 명령이 클락오프 모드 명령이거나 또는 상기 수면 모드 상태가 기 설정된 제1 기준 시간을 초과할 경우, 상기 CPU는 상기 데이터 레인에 제1 전압을 인가하고, 상기 레지스터의 값을 변경하며 변경된 레지스터 값에 의해 상기 클락 레인에 제 2 전압을 인가하여 상기 오실레이터를 오프하는 클락 오프모드로 진입한다.
또한, 본 발명에 따른 모드 명령이 깊은수면 모드 명령이거나, 또는 상기 클락 오프모드 상태가 기 설정된 제2 기준시간을 초과하여 지속 될 경우, 상기 CPU는 상기 클락 레인과 데이터 레인에 제 2 전압을 인가하여 깊은수면 모드로 진입한다.
또한, 본 발명에 따른 CPU는 카운터를 포함하여 상기 카운터는 상기 수면모드가 시작되는 시점부터 상기 수면모드 기간을 측정하고, 상기 CPU는 상기 카운터가 측정한 수면모드 기간이 제 1기준시간을 초과하면 상기 클락 오프모드로 진입하며 제1 기준시간 이하이면 상기 수면모드를 유지한다.
또한, 본 발명에 따른 CPU는 카운터를 포함하여 상기 카운터는 상기 클락 오프모드가 시작되는 시점부터 상기 클락 오프모드 기간을 측정하고, 상기 CPU는 상기 카운터가 측정한 클락 오프모드 기간이 제 2기준시간을 초과하면 깊은 수면모드로 진입하며 제2 기준시간 이하이면 클락오프 모드를 유지한다.
또한, 본 발명에 따른 CPU는 제1 기준시간 조절부 및 제1 전압 조절부를 더 포함하여 상기 제1 기준시간 및 상기 제1 전압 중 적어도 하나 이상이 조절되는 조절하는 소비전력 저감 표시장치.
또한, 본 발명에 따른 CPU는 제2 기준시간 조절부 및 제2 전압 조절부를 더 포함하여 상기 제2 기준시간 및 상기 제2 전압 중 적어도 하나 이상이 조절된다.
본 발명에 따른 수면모드에서 소비전력 저감방법 및 소비전력 저감 표시장치는, 클락을 효율적으로 관리할 수 있고, 클락을 활성화할 경우 발생하는 소비전력을 최소화하는 효과가 있다.
도 1은 본 발명에 따른 표시장치를 나타낸 도면이다.
도 2는 본 발명에 따른 화소 회로를 나타낸 도면이다.
도 3은 본 발명에 따른 세트의 구조를 나타낸 도면이다.
도 4는 본 발명에 따른 수면모드의 DSI클락과 데이터 레인의 상태변화를 나타낸 도면이다.
도 5 는 본 발명에 따른 클락-오프 모드의 DSI 클락과 데이터의 상태변화를 나타낸 도면이다.
도 6 은 본 발명에 따른 깊은 수면모드의 DSI 클락과 데이터의 상태변화를 나타낸 도면이다.
도 7은 본 발명에 따른 레지스터 맵을 나타낸 도면이다.
도 8은 본 발명에 따른 클락 컨트롤 레지스터를 나타낸 도면이다.
도 9는 본 발명에 따른 PLL컨트롤 레지스터를 나타낸 도면이다.
도 10은 본 발명에 따른 클락 오프모드 진입 방법을 나타내는 도면이다.
도 2는 본 발명에 따른 화소 회로를 나타낸 도면이다.
도 3은 본 발명에 따른 세트의 구조를 나타낸 도면이다.
도 4는 본 발명에 따른 수면모드의 DSI클락과 데이터 레인의 상태변화를 나타낸 도면이다.
도 5 는 본 발명에 따른 클락-오프 모드의 DSI 클락과 데이터의 상태변화를 나타낸 도면이다.
도 6 은 본 발명에 따른 깊은 수면모드의 DSI 클락과 데이터의 상태변화를 나타낸 도면이다.
도 7은 본 발명에 따른 레지스터 맵을 나타낸 도면이다.
도 8은 본 발명에 따른 클락 컨트롤 레지스터를 나타낸 도면이다.
도 9는 본 발명에 따른 PLL컨트롤 레지스터를 나타낸 도면이다.
도 10은 본 발명에 따른 클락 오프모드 진입 방법을 나타내는 도면이다.
이하, 첨부한 도면을 참고로 하여 본 발명의 실시 예에 대하여 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시 예에 한정되지 않는다. 또한, 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 동일 또는 유사한 구성요소에 대해서는 동일한 참조부호를 붙였다.
명세서 전체에서, 어떤 부분이 어떤 구성요소를 "포함"한다고 할 때, 이는 특별히 반대되는 기재가 없는 한 다른 구성요소를 제외하는 것이 아니라 다른 구성요소를 더 포함할 수 있는 것을 의미한다. 또한, 명세서에 기재된 "…부", "모듈" 등의 용어는 적어도 하나의 기능이나 동작을 처리하는 단위를 의미하며, 이는 하드웨어나 소프트웨어 또는 하드웨어 및 소프트웨어의 결합으로 구현될 수 있다.
도 1은 본 발명에 따른 표시장치를 나타낸 도면이다.
도 1에 도시된 바와 같이, 본 발명에 따른 표시장치는 복수의 화소(100)를 포함한 표시 패널(10), 게이트 구동부(20), 데이터 구동부(30), 신호 제어부(40) 및 신호 제어부(40)를 제어하는 세트(50)를 포함한다.
표시 패널(10)은 복수의 게이트 선(G1 내지 Gn) 및 복수의 데이터 선(D1 내지 Dm)이 서로 교차되는 영역에 위치하는 화소(100)를 복수 개 포함한다. 복수의 화소 각각은 복수의 게이트선(G1 내지 Gn) 중 대응하는 게이트 선과 복수의 데이터 선(D1 내지 Dm) 중 대응하는 데이터 선에 각각 연결되고, 복수의 화소는 행렬의 형태로 배열된다.
복수의 게이트선(G1 내지 Gn)은 복수의 화소(100)의 행 방향으로 뻗을 수 있으며, 복수의 데이터 선(D1 내지 Dm)은 대략 복수의 화소의 열 방향으로 뻗을 수 있고, 서로 평행할 수 있다.
세트(50)는 신호 제어부(40)를 제어할 수 있는 권한이 있으며, 모드 명령을 결정하고, 출력 영상 데이터 신호 (VDT)에 따라 표시패널(10)에 출력 영상이 표시되는 정상 구동모드(이하, 정상 구동모드라 한다.)에서는 외부에서 공급되는 영상 소스(IS) 에 따라 영상 데이터(DATA)를 생성하고, 절전 모드에서는 영상 데이터(DATA) 및 클락(CLK)을 레지스터에 의해 정의되는 세 개의 모드(수면모드, 클락 오프 모드, 깊은 수면 모드)에 따라 생성한다.
세트(50)와 신호제어부(40) 사이에는 4개의 데이터 레인(Lane)(0~3)과 클락 레인(4)이 필요하고, 본 발명의 실시 예에서는 각 레인은 양극성(+) 및 음극성(-) 신호를 가지는 차등 신호로 전달하기 위한 라인이 쌍으로 형성되어 있다.
따라서, 본 발명에 따른 세트(50)와 신호 제어부(40) 사이에는 10개의 라인이 형성되어 있다. 하지만, 이는 실시 예를 설명하기 위한 일 예시일 뿐 본 발명의 실시 예가 이에 한정되는 것은 아니다.
세트(50)는, 정상 구동모드에서 모드 명령에 따라 클락 레인(DSI_CLK+, DSI_CLK-)(4) 또는 데이터 레인(DSI_DATA0+, DSI_DATA0-, DSI_DATA1+, DSI_DATA1-, DSI_DATA2+, DSI_DATA2-, DSI_DATA3+, DSI_DATA3-)(0~3) 중 적어도 하나 이상의 전압을 변경하여 수면모드, 클락 오프모드 또는 깊은 수면 모드를 유지한다.
클락레인(4)은 입력받은 영상데이터(DATA)의 기준 및 동기화를 위한 클락이 전송되는 레인이다. 데이터 레인(1~3)은 영상 데이터(DATA)의 RGB데이터가 단방향으로 전송되는 레인이고, 데이터 레인(0)은 신호 제어부(40)의 수신정보 및 상태 정보가 세트(50)에 전송되는 양방향 레인이다.
세트(50)는 수면모드, 클락 오프모드, 또는 깊은 수면모드에서 사용자의 이벤트나 웨이크업 소스(Wake-Up Source)의 변화에 따라 정상 구동모드로 회귀할 수 있다.
신호 제어부(40)는 입력받은 영상데이터(DATA)에 따라 계조를 나타내는 감마 데이터를 생성 및 배열하여 출력 영상 데이터 신호(VDT)를 생성하고, 데이터 구동 제어 신호(DCS)와 함께 데이터 구동부(30)에 전달한다. 또한, 신호 제어부(40)는 게이트 구동신호(GCS)를 게이트 구동부(20)에 전달한다.
게이트 구동부(20)는, 게이트 구동 제어 신호(GCS)에 의해 제어되고, 표시 패널(10)에 연결된 복수의 게이트 선(G1 내지 Gn)으로 복수의 게이트 신호를 생성하여 전달한다.
게이트 구동부(20)는 게이트 구동 제어 신호(GCS) 중 스캔 동작의 시작을 제어하는 스타트 신호에 응답하여 복수의 게이트 신호를 순차적으로 발생시키는 시프트 레지스터(shift register)와 복수의 게이트 신호의 전압을 복수의 화소 구동에 적합한 전압 레벨로 시프트 시키기 위한 레벨 시프트(level shift)를 포함할 수 있다.
데이터 구동부(30)는 데이터 구동 제어 신호(DCS)에 따라 출력 영상 데이터 신호(VDT)를 샘플링(sampling)한 후에, 샘플링된 출력 영상 데이터 신호(VDT)를 한 라인씩 래치(latch)하여 래치된 츨력 영상 데이터를 복수의 데이터 전압으로 변환하여 복수의 복수의 데이터 선(D1 내지 Dm)에 공급한다.
도 2는 본 발명에 따른 표시 패널의 화소 회로를 나타낸 도면이다.
도 2에 도시된 바와 같이, 표시 패널(10)의 화소 회로(110)는 스위칭 트랜지스터(TS), 구동 트랜지스터(TR) 및 저장 커패시터(CS)를 포함한다. 유기 발광다이오드(organic light emitting diode)(OLED)의 캐소드 전극에는 전압(VSS)이 연결되어 있다.
스위칭 트랜지스터(TS)는 게이트 신호 배선(G1)에 연결되어 있는 게이트 전극, 데이터 배선(D1)에 연결되어 있는 제1 전극, 및 제2 전극을 포함한다.
구동 트랜지스터(TR)는 스위칭 트랜지스터(TS)의 제2 전극에 연결되어 있는 게이트 전극, 전압(VDD)에 연결되어 있는 소스 전극, 및 유기발광다이오드(OLED)의 애노드 전극에 연결되어 있는 드레인 전극을 포함한다.
저장 커패시터(CS)는 구동 트랜지스터(TR)의 게이트 전극 및 소스 전극 사이에 연결되어 있다.
게이트 배선(G1)을 통해 전달되는 게이트-온 전압의 주사 신호에 의해 스위칭 트랜지스터(TS)가 턴 온 될 때, 구동 트랜지스터(TR)의 게이트 전극에 데이터 배선(D1)을 통해 데이터 신호가 전달된다. 저장 커패시터(CS)에 의해 구동 트랜지스터(TR)의 게이트 전극에 전달된 데이터 신호에 따른 전압이 유지된다.
그러면 저장 커패시터(CS)에 의해 유지되는 전압에 따르는 구동 전류가 구동 트랜지스터(TR)에 흐른다. 이 구동 전류가 유기발광다이오드(OLED)에 흐르고, 유기발광다이오드(OLED)는 구동 전류에 따르는 휘도로 발광한다.
도 3은 본 발명에 따른 세트의 구조를 나타낸 도면이다.
도 4는 본 발명에 따른 수면모드의 DSI클락과 데이터 레인의 상태변화를 나타낸 도면이다.
도 5 는 본 발명에 따른 클락-오프 모드의 DSI 클락과 데이터의 상태변화를 나타낸 도면이다.
도 6 은 본 발명에 따른 깊은 수면모드의 DSI 클락과 데이터의 상태변화를 나타낸 도면이다.
도 7은 본 발명에 따른 레지스터 맵을 나타낸 도면이다.
도 8은 본 발명에 따른 클락 컨트롤 레지스터를 나타낸 도면이다.
도 9는 본 발명에 따른 PLL컨트롤 레지스터를 나타낸 도면이다.
도 10은 본 발명에 따른 클락 오프모드 진입 방법을 나타내는 도면이다.
이하, 도 3 내지 10을 이용하여 본 발명에 따른 표시장치에 대해서 설명한다.
도 6에서, 클락 오프모드(500)에서 깊은 수면모드(600)로 진입하게 되면, DSI 클락과 데이터는 모두 LP-00상태(6a, 6b)로 유지하게 되며, LP-00 상태는 클락과 데이터의 전압 레벨이 모두 LP(Low Power) 레벨인 0V가되어 세트(50) 및 드라이버 아이씨(Driver IC)의 소비전력이 감소할 수 있다.
본 발명에 따른 본 발명에 따른 세트(50)는 CPU(51), 레지스터(52) 및 오실레이터(53)를 포함한다.
오실레이터(53)는 레지스터(52)의 값에 따라 제어되는 PLL을 포함하고, 신호제어부(40)에 클락(CLK) 신호를 전송한다.
레지스터(52)는 CPU(51)에 의해 값이 변경된다.
도 7에 도시된 레지스터(52)의 레지스터 맵을 참조하면, 레지스터(52)는 클락 컨트롤에 관여하는 DSIM_CLKCTRL레지스터와 오실레이터(53)의 PLL을 제어하는 DSIM_PLLCTRL 레지스터를 포함한다.
도 8에 도시된 바와 같이 DSIM_CLTR 레지스터는 하부 레지스터들을 포함하고, 하부 레지스터 ByteClkEn에는 오실레이터(53)의 클락 전송 동작을 제어하는 비트 데이터(bit)가 저장된다. 하부 레지스터 ByteClkEn에 저장된 비트의 초기값은 0 이며, 하부 레지스터 ByteClkEn의 값이 0일 때 오실레이터(53)는 온 되어 클락을 전송하고, 1일 때 오프가 되어 클락을 전송하지 않는다.
도 9에 도시된 바와 같이 DSIM_PLLCLTR 레지스터는 하부 레지스터들을 포함하고, 하부 레지스터 PllEn에는 PLL의 동작을 제어하는 비트 데이터(bit)가 저장된다. 하부 레지스터 PllEn에 저장된 비트의 초기값은 0이며, 하부 레지스터 PllEn의 값이 0일 때 PLL은 온 되고 1일 때 오프가 된다.
CPU(51)는 하부 레지스터 ByteClkEn와 PllEn의 값을 0 또는 1로 변경하며, 변경된 하부 레지스터 값에 따라 수면모드, 클락 오프 모드, 깊은 수면 모드에서 오실레이터(53)의 클락 전송 동작 및 PLL을 제어한다.
CPU(51)는 정상 구동모드(300)에서 수면모드 명령, 또는 정상 구동모드(300)에서 사용자의 이벤트가 없는 경우, ByteClkEn와 PllEn의 값을 0으로 변경하여 수면모드(400)로 진입한다.
도 4에 도시된 바와 같이, 수면모드(400)에서는 클락(DSI-CLK+, DSI-CLK-)의 전압 레벨은 LP-11 (1.1~1.3V, 4a)로 유지되고, 데이터(DSI-DATA+, DSI-DATA-)전압 레벨(Voltage Level)이 LP-11(1.1~1.3V, 4b)로 유지된다. 이때, CPU(51)는 수면모드(400)에서 사용자의 이벤트 또는 웨이크업 소스가 변화되는 경우는 다시 정상 구동모드(300)로 회귀한다.
CPU(51)는 수면모드(400)가 기 설정된 제1 기준시간을 초과하거나, 제 1 기준시간 동안 사용자의 이벤트가 없는 경우, 또는 클락 오프 모드 명령에 따라 ByteClkEn와 PllEn의 값을 1로 변경하여 클락 오프모드(500)로 진입한다.
도 5에 도시된 바와 같이, 클락 오프모드(500)에서는 ByteClkEn 및 PllEn의 변경된 레지스터 값에 의해 클락(DSI-CLK+, DSI-CLK-)의 전압 레벨은 LP-00 (0V, 5b)로 유지되어 오실레이터(53) 및 PLL은 오프 되고, DSI 데이터(DSI-DATA+, DSI-DATA-)전압 레벨은 LP-11(1.1~1.3V, 5a)로 유지된다. 그러므로 오실레이터(53)를 비활성화함으로써 오실레이터(53)에 소비되는 소비전력을 최소화할 수 있다.
이때, CPU(51)는 클락 오프모드(500)에서 사용자의 이벤트 또는 웨이크업 소스가 변화되는 경우는 다시 정상 구동모드(300)로 회귀한다.
CPU(51)는 클락 오프모드(500)가 기 설정된 제2 기준 시간을 초과하거나, 제 2 기준시간 동안 사용자의 이벤트가 없는 경우, 또는 깊은 수면모드 명령에 따라 깊은 수면모드(600)로 진입한다. 깊은 수면모드(600)에서 ByteClkEn와 PllEn의 값은 1로 유지된다.
도 6에 도시된 바와 같이, 깊은 수면모드(600)에서는 DSI클락과 데이터의 전압 레벨은 모두LP-00 (0V, 6a, 6b)로 유지된다.
이때, CPU(51)는 깊은 수면모드(600)에서 사용자의 이벤트 또는 웨이크업 소스가 변화되는 경우는 다시 정상 구동모드로 회귀한다.
CPU(51)는 클락을 카운트하여 시간의 경과를 측정하는 카운터(54)를 포함할 수 있고, 카운터(54)는 내부에서 발생하는 클락을 이용하여 수면모드(400)가 시작되는 시점부터 수면모드 기간을 측정하고, 클락 오프모드(500)가 시작되는 시점부터 클락 오프모드 기간을 측정한다.
CPU(51)는, 카운터(54)에서 측정된 수면모드 기간이 제 1기준시간을 초과하거나 제 1 기준시간 동안 사용자의 이벤트가 없는 경우 클락 오프모드(500)로 진입하며, 수면 모드 기간이 제1 기준시간 이하면 수면모드(400)를 유지한다.
CPU(51)는, 카운터(54)에서 측정된 수면모드 기간이 제 2기준시간을 초과하거나 제 2 기준시간 동안 사용자의 이벤트가 없는 경우 깊은 수면모드(600)로 진입하며, 클락 오프모드 기간이 제2 기준시간 이하이면 클락 오프모드(500)을 유지한다.
CPU(51)은, 제1 기준시간 또는 제2 기준시간 중 사용자의 이벤트 또는 웨이크업 소스가 변화되는 경우는 다시 정상 구동모드(300)로 회귀한다.
구체적으로, 도 10에 도시된 바와 같이, 제1 기준시간(t1)을 50초, 제2 기준시간(t2)을 100초로 설정하였을 경우, 수면모드가 시작되면 카운터(54)가 수면모드 시간을 카운트하고 슬립 모드 상태가 50초가 초과되는 시점에 CPU(51)는 클락 오프 모드로 진입하고, 클락 오프 모드 진입 후 50초가 초과 되는 시점에 CPU(51)는 깊은 수면모드로 진입하게 된다. 깊은 수면모드로 진입 시 카운터 값은 다시 0으로 초기화된다.
CPU(51)는 제1 기준시간 조절부 및 제2 기준시간 조절부 더 포함하여 제1, 2기준시간을 조절할 수 있으며, 전압 조절부를 더 포함하여 클락 및 전압 레벨을 조절할 수 있다.
도 11은 본 발명에 따른 절전 모드 진입 방법을 나타내는 도면이다.
이하, 도 11을 이용하여 본 발명에 따른 소비전력 저감 방법에 대하여 설명한다.
D10단계에서, 출력 영상 데이터 신호(VDT)에 따라 표시패널(10)에 출력 영상이 표시된다.(정상 구동모드 단계)
S20 단계에서, CPU(51)는 수면모드 명령에 따라 세트에서 표시장치로 전송되는 클락 및 영상 데이터 전압 레벨은 제 1 전압(예를 들어, 1.1~1.3V)으로 유지된다.(수면모드 단계)
S30 단계에서, CPU(51)는 수면모드가 시작되는 시간을 시작점으로 측정된 수면모드 기간이 제1 기준시간(N)을 초과하면 S40 단계로 이동하며, 제1 기준시간 이하이면 수면모드를 유지하고, 사용자의 이벤트가 발생하거나, 또는 웨이크업 소스가 변화되는 경우는 다시 정상 구동모드로 회귀한다.
S40 단계에서, CPU(51)는 세트(50)의 레지스터 값을 변경하고, 변경된 레지스터 값에 따라 클락신호를 제2 전압으로 유지한다.(클락 오프모드)
S50 단계에서, CPU(51)는 클락 오프모드가 시작되는 시간을 시작점으로 측정된 클락 오프모드 기간이 제 2기준시간(M)을 초과하면, S50 단계로 이동하며, 제2 기준시간 이하이면 클락오프 모드를 유지하고, 사용자의 이벤트 가 발생하거나, 또는 웨이크업 소스가 변화되는 경우는 다시 정상 구동모드로 회귀한다.
S60 단계에서, 클락 및 영상 데이터 전압 레벨은 제2 전압(예를 들어, 0V)으로 유지된다.(깊은 수면모드) CPU(51)는 깊은 수면모드 단계에서 사용자의 이벤트 또는 웨이크업 소스가 변화되는 경우는 다시 정상 구동모드로 회귀한다.
이상에서 본 발명의 일 실시 예에 대하여 설명하였으나, 본 발명의 사상은 본 명세서에 제시되는 실시 예에 제한되지 아니하며, 본 발명의 설명에서는 세트(50)와 신호 제어부(40)를 분리하여 설명했으나 이에 한정되지 않고 세트(50)와 신호 제어부(40)가 하나로 통합되어 형성될 수도 있다. 또한, 본 발명의 사상을 이해하는 당업자는 동일한 사상의 범위 내에서, 구성요소의 부가, 변경, 삭제, 추가 등에 의해서 다른 실시 예를 용이하게 제안할 수 있을 것이나, 이 또한 본 발명의 권리범위 내에 든다고 할 것이다.
10: 표시 패널 20: 게이트 구동부
30: 데이터 구동부 40: 신호 제어부
50: 세트 51: CPU
52: 레지스터 53: 오실레이터
54: 카운터 100: 화소
30: 데이터 구동부 40: 신호 제어부
50: 세트 51: CPU
52: 레지스터 53: 오실레이터
54: 카운터 100: 화소
Claims (13)
- 영상을 표시하는 표시패널, 상기 표시패널에 데이터 전압을 인가하는 데이터 구동부, 상기 표시패널에 게이트 신호를 순차적으로 인가하는 게이트 구동부, 및 상기 데이터 구동부 및 상기 게이트 구동부를 제어하고, 입력받은 영상 데이터에 따라 출력 영상 데이터 신호를 생성하는 신호 제어부를 포함하는 표시장치, 그리고 상기 신호 제어부에 상기 영상 데이터의 기준 및 동기화를 위한 클락 신호가 전송되는 클락 레인 및 상기 영상 데이터의 RGB 데이터가 전송되는 복수의 데이터 레인으로 연결되어, 모드 명령에 따라 생성된 전압들을 상기 클락 레인 및 상기 복수의 데이터 레인 각각에 전달하는 세트를 포함하고, 상기 세트는, 상기 클락 신호를 생성하여 상기 클락 레인에 인가하는 오실레이터, 상기 모드 명령에 따라 상기 클락 신호의 전압 레벨이 변경되도록, 상기 오실레이터를 제어하는 레지스터, 외부에서 공급되는 영상 소스에 따라 상기 영상 데이터를 생성하여 상기 복수의 데이터 레인으로 인가하고, 상기 모드 명령에 따라 상기 레지스터의 값을 변경하는 CPU를 포함하는 장치의 소비전력 저감방법으로서,
정상 구동모드에서, 상기 CPU가, 상기 표시패널에 출력 영상이 표시되도록 상기 영상 데이터를 상기 표시장치에 출력하는 단계;
수면 모드 명령에 따라, 수면 모드로 진입하도록, 상기 CPU가, 상기 클락 레인에 제1 전압이 인가될 수 있도록 상기 레지스터의 값을 설정하고, 상기 복수의 데이터 레인에 상기 제1 전압을 인가하는 단계;
상기 CPU가, 상기 수면 모드로 진입한 시점부터 수면모드 기간을 측정하는 단계;
상기 수면모드 기간이 제1 기준시간을 초과하면, 상기 CPU가, 상기 클락 레인에 상기 제1 전압보다 낮은 제2 전압이 인가될 수 있도록 상기 레지스터의 값을 변경하여 클락 오프 모드로 진입하는 단계;
상기 수면 모드 기간이 제1 기준시간 이하이면, 상기 CPU가, 상기 수면 모드를 유지하는 단계; 그리고
상기 수면모드가 시작된 후 사용자의 이벤트가 발생하거나 또는 웨이크업 소스가 변화되면, 상기 CPU가, 상기 표시패널에 출력 영상이 표시되도록 상기 정상 구동모드로 회귀하는 단계
를 포함한 수면모드에서 소비전력 저감방법. - 제1항에 있어서,
상기 CPU가, 상기 클락 오프 모드로 진입한 시점부터 클락 오프 모드 기간을 측정하는 단계; 및
상기 클락 오프 모드 기간이 제2 기준시간을 초과하면 상기 CPU가, 상기 복수의 데이터 레인에도 상기 제2 전압을 인가하는 단계를 더 포함한 수면모드에서 소비전력 저감방법. - 삭제
- 삭제
- 영상을 표시하는 표시패널, 상기 표시패널에 데이터 전압을 인가하는 데이터 구동부, 상기 표시패널에 게이트 신호를 순차적으로 인가하는 게이트 구동부, 그리고 상기 데이터 구동부 및 상기 게이트 구동부를 제어하고, 입력받은 영상 데이터에 따라 출력 영상 데이터 신호를 생성하는 신호 제어부를 포함하는 표시장치, 그리고
상기 신호 제어부에 상기 영상 데이터의 기준 및 동기화를 위한 클락 신호가 전송되는 클락 레인 및 상기 영상 데이터의 RGB 데이터가 전송되는 복수의 데이터 레인으로 연결되어, 모드 명령에 따라 생성된 전압들을 상기 클락 레인 및 상기 복수의 데이터 레인 각각에 전달하는 세트
를 포함하고,
상기 세트는,
클락 신호를 생성하여 상기 클락 레인에 인가하는 오실레이터,
상기 모드 명령에 따라 상기 클락 신호의 전압 레벨이 변경되도록, 상기 오실레이터를 제어하는 레지스터,
정상 구동모드에서 외부에서 공급되는 영상 소스에 따라 상기 영상 데이터를 생성하여 상기 복수의 데이터 레인으로 인가하고, 상기 모드 명령에 따라 상기 레지스터의 값을 변경하는 CPU를 포함하며,
상기 CPU는,
상기 모드 명령 중 수면 모드 명령에 따라 상기 클락 레인에 제1 전압이 인가될 수 있도록 상기 레지스터의 값을 설정하고 상기 복수의 데이터 레인에 상기 제1 전압을 인가하여, 수면 모드로 진입하고,
상기 수면 모드로 진입한 시점부터 수면 모드 기간을 측정하며,
상기 수면 모드 기간이 제1 기준시간을 초과하면, 상기 클락 레인에 상기 제1 전압보다 낮은 제2 전압이 인가될 수 있도록 상기 레지스터의 값을 변경하여 클락 오프 모드로 진입하고,
상기 수면 모드 기간이 제1 기준시간 이하이면, 상기 수면 모드를 유지하며,
상기 수면 모드로 진입한 후 사용자의 이벤트가 발생하거나 또는 웨이크업 소스가 변화되면, 상기 표시패널에 출력 영상이 표시되도록 정상 구동 모드로 회귀하는,
소비전력 저감 표시장치. - 삭제
- 삭제
- 삭제
- 제5항에 있어서,
상기 CPU는, 상기 클락 오프 모드로 진입한 시점부터 클락 오프 모드 기간을 측정하며,
상기 클락 오프 모드 기간이 제2 기준시간을 초과하면, 상기 복수의 데이터 레인에도 상기 제2 전압을 인가하여 깊은수면 모드로 진입하는 소비전력 저감 표시장치. - 삭제
- 삭제
- 제5항에 있어서,
상기 CPU는 제1 기준시간 조절부 및 제1 전압 조절부를 더 포함하여 상기 제1 기준시간 및 상기 제1 전압 중 적어도 하나 이상이 조절되는 조절하는 소비전력 저감 표시장치. - 제9항에 있어서,
상기 CPU는 제2 기준시간 조절부 및 제2 전압 조절부를 더 포함하여 상기 제2 기준시간 및 상기 제2 전압 중 적어도 하나 이상이 조절되는 소비전력 저감 표시장치.
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