KR101406753B1

KR101406753B1 - 웨이퍼 검사용 인터페이스 및 웨이퍼 검사 장치

Info

Publication number: KR101406753B1
Application number: KR1020130026096A
Authority: KR
Inventors: 히로시 야마다
Original assignee: 도쿄엘렉트론가부시키가이샤
Priority date: 2012-03-14
Filing date: 2013-03-12
Publication date: 2014-06-12
Also published as: US9151780B2; CN103308735A; TW201350883A; KR20130105444A; US20130249587A1; TWI583976B; JP5941713B2; JP2013191736A; CN103308735B

Abstract

웨이퍼에 형성된 복수의 반도체 디바이스의 복수의 전극에 대하여 복수의 프로브를 각각 일괄하여 접촉시키는 프로브 카드에서의 웨이퍼 대향면의 평활도를 확보할 수 있는 웨이퍼 검사용 인터페이스를 제공한다. 웨이퍼 검사용 인터페이스(18)는, 기판(20a)과, 상기 기판(20a)의 웨이퍼(W)에 대향하는 면에 웨이퍼(W)에 형성된 복수의 반도체 디바이스의 전극에 대응하여 설치된 복수의 프로브(25)를 구비한 프로브 카드(20)와, 상기 프로브 카드(20)의 웨이퍼(W)에 대향하는 면과는 반대측의 면에 접촉하여 상기 프로브 카드를 지지하는 포고 프레임(40)과, 프로브 카드(20)의 포고 프레임(40)과의 접촉면에 설치되고, 프로브 카드(20)의 두께를 조정하는 심(51)을 가지고, 심(51)은, 평면에서 봤을 때 십자 형상을 나타내고 있다.

Description

웨이퍼 검사용 인터페이스 및 웨이퍼 검사 장치{WAFER INSPECTION INTERFACE AND WAFER INSPECTION APPARATUS}

본 발명은, 프로브 카드를 구비하는 웨이퍼 검사용 인터페이스 및 웨이퍼 검사 장치에 관한 것이다.

웨이퍼 검사 장치로서, 예를 들면 웨이퍼에 형성된 복수의 반도체 디바이스에 대하여 전기적 특성 검사를 행하는 프로브 장치 또는 번인(burn-in) 검사 장치가 알려져 있다.

도 9는, 종래의 프로브 장치의 개략 구성을 도시한 단면도, 도 10은, 도 9의 프로브 장치에서의 포고 프레임(포고 링)을 도시한 단면도이다.

도 9에서 프로브 장치(100)는, 웨이퍼(W)를 반송하는 반송 영역을 형성하는 로더실(101)과, 웨이퍼(W)에 형성된 복수의 반도체 디바이스의 전기적 특성 검사를 행하는 검사실(102)을 구비하고, 로더실(101) 및 검사실(102) 내의 각종의 기기를 제어 장치에 의해 제어하여 반도체 디바이스의 전기적 특성 검사를 행하도록 구성되어 있다. 검사실(102)은, 로더실(101)로부터 반입된 웨이퍼(W)를 재치(載置)하고, X, Y, Z 및 θ 방향으로 이동하는 재치대(106)와, 재치대(106)의 상방에 배치된 포고 프레임(109)과, 포고 프레임(109)에 지지된 프로브 카드(108)와, 재치대(106)와 협동하여 프로브 카드(108)에 설치된 복수의 프로브(검사 바늘)와 웨이퍼(W)에 형성된 복수의 반도체 디바이스의 각 전극과의 얼라이먼트(위치 조정)를 행하는 얼라이먼트 기구(110)를 구비한다. 얼라이먼트 기구(110)와 재치대(106)의 협동에 의해 웨이퍼(W)와 프로브 카드(108)의 얼라이먼트가 행해져 프로브 카드(108)의 각 프로브와 웨이퍼(W)의 각 전극이 각각 접촉하고, 웨이퍼(W)에 형성된 복수의 반도체 디바이스에 대하여 반도체 디바이스마다 전기적 특성 검사가 행해진다(예를 들면, 특허 문헌 1 참조).

도 10에서 포고 프레임(109)은, 변환 링(112)에 지지되어 있고, 변환 링(112)을 개재하여 프로브 장치(100)의 상부 플레이트에 장착되어 있다. 포고 프레임(109)은, 중앙에 두께 방향으로 관통하는 개구부(109A)를 가지고, 개구부(109A)의 주위의 링부(109B)에는 다수의 포고 핀(109C)이 두께 방향으로 관통하도록 배치되어 있다. 포고 핀(109C)은 포고 프레임(109)의 하방에 설치된 프로브 카드(108)의 외주연부에 설치된 접속 단자(108A)와 접촉하고, 프로브 카드(108)의 하면 중앙부에 형성된 프로브(108B)와 도시 생략된 검사 장치를 전기적으로 접속한다. 프로브(108B)는, 그 하방에 배치되는 웨이퍼(W)에 설치된 하나의 반도체 디바이스의 대응하는 전극과 접촉한다.

그런데, 종래의 프로브 장치에서는, 웨이퍼에 형성된 복수의 반도체 디바이스에 대하여 반도체 디바이스마다 프로브 카드에 형성된 프로브와의 접촉 및 전기적 특성의 검사가 반복되고 있었다. 따라서, 웨이퍼와 접촉하는 프로브 카드의 접촉면은 좁고, 이 접촉면에서의 표면의 평활도가 문제가 되는 경우는 없었다.

일본특허공개공보 2004-140241호

그러나, 본 발명이 대상으로 하는 웨이퍼 검사 장치는, 웨이퍼에 형성된 모든 반도체 디바이스의 모든 전극에, 프로브 카드에 형성된 모든 프로브를 각각 일괄하여 접촉시켜 모든 반도체 디바이스에 대하여 한 번에 전기적 특성 검사를 행하는 일괄 접촉형 장치이다. 이 때문에, 웨이퍼에 형성된 복수의 반도체 디바이스와 접촉하는 프로브 카드의 접촉면이 종래 장치에 비해 큰 폭으로 확대되어, 프로브 카드에서의 웨이퍼 접촉면의 평활도를 유지하는 것이 곤란해졌다.

본 발명의 과제는, 웨이퍼에 형성된 복수의 반도체 디바이스의 복수의 전극에 대하여 복수의 프로브를 각각 일괄하여 접촉시키는 프로브 카드에서의 웨이퍼 대향면의 평활도를 소정 범위로 유지할 수 있는 웨이퍼 검사용 인터페이스 및 웨이퍼 검사 장치를 제공하는 것에 있다.

상기 과제를 해결하기 위하여, 청구항 1에 기재된 웨이퍼 검사용 인터페이스는, 기판과, 상기 기판의 웨이퍼에 대향하는 면에 상기 웨이퍼에 형성된 복수의 반도체 디바이스의 전극에 대응하여 설치된 복수의 프로브를 구비한 프로브 카드와, 상기 프로브 카드의 상기 웨이퍼에 대향하는 면과는 반대측의 면에 접촉하여 상기 프로브 카드를 지지하는 프레임과, 상기 프로브 카드의 상기 프레임과의 접촉면에 형성되고, 상기 프로브 카드의 두께를 조정하는 스페이서를 가지는 것을 특징으로 하는 웨이퍼 검사용 인터페이스이다.

청구항 2에 기재된 웨이퍼 검사용 인터페이스는, 청구항 1에 기재된 웨이퍼 검사용 인터페이스에 있어서, 상기 스페이서는, 상기 프로브 카드에서의 상기 웨이퍼에 대향하는 면의 평활도를 확보하기 위한 스페이서인 것을 특징으로 한다.

청구항 3에 기재된 웨이퍼 검사용 인터페이스는, 청구항 2에 기재된 웨이퍼 검사용 인터페이스에 있어서, 상기 프로브 카드에서의 상기 웨이퍼에 대향하는 면은, 복수의 프로브의 선단부에 의해 형성되는 면인 것을 특징으로 한다.

청구항 4에 기재된 웨이퍼 검사용 인터페이스는, 청구항 1에 기재된 웨이퍼 검사용 인터페이스에 있어서, 상기 프로브 카드에서의 상기 복수의 프로브는, 상기 웨이퍼에 형성된 복수의 반도체 디바이스에 대응하는 복수의 프로브군으로 구분되고, 상기 스페이서는, 상기 복수의 프로브군 상호의 간극에 설치되어 있는 것을 특징으로 한다.

청구항 5에 기재된 웨이퍼 검사용 인터페이스는, 청구항 4에 기재된 웨이퍼 검사용 인터페이스에 있어서, 상기 복수의 프로브군은 바둑판 형상으로 배열되어 있고, 상기 스페이서는 상기 바둑판 형상으로 배열된 상기 복수의 프로브군 상호 간의 격자 형상의 간극의 모서리부에 설치되어 있는 것을 특징으로 한다.

청구항 6에 기재된 웨이퍼 검사용 인터페이스는, 청구항 5에 기재된 웨이퍼 검사용 인터페이스에 있어서, 상기 스페이서는, 평면 시에서 봤을 때 십자 형상을 나타내고 있는 것을 특징으로 한다.

청구항 7에 기재된 웨이퍼 검사용 인터페이스는, 청구항 1 내지 6 항 중 어느 한 항에 기재된 웨이퍼 검사용 인터페이스에 있어서, 상기 스페이서는, 상기 프로브 카드에서의 기판과 열팽창율이 동일 또는 근사한 저팽창율재로 형성되어 있는 것을 특징으로 한다.

청구항 8에 기재된 웨이퍼 검사용 인터페이스는, 청구항 2 또는 3 항에 기재된 웨이퍼 검사용 인터페이스에 있어서, 상기 평활도는, 산술 평균 거칠기(Ra)가 Ra ≤ 30 μm인 것을 특징으로 한다.

상기 과제를 해결하기 위하여, 청구항 9에 기재된 웨이퍼 검사 장치는, 웨이퍼에 형성된 반도체 디바이스의 전기적 특성을 검사하는 검사실과, 상기 검사실로의 상기 웨이퍼의 반출입을 행하는 반송 기구를 구비하는 웨이퍼 검사 장치에 있어서, 상기 검사실은 웨이퍼 검사용 인터페이스를 가지고, 상기 웨이퍼 검사용 인터페이스는, 기판과, 상기 기판의 웨이퍼에 대향하는 면에 상기 웨이퍼에 형성된 복수의 반도체 디바이스의 전극에 대응하여 설치된 복수의 프로브를 구비한 프로브 카드와, 상기 프로브 카드의 상기 웨이퍼에 대향하는 면과는 반대측의 면에 접촉하여 상기 프로브 카드를 지지하는 프레임과, 상기 프로브 카드의 상기 프레임과의 접촉면에 설치되고, 상기 프로브 카드의 두께를 조정하는 스페이서를 가지는 것을 특징으로 한다.

본 발명에 따르면, 프로브 카드의 프레임과의 접촉면에 프로브 카드의 두께를 조정하는 스페이서를 설치했으므로, 웨이퍼에 형성된 복수의 반도체 디바이스의 복수의 전극에 대하여 복수의 프로브를 각각 일괄하여 접촉시키는 프로브 카드에서의 웨이퍼 대향면의 평활도를 소정 범위로 유지할 수 있다.

도 1은 본 발명의 실시예에 따른 웨이퍼 검사 장치의 외관을 도시한 사시도이다.
도 2는 도 1에서의 웨이퍼 검사 장치의 II - II 선을 따르는 단면도이다.
도 3은 도 2에서의 검사실이 가지는 웨이퍼 검사용 인터페이스의 구성을 개략적으로 도시한 단면도이다.
도 4는 도 3에서의 프로브 카드를 도시한 도이며, 도 4의 (A)는 포고 프레임과의 접촉면을 도시한 평면도, 도 4의 (B)는 웨이퍼와의 접촉면을 도시한 평면도이다.
도 5는 도 4에서의 심의 사시도이다.
도 6은 도 3의 웨이퍼 검사용 인터페이스의 부분 확대 단면도이다.
도 7은 도 6의 웨이퍼 검사용 인터페이스를 이용한 웨이퍼에서의 각 반도체 디바이스의 전기적 특성 검사의 공정도이다.
도 8은 도 6의 웨이퍼 검사용 인터페이스를 이용한 웨이퍼에서의 각 반도체 디바이스의 전기적 특성 검사의 공정도이다.
도 9는 종래의 프로브 장치의 개략 구성을 도시한 단면도이다.
도 10은 도 9에서의 포고 프레임을 도시한 단면도이다.

이하에, 본 발명의 실시예에 대하여 도면을 참조하여 설명한다.

도 1은, 본 발명의 실시예에 따른 웨이퍼 검사 장치의 외관을 도시한 사시도이다.

이 웨이퍼 검사 장치(10)는, 웨이퍼에 형성된 모든 반도체 디바이스의 모든 전극에 대하여 프로브 카드의 모든 프로브를 각각 일괄하여 접촉시켜 한 번에 전기적 특성 검사를 행하는 일괄 접촉형의 검사 장치로서, 공용할 수 있는 장치에 대해서는 가능한 한 공용한다고 하는 개념 하에 개발된 것이다. 따라서, 장치의 소형화를 도모하기 위하여, 검사실 이외의 다른 장소에서 웨이퍼의 얼라이먼트가 행해진다.

도 1에서 웨이퍼 검사 장치(10)는, 당해 웨이퍼 검사 장치(10)의 배면에서 웨이퍼의 반출입을 행하는 반출입 영역(S10)과, 이 반출입 영역(S10)에 대향하여 정면에 설치된 검사 영역(S40)과, 반출입 영역(S10)과 검사 영역(S40) 사이에 형성된 반송 영역(S30)으로 주로 구성되어 있다.

반출입 영역(S10)은, 복수의 재치 기구에 대응하여 복수의 단위 반출입 영역으로 구획되어 있고, 검사 영역(S40)도 복수의 검사실에 대응하여 복수의 단위 검사 영역으로 구획되어 있다. 즉, 반출입 영역(S10) 및 검사 영역(S40)은, 각각 맨션풍으로 복수의 방으로 구획되어 있고, 그 사이의 반송 영역(S30)을 웨이퍼 반송 기구(후술하는 도 2 참조)가 이동하여 웨이퍼를 반송한다.

도 2는, 도 1의 II - II 선을 따르는 단면도이다.

도 2에서, 반출입 영역(S10)에는 재치 기구로서 예를 들면 복수의 풉(F)의 수용 기구가 설치되어 있다. 또한, 반출입 영역(S10)의 도면 중 좌단에는 얼라이먼트실(12)을 가지는 얼라이먼트 영역(S20)이 형성되어 있고, 우단에는 바늘 자국 검사 장치(17)를 가지는 바늘 자국 검사 영역(S50)이 설치되어 있다. 또한, 반송 영역(S30)에는 웨이퍼 반송 기구(13)가 설치되어 있고, 검사 영역(S40)에는 복수의 검사실(14)이 설치되어 있다.

웨이퍼 반송 기구(13)는, 예를 들면 기대(基臺) 상에 설치된 회전체와, 회전체 상에서 각각 개별로 일방향으로 왕복 이동하는 상하 2 매의 암과, 기대 및 암을 승강시키는 승강 기구와, 이들을 반송 영역(S30)을 따라 왕복 이동시키는 이동 기구를 구비하고 있고, 상측의 암(13A)의 선단에는 웨이퍼(W)를 재치하여 반송하는 픽(13B)이 설치되어 있다(후술하는 도 3 참조).

웨이퍼 검사 장치(10)에서는, 웨이퍼 반송 기구(13)가 풉(F)으로부터 미검사의 웨이퍼(W)를 수취하여 얼라이먼트실(12)로 반송하고, 이 얼라이먼트실(12)에서는, 웨이퍼 반송 기구(13)의 픽(13B)에 대한 웨이퍼(W)의 얼라이먼트를 행하고, 웨이퍼 반송 기구(13)가 얼라이먼트 후의 웨이퍼(W)를 소정의 검사실(14)로 반입한다. 검사실(14)은, 후술하는 웨이퍼 검사용 인터페이스(18)를 가지고, 이 웨이퍼 검사용 인터페이스(18)는, 웨이퍼(W)에 형성된 복수의 반도체 디바이스의 전기적 특성 검사를 행한다.

또한, 웨이퍼 반송 기구(13)는 검사 완료된 웨이퍼(W)를 소정의 검사실(14)로부터 반출입 영역(S10)의 일단에 위치하는 바늘 자국 검사 영역(S50) 내에 설치된 바늘 자국 검사 장치(17)로 전달하고, 바늘 자국 검사 장치(17)는 검사 완료된 웨이퍼(W)에서의 각 반도체 디바이스의 전극에서의 바늘 자국(프로브(25)의 접촉 자국)의 검사를 행하고, 이 후 웨이퍼 반송 기구(13)가 검사 후의 웨이퍼(W)를 반출입 영역(S10)의 풉(F)으로 반입한다.

이 경우, 웨이퍼 반송 기구(13)는, 예를 들면 제 1 풉(F)으로부터 반출한 제 1 웨이퍼(W)를 제 1 검사실(14) 내로 반입하는데, 제 1 검사실(14) 내에서 제 1 웨이퍼(W)에 형성된 반도체 디바이스의 전기적 특성 검사가 행해지고 있는 동안에, 제 2 풉(F)으로부터 반출한 제 2 웨이퍼(W)를 제 2 검사실(14) 내로 반입할 수 있다. 또한 웨이퍼 반송 기구(13)는, 제 1 검사실(14) 내에서 제 1 웨이퍼(W)에 형성된 반도체 디바이스의 전기적 특성 검사가 행해지고 있는 동안에, 제 3 검사실로부터 검사 후의 제 3 웨이퍼(W)를 반출하여 제 3 풉(F)으로 반입할 수도 있다. 즉 웨이퍼 반송 기구(13)는, 복수의 풉(F) 및 복수의 검사실(14) 사이에서 순차적으로 웨이퍼(W)의 반출입을 행하고, 복수의 검사실(14)은, 각 검사실(14)에서 순차적으로 복수의 웨이퍼(W)에 대하여 이 웨이퍼(W)에 형성된 반도체 디바이스의 전기적 특성 검사를 행한다.

도 3은, 도 2에서의 검사실이 가지는 웨이퍼 검사용 인터페이스의 구성을 개략적으로 도시한 단면도이다.

도 3에서 웨이퍼 검사용 인터페이스(18)는, 검사실(14) 내의 천장부에 배치된 판상(板狀) 부재로 이루어지는 헤드 플레이트(19)와, 이 헤드 플레이트(19)의 하면을 구성하는 프레임(이하, ‘포고 프레임’이라고 함)(40)과, 이 포고 프레임(40)의 하면에 접촉하도록 배치된 프로브 카드(20)를 가진다. 프로브 카드(20)는, 기판(20a)과, 이 기판(20a)의 웨이퍼(W)와 대향하는 면에 형성된 복수의 프로브(25)로 주로 구성되어 있다. 프로브 카드(20)의 포고 프레임(40)과의 접촉면에는, 프로브 카드(20)의 두께를 조정하는 스페이서(이하, ‘심’(shim)이라고 함)(51)가 다수 배치되어 있다. 웨이퍼 검사용 인터페이스(18)는, 또한 프로브 카드(20)의 외주를 보지(保持)하여 포고 프레임(40)에 고정하는 고정 링(21)과, 검사실(14) 내의 저부(底部)로부터 세워 설치되어 도 3 중 상하 방향으로 이동하는 봉 형상의 리프터(22)와, 이 리프터(22)의 정부(頂部)에 설치된 대(臺) 형상의 척 탑(23)을 가진다. 척 탑(23)은 단면 볼록 형상을 나타내고, 중앙부에서 도면 중 상방으로 돌출된 볼록부(23A)와, 이 볼록부(23A)를 둘러싸고 볼록부(23A)보다 일단 낮게 형성된 단차부(23B)를 가지고, 볼록부(23A)의 상부 평면은 웨이퍼(W)의 웨이퍼 재치면(23C)으로 되어 있다.

도 4는, 도 3에서의 프로브 카드(20)를 도시한 도이며, 도 4의 (A)는 포고 프레임(40)과의 접촉면을 도시한 평면도, 도 4의 (B)는 웨이퍼(W)와의 접촉면을 도시한 평면도이다.

도 4의 (A), (B)에서, 프로브 카드(20)는 예를 들면 세라믹제이며, 직경이 330 mmφ인 원형 판상체를 나타내고, 그 두께는 예를 들면 2.9 mm이다. 중앙부의 접촉 영역(52)에는 예를 들면 한 변이 10 mm인 정방형(正方形)의 프로브 영역(53)이 규칙적으로 다수 배열되어 있고, 각 프로브 영역(53)에는 웨이퍼(W)에 형성된 복수의 반도체 디바이스에서의 각 반도체 디바이스의 복수의 전극에 각각 대응하는 한 군의 프로브(25)가 설치되어 있다. 한 무리의 프로브(25)에 의해 하나의 반도체 디바이스의 복수의 전극에 대응하는 하나의 프로브군이 형성되어 있다.

도 4의 (A)에서, 접촉 영역(52) 내에 규칙적으로 다수 배열된 프로브 영역(53) 상호 간에는 격자 형상의 간극이 형성되어 있고, 이 격자 형상의 간극의 모서리부에, 각각 평면에서 봤을 때 십자 형상의 심(51)이 배치되어 있다.

도 5는, 도 4에서의 심(51)의 사시도이다.

도 5에서 심(51)은, 평면에서 봤을 때 십자 형상을 나타내고 있다. 심(51)의 길이(a)는 예를 들면 15 ~ 20 mm, 두께(b)는 예를 들면 150 ~ 250 μm이다. 심(51)은, 열팽창율이 프로브 카드(20)의 기판(20a)과 동일 또는 근사한 재료, 예를 들면 인바(Invar) 등의 저열팽창 재료로 형성되어 있다. 이에 의해, 열팽창 또는 열수축했을 경우라도 기판(20a)과 심(51) 간에 휨이 발생하지는 않는다. 열팽창율이 근사하다는 것은, 예를 들면 웨이퍼(W)에 형성된 반도체 디바이스의 전기적 특성 검사를 행하는 검사 온도의 변경에 수반하여 분위기 온도가 변화해도, 2 개의 부재의 접촉면에서 휨이 발생하지 않을 정도로 2 개의 부재의 열팽창율의 차가 작은 것을 말한다.

여기서, 프로브 카드(20)에서의 기판(20a)의 표면 평활도는, 예를 들면 산술 평균 거칠기(Ra)가 Ra = 50 ~ 100 μm 정도이다. 따라서, 기판(20a)을 표면 평활도가 높은 포고 프레임(40)에 접촉시키면, 포고 프레임(40)과의 접촉면은 평평하게 되지만, 접촉면과 반대측의 면은 평평하게 되지 않는다. 또한, 기판(20a)의 웨이퍼(W)와의 대향면에 복수의 프로브(25)를 심어 프로브 카드(20)를 형성할 시에서의 기판(20a)의 포고 프레임(40)과의 접촉면으로부터 프로브(25)의 선단부까지의 길이인 프로브 카드(20)의 두께는, 프로브(25)의 길이의 불균일 뿐만 아니라 기판(20a)의 두께의 불균일에 의해 더욱 불균일해진다.

그런데, 본 발명이 대상으로 하는 프로브 장치에서는, 프로브 카드(20)에서의 웨이퍼(W)에 대향하는 면의 평활도로서, 예를 들면 산술 평균 거칠기(Ra ≤ 30 μm)가 요구된다.

따라서 본 발명자는, 프로브 카드(20)에서의 웨이퍼(W)와 대향하는 면의 평활도에 대한 요구를 달성하기 위하여, 프로브 카드(20)에서의 규칙적으로 다수 배열된 프로브 영역(53) 상호 간의 격자 형상의 간극의 각 모서리부에, 도 5의 십자 형상의 심(51)을 각각 배치하고, 이에 의해 프로브 카드(20)의 두께를 균등시키고, 이로써 웨이퍼(W)에 대향하는 면에 요구되는 평활도를 확보했다.

또한, 프로브 카드(20)에서의 웨이퍼(W)에 대향하는 면이란, 복수의 프로브(25)의 선단부에 의해 형성되는 면을 말한다.

프로브 카드(20)에의 심(51)의 접착은, 이하와 같이 행해진다.

우선, 프로브 카드(20)에서의 규칙적으로 다수 배열된 프로브 영역(53) 상호 간의 격자 형상의 간극의 모서리부(이하, ‘심 접착 위치’라고 함)의 모두에서 프로브 카드(20)의 두께를 측정한다. 이어서, 예를 들면 두께가 10 μm씩 변화하는 복수의 심(51)을 준비하고, 각 심 접착 위치에 어느 두께의 심(51)을 접착함에 따라 프로브 카드(20)의 두께가 균등하게 되는지를 구하고, 구한 소정 두께의 심(51)을 각각 대응하는 심 접착 위치에 접착한다. 이에 의해, 프로브 카드(20)의 두께가 균등해지고, 이 프로브 카드(20)에서의 웨이퍼(W)에 대향하는 면의 산술 평균 거칠기(Ra ≤30 μm)를 달성할 수 있다. 심(51)의 프로브 카드(20)에의 접착은, 예를 들면 열경화성 접착제에 의해 행해진다.

도 6은, 도 3의 웨이퍼 검사용 인터페이스의 부분 확대 단면도이다.

도 6에서, 프로브 카드(20)의 포고 프레임(40)과의 접촉면에 소정 두께의 심(51)이 다수 접착되어 있다. 즉, 웨이퍼 검사용 인터페이스(18)는, 기판(20a)과, 이 기판(20a)의 웨이퍼(W)에 대향하는 면에 설치된 복수의 프로브(25)를 구비한 프로브 카드(20)와, 웨이퍼(W)를 사이에 두고 프로브 카드(20)에 대향하여 배치된 대 형상의 척 탑(23)과, 프로브 카드(20)의 웨이퍼(W)에 대향하는 면과는 반대측의 면에 접촉하여 이 프로브 카드(20)를 지지하는 포고 프레임(40)으로 주로 구성되어 있다.

프로브 카드(20)의 포고 프레임(40)과의 접촉면의 심 접착 위치에는, 각각 심(51)이 접착되어 있다. 이에 의해, 프로브 카드(20)에서의 두께의 불균일이 시정되고, 프로브 카드(20)에서의 웨이퍼(W)에 대향하는 면의 평활도가 소정 범위로 유지된다.

또한, 프로브 카드(20)에서의 접촉 영역(52)을 둘러싸도록 형성된 고정 링(21)은, 프로브 카드(20)를 포고 프레임(40)에 고정한다. 또한, 프로브 카드(20)와 웨이퍼(W) 간에는 내측 공간(28)이 형성되고, 척 탑(23)과 고정 링(21) 간에는 내측 공간(28)을 포함하는 외측 공간(27)이 형성되어 있다. 내측 공간(28) 및 외측 공간(27)은, 각각 씰 부재(26 및 24)에 의해 씰링되어 있다(도 3 참조).

이하에, 이러한 구성의 웨이퍼 검사용 인터페이스를 구비한 웨이퍼 검사 장치에 의한 웨이퍼에 형성된 반도체 디바이스의 전기적 특성 검사에 대하여 설명한다.

도 7 및 도 8은, 도 6의 웨이퍼 검사용 인터페이스를 구비한 웨이퍼 검사 장치에 의한 웨이퍼에 형성된 반도체 디바이스의 전기적 특성 검사의 공정도이다.

우선, 웨이퍼 반송 기구(13)가 얼라이먼트 후의 웨이퍼(W)를 검사실(14) 내로 반입하고, 픽(13B)에 대하여 얼라이먼트가 행해진 웨이퍼(W)를 프로브 카드(20)와 대향시킨다. 이 때, 웨이퍼 반송 기구(13)는 암(13A)을 미소하게 이동시켜, 픽(13B)과 프로브 카드(20)와의 얼라이먼트를 행한다(도 7의 (A)). 이에 의해, 웨이퍼(W)와 프로브 카드(20)와의 얼라이먼트가 행해진다.

이어서, 웨이퍼 반송 기구(13)가 픽(13B)을 프로브 카드(20)를 향해 이동시켜 웨이퍼(W)를 프로브 카드(20)에 접촉시킨다. 이 때, 이미 웨이퍼(W)와 프로브 카드(20)와의 얼라이먼트가 행해져 있으므로, 프로브 카드(20)의 각 프로브(25)가 웨이퍼(W)에 형성된 각 반도체 디바이스의 각 전극과 각각 정확히 접촉한다(도 7의 (B)). 이 때, 프로브 카드(20)의 포고 프레임(40)과의 접촉면에 복수의 심(51)이 배치되고, 프로브 카드(20)의 두께가 균등하게 조정되어 있으므로, 프로브 카드(20)에서의 웨이퍼(W)와 대향하는 면의 평활도가 소정 범위, 예를 들면 산술 평균 거칠기(Ra)가, Ra ≤ 30 μm로 유지된다. 따라서, 프로브 카드(20)의 프로브(25)와 웨이퍼(W)에 형성된 반도체 디바이스의 각 전극이 정확히 접촉한다.

이어서, 프로브 카드(20)와 웨이퍼(W) 간에 형성된 내측 공간(28)을 감압하여 웨이퍼(W)를 프로브 카드(20)에 끌어당겨 임시 고정하고, 이 후 픽(13B)은 웨이퍼(W)로부터 분리되어 웨이퍼 반송 기구(13)에 의해 검사실(14)로부터 퇴출된다(도 7의 (C)).

이어서, 척 탑(23)을 지지하는 리프터(22)가 척 탑(23)을 상방으로 이동시켜 척 탑(23)을 고정 링(21)에 접촉시킨다. 이 때, 척 탑(23)의 볼록부(23A)는 단차부(23B)로부터 상방으로 돌출되어 있으므로, 이 볼록부(23A)의 상부 평면인 웨이퍼 재치면(23C)은 프로브 카드(20)에 임시 고정된 웨이퍼(W)에 접촉하고, 결과적으로 웨이퍼(W)가 웨이퍼 재치면(23C) 상에 위치하게 된다(도 8의 (A)).

이어서, 척 탑(23)이 고정 링(21)에 접촉되어, 척 탑(23)과 고정 링(21) 간에 형성된 외측 공간(27)을 감압하여 척 탑(23)을 고정 링(21)에 끌어당기고, 척 탑(23)이 고정 링(21)에 의해 간접적으로 고정된다. 이 때, 고정 링(21)에 끌어당겨진 척 탑(23)은 웨이퍼 재치면(23C) 상에 위치하는 웨이퍼(W)를 프로브 카드(20)에 압압하지만, 척 탑(23)은 웨이퍼(W)보다 높은 강성을 가지므로, 웨이퍼(W)를 프로브 카드(20)에 균일하게 압압할 수 있다. 이 후, 리프터(22)는 도면 중 하방으로 이동하여 척 탑(23)으로부터 분리된다(도 8의 (B)).

이어서, 프로브 카드(20)의 각 프로브(25)로부터 소정치의 전류가 각 반도체 디바이스의 각 전극에 흘러 각 반도체 디바이스의 전기적 특성 검사가 일괄하여 행해지고, 이 후 본 검사를 종료한다.

본 실시예에 따르면, 프로브 카드(20)의 포고 프레임(40)과의 접촉면에, 프로브 카드(20)의 두께를 조정하는 심(51)을 설치했으므로, 웨이퍼(W)에 형성된 복수의 반도체 디바이스의 복수의 전극에 대하여 복수의 프로브를 각각 일괄하여 접촉시키는 프로브 카드의 두께가 균등해져, 웨이퍼 대향면의 평활도를 확보할 수 있다. 또한 이에 의해, 프로브 카드(20)에 형성된 각 프로브(25)를 웨이퍼(W)에 형성된 복수의 반도체 디바이스의 각 전극에 정확히 접촉시킬 수 있고, 이로써 웨이퍼에 형성된 반도체 디바이스에 대하여 적정한 전기적 특성 검사를 행할 수 있다.

본 실시예에 따르면, 심(51)의 형상을 평면에서 봤을 때 십자 형상으로 했으므로, 심 접착 위치인 프로브 카드(20)에 형성된 복수의 프로브군 상호 간의 격자 형상의 간극의 모서리부의 형상에 쉽게 적합시킬 수 있고, 또한 이 심(51)은, 예를 들면 작업자의 손 또는 지그에 의해 잡기 쉽게 되어 있기 때문에, 심(51)을 프로브 카드(20)의 기판(20a)에 접착할 시의 핸들링이 용이해져 작업성이 향상된다. 또한, 프로브 카드의 심 접착 위치가 되는 모든 개소에서 심(51)을 쉽게 접착할 수 있게 되므로, 두께 조정이 용이해져 웨이퍼(W)에 대향하는 면의 평활도를 쉽게 유지할 수 있게 된다. 또한 심(51)은, 예를 들면 단면 원형의 심에 비해 소정의 평면적을 가지므로, 국소적인 응력의 집중을 방지하여, 프로브 카드(20)의 국소적인 변형을 억제할 수 있다. 이에 의해, 기판(20a)에 형성되는 프로브(25)의 국소적인 기울기를 방지할 수도 있다.

본 실시예에서, 프로브 카드(20)의 접촉 영역(52)의 주변부 근방의 심으로서, 평면에서 봤을 때 L 자 형상의 심을 이용하는 것이 바람직하다. 이에 의해, 접촉 영역(52)의 전면에 걸쳐 균등하게 심을 접착할 수 있어, 프로브 카드(20)에서의 웨이퍼(W)에 대향하는 면의 평활도를 쉽게 확보할 수 있게 된다. 또한 본 실시예에서, 평면에서 봤을 때 십자 형상의 심(51) 대신에 원 기둥 또는 각 기둥의 심을 적용할 수도 있다.

본 실시예에서는, 프로브 카드(20)의 각 프로브(25)를 각각 대응하는 웨이퍼(W)의 모든 반도체 디바이스에서의 모든 전극에 대하여 일괄하여 접촉시켜 한 번에 전기적 특성 검사를 행할 수 있으므로, 반도체 디바이스의 생산성이 향상된다.

이상, 본 발명에 대하여 상기 실시예를 이용하여 설명했지만, 본 발명은 상기 실시예에 한정되지 않는다.

W : 웨이퍼
14 : 검사실
18 : 웨이퍼 검사용 인터페이스
20 : 프로브 카드
20a : 기판
23 : 척 탑
25 : 프로브
40 : 포고 프레임
51 : 심(스페이서)

Claims

기판과, 상기 기판의 웨이퍼에 대향하는 면에 상기 웨이퍼에 형성된 복수의 반도체 디바이스의 전극에 대응하여 설치된 복수의 프로브를 구비한 프로브 카드와,
상기 프로브 카드의 상기 웨이퍼에 대향하는 면과는 반대측의 면에 접촉하여 상기 프로브 카드를 지지하는 프레임과,
상기 프로브 카드의 상기 프레임과의 접촉면에 형성되고, 상기 프로브 카드의 두께를 조정하는 스페이서를 가지는 웨이퍼 검사용 인터페이스로서,
상기 스페이서는, 상기 프로브 카드에서의 기판과 열팽창율이 동일 또는 근사한 저팽창율재로 형성되어 있는 것을 특징으로 하는 웨이퍼 검사용 인터페이스.
제 1 항에 있어서,
상기 스페이서는, 상기 프로브 카드에서의 상기 웨이퍼에 대향하는 면의 평활도를 확보하기 위한 스페이서인 것을 특징으로 하는 웨이퍼 검사용 인터페이스.
제 2 항에 있어서,
상기 프로브 카드에서의 상기 웨이퍼에 대향하는 면은, 복수의 프로브의 선단부에 의해 형성되는 면인 것을 특징으로 하는 웨이퍼 검사용 인터페이스.
제 1 항에 있어서,
상기 프로브 카드에서의 상기 복수의 프로브는, 상기 웨이퍼에 형성된 복수의 반도체 디바이스에 대응하는 복수의 프로브군으로 구분되고,
상기 스페이서는, 상기 복수의 프로브군 상호의 간극에 설치되어 있는 것을 특징으로 하는 웨이퍼 검사용 인터페이스.
제 4 항에 있어서,
상기 복수의 프로브군은 바둑판 형상으로 배열되어 있고, 상기 스페이서는 상기 바둑판 형상으로 배열된 상기 복수의 프로브군 상호 간의 격자 형상의 간극의 모서리부에 설치되어 있는 것을 특징으로 하는 웨이퍼 검사용 인터페이스.
제 5 항에 있어서,
상기 스페이서는, 평면에서 봤을 때 십자 형상을 나타내고 있는 것을 특징으로 하는 웨이퍼 검사용 인터페이스.
삭제
제 2 항 또는 제 3 항에 있어서,
상기 평활도는, 산술 평균 거칠기(Ra)가 Ra ≤ 30 μm인 것을 특징으로 하는 웨이퍼 검사용 인터페이스.
웨이퍼에 형성된 반도체 디바이스의 전기적 특성을 검사하는 검사실과, 상기 검사실로의 상기 웨이퍼의 반출입을 행하는 반송 기구를 구비하는 웨이퍼 검사 장치에 있어서,
상기 검사실은 웨이퍼 검사용 인터페이스를 가지고,
상기 웨이퍼 검사용 인터페이스는,
기판과, 상기 기판의 웨이퍼에 대향하는 면에 상기 웨이퍼에 형성된 복수의 반도체 디바이스의 전극에 대응하여 설치된 복수의 프로브를 구비한 프로브 카드와,
상기 프로브 카드의 상기 웨이퍼에 대향하는 면과는 반대측의 면에 접촉하여 상기 프로브 카드를 지지하는 프레임과,
상기 프로브 카드의 상기 프레임과의 접촉면에 설치되고, 상기 프로브 카드의 두께를 조정하는 스페이서를 가지고,
상기 스페이서는, 상기 프로브 카드에서의 기판과 열팽창율이 동일 또는 근사한 저팽창율재로 형성되어 있는 것을 특징으로 하는 웨이퍼 검사 장치.