KR100856606B1 - A method and apparatus to dynamically change an operating frequency and operating voltage of an electronic device - Google Patents
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- 230000008859 change Effects 0.000 title claims abstract description 20
- 238000000034 method Methods 0.000 title claims description 33
- 230000007704 transition Effects 0.000 description 41
- 238000010586 diagram Methods 0.000 description 3
- 230000007246 mechanism Effects 0.000 description 3
- 230000003287 optical effect Effects 0.000 description 3
- 230000008569 process Effects 0.000 description 3
- 230000002411 adverse Effects 0.000 description 1
- 230000015556 catabolic process Effects 0.000 description 1
- 238000006731 degradation reaction Methods 0.000 description 1
- 230000001934 delay Effects 0.000 description 1
- 230000000977 initiatory effect Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 230000000644 propagated effect Effects 0.000 description 1
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- G06F1/32—Means for saving power
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- G06F1/3234—Power saving characterised by the action undertaken
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Abstract
일 실시예에 따르면, 전자 디바이스에 대한 목표 동작 포인트를 결정하는 단계 - 상기 목표 동작 포인트는 목표 동작 주파수 및 목표 동작 전압을 포함함 - 및 현재 동작 주파수 및 현재 동작 전압을 포함하는 상기 전자 디바이스의 현재 동작 포인트를, 상기 현재 동작 주파수를 상기 목표 동작 주파수로 그리고 상기 현재 동작 전압을 상기 목표 동작 전압으로 비동시적으로 변화시킴으로써 동적으로 변화시키는 단계 - 상기 현재 동작 전압의 변화 동안 상기 전자 디바이스는 활성 상태에 있음 -를 포함하는 방법이 제공된다.According to one embodiment, determining a target operating point for an electronic device, the target operating point comprising a target operating frequency and a target operating voltage, and a current operating frequency and a current operating voltage comprising the current operating voltage. Dynamically changing an operating point by asynchronously changing the current operating frequency to the target operating frequency and the current operating voltage to the target operating voltage, wherein the electronic device is in an active state during the change of the current operating voltage. Yes-is provided.
전자 디바이스, 목표 동작 주파수, 목표 동작 전압, 현재 동작 주파수, 현재 동작 전압, 활성 상태 Electronic device, target operating frequency, target operating voltage, current operating frequency, current operating voltage, active state
Description
본 발명의 실시예들은 전자 디바이스들에 관한 것이다. 특히, 본 발명의 실시예들은 전자 디바이스의 동작 전압 및 동작 주파수를 변화시키는 것에 관한 것이다. Embodiments of the present invention relate to electronic devices. In particular, embodiments of the present invention relate to varying operating voltages and operating frequencies of electronic devices.
본 명세서의 목적상, "전자 디바이스"라는 용어는 마이크로프로세서(프로세서), 칩셋, 그래픽 프로세서, 그래픽 액셀레터, 및 기타 데이터 프로세싱 디바이스들을 포함하나 이들로만 한정되는 것은 아닌 임의의 전자 디바이스를 포함하도록 광범위하게 해석되어야 한다. 전자 디바이스 주파수는 지난 10년에 걸쳐 대략 10배로 증가했다. 예를 들어, 90년대 중반에는 133mHz의 주파수에서 작동하는 전자 디바이스들이 보통이었으나, 오늘날 전자 디바이스는 1.6GHz 이상에서 작동된다. 이러한 전자 디바이스 주파수의 증가는 높은 동작 주파수 및 이러한 고주파수들에서 작동하는 전자 디바이스들과 연관된 고전력에 기인하여 전력 소모의 급격한 상승을 유도하였다. For the purposes of this specification, the term “electronic device” is used broadly to include any electronic device, including but not limited to microprocessors (processors), chipsets, graphics processors, graphics accelerators, and other data processing devices. It should be interpreted as Electronic device frequencies have increased approximately 10 times over the last decade. For example, in the mid-1990s, electronic devices operating at frequencies of 133 mHz were common, but today electronic devices operate at 1.6 GHz and above. This increase in electronic device frequency has led to a sharp rise in power consumption due to the high operating frequency and the high power associated with electronic devices operating at these high frequencies.
따라서, 전자 디바이스 전력 소모를 낮추는 것은 현대의 전자 디바이스들을 설계할 때 중요한 고려 사항이다. 저전력에서 작동하는 전자 디바이스들은, 배터리를 재충전할 필요없이, 배터리 전력으로 장기간 작동할 수 있다는 점에서 유리하다. Thus, lowering electronic device power consumption is an important consideration when designing modern electronic devices. Electronic devices operating at low power are advantageous in that they can operate for a long time on battery power without having to recharge the battery.
전자 디바이스의 전력 소모를 줄이는 한가지 기술은 전력 소모 및/또는 성능 기준에 기초하여 전자 디바이스의 동작 주파수 및 동작 전압을 동적으로 스케일하는 것이다. 예를 들어 고성능이 필요하지 않고 전자 디바이스가 배터리 전원으로 작동한다면, 전자 디바이스는 전력을 절약하기 위해 저주파수에서 작동하도록 동적으로 스케일되거나 스위칭될 수 있다. 전자 디바이스가 벽 소켓(AC 전원)에 접속될 때 디바이스는 그의 동작 주파수를 증가시키도록 스케일될 수 있다.One technique for reducing the power consumption of an electronic device is to dynamically scale the operating frequency and operating voltage of the electronic device based on power consumption and / or performance criteria. For example, if high performance is not required and the electronic device operates on battery power, the electronic device can be dynamically scaled or switched to operate at low frequencies to save power. When an electronic device is connected to a wall socket (AC power source), the device can be scaled to increase its operating frequency.
저전력 소모는 전자 디바이스의 동작 주파수에 부가하여 전자 디바이스의 동작 전압을 스케일링함으로써 달성될 수 있다. 그러나, 동작 전압을 스케일링하는 것은 전자 디바이스에 동작 불안정을 초래할 수 있다. 이러한 동작 불안정을 줄이기 위해, 전압 변화의 기간 동안 모든 계산들이 일반적으로 중지된다. 이 기간은 최저 동작 전압으로부터 최고 동작 전압까지 전압이 스윙하도록 허용하고, 전자 디바이스의 동작 주파수를 제어하는 위상 고정 루프 회로가 리셋되거나 재고정되도록 허용하기 위해 130㎲ 이상일 수 있다. 그렇게 긴 기간 동안 모든 계산을 중지하는 것은 전자 디바이스 성능의 열화를 초래할 것으로 평가된다.Low power consumption can be achieved by scaling the operating voltage of the electronic device in addition to the operating frequency of the electronic device. However, scaling the operating voltage can cause operating instability in the electronic device. To reduce this operational instability, all calculations are typically stopped during the period of voltage change. This period may be 130 kV or greater to allow the voltage to swing from the lowest operating voltage to the highest operating voltage, and to allow the phase locked loop circuit that controls the operating frequency of the electronic device to be reset or recalibrated. It is estimated that stopping all calculations for such a long period of time will result in degradation of the electronic device performance.
또한, 전압 변화 동안 전자 디바이스의 캐시로의 스누프 서비스(snoop services)가 가능하지 않기 때문에, 전압 변화 동안 메모리 트래픽은 적어도 130㎲ 이상 동안 통상적으로 중단된다. 메모리 트래픽의 중단은, 데이터가 상실되거나 또는 오디오-비쥬얼 아티펙트(audio-visual artifacts)가 사용자에게 인식될 수 있기 전인 10-15㎲ 이상의 지연을 통상적으로 견딜 수 없는 등시성 트래픽에 영향을 준다. 소정의 경우들에 있어서, 캐시들은 전압 스윙 전에 플러시(flush)되어야 한다. 이것은 전자 디바이스의 성능에 악영향을 주고 플러시 시간 패널티(penelty)에 기인하여 캐시 사이즈를 제한한다.Also, because snoop services to the cache of the electronic device during the voltage change are not possible, the memory traffic is typically interrupted for at least 130 Hz or more during the voltage change. Interruption of memory traffic affects isochronous traffic that typically cannot tolerate delays of 10-15 Hz or more before data is lost or audio-visual artifacts can be recognized by the user. In some cases, caches must be flushed before a voltage swing. This adversely affects the performance of the electronic device and limits the cache size due to flush time penalties.
상술한 바와 같이, 전자 디바이스에서 동작 전압의 변화를 달성하는 것은 각각의 변화 동안 전체 시스템 성능의 패널티를 초래할 수 있어서, 분당 변화 혹은 스위칭의 횟수를 제한하여, 전자 디바이스의 전력 모드가 전자 디바이스의 현재 성능 요구를 따라가지 못하게 한다. As noted above, achieving a change in operating voltage in the electronic device can result in a penalty of overall system performance during each change, limiting the number of changes or switching per minute, such that the power mode of the electronic device Do not keep up with performance requirements.
도 1은 본 발명의 일 실시예에 따른 전자 디바이스의 상위 레벨 블럭도.1 is a high level block diagram of an electronic device in accordance with an embodiment of the present invention.
도 2는 본 발명의 일 실시예에 따른 전압 전이 단계 동안 수행되는 동작들의 순서도.2 is a flow chart of operations performed during a voltage transition step according to one embodiment of the invention.
도 3은 본 발명의 일 실시예에 따른 주파수 전이 단계 동안 수행되는 동작들의 순서도.3 is a flow chart of operations performed during a frequency transition step in accordance with an embodiment of the present invention.
도 4는 본 발명에 따른 시스템의 상위 레벨 블럭도.4 is a high level block diagram of a system in accordance with the present invention.
본 명세서에서 "일 실시예" 또는 "실시예"의 참조는 그 실시예와 관련하여 설명되는 특징, 구조, 특성이 본 발명의 적어도 하나의 실시예에 포함됨을 나타낸다. 본 명세서의 여러 곳에 "일 실시예에서"라는 문구가 나오는데, 이는 모두 동일한 실시예를 참조하는 것일 필요는 없으며, 다른 실시예들과 상호 배타적인 별도의 혹은 대안적인 실시예들일 필요도 없다. 또한, 소정의 실시예들에 의해 제한될 수 있으나 다른 실시예들에 의해서는 제한되지 않는 다양한 특징들이 설명된다. 마찬가지로, 소정의 실시예들에 대해서는 요건이 될 수 있으나 다른 실시예들에서는 그렇지 않은 다양한 요건들이 설명된다. Reference in this specification to “one embodiment” or “an embodiment” indicates that a feature, structure, or characteristic described in connection with the embodiment is included in at least one embodiment of the present invention. The appearances of the phrase “in one embodiment” in various places in the specification are not necessarily all referring to the same embodiment, nor need to be separate or alternative embodiments that are mutually exclusive of other embodiments. In addition, various features are described that may be limited by certain embodiments but not limited by other embodiments. Likewise, various requirements are described that may be requirements for certain embodiments but not others.
도 1은 일 실시예에 따른 프로세서 형태의 전자 디바이스에 대한 다양한 단계들을 나타내는 단계도를 나타낸다. 도 1을 참조하면, 참조 번호 10은 프로세서의 동작의 정상 상태를 나타낸다. 이 정상 상태(10)에서, 프로세서는 현재 동작 주파수와 현재 동작 전압을 포함하는 동작 포인트에서 동작한다. 정상 상태(10)에서, 프로세서의 성능은 프로세서가 작동하고 있는 동작 포인트와 매칭된다. 즉, 정상 상태(10)는, 프로세서의 동작 포인트가, 프로세서의 성능 요건 및 전력 소비 요건의 두 견지에서 요구되는, 동작 주파수 및 동작 전압에서 동작하고 있는 프로세서의 상태이다.1 is a step diagram illustrating various steps for an electronic device in the form of a processor, according to one embodiment. Referring to FIG. 1,
일 실시예에 있어서, 프로세서는, 예를 들어 성능 요건이 증가되어 프로세서의 동작 포인트가 상승될 필요가 있는 경우가 발생하면 정상 상태(10)를 떠날 것이다. 대안적으로, 프로세서는, 전력을 절약할 필요가 있어서 프로세서의 동작 포인트가 낮추어지는 경우 발생하면 그의 정상 상태(10)를 떠날 것이다. 어느 한 경우에, 프로세서의 동작 포인트를 정상 상태(10)와 관련된 동작 포인트보다 낮은 목표 동작 포인트로 낮추기 위해, 프로세서는 먼저 프로세서의 동작 주파수가 정상 상태(10)에서의 프로세서의 동작 주파수보다 낮은 값으로 낮춰지는 주파수 전이 단계(12)로 진입한다. 주파수 전이 단계(12) 동안 수행되는 특정 동작들은 하기에서 더 상세히 설명될 것이다.In one embodiment, the processor will leave
주파수 전이 단계(12)의 실행 후, 프로세서는 전압 전이 단계(14)로 진입한다. 전압 전이 단계(14) 동안, 프로세서의 동작 전압은 정상 상태(10)와 관련된 동작 전압으로부터 정상 상태(10)와 관련된 동작 전압보다 낮은 목표 동작 전압으로 낮춰진다. 전압 전이 단계(14)를 실행한 후, 프로세서는 프로세싱 속도(성능) 및 전력 소비의 두 관점에서 현재의 요구들이 프로세서의 현재 동작 포인트와 매칭될 것이므로, 다시 정상 상태(10)에 있게 된다.After execution of the
다른 경우에, 프로세서의 동작 포인트를 그의 정상 상태(10)의 동작 포인트로부터 높은 동작 포인트로 전이하기 위해, 프로세서는 먼저 정상 상태(10)와 관련된 동작 전압이 더 높은 목표 동작 전압으로 전이되는 전압 전이 단계(16)로 진입하고, 전압 전이 단계(16)를 실행한 후, 주파수 전이 단계(18)가 실행되어 정상 상태(10)와 관련된 동작 주파수가 더 높은 동작 주파수로 전이된다. 주파수 전이 단계(18)의 실행 후, 프로세서는 이제 전력 소비 및 프로세서 성능의 두 관점에서 요구되는 것과 매칭되는 동작 전압 및 동작 주파수를 포함하는 동작 포인트에서 동작할 것이므로, 다시 정상 상태(10)에 있게 된다. 소정의 실시예들에 있어서, 전압 전이 단계들(16, 14)은 동일하거나 유사한 동작들을 야기할 것이고, 주파수 전이 단계들(12, 18)은 동일하거나 유사한 동작들을 야기할 것이다. In other cases, to transition the operating point of the processor from its operating point in its
도 2를 참조하면, 참조 번호 30은 본 발명의 일 실시예에 따른 전압 전이 단계(14, 16) 동안 수행되는 동작들의 순서도를 나타낸다. 상술한 바와 같이, 전압 전이 단계(14, 16)는 프로세서가 그의 현재의 동작 전압이, 전압 전이 단계(14)의 경우 더 낮은 그리고 전압 전이 단계(16)의 경우에는 더 높은 목표 동작 전압과 다를 때 진입된다. 블럭 32에서, 프로세서의 현재의 동작 전압을 증분량만큼 변화시키기 위한 동작이 수행된다. 이 증분량은 상이한 프로세서들에 대해 다를 것이나, 일 실시예에서는 5-50mV 범위의 작은 양이다. 일 실시예에서는 각 증분량의 사이즈가 프로세서가 동작 불안정을 상승시키기 않고서 견딜 수 있는 증분 전압 변화를 나타내는 값으로 설정된다.Referring to FIG. 2,
블럭 34에서, 전압을 증분하여 변화시킨 후, 프로세서는 프로세서의 회로가 새로운 동작 전압으로 조정될 수 있게 해주는 소정의 기간을 대기한다. 따라서, 각각의 증가를 시간적으로 산재시킴으로써, 프로세서와 연관된 클럭 회로와 로직 타이밍 회로는 소프트웨어에 투명한 방식으로 동작을 계속할 수 있다(즉, 프로세서는 활성 상태로 남아 있는다). 일 실시예에서, 소정의 대기 시간은 5-30㎲ 사이이다. 블럭 32에서, 목표 동작 전압이 도달되었는지를 결정하기 위해 체크가 이루어진다. 목표 동작 전압에 도달되지 않았으면, 블럭 32가 다시 실행되고, 그렇지 않다면 전압 전이 상태로부터 빠져 나온다. 전압 전이 단계(14, 16) 동안, 프로세서는, 프로세서가 계속해서 코드를 실행할 수 있고 프로세서와 연결된 프로세서 버스 상에서 메모리 트랜잭션이 여전히 가능한 활성 상태에 남아 있게 된다. At block 34, after incrementing and changing the voltage, the processor waits for a predetermined period of time allowing the circuitry of the processor to adjust to the new operating voltage. Thus, by interspersing each increment in time, the clock circuitry and logic timing circuitry associated with the processor can continue to operate in a software transparent manner (ie, the processor remains active). In one embodiment, the predetermined waiting time is between 5-30 ms. At block 32, a check is made to determine if the target operating voltage has been reached. If the target operating voltage has not been reached, block 32 is executed again, otherwise exits from the voltage transition state. During the
도 3을 참조하면, 참조 번호 40은 주파수 전이 단계(12, 18) 동안 수행되는 동작들의 순서도이다. 블럭 42에서, 주파수 전이 단계(12, 18)에 진입한 후, 프로세서는 그에 연결된 프로세서 버스 상에서 새로운 버스 트랜잭션의 개시를 중지한다. 블럭 43에서, 프로세서 버스에 대한 모든 계류중인 또는 큐잉된 버스 트랜잭션이 완료되었는지를 판정하기 위한 체크가 이루어진다. 블럭 44가 실행되어 모든 계류중인 버스 트랜잭션들이 완료될 때까지 블럭 43이 재실행된다. 블럭 44의 실행은 원시 버스 메카니즘(native bus mechanism)을 이용하여 프로세서 버스를 스톨링하는 것을 포함한다. 그 후, 프로세서의 로직 유닛들을 중단하고, 소정의 경우에 코어 클럭인 제1 (코어) 클럭을 중단하고, 위상 고정 루프 회로에게 프로세서 코어가 목표 동작 주파수로 설정되도록 명령하는 것을 포함하는 블럭 46이 실행된다. Referring to FIG. 3,
블럭 46의 실행 후, 블럭 48이 실행되어 프로세서는 코어 위상 고정 루프 회로가 재설정되도록 해주는 소정의 지연 기간 동안 대기한다. 어떤 경우들에서, 소정의 지연 기간은 약 10㎲일 수 있다. 블럭 40에서, 코어 클럭이 복원되고, 프로세서 버스가 해제되고, 중단된 로직 유닛들이 재시작된다. 그 후, 블럭 52가 실행되어 정상 코드 실행이 재개된다.After execution of
도 4를 참조하면, 참조 번호 60은 일반적으로 본 발명의 일 실시예에 따른 프로세서를 포함한 시스템을 나타낸다. 시스템(60)은 프로세서 버스(64)에 의해 메모리 컨트롤러(66)에 연결된 프로세서(62)를 포함한다. 메모리 컨트롤러(66)는 메인 메모리(68)와의 메모리 트랜잭션들을 제어한다. 프로세서는 프로세서(62)에 대한 전압 공급기(도시되지 않음)의 출력을 조절하는 전압 조절기(70)에 연결된다. 프로세서(62)는 대수 및 논리 유닛(ALU) 등과 같은 기능 유닛들을 포함하는 프로세서 코어(62A)를 포함한다. 위상 고정 루프 회로(62B)는 클럭 발생기(72)로부터 클럭 신호를 수신하고 수신된 클럭 신호를 요구되는 동작 주파수로 스케일링하는데, 스케일링된 클럭 신호는 프로세서 코어(62A)에 공급된다. Referring to FIG. 4,
프로세서(62)는 또한 위상 고정 루프 회로(62B)와 전압 조절기(70) 모두를 제어하는 동작 포인트 제어 유닛(62C)을 포함한다. 사용 중, 동작 포인트 제어 유닛(62C)은 프로세서(62)의 동작 포인트가 목표 동작 포인트보다 더 높거나 낮아진다. 소정의 경우에, 이러한 판정은, 전력 및/또는 성능 요건들에 따라 프로세서의 동작 주파수 및 동작 전압을 스케일링하기 위해 운영 시스템으로부터 입력을 수신하는 단계를 포함할 수 있다. 소정의 경우에, 프로세서가 AC 전원으로부터 배터리 전원으로 스위칭될 때, 또는 작동중인 계산 부하가 줄어들면, 현재 동작 포인트는 목표 동작 포인트보다 높은 것으로 판정될 수 있다. 다른 경우에, 높은 프로세싱 부하가 있으면, 현재 동작 포인트는 목표 동작 포인트보다 낮은 것으로 판정될 수 있다. Processor 62 also includes an operating
목표 동작 포인트가 현재 동작 포인트보다 높으면, 동작 포인트 제어 유닛(62C)은 위상 고정 루프 회로(62B) 및 전압 조절기(70)에 제어 신호를 보내어, 프로세서(62)에 대한 동작 주파수 및 동작 전압을 증가시킨다. 역으로, 동작 포인트 제어 메카니즘(62C)이 목표 동작 포인트가 현재 동작 포인트보다 낮다고 판정하면, 동작 포인트 제어 유닛(62C)은 위상 고정 루프 회로(62B)에 제어 신호를 보내어 현재 동작 주파수를 목표 동작 주파수로 낮추게 한다. 또한, 동작 포인트 제어 유닛(62C)은 전압 조절기(70)에 제어 신호를 보내어 전압 조절기(70)가 프로세서(62)에 대한 동작 전압을 낮추기 위한 제어 신호를 송신하게 야기한다.If the target operating point is higher than the current operating point, the operating
프로세서(62)의 동작 주파수 및 동작 전압을 목표 동작 주파수 및 목표 동작 전압으로 변화시키기 위해 프로세서(62)에 의해 수행되는 실제 동작들은 도 1을 참조하여 상술한 주파수 전이 단계(12, 18)와 전압 전이 단계(14, 16) 동안 수행되는 동작들에 대응한다. 따라서, 전압 전이 단계는 주파수 전이 단계와 분리되고, 동작 포인트를 낮추는 다운 전이 동안 주파수 전이가 먼저 수행된다. 높은 동작 포인트로의 업 전이 동안, 높은 주파수 동작이 진행하도록 허용하기 위해 우선 전압 전이가 수행된다. 일 실시예에서 프로세서 동작 및 버스(64) 상의 버스 트래픽은 전압 전이 단계 동안 중단되지 않는다. 또한, 동작 불안정을 감소시키기 위해, 전압 전이가 작은 증분들로 수행되고(일 실시예에서 각각의 증분은 5-50mV이다), 시간적으로 산재되어(일 실시예에서 약 0.5 내지 30㎲만큼 떨어져서), 프로세서 회로가 전이에 의해 영향을 받지 않는다.Actual operations performed by the processor 62 to change the operating frequency and operating voltage of the processor 62 to the target operating frequency and the target operating voltage include the
상술한 방식으로 전압 및 주파수 전이들을 수행하면서, 주파수 전이 단계는 일 실시예에서, 5-10㎲ 이내에 완성될 수 있다. 주파수 전이 페이즈 동안 프로세서 버스(64)가 작동가능하므로, 전이 단계들 동안 프로세서로의 트래픽은 원시 버스 메카니즘(native bus mechanism)을 이용하여 차단될 수 있다. 이것은 프로세서(62)를 포함하는 칩셋에 있어서 낮은 시간 오버헤드(낮은 대기시간 및 영향) 및 낮은 구현 비용을 가능하게 해준다. 일 실시예에서, 주파수 전이는 프로세서(62)내에서부터 완전히 제어되고, 따라서 이를 수행하기 위해 외부 디바이스가 필요하지 않다. 이것은 프로세서 인터페이스 핀들을 절약한다.While performing voltage and frequency transitions in the manner described above, in one embodiment the frequency transition step can be completed within 5-10 Hz. Since the
소정의 실시예들에서, 동작 포인트 제어 유닛(62C)은 하드 코드화된 다양한 동작 포인트들을 갖는다. 또한, 상술한 기술들을 실시하기 위해 필요한 각각의 전압 증분량 및 지연 기간도 동작 포인트 제어 유닛(62C) 내에 하드 코드화되어 있다. 다른 실시예들에서, 이 값들은 펌웨어로 존재할 수 있다. 또한 다른 실시예들에서, 이 값들은 부분적으로 또는 모두 소프트웨어로 프로그램될 수 있다.In certain embodiments, operating
상술한 프로세스들을 수행하기 위한 로직은 전자 디바이스 내에 하드웨어로 구현될 수 있으며, 또는 대안적으로 디바이스의 외부에 구현될 수 있다. 상술한 프로세스들은 또한 컴퓨터의 메모리 내에 실행될 명령들의 세트로서 저장될 수 있다. 또한, 상술한 동작들을 수행하기 위한 명령들은 대안적으로 자기 및 광학 디스크를 포함한, 다른 형태의 머신-판독가능 매체 상에 저장될 수 있다. 예를 들어, 일 실시예의 동작들은 디스크 드라이브(또는 컴퓨터-판독가능 매체 드라이브)를 통해 액세스 가능한 자기 디스크 또는 광학 디스크 등과 같은 머신-판독가능 매체 상에 저장될 수 있다. 또한, 명령들은 컴파일되고 링크된 버전의 형태로 데이터 네트워크를 통해 컴퓨팅 디바이스에 다운로드될 수 있다.Logic for performing the processes described above may be implemented in hardware within an electronic device, or alternatively, may be implemented outside of the device. The processes described above can also be stored as a set of instructions to be executed in a memory of a computer. In addition, the instructions for performing the operations described above may alternatively be stored on other forms of machine-readable media, including magnetic and optical disks. For example, the operations of one embodiment may be stored on a machine-readable medium, such as a magnetic disk or an optical disk, accessible through a disk drive (or computer-readable medium drive). In addition, the instructions may be downloaded to a computing device via a data network in the form of a compiled and linked version.
대안적으로, 상술한 동작들을 수행하기 위한 프로세스들은, LSI 회로(Large-Scale Integrated circuit), 주문형 집적 회로(ASIC's) 등과 같은 별개의 하드웨어 컴포넌트, 전기적으로 소거가능한 프로그래머블 ROM(EEPROM) 등의 펌웨어 등의 추가적인 컴퓨터 및/또는 머신 판독가능 매체 상에, 그리고 전기, 광, 음향 및 기타 형태의 전파 신호들(예를 들면, 반송파, 적외선 신호, 디지털 신호 등) 등에 구현될 수 있다. Alternatively, the processes for performing the above-described operations may include separate hardware components such as large-scale integrated circuits (ASI's), application specific integrated circuits (ASIC's), firmware such as electrically erasable programmable ROM (EEPROM), and the like. May be implemented on additional computer and / or machine readable media, and in electrical, optical, acoustical and other forms of propagated signals (eg, carrier waves, infrared signals, digital signals, etc.).
비록 본 발명은 특정한 바람직한 실시예들을 참조하여 설명되었지만, 다양한 변경들 및 변화들이 본 발명의 넓은 사상 및 범위를 벗어나지 않고 이루어질 수 있을 것이다. 따라서, 명세서 및 도면들은 제한적인 의미로가 아니고 예시적인 것으로 여겨져야 할 것이다. 그러므로, 예를 들어, 소정의 실시예에서는 동작 포인트 제어 유닛(62C) 또는 적어도 그 컴포넌트들이 프로세서(62)의 외부에 배치될 수도 있고, 프로세서(62)를 포함한 칩셋의 일부를 형성할 수도 있다. 또한, 동작 포인트 제어 유닛(62)은 펌웨어, 소프트웨어 또는 하드웨어로 구현될 수 있다. 마찬가지로, 전압 조절 유닛(70) 또는 적어도 그의 컴포넌트들은 프로세서(62) 또는 칩셋의 임의의 다른 일부 내부에 배치될 수 있다.Although the present invention has been described with reference to specific preferred embodiments, various changes and modifications may be made without departing from the broad spirit and scope of the invention. Accordingly, the specification and drawings are to be regarded in an illustrative rather than a restrictive sense. Thus, for example, in some embodiments the operating
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- 2003-10-03 EP EP03759704A patent/EP1552371A2/en not_active Ceased
- 2003-10-03 AU AU2003275426A patent/AU2003275426A1/en not_active Abandoned
- 2003-10-03 WO PCT/US2003/031449 patent/WO2004036402A2/en not_active Application Discontinuation
- 2003-10-03 KR KR1020057006484A patent/KR100856606B1/en active IP Right Grant
- 2003-10-14 CN CNB2003101156875A patent/CN100351777C/en not_active Expired - Fee Related
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- 2004-05-26 US US10/855,268 patent/US7237128B2/en not_active Expired - Lifetime
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Publication number | Publication date |
---|---|
US20040073821A1 (en) | 2004-04-15 |
AU2003275426A1 (en) | 2004-05-04 |
US7237128B2 (en) | 2007-06-26 |
CN100351777C (en) | 2007-11-28 |
KR20050075359A (en) | 2005-07-20 |
US20060156040A1 (en) | 2006-07-13 |
EP1552371A2 (en) | 2005-07-13 |
US7013406B2 (en) | 2006-03-14 |
WO2004036402A3 (en) | 2004-08-12 |
WO2004036402A2 (en) | 2004-04-29 |
CN1516000A (en) | 2004-07-28 |
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