KR100476590B1 - Socket for testing a semiconductor device - Google Patents
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Abstract
본 발명은 반도체 디바이스 테스트 소켓에 관한 것으로, 본 발명에서는 핀-플랜저의 일부에 일련의 삽입 홈을 형성시켜, 탄성 스프링의 일부가 핀-플랜저의 내부에 선택적으로 삽입될 수 있도록 유도함과 아울러, 핀-플랜저를 수용하는 바렐의 일부에 음각으로 패인 고정 홈을 형성시켜, 바렐의 고정 구조가 대폭 개선될 수 있도록 유도하고, 이를 통해, 프로브-핀의 전체적인 사이즈 최소화를 유도한다. 또한, 본 발명에서는 프로브-핀 고정용 하우징을 얇은 두께를 갖는 단독 구조물로 교체시키고, 이를 통해, 프로브-핀의 조립성 향상을 유도한다.The present invention relates to a semiconductor device test socket, wherein the present invention forms a series of insertion grooves in a portion of the pin-plunger, inducing a portion of the elastic spring to be selectively inserted into the pin-plunger, A negatively recessed fixation groove is formed in a portion of the barrel containing the flanger, leading to a significant improvement in the fixing structure of the barrel, thereby minimizing the overall size of the probe-pin. In addition, in the present invention, the probe-pin fixing housing is replaced with a single structure having a thin thickness, thereby inducing an improvement in the assembly of the probe-pin.
이러한 본 발명의 실시에 따라, 프로브-핀의 전체적인 사이즈가 최소화되고, 이를 통해, 해당 프로브-핀이 나타내는 인덕턴스 및 캐패시턴스가 크게 감소되는 경우, 테스트 소켓의 신호특성은 대폭 향상될 수 있게 되며, 결국, 테스트 대상 반도체 디바이스들의 필터링 신뢰성 극대화를 통해, 최종 출하되는 반도체 제품들은 일정 수준 이상의 품질을 유지할 수 있게 된다. According to the implementation of the present invention, the overall size of the probe pin is minimized, whereby the signal characteristics of the test socket can be greatly improved when the inductance and capacitance represented by the probe pin are greatly reduced, and eventually By maximizing the filtering reliability of the semiconductor devices under test, the final shipped semiconductor products can maintain a certain level of quality.
또한, 본 발명의 실시에 따라, 일련의 향상된 조립 조건이 구현되는 경우, 반도체 생산업체에서는 전체적인 반도체 테스트 공정효율이 일정 수준 이상으로 향상되는 이점을 손쉽게 획득할 수 있게 된다.In addition, according to the practice of the present invention, when a series of improved assembly conditions are implemented, semiconductor manufacturers can easily obtain the advantage that the overall semiconductor test process efficiency is improved to a certain level or more.
Description
본 발명은 반도체 디바이스 테스트 소켓에 관한 것으로, 좀더 상세하게는 핀-플랜저의 일부에 일련의 삽입 홈을 형성시켜, 탄성 스프링의 일부가 핀-플랜저의 내부에 선택적으로 삽입될 수 있도록 하고, 이를 통해, 프로브-핀의 전체적인 사이즈 최소화를 유도함과 아울러, 프로브-핀 고정용 하우징을 얇은 두께를 갖는 단독 구조물로 교체시켜, 프로브-핀의 전체적인 조립성 향상을 유도할 수 있는 반도체 디바이스 테스트 소켓에 관한 것이다.TECHNICAL FIELD The present invention relates to a semiconductor device test socket, and more particularly to forming a series of insertion grooves in a portion of a pin-plunger so that a portion of the elastic spring can be selectively inserted into the inside of the pin-plunger. In addition, the present invention relates to a semiconductor device test socket capable of minimizing the overall size of the probe-pin and replacing the probe-pin fixing housing with a thin-walled single structure to improve overall assembly of the probe-pin. .
통상, "웨이퍼 레벨의 제조 공정이 완료된 각 반도체 디바이스들" 또는 "패키징 공정이 완료된 각 반도체 디바이스들"은 일련의 후속공정을 수행 받기 이전에 일련의 전기적인 특성검사를 받는 것이 일반적이다.Typically, each of the "semiconductor devices for which the wafer level manufacturing process has been completed" or "each semiconductor device for which the packaging process is completed" is typically subjected to a series of electrical property inspections before being subjected to a series of subsequent processes.
이러한 테스트 공정은 각 반도체 제품들로 기 정해진 테스트 전압, 테스트 전류, 테스트 신호등을 공급하여 그 출력상태를 점검하고, 이를 통해, 해당 반도체 제품들이 특정 기준에 적합하게 제조되었는가의 여부를 최종 필터링(Final filtering)하는 공정으로써, 이 테스트 공정의 정확도 여부에 따라, 최종 출하되는 반도체 제품은 그 품질에 있어, 지대한 영향을 받게 된다. Such a test process supplies a predetermined test voltage, test current, test signal, etc. to each semiconductor product and checks its output state, thereby performing final filtering whether the semiconductor products are manufactured according to a specific standard. As a process for filtering, depending on the accuracy of this test process, the final shipped semiconductor product is greatly affected by the quality thereof.
이러한 이유로, 종래의 반도체 생산업체에서는 테스트 공정을 전담하는 반도체 테스트 설비를 필수적으로 구비하고, 이 반도체 테스트 설비의 정밀한 운용을 통해, 최종 출하되는 반도체 제품의 품질향상을 도모하고 있다.For this reason, the conventional semiconductor producers are essentially equipped with a semiconductor test facility dedicated to the test process, and through the precise operation of the semiconductor test facility, to improve the quality of the semiconductor product finally shipped.
도 1에 도시된 바와 같이, 종래의 기술에 따른 반도체 테스트 설비(100) 체제 하에서, 테스트 대상 반도체 디바이스(1), 예컨대, 비지에이 타입(BGA type:Ball Grid Array type; 이하, "BGA 타입"이라 칭함) 반도체 디바이스는 테스트 소켓(101)을 매개로 테스트 보드(2)와 일련의 전기적인 연결관계를 형성하여, 자신에게 요구되는 반도체 테스트 공정을 수행 받게 된다.As shown in FIG. 1, under the semiconductor test facility 100 system according to the related art, the semiconductor device 1 to be tested, for example, a BGA type (BGA type: Ball Grid Array type; hereinafter referred to as “BGA type”). The semiconductor device forms a series of electrical connections with the test board 2 through the test socket 101 to perform a semiconductor test process required by the semiconductor device.
이때, 테스트 보드(2)는 해당 테스트 대상 반도체 디바이스(1)로 일련의 테스트 전압, 테스트 전류, 테스트 신호등을 공급함으로써, 해당 반도체 디바이스(1)가 그 불량유무에 따라, 정밀하게 필터링될 수 있도록 유도하는 역할을 수행하며, 테스트 소켓(101)은 테스트 대상 반도체 디바이스(1) 및 테스트 보드(2) 사이에 개재된 상태에서, 이들을 전기적으로 연결하는 역할을 수행한다.In this case, the test board 2 supplies a series of test voltages, test currents, test signals, etc. to the test target semiconductor device 1 so that the semiconductor device 1 can be accurately filtered according to whether there is a defect. The test socket 101 serves to electrically connect the test sockets 101 in the state interposed between the test target semiconductor device 1 and the test board 2.
여기서, 도면에 도시된 바와 같이, 테스트 소켓(101)은 상·하부 하우징(102,103)과, 이 상·하부 하우징(102,103)의 삽입홀(106)에 끼워져 고정되는 프로브-핀(110:Probe-pin)의 조합으로 이루어진다. Here, as shown in the figure, the test socket 101 is inserted into the upper and lower housings 102 and 103, and the insertion hole 106 of the upper and lower housings 102 and 103, and the probe pin 110 (Probe-) pin) combination.
이 경우, 프로브-핀(110)은 통체 형상의 금속제 바렐(113:Barrel)과, 이 바렐(113)에 움직임이 가능하도록 고정되며, 반도체 디바이스(1)의 터미널(1a) 및 테스트 보드(2)의 콘택 패드(2a)와 각각 전기적으로 접촉되는 상·하부 핀-플랜저(111,112:Pin-flanger)와, 이 상·하부 핀-플랜저(111,112)들을 물리적으로 연결하는 탄성체, 예컨대, 탄성 스프링(114)의 조합으로 이루어진다.In this case, the probe-pin 110 is fixed to the barrel-shaped metallic barrel 113 and the barrel 113 so as to be movable, and the terminal 1a and the test board 2 of the semiconductor device 1 are fixed. Upper and lower pin-flangers 111 and 112 electrically contacting the contact pads 2a of the upper and lower contact pins 2a, and elastic bodies physically connecting the upper and lower pin-flanges 111 and 112, for example, elastic springs 114).
이때, 상·하부 하우징(102,103)의 삽입홀(106)은 소구경 삽입홀(104) 및 대구경 삽입홀(105)의 조합으로 이루어져, 그 경계면이 급격히 좁아지는 병목형 구조를 형성함으로써, 상·하부 핀-플랜저(111,112)들을 수용하는 바렐(113)의 단부가 소구경 삽입홀(104)의 병목부에 걸려 고정될 수 있도록 유도하고, 이를 통해, 해당 상·하부 핀-플랜저(111,112)들이 상·하부 하우징(102,103)으로부터 이탈되지 않으면서도, 이 상·하부 하우징(102,103)의 외부로 적절하게 노출될 수 있도록 유도하는 기반 환경을 제공한다.At this time, the insertion hole 106 of the upper and lower housings 102 and 103 is composed of a combination of the small-diameter insertion hole 104 and the large-diameter insertion hole 105, thereby forming a bottleneck structure in which the interface becomes sharply narrow. The end of the barrel 113 that accommodates the lower pin-flanges 111 and 112 is guided so that it can be fixed to the bottleneck of the small-diameter insertion hole 104, through which the upper and lower pin-flanges 111 and 112 can be fixed. A base environment is provided which leads to proper exposure to the outside of the upper and lower housings 102 and 103 without being separated from the upper and lower housings 102 and 103.
이러한 구조 하에서, 상술한 테스트 대상 반도체 디바이스(1)가 외력에 의해 테스트 보드(2)쪽으로 하강하여, 상부 핀-플랜저(111)를 가압하면, 탄성 스프링(114)은 그 힘에 의해 테스트 보드(2)측으로 강하게 압축됨으로써, 테스트 대상 반도체 디바이스(1) 및 테스트 보드(2)를 연결하는 일련의 통전로를 형성하게 된다. Under this structure, when the above-described semiconductor device 1 under test is lowered toward the test board 2 by an external force and presses the upper pin-flange 111, the elastic spring 114 is subjected to the test board (by the force). By strongly compressing to 2) side, a series of energization paths connecting the test target semiconductor device 1 and the test board 2 are formed.
이 상황에서, 테스트 보드(2)는 테스트 대상 반도체 디바이스(1)측으로, 일련의 테스트 전압, 테스트 전류, 테스트 신호 등을 공급함으로써, 해당 반도체 디바이스(1)가 그 불량유무에 따라, 정밀하게 필터링될 수 있도록 유도하게 된다.In this situation, the test board 2 supplies a series of test voltages, test currents, test signals, and the like to the semiconductor device 1 to be tested, so that the semiconductor device 1 is precisely filtered according to whether there is a defect. To make it possible.
이러한 종래의 기술 체제 하에서, 상·하부 핀-플랜저(111,112) 사이에는 이들을 물리적으로 연결하는 탄성 스프링(114)이 개재되는 바, 이 때문에, 별도의 조치가 취해지지 않는 한, 상·하부 핀-플랜저(111,112)들은 적어도, 탄성 스프링(114)의 길이 만큼은 그 간격이 벌어질 수밖에 없게 되며, 결국, 이 여파로, 상·하부 핀-플랜저(111,112)를 수용하는 바렐(113) 역시, 그 길이가 길어질 수밖에 없게 된다.Under such a prior art scheme, an elastic spring 114 for physically connecting them is interposed between the upper and lower pin-flanges 111 and 112, and therefore, unless an additional measure is taken, the upper and lower pins- The flangers 111 and 112 are forced to open at least the length of the elastic spring 114, so that in the aftermath, the barrel 113 accommodating the upper and lower pin-flanges 111 and 112 also has its length. Will be long.
통상, 상·하부 핀-플랜저(111,112) 사이의 거리가 벌어져, 바렐(113)의 길이가 길어지는 경우, 전체적인 프로브-핀(110)이 사이즈는 증가할 수밖에 없으며, 결국, 해당 프로브-핀(110)이 나타내는 인덕턴스 및 캐패시턴스는 이러한 사이즈 증가에 비례하여, 커질 수밖에 없게 된다.In general, when the distance between the upper and lower pin-flanges 111 and 112 increases, and the length of the barrel 113 becomes long, the overall probe-pin 110 has to increase in size, and eventually, the corresponding probe-pin ( The inductance and capacitance represented by 110 are inevitably large in proportion to this size increase.
근래에, 반도체 제조기술이 급격한 발전을 이루면서, 테스트 대상 반도체 디바이스의 동작 속도는 점점 빨라지는 추세에 있는 바, 이러한 상황에도 불구하고, 종래의 체제 하에서, 프로브-핀(110)이 나타내는 인덕턴스 및 캐패시턴스는 자신의 사이즈 증가로 인해, 그 크기가 커질 수밖에 없기 때문에, 테스트 소켓(101)은 양호한 신호특성을 나타낼 수 없게 되며, 결국, 종래의 테스트 소켓(101)은 고속의 테스트 대상 반도체 디바이스(1)를 정교하게 테스트할 수 없게 되고, 그 결과, 테스트 대상 반도체 디바이스(10를 신뢰성 있게 필터링할 수 없게 된다.In recent years, with the rapid development of semiconductor manufacturing technology, the operating speed of the semiconductor device under test has been gradually increasing. Despite this situation, under the conventional system, the inductance and capacitance exhibited by the probe-pin 110 are exhibited. Due to the increase in size thereof, the size of the test socket 101 cannot exhibit good signal characteristics because the size thereof is inevitably increased. As a result, the conventional test socket 101 is a high-speed test target semiconductor device 1. Cannot be precisely tested, and as a result, the semiconductor device 10 to be tested cannot be reliably filtered.
물론, 상·하부 핀-플랜저(111,112) 사이에 개재된 탄성 스프링(114)의 길이를 줄이면, 바렐(113)의 사이즈도 더불어 줄어들게 되어, 앞의 문제점을 어느 정도 차단시킬 수 있겠지만, 유효 탄성력을 고려할 때, 탄성 스프링(114)의 길이를 줄이는 데에는 한계가 따를 수밖에 없다.Of course, if the length of the elastic spring 114 interposed between the upper and lower pin-plungers (111, 112) is reduced, the size of the barrel 113 is also reduced, it may block some of the above problems, but the effective elastic force In consideration of this, there is bound to be a limit in reducing the length of the elastic spring 114.
최근, 앞서 언급한 문제점을 해결하기 위하여, 도 2에 도시된 바와 같은 새로운 타입의 테스트 소켓(121)이 개발되어 널리 보급되고 있다.Recently, in order to solve the aforementioned problem, a new type of test socket 121 as shown in FIG. 2 has been developed and widely used.
이때, 새로운 타입의 테스트 소켓(121)은, 앞의 경우와 유사하게, 상·하부 하우징(122,123)과, 바렐(132), 탄성 스프링(134)을 구비한 상태로 상·하부 하우징(122,123)의 삽입홀(126)에 끼워져 고정되는 프로브-핀(130)의 조합으로 이루어지며, 이 프로브-핀(130)을 고정시키는 삽입홀(126) 역시, 앞의 경우와 유사하게, 소구경 삽입홀(124) 및 대구경 삽입홀(125)의 조합으로 이루어진다.At this time, the new type of test socket 121, the upper and lower housings 122 and 123, the barrel 132, the elastic spring 134, the upper and lower housings 122 and 123, similarly to the previous case It is made of a combination of the probe-pin 130 is inserted and fixed to the insertion hole 126 of the, the insertion hole 126 for fixing the probe-pin 130 also, similar to the previous case, a small diameter insertion hole 124 and the large-diameter insertion hole 125.
그러나, 이러한 유사성과 달리, 새로운 타입의 테스트 소켓(121)에서, 바렐(132)의 일부에는 상·하부 핀-플랜저 중의 어느 하나, 예컨대, 상부 핀-플랜저를 대체하는 유사 구조물(132a)이 자체 형성된다. 이러한 유사 구조물(132a)이 형성되는 경우, 프로브-핀(130)은 단지, 상부 핀-플랜저 또는 하부 핀-플랜저 중의 어느 하나, 예컨대, 하부 핀-플랜저(131)만을 구비하고서도, 정상적인 수준의 반도체 디바이스 테스트 과정을 진행시킬 수 있기 때문에, 결국, 자신의 전체적인 사이즈가 짧아지는 효과를 손쉽게 획득할 수 있게 된다.However, unlike this similarity, in the new type of test socket 121, a portion of the barrel 132 has a similar structure 132a, which replaces any one of the upper and lower pin-flanges, for example, the upper pin-plunger. Is formed. When such a similar structure 132a is formed, the probe-pin 130 only includes the upper pin-plunger or the lower pin-plunger, for example, the lower pin-plunger 131, but at a normal level of semiconductor. Since the device test process can be performed, the effect of shortening its overall size can be easily obtained.
물론, 프로브-핀(130)의 전체적인 사이즈가 짧아지는 경우, 해당 프로브-핀(130)이 나타내는 인덕턴스 및 캐패시턴스는 프로브-핀(130)의 사이즈 감소 폭 만큼, 작아질 수 있기 때문에, 테스트 소켓(121)은 그만큼 양호한 신호특성을 나타낼 수 있게 되며, 결국, 테스트 대상 반도체 디바이스(1)를 앞의 경우보다 좀더 정교하게 테스트할 수 있게 된다. Of course, when the overall size of the probe-pin 130 is shortened, the inductance and capacitance represented by the probe-pin 130 may be reduced by the size reduction width of the probe-pin 130, so that the test socket ( 121 can exhibit such good signal characteristics, and as a result, the semiconductor device 1 to be tested can be tested more precisely than in the previous case.
그러나, 이러한 새로운 타입의 테스트 소켓(121)은 기본적으로, 앞의 경우와 유사하게, "바렐(132)의 단부가 소구경 삽입홀(124)의 병목부에 걸려 고정될 수 있도록 유도하는 구조"를 형성하고 있기 때문에, 바렐(132)의 길이가 적어도, 상·하부 하우징의 대구경 삽입홀(125)의 길이에 대응되는 사이즈 만큼 길어질 수밖에 없는 단점을 나타낼 수밖에 없게 되며, 결국, 유사 구조물(132a)의 형성에도 불구하고, 인덕턴스 및 캐패시턴스의 값을 줄이는 데에는 어느 정도의 한계를 보일 수밖에 없게 된다.However, this new type of test socket 121 is basically, similar to the previous case, "a structure that induces the end of the barrel 132 can be fixed to the bottleneck of the small diameter insertion hole 124 fixed" Since the length of the barrel 132 is at least as long as the size corresponding to the length of the large-diameter insertion hole 125 of the upper and lower housings, there is no choice but to exhibit a disadvantage that the length of the similar structure (132a) In spite of the formation of, the limit of inductance and capacitance is reduced.
근래에, 이러한 한계 상황을 극복하기 위하여, 도 3에 도시된 바와 같은 또 다른 타입의 테스트 소켓(141)이 개발되어 널리 보급되고 있다.In recent years, to overcome this limitation, another type of test socket 141 as shown in FIG. 3 has been developed and widely used.
이때, 또 다른 타입의 소켓(141)은 앞의 새로운 타입과 유사하게, 상·하부 하우징(142,143)과, 바렐(152),탄성 스프링(154)을 구비한 상태로, 상·하부 하우징(142,143)의 삽입홀(146)에 끼워져 고정되는 프로브-핀(150)의 조합으로 이루어지며, 이 프로브-핀(150)을 고정시키는 삽입홀(146) 역시, 앞의 경우와 유사하게, 소구경 삽입홀(144) 및 대구경 삽입홀(145)의 조합으로 이루어진다. 물론, 바렐(152)의 일부에는 앞의 경우와 유사하게, 상·하부 핀-플랜저 중의 어느 하나, 예컨대, 상부 핀-플랜저를 대체하는 유사 구조물(152a)이 자체 형성된다.At this time, another type of socket 141, similar to the new type of the previous, the upper and lower housings (142 and 143), the barrel 152, the elastic spring 154, with the upper and lower housings (142 and 143) It is made of a combination of the probe-pin 150 is inserted and fixed to the insertion hole 146 of the), the insertion hole 146 for fixing the probe-pin 150 also, similar to the previous case, small diameter insertion It consists of a combination of the hole 144 and the large-diameter insertion hole 145. Of course, similarly to the previous case, a part of the barrel 152 is formed with a similar structure 152a, which replaces any one of the upper and lower pin-plungers, for example, the upper pin-plunger.
그러나, 이러한 유사성과 달리, 새로운 타입의 테스트 소켓(141)에서, 바렐(152)의 일부에는 프로브-핀(150)의 고정을 가이드 하기 위한 고정 돌기(152b)가 양각으로 돌출·형성된다. 이러한 고정 돌기(152b)가 형성되는 경우, 프로브-핀(150)은 "바렐(152)의 단부가 아닌, 바렐(152)의 중간 부위가 소구경 삽입홀(144)의 병목부에 걸려 고정될 수 있도록 유도하는 구조"를 형성할 수 있기 때문에, 하우징(142,143)에 형성된 대구경 삽입홀(145)의 길이를 줄일 수 있게 되며, 결국, 자신의 전체적인 사이즈가 짧아지는 효과를 손쉽게 획득할 수 있게 된다.However, unlike this similarity, in the new type of test socket 141, a part of the barrel 152 is provided with a relief projection 152b for guiding the fixing of the probe-pin 150 in relief. When the fixing protrusion 152b is formed, the probe-pin 150 may not be fixed at the bottleneck portion of the small-diameter insertion hole 144 by the intermediate portion of the barrel 152, not at the end of the barrel 152. It is possible to form a structure to guide so that ", it is possible to reduce the length of the large-diameter insertion hole 145 formed in the housing (142,143), it is possible to easily obtain the effect of shortening its overall size .
물론, 프로브-핀(150)의 전체적인 사이즈가 짧아지는 경우, 해당 프로브-핀(150)이 나타내는 인덕턴스 및 캐패시턴스는 프로브-핀(150)의 사이즈 감소 폭 만큼, 작아질 수 있기 때문에, 테스트 소켓(141)은 그만큼 양호한 신호특성을 나타낼 수 있게 되며, 결국, 테스트 대상 반도체 디바이스(1)를 앞의 경우보다 좀더 정교하게 테스트할 수 있게 된다. Of course, when the overall size of the probe-pin 150 is shortened, the inductance and capacitance represented by the probe-pin 150 can be reduced by the size reduction width of the probe-pin 150, so that the test socket ( 141 may exhibit such a good signal characteristic, and as a result, it is possible to test the semiconductor device 1 under test more precisely than in the previous case.
그러나, 이러한 새로운 타입의 테스트 소켓은 "고정 돌기(152b)를 이용한다"는 상이점을 갖고 있기는 하지만, 기본적으로, "대구경 삽입홀(145)을 이동로로 하여, 고정 돌기(152b)를 소구경 삽입홀의 병목부에 걸어 고정시키는 구조"를 탈피하지 못하고 있기 때문에, 바렐(152)의 길이가 적어도, 하우징(142,143)의 대구경 삽입홀(145)의 길이에 대응되는 사이즈 만큼은 길어질 수밖에 없는 단점을 나타낼 수밖에 없으며, 결국, 고정 돌기(152b)의 형성에도 불구하고, 해당 프로브-핀(150)이 나타내는 인덕턴스 및 캐패시턴스의 값을 줄이는 데에 어느 정도의 한계를 보일 수밖에 없게 된다.However, although this new type of test socket has the difference of "using the fixed protrusion 152b", basically, the "large diameter insertion hole 145 is used as a moving path, and the fixed protrusion 152b is made into the small diameter. Since the structure to be fixed to the bottleneck of the insertion hole is not avoided, the barrel 152 may have a length that is at least as long as the size corresponding to the length of the large-diameter insertion hole 145 of the housings 142 and 143. Inevitably, despite the formation of the fixing protrusion 152b, there is no limit to reducing the value of the inductance and capacitance represented by the probe-pin 150.
한편, 종래의 반도체 테스트 설비를 운영하다 보면, "테스트 보드(2)의 수리, 테스트 보드(2)의 교체, 프로브-핀(110,130,150) 자체의 노후화‥‥" 등을 원인으로 하여, 기존의 프로브-핀을 새로운 프로브-핀으로 교체시켜야 하는 경우가 빈번하게 발생하게 된다.On the other hand, when operating a conventional semiconductor test facility, the existing probe is caused by the "repair of the test board 2, the replacement of the test board 2, the aging of the probe pins 110, 130, 150 itself", and the like. Frequently, the pins need to be replaced with new probe pins.
그런데, 앞서 언급한 바와 같이, 종래의 기술에 따른 각 타입의 바렐(113,132,152)은 상·하부 구조물이 일체로 결합된 일정 두께의 하우징에 밀착·삽입되어 있어, 그 착탈이 매우 힘들기 때문에, 종래의 구조 하에서, 각 프로브-핀(110,130,150)들을 제거하거나, 새로운 프로브-핀들을 끼우는 데에는 필요 이상의 많은 불편함이 따를 수밖에 없으며, 결국, 이러한 낙후된 조립조건 하에서, 반도체 생산업체에서는 전체적인 반도체 테스트 공정효율이 대폭 저하되는 문제점을 감수할 수밖에 없게 된다.However, as mentioned above, each type of barrels 113, 132, 152 according to the prior art is in close contact with and inserted into a housing having a predetermined thickness in which the upper and lower structures are integrally coupled, and thus the detachment is very difficult. Under the structure of, it is necessary to remove each probe-pin (110, 130, 150), or to insert a new probe-pin more than necessary inconvenience, after all, under these poor assembly conditions, semiconductor manufacturers, the overall semiconductor test process efficiency It is inevitable that this problem will be greatly reduced.
따라서, 본 발명의 목적은 핀-플랜저의 일부에 일련의 삽입 홈을 형성시켜, 탄성 스프링의 일부가 핀-플랜저의 내부에 선택적으로 삽입될 수 있도록 유도함과 아울러, 핀-플랜저를 수용하는 바렐의 일부에 음각으로 패인 고정 홈을 형성시켜, 바렐의 고정 구조가 대폭 개선될 수 있도록 유도함으로써, 프로브-핀의 전체적인 사이즈 최소화를 유도하는데 있다.Accordingly, it is an object of the present invention to form a series of insertion grooves in a portion of the pin-plunger, inducing a portion of the elastic spring to be selectively inserted into the inside of the pin-plunger, and at the same time It is to induce the minimization of the overall size of the probe-pin by forming a recessed groove recessed in a portion, leading to a significant improvement in the barrel fixed structure.
본 발명의 다른 목적은 프로브-핀의 전체적인 사이즈 최소화를 통해, 해당 프로브-핀이 나타내는 인덕턴스 및 캐패시턴스 감소를 유도하고, 이를 통해, 테스트 소켓의 신호특성이 대폭 향상될 수 있도록 함으로써, 테스트 대상 반도체 디바이스들의 필터링 신뢰성을 극대화하고, 이를 통해, 최종 출하되는 반도체 디바이스들의 품질향상을 도모하는데 있다.Another object of the present invention is to reduce the overall size of the probe-pin, to induce inductance and capacitance reduction that the probe-pin represents, thereby allowing the signal characteristics of the test socket to be significantly improved, thereby reducing the semiconductor device under test Maximize the filtering reliability of these devices, thereby improving the quality of semiconductor devices that are finally shipped.
본 발명의 또 다른 목적은 프로브-핀 고정용 하우징을 얇은 두께의 단독 구조물로 교체시키고, 이를 통해, 프로브-핀의 조립성 향상을 유도함으로써, 전체적인 반도체 디바이스 테스트 공정효율을 일정 수준 이상으로 향상시키는데 있다.It is still another object of the present invention to replace the probe-pin fixing housing with a thin-walled single structure, thereby inducing assembly of the probe-pin, thereby improving the overall semiconductor device test process efficiency to a certain level or more. have.
본 발명의 또 다른 목적들은 다음의 상세한 설명과 첨부된 도면으로부터 보다 명확해질 것이다.Still other objects of the present invention will become more apparent from the following detailed description and the accompanying drawings.
상기와 같은 목적을 달성하기 위하여 본 발명에서는 다수의 삽입홀을 구비한 상태에서, 테스트 대상 반도체 디바이스 및 테스트 보드 사이에 배치되는 박판(Thin plate)과, 이 박판의 삽입홀에 끼워져 고정되며, 테스트 대상 반도체 디바이스 및 테스트 보드를 상호 전기적으로 연결하는 프로브-핀들의 조합으로 이루어지는 반도체 디바이스 테스트 소켓을 개시한다.In order to achieve the above object, in the present invention, a plurality of insertion holes are provided, and a thin plate disposed between the test target semiconductor device and the test board is inserted into and fixed to the insertion hole of the thin plate, and the test A semiconductor device test socket comprising a combination of probe-pins electrically connecting a target semiconductor device and a test board to each other is disclosed.
이때, 앞의 각 프로브-핀들은 박판의 삽입홀에 끼워져 고정되며, 테스트 대상 반도체 디바이스와 전기적으로 접촉되는 통체 형상의 바렐과, 이 바렐 내부에 움직임이 가능하도록 고정된 상태에서, 일측 단부가 바렐의 외부로 노출되어, 테스트 보드와 전기적으로 접촉되며, 내부로 패인 삽입홈을 자체 구비한 핀-플랜저와, 바렐의 내부에 배치되며, 바렐 및 핀-플랜저를 물리적으로 연결하고, 일부가 핀-플랜저의 삽입홈에 삽입되는 탄성체의 조합으로 이루어진다. At this time, each of the preceding probe-pins is fitted into the insertion hole of the thin plate, and the barrel-shaped barrel which is in electrical contact with the semiconductor device under test, and the one end of the barrel is fixed to be movable in the barrel. Exposed to the outside of the circuit board, and electrically contacted with the test board, the pin-flange having its own internally recessed insertion groove, disposed inside the barrel, physically connecting the barrel and the pin-flange, and partially It consists of a combination of elastic bodies inserted into the insertion groove of the flanger.
이하, 첨부된 도면을 참조하여, 본 발명에 따른 반도체 디바이스 테스트 소켓을 좀더 상세히 설명하면 다음과 같다. Hereinafter, a semiconductor device test socket according to the present invention will be described in more detail with reference to the accompanying drawings.
도 4에 도시된 바와 같이, 본 발명에 따른 반도체 테스트 설비(200) 체제 하에서, 테스트 대상 반도체 디바이스(1), 예컨대, BGA 타입 반도체 디바이스는 본 발명의 요지를 이루는 테스트 소켓(210)을 매개로 테스트 보드(2)와 일련의 전기적인 연결관계를 형성하여, 자신에게 요구되는 반도체 테스트 공정을 수행 받게 된다.As shown in FIG. 4, under the semiconductor test facility 200 system according to the present invention, the semiconductor device 1 to be tested, for example, a BGA type semiconductor device, is connected to a test socket 210 that forms the gist of the present invention. By forming a series of electrical connections with the test board 2, the semiconductor test process required by the test board 2 is performed.
이때, 테스트 보드(2)는 해당 테스트 대상 반도체 디바이스(1)로 일련의 테스트 전압, 테스트 전류, 테스트 신호등을 공급함으로써, 해당 반도체 디바이스(1)가 그 불량유무에 따라, 정밀하게 필터링될 수 있도록 유도하는 역할을 수행하며, 본 발명의 테스트 소켓(210)은 테스트 대상 반도체 디바이스(1) 및 테스트 보드(2) 사이에 개재된 상태에서, 이들을 전기적으로 연결하는 역할을 수행한다.In this case, the test board 2 supplies a series of test voltages, test currents, test signals, etc. to the test target semiconductor device 1 so that the semiconductor device 1 can be accurately filtered according to whether there is a defect. The test socket 210 of the present invention serves to electrically connect them in a state interposed between the test target semiconductor device 1 and the test board 2.
여기서, 도면에 도시된 바와 같이, 본 발명에 따른 테스트 소켓(210)은 다수의 삽입홀(212)을 구비한 상태에서, 테스트 대상 반도체 디바이스(1) 및 테스트 보드(2) 사이에 배치되는 예컨대, 필름, 플라스틱 판 등의 박판(211)과, 이 박판(211)의 삽입홀(212)에 끼워져 고정되며, 테스트 대상 반도체 디바이스(1) 및 테스트 보드(2)를 상호 전기적으로 연결하는 프로브-핀(220)들의 조합으로 이루어진다.Here, as shown in the figure, the test socket 210 according to the present invention, for example, disposed between the test target semiconductor device 1 and the test board 2 with a plurality of insertion holes 212 Probes that are inserted into and fixed to a thin plate 211 such as a film, a plastic plate, and the insertion hole 212 of the thin plate 211, and electrically connect the test target semiconductor device 1 and the test board 2 to each other. It is made up of a combination of pins 220.
이때, 앞의 각 프로브-핀(220)들은 박판(211)의 삽입홀(212)에 끼워져 고정되며, 테스트 대상 반도체 디바이스(1)의 터미널(1a), 예컨대, 콘택볼과 전기적으로 접촉되는 통체 형상의 바렐(221)과, 이 바렐(221) 내부에 움직임이 가능하도록 고정된 상태에서, 일측 단부가 바렐(220)의 외부로 노출되어, 테스트 보드(2)의 콘택 패드(2a)와 전기적으로 접촉되는 핀-플랜저(222)와, 바렐(221)의 내부에 배치되며, 바렐(221) 및 핀-플랜저(222)를 물리적으로 연결하는 탄성체(223), 예컨대, 탄성 스프링의 조합으로 이루어진다.In this case, each of the probe-pins 220 is inserted into and fixed to the insertion hole 212 of the thin plate 211, and the cylinder is in electrical contact with the terminal 1a of the semiconductor device 1 to be tested, for example, a contact ball. In a state in which the barrel 221 and the barrel 221 are fixed to be movable in the barrel 221, one end portion of the barrel 221 is exposed to the outside of the barrel 220 so as to be electrically connected to the contact pad 2a of the test board 2. And a pin-plunger 222 contacted with a barrel and an elastic body 223 disposed in the barrel 221 and physically connecting the barrel 221 and the pin-flange 222, for example, a combination of elastic springs. .
여기서, 도면에 도시된 바와 같이, 본 발명의 체제 하에서, 핀-플랜저(222)의 일부에는 해당 핀-플랜저(222)의 내부로 패인 삽입홈(222a)이 자체 구비되며, 이 상태에서, 탄성체(223)의 일부는 핀-플랜저(222)의 삽입홈(222a)에 삽입된다.Here, as shown in the figure, under the regime of the present invention, a part of the pin-flange 222 is provided with an insertion groove 222a which is dug into the inside of the pin-flange 222 itself, in this state, the elastic body A portion of 223 is inserted into the insertion groove 222a of the pin-flange 222.
이처럼, 본 발명의 실시에 의해, 탄성체(223)의 일부가 핀-플랜저(222)의 삽입홈(222a)에 삽입되는 경우, 바렐(221) 및 핀-플랜저(222) 사이의 간격은 탄성체(223)가 삽입홈(222a)에 삽입된 만큼 짧아지게 되며, 그 영향으로, 핀-플랜저(222)를 수용한 바렐(221) 역시, 최소한의 사이즈를 유지할 수 있게 되고, 결국, 프로브-핀(220)들의 길이는 종래에 비해, 대폭 짧아지게 된다. 물론, 탄성체(223)의 일부가 삽입홈(222a)에 삽입·고정되더라도, 탄성체(223)의 실질적인 길이는 줄어들지 않기 때문에, 해당 탄성체(223)의 유효 탄성력은 아무런 영향을 받지 않는다.As such, when a part of the elastic body 223 is inserted into the insertion groove 222a of the pin-plunger 222 by the practice of the present invention, the distance between the barrel 221 and the pin-plunger 222 is an elastic body ( 223 is shortened as long as it is inserted into the insertion groove 222a. As a result, the barrel 221 accommodating the pin-plunger 222 can also maintain a minimum size. The length of the 220 is significantly shorter than in the prior art. Of course, even if a part of the elastic body 223 is inserted and fixed in the insertion groove 222a, since the substantial length of the elastic body 223 is not reduced, the effective elastic force of the elastic body 223 is not affected at all.
앞서 언급한 바와 같이, 테스트 소켓(210)의 신호특성은 프로브-핀(220)의 길이 증가에 민감한 영향을 받는다.As mentioned above, the signal characteristic of the test socket 210 is sensitive to the increase in the length of the probe-pin 220.
이러한 배경 하에서, 종래의 경우, 상·하부 핀-플랜저들은 적어도, 탄성 스프링의 길이 만큼은 그 간격이 벌어질 수밖에 없었으며, 이 여파로, 상·하부 핀-플랜저를 수용하는 바렐 역시, 그 길이가 길어질 수밖에 없었기 때문에, 결국, 해당 프로브-핀이 나타내는 인덕턴스 및 캐패시턴스는 이러한 사이즈 증가에 비례하여, 커질 수밖에 없었고, 그 결과, 종래의 테스트 소켓은 고속의 테스트 대상 반도체 디바이스를 정교하게 테스트할 수 없었다.Under this background, in the conventional case, the upper and lower pin-flanges had to be spaced at least as much as the length of the elastic spring, and in the aftermath, the barrels accommodating the upper and lower pin-plungers were also different. Inevitably, the inductance and capacitance exhibited by the probe-pin were inevitably large in proportion to the increase in size, and as a result, the conventional test socket was not able to precisely test the high-speed test semiconductor device.
그러나, 본 발명의 경우, 앞서 언급한 바와 같이, 바렐(221) 및 핀-플랜저(222)를 물리적으로 연결하는 탄성체(223)는 그 일부가 핀-플랜저(222)의 삽입홈(222a)에 삽입·고정되는 "핀 삽입형 구조"를 형성하기 때문에, 본 발명의 체제 하에서, 바렐(221) 및 핀-플랜저(222) 사이의 간격은 탄성체(223)가 삽입홈(222a)에 삽입된 만큼 짧아지게 되며, 그 영향으로, 핀-플랜저(222)를 수용한 바렐(221) 역시, 최소한의 사이즈를 유지할 수 있게 되고, 결국, 프로브-핀(220)들의 길이는 주어진 조건 내에서 최소화될 수 있게 된다.However, in the present invention, as mentioned above, the elastic body 223 which physically connects the barrel 221 and the pin-plunger 222 is part of the insertion groove 222a of the pin-flange 222. Because of the formation of the "pin insertion type structure" to be inserted and fixed, under the regime of the present invention, the distance between the barrel 221 and the pin-flange 222 is as short as the elastic body 223 is inserted into the insertion groove 222a. As a result, the barrel 221 containing the pin-flange 222 can also maintain a minimum size, so that the length of the probe-pins 220 can be minimized within a given condition. do.
이러한 본 발명의 실시에 따라, 프로브-핀(220)들의 길이가 최소화되는 경우, 해당 프로브-핀(220)들이 나타내는 인덕턴스 및 캐패시턴스는 이러한 사이즈 감소에 비례하여, 자연스럽게 줄어들게 되며, 결국, 테스트 대상 반도체 디바이스(1)의 필터링 신뢰성은 주어진 조건 내에서 극대화될 수 있게 된다.According to this embodiment of the present invention, when the length of the probe pins 220 is minimized, the inductance and capacitance represented by the probe pins 220 are naturally reduced in proportion to the size reduction, and thus, the semiconductor under test The filtering reliability of the device 1 can be maximized within a given condition.
한편, 도면에 도시된 바와 같이, 본 발명의 체제 하에서, 바렐(221)의 일부, 예컨대, 테스트 대상 반도체 디바이스(1)의 터미널(1a)과 접촉되는 바렐(221)의 접촉면에는 종래의 특정 구조물, 예컨대, 상부 핀-플랜저를 대체하면서, 테스트 대상 반도체 디바이스(1)와의 접촉 신뢰성 향상을 위한 접촉 경사면(221a)이 더 형성된다.On the other hand, as shown in the figure, under the framework of the present invention, a part of the barrel 221, for example, the contact surface of the barrel 221 in contact with the terminal 1a of the semiconductor device 1 to be tested, the specific structure of the prior art For example, a contact inclined surface 221a is further formed to improve contact reliability with the semiconductor device 1 under test, while replacing the upper pin-plunger.
이러한 접촉 경사면이 더 형성되는 경우, 프로브-핀(220)은 단지, 바렐(221)의 일부, 예컨대, 바렐(221)의 하부 쪽에만 일련의 핀-플랜저(222)를 단독 구비한 상태에서도, 정상적인 수준의 반도체 디바이스 테스트 과정을 진행시킬 수 있게 되며, 결국, 자신의 전체적인 사이즈가 짧아지는 효과를 손쉽게 획득할 수 있게 된다.When such a contact inclined surface is further formed, even when the probe-pin 220 is provided with a series of pin-flanges 222 only on a part of the barrel 221, for example, the lower side of the barrel 221, You will be able to proceed with the testing process for semiconductor devices at a normal level, which will make it easier to achieve the effect of shortening your overall size.
이처럼, 본 발명의 실시에 의해, 프로브-핀(220)의 전체적인 사이즈가 짧아지는 경우, 해당 프로브-핀(220)이 나타내는 인덕턴스 및 캐패시턴스는 프로브-핀의 사이즈 감소 폭 만큼, 작아질 수 있기 때문에, 테스트 소켓(210)은 그만큼 양호한 신호특성을 나타낼 수 있게 되며, 결국, 테스트 대상 반도체 디바이스(1)를 좀더 정교하게 테스트할 수 있게 된다.As such, when the overall size of the probe-pin 220 is shortened by the practice of the present invention, the inductance and capacitance represented by the probe-pin 220 may be reduced by the size reduction width of the probe-pin. As a result, the test socket 210 may exhibit such a good signal characteristic, and as a result, the test target semiconductor device 1 may be more precisely tested.
이때, 도면에 도시된 바와 같이, 바렐(221)의 일부에는 잘록하게 음각된 상태로, 박판(211)과 밀착되어, 프로브-핀(220)을 고정하는 음각 고정홈(221b)이 더 형성된다. 이 경우, 음각 고정홈(221b)은 바렐(221)이 박판(211)의 삽입홀(212)에 실장될 때, 박판(211)의 접합 레이어와 맞닿아, 박판(211)의 상·하부면에 밀착됨으로써, 프로브-핀(220)의 고정 신뢰성을 향상시키는 역할을 수행하게 되며, 결국, 이러한 음각 고정홈(221b)의 작용으로 인해, 프로브-핀(220)은 외부에서 충격이 가해지더라도, 박판(211)으로부터 쉽게 탈거 되지 않게 된다.At this time, as shown in the figure, a portion of the barrel 221 is in a concave engraved state, in close contact with the thin plate 211, the intaglio fixing groove 221b for fixing the probe-pin 220 is further formed. . In this case, the intaglio fixing groove 221b is in contact with the bonding layer of the thin plate 211 when the barrel 221 is mounted in the insertion hole 212 of the thin plate 211, so that the upper and lower surfaces of the thin plate 211. By being in close contact with, the probe-pin 220 plays a role of improving the reliability, and eventually, due to the action of the intaglio fixing groove 221b, even if the probe-pin 220 is impacted from the outside, It is not easily removed from the thin plate 211.
앞서 언급한 바와 같이, 종래의 경우에도, "바렐의 일부에 상·하부 핀-플랜저 중의 어느 하나를 대체할 수 있는 유사 구조물을 형성하고, 이를 통해, 프로프-핀의 사이즈 감소를 유도하는 기술"이 제시되어 있었다.As mentioned above, even in the conventional case, "a technique for forming a similar structure that can replace any one of the upper and lower pin-flanges in a part of the barrel, thereby inducing a size reduction of the prop-pin "Was presented.
그러나, 종래의 테스트 소켓은 기본적으로, "하우징의 대구경 삽입홀을 이동로로 하여, 바렐을 소구경 삽입홀의 병목부에 걸어 고정시키는 구조"를 탈피하지 못하였기 때문에, "바렐의 길이"가 적어도, 하우징의 대구경 삽입홀의 길이에 대응되는 사이즈 만큼은 길어질 수밖에 없는 단점을 나타낼 수밖에 없었으며, 결국, 반도체 생산업체에서는 유사 구조물의 형성에도 불구하고, 해당 프로브-핀이 나타내는 인덕턴스 및 캐패시턴스의 값을 줄이는 데에 어느 정도의 한계를 감수할 수밖에 없었다.However, the conventional test socket basically failed to escape the "structure for fixing the barrel to the bottleneck of the small-diameter insertion hole by using the large-diameter insertion hole of the housing as a moving path". In addition, the size corresponding to the length of the large-diameter insertion hole of the housing was inevitably lengthened. Therefore, semiconductor manufacturers, in spite of the formation of similar structures, have been used to reduce the inductance and capacitance values of the probe-pins. I had to accept some limitations.
그러나, 본 발명에서는 이러한 사안을 미리 감안하여, 상술한 바와 같이, 바렐(221)의 일부에 음각 고정홈(221b)을 더 형성시키고, 이를 통해, 프로브-핀(220)의 고정 구조가 "바렐(221) 자체적인 작용에 의해 박판(211)에 걸려 고정되는 구조"로 변경될 수 있도록 유도함으로써, 바렐(221) 및 다른 구조물, 예컨대, 하우징과의 관계에 따른 해당 바렐(221)의 불필요한 길이 증가를 미리 차단시키고, 이를 통해, 프로브-핀(220)이 최소의 인덕턴스 및 캐패시턴스의 값을 나타낼 수 있도록 가이드 함으로써, 상술한 접촉 경사면(221a)의 활용도가 별다른 장애물 없이, 최적화될 수 있도록 유도할 수 있게 된다.However, in the present invention, in consideration of such a problem in advance, as described above, the intaglio fixing groove 221b is further formed in a part of the barrel 221, and through this, the fixing structure of the probe-pin 220 is "barrel. (221) by inducing them to be changed to a "structure fixed to the thin plate 211 by its own action, so that the unnecessary length of the barrel 221 according to the relationship with the barrel 221 and other structures, for example, the housing By blocking the increase in advance and thereby guiding the probe-pin 220 to exhibit the minimum value of inductance and capacitance, it is possible to induce the utilization of the above-described contact slope 221a to be optimized without any obstacles. It becomes possible.
한편, 앞의 언급에서와 같이, 본 발명의 체제 하에서, 바렐(221)은 박판(211)의 삽입홀(212)에 끼워져 고정되는 구조를 형성한다. 이는 종래의 체제 하에서, 바렐이 상·하부 구조물이 일체로 결합된 일정 두께의 하우징에 밀착·삽입되어 있던 것과 비교할 때, 매우 상이한 구조라 할 수 있다.On the other hand, as mentioned in the foregoing, under the system of the present invention, the barrel 221 forms a structure that is fitted and fixed to the insertion hole 212 of the thin plate 211. This can be said to be a very different structure when compared with the conventional system in which the barrel is tightly inserted and inserted into a housing having a predetermined thickness in which the upper and lower structures are integrally coupled.
상술한 바와 같이, 반도체 테스트 설비를 운영하다 보면, "테스트 보드의 수리, 테스트 보드의 교체, 프로브-핀 자체의 노후화‥‥" 등을 원인으로 하여, 기존의 프로브-핀을 새로운 프로브-핀으로 교체시켜야 하는 경우가 빈번하게 발생하게 된다.As described above, when operating a semiconductor test facility, an existing probe pin may be replaced with a new probe pin due to "repair of the test board, replacement of the test board, deterioration of the probe pin itself." Frequent replacements will occur.
이러한 환경에서, 종래의 경우, 바렐은 상·하부 구조물이 일체로 결합된 일정 두께의 하우징에 밀착·삽입되어 있었기 때문에, 그 착탈이 매우 힘들었으며, 결국, 종래의 구조 하에서, 각 프로브-핀들을 제거하거나, 새로운 프로브-핀들을 끼우는 데에는 필요 이상의 많은 불편함이 따를 수밖에 없었고, 이러한 낙후된 조립조건 하에서, 반도체 생산업체에서는 전체적인 반도체 테스트 공정효율이 대폭 저하되는 문제점을 감수할 수밖에 없었다.In this environment, in the conventional case, since the barrel was intimately inserted and inserted into a housing of a certain thickness in which the upper and lower structures were integrally coupled, the detachment was very difficult. Consequently, under the conventional structure, each probe-pin Removing or inserting new probe-pins was more than necessary, and under these poor assembly conditions, semiconductor manufacturers were forced to suffer from a significant drop in overall semiconductor test process efficiency.
그러나, 본 발명의 경우, 앞서 언급한 바와 같이, 바렐(221)은 예컨대, 필름, 플라스틱 판 등과 같이 얇은 두께를 갖는 박판(211)의 삽입홀(212)에 끼워져 고정되는 구조를 형성하기 때문에, 그 착탈이 매우 용이해지게 되며, 결국, 본 발명의 구조 하에서, 새로운 프로브-핀들을 갈아 끼우는 데에는 큰 노력이 별로 필요 없게 되고, 이러한 향상된 조립 조건 하에서, 반도체 생산업체에서는 전체적인 반도체 테스트 공정효율이 일정 수준 이상으로 향상되는 이점을 손쉽게 획득할 수 있게 된다.However, in the case of the present invention, as mentioned above, since the barrel 221 forms a structure that is fitted into the fixing hole 212 of the thin plate 211 having a thin thickness, such as a film, a plastic plate, etc., The attachment and detachment becomes very easy, and, consequently, under the structure of the present invention, much effort is not required to replace new probe-pins, and under such improved assembly conditions, the overall semiconductor test process efficiency is constant in the semiconductor manufacturer. Benefits that go beyond the level can be easily obtained.
이러한 본 발명의 구조 하에서, 상술한 테스트 대상 반도체 디바이스(1)가 외력에 의해 테스트 보드(2)쪽으로 하강하여, 해당 반도체 디바이스의 터미널(1a)이 바렐(221)의 오픈홀로 유입되고, 이를 통해, 탄성체(223)가 가압되면, 해당 탄성체(223)는 그 힘에 의해 테스트 보드(2)측으로 강하게 압축됨으로써, 테스트 대상 반도체 디바이스(1) 및 테스트 보드(2)를 연결하는 일련의 통전로를 형성하게 된다. 이러한 통전 상황에서, 테스트 보드(2)는 테스트 대상 반도체 디바이스(1)측으로, 일련의 테스트 전압, 테스트 전류, 테스트 신호 등을 공급하게 되며, 결국, 해당 반도체 디바이스(1)는 그 불량유무에 따라, 정밀하게 필터링될 수 있게 된다.Under the structure of the present invention, the above-described semiconductor device 1 to be tested is lowered toward the test board 2 by an external force, so that the terminal 1a of the semiconductor device flows into the open hole of the barrel 221, thereby When the elastic body 223 is pressurized, the elastic body 223 is strongly compressed to the test board 2 side by the force, thereby connecting a series of conducting paths connecting the semiconductor device 1 and the test board 2 to be tested. To form. In this energized situation, the test board 2 supplies a series of test voltages, test currents, test signals, etc. to the semiconductor device 1 to be tested, and eventually, the semiconductor device 1 depends on whether there is a defect. This can be filtered precisely.
이러한 본 발명은 생산업체의 상항에 따라, 다양한 형태로 변형·실시될 수 있다.The present invention can be modified and implemented in various forms according to the circumstances of the producer.
예를 들어, 본 발명에서는 도 5에 도시된 바와 같이, 삽입홈(222a)을 핀-플랜저(222)의 종단까지 연장· 형성하고, 이 상태에서, 탄성체(223)의 일부를 핀-플랜저(222)의 삽입홈(222a)에 앞의 실시예 보다 좀더 깊게 삽입시킬 수도 있다. 이 경우, 바렐(221) 및 핀-플랜저(222) 사이의 간격은 앞의 실시예 보다 더욱 짧아지게 되며, 그 영향으로, 핀-플랜저(222)를 수용한 바렐(221) 역시, 앞의 실시예 보다 더욱 컴팩트한 사이즈를 유지할 수 있게 되고, 결국, 프로브-핀(220)들의 길이는 앞의 실시예에 비해, 대폭 짧아질 수 있게 된다.For example, in the present invention, as shown in FIG. 5, the insertion groove 222a extends and is formed to the end of the pin-plunger 222, and in this state, a part of the elastic body 223 is formed in the pin-plunger ( The insertion groove 222a of the 222 may be inserted deeper than the previous embodiment. In this case, the spacing between the barrel 221 and the pin-flange 222 becomes shorter than the previous embodiment, and, as a result, the barrel 221 which accommodates the pin-flunger 222 also implements the foregoing. It is possible to maintain a more compact size than the example, and eventually, the length of the probe-pins 220 can be significantly shorter than in the previous embodiment.
이상에서 상세히 설명한 바와 같이, 본 발명에서는 핀-플랜저의 일부에 일련의 삽입 홈을 형성시켜, 탄성 스프링의 일부가 핀-플랜저의 내부에 선택적으로 삽입될 수 있도록 유도함과 아울러, 핀-플랜저를 수용하는 바렐의 일부에 음각으로 패인 고정 홈을 형성시켜, 바렐의 고정 구조가 대폭 개선될 수 있도록 유도하고, 이를 통해, 프로브-핀의 전체적인 사이즈 최소화를 유도한다. 또한, 본 발명에서는 프로브-핀 고정용 하우징을 얇은 두께의 단독 구조물로 교체시키고, 이를 통해, 프로브-핀의 조립성 향상을 유도한다.As described in detail above, in the present invention, a series of insertion grooves are formed in a part of the pin-plunger, thereby inducing a part of the elastic spring to be selectively inserted into the pin-plunger, and accommodating the pin-plunger. By forming a recessed groove recessed engraved in a portion of the barrel to induce a significant improvement in the structure of the barrel, thereby inducing the minimization of the overall size of the probe-pin. In addition, in the present invention, the probe-pin fixing housing is replaced with a thin-walled single structure, thereby inducing assembly of the probe-pin.
이러한 본 발명의 실시에 따라, 프로브-핀의 전체적인 사이즈가 최소화되고, 이를 통해, 해당 프로브-핀이 나타내는 인덕턴스 및 캐패시턴스가 크게 감소되는 경우, 테스트 소켓의 신호특성은 대폭 향상될 수 있게 되며, 결국, 테스트 대상 반도체 디바이스들의 필터링 신뢰성 극대화를 통해, 최종 출하되는 반도체 제품들은 일정 수준 이상의 품질을 유지할 수 있게 된다. According to the implementation of the present invention, the overall size of the probe pin is minimized, whereby the signal characteristics of the test socket can be greatly improved when the inductance and capacitance represented by the probe pin are greatly reduced, and eventually By maximizing the filtering reliability of the semiconductor devices under test, the final shipped semiconductor products can maintain a certain level of quality.
또한, 본 발명의 실시에 따라, 일련의 향상된 조립 조건이 구현되는 경우, 반도체 생산업체에서는 전체적인 반도체 테스트 공정효율이 일정 수준 이상으로 향상되는 이점을 손쉽게 획득할 수 있게 된다.In addition, according to the practice of the present invention, when a series of improved assembly conditions are implemented, semiconductor manufacturers can easily obtain the advantage that the overall semiconductor test process efficiency is improved to a certain level or more.
이러한 본 발명은 테스트 소켓을 필요로 하는 다양한 기종의 반도체 테스트 설비에서 전반적으로 유용한 효과를 나타낸다.The present invention has an overall useful effect in various types of semiconductor test equipment requiring a test socket.
그리고, 앞에서, 본 발명의 특정한 실시예가 설명되고 도시되었지만 본 발명이 당업자에 의해 다양하게 변형되어 실시될 가능성이 있는 것은 자명한 일이다.And, in the foregoing, specific embodiments of the present invention have been described and illustrated, but it is obvious that the present invention may be variously modified and implemented by those skilled in the art.
이와 같은 변형된 실시예들은 본 발명의 기술적사상이나 관점으로부터 개별적으로 이해되어서는 안되며 이와 같은 변형된 실시예들은 본 발명의 첨부된 특허청구의 범위안에 속한다 해야 할 것이다. Such modified embodiments should not be understood individually from the technical spirit or point of view of the present invention and such modified embodiments should fall within the scope of the appended claims of the present invention.
도 1 내지 도 3은 종래의 기술에 따른 반도체 디바이스 테스트 소켓을 개념적으로 도시한 예시도.1 to 3 conceptually illustrate a semiconductor device test socket according to the prior art;
도 4는 본 발명의 일실시예에 따른 반도체 디바이스 테스트 소켓을 개념적으로 도시한 예시도.4 conceptually illustrates a semiconductor device test socket according to an embodiment of the present invention;
도 5는 본 발명의 다른 실시예에 따른 반도체 디바이스 테스트 소켓을 개념적으로 도시한 예시도. 5 is an exemplary diagram conceptually illustrating a semiconductor device test socket according to another exemplary embodiment of the present disclosure.
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