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KR100282936B1 - 디스크 구동장치에 있어서 신호처리를 위한 데이타 검출레벨 조정회로 - Google Patents

디스크 구동장치에 있어서 신호처리를 위한 데이타 검출레벨 조정회로 Download PDF

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KR100282936B1
KR100282936B1 KR1019940036630A KR19940036630A KR100282936B1 KR 100282936 B1 KR100282936 B1 KR 100282936B1 KR 1019940036630 A KR1019940036630 A KR 1019940036630A KR 19940036630 A KR19940036630 A KR 19940036630A KR 100282936 B1 KR100282936 B1 KR 100282936B1
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KR
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voltage
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윤종윤
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윤종용
삼성전자주식회사
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Abstract

1. 청구범위에 기재된 발명이 속한 기술분야
디스크 구동장치에 있어서 자기디스크상으로부터 픽업한 신호로부터 데이타를 검출하는데 이용되는 검출레벨을 가변적으로 조정하는 회로에 관한 것이다.
2. 발명이 해결하고자 하는 기술적 과제
자기 디스크상의 구간에 따라 적응적으로 데이타 검출레벨을 가변 조정하여 데이타 에러를 방지한다.
3. 발명의 해결방법의 요지
자기디스크상으로부터 리드되는 아나로그 리드신호의 레벨에 대응하여 변화하는 레벨의 동적 검출레벨전압과 미리 설정된 일정 레벨의 고정 검출레벨전압을 발생하고, 아나로그 리드신호로부터 검출된 데이타로부터 자기디스크상의 현재 헤드가 위치한 구간을 검출하고, 검출된 구간에 대응하여 동적 검출레벨과 고정 검출레벨중 하나를 데이타 검출레벨로서 선택한다.
4. 발명의 중요한 용도
하드 디스크 드라이브, 플로피 디스크 드라이브등과 같은 디스크 구동장치에 있어서 자기디스크상에 기록되어 있는 데이타를 리드하는데 이용된다.

Description

디스크 구동장치에 있어서 신호처리를 위한 데이타 검출레벨 조정회로
제1도는 통상적인 펄스검출기의 블럭구성도.
제2도는 제1도의 동작타이밍도.
제3도는 본 발명에 따른 데이타 검출레벨 조정회로의 일실시예의 블럭구성도.
제4도는 본 발명에 따른 제3도의 상세회로도.
제5도는 본 발명에 따른 제3도 및 제4도의 동작타이밍도.
제6도는 본 발명에 따른 데이타 검출레벨 조정회로의 다른 실시예의 블럭구성도.
〈도면의 주요부분에 대한 부호의 설명〉
28 : 펄스 검출기 30 : 동적 검출레벨 발생회로
32 : 고정 검출레벨 발생회로 34 : 아나로그 스위치
36 : 구간 검출회로 38 : 섹터 어드레스마크 검출회로
40,46 : 플립플롭 42,48 : 카운터
44,50 : 비교기 R1-R4 : 저항
본 발명은 디스크 구동장치에 있어서 자기디스크상으로부터 픽업한 신호로부터 데이타를 검출하는 회로에 관한 것으로, 특히 데이타를 검출하는데 이용되는 검출레벨을 가변적으로 조정하는 회로에 관한 것이다.
일반적으로 하드 디스크 드라이브, 플로피 디스크 드라이브등의 디스크 구동장치는 컴퓨터시스템의 보조기억장치로 널리 사용되고 있다. 이러한 디스크 구동장치는 자기디스크상에 기록되어 있는 데이타를 리드할때 헤드에 의해 디스크상으로부터 픽업(pickup)된 아나로그 리드신호의 진폭 피크(peak)에 따른 데이타펄스를 검출한다. 아나로그 리드신호의 진폭 피크들은 각각 기록된 데이타에 대응하며, 검출된 데이타펄스는 기록시에 부호화된 데이타에 해당한다.
이와같이 데이타펄스를 검출하기 위한 펄스검출기는 통상적으로 미합중국 National Semiconductor사의 디스크 펄스검출기 "DP8464"와 같은 원칩(one chip)화된 집적회로가 사용된다.
제1도는 상기 디스크 펄스검출기 "DP8464"의 구성을 보인 블럭구성도이다. 제1도를 참조하여 본 발명을 이해하는데 유용한 일반적인 데이타 검출 동작을 제2도의 동작타이밍도를 참조하여 설명한다. 헤드(도시하지 않았음)에 의해 디스크상으로부터 픽업된 아나로그 리드신호는 이득제어증폭기(10)에서 이득제어증폭된후, 필터(12)를 거쳐 미분기(18)와 히스테리시스 차동비교기(22) 및 정류회로(14)에 동시에 인가된다. 이때 필터(12)의 출력 파형은 제2도(a)와 같이 나타난다. 정류회로(14)는 필터(12)의 출력 신호를 전파정류함으로써 신호의 전압레벨을 검출하여 자동이득제어회로(16)에 인가한다. 자동이득제어회로(16)는 정류회로(14)에서 검출한 전압레벨에 대응하여 이득제어증폭기(10)의 이득을 적절하게 제어한다. 미분기(18)는 필터(12)에서 출력되는 신호를 미분함으로써 신호의 진폭 피크를 검출한다. 양방향 단안정 멀티바이브레이터(20)는 미분기(18)에서 검출된 진폭 피크에 응답하여 제2도(b)와 같은 파형의 타임펄스를 출력한다. 이때 미분기(18)는 기준전압레벨 EREF상의 잡음에도 응답함으로써 제2도(b)와 같은 잡음펄스 Pn을 발생한다. 이 잡음펄스 Pn은 결과적으로 오(false)데이타로 나타나게 되는데, 이러한 오데이타를 방지하고 실제의 진폭 피크만을 데이타로 검출하기 위해 히스테리시스 차동비교기(22)를 사용한다. 히스테리시스 차동비교기(22)는 필터(12)의 출력신호를 미리 설정된 데이타 검출레벨과 히스테리시스비교를 한다. 이때 데이타 검출레벨은 별도의 검출레벨 설정회로(도시하지 않았음)에 의해 설정되는 전압레벨로서 히스테리시스 차동비교기(22)의 히스테리시스 레벨 SETHYS이 된다. 히스테리시스 레벨 SETHYS을 기준 전압레벨 EREF에 대하여 도시하면 제2도(a)에서의 EH및 EL이 된다. 이에따라 히스테리시스 차동비교기(22)는 필터(12)의 출력신호의 변화에 대응하여 제2도(c)와 같은 파형의 신호를 출력한다. 플립플롭(24)은 양방향 단안정 멀티바이브레이터(20)에서 출력되는 타임펄스의 상승엣지(rising edge)에서마다 히스테리시스 차동비교기(22)의 출력신호를 래치함으로써 제2도(d)와 같은 파형의 신호를 출력한다. 그러면 양방향 단안정 멀티바이브레이터(26)는 플립플롭(24)에서 출력되는 신호의 상승엣지 및 하강엣지(falling edge)에서마다 트리거됨으로써 제2도(e)와 같은 펄스신호를 발생한다. 제2도(e)의 펄스신호를 제2도(a)의 신호와 비교해 보면 실제의 진폭 피크만이 검출된 것을 알 수 있다. 그러므로 양방향 단안정 멀티바이브레이터(26)에서 발생되는 펄스신호는 기록시 부호화된 데이타 ERD로서 출력된다.
한편 자기디스크상의 동일한 트랙에서도 리드되는 신호의 진폭은 일정치 않고 특정 구간마다 서로 다르다. 이를 보다 상세히 살명하면 다음과 같다.
통상적으로 서보위치정보를 제공하기 위한 방식의 하나로서 널리 사용되는 엠베디드(embeded) 섹터서보방식에 있어 자기디스크상에 서보정보구간과 데이타정보구간이 하나의 트랙에서 원주방향으로 교호적으로 배치된다. 서보정보구간은 헤드의 위치정보를 기록하는 구간으로 트랙위치정보, 트랙 어드레스, 인덱스정보, 탐색(seek)정보등을 포함하며, 데이타정보구간은 실제의 데이타정보가 기록되는 구간이다. 또한 서보정보구간에는 섹터들을 구분하기 위한 서보정보의 하나로서 섹터 어드레스마크(sector address mark)가 기록되는데, 섹터 어드레스마크는 예를들어 DC갭(Direct Current gap) 형태로 기록된다.
일반적으로 데이타정보구간은 트랙과 트랙 사이에 보호대(guard band)가 존재하는데, 이는 각 트랙의 데이타정보가 서로 간섭을 일으키게 되는 것을 방지하기 위한 것이다. 그러나 서보정보구간에 기록되는 서보정보는 트랙 사이에 보호대가 없이 그대로 연결된다. 이는 트랙 탐색시 탐색정보를 리드하기 위해 보호대를 두지 않는 것으로, 만일 탐색중에 헤드가 보호대를 지남으로써 정보를 리드하지 못하게 되는 구간이 발생하는 것을 방지하기 위함이다. 이에 반하여 데이타정보구간의 경우에는 보호대를 두지 않으면, 약간의 오프-트랙이 있어도 인접한 트랙에 기록되어 있는 정보에 의해 간섭을 받게 되어 신호의 왜곡이 발생하게 된다.
이에따라 헤드가 자기디스크상에 기록되어 있는 정보를 리드할때 서보정보는 트랙상에 빈 곳이 없이 넓게 퍼져 자화되어 있는 것과 대조적으로 데이타정보는 보호대를 제외한 부분에 좁게 자화되어 있으므로 헤드에 의해 픽업되는 신호의 진폭이 서보정보구간과 데이타정보구간에서 서로 다르게 된다.
그리고 데이타정보구간과 서보정보구간에 기록되는 정보의 주파수는 서로 다르다. 이에 따라 헤드에 의해 픽업되는 신호의 진폭이 서보정보구간과 데이타정보구간에서 서로 달라진다.
따라서 데이타 검출레벨도 서보정보구간과 데이타정보구간에서 서로 다르게 설정할 필요가 있다.
한편 헤드에 의해 픽업되는 신호는 실제적으로 신호의 간섭, 충격, 잡음등 운용환경에 의해 변형된다. 특히 디스크의 용량이 커질수록 디스크상의 기록 정보가 고밀도화되고 트랙수가 많아짐에 따라 신호의 변형은 더욱 심화된다. 또한 헤드가 자기디스크상으로부터 부상되는 높이가 자기디스크상의 내외주에서 일정치 못함으로써 픽업되는 신호의 진폭이 달라진다. 이에따라 데이타 검출레벨을 부적절하게 설정하면 데이타 에러가 발생된다. 즉, 데이타 검출레벨을 너무 낮게 설정하면 잡음이 데이타로서 검출되는 경우가 발생하며, 이와 반대로 데이타 검출레벨을 너무 높게 설정하면 데이타가 유실된다.
또한편 자기디스크상으로부터 리드되는 신호의 진폭은 자기디스크상의 내주 즉, 안쪽의 트랙과 외주 즉, 바깥쪽의 트랙에서 서로 다르다. 이는 자기 디스크상의 정보 기록밀도가 다르기 때문이다. 일반적으로 내주 트랙의 기록밀도가 외주 트랙의 기록밀도보다 높음으로써 내주 트랙에서 픽업되는 신호는 동일 트랙상의 인접한 비트의 신호에 의해 간섭됨으로써 진폭이 외주 트랙의 신호에 비해 낮아진다.
상기와 같은 신호의 변형을 고려하여 데이타 검출레벨을 적절한 값으로 설정하기 위한 기술들이 제안되어 왔다.
이러한 기술의 하나로서 본원 출원인에 의해 선출원된 대한민국 특허출원 제92-22634호가 있다. 상기 특허출원 제92-22634호는 전원이 온될때마다 데이타 검출레벨은 초기값부터 감소 및 증가시켜가면서 리드시험을 하에 데이타 에러가 발생하지 않는 한도내에서의 최대레벨값과 최소레벨값을 결정하고, 결정된 최대레벨값과 최소레벨값을 평균하여 데이타 검출레벨을 설정한다. 이때 서보정보구간과 데이타 정보구간에 대한 데이타 검출레벨을 서로 다르게 조정한다. 이에따라 자기디스크상의 구간과 운용환경에 적응적으로 데이타 검출레벨을 조정하게 됨으로써 데이타 에러를 방지한다.
그러나 상기 특허출원 제92-22634호는 일단 데이타 검출레벨을 설정한후, 디스크상으로부터 픽업되는 아나로그 리드신호의 레벨이 일시적으로 변동될 경우 여전히 데이타 에러가 발생하는 문제점이 있었다. 또한 자기디스크상의 내외주에 대하여 구분없이 동일한 데이타 검출레벨을 가짐으로써 여전히 데이타 에러가 발생하는 문제점이 있었다.
따라서 본 발명의 목적은 자기 디스크상의 각 구간과 운용환경에 따라 적응적으로 데이타 검출레벨을 가변 조정하여 데이타 에러를 방지할 수 있는 데이타 검출레벨 조정회로를 제공함에 있다.
본 발명의 다른 목적은 자기 디스크상의 내외주와 운용환경에 따라 적응적으로 데이타 검출레벨을 가변 조정하여 데이타 에러를 방지할 수 있는 데이타 검출레벨 조정회로를 제공함에 있다.
이하 본 발명의 바람직한 실시예를 첨부한 도면을 참조하여 상세히 설명한다. 하기 설명에서 구체적인 회로구성, 주파수, 비트수등 많은 특정 상세들이 본 발명의 보다 전반적인 이해를 제공하기 위해 나타나 있다. 이들 특정 상세들 없이 본 발명이 실시될 수 있다는 것은 이 기술분야에서 통상의 지식을 가진자에게 자명할 것이다. 그리고 본 발명의 요지를 불필요하게 흐릴 수 있는 공지 기능 및 구성에 대한 상세한 설명은 생략한다.
제3도는 본 발명에 따른 데이타 검출레벨 조정회로의 일실시예의 블럭구성을 보인 것이다. 제3도에서 참조부호 28은 전술한 제1도의 펄스검출기를 보인 것으로, 자기디스크상으로부터 리드되는 아나로그 리드신호의 진폭 피크를 검출하고, 아나로그 리드신호를 미리 설정된 데이타 검출레벨 SETHYS와 비교한 결과에 의해 진폭피크중 실제 데이타에 해당하는 진폭 피크만을 부호화 데이타 ERD로 검출한다. 동적 검출레벨 발생회로(30)는 펄스검출기(28)의 정류회로(14)의 출력단에 접속되며 아나로그 리드신호의 레벨에 대응하여 변화하는 레벨을 가지는 동적 검출레벨전압을 정류회로(14)의 출력 전압 Vrec으로부터 발생한다. 고정 검출레벨 발생회로(32)는 미리 설정된 일정 레벨을 가지는 고정 검출레벨전압을 발생한다. 구간 검출회로(36)는 부호화 데이타 ERD로부터 자기디스크상의 현재 헤드가 위치한 구간을 검출하여 서보정보구간과 데이타정보구간을 구별해 낸다. 아나로그 스위치(34)는 구간검출회로(36)에 의해 검출된 구간에 대응하여 동적 검출레벨 발생회로(30)와 고정검출레벨 발생회로(32)의 출력중 하나를 선택하여 데이타 검출레벨 SETHYS로서 펄스검출기(28)의 히스테리시스 비교기(22)에 제공한다. 이때 만일 구간검출회로(36)에서 현재의 구간이 서보정보구간으로 검출된 경우에는 고정 검출레벨전압을 데이타 검출레벨 SETHYS로 선택하고, 데이타정보구간으로 검출될 경우에는 동적 검출레벨전압을 데이타 검출레벨 SETHYS로 선택한다.
제4도는 본 발명에 따른 제3도의 데이타 검출레벨 조정회로의 상세회로도를 보인 것으로, 펄스검출기(28)는 생략한 것이다.
동적 검출레벨 발생회로(30)는 정류회로(14)의 출력 전압 Vrec를 일정 분압하여 동적 검출레벨전압으로서 출력하는 저항(R1, R2)으로 구성한다. 이에따라 동적 검출레벨전압은 정류회로(14)의 출력 레벨에 대응하여 변화하는 레벨을 가진다.
고정 검출레벨 발생회로(32)는 전압 Vcc를 일정 분압하여 고정 검출레벨전압을 출력하는 저항(R3, R4)으로 구성한다. 이에따라 고정 검출레벨전압은 항상 일정레벨을 가진다.
구간검출회로(36)는 섹터어드레스마크 검출회로(38)와 플립플롭(40, 46)과 카운터(42, 48)와 비교기(44, 50)로 구성한다. 섹터 어드레스마크 검출회로(38)는 펄스 검출기(28)에 의해 검출된 부호화된 데이타 ERD로부터 섹터 어드레스마크를 검출하는 회로로서, 섹터 어드레스마크를 검출할때마다 논리 "하이"의 펄스를 섹터 어드레스마크 검출신호로서 발생한다. 이에따라 섹터 어드레스마크 검출신호에 의해 매 섹터의 시작을 알 수 있게 된다. 자기디스크로부터 리드된 부호화된 데이타 ERD로부터 섹터 어드레스마크를 검출하는 기술은 공지된 일반적인 기술이다. 플립플롭(40)는 섹터 어드레스마크 검출신호에 의해 전원전압 Vcc를 래치하여 논리 "하이"를 출력한다. 카운터(42)는 플립플롭(40)는 논리 "하이"에 의해 인에이블된후 클럭신호 CLK의 펄스를 카운트하며 카운트데이타를 출력한다. 클럭신호 CLK는 부호화된 데이타 ERD로부터 분리하는 신호로서 부호화된 데이타 ERD에 동기된다. 비교기(44)는 카운터(42)의 카운트데이타를 미리 설정된 제1구간값 VAL1과 비교하여 서로 다른 동안에는 논리 "로우"를 출력하다가 동일하게 될때 논리 "하이"를 발생하여 플립플롭(46)으로 출력하는 동시에 플립플롭(40)과 카운터(42)를 리셋트시킨다. 플립플롭(46)은 비교기(44)의 출력이 논리 "하이"로 되는 것에 의해 전원전압 Vcc을 래치하여 논리 "하이"신호를 아나로그 스위치(34)와 카운터(48)에 공통으로 출력한다. 카운터(48)는 플립플롭(46)의 논리 "하이"에 의해 인에이블된후 클럭신호 CLK의 펄스를 카운트하며 카운트데이타를 출력한다. 비교기(50)는 카운터(48)의 카운트데이타를 미리 설정된 제2구간값 VAL2와 비교하여 서로 다른 동안에는 논리 "로우"를 출력하다가 동일하게 될때 논리 "하이"를 발생하여 플립플롭(46)과 카운터(48)를 리셋트시킨다.
아나로그 스위치(34)는 구간 검출회로(36)로부터 논리 "하이"가 인가되는 동안에는 고정 검출레벨전압을 데이타 검출레벨 SETHYS로 선택하고, 논리 "로우"가 인가되는 경우에는 동적 검출레벨전압을 데이타 검출레벨 SETHYS로 선택한다.
제5도는 상기 제3도 및 제4도의 동작타이밍도이다. 제5도(a)는 자기디스크상의 데이타 기록 포맷을 보인 것으로, 섹터 어드레스마크로서 DC갭이 기록되는 예를 보인 것이다. 제5도(b)는 섹터 어드레스마크 검출회로(38)의 출력 파형을 보인 것으로, DC갭을 검출할때마다 섹터 어드레스마크 검출신호가 발생되는 것을 보인 것이다. 제5도(c)는 비교기(44)의 출력 파형을 보인 것으로, 매 서보정보구간의 시작시마다 논리 "하이"의 펄스가 출력되는 것을 보인 것이다. 제5도(d)는 플립플롭(46)의 출력 파형을 보인 것으로, DC갭을 포함한 서보정보구간 T1동안에는 논리 "하이"가 되고 데이타정보구간 T2동안에는 논리 "로우"가 되는 것을 보인 것이다.
이하 본 발명에 따른 제3도 및 제4도의 동작예를 제5도의 동작타이밍도를 참조하여 상세히 설명한다.
우선 자기디스크상에서 리드된 아나로그 리드신호로부터 펄스검출기(28)에 의해 부호화된 데이타 ERD가 검출되는 것은 전술한 제1도에서 설명한 바와 동일하다.
이러한 상태에서 구간 검출회로(36)는 부호화된 데이타 ERD로부터 서보정보 구간과 데이타정보구간을 구별하는 신호를 발생하게 된다. 우선 섹터 어드레스마크 검출회로(38)는 펄스검출기(28)에 의해 검출된 부호화된 데이타 ERD로부터 제5도(a)와 같은 DC갭형태의 섹터 어드레스마크를 검출하는데, 섹터 어드레스마크를 검출할때마다 제5도(b)와 같이 논리 "하이"의 펄스를 섹터 어드레스마크 검출신호로서 발생한다. 이에따라 섹터 어드레스마크 검출신호에 의해 매 섹터의 시작을 알 수 있게 된다.
그러면 플립플롭(40)는 클럭단자 CK에 입력하는 섹터 어드레스마크 검출신호에 의해 데이타입력단자 D의 전원전압 Vcc를 래치하여 논리 "하이"를 카운터(42)의 인에이블단자 EN에 출력함으로써 카운터(42)를 인에이블시킨다. 이에따라 카운터(42)는 클럭신호 CLK의 펄스를 카운트하기 시작하며 카운트에 따른 카운트데이타를 출력한다. 이때 비교기(44)는 카운터(42)의 카운트데이타를 미리 설정된 제1구간값 VAL1과 비교하여 서로 다른 동안에는 논리 "로우"를 출력하다가 동일하게 될때 논리 "하이"를 발생한다. 여기서 제1구간값 VAL1은 섹터 어드레스마크가 검출된 시점부터 데이타정보구간이 끝날때까지의 구간에 해당하는 값으로 설정한다. 이에따라 비교기(44)는 제5도(c)와 같이 데이타정보구간이 끝나는 시점 즉, 매 서보정보구간의 시작 시점에서마다 논리 "하이"의 펄스를 발생한다. 이 신호는 플립플롭(40)과 카운터(42)를 리셋트시킴으로써 초기화시키는 동시에 플립플롭(46)에 인가된다.
그러면 플립플롭(46)은 클럭단자 CK에 입력되는 비교기(44)의 출력 논리 "하이"의 펄스에 의해 데이타입력단자 D의 전원전압 Vcc를 래치하여 논리 "하이"신호를 아나로그 스위치(34)와 카운터(48)에 공통으로 출력한다.
이에따라 아나로그 스위치(34)는 이때부터 고정 검출레벨 발생회로(32)의 고정 검출레벨전압을 데이타 검출레벨 SETHYS로서 선택하여 히스테리시스 비교기(22)에 제공하게 된다.
한편 카운터(48)는 플립플롭(46)의 논리 "하이"에 의해 인에이블됨으로써 클럭신호 CLK의 펄스를 카운트하기 시작하며 카운트에 따른 카운트데이타를 출력한다. 이때 비교기(50)는 카운터(48)의 카운트데이타를 미리 설정된 제2구간값 VAL2와 비교하여 서로 다른 동안에는 논리 "로우"를 출력하다가 동일하게 될때 논리 "하이"를 발생한다. 여기서 제2구간값 VAL2는 서보정보구간의 시작 시점부터 서보정보구간이 끝날때까지의 구간에 해당하는 값으로 설정한다. 이에따라 비교기(50)는 서보정보구간이 끝나는 시점에서마다 논리 "하이"의 펄스를 발생한다. 이 신호는 플립플롭(46)과 카운터(48)를 리셋트시킴으로써 초기화시킨다.
이에따라 플립플롭(46)의 출력신호는 다시 논리 "로우"로 아나로그 스위치(34)에 인가된다.
이에따라 아나로그 스위치(34)는 이때부터 동적 검출레벨 발생회로(30)의 동적 검출레벨전압을 데이타 검출레벨 SETHYS로서 선택하여 히스테리시스 비교기(22)에 제공하게 된다.
상기한 바와 같은 동작이 반복됨으로써 데이타 검출레벨 SETHYS는 구간 검출회로(36)에 의해 검출되는 서보정보구간과 데이타정보구간에 대하여 서로 다르게 히스테리시스 비교기(22)에 제공된다. 즉, 아나로그 스위치(34)는 제5도의 서보정보구간 T1동안 고정 검출레벨 발생회로(32)의 고정 검출레벨전압을 데이타 검출레벨 SETHYS로 제공하고, 데이타정보구간 T2동안 동적 검출레벨 발생회로(30)의 동적 검출레벨전압을 데이타 검출레벨 SETHYS로서 제공한다. 여기서 고정 검출레벨전압은 저항(R3-R4)에 의해 항상 일정한 레벨의 전압이나, 동적 검출레벨전압은 정류회로(14)의 출력 전압 Vrec를 이용하므로 아나로그 리드신호의 레벨에 대응하여 변화하는 레벨의 전압이다.
따라서 아나로그 리드신호의 진폭이 보다 큰 서보정보구간에서는 그에 적합하게 고정적으로 설정한 고정 검출레벨전압에 의해 펄스검출기(28)의 히스테리시스 비교기(22)가 동작을 하게 되고, 디스크상으로부터 픽업되는 아나로그 리드신호의 레벨이 일시적으로 변동될 수 있는 데이타정보구간에서는 그때마다의 아나로그 리드신호의 레벨에 적응적으로 데이타 검출레벨도 변동됨으로써 데이타 에러를 방지할 수 있게 된다.
한편 전술한 바와 같이 자기디스크상으로부터 리드되는 신호의 진폭은 자기 디스크상의 내외주에서 서로 다른 것을 고려하여 제6도와 같이 데이타 검출레벨 조정회로를 구성한다. 제6도에서 펄스검출기(28)와 동적 검출레벨 발생회로(30)와 구간검출회로(36)는 제3도 및 제4도와 동일하다. 마이크로 프로세서(52)는 미리 설정된 다수의 레벨중 현재 리드되는 자기디스크상의 트랙에 대응하는 레벨에 해당하는 PWM신호를 발생한다. 이때 마이크로 프로세서(52)는 내주트랙에서는 상대적으로 낮은 레벨이 되도록 PWM신호를 발생하고, 외주트랙에서는 상대적으로 높은 레벨이 되도록 PWM신호를 발생한다. 필터회로(54)는 마이크로 프로세서(52)로부터 출력되는 PWM신호를 저역 필터링함으로써 전압레벨을 검출하여 아나로그 스위치(34)로 출력한다. 이에따라 필터회로(54)으로부터 출력되는 전압은 트랙마다 각기 다른 고정 설정된 고정 검출레벨전압이 된다.
아나로그 스위치(34)는 구간검출회로(36)의 출력에 의해 서보정보구간에서는 필터회로(54)의 고정 검출레벨전압을 데이타 검출레벨 SETHYS로서 선택하여 히스테리시스 비교기(22)에 제공하게 되고, 데이타정보구간에서는 동적 검출레벨 발생회로(30)의 동적 검출레벨전압을 데이타 검출레벨 SETHYS로서 선택하여 히스테리시스 비교기(22)에 제공하게 된다.
따라서 아나로그 리드신호의 진폭이 보다 큰 서보정보구간에서는 해당 트랙마다 그에 적합하게 고정적으로 설정한 고정 검출레벨전압에 의해 펄스검출기(28)의 히스테리시스 비교기(22)가 동작을 하게 되고, 디스크상으로부터 픽업되는 아나로그 리드신호의 레벨이 일시적으로 변동될 수 있는 데이타정보구간에서는 그때마다의 아나로그 리드신호의 레벨에 적응적으로 데이타 검출레벨도 변동됨으로써 데이타 에러를 방지할 수 있게 된다.
상술한 바와 같이 본 발명은 자기디스크상의 구간 또는 내외주에 따라 적응적으로 데이타 조정함으로써 데이타 에러를 방지할 수 있는 잇점이 있다.
한편 상술한 본 발명의 설명에서는 구체적인 실시예에 관해 설명하였으나, 여러가지 변형이 본 발명의 범위에서 벗어나지 않고 실시할 수 있다. 특히 본 발명의 설명에서는 섹터 어드레스마크를 이용하여 서보정보구간과 데이타정보구간을 구별하는 것을 예시하였으나 인덱스신호와 같은 다른 기준신호에 의해서도 구별토록 할 수도 있다. 따라서 발명의 범위는 설명된 실시예에 의해서 정할 것이 아니고 특허 청구의 범위와 특허 청구의 범위의 균등한 것에 의해 정하여져야 한다.

Claims (6)

  1. 디스크 구동장치의 리드 신호처리를 위한 데이타 검출레벨 조정회로에 있어서, 자기디스크상으로부터 리드되는 아나로그 리드신호의 진폭 피크를 검출하고 상기 아나로그 리드신호를 설정된 데이타 검출레벨과 비교하는 것에 의해 상기 검출된 진폭 피크중 실제 데이타에 해당하는 진폭 피크를 데이타로 검출하는 펄스검출수단과, 상기 아나로그 리드신호의 레벨에 대응하여 변화하는 레벨을 가지는 동적 검출레벨전압을 발생하는 동적 검출레벨 발생수단과, 미리 설정된 일정 레벨을 가지는 고정 검출레벨전압을 발생하는 고정 검출레벨 발생수단과, 상기 펄스검출수단에 의해 검출된 데이타로부터 상기 자기디스크상의 현재 헤드가 위치한 구간을 검출하여 서보정보구간과 데이타정보구간을 구별하는 구간검출수단과, 상기 구간검출수단에 의해 검출된 구간에 대응하여 상기 동적 검출레벨 발생수단과 상기 고정 검출레벨 발생수단의 출력중 하나를 선택하여 상기 데이타 검출레벨로서 제공하는 스위치수단을 구비하는 것을 특징으로 하는 데이타 검출레벨 조정회로.
  2. 제1항에 있어서, 상기 스위치수단이 상기 구간검출수단에서 서보정보구간으로 검출될 경우에는 상기 고정 검출레벨전압을 상기 데이타 검출레벨로 선택하고, 데이타정보구간으로 검출될 경우에는 상기 동적 검출레벨전압을 상기 데이타 검출레벨로 선택하고, 데이타정보구간으로 검출될 경우에는 상기 동적 검출레벨전압을 상기 데이타 검출레벨로 선택하는 것을 특징으로 하는 데이타 검출레벨 조정회로.
  3. 제2항에 있어서, 상기 서보정보구간이 섹터들을 구분하기 위한 섹터 어드레스 마크가 기록된 구간을 포함하는 것을 특징으로 데이타 검출레벨 조정회로.
  4. 디스크 구동장치의 리드 신호처리를 위한 데이타 검출레벨 조정회로에 있어서, 자기디스크상으로부터 리드되는 아나로그 리드신호의 진폭 피크를 검출하여 그에 따른 펄스신호를 발생하는 피크검출수단과, 상기 아나로그 리드신호를 설정된 데이타 검출레벨과 히스테리시스 비교하는 비교수단과, 상기 펄스신호에 의해 상기 비교수단의 출력을 래치하여 그로부터 상기 검출된 진폭 피크중 실제 데이타에 해당하는 진폭 피크에 따른 펄스신호를 데이타로 검출하는 데이타 검출수단과, 상기 아나로그 리드신호를 정류하는 정류수단과, 상기 정류된 전압을 분압하여 분압된 레벨전압을 동적 검출레벨전압으로서 발생하는 동적 검출레벨 발생수단과, 일정 레벨을 가지는 전원전압을 분압하여 분압된 레벨전압을 고정 검출레벨 전압으로서 발생하는 고정 검출레벨 발생수단과, 상기 데이타검출수단에 의해 검출된 데이타로부터 상기 자기디스크상의 현재 헤드가 위치한 구간을 검출하여 서보정보구간과 데이타정보구간을 구별하는 구간검출수단과, 상기 구간검출수단에서 서보정보구간으로 검출될 경우에는 상기 고정 검출레벨전압을 상기 데이타 검출레벨로 선택하고 데이타정보구간으로 검출될 경우에는 상기 동적 검출레벨전압을 상기 데이타 검출레벨로 선택하여 상기 데이타 검출레벨로서 제공하는 스위치수단을 구비하는 것을 특징으로 하는 데이타 검출레벨 조정회로.
  5. 디스크 구동장치의 리드 신호처리를 위한 데이타 검출레벨 조정회로에 있어서, 자기디스크상으로부터 리드되는 아나로그 리드신호의 진폭 피크를 검출하고 상기 아나로그 리드신호를 설정된 데이타 검출레벨과 비교하는 것에 의해 상기 검출된 진폭 피크중 실제 데이타에 해당하는 진폭 피크를 데이타로 검출하는 펄스검출수단과, 상기 아나로그 리드신호의 레벨에 대응하여 변화하는 레벨을 가지는 동적 검출레벨전압을 발생하는 동적 검출레벨 발생수단과, 미리 설정된 다수의 레벨중 현재 리드되는 자기디스크상의 트랙에 대응하여 설정된 레벨을 가지는 고정 검출레벨전압을 발생하는 고정 검출레벨 발생수단과, 상기 펄스검출수단에 의해 검출된 데이타로부터 상기 자기디스크상의 현재 헤드가 위치한 구간을 검출하여 서보정보구간과 데이타정보구간을 구별하는 구간검출수단과, 상기 구간검출수단에 의해 검출된 구간에 대응하여 상기 동적 검출레벨 발생수단과 상기 고정 검출레벨 발생수단의 출력중 하나를 선택하여 상기 데이타 검출 레벨로서 제공하는 스위치수단을 구비하는 것을 특징으로 하는 데이타 검출레벨 조정회로.
  6. 제5항에 있어서, 상기 스위치수단이 상기 구간검출수단에서 서보정보구간으로 검출될 경우에는 상기 고정 검출레벨전압을 상기 데이타 검출레벨로 선택하고, 데이타정보구간으로 검출될 경우에는 상기 동적 검출레벨전압을 상기 데이타 검출레벨로 선택하는 것을 특징으로 하는 데이타 검출레벨 조정회로.
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