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KR0163764B1 - 신호처리장치 - Google Patents

신호처리장치 Download PDF

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Publication number
KR0163764B1
KR0163764B1 KR1019900013086A KR900013086A KR0163764B1 KR 0163764 B1 KR0163764 B1 KR 0163764B1 KR 1019900013086 A KR1019900013086 A KR 1019900013086A KR 900013086 A KR900013086 A KR 900013086A KR 0163764 B1 KR0163764 B1 KR 0163764B1
Authority
KR
South Korea
Prior art keywords
signal
amplifier
voltage
signals
linear
Prior art date
Application number
KR1019900013086A
Other languages
English (en)
Other versions
KR910005676A (ko
Inventor
아담슨 라고니 윌리암
Original Assignee
피터 엠. 엠마뉴엘
톰슨 컨슈머 일렉트로닉스 인코포레이티드
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 피터 엠. 엠마뉴엘, 톰슨 컨슈머 일렉트로닉스 인코포레이티드 filed Critical 피터 엠. 엠마뉴엘
Publication of KR910005676A publication Critical patent/KR910005676A/ko
Application granted granted Critical
Publication of KR0163764B1 publication Critical patent/KR0163764B1/ko

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    • C—CHEMISTRY; METALLURGY
    • C07—ORGANIC CHEMISTRY
    • C07K—PEPTIDES
    • C07K5/00—Peptides containing up to four amino acids in a fully defined sequence; Derivatives thereof
    • C07K5/04—Peptides containing up to four amino acids in a fully defined sequence; Derivatives thereof containing only normal peptide links
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00—Details of television systems
    • H04N5/14—Picture signal circuitry for video frequency region
    • H04N5/20—Circuitry for controlling amplitude response
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03G—CONTROL OF AMPLIFICATION
    • H03G7/00—Volume compression or expansion in amplifiers
    • H03G7/002—Volume compression or expansion in amplifiers in untuned or low-frequency amplifiers, e.g. audio amplifiers

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Abstract

내용 없음.

Description

신호 처리 장치
제1a도 및 1b도는 화이트-스트레치(white-stretch) 이득 특성 및 화이트 스트레치 전달 함수를 갖는 장치의 블록 선도.
제2a도 및 2b도는 제1b도 장치의 임의 블록을 실행하기 위한 제1 및 제2증폭기 장치의 개요도 및 관련된 전달 함수를 도시한 도.
제3a도 및 3b도는 제1b도 장치의 실행시 또한 활용되는 전류원을 도시하는 도.
제4도는 제1b도 장치의 또다른 블록을 실행하기 위한 전류 스티어링 네트워크의 개요도.
제5도는 제3a도 및 제3b도에 도시된 전류원 대신에 활용될 수 있는 교류 전류원을 도시한 도.
제6도는 제2a도, 제3a도 및 3b도 그리고 4도에 도시된 부분을 활용하는 제1b도 장치의 완전한 실행을 도시한 개요도.
제7도는 제1b도의 화이트 스트레치 장치가 텔레비젼 시스템에서 활용되는 방법을 도시한 도.
* 도면의 주요부분에 대한 부호의 설명
136 : 화이트 스트레치 처리 유니트 140 : 제어 신호 발생기
142,182,194,220,226 : 입력 144,146,192,208,214 : 출력
148 : 색도 처리 유니트 152 : 매트릭스
154 : 집적 회로 156 : 파킹 회로
158 : 컨트래스트 제어 유니트 159,161 : 전위차계
160 : 명도 제어 유니트 166 : 키네스코우프
168 : 피크 검출기
171,173,175,179,210,216,244,246,253,261 : 저항기
177 : 에미터 팔로워 183 : 평균 검출기
184 : 선형 증폭기 186 : 비선형 증폭기
188 : 소프트 스위치
196,198,224,230,250,252,256,258 : 트랜지스터
218 : 전압 공급원 270 : 다이오드
본 발명은 제어 가능한 비선형 처리 회로에 관한 것이며, 특히 비디오 영상의 컨트래스트를 향상시키는 상기 회로에 관한 것이다.
자동 컨트래스트' 및 '화이트-스트레치'처리부를 포함하는 다이나믹 비디오 시스템이라 명칭되어 동시에 출원된 미합중국 특허출원 일련번호 제RCA 85,479호에 텔레비젼 시스템에 화이트 스트레치 처리부를 사용하는 장점이 기술되어 있다. 화이트 스트레치는 영상 특성을 표시하는 제어 신호의 함수에 따라서 고 휘도 진폭에 비례하는 중간 범위 휘도 진폭을 엠퍼사이즈(emphasize)하거나 부트(boost)시켜 재생 영상의 컨트래스트를 향상시킨다. 화이트 스트레치 처리의 장점이 본 출원에 간략하게 서술된다. 그러나, 본 출원은 주로 화이트-스트레치를 발생시키기 위하여 사용되는 제어 가능한 비선형 이득 특성을 제공하는 장치에 관한 것이다.
본 발명의 양상에 따르면, 비선형 처리 장치는 입력 신호에 응답하여 선형 및 비선형 출력 신호를 발생시키기 위해 배열된 제1 및 제2증폭기 및 제어 신호에 따라서 출력 신호를 결합시키는 소프트-스위치를 포함한다. 특히, 본 발명의 또다른 양상에 따르면, 제1 및 제2증폭기는 전압-팔로워(followers)를 구비하는데, 상기 전압 팔로워의 입력은 병렬로 연결되어 있고 출력 모두는 저항 전압 분할기의 제1저항기에 의하여 연결되어 있다. 제2증폭기가 제1증폭기에 앞서 차단되도록 바이어스 전압은 제2증폭기에 연결되어 있다. 제2증폭기가 차단되기 전, 증폭기에 의해 제공된 출력 신호는 동일한 진폭을 갖고 전류는 제1저항기를 통해서 흐르지 않는다. 제2증폭기가 차단된 후, 전류는 제1저항기를 통하여 흐르고 전압 분할기의 전압 분할 작용에 의해서, 제1증폭기 출력 신호의 감쇠 버젼(version)은 제2증폭기의 출력에서 발생된다. 결과적으로, 선형 출력 신호는 제1증폭기의 출력에서 발생되고 비선형 출력 신호는 제2증폭기의 출력에서 발생된다.
본 발명이 첨부한 도면을 참조하여 상세히 설명될 것이다.
도면에서, 동일하거나 유사한 소자에는 동일한 참조 번호가 병기된다.
다음 설명에서, 휘도 신호의 정 진행부(positive-going portions)가 재생 영상의 화이트-진행(white-going)부와 대응한다고 가정하자.
제1a도를 참조하면, 화이트 스트레치 이득 특성이 도시되어 있다. 이득 특성은 고-휘도 진폭 레벨과 비교되는 중간 범위 및 저 레벨 휘도 진폭 레벨에 대해 증가 이득(슬로우프)을 갖는 일군의 비선형 전달 함수를 포함한다. 비선형도는 제어 신호 Vc 크기의 역함수에 따라서 증가한다. 제어 신호 Vc 가 최고 크기(Vc1)인 경우에, 이득 특성은 선형 전달 함수로 된다. 보다 적은 크기인 경우에(예 Vc2Vc1), 전달 함수는 더욱 비선형이 된다.
제1a도의 전달 함수를 발생시키는 효율적인 방식이 제1b도에 도시되어 있다. 입력(182)에서의 입력 전압은 선형 증폭기(184)의 입력 및 비선형 증폭기(186)의 입력에 병렬로 연결되어 있다. 증폭기(184,186)의 출력 신호는 소프트-스위치(188)에 연결되어 있으며, 이 소프트 스위치는 제어 전압 Vc 에 따라서 선형 및 비선형 출력 신호를 결합하여 최종 출력 신호를 출력(192)에서 발생시킨다. 입력(182) 및 출력(192)간의 이득 특성이 제1a도에 도시되어 있다.
제1b도 블록 선도의 증폭기(184,186) 실행이 제2a도에 개요적으로 도시되어 있다. 제2a도의 증폭기에 대한 전달 함수가 제2b도에 도시되어 있다.
입력(194)에서의 전압은(제1b도의 입력 전압(182)에 대응) PNP 트랜지스터(196,198)의 베이스에 병렬로 연결되어 있다. 트랜지스터(196,198)는 에미터 팔로워로서 구성되어 있고, 이 에미터-팔로워 각각의 콜렉터는 접지에 접속되고 출력 전압은 각 에미터에서 발생된다. PNP 트랜지스터(196)의 에미터는 저항기(206)를 통하여 전원 Vcc 에 접속되어 저항기(206) 양단의 출력 신호를 출력(208)에서 발생시킨다. 에미터-팔로워(198)는 직렬 접속된 부하 저항기(216) 및 바이어스 전압 공급원(218) 양단의 출력 전압을 출력(214)에서 발생시킨다. 전원(218)에 의하여 제공된 바이어스 전압값이 설정되므로써 트랜지스터(198)는 입력 신호의 소망 항복점 레벨(VB)에서 차단된다. 항복점 레벨 다음에, 트랜지스터(196)는 계속해서 도전된다. 결과적으로, 에미터-팔로워(198)는 에미터-팔로워(196)보다 적은 다이나믹 범위를 갖는다. 저항기(210)는 출력(208,214)사이에 접속된다.
트랜지스터(198)가 도전되는 동안, 출력(208, 214)에서의 출력 전압은 거의 동일하고 입력 전압과 관계하여 선형이 된다. 게다가, 전류가 저항기(210)를 통하여 흐르지 않기 때문에 출력(208)에서의 출력 신호 감쇠는 발생하지 않는다. 그러나, 트랜지스터(198)가 턴오프될때, 전류는 저항기(210)를 통하여 흐른다. 항복점(VB)에서 및 항복점(VB)를 초과한 곳에서, 출력(208)에서의 출력 신호는 변경됨이 없이 계속되나 출력(208)에서의 출력 신호의 감쇠 버젼은 저항기(210, 216)사이의 전압 분할로 인해 출력(214)에서 발생된다. 항복점(VB)은 전원(218) 및 트랜지스터(198)의 베이스에 존재하는 DC 바이어스에 의하여 결정된다. 제2b도에 도시된 A2및 A1의 기울기 비는 저항기(210,216)의 비에 의하여 결정된다.
제3a도 및 3b도는 제2a도의 출력 전압을 전류로 변환시키는 회로의 개요도이다. 후술되는 바와 같이, 이들 전류는 전류 스티어링 네트워크를 구비한 소프트-스위치 (188)에 인가된다. 제3a도에 도시된 바와 같이, 출력(208)에서 발생된 선형 전압 신호는 트랜지스터(224)의 베이스에 연결된 하나의 입력(220)에 인가된다. 대응하는 방식으로, 출력(214)에서 발생된 비선형 전압 신호는 트랜지스터(230)의 베이스에 연결되는 입력(226)에 인가된다. 트랜지스터(224,230)는 제4도와 관련하여 서술되는 전류 스티어링 회로에 연결된 각 콜렉터를 갖는다. 트랜지스터(224,230)의 베이스에 인가된 전압에 응답하여, 각 콜렉터 전류(236,238)가 발생된다. 트랜지스터(224,230)의 에미터는 각 에미터 저항기(244,246)에 접속된다. 저항기(244)는 직접적으로 접지에 연결되고 저항기(246)는 바이어스 전압원(248)을 통하여 접지에 연결되어 있다. 저항기(246)는 저항기(244)보다 낮은 값을 갖으므로써 선형 및 비선형 신호 전류의 블랙 대 화이트 차를 같게 한다. 바이어스 전압원(248)에 의하여 제공된 바이어스는 두 출력 전류의 DC 성분을 같게 하기 위하여 사용된 옵셋을 초래한다.
제4도에 도시된 바와 같이, 소프트 스위치(188)는 전류 스티어링 차동 증폭기로서 실행된다. 트랜지스터(224,230)는 제3a도 및 3b도와 관련되어 상기에 논의된 동일한 방식으로 동작한다. 트랜지스터(250)의 베이스에 인가된 제어 전압 Vc 의 함수에 따라서, 트랜지스터(250,252)는 트랜지스터(224)의 콜렉터에 흐르는 전류(236)를 스티어링하는 차동 증폭기를 형성하며, 부하 저항기(253)는 출력 전압을 발생시키는 신호 출력단자(192)사이에 접속되거나 전원 Vcc 에 접속되어 트랜지스터(258)의 베이스에 인가된 제어 전압 Vc 의 함수에 따라서, 차동 트랜지스터쌍(256,258)은 트랜지스터(230)의 콜렉터내에 흐르는 전류(238)를 유사하게 스티어링한다. 결과적으로, 부하 저항기(253)를 통하여 흐르는 전류는 선형 및 비선형 전류(236,238)의 결합을 제어가능하게 결합할 수 있다.
트랜지스터(252,256)의 베이스에 연결된 전압원(259)은 전류 스티어링을 연속적으로 제어할 수 있는 범위를 설정한다. 공지된 바와 같이, 차동 증폭기의 출력 전류가 입력 전압에 응답하는 차동 입력 전압의 범위는 약 +150 밀리볼트이다. 전압원(259)에 의하여 제공된 전압은 대략 제어 범위의 중간에 대응한다. 제어 전압 Vc 의 크기가 전압원(259)에 의하여 제공된 전압 이하인 경우, 트랜지스터(256)는 트랜지스터(258)보다 더욱 많이 도전되고 트랜지스터(252)는 트랜지스터(250)보다 더욱 많이 도전된다. 결과적으로, 부하 저항기(253) 양단에 발생된 출력 전압은 선형 전류(트랜지스터(224)에 의하여 제공됨)로부터 영향(contribution)을 받기 보다 비선형 전류(트랜지스터(230)에 의하여 제공됨)로부터 크게 영향을 받는다. 제어 전압 Vc 의 크기가 전압원(259)에 의하여 제공된 전압 이상인 경우에, 트랜지스터(250)는 트랜지스터(252)보다 더욱 많이 도전되고 트랜지스터(258)는 트랜지스터(256)보다 더욱 많이 도전된다. 결과적으로, 부하 저항기 양단에 발생된 출력 전압은 트랜지스터(230)에 의하여 제공된 비선형 전류로부터 영향을 받기 보다 트랜지스터(224)에 의하여 제공된 선형 전류로부터 크게 영향을 받는다. 따라서, 입력(182) 및 출력(192)사이의 이득 특성이 제1a도에 도시되어 있다.
제4도의 회로는 입력(182) 및 출력(192)사이의 신호를 반전시킨다. 일부 응용에서, 이 신호 반전은 바람직하지 않다. 신호 반전을 일으키지 않는 제3a도, 3b도 및 제4도에 도시된 전류원에 대한 또다른 배열이 제5도에 도시되어 있다. 이 배열에서, 입력(220,226)에 인가된 입력 전압은 트랜지스터(224,230)의 각 베이스에 연결되는 대신에 각 에미터에 연결되어 있다. 입력(220,226)은 각 저항기(261,263)를 통하여 트랜지스터(224,230)의 각 에미터에 연결되어 있다. 또한 제5도의 회로에서, 바이어스 전압원(248)은 트랜지스터(224,230)의 베이스에 연결되어 있다. 입력(220,226)에 발생되는 두 입력 전압 간의 블랙 대 화이트 차를 보상하기 위하여, 저항기(261)는 저항기(263)보다 높은 값을 갖고 두 입력 전압의 DC 성분 사이의 차를 보상하기 위하여, 저항기(246)는 저항기(244)보다 작은 값을 갖도록 된다.
제6도는 제1b도 블록 선도의 완전한 실행을 도시한다. 제6도는 모두 연결된 제2a도, 3a도, 3b도 및 제4도와 관련하여 상술된 회로부분을 도시한다. 그러나, 어떤 실제 수정이 행해져 있다.
제2a도에 도시된 바와 같은 에미터 팔로워(198)와 관계된 바이어스 전압원(218)은 저항기(261,261')사이의 공급 전압원 Vcc 의 전압 분할(테브난의 전압원처럼)에 의하여 제공된다. 제2a도에 도시된 저항기(216)는 저항기(216',261)의 테브난 등가에 대응한다. 동일한 방법으로, 제3b도 및 제4도에 도시된 바와 같은 비선형 입력 전압에 대한 전류원과 연결된 바이어스 전압(248)은 저항기(263,246')사이의 전압 공급원 Vcc 의 전압 분할에 의하여 제공된다. 저항기(264,266)를 포함하는 전압 분할기는 제4도에 도시된 바와 같이 트랜지스터(252,256)의 베이스에 연결된 전압원(259)에 대응한다. Vc 제어 입력(190) 및 저항기(264,266)의 접합 사이에 결합되는 다이오드(270)를 부가하는 것이 중요한데, 이 이유는, 상기 다이오드는 제어 전압 Vc 로 하여금 하나의 다이오드 전압 강하가 저항기(264,266)의 접합에서 발생되는 전압을 초과하지 못하도록하게 때문이다. 이것이 높은 제어 전압 Vc 의 크기에서 출력 신호(YOUT)의 왜곡을 방지한다.
제1도 내지 6도를 참조하여 서술된 제어가능한 비선형 이득 특성 신호 처리 회로가 텔레비젼 시스템에 사용되어 화이트 스트레치 처리를 실행하는 방법이 제7도에 도시되어 있다. 제7도를 참조하면, 비선형 이득 특성 회로가 화이트 스트레치 처리 유니트(136)내에서 결합되어 있다. 화이트 스트레치 처리 유니트(136)에 대한 제어 전압(제7도와 연관되는 제어 신호 VCA처럼 표시)은 후술되는 바와 같이 제어 신호 발생기(140)에 의하여 발생된다.
특히 제7도를 참조하여, 입력(142)에 제공된 합성 비디오는 두 성분 즉 출력(144)에 제공된 휘도 신호 및 출력(146)에 제공된 색도 신호로 분리된다.
색도 신호는 빨, 녹, 청색의 색차 신호 즉 r-Y, b-Y 및 g-Y 를 발생시키기 위하여 공지된 방식으로 프로세서내에서 처리된다. 색차 신호는 매트릭스(152)에 연결되어 있다. 색도 처리 유니트(148) 및 매트릭스(152)는 집적 회로(IC)(154)내에 포함되어 있다.
휘도 신호는 발생기(140)에 의하여 발생된 제어 신호 Vc 를 또한 수신하는 화이트 스트레치 처리 유니트(136)에 연결된다. 화이트-스트레치 처리 유니트(136)의 출력 신호는 영상의 첨예도(sharpness)를 개선시키는 피킹 회로(156)에 연결되어 있다. 피킹 회로(156)의 출력 신호는 집적 회로(154)에 연결되어 있다.
휘도 신호를 처리하기 위하여, 집적 회로(154)는 컨트래스트 제어 유니트(158) 및 명도 제어 유니트(160)를 포함한다. 컨트래스트 및 명도용 사용자 조정 소자는 각 전위차계(159,161)로 표시되어 있으며, 비록 현대 텔레비젼 시스템일지라도 상기 전위차계는 통상적으로 마이크로 프로세서로 제어되는 D/A 변환기를 포함한다. 처리된 휘도 신호는 색차 신호와 결합되어 저레벨의 빨(r), 녹(g), 청(b) 색 신호를 발생시키는 매트릭스(152)에 연결된다. 편향 처리부(도시되지 않음)에서 각각 발생되는 수평 및 수직 리트레이스 블래킹(retrace blanking) 펄스 즉 HB 및 VB 는 매트릭스(152)에 의하여 r,g,b 색 신호에 삽입되어 수평 및 수직 리트레이스 라인의 디스플레이를 방지한다.
저 레벨 r,g,b 색 신호는 구동 증폭기(164r,164b,164g)에 의하여 증폭되어 키네스코우프(166)의 각 캐소우드를 구동시키는데 적합한 R,G,B 구동 신호를 발생시킨다.
예를들어 캐릭터(character)에 대응하는 과다한 화이트-고잉 신호 피크로 인한 스팟 블루밍(spot blooming)뿐만 아니라 디스플레이 드라이버 및 형광체 포화(phosphor saturation)를 방지하기 위하여, 피크 검출기(168)는 후술되는 바와 같이 제어 신호 발생기(140)내에서 발생되는 휘도-표시 신호의 화이트-고잉 피크를 검출하고 이에 응답하여 컨트래스트 제어 유니트(158)용 제어 신호를 발생시킨다. 스팟 블루밍에 대응하는 임계치를 초과하는 화이트 고잉 피크가 검출될때마다, 컨트래스트는 자동적으로 감소된다.
유감스럽게도, 컨트래스트 제어 유니트(158)가 선형 이득 전달 함수를 갖기 때문에, 자동 컨트래스트 제어 장치는 균일한 모든 진폭에 영향을 미친다. 결과적으로, 중간 범위 진폭 뿐만 아니라 고 진폭도 감소되어, 영상의 명도를 상당히 감소시킨다. 화이트 스트레치 처리 유니트(136)는 다음 방식으로 이 작용을 상쇄한다.
화이트 스트레치 처리 유니트(136)에 대한 제어 신호(전압) VCA는 후술되는 휘도 표시 신호의 평균값에 응답해서 파생된다. 평균 영상 명도가 낮을 때, 제어 신호 VCA는 화이트 스트레치 처리 유니트(136)의 비선형도를 증가(Vc2인 경우가 제1a도에 도시)시킨다. 결과적으로, 휘도 신호의 중간 범위 진폭은 고 진폭 레벨과 관계하여 증가된다. 작은 영상 에리어에 대응하는 화이트 고잉 피크가 평균 레벨에 거의 영향을 미치지 않기 때문에, 중간 범위 진폭을 감소시키는 경향이 있는, 과다한 화이트-고잉 피크에 응답하는 자동 컨트래스트 감소는 증간 범위 진폭에 인가된 화이트 스트레치 이득 증가에 의하여 보상된다. 이 방식으로, 상당히 선명하고 밝은 영상을 제공하는 동안 스팟 블루밍 뿐만 아니라 디스플레이 드라이버 및 형광체 포화가 최소화된다.
서두에 논의된 것처럼, 자동 컨트래스트 및 화이트 스트레치 제어를 위하여, 컨트레스트 및 휘도와 같은 영상 특성이 조정되어 각 제어 신호가 재생 영상의 내용을 적당히 반영(reflect)시킨 후, 재생 영상의 휘도 성분을 표시하는 신호의 피크값 및 평균값 각각을 검출하는 것이 바람직하다. 도시바로부터 제조되어 상업적으로 활용되는 TA7730 휘도 처리 IC 는 컨트래스트 및 휘도의 제어를 받는 r,g,b 색 신호 결합에 의하여 파생된 휘도 표시 신호를 출력단자에 제공한다. 유감스럽게도, 제1도의 IC(154)를 참조하여 표시된 바와 같이, 컨트래스트 및 명도 제어 처리를 반영하는 휘도 표시 신호는 예를들어 볼보로부터 제조되어 활용되는 TDA4580 과 같은 다른 IC 에 의하여 제공되지는 않는다.
라고니에 의하여 텔레비젼 시스템용 제어 신호 발생기라 명칭되어 출원된 특허원과 관계되는 제어 신호 발생기(140)가 이 문제점을 해결한다. 제어 신호 발생기(140)는 IC(154)의 각 출력단자에서 발생된 r,g,b 색 신호를 결합하여 처리된 휘도 정보를 거의 근시적으로 표시하는 신호를 발생시킨다. 그러나, 리트레이스 블래킹 펄스가 가해지기 전 r,g,b 신호가 결합되는 TA7730 IC 에 의하여 발생된 합산 휘도 신호와는 달리, 최종 합산 휘도신호는 r,g,b 신호에 포함된 고 레벨(예를들어 -100 내지 -160 IRE)리트레이스 블래킹 펄스에 대응하는 펄스를 포함한다. 합산 휘도 신호에 포함되는 상기 펄스는 블랙 레벨 이하로 상당히 확장되어 평균값(피크 대 피크값 뿐만 아니라)에 영향을 미친다. 따라서, 합산 신호의 평균값 검출에 의하여 파생된 제어 신호는 재생 영상의 명도를 정확하게 표시하지 못한다. 제어 신호 발생기(140)는 이 문제점을 또한 해결하는 것이다.
특히, 제어 신호 발생기(140)에 관계하여, IC(154)의 각 출력 단자에서 발생되는 r,g,b 색 신호는 저항기(171,173,175)를 구비한 저항성 결합기에 의하여 합산된다. 저항기(171,173,175)의 공통 접합에서 발생된 최종 합산 신호는 에미터-팔로워 증폭기(177)의 베이스에 연결되어 있다. 출력 신호는 에미터-팔로워(177)의 저 임피던스 에미터 출력의 부하 저하기(179) 양단에 전달된다.
전압 공급원(Vcc) 및 에미터 팔로워(177)의 에미터 사이에 연결된 저항기(181)는 에미터 팔로워(177)의 도전 임계를 상승시키므로써, 상기 블랙 레벨 이상의 결함없는 화이트 고잉 합산 신호가 에미터 출력에 제공되도록 하지만 r,g,b 색 신호의 리트레이스 블래킹 펄스에 대응하는 펄스가 제거되도록 한다. 따라서, 에미터에 인가된 증가 바이어스로 인해, 검출된 평균값 및 최종 화이트 스트레치 신호 VCA는 재생 영상의 평균 휘도 성분을 상당히 신뢰할 수 있게 표시한다.
저항기(171,173,175)가 공지된 휘도 매트릭스식에 따라서 비례되어 정확하게 휘도 신호를 발생시키는 동안, 화이트 스트레치 처리 제어에 적합한 처리된 휘도-표시 성분을 제공하는데 적합한 저항기비는 1:1:1 비라는 것이 발견되었다.
합산 출력 신호의 평균값은 R-C 저역 필터만을 구비하는 평균 검출기(183)에 의하여 발생된다. 합산 출력 신호의 화이트 피크값은 피크 검출기(168)에 의하여 검출된다. 매우 샤프한 피크에 응답할 수 있는 적절한 피크 검출기가 G.A 휘트리지에 의하여 1989년 7월 14일에 피드백을 갖는 피크 검출기라는 명칭으로 출원된 미합중국 특허출원 일련번호 제380,697호에 공지되어 있는데, 이것은 본 출원의 양수인과 동일한 양수인에게 양도되었다.
본 발명의 바람직한 실시예에 대해서 설명하는 동안에도, 당업자는 변경 및 수정을 할 수 있다는 것을 알 수 있다. 예를 들어 제1b도에서 블록 형태로 도시된 증폭기(184,186)가 제2a도에 도시된 바와 같은 에미터 팔로워로서 실행된다고 설명되었지만, 다른 팔로워 증폭기 및 다른 증폭기 구성이 사용될 수 있다. 따라서, 다음 청구범위는 본 발명의 영역내에 있는 상기와 같은 수정 및 그외다른 수정 모두를 커버한다.

Claims (5)

  1. 입력 신호에 응답하여 상기 입력 신호의 소정 진폭 범위에 대한 상기 입력에 선형적으로 관계되는 제1신호((196)의 에미터)를 발생시키는 제1증폭기(184)와, 상기 입력 신호에 응답하여 제2신호((198)의 에미터)를 발생시키는 제2증폭기(198) 및, 제1(208) 및 제2(접지) 단부와 상기 제1 및 제2단부간의 탭 포인트(214)를 갖는 전압 분할기(210,216)를 구비하며, 상기 제1신호는 상기 전압 분할기의 상기 제1단부에 결합되어 상기 제1신호에 대응하는 상기 전압 분할기의 상기 제1단부에서 제1중간 신호(선형 전압 신호)를 발생시키는 신호 처리 장치에 있어서, 제어 신호(VC)에 응답하여 상기 제1 및 제2중간 신호를 제어가능하게 결합시켜 결합 신호(YOUT)를 발생시키는 수단(188,224,230)을 구비하며, 상기 제2신호는 상기 입력 신호의 상기 소정 진폭 범위의 제1부분에 대한 상기 입력 신호에 비례적으로 관계되고 상기 제2증폭기는 상기 소정 진폭 범위의 제2부분을 차단하며, 상기 제2신호는 상기 전압 분할기의 상기 탭 포인트에 연결되어 상기 입력 신호의 상기 소정 진폭 범위의 상기 제1부분에 대한 상기 제2신호에 대응하고 상기 입력 신호의 상기 소정 진폭 범위의 상기 제2부분에 대한 상기 제1신호의 전압 분할된 버젼에 대응하는 상기 탭 포인트에서 제2중간 신호(비선형 전압 신호)를 발생시키는 것을 특징으로 하는 신호 처리 장치.
  2. 제1항에 있어서, 상기 결합 수단(188,224,230)은: 상기 제1 및 제2중간 신호(선형 전압 신호, 비선형 전압 신호)를 표시하는 제1 및 제2신호(ILIN, INONLIN)를 발생시키는 수단(224,230)과, 상기 제어 신호(VC)에 응답하여 상기 제1 및 제2표시 신호를 제어가능하게 결합하는 수단(188)을 구비하는 것을 특징으로 하는 신호 처리 장치.
  3. 제2항에 있어서, 상기 제1 및 제2중간 신호 각각은 제1 및 제2전압 신호이며, 상기 제1 및 제2표시 신호 각각은 제1 및 제2전류 신호이며, 상기 결합 수단은 상기 제어 신호에 응답하여 전류 스티어링 네트워크를 구비하여 상기 제1 및 제2전류 신호를 제어가능하게 결합시키는 것을 특징으로 하는 신호 처리 장치.
  4. 제1항, 2항 또는 3항중 어느 한 항에 있어서, 상기 전압 분할기는 상기 제2증폭기에 결합된 바이어스 전압을 설정하여 상기 입력 신호의 소정 진폭 범위의 상기 제2부분동안 바이어스될 상기 제2증폭기를 차단시키는 것을 특징으로 하는 신호 처리 장치.
  5. 제4항에 있어서, 상기 제1 및 제2증폭기 각각은 팔로워 증폭기를 구비하는 것을 특징으로 하는 신호 처리 장치.
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