JPS6319860Y2 - - Google Patents
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- JPS6319860Y2 JPS6319860Y2 JP3872183U JP3872183U JPS6319860Y2 JP S6319860 Y2 JPS6319860 Y2 JP S6319860Y2 JP 3872183 U JP3872183 U JP 3872183U JP 3872183 U JP3872183 U JP 3872183U JP S6319860 Y2 JPS6319860 Y2 JP S6319860Y2
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- 230000005540 biological transmission Effects 0.000 claims description 13
- 238000006243 chemical reaction Methods 0.000 claims description 8
- 239000000446 fuel Substances 0.000 claims 1
- 238000005303 weighing Methods 0.000 description 8
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- Information Transfer Systems (AREA)
Description
【考案の詳細な説明】
この考案はガソリンスタンド等の給油所におい
て使用される給油装置に係り、特に給油装置機器
間を結ぶデータ転送装置の改善に関する。[Detailed Description of the Invention] This invention relates to a refueling device used in a refueling station such as a gas station, and particularly relates to an improvement of a data transfer device that connects refueling device devices.
周知の通り、給油所においては電子機器が広範
に使用されており、それらの機器の間でデータ転
送の必要性が生じる。例えば、給油代金は計量機
が計量した給油量に油の単価を乗じて得られる
が、前記単価は外部の者が触れないように事務所
内の操作卓に設けられたデジタルスイツチ等によ
つて設定される一方、前記給油代金は計量機に内
蔵された計量機制御装置によつて算出されること
が多く、この場合前記単価を計量機側にデータ転
送しなければならない。このようなデータ転送に
は種種の方法があり、中でもUART(Universal
Asynchronous Receiver Transmitter)LSIを
用いた非同期のシリアルデータ転送方法は、その
代表的なものである。しかしながら上記LSIを使
用したデータ転送装置は回路が複雑となり、高価
となる欠点があつた。 As is well known, the widespread use of electronic equipment in gas stations creates a need for data transfer between such equipment. For example, the refueling price is obtained by multiplying the amount of refueling measured by a weighing machine by the unit price of the oil, but the unit price is set by a digital switch etc. installed on the operation console in the office to prevent it from being touched by outsiders. On the other hand, the refueling price is often calculated by a weighing machine control device built into the weighing machine, and in this case, the unit price must be data-transferred to the weighing machine. There are various methods for such data transfer, among them UART (Universal
A typical example is an asynchronous serial data transfer method using LSI (Asynchronous Receiver Transmitter) LSI. However, the data transfer device using the above-mentioned LSI has the disadvantage that the circuit is complicated and expensive.
この考案は上記の事情に鑑み、安価で信頼性の
高い給油装置における直列データ転送装置を提供
するもので、クロツクパルスを出力する発振器
と、前記クロツクパルスを分周して一定周期のパ
ルス信号を出力する分周回路と、これら2系列の
パルスに基づいて並列データを直列データに変換
してシリアル送信する送信回路と、前記2系列の
パルスに基づいて前記直列データを並列データに
変換する受信回路とを具備することを特徴とす
る。 In view of the above circumstances, this invention provides an inexpensive and highly reliable serial data transfer device for refueling equipment, which includes an oscillator that outputs clock pulses, and a pulse signal with a constant period by dividing the frequency of the clock pulse. a frequency dividing circuit, a transmitting circuit that converts parallel data into serial data based on these two series of pulses and serially transmits the data, and a receiving circuit that converts the serial data into parallel data based on the two series of pulses. It is characterized by comprising:
以下、図面に基づいて本考案の実施例を説明す
る。 Embodiments of the present invention will be described below based on the drawings.
第1図は本考案の一実施例の構成を示すブロツ
ク図であり、この図において符号1は事務所内の
操作卓に設けられた送信回路、2は計量機内に設
けられた受信回路、3はそれらの間を結ぶ伝送路
である。 FIG. 1 is a block diagram showing the configuration of an embodiment of the present invention. In this figure, reference numeral 1 is a transmitting circuit installed in a console in an office, 2 is a receiving circuit installed in a weighing machine, and 3 is a receiving circuit installed in a weighing machine. It is a transmission line that connects them.
まず送信回路1は並列データDpを直列データ
Dsに変換する16ビツトのシフトレジスタ4と、
このシフトレジスタ4の並列入力端に各4ビツト
計16ビツトの並列データDpを供給するデジタル
スイツチ(例えばデジタルサミールスイツチ)5
a〜5dと、シフトレジスタ4のクロツク端子
CKにクロツク信号φを印加するレシーバ6と、
シフトレジスタ4のロード端子LDにパルス信号
Spを供給するレシーバ7と、シフトレジスタ4
の直列出力端Soutから供給される直列データDs
を増幅して伝送路3に供給するドライバ8とから
構成される。ここで、デジタルスイツチ5a〜5
dは油の単価を設定するもので、5aは千の位、
5bは百の位、5cは十の位、5dは一の位を
各々手動で設定するためのものである。そして各
デジタルスイツチ5a〜5dからは設定値に対応
するBCD(binary coded decimal)符号が出力
される。 First, transmitting circuit 1 converts parallel data Dp into serial data.
16-bit shift register 4 for converting to Ds,
A digital switch (for example, a digital Samir switch) 5 supplies parallel data Dp of 4 bits each, a total of 16 bits, to the parallel input terminal of the shift register 4.
a to 5d and the clock terminal of shift register 4
a receiver 6 that applies a clock signal φ to CK;
Pulse signal to load terminal LD of shift register 4
Receiver 7 that supplies Sp and shift register 4
The serial data Ds supplied from the series output terminal Sout of
and a driver 8 that amplifies and supplies the amplified signal to the transmission line 3. Here, the digital switches 5a to 5
d is for setting the unit price of oil, 5a is in the thousandth place,
5b is for manually setting the hundreds digit, 5c is for the tens digit, and 5d is for manually setting the ones digit. Each of the digital switches 5a to 5d outputs a BCD (binary coded decimal) code corresponding to the set value.
次に受信回路2は、直列データDsを並列デー
タDpに変換する16ビツトのシフトレジスタ10
と、直列データDsを受信して前記シフトレジス
タ10の直列入力端Sinに供給するレシーバ11
と、シフトレジスタ10の並列出力端から供給さ
れる16ビツトの並列データDpをラツチするラツ
チ回路12と、前記ラツチ回路12から供給され
る並列データDpに基づいて給油代金を算出する
計量機制御装置13と、シフトレジスタ10のク
ロツク端子CKに一定周期Tのクロツクパルスφ
を供給する発振器14と、前記クロツクパルスφ
を1/16に分周してパルス信号Spを形成し、これ
をラツチ回路12のクロツク端子CKへ供給する
分周回路15と、前記クロツクパルスφおよびパ
ルス信号Spを各々送信回路1側に伝送するドラ
イバ16および17とから構成される。 Next, the receiving circuit 2 includes a 16-bit shift register 10 that converts the serial data Ds into parallel data Dp.
and a receiver 11 that receives the serial data Ds and supplies it to the serial input terminal Sin of the shift register 10.
, a latch circuit 12 that latches the 16-bit parallel data Dp supplied from the parallel output terminal of the shift register 10, and a meter control device that calculates the refueling price based on the parallel data Dp supplied from the latch circuit 12. 13, and a clock pulse φ with a constant period T is applied to the clock terminal CK of the shift register 10.
an oscillator 14 that supplies the clock pulse φ
A frequency divider circuit 15 divides the clock pulse φ by 1/16 to form a pulse signal Sp, and supplies this to the clock terminal CK of the latch circuit 12, and transmits the clock pulse φ and the pulse signal Sp to the transmitting circuit 1 side, respectively. It is composed of drivers 16 and 17.
また、伝送路3は、ドライバ8とレシーバ11
とを結び直列データDsを伝送する伝送路3a、
ドライバ16とレシーバ6とを結びクロツクパル
スφを伝送する伝送路3bおよびドライバ17と
レシーバ7とを結びパルス信号Spを伝送する伝
送路3cからなつている。 Furthermore, the transmission path 3 includes a driver 8 and a receiver 11.
a transmission line 3a that connects and transmits serial data Ds,
The transmission line 3b connects the driver 16 and the receiver 6 and transmits the clock pulse φ, and the transmission line 3c connects the driver 17 and the receiver 7 and transmits the pulse signal Sp.
このような構成において、デジタルスイツチ5
a〜5dによつて単価「1234」を設定した場合を
例にとつて、本実施例の動作を説明する。この場
合、デジタルスイツチ5aが「1」に、5bが
「2」に、5cが「3」に、5dが「4」に各々
手動設定される。また、受信回路2側に設けられ
た発振器14は常時クロツクパルスφを出力して
おり、これによつてシフトレジスタ4,10の各
クロツク端子CKにはクロツクパルスφが、シフ
トレジスタ4のロード端子LDとラツチ回路12
のクロツク端子CKにはパルス信号Spが常時印加
されている。ここで、パルス信号Spの周期はク
ロツクパルスφの周期Tの16倍となつている。 In such a configuration, the digital switch 5
The operation of this embodiment will be explained by taking as an example the case where the unit price "1234" is set by a to 5d. In this case, the digital switch 5a is manually set to "1", the digital switch 5b to "2", the digital switch 5c to "3", and the digital switch 5d to "4". Further, the oscillator 14 provided on the side of the receiving circuit 2 constantly outputs a clock pulse φ, so that the clock pulse φ is sent to each clock terminal CK of the shift registers 4 and 10, and to the load terminal LD of the shift register 4. Latch circuit 12
A pulse signal Sp is constantly applied to the clock terminal CK of the circuit. Here, the period of the pulse signal Sp is 16 times the period T of the clock pulse φ.
このような設定において、第2図に示す時刻t1
に分周回路15からパルス信号Spが出力され、
これがシフトレジスタ4のロード端子LDに供給
されると、その立上りでシフトレジスタ4の各ビ
ツトには並列データDpがセツトされる。すなわ
ち、シフトレジスタ4の第0〜第3ビツトには
「1」が、第4〜第7ビツトには「2」が、第8
〜第11ビツトには「3」が、第12〜第15ビツトに
は「4」が各々BCD符号によつて記憶され、こ
れによつて第3,6,10,11,13の各ビツトが
“1”信号に、他の各ビツトが“0”信号にセツ
トされる。こうしてセツトされたシフトレジスタ
4の内容X0〜X16(Xiは第iビツト目の内容)は
クロツクパルスφが立上る毎に1ビツトずつシフ
トされ直列出力端Soutから直列データDsとして
順次出力される。すなわち、第2図ハに示すよう
に時刻t1〜t1+3T/2の間は信号X0が出力され、
以後時間T毎に順次信号X0→X1→……X15と出力
される。したがつて今の場合、直列データDsは
“0”→“0”→“0”→“1”→……→“1”
→“0”→“0”となる(第2図ハ参照)。こう
して並列データDpはシフトレジスタ4によつて
直列データDsに変換され、ドライバ8、伝送路
3aを介して受信回路2へ伝送される。 In such a setting, the time t 1 shown in FIG.
A pulse signal Sp is output from the frequency dividing circuit 15,
When this is supplied to the load terminal LD of the shift register 4, parallel data Dp is set in each bit of the shift register 4 at the rising edge. That is, the 0th to 3rd bits of the shift register 4 are "1", the 4th to 7th bits are "2", and the 8th bit is "1".
~ “3” is stored in the 11th bit and “4” is stored in the 12th to 15th bits using BCD codes, so that each of the 3rd, 6th, 10th, 11th, and 13th bits is The other bits are set to a "1" signal and each other bit is set to a "0" signal. The thus set contents X 0 to X 16 (X i is the contents of the i-th bit) of the shift register 4 are shifted one bit at a time every time the clock pulse φ rises and are sequentially output as serial data Ds from the serial output terminal Sout. Ru. That is, as shown in FIG. 2C, the signal X 0 is output between time t 1 and t 1 +3T/2,
Thereafter, the signals are sequentially outputted every time T as follows: X 0 →X 1 →...X 15 . Therefore, in this case, the serial data Ds is “0”→“0”→“0”→“1”→……→“1”
→ “0” → “0” (see Figure 2 C). In this way, the parallel data Dp is converted into serial data Ds by the shift register 4, and transmitted to the receiving circuit 2 via the driver 8 and the transmission line 3a.
受信回路2へ伝送された直列データDsはレシ
ーバ11を介してシフトレジスタ10の直列入力
端Sinに印加され、クロツク信号φの立下り時に
順次シフトレジスタ10に読み込まれる。すなわ
ち時刻t1から時間T経過後に信号X0が、時刻t1か
ら時間2T経過後に信号X1が……時刻t1から時間
16T経過後の時刻t2に信号X15が順次シフトレジ
スタ10に取込まれ、シフトレジスタ10の第0
ビツトには信号X0が、第1ビツトには信号X1が
……第15ビツトには信号X15がセツトされる。そ
して時刻t2から時間T後の時刻t3にパルス信号Sp
の立下りによつて前記信号X0〜X15からなる並列
データDp(今の場合「1234」)がラツチ回路12
にラツチされる。こうして1サイクルの送受信が
終了し、以下同様のサイクルが繰返される。ま
た、ラツチ回路12にラツチされた並列データ
Dpは必要に応じて計量機制御装置13に読み込
まれ、この並列データDp(単価)と給油量とから
給油代金が算出される。 The serial data Ds transmitted to the receiving circuit 2 is applied to the serial input terminal Sin of the shift register 10 via the receiver 11, and is sequentially read into the shift register 10 at the falling edge of the clock signal φ. In other words, after time T has passed since time t 1 , signal X 0 has passed, and after time 2T has passed since time t 1 , signal X 1 has passed...
At time t2 after 16T has elapsed, the signal X15 is sequentially taken into the shift register 10, and
The signal X0 is set to the bit, the signal X1 is set to the first bit, and the signal X15 is set to the 15th bit. Then, at time t 3 after time T from time t 2 , the pulse signal Sp
The parallel data Dp (in this case " 1234 ") consisting of the signals X 0 to
is latched to. In this way, one cycle of transmission and reception is completed, and the same cycle is repeated thereafter. In addition, parallel data latched in the latch circuit 12
Dp is read into the weighing machine control device 13 as necessary, and the refueling price is calculated from this parallel data Dp (unit price) and the refueling amount.
なお、上述したレシーバ6,7,11にフオト
カプラを使用すれば送信回路1と受信回路2とを
電気的にアイソレートすることができ、これによ
つて計量機の防爆作用を向上させることが可能と
なる。また、上記実施例は単価データの直列伝送
を例にとつて説明したが他のデータも同様の方法
で伝送できることは勿論である。 Note that if a photocoupler is used in the receivers 6, 7, and 11 described above, the transmitting circuit 1 and the receiving circuit 2 can be electrically isolated, thereby improving the explosion-proofing effect of the weighing machine. becomes. Further, although the above embodiment has been described by taking as an example the serial transmission of unit price data, it is of course possible to transmit other data in a similar manner.
以上説明したようにこの考案はクロツクパルス
を出力する発振器と、前記クロツクパルスを分周
して一定周期のパルス信号を出力する分周回路
と、これら2系列のパルスに基づいて並列データ
を直列データに変換してシリアル送信する送信回
路と、前記2系列のパルスに基づいて前記直列デ
ータを並列データに変換する受信回路とを具備す
るので、3本の伝送線のみでデータを転送するこ
とができる。また受信側に発振器と分周回路とを
設ければ受信側が送信側をコントロールすること
ができるので空送り等が回避され、装置の信頼性
を高めることができる。さらに特殊なICを使用
する必要がなく、回路構成も簡単化されるので装
置が安価になる利点が得られる。また、受信側に
は常時最新のデータが得られる効果がある。 As explained above, this invention consists of an oscillator that outputs clock pulses, a frequency dividing circuit that divides the frequency of the clock pulse and outputs a pulse signal of a constant period, and converts parallel data into serial data based on these two series of pulses. Since the transmitting circuit includes a transmitting circuit that serially transmits data, and a receiving circuit that converts the serial data into parallel data based on the two series of pulses, data can be transferred using only three transmission lines. Furthermore, if an oscillator and a frequency dividing circuit are provided on the receiving side, the receiving side can control the transmitting side, thereby avoiding idle feeds and the like, thereby increasing the reliability of the device. Furthermore, since there is no need to use a special IC and the circuit configuration is simplified, the device has the advantage of being cheaper. Additionally, the receiving side has the effect of always being able to obtain the latest data.
第1図は本考案の一実施例の構成を示すブロツ
ク図、第2図はクロツクパルスφ、パルス信号
Spおよび直列データDsの波形を示す波形図であ
る。
3……伝送路、4……シフトレジスタ(並直列
変換回路)、10……シフトレジスタ(直並列変
換回路)、12……ラツチ回路、14……発振器、
15……分周回路、Dp……並列データ、Ds……
直列データ、Sp……パルス信号(分周回路の出
力信号)、φ……クロツクパルス。
Fig. 1 is a block diagram showing the configuration of an embodiment of the present invention, and Fig. 2 shows the clock pulse φ and the pulse signal.
FIG. 3 is a waveform diagram showing waveforms of Sp and serial data Ds. 3... Transmission line, 4... Shift register (parallel/serial conversion circuit), 10... Shift register (serial/parallel conversion circuit), 12... Latch circuit, 14... Oscillator,
15... Frequency divider circuit, Dp... Parallel data, Ds...
Serial data, Sp...pulse signal (output signal of frequency divider circuit), φ...clock pulse.
Claims (1)
回路と、前記直列データをシリアル伝送する伝送
路と、前記伝送路を介して伝送された前記直列デ
ータを並列データに変換する直並列変換回路と、
前記直並列変換して得られた並列データをラツチ
するラツチ回路と、前記並直列変換回路および前
記直並列変換回路にクロツクパルスを供給する発
振器と、前記クロツクパルスを分周してその出力
パルスを前記並直列変換回路のロード端子および
前記ラツチ回路のクロツク端子に供給する分周回
路とを具備することを特徴とする給油装置におけ
る直列データ転送装置。 a parallel-serial conversion circuit that converts parallel data into serial data; a transmission path that serially transmits the serial data; and a serial-parallel conversion circuit that converts the serial data transmitted via the transmission path into parallel data;
a latch circuit that latches the parallel data obtained by the serial-parallel conversion; an oscillator that supplies clock pulses to the parallel-serial conversion circuit and the serial-parallel conversion circuit; and an oscillator that divides the frequency of the clock pulse and converts the output pulse to the 1. A serial data transfer device for a fuel supply system, comprising a frequency dividing circuit that supplies a load terminal of a serial conversion circuit and a clock terminal of the latch circuit.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3872183U JPS59147244U (en) | 1983-03-17 | 1983-03-17 | Serial data transfer device in oil supply system |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3872183U JPS59147244U (en) | 1983-03-17 | 1983-03-17 | Serial data transfer device in oil supply system |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS59147244U JPS59147244U (en) | 1984-10-02 |
JPS6319860Y2 true JPS6319860Y2 (en) | 1988-06-02 |
Family
ID=30169386
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3872183U Granted JPS59147244U (en) | 1983-03-17 | 1983-03-17 | Serial data transfer device in oil supply system |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59147244U (en) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0828669B2 (en) * | 1985-12-12 | 1996-03-21 | 日本電気株式会社 | High-speed data processing method |
-
1983
- 1983-03-17 JP JP3872183U patent/JPS59147244U/en active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS59147244U (en) | 1984-10-02 |
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