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JPS5974648A - スパツタ装置 - Google Patents

スパツタ装置

Info

Publication number
JPS5974648A
JPS5974648A JP18456282A JP18456282A JPS5974648A JP S5974648 A JPS5974648 A JP S5974648A JP 18456282 A JP18456282 A JP 18456282A JP 18456282 A JP18456282 A JP 18456282A JP S5974648 A JPS5974648 A JP S5974648A
Authority
JP
Japan
Prior art keywords
substrate
angle
targets
sputtered
target
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP18456282A
Other languages
English (en)
Inventor
Hideji Ogishi
大岸 秀次
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP18456282A priority Critical patent/JPS5974648A/ja
Publication of JPS5974648A publication Critical patent/JPS5974648A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Electrodes Of Semiconductors (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明はスパッタ装置、特に、被スパツタ基板の段差部
の膜質を向上させることのできるスパッタ装置に関する
最近、高集積度の半導体集積回路においては、ワード線
の低抵抗化のためにゲート電極としてポリシリコンとシ
リサイドよりなるポリサイド構造を用t・ることが提案
されて(・る。
ところが、このような構造においては、ワード線の段差
部においてシリサイドの膜比抵抗が異常に高くなり、段
差部の膜質が低下するという問題点がある。
本発明の目的は、前記した問題点を解決するためになさ
れたもので、被スパツタ基板の段差部における膜比抵抗
を低下させ、段差部の膜質ケ向上させることのできるス
パッタ装置を提供することにある。
以下、本発明乞図面に示す一実施例にしたがって詳細に
説明する。
第1図は本発明によるスパッタ装置の一実施例を示す断
面図である。
この実施例にお(・て、スパッタ用の真空容器1の内部
には、スパッタ源の陰極を構成するシリコン<S; )
のターゲット2が2個およびモリブデン(MO)または
タンタル(Ta)等のターゲット3が配置されている。
これらのターゲット2および3の上方には、シリコンウ
ェハよりなる被スパツタ基板4(第2図)ン自転可能に
支持する支持治具であるサテライト治具5がレール6に
より回転可能に支持されている。このレール6自体も水
平面内で回転できる。
したがって、本実施例では、級スパッタ基板4はサテラ
イト治具5により、自転および公転可能に支持されてい
ることになろう また、前記真空容器1の底部には、該真空容器1内ケ排
気して真空状態にfるための真空排気路7が設けられて
いる。
さらに、本実施例におけろ前記ターゲット2の周囲と下
部(図示せず)には、磁界発生用の永久磁石8(第2図
参照)が配置されている。
また、第2図に示すように、前記ターゲット2の下側に
は、該ターゲツト20角度ヶ可変にするための角度可変
装置10が設置されて(・る。この角度可変装置10に
より、ターゲット10は被スパツタ基板4に対する角度
ン自白に変えることができる。
次に、本実施例の作用につ(・て説明する。
この実施例では、スパッタ源の陰極乞構成するターゲッ
ト2および3が角度可変装置10により、サテライト治
具5で支持された併スバ、・夕基板4に対する角度を自
由に可変調整できるので、たとえば被スパック基板4上
に形成された段差部11が存在するような場合でも、第
3図に示すように、ターゲツト20角度を二点鎖線位置
から実線位置に変えることにより、段差部11に対する
スパッタ膜形成物質の入射角は実線位置の場合の方が二
点鎖線位置の場合よりも太き(なる。
すなわち、段差部11に対するスパッタ膜形成物質の入
射角が大きくなると、実質的に段差角度が小さくなった
のと同等な状態が得られることになり、段差部11に対
するカバレッジが改善されるので、この段差部11に形
成されるスパッタ膜(シリサイド膜)の比抵抗は入射角
が小さく・場合に比べて著しく低下し、段差部11以外
の部分との差が小さくなり、段差部11のシリサイド膜
の膜質が大巾に向上する。その結果、被スパツタ基板4
上に形成されるワード線の段差部11における膜比抵抗
の低下による半導体集積回路のアクセスタイムが短縮さ
れ、高速化が可能になる。
また、本実施例におり・ては、サテライ)?白兵5で支
持される各祖スノくツタ基板4が回転および公転可能で
あるので、スノくツタ装置のステップカッくレッジン改
善することができると(・う利点もj得られろ。
なお、本発明は前記実施例に限定されるものでは′t、
c<、他の様々な変形が可能であり、本発明Q′!それ
らも含むものである。
以上説明したように、本発明によれ番了、被スノくツタ
基板の段差部における膜比机抗をターゲットの角度の可
変調整により大巾に低下さ−ぜることカーでき、段差部
のスノくツタ膜の膜質な向上させろことができる。
【図面の簡単な説明】
第1図は本発明によるスノくツタ装置の一実施例を示す
略断面図、 第2図は本発明のターゲット角度可変機構7示す概略的
説明図、 第3図は本発明による段差部への入射角可変状態7示す
概略的説明図である。 1・・・真空容器、2・・・ターゲ・ノド(陰極)、3
・・・陽極、4・・・被スパツタ基板、5・・・サテラ
イト治具(支持治具)、6・・・レール、7・・・真空
排気路、8・・・電磁石、lO・・・角度可変装置、1
1・・・段差部。 代yx :ff埋1 薄61゛1幸7、−)。 ゴ   y 第  1  図 第  2 図 第  3  図

Claims (1)

  1. 【特許請求の範囲】 1、被スパッタ基板ケ支持治具に対して自公転可能に支
    持すると共に、この被スパッタ基板ニ対向する位置にタ
    ーゲットを配置したスパッタ装置において、ターゲット
    の角度を可変としたことを特徴とするスパッタ装置。 2、ターゲットが被スパツタ基板の段差部に対する入射
    角を太き(する方向に移動可能であることを特徴とする
    特許請求の範囲第1項記載のスパッタ装置。
JP18456282A 1982-10-22 1982-10-22 スパツタ装置 Pending JPS5974648A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP18456282A JPS5974648A (ja) 1982-10-22 1982-10-22 スパツタ装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP18456282A JPS5974648A (ja) 1982-10-22 1982-10-22 スパツタ装置

Publications (1)

Publication Number Publication Date
JPS5974648A true JPS5974648A (ja) 1984-04-27

Family

ID=16155373

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18456282A Pending JPS5974648A (ja) 1982-10-22 1982-10-22 スパツタ装置

Country Status (1)

Country Link
JP (1) JPS5974648A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5015352A (en) * 1988-10-15 1991-05-14 Yoshida Kogyo K.K. Preparation method for amorphous superlattice alloys
US5328582A (en) * 1992-12-04 1994-07-12 Honeywell Inc. Off-axis magnetron sputter deposition of mirrors
US5879519A (en) * 1988-02-08 1999-03-09 Optical Coating Laboratory, Inc. Geometries and configurations for magnetron sputtering apparatus

Cited By (3)

* Cited by examiner, † Cited by third party
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US5015352A (en) * 1988-10-15 1991-05-14 Yoshida Kogyo K.K. Preparation method for amorphous superlattice alloys
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