JPH11282991A - Ｉｃカード - Google Patents
ＩｃカードInfo
- Publication number
- JPH11282991A JPH11282991A JP10083468A JP8346898A JPH11282991A JP H11282991 A JPH11282991 A JP H11282991A JP 10083468 A JP10083468 A JP 10083468A JP 8346898 A JP8346898 A JP 8346898A JP H11282991 A JPH11282991 A JP H11282991A
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- JP
- Japan
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- command
- execution order
- icc
- order
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Abstract
(57)【要約】
【課題】 予め定められた順序でコマンドが送信されな
い場合はエラーにして不正な使用を防ぐ。 【解決手段】 命令入力部１１、応答出力部１５、命令
解析部１２、命令処理実行部１３、データを記憶する不
揮発性メモリ１４を備えたＩＣカードにおいて、不揮発
性メモリ１４に命令の実行順序を登録したテーブル１４
ａを備えたものである。
い場合はエラーにして不正な使用を防ぐ。 【解決手段】 命令入力部１１、応答出力部１５、命令
解析部１２、命令処理実行部１３、データを記憶する不
揮発性メモリ１４を備えたＩＣカードにおいて、不揮発
性メモリ１４に命令の実行順序を登録したテーブル１４
ａを備えたものである。
Description
【０００１】
【発明の属する技術分野】本発明はＩＣカード（ＩＣ
Ｃ）に関する。
Ｃ）に関する。
【０００２】
【従来の技術】近年、クレジットカードやプリペイドカ
ード等さまざまな形でＩＣＣが使用され、ＣＰＵを内蔵
して利便性の観点からいろいろな機能が付加されて汎用
性を持たせたものが開発されている。このような従来の
ＩＣＣについてその概略を説明する。図８において、Ｃ
ＰＵを内蔵したＩＣＣ１は、接続装置２（インターフェ
ース・デバイス：ＩＦＤ）からの処理要求であるコマン
ド（命令）を受け付けるコマンド入力部１１、受け付け
たコマンドを解析するコマンド解析部１２、解析したコ
マンドに基づき要求されている処理を実行する要求処理
実行部１３、処理の実行過程においてアクセスされるメ
モリ１４、処理結果をレスポンスとして接続装置２へ返
すレスポンス出力部とからなっている。
ード等さまざまな形でＩＣＣが使用され、ＣＰＵを内蔵
して利便性の観点からいろいろな機能が付加されて汎用
性を持たせたものが開発されている。このような従来の
ＩＣＣについてその概略を説明する。図８において、Ｃ
ＰＵを内蔵したＩＣＣ１は、接続装置２（インターフェ
ース・デバイス：ＩＦＤ）からの処理要求であるコマン
ド（命令）を受け付けるコマンド入力部１１、受け付け
たコマンドを解析するコマンド解析部１２、解析したコ
マンドに基づき要求されている処理を実行する要求処理
実行部１３、処理の実行過程においてアクセスされるメ
モリ１４、処理結果をレスポンスとして接続装置２へ返
すレスポンス出力部とからなっている。
【０００３】接続装置２とＩＣＣ１の間で交換される情
報（コマンド、レスポンス）の最小単位はキャラクタで
あり、図９に示すように、先頭からスタートビット（Ｓ
Ｔ）、８個のデータビット（ａ〜ｈ）・パリティビット
（ｉ）の順に送信され、直後にキャラクタ保護時間（Ｇ
Ｔ）が１ビット以上続く形になっている。
報（コマンド、レスポンス）の最小単位はキャラクタで
あり、図９に示すように、先頭からスタートビット（Ｓ
Ｔ）、８個のデータビット（ａ〜ｈ）・パリティビット
（ｉ）の順に送信され、直後にキャラクタ保護時間（Ｇ
Ｔ）が１ビット以上続く形になっている。
【０００４】このようなキャラクタ複数個から、例えば
Ｔ＝１ブロック伝送プロトコルを利用する場合、図１０
に示すような情報ブロックが構成される。情報ブロック
は、先頭フィールド、情報フィールド（ＩＮＦ）、最終
フィールドからなり、先頭フィールドは、ブロックの送
信元のアドレス、あて先アドレス及びＶＰＰ端子の状態
制御を示すノードアドレス（ＮＡＤ）１バイト、伝送制
御情報を含むプロトコル制御バイト（ＰＣＢ）１バイ
ト、および情報フィールド長（ＬＥＮ）１バイトからな
り、情報フィールドは、最大２５４バイトまで挿入可能
であり、ブロックの最後は必ず誤り検出符合（ＥＤＣ）
１または２バイトとなる。なお、各１バイトには、実際
にはＳＴビット、パリティ検査ビット、ＧＴが付加され
ている。
Ｔ＝１ブロック伝送プロトコルを利用する場合、図１０
に示すような情報ブロックが構成される。情報ブロック
は、先頭フィールド、情報フィールド（ＩＮＦ）、最終
フィールドからなり、先頭フィールドは、ブロックの送
信元のアドレス、あて先アドレス及びＶＰＰ端子の状態
制御を示すノードアドレス（ＮＡＤ）１バイト、伝送制
御情報を含むプロトコル制御バイト（ＰＣＢ）１バイ
ト、および情報フィールド長（ＬＥＮ）１バイトからな
り、情報フィールドは、最大２５４バイトまで挿入可能
であり、ブロックの最後は必ず誤り検出符合（ＥＤＣ）
１または２バイトとなる。なお、各１バイトには、実際
にはＳＴビット、パリティ検査ビット、ＧＴが付加され
ている。
【０００５】接続装置２からＩＣＣ１に送られるコマン
ドは図１０に示すブロックの情報フィールド内に収めら
れ、図１１に示すように、見出し部と本体部から構成さ
れる。見出し部は、ＩＳＯのコマンドか否かを示すクラ
スバイト（ＣＬＡ）、命令コード（ＩＮＳ）、アクセス
するファイルを指示するパラメータＰ１、Ｐ２からな
り、本体部はコマンドデータフィールドバイト長（Ｌ
ｃ）、コマンドデータフィールド（ｃデータ：可変
長）、レスポンスデータフィールド長（Ｌｅ）からなっ
ている。
ドは図１０に示すブロックの情報フィールド内に収めら
れ、図１１に示すように、見出し部と本体部から構成さ
れる。見出し部は、ＩＳＯのコマンドか否かを示すクラ
スバイト（ＣＬＡ）、命令コード（ＩＮＳ）、アクセス
するファイルを指示するパラメータＰ１、Ｐ２からな
り、本体部はコマンドデータフィールドバイト長（Ｌ
ｃ）、コマンドデータフィールド（ｃデータ：可変
長）、レスポンスデータフィールド長（Ｌｅ）からなっ
ている。
【０００６】また、ＩＣＣ１から接続装置２へ送られる
レスポンスは、図１２に示すように、本体部、後続部か
らなり、先頭からレスポンスデータフィールド（ｒデー
タ）、処理結果を示すステータスデータバイト１（ＳＷ
１）、ステータスデータバイト２（ＳＷ２）の順に送ら
れる。
レスポンスは、図１２に示すように、本体部、後続部か
らなり、先頭からレスポンスデータフィールド（ｒデー
タ）、処理結果を示すステータスデータバイト１（ＳＷ
１）、ステータスデータバイト２（ＳＷ２）の順に送ら
れる。
【０００７】
【発明が解決しようとする課題】ところで、ＩＣＣでは
その内部で実行するコマンドのシーケンス（順序）に関
してほとんどチェック機能を持たず、外部システム（接
続装置）側での管理に任されていた。しかし、近年では
偽造ＩＣカードや偽造端末による不正を防ぐためにＩＣ
カード利用シーケンスを監視する機能がＩＣカード側に
も必要になってきた。
その内部で実行するコマンドのシーケンス（順序）に関
してほとんどチェック機能を持たず、外部システム（接
続装置）側での管理に任されていた。しかし、近年では
偽造ＩＣカードや偽造端末による不正を防ぐためにＩＣ
カード利用シーケンスを監視する機能がＩＣカード側に
も必要になってきた。
【０００８】本発明は上記課題を解決するためのもの
で、ＩＣカード内にチェック機構を設け、予め定められ
た順序でコマンドが送信されない場合はエラーとして処
理することにより、不正な使用を防ぐことを目的とする
ものである。
で、ＩＣカード内にチェック機構を設け、予め定められ
た順序でコマンドが送信されない場合はエラーとして処
理することにより、不正な使用を防ぐことを目的とする
ものである。
【０００９】
【課題を解決するための手段】本発明は、命令入力部、
応答出力部、命令解析部、命令処理実行部、データを記
憶する不揮発性メモリを備えたＩＣカードにおいて、不
揮発性メモリに命令の実行順序を登録したテーブルを備
えたことを特徴とする。また本発明は、各命令が実行順
序を示す番号を備えたことを特徴とする。また本発明
は、認証が成立したことを条件に、前記テーブルに規定
された実行順序を書き換えることができる専用の命令を
有することを特徴とする。
応答出力部、命令解析部、命令処理実行部、データを記
憶する不揮発性メモリを備えたＩＣカードにおいて、不
揮発性メモリに命令の実行順序を登録したテーブルを備
えたことを特徴とする。また本発明は、各命令が実行順
序を示す番号を備えたことを特徴とする。また本発明
は、認証が成立したことを条件に、前記テーブルに規定
された実行順序を書き換えることができる専用の命令を
有することを特徴とする。
【００１０】
【発明の実施の形態】以下、本発明の実施の形態につい
て説明する。図１は本発明のＩＣＣを説明する図であ
り、図８と同一参照数字は同一内容を示している。図２
は本発明において用いられるコマンドの構成を説明する
図、図３は使用されるコマンドの例を説明する図、図４
は実行順序テーブルを説明する図である。図１に示すＩ
ＣＣは、メモリ１４内にコマンドの実行順序を規定する
実行順序テーブル１４ａを備えた以外は図８で説明した
ものと同じであるので、その詳細な説明は省略する。本
発明においては、ＩＣＣのサポートするコマンドそれぞ
れがユニークなコマンド番号を持ち、その実行順序がコ
マンド番号を使ってテーブル１４ａに登録されており、
登録された実行順序に合致するコマンドは適正に処理さ
れ、それに合致しないコマンドはエラーとなる。
て説明する。図１は本発明のＩＣＣを説明する図であ
り、図８と同一参照数字は同一内容を示している。図２
は本発明において用いられるコマンドの構成を説明する
図、図３は使用されるコマンドの例を説明する図、図４
は実行順序テーブルを説明する図である。図１に示すＩ
ＣＣは、メモリ１４内にコマンドの実行順序を規定する
実行順序テーブル１４ａを備えた以外は図８で説明した
ものと同じであるので、その詳細な説明は省略する。本
発明においては、ＩＣＣのサポートするコマンドそれぞ
れがユニークなコマンド番号を持ち、その実行順序がコ
マンド番号を使ってテーブル１４ａに登録されており、
登録された実行順序に合致するコマンドは適正に処理さ
れ、それに合致しないコマンドはエラーとなる。
【００１１】例えば、ＩＣＣが３つのコマンド、ＲＥＡ
Ｄ（読取り）コマンド、ＷＲＩＴＥ（書き込み）コマン
ド、ＥＲＡＳＥ（消去）コマンドをサポートしていると
すると、図３に示すようにそれぞれにコマンド番号０
１、０２、０３が割当られ、さらにＶＥＲＩＦＹ（認
証）コマンドには０４を割り当てる。このコマンド番号
を利用して実行順序テーブル１４ａには予めその順番が
登録されている。コマンド番号はコマンドコード（ＩＮ
Ｓ）を利用するのがよい。
Ｄ（読取り）コマンド、ＷＲＩＴＥ（書き込み）コマン
ド、ＥＲＡＳＥ（消去）コマンドをサポートしていると
すると、図３に示すようにそれぞれにコマンド番号０
１、０２、０３が割当られ、さらにＶＥＲＩＦＹ（認
証）コマンドには０４を割り当てる。このコマンド番号
を利用して実行順序テーブル１４ａには予めその順番が
登録されている。コマンド番号はコマンドコード（ＩＮ
Ｓ）を利用するのがよい。
【００１２】図４（ａ）は実行順序テーブルの１例を示
すもので、リッセト（活性化）直後のコマンドにのみ適
用するのか否かのフラグがＯＮになっている場合を例に
説明する。このフラグは、図４（ｂ）に示すように、０
０の場合はリセット直後のコマンドに適用、０１の場合
はリセット直後のコマンド以外にも適用するものであ
る。もちろんこのような規定をせず、常時コマンド順序
が適用されるようにしてもよい。この例では、１コマン
ド目がコマンド番号０３、２コマンド目がコマンド番号
０２となっている場合に正常処理が行われ、これ以外の
順番ではエラとなる。すなわち、１コマンド目に記載さ
れているコマンドを受信すると、次のコマンドは２番目
に指定されているコマンド以外は受付なくなり、ＩＣＣ
からはエラーステータスが返される。こうして誤ったコ
マンドシーケンスによる利用を防止することができる。
なお、番号を付して前後の順番を間違わないようにする
コマンドは、特に重要なコマンドに対して行うようにし
ても良く、また番号を付すコマンドの数はテーブルの許
す範囲で広げることができる。
すもので、リッセト（活性化）直後のコマンドにのみ適
用するのか否かのフラグがＯＮになっている場合を例に
説明する。このフラグは、図４（ｂ）に示すように、０
０の場合はリセット直後のコマンドに適用、０１の場合
はリセット直後のコマンド以外にも適用するものであ
る。もちろんこのような規定をせず、常時コマンド順序
が適用されるようにしてもよい。この例では、１コマン
ド目がコマンド番号０３、２コマンド目がコマンド番号
０２となっている場合に正常処理が行われ、これ以外の
順番ではエラとなる。すなわち、１コマンド目に記載さ
れているコマンドを受信すると、次のコマンドは２番目
に指定されているコマンド以外は受付なくなり、ＩＣＣ
からはエラーステータスが返される。こうして誤ったコ
マンドシーケンスによる利用を防止することができる。
なお、番号を付して前後の順番を間違わないようにする
コマンドは、特に重要なコマンドに対して行うようにし
ても良く、また番号を付すコマンドの数はテーブルの許
す範囲で広げることができる。
【００１３】図５は実行順序指定によるコマンド処理の
１例を示す処理フローであり、この処理では送信される
コマンド１つ１つについての処理を実行し、順番が間違
った段階でエラーステータスを返すものである。ＩＣＣ
を活性化し、外部からＩＣＣへコマンドが送信される
と、ＩＣＣではコマンド受信処理を行う（ステップＳ１
〜Ｓ３）。次いで、ＩＣＣでは図４（ｂ）に示したフラ
グのチェックを行い、フラグがセットされているか否か
を判断する（ステップＳ４、Ｓ５）。フラグがセットさ
れている場合は、リセット直後のコマンドにのみ適用さ
れるため、リセット直後のコマンドか否かを判断し、リ
セット直後のコマンドであれば、テーブルチェックを行
い、また、ステップＳ５でフラグがリセットされている
場合はリセット直後以外のコマンドにも適用されるため
テーブルチェックを行う（ステップＳ６、Ｓ７）。テー
ブルチェックを行ってコマンド実行順序が一致している
場合、あるいはステップＳ６でリセット直後のコマンド
でない場合は、そのままコマンド処理を実行し（ステッ
プＳ９）、ＩＣＣから正常な処理が行われたことを接続
装置へレスポンスとして返し（ステップＳ１０）、以上
の処理が最後のコマンドまで実行される（ステップＳ１
１）。また、ステップＳ８において、テーブルに登録し
た実行順序と不一致の場合には、その時点でレスポンス
処理でエラーステータスを返し処理を終了する。
１例を示す処理フローであり、この処理では送信される
コマンド１つ１つについての処理を実行し、順番が間違
った段階でエラーステータスを返すものである。ＩＣＣ
を活性化し、外部からＩＣＣへコマンドが送信される
と、ＩＣＣではコマンド受信処理を行う（ステップＳ１
〜Ｓ３）。次いで、ＩＣＣでは図４（ｂ）に示したフラ
グのチェックを行い、フラグがセットされているか否か
を判断する（ステップＳ４、Ｓ５）。フラグがセットさ
れている場合は、リセット直後のコマンドにのみ適用さ
れるため、リセット直後のコマンドか否かを判断し、リ
セット直後のコマンドであれば、テーブルチェックを行
い、また、ステップＳ５でフラグがリセットされている
場合はリセット直後以外のコマンドにも適用されるため
テーブルチェックを行う（ステップＳ６、Ｓ７）。テー
ブルチェックを行ってコマンド実行順序が一致している
場合、あるいはステップＳ６でリセット直後のコマンド
でない場合は、そのままコマンド処理を実行し（ステッ
プＳ９）、ＩＣＣから正常な処理が行われたことを接続
装置へレスポンスとして返し（ステップＳ１０）、以上
の処理が最後のコマンドまで実行される（ステップＳ１
１）。また、ステップＳ８において、テーブルに登録し
た実行順序と不一致の場合には、その時点でレスポンス
処理でエラーステータスを返し処理を終了する。
【００１４】前述したように、コマンドの実行順序は不
揮発性メモリにテーブルとして登録されているが、この
実行順序は専用のコマンドを用いてＩＣＣ発行処理後に
変更するようにしてもよく、そうした例について以下に
説明する。図６は実行順序テーブルを書き換える専用の
コマンドの構成を示し、例えば命令コードが９９の場合
はこの専用のコマンドとする。専用コマンドのデータ部
の００は図４（ｂ）で示したフラグに相当し、このコマ
ンドではリセット直後に適用することを示している。次
の２バイトの０１、０２はコマンドの実行順序を示して
いる。こうしてリセット直後に適用か否かのフラグと、
コマンド実行順序が新たに書き換えられる。なお、この
コマンドは認証処理が成功したときのみ行えることと
し、正当な権利を持つ人以外は実行できないようにして
おく必要がある。
揮発性メモリにテーブルとして登録されているが、この
実行順序は専用のコマンドを用いてＩＣＣ発行処理後に
変更するようにしてもよく、そうした例について以下に
説明する。図６は実行順序テーブルを書き換える専用の
コマンドの構成を示し、例えば命令コードが９９の場合
はこの専用のコマンドとする。専用コマンドのデータ部
の００は図４（ｂ）で示したフラグに相当し、このコマ
ンドではリセット直後に適用することを示している。次
の２バイトの０１、０２はコマンドの実行順序を示して
いる。こうしてリセット直後に適用か否かのフラグと、
コマンド実行順序が新たに書き換えられる。なお、この
コマンドは認証処理が成功したときのみ行えることと
し、正当な権利を持つ人以外は実行できないようにして
おく必要がある。
【００１５】図７は実行順序テーブルを書き換える処理
を説明する図である。ＩＣＣを活性化し、外部からＩＣ
Ｃへコマンドを送信し、ＩＣＣ側でコマンド受信処理を
行う（ステップＳ４１〜Ｓ４３）。次いで、認証処理を
実行し（ステップＳ４４）、認証ＯＫか否か判断し（ス
テップＳ４５）、認証が成功しなかった場合には処理は
終了する。認証が成功した場合には命令コードを見て、
順序テーブル書換えコマンドか否か判断する（ステップ
Ｓ４６）。順序テーブル書き換えコマンドでない場合は
処理は終了する。順序テーブル書き換えコマンドの場合
には、リセット直後に適用するフラグをセットするのか
否かを判断し（ステップＳ４７）、セットの場合にはフ
ラグセット処理、セットでない場合はフラグリセット処
理をそれぞれ行い（ステップＳ４８，４９）、次いで、
順序テーブル書き換え処理を実行する（ステップＳ５
０）。 こうして認証が成功した正当な権利を持つ人の
みがフラグセット処理、実行順序テーブル書き換え処理
を行うことができる。
を説明する図である。ＩＣＣを活性化し、外部からＩＣ
Ｃへコマンドを送信し、ＩＣＣ側でコマンド受信処理を
行う（ステップＳ４１〜Ｓ４３）。次いで、認証処理を
実行し（ステップＳ４４）、認証ＯＫか否か判断し（ス
テップＳ４５）、認証が成功しなかった場合には処理は
終了する。認証が成功した場合には命令コードを見て、
順序テーブル書換えコマンドか否か判断する（ステップ
Ｓ４６）。順序テーブル書き換えコマンドでない場合は
処理は終了する。順序テーブル書き換えコマンドの場合
には、リセット直後に適用するフラグをセットするのか
否かを判断し（ステップＳ４７）、セットの場合にはフ
ラグセット処理、セットでない場合はフラグリセット処
理をそれぞれ行い（ステップＳ４８，４９）、次いで、
順序テーブル書き換え処理を実行する（ステップＳ５
０）。 こうして認証が成功した正当な権利を持つ人の
みがフラグセット処理、実行順序テーブル書き換え処理
を行うことができる。
【００１６】
【発明の効果】以上のように本発明によれば、ＩＣカー
ド内にチェック機構を設け、ＩＣカード内の機能を利用
する時には、予め定められた手順に従ってコマンドをＩ
Ｃカードへ送らなければ違反と見なしエラーステータス
が返されるので、誤ったコマンドシーケンスの利用を防
止し、偽造ＩＣカードや偽造端末による不正利用を防ぐ
ことが可能となる。
ド内にチェック機構を設け、ＩＣカード内の機能を利用
する時には、予め定められた手順に従ってコマンドをＩ
Ｃカードへ送らなければ違反と見なしエラーステータス
が返されるので、誤ったコマンドシーケンスの利用を防
止し、偽造ＩＣカードや偽造端末による不正利用を防ぐ
ことが可能となる。
【図１】 本発明のＩＣカードを説明する図である。
【図２】 本発明のコマンドの構成を説明する図であ
る。
る。
【図３】 本発明で使用されるコマンドの例を説明する
図である。
図である。
【図４】 実行順序テーブルを説明する図である。
【図５】 順序指定によるコマンド処理の１例を示す処
理フローを示す図である。
理フローを示す図である。
【図６】 実行順序テーブルを書き換える専用のコマン
ドの構成を示す図である。
ドの構成を示す図である。
【図７】 実行順序テーブルを書き換える処理を説明す
る図である。
る図である。
【図８】 従来のＩＣＣを説明する概略図である。
【図９】 キャラクタを説明する図である。
【図１０】 ブロックを説明する図である。
【図１１】 コマンドを説明する図である。
【図１２】 レスポンスを説明する図である。
１…ＩＣカード、２…接続装置、１２…コマンド解析
部、１３…コマンド処理実行部、１４…メモリ、１４ａ
…実行順序テーブル。
部、１３…コマンド処理実行部、１４…メモリ、１４ａ
…実行順序テーブル。
Claims (3)
- 【請求項１】 命令入力部、応答出力部、命令解析部、
命令処理実行部、データを記憶する不揮発性メモリを備
えたＩＣカードにおいて、 不揮発性メモリに命令の実行順序を登録したテーブルを
備えたことを特徴とするＩＣカード。 - 【請求項２】 請求項１記載のＩＣカードにおいて、各
命令が実行順序を示す番号を備えたことを特徴とするＩ
Ｃカード。 - 【請求項３】 請求項１記載のＩＣカードにおいて、認
証が成立したことを条件に、前記テーブルに規定された
実行順序を書き換えることができる専用の命令を有する
ことを特徴とするＩＣカード。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10083468A JPH11282991A (ja) | 1998-03-30 | 1998-03-30 | Ｉｃカード |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10083468A JPH11282991A (ja) | 1998-03-30 | 1998-03-30 | Ｉｃカード |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11282991A true JPH11282991A (ja) | 1999-10-15 |
Family
ID=13803312
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10083468A Pending JPH11282991A (ja) | 1998-03-30 | 1998-03-30 | Ｉｃカード |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH11282991A (ja) |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2007145366A1 (en) * | 2006-06-15 | 2007-12-21 | Kabushiki Kaisha Toshiba | Portable electronic device and control method thereof |
| JP2008047040A (ja) * | 2006-08-21 | 2008-02-28 | Toshiba Corp | 携帯可能電子装置およびｉｃカード |
| JP2009093436A (ja) * | 2007-10-09 | 2009-04-30 | Kyoraku Sangyo Kk | 電子機器、主制御基板、周辺基板、認証方法および認証プログラム |
| JP2009265934A (ja) * | 2008-04-24 | 2009-11-12 | Kyoraku Sangyo Kk | 電子機器、主制御基板、周辺基板、認証方法および認証プログラム |
| JP2009265933A (ja) * | 2008-04-24 | 2009-11-12 | Kyoraku Sangyo Kk | 電子機器、主制御基板、周辺基板、認証方法および認証プログラム |
| US7721346B2 (en) | 2003-03-28 | 2010-05-18 | Sanyo Electric Co., Ltd | Method and apparatus for encrypting data to be secured and inputting/outputting the same |
| JP2013149342A (ja) * | 2013-04-15 | 2013-08-01 | Mega Chips Corp | 半導体記憶装置 |
-
1998
- 1998-03-30 JP JP10083468A patent/JPH11282991A/ja active Pending
Cited By (11)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JP2013149342A (ja) * | 2013-04-15 | 2013-08-01 | Mega Chips Corp | 半導体記憶装置 |
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