JPH10275905A - シリコンウェーハの製造方法およびシリコンウェーハ - Google Patents
シリコンウェーハの製造方法およびシリコンウェーハInfo
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- JPH10275905A JPH10275905A JP9080939A JP8093997A JPH10275905A JP H10275905 A JPH10275905 A JP H10275905A JP 9080939 A JP9080939 A JP 9080939A JP 8093997 A JP8093997 A JP 8093997A JP H10275905 A JPH10275905 A JP H10275905A
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
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Abstract
(57)【要約】
【課題】 シリコンウェーハ表面の化学的機械的研磨に
よる表面不良のないSOI構造のシリコンウェーハを得
る。 【解決手段】シリコンウェーハ表面から、水素イオン注
入を行なって、水素注入層を形成し、これを加熱して水
素注入層からシリコン表面を剥がした後、シリコンウェ
ーハを水素雰囲気中でアニールして剥がれた表面を平坦
にする。また、水素雰囲気中のプラズマ処理によりアニ
ールを行う。また、ラピッドサーマルアニールによりア
ニールを行う。
よる表面不良のないSOI構造のシリコンウェーハを得
る。 【解決手段】シリコンウェーハ表面から、水素イオン注
入を行なって、水素注入層を形成し、これを加熱して水
素注入層からシリコン表面を剥がした後、シリコンウェ
ーハを水素雰囲気中でアニールして剥がれた表面を平坦
にする。また、水素雰囲気中のプラズマ処理によりアニ
ールを行う。また、ラピッドサーマルアニールによりア
ニールを行う。
Description
【0001】
【発明の属する技術分野】この発明は、半導体デバイス
の低消費電力化、高速化、高集積化に有効なSOI(Si
licon on Insulator)構造のシリコンウェーハの製造方
法に関するものである。
の低消費電力化、高速化、高集積化に有効なSOI(Si
licon on Insulator)構造のシリコンウェーハの製造方
法に関するものである。
【0002】
【従来の技術】従来からSOIウェーハの製造方法とし
て、いろいろな方法が提案されているが、近年有力とさ
れる方法に、スマートカット法と称される方法がある
(例えば、ELECTRONICS LETTERS
31(1995)1201参照)。スマートカット法について説明
すると、先ずシリコンウェーハを熱酸化して表面にシリ
コン酸化膜を形成する。次に、シリコンウェーハ表面か
ら、水素イオン注入を行なって、水素注入層を形成す
る。次に、シリコンウェーハの水素注入層のある側に、
ベースウェーハを貼り合わせる。次に、このシリコンウ
ェーハを加熱して、水素注入層からシリコン表面を剥が
す。こうして基板材の上に薄いシリコン層を形成する。
この時、薄いシリコン層の剥がし面には微少な凸凹が形
成されるため、表面を化学的機械的に研磨し平滑化し
て、SOIウェーハを製造する。一方、最近、化学的機
械的研磨の影響がデバイスの特性、歩留まりに大きく現
われることが報告されている(H.Yamamoto et al, Proc
eeding of The 2nd International Symposium on Adva
nced Science and Technology of Silicon Materials,
(1996)P425)。
て、いろいろな方法が提案されているが、近年有力とさ
れる方法に、スマートカット法と称される方法がある
(例えば、ELECTRONICS LETTERS
31(1995)1201参照)。スマートカット法について説明
すると、先ずシリコンウェーハを熱酸化して表面にシリ
コン酸化膜を形成する。次に、シリコンウェーハ表面か
ら、水素イオン注入を行なって、水素注入層を形成す
る。次に、シリコンウェーハの水素注入層のある側に、
ベースウェーハを貼り合わせる。次に、このシリコンウ
ェーハを加熱して、水素注入層からシリコン表面を剥が
す。こうして基板材の上に薄いシリコン層を形成する。
この時、薄いシリコン層の剥がし面には微少な凸凹が形
成されるため、表面を化学的機械的に研磨し平滑化し
て、SOIウェーハを製造する。一方、最近、化学的機
械的研磨の影響がデバイスの特性、歩留まりに大きく現
われることが報告されている(H.Yamamoto et al, Proc
eeding of The 2nd International Symposium on Adva
nced Science and Technology of Silicon Materials,
(1996)P425)。
【0003】
【発明が解決しようとする課題】このようなシリコンウ
ェーハ表面の研磨における不良は、上記のようなスマー
トカット法など従来の方法で製造したSOI構造のウェ
ーハでも同様に生じ、デバイスの特性、歩留まりを低下
させる原因となっていた。この発明は、このような従来
の問題を解決し、表面に不良のないSOI構造の半導体
ウェーハを提供しようとするものである。
ェーハ表面の研磨における不良は、上記のようなスマー
トカット法など従来の方法で製造したSOI構造のウェ
ーハでも同様に生じ、デバイスの特性、歩留まりを低下
させる原因となっていた。この発明は、このような従来
の問題を解決し、表面に不良のないSOI構造の半導体
ウェーハを提供しようとするものである。
【0004】
【課題を解決するための手段】この発明のシリコンウェ
ーハの製造方法は、表面にシリコン酸化膜が形成された
シリコンウェーハ材の一の主面から水素イオンを注入し
て水素注入層を形成する工程と、上記シリコンウェーハ
材の上記一の主面に基板材を張り合わせる工程と、上記
シリコンウェーハ材を加熱して上記シリコンウェーハ材
の上記基板材と張り合わされた部分のシリコンウェーハ
を上記水素注入層において剥ぐ工程と、上記基板材と張
り合わされて剥がされた部分の上記シリコンウェーハを
水素雰囲気中でアニールして剥がされた表面を平坦にす
る工程とを含むことを特徴とするものである。
ーハの製造方法は、表面にシリコン酸化膜が形成された
シリコンウェーハ材の一の主面から水素イオンを注入し
て水素注入層を形成する工程と、上記シリコンウェーハ
材の上記一の主面に基板材を張り合わせる工程と、上記
シリコンウェーハ材を加熱して上記シリコンウェーハ材
の上記基板材と張り合わされた部分のシリコンウェーハ
を上記水素注入層において剥ぐ工程と、上記基板材と張
り合わされて剥がされた部分の上記シリコンウェーハを
水素雰囲気中でアニールして剥がされた表面を平坦にす
る工程とを含むことを特徴とするものである。
【0005】また、この発明のシリコンウェーハの製造
方法は、上記アニールを、摂氏1050度から1350
度の範囲に加熱して行うことを特徴とするものである。
また、この発明のシリコンウェーハの製造方法は、上記
アニールを、水素雰囲気中のプラズマ処理により行うこ
とを特徴とするものである。
方法は、上記アニールを、摂氏1050度から1350
度の範囲に加熱して行うことを特徴とするものである。
また、この発明のシリコンウェーハの製造方法は、上記
アニールを、水素雰囲気中のプラズマ処理により行うこ
とを特徴とするものである。
【0006】また、この発明のシリコンウェーハの製造
方法は、上記アニールを、ラピッドサーマルアニールに
より行うことを特徴とするものである。また、この発明
のシリコンウェーハの製造方法は、上記アニールを、上
記剥がされた表面の化学的機械的研磨を行った後に行な
うことを特徴とするものである。
方法は、上記アニールを、ラピッドサーマルアニールに
より行うことを特徴とするものである。また、この発明
のシリコンウェーハの製造方法は、上記アニールを、上
記剥がされた表面の化学的機械的研磨を行った後に行な
うことを特徴とするものである。
【0007】また、この発明のシリコンウェーハの製造
方法は、表面にシリコン酸化膜が形成されたシリコンウ
ェーハ材の一の主面から水素イオンを注入して水素注入
層を形成する工程と、上記シリコンウェーハ材の上記一
の主面に基板材を張り合わせる工程と、上記シリコンウ
ェーハ材を加熱して上記シリコンウェーハ材の上記基板
材と張り合わされた部分のシリコンウェーハを上記水素
注入層において剥ぐ工程と、上記基板材と張り合わされ
て剥がされた部分の上記シリコンウェーハの表面にシリ
コンをエピタキシャル成長させて平坦な新表面を形成す
る工程とを含むことを特徴とするものである。また、こ
の発明のシリコンウェーハの製造方法は、上記のシリコ
ンのエピタキシャル成長を、トリクロルシラン(SiH
Cl3)、ジクロルシラン(SiH2Cl2)、モノクロ
ルシラン(SiH2Cl)またはモノシラン(SiH4)
中で摂氏800度以上の温度で行なうことを特徴とする
ものである。
方法は、表面にシリコン酸化膜が形成されたシリコンウ
ェーハ材の一の主面から水素イオンを注入して水素注入
層を形成する工程と、上記シリコンウェーハ材の上記一
の主面に基板材を張り合わせる工程と、上記シリコンウ
ェーハ材を加熱して上記シリコンウェーハ材の上記基板
材と張り合わされた部分のシリコンウェーハを上記水素
注入層において剥ぐ工程と、上記基板材と張り合わされ
て剥がされた部分の上記シリコンウェーハの表面にシリ
コンをエピタキシャル成長させて平坦な新表面を形成す
る工程とを含むことを特徴とするものである。また、こ
の発明のシリコンウェーハの製造方法は、上記のシリコ
ンのエピタキシャル成長を、トリクロルシラン(SiH
Cl3)、ジクロルシラン(SiH2Cl2)、モノクロ
ルシラン(SiH2Cl)またはモノシラン(SiH4)
中で摂氏800度以上の温度で行なうことを特徴とする
ものである。
【0008】
【発明の実施の形態】以下、この発明の実施の形態を図
を参照して説明する。なお、図中、同一の符号は同一ま
たは相当の部分を示す。 実施の形態1.図1は、この発明の実施の形態1のSO
Iウェーハの製造方法を説明する図であり、(a)〜
(f)は、各工程の断面図を示す。この製造方法につい
て説明すると、先ず図1(a)に示すように、シリコン
ウェーハ材1を準備し、図2(b)に示すように、シリ
コンウェーハ材1を熱酸化して表面にシリコン酸化膜2
を形成する。次に、図1(c)に示すように、シリコン
ウェーハ材1の一つの表面から、2×1016〜1×10
17/cm2の水素イオン注入を行なって、水素注入層4
を形成する。その後、図1(d)に示すように、シリコ
ンウェーハ材1の水素注入をした表面の側に、別のシリ
コンウェーハ材(ベースウェーハ)などの適当な基板材
5を貼り合わせる。
を参照して説明する。なお、図中、同一の符号は同一ま
たは相当の部分を示す。 実施の形態1.図1は、この発明の実施の形態1のSO
Iウェーハの製造方法を説明する図であり、(a)〜
(f)は、各工程の断面図を示す。この製造方法につい
て説明すると、先ず図1(a)に示すように、シリコン
ウェーハ材1を準備し、図2(b)に示すように、シリ
コンウェーハ材1を熱酸化して表面にシリコン酸化膜2
を形成する。次に、図1(c)に示すように、シリコン
ウェーハ材1の一つの表面から、2×1016〜1×10
17/cm2の水素イオン注入を行なって、水素注入層4
を形成する。その後、図1(d)に示すように、シリコ
ンウェーハ材1の水素注入をした表面の側に、別のシリ
コンウェーハ材(ベースウェーハ)などの適当な基板材
5を貼り合わせる。
【0009】その後、このシリコンウェーハ材1を40
0〜600℃に加熱すると、図5(e)に示すように、
基板材5が張り合わされた側のシリコンウェーハ材1の
表面部分を水素注入層4から剥がすことができる。こう
して基板材5の上に薄いシリコン層6を形成したSOI
構造のシリコンウェーハ7を得る。この時、薄いシリコ
ン層6の剥がし面には20nm程度の凸凹が形成され
る。そのため、必要に応じて、図5(f)に示すよう
に、シリコン層6の表面を化学的機械的に研磨し平滑化
する。ここまでの工程は、いわゆるスマートカット法と
称される方法と同様である。
0〜600℃に加熱すると、図5(e)に示すように、
基板材5が張り合わされた側のシリコンウェーハ材1の
表面部分を水素注入層4から剥がすことができる。こう
して基板材5の上に薄いシリコン層6を形成したSOI
構造のシリコンウェーハ7を得る。この時、薄いシリコ
ン層6の剥がし面には20nm程度の凸凹が形成され
る。そのため、必要に応じて、図5(f)に示すよう
に、シリコン層6の表面を化学的機械的に研磨し平滑化
する。ここまでの工程は、いわゆるスマートカット法と
称される方法と同様である。
【0010】次に、シリコンウェーハ7を、水素雰囲気
中でアニールする。図2は、アニールを行うためのアニ
ール装置(炉)をしめす。図2において、7はアニール
をするシリコンウェーハ、8はこのウェーハを保持する
保持具、9は炉体である。炉体9の上部入り口から水素
ガスが導入され、下部出口から排出される。このアニー
ル炉により、図1(e)の段階のシリコンウェーハ7
を、摂氏1050度から1350度で水素雰囲気中で数
10秒から数10分のアニールを行なう。これにより図
1(f)に示すような表面の平坦なシリコンウェーハ7
が得られる。加熱温度が、摂氏1050度以下だと、ア
ニールに長時間を要する。また、加熱温度が、摂氏13
50度以上だと、シリコンが溶融するので適当でない。
このように、加熱温度を、摂氏1050度〜1350度
の範囲とすることにより、プロセスの安定化、スループ
ットの向上、ウェーハ品質の向上が実現できる。
中でアニールする。図2は、アニールを行うためのアニ
ール装置(炉)をしめす。図2において、7はアニール
をするシリコンウェーハ、8はこのウェーハを保持する
保持具、9は炉体である。炉体9の上部入り口から水素
ガスが導入され、下部出口から排出される。このアニー
ル炉により、図1(e)の段階のシリコンウェーハ7
を、摂氏1050度から1350度で水素雰囲気中で数
10秒から数10分のアニールを行なう。これにより図
1(f)に示すような表面の平坦なシリコンウェーハ7
が得られる。加熱温度が、摂氏1050度以下だと、ア
ニールに長時間を要する。また、加熱温度が、摂氏13
50度以上だと、シリコンが溶融するので適当でない。
このように、加熱温度を、摂氏1050度〜1350度
の範囲とすることにより、プロセスの安定化、スループ
ットの向上、ウェーハ品質の向上が実現できる。
【0011】上記のように水素雰囲気中でのアニールに
より、シリコンウェーハの表面が平坦になるのは、表面
のシリコン原子が再配列する等の効果による。シリコン
原子の再配列の様子を図3に示す。図3(a)は、アニ
ールする前のシリコン表面を拡大して模式的に示した断
面図である。水素雰囲気中で加熱すると、図3(b)に
示すように、水素の効果によりシリコン表面が活性化さ
れ、シリコン原子が表面を動き回わりエネルギー安定点
に移動する。この結果、図3(c)に示すように、表面
が平坦になる。
より、シリコンウェーハの表面が平坦になるのは、表面
のシリコン原子が再配列する等の効果による。シリコン
原子の再配列の様子を図3に示す。図3(a)は、アニ
ールする前のシリコン表面を拡大して模式的に示した断
面図である。水素雰囲気中で加熱すると、図3(b)に
示すように、水素の効果によりシリコン表面が活性化さ
れ、シリコン原子が表面を動き回わりエネルギー安定点
に移動する。この結果、図3(c)に示すように、表面
が平坦になる。
【0012】アニールするシリコンウェーハは、図1
(e)の段階で表面が剥がれたままでアニールすると、
化学的機械的研磨の影響のないシリコンウェーハが製造
できる。また、図1(f)の段階で、アニールするまえ
に、必要に応じて表面に影響を残さない程度に、適度に
化学的機械的研磨を施しておくようにしてもよい。予め
適度の化学的機械的研磨を施した場合には、水素による
アニールの簡略化、迅速化を図ることができ、またこの
場合にも最終的に化学的機械的研磨の影響のないシリコ
ンウェーハを得ることができる。
(e)の段階で表面が剥がれたままでアニールすると、
化学的機械的研磨の影響のないシリコンウェーハが製造
できる。また、図1(f)の段階で、アニールするまえ
に、必要に応じて表面に影響を残さない程度に、適度に
化学的機械的研磨を施しておくようにしてもよい。予め
適度の化学的機械的研磨を施した場合には、水素による
アニールの簡略化、迅速化を図ることができ、またこの
場合にも最終的に化学的機械的研磨の影響のないシリコ
ンウェーハを得ることができる。
【0013】実施の形態2.図4は、この発明の実施の
形態2のSOI構造のシリコンウェーハの製造方法を説
明する図であり、ラピッドアニール装置を示す。図4に
おいて、7はアニールをするシリコンウェーハ、10は
このシリコンウェーハを保持する保持具(サセプタ)、
11は透明チャンバ、12は加熱用の赤外線等のランプ
を示す。水素ガスは、チャンバ11の図示左側の入口よ
り導入され、右側の出口から排出される。
形態2のSOI構造のシリコンウェーハの製造方法を説
明する図であり、ラピッドアニール装置を示す。図4に
おいて、7はアニールをするシリコンウェーハ、10は
このシリコンウェーハを保持する保持具(サセプタ)、
11は透明チャンバ、12は加熱用の赤外線等のランプ
を示す。水素ガスは、チャンバ11の図示左側の入口よ
り導入され、右側の出口から排出される。
【0014】実施の形態1では、水素処理をアニール炉
を用いたバッチ方式で行なっている。この実施の形態で
は、シリコンウェーハ1枚毎の、枚葉の処理が可能であ
り、熱放射光をシリコンウェーハに短時間照射してアニ
ールする、いわゆる短時間アニール(ラピッドサーマル
アニール)により処理する。ラピッドアニール装置とし
ては、ハロゲンランプ、アークランプなどによる赤外線
アニール装置、キセノンフラシュランプなどによるフラ
シュランプアニール装置などが用いられる。なお、アニ
ールするシリコンウェーハ7の準備工程は、実施の形態
1と同様である。このような短時間アニールによれば、
プロセスが制御しやすい等の効果がある。
を用いたバッチ方式で行なっている。この実施の形態で
は、シリコンウェーハ1枚毎の、枚葉の処理が可能であ
り、熱放射光をシリコンウェーハに短時間照射してアニ
ールする、いわゆる短時間アニール(ラピッドサーマル
アニール)により処理する。ラピッドアニール装置とし
ては、ハロゲンランプ、アークランプなどによる赤外線
アニール装置、キセノンフラシュランプなどによるフラ
シュランプアニール装置などが用いられる。なお、アニ
ールするシリコンウェーハ7の準備工程は、実施の形態
1と同様である。このような短時間アニールによれば、
プロセスが制御しやすい等の効果がある。
【0015】実施の形態3.図5は、この発明の実施の
形態3のSOI構造のシリコンウェーハの製造方法を説
明する図であり、プラズマアニール装置を示す。図5に
おいて、7はアニールをするシリコンウェーハ、13は
シリコンウェーハ7を挟む電極、14はチャンバ、15
は高周波発生機、16はコンデンサを示す。また、電極
13の下側電極は、図示していない加熱装置により温度
を数100℃にコントロールする。水素ガスは、チャン
バ14の図示左側の入口より導入され、右側の出口から
排出される。この例では、水素中のプラズマ処理を高周
波電力により行なっている。また、プラズマの発生はE
CR(電子−サイクロトロン共鳴)、光等の他の励起源
を用いて行なっても良い。なお、アニールするシリコン
ウェーハ7の準備工程は、実施の形態1と同様である。
形態3のSOI構造のシリコンウェーハの製造方法を説
明する図であり、プラズマアニール装置を示す。図5に
おいて、7はアニールをするシリコンウェーハ、13は
シリコンウェーハ7を挟む電極、14はチャンバ、15
は高周波発生機、16はコンデンサを示す。また、電極
13の下側電極は、図示していない加熱装置により温度
を数100℃にコントロールする。水素ガスは、チャン
バ14の図示左側の入口より導入され、右側の出口から
排出される。この例では、水素中のプラズマ処理を高周
波電力により行なっている。また、プラズマの発生はE
CR(電子−サイクロトロン共鳴)、光等の他の励起源
を用いて行なっても良い。なお、アニールするシリコン
ウェーハ7の準備工程は、実施の形態1と同様である。
【0016】実施の形態1及び2では、水素中の高温処
理でのアニールで行なっている。この実施の形態では、
プラズマ中で水素処理をしてアニールを行なう。このよ
うにすると、処理温度を室温から600℃程度まで下げ
ることができる等の効果がある。また、このようなプラ
ズマ処理では、処理時間は、実施の形態1に比べて短い
ので、プロセスが制御しやすい、汚染が導入されにくい
等の効果がある。
理でのアニールで行なっている。この実施の形態では、
プラズマ中で水素処理をしてアニールを行なう。このよ
うにすると、処理温度を室温から600℃程度まで下げ
ることができる等の効果がある。また、このようなプラ
ズマ処理では、処理時間は、実施の形態1に比べて短い
ので、プロセスが制御しやすい、汚染が導入されにくい
等の効果がある。
【0017】実施の形態4.図6は、この発明の実施の
形態4のSOI構造のシリコンウェーハの製造方法を説
明する図であり、シリコンのエピタキシャル成長装置を
示す。図6において、7はエピタキシャル成長をさせる
シリコンウェーハ、17はこのシリコンウェーハを保持
して回転する保持具、18は高周波コイル、19はチャ
ンバを示す。水素ガスは、チャンバ14の図示左側の入
口より導入され、右側の出口から排出される。
形態4のSOI構造のシリコンウェーハの製造方法を説
明する図であり、シリコンのエピタキシャル成長装置を
示す。図6において、7はエピタキシャル成長をさせる
シリコンウェーハ、17はこのシリコンウェーハを保持
して回転する保持具、18は高周波コイル、19はチャ
ンバを示す。水素ガスは、チャンバ14の図示左側の入
口より導入され、右側の出口から排出される。
【0018】実施の形態1ではウェーハ剥がしの後、水
素アニールを行なっている。これに対し、この実施の形
態では、図1(e)の工程で水素注入層4から薄いシリ
コン層6を剥がした後、剥がされた面にシリコンのエピ
タキシャル成長を行ない新たな表面を平坦に形成する。
このシリコンのエピタキシャル成長は、トリクロルシラ
ン(SiHCl3)、ジクロルシラン(SiH2C
l2)、モノクロルシラン(SiH2Cl)またはモノシ
ラン(SiH4)中で800℃以上で行なう。これらの
材料を用いることにより、シリコン成長層の表面での欠
陥低減層を形成することができる。なお、エピタキシャ
ル成長をさせるためのシリコンウェーハ7の準備工程
は、実施の形態1と同様である。このような製造方法に
よれば、化学的機械的研磨の影響をなくすことができる
上、さらにシリコンウェーハのシリコン層6の膜厚の制
御等が可能となる。
素アニールを行なっている。これに対し、この実施の形
態では、図1(e)の工程で水素注入層4から薄いシリ
コン層6を剥がした後、剥がされた面にシリコンのエピ
タキシャル成長を行ない新たな表面を平坦に形成する。
このシリコンのエピタキシャル成長は、トリクロルシラ
ン(SiHCl3)、ジクロルシラン(SiH2C
l2)、モノクロルシラン(SiH2Cl)またはモノシ
ラン(SiH4)中で800℃以上で行なう。これらの
材料を用いることにより、シリコン成長層の表面での欠
陥低減層を形成することができる。なお、エピタキシャ
ル成長をさせるためのシリコンウェーハ7の準備工程
は、実施の形態1と同様である。このような製造方法に
よれば、化学的機械的研磨の影響をなくすことができる
上、さらにシリコンウェーハのシリコン層6の膜厚の制
御等が可能となる。
【0019】
【発明の効果】以上説明したように、この発明によれ
ば、表面が化学的機械的研磨の影響を受けない特性のよ
い表面層を備えたSOI構造のシリコンウェーハを得る
ことができる。
ば、表面が化学的機械的研磨の影響を受けない特性のよ
い表面層を備えたSOI構造のシリコンウェーハを得る
ことができる。
【図1】 この発明の実施の形態1よるシリコンウェー
ハの製造プロセスを示す断面図。
ハの製造プロセスを示す断面図。
【図2】 この発明の実施の形態1における水素中の熱
処理を行なうアニール装置を示す断面図。
処理を行なうアニール装置を示す断面図。
【図3】 この発明の実施の形態1におけるシリコンウ
ェーハの表面を説明するための断面図。
ェーハの表面を説明するための断面図。
【図4】 この発明の実施の形態2における水素中の熱
処理を行うラピッドアニール装置を示す断面図。
処理を行うラピッドアニール装置を示す断面図。
【図5】 この発明の実施の形態3における水素処理を
水素プラズマ中で行なうプラズマアニール装置を示す断
面図。
水素プラズマ中で行なうプラズマアニール装置を示す断
面図。
【図6】 この発明の実施の形態4におけるエピタキシ
ャル成長を説明するための図。
ャル成長を説明するための図。
【図7】 この発明の実施の形態4におけるシリコンウ
ェーハを示す断面図。
ェーハを示す断面図。
1 シリコンウェーハ材、 2 シリコン酸化膜、 4
水素注入層、 5基板材、 6 シリコン層、 7
シリコンウェーハ。
水素注入層、 5基板材、 6 シリコン層、 7
シリコンウェーハ。
Claims (8)
- 【請求項1】 表面にシリコン酸化膜が形成されたシリ
コンウェーハ材の一の主面から水素イオンを注入して水
素注入層を形成する工程と、上記シリコンウェーハ材の
上記一の主面に基板材を張り合わせる工程と、上記シリ
コンウェーハ材を加熱して上記シリコンウェーハ材の上
記基板材と張り合わされた部分のシリコンウェーハを上
記水素注入層において剥ぐ工程と、上記基板材と張り合
わされて剥がされた部分の上記シリコンウェーハを水素
雰囲気中でアニールして剥がされた表面を平坦にする工
程とを含むことを特徴とするシリコンウェーハの製造方
法。 - 【請求項2】 上記アニールを、摂氏1050度から1
350度の範囲に加熱して行うことを特徴とする請求項
1に記載のシリコンウェーハの製造方法。 - 【請求項3】 上記アニールを、水素雰囲気中のプラズ
マ処理により行うことを特徴とする請求項1に記載のシ
リコンウェーハの製造方法。 - 【請求項4】 上記アニールを、ラピッドサーマルアニ
ールにより行うことを特徴とする請求項1に記載のシリ
コンウェーハの製造方法。 - 【請求項5】 上記アニールを、上記剥がされた表面の
化学的機械的研磨を行った後に行なうことを特徴とする
請求項1ないし4のいずれかに記載のシリコンウェーハ
の製造方法。 - 【請求項6】 表面にシリコン酸化膜が形成されたシリ
コンウェーハ材の一の主面から水素イオンを注入して水
素注入層を形成する工程と、上記シリコンウェーハ材の
上記一の主面に基板材を張り合わせる工程と、上記シリ
コンウェーハ材を加熱して上記シリコンウェーハ材の上
記基板材と張り合わされた部分のシリコンウェーハを上
記水素注入層において剥ぐ工程と、上記基板材と張り合
わされて剥がされた部分の上記シリコンウェーハの表面
にシリコンをエピタキシャル成長させて平坦な新表面を
形成する工程とを含むことを特徴とするシリコンウェー
ハの製造方法。 - 【請求項7】 上記のシリコンのエピタキシャル成長
を、トリクロルシラン(SiHCl3)、ジクロルシラ
ン(SiH2Cl2)、モノクロルシラン(SiH2C
l)またはモノシラン(SiH4)中で摂氏800度以
上の温度で行なうことを特徴とする請求項6に記載のシ
リコンウェーハの製造方法。 - 【請求項8】 請求項1ないし7のいずれかに記載の製
造方法により製造されたことを特徴とするシリコンウェ
ーハ。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9080939A JPH10275905A (ja) | 1997-03-31 | 1997-03-31 | シリコンウェーハの製造方法およびシリコンウェーハ |
TW086115996A TW409418B (en) | 1997-03-31 | 1997-10-28 | SOI silicon wafer and its manufacturing method |
FR9715079A FR2761526B1 (fr) | 1997-03-31 | 1997-12-01 | Procede pour fabriquer une tranche de silicium et tranche de silicium fabriquee par ce procede |
DE19753494A DE19753494A1 (de) | 1997-03-31 | 1997-12-02 | Verfahren zur Herstellung eines Siliziumwafers und dadurch hergestellte Siliziumwafer |
KR1019970065258A KR19980079501A (ko) | 1997-03-31 | 1997-12-02 | 실리콘 웨이퍼의 제조 방법 및 실리콘 웨이퍼 |
FR9806168A FR2762136B1 (fr) | 1997-03-31 | 1998-05-15 | Procede pour fabriquer une tranche de silicium et tranche de silicium fabriquee par ce procede |
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP9080939A JPH10275905A (ja) | 1997-03-31 | 1997-03-31 | シリコンウェーハの製造方法およびシリコンウェーハ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH10275905A true JPH10275905A (ja) | 1998-10-13 |
Family
ID=13732451
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP9080939A Pending JPH10275905A (ja) | 1997-03-31 | 1997-03-31 | シリコンウェーハの製造方法およびシリコンウェーハ |
Country Status (5)
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---|---|
JP (1) | JPH10275905A (ja) |
KR (1) | KR19980079501A (ja) |
DE (1) | DE19753494A1 (ja) |
FR (2) | FR2761526B1 (ja) |
TW (1) | TW409418B (ja) |
Cited By (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2000024059A1 (fr) * | 1998-10-16 | 2000-04-27 | Shin-Etsu Handotai Co., Ltd. | Procede de production de tranche soi utilisant un procede de separation d'implantation d'ions hydrogene et tranche soi produite a l'aide du procede |
JP2000331899A (ja) * | 1999-05-21 | 2000-11-30 | Shin Etsu Handotai Co Ltd | Soiウェーハの製造方法およびsoiウェーハ |
JP2001094080A (ja) * | 1999-09-24 | 2001-04-06 | Komatsu Electronic Metals Co Ltd | 半導体用薄膜ウェハの製造方法 |
WO2001028000A1 (fr) * | 1999-10-14 | 2001-04-19 | Shin-Etsu Handotai Co., Ltd. | Procede de fabrication d'une tranche de soi, et tranche de soi |
US6461939B1 (en) | 1999-04-09 | 2002-10-08 | Shin-Etsu Handotai Co., Ltd. | SOI wafers and methods for producing SOI wafer |
JP2002542622A (ja) * | 1999-04-21 | 2002-12-10 | シリコン ジェネシス コーポレイション | エピプロセスを用いたsoi基板の表面仕上げ |
JP2003509838A (ja) * | 1999-08-20 | 2003-03-11 | エス オー イ テク シリコン オン インシュレータ テクノロジース | マイクロエレクトロニクス用基板の処理方法及び該方法により得られた基板 |
JPWO2003005435A1 (ja) * | 2001-07-05 | 2004-10-28 | 大見 忠弘 | 基板処理装置および基板処理方法、基板平坦化方法 |
JP2004535685A (ja) * | 2001-07-16 | 2004-11-25 | エス.オー.アイ.テック、シリコン、オン、インシュレター、テクノロジーズ | 表面状態を改善する方法 |
KR100465527B1 (ko) * | 2002-11-21 | 2005-01-13 | 주식회사 실트론 | Soi 웨이퍼의 결함 제거 및 표면 경면화 방법 |
US6902988B2 (en) | 1999-08-20 | 2005-06-07 | S.O.I.Tec Silicon On Insulator Technologies S.A. | Method for treating substrates for microelectronics and substrates obtained by said method |
KR100668160B1 (ko) * | 1998-07-07 | 2007-01-11 | 신에쯔 한도타이 가부시키가이샤 | Soi웨이퍼의 제조방법 및 이 방법으로 제조된 soi웨이퍼 |
JP2007184626A (ja) * | 1997-12-26 | 2007-07-19 | Canon Inc | Soi基板の熱処理方法及び作製方法 |
JP2007525018A (ja) * | 2003-10-01 | 2007-08-30 | ウェーハマスターズ・インコーポレイテッド | フラッシュアニールを使用した選択的な加熱 |
JP2008028415A (ja) * | 1999-10-14 | 2008-02-07 | Shin Etsu Handotai Co Ltd | Soiウエーハの製造方法及びsoiウエーハ |
JP2010016356A (ja) * | 2008-06-04 | 2010-01-21 | Semiconductor Energy Lab Co Ltd | 半導体基板の作製方法 |
WO2011151968A1 (ja) | 2010-06-01 | 2011-12-08 | 信越半導体株式会社 | 貼り合わせウェーハの製造方法 |
US8993410B2 (en) | 2006-09-08 | 2015-03-31 | Silicon Genesis Corporation | Substrate cleaving under controlled stress conditions |
US9362439B2 (en) | 2008-05-07 | 2016-06-07 | Silicon Genesis Corporation | Layer transfer of films utilizing controlled shear region |
Families Citing this family (23)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20070122997A1 (en) | 1998-02-19 | 2007-05-31 | Silicon Genesis Corporation | Controlled process and resulting device |
US6155909A (en) | 1997-05-12 | 2000-12-05 | Silicon Genesis Corporation | Controlled cleavage system using pressurized fluid |
JP3451908B2 (ja) * | 1997-11-05 | 2003-09-29 | 信越半導体株式会社 | Soiウエーハの熱処理方法およびsoiウエーハ |
JPH11307472A (ja) * | 1998-04-23 | 1999-11-05 | Shin Etsu Handotai Co Ltd | 水素イオン剥離法によってsoiウエーハを製造する方法およびこの方法で製造されたsoiウエーハ |
JP3635200B2 (ja) * | 1998-06-04 | 2005-04-06 | 信越半導体株式会社 | Soiウェーハの製造方法 |
FR2787919B1 (fr) * | 1998-12-23 | 2001-03-09 | Thomson Csf | Procede de realisation d'un substrat destine a faire croitre un compose nitrure |
JP2000223683A (ja) * | 1999-02-02 | 2000-08-11 | Canon Inc | 複合部材及びその分離方法、貼り合わせ基板及びその分離方法、移設層の移設方法、並びにsoi基板の製造方法 |
JP2000256094A (ja) * | 1999-03-08 | 2000-09-19 | Speedfam-Ipec Co Ltd | シリコンエピタキシャル成長ウェーハ製造方法およびその装置 |
US6489241B1 (en) * | 1999-09-17 | 2002-12-03 | Applied Materials, Inc. | Apparatus and method for surface finishing a silicon film |
KR100549257B1 (ko) * | 1999-12-08 | 2006-02-03 | 주식회사 실트론 | 에스오아이 웨이퍼의 표면 정밀 가공 방법 |
JP4450126B2 (ja) | 2000-01-21 | 2010-04-14 | 日新電機株式会社 | シリコン系結晶薄膜の形成方法 |
EP1346412B1 (en) * | 2000-12-22 | 2008-03-12 | Nxp B.V. | Semiconductor device comprising an arrangement of an electrically programmable non-volatile memory element |
KR100434914B1 (ko) * | 2001-10-19 | 2004-06-09 | 주식회사 실트론 | 고품질 웨이퍼 및 그의 제조방법 |
KR100467837B1 (ko) * | 2002-05-17 | 2005-01-24 | 주식회사 실트론 | 에스오아이 웨이퍼 제조방법 |
RU2217842C1 (ru) * | 2003-01-14 | 2003-11-27 | Институт физики полупроводников - Объединенного института физики полупроводников СО РАН | Способ изготовления структуры кремний-на-изоляторе |
FR2853991B1 (fr) * | 2003-04-17 | 2005-10-28 | Soitec Silicon On Insulator | Procede de traitement de substrats demontables, et substrat intermediaire demontable, avec polissage perfectionne |
ATE504082T1 (de) | 2003-05-27 | 2011-04-15 | Soitec Silicon On Insulator | Verfahren zur herstellung einer heteroepitaktischen mikrostruktur |
US8293619B2 (en) | 2008-08-28 | 2012-10-23 | Silicon Genesis Corporation | Layer transfer of films utilizing controlled propagation |
US7811900B2 (en) | 2006-09-08 | 2010-10-12 | Silicon Genesis Corporation | Method and structure for fabricating solar cells using a thick layer transfer process |
EP1926130A1 (en) | 2006-11-27 | 2008-05-28 | S.O.I.TEC. Silicon on Insulator Technologies S.A. | Method of improving the surface of a semiconductor substrate |
US8330126B2 (en) | 2008-08-25 | 2012-12-11 | Silicon Genesis Corporation | Race track configuration and method for wafering silicon solar substrates |
JP5625239B2 (ja) * | 2008-12-25 | 2014-11-19 | 信越半導体株式会社 | 貼り合わせウェーハの製造方法 |
US8329557B2 (en) | 2009-05-13 | 2012-12-11 | Silicon Genesis Corporation | Techniques for forming thin films by implantation with reduced channeling |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4786615A (en) * | 1987-08-31 | 1988-11-22 | Motorola Inc. | Method for improved surface planarity in selective epitaxial silicon |
DD266888A1 (de) * | 1987-11-12 | 1989-04-12 | Akad Wissenschaften Ddr | Verfahren zur oberflaechenglaettung dicker soi-schichten |
JPH04162628A (ja) * | 1990-10-26 | 1992-06-08 | Nec Corp | 半導体装置の製造方法 |
TW211621B (ja) * | 1991-07-31 | 1993-08-21 | Canon Kk | |
EP1043768B1 (en) * | 1992-01-30 | 2004-09-08 | Canon Kabushiki Kaisha | Process for producing semiconductor substrates |
US5427055A (en) * | 1992-01-31 | 1995-06-27 | Canon Kabushiki Kaisha | Method for controlling roughness on surface of monocrystal |
JPH0766376A (ja) * | 1993-08-26 | 1995-03-10 | Toshiba Corp | 半導体基板の製造方法 |
JP3293736B2 (ja) * | 1996-02-28 | 2002-06-17 | キヤノン株式会社 | 半導体基板の作製方法および貼り合わせ基体 |
JP3542376B2 (ja) * | 1994-04-08 | 2004-07-14 | キヤノン株式会社 | 半導体基板の製造方法 |
SG65697A1 (en) * | 1996-11-15 | 1999-06-22 | Canon Kk | Process for producing semiconductor article |
-
1997
- 1997-03-31 JP JP9080939A patent/JPH10275905A/ja active Pending
- 1997-10-28 TW TW086115996A patent/TW409418B/zh not_active IP Right Cessation
- 1997-12-01 FR FR9715079A patent/FR2761526B1/fr not_active Expired - Lifetime
- 1997-12-02 DE DE19753494A patent/DE19753494A1/de not_active Ceased
- 1997-12-02 KR KR1019970065258A patent/KR19980079501A/ko not_active Application Discontinuation
-
1998
- 1998-05-15 FR FR9806168A patent/FR2762136B1/fr not_active Expired - Fee Related
Cited By (29)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2007184626A (ja) * | 1997-12-26 | 2007-07-19 | Canon Inc | Soi基板の熱処理方法及び作製方法 |
KR100668160B1 (ko) * | 1998-07-07 | 2007-01-11 | 신에쯔 한도타이 가부시키가이샤 | Soi웨이퍼의 제조방법 및 이 방법으로 제조된 soi웨이퍼 |
KR100607186B1 (ko) * | 1998-10-16 | 2006-08-01 | 신에쯔 한도타이 가부시키가이샤 | 수소이온 주입 박리법에 의한 soi 웨이퍼 제조방법 및그 방법으로 제조된 soi 웨이퍼 |
US6372609B1 (en) | 1998-10-16 | 2002-04-16 | Shin-Etsu Handotai Co., Ltd. | Method of Fabricating SOI wafer by hydrogen ION delamination method and SOI wafer fabricated by the method |
WO2000024059A1 (fr) * | 1998-10-16 | 2000-04-27 | Shin-Etsu Handotai Co., Ltd. | Procede de production de tranche soi utilisant un procede de separation d'implantation d'ions hydrogene et tranche soi produite a l'aide du procede |
US6461939B1 (en) | 1999-04-09 | 2002-10-08 | Shin-Etsu Handotai Co., Ltd. | SOI wafers and methods for producing SOI wafer |
JP2002542622A (ja) * | 1999-04-21 | 2002-12-10 | シリコン ジェネシス コーポレイション | エピプロセスを用いたsoi基板の表面仕上げ |
JP2000331899A (ja) * | 1999-05-21 | 2000-11-30 | Shin Etsu Handotai Co Ltd | Soiウェーハの製造方法およびsoiウェーハ |
JP2003509838A (ja) * | 1999-08-20 | 2003-03-11 | エス オー イ テク シリコン オン インシュレータ テクノロジース | マイクロエレクトロニクス用基板の処理方法及び該方法により得られた基板 |
US6902988B2 (en) | 1999-08-20 | 2005-06-07 | S.O.I.Tec Silicon On Insulator Technologies S.A. | Method for treating substrates for microelectronics and substrates obtained by said method |
US7235427B2 (en) | 1999-08-20 | 2007-06-26 | S.O.I.Tec Silicon On Insulator Technologies | Method for treating substrates for microelectronics and substrates obtained by said method |
JP2001094080A (ja) * | 1999-09-24 | 2001-04-06 | Komatsu Electronic Metals Co Ltd | 半導体用薄膜ウェハの製造方法 |
EP2259299A1 (en) | 1999-10-14 | 2010-12-08 | Shin-Etsu Handotai Co., Ltd. | Method for manufacturing SOI wafer, and SOI wafer |
US6846718B1 (en) | 1999-10-14 | 2005-01-25 | Shin-Etsu Handotai Co., Ltd. | Method for producing SOI wafer and SOI wafer |
WO2001028000A1 (fr) * | 1999-10-14 | 2001-04-19 | Shin-Etsu Handotai Co., Ltd. | Procede de fabrication d'une tranche de soi, et tranche de soi |
US7176102B2 (en) | 1999-10-14 | 2007-02-13 | Shin-Etsu Handotai Co., Ltd. | Method for producing SOI wafer and SOI wafer |
KR100730806B1 (ko) * | 1999-10-14 | 2007-06-20 | 신에쯔 한도타이 가부시키가이샤 | Soi웨이퍼의 제조방법 및 soi 웨이퍼 |
JP2008028415A (ja) * | 1999-10-14 | 2008-02-07 | Shin Etsu Handotai Co Ltd | Soiウエーハの製造方法及びsoiウエーハ |
JPWO2003005435A1 (ja) * | 2001-07-05 | 2004-10-28 | 大見 忠弘 | 基板処理装置および基板処理方法、基板平坦化方法 |
JP2004535685A (ja) * | 2001-07-16 | 2004-11-25 | エス.オー.アイ.テック、シリコン、オン、インシュレター、テクノロジーズ | 表面状態を改善する方法 |
KR100465527B1 (ko) * | 2002-11-21 | 2005-01-13 | 주식회사 실트론 | Soi 웨이퍼의 결함 제거 및 표면 경면화 방법 |
JP2007525018A (ja) * | 2003-10-01 | 2007-08-30 | ウェーハマスターズ・インコーポレイテッド | フラッシュアニールを使用した選択的な加熱 |
US8993410B2 (en) | 2006-09-08 | 2015-03-31 | Silicon Genesis Corporation | Substrate cleaving under controlled stress conditions |
US9356181B2 (en) | 2006-09-08 | 2016-05-31 | Silicon Genesis Corporation | Substrate cleaving under controlled stress conditions |
US9640711B2 (en) | 2006-09-08 | 2017-05-02 | Silicon Genesis Corporation | Substrate cleaving under controlled stress conditions |
US9362439B2 (en) | 2008-05-07 | 2016-06-07 | Silicon Genesis Corporation | Layer transfer of films utilizing controlled shear region |
US11444221B2 (en) | 2008-05-07 | 2022-09-13 | Silicon Genesis Corporation | Layer transfer of films utilizing controlled shear region |
JP2010016356A (ja) * | 2008-06-04 | 2010-01-21 | Semiconductor Energy Lab Co Ltd | 半導体基板の作製方法 |
WO2011151968A1 (ja) | 2010-06-01 | 2011-12-08 | 信越半導体株式会社 | 貼り合わせウェーハの製造方法 |
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