JPH10145788A - 映像再生装置 - Google Patents
映像再生装置Info
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- JPH10145788A JPH10145788A JP29904896A JP29904896A JPH10145788A JP H10145788 A JPH10145788 A JP H10145788A JP 29904896 A JP29904896 A JP 29904896A JP 29904896 A JP29904896 A JP 29904896A JP H10145788 A JPH10145788 A JP H10145788A
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Abstract
(57)【要約】
【課題】 簡単な構成で縮小画面を表示することのでき
る映像再生装置を提供する。 【解決手段】 入力された8×8のDCT係数ブロック
に対し、まず水平方向の1次元逆DCT変換を行なう。
次に、垂直方向の1次元逆DCT変換を行なうが、この
とき画面の縮小率に応じて表示されない画素に関する演
算は行なわれない。これにより画像の復号における演算
数を減らすことができ、1台の復号器で多画面表示を行
なうことができる。
る映像再生装置を提供する。 【解決手段】 入力された8×8のDCT係数ブロック
に対し、まず水平方向の1次元逆DCT変換を行なう。
次に、垂直方向の1次元逆DCT変換を行なうが、この
とき画面の縮小率に応じて表示されない画素に関する演
算は行なわれない。これにより画像の復号における演算
数を減らすことができ、1台の復号器で多画面表示を行
なうことができる。
Description
【0001】
【発明の属する技術分野】この発明は映像再生装置に関
し、特にネットワークを介して伝送された複数のデジタ
ル画像を同一ネットワークの一箇所で多画面映像として
再生するための映像再生装置に関する。
し、特にネットワークを介して伝送された複数のデジタ
ル画像を同一ネットワークの一箇所で多画面映像として
再生するための映像再生装置に関する。
【0002】
【従来の技術】従来より撮影された動画像データを、M
PEG(MPEG1,MPEG2)などの方式により圧
縮し、ネットワークを介して伝送し、再生する技術が知
られている。
PEG(MPEG1,MPEG2)などの方式により圧
縮し、ネットワークを介して伝送し、再生する技術が知
られている。
【0003】図23は、MPEG方式による符号化の方
式を説明するための図である。図を参照して、MPEG
では、離散コサイン変換(以下DCTという)を利用し
た符号化方式が採用されている。MPEGでの符号化に
おいて、1枚の画像Sには、8×8画素のブロックBを
1つの単位として、2次元DCTが施される。その後ジ
グザグスキャンにより、DCTが施されたブロックは、
0ランとレベルの組合せとされた後、ハフマン符号化に
より符号化され、伝送される。
式を説明するための図である。図を参照して、MPEG
では、離散コサイン変換(以下DCTという)を利用し
た符号化方式が採用されている。MPEGでの符号化に
おいて、1枚の画像Sには、8×8画素のブロックBを
1つの単位として、2次元DCTが施される。その後ジ
グザグスキャンにより、DCTが施されたブロックは、
0ランとレベルの組合せとされた後、ハフマン符号化に
より符号化され、伝送される。
【0004】図24は、MPEG方式の動画像再生装置
(復号器)の構成を示すブロック図である。
(復号器)の構成を示すブロック図である。
【0005】図を参照して、再生装置はネットワークを
介して入力されたMPEGによるデータから、所望の可
変長符号(ハフマン符号)を分離する分離器105と、
分離された可変長符号の復号を行ない、0ランとレベル
とを再生する復号器107と、ジグザグスキャン部10
9と、8×8の係数ごとに逆量子化を行なう逆量子化部
111と、逆DCTを行なう逆DCT部113と、I−
ピクチャまたはP−ピクチャのどちらかの画像を記憶す
る第1および第2フレームメモリ117,119と、予
測処理である動き補償を行なう動き補償部115と、動
き補償された画像および逆DCT部113より出力され
る画像の加算を行なう加算器121と、第1フレームメ
モリ117、第2フレームメモリ119または加算器1
21のいずれかの出力を記憶する出力用フレームメモリ
123とを備える。
介して入力されたMPEGによるデータから、所望の可
変長符号(ハフマン符号)を分離する分離器105と、
分離された可変長符号の復号を行ない、0ランとレベル
とを再生する復号器107と、ジグザグスキャン部10
9と、8×8の係数ごとに逆量子化を行なう逆量子化部
111と、逆DCTを行なう逆DCT部113と、I−
ピクチャまたはP−ピクチャのどちらかの画像を記憶す
る第1および第2フレームメモリ117,119と、予
測処理である動き補償を行なう動き補償部115と、動
き補償された画像および逆DCT部113より出力され
る画像の加算を行なう加算器121と、第1フレームメ
モリ117、第2フレームメモリ119または加算器1
21のいずれかの出力を記憶する出力用フレームメモリ
123とを備える。
【0006】出力用フレームメモリ123に記憶された
画像は、出力され、ディスプレイに表示される。
画像は、出力され、ディスプレイに表示される。
【0007】また、従来より複数地点に設置されたカメ
ラにより撮影された映像を、多画面映像として1つの画
面に表示させるシステムが知られる。このようなシステ
ムは、1地点で多地点を監視する目的などのために使用
される。
ラにより撮影された映像を、多画面映像として1つの画
面に表示させるシステムが知られる。このようなシステ
ムは、1地点で多地点を監視する目的などのために使用
される。
【0008】このようなシステムに、MPEG方式を適
用させることが考えられるが、MPEG方式で、動画像
再生装置が処理するデータは1画面分だけでも膨大な量
である。したがって、複数の画面の処理をリアルタイム
に1台の再生装置で行なうことは困難である。
用させることが考えられるが、MPEG方式で、動画像
再生装置が処理するデータは1画面分だけでも膨大な量
である。したがって、複数の画面の処理をリアルタイム
に1台の再生装置で行なうことは困難である。
【0009】そのような制約の下で、MPEG方式を用
いて多画面映像を1つの画面に表示させるシステムとし
て以下のものが考えられる。
いて多画面映像を1つの画面に表示させるシステムとし
て以下のものが考えられる。
【0010】(1) 複数の復号器を用いて多画面表示
を実現するシステム 図25は、そのようなシステムの一例を示す図である。
図を参照して、システムは、複数のカメラ3a〜3c
と、それぞれのカメラに接続される符号器4a〜4c
と、符号化された信号を伝送する伝送路6と、伝送され
た信号をそれぞれの符号器からの信号に分離する分離器
10と、分離された信号をそれぞれ復号する複数の復号
器12a〜12cと、復号された画像を縮小し、合成す
る縮小合成器14と、縮小および合成された画像を表示
する多画面出力装置(ディスプレイ)16とから構成さ
れる。
を実現するシステム 図25は、そのようなシステムの一例を示す図である。
図を参照して、システムは、複数のカメラ3a〜3c
と、それぞれのカメラに接続される符号器4a〜4c
と、符号化された信号を伝送する伝送路6と、伝送され
た信号をそれぞれの符号器からの信号に分離する分離器
10と、分離された信号をそれぞれ復号する複数の復号
器12a〜12cと、復号された画像を縮小し、合成す
る縮小合成器14と、縮小および合成された画像を表示
する多画面出力装置(ディスプレイ)16とから構成さ
れる。
【0011】選択されたチャンネルのディジタル映像
が、それぞれの復号器12a〜12cで再生されるた
め、処理速度を特に考慮せずに多画面の再生を行なうこ
とができる。
が、それぞれの復号器12a〜12cで再生されるた
め、処理速度を特に考慮せずに多画面の再生を行なうこ
とができる。
【0012】(2) 受信側で復号器の制御を行なうシ
ステム 図26は、そのようなシステムの一例を示す図である。
ステム 図26は、そのようなシステムの一例を示す図である。
【0013】図を参照して、システムは、カメラ3a
と、カメラに接続される符号器4aと、双方向の伝送路
20と、伝送された信号から所望の信号を選択し、選択
された信号を分離する選択分離器22と、分離された信
号の復号を行なう復号器24と、復号された画像データ
を多画面表示する多画面出力装置16と、ユーザからの
多画面表示を行なうか、詳細画面表示(多画面表示の中
の1画面を拡大して表示する表示をいう)を行なうかの
指示に基づいて、画面サイズをカメラ側の制御パーソナ
ルコンピュータ(制御PC)18に伝送する制御PC2
6と、制御PC26からの画面サイズを入力し、符号器
4aを制御する制御PC18とから構成される。
と、カメラに接続される符号器4aと、双方向の伝送路
20と、伝送された信号から所望の信号を選択し、選択
された信号を分離する選択分離器22と、分離された信
号の復号を行なう復号器24と、復号された画像データ
を多画面表示する多画面出力装置16と、ユーザからの
多画面表示を行なうか、詳細画面表示(多画面表示の中
の1画面を拡大して表示する表示をいう)を行なうかの
指示に基づいて、画面サイズをカメラ側の制御パーソナ
ルコンピュータ(制御PC)18に伝送する制御PC2
6と、制御PC26からの画面サイズを入力し、符号器
4aを制御する制御PC18とから構成される。
【0014】多画面表示を行なうときは画面サイズに基
づいて、符号器4aは撮影された映像のデータを間引
き、符号化し伝送する。受信側では伝送されたデータを
1つの復号器(または複数の復号器)で再生する。詳細
画面を表示する場合には、符号器4aは、詳細画面を符
号化したデータの伝送を要求する。
づいて、符号器4aは撮影された映像のデータを間引
き、符号化し伝送する。受信側では伝送されたデータを
1つの復号器(または複数の復号器)で再生する。詳細
画面を表示する場合には、符号器4aは、詳細画面を符
号化したデータの伝送を要求する。
【0015】このシステムでは、多画面表示を行なうと
きに、復号器には予め間引きされることによりデータ量
を少なくされたデータが入力されるため、復号器での処
理の負担を軽減することができる。
きに、復号器には予め間引きされることによりデータ量
を少なくされたデータが入力されるため、復号器での処
理の負担を軽減することができる。
【0016】(3) 階層的符号化を採用するシステム 図27は、そのようなシステムの一例を示す図である。
【0017】図を参照して、システムは、カメラ3a
と、撮影された画像データの中の縮小画面表示のための
基本成分の符号化を行なう符号器4E1と、基本成分と
の加算により詳細画面を表示することができる拡張成分
を符号化する符号化器4E2と、両符号器4E1,4E
2から出力される符号化されたデータを多重する多重部
28と、多重されたデータを伝送する伝送路6と、伝送
された信号を分離する分離部30と、基本成分の復号を
行なう復号器32D1と、拡張成分の復号を行なう復号
器32D2と、基本成分と拡張成分の合成を行なう合成
部34と、多画面出力装置16とから構成される。
と、撮影された画像データの中の縮小画面表示のための
基本成分の符号化を行なう符号器4E1と、基本成分と
の加算により詳細画面を表示することができる拡張成分
を符号化する符号化器4E2と、両符号器4E1,4E
2から出力される符号化されたデータを多重する多重部
28と、多重されたデータを伝送する伝送路6と、伝送
された信号を分離する分離部30と、基本成分の復号を
行なう復号器32D1と、拡張成分の復号を行なう復号
器32D2と、基本成分と拡張成分の合成を行なう合成
部34と、多画面出力装置16とから構成される。
【0018】受信側では、基本成分のみを再生すること
で縮小画面を出力し、多画面再生を実現する。特定の画
面に対してフルサイズの画面を出力する場合には、基本
成分に拡張成分を加算したものを用いる。
で縮小画面を出力し、多画面再生を実現する。特定の画
面に対してフルサイズの画面を出力する場合には、基本
成分に拡張成分を加算したものを用いる。
【0019】
【発明が解決しようとする課題】しかしながら、上記
(1)のシステムでは、再生装置が複雑大型化するとい
う問題がある。また、上記(2)および(3)のシステ
ムでは、受信側の多画面再生の機能を送信側の符号器の
機能に依存させなければならない。そのために通信手続
き(プロトコル)やシステムの構成が複雑になり、コス
トアップにつながるという問題がある。
(1)のシステムでは、再生装置が複雑大型化するとい
う問題がある。また、上記(2)および(3)のシステ
ムでは、受信側の多画面再生の機能を送信側の符号器の
機能に依存させなければならない。そのために通信手続
き(プロトコル)やシステムの構成が複雑になり、コス
トアップにつながるという問題がある。
【0020】この発明は、上記問題点を解決するために
なされたもので、簡単な構成で縮小画面を表示すること
のできる映像再生装置を提供することを目的とする。
なされたもので、簡単な構成で縮小画面を表示すること
のできる映像再生装置を提供することを目的とする。
【0021】
【課題を解決するための手段】上記目的を達成するた
め、請求項1に記載の映像再生装置は、複数の画素から
なる映像を表示するためのデータを入力する入力手段
と、入力されたデータに基づいて、複数の画素のうち一
部の画素を表示するためのデータを演算する演算手段と
を備え、演算手段は、複数の画素に含まれる画素であっ
て、一部の画素以外の画素に関する演算を省くことを特
徴とする。
め、請求項1に記載の映像再生装置は、複数の画素から
なる映像を表示するためのデータを入力する入力手段
と、入力されたデータに基づいて、複数の画素のうち一
部の画素を表示するためのデータを演算する演算手段と
を備え、演算手段は、複数の画素に含まれる画素であっ
て、一部の画素以外の画素に関する演算を省くことを特
徴とする。
【0022】この発明に従うと、表示される一部の画素
以外の画素に関する演算が省かれるため、効率的に映像
を再生することが可能となる。
以外の画素に関する演算が省かれるため、効率的に映像
を再生することが可能となる。
【0023】さらに好ましくは、映像再生装置は、演算
手段により演算されたデータに基づいて、複数の縮小さ
れた画像を1画面に表示する表示手段を備える。
手段により演算されたデータに基づいて、複数の縮小さ
れた画像を1画面に表示する表示手段を備える。
【0024】この発明に従うと、1画面に複数の縮小さ
れた映像が表示されるため、使い勝手のよい映像再生装
置を提供することが可能となる。
れた映像が表示されるため、使い勝手のよい映像再生装
置を提供することが可能となる。
【0025】さらに好ましくは演算手段は、演算が省か
れた画素を補って動き補償を行なう動き補償手段を含
む。
れた画素を補って動き補償を行なう動き補償手段を含
む。
【0026】この発明に従うと、演算が省かれた画素を
補って動き補償が行なわれるため、効果的な画像の圧縮
および再生が可能となる。
補って動き補償が行なわれるため、効果的な画像の圧縮
および再生が可能となる。
【0027】さらに好ましくは、複数の画素からなる映
像を表示するためのデータはMPEG方式によるデータ
である。
像を表示するためのデータはMPEG方式によるデータ
である。
【0028】
【発明の実施の形態】図1は、本発明の第1の実施の形
態による復号器(映像再生装置)1の使用される環境を
示した図である。
態による復号器(映像再生装置)1の使用される環境を
示した図である。
【0029】図を参照して、復号器1は伝送路6に接続
される。復号器1には、多画面表示を行なうことができ
るディスプレイ2が接続される。伝送路6には、符号器
4a〜4cが接続される。符号器4a〜4cにはそれぞ
れカメラ3a〜3cが接続される。伝送路6にはまた、
オンデマンドのビデオサーバ5が接続される。
される。復号器1には、多画面表示を行なうことができ
るディスプレイ2が接続される。伝送路6には、符号器
4a〜4cが接続される。符号器4a〜4cにはそれぞ
れカメラ3a〜3cが接続される。伝送路6にはまた、
オンデマンドのビデオサーバ5が接続される。
【0030】復号器1は、カメラ3a〜3cおよびビデ
オサーバ5から出力される画像データのうち所望のもの
を復号する。ディスプレイ2には、復号された複数の画
像2a〜2dが多画面として表示される。また、ユーザ
からの指示により、1つの画面をフルサイズの画面とし
てディスプレイ2に表示することができる。
オサーバ5から出力される画像データのうち所望のもの
を復号する。ディスプレイ2には、復号された複数の画
像2a〜2dが多画面として表示される。また、ユーザ
からの指示により、1つの画面をフルサイズの画面とし
てディスプレイ2に表示することができる。
【0031】図2は、復号器1の構成を示すブロック図
である。この復号器は、図24に示される復号器の構成
に加えて、制御器101と、演算画素制御器103とを
備える。制御器101は、分離器105にチャンネル情
報を送り、所望のチャンネルの画像データを分離するよ
うに指示する。制御器101は、可変長符号復号器10
7に同期信号を送る。また制御器101は、演算画素制
御器103に表示すべき画面サイズを伝える。
である。この復号器は、図24に示される復号器の構成
に加えて、制御器101と、演算画素制御器103とを
備える。制御器101は、分離器105にチャンネル情
報を送り、所望のチャンネルの画像データを分離するよ
うに指示する。制御器101は、可変長符号復号器10
7に同期信号を送る。また制御器101は、演算画素制
御器103に表示すべき画面サイズを伝える。
【0032】演算画素制御器103は、逆DCT部11
3に、不要な演算を省略するための信号(演算画素の制
限信号)を送る。また、演算画素制御器103は、演算
画素の制御が行なわれた場合にも動き補償を適切に行な
うように、動き補償部115へ制御信号を送る。
3に、不要な演算を省略するための信号(演算画素の制
限信号)を送る。また、演算画素制御器103は、演算
画素の制御が行なわれた場合にも動き補償を適切に行な
うように、動き補償部115へ制御信号を送る。
【0033】多画面表示にあっては、伝送路を介して送
られるフルサイズの画面のデータを縮小し、表示する必
要がある。図3に示されるように、本実施の形態におい
ては、(A)に示されるフルサイズの画面と、(B)に
示される、フルサイズ画面に対して面積比1/4倍の画
面と、(C)に示される1/16倍の画面と、(D)に
示される1/64倍の画面の中から任意の大きさの画面
を表示することが可能である。
られるフルサイズの画面のデータを縮小し、表示する必
要がある。図3に示されるように、本実施の形態におい
ては、(A)に示されるフルサイズの画面と、(B)に
示される、フルサイズ画面に対して面積比1/4倍の画
面と、(C)に示される1/16倍の画面と、(D)に
示される1/64倍の画面の中から任意の大きさの画面
を表示することが可能である。
【0034】フルサイズ画面において表示される画素
は、(A)に示されるように、x方向0〜8、y方向0
〜8の8×8のブロックの集合から構成される。(B)
に示される1/4倍画面の表示にあっては、その8×8
のブロックのうち、x=0,2,4,6およびy=0,
2,4,6の位置にある画素のみが表示される。(C)
に示される1/16倍画面の表示にあっては、8×8の
ブロックのうち、x=0,4およびy=0,4の位置に
ある画素のみが表示される。(D)に示される1/64
倍画面の表示にあっては、8×8のブロックのうち、x
=0およびy=0の位置にある画素のみが表示される。
は、(A)に示されるように、x方向0〜8、y方向0
〜8の8×8のブロックの集合から構成される。(B)
に示される1/4倍画面の表示にあっては、その8×8
のブロックのうち、x=0,2,4,6およびy=0,
2,4,6の位置にある画素のみが表示される。(C)
に示される1/16倍画面の表示にあっては、8×8の
ブロックのうち、x=0,4およびy=0,4の位置に
ある画素のみが表示される。(D)に示される1/64
倍画面の表示にあっては、8×8のブロックのうち、x
=0およびy=0の位置にある画素のみが表示される。
【0035】本実施の形態では、(B)、(C)または
(D)の画面において縮小画面の表示に関係しない画素
を、逆DCT演算の演算対象から省くことを特徴として
いる。以下にその具体的な処理について述べる。
(D)の画面において縮小画面の表示に関係しない画素
を、逆DCT演算の演算対象から省くことを特徴として
いる。以下にその具体的な処理について述べる。
【0036】まず、図4を参照して、2次元の8点逆D
CT演算処理において、入力されるDCT係数ブロック
をF(u,v)とし、出力されるブロックをf(x,
y)とすると、逆DCT演算は式(1−1)で表わされ
る。ここで、引数x,vについて項の順序を変えると、
式(1−2)を導くことができる。
CT演算処理において、入力されるDCT係数ブロック
をF(u,v)とし、出力されるブロックをf(x,
y)とすると、逆DCT演算は式(1−1)で表わされ
る。ここで、引数x,vについて項の順序を変えると、
式(1−2)を導くことができる。
【0037】そこで、式(1−3)と定義すると、式
(1−1)は式(1−4)と表わすことができる。
(1−1)は式(1−4)と表わすことができる。
【0038】
【数1】
【0039】ここに、式(1−3)は水平方向の1次元
逆DCT変換を示し、式(1−4)は垂直方向の1次元
逆DCT変換を示す。このように、2次元逆DCT変換
は、水平方向と垂直方向のそれぞれの1次元逆DCT変
換に分けることができる。
逆DCT変換を示し、式(1−4)は垂直方向の1次元
逆DCT変換を示す。このように、2次元逆DCT変換
は、水平方向と垂直方向のそれぞれの1次元逆DCT変
換に分けることができる。
【0040】すなわち、実際に復号器に入力されるDC
T係数ブロックが図5に示される、x方向0〜7、y方
向0〜7のブロックであるときに、その2次元逆DCT
変換は、水平方向逆DCTと垂直方向逆DCTとの組合
せにより、図6のフローチャートでの処理により行なう
ことができる。
T係数ブロックが図5に示される、x方向0〜7、y方
向0〜7のブロックであるときに、その2次元逆DCT
変換は、水平方向逆DCTと垂直方向逆DCTとの組合
せにより、図6のフローチャートでの処理により行なう
ことができる。
【0041】図を参照して、ステップS1において変数
yを0とする。ステップS2においてy<7であるかが
判定される。ステップS2でYESであれば、ステップ
S3でy行に存在する8個の画素に対して水平方向の1
次元逆DCT演算が施される。その結果は、ステップS
4において同じy行に戻される。ステップS5において
変数yを1インクリメントする。次にステップS2から
の処理を繰返し行なう。
yを0とする。ステップS2においてy<7であるかが
判定される。ステップS2でYESであれば、ステップ
S3でy行に存在する8個の画素に対して水平方向の1
次元逆DCT演算が施される。その結果は、ステップS
4において同じy行に戻される。ステップS5において
変数yを1インクリメントする。次にステップS2から
の処理を繰返し行なう。
【0042】ステップS2でNOであれば、ステップS
6で変数xを0とする。ステップS7でx<7であるか
が判定される。ステップS7でYESであれば、ステッ
プS8でx列に存在する8個の画素について1次元逆D
CT演算が行われる。その結果は、ステップS9におい
て同じx列に戻される。ステップS10で変数xは1イ
ンクリメントされる。その後ステップS7からの処理が
繰返し行なわれる。
6で変数xを0とする。ステップS7でx<7であるか
が判定される。ステップS7でYESであれば、ステッ
プS8でx列に存在する8個の画素について1次元逆D
CT演算が行われる。その結果は、ステップS9におい
て同じx列に戻される。ステップS10で変数xは1イ
ンクリメントされる。その後ステップS7からの処理が
繰返し行なわれる。
【0043】ステップS7でNOとなれば1つのDCT
係数ブロックの逆DCT変換を終了する。
係数ブロックの逆DCT変換を終了する。
【0044】ここで図7を参照して、本実施の形態にお
いては、入力された8×8のDCT係数ブロックに対し
て、まずy=0〜8の範囲で水平方向の1次元逆DCT
を施す。次に、垂直方向の1次元逆DCTを施すわけで
あるが、このとき表示に関与しない画素の演算が省かれ
る。
いては、入力された8×8のDCT係数ブロックに対し
て、まずy=0〜8の範囲で水平方向の1次元逆DCT
を施す。次に、垂直方向の1次元逆DCTを施すわけで
あるが、このとき表示に関与しない画素の演算が省かれ
る。
【0045】具体的には、(A)のフルサイズ画面で
は、すべての画素が表示に関与するため、x=0〜8の
すべての範囲で垂直方向の1次元逆DCTが施される。
は、すべての画素が表示に関与するため、x=0〜8の
すべての範囲で垂直方向の1次元逆DCTが施される。
【0046】(B)の1/4倍画面では、x=0,2,
4,6の列のみが表示に関与する画素となるため、x=
1,3,4,7の列の画素に対しての演算は行なわれな
い。
4,6の列のみが表示に関与する画素となるため、x=
1,3,4,7の列の画素に対しての演算は行なわれな
い。
【0047】(C)の1/16倍画面では、x=0,4
の列のみが表示に関与する画素となるため、x=1〜
3,5〜7の列の画素に対しての演算は行なわれない。
の列のみが表示に関与する画素となるため、x=1〜
3,5〜7の列の画素に対しての演算は行なわれない。
【0048】(D)の1/64倍画面では、x=0の列
のみが表示に関与する画素となるため、x=1〜7の列
の画素に対しての演算は行なわれない。
のみが表示に関与する画素となるため、x=1〜7の列
の画素に対しての演算は行なわれない。
【0049】より具体的に本実施の形態において行なわ
れる逆DCTの処理は、図8のフローチャートに示され
るものとなる。
れる逆DCTの処理は、図8のフローチャートに示され
るものとなる。
【0050】図8を参照して、ステップS11〜S19
は、図6のステップS1〜S9と同一であるが、ステッ
プS20での処理が異なる。ステップS20においてフ
ルサイズ画面表示の場合はb=1とされ、1/4倍画面
表示の場合はb=2とされ、1/8倍画面表示の場合は
b=4とされ、1/64倍画面表示の場合はb=8とさ
れる。ステップS20では、xにbの値が加算される。
は、図6のステップS1〜S9と同一であるが、ステッ
プS20での処理が異なる。ステップS20においてフ
ルサイズ画面表示の場合はb=1とされ、1/4倍画面
表示の場合はb=2とされ、1/8倍画面表示の場合は
b=4とされ、1/64倍画面表示の場合はb=8とさ
れる。ステップS20では、xにbの値が加算される。
【0051】図8の処理により変換が行なわれた8×8
のブロックのうち、表示に必要となる画素を図3に示さ
れるように取出し表示することで縮小画面の表示は行な
われる。
のブロックのうち、表示に必要となる画素を図3に示さ
れるように取出し表示することで縮小画面の表示は行な
われる。
【0052】このように、縮小により画面に再生されな
い画素の演算を省くことにより1画面(1チャンネル)
当りの処理量を削減することができる。これにより、1
台の復号器でも多画面の再生が可能となる。
い画素の演算を省くことにより1画面(1チャンネル)
当りの処理量を削減することができる。これにより、1
台の復号器でも多画面の再生が可能となる。
【0053】次に、図2の演算画素制御器103が動き
補償部115に対して行なう処理について説明する。
補償部115に対して行なう処理について説明する。
【0054】動き補償は、フルサイズ画面の場合、図9
に示されるように、8×8のブロックを4つまとめた、
16×16のブロック(マクロブロック)MB単位とし
て行なわれる。
に示されるように、8×8のブロックを4つまとめた、
16×16のブロック(マクロブロック)MB単位とし
て行なわれる。
【0055】よって縮小画面を表示する場合には、画面
の縮小率に応じたマクロブロックで動き補償は行なわれ
る。
の縮小率に応じたマクロブロックで動き補償は行なわれ
る。
【0056】図10を参照して、動き補償とは、動画像
が時間的に前後の画面(A)、(B)で相関性が高いの
を利用してその差分をコード化する、MPEGなどに用
いられる予測符号化である。その差分をより小さくする
ために、マクロブロック内の画像がどのくらい移動した
かを表わす動きベクトルMVと、動きを考慮した前後の
画面の差分をコード化するのである。
が時間的に前後の画面(A)、(B)で相関性が高いの
を利用してその差分をコード化する、MPEGなどに用
いられる予測符号化である。その差分をより小さくする
ために、マクロブロック内の画像がどのくらい移動した
かを表わす動きベクトルMVと、動きを考慮した前後の
画面の差分をコード化するのである。
【0057】多画面再生時には、図11に示されるよう
に、動きベクトルも画面のサイズに合わせ、1/2、1
/4、1/8倍とする。
に、動きベクトルも画面のサイズに合わせ、1/2、1
/4、1/8倍とする。
【0058】また、動きベクトルの値によっては縮小操
作によって表示されない画素を参照しなければならない
場合がある。
作によって表示されない画素を参照しなければならない
場合がある。
【0059】たとえば、図12に示されるように、x=
1,3およびy=1,3の座標で示される画素が表示さ
れていない場合において、F、GまたはHの画素を参照
しなければならないときは、式(2−1)、式(2−
2)、または式(2−3)によりそれらの画素の周辺に
存在する画素から平均値を演算したものを、F、Gまた
はHの画素のデータとする。
1,3およびy=1,3の座標で示される画素が表示さ
れていない場合において、F、GまたはHの画素を参照
しなければならないときは、式(2−1)、式(2−
2)、または式(2−3)によりそれらの画素の周辺に
存在する画素から平均値を演算したものを、F、Gまた
はHの画素のデータとする。
【0060】 F=(B+C+D+E)/4 …(2−1) G=(B+C)/2 …(2−2) H=(B+D)/2 …(2−3) 図13は、本発明の第2の実施の形態による復号器の構
成を示すブロック図である。
成を示すブロック図である。
【0061】図を参照して、この復号器は図2に示され
る復号器の逆量子化部111と逆DCT部113との間
に乗算器125を設けている。乗算器125は、表示さ
れる画面サイズに応じて演算画素制御器103から出力
されるフィルタ行列を、逆量子化部111から出力され
る8×8のブロックに掛け合せる。これにより、逆量子
化部111から出力されるDCT係数の高周波部分を任
意に削除することができる。
る復号器の逆量子化部111と逆DCT部113との間
に乗算器125を設けている。乗算器125は、表示さ
れる画面サイズに応じて演算画素制御器103から出力
されるフィルタ行列を、逆量子化部111から出力され
る8×8のブロックに掛け合せる。これにより、逆量子
化部111から出力されるDCT係数の高周波部分を任
意に削除することができる。
【0062】逆量子化部111より出力される、8×8
のDCT係数ブロックに対して、フルサイズの画面を表
示する際には、式(3−1)のフィルタ行列が掛け合さ
れる。1/4倍画面を表示する際には、式(3−2)の
フィルタ行列が掛け合される。1/16倍画面を表示す
る際には、式(3−3)のフィルタ行列が掛け合され
る。1/64倍画面を表示する際には、式(3−4)の
フィルタ行列が掛け合される。
のDCT係数ブロックに対して、フルサイズの画面を表
示する際には、式(3−1)のフィルタ行列が掛け合さ
れる。1/4倍画面を表示する際には、式(3−2)の
フィルタ行列が掛け合される。1/16倍画面を表示す
る際には、式(3−3)のフィルタ行列が掛け合され
る。1/64倍画面を表示する際には、式(3−4)の
フィルタ行列が掛け合される。
【0063】
【数2】
【0064】
【数3】
【0065】このフィルタ行列により、フルサイズ画面
を表示する場合の8×8のDCT係数ブロックは、図1
4に示されるように逆量子化部111から出力されたま
まの状態で、逆DCT部113に入力される。
を表示する場合の8×8のDCT係数ブロックは、図1
4に示されるように逆量子化部111から出力されたま
まの状態で、逆DCT部113に入力される。
【0066】1/4倍画面を表示する場合のDCT係数
ブロックは、図15に示されるように、左上の4×4の
低周波部分を除いて0にクリアされる。
ブロックは、図15に示されるように、左上の4×4の
低周波部分を除いて0にクリアされる。
【0067】1/16倍画面を表示する場合のDCT係
数ブロックは、図16に示されるように、左上の2×2
の低周波部分を除いて、0にクリアされる。
数ブロックは、図16に示されるように、左上の2×2
の低周波部分を除いて、0にクリアされる。
【0068】1/64倍画面を表示する場合のDCT係
数ブロックは、図17に示されるように左上の1×1の
低周波部分を除いて0にクリアされる。
数ブロックは、図17に示されるように左上の1×1の
低周波部分を除いて0にクリアされる。
【0069】これらの処理は、後に行なわれる水平方向
の演算処理を部分的に省くことによって生じる誤差を最
小限にとどめるための処理である。
の演算処理を部分的に省くことによって生じる誤差を最
小限にとどめるための処理である。
【0070】これらの処理により、低周波成分のみとな
った8×8のDCT係数ブロックに対し、図18に示さ
れる水平方向の1次元逆DCTと、垂直方向の1次元逆
DCTとが実行される。
った8×8のDCT係数ブロックに対し、図18に示さ
れる水平方向の1次元逆DCTと、垂直方向の1次元逆
DCTとが実行される。
【0071】水平方向の1次元逆DCTでは、(A)の
フルサイズ画面においては、y=0〜7のすべての行で
逆DCTが施される。
フルサイズ画面においては、y=0〜7のすべての行で
逆DCTが施される。
【0072】(B)の1/4倍画面では、y=0〜3の
行でのみ逆DCTが施される。(C)の1/16倍画面
では、y=0〜1の行でのみ逆DCTが施される。
(D)の1/64倍画面では、y=0の行でのみ逆DC
Tが施される。
行でのみ逆DCTが施される。(C)の1/16倍画面
では、y=0〜1の行でのみ逆DCTが施される。
(D)の1/64倍画面では、y=0の行でのみ逆DC
Tが施される。
【0073】これらの水平方向の1次元逆DCTが施さ
れたDCT係数ブロックに対し、次に垂直方向の逆DC
Tを行なうが、これは図7に示される第1の実施の形態
での処理と同一であるので、ここでの説明を繰返さな
い。
れたDCT係数ブロックに対し、次に垂直方向の逆DC
Tを行なうが、これは図7に示される第1の実施の形態
での処理と同一であるので、ここでの説明を繰返さな
い。
【0074】図19は、以上に述べた水平方向逆DCT
と垂直方向逆DCTでの処理を示したフローチャートで
ある。
と垂直方向逆DCTでの処理を示したフローチャートで
ある。
【0075】このフローチャートのステップS101、
およびS103〜S110は、図8に示されるフローチ
ャートのステップS11、およびS13〜S20に対応
する。ステップS102においては、変数yがaを超え
たか否かが判定される。
およびS103〜S110は、図8に示されるフローチ
ャートのステップS11、およびS13〜S20に対応
する。ステップS102においては、変数yがaを超え
たか否かが判定される。
【0076】aの値は、フルサイズ画面にあっては7で
あり、1/4倍画面にあっては3であり、1/16倍画
面にあっては1であり、1/64倍画面にあっては0で
ある。
あり、1/4倍画面にあっては3であり、1/16倍画
面にあっては1であり、1/64倍画面にあっては0で
ある。
【0077】第2の実施の形態によると、1/64倍画
面においての演算数は従来技術の1/8倍となる。これ
により1つの復号器で十分多画面表示を実現することが
できる。
面においての演算数は従来技術の1/8倍となる。これ
により1つの復号器で十分多画面表示を実現することが
できる。
【0078】次に、本実施の形態による復号により生じ
る誤差について述べる。図20を参照して、復号を行な
う画素がF1からF13までのフレームで構成され、そ
れらのフレームが、I0、B0、B1、P0、B2、B
3、P1、B4、B5、P2、B6、B7およびI1の
順で構成されていると仮定する。ここに、I、P、Bは
それぞれ、MPEG方式におけるIピクチャ、Pピクチ
ャ、Bピクチャを示す。これらのデータの伝送の順は、
I0、P0、B0、B1、P1、B2、B3、P2、B
4、B5、I1、B6、B7の順である。
る誤差について述べる。図20を参照して、復号を行な
う画素がF1からF13までのフレームで構成され、そ
れらのフレームが、I0、B0、B1、P0、B2、B
3、P1、B4、B5、P2、B6、B7およびI1の
順で構成されていると仮定する。ここに、I、P、Bは
それぞれ、MPEG方式におけるIピクチャ、Pピクチ
ャ、Bピクチャを示す。これらのデータの伝送の順は、
I0、P0、B0、B1、P1、B2、B3、P2、B
4、B5、I1、B6、B7の順である。
【0079】図21は、図20のデータから第1の実施
の形態により縮小画面を作成したときと、従来のMPE
G方式により縮小画面を作成したときとの画素の輝度値
の差分(Δx)をとり、その二乗誤差平均を表わしたグ
ラフである。なお、従来のMPEG方式による縮小画面
とは、MPEG方式によりフルサイズ画面を再生し、そ
の画面を間引いて作成した縮小画面をいう。
の形態により縮小画面を作成したときと、従来のMPE
G方式により縮小画面を作成したときとの画素の輝度値
の差分(Δx)をとり、その二乗誤差平均を表わしたグ
ラフである。なお、従来のMPEG方式による縮小画面
とは、MPEG方式によりフルサイズ画面を再生し、そ
の画面を間引いて作成した縮小画面をいう。
【0080】図21においては、Iピクチャにおいて誤
差は0となり、経時的に誤差は累積されていく。しか
し、次に現われるIピクチャで誤差は0にリセットされ
る。これにより、従来技術の方法により再生した画面と
の誤差は、1/16倍画面で6%、1/64画面で最大
10%程度に抑えることができる。このように、視覚的
にも映像の劣化は認められない。
差は0となり、経時的に誤差は累積されていく。しか
し、次に現われるIピクチャで誤差は0にリセットされ
る。これにより、従来技術の方法により再生した画面と
の誤差は、1/16倍画面で6%、1/64画面で最大
10%程度に抑えることができる。このように、視覚的
にも映像の劣化は認められない。
【0081】図22は、第2の実施の形態における誤差
を示すグラフであり、図21と対応するグラフである。
を示すグラフであり、図21と対応するグラフである。
【0082】第2の実施の形態では、フィルタリングを
行なっているため、Iピクチャでの演算に関しても誤差
が生じるが、その誤差は第1の実施の形態での誤差の範
囲に納まる。したがって、第2の実施の形態にあっても
視覚上特に問題のない画面を再生することができる。
行なっているため、Iピクチャでの演算に関しても誤差
が生じるが、その誤差は第1の実施の形態での誤差の範
囲に納まる。したがって、第2の実施の形態にあっても
視覚上特に問題のない画面を再生することができる。
【0083】このように本発明によると、符号器に依存
せず多画面表示が可能となり、たとえばビデオサーバか
らの信号のように多画面表示を意図して符号化されてい
ない信号が、複数チャンネル伝送路に送信されているケ
ーブルテレビのようなシステムでも、多チャンネルの映
像モニタを多画面で同時に行なえるシステムを容易に構
築することができる。
せず多画面表示が可能となり、たとえばビデオサーバか
らの信号のように多画面表示を意図して符号化されてい
ない信号が、複数チャンネル伝送路に送信されているケ
ーブルテレビのようなシステムでも、多チャンネルの映
像モニタを多画面で同時に行なえるシステムを容易に構
築することができる。
【0084】また、上記実施の形態によると、フルサイ
ズの画面内に最大64画面の多画面表示が可能となり、
しかも1つの復号器で多画面表示を実現することができ
る。
ズの画面内に最大64画面の多画面表示が可能となり、
しかも1つの復号器で多画面表示を実現することができ
る。
【0085】またこの発明によると、端末の能力に応じ
た復号処理を行なうことができるので、符号器の能力に
よらない階層的な復号を行なうことができる。
た復号処理を行なうことができるので、符号器の能力に
よらない階層的な復号を行なうことができる。
【0086】さらに、復号器での処理を効率的に行なう
のみであるから、複雑な通信手続き(プロトコル)を必
要としない。
のみであるから、複雑な通信手続き(プロトコル)を必
要としない。
【0087】さらに、図26に示されるシステムでは、
復号器側からカメラへ指示を送る必要があるので、通信
に遅れが生ずる場合があるが、本発明によると、そのよ
うな通信の遅れをなくすことができる。
復号器側からカメラへ指示を送る必要があるので、通信
に遅れが生ずる場合があるが、本発明によると、そのよ
うな通信の遅れをなくすことができる。
【図1】本発明の第1の実施の形態における復号器1の
使用される環境を示す図である。
使用される環境を示す図である。
【図2】図1の符号器1の構成を示すブロック図であ
る。
る。
【図3】図1のディスプレイ2に表示される画面を説明
するための図である。
するための図である。
【図4】1次元逆DCT変換を説明するための図であ
る。
る。
【図5】逆DCT変換により処理される1つのブロック
を示す図である。
を示す図である。
【図6】1次元逆DCT変換の処理を示すフローチャー
トである。
トである。
【図7】DCT係数ブロックのうち1次元逆DCTを行
なう部分と行なわない部分とを説明するための図であ
る。
なう部分と行なわない部分とを説明するための図であ
る。
【図8】第1の実施の形態における復号器が行なう逆D
CT変換のフローチャートである。
CT変換のフローチャートである。
【図9】動き補償を行なう単位となるマクロブロックM
Bを示す図である。
Bを示す図である。
【図10】動き補償における動きベクトルMVを説明す
るための図である。
るための図である。
【図11】表示される画面サイズと動きベクトルの大き
さとの関係を示す図である。
さとの関係を示す図である。
【図12】動き補償において参照する画素のデータが演
算されていない場合の処理を説明するための図である。
算されていない場合の処理を説明するための図である。
【図13】本発明の第2の実施の形態における復号器の
構成を示すブロック図である。
構成を示すブロック図である。
【図14】フルサイズ画面において、乗算器125より
出力されるDCT係数ブロックの構成を示す図である。
出力されるDCT係数ブロックの構成を示す図である。
【図15】1/4倍画面において、乗算器125より出
力されるDCT係数ブロックの構成を示す図である。
力されるDCT係数ブロックの構成を示す図である。
【図16】1/16倍画面において、乗算器125より
出力されるDCT係数ブロックの構成を示す図である。
出力されるDCT係数ブロックの構成を示す図である。
【図17】1/64倍画面において、乗算器125より
出力されるDCT係数ブロックの構成を示す図である。
出力されるDCT係数ブロックの構成を示す図である。
【図18】第2の実施の形態において、DCT係数ブロ
ックの1次元逆DCTを行なう部分と行なわない部分と
を説明するための図である。
ックの1次元逆DCTを行なう部分と行なわない部分と
を説明するための図である。
【図19】第2の実施の形態における1次元逆DCTの
処理を示すフローチャートである。
処理を示すフローチャートである。
【図20】MPEG方式における画像のシーケンスを説
明するための図である。
明するための図である。
【図21】第1の実施の形態における映像の出力と、従
来技術における映像の出力との誤差を示す図である。
来技術における映像の出力との誤差を示す図である。
【図22】第2の実施の形態における映像の出力と、従
来技術における映像の出力との間の誤差を示す図であ
る。
来技術における映像の出力との間の誤差を示す図であ
る。
【図23】MPEG方式における単位ブロックを示す図
である。
である。
【図24】従来技術におけるMPEG方式を採用した復
号器の構成を示すブロック図である。
号器の構成を示すブロック図である。
【図25】図24に示される復号器を用いた多画面表示
システムの一例を示す図である。
システムの一例を示す図である。
【図26】受信側で符号器の制御を行なうことにより多
画面表示を実現するシステムの構成を示す図である。
画面表示を実現するシステムの構成を示す図である。
【図27】階層的符号化を採用した多画面表示を実現す
るシステムの構成を示す図である。
るシステムの構成を示す図である。
1 復号器 2 ディスプレイ 3a〜3c カメラ 4a〜4c 符号器 6 伝送路 101 制御器 103 演算画素制御器 113 逆DCT部 115 動き補償部 125 乗算器
Claims (4)
- 【請求項1】 複数の画素からなる映像を表示するため
のデータを入力する入力手段と、 前記入力されたデータに基づいて、前記複数の画素のう
ち一部の画素を表示するためのデータを演算する演算手
段とを備え、 前記演算手段は、前記複数の画素に含まれる画素であっ
て、前記一部の画素以外の画素に関する演算を省くこと
を特徴とする、映像再生装置。 - 【請求項2】 前記演算手段により演算されたデータに
基づいて、複数の縮小された画像を1画面に表示する表
示手段をさらに備えた、請求項1に記載の映像再生装
置。 - 【請求項3】 前記演算手段は、前記演算が省かれた画
素を補って動き補償を行なう動き補償手段を含む、請求
項1または2に記載の映像再生装置。 - 【請求項4】 前記複数の画素からなる映像を表示する
ためのデータは、MPEG方式によるデータである、請
求項1〜3のいずれかに記載の映像再生装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP29904896A JPH10145788A (ja) | 1996-11-11 | 1996-11-11 | 映像再生装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP29904896A JPH10145788A (ja) | 1996-11-11 | 1996-11-11 | 映像再生装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH10145788A true JPH10145788A (ja) | 1998-05-29 |
Family
ID=17867544
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP29904896A Withdrawn JPH10145788A (ja) | 1996-11-11 | 1996-11-11 | 映像再生装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH10145788A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH11234672A (ja) * | 1997-11-14 | 1999-08-27 | Sony Electronics Inc | デコ―ディング方法及び装置 |
JP2000341695A (ja) * | 1999-05-11 | 2000-12-08 | Thomson Licensing Sa | 符号化高精細度ビデオ信号から拡張デコード低減解像度ビデオ信号を得るための装置および方法 |
US7042950B2 (en) | 2001-11-14 | 2006-05-09 | Matsushita Electric Industrial Co., Ltd. | Multichannel video processing unit and method |
JP2009527994A (ja) * | 2006-02-21 | 2009-07-30 | クゥアルコム・インコーポレイテッド | 無線装置におけるマルチプログラム・ビューイング |
US8428048B2 (en) | 2006-02-21 | 2013-04-23 | Qualcomm Incorporated | Multi-program viewing in a wireless apparatus |
-
1996
- 1996-11-11 JP JP29904896A patent/JPH10145788A/ja not_active Withdrawn
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH11234672A (ja) * | 1997-11-14 | 1999-08-27 | Sony Electronics Inc | デコ―ディング方法及び装置 |
JP2006115536A (ja) * | 1997-11-14 | 2006-04-27 | Sony Electronics Inc | 復号方法及び復号装置 |
JP4510946B2 (ja) * | 1997-11-14 | 2010-07-28 | ソニー エレクトロニクス インク | 復号方法及び復号装置 |
JP4511451B2 (ja) * | 1997-11-14 | 2010-07-28 | ソニー エレクトロニクス インク | 復号方法及び復号装置 |
JP2000341695A (ja) * | 1999-05-11 | 2000-12-08 | Thomson Licensing Sa | 符号化高精細度ビデオ信号から拡張デコード低減解像度ビデオ信号を得るための装置および方法 |
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JP2009527994A (ja) * | 2006-02-21 | 2009-07-30 | クゥアルコム・インコーポレイテッド | 無線装置におけるマルチプログラム・ビューイング |
US8330866B2 (en) | 2006-02-21 | 2012-12-11 | Qualcomm Incorporated | Multi-program viewing in a wireless apparatus |
US8428048B2 (en) | 2006-02-21 | 2013-04-23 | Qualcomm Incorporated | Multi-program viewing in a wireless apparatus |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20040203 |