JPH0246232Y2 - - Google Patents
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- JPH0246232Y2 JPH0246232Y2 JP1984045998U JP4599884U JPH0246232Y2 JP H0246232 Y2 JPH0246232 Y2 JP H0246232Y2 JP 1984045998 U JP1984045998 U JP 1984045998U JP 4599884 U JP4599884 U JP 4599884U JP H0246232 Y2 JPH0246232 Y2 JP H0246232Y2
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Description
【考案の詳細な説明】
技術分野
本考案はスイツチングレギユレータに関し、特
に規定値以上の過電圧が入力された場合に於ける
保護に関するものである。[Detailed Description of the Invention] Technical Field The present invention relates to a switching regulator, and particularly relates to protection when an overvoltage exceeding a specified value is input.
背景技術
スイツチングレギユレータは、直流電源をスイ
ツチングすることにより脈流とし、この脈流をト
ランスに供給して変圧した後に整流することによ
つて所望の直流電圧に変換するものであつて、テ
レビジヨン受像機等の各種電子回路装置に多用さ
れている。BACKGROUND ART A switching regulator converts a DC power supply into a pulsating current by switching it, supplies this pulsating current to a transformer, transforms it, and then rectifies it to a desired DC voltage. It is widely used in various electronic circuit devices such as television receivers.
第1図はテレビジヨン受像機に用いられるスイ
ツチングレギユレータの一例を示す回路図であ
る。同図に於いて1は電源投入時にスイツチング
レギユレータを自動的に起動させる起動用トラン
ジスタであつて、電源入力端2a,2b間に例え
ばDC24Vの電源が供給されると、コンデンサ3
と抵抗4の値によつて決まる所定時間にわたつて
オンとなることにより、抵抗5および逆流防止用
のダイオード6を介してパルス幅可変出力回路7
に電源を供給する。パルス幅可変出力回路7はト
ランジスタ8,9とコンデンサ10,11および
抵抗12〜15とによつてマルチバイブレータ回
路を構成しており、コンデンサ10,11と抵抗
13,14の値によつて定まる一定周期の短形波
信号が出力される。そして、このマルチバイブレ
ータ回路の短形波出力信号は、ダイオード16お
よび抵抗17を介して電源を積分する抵抗18と
コンデンサ19の接続点Pに供給される。このた
め、積分回路はトランジスタ8がオフとなる期間
に於いて積分を行ない、トランジスタ8がオンに
なると抵抗17、ダイオード16およびトランジ
スタ8を介してコンデンサ19の充電電荷が急速
に放電されることになる。従つて、抵抗18とコ
ンデンサ19による積分回路からは、トランジス
タ8のオフ期間に於いて徐々にレベルが上昇し、
トランジスタ8がオンになると急減するマルチバ
イブレータの発振周期に同期した鋸歯状の積分信
号が発生されることになる。この積分信号は抵抗
20を介してトランジスタ21に供給されること
により、設定レベル以下の積分信号が供給される
期間に於いてのみオンとなつてパルス信号Aを発
生する。そして、このパルス信号Aのパルス幅は
後述するスイツチングレギユレータの出力レベル
に応じて、積分回路を構成する抵抗18とコンデ
ンサ19の接続点Pの電位に応じて可変されるこ
とになり、接続点Pの電位が高い場合には積分出
力の立ち上がりが急峻となることからトランジス
タ21のオン期間が長くなるとパルス信号Aのパ
ルス幅が広いものとなる。また、接続点Pの電位
が低い場合には、積分出力の立ち上りが緩やかと
なることから、トランジスタ21のオン期間が短
かくなつてパルス信号Aのパルス幅が狭いものと
なる。ただし、起動開始時に於いてはスイツチン
グレギユレータの出力は零であることから、パル
ス幅可変出力回路7からは予め定められた幅のパ
ルス信号Aが発生されることとなり、このパルス
信号Aによつてトランジスタ22がオン・オフ動
作を行なう。この様にしてトランジスタ22がパ
ルス信号Aによつて駆動されると、起動用トラン
ジスタ1から供給される起動電源が抵抗23を介
してパルストランス24の1次側にパルス信号A
に応じて流されることになり、その2次側出力に
よつて出力トランジスタ25がオン・オフ駆動さ
れる。出力トランジスタ25がオン・オフ動作を
行なうと、電源入力端2aに供給される電源が出
力トランス26の1次側に断続電流として流れる
ことになり、その2次側の両端間には1次電流の
オン期間、つまりパルス幅可変出力回路7から発
生されるパルス出力信号Aのデユーテイーに対応
したレベルの交流が出力されることになり、この
交流出力はダイオード27,28に於いて整流さ
れた後にコンデンサ29によつて平滑されること
により、出力端30a,30c間に例えば
DC22Vの電源として出力されることになる。従
つて、ダイオード27,28およびコンデンサ2
9は出力トランス26の出力を整流および平滑す
る整流回路を構成していることになる。また、出
力トランスの2次側に於ける中間タツプの出力
は、ダイオード31によつて整流されることによ
りDC12Vの電源として出力される。 FIG. 1 is a circuit diagram showing an example of a switching regulator used in a television receiver. In the figure, reference numeral 1 denotes a starting transistor that automatically starts the switching regulator when the power is turned on. When power of, for example, 24 VDC is supplied between the power input terminals 2a and 2b, the capacitor 3
By being turned on for a predetermined time determined by the value of the resistor 4 and the resistor 4, the pulse width variable output circuit 7 is output via the resistor 5 and the diode 6 for preventing backflow.
to supply power. The variable pulse width output circuit 7 constitutes a multivibrator circuit by transistors 8 and 9, capacitors 10 and 11, and resistors 12 to 15, and has a constant pulse width determined by the values of the capacitors 10 and 11 and resistors 13 and 14. A periodic rectangular wave signal is output. The rectangular wave output signal of this multivibrator circuit is supplied via a diode 16 and a resistor 17 to a connection point P between a resistor 18 and a capacitor 19 that integrates the power supply. Therefore, the integration circuit performs integration during the period when transistor 8 is off, and when transistor 8 is turned on, the charge in capacitor 19 is rapidly discharged via resistor 17, diode 16, and transistor 8. Become. Therefore, the level of the integrating circuit made up of the resistor 18 and the capacitor 19 gradually increases during the off period of the transistor 8.
When the transistor 8 is turned on, a sawtooth integral signal is generated which is synchronized with the oscillation period of the multivibrator, which rapidly decreases. This integral signal is supplied to the transistor 21 via the resistor 20, so that it is turned on and generates the pulse signal A only during the period in which the integral signal below the set level is supplied. The pulse width of this pulse signal A is varied in accordance with the output level of a switching regulator, which will be described later, and in accordance with the potential of a connection point P between a resistor 18 and a capacitor 19 that constitute an integrating circuit. When the potential at the connection point P is high, the integral output rises steeply, and therefore, as the on period of the transistor 21 becomes longer, the pulse width of the pulse signal A becomes wider. Furthermore, when the potential at the connection point P is low, the integral output rises slowly, so the on period of the transistor 21 becomes short and the pulse width of the pulse signal A becomes narrow. However, since the output of the switching regulator is zero at the start of startup, the pulse width variable output circuit 7 generates a pulse signal A with a predetermined width. The transistor 22 performs on/off operations according to the above. When the transistor 22 is driven by the pulse signal A in this manner, the starting power supplied from the starting transistor 1 is applied to the primary side of the pulse transformer 24 via the resistor 23 to receive the pulse signal A.
The output transistor 25 is turned on and off by its secondary output. When the output transistor 25 performs on/off operations, the power supplied to the power input terminal 2a flows as an intermittent current to the primary side of the output transformer 26, and a primary current flows between both ends of the secondary side. During the ON period of , that is, an alternating current at a level corresponding to the duty of the pulse output signal A generated from the variable pulse width output circuit 7 is output, and after this alternating current output is rectified by the diodes 27 and 28. By being smoothed by the capacitor 29, for example, the voltage between the output ends 30a and 30c is
It will be output as a 22V DC power supply. Therefore, diodes 27, 28 and capacitor 2
9 constitutes a rectifier circuit that rectifies and smoothes the output of the output transformer 26. Further, the output of the intermediate tap on the secondary side of the output transformer is rectified by the diode 31 and output as a 12V DC power source.
ここで、ダイオード31を介して出力される
12Vの出力電源は、ダイオード32を介してパル
ス幅可変出力回路7およびパルストランス24に
電源として供給されることになる。従つて、起動
用トランジスタ1は、スイツチングレギユレータ
の出力が電源としてパルス幅可変出力回路7およ
びパルストランス24に供給されるまでの短時間
にわたつてのみこれらの回路に起動時の電源を供
給すれば良いことになり、そのオン期間の設定は
コンデンサ3と抵抗4の値によつて決定される。 Here, the signal is output via the diode 31.
The 12V output power is supplied as power to the variable pulse width output circuit 7 and the pulse transformer 24 via the diode 32. Therefore, the starting transistor 1 supplies the starting power to these circuits only for a short period of time until the output of the switching regulator is supplied as power to the variable pulse width output circuit 7 and the pulse transformer 24. The on-period setting is determined by the values of the capacitor 3 and resistor 4.
一方、スイツチングレギユレータの+22V出力
は、抵抗33、可変抵抗器34および抵抗35に
よつて分圧され、その分圧出力は可変抵抗器34
の摺動片からエラーアンプを構成するトランジス
タ36に供給されることにより、このトランジス
タ36の出力が抵抗37を介して接続点Pに供給
される。そして、この接続点Pの電位はトランジ
スタ36により出力電圧に反比例して制御される
ことにより、フイードバツク制御されて出力電圧
が一定化される。 On the other hand, the +22V output of the switching regulator is divided by a resistor 33, a variable resistor 34, and a resistor 35, and the divided voltage output is divided by a variable resistor 34.
The output of the transistor 36 is supplied to the connection point P via the resistor 37 by being supplied from the sliding piece to the transistor 36 constituting the error amplifier. The potential at this connection point P is controlled by the transistor 36 in inverse proportion to the output voltage, thereby performing feedback control and making the output voltage constant.
次に負荷が増大すると、電源入力端2a−出力
トランス26の1次側−出力トランス25−微少
抵抗38−電源入力端2bを介してコンデンサ4
0a,40bによつて平均化された過電流が流れ
ることから、微少抵抗38の両端電位をベース入
力とするリミツター用のトランジスタ39がオン
となる。ここで、トランジスタ39がオンになる
と、接続点Pがアースに落されることから、トラ
ンジスタ21がオン状態を続けることになり、こ
れに伴なつてパルス信号Aは“H”状態を保持し
続けることになる。この結果、パルストランス2
4にはパルス信号が流れなくなることから、出力
トランジスタ25のオン・オフ動作が中止されて
出力の発生が阻止されることから、過負荷に対す
る保護が行なわれることになる。なお、40a,
40bは電源入力端2aとアース間に接続された
平滑用のコンデンサである。 Next, when the load increases, the capacitor 4
Since the overcurrent averaged by 0a and 40b flows, the limiter transistor 39 whose base input is the potential across the microresistance 38 is turned on. Here, when the transistor 39 is turned on, the connection point P is grounded, so the transistor 21 continues to be in the on state, and accordingly, the pulse signal A continues to be in the "H" state. It turns out. As a result, pulse transformer 2
Since the pulse signal no longer flows through the output transistor 4, the on/off operation of the output transistor 25 is stopped and generation of an output is prevented, thereby providing protection against overload. In addition, 40a,
40b is a smoothing capacitor connected between the power input terminal 2a and the ground.
しかしながら、上記構成によるスイツチングレ
ギユレータに於いて、例えば最大24Vの規定値を
越えて例えば48Vの過電圧があやまつて入力され
ると、出力トランジスタに過大電流が流れて破損
するとともに、過電圧のレベルによつては他の回
路部分も損傷してしまう問題を有している。 However, in the switching regulator with the above configuration, if an overvoltage of, for example, 48V exceeds the maximum specified value of 24V and is inadvertently input, an excessive current flows to the output transistor, causing damage, and the overvoltage level increases. Depending on the situation, other circuit parts may also be damaged.
考案の開示
従つて、本考案による目的は、過電圧が印加さ
れた場合に於ける保護が確実に行え、かつ外来ノ
イズ等による所定時間内の過電流には保護動作が
動作しないスイツチングレギユレータを提供する
ことである。DISCLOSURE OF THE INVENTION Therefore, the object of the present invention is to provide a switching regulator that can ensure protection when overvoltage is applied, and in which the protective operation does not operate in case of overcurrent within a predetermined time due to external noise, etc. The goal is to provide the following.
この様な目的を達成するために本考案は、ツエ
ナーダイオードと抵抗の直列体を直流電源の正極
入力端とリミツター用トランジスタの入力端との
間に設けたものである。 In order to achieve such an object, the present invention provides a series body of a Zener diode and a resistor between the positive input terminal of the DC power supply and the input terminal of the limiter transistor.
よつて、この様に構成されたスイツチングレギ
ユレータに於いては、規定値を越える直流電源が
印加されるとツエナーダイオードがオンとなつて
その出力がリミツター用トランジスタをオンさせ
ることから、出力トランジスタが強制的にカツト
オフされて過電圧入力による破損が防止されるこ
とになる。 Therefore, in a switching regulator configured in this way, when a DC power exceeding a specified value is applied, the Zener diode turns on and its output turns on the limiter transistor, so that the output The transistor will be forced cut off to prevent damage due to overvoltage input.
考案を実施するための最良な形態
第2図は本考案によるスイツチングレギユレー
タの一実施例を示す回路図であつて、第1図と同
一部分は同一記号を用いて示してある。同図に於
いて41は出力トランジスタ25とアース間に設
けられた例えば0.1Ω程度の微少値を有する電流
検出用の抵抗、42,43は抵抗41の両端電圧
を分圧する抵抗、44は分圧信号をレベルシフト
するダイオード、45はダイオード44の出力信
号を平滑・平均化するコンデンサ、46は抵抗4
7を介してパルス幅可変出力回路7の接続点Pと
アース間に接続されたリミツター用のトランジス
タであつて、抵抗48を介して供給されるコンデ
ンサ45による平滑信号をベース入力としてい
る。49はカソード側が電源入力端(+)2aに
接続されたツエナーダイオード、50はツエナー
ダイオード49とダイオード44のカソード側と
の間に接続された抵抗である。そして、ツエナー
ダイオード49は、最大許容電圧を越える過電圧
が入力された時にオンとなる様にその特性および
抵抗50の値が設定されている。BEST MODE FOR CARRYING OUT THE INVENTION FIG. 2 is a circuit diagram showing an embodiment of a switching regulator according to the present invention, and the same parts as in FIG. 1 are indicated using the same symbols. In the figure, 41 is a current detection resistor with a minute value of, for example, about 0.1Ω, which is installed between the output transistor 25 and the ground, 42 and 43 are resistors that divide the voltage across the resistor 41, and 44 is a voltage dividing resistor. A diode for level shifting the signal, 45 a capacitor for smoothing and averaging the output signal of the diode 44, and 46 a resistor 4.
This is a limiter transistor connected between the connection point P of the variable pulse width output circuit 7 and the ground via a resistor 48, and has a base input as a smoothed signal by a capacitor 45 supplied via a resistor 48. 49 is a Zener diode whose cathode side is connected to the power input terminal (+) 2a, and 50 is a resistor connected between the Zener diode 49 and the cathode side of the diode 44. The characteristics and the value of the resistor 50 are set so that the Zener diode 49 turns on when an overvoltage exceeding the maximum allowable voltage is input.
この様に構成されたスイツチングレギユレータ
に於いて、出力トランジスタ25がスイツチング
制御されると、出力トランス26の1次側に鋸歯
状の電流が流れることによりその2次側に巻数比
に応じて変圧された出力が発生され、この2次側
出力がダイオード27,28およびコンデンサ2
9により整流・平滑されて所望電圧の直流電源と
して電源出力端30a,30cから図示しない電
子機器に供給されることになる。また、この電源
出力は、抵抗33、可変抵抗34および抵抗35
に於いて分圧された後に、エアーランプを構成さ
れるトランジスタ36を介してパルス幅可変出力
回路7の接続点Pに供給されて、出力トランジス
タ25をスイツチング制御するパルス信号Aのパ
ルス幅が可変されることにより、出力電圧一定化
のためのフイードバツク制御が行なわれる。 In the switching regulator configured in this manner, when the output transistor 25 is subjected to switching control, a sawtooth current flows through the primary side of the output transformer 26, causing the secondary side to flow in accordance with the turns ratio. A transformed output is generated, and this secondary output is connected to diodes 27, 28 and capacitor 2.
9, the signal is rectified and smoothed and supplied as a DC power source of a desired voltage to an electronic device (not shown) from the power source output terminals 30a, 30c. In addition, this power output is connected to a resistor 33, a variable resistor 34, and a resistor 35.
After being divided in voltage at As a result, feedback control for making the output voltage constant is performed.
一方、電流検出用の抵抗41は、出力トランジ
スタ25とアース間に接続されていることから、
出力トランジスタ25に流れる電流そのもの、つ
まりコンデンサ40a,40bによつて平滑され
る以前の電流を検出することになる。このため
に、抵抗41の両端には、出力トランジスタ25
に流れる電流値に応じた鋸歯状の電流検出信号B
が第3図aに示す様に発生されることになる。そ
して、この電流検出信号は、抵抗42,43に於
いて分圧されることにより第3図bに示す信号C
となる。次にこの信号Cはダイオード44に供給
されることにより、第3図bに点線で示すVD分
がレベルシフトされて第3図cに示す様にピーク
部分のみが信号Dとして出力される。この信号D
は、コンデンサ45に於いて平滑・平均化される
ことにより、第3図dに示す信号Eとなる。この
様にして取り出された信号Eは、出力トランジス
タ25に流れる電流波形のピーク部分を注目して
取り出したものであるために、鋸歯状の波形形状
による影響は少なく、ピータ値に対する影響を最
も強く受ける信号となる。そして、出力トランジ
スタ25に過電流が流れて出力信号Eが予め設定
された基準値を越えると、トランジスタ46がオ
ンとなることによつて、パルス幅可変制御回路7
に於ける接続点Pを抵抗47を介してアースに落
すことになる。この結果、トランジスタ21がオ
ン状態を続けることから、パルス幅可変出力回路
7の動作が強制的に停止されることにより、出力
トランジスタ25がオフとなつて過電流による破
損が防止されることになる。 On the other hand, since the current detection resistor 41 is connected between the output transistor 25 and the ground,
The current flowing through the output transistor 25 itself, that is, the current before being smoothed by the capacitors 40a and 40b is detected. For this purpose, an output transistor 25 is connected across the resistor 41.
Sawtooth current detection signal B corresponding to the current value flowing in
will be generated as shown in FIG. 3a. Then, this current detection signal is voltage-divided by the resistors 42 and 43, so that the signal C shown in FIG.
becomes. Next, this signal C is supplied to the diode 44, whereby the level of V D shown by the dotted line in FIG. 3b is shifted, and only the peak portion is outputted as signal D as shown in FIG. 3c. This signal D
is smoothed and averaged by the capacitor 45, resulting in the signal E shown in FIG. 3d. Since the signal E extracted in this way is extracted by paying attention to the peak portion of the current waveform flowing through the output transistor 25, the effect of the sawtooth waveform shape is small, and the effect on the Peter value is the strongest. It becomes a signal to be received. Then, when an overcurrent flows through the output transistor 25 and the output signal E exceeds a preset reference value, the transistor 46 is turned on, thereby controlling the pulse width variable control circuit 7.
The connection point P at the terminal is grounded via the resistor 47. As a result, since the transistor 21 continues to be on, the operation of the variable pulse width output circuit 7 is forcibly stopped, and the output transistor 25 is turned off, thereby preventing damage due to overcurrent. .
次に何かの原因によつて、電源入力端2a,2
b間に許容電圧を越える過電圧が入力されると、
ツエナーダイオード49がオンとなる。そして、
このツエナーダイオード49がオンになると、そ
の出力が抵抗50,43を介してアースに流れる
ことにより抵抗分割されて出力されることにな
り、この分割出力信号がダイオード44、抵抗4
8を介してトランジスタ46をオンにする。トラ
ンジスタ46がオンなると、パルス幅可変出力回
路7の接続点Pが抵抗47を介してアースに落さ
れることにより、トランジスタ21がオン状態を
続けてパルス幅可変出力回路7の動作が強制的に
停止される。この結果、パルス幅可変出力回路7
から発生されるパルス信号Aによりスイツチング
動作を行なう出力トランジスタ25がカツトオフ
となることから、過電圧入力による破損が防止さ
れる。 Next, for some reason, the power input terminals 2a, 2
If an overvoltage exceeding the allowable voltage is input between
The Zener diode 49 is turned on. and,
When the Zener diode 49 is turned on, its output flows to the ground via the resistors 50 and 43, and is divided into resistances and output.
8 to turn on transistor 46. When the transistor 46 is turned on, the connection point P of the variable pulse width output circuit 7 is grounded via the resistor 47, so that the transistor 21 remains on and the operation of the variable pulse width output circuit 7 is forced. will be stopped. As a result, the pulse width variable output circuit 7
Since the output transistor 25, which performs the switching operation, is cut off by the pulse signal A generated from the output voltage, damage caused by overvoltage input is prevented.
この場合、入力電源ラインには他の機器に対す
る電源のオン・オフ等によつて多くのノイズが含
まれており、この電源をツエナーダイオードを介
してリミツター制御用の信号とすることには問題
が生ずるが、この場合にはコンデンサ45がノイ
ズを吸収することから何ら問題とはならない。 In this case, the input power line contains a lot of noise due to the power being turned on and off to other devices, so there is a problem in using this power as a signal for limiter control via a Zener diode. However, in this case, the capacitor 45 absorbs the noise, so there is no problem.
なお、抵抗50は、ツエナーダイオード49が
オンしたときのツエナーダイオード電流を制限す
るために入れたものであつて、ツエナーダイオー
ドの定確許容電力によつては、必ずしも挿入する
必要はない。 Note that the resistor 50 is inserted to limit the Zener diode current when the Zener diode 49 is turned on, and does not necessarily need to be inserted depending on the fixed allowable power of the Zener diode.
なお、上記実施例に於いては、リミツター用の
トランジスタ47がパルス幅可変出力回路7の接
続点Pを制御した場合について説明したが、出力
トランジスタ25の動作を強制的にオフ制御する
ことが出来る部分であればいかなる部分を制御し
ても良いことは言うまでもない。 In the above embodiment, a case has been described in which the limiter transistor 47 controls the connection point P of the variable pulse width output circuit 7, but the operation of the output transistor 25 can be forcibly turned off. It goes without saying that any part may be controlled.
以上説明した様に、本考案によるスイツチング
レギユレータに於いては出力トランジスタに流れ
る電流をダイレクトに検出し、この電流検出信号
のピーク部分を取り出して平滑し平均化した信号
を用いて過電圧が入力されたことを検出し、ツエ
ナーダイオードの出力信号をリミツター用のトラ
ンジスタに供給することによつて、出力トランジ
スタを強制的にオフさせるものであるために、迅
速にかつ確実に過電圧入力に対する出力トランジ
スタおよびその関連回路の破損を防止できるとい
う効果がある。 As explained above, in the switching regulator according to the present invention, the current flowing through the output transistor is directly detected, and the peak portion of this current detection signal is extracted, smoothed, and averaged. By detecting the input and supplying the output signal of the Zener diode to the limiter transistor, the output transistor is forcibly turned off. This has the effect of preventing damage to the circuits and related circuits.
また本願は、検出した電流に外来ノイズ等が含
まれていて電流検出信号のパルスの一サイクル分
だけ異常になつたとしても応答せず、電流検出信
号がある程度の連続した異常電流である時に応答
するので、通常のスイツチングレギユレータの使
用において、必要なときにだけ動作するという効
果もある。 In addition, the present application does not respond even if the detected current contains external noise and becomes abnormal for one cycle of the current detection signal pulse, but responds when the current detection signal is a continuous abnormal current to a certain extent. Therefore, when using a normal switching regulator, it has the effect of operating only when necessary.
第1図は従来のスイツチングレギユレータの一
例を示す回路図、第2図は本考案によるスイツチ
ングレギユレータの一実施例を示す回路図、第3
図a〜dは第2図に示す回路の動作を説明するた
めの各部波形図である。
1……起動トランジスタ、3,10,11,1
9,29,40a,40b……コンデンサ、45
……平滑・平均化するコンデンサ(コンデンサ)、
4,5,12,13,14,15,17,18,
20,23,33,35,37,41,42,4
3,47,48,50……抵抗、6,16,2
7,28,31,32,41,44……ダイオー
ド、8,9,21,22,25,36,39,4
6……トランジスタ、24……パルストランス、
26……出力トランス、49……ツエナーダイオ
ード。
Fig. 1 is a circuit diagram showing an example of a conventional switching regulator, Fig. 2 is a circuit diagram showing an embodiment of a switching regulator according to the present invention, and Fig. 3 is a circuit diagram showing an example of a switching regulator according to the present invention.
Figures a to d are waveform diagrams of various parts for explaining the operation of the circuit shown in Figure 2. 1...Starting transistor, 3, 10, 11, 1
9, 29, 40a, 40b... Capacitor, 45
...Smoothing/averaging capacitor (capacitor),
4, 5, 12, 13, 14, 15, 17, 18,
20, 23, 33, 35, 37, 41, 42, 4
3,47,48,50...Resistance, 6,16,2
7, 28, 31, 32, 41, 44...Diode, 8, 9, 21, 22, 25, 36, 39, 4
6...transistor, 24...pulse transformer,
26... Output transformer, 49... Zener diode.
Claims (1)
号を出力するパルス幅可変出力回路と、このパル
ス幅可変出力回路から発生されるパルス信号に応
じて開閉することにより出力トランスに断続電流
を供給する出力トランジスタと、この出力トラン
ジスの出力を整流平滑することにより目的とする
電圧の直流電源を出力する整流回路と、前記直流
電源出力の電圧に応じて前記パルス幅可変出力回
路を制御することによつて発生されるパルス信号
のパルス幅を制御するエラーアンプと、前記出力
トランジスタを直接流れる電流を検出するために
前記出力トランジスタに対して直列に接続された
微小抵抗と、この微小抵抗の両端間に発生される
電流検出信号のピーク部をレベルシフトによつて
取り出すダイオードと、このダイオードの出力信
号を平滑・平均化するコンデンサと、このコンデ
ンサによる平滑信号レベルが設定値を越えた時に
前記出力トランジスタを強制的にオフするリミツ
ター用のトランジスタを強制的にオフするリミツ
ター用のトランジスタとを備えたスイツチングレ
ギユレータに於いて、前記リミツター用のトラン
ジスタのベース側に接続されたツエナーダイオー
ドであつて、規定値以上の電源電圧が供給された
時にオンとなつてその出力により前記リミツター
用のトランジスタをオンするツエナーダイオード
とを備えたことを特徴とするスイツチングレギユ
レータ。 A variable pulse width output circuit that outputs a pulse signal whose pulse width is varied by external control, and an output transistor that supplies intermittent current to the output transformer by opening and closing in response to the pulse signal generated from this variable pulse width output circuit. and a rectifier circuit that rectifies and smoothes the output of this output transistor to output a DC power supply of a target voltage, and a pulse width variable output circuit that controls the pulse width variable output circuit according to the voltage of the DC power output. an error amplifier that controls the pulse width of the pulse signal to be generated; a microresistance connected in series with the output transistor to detect the current flowing directly through the output transistor; A diode that takes out the peak part of the current detection signal by level shifting, a capacitor that smooths and averages the output signal of this diode, and a capacitor that forcibly turns the output transistor when the level of the smoothed signal by this capacitor exceeds a set value. In a switching regulator equipped with a limiter transistor that forcibly turns off a limiter transistor that is turned off when A switching regulator comprising: a Zener diode which is turned on when the above power supply voltage is supplied, and whose output turns on the limiter transistor.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4599884U JPS60160084U (en) | 1984-03-30 | 1984-03-30 | switching regulator |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4599884U JPS60160084U (en) | 1984-03-30 | 1984-03-30 | switching regulator |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS60160084U JPS60160084U (en) | 1985-10-24 |
JPH0246232Y2 true JPH0246232Y2 (en) | 1990-12-06 |
Family
ID=30559993
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4599884U Granted JPS60160084U (en) | 1984-03-30 | 1984-03-30 | switching regulator |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60160084U (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5660920A (en) * | 1979-10-24 | 1981-05-26 | Fujitsu Ltd | Voltage trailing control circuit |
JPS5663618A (en) * | 1979-10-26 | 1981-05-30 | Fujitsu Ltd | Voltage drooping control circuit |
-
1984
- 1984-03-30 JP JP4599884U patent/JPS60160084U/en active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5660920A (en) * | 1979-10-24 | 1981-05-26 | Fujitsu Ltd | Voltage trailing control circuit |
JPS5663618A (en) * | 1979-10-26 | 1981-05-30 | Fujitsu Ltd | Voltage drooping control circuit |
Also Published As
Publication number | Publication date |
---|---|
JPS60160084U (en) | 1985-10-24 |
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