JPH0155514B2 - - Google Patents
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- JPH0155514B2 JPH0155514B2 JP56136552A JP13655281A JPH0155514B2 JP H0155514 B2 JPH0155514 B2 JP H0155514B2 JP 56136552 A JP56136552 A JP 56136552A JP 13655281 A JP13655281 A JP 13655281A JP H0155514 B2 JPH0155514 B2 JP H0155514B2
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- Cash Registers Or Receiving Machines (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、装置の待機中の所定時間ごとに商
品データを表示部で表示するもので表示機能付電
子レジスタ等に利用されるものである。[Detailed Description of the Invention] [Field of Industrial Application] This invention displays product data on a display section at predetermined intervals while the device is on standby, and is used in electronic registers with a display function, etc. .
一般に、たとえばPLU(プライス・ルツクアツ
プ)キーを備えた電子レジスタにおいては、各
PLUキーに対応して商品のキヤラクタコードお
よびその商品の単価データがメモリに記憶されて
いる。そして、登録時のPLUキー操作によつて
前記メモリから対応するキヤラクタコード、単価
データが読み出されて所定の登録処理が行なわ
れ、表示部は一連の登録操作に対応したデータを
表示し、また、売上データ処理を行なつておらず
待機している電子レジスタの表示部は前回の表示
を縦続しているか、あるいは時刻表示に切り替え
られていたり、特開昭56−35261号公報のように
始業時のみ日付を表示部に表示するものが知られ
ている。
Generally, for example, in an electronic register equipped with a PLU (Price Lookup) key, each
The character code of the product and the unit price data of the product are stored in the memory in correspondence with the PLU key. Then, by operating the PLU key at the time of registration, the corresponding character code and unit price data are read out from the memory and predetermined registration processing is performed, and the display section displays data corresponding to a series of registration operations, In addition, the display section of an electronic register that is not processing sales data and is on standby may display the previous display in cascade, or may have been switched to display the time, or as shown in Japanese Patent Application Laid-Open No. 56-35261. It is known that the date is displayed on the display only at the beginning of the day.
しかるに、従来、前記メモリに記憶された商品
のキヤラクタコードおよび単価データは単に登録
時に利用されているだけであり、売上データ処理
を行なつていない待機状態の時は前記メモリ内の
豊富な情報や表示部が有効に活用されていない無
駄があつた。
However, conventionally, the character code and unit price data of the product stored in the memory are simply used at the time of registration, and when the product is in a standby state where sales data is not being processed, the rich information in the memory is used. There was a lot of waste as the display area was not being used effectively.
この発明の課題は、売上データ処理を行なつて
いない待機状態時に商品のキヤラクタおよびその
商品の価格からなる複数の商品データを所定時間
ごとに記憶手段から読み出して表示し、記憶され
た前記商品データと表示部を有効に活用できるよ
うにすることである。 An object of the present invention is to read out and display a plurality of product data consisting of product characters and product prices from a storage means at predetermined time intervals during a standby state in which sales data processing is not being performed, and display the stored product data. and to enable effective use of the display section.
この発明の手段は次の通りである。 The means of this invention are as follows.
判断手段1(第4図の機能ブロツク図を参照、
以下同じ)は、売上データ処理を行なつていない
こと、即ち電子レジスタにキー入力が行なわれて
いないこと等を判断する(例えばCPU1等、
S2)。 Judgment means 1 (see the functional block diagram in Figure 4)
The same applies hereafter) determines that sales data is not being processed, that is, no key input has been made to the electronic register (for example, CPU 1, etc.)
S2 ).
計時手段2はこの判断手段1が売上データ処理
を行なつていないと判断した際に、例えば10秒等
の所定の時間を計時する(タイマー6等)。 When the determining means 1 determines that sales data processing is not being performed, the time measuring means 2 measures a predetermined period of time, such as 10 seconds (timer 6 or the like).
読出手段3はこの計時手段2が前記所定の時間
を計時する毎に予め記憶している例えばキヤベツ
120円、ニンジン93円等の複数の商品データのう
ち、少なくとも1つの商品データを順次読み出す
(CPU1等、S8)。 Each time the timer 2 measures the predetermined time, the readout means 3 reads the information stored in advance, for example, from the
At least one product data is sequentially read out of a plurality of product data such as 120 yen, carrot 93 yen, etc. (CPU 1, etc., S 8 ).
なお、括弧内は上記各手段が実施例においては
どのように具体化されたかを明瞭にするために実
施例中の番号あるいはステツプ数を参考に付加し
たものである。 In addition, in parentheses, numbers or step numbers in the embodiments are added for reference in order to clarify how each of the above-mentioned means is embodied in the embodiments.
この発明の手段の作用は次の通りである。 The operation of the means of this invention is as follows.
商品のキヤラクタおよびその価格を含む商品デ
ータを複数記憶し、売上データ処理に伴いこの商
品データを表示部に表示する表示機能付電子レジ
スタにおいて、判断手段1により売上データ処理
を行なつていないことが判断された際に、計時手
段2が所定の時間を計時する毎に読出手段3によ
り前記複数の商品データのうち、少なくとも1つ
の商品データを読み出し前記表示部に表示する。 In an electronic register with a display function that stores a plurality of product data including product characters and their prices and displays this product data on a display unit as sales data is processed, the determination means 1 determines that the sales data is not processed. When the determination is made, the reading means 3 reads out at least one product data from among the plurality of product data and displays it on the display section every time the clock means 2 measures a predetermined time.
従つて、売上データ処理に表示部を使用してい
ない時間を利用し、売上データ処理のために記憶
されている商品データを顧客に対する商品の宣伝
に有効に活用できる。 Therefore, the time when the display section is not used for sales data processing can be utilized, and the product data stored for sales data processing can be effectively utilized for advertising products to customers.
以下、一実施例を第1図ないし第3図を参照し
て説明する。
Hereinafter, one embodiment will be described with reference to FIGS. 1 to 3.
第1図は電子レジスタの概略システム構成図を
示し、符号1はCPUで、このCPU1はコントロ
ールバスCBを介して入力制御部2、表示制御部
3、印字制御部4、PLUメモリ5にR/W信号、
チツプ指定信号を出力し、印字制御部4から出力
される制御信号が入力される。また、CPU1は
アドレスバスABを介し、前記各制御部2,3,
4およびPLUメモリ5にアドレス信号を出力す
る。また、CPU1はデーバスDBを介し、入力バ
ツフアINからのデータを入力し、また表示制御
部3に備えられた表示バツフアDIおよび印字制
御部4に備えられた印字バツフアPRにそれぞれ
データを出力し、さらにPLUメモリ5との間に
おいてデータの授受を行なう。またCPU1はタ
イマ6にカウントアツプ用の信号UPおよびタイ
マ6の計数内容を消失する信号CLを夫々出力す
る。このタイマ6は入力された信号UPを計数し、
この計数データをデコーダ7へ出力する。デコー
ダ7は入力した計数データが10秒以上、3分以上
経過した時間を示す値に達している場合にはスリ
ーステートバツフア81,82に対して“1”信号
を出力する。このスリーステートバツフア81,
82にはCPU1からゲート信号が入力され、この
ゲート信号が入力された際、前記“1”信号をデ
ータバスDBに出力する。 FIG. 1 shows a schematic system configuration diagram of an electronic register, and reference numeral 1 indicates a CPU. W signal,
A chip designation signal is output, and a control signal output from the print control section 4 is input. Further, the CPU 1 communicates with each of the control units 2, 3,
4 and the PLU memory 5. Further, the CPU 1 inputs data from the input buffer IN via the data bus DB, and outputs the data to the display buffer DI provided in the display control section 3 and the print buffer PR provided in the print control section 4, respectively. Furthermore, data is exchanged with the PLU memory 5. Further, the CPU 1 outputs a count-up signal UP and a signal CL for erasing the count contents of the timer 6 to the timer 6, respectively. This timer 6 counts the input signal UP,
This count data is output to the decoder 7. The decoder 7 outputs a "1" signal to the three-state buffers 8 1 and 8 2 when the input counting data reaches a value indicating the time when 10 seconds or more or 3 minutes or more have passed. This three-state buffer 8 1 ,
A gate signal is input from the CPU 1 to 82 , and when this gate signal is input, the "1" signal is output to the data bus DB.
前記入力制御部2は入力部9にタイミング信号
KPを出力し、入力部9においてキー操作が行な
われた際にタイミング信号KPが操作キーに応じ
て選択され、キー入力信号KIとして入力バツフ
アINに入力される。前記入力部9には置数キー、
クリアキー、PLUキー、現金/預かりキーなど
のほか「登録」、「設定」など各モードに指定する
モードスイツチが備えられている。また、前記表
示制御部3はデイジツト信号DG、および表示バ
ツフアDIのデータをデコードしたセグメント信
号SGを表示部10に出力し、金額データなどを
表示する。また、前記印字制御部4には、印字部
11に備えられている印字ドラム(図示せず)の
印字位置信号TPと印字バツフアPR内のデータと
の一致によつて生じる印字駆動信号HDを印字部
11に送る。そして、印字部11は印字駆動信号
HDに従つて金額データなどを記録紙に印字す
る。 The input control section 2 inputs a timing signal to the input section 9.
KP is output, and when a key operation is performed in the input section 9, a timing signal KP is selected according to the operated key and inputted to the input buffer IN as a key input signal KI. The input section 9 includes a number key,
It is equipped with a clear key, PLU key, cash/deposit key, etc., as well as a mode switch for specifying each mode such as ``registration'' and ``setting.'' Further, the display control section 3 outputs the digit signal DG and the segment signal SG obtained by decoding the data of the display buffer DI to the display section 10 to display amount data and the like. The print control unit 4 also prints a print drive signal HD generated when the print position signal TP of a print drum (not shown) provided in the print unit 11 matches the data in the print buffer PR. Send to Department 11. Then, the printing unit 11 receives a print drive signal.
Prints amount data etc. on recording paper according to HD.
また、前記PLUメモリ5の各記憶領域には
夫々商品名を示すキヤラクタードとその商品の単
価データからなる一連のデータが記憶され、さら
にこの一連のデータを電子レジスタの登録中断時
に表示するか否かを指定する表示フラグが記憶さ
れる。そして、この各記憶領域の行アドレスは置
数キー操作によつて入力されたPLU番号と対応
づけられている。 Further, each storage area of the PLU memory 5 stores a series of data consisting of a character indicating a product name and unit price data of the product, and whether or not this series of data is displayed when electronic register registration is interrupted. A display flag is stored that specifies whether the The row address of each storage area is associated with the PLU number input by operating the numeric keys.
次に、この発明の動作について説明する。ま
ず、入力部9のモードスイツチを「設定」モード
に指定し、置数キー、PLUキーを順次操作し、
続けて置数キー□1あるいは□0を操作してPLUメ
モリ5の対応する記憶領域に表示フラグをセツト
する。そして、モードスツチを「登録」モードに
指定した状態では常時第2図のフローに従つた動
作が実行されている。 Next, the operation of this invention will be explained. First, set the mode switch on the input section 9 to "setting" mode, operate the numeric keys and the PLU key in sequence,
Next, operate the numeric key □1 or □0 to set the display flag in the corresponding storage area of the PLU memory 5. When the mode switch is set to the "registration" mode, the operation according to the flow shown in FIG. 2 is always executed.
すなわち、ステツプS1の実行において、入力バ
ツフアINの内容がCPU1のAレジスタに転送さ
れる。次いでステツプS2の実行に移り、Aレジス
タの内容が「0」であるか否かの判断が実行さ
れ、否と判断されてデータの入力が有る場合には
ステツプS3に移る。ステツプS3の実行において、
CPU1からタイマ6に信号CLが出力され、その
内容はクリアされる。次いでステツプS4の実行に
移り、Aレジスタ内のキーコードに従つた処理動
作が実行され、この後ステツプS1に戻る。前記ス
テツプS2においてAレジスタの内容が「0」の場
合は、キー操作は行なわれて無いと判断されてス
テツプS5に移る。ステツプS5の実行において、
CPU1から信号UPが出力され、タイマの計数値
がカウントアツプされる。次いでステツプS6の実
行に移り、CPU1からスリーステートバツフア
82にゲート信号が出力され、そこから“1”信
号の出力が有るか否かの判断が実行され、否と判
断されると3分に達して無いとみなされてステツ
プS1に戻る。 That is, in executing step S1 , the contents of the input buffer IN are transferred to the A register of the CPU1. Next, the program moves to step S2 , where it is determined whether the contents of the A register are "0" or not.If it is determined not to be "0" and there is data input, the program moves to step S3 . In executing step S3 ,
A signal CL is output from the CPU 1 to the timer 6, and its contents are cleared. Next, the process moves to step S4 , where a processing operation according to the key code in the A register is executed, and then the process returns to step S1 . If the content of the A register is "0" in step S2 , it is determined that no key operation has been performed, and the process moves to step S5 . In executing step S5 ,
The signal UP is output from CPU1, and the count value of the timer is counted up. Next, the process moves to step S6 , in which the gate signal is output from the CPU 1 to the three-state buffer 82 , from which it is determined whether or not a "1" signal is output. It is assumed that the time limit has not been reached and the process returns to step S1 .
前記ステツプS6においてタイマ6が3分を経過
したと判断されるとステツプS7に移る。ステツプ
S7の実行において、PLUメモリ5の各記憶領域
を指定するPLUアドレスの初期値がXレジスタ
に設定される。次いでステツプS8の実行に移り、
Xレジスタによつてアドレス指定されるPLUメ
モリ5の記憶領域M(X)の内容がAレジスタに
読み出される。次いでステツプS9の実行に移り、
Aレジスタに表示フラグ“11”が含まれているか
否かの判断が実行され、有りと判断されるとステ
ツプS10に移る。ステツプS10では、CPU1から信
号CLが出力されタイマ6の内容がクリアされる。
次いでステツプS11の実行に移り、Aレジスタの
キヤラクタコードおよび単価データからなる一連
のデータが表示バツフアDIに転送され、表示部
10において表示され、この後ステツプS12に移
る。前記ステツプS9においてAレジスタに表示フ
ラグが記憶されて無い場合にもステツプS12に移
り、Xレジスタ内のアドレスが更新される。次い
でステツプS13の実行に移り、Xレジスタの内容
がPLUメモリ5の各記憶領域の最終アドレスよ
り大でアドレスENDになつたか否かの判断が実
行され、YESと判断されるとステツプS7に戻り、
否と判断されるとステツプS14に移る。ステツプ
S14の実行において、入力バツフアINの内容がA
レジスタに転送される。次いでステツプS15の実
行に移り、Aレジスタの内容が「0」で無いと判
断されると、キー操作が行なわれたとみなされて
ステツプS3に戻り、「0」と判断されるとステツ
プS16に移る。ステツプS16の実行において、CPU
1から信号UPが出力され、タイマ6の内容が
「1」アツプされる。次いでステツプS17の実行に
移り、CPU1からスリーステートバツフア81に
ゲート信号が出力され、そこから“1”信号の出
力が有るか否か即ち、ステツプS6においてタイマ
6がクリアされてから10秒経過したか否かが判断
され、経過していなければステツプS14に戻り、
PLUのキヤラクタ及び単価を表示し続ける。10
秒が経過すればステツプS8へ戻り、次のPLUデ
ータが表示される。 When it is determined in step S6 that three minutes have elapsed on the timer 6, the process moves to step S7 . step
In the execution of S7 , the initial value of the PLU address specifying each storage area of the PLU memory 5 is set in the X register. Next, proceed to step S8 ,
The contents of the storage area M(X) of the PLU memory 5 addressed by the X register are read into the A register. Next, proceed to step S9 ,
A determination is made as to whether or not the display flag "11" is included in the A register, and if it is determined that the display flag is present, the process moves to step S10 . In step S10 , the signal CL is output from the CPU 1 and the contents of the timer 6 are cleared.
Next, the process moves to step S11 , where a series of data consisting of the character code and unit price data in the A register is transferred to the display buffer DI and displayed on the display section 10, and then the process moves to step S12 . Even if the display flag is not stored in the A register in step S9 , the process moves to step S12 and the address in the X register is updated. Next, the process moves to step S13 , where it is determined whether the content of the X register is greater than the final address of each storage area of the PLU memory 5 and has reached the address END.If it is determined to be YES, the process proceeds to step S7 . return,
If it is determined no, the process moves to step S14 . step
When executing S14 , the contents of the input buffer IN are A.
Transferred to register. Next, the process moves to step S15 , and if it is determined that the contents of the A register are not "0", it is assumed that a key operation has been performed, and the process returns to step S3 ; if it is determined that the content is "0", the process returns to step S3. Move to 16 . In executing step S16 , the CPU
A signal UP is output from 1, and the contents of timer 6 are incremented by 1. Next, the process moves to step S17 , where a gate signal is output from the CPU 1 to the three-state buffer 81 , and it is determined whether or not a "1" signal is output from there, that is, after the timer 6 is cleared in step S6. It is determined whether 10 seconds have elapsed, and if not, the process returns to step S14 .
Continue to display the PLU character and unit price. Ten
When the second has elapsed, the process returns to step S8 and the next PLU data is displayed.
例えば、第3図に示すように置数キー□1、
PLUキーを順次操作すると、入力された数値デ
ータ「1」と対応するPLUメモリ5の記憶領域
の内容が読み出され、表示部10にその商品のキ
ヤラクタ「キヤベツ」と単価「120」が表示され
る。続いて置数キー□2、PLUキーを操作すると、
前述と同様の動作が行なわれて表示部10に「ニ
ンジン93」が表示され、さらに続けて現金/預か
りキーを操作すると表示部10に「ゴウケイ213」
の表示が行なわれ、これと同時にレシートが発行
される。 For example, as shown in Figure 3, the number key □1,
When the PLU keys are operated in sequence, the contents of the storage area of the PLU memory 5 corresponding to the input numerical data "1" are read out, and the character "Cabetsu" and unit price "120" of the product are displayed on the display section 10. Ru. Next, operate the numeric key □2 and the PLU key,
The same operation as described above is performed and "Carrot 93" is displayed on the display section 10, and when the cash/deposit key is further operated, "Gokei 213" is displayed on the display section 10.
will be displayed and a receipt will be issued at the same time.
前記顧客の登録終了後、キー操作が行なわれず
に3分間経過したとすると、前記ステツプS6〜
S17が順次実行される結果、PLUメモリ5の最初
の記憶領域に記憶された一連のデータが読み出さ
れ、表示部10において「キヤベツ120」が表示
される。この後、タイマ6がカウントアツプさ
れ、前記データが表示されてから10秒の経過がス
テツプS17で判断されると、PLUメモリ5の2番
目の記憶領域の内容が読み出されるが、表示フラ
グが“0”であるので、次の3番目の記憶領域の
データ「タマネギ48」が表示部10において表示
される。全く同様に、PLUメモリ5の各記憶領
域の一連のデータが10秒毎に順次読み出され、こ
のうち表示フラグが記憶されているデータが10秒
毎に順次表示部10において表示される。そし
て、PLUメモリ5の各記憶領域の内容の読み出
しがすべて終了すると前記ステツプS13,S7が実
行され、この結果、PLUメモリ5は再び最初の
記憶領域から読み出しが開始され、表示部10に
おいて10秒毎に前述と同様の表示が繰り返えされ
る。ところで、PLUメモリ5の内容が10秒毎に
切り替え表示されている間、次の顧客に対して登
録操作を行なつたとすると、前記ステツプS15に
おいてこのキー操作が検出されてステツプS3,S4
が順次実行されてタイマ6がクリアされると共に
入力処理が実行される。そして、前記顧客に対し
て登録終了の後3分が経過すると、表示部10に
PLUメモリ5の前記一連のデータが10秒毎に順
次繰り返し表示される。 Assuming that 3 minutes have passed without any key operation after the customer's registration is completed, steps S6 to S6 are performed.
As a result of sequential execution of S17 , a series of data stored in the first storage area of the PLU memory 5 is read out, and "cabbage 120" is displayed on the display unit 10. Thereafter, the timer 6 counts up and when it is determined in step S17 that 10 seconds have passed since the data was displayed, the contents of the second storage area of the PLU memory 5 are read out, but the display flag is Since it is “0”, the data “onion 48” in the next third storage area is displayed on the display unit 10. In exactly the same way, a series of data in each storage area of the PLU memory 5 is sequentially read out every 10 seconds, and among these data, the data in which the display flag is stored is sequentially displayed on the display unit 10 every 10 seconds. When the reading of the contents of each storage area of the PLU memory 5 is completed, steps S 13 and S 7 are executed, and as a result, the PLU memory 5 starts reading from the first storage area again, and the display unit 10 The same display as above is repeated every 10 seconds. By the way, if you perform a registration operation for the next customer while the contents of the PLU memory 5 are being switched and displayed every 10 seconds, this key operation will be detected in step S15 and the process will proceed to steps S3 and S. Four
are executed sequentially, the timer 6 is cleared, and the input processing is executed. Then, when three minutes have passed after the registration for the customer is completed, the display section 10 displays
The series of data in the PLU memory 5 is displayed repeatedly in sequence every 10 seconds.
前述したようにこの実施例では、顧客に対して
登録が終了した後3分が経過すると、表示部10
には自動的にPLUメモリ5の表示指定された一
連のデータが順次表示されるから、特にオペレー
タが表示を切り替える操作を行なう必要もなくて
便利である。また、前記実施例ではPLUメモリ
5に記憶された一連のデータのうち10秒毎に表示
する一連のデータを自由に表示指定できる利点も
ある。 As mentioned above, in this embodiment, when 3 minutes have passed after the registration for the customer is completed, the display unit 10
Since the series of data designated for display in the PLU memory 5 is automatically displayed in sequence, there is no need for the operator to perform any particular display switching operation, which is convenient. In addition, the above embodiment has the advantage that out of the series of data stored in the PLU memory 5, a series of data to be displayed every 10 seconds can be freely designated for display.
なお、前記実施例においては、PLUメモリ5
の一連のデータを夫々PLUキーに併せて入力す
る数値と対応づけたが、これに限らず、前記一連
のデータを夫々部門別キーと対応づけても良い。 Note that in the above embodiment, the PLU memory 5
Although each series of data is associated with a numerical value input in conjunction with a PLU key, the present invention is not limited to this, and each series of data may be associated with a department key.
また、前記実施例においてはPLUメモリ5の
表示指示された一連のデータを表示部10に切り
替え表示するよう構成したが、これに限らず、表
示部10に表示データが1桁づつ一方向に移動す
る、いわゆる流れ文字として表示するよう構成し
てもよい。 Further, in the above embodiment, a series of data instructed to be displayed in the PLU memory 5 is switched and displayed on the display section 10, but the present invention is not limited to this, and the display data is moved one digit at a time in one direction. It may also be configured to display the text as so-called flowing text.
また、前記実施例においては登録操作が中断し
てから3分が経過すると自動的に一連のデータを
順次切り替え表示させる構成としたが、これに限
らず、前記一連のデータの表示を開始するスイツ
チを備えてもよい。 Furthermore, in the embodiment described above, a series of data is automatically switched and displayed in sequence when three minutes have elapsed since the registration operation was interrupted, but the present invention is not limited to this. may be provided.
また、前記実施例においては前記一連のデータ
を切り替え表示させる構成としたが、これに限ら
ず、前記一連のデータを順次音声によつて発音さ
せることも可能である。 Further, in the embodiment described above, the series of data is switched and displayed, but the present invention is not limited to this, and it is also possible to sequentially pronounce the series of data by voice.
この発明によれば、売上データ処理に表示部を
使用していない時間を利用し、売上データ処理の
ために記憶している商品データを表示部に表示す
るようにしたため、売上データ処理のために記憶
している商品データを顧客に対する商品の宣伝に
有効に活用することができ、顧客に対するサービ
スの向上が図れる。
According to this invention, the product data stored for sales data processing is displayed on the display section by using the time when the display section is not used for sales data processing. Stored product data can be effectively utilized for advertising products to customers, and service to customers can be improved.
第1図はこの発明の一実施例を示す概略システ
ム構成図、第2図は同実施例の動作を説明するた
めのフローチヤート、第3図は同実施例のキー操
作手順図と表示状態図、第4図はこの発明の機能
ブロツク図である。
1…CPU、3…表示制御部、5…PLUメモリ、
6…タイマ、7…デコーダ、81,82…スリース
テートバツフア、10…表示部。
Fig. 1 is a schematic system configuration diagram showing an embodiment of the present invention, Fig. 2 is a flowchart for explaining the operation of the embodiment, and Fig. 3 is a key operation procedure diagram and display state diagram of the embodiment. , FIG. 4 is a functional block diagram of the present invention. 1...CPU, 3...Display control unit, 5...PLU memory,
6...Timer, 7...Decoder, 81 , 82 ...Three-state buffer, 10...Display section.
Claims (1)
データを複数記憶し、売上データ処理に伴いこの
商品データを表示部に表示する表示機能付電子レ
ジスタにおいて、売上データ処理を行なつていな
いことを判断する判断手段と、この判断手段が売
上データ処理を行なつていないと判断した際に、
所定の時間を計時する計時手段と、この計時手段
が所定の時間を計時する毎に前記記憶している複
数の商品データから少なくとも1つの商品データ
を順次読み出す読出手段とを備え、この読み出さ
れた商品データを前記表示部に順次表示すること
を特徴とする表示機能付電子レジスタ。1. Judgment to determine that sales data is not being processed in an electronic register with a display function that stores multiple pieces of product data including product characters and their prices and displays this product data on a display unit as sales data is processed. means, and when it is determined that this judgment means is not processing sales data,
A clocking means for counting a predetermined time; and a reading means for sequentially reading out at least one product data from the plurality of stored product data each time the clocking means clocks a predetermined time. 1. An electronic cash register with a display function, characterized in that product data is sequentially displayed on the display section.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13655281A JPS5837770A (en) | 1981-08-31 | 1981-08-31 | Display system for electronic register |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP13655281A JPS5837770A (en) | 1981-08-31 | 1981-08-31 | Display system for electronic register |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5837770A JPS5837770A (en) | 1983-03-05 |
JPH0155514B2 true JPH0155514B2 (en) | 1989-11-24 |
Family
ID=15177883
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP13655281A Granted JPS5837770A (en) | 1981-08-31 | 1981-08-31 | Display system for electronic register |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5837770A (en) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS55123770A (en) * | 1979-03-16 | 1980-09-24 | Sharp Corp | Electronic cash register |
JPS5614368A (en) * | 1979-07-13 | 1981-02-12 | Sharp Corp | Electronic cash register |
-
1981
- 1981-08-31 JP JP13655281A patent/JPS5837770A/en active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS55123770A (en) * | 1979-03-16 | 1980-09-24 | Sharp Corp | Electronic cash register |
JPS5614368A (en) * | 1979-07-13 | 1981-02-12 | Sharp Corp | Electronic cash register |
Also Published As
Publication number | Publication date |
---|---|
JPS5837770A (en) | 1983-03-05 |
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