JPH08331616A - 非同期転送モードを用いたマルチプロセッサ制御方式のデジタル構内交換機 - Google Patents
非同期転送モードを用いたマルチプロセッサ制御方式のデジタル構内交換機Info
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- JPH08331616A JPH08331616A JP7133654A JP13365495A JPH08331616A JP H08331616 A JPH08331616 A JP H08331616A JP 7133654 A JP7133654 A JP 7133654A JP 13365495 A JP13365495 A JP 13365495A JP H08331616 A JPH08331616 A JP H08331616A
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- H04Q11/00—Selecting arrangements for multiplex systems
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- H04Q11/0478—Provisions for broadband connections
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/54—Store-and-forward switching systems
- H04L12/56—Packet switching systems
- H04L12/5601—Transfer mode dependent, e.g. ATM
- H04L2012/5638—Services, e.g. multimedia, GOS, QOS
- H04L2012/5671—Support of voice
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- Computer Networks & Wireless Communication (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Exchange Systems With Centralized Control (AREA)
- Sub-Exchange Stations And Push- Button Telephones (AREA)
Abstract
(57)【要約】
【目的】 本発明は、複数のシングルプロセッサ方式デ
ジタル構内交換機にＡＴＭを用いて、ＰＣＭ音声やデー
タおよびプロセッサ間の通信データを多重化することに
よりマルチプロセッサ方式のデジタル構内交換機を提供
する。 【構成】 プロセッサ部、時分割スイッチ、加入者回
路、トランク回路、電話機端末等により構成され、時分
割スイッチ２１のＰＣＭ音声信号やデータは、ＡＴＭイ
ンタフェ−ス回路３１を介してＡＴＭスイッチ５に接続
される等して音声信号等の通信を可能とし、さらに一方
のプロセッサから他方のプロセッサにデータを送信する
場合は、プロセッサからのデータをＡＴＭインタフェ−
ス回路で音声信号等と多重化し他方のＡＴＭスイッチイ
ンターフェース回路に送信する。
ジタル構内交換機にＡＴＭを用いて、ＰＣＭ音声やデー
タおよびプロセッサ間の通信データを多重化することに
よりマルチプロセッサ方式のデジタル構内交換機を提供
する。 【構成】 プロセッサ部、時分割スイッチ、加入者回
路、トランク回路、電話機端末等により構成され、時分
割スイッチ２１のＰＣＭ音声信号やデータは、ＡＴＭイ
ンタフェ−ス回路３１を介してＡＴＭスイッチ５に接続
される等して音声信号等の通信を可能とし、さらに一方
のプロセッサから他方のプロセッサにデータを送信する
場合は、プロセッサからのデータをＡＴＭインタフェ−
ス回路で音声信号等と多重化し他方のＡＴＭスイッチイ
ンターフェース回路に送信する。
Description
【０００１】
【産業上の利用分野】本発明は、マルチプロセッサ制御
方式のデジタル構内交換機に関し、特にプロセッサ間デ
ータ転送にＡＴＭ（非同期転送モード）を用いた方式に
関する。
方式のデジタル構内交換機に関し、特にプロセッサ間デ
ータ転送にＡＴＭ（非同期転送モード）を用いた方式に
関する。
【０００２】
【従来の技術】図３は、従来のマルチプロセッサ制御方
式のデジタル構内交換機のプロセッサ間接続を示す一般
的なブロック図である。従来のマルチプロセッサ制御方
式のデジタル構内交換機は、負荷分散、機能分散のため
複数のプロセッサ部７１〜７６により構成され、プロセ
ッサ間データ転送を行う手段としてプロセッサ間データ
通信専用バス７を備え、かつプロセッサ間データ通信専
用バス７とプロセッサ間のインターフェースを行うプロ
セッサ間バスインターフェース回路８１〜８６を備えて
いる。また、時分割スイッチ９１〜９４と空間分割スイ
ッチ６との間の接続においても専用のバスを備えてお
り、これらにより、マルチプロセッサ制御方式の構内交
換機は実現されている。
式のデジタル構内交換機のプロセッサ間接続を示す一般
的なブロック図である。従来のマルチプロセッサ制御方
式のデジタル構内交換機は、負荷分散、機能分散のため
複数のプロセッサ部７１〜７６により構成され、プロセ
ッサ間データ転送を行う手段としてプロセッサ間データ
通信専用バス７を備え、かつプロセッサ間データ通信専
用バス７とプロセッサ間のインターフェースを行うプロ
セッサ間バスインターフェース回路８１〜８６を備えて
いる。また、時分割スイッチ９１〜９４と空間分割スイ
ッチ６との間の接続においても専用のバスを備えてお
り、これらにより、マルチプロセッサ制御方式の構内交
換機は実現されている。
【０００３】図４は、従来のプロセッサ間接続方式を示
すブロック図であり、特開平２−２７７３４０号公報に
も開示されている。複数のプロセッサ１００〜１０ｎが
ＡＴＭスイッチに接続されて構成されている。各プロセ
ッサは、ＡＴＭインターフェース回路を有し、このイン
ターフェース回路を介して、各プロセッサはＡＴＭスイ
ッチに接続される。これにより、各プロセッサ間のデー
タ通信を実現している。
すブロック図であり、特開平２−２７７３４０号公報に
も開示されている。複数のプロセッサ１００〜１０ｎが
ＡＴＭスイッチに接続されて構成されている。各プロセ
ッサは、ＡＴＭインターフェース回路を有し、このイン
ターフェース回路を介して、各プロセッサはＡＴＭスイ
ッチに接続される。これにより、各プロセッサ間のデー
タ通信を実現している。
【０００４】
【発明が解決しようとする課題】従来技術の第１の問題
点は、この従来のマルチプロセッサ制御方式のデジタル
構内交換機において、上述のようにプロセッサ間でデー
タ通信用のバスと、時分割スイッチ間接続用のバスを別
々に必要とする。ＡＴＭを用いる方法が示されている
が、従来の技術は、単にプロセッサ間のデータ通信のみ
であり、時分割スイッチ間接続用のバス等の性質の異な
るバスについては、何も示されていない。その理由は、
プロセッサ間データ通信用バスと、時分割スイッチ間接
続用のバスは信号形式、転送速度が異なっているためで
あり、単に多重するのみではマルチプロセッサ方式のデ
ジタル構内交換機を実現できないからである。
点は、この従来のマルチプロセッサ制御方式のデジタル
構内交換機において、上述のようにプロセッサ間でデー
タ通信用のバスと、時分割スイッチ間接続用のバスを別
々に必要とする。ＡＴＭを用いる方法が示されている
が、従来の技術は、単にプロセッサ間のデータ通信のみ
であり、時分割スイッチ間接続用のバス等の性質の異な
るバスについては、何も示されていない。その理由は、
プロセッサ間データ通信用バスと、時分割スイッチ間接
続用のバスは信号形式、転送速度が異なっているためで
あり、単に多重するのみではマルチプロセッサ方式のデ
ジタル構内交換機を実現できないからである。
【０００５】第２の問題点は、前述のプロセッサ間デー
タ通信用バスと時分割スイッチ間接続用バスの距離を長
くすることができず、通常１つのシステム内で使用し、
システム間にまたがって使用することができなかった。
その理由は、前述のプロセッサ間データ通信用バスと時
分割スイッチ間接続用バスの通信速度は高速であり、距
離が長い場合はビットエラー等の通信障害が起きてしま
うためである。
タ通信用バスと時分割スイッチ間接続用バスの距離を長
くすることができず、通常１つのシステム内で使用し、
システム間にまたがって使用することができなかった。
その理由は、前述のプロセッサ間データ通信用バスと時
分割スイッチ間接続用バスの通信速度は高速であり、距
離が長い場合はビットエラー等の通信障害が起きてしま
うためである。
【０００６】本発明の目的は、２台以上のシングルプロ
セッサ方式デジタル構内交換機に非同期転送モードを用
いてＰＣＭ音声やデータを伝送すると同時に、プロセッ
サ間通信のデータを多重化することによりマルチプロセ
ッサ方式のデジタル構内交換機を構成する。これによ
り、前述の従来の技術の問題点を解決し、かつ、マスタ
のデジタル構内交換機からすべてのスレーブのデジタル
構内交換機のシステム設定を行うことができるようにす
ることにある。
セッサ方式デジタル構内交換機に非同期転送モードを用
いてＰＣＭ音声やデータを伝送すると同時に、プロセッ
サ間通信のデータを多重化することによりマルチプロセ
ッサ方式のデジタル構内交換機を構成する。これによ
り、前述の従来の技術の問題点を解決し、かつ、マスタ
のデジタル構内交換機からすべてのスレーブのデジタル
構内交換機のシステム設定を行うことができるようにす
ることにある。
【０００７】
【課題を解決するための手段】上記目的を達成するため
に、本発明の非同期転送モードを用いたマルチプロセッ
サ制御方式のデジタル構内交換機は、第１のデジタル構
内交換機の時分割スイッチのＰＣＭ音声信号やデータ信
号、およびプロセッサ部からの制御信号をＡＴＭ符号化
してＡＴＭスイッチに送出し、またＡＴＭスイッチから
のＡＴＭ符号化されたデータであるセルをＰＣＭ音声信
号やデータ信号および制御信号に複号化し、ＰＣＭ音声
信号やデータ信号は時分割スイッチに送出し、制御信号
はプロセッサ部に送出するＡＴＭインターフェース回路
を有し、第２のデジタル構内交換機も第１のデジタル構
内交換機と同様にＡＴＭインターフェース回路を有し、
第１のデジタル構内交換機と第２のデジタル構内交換機
を第１のデジタル構内交換機に搭載されたＡＴＭスイッ
チを用いて接続することで構成するものである。
に、本発明の非同期転送モードを用いたマルチプロセッ
サ制御方式のデジタル構内交換機は、第１のデジタル構
内交換機の時分割スイッチのＰＣＭ音声信号やデータ信
号、およびプロセッサ部からの制御信号をＡＴＭ符号化
してＡＴＭスイッチに送出し、またＡＴＭスイッチから
のＡＴＭ符号化されたデータであるセルをＰＣＭ音声信
号やデータ信号および制御信号に複号化し、ＰＣＭ音声
信号やデータ信号は時分割スイッチに送出し、制御信号
はプロセッサ部に送出するＡＴＭインターフェース回路
を有し、第２のデジタル構内交換機も第１のデジタル構
内交換機と同様にＡＴＭインターフェース回路を有し、
第１のデジタル構内交換機と第２のデジタル構内交換機
を第１のデジタル構内交換機に搭載されたＡＴＭスイッ
チを用いて接続することで構成するものである。
【０００８】望ましい態様としては、マスタのデジタル
構内交換機となる第１のデジタル構内交換機に、デジタ
ル構内交換機の保守者により入力されたシステムの設定
を行うためのデータを記憶する主記憶装置と、例えば磁
気記憶装置の外部記憶装置と、外部記憶装置と中央演算
装置をインターフェースする外部記憶装置インターフェ
ース回路と、中央演算装置からのデータをＡＴＭ符号化
してＡＴＭスイッチに送出し、ＡＴＭスイッチからのセ
ルを中央演算装置へのデータに復号化して中央演算装置
に送出するＡＴＭインターフェース回路を備え、第２の
デジタル構内交換機も第１のデジタル構内交換機とＡＴ
Ｍスイッチを除いては同じ構成であり、第１のデジタル
構内交換機に記憶されているシステムの設定を行うデー
タを、ＡＴＭスイッチを用いて接続することで、マスタ
となる第１のデジタル構内交換機からスレーブとなる第
２のデジタル構内交換機のシステム設定を行える構成と
することが好ましい。
構内交換機となる第１のデジタル構内交換機に、デジタ
ル構内交換機の保守者により入力されたシステムの設定
を行うためのデータを記憶する主記憶装置と、例えば磁
気記憶装置の外部記憶装置と、外部記憶装置と中央演算
装置をインターフェースする外部記憶装置インターフェ
ース回路と、中央演算装置からのデータをＡＴＭ符号化
してＡＴＭスイッチに送出し、ＡＴＭスイッチからのセ
ルを中央演算装置へのデータに復号化して中央演算装置
に送出するＡＴＭインターフェース回路を備え、第２の
デジタル構内交換機も第１のデジタル構内交換機とＡＴ
Ｍスイッチを除いては同じ構成であり、第１のデジタル
構内交換機に記憶されているシステムの設定を行うデー
タを、ＡＴＭスイッチを用いて接続することで、マスタ
となる第１のデジタル構内交換機からスレーブとなる第
２のデジタル構内交換機のシステム設定を行える構成と
することが好ましい。
【０００９】
【作用】端末（電話機）からの音声は加入者回路でＰＣ
Ｍ化され、時分割スイッチを介してＡＴＭインターフェ
ース回路に入力される。ＡＴＭインターフェース回路で
はＰＣＭ音声信号をＡＴＭ符号化しＡＴＭスイッチへ出
力される。プロセッサからの制御信号もＡＴＭインター
フェース回路でＡＴＭ符号化されＡＴＭスイッチに出力
される。ＡＴＭスイッチからのセルをＡＴＭインターフ
ェース回路でＰＣＭ音声信号と制御信号を復号化しＰＣ
Ｍ音声信号やデータ信号は時分割スイッチに送出し制御
信号はプロセッサに送出する。また、マスタのデジタル
構内交換機のシステム設定データを前述の方法でプロセ
ッサを介してデータ転送することで、複数のデジタル構
内交換機のシステム設定を１台の構内交換機から行うこ
とができる。
Ｍ化され、時分割スイッチを介してＡＴＭインターフェ
ース回路に入力される。ＡＴＭインターフェース回路で
はＰＣＭ音声信号をＡＴＭ符号化しＡＴＭスイッチへ出
力される。プロセッサからの制御信号もＡＴＭインター
フェース回路でＡＴＭ符号化されＡＴＭスイッチに出力
される。ＡＴＭスイッチからのセルをＡＴＭインターフ
ェース回路でＰＣＭ音声信号と制御信号を復号化しＰＣ
Ｍ音声信号やデータ信号は時分割スイッチに送出し制御
信号はプロセッサに送出する。また、マスタのデジタル
構内交換機のシステム設定データを前述の方法でプロセ
ッサを介してデータ転送することで、複数のデジタル構
内交換機のシステム設定を１台の構内交換機から行うこ
とができる。
【００１０】
【実施例】次に本発明について図を参照して説明する。
【００１１】図１は本発明の非同期転送モードを用いた
マルチプロセッサ制御方式のデジタル構内交換機の構成
を示すブロック図である。
マルチプロセッサ制御方式のデジタル構内交換機の構成
を示すブロック図である。
【００１２】デジタル構内交換機１は、プロセッサ部１
１、時分割スチッチ２１、加入者回路４１、トランク回
路６１、そして電話機（端末）５１等により構成されて
いる。その他のデジタル構内交換機２〜４も同じ構成で
ある。ただし、マスタとなるデジタル構内交換機１のみ
はＡＴＭスイッチ５を搭載している。一般に回線数の少
ないデジタル構内交換機は、１台のプロセッサでデジタ
ル構内交換機全体を制御するシングルプロセッサ方式で
あり、回線数が多いデジタル構内交換機は、複数のプロ
セッサでデジタル構内交換機を制御するマルチプロセッ
サ方式である。
１、時分割スチッチ２１、加入者回路４１、トランク回
路６１、そして電話機（端末）５１等により構成されて
いる。その他のデジタル構内交換機２〜４も同じ構成で
ある。ただし、マスタとなるデジタル構内交換機１のみ
はＡＴＭスイッチ５を搭載している。一般に回線数の少
ないデジタル構内交換機は、１台のプロセッサでデジタ
ル構内交換機全体を制御するシングルプロセッサ方式で
あり、回線数が多いデジタル構内交換機は、複数のプロ
セッサでデジタル構内交換機を制御するマルチプロセッ
サ方式である。
【００１３】ここでは、本発明の一実施例として、デジ
タル構内交換機１とデジタル構内交換機２との間での制
御データや、ＰＣＭ音声信号の送受信方法について説明
する。
タル構内交換機１とデジタル構内交換機２との間での制
御データや、ＰＣＭ音声信号の送受信方法について説明
する。
【００１４】単独に機能するシングルプロセッサ方式の
デジタル構内交換機１における時分割スイッチ２１のＰ
ＣＭ音声信号やデータ信号は、ＡＴＭスイッチ５と接続
するためのＡＴＭインターフェース回路３１を介してＡ
ＴＭスイッチ５に接続される。これを第１のデジタル構
内交換機とする。
デジタル構内交換機１における時分割スイッチ２１のＰ
ＣＭ音声信号やデータ信号は、ＡＴＭスイッチ５と接続
するためのＡＴＭインターフェース回路３１を介してＡ
ＴＭスイッチ５に接続される。これを第１のデジタル構
内交換機とする。
【００１５】さらにもう一方のデジタル構内交換機２の
時分割スイッチ２２のＰＣＭ音声信号やデータ信号は、
ＡＴＭインターフェース回路３２を介してＡＴＭスイッ
チ５に接続される。これを第２のデジタル構内交換機と
する。
時分割スイッチ２２のＰＣＭ音声信号やデータ信号は、
ＡＴＭインターフェース回路３２を介してＡＴＭスイッ
チ５に接続される。これを第２のデジタル構内交換機と
する。
【００１６】ＡＴＭインターフェース回路３１，３２
は、ＡＴＭ符号化およびＡＴＭ復号化を行い、これによ
りデジタル構内交換機１，２間のＰＣＭ音声信号やデー
タ信号の通信を可能にする。さらにＡＴＭインターフェ
ース回路３１はプロセッサ部１１に接続され、ＡＴＭイ
ンターフェース回路３２はプロセッサ部１２に接続され
ている。第１のデジタル構内交換機１のプロセッサ部１
１から第２のデジタル構内交換機２のプロセッサ部１２
にデータを送信する場合は、プロセッサ部１１からのデ
ータをＡＴＭインターフェース回路３１で、音声信号や
データ信号と同様にしてＡＴＭ符号化してＡＴＭスイッ
チ５に送信する。ＡＴＭスイッチ５では、第１のデジタ
ル構内交換機１からのＡＴＭ符号化されたデータを、デ
ータのヘッダに示された相手先により交換処理して第２
のＡＴＭスイッチインターフェース回路３２に送信す
る。受信側のＡＴＭインターフェース回路３２は、第１
のデジタル構内交換機１のプロセッサ部１１からのＡＴ
Ｍ符号化された受信データをＡＴＭ復号化しプロセサ部
１２に送る。また、逆方向も同様にプロセッサ間データ
通信を行う。これにより、プロセッサ相互間のデータ通
信を可能にする。 このように、ＰＣＭ音声やデータお
よびプロセッサ間通信データをＡＴＭ多重化しＡＴＭス
イッチで伝送することにより、マルチプロセッサ方式の
デジタル構内交換機を構成することを可能とする。
は、ＡＴＭ符号化およびＡＴＭ復号化を行い、これによ
りデジタル構内交換機１，２間のＰＣＭ音声信号やデー
タ信号の通信を可能にする。さらにＡＴＭインターフェ
ース回路３１はプロセッサ部１１に接続され、ＡＴＭイ
ンターフェース回路３２はプロセッサ部１２に接続され
ている。第１のデジタル構内交換機１のプロセッサ部１
１から第２のデジタル構内交換機２のプロセッサ部１２
にデータを送信する場合は、プロセッサ部１１からのデ
ータをＡＴＭインターフェース回路３１で、音声信号や
データ信号と同様にしてＡＴＭ符号化してＡＴＭスイッ
チ５に送信する。ＡＴＭスイッチ５では、第１のデジタ
ル構内交換機１からのＡＴＭ符号化されたデータを、デ
ータのヘッダに示された相手先により交換処理して第２
のＡＴＭスイッチインターフェース回路３２に送信す
る。受信側のＡＴＭインターフェース回路３２は、第１
のデジタル構内交換機１のプロセッサ部１１からのＡＴ
Ｍ符号化された受信データをＡＴＭ復号化しプロセサ部
１２に送る。また、逆方向も同様にプロセッサ間データ
通信を行う。これにより、プロセッサ相互間のデータ通
信を可能にする。 このように、ＰＣＭ音声やデータお
よびプロセッサ間通信データをＡＴＭ多重化しＡＴＭス
イッチで伝送することにより、マルチプロセッサ方式の
デジタル構内交換機を構成することを可能とする。
【００１７】図２は、プロセッサ部１１、ＡＴＭインタ
ーフェース回路３１、ＡＴＭスイッチ５、時分割２１の
接続について示した図である。この図によりマスタのデ
ジタル構内交換機からスレーブのデジタル構内交換機に
対してシステム設定を行う方法について説明する。
ーフェース回路３１、ＡＴＭスイッチ５、時分割２１の
接続について示した図である。この図によりマスタのデ
ジタル構内交換機からスレーブのデジタル構内交換機に
対してシステム設定を行う方法について説明する。
【００１８】マスタのデジタル構内交換機１のプロセッ
サ部１１は、中央演算装置１１１、主記憶装置１１２、
外部記憶装置インターフェース回路１１３、外部記憶装
置１１４により構成されている。保守装置１１６は、プ
ロセッサ部１１の保守装置インターフェース１１５に接
続されている。中央演算装置１１１は、ＡＴＭインター
フェース回路３１の送信用ＡＴＭインターフェース回路
３１１と受信用ＡＴＭインターフェース回路３２２に接
続している。また時分割スイッチ２１とＡＴＭスイッチ
５もＡＴＭインターフェース回路３１に接続されてい
る。
サ部１１は、中央演算装置１１１、主記憶装置１１２、
外部記憶装置インターフェース回路１１３、外部記憶装
置１１４により構成されている。保守装置１１６は、プ
ロセッサ部１１の保守装置インターフェース１１５に接
続されている。中央演算装置１１１は、ＡＴＭインター
フェース回路３１の送信用ＡＴＭインターフェース回路
３１１と受信用ＡＴＭインターフェース回路３２２に接
続している。また時分割スイッチ２１とＡＴＭスイッチ
５もＡＴＭインターフェース回路３１に接続されてい
る。
【００１９】このような構成で、システムのデータ設定
は保守装置１１６から保守者等により入力される。入力
されたデータは、中央演算装置１１１の指令により、保
守装置インターフェース１１５を介して主記憶装置１１
２に記憶される。また、主記憶装置１１２内に記憶され
ているデータは、保守装置１１６からの指示や定期的な
中央演算装置１１１の処理により、外部記憶装置インタ
ーフェース１１３を介して、磁気記憶装置等の外部記憶
装置１１４に記憶される。主記憶装置１１２に記憶され
たシステム設定のデータは、中央演算装置１１１の処理
により送信用ＡＴＭインターフェース回路３１１に送出
し、送信用ＡＴＭインターフェース回路３１１によりＡ
ＴＭ符号化されたデータをＡＴＭスイッチ５を介してス
レーブのデジタル構内交換機に転送する。このデータを
受信したスレーブのデジタル構内交換機は、前述の送信
側とは逆の手順でスレーブのデジタル構内交換機の主記
憶装置に記憶する。これにより、マスタのデジタル構内
交換機からスレーブのデジタル構内交換機のシステム設
定データを設定することができるようにすることが可能
になる。
は保守装置１１６から保守者等により入力される。入力
されたデータは、中央演算装置１１１の指令により、保
守装置インターフェース１１５を介して主記憶装置１１
２に記憶される。また、主記憶装置１１２内に記憶され
ているデータは、保守装置１１６からの指示や定期的な
中央演算装置１１１の処理により、外部記憶装置インタ
ーフェース１１３を介して、磁気記憶装置等の外部記憶
装置１１４に記憶される。主記憶装置１１２に記憶され
たシステム設定のデータは、中央演算装置１１１の処理
により送信用ＡＴＭインターフェース回路３１１に送出
し、送信用ＡＴＭインターフェース回路３１１によりＡ
ＴＭ符号化されたデータをＡＴＭスイッチ５を介してス
レーブのデジタル構内交換機に転送する。このデータを
受信したスレーブのデジタル構内交換機は、前述の送信
側とは逆の手順でスレーブのデジタル構内交換機の主記
憶装置に記憶する。これにより、マスタのデジタル構内
交換機からスレーブのデジタル構内交換機のシステム設
定データを設定することができるようにすることが可能
になる。
【００２０】
【発明の効果】本発明は、以上説明したように構成され
ているので、以下に記載されるような効果を奏する。
ているので、以下に記載されるような効果を奏する。
【００２１】第１の効果は、回線数の多いデジタル構内
交換機を構成する場合、一般にマルチプロセッサ方式で
あるため、プロセッサ間のデータ通信を行うためのイン
ターフェース回路と、プロセッサ間のデータ通信用のバ
スと、それらを制御するための制御回路を必要としてお
り、システム構成は、シングルプロセッサ方式のデジタ
ル構内交換機と全く異なったシステム構成であるが、本
発明のマルチプロセッサ制御方式は、シングルプロセッ
サ方式のデジタル構内交換機に、ＡＴＭインターフェー
ス回路を追加することで、マルチプロセッサ方式のデジ
タル構内交換機を構成することができ、回路・装置構成
の簡易化を実現できることである。これは、従来のマル
チプロセッサ制御方式ではプロセッサ間通信専用のバス
を設けていたが、これをＡＴＭ符号化し、さらに音声デ
ータと多重化することで、マルチプロセッサ制御方式固
有の特殊なプロセッサ間バスとインターフェース回路を
必要としないためである。
交換機を構成する場合、一般にマルチプロセッサ方式で
あるため、プロセッサ間のデータ通信を行うためのイン
ターフェース回路と、プロセッサ間のデータ通信用のバ
スと、それらを制御するための制御回路を必要としてお
り、システム構成は、シングルプロセッサ方式のデジタ
ル構内交換機と全く異なったシステム構成であるが、本
発明のマルチプロセッサ制御方式は、シングルプロセッ
サ方式のデジタル構内交換機に、ＡＴＭインターフェー
ス回路を追加することで、マルチプロセッサ方式のデジ
タル構内交換機を構成することができ、回路・装置構成
の簡易化を実現できることである。これは、従来のマル
チプロセッサ制御方式ではプロセッサ間通信専用のバス
を設けていたが、これをＡＴＭ符号化し、さらに音声デ
ータと多重化することで、マルチプロセッサ制御方式固
有の特殊なプロセッサ間バスとインターフェース回路を
必要としないためである。
【００２２】第２の効果は、複数台のデジタル構内交換
機を接続することも可能になり、さらにＡＴＭを光ファ
イバーに収容することで、デジタル構内交換機間の距離
を長距離にすることが可能になるということである。こ
れは、光ファイバーは信号損失が極めて少ないためであ
り、またＡＴＭ信号方式は光ファイバーとの親和性が高
いためである。
機を接続することも可能になり、さらにＡＴＭを光ファ
イバーに収容することで、デジタル構内交換機間の距離
を長距離にすることが可能になるということである。こ
れは、光ファイバーは信号損失が極めて少ないためであ
り、またＡＴＭ信号方式は光ファイバーとの親和性が高
いためである。
【００２３】第３の効果は、マスタとなるデジタル構内
交換機に接続された保守装置から入力したシステム設定
データを、スレーブとなるデジタル構内交換機に転送す
ることで、マスタのデジタル構内交換機からすべてのシ
ステム設定が可能になるということである。これは、Ａ
ＴＭを介して、マスタのデジタル構内交換機の主記憶装
置に記憶されているシステム設定データをスレーブのデ
ジタル構内交換機の主記憶装置に転送することが可能に
なるためである。
交換機に接続された保守装置から入力したシステム設定
データを、スレーブとなるデジタル構内交換機に転送す
ることで、マスタのデジタル構内交換機からすべてのシ
ステム設定が可能になるということである。これは、Ａ
ＴＭを介して、マスタのデジタル構内交換機の主記憶装
置に記憶されているシステム設定データをスレーブのデ
ジタル構内交換機の主記憶装置に転送することが可能に
なるためである。
【図１】本発明の非同期転送モードを用いたマルチプロ
セッサ制御方式のデジタル構内交換機の一実施例を説明
するための接続方式のブロック図である。
セッサ制御方式のデジタル構内交換機の一実施例を説明
するための接続方式のブロック図である。
【図２】本発明のＡＴＭインターフェース部およびプロ
セッサ部のブロック図である。
セッサ部のブロック図である。
【図３】従来のマルチプロセッサ制御方式のデジタル交
換機の接続方式のブロック図である。
換機の接続方式のブロック図である。
【図４】従来のＡＴＭを使用したプロセッサ間接続方式
のブロック図である。
のブロック図である。
１ デジタル構内交換機（マスタ） ２，３，４ デジタル構内交換機（スレーブ） ５ ＡＴＭスイッチ １１，１２，１３，１４ プロセッサ部 ２１，２２，２３，２４ 時分割スイッチ ３１，３２，３３，３４ ＡＴＭインターフェース回
路 ４１，４２，４３，４４ 加入者回路 ５１，５２，５３，５４ 電話機（端末） ６１，６２，６３，６４ トランク回路 １１１ 中央演算装置 １１２ 主記憶装置 １１３ 外部記憶装置インターフェース回路 １１４ 外部記憶装置 １１５ 保守装置インターフェース １１６ 保守装置 ３１１ 送信用ＡＴＭインターフェース回路 ３２２ 受信用ＡＴＭインターフェース回路 ７１，７２，７３，７４，７５，７６ プロセッサ部 ８１，８２，８３，８４，８５，８６， プロセッサ間
バスインターフェース回路 ９１，９２，９３，９４ 時分割スイッチ ６ 空間分割スイッチ ７ プロセッサバス １００，１０１，１０２，１０ｎ プロセッサ ２００ ＡＴＭスイッチ
路 ４１，４２，４３，４４ 加入者回路 ５１，５２，５３，５４ 電話機（端末） ６１，６２，６３，６４ トランク回路 １１１ 中央演算装置 １１２ 主記憶装置 １１３ 外部記憶装置インターフェース回路 １１４ 外部記憶装置 １１５ 保守装置インターフェース １１６ 保守装置 ３１１ 送信用ＡＴＭインターフェース回路 ３２２ 受信用ＡＴＭインターフェース回路 ７１，７２，７３，７４，７５，７６ プロセッサ部 ８１，８２，８３，８４，８５，８６， プロセッサ間
バスインターフェース回路 ９１，９２，９３，９４ 時分割スイッチ ６ 空間分割スイッチ ７ プロセッサバス １００，１０１，１０２，１０ｎ プロセッサ ２００ ＡＴＭスイッチ
Claims (2)
- 【請求項１】 システム全体を制御するプロセッサ部、
音声およびデータを交換する時分割スイッチ、電話機等
の端末と時分割スイッチをインターフェースをする加入
者回路、レジスタ、センダ等のトランク回路、および、
例えば電話機の端末により構成され、単独に機能するｎ
台のシングルプロセッサ方式のデジタル構内交換機にお
いて、 第１のデジタル構内交換機の時分割スイッチのＰＣＭ音
声信号やデータ信号、およびプロセッサ部からの制御信
号をＡＴＭ符号化してＡＴＭスイッチに送出し、またＡ
ＴＭスイッチからのＡＴＭ符号化されたデータであるセ
ルをＰＣＭ音声信号やデータ信号および制御信号に複号
化し、ＰＣＭ音声信号やデータ信号は時分割スイッチに
送出し、制御信号はプロセッサ部に送出するＡＴＭイン
ターフェース回路を備え、第２のデジタル構内交換機も
第１のデジタル構内交換機と同様にＡＴＭインターフェ
ース回路を備え、第１のデジタル構内交換機と第２のデ
ジタル構内交換機を第１のデジタル構内交換機に搭載さ
れたＡＴＭスイッチを用いて接続することで構成するこ
とを特徴とする、非同期転送モードを用いたマルチプロ
セッサ制御方式のデジタル構内交換機。 - 【請求項２】 マスタのデジタル構内交換機となる第１
のデジタル構内交換機に、デジタル構内交換機の保守者
により入力されたシステムの設定を行うためのデータを
記憶する主記憶装置と、例えば磁気記憶装置の外部記憶
装置と、外部記憶装置と中央演算装置をインターフェー
スする外部記憶装置インターフェース回路と、中央演算
装置からのデータをＡＴＭ符号化してＡＴＭスイッチに
送出し、ＡＴＭスイッチからのセルを中央演算装置への
データに復号化して中央演算装置に送出するＡＴＭイン
ターフェース回路を備え、第２のデジタル構内交換機も
第１のデジタル構内交換機とＡＴＭスイッチを除いては
同じ構成であり、第１のデジタル構内交換機に記憶され
ているシステムの設定を行うデータを、ＡＴＭスイッチ
を用いて接続することで、マスタとなる第１のデジタル
構内交換機からスレーブとなる第２のデジタル構内交換
機のシステム設定を行える請求項１に記載の、非同期転
送モードを用いたマルチプロセッサ制御方式のデジタル
構内交換機。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7133654A JPH08331616A (ja) | 1995-05-31 | 1995-05-31 | 非同期転送モードを用いたマルチプロセッサ制御方式のデジタル構内交換機 |
| AU54547/96A AU703503B2 (en) | 1995-05-31 | 1996-05-27 | Digital PB exchanger with multi-processor control system using asynchronous transfer mode |
| CA002177781A CA2177781C (en) | 1995-05-31 | 1996-05-30 | Digital pb exchanger with multi-processor control system using asynchronous transfer mode |
| US08/657,769 US6009095A (en) | 1995-05-31 | 1996-05-31 | Digital PB exchanger with multi-processor control system using asynchronous transfer mode |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7133654A JPH08331616A (ja) | 1995-05-31 | 1995-05-31 | 非同期転送モードを用いたマルチプロセッサ制御方式のデジタル構内交換機 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08331616A true JPH08331616A (ja) | 1996-12-13 |
Family
ID=15109836
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7133654A Pending JPH08331616A (ja) | 1995-05-31 | 1995-05-31 | 非同期転送モードを用いたマルチプロセッサ制御方式のデジタル構内交換機 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US6009095A (ja) |
| JP (1) | JPH08331616A (ja) |
| AU (1) | AU703503B2 (ja) |
| CA (1) | CA2177781C (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US6724774B1 (en) | 1998-05-18 | 2004-04-20 | Nec Corporation | Subscriber access apparatus capable of adapting all of analog communication access network, ISDN access network and XDSL access network to ATM core network |
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| US6788703B2 (en) | 1998-12-30 | 2004-09-07 | Nortel Networks Limited | DS0 on ATM, mapping and handling |
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| US6778538B2 (en) | 1998-12-30 | 2004-08-17 | Nortel Networks Limited | Virtual junctors |
| CN1324841C (zh) * | 2003-09-23 | 2007-07-04 | 中兴通讯股份有限公司 | 数字信号处理方法及装置 |
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| JP2594918B2 (ja) * | 1986-09-16 | 1997-03-26 | 株式会社日立製作所 | 分散形交換システム |
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-
1995
- 1995-05-31 JP JP7133654A patent/JPH08331616A/ja active Pending
-
1996
- 1996-05-27 AU AU54547/96A patent/AU703503B2/en not_active Ceased
- 1996-05-30 CA CA002177781A patent/CA2177781C/en not_active Expired - Fee Related
- 1996-05-31 US US08/657,769 patent/US6009095A/en not_active Expired - Fee Related
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Also Published As
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|---|---|
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| CA2177781A1 (en) | 1996-12-01 |
| AU703503B2 (en) | 1999-03-25 |
| CA2177781C (en) | 2001-11-20 |
| US6009095A (en) | 1999-12-28 |
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